KR900004346Y1 - Compare and detecting syn circuit of maximum signal - Google Patents
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Abstract
내용 없음.No content.
Description
제1도는 본 고안의 회로도.1 is a circuit diagram of the present invention.
제2a-e도는 각부의 파형도.2a-e is a waveform diagram of each part.
* 도면의 주요부분에 대한 부호의 설명* Explanation of symbols for main parts of the drawings
10 : 펄스 발생기 20 : 블랭크펄스 처리부10 pulse generator 20 blank pulse processing unit
30 : 최대값 비교검출부 40 : 기준전압 조정부30: maximum value comparison detection unit 40: reference voltage adjustment unit
50 : 적분회로 60 : 제어회로50: integrating circuit 60: control circuit
1,2,3 : 입력단자 R1-R11: 저항1,2,3: Input terminal R 1 -R 11 : Resistance
VR1: 가변저항 Q1-Q7: 트랜지스터VR 1 : Variable resistor Q 1 -Q 7 : Transistor
C1-C3: 콘덴서 VCC : 전원C 1 -C 3 : Capacitor VCC: Power
본 고안은 최대값 신호의 비교 검출 합성 회로에 관한 것이다.The present invention relates to a comparison detection synthesis circuit of a maximum value signal.
비데오 카메라에 있어서 촬영 포인트의 조명 상태가 현저한 차이가 생기게 될때에는 화면의 입사광(전체적인 신호의 최대값)만으로 조리개 및 자동이득 조정회로가 제어되는 경우에 촬영 포인트의 색상 및 휘도 상태가 일정하지 않고 변해버리는 단점이 생기는 것이었다.When there is a significant difference in the lighting condition of the shooting point in the video camera, the color and brightness of the shooting point are not constant when the aperture and automatic gain adjustment circuit are controlled only by the incident light on the screen (maximum value of the overall signal). It was a disadvantage to throw away.
본 고안의 목적은 각각의 영상 신호의 최대치를 비교 검출하여 조리개 및 자동이득 조정회로가 제어될 수 있게 함으로서 촬영 포인트의 색상 및 휘도 상태를 일정하게 유지할수 있는 최대값 신호의 비교 검출 합성회로를 제공하고자 하는 것으로 입력 신호를 비교 검출하는 최대값 비교 검출부가 블랭킹 신호에 의하여 샘플링되는 입력 신호의 범위가 설정되게 구성하고 입력 신호의 기준 레벨을 제어하기 위한 기준전압 조정부를 연결시켜 된 것이다.An object of the present invention is to provide a comparison detection synthesis circuit of a maximum value signal that can maintain a constant color and luminance state of a shooting point by allowing the aperture and automatic gain adjustment circuit to be controlled by comparing and detecting the maximum value of each image signal. The maximum value comparison detection unit for comparing and detecting the input signal is configured such that the range of the input signal sampled by the blanking signal is set, and the reference voltage adjustment unit for controlling the reference level of the input signal is connected.
이를 첨부 도면에 의하여 상세히 설명하면 다음과 같다.This will be described in detail with reference to the accompanying drawings.
제1도에서 펄스발생기(10)에 연결된 콘덴서(C1)가 트랜지스터(Q1-Q3)의 베이스측에 연결됨과 동시에 저항(R6-R8)을 통하여 저항(R9)이 연결되어 서로 공접된 트랜지스터(Q1-Q3)의 에미터측에 연결되고 트랜지스터(Q1-Q3)의 콜렉터측이 저항(R1-R3)을 통한 입력단자(1-3)와 트랜지스터(Q4-Q6)의 베이스측에 연결되게 블랭크펄스(BLANK PULSE)처리부(20)를 구성한 후 콜렉터측이 전원(VCC)에 연결된 트랜지스터(Q4-Q6)의 에미터측이 저항(R10)(R11)과 트랜지스터(Q7)의 에미터측에 연결되게 최대값 비교검출부(30)를 구성한다.In FIG. 1, the capacitor C 1 connected to the pulse generator 10 is connected to the base side of the transistors Q 1- Q 3 , and at the same time, the resistor R 9 is connected through the resistors R 6- R 8 . It is connected to the emitter side of the transistors Q 1 -Q 3 which are in common with each other, and the collector side of the transistors Q 1 -Q 3 is connected to the input terminals 1-3 and Q through the resistors R 1 -R 3 . After configuring the blank pulse processing unit 20 to be connected to the base side of 4 -Q 6 ), the emitter side of the transistor Q 4 -Q 6 connected to the collector VCC is connected to the resistor R 10 . The maximum value comparison detection unit 30 is configured to be connected to the emitter side of the transistor R 11 and the transistor Q 7 .
그리고 콜렉터측이 전원(VCC)에 연결된 트랜지스터(Q7)의 베이스측이 콘덴서(C2)와 가변저항(VR1)저항(R4)(R5)을 통하여 전원(VCC)에 연결되게 기준전압조정부(40)를 구성하고 트랜지스터(Q7)의 에미터측이 저항(R1)과 콘덴서(C3)로 구성된 적분회로(50)를 통하여 제어회로(60)에 연결되게 구성한 것이다.The base side of the transistor Q 7 having the collector side connected to the power supply VCC is connected to the power supply VCC through the capacitor C 2 and the variable resistor VR 1 resistor R 4 and R 5 . The voltage adjusting unit 40 is configured and the emitter side of the transistor Q 7 is connected to the control circuit 60 through an integrating circuit 50 composed of a resistor R 1 and a capacitor C 3 .
또한 제2a-e도는 제1도의 각부의 파형도이다.2a-e is a waveform diagram of each part of FIG.
이와같이 구성된 본 고안의 작용 효과를 설명하면 다음과 같다.Referring to the effects of the present invention configured as described above are as follows.
펄스발생기(10)가 제2d도와 같은 「L라벨」의 블랭크 펄스가 트랜지스터(Q1-Q3)의 베이스측에 인가되면 트랜지스터(Q1-Q3)가 "턴오프"되기 때문에 입력단자(1-3)에 인가된 제2a-c도와 같은 적,녹,청의 영상신호 전압이 트랜지스터(Q4-Q6)의 베이스측에 인가된다.A pulse generator (10), since the blank when the pulse of "L label" such 2d help applied to the base side of the transistor (Q 1 -Q 3) transistor (Q 1 -Q 3) a "turn-off" input terminals ( The video signal voltages of red, green, and blue shown in Figs. 2a-c applied to 1-3 are applied to the base side of the transistors Q 4 -Q 6 .
여기서 입력단자(1)에 인가된 제2a도와 같은 적의 영상신호 전압이 다른 신호에 비하여 최대일 경우에는 트랜지스터(Q4)가 "턴온"되어 전원(VCC)이 적의영상신호와 함께 트랜지스터(Q4)를 통하여 접점(E)에 인가되며 트랜지스터(Q5)(Q6)에는 역방향 바이어스가 가하여지므로 트랜지스터(Q5)(Q6)는 "턴오프"된다.Here, when the red video signal voltage applied to the input terminal 1, as shown in FIG. 2a, is maximum compared to the other signals, the transistor Q 4 is "turned on" so that the power supply VCC is coupled with the red video signal to the transistor Q 4. Is applied to the contact point E through the transistor and the reverse bias is applied to the transistors Q 5 and Q 6 so that the transistors Q 5 and Q 6 are " turned off ".
또한 다음순간 입력단자(2)에 인가된 제2b도와 같은 녹의 영상신호 전압이 다른 신호에 비하여 최대일 경우에는 트랜지스터(Q5)가 "턴온"되어 전원(VCC)이 녹의 영상신호와 함께 트랜지스터(Q5)를 통하여 접점(E)에 인가되며 트랜지스터(Q4)(Q6)에는 역방향 바이어스가 가하여지므로 트랜지스터(Q4)(Q6)는 "턴오프"되고 입력단자에 인가된 제2c도와 같은 청의 영상 신호전압이 다른 신호에 비하여 최대일 경우에도 위와같은 전원(VCC)이 청의 영상 신호와 함께 트랜지스터(Q6)를 통하여 접점(E)에 인가된 후 접점(E)에 인가된 제2a-c도와 같은 적,녹,청의 영상 신호가 비교합성되어 제2e도와 같은 파형이 발생됨으로서 샘플링되는 입력신호의 범위가 설정되는 것이다.In addition, when the green video signal voltage applied to the input terminal 2 at the next instant is the maximum value compared to the other signals, the transistor Q 5 is "turned on" so that the power supply VCC is connected with the green video signal. applied to the contact point (E) through Q 5) and a transistor (Q 4) (Q 6) is so added that a reverse bias transistor (Q 4) (Q 6) is "off" the first 2c help applied to the input terminal Even when the image signal voltage of the same blue is maximum compared to other signals, the above-described power supply VCC is applied to the contact point E through the transistor Q 6 together with the blue image signal and then applied to the contact point E. The red, green, and blue video signals, such as -c, are compared and synthesized to generate a waveform, such as 2e, to set the range of the input signal to be sampled.
그리고 고정저항(Q4)(Q5)과 가변저항(VR1)의 조정에 의하여 전원(VCC)이 트랜지스터(Q7)의 베이스축에 인가되어 트랜지스터(Q7)를 "턴온"시킴에 따라 전원(VCC)이 트랜지스터(Q7)를 통하여 접점(E)에 인가됨으로써 제2e도와 같은 합성된 신호의 기준전압 레벨이 조정된 후 기준전압 레벨이 조정된 신호가 저항(R11)과 콘덴서(C3)의 시정수에 의하여 제어회로(60)에 일정하게 공급되어 조리개 및 자동이득 조정 회로가 제어됨으로서 비데오 카메라의 촬영포인트의 색상 및 휘도 상태가 일정하게 유지될 수 있는 것이며 이때 콘덴서(C2)는 직류 변환용이다.The power supply VCC is applied to the base axis of the transistor Q 7 by the adjustment of the fixed resistor Q 4 and Q 5 and the variable resistor VR 1 to turn on the transistor Q 7 . Since the power supply VCC is applied to the contact point E through the transistor Q 7 , the reference voltage level of the synthesized signal as shown in FIG. 2E is adjusted, and then the signal whose reference voltage level is adjusted is a resistor R 11 and a capacitor ( C 3) is constantly supplied to the control circuit 60 by the time constant will have the color and the brightness state of an iris and an automatic gain adjustment circuit shooting point of the video camera by being controlled to be kept constant in this case a capacitor (C 2 ) Is for DC conversion.
그러나 펄스 발생기가 제2d도와 같은 「H레벨」의 블랭크 펄스가 트랜지스터(Q1-Q3)의 베이스측과 저항(R6-R8)을 통한 트랜지스터(Q1-Q3)의 에미터측에 인가되면 트랜지스터(Q1-Q3)의 베이스축과 에미터측에 전위차가 발생되어 트랜지스터(Q1-Q3)가 "턴온"됨으로서 입력단자(1-3)에 인가된 제2a-c도와 같은 적,녹,청의 영상신호의 큰 전압이 저항(R1-R3)과 트랜지스터(Q1-Q3) 및 저항(R9)을 통하여 접지로 흐르게되고 트랜지스터(Q4-Q6)의 베이스측에는 영상신호의 적은 전압이 인가되므로 트랜지스터(Q4-Q6)가 "턴오프"되어 제2e도와 같이 적,녹,청의 영상 신호의 귀선소거 신호가 제공됨으로서 불필요한 각각의 영상신호가 제거될 수 있는 것이다.However, the pulse generator to the emitter teocheuk of the base side and the resistance (R 6 -R 8) transistors (Q 1 -Q 3) through 2d of the blank of "H level", the same pulse to help the transistors (Q 1 -Q 3) When applied, a potential difference is generated between the base axis of the transistors Q 1 -Q 3 and the emitter side, so that the transistors Q 1 -Q 3 are "turned on", such as those of 2a-c applied to the input terminals 1-3. The large voltage of the red, green, and blue video signals flows to ground through the resistors R 1 -R 3 , the transistors Q 1 -Q 3 , and the resistors R 9 , and the base of the transistors Q 4 -Q 6 . Since a small voltage of the video signal is applied to the side, the transistors Q 4 -Q 6 are “turned off” so that the redundancy signal of the red, green, and blue video signals is provided as shown in FIG. It is.
따라서 펄스발생기(10)의 블랭크 펄스가 「L라벨」로 되면 블랭크 펄스처리부(20)의 제어 작용이 정지됨으로서 제2a-c도와 같은 적,녹,청의 영상 신호가 최대값 비교검출부(30)를 통하여 비교되어 합성되며 제2e도와 같이 합성된 신호는 기준전압 조정부(40)에 의하여 기준 전압이 조정되고, 적분회로(50)의 시정수에 의하여 제어회로(60)에 공급됨으로서 비데오 카메라의 촬영포인트의 색상 및 휘도 상태가 일정하게 유지될 수 있는 것이다.Therefore, when the blank pulse of the pulse generator 10 becomes "L label", the control operation of the blank pulse processing unit 20 is stopped, so that the red, green, and blue video signals as shown in 2a-c degrees may cause the maximum value comparison detection unit 30 to stop. The synthesized signal is compared and synthesized as shown in FIG. 2E. The reference voltage is adjusted by the reference voltage adjusting unit 40 and supplied to the control circuit 60 by the time constant of the integrating circuit 50. The color and luminance state of can be kept constant.
그러나 펄스발생기(10)의 블랭크 펄스 「H레벨」로 되면 제2a-c도와 같은 적,녹,청의 영상 신호가 블랭킹펄스처리부(20)를 통하여 접지로 흐르게 되므로 최대값 비교검출부(30)의 작용이 정지되어 제2e도와 같이 적,녹,청의 영상 신호의 귀선소거 신호가 제공됨으로서 불필요한 각각의 영상 신호가 제거될 수 있는 것으로 본 고안은 비데오 카메라와 텔레비젼 수상기의 자동 이득 조절 회로에 실시될 수 있는 것이다.However, when the blank pulse "H level" of the pulse generator 10 becomes a red, green, and blue video signal as shown in the 2a-c degree flows to the ground through the blanking pulse processing unit 20, the operation of the maximum value comparison detection unit 30 This stop can be provided by the blanking signal of the red, green, and blue video signal as shown in Figure 2e can be eliminated each unnecessary video signal can be implemented in the automatic gain control circuit of video cameras and television receivers will be.
이상에서와 같이 본 고안은 적,녹,청의 영상 신호가 펄스발생기가 연결되어 트랜지스터와 저항으로 구성된 블랭크 신호 처리부에 의하여 제어되고 트랜지스터로 구성된 최대값 비교 검출부를 통하여 비교 합성된 후 합성된 신호의 기준 전압이 가변 저항과 트랜지스터에 의하여 조정되며 기준 전압이 조정된 합성신호가 적분회로의 시정수에 의하여 제어회로에 공급되게 구성한 것으로 비데오 카메라의 경우에 있어서 필요한 화면의 입사광만을 샘플링 함으로서 주위 배경과 조화되는 촬영 화면이 얻어질 수 있는 효과가 있는 것이다.As described above, the present invention is based on a signal synthesized after the red, green, and blue video signals are controlled by a blank signal processor consisting of a transistor and a resistor connected to a pulse generator and compared and synthesized through a maximum value comparison detector composed of transistors. The voltage is controlled by the variable resistor and the transistor, and the synthesized signal whose reference voltage is adjusted is supplied to the control circuit by the time constant of the integrating circuit. In the case of the video camera, only the incident light of the screen required is harmonized with the surrounding background The shooting screen has an effect that can be obtained.
Claims (1)
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR2019870012265U KR900004346Y1 (en) | 1987-07-27 | 1987-07-27 | Compare and detecting syn circuit of maximum signal |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR2019870012265U KR900004346Y1 (en) | 1987-07-27 | 1987-07-27 | Compare and detecting syn circuit of maximum signal |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| KR890003896U KR890003896U (en) | 1989-04-14 |
| KR900004346Y1 true KR900004346Y1 (en) | 1990-05-19 |
Family
ID=19265710
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| KR2019870012265U KR900004346Y1 (en) | 1987-07-27 | 1987-07-27 | Compare and detecting syn circuit of maximum signal |
Country Status (1)
| Country | Link |
|---|---|
| KR (1) | KR900004346Y1 (en) |
-
1987
- 1987-07-27 KR KR2019870012265U patent/KR900004346Y1/en not_active IP Right Cessation
Also Published As
| Publication number | Publication date |
|---|---|
| KR890003896U (en) | 1989-04-14 |
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