KR830008237A - 송신 언더런상의 자동 어보트를 갖는 통신 서브씨 전송 언더런상의 자동 어보트를 갖는 통신 서브씨스템 - Google Patents

송신 언더런상의 자동 어보트를 갖는 통신 서브씨 전송 언더런상의 자동 어보트를 갖는 통신 서브씨스템 Download PDF

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KR830008237A
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오· 홀티 토마스
피· 켈리 리챠드
에스 ·노이즈 스트븐
시· 래이몬드 제임즈
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니콜라스 프레지노스
허니웰 인포오메이숀 시스템스 인코오포레이티드
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Abstract

내용 없음

Description

송신 언더런시에 자동 어보트를 갖는 통신 서브시스템
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제 2 도는 통신 서브시스템의 블록 다이어그램.
제 3 도는 전송 언더 로직의 상세한 논리 다이어그램.
제 4 도는 어보트 비트를 발생하기 위한 로직의 타이밍 다이어그램.

Claims (5)

  1. 써스템버스, 공동으로 써스템버스에 결합되어 있는 중앙처리유닛(CPU), 메인메모리, 주변제어기로 구성되며, 통신서브씨스템이 씨스템버스에 결합되고 변복조장치, 다이얼링 유닛, 터치-토운 수신기 등을 포함하는 데이터 처리씨스템에 있어서, 데이터처리 씨스템에 의해 메시지를 수신하고 전송하는 것을 제어하기 위한 통신 제어기, 메인메모리로부터 정보의 데이터 바이트를 수신하여 처리하기 위한 메인메모리에 결합된 마이크로프로세서, 마이크로프로세서로부터 정보의 데이터바이트를 수신하기 위해 마이크로프로세서에 결합되고 마이크로프로세서가 예정된 시간간격내에서 USRT에 데이터 바이트를 전송하지 못할때 언더런 신호를 발생하는 유니버설 동기화 수신기 전송기(USRT), 등으로 구성됨을 특지응로 하는 전송언더런상의 자동 어보트를 갖는 통신 서브 씨스템.
  2. 마이크로프로세서로부터 수신된 데이터 바이트를 기억하고 통신장치중 선택된 장치에 직렬로 데이터 바이트를 전송하기 위해 USRT에서 제1레지스터를 포함하는 제1항에 따르는 데이터처리 씨스템.
  3. URST 에 결합되고 제1예정신호를 발생하기 위해 언더런신호에 반응하는 제2항에 따르는 데이터처리 씨스템.
  4. URST가 언더런 신호에 반응하는 플랙바이트 신호를 발생하고 플랙바이트 신호위에 예정된 신호를 첨가하기 위해 시프트 레지스터에 결합된 제1장치를 포함하는 제3항에 따르는 장치.
  5. 제1장치계 시프트 레지스터에 입력단자가 계합된 AND게이트와 AND 게이트에 결합된 OR 게이트를 포함하는 제4항에 따르는 데이터 처리 씨스템.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019810003775A 1980-10-06 1981-10-06 송신 언더런시에 자동 어보트를 갖는 통신 서브시스템 KR860000983B1 (ko)

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US06/194,655 US4418384A (en) 1980-10-06 1980-10-06 Communication subsystem with an automatic abort transmission upon transmit underrun
US194655 1988-05-16

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KR830008237A true KR830008237A (ko) 1983-11-16
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BR (1) BR8106415A (ko)
CA (1) CA1163342A (ko)
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