KR20230033142A - 표시 장치 - Google Patents

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Abstract

일 실시예에 따른 표시 장치는 영상을 표시하는 복수의 화소들을 포함하는 표시 패널, 상기 표시 패널에서 센싱된 복수의 피드백 전압들을 기초로 상기 표시 패널을 구동하기 위한 구동 전압을 생성하는 패널 구동부 및 상기 복수의 화소들과 연결되어 상기 복수의 피드백 전압들을 각각 센싱하고 센싱된 상기 복수의 피드백 전압들을 상기 패널 구동부에 각각 제공하는 복수의 센싱 라인들을 포함하고, 상기 패널 구동부는 상기 복수의 피드백 전압들의 평균에 해당하는 평균 피드백 전압을 생성하고 상기 평균 피드백 전압을 기초로 상기 구동 전압을 생성한다.

Description

표시 장치 {DISPLAY DEVICE}
본 발명은 표시 장치에 관한 것으로, 상세하게는 표시 영역의 전체적인 표시품질이 개선된 표시 장치에 관한 것이다.
표시 장치는 영상을 표시하는 표시 패널, 외부 입력을 감지하는 입력감지유닛, 및 전자 모듈과 같이 다양한 전자 부품들로 구성된 장치일 수 있다. 전자 부품들은 다양하게 배열된 신호 라인들에 의해 전기적으로 서로 연결될 수 있다. 표시 패널은 복수 개의 화소들을 포함한다. 복수 개의 화소들 각각은 광을 생성하는 발광 소자 및 발광 소자로 흐르는 전류량을 제어하는 회로부를 포함한다.
화소 내 회로부에서 누설 전류가 생기는 경우, 발광 소자를 통해 흐르는 전류량에 변화가 생겨서 표시품질이 저하될 수 있다.
본 발명은 표시 패널의 휘도 편차를 줄이고 표시품질을 개선할 수 있는 표시장치를 제공하는 것을 목적으로 한다.
일 실시예에 따른 표시 장치는 영상을 표시하는 복수의 화소들을 포함하는 표시 패널, 상기 표시 패널에서 센싱된 복수의 피드백 전압들을 기초로 상기 표시 패널을 구동하기 위한 구동 전압을 생성하는 패널 구동부 및 상기 복수의 화소들과 연결되어 상기 복수의 피드백 전압들을 각각 센싱하고 센싱된 상기 복수의 피드백 전압들을 상기 패널 구동부에 각각 제공하는 복수의 센싱 라인들을 포함하고, 상기 패널 구동부는 상기 복수의 피드백 전압들의 평균에 해당하는 평균 피드백 전압을 생성하고 상기 평균 피드백 전압을 기초로 상기 구동 전압을 생성한다.
상기 패널 구동부는 소스 제어 신호 및 게이트 제어 신호를 생성하고, 외부에서 수신한 영상 신호를 토대로 영상 데이터를 생성하는 컨트롤러, 상기 영상 데이터 및 상기 소스 제어 신호를 수신하고, 상기 영상 데이터를 토대로 데이터 신호를 생성하여 상기 표시 패널에 송신하는 데이터 구동부 및 복수의 스캔 라인들을 포함하고, 상기 게이트 제어 신호를 토대로 생성한 스캔 신호를 상기 표시 패널에 상기 복수의 스캔 라인들을 통하여 순차적으로 송신하는 스캔 구동부를 포함할 수 있다.
상기 복수의 화소들은 상기 패널 구동부에서 가장 멀리 배치된 복수의 상측 화소들 및 상기 패널 구동부에서 가장 가깝게 배치된 복수의 하측 화소들을 포함하고, 상기 복수의 센싱 라인들은, 상기 복수의 상측 화소들에 연결된 복수의 상측 센싱 라인들 및 상기 복수의 하측 화소들에 연결된 복수의 하측 센싱 라인들을 포함할 수 있다.
상기 상측 화소들은 제1 방향에서 서로 가장 멀리 배치된 제1 상측 화소 및 제2 상측 화소를, 상기 하측 화소들은 상기 제1 방향에서 서로 가장 멀리 배치된 제1 하측 화소 및 제2 하측 화소를 포함하고, 상기 복수의 상측 센싱 라인들은 상기 제1 상측 화소에 연결된 제1 상측 센싱 라인 및 상기 제2 상측 화소에 연결된 제2 상측 센싱 라인을 포함하고, 상기 복수의 하측 센싱 라인들은 상기 제1 하측 화소에 연결된 제1 하측 센싱 라인 및 상기 제2 하측 화소에 연결된 제2 하측 센싱 라인을 포함할 수 있다.
상기 복수의 피드백 전압들은 상기 제1 상측 센싱 라인에서 센싱되는 제1 상측 피드백 전압, 상기 제2 상측 센싱 라인에서 센싱되는 제2 상측 피드백 전압, 상기 제1 하측 센싱 라인에서 센싱되는 제1 하측 피드백 전압, 및 상기 제2 하측 센싱 라인에서 센싱되는 제2 하측 피드백 전압을 포함할 수 있다.
상기 평균 피드백 전압은 상기 제1 상측 피드백 전압과 상기 제2 상측 피드백 전압의 평균인 상측 평균 피드백 전압 및 상기 제1 하측 피드백 전압과 상기 제2 하측 피드백 전압의 평균인 하측 평균 피드백 전압을 포함할 수 있다.
스캔 신호의 스캔 방향을 따라 한 프레임을 기준으로 상기 상측 평균 피드백 전압과 상기 하측 평균 피드백 전압의 사이에서 선형적으로 증가할 수 있다.
상기 패널 구동부는 휘도 보상부를 더 포함하고 상기 휘도 보상부는 상기 복수의 센싱 라인들로부터 수신한 상기 복수의 피드백 전압들의 평균을 산출하여 상기 평균 피드백 전압을 생성하는 피드백 전압 생성부 및 상기 평균 피드백 전압을 기초로 상기 구동 전압을 생성하는 구동 전압 생성부를 포함할 수 있다.
상기 휘도 보상부는 보상 전압 생성부를 더 포함하고, 상기 보상 전압 생성부는 생성된 상기 구동 전압을 기초로 보상 전압을 생성하고 상기 표시 패널에 인가할 수 있다.
상기 보상 전압은 상기 스캔 신호에 따라서 상기 구동 전압과 일정한 전압 갭(gap)을 유지하면서 선형적으로 변화할 수 있다.
상기 복수의 스캔 라인들 중 n번째 스캔 라인에서의 상기 구동 전압은 아래 수학식으로 결정될 수 있다.
[수학식]
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상기 표시 패널에 인가되는 상기 구동 전압은 상기 패널 구동부에서 가장 가까운 상기 표시 패널의 하측으로부터 상기 패널 구동부에서 멀어지는 상기 표시 패널의 상측으로 갈수록 선형적으로 감소할 수 있다.
상기 표시 패널의 상기 복수의 하측 화소들에 인가되는 상기 구동 전압은 상기 표시 패널의 상기 복수의 상측 화소들에 인가되는 상기 구동 전압보다 클 수 있다.
일 실시예에 따른 표시 장치는 영상을 표시하는 복수의 화소들을 포함하는 표시 패널, 상기 복수의 화소들에 인가된 초기 구동 전압을 기초로 복수의 피드백 전압들을 센싱하는 복수의 센싱 라인들 및 상기 복수의 피드백 전압들을 기초로 상기 표시 패널을 구동하기 위한 구동 전압을 생성하는 패널 구동부를 포함하고, 상기 복수의 화소들은 상기 초기 구동 전압의 인가 방향에서 가장 먼 상기 표시 패널의 상측에 배치된 복수의 상측 화소들 및 상기 초기 구동 전압의 인가 방향에서 가장 가까운 상기 표시 패널의 하측에 배치된 복수의 하측 화소들을 포함하고, 상기 구동 전압은 상기 표시 패널의 상기 하측으로부터 상기 표시 패널의 상기 상측으로 갈수록 선형적으로 감소할 수 있다.
상기 피드백 전압은 상기 복수의 상측 화소들에서 센싱된 상측 피드백 전압들 및 상기 복수의 하측 화소들에서 센싱된 하측 피드백 전압들을 포함하고, 상기 패널 구동부는 상기 상측 피드백 전압들의 평균을 산출하여 상측 평균 피드백 전압을 생성하고 상기 하측 피드백 전압들의 평균을 산출하여 하측 평균 피드백 전압을 생성할 수 있다.
상기 구동 전압은 한 프레임 내에서 스캔 방향을 따라 최소 상기 상측 평균 피드백 전압으로부터 최대 상기 하측 평균 피드백 전압까지 선형적으로 증가할 수 있다.
상기 패널 구동부는 상기 표시 패널의 상기 상측과 상기 표시 패널의 상기 하측 사이의 휘도의 차이를 보상하는 휘도 보상부를 포함하고, 상기 휘도 보상부는 상기 구동 전압을 기초로 상기 구동 전압과 일정한 전압 갭(gap)을 유지하면서 상기 표시 패널의 상기 하측으로부터 상기 상측으로 갈수록 감소하는 보상 전압을 생성할 수 있다.
상기 구동 전압은 한 프레임을 기준으로 상기 상측 화소들의 제1 스캔 구간에서 상기 하측 화소들의 제2 스캔 구간까지 선형적으로 증가하고, 상기 제1 스캔 구간에서 상기 제2 스캔 구간의 한 프레임 구간의 상기 증가는 매 프레임에서 반복될 수 있다.
상기 복수의 센싱 라인들은 상기 복수의 상측 화소들에 연결된 상측 센싱 라인 및 상기 복수의 하측 화소들에 연결된 하측 센싱 라인을 포함할 수 있다.
상기 표시 패널은 영상을 표시하는 표시 영역 및 상기 표시 영역에 인접한 비표시 영역을 포함하고, 상기 복수의 상측 화소들 및 상기 복수의 하측 화소들은 상기 표시 영역에 배치되고, 상기 상측 센싱 라인 및 상기 하측 센싱 라인은 상기 비표시 영역에 배치될 수 있다.
본 발명의 실시예에 따르면, 일 실시예에 따른 표시 장치는 피드백 전압을 기초로 선형적으로 변화하는 구동 전압을 표시 패널에 인가하여, 표시 장치의 전체적인 휘도 편차를 감소시킬 수 있다.
도 1은 본 발명의 일 실시예에 따른 표시 장치의 사시도이다.
도 2는 본 발명의 일 실시예에 따른 표시 장치의 분해 사시도이다.
도 3은 본 발명의 일 실시예에 따른 표시 장치의 블럭도이다.
도 4은 본 발명의 일 실시예에 따른 화소의 등가회로도이다.
도 5는 본 발명의 일 실시예에 따른 표시 장치의 평면도이다.
도 6은 본 발명의 일 실시예에 따른 휘도 보상부의 블록도이다.
도 7은 본 발명의 일 실시예에 따른 보상 전압을 보여주는 그래프이다.
도 8은 본 발명의 일 실시예에 따른 구동 전압을 보여주는 그래프이다.
도 9는 본 발명의 일 실시예에 따른 표시 장치의 구동 방법을 보여주는 흐름도이다.
도 10은 본 발명의 다른 일 실시예에 따른 보상 전압을 보여주는 그래프이다.
도 11은 본 발명의 다른 일 실시예에 따른 보상 전압을 보여주는 그래프이다.
본 명세서에서, 어떤 구성요소(또는 영역, 층, 부분 등)가 다른 구성요소 “상에 있다”, “연결된다”, 또는 “결합된다”고 언급되는 경우에 그것은 다른 구성요소 상에 직접 배치/연결/결합될 수 있거나 또는 그들 사이에 제3의 구성요소가 배치될 수도 있다는 것을 의미한다.
동일한 도면부호는 동일한 구성요소를 지칭한다. 또한, 도면들에 있어서, 구성요소들의 두께, 비율, 및 치수는 기술적 내용의 효과적인 설명을 위해 과장된 것이다. “및/또는”은 연관된 구성요소들이 정의할 수 있는 하나 이상의 조합을 모두 포함한다.
제1, 제2 등의 용어는 다양한 구성요소들을 설명하는데 사용될 수 있지만, 상기 구성요소들은 상기 용어들에 의해 한정되어서는 안 된다. 상기 용어들은 하나의 구성요소를 다른 구성요소로부터 구별하는 목적으로만 사용된다. 예를 들어, 본 발명의 권리 범위를 벗어나지 않으면서 제1 구성요소는 제2 구성요소로 명명될 수 있고, 유사하게 제2 구성요소도 제1 구성요소로 명명될 수 있다. 단수의 표현은 문맥상 명백하게 다르게 뜻하지 않는 한, 복수의 표현을 포함한다.
또한, “아래에”, “하측에”, “위에”, “상측에” 등의 용어는 도면에 도시된 구성요소들의 연관관계를 설명하기 위해 사용된다. 상기 용어들은 상대적인 개념으로, 도면에 표시된 방향을 기준으로 설명된다.
"포함하다" 또는 "가지다" 등의 용어는 명세서 상에 기재된 특징, 숫자, 단계, 동작, 구성요소, 부품 또는 이들을 조합한 것이 존재함을 지정하려는 것이지, 하나 또는 그 이상의 다른 특징들이나 숫자, 단계, 동작, 구성요소, 부품 또는 이들을 조합한 것들의 존재 또는 부가 가능성을 미리 배제하지 않는 것으로 이해되어야 한다.
다르게 정의되지 않는 한, 본 명세서에서 사용된 모든 용어 (기술 용어 및 과학 용어 포함)는 본 발명이 속하는 기술 분야의 당업자에 의해 일반적으로 이해되는 것과 동일한 의미를 갖는다. 또한, 일반적으로 사용되는 사전에서 정의된 용어와 같은 용어는 관련 기술의 맥락에서 갖는 의미와 일치하는 의미를 갖는 것으로 해석되어야 하고, 여기서 명시적으로 정의되지 않는 한 너무 이상적이거나 지나치게 형식적인 의미로 해석되어서는 안된다.
이하, 도면을 참조하여 본 발명의 실시예들을 설명한다.
도 1은 본 발명의 일 실시예에 따른 표시 장치의 사시도이고, 도 2는 본 발명의 일 실시예에 따른 표시 장치의 분해 사시도이다.
도 1 및 도 2를 참조하면, 표시 장치(DD)는 전기적 신호에 따라 활성화되는 장치일 수 있다. 본 발명에 따른 표시 장치(DD)는 텔레비전, 모니터 등과 같은 대형 표시 장치를 비롯하여, 휴대 전화, 태블릿, 노트북, 자동차 내비게이션, 게임기 등과 같은 중소형 표시 장치일 수 있다. 이것들은 단지 실시예로서 제시된 것들로서, 본 발명의 개념에서 벗어나지 않은 이상 다른 형태의 표시 장치를 포함할 수 있음은 물론이다. 표시 장치(DD)는 제1 방향(DR1)으로 장변을 갖고, 제1 방향(DR1)과 교차하는 제2 방향(DR2)으로 단변을 갖는 직사각형 형상을 갖는다. 그러나, 표시 장치(DD)의 형상은 이에 한정되지 않고, 다양한 형상의 표시 장치(DD)가 제공될 수 있다. 표시 장치(DD)는 제1 방향(DR1) 및 제2 방향(DR2) 각각에 평행한 표시면(IS)에 제3 방향(DR3)을 향해 영상(IM)을 표시할 수 있다. 영상(IM)이 표시되는 표시면(IS)은 표시 장치(DD)의 전면(front surface)과 대응될 수 있다.
본 실시예에서는 영상(IM)이 표시되는 방향을 기준으로 각 부재들의 전면(또는 상면)과 배면(또는 하면)이 정의된다. 전면과 배면은 제3 방향(DR3)에서 서로 대향(opposing)되고, 전면과 배면 각각의 법선 방향은 제3 방향(DR3)과 평행할 수 있다.
제3 방향(DR3)에서의 전면과 배면 사이의 이격 거리는 표시 장치(DD)의 제3 방향(DR3)에서의 두께와 대응될 수 있다. 한편, 제1 내지 제3 방향들(DR1, DR2, DR3)이 지시하는 방향은 상대적인 개념으로서 다른 방향으로 변환될 수 있다.
표시 장치(DD)는 외부에서 인가되는 외부 입력을 감지할 수 있다. 외부 입력은 표시 장치(DD)의 외부에서 제공되는 다양한 형태의 입력들을 포함할 수 있다. 본 발명의 일 실시예에 따른 표시 장치(DD)는 외부에서 인가되는 사용자의 외부 입력을 감지할 수 있다. 사용자의 외부 입력은 사용자 신체의 일부, 광, 열, 시선, 또는 압력 등 다양한 형태의 외부 입력들 중 어느 하나 또는 그들의 조합일 수 있다. 또한, 표시 장치(DD)는 표시 장치(DD)의 구조에 따라 표시 장치(DD)의 측면이나 배면에 인가되는 사용자의 외부 입력을 감지할 수도 있으며, 어느 하나의 실시예로 한정되지 않는다. 본 발명의 일 예로, 외부 입력은 입력 장치(예를 들어, 스타일러스 펜, 액티브 펜, 터치 펜, 전자 펜, e-펜 등)에 의한 입력 등을 포함할 수도 있다.
표시 장치(DD)의 표시면(IS)은 표시 영역(DA) 및 비표시 영역(NDA)으로 구분될 수 있다. 표시 영역(DA)은 영상(IM)이 표시되는 영역일 수 있다. 사용자는 표시 영역(DA)을 통해 영상(IM)을 시인한다. 본 실시예에서, 표시 영역(DA)은 꼭지점들이 둥근 사각 형상으로 도시되었다. 다만, 이는 예시적으로 도시한 것이고, 표시 영역(DA)은 다양한 형상을 가질 수 있으며, 어느 하나의 실시예로 한정되지 않는다.
비표시 영역(NDA)은 표시 영역(DA)에 인접한다. 비표시 영역(NDA)은 소정의 컬러를 가질 수 있다. 비표시 영역(NDA)은 표시 영역(DA)을 에워쌀 수 있다. 이에 따라, 표시 영역(DA)의 형상은 실질적으로 비표시 영역(NDA)에 의해 정의될 수 있다. 다만, 이는 예시적으로 도시한 것이고, 비표시 영역(NDA)은 표시 영역(DA)의 일 측에만 인접하여 배치될 수도 있고, 생략될 수도 있다. 본 발명의 일 실시예에 따른 표시 장치(DD)는 다양한 실시예들을 포함할 수 있으며, 어느 하나의 실시예로 한정되지 않는다.
도 2에 도시된 바와 같이, 표시 장치(DD)는 표시 모듈(DM) 및 표시 모듈(DM) 상에 배치된 윈도우(WM)를 포함할 수 있다. 표시 모듈(DM)은 표시 패널(DP) 및 입력 감지층(ISP)을 포함할 수 있다.
본 발명의 일 실시예에 따른 표시 패널(DP)은 발광형 표시 패널일 수 있다. 그 일 예로 표시 패널(DP)은 유기 발광 표시 패널, 무기 발광 표시 패널 또는 퀀텀닷(quantum dot) 발광 표시 패널일 수 있다. 유기 발광 표시 패널의 발광층은 유기 발광 물질을 포함할 수 있다. 무기 발광 표시 패널의 발광층은 무기 발광 물질을 포함할 수 있다. 퀀텀닷 발광 표시 패널의 발광층은 퀀텀닷, 및 퀀텀로드 등을 포함할 수 있다. 이하, 본 실시예에서 표시 패널(DP)은 유기 발광 표시 패널로 설명된다.
표시 패널(DP)은 영상(IM)을 출력하고, 출력된 영상(IM)은 표시면(IS)을 통해 표시될 수 있다.
입력 감지층(ISP)은 표시 패널(DP) 상에 배치되어 외부 입력을 감지할 수 있다. 입력 감지층(ISP)은 표시 패널(DP) 상에 직접 배치될 수 있다. 본 발명의 일 실시예에 따르면, 입력 감지층(ISP)은 연속공정에 의해 표시 패널(DP) 상에 형성될 수 있다. 즉, 입력 감지층(ISP)이 표시 패널(DP) 상에 직접 배치되는 경우, 내부 접착 필름(미도시)이 입력 감지층(ISP)과 표시 패널(DP) 사이에 배치되지 않는다. 그러나, 입력 감지층(ISP)과 표시 패널(DP) 사이에 내부 접착 필름이 배치될 수 있다. 이 경우, 입력 감지층(ISP)은 표시 패널(DP)과 연속 공정에 의해 제조되지 않으며, 표시 패널(DP)과 별도의 공정을 통해 제조된 후, 내부 접착 필름에 의해 표시 패널(DP)의 상면에 고정될 수 있다.
윈도우(WM)는 영상(IM)을 출사할 수 있는 투명한 물질로 이루어질 수 있다. 예를 들어, 유리, 사파이어, 플라스틱 등으로 구성될 수 있다. 윈도우(WM)는 단일층으로 도시되었으나, 이에 한정하는 것은 아니며 복수 개의 층들을 포함할 수 있다.
한편, 도시되지 않았으나, 상술한 표시 장치(DD)의 비표시 영역(NDA)은 실질적으로 윈도우(WM)의 일 영역에 소정의 컬러를 포함하는 물질이 인쇄된 영역으로 제공될 수 있다. 본 발명의 일 예로, 윈도우(WM)는 비표시 영역(NDA)을 정의하기 위한 차광패턴을 포함할 수 있다. 차광패턴은 유색의 유기막으로써 예컨대, 코팅 방식으로 형성될 수 있다.
윈도우(WM)는 접착 필름을 통해 표시 모듈(DM)에 결합될 수 있다. 본 발명의 일 예로, 접착 필름은 광학투명접착필름(OCA, Optically Clear Adhesive film)을 포함할 수 있다. 그러나, 접착 필름은 이에 한정되지 않으며, 통상의 접착제 또는 점착제를 포함할 수 있다. 예를 들어, 접착 필름은 광학투명접착수지(OCR, Optically Clear Resin) 또는 감압접착필름(PSA, Pressure Sensitive Adhesive film)을 포함할 수 있다.
윈도우(WM)와 표시 모듈(DM) 사이에는 반사방지층이 더 배치될 수 있다. 반사방지층은 윈도우(WM)의 상측으로부터 입사되는 외부광의 반사율을 감소시킨다. 본 발명의 일 실시예에 따른 반사방지층은 위상지연자(retarder) 및 편광자(polarizer)를 포함할 수 있다. 위상지연자는 필름타입 또는 액정 코팅타입일 수 있고, λ/2 위상지연자 및/또는 λ/4 위상지연자를 포함할 수 있다. 편광자 역시 필름타입 또는 액정 코팅타입일 수 있다. 필름타입은 연신형 합성수지 필름을 포함하고, 액정 코팅타입은 소정의 배열로 배열된 액정들을 포함할 수 있다. 위상지연자 및 편광자는 하나의 편광필름으로 구현될 수 있다.
본 발명의 일 예로, 반사방지층은 컬러 필터들을 포함할 수도 있다. 표시 패널(DP)에 포함된 복수의 화소들(PX, 도 3 참조)이 생성하는 광의 컬러들을 고려하여 컬러 필터들의 배열이 결정될 수 있다. 반사방지층은 차광 패턴을 더 포함할 수도 있다.
표시 모듈(DM)은 전기적 신호에 따라 영상(IM)을 표시하고, 외부 입력에 대한 정보를 송/수신할 수 있다. 표시 모듈(DM)은 유효 영역(AA) 및 비유효 영역(NAA)으로 정의될 수 있다. 유효 영역(AA)은 표시 모듈(DM)에서 제공되는 영상(IM)을 출사하는 영역으로 정의될 수 있다. 또한 유효 영역(AA)은 입력 감지층(ISP)이 외부에서 인가되는 외부 입력을 감지하는 영역으로 정의될 수도 있다.
비유효 영역(NAA)은 유효 영역(AA)에 인접한다. 예를 들어, 비유효 영역(NAA)은 유효 영역(AA)을 에워쌀 수 있다. 다만, 이는 예시적으로 도시한 것이고, 비유효 영역(NAA)은 다양한 형상으로 정의될 수 있으며, 어느 하나의 실시예로 한정되지 않는다. 일 실시예에 따르면, 표시 모듈(DM)의 유효 영역(AA)은 표시 영역(DA)의 적어도 일부와 대응될 수 있다.
표시 모듈(DM)은 메인회로기판(MCB), 복수의 연성회로필름들(D-FCB) 및 복수의 구동칩들(DIC)을 더 포함할 수 있다. 메인회로기판(MCB)은 연성회로필름들(D-FCB)과 접속되어 표시 패널(DP)과 전기적으로 연결될 수 있다. 연성회로필름들(D-FCB)은 표시 패널(DP)에 접속되어 표시 패널(DP)과 메인회로기판(MCB)을 전기적으로 연결한다. 메인회로기판(MCB)은 복수의 구동 소자를 포함할 수 있다. 복수의 구동 소자는 표시 패널(DP)을 구동하기 위한 회로부를 포함할 수 있다. 연성회로필름들(D-FCB) 상에는 구동칩들(DIC)이 실장될 수 있다.
본 발명의 일 예로, 연성회로필름들(D-FCB)은 제1 연성회로필름(D-FCB1), 제2 연성회로필름(D-FCB2) 및 제3 연성회로필름(D-FCB3)을 포함할 수 있다. 구동칩들(DIC)은 제1 구동칩(DIC1), 제2 구동칩(DIC2) 및 제3 구동칩(DIC3)을 포함할 수 있다. 제1 내지 제3 연성회로필름들(D-FCB1, D-FCB2, D-FCB3)은 서로간에 제1 방향(DR1)으로 이격되어 배치되고, 표시 패널(DP)에 접속되어 표시 패널(DP)과 메인회로기판(MCB)을 전기적으로 연결할 수 있다. 제1 연성회로필름(D-FCB1) 상에는 제1 구동칩(DIC1)이 실장될 수 있다. 제2 연성회로필름(D-FCB2) 상에는 제2 구동칩(DIC2)이 실장될 수 있다. 제3 연성회로필름(D-FCB3)에는 제3 구동칩(DIC3)이 실장될 수 있다. 그러나, 본 발명의 실시예는 이에 한정되지 않는다. 예를 들어, 표시 패널(DP)은 하나의 연성회로필름을 통하여 메인회로기판(MCB)에 전기적으로 연결되고, 하나의 연성회로필름 상에는 하나의 구동칩만이 실장될 수도 있다. 또한, 표시 패널(DP)은 네 개 이상의 연성회로필름들을 통하여 메인회로기판(MCB)에 전기적으로 연결되고, 연성회로필름들 상에 구동칩들이 각각 실장될 수도 있다.
도 2에서는 제1 내지 제3 구동칩들(DIC1, DIC2, DIC3)이 제1 내지 제3 연성회로필름들(D-FCB1, D-FCB2, D-FCB3) 상에 각각 실장된 구조를 도시하였으나, 본 발명은 이에 한정되지 않는다. 예를 들어, 제1 내지 제3 구동칩들(DIC1, DIC2, DIC3)은 표시 패널(DP) 상에 직접 실장될 수 있다. 이 경우, 표시 패널(DP)의 제1 내지 제3 구동칩(DIC1, DIC2, DIC3)이 실장된 부분은 밴딩되어 표시 모듈(DM)의 후면에 배치될 수 있다. 또한, 제1 내지 제3 구동칩들(DIC1, DIC2, DIC3)은 메인회로기판(MCB) 상에 직접 실장될 수도 있다.
입력 감지층(ISP)은 연성회로필름들(D-FCB)을 통해 메인회로기판(MCB)과 전기적으로 연결될 수 있다. 그러나, 본 발명의 실시예는 이에 한정되지 않는다. 즉, 표시 모듈(DM)은 입력 감지층(ISP)을 메인회로기판(MCB)과 전기적으로 연결하기 위한 별도의 연성회로필름을 추가적으로 포함할 수 있다.
표시 장치(DD)는 표시 모듈(DM)을 수용하는 외부케이스(EDC)를 더 포함한다. 외부케이스(EDC)는 윈도우(WM)와 결합되어 표시 장치(DD)의 외관을 정의할 수 있다. 외부케이스(EDC)는 외부로부터 가해지는 충격을 흡수하며 표시 모듈(DM)로 침투되는 이물질/수분 등을 방지하여 외부케이스(EDC)에 수용된 구성들을 보호한다. 한편, 본 발명의 일 예로, 외부케이스(EDC)는 복수의 수납 부재들이 결합된 형태로 제공될 수 있다.
일 실시예에 따른 표시 장치(DD)는 표시 모듈(DM)을 동작시키기 위한 다양한 기능성 모듈을 포함하는 전자모듈, 표시 장치(DD)의 전반적인 동작에 필요한 전원을 공급하는 전원공급모듈, 표시 모듈(DM) 및/또는 외부케이스(EDC)와 결합되어 표시 장치(DD)의 내부 공간을 분할하는 브라켓 등을 더 포함할 수 있다.
도 3은 본 발명의 일 실시예에 따른 표시 장치의 블럭도이다.
도 3을 참조하면, 표시 장치(DD)는 표시 패널(DP), 패널 구동부(PDB) 및 전압 생성부(VGB)를 포함한다.
일 실시예에서, 패널 구동부(PDB)는 컨트롤러(CP), 데이터 구동부(SDB), 스캔 구동부(GDB) 및 휘도 보상부(AVC)를 포함할 수 있다.
컨트롤러(CP)는 외부로부터 영상 신호(RGB) 및 외부 제어 신호(CTRL)를 수신한다. 컨트롤러(CP)는 외부로부터 영상 신호(RGB) 및 외부 제어 신호(CTRL)를 수신한다. 컨트롤러(CP)는 데이터 구동부(SDB)와의 인터페이스(interface) 사양에 맞도록 영상 신호(RGB)의 데이터 포맷을 변환하여 영상 데이터(IMD)를 생성한다. 컨트롤러(CP)는 영상 신호(RGB) 및 외부 제어 신호(CTRL)에 기초하여 소스 제어 신호(SDS) 및 게이트 제어 신호(GDS)를 생성할 수 있다. 외부 제어 신호(CTRL)는 수직 동기 신호(Vsync, 도 7 참조), 수평 동기 신호 및 메인 클럭 등을 포함할 수 있다.
컨트롤러(CP)는 영상 데이터(IMD), 소스 제어 신호(SDS)를 데이터 구동부(SDB)에 송신하고, 게이트 제어 신호(GDS)를 스캔 구동부(GDB)에 송신할 수 있다. 패널 구동부(PDB)는 소스 제어 신호(SDS) 및 게이트 제어 신호(GDS)를 토대로, 표시 패널(DP)을 구동하는 구동 신호(DSS)를 생성할 수 있다. 본 발명의 일 예로, 구동 신호(DSS)는 데이터 신호(DS), 스캔 신호들(SC1 내지 SCn) 및 초기화 신호들(SS1 내지 SSn)을 포함할 수 있다.
데이터 구동부(SDB)는 컨트롤러(CP)로부터 영상 데이터(IMD) 및 소스 제어 신호(SDS)를 수신한다. 소스 제어 신호(SDS)는 데이터 구동부(SDB)의 동작을 개시하는 수평 개시 신호를 포함할 수 있다. 데이터 구동부(SDB)는 소스 제어 신호(SDS)에 응답하여, 영상 데이터(IMD)를 토대로 데이터 신호(DS)를 생성한다. 데이터 구동부(SDB)는 데이터 신호(DS)를 후술하는 복수 개의 데이터 라인들(DL1 내지 DLm)에 출력한다. 데이터 신호(DS)는 영상 데이터(IMD)의 계조 값에 대응하는 아날로그 전압이다.
스캔 구동부(GDB)는 컨트롤러(CP)로부터 게이트 제어 신호(GDS)를 수신한다. 게이트 제어 신호(GDS)는 스캔 구동부(GDB)의 동작을 개시하는 수직 개시 신호, 스캔 신호들(SC1 내지 SCn) 및 초기화 신호들(SS1 내지 SSn)의 출력 시기를 결정하는 스캔 클럭 신호 등을 포함할 수 있다. 스캔 구동부(GDB)는 게이트 제어 신호(GDS)를 토대로 스캔 신호들(SC1 내지 SCn) 및 초기화 신호들(SS1 내지 SSn)을 생성한다. 스캔 구동부(GDB)는 스캔 신호들(SC1 내지 SCn)을 후술하는 복수 개의 스캔 라인들(SCL1 내지 SCLn)에 순차적으로 출력하고, 초기화 신호들(SS1 내지 SSn)을 후술하는 복수 개의 초기화 라인들(SSL1 내지 SSLn)에 순차적으로 출력한다.
일 실시예에서, 스캔 신호들(SC1 내지 SCn)은 제1 스캔 라인(SCL1)에서 마지막 n번째 스캔 라인(SCLn)까지 순차적으로 인가될 수 있다. 제1 스캔 라인(SCL)은 제2 방향(DR2)에서 표시 패널(DP)의 가장 상측(UP, 도 5 참조)에 배치되고, 마지막 n번째 스캔 라인(SCLn)은 제2 방향(DR2)에서 표시 패널(DP)의 가장 하측(DN, 도 5 참조)에 배치될 수 있다. 즉, 본 실시예에서 스캔 신호들(SC1 내지 SCn)은 한 프레임에서(FR, 도 7 참조) 표시 패널(DP)의 상측(UP, 도 5 참조)에서 하측(DN, 도 5 참조)으로 순차적으로 인가될 수 있다.
전압 생성부(VGB)는 표시 패널(DP)의 동작에 필요한 전압들을 생성한다. 본 발명의 일 예로, 전압 생성부(VGB)는 초기 구동 전압들을 생성할 수 있다. 예를 들어, 전압 생성부(VGB)는 제1 구동 전압(ELVDD1), 제2 구동 전압(ELVSS) 및 초기화 전압(Vinit)을 발생시킬 수 있다.
본 발명의 일 예로, 표시 패널(DP)은 복수 개의 스캔 라인들(SCL1 내지 SCLn), 복수 개의 초기화 라인들(SSL1 내지 SSLn), 복수 개의 데이터 라인들(DL1 내지 DLm) 및 복수 개의 화소들(PX11 내지 PXnm)을 포함한다. 스캔 라인들(SCL1 내지 SCLn) 및 초기화 라인들(SSL1 내지 SSLn)은 스캔 구동부(GDB)으로부터 제1 방향(DR1)으로 연장되고, 제2 방향(DR2)으로 서로 이격하여 배열된다. 데이터 라인들(DL1 내지 DLm)은 데이터 구동부(SDB)으로부터 제2 방향(DR2)의 반대 방향으로 연장되며, 제1 방향(DR1)으로 서로 이격되어 배열된다.
복수의 화소들(PX11 내지 PXnm) 각각은 스캔 라인들(SCL1 내지 SCLn) 중 대응하는 하나의 스캔 라인 및 초기화 라인들(SSL1 내지 SSLn) 중 대응하는 하나의 초기화 라인에 전기적으로 연결된다. 또한, 복수의 화소들(PX11 내지 PXnm) 각각은 데이터 라인들(DL1 내지 DLm) 중 대응하는 하나의 데이터 라인에 전기적으로 연결된다.
복수의 화소들(PX11 내지 PXnm) 각각은 제1 전원 라인(RL1), 제2 전원 라인(RL2) 및 초기화 전원 라인(IVL)에 전기적으로 연결된다. 제1 전원 라인(RL1)은 제1 구동 전압(ELVDD)을 수신한다. 제2 전원 라인(RL2)은 제2 구동 전압(ELVSS)을 수신한다. 초기화 전원 라인(IVL)은 초기화 전압(Vinit)을 수신한다. 본 발명의 일 예로, 제2 전원 라인(RL2)은 2개 이상의 화소들과 중첩되도록 형성될 수도 있다.
화소들(PX11 내지 PXnm)은 서로 다른 컬러광을 생성하는 유기발광 다이오드를 가진 복수 개의 그룹을 포함할 수 있다. 예컨대, 레드 컬러광을 생성하는 레드 화소들, 그린 컬러광을 생성하는 그린 화소들, 및 블루 컬러광을 생성하는 블루 화소들을 포함할 수 있다. 레드 화소의 유기발광 다이오드, 그린 화소의 유기발광 다이오드 및 블루 화소의 유기발광 다이오드는 서로 다른 물질의 발광층을 포함할 수 있다.
휘도 보상부(AVC)는 표시 패널(DP)에서 발생하는 휘도 차이를 보상할 수 있다. 일 실시예에서, 휘도 보상부(AVC)는 표시 패널(DP)의 상측(UP)과 하측(DN)간에 발생하는 휘도 차이를 보상할 수 있다.
예를 들어, 표시 패널(DP)의 상측(UP)에 배치된 상측 화소들(PX11 내지 PX1m)의 휘도는 표시 패널(DP)의 하측(DN)에 배치된 하측 화소들(PXn1 내지 PXnm)의 휘도보다 작을 수 있다. 이러한 휘도 차이는, 상측 화소들(PX11 내지 PX1m)이 하측 화소들(PXn1 내지 PXnm)보다 전압 생성부(VGB)로부터 멀리 떨어져 있기 때문에 전압 강하(IR drop)에 의해서 발생할 수 있다. 전압 생성부(VGB)에서 표시 패널(DP)에 인가되는 초기 구동 전압인 제1 구동 전압(ELVDD1)은 가까운 하측 화소들(PXn1 내지 PXnm)에 먼저 인가되고 점차 상측으로 진행하여 마지막으로 상측 화소들(PX11 내지 PX1m)에 인가되는데, 이 과정에서 배선 저항 및 전류에 의한 전압 강하(IR drop)가 발생될 수 있다.
휘도 보상부(AVC)는 표시 패널의 상측(UP)에 하측(DN)보다 낮은 보상 전압을 인가하여 이러한 휘도 차이를 보상할 수 있다. 이러한 보상 전압은 화소에 인가되는 데이터 전압에 해당할 수 있다. 자세한 설명은 후술한다.
도 4는 본 발명의 일 실시예에 따른 화소의 등가회로도이다.
도 4를 참조하면, 스캔 라인들(SCL1 내지 SCLn) 중 i번째 스캔 라인(SCLi), 초기화 라인들(SSL1 내지 SSLn) 중 i번째 초기화 라인(SSLi)에 연결되고, 데이터 라인들(DL1 내지 DLm) 중 j번째 데이터 라인(DLj)에 연결된 화소(PXij)가 예시적으로 도시된다.
본 발명의 일 예로, 화소(PXij)는 제1 내지 제3 트랜지스터들(T1, T2, T3), 커패시터(Cst) 및 발광 다이오드(OLED)를 포함할 수 있다. 본 실시예에서 제1 내지 제3 트랜지스터들(T1, T2, T3) 각각은 N타입의 트랜지스터인 것으로 설명된다. 다만, 본 발명은 이에 제한되지 않고, 제1 내지 제3 트랜지스터들(T1, T2, T3)은 P타입의 트랜지스터 또는 N타입의 트랜지스터 중 어느 하나로 구현될 수 있다. 본 명세서에서 “트랜지스터가 신호라인 에 접속된다”는 “트랜지스터의 소스 전극, 드레인 전극, 게이트 전극 중 어느 하나의 전극이 신호 라인과 일체의 형상을 갖거나, 연결전극을 통해서 연결된 것”을 의미한다. 또한, “트랜지스터가 다른 트랜지스터와 전기적으로 연결된다”는 것은 “트랜지스터의 소스 전극, 드레인 전극, 게이트 전극 중 어느 하나의 전극이 다른 트랜지스터의 소스 전극, 드레인 전극, 게이트 전극 중 어느 하나의 전극과 일체의 형상을 갖거나, 연결전극을 통해서 연결된 것”을 의미한다.
본 실시예에서, 제1 트랜지스터(T1)는 구동 트랜지스터일 수 있고, 제2 트랜지스터(T2)는 스위칭 트랜지스터일 수 있다. 제3 트랜지스터(T3)는 초기화 트랜지스터일 수 있다. 이하, 제1 내지 제3 트랜지스터들(T1 내지 T3)은 각각 제1 전극, 제2 전극 및 제어 전극을 포함하며, 제1 전극은 소스 전극이라 지칭하고, 제2 전극은 드레인 전극이라 지칭하며, 제어 전극은 게이트 전극이라 지칭한다.
제1 트랜지스터(T1)는 제1 전원 라인(RL1)과 발광 다이오드(OLED) 사이에 접속된다. 제1 트랜지스터(T1)의 소스 전극(S1)은 발광 다이오드(OLED)의 애노드(AN)와 전기적으로 연결된다. 제1 트랜지스터(T1)의 드레인 전극(D1)은 제1 전원 라인(RL1)과 전기적으로 연결된다. 제1 트랜지스터(T1)의 게이트 전극(G1)은 제1 기준 노드(RN1)에 전기적으로 연결된다. 제1 기준 노드(RN1)는 제2 트랜지스터(T2)의 소스 전극(S2)과 전기적으로 연결된 노드일 수 있다. 본 발명의 일 예로, 제1 구동 전압(ELVDD)은 제1 전원 라인(RL1)을 통해 제1 트랜지스터(T1)의 드레인 전극(D1)에 전달될 수 있다.
제2 트랜지스터(T2)는 j번째 데이터 라인(DLj)과 제1 트랜지스터(T1)의 게이트 전극(G1) 사이에 접속된다. 제2 트랜지스터(T2)의 소스 전극(S2)은 제1 트랜지스터(T1)의 게이트 전극(G1)에 전기적으로 연결된다. 제2 트랜지스터(T2)의 드레인 전극(D2)은 j번째 데이터 라인(DLj)에 전기적으로 연결된다. 제2 트랜지스터(T2)의 게이트 전극(G2)은 i번째 스캔 라인(SCLi)에 전기적으로 연결된다. 본 발명의 일 예로, i번째 스캔 신호(SCi)는 i번째 스캔 라인(SCLi)을 통해 제2 트랜지스터(T2)의 게이트 전극(G2)으로 전달될 수 있다. 데이터 신호(DS)는 j번째 데이터 라인(DLj)을 통해 제2 트랜지스터(T2)의 드레인 전극(D2)으로 전달될 수 있다.
제3 트랜지스터(T3)는 제2 기준 노드(RN2)와 초기화 전원 라인(IVL) 사이에 접속된다. 제3 트랜지스터(T3)의 소스 전극(S3)은 제2 기준 노드(RN2)와 전기적으로 연결된다. 제2 기준 노드(RN2)는 제1 트랜지스터(T1)의 소스 전극(S1)과 전기적으로 연결된 노드일 수 있다. 또한, 제2 기준 노드(RN2)는 발광 다이오드(OLED)의 애노드(AN)와 전기적으로 연결된 노드일 수 있다. 제3 트랜지스터(T3)의 드레인 전극(D3)은 초기화 전원 라인(IVL)에 전기적으로 연결된다. 제3 트랜지스터(T3)의 게이트 전극(G3)은 i번째 초기화 라인(SSLi)에 전기적으로 연결된다. 본 발명의 일 예로, i번째 초기화 신호(SSi)는 i번째 초기화 라인(SSLi)을 통해 제3 트랜지스터(T3)의 게이트 전극(G3)으로 전달될 수 있다. 초기화 전압(Vinit)은 초기화 전원 라인(IVL)을 통해 제3 트랜지스터(T3)의 드레인 전극(D3)으로 전달될 수 있다.
발광 다이오드(OLED)는 제2 기준 노드(RN2)와 제2 전원 라인(RL2) 사이에 접속된다. 발광 다이오드(OLED)의 애노드(Anode, AN)는 제2 기준 노드(RN2)에 전기적으로 연결된다. 발광 다이오드(OLED)의 캐소드(CA )는 제2 전원 라인(RL2)에 전기적으로 연결된다.
커패시터(Cst)는 제1 기준 노드(RN1)와 제2 기준 노드(RN2) 사이에 접속된다. 커패시터(Cst)의 제1 전극(Cst1)은 제1 기준 노드(RN1)에 전기적으로 연결되고, 커패시터(Cst)의 제2 전극(Cst2)은 제2 기준 노드(RN2)에 전기적으로 연결될 수 있다.
도 3을 참조하면, 스캔 구동부(GDB)는 스캔 신호들(SC1 내지 SCn) 및 초기화 신호들(SS1 내지 SSn)을 순차적으로 표시 패널(DP)으로 송신한다. 스캔 신호들(SC1 내지 SCn) 및 초기화 신호들(SS1 내지 SSn) 각각은 일부 구간 동안에 하이 레벨을 갖고 일부 구간 동안 로우 레벨을 가질 수 있다. 이때, N타입의 트랜지스터들은 대응하는 신호가 하이 레벨을 가질 때 턴-온되고 P타입의 트랜지스터들은 대응하는 신호가 로우 레벨을 가질 때 턴-온된다. 이하, 도 4에 기재된 N타입의 제1 내지 제3 트랜지스터들(T1, T2, T3)을 포함하는 화소(PXij)를 기준으로 설명한다.
i번째 초기화 신호(SSi)가 하이 레벨을 가질 때, 제3 트랜지스터(T3)는 턴-온 된다. 제3 트랜지스터(T3)가 턴-온 되면, 제3 트랜지스터(T3)를 통해 초기화 전압(Vinit)이 제2 기준 노드(RN2)에 전달된다. 따라서 제2 기준 노드(RN2)가 초기화 전압(Vinit)으로 초기화 되고, 제2 기준 노드(RN2)와 전기적으로 연결된 제1 트랜지스터(T1)의 소스 전극(S1) 및 발광 다이오드(OLED)의 애노드(AN) 도 초기화 전압(Vinit)으로 초기화 된다.
i번째 스캔 신호(SCi)가 하이 레벨을 가질 때, 제2 트랜지스터(T2)는 턴-온 된다. 제2 트랜지스터(T2)가 턴-온 되면 제2 트랜지스터(T2)를 통해 데이터 신호(DS)가 제1 기준 노드(RN1)에 전달된다. 따라서 제1 기준 노드(RN1)와 전기적으로 연결된 제1 트랜지스터(T1)의 게이트 전극(G1) 및 커패시터(Cst)의 제1 전극(Cst1)에도 데이터 신호(DS)가 인가된다. 제1 트랜지스터(T1)의 게이트 전극(G1)에 데이터 신호(DS)가 인가되면, 제1 트랜지스터(T1)는 턴-온 될 수 있다.
본 발명의 일 예로, i번째 초기화 신호(SSi)가 하이 레벨을 갖는 구간과 i번째 스캔 신호(SCi)가 하이 레벨을 갖는 구간은 중첩될 수 있다. 이 경우, 커패시터(Cst)의 양단에는 데이터 신호(DS)와 초기화 전압(Vinit)이 인가되고, 커패시터(Cst)에는 양단의 전압차(DS-Vinit)에 대응하는 전하가 저장될 수 있다.
한편, 발광 다이오드(OLED)의 캐소드(CA)에는 제2 구동 전압(ELVSS)이 인가된다. 따라서 i번째 초기화 신호(SSi)가 하이 레벨을 가져, 제2 구동 전압(ELVSS)의 전압 레벨보다 낮은 전압 레벨을 갖는 초기화 전압(Vinit)이 발광 다이오드(OLED)의 애노드(AN)에 인가되면, 발광 다이오드(OLED)에는 전류가 흐르지 않는다.
i번째 스캔 신호(SCi)가 로우 레벨을 가질 때, 제2 트랜지스터(T2)는 턴-오프 된다. i번째 초기화 신호(SSi)가 로우 레벨을 가질 때, 제3 트랜지스터(T3)는 턴-오프 된다. 본 발명의 일 예로, i번째 스캔 신호(SCi)가 로우 레벨을 갖는 구간과, i번째 초기화 신호(SSi)가 로우 레벨을 갖는 구간은 중첩될 수 있다.
i번째 스캔 신호(SCi)가 로우 레벨을 가져, 제2 트랜지스터(T2)가 턴-오프 되더라도, 제1 트랜지스터(T1)는 커패시터(Cst)에 저장된 전하에 의하여 턴-온 상태를 유지한다. 따라서, 제1 트랜지스터(T1)를 통하여 구동 전류(I_OLED)가 흐르게 된다. 제1 트랜지스터(T1)를 통해 유입된 구동 전류(I_OLED)에 의해 내부 커패시터에 발광 다이오드(OLED)의 애노드(AN)의 전압 레벨이 서서히 증가할 수 있다. 애노드(AN)의 전압 레벨이 캐소드(CA)의 전압 레벨보다 높아지면, 발광 다이오드(OLED)로 구동 전류(I_OLED)가 흐르게 되고, 발광 다이오드(OLED)는 발광한다. 이때, 제2 기준 노드(RN2)의 전압 레벨이 높아지더라도, 커패시터(Cst)의 커플링(coupling)효과로 제1 기준 노드(RN1)의 전압 레벨도 높아져 제1 트랜지스터(T1)를 통해 흐르는 구동 전류(I_OLED)의 크기는 유지될 수 있다.
본 발명의 일 예로, 제1 트랜지스터(T1)의 전류-전압 관계에 따르면 제1 트랜지스터(T1)의 드레인 전극(D1)에 인가되는 제1 구동 전압(ELVDD)의 전압 레벨이 제1 트랜지스터(T1)의 포화 전압 레벨보다 큰 경우에, 구동 전류(I_OLED)의 크기는 제1 트랜지스터(T1)의 게이트 전극(G1)에 인가되는 데이터 신호(DS)의 전압 레벨에 비례할 수 있다. 제1 트랜지스터(T1)의 포화 전압 레벨이란, 제1 트랜지스터(T1)의 드레인 전극(D1)에 인가되는 전압의 레벨을 크게 하여도, 구동 전류(I_OLED)의 크기가 일정하게 유지되는 지점의 전압 레벨일 수 있다.
반면, 제1 트랜지스터(T1)의 드레인 전극(D1)에 인가되는 제1 구동 전압(ELVDD)의 전압 레벨이 포화 전압 레벨보다 작은 경우, 제1 트랜지스터(T1)를 통해 흐르는 구동 전류(I_OLED)의 크기는 제1 구동 전압(ELVDD)의 전압 레벨 및 데이터 신호(DS)의 전압 레벨에 따라 결정된다.
따라서, 제1 트랜지스터(T1)에 일정한 크기의 전압 레벨을 갖는 데이터 신호(DS)를 인가하여도, 제1 구동 전압(ELVDD)의 전압 레벨에 따라 구동 전류(I_OLED)의 크기는 달라질 수 있고, 발광 다이오드(OLED)의 발광 세기도 달라질 수 있다.
일 실시예에서, 구동 트랜지스터인 제1 트랜지스터(T1)에 걸리는 전압의 크기가 작을수록 발광 다이오드(OLED)의 발광 밝기는 커지고 화소(PXij)의 휘도는 증가할 수 있다. 제1 트랜지스터(T1)에 걸리는 전압은 게이트 전극(G1)에 인가되는 전압과 소스 전극(S1)에 인가되는 전압의 차이에 해당할 수 있다. 즉, 제1 트랜지스터(T1)에 걸리는 전압 레벨은 게이트 전극(G1)에 인가되는 데이터 신호(DS)의 전압 레벨과 비례할 수 있다. 데이터 신호(DS)의 전압(이하, 데이터 전압)이 낮으면 제1 트랜지스터(T1)의 전압은 낮고 발광 다이오드(OLED)는 밝게 발광하고 화소(PXij)의 휘도는 증가할 수 있다. 즉, 화소(PXij)에 인가되는 데이터 전압의 크기와 화소(PXij)의 휘도는 반비례 관계에 있다.
도 5는 본 발명의 일 실시예에 따른 표시 장치의 평면도이다.
일 실시예에서, 패널 구동부(PDB)는 메인회로기판(MCB) 상에 배치될 수 있다. 예를 들어, 휘도 보상부(AVC)는 메인회로기판(MCB) 상에 배치될 수 있다. 전압 생성부(VGB)는 메인회로기판(MCB) 상에 배치될 수 있다.
도 5를 참조하면, 표시 패널(DP)은 상측(UP)에 배치되고 제1 방향(DR2)으로 배열되는 복수의 상측 화소들을 포함할 수 있다. 복수의 상측 화소들은 제1 상측 화소(PX11) 및 제2 상측 화소(PX1m)를 포함할 수 있다. 제1 상측 화소(PX11)와 제2 상측 화소(PX1m)는 서로 제1 방향(DR1)에서 가장 멀리 배치된다.
표시 패널(DP)은 하측(DN)에 배치되고 제1 방향(DR1)으로 배열되는 복수의 하측 화소들을 포함할 수 있다. 복수의 하측 화소들은 제1 하측 화소(PXn1) 및 제2 하측 화소(PXnm)를 포함할 수 있다. 제1 하측 화소(PXn1)와 제2 하측 화소(PXnm)는 제1 방향(DR1)에서 서로 가장 멀리 배치된다. 여기에서, 상측(UP)은 제2 방향(DR2)에서 메인회로기판(MCB)으로부터 가장 멀리 떨어진 표시 패널(DP)의 일측에 해당하고, 하측(DN)은 제2 방향(DR2)에서 메인회로기판(MCB)에서 가장 가까운 표시 패널(DP)의 타측에 해당할 수 있다.
도 5 에서, 전압 생성부(VGB)는 메인회로기판(MCB) 상에 배치되어, 표시 패널(DP)의 하측 화소들(PXn1 내지 PXnm)과 가깝고 상측 화소들(PX11 내지 PX1m)과 멀리 배치될 수 있다. 전압 생성부(VGB)는 표시 패널(DP)의 하측 화소들(PXn1 내지 PXnm)을 통해 상측 화소들(PX11 내지 PX1m)까지 초기 구동 전압(ELVDD1)을 표시 패널(DP)에 인가할 수 있다.
표시 패널(DP)과 메인회로기판(MCB) 상에는 복수의 센싱 라인들(FL1-1, FL1-2, FL2-1, FL2-2)이 배치될 수 있다. 복수의 센싱 라인들(FL1-1, FL1-2, FL2-1, FL2-2)은 복수의 화소들(PX11 내지 PXnm) 중에서 제1 상측 화소(PX11)와 연결된 제1 상측 센싱 라인(FL1-1), 제2 상측 화소(PX1m)와 연결된 제2 상측 센싱 라인(FL1-2), 제1 하측 화소(PXn1)와 연결된 제1 하측 센싱 라인(FL2-1) 및 제2 하측 화소(PXnm)와 연결된 제2 하측 센싱 라인(FL2-2)을 포함할 수 있다.
복수의 센싱 라인들(FL1-1, FL1-2, FL2-1, FL2-2)은 피드백 전압(VFB1)을 센싱할 수 있다. 복수의 센싱 라인들(FL1-1, FL1-2, FL2-1, FL2-2)은 표시 패널(DP)로부터 피드백 전압(VFB1)을 센싱하여 휘도 보상부(AVC)에 제공할 수 있다. 복수의 화소들은 표시 영역(DA)에 배치되고, 복수의 센싱 라인들(FL1-1, FL1-2, FL2-1, FL2-2)은 비표시 영역(NDA)에 배치될 수 있다.
복수의 센싱 라인들(FL1-1, FL1-2, FL2-1, FL2-2)은 제1 및 제3 연성회로필름들(D-FCB1, DFCB3)을 통과하여 메인회로기판(MCB) 상의 휘도 보상부(AVC)에 연결될 수 있다.
피드백 전압(VFB1)은 표시 패널(DP)에 인가된 초기 구동 전압(ELVDD1)의 화소 위치 별 변화값에 해당할 수 있다. 피드백 전압(VFB1)은 복수의 전압들로 제공될 수 있다. 일 실시예에서, 피드백 전압(VFB1)은 제1 상측 센싱 라인(FL1-1)을 통해 센싱된 제1 상측 피드백 전압(VFB_U1), 제2 상측 센싱 라인(FL1-2)을 통해 센싱된 제2 상측 피드백 전압(VFB_U2), 제1 하측 센싱 라인(FL2-1)을 통해 센싱된 제1 하측 피드백 전압(VFB_D1) 및 제2 하측 센싱 라인(FL2-2)을 통해 센싱된 제2 하측 피드백 전압(VFB_D2)을 포함할 수 있다.
도 5에 따를 때, 본 실시예에서 스캔 방향(SDR)은 표시 패널(DP)의 상측(UP)에서 하측(DN)으로 진행될 수 있다.
도 6은 본 발명의 일 실시예에 따른 휘도 보상부의 블록도이다. 도 7은 본 발명의 일 실시예에 따른 보상 전압을 보여주는 그래프이다. 도 8은 본 발명의 일 실시예에 따른 구동 전압을 보여주는 그래프이다.
휘도 보상부(AVC)는 제1 상측 피드백 전압(VFB_U1), 제2 상측 피드백 전압(VFB_U2), 제1 하측 피드백 전압(VFB_D1) 및 제2 하측 피드백 전압(VFB_D2)을 포함하는 피드백 전압(VFB1)을 수신하여 이를 기초로 구동 전압(ELVDD2)을 생성하고, 구동 전압(ELVDD2)을 기초로 보상 전압(VREG1, VREF1)을 생성하여 표시 패널에 제공한다.
도 6을 참조하면, 휘도 보상부(AVC)는 피드백 전압 생성부(610), 구동 전압 생성부(620) 및 보상 전압 생성부(630)를 포함할 수 있다.
피드백 전압 생성부(610)는 복수의 피드백 전압들(VFB1)을 기초로 평균 피드백 전압(VFB2)을 산출할 수 있다. 일 실시예에서, 피드백 전압 생성부(610)는 제1 상측 피드백 전압(VFB_U1)과 제2 상측 피드백 전압(VFB_U2)의 평균을 산출하여 상측 평균 피드백 전압(VFB_UP, 도 8 참조)을 생성할 수 있다.
피드백 전압 생성부(610)는 제1 하측 피드백 전압(VFB_D1)과 제2 하측 피드백 전압(VFB_D2)의 평균을 산출하여 하측 평균 피드백 전압(VFB_DN, 도 8 참조)을 생성할 수 있다. 전압 강하(IR drop)에 따라 하측 평균 피드백 전압(VFB_DN)의 크기는 상측 평균 피드백 전압(VFB_UP)의 크기보다 크다.
도 8을 참조하여 설명하면, 구동 전압 생성부(620)는 상측 평균 피드백 전압(VFB_UP)과 하측 평균 피드백 전압(VFB_DN)의 차이를 기초로 구동 전압(VCS)을 산출할 수 있다. 구동 전압(VCS)은 한 프레임 내에서 상측 평균 피드백 전압(VFB_UP)과 하측 평균 피드백 전압(VFB_DN)의 사이에서 선형적으로 변화할 수 있다. 예를 들어, 구동 전압(VCS)은 1부터 n까지 스캔라인들에 각각 대응하는 복수의 구동 전압들(VCS)을 포함할 수 있다. 한 프레임 내에서, 표시 패널의 상측에 배치된 첫번째 스캔 라인에 대응하는 첫번째 구동 전압의 크기는 표시 패널의 하측에 배치된 마지막 스캔 라인에 대응하는 마지막 구동 전압의 크기보다 작다.
구동 전압 생성부(620)는 한 프레임 내에서 표시 패널의 상측에서 하측으로 갈수록 선형적으로 증가하는 복수의 구동 전압들(VCS)을 산출할 수 있다. 예를 들어, 복수의 구동 전압들(VCS)은 표시 패널의 상측(UP)에서 하측(DN)으로 향하는 스캔 방향(SDR)을 따라서 점점 증가할 수 있다.
복수의 구동 전압들(VCS) 중 n번째 스캔 라인에 대응하는 구동 전압(VCS_n)의 크기는 아래 수학식으로 산출할 수 있다.
[수학식]
Figure pat00002
여기에서, VCSn은 n번째 스캔 라인에서의 구동 전압이고, VFBup은 상측 평균 피드백 전압이고, VFBdn은 하측 평균 피드백 전압이고, Vtotal은 복수의 스캔 라인들에 걸리는 총 전압이고, Vn은 n번째 스캔 라인에 걸리는 전압에 해당할 수 있다.
도 7을 참조하여 설명하면, 보상 전압 생성부(630)는 구동 전압(VCS)을 기초로 보상 구동 전압(ELVDD2) 및 보상 전압(VREG1, VREF1)을 생성할 수 있다.
보상 구동 전압(ELVDD2)은 선형적으로 변화하는 복수의 구동 전압들(VCS)을 포함할 수 있다. 즉, 보상 구동 전압(ELVDD2)은 프레임(FR)마다 표시 패널의 상측에서 하측으로 선형적으로 증가하는 복수의 구동 전압들(VCS)을 포괄하는 개념으로 복수의 구동 전압들(ELVDD2) 또는 구동 전압(ELVDD2)으로 지칭될 수 있다.
보상 전압 생성부(630)는 구동 전압(ELVDD2)과 일정한 전압 갭들(VG1, VG2)을 가지고 비례적으로 증가 또는 감소하는 보상 전압들(VREG1, VREF1)을 생성할 수 있다.
보상 전압(CV)은 구동 전압(ELVDD2)의 변화에 따라 같이 변화한다. 보상 전압(CV)은 블랙(VREG1) 또는 화이트(VREF1)에 해당하는 감마 기준 전압에 해당할 수 있다. 보상 전압(CV)은 표시 패널(DP)의 복수의 화소들에 제공될 수 있다. 즉, 표시 패널(DP)의 상측 화소들에 인가되는 보상 전압(CV)의 크기는 표시 패널(DP)의 하측 화소들에 인가되는 보상 전압(CV)의 크기보다 작다.
보상 전압(CV)은 보상 데이터 전압(VREG1, VREF1)으로 지칭될 수 있다. 보상 전압(CV)의 크기는 화소의 휘도와 반비례한다. 본 실시예에서 따른 표시 장치(DD)는 하측 화소들에 인가되는 보상 전압의 크기보다 상측 화소들에 인가되는 보상 전압(CV)의 크기를 크게 하여 표시 패널(DP)의 상측과 하측 간의 휘도 차이를 개선시킬 수 있다.
도 7을 참조하면, 구동 전압(ELVDD2) 및 보상 전압(CV)은 각 프레임(FR) 마다 선형적으로 변화하는 값을 가질 수 있다. 복수 개의 프레임(FR)에서 구동 전압(ELVDD2) 및 보상 전압(CV)의 변화는 각각의 프레임(FR)마다 반복될 수 있다. 즉, 하나의 프레임(FR)에서 상측 화소들(PX11 내지 PX1m)을 스캔하는 제1 스캔 구간(t1)에서 하측 화소들(PXn1 내지 PXnm)을 스캔하는 제2 스캔 구간(t2)까지 한 프레임에서의 전압 증가는 각각의 프레임(FR)에서 반복하여 나타난다.
도 9는 본 발명의 일 실시예에 따른 표시 장치의 구동 방법을 보여주는 흐름도이다. 도 9는 휘도 보상부(AVC)의 표시 패널의 상측과 하측 간 휘도 차이의 보상 방법을 보여줄 수 있다. 도 5 내지 도 7을 참조하여 도 9를 설명한다.
도 9에서, 패널 구동부(PDB)의 휘도 보상부(AVC)는 표시 패널(DP)의 상측(UP) 및 하측(DN) 각각으로부터 초기 구동 전압(ELVDD1)을 수신한다(단계 S110).
피드백 전압 생성부(610)는 초기 구동 전압들(ELVDD1)을 기초로 피드백 전압(VFB1)을 생성한다(단계 S120).
구동 전압 생성부(620)는 피드백 전압(VFB1)을 기초로 평균 피드백 전압(VFB2)을 산출하고 평균 피드백 전압(VFB2)을 기초로 구동 전압(VCS)을 생성한다(단계 S130).
보상 전압 생성부(630)는 구동 전압(VCS)을 기초로 보상 전압(CV)을 생성한다(단계 S140). 일 실시예에서, 보상 전압 생성부(630)는 복수의 구동 전압들(VCS)을 포함하는 보상 구동 전압(ELVDD2)을 생성하고 보상 구동 전압(ELVDD2)과 일정한 전압 갭(VG1, VG2)을 유지하며 비례적으로 증가 또는 감소하는 보상 전압(CV)을 생성할 수 있다.
휘도 보상부(AVC)는 보상 전압(CV)을 표시 패널(DP)의 상측 화소들(PX11 내지 PX1m)로부터 하측 화소들(PXn1 내지 PXnm)까지 제공한다(단계 S150).
도 10은 본 발명의 다른 일 실시예에 따른 보상 전압을 보여주는 그래프이다. 도 11은 본 발명의 다른 일 실시예에 따른 보상 전압을 보여주는 그래프이다. 중복된 설명은 생략한다.
도 10에서, 각 프레임(FR)마다 보상 전압(VREG1, VREF1)은 구동 전압(ELVDD2)의 증가에 따라 증가하지만, 선형적으로 증가하지 않을 수 있다. 즉 구동 전압(ELVDD2)의 선형적 증가에도 불구하고 보상 전압(VREG1, VREF1)은 표시 패널의 특성에 따라서 비선형적으로 증가할 수 있다.
도 11에서, 보상 전압들(VREG1, VREF1, 이하 CV)은 구동 전압(ELVDD2)의 증가 기울기와 다른 기울기를 가지고 증가할 수 있다. 이 때, 보상 전압(CV)은 선형적으로 증가할 수 있다. 예를 들어, 보상 전압(CV)은 제1 내지 제3 기울기들(11, 12, 13)을 가지고 선형적으로 증가할 수 있다.
일 실시예에서, 아래 수학식에서 n번째 스캔 라인에 걸리는 스캔 전압에 0.5를 곱하는 경우(즉, 각각의 스캔 라인에 걸리는 스캔 전압에 0.5를 곱하는 경우), 보상 전압(CV)은 제2 기울기(12)를 가지고 증가할 수 있다. 0을 곱하는 경우, 보상 전압(CV)은 제3 기울기(130)를 가질 수 있다. 즉, 증가하지 않는다. 1을 곱하는 경우 보상 전압(CV)은 구동 전압(ELVDD2)의 기울기와 동일한 제1 기울기(11)를 가지고 증가할 수 있다.
[수학식]
Figure pat00003
이상에서와 같이 도면과 명세서에서 실시 예가 개시되었다. 여기서 특정한 용어들이 사용되었으나, 이는 단지 본 발명을 설명하기 위한 목적에서 사용된 것이지 의미 한정이나 청구범위에 기재된 본 발명의 범위를 제한하기 위하여 사용된 것은 아니다. 그러므로 본 기술분야의 통상의 지식을 가진 자라면 이로부터 다양한 변형 및 균등한 타 실시 예가 가능하다는 점을 이해할 것이다. 따라서 본 발명의 진정한 기술적 보호 범위는 첨부된 청구범위의 기술적 사상에 의해 정해져야 할 것이다.
DD: 표시 장치
DP: 표시 패널
PDB: 패널 구동부
AVC: 휘도 보상부
VFB1: 피드백 전압
VFB2: 평균 피드백 전압
VCS, ELVDD2: 구동 전압

Claims (20)

  1. 영상을 표시하는 복수의 화소들을 포함하는 표시 패널;
    상기 표시 패널에서 센싱된 복수의 피드백 전압들을 기초로 상기 표시 패널을 구동하기 위한 구동 전압을 생성하는 패널 구동부; 및
    상기 복수의 화소들과 연결되어 상기 복수의 피드백 전압들을 각각 센싱하고 센싱된 상기 복수의 피드백 전압들을 상기 패널 구동부에 각각 제공하는 복수의 센싱 라인들을 포함하고,
    상기 패널 구동부는 상기 복수의 피드백 전압들의 평균에 해당하는 평균 피드백 전압을 생성하고 상기 평균 피드백 전압을 기초로 상기 구동 전압을 생성하는 표시 장치.
  2. 제1항에 있어서, 상기 패널 구동부는,
    소스 제어 신호 및 게이트 제어 신호를 생성하고, 외부에서 수신한 영상 신호를 토대로 영상 데이터를 생성하는 컨트롤러;
    상기 영상 데이터 및 상기 소스 제어 신호를 수신하고, 상기 영상 데이터를 토대로 데이터 신호를 생성하여 상기 표시 패널에 송신하는 데이터 구동부; 및
    복수의 스캔 라인들을 포함하고, 상기 게이트 제어 신호를 토대로 생성한 스캔 신호를 상기 표시 패널에 상기 복수의 스캔 라인들을 통하여 순차적으로 송신하는 스캔 구동부를 포함하는 표시 장치.
  3. 제2항에 있어서, 상기 복수의 화소들은 상기 패널 구동부에서 가장 멀리 배치된 복수의 상측 화소들 및 상기 패널 구동부에서 가장 가깝게 배치된 복수의 하측 화소들을 포함하고,
    상기 복수의 센싱 라인들은,
    상기 복수의 상측 화소들에 연결된 복수의 상측 센싱 라인들; 및
    상기 복수의 하측 화소들에 연결된 복수의 하측 센싱 라인들을 포함하는 표시 장치.
  4. 제3항에 있어서, 상기 상측 화소들은 제1 방향에서 서로 가장 멀리 배치된 제1 상측 화소 및 제2 상측 화소를, 상기 하측 화소들은 상기 제1 방향에서 서로 가장 멀리 배치된 제1 하측 화소 및 제2 하측 화소를 포함하고,
    상기 복수의 상측 센싱 라인들은 상기 제1 상측 화소에 연결된 제1 상측 센싱 라인 및 상기 제2 상측 화소에 연결된 제2 상측 센싱 라인을 포함하고,
    상기 복수의 하측 센싱 라인들은 상기 제1 하측 화소에 연결된 제1 하측 센싱 라인 및 상기 제2 하측 화소에 연결된 제2 하측 센싱 라인을 포함하는 표시 장치.
  5. 제4항에 있어서, 상기 복수의 피드백 전압들은 상기 제1 상측 센싱 라인에서 센싱되는 제1 상측 피드백 전압, 상기 제2 상측 센싱 라인에서 센싱되는 제2 상측 피드백 전압, 상기 제1 하측 센싱 라인에서 센싱되는 제1 하측 피드백 전압, 및 상기 제2 하측 센싱 라인에서 센싱되는 제2 하측 피드백 전압을 포함하는 표시 장치.
  6. 제5항에 있어서, 상기 평균 피드백 전압은,
    상기 제1 상측 피드백 전압과 상기 제2 상측 피드백 전압의 평균인 상측 평균 피드백 전압; 및
    상기 제1 하측 피드백 전압과 상기 제2 하측 피드백 전압의 평균인 하측 평균 피드백 전압을 포함하는 표시 장치.
  7. 제6항에 있어서, 상기 구동 전압은 상기 상측 화소들로부터 상기 하측 화소들로 진행하는 상기 스캔 신호의 스캔 방향을 따라 한 프레임을 기준으로 상기 상측 평균 피드백 전압과 상기 하측 평균 피드백 전압의 사이에서 선형적으로 증가하는 표시 장치.
  8. 제7항에 있어서, 상기 패널 구동부는 휘도 보상부를 더 포함하고 상기 휘도 보상부는,
    상기 복수의 센싱 라인들로부터 수신한 상기 복수의 피드백 전압들의 평균을 산출하여 상기 평균 피드백 전압을 생성하는 피드백 전압 생성부; 및
    상기 평균 피드백 전압을 기초로 상기 구동 전압을 생성하는 구동 전압 생성부를 포함하는 표시 장치.
  9. 제8항에 있어서, 상기 휘도 보상부는 보상 전압 생성부를 더 포함하고, 상기 보상 전압 생성부는 생성된 상기 구동 전압을 기초로 보상 전압을 생성하고 상기 표시 패널에 인가하는 표시 장치.
  10. 제9항에 있어서, 상기 보상 전압은 상기 스캔 신호에 따라서 상기 구동 전압과 일정한 전압 갭(gap)을 유지하면서 선형적으로 변화하는 표시 장치.
  11. 제6항에 있어서, 상기 복수의 스캔 라인들 중 n번째 스캔 라인에서의 상기 구동 전압은 아래 수학식으로 결정되는 표시 장치.
    [수학식]
    Figure pat00004

    여기에서, VCSn은 n번째 스캔 라인에서의 구동 전압이고, VFBup은 상측 평균 피드백 전압이고, VFBdn은 하측 평균 피드백 전압이고, Vtotal은 복수의 스캔 라인들에 걸리는 총 전압이고, Vn은 n번째 스캔 라인에 걸리는 전압에 해당한다.
  12. 제1항에 있어서, 상기 표시 패널에 인가되는 상기 구동 전압은,
    상기 패널 구동부에서 가장 가까운 상기 표시 패널의 하측으로부터 상기 패널 구동부에서 멀어지는 상기 표시 패널의 상측으로 갈수록 선형적으로 감소하는 표시 장치.
  13. 제3항에 있어서, 상기 표시 패널의 상기 복수의 하측 화소들에 인가되는 상기 구동 전압은 상기 표시 패널의 상기 복수의 상측 화소들에 인가되는 상기 구동 전압보다 큰 표시 장치.
  14. 영상을 표시하는 복수의 화소들을 포함하는 표시 패널;
    상기 복수의 화소들에 인가된 초기 구동 전압을 기초로 복수의 피드백 전압들을 센싱하는 복수의 센싱 라인들; 및
    상기 복수의 피드백 전압들을 기초로 상기 표시 패널을 구동하기 위한 구동 전압을 생성하는 패널 구동부를 포함하고,
    상기 복수의 화소들은 상기 초기 구동 전압의 인가 방향에서 가장 먼 상기 표시 패널의 상측에 배치된 복수의 상측 화소들 및 상기 초기 구동 전압의 인가 방향에서 가장 가까운 상기 표시 패널의 하측에 배치된 복수의 하측 화소들을 포함하고,
    상기 구동 전압은 상기 표시 패널의 상기 하측으로부터 상기 표시 패널의 상기 상측으로 갈수록 선형적으로 감소하는 것을 특징으로 하는 표시 장치.
  15. 제14항에 있어서, 상기 피드백 전압은 상기 복수의 상측 화소들에서 센싱된 상측 피드백 전압들 및 상기 복수의 하측 화소들에서 센싱된 하측 피드백 전압들을 포함하고,
    상기 패널 구동부는 상기 상측 피드백 전압들의 평균을 산출하여 상측 평균 피드백 전압을 생성하고 상기 하측 피드백 전압들의 평균을 산출하여 하측 평균 피드백 전압을 생성하는 표시 장치.
  16. 제15항에 있어서, 상기 구동 전압은 한 프레임 내에서 스캔 방향을 따라 최소 상기 상측 평균 피드백 전압으로부터 최대 상기 하측 평균 피드백 전압까지 선형적으로 증가하는 표시 장치.
  17. 제14항에 있어서, 상기 패널 구동부는 상기 표시 패널의 상기 상측과 상기 표시 패널의 상기 하측 사이의 휘도의 차이를 보상하는 휘도 보상부를 포함하고,
    상기 휘도 보상부는 상기 구동 전압을 기초로 상기 구동 전압과 일정한 전압 갭(gap)을 유지하면서 상기 표시 패널의 상기 하측으로부터 상기 상측으로 갈수록 감소하는 보상 전압을 생성하는 표시 장치.
  18. 제14항에 있어서, 상기 구동 전압은 한 프레임을 기준으로 상기 상측 화소들의 제1 스캔 구간에서 상기 하측 화소들의 제2 스캔 구간까지 선형적으로 증가하고, 상기 제1 스캔 구간에서 상기 제2 스캔 구간의 한 프레임 구간의 상기 증가는 매 프레임에서 반복되는 표시 장치.
  19. 제14항에 있어서, 상기 복수의 센싱 라인들은 상기 복수의 상측 화소들에 연결된 상측 센싱 라인 및 상기 복수의 하측 화소들에 연결된 하측 센싱 라인을 포함하는 표시 장치.
  20. 제19항에 있어서, 상기 표시 패널은 영상을 표시하는 표시 영역 및 상기 표시 영역에 인접한 비표시 영역을 포함하고,
    상기 복수의 상측 화소들 및 상기 복수의 하측 화소들은 상기 표시 영역에 배치되고, 상기 상측 센싱 라인 및 상기 하측 센싱 라인은 상기 비표시 영역에 배치되는 표시 장치.

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