KR20200093115A - 표시 장치 - Google Patents

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Abstract

본 발명의 표시 장치는, 제1 데이터 라인과 연결된 제1 화소; 제2 데이터 라인과 연결된 제2 화소; 제1 노드 전압이 인가된 제1 노드; 제1 계조 전압들을 생성하는 제1 계조 전압 생성부; 제2 계조 전압들을 생성하는 제2 계조 전압 생성부; 및 상기 제1 계조 전압들 중 하나에 기초하여 생성된 제1 데이터 신호를 상기 제1 데이터 라인에 인가하고, 상기 제1 노드 전압, 상기 제1 계조 전압들, 및 상기 제2 계조 전압들 중 하나에 기초하여 생성된 제2 데이터 신호를 상기 제2 데이터 라인에 인가하는 데이터 구동부를 포함한다.

Description

표시 장치{DISPLAY DEVICE}
본 발명은 표시 장치에 관한 것이다.
정보화 기술이 발달함에 따라 사용자와 정보간의 연결매체인 표시 장치의 중요성이 부각되고 있다. 이에 부응하여 액정 표시 장치(Liquid Crystal Display Device), 유기 발광 표시 장치(Organic Light Emitting Display Device), 플라즈마 표시 장치(Plasma Display Device) 등과 같은 표시 장치의 사용이 증가하고 있다.
표시 장치는 사용자 인증을 위해 지문 센서를 구비할 수 있다. 지문 센서는 광학식 지문 센서(optical fingerprint sensor)일 수 있다.
표시 장치는 조사 광원(irradiation light source)을 이용하여 사용자의 지문에 고휘도의 광을 조사하고, 광학식 지문 센서는 조사 광의 반사 광을 검출함으로써 사용자의 지문 형태를 검출할 수 있다.
표시 장치는 화소들을 조사 광원으로 이용할 수도 있다. 이러한 경우, 지문 센싱 영역에 위치한 화소들은 국부적으로 고휘도의 광을 방출할 필요가 있다. 하지만, 종래 기술에 따른 표시 장치는 단일(single) 계조 전압 생성부를 포함하기 때문에, 지문 비-센싱 영역에 위치한 화소들이 고계조를 표시할 경우, 의도치 않은 고휘도의 광이 방출되는 문제가 있다.
해결하고자 하는 기술적 과제는, 지문 센싱 영역에 위치한 화소들이 국부적으로 고휘도의 광을 방출하더라도 지문 비-센싱 영역의 표시가 정상적으로 유지될 수 있는 표시 장치를 제공하는 데 있다.
본 발명의 한 실시예에 따른 표시 장치는, 제1 데이터 라인과 연결된 제1 화소; 제2 데이터 라인과 연결된 제2 화소; 제1 노드 전압이 인가된 제1 노드; 제1 계조 전압들을 생성하는 제1 계조 전압 생성부; 제2 계조 전압들을 생성하는 제2 계조 전압 생성부; 및 상기 제1 계조 전압들 중 하나에 기초하여 생성된 제1 데이터 신호를 상기 제1 데이터 라인에 인가하고, 상기 제1 노드 전압, 상기 제1 계조 전압들, 및 상기 제2 계조 전압들 중 하나에 기초하여 생성된 제2 데이터 신호를 상기 제2 데이터 라인에 인가하는 데이터 구동부를 포함한다.
상기 데이터 구동부는 디지털-아날로그 변환부를 포함하고, 상기 디지털-아날로그 변환부는: 입력 단자가 상기 제1 계조 전압 생성부와 연결되고, 출력 단자가 상기 제1 데이터 라인과 연결된 제1 디지털-아날로그 변환기; 입력 단자들이 상기 제1 노드, 상기 제1 계조 전압 생성부, 및 상기 제2 계조 전압 생성부와 연결된 멀티플렉서; 및 입력 단자가 상기 멀티플렉서의 출력 단자와 연결되고, 출력 단자가 상기 제2 데이터 라인과 연결된 제2 디지털-아날로그 변환기를 포함할 수 있다.
상기 제1 계조 전압 생성부는 제1 고전압 단자에 인가된 제1 고전압과 제1 저전압 단자에 인가된 제1 저전압의 차이를 분압하여 상기 제1 계조 전압들을 생성하고, 상기 제2 계조 전압 생성부는 제2 고전압 단자에 인가된 제2 고전압과 제2 저전압 단자에 인가된 제2 저전압의 차이를 분압하여 상기 제2 계조 전압들을 생성할 수 있다.
상기 제1 노드는 상기 제1 저전압 단자와 연결될 수 있다.
상기 제1 노드는 상기 제2 저전압 단자와 더 연결될 수 있다.
상기 멀티플렉서는: 제1 기간 동안 상기 제1 계조 전압들을 상기 제2 디지털-아날로그 변환기로 제공하고, 상기 제1 기간 다음의 제2 기간 동안 상기 제1 노드 전압을 상기 제2 디지털-아날로그 변환기로 제공하고, 상기 제2 기간 다음의 제3 기간 동안 상기 제2 계조 전압들을 상기 제2 디지털-아날로그 변환기로 제공하고, 상기 제1 기간, 상기 제2 기간, 및 상기 제3 기간은 한 영상 프레임 기간에 포함될 수 있다.
상기 멀티플렉서는: 상기 제3 기간 다음의 제4 기간 동안 상기 제1 노드 전압을 상기 제2 디지털-아날로그 변환기로 제공하고, 상기 제4 기간 다음의 제5 기간 동안 상기 제1 계조 전압들을 상기 제2 디지털-아날로그 변환기로 제공하고, 상기 제1 기간, 상기 제2 기간, 상기 제3 기간, 상기 제4 기간, 및 상기 제5 기간은 한 영상 프레임 기간에 포함될 수 있다.
상기 제1 계조 전압 생성부는: 상기 제1 계조 전압들 중 제1 색상을 표현하기 위한 제1 색상 계조 전압들을 생성하는 제1 색상 계조 전압 생성부; 상기 제1 계조 전압들 중 상기 제1 색상과 다른 제2 색상을 표현하기 위한 제2 색상 계조 전압들을 생성하는 제2 색상 계조 전압 생성부; 및 상기 제1 계조 전압들 중 상기 제1 색상 및 상기 제2 색상과 다른 제3 색상을 표현하기 위한 제3 색상 계조 전압들을 생성하는 제3 색상 계조 전압 생성부를 포함할 수 있다.
상기 제2 계조 전압 생성부는: 상기 제2 계조 전압들 중 제4 색상을 표현하기 위한 제4 색상 계조 전압들을 생성하는 제4 색상 계조 전압 생성부; 및 상기 제2 계조 전압들 중 상기 제4 색상과 다른 제5 색상을 표현하기 위한 제5 색상 계조 전압들을 생성하는 제5 색상 계조 전압 생성부를 포함할 수 있다.
상기 제4 색상 및 상기 제5 색상 각각은 상기 제1 색상, 상기 제2 색상, 및 상기 제3 색상 중 하나와 대응할 수 있다.
상기 제1 화소는 표시 영역 중 지문 비-센싱 영역에 위치하고, 상기 제2 화소는 상기 표시 영역 중 지문 센싱 영역에 위치할 수 있다.
본 발명의 한 실시예에 따른 표시 장치는, 제1 데이터 라인과 연결되고, 표시 영역 중 지문 비-센싱 영역에 위치한 제1 화소; 제2 데이터 라인과 연결되고, 상기 표시 영역 중 지문 센싱 영역에 위치한 제2 화소; 제1 노드 전압이 인가된 제1 노드; 제1 계조 전압들을 생성하는 제1 계조 전압 생성부; 제2 계조 전압들을 생성하는 제2 계조 전압 생성부; 및 상기 제1 노드 전압, 상기 제1 계조 전압들, 및 상기 제2 계조 전압들 중 하나에 기초하여 생성된 제1 데이터 신호를 상기 제1 데이터 라인에 인가하고, 상기 제1 노드 전압, 상기 제1 계조 전압들, 및 상기 제2 계조 전압들 중 하나에 기초하여 생성된 제2 데이터 신호를 상기 제2 데이터 라인에 인가하는 데이터 구동부를 포함할 수 있다.
상기 데이터 구동부는 디지털-아날로그 변환부를 포함하고, 상기 디지털-아날로그 변환부는: 입력 단자들이 상기 제1 노드, 상기 제1 계조 전압 생성부, 및 상기 제2 계조 전압 생성부와 연결된 제1 멀티플렉서; 입력 단자가 상기 제1 멀티플렉서의 출력 단자와 연결되고, 출력 단자가 상기 제1 데이터 라인과 연결된 제1 디지털-아날로그 변환기; 입력 단자들이 상기 제1 노드, 상기 제1 계조 전압 생성부, 및 상기 제2 계조 전압 생성부와 연결된 제2 멀티플렉서; 및 입력 단자가 상기 제2 멀티플렉서의 출력 단자와 연결되고, 출력 단자가 상기 제2 데이터 라인과 연결된 제2 디지털-아날로그 변환기를 포함할 수 있다.
상기 제1 계조 전압 생성부는 제1 고전압 단자에 인가된 제1 고전압과 제1 저전압 단자에 인가된 제1 저전압의 차이를 분압하여 상기 제1 계조 전압들을 생성하고, 상기 제2 계조 전압 생성부는 제2 고전압 단자에 인가된 제2 고전압과 제2 저전압 단자에 인가된 제2 저전압의 차이를 분압하여 상기 제2 계조 전압들을 생성할 수 있다.
상기 제1 노드는 상기 제1 저전압 단자와 연결될 수 있다.
상기 제1 노드는 상기 제2 저전압 단자와 더 연결될 수 있다.
상기 제2 멀티플렉서는: 제1 기간 동안 상기 제1 계조 전압들을 상기 제2 디지털-아날로그 변환기로 제공하고, 상기 제1 기간 다음의 제2 기간 동안 상기 제1 노드 전압을 상기 제2 디지털-아날로그 변환기로 제공하고, 상기 제2 기간 다음의 제3 기간 동안 상기 제2 계조 전압들을 상기 제2 디지털-아날로그 변환기로 제공하고, 상기 제1 기간, 상기 제2 기간, 및 상기 제3 기간은 한 영상 프레임 기간에 포함될 수 있다.
상기 제2 멀티플렉서는: 상기 제3 기간 다음의 제4 기간 동안 상기 제1 노드 전압을 상기 제2 디지털-아날로그 변환기로 제공하고, 상기 제4 기간 다음의 제5 기간 동안 상기 제1 계조 전압들을 상기 제2 디지털-아날로그 변환기로 제공하고, 상기 제1 기간, 상기 제2 기간, 상기 제3 기간, 상기 제4 기간, 및 상기 제5 기간은 한 영상 프레임 기간에 포함될 수 있다.
본 발명에 따른 표시 장치는 지문 센싱 영역에 위치한 화소들이 국부적으로 고휘도의 광을 방출하더라도 지문 비-센싱 영역의 표시가 정상적으로 유지될 수 있다.
도 1 및 도 2는 본 발명의 한 실시예에 따른 표시 장치를 설명하기 위한 도면이다.
도 3은 본 발명의 한 실시예에 따른 표시 패널을 설명하기 위한 도면이다.
도 4 및 도 5는 본 발명의 한 실시예에 따른 화소를 설명하기 위한 도면이다.
도 6 내지 도 9는 본 발명의 한 실시예에 따른 제1 계조 전압 생성부 및 제2 계조 전압 생성부를 설명하기 위한 도면이다.
도 10은 본 발명의 한 실시예에 따른 데이터 구동부를 설명하기 위한 도면이다.
도 11은 본 발명의 한 실시예에 따른 지문 센싱 영역 및 그 주변의 휘도를 설명하기 위한 도면이다.
도 12는 본 발명의 다른 실시예에 따른 데이터 구동부를 설명하기 위한 도면이다.
이하, 첨부한 도면을 참고로 하여 본 발명의 여러 실시 예들에 대하여 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자가 용이하게 실시할 수 있도록 상세히 설명한다. 본 발명은 여러 가지 상이한 형태로 구현될 수 있으며 여기에서 설명하는 실시 예들에 한정되지 않는다.
본 발명을 명확하게 설명하기 위해서 설명과 관계없는 부분은 생략하였으며, 명세서 전체를 통하여 동일 또는 유사한 구성요소에 대해서는 동일한 참조 부호를 붙이도록 한다. 따라서 앞서 설명한 참조 부호는 다른 도면에서도 사용할 수 있다.
또한, 도면에서 나타난 각 구성의 크기 및 두께는 설명의 편의를 위해 임의로 나타내었으므로, 본 발명이 반드시 도시된 바에 한정되지 않는다. 도면에서 여러 층 및 영역을 명확하게 표현하기 위하여 두께를 과장되게 나타낼 수 있다.
도 1 및 도 2는 본 발명의 한 실시예에 따른 표시 장치를 설명하기 위한 도면이다.
도 1을 참조하면, 본 발명의 한 실시예에 따른 표시 장치(DD)는 표시 영역(DA)을 포함하고, 표시 영역(DA)은 지문 센싱 영역(FA)과 지문 비-센싱 영역(NFA)을 포함할 수 있다.
도 2는 도 1의 I-I' 선에 따라 자른 표시 장치(DD)의 일부 단면도이다. 도 2를 참조하면, 표시 장치(DD)는 순차적으로 적층된 쿠션(CL), 표시 패널(DP), 및 윈도우(WD)를 포함할 수 있다. 또한, 표시 장치(DD)는 광학식 지문 센서(OS)를 더 포함할 수 있다.
광학식 지문 센서(OS)는 수광 소자들을 포함할 수 있고, 수광 소자들에 입사되는 광을 이용하여 사용자의 지문 정보를 추출할 수 있다.
쿠션(CL)은 표시 패널(DP)의 충격 완화를 위해서 구비되며, 신축성있는 소재로 구성될 수 있다. 쿠션(CL)이 불투명한 소재로 구성되는 경우, 쿠션(CL)은 광학식 지문 센서(OS)를 노출시키는 개구부(CO)를 포함할 수 있다.
표시 패널(DP)은 외부 프로세서에서 제공된 영상 프레임에 대한 정보에 기초하여 화소들을 발광시킴으로써 영상 프레임을 표시할 수 있다. 표시 패널(DP)에 대해서는 도 3을 참조하여 더 상세히 설명한다.
윈도우(WD)는 표시 패널(DP)을 커버하여, 외부 충격으로부터 표시 패널(DP)을 보호할 수 있다. 윈도우(WD)는 투명한 소재(유리, 플라스틱 등)로 구성될 수 있다.
사용자가 지문 센싱 영역(FA)에 지문을 위치시키면, 표시 장치(DD)는 지문 센싱 영역(FA)에 위치한 화소들을 조사 광원으로 이용하여 지문에 고휘도의 광을 조사시키고, 조사 광의 반사 광(ray1, ray2)을 이용하여 사용자의 지문 정보를 추출할 수 있다.
도 3은 본 발명의 한 실시예에 따른 표시 패널을 설명하기 위한 도면이다.
표시 패널(DP)은 타이밍 제어부(11), 데이터 구동부(12), 주사 구동부(13), 화소부(14), 제1 계조 전압 생성부(15), 제2 계조 전압 생성부(16), 및 발광 구동부(17)를 포함할 수 있다.
타이밍 제어부(11)는 외부 프로세서로부터 영상 프레임에 대한 계조 값들 및 제어 신호들을 제공받을 수 있다. 타이밍 제어부(11)는 이러한 계조 값들 및 제어 신호들을 데이터 구동부(12)의 사양(specification)에 맞게 변환하여 데이터 구동부(12)에 제공할 수 있다. 또한, 타이밍 제어부(11)는 주사 구동부(13) 및 발광 구동부(17)로 제어 신호들을 제공할 수 있다.
데이터 구동부(12)는 타이밍 제어부(11)로부터 수신한 계조 값들 및 제어 신호들을 이용하여 데이터 라인들(DL1~DLn)로 제공할 데이터 신호들을 생성할 수 있다. n은 0보다 큰 정수일 수 있다. 예를 들어, 데이터 구동부(12)는 데이터 신호들을 화소 행 단위로 데이터 라인들(DL1~DLn)에 인가할 수 있다. 각각의 데이터 신호들은 제1 계조 전압 생성부(15)에서 제공된 제1 계조 전압들, 제2 계조 전압 생성부(16)에서 제공된 제2 계조 전압들, 및 제1 노드(N1)에 인가된 제1 노드 전압 중 하나에 대응할 수 있다.
주사 구동부(13)는 타이밍 제어부(11)로부터 클록 신호, 주사 시작 신호 등의 제어 신호들을 수신하여 주사 라인들(SL1~SLm)에 제공할 주사 신호들을 생성할 수 있다. 예를 들어, 주사 구동부(13)는 주사 라인들(SL1~SLm)에 순차적으로 턴-온 레벨의 펄스를 갖는 주사 신호들을 제공할 수 있다. 예를 들어, 주사 구동부(13)는 시프트 레지스터(shift register) 형태로 구성될 수 있고, 클록 신호의 제어에 따라 주사 시작 신호의 턴-온 레벨의 펄스를 다음 스테이지 회로로 순차적으로 전달하는 방식으로 주사 신호들을 생성할 수 있다. m은 0보다 큰 정수일 수 있다.
발광 구동부(17)는 타이밍 제어부(11)로부터 클록 신호, 발광 중지 신호 등을 수신하여 발광 라인들(EL1~ELo)에 제공할 발광 신호들을 생성할 수 있다. 예를 들어, 발광 구동부(17)는 발광 라인들(EL1~ELo)에 순차적으로 턴-오프 레벨의 펄스를 갖는 발광 신호들을 제공할 수 있다. 예를 들어, 발광 구동부(17)는 시프트 레지스터 형태로 구성될 수 있고, 클록 신호의 제어에 따라 발광 중지 신호의 턴-오프 레벨의 펄스를 다음 스테이지 회로로 순차적으로 전달하는 방식으로 발광 신호들을 생성할 수 있다. o는 0보다 큰 정수일 수 있다.
화소들(14)은 화소(PXij)를 포함한다. 각각의 화소(PXij)는 대응하는 데이터 라인, 주사 라인, 및 발광 라인에 연결될 수 있다. i 및 j는 각각 0보다 큰 정수일 수 있다. 화소(PXij)는 스캔 트랜지스터가 i 번째 주사 라인 및 j 번째 데이터 라인과 연결된 화소를 의미할 수 있다. 실시예에 따라 발광 구동부(17)가 표시 패널(DP)에 구비되지 않는 경우, 화소들(14)은 발광 라인들(EL1~ELo)과 연결되지 않을 수도 있다.
화소들(14)은 제1 색상의 광을 방출하는 화소들, 제2 색상의 광을 방출하는 화소들, 및 제3 색상의 광을 방출하는 화소들을 포함할 수 있다. 제1 색상, 제2 색상, 및 제3 색상은 서로 다른 색상일 수 있다. 예를 들어, 제1 색상은 적색, 녹색, 및 청색 중 한가지 색상일 수 있고, 제2 색상은 적색, 녹색, 및 청색 중 제1 색상이 아닌 한가지 색상일 수 있고, 제3 색상은 적색, 녹색, 및 청색 중 제1 색상 및 제2 색상이 아닌 나머지 색상일 수 있다. 또한, 제1 내지 제3 색상들로 적색, 녹색, 및 청색 대신 마젠타(magenta), 시안(cyan), 및 옐로우(yellow)가 사용될 수도 있다. 다만, 본 실시예에서는 설명의 편의를 위해 제1 내지 제3 색상들로 적색, 녹색, 및 청색이 사용되며, 마젠타는 적색 및 청색의 조합, 시안은 녹색 및 청색의 조합, 옐로우는 적색 및 녹색의 조합으로 표현되는 것으로 설명한다.
이하에서, 화소들(14)의 위치는 화소들(14) 각각의 발광 다이오드의 위치를 기준으로 설명된다. 즉, 화소들(14) 각각의 발광 다이오드에 연결된 화소 회로의 위치는 발광 다이오드의 위치와 대응하지 않을 수 있으며, 공간 효율성을 위해 표시 패널(DP) 내에서 적절히 배치될 수 있다.
제1 계조 전압 생성부(15)는 제1 계조 전압들을 생성할 수 있다. 실시예에 따라, 제1 계조 전압들의 크기는 입력 최대 휘도 값에 기초할 수 있다. 이하에서 설명의 편의를 위해 0 계조(최소 계조)부터 255 계조(최대 계조)까지 총 256 개 계조들이 존재하는 것으로 설명하나, 계조 값을 8 비트 이상으로 표현하는 경우 더 많은 계조가 존재할 수도 있다. 최소 계조는 가장 어두운 계조이며, 최대 계조는 가장 밝은 계조일 수 있다.
최대 휘도 값은 최대 계조에 대응하여 화소들에서 방출되는 광의 휘도 값일 수 있다. 예를 들어, 최대 휘도 값은 하나의 도트(dot)를 이루는 제1 색상의 화소가 255 계조에 대응하여 발광하고, 제2 색상의 화소가 255 계조에 대응하여 발광하고, 및 제3 색상의 화소가 255 계조에 대응하여 발광함으로써 생성되는 백색 광의 휘도 값일 수 있다. 휘도 값의 단위는 니트(nit)일 수 있다.
따라서, 화소들(14)은 부분적으로(공간적으로) 어둡거나 밝은 영상 프레임을 표시할 수 있지만, 영상 프레임의 최대 밝기는 최대 휘도 값으로 제한되게 된다. 이러한 최대 휘도 값은 표시 장치(DD)에 대한 사용자의 조작에 의해 수동적으로 설정되거나, 조도 센서 등과 연계된 알고리즘에 의해 자동적으로 설정될 수 있다. 이때, 설정되는 최대 휘도 값을 입력 최대 휘도 값이라고 표현한다. 제1 계조 전압 생성부(15)는 외부 프로세서로부터 입력 최대 휘도 값을 직접 수신하도록 구성될 수도 있고, 타이밍 제어부(11)를 통해서 입력 최대 휘도 값을 수신하도록 구성될 수도 있다.
제품에 따라 달라질 수 있지만, 예를 들어, 최대 휘도 값의 최대 값은 1200 니트이고, 최소 값은 4 니트일 수 있다. 계조 값이 동일하더라도 입력 최대 휘도 값이 달라지면, 제1 계조 전압 생성부(15)에서 다른 제1 계조 전압들을 제공하므로 화소의 발광 휘도도 달라지게 된다.
제2 계조 전압 생성부(16)는 제2 계조 전압들을 생성할 수 있다. 실시예에 따라, 제2 계조 전압들의 크기는 입력 최대 휘도 값에 기초할 수 있다. 제2 계조 전압 생성부(16)는 제1 계조 전압 생성부(15)와 유사하게 구성될 수 있으므로, 중복된 설명은 생략한다.
제1 계조 전압 생성부(15)에서 생성된 제1 계조 전압들은 영상 프레임의 표시를 위해 사용될 수 있다. 제2 계조 전압 생성부(16)에서 생성된 제2 계조 전압들은 지문 검출을 위한 조사 광을 생성하기 위해 사용될 수 있다.
따라서, 동일한 계조 값에 대해서 제1 계조 전압에 의한 화소(PXij)의 발광 휘도보다 제2 계조 전압에 의한 화소(PXij)의 발광 휘도가 더 높을 수 있다.
제1 노드(N1)에는 제1 노드 전압이 인가될 수 있다. 제1 노드 전압에 대해서는 도 9를 참조하여 후술한다.
도 4 및 도 5는 본 발명의 한 실시예에 따른 화소를 설명하기 위한 도면이다.
도 4를 참조하면, 화소(PXij)는 트랜지스터들(M1, M2, M3, M4, M5, M6, M7), 스토리지 커패시터(Cst), 및 발광 다이오드(LD)를 포함할 수 있다.
본 실시예에서 트랜지스터들(M1~M7)은 P형 트랜지스터, 예를 들어 PMOS로 도시되었지만, 당업자라면 N형 트랜지스터, 예를 들어 NMOS로 동일한 기능을 하는 화소 회로를 구성할 수 있을 것이다.
스토리지 커패시터(Cst)는 일전극이 제1 전원 라인(ELVDD)에 연결되고, 타전극이 트랜지스터(M1)의 게이트 전극에 연결될 수 있다.
트랜지스터(M1)는 일전극이 트랜지스터(M5)의 타전극에 연결되고, 타전극이 트랜지스터(M6)의 일전극에 연결되고, 게이트 전극이 스토리지 커패시터(Cst)의 타전극에 연결될 수 있다. 트랜지스터(M1)를 구동 트랜지스터로 명명할 수 있다. 트랜지스터(M1)는 게이트 전극과 소스 전극의 전위차에 따라 제1 전원 라인(ELVDD)과 제2 전원 라인(ELVSS) 사이에 흐르는 구동 전류량을 결정한다.
트랜지스터(M2)는 일전극이 데이터 라인(DLj)에 연결되고, 타전극이 트랜지스터(M1)의 일전극에 연결되고, 게이트 전극이 현재 주사 라인(SLi)에 연결될 수 있다. 트랜지스터(M2)를 스캔 트랜지스터, 스위칭 트랜지스터 등으로 명명할 수 있다. 트랜지스터(M2)는 현재 주사 라인(SLi)에 턴-온 레벨의 주사 신호가 인가되면 데이터 라인(DLj)의 데이터 전압을 화소(PXij)로 인입시킨다.
트랜지스터(M3)는 일전극이 트랜지스터(M1)의 타전극에 연결되고, 타전극이 트랜지스터(M1)의 게이트 전극에 연결되고, 게이트 전극이 현재 주사 라인(SLi)에 연결된다. 트랜지스터(M3)는 현재 주사 라인(SLi)에 턴-온 레벨의 주사 신호가 인가되면 트랜지스터(M1)를 다이오드 형태로 연결시킨다.
트랜지스터(M4)는 일전극이 트랜지스터(M1)의 게이트 전극에 연결되고, 타전극이 초기화 전압 라인(VINT)에 연결되고, 게이트 전극이 이전 주사 라인(SL(i-1))에 연결된다. 다른 실시예에서, 트랜지스터(M4)의 게이트 전극은 다른 주사 라인에 연결될 수도 있다. 트랜지스터(M4)는 이전 주사 라인(SL(i-1))에 턴-온 레벨의 주사 신호가 인가되면 트랜지스터(M1)의 게이트 전극에 초기화 전압을 전달하여, 트랜지스터(M1)의 게이트 전극의 전하량을 초기화시킨다.
트랜지스터(M5)는 일전극이 제1 전원 라인(ELVDD)에 연결되고, 타전극이 트랜지스터(M1)의 일전극에 연결되고, 게이트 전극이 발광 라인(ELi)에 연결된다. 트랜지스터(M6)는 일전극이 트랜지스터(M1)의 타전극에 연결되고, 타전극이 발광 다이오드(LD)의 애노드에 연결되고, 게이트 전극이 발광 라인(ELi)에 연결된다. 트랜지스터들(M5, M6)은 발광 트랜지스터로 명명될 수 있다. 트랜지스터들(M5, M6)은 턴-온 레벨의 발광 신호가 인가되면 제1 전원 라인(ELVDD)과 제2 전원 라인(ELVSS) 사이의 구동 전류 경로를 형성하여 발광 다이오드(LD)를 발광시킨다.
트랜지스터(M7)는 일전극이 발광 다이오드(LD)의 애노드에 연결되고, 타전극이 초기화 전압 라인(VINT)에 연결되고, 게이트 전극이 현재 주사 라인(SLi)에 연결된다. 다른 실시예에서, 트랜지스터(M7)의 게이트 전극은 다른 주사 라인에 연결될 수도 있다. 예를 들어, 트랜지스터(M7)의 게이트 전극은 이전 주사 라인(SL(i-1)) 또는 그 이전 주사 라인, 다음 주사 라인(i+1 번째 주사 라인) 또는 그 다음의 주사 라인에 연결될 수도 있다. 트랜지스터(M7)는 현재 주사 라인(SLi)에 턴-온 레벨의 주사 신호가 인가되면 발광 다이오드(LD)의 애노드에 초기화 전압을 전달하여, 발광 다이오드(LD)에 축적된 전하량을 초기화시킨다.
발광 다이오드(LD)는 애노드가 트랜지스터(M6)의 타전극에 연결되고, 캐소드가 제2 전원 라인(ELVSS)에 연결될 수 있다. 발광 다이오드(LD)는 특정 색상(제1 색상, 제2 색상, 또는 제3 색상)에 해당하는 파장의 광을 방출하는 소자일 수 있다. 발광 다이오드(LD)가 방출하는 광의 파장은 발광 다이오드(LD)의 밴드갭(bandgap)에 의존할 수도 있다.
발광 다이오드(LD)는 유기 발광 다이오드(organic light emitting diode), 무기 발광 다이오드(inorganic light emitting diode), 나노 엘이디(Nano light emitting diode) 등에 해당할 수 있다.
도 5는 도 4의 화소의 예시적인 구동 방법을 설명하기 위한 도면이다.
먼저, 이전 주사 라인(SL(i-1))에 턴-온 레벨(로우 레벨)의 주사 신호가 인가된다. 이때, 트랜지스터(M4)는 턴-온 상태가 되므로, 트랜지스터(M1)의 게이트 전극에 초기화 전압이 인가되어 전하량이 초기화된다. 발광 라인(ELi)에는 턴-오프 레벨(하이 레벨)의 발광 신호가 인가되므로, 트랜지스터들(M5, M6)은 턴-오프 상태이고, 초기화 전압 인가 과정에 따른 불필요한 발광 다이오드(LD)의 발광이 방지된다.
다음으로, 데이터 라인(DLj)에는 현재 화소행에 대한 데이터 전압(DATAij)이 인가되고, 현재 주사 라인(SLi)에는 턴-온 레벨의 주사 신호가 인가된다. 이에 따라 트랜지스터(M2, M1, M3)가 도통 상태가 되며, 데이터 라인(DLj)과 트랜지스터(M1)의 게이트 전극이 전기적으로 연결된다. 따라서, 데이터 전압(DATAij)이 스토리지 커패시터(Cst)의 타전극에 인가되고, 스토리지 커패시터(Cst)는 제1 전원 라인(ELVDD)의 전압과 데이터 전압(DATAij)의 차이에 해당하는 전하량을 축적한다.
이때, 트랜지스터(M7)는 턴-온 상태이므로, 발광 다이오드(LD)의 애노드와 초기화 전압 라인(VINT)이 연결되고, 발광 다이오드(LD)는 초기화 전압과 제2 전원 전압의 전압 차이에 해당하는 전하량으로 프리차지(precharge) 또는 초기화된다.
이후, 발광 라인(ELi)에 턴-온 레벨의 발광 신호가 인가됨에 따라, 트랜지스터들(M5, M6)이 턴-온되며, 스토리지 커패시터(Cst)에 축적된 전하량에 따라 트랜지스터(M1)를 통과하는 구동 전류량이 조절되어 발광 다이오드(LD)로 구동 전류가 흐른다. 발광 다이오드(LD)는 발광 라인(ELi)에 턴-오프 레벨의 발광 신호가 인가되기 전까지 발광한다. 따라서, 발광 라인(ELi)에 턴-온 레벨의 발광 신호가 인가되는 기간을 해당 화소의 발광 기간이라고 명명할 수 있다.
도 6 내지 도 9는 본 발명의 한 실시예에 따른 제1 계조 전압 생성부 및 제2 계조 전압 생성부를 설명하기 위한 도면이다.
제1 계조 전압 생성부(15)에서 생성된 제1 계조 전압들은 영상 프레임의 표시를 위해 사용되므로, 모든 3원색(적색, 청색, 녹색)에 대한 제1 계조 전압들이 구비될 필요가 있다.
따라서, 제1 계조 전압 생성부(15)는 제1 색상 계조 전압 생성부(15R), 제2 색상 계조 전압 생성부(15G), 및 제3 색상 계조 전압 생성부(15B)를 포함할 수 있다.
제1 색상 계조 전압 생성부(15R)는 제1 계조 전압들 중 제1 색상을 표현하기 위한 제1 색상 계조 전압들을 생성할 수 있다. 전술한 바와 같이, 설명의 편의를 위하여 제1 색상은 적색으로 가정한다.
제2 색상 계조 전압 생성부(15G)는 제1 계조 전압들 중 제1 색상과 다른 제2 색상을 표현하기 위한 제2 색상 계조 전압들을 생성할 수 있다. 전술한 바와 같이, 설명의 편의를 위하여 제2 색상은 녹색으로 가정한다.
제3 색상 계조 전압 생성부(15B)는 제1 계조 전압들 중 제1 색상 및 제2 색상과 다른 제3 색상을 표현하기 위한 제3 색상 계조 전압들을 생성할 수 있다. 전술한 바와 같이 설명의 편의를 위하여 제3 색상은 청색으로 가정한다.
제2 계조 전압 생성부(16)에서 생성된 제2 계조 전압들은 지문 검출을 위한 조사 광을 생성하기 위해 사용될 수 있다. 조사 광의 높은 휘도는 지문 검출을 위해 필요한 요소이나, 조사 광의 색상은 지문 검출에 불필요한 요소일 수 있다. 따라서, 모든 3원색에 대응하는 제2 계조 전압들이 구비될 필요는 없다.
따라서, 제2 계조 전압 생성부(16)는 2 개의 색상 계조 전압 생성부들(예를 들어, 제4 색상 계조 전압 생성부(16G) 및 제5 색상 계조 전압 생성부(16B))을 포함할 수 있다.
제4 색상 계조 전압 생성부(16G)는 제2 계조 전압들 중 제4 색상을 표현하기 위한 제4 색상 계조 전압들을 생성할 수 있다.
제5 색상 계조 전압 생성부(16B)는 제2 계조 전압들 중 제4 색상과 다른 제5 색상을 표현하기 위한 제5 색상 계조 전압들을 생성할 수 있다.
제4 색상 및 상기 제5 색상 각각은 제1 색상, 제2 색상, 및 제3 색상 중 하나와 대응할 수 있다. 예를 들어, 제4 색상은 녹색이고, 제5 색상은 청색일 수 있다. 다른 예를 들어, 제4 색상은 녹색이고, 제5 색상은 적색일 수 있다. 또 다른 예를 들어, 제4 색상은 청색이고, 제5 색상은 적색일 수 있다.
본 실시예에 따르면, 제2 계조 전압 생성부(16)가 2 개의 색상 계조 전압 생성부들만 구비하므로, 3 개의 색상 계조 전압 생성부들을 포함하는 제1 계조 전압 생성부(15)에 비해 구성 비용이 감소되는 장점이 있다.
다른 실시예에 따르면, 제2 계조 전압 생성부(16)는 1 개의 색상 계조 전압 생성부만을 포함할 수도 있다. 예를 들어, 제2 계조 전압 생성부(16)는 녹색 계조 전압 생성부만을 포함할 수 있다. 알려진 바와 같이, 녹색은 적색 및 청색에 비해 휘도에 기여하는 바가 높다. 따라서, 녹색 광으로 지문 검출에 필요한 휘도를 충분히 확보할 수 있는 경우, 제2 계조 전압 생성부(16)는 1 개의 색상 계조 전압 생성부만을 포함하도록 구성될 수도 있다.
도 7을 참조하면, 예시적인 제1 색상 계조 전압 생성부(15R)가 도시된다. 다른 색상 계조 전압 생성부들(15G, 15B, 16G, 16B)은 제1 색상 계조 전압 생성부(15R)와 실질적으로 동일하게 구성될 수 있으므로, 중복된 설명은 생략한다. 다만, 다른 색상 계조 전압 생성부들(15G, 15B, 16G, 16B)의 선택 값 제공부에 저장된 선택 값들은 제1 색상 계조 전압 생성부(15R)의 선택 값 제공부(1511)에 저장된 선택 값들과 다를 수 있다.
제1 색상 계조 전압 생성부(15R)는 선택 값 제공부(1511), 계조 전압 출력부(1512), 저항 스트링들(RS1~RS11), 멀티플렉서들(MX1~MX12), 및 저항들(R1~R10)을 포함할 수 있다.
선택 값 제공부(1511)는 입력 최대 휘도 값(DBVI)에 따라 멀티플렉서들(MX1~MX12)에 대한 선택 값들을 제공할 수 있다. 입력 최대 휘도 값(DBVI)에 따른 선택 값들은 메모리 소자, 예를 들어 레지스터 등의 소자에 미리 저장될 수 있다.
저항 스트링(RS1)은 제1 고전압 단자(VH1)에 인가된 제1 고전압 및 제1 저전압 단자(VL1)에 인가된 제2 저전압의 중간 전압들을 생성할 수 있다. 멀티플렉서(MX1)는 선택 값에 따라 저항 스트링(RS1)으로부터 제공된 중간 전압들 중 하나를 선택하여, 기준 전압(VT)을 출력할 수 있다. 멀티플렉서(MX2)는 선택 값에 따라 저항 스트링(RS1)으로부터 제공된 중간 전압들 중 하나를 선택하여, 255 계조 전압(RV255)을 출력할 수 있다.
저항 스트링(RS11)은 기준 전압(VT) 및 255 계조 전압(RV255)의 중간 전압들을 생성할 수 있다. 멀티플렉서(MX12)는 선택 값에 따라 저항 스트링(RS11)으로부터 제공된 중간 전압들 중 하나를 선택하여, 203 계조 전압(RV203)을 출력할 수 있다.
저항 스트링(RS10)은 기준 전압(VT) 및 203 계조 전압(RV203)의 중간 전압들을 생성할 수 있다. 멀티플렉서(MX11)는 선택 값에 따라 저항 스트링(RS10)으로부터 제공된 중간 전압들 중 하나를 선택하여, 151 계조 전압(RV151)을 출력할 수 있다.
저항 스트링(RS9)은 기준 전압(VT) 및 151 계조 전압(RV151)의 중간 전압들을 생성할 수 있다. 멀티플렉서(MX10)는 선택 값에 따라 저항 스트링(RS9)으로부터 제공된 중간 전압들 중 하나를 선택하여, 87 계조 전압(RV87)을 출력할 수 있다.
저항 스트링(RS8)은 기준 전압(VT) 및 87 계조 전압(RV87)의 중간 전압들을 생성할 수 있다. 멀티플렉서(MX9)는 선택 값에 따라 저항 스트링(RS8)으로부터 제공된 중간 전압들 중 하나를 선택하여, 51 계조 전압(RV51)을 출력할 수 있다.
저항 스트링(RS7)은 기준 전압(VT) 및 51 계조 전압(RV51)의 중간 전압들을 생성할 수 있다. 멀티플렉서(MX8)는 선택 값에 따라 저항 스트링(RS7)으로부터 제공된 중간 전압들 중 하나를 선택하여, 35 계조 전압(RV35)을 출력할 수 있다.
저항 스트링(RS6)은 기준 전압(VT) 및 35 계조 전압(RV35)의 중간 전압들을 생성할 수 있다. 멀티플렉서(MX7)는 선택 값에 따라 저항 스트링(RS6)으로부터 제공된 중간 전압들 중 하나를 선택하여, 23 계조 전압(RV23)을 출력할 수 있다.
저항 스트링(RS5)은 기준 전압(VT) 및 23 계조 전압(RV23)의 중간 전압들을 생성할 수 있다. 멀티플렉서(MX6)는 선택 값에 따라 저항 스트링(RS5)으로부터 제공된 중간 전압들 중 하나를 선택하여, 11 계조 전압(RV11)을 출력할 수 있다.
저항 스트링(RS4)은 제1 고전압 및 11 계조 전압(RV11)의 중간 전압들을 생성할 수 있다. 멀티플렉서(MX5)는 선택 값에 따라 저항 스트링(RS4)으로부터 제공된 중간 전압들 중 하나를 선택하여, 7 계조 전압(RV7)을 출력할 수 있다.
저항 스트링(RS3)은 제1 고전압 및 7 계조 전압(RV7)의 중간 전압들을 생성할 수 있다. 멀티플렉서(MX4)는 선택 값에 따라 저항 스트링(RS3)으로부터 제공된 중간 전압들 중 하나를 선택하여, 1 계조 전압(RV1)을 출력할 수 있다.
저항 스트링(RS2)은 제1 고전압 및 1 계조 전압(RV1)의 중간 전압들을 생성할 수 있다. 멀티플렉서(MX3)는 선택 값에 따라 저항 스트링(RS2)으로부터 제공된 중간 전압들 중 하나를 선택하여, 0 계조 전압(RV0)을 출력할 수 있다.
전술한 0, 1, 7, 11, 23, 35, 51, 87, 151, 203, 및 255 계조들은 기준 계조들로 명명될 수 있다. 또한, 멀티플렉서들(MX2~MX12)로부터 생성된 계조 전압들(RV0, RV1, RV7, RV11, RV23, RV35, RV51, RV87, RV151, RRV203, RV255)은 기준 계조 전압들로 명명될 수 있다. 기준 계조들의 개수 및 기준 계조들에 해당하는 계조 번호는 제품에 따라 달리 설정될 수 있다. 이하에서는 설명의 편의를 위하여, 0, 1, 7, 11, 23, 35, 51, 87, 151, 203, 및 255 계조를 기준 계조로서 설명한다.
계조 전압 출력부(1512)는 기준 계조 전압들(RV0, RV1, RV7, RV11, RV23, RV35, RV51, RV87, RV151, RV203, RV255)을 분압하여, 제1 색상 계조 전압들(RV0~RV255)을 생성할 수 있다. 예를 들어, 계조 전압 출력부(1512)는 기준 계조 전압들(RV1, RV7)을 분압하여 제1 색상 계조 전압들(RV2~RV6)을 생성할 수 있다.
도 8을 참조하면, 계조 값에 대한 출력 휘도의 백색 광 곡선들(WC1, WC2, ..., WC(k-1), WCk)이 도시된다. k는 0보다 큰 정수일 수 있다.
백색 광 곡선들(WC1~WCk)의 최대 휘도 값들은 서로 다를 수 있다. 예를 들어, 백색 광 곡선(WC1)의 최대 휘도 값(예를 들어, 4 니트)이 가장 낮고, 백색 광 곡선(WCk)의 최대 휘도 값(예를 들어, 1200 니트)이 가장 높을 수 있다.
이때, 백색 광을 생성하기 위해서, 모든 색상의 화소들(14)은 동일한 계조에 대한 데이터 전압들을 입력받는 것으로 가정한다.
도 8의 백색 광 곡선들(WC1~WCk) 상에 도시된 가상의 점들(imaginary dots)이 전술한 선택 값 제공부(1511)에 미리 저장된 선택 값들과 대응할 수 있다. 선택 값들의 개수가 많을 수록 더 정확한 백색 광 곡선들을 직접 표현 할 수 있지만, 증가된 선택 값들에 대응하는 멀티플렉서들, 레지스터들 등의 물리 소자들도 더 필요하게 되므로 한계가 존재한다. 따라서, 전술한 기준 계조 전압들에 대한 선택 값들이 미리 저장되고 사용되며, 나머지 계조 전압들은 분압되어 생성될 수 있다. 또한, 동일한 이유로 4 니트 내지 1200 니트 사이에서 일부 최대 휘도 값들(예를 들어, 기준 최대 휘도 값들)에 대한 선택 값들이 미리 저장되고 사용되며, 나머지 최대 휘도 값들에 대해서는 선택 값들이 보간되어 생성될 수 있다.
미리 저장된 선택 값들은 다-시점 프로그래밍(MTP, multi-time programming)을 통해서, 개별 제품 마다 설정될 수 있다. 즉, 계조 값들에 대해서 목적하는 휘도의 백색 광이 방출될 수 있도록, 반복 측정을 통해서 선택 값들이 설정되어 제품에 저장될 수 있다.
한 실시예에 따르면, 제1 계조 전압 생성부(15) 및 제2 계조 전압 생성부(16)에 동일한 입력 최대 휘도 값(DBVI)이 입력되더라도, 제1 계조 전압 생성부(15)에 대응하는 제1 백색 광 곡선과 제2 계조 전압 생성부(16)에 대응하는 제2 백색 광 곡선은 서로 다를 수 있다. 예를 들어, 동일한 계조 값에 대하여, 제2 계조 전압 생성부(16)의 제2 계조 전압에 기초하여 발광하는 제2 화소의 발광 휘도는 제1 계조 전압 생성부(15)의 제1 계조 전압에 기초하여 발광하는 제1 화소의 발광 휘도보다 높을 수 있다. 예를 들어, 제1 백색 광 곡선이 WCx라면, 제2 백색 광 곡선은 WCy일 수 있다. 이때, x는 정수이고, y는 x보다 큰 정수일 수 있다.
도 9를 참조하면, 제1 계조 전압 생성부(15), 제2 계조 전압 생성부(16), 및 제1 노드(N1)의 한 실시예에 따른 연결 구성이 도시된다.
도 7을 참조하여 전술한 바와 같이, 제1 계조 전압 생성부(15)는 제1 고전압 단자(VH1)에 인가된 제1 고전압과 제1 저전압 단자(VL1)에 인가된 제1 저전압의 차이를 분압하여 제1 계조 전압들을 생성할 수 있다. 생성된 제1 계조 전압들은 제1 계조 전압 생성부(15)의 출력 라인들(OLS1)에 인가될 수 있다.
유사하게, 제2 계조 전압 생성부(16)는 제2 고전압 단자(VH2)에 인가된 제2 고전압과 제2 저전압 단자(VL2)에 인가된 제2 저전압의 차이를 분압하여 제2 계조 전압들을 생성할 수 있다. 생성된 제2 계조 전압들은 제2 계조 전압 생성부(16)의 출력 라인들(OLS2)에 인가될 수 있다.
한 실시예에 따르면, 공통 저전압 단자(VLC)가 구비될 수 있다. 제1 저전압 단자(VL1) 및 제2 저전압 단자(VL2)는 공통 저전압 단자(VLC)와 연결될 수 있다. 이때, 제1 노드(N1)는 제1 저전압 단자(VL1) 및 제2 저전압 단자(VL2)와 연결될 수 있다.
다른 실시예에 따르면, 공통 저전압 단자(VLC)가 구비되지 않을 수도 있다. 이때, 제1 저전압 단자(VL1) 및 제2 저전압 단자(VL2)는 서로 분리될 수도 있다. 이러한 경우, 제1 노드(N1)는 제1 저전압 단자(VL1)에만 연결될 수도 있다. 한편, 제1 노드(N1)는 제2 저전압 단자(VL2)에만 연결될 수도 있다.
각 실시예에 따르는 경우, 제1 노드(N1)에는 안정적인 제1 노드 전압이 유지될 수 있다. 예를 들어, 제1 저전압 및 제2 저전압은 계조 전압들을 생성하기 위한 기초 전압으로써, 계조 전압들과 달리 입력 최대 휘도 값(DBVI)에 따라 변동되지 않는, 비교적 안정적인 전압일 수 있다.
도 10은 본 발명의 한 실시예에 따른 데이터 구동부를 설명하기 위한 도면이다.
도 10을 참조하면, 본 발명의 한 실시예에 따른 데이터 구동부(12)는 쉬프트 레지스터부(SHR), 샘플링 래치부(SLU), 홀딩 래치부(HLU), 디지털-아날로그 변환부(DAU), 및 버퍼부(BFU)를 선택적으로 포함할 수 있다.
여기서, 쉬프트 레지스터부(SHR), 샘플링 래치부(SLU), 홀딩 래치부(HLU), 및 버퍼부(BFU)는 종래 기술을 이용하여 구성 가능하다. 이하에선, 쉬프트 레지스터부(SHR), 샘플링 래치부(SLU), 홀딩 래치부(HLU), 및 버퍼부(BFU)의 예시적인 구성을 기재한다.
쉬프트 레지스터부(SHR)는 타이밍 제어부(11)로부터 소스 스타트 펄스(source start pulse) 및 소스 쉬프트 클록(source shift clock)을 제공받을 수 있다. 쉬프트 레지스터부(SHR)는 소스 쉬프트 클록의 1 주기마다 소스 스타트 펄스를 쉬프트시키면서 샘플링 신호들을 순차적으로 생성할 수 있다. 샘플링 신호들의 개수는 데이터 라인들(..., DL1a, DL1b, DL1c, ..., DL2a, DL2b, DL2c, ..., DL3a, DL3b, DL3c, ...)의 개수와 대응할 수 있다. 예를 들어, 샘플링 신호들의 개수는 데이터 라인들(DL1a~DL3c)와 동일할 수 있다. 다른 예를 들어, 표시 패널(DP)이 데이터 구동부(12)와 데이터 라인들(DL1a~DL3c) 사이에 디멀티플렉서를 더 포함한다면, 샘플링 신호들의 개수는 데이터 라인들(DL1a~DL3c)의 개수보다 작을 수도 있다. 설명의 편의를 위해서, 이하에선 샘플링 신호들의 개수와 데이터 라인들(DL1a~DL3c)의 개수가 동일한 경우를 가정한다.
샘플링 래치부(SLU)는 데이터 라인들(DL1a~DL3c)의 개수와 대응하는 샘플링 래치들을 포함할 수 있고, 타이밍 제어부(11)로부터 영상 프레임에 대한 계조 값들을 순차적으로 제공받을 수 있다. 샘플링 래치부(SLU)는 쉬프트 레지스터부(SHR)로부터 순차적으로 공급받은 샘플링 신호들에 응답하여, 타이밍 제어부(11)로부터 순차적으로 제공받은 계조 값들을 대응하는 샘플링 래치들에 저장할 수 있다.
홀딩 래치부(HLU)는 데이터 라인들(DL1a~DL3c)의 개수와 대응하는 홀딩 래치들을 포함할 수 있다. 홀딩 래치부(HLU)는 타이밍 제어부(11)로부터 소스 출력 인에이블 신호(source output enable)가 입력될 때, 샘플링 래치들에 저장된 계조 값들을 홀딩 래치들에 저장할 수 있다.
디지털-아날로그 변환부(DAU)는 디지털-아날로그 변환기들(..., DAC1, ..., DAC2, ..., DAC3, ...) 및 멀티플렉서들(..., MUX, ...)을 포함할 수 있다. 본 실시예에서, 디지털-아날로그 변환기들(DAC1~DAC3)의 개수는 데이터 라인들(DL1a~DL3c)의 개수와 대응할 수 있다. 예를 들어, 디지털-아날로그 변환기들(DAC1~DAC3)의 개수는 데이터 라인들(DL1a~DL3c)의 개수와 동일할 수 있다. 하지만, 멀티플렉서들(MUX)의 개수는 데이터 라인들(DL1a~DL3c)의 개수와 대응하지 않을 수 있다. 예를 들어, 멀티플렉서들(MUX)의 개수는 디지털-아날로그 변환기들(DAC1~DAC3)의 개수보다 더 작을 수 있다.
제1 디지털-아날로그 변환기(DAC1) 및 제3 디지털-아날로그 변환기(DAC3)의 입력 단자들은 멀티플렉서(MUX)와 연결되지 않을 수 있다. 제1 디지털-아날로그 변환기(DAC1) 및 제3 디지털-아날로그 변환기(DAC3)의 연결 구성들을 실질적으로 동일할 수 있으므로, 이하에선 제1 디지털-아날로그 변환기(DAC1)를 기준으로 설명한다. 제1 디지털-아날로그 변환기(DAC1)는 입력 단자가 제1 계조 전압 생성부(15)와 연결되고, 출력 단자가 제1 데이터 라인(DL1b)과 연결될 수 있다. 예를 들어, 제1 디지털-아날로그 변환기(DAC1)의 출력 단자는 버퍼(BUF1)를 통해서 제1 데이터 라인(DL1b)과 연결될 수 있다. 후술하는 바와 같이, 버퍼부(BFU)가 생략되는 경우 제1 디지털-아날로그 변환기(DAC1)의 출력 단자는 제1 데이터 라인(DL1b)과 직접 연결될 수도 있다.
반면, 제2 디지털-아날로그 변환기(DAC2)의 입력단은 멀티플렉서(MUX)와 연결될 수 있다. 제2 디지털-아날로그 변환기(DAC2)는 입력 단자가 멀티플렉서(MUX)의 출력 단자와 연결되고, 출력 단자가 제2 데이터 라인(DL2b)과 연결될 수 있다. 예를 들어, 제2 디지털-아날로그 변환기(DAC2)의 출력 단자는 버퍼(BUF2)를 통해서 제2 데이터 라인(DL2b)과 연결될 수 있다. 후술하는 바와 같이, 버퍼부(BFU)가 생략되는 경우 제2 디지털-아날로그 변환기(DAC2)의 출력 단자는 제2 데이터 라인(DL2b)과 직접 연결될 수도 있다.
멀티플렉서(MUX)는 입력 단자들이 제1 노드(N1), 제1 계조 전압 생성부(15), 및 제2 계조 전압 생성부(16)와 연결될 수 있다.
각각의 디지털-아날로그 변환기들(DAC1, DAC2, DAC3)은 대응하는 홀딩 래치에 저장된 계조 값에 대응하는 제1 계조 전압 또는 제2 계조 전압을 대응하는 데이터 라인에 인가할 수 있다. 다만, 제2 디지털-아날로그 변환기(DAC2)는 멀티플렉서(MUX)로부터 제1 노드 전압을 입력받는 경우, 홀딩 래치에 저장된 계조 값과 무관하게 제1 노드 전압을 출력할 수 있다.
버퍼부(BFU)는 버퍼들(..., BUF1, ..., BUF2, ..., BUF3, ...)을 포함할 수 있다. 예를 들어, 버퍼들(BUF1~BUF3)은 증폭기(amplifier) 형태로 구현될 수 있다. 버퍼들(BUF1~BUF3)은 디지털-아날로그 변환기들(DAC1~DAC3)로부터 공급된 계조 전압들에 대응하는 데이터 신호들을 생성하여 데이터 라인들(DL1a~DL3c)에 공급할 수 있다. 버퍼들(BUF1~BUF3)의 이득(gain)이 1이라면, 계조 전압들과 데이터 신호들의 전압 크기가 실질적으로 동일할 수 있다. 표시 패널(DP)에 따라서, 버퍼부(BFU)는 데이터 구동부(12)에서 제외될 수도 있으며, 이러한 경우 디지털-아날로그 변환부(DAU)는 데이터 라인들(DL1a~DL3c)과 직접 연결될 수 있다.
제1 데이터 라인들(..., DL1a, DL1b, DL1c)은 지문 비-센싱 영역(NFA)에 위치한 제1 화소들(PX1ak, PX1bk, PX1ck)과 연결될 수 있다. 제2 데이터 라인들(DL2a, DL2b, DL2c)은 지문 센싱 영역(FA)에 위치한 제2 화소들(PX2ak, PX2bk, PX2ck)과 연결될 수 있다. 제3 데이터 라인들(DL3a, DL3b, DL3c)은 지문 비-센싱 영역(NFA)에 위치한 제3 화소들(PX3ak, PX3bk, PX3ck)에 연결될 수 있다.
제1 화소들(PX1ak~PX1ck), 제2 화소들(PX2ak~PX2ck), 및 제3 화소들(PX3ak~PX3ck)은 동일한 k 번째 주사 라인(SLk)에 연결될 수 있다. 예를 들어, 각 화소들(PX1ak~PX3ck)의 스위칭 트랜지스터(M2)의 게이트 전극은 k 번째 주사 라인(SLk)과 연결될 수 있다(도 4 참조). k는 1 이상의 정수일 수 있다.
도 11은 본 발명의 한 실시예에 따른 지문 센싱 영역 및 그 주변의 휘도를 설명하기 위한 도면이다. 도 11을 설명함에 있어서, 도 10을 더 참조한다.
도 11에서 지문 센싱 영역(FA)을 제외한 나머지 영역은 지문 비-센싱 영역이다. 지문 센싱 영역(FA)에 위치한 화소들(PX2ak, PX2bk, PX2ck, ...)은 지문 센싱 기간 동안 제2 계조 전압들에 기초하여 고휘도의 조사 광을 방출할 수 있다. 지문 센싱 기간은 복수의 영상 프레임 기간들에 대응할 수 있다.
멀티플렉서(MUX)는 제1 기간 동안 제1 계조 전압들을 제2 디지털-아날로그 변환기(DAC2)로 제공할 수 있다. 따라서, 제1 기간 동안, 제2 데이터 라인들(DL2a, DL2b, DL2c)에는 제1 계조 전압들에 기초한 제2 데이터 신호들이 인가될 수 있다. 제1 기간 동안, 제1 데이터 라인들(DL1a, DL1b, DL1c) 및 제3 데이터 라인들(DL3a, DL3b, DL3c)에는 제1 계조 전압들에 기초한 제1 데이터 신호들 및 제3 데이터 신호들이 인가될 수 있다.
제1 기간 중, 주사 라인(SL(k-2))으로 턴-온 레벨의 주사 신호가 공급되면, 주사 라인(SL(k-2))에 연결된 화소들(PX1a(k-2)~PX3c(k-2))에 제1 계조 전압들에 대응하는 데이터 신호들이 기입될 수 있다. 화소들(PX1a(k-2)~PX3c(k-2))은 발광 기간 동안 제1 계조 전압들에 대응하여 발광할 수 있다.
다음으로, 멀티플렉서(MUX)는 제1 기간 다음의 제2 기간 동안 제1 노드 전압을 제2 디지털-아날로그 변환기(DAC2)로 제공할 수 있다. 따라서, 제2 기간 동안, 제2 데이터 라인들(DL2a, DL2b, DL2c)에는 제1 노드 전압에 기초한 제2 데이터 신호들이 인가될 수 있다. 제2 기간 동안, 제1 데이터 라인들(DL1a, DL1b, DL1c) 및 제3 데이터 라인들(DL3a, DL3b, DL3c)에는 제1 계조 전압들에 기초한 제1 데이터 신호들 및 제3 데이터 신호들이 인가될 수 있다.
제2 기간 중, 주사 라인(SL(k-1))으로 턴-온 레벨의 주사 신호가 공급되면, 주사 라인(SL(k-1))에 연결된 제1 화소들 및 제3 화소들(PX1a(k-1)~PX1c(k-1), PX3a(k-1)~PX3c(k-1))에는 제1 계조 전압들에 대응하는 데이터 신호들이 기입될 수 있다. 제1 화소들 및 제3 화소들(PX1a(k-1)~PX1c(k-1), PX3a(k-1)~PX3c(k-1))은 발광 기간 동안 제1 계조 전압들에 대응하여 발광할 수 있다.
한편, 제2 기간 중, 주사 라인(SL(k-1))에 연결된 제2 화소들(PX2a(k-2)~PX2c(k-2))에는 제1 노드 전압에 대응하는 데이터 신호들이 기입될 수 있다. 도 4, 도 7, 및 도 9를 다시 참조하면, 제1 노드 전압은 생성될 수 있는 계조 전압들 중 가장 낮은 전압에 대응하고, 구동 트랜지스터(M1)는 P형으로 구성되므로, 제2 화소들(PX2a(k-2)~PX2c(k-2))은 발광 기간 동안 화이트 계조(가장 밝은 계조)로 발광할 수 있다. 다른 실시예에서, 도 4의 화소 회로가 N형 트랜지스터들로 구성된 경우, 제2 화소들(PX2a(k-2)~PX2c(k-2))은 발광 기간 동안 블랙 계조(가장 어두운 계조)로 발광할 수도 있다.
다음으로, 멀티플렉서(MUX)는 제2 기간 다음의 제3 기간 동안 제2 계조 전압들을 제2 디지털-아날로그 변환기(DAC2)로 제공할 수 있다. 따라서, 제3 기간 동안, 제2 데이터 라인들(DL2a, DL2b, DL2c)에는 제2 계조 전압들에 기초한 제2 데이터 신호들이 인가될 수 있다. 제2 기간 동안, 제1 데이터 라인들(DL1a, DL1b, DL1c) 및 제3 데이터 라인들(DL3a, DL3b, DL3c)에는 제1 계조 전압들에 기초한 제1 데이터 신호들 및 제3 데이터 신호들이 인가될 수 있다.
제3 기간 중, 주사 라인(SLk)으로 턴-온 레벨의 주사 신호가 공급되면, 주사 라인(SLk)에 연결된 제1 화소들 및 제3 화소들(PX1ak~PX1ck, PX3ak~PX3ck)에는 제1 계조 전압들에 대응하는 데이터 신호들이 기입될 수 있다. 제1 화소들 및 제3 화소들(PX1ak~PX1ck, PX3ak~PX3ck)은 발광 기간 동안 제1 계조 전압들에 대응하여 발광할 수 있다.
한편, 제3 기간 중, 주사 라인(SLk)에 연결된 제2 화소들(PX2ak~PX2ck)에는 제2 계조 전압들에 대응하는 데이터 신호들이 기입될 수 있다. 제2 화소들(PX2ak~PX2ck)은 발광 기간 동안 제2 계조 전압들에 대응하여 발광할 수 있다.
제1 기간, 상기 제2 기간, 및 상기 제3 기간은 한 영상 프레임 기간에 포함될 수 있다.
다음으로, 멀티플렉서(MUX)는 제3 기간 다음의 제4 기간 동안 제1 노드 전압을 제2 디지털-아날로그 변환기(DAC2)로 제공할 수 있다. 따라서, 제4 기간 동안, 제2 데이터 라인들(DL2a, DL2b, DL2c)에는 제1 노드 전압에 기초한 제2 데이터 신호들이 인가될 수 있다. 제4 기간 동안, 제1 데이터 라인들(DL1a, DL1b, DL1c) 및 제3 데이터 라인들(DL3a, DL3b, DL3c)에는 제1 계조 전압들에 기초한 제1 데이터 신호들 및 제3 데이터 신호들이 인가될 수 있다.
제4 기간 중, 주사 라인(SL(k+3))으로 턴-온 레벨의 주사 신호가 공급되면, 주사 라인(SL(k+3))에 연결된 제1 화소들 및 제3 화소들(PX1a(k+3)~PX1c(k+3), PX3a(k+3)~PX3c(k+3))에는 제1 계조 전압들에 대응하는 데이터 신호들이 기입될 수 있다. 제1 화소들 및 제3 화소들(PX1a(k+3)~PX1c(k+3), PX3a(k+3)~PX3c(k+3))은 발광 기간 동안 제1 계조 전압들에 대응하여 발광할 수 있다.
한편, 제4 기간 중, 주사 라인(SL(k+3))에 연결된 제2 화소들(PX2a(k+3)~PX2c(k+3))에는 제1 노드 전압에 대응하는 데이터 신호들이 기입될 수 있다. 전술한 바와 같이, 제2 화소들(PX2a(k+3)~PX2c(k+3))은 발광 기간 동안 화이트 계조(또 블랙 계조)로 발광할 수 있다.
다음으로, 멀티플렉서(MUX)는 제4 기간 다음의 제5 기간 동안 제1 계조 전압들을 제2 디지털-아날로그 변환기(DAC2)로 제공할 수 있다. 따라서, 제5 기간 동안, 제2 데이터 라인들(DL2a, DL2b, DL2c)에는 제1 계조 전압들에 기초한 제2 데이터 신호들이 인가될 수 있다. 제5 기간 동안, 제1 데이터 라인들(DL1a, DL1b, DL1c) 및 제3 데이터 라인들(DL3a, DL3b, DL3c)에는 제1 계조 전압들에 기초한 제1 데이터 신호들 및 제3 데이터 신호들이 인가될 수 있다.
제5 기간 중, 주사 라인(SL(k+4))으로 턴-온 레벨의 주사 신호가 공급되면, 주사 라인(SL(k+4))에 연결된 화소들(PX1a(k+4)~PX3c(k+4))에 제1 계조 전압들에 대응하는 데이터 신호들이 기입될 수 있다. 화소들(PX1a(k+4)~PX3c(k+4))은 발광 기간 동안 제1 계조 전압들에 대응하여 발광할 수 있다.
제1 기간, 제2 기간, 제3 기간, 제4 기간, 및 제5 기간은 한 영상 프레임 기간에 포함될 수 있다.
본 실시예에 따르면, 한 영상 프레임에서 지문 센싱 영역(FA)에 위치한 제2 화소들(PX2ak, PX2bk, PX2ck, ...)에 제2 계조 전압들에 대응하는 데이터 신호들이 공급되어, 제2 화소들(PX2ak, PX2bk, PX2ck, ...)이 고휘도의 조사 광을 방출할 수 있으므로, 지문 센싱이 가능하다. 한편, 동일한 영상 프레임 동안 지문 비-센싱 영역에 위치한 다른 화소들은 제1 계조 전압들에 대응하여 구동되므로 영상 프레임의 표시 품질이 유지될 수 있다.
한편, 제2 데이터 라인들(DL2a, DL2b, DL2c)은 제1 계조 전압 생성부(15)에 연결된 상태에서 제2 계조 전압 생성부(16)에 연결된 상태로 전환되는 경우, 전환에 필요한 시간 및 제2 데이터 라인들(DL2a, DL2b, DL2c)의 전압 안정화를 위한 시간이 확보될 필요가 있다. 만약 이러한 여유 시간이 확보되지 않으면, 잘못된 데이터 신호들이 제2 화소들(PX2a(k-1), PX2b(k-1), PX2c(k-1), PX2ak, PX2bk, PX2ck)에 기입될 수도 있고, 표시 불량이 발생할 수 있다.
본 실시예에서는, 제2 데이터 라인들(DL2a, DL2b, DL2c)이 제1 계조 전압 생성부(15)에 연결된 상태에서 제2 계조 전압 생성부(16)에 연결된 상태로 전환되는 경우, 멀티플렉서(MUX)를 통해서 제1 노드 전압이 제2 데이터 라인들(DL2a, DL2b, DL2c)로 공급되도록 함으로써, 이러한 표시 불량을 방지할 수 있다. 이때, 제2 화소들(PX2a(k-1), PX2b(k-1), PX2c(k-1))은 강한 화이트 계조로 발광할 수 있으므로, 지문 센싱을 위한 조사 광으로 사용될 수도 있다.
비록, 제2 화소들(PX2a(k-1), PX2b(k-1), PX2c(k-1))을 연결하는 단색 테두리(백색 또는 흑색)가 사용자에게 시인될 수도 있지만, 지문 센싱 영역(FA)을 둘러싸는 지문 비-센싱 영역의 화소들에 화이트 계조(또는 블랙 계조)에 대응하는 데이터 신호들을 공급함으로써, 자연스러운 테두리를 사용자가 시인하도록 할 수도 있다.
또한, 전술한 바와 같이 제1 노드 전압은 안정적인 기초 전압으로써 제2 데이터 라인들(DL2a, DL2b, DL2c)의 전압 안정화를 빠르게 수행할 수 있어, 전압 안정화를 위해 필요한 시간이 감소될 수도 있다. 즉, 제1 노드 전압을 이용하는 경우, 표시되는 단색 테두리의 두께가 더 얇아질 수 있고, 영상 프레임을 표시할 수 있는 지문-비 센싱 영역의 화소들을 더 많이 확보할 수 있다.
상술한 설명은 제2 데이터 라인들(DL2a, DL2b, DL2c)이 제2 계조 전압 생성부(16)에 연결된 상태에서 제1 계조 전압 생성부(15)에 연결된 상태로 전환되는 경우에도 동일하게 적용될 수 있으므로, 중복된 설명은 생략한다.
도 12는 본 발명의 다른 실시예에 따른 데이터 구동부를 설명하기 위한 도면이다.
도 12를 참조하면, 데이터 구동부(12')는 도 10의 데이터 구동부(12)에 비해, 변형된 디지털-아날로그 변환부(DAU')를 포함한다. 다른 중복된 구성에 대한 설명은 생략한다.
데이터 구동부(12)는 제1 노드 전압, 제1 계조 전압들, 및 제2 계조 전압들 중 하나에 기초하여 생성된 제1 데이터 신호를 제1 데이터 라인(DL1b)에 인가하고, 제1 노드 전압, 제1 계조 전압들, 및 제2 계조 전압들 중 하나에 기초하여 생성된 제2 데이터 신호를 제2 데이터 라인(DL2b)에 인가할 수 있다.
디지털-아날로그 변환부(DAU')는 멀티플렉서들(MUX1, MUX2, MUX3, ...) 및 디지털-아날로그 변환기들(DAC1, DAC2, DAC3, ...)을 포함할 수 있다. 본 실시예에서, 멀티플렉서들(MUX1~MUX3)의 개수는 디지털-아날로그 변환기들(DAC1~DAC3)의 개수와 대응할 수 있다. 예를 들어, 멀티플렉서들(MUX1~MUX3)의 개수는 디지털-아날로그 변환기들(DAC1~DAC3)의 개수와 동일할 수 있다.
제1 멀티플렉서(MUX1)는 입력 단자들이 제1 노드(N1), 제1 계조 전압 생성부(15), 및 제2 계조 전압 생성부(16)와 연결될 수 있다.
제1 디지털-아날로그 변환기(DAC1)는 입력 단자가 제1 멀티플렉서(MUX1)의 출력 단자와 연결되고, 출력 단자가 제1 데이터 라인(DL1b)과 연결될 수 있다.
제2 멀티플렉서(MUX2)는 입력 단자들이 제1 노드(N1), 제1 계조 전압 생성부(15), 및 제2 계조 전압 생성부(16)와 연결될 수 있다.
제2 디지털-아날로그 변환기(DAC2)는 입력 단자가 제2 멀티플렉서(MUX2)의 출력 단자와 연결되고, 출력 단자가 제2 데이터 라인(DL2b)와 연결될 수 있다.
지금까지 참조한 도면과 기재된 발명의 상세한 설명은 단지 본 발명의 예시적인 것으로서, 이는 단지 본 발명을 설명하기 위한 목적에서 사용된 것이지 의미 한정이나 특허청구범위에 기재된 본 발명의 범위를 제한하기 위하여 사용된 것은 아니다. 그러므로 본 기술 분야의 통상의 지식을 가진 자라면 이로부터 다양한 변형 및 균등한 타 실시 예가 가능하다는 점을 이해할 것이다. 따라서, 본 발명의 진정한 기술적 보호 범위는 첨부된 특허청구범위의 기술적 사상에 의해 정해져야 할 것이다.
12: 데이터 구동부
15: 제1 계조 전압 생성부
16: 제2 계조 전압 생성부
SHR: 쉬프트 레지스터부
SLU: 샘플링 래치부
HLU: 홀딩 래치부
DAU: 디지털-아날로그 변환부
BFU: 버퍼부
PX1ak~PX3ck: 화소들

Claims (18)

  1. 제1 데이터 라인과 연결된 제1 화소;
    제2 데이터 라인과 연결된 제2 화소;
    제1 노드 전압이 인가된 제1 노드;
    제1 계조 전압들을 생성하는 제1 계조 전압 생성부;
    제2 계조 전압들을 생성하는 제2 계조 전압 생성부; 및
    상기 제1 계조 전압들 중 하나에 기초하여 생성된 제1 데이터 신호를 상기 제1 데이터 라인에 인가하고, 상기 제1 노드 전압, 상기 제1 계조 전압들, 및 상기 제2 계조 전압들 중 하나에 기초하여 생성된 제2 데이터 신호를 상기 제2 데이터 라인에 인가하는 데이터 구동부를 포함하는,
    표시 장치.
  2. 제1 항에 있어서,
    상기 데이터 구동부는 디지털-아날로그 변환부를 포함하고,
    상기 디지털-아날로그 변환부는:
    입력 단자가 상기 제1 계조 전압 생성부와 연결되고, 출력 단자가 상기 제1 데이터 라인과 연결된 제1 디지털-아날로그 변환기;
    입력 단자들이 상기 제1 노드, 상기 제1 계조 전압 생성부, 및 상기 제2 계조 전압 생성부와 연결된 멀티플렉서; 및
    입력 단자가 상기 멀티플렉서의 출력 단자와 연결되고, 출력 단자가 상기 제2 데이터 라인과 연결된 제2 디지털-아날로그 변환기를 포함하는,
    표시 장치.
  3. 제2 항에 있어서,
    상기 제1 계조 전압 생성부는 제1 고전압 단자에 인가된 제1 고전압과 제1 저전압 단자에 인가된 제1 저전압의 차이를 분압하여 상기 제1 계조 전압들을 생성하고,
    상기 제2 계조 전압 생성부는 제2 고전압 단자에 인가된 제2 고전압과 제2 저전압 단자에 인가된 제2 저전압의 차이를 분압하여 상기 제2 계조 전압들을 생성하는,
    표시 장치.
  4. 제3 항에 있어서,
    상기 제1 노드는 상기 제1 저전압 단자와 연결된,
    표시 장치.
  5. 제4 항에 있어서,
    상기 제1 노드는 상기 제2 저전압 단자와 더 연결된,
    표시 장치.
  6. 제2 항에 있어서,
    상기 멀티플렉서는:
    제1 기간 동안 상기 제1 계조 전압들을 상기 제2 디지털-아날로그 변환기로 제공하고,
    상기 제1 기간 다음의 제2 기간 동안 상기 제1 노드 전압을 상기 제2 디지털-아날로그 변환기로 제공하고,
    상기 제2 기간 다음의 제3 기간 동안 상기 제2 계조 전압들을 상기 제2 디지털-아날로그 변환기로 제공하고,
    상기 제1 기간, 상기 제2 기간, 및 상기 제3 기간은 한 영상 프레임 기간에 포함된,
    표시 장치.
  7. 제6 항에 있어서,
    상기 멀티플렉서는:
    상기 제3 기간 다음의 제4 기간 동안 상기 제1 노드 전압을 상기 제2 디지털-아날로그 변환기로 제공하고,
    상기 제4 기간 다음의 제5 기간 동안 상기 제1 계조 전압들을 상기 제2 디지털-아날로그 변환기로 제공하고,
    상기 제1 기간, 상기 제2 기간, 상기 제3 기간, 상기 제4 기간, 및 상기 제5 기간은 한 영상 프레임 기간에 포함된,
    표시 장치.
  8. 제1 항에 있어서,
    상기 제1 계조 전압 생성부는:
    상기 제1 계조 전압들 중 제1 색상을 표현하기 위한 제1 색상 계조 전압들을 생성하는 제1 색상 계조 전압 생성부;
    상기 제1 계조 전압들 중 상기 제1 색상과 다른 제2 색상을 표현하기 위한 제2 색상 계조 전압들을 생성하는 제2 색상 계조 전압 생성부; 및
    상기 제1 계조 전압들 중 상기 제1 색상 및 상기 제2 색상과 다른 제3 색상을 표현하기 위한 제3 색상 계조 전압들을 생성하는 제3 색상 계조 전압 생성부를 포함하는,
    표시 장치.
  9. 제8 항에 있어서,
    상기 제2 계조 전압 생성부는:
    상기 제2 계조 전압들 중 제4 색상을 표현하기 위한 제4 색상 계조 전압들을 생성하는 제4 색상 계조 전압 생성부; 및
    상기 제2 계조 전압들 중 상기 제4 색상과 다른 제5 색상을 표현하기 위한 제5 색상 계조 전압들을 생성하는 제5 색상 계조 전압 생성부를 포함하는,
    표시 장치.
  10. 제9 항에 있어서,
    상기 제4 색상 및 상기 제5 색상 각각은 상기 제1 색상, 상기 제2 색상, 및 상기 제3 색상 중 하나와 대응하는,
    표시 장치.
  11. 제1 항에 있어서,
    상기 제1 화소는 표시 영역 중 지문 비-센싱 영역에 위치하고,
    상기 제2 화소는 상기 표시 영역 중 지문 센싱 영역에 위치하는,
    표시 장치.
  12. 제1 데이터 라인과 연결되고, 표시 영역 중 지문 비-센싱 영역에 위치한 제1 화소;
    제2 데이터 라인과 연결되고, 상기 표시 영역 중 지문 센싱 영역에 위치한 제2 화소;
    제1 노드 전압이 인가된 제1 노드;
    제1 계조 전압들을 생성하는 제1 계조 전압 생성부;
    제2 계조 전압들을 생성하는 제2 계조 전압 생성부; 및
    상기 제1 노드 전압, 상기 제1 계조 전압들, 및 상기 제2 계조 전압들 중 하나에 기초하여 생성된 제1 데이터 신호를 상기 제1 데이터 라인에 인가하고, 상기 제1 노드 전압, 상기 제1 계조 전압들, 및 상기 제2 계조 전압들 중 하나에 기초하여 생성된 제2 데이터 신호를 상기 제2 데이터 라인에 인가하는 데이터 구동부를 포함하고,
    표시 장치.
  13. 제12 항에 있어서,
    상기 데이터 구동부는 디지털-아날로그 변환부를 포함하고,
    상기 디지털-아날로그 변환부는:
    입력 단자들이 상기 제1 노드, 상기 제1 계조 전압 생성부, 및 상기 제2 계조 전압 생성부와 연결된 제1 멀티플렉서;
    입력 단자가 상기 제1 멀티플렉서의 출력 단자와 연결되고, 출력 단자가 상기 제1 데이터 라인과 연결된 제1 디지털-아날로그 변환기;
    입력 단자들이 상기 제1 노드, 상기 제1 계조 전압 생성부, 및 상기 제2 계조 전압 생성부와 연결된 제2 멀티플렉서; 및
    입력 단자가 상기 제2 멀티플렉서의 출력 단자와 연결되고, 출력 단자가 상기 제2 데이터 라인과 연결된 제2 디지털-아날로그 변환기를 포함하는,
    표시 장치.
  14. 제13 항에 있어서,
    상기 제1 계조 전압 생성부는 제1 고전압 단자에 인가된 제1 고전압과 제1 저전압 단자에 인가된 제1 저전압의 차이를 분압하여 상기 제1 계조 전압들을 생성하고,
    상기 제2 계조 전압 생성부는 제2 고전압 단자에 인가된 제2 고전압과 제2 저전압 단자에 인가된 제2 저전압의 차이를 분압하여 상기 제2 계조 전압들을 생성하는,
    표시 장치.
  15. 제14 항에 있어서,
    상기 제1 노드는 상기 제1 저전압 단자와 연결된,
    표시 장치.
  16. 제15 항에 있어서,
    상기 제1 노드는 상기 제2 저전압 단자와 더 연결된,
    표시 장치.
  17. 제16 항에 있어서,
    상기 제2 멀티플렉서는:
    제1 기간 동안 상기 제1 계조 전압들을 상기 제2 디지털-아날로그 변환기로 제공하고,
    상기 제1 기간 다음의 제2 기간 동안 상기 제1 노드 전압을 상기 제2 디지털-아날로그 변환기로 제공하고,
    상기 제2 기간 다음의 제3 기간 동안 상기 제2 계조 전압들을 상기 제2 디지털-아날로그 변환기로 제공하고,
    상기 제1 기간, 상기 제2 기간, 및 상기 제3 기간은 한 영상 프레임 기간에 포함된,
    표시 장치.
  18. 제17 항에 있어서,
    상기 제2 멀티플렉서는:
    상기 제3 기간 다음의 제4 기간 동안 상기 제1 노드 전압을 상기 제2 디지털-아날로그 변환기로 제공하고,
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    표시 장치.
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