KR20200026621A - Semiconductor device package - Google Patents

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KR20200026621A
KR20200026621A KR1020180104807A KR20180104807A KR20200026621A KR 20200026621 A KR20200026621 A KR 20200026621A KR 1020180104807 A KR1020180104807 A KR 1020180104807A KR 20180104807 A KR20180104807 A KR 20180104807A KR 20200026621 A KR20200026621 A KR 20200026621A
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엘지이노텍 주식회사
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Abstract

The present invention provides a semiconductor element package with an improved adhesion force. According to an embodiment of the present invention, the semiconductor element package comprises: a substrate; an electrode disposed on the substrate; a semiconductor element disposed on the electrode; and a light-transmitting layer. The substrate includes a light-transmitting hole penetrating the substrate. The light-transmitting layer includes: a first light-transmitting unit disposed on a lower part of the substrate; a second light-transmitting unit disposed in the light-transmitting hole; a third light-transmitting unit overlapping the electrode in a horizontal direction on the substrate; and a fourth light-transmitting unit disposed on the electrode and covering the semiconductor element. An area of the first light-transmitting unit is greater than that of the second light-transmitting unit.

Description

반도체 소자 패키지{SEMICONDUCTOR DEVICE PACKAGE}Semiconductor device package {SEMICONDUCTOR DEVICE PACKAGE}

실시예는 반도체 소자 패키지에 관한 것이다.Embodiments relate to a semiconductor device package.

GaN, AlGaN 등의 화합물을 포함하는 반도체 소자는 넓고 조정이 용이한 밴드 갭 에너지를 가지는 등의 많은 장점을 가져서 발광 소자, 수광 소자 및 각종 다이오드 등으로 다양하게 사용될 수 있다.A semiconductor device including a compound such as GaN, AlGaN, etc. has many advantages, such as having a wide and easy to adjust band gap energy, and can be used in various ways as a light emitting device, a light receiving device, and various diodes.

특히, 반도체의 3-5족 또는 2-6족 화합물 반도체 물질을 이용한 발광 다이오드(Light Emitting Diode)나 레이저 다이오드(Laser Diode)와 같은 발광소자는 박막 성장 기술 및 소자 재료의 개발로 적색, 녹색, 청색 및 자외선 등 다양한 색을 구현할 수 있으며, 형광 물질을 이용하거나 색을 조합함으로써 효율이 좋은 백색 광선도 구현이 가능하며, 형광등, 백열등 등 기존의 광원에 비해 저소비전력, 반영구적인 수명, 빠른 응답속도, 안전성, 환경 친화성의 장점을 가진다. Particularly, light emitting devices such as light emitting diodes or laser diodes using semiconductors of Group 3-5 or Group 2-6 compound semiconductors have been developed through the development of thin film growth technology and device materials. Various colors such as blue and ultraviolet light can be realized, and efficient white light can be realized by using fluorescent materials or by combining colors.Low power consumption, semi-permanent lifespan, and quick response speed compared to conventional light sources such as fluorescent and incandescent lamps can be realized. It has the advantages of safety, environmental friendliness.

뿐만 아니라, 광검출기나 태양 전지와 같은 수광 소자도 반도체의 3-5족 또는 2-6족 화합물 반도체 물질을 이용하여 제작하는 경우 소자 재료의 개발로 다양한 파장 영역의 빛을 흡수하여 광 전류를 생성함으로써 감마선부터 라디오 파장 영역까지 다양한 파장 영역의 빛을 이용할 수 있다. 또한 빠른 응답속도, 안전성, 환경 친화성 및 소자 재료의 용이한 조절의 장점을 가져 전력 제어 또는 초고주파 회로나 통신용 모듈에도 용이하게 이용할 수 있다.In addition, when a light-receiving device such as a photodetector or a solar cell is also manufactured using a group 3-5 or group 2-6 compound semiconductor material of a semiconductor, the development of device materials absorbs light in various wavelength ranges to generate a photocurrent. As a result, light in various wavelength ranges, from gamma rays to radio wavelength ranges, can be used. It also has the advantages of fast response speed, safety, environmental friendliness and easy control of device materials, making it easy to use in power control or microwave circuits or communication modules.

따라서, 반도체 소자는 광 통신 수단의 송신 모듈, LCD(Liquid Crystal Display) 표시 장치의 백라이트를 구성하는 냉음극관(CCFL: Cold Cathode Fluorescence Lamp)을 대체하는 발광 다이오드 백라이트, 형광등이나 백열 전구를 대체할 수 있는 백색 발광 다이오드 조명 장치, 자동차 헤드 라이트 및 신호등 및 Gas나 화재를 감지하는 센서 등에까지 응용이 확대되고 있다. 또한, 반도체 소자는 고주파 응용 회로나 기타 전력 제어 장치, 통신용 모듈에까지 응용이 확대될 수 있다.Accordingly, the semiconductor device may replace a light emitting diode backlight, a fluorescent lamp, or an incandescent bulb which replaces a cold cathode tube (CCFL) constituting a backlight module of an optical communication means, a backlight of a liquid crystal display (LCD) display device. Applications are expanding to include white LED lighting devices, automotive headlights and traffic lights, and sensors to detect gas or fire. In addition, the semiconductor device may be extended to high frequency application circuits, other power control devices, and communication modules.

특히, 자외선 파장 영역의 광을 방출하는 발광소자는 경화작용이나 살균 작용을 하여 경화용, 의료용, 및 살균용으로 사용될 수 있다.In particular, the light emitting device that emits light in the ultraviolet wavelength region can be used for curing, medical treatment, and sterilization by curing or sterilizing.

최근 자외선 발광소자 패키지에 대한 연구가 활발하나, 아직까지 자외선 발광소자는 내구성 좋지 않고, 부착력이 낮아 패키지로부터 분리되는 한계가 존재한다.Recently, the research on the ultraviolet light emitting device package is active, but the ultraviolet light emitting device is still poor durability, there is a limit that is separated from the package because of low adhesion.

실시예는 부착력이 개선된 반도체 소자 패키지를 제공한다.The embodiment provides a semiconductor device package with improved adhesion.

또한, 자외선 광에 대한 투과율 및 내성이 개선된 반도체 소자 패키지를 제공한다.The present invention also provides a semiconductor device package having improved transmittance and resistance to ultraviolet light.

실시예에서 해결하고자 하는 과제는 이에 한정되는 것은 아니며, 아래에서 설명하는 과제의 해결수단이나 실시 형태로부터 파악될 수 있는 목적이나 효과도 포함된다고 할 것이다.The problem to be solved in the examples is not limited thereto, and the object or effect that can be grasped from the solution means or the embodiment described below will be included.

실시예에 따른 반도체 소자 패키지는 기판; 상기 기판에 배치되는 전극; 상기 전극 상에 배치되는 반도체 소자; 및 투광층;을 포함하고, 상기 기판은 상기 기판을 관통하는 투광홀을 포함하며, 상기 투광층은, 상기 기판 하부에 배치되는 제1 투광부; 상기 투광홀 내에 배치되는 제2 투광부; 상기 기판 상에서 상기 전극과 수평 방향으로 중첩되는 제3 투광부; 및 상기 전극 상에 배치되고 상기 반도체 소자를 덮는 제4 투광부;를 포함하고, 상기 제1 투광부의 면적은 상기 제2 투광부의 면적보다 크다.The semiconductor device package according to the embodiment includes a substrate; An electrode disposed on the substrate; A semiconductor device disposed on the electrode; And a light transmitting layer, wherein the substrate includes a light transmitting hole penetrating through the substrate, and the light transmitting layer includes: a first light transmitting portion disposed below the substrate; A second light transmitting part disposed in the light transmitting hole; A third light transmitting portion overlapping the electrode in a horizontal direction on the substrate; And a fourth light transmitting portion disposed on the electrode and covering the semiconductor element, wherein an area of the first light transmitting portion is larger than that of the second light transmitting portion.

상기 전극은, 상기 기판의 일측에 배치되는 제1 전극부; 및 상기 제1 전극부와 이격 배치되는 제2 전극부;를 포함하고, 상기 제1 전극은, 상기 기판 상부에 배치되는 제1 상부 전극; 상기 기판을 관통하는 전극홀 내에 배치되는 제1 연결 전극; 및 상기 기판 하부에 배치되는 제1 하부 전극;을 포함하고, 상기 제2 전극은, 상기 기판 상부에 배치되는 제2 상부 전극; 상기 기판을 관통하는 전극홀 내에 배치되는 제2 연결 전극; 및 상기 기판 하부에 배치되는 제2 하부 전극;을 포함할 수 있다.The electrode may include a first electrode part disposed at one side of the substrate; And a second electrode portion spaced apart from the first electrode portion, wherein the first electrode comprises: a first upper electrode disposed on the substrate; A first connection electrode disposed in the electrode hole penetrating the substrate; And a first lower electrode disposed under the substrate, wherein the second electrode comprises: a second upper electrode disposed over the substrate; A second connection electrode disposed in the electrode hole penetrating the substrate; And a second lower electrode disposed under the substrate.

상기 투광층은, 상기 제1 상부 전극 및 상기 제2 상부 전극 사이에 배치되는 제5 투광부를 더 포함할 수 있다.The light transmitting layer may further include a fifth light transmitting part disposed between the first upper electrode and the second upper electrode.

상기 투광층은 무기 재료를 포함하고, 상기 무기 재료는, 플루오르네이티드 에틸렌-프로필렌(fluorinated ethylene-propylene, FEP), 테트라플루오로에틸렌 헥사플루오로프로필렌 비닐리덴플루오라이드(Tetra fluoro ethylene Hexa fluoro propylene Vinylidene fluoride, THV) 중 적어도 하나를 포함할 수 있다.The light transmitting layer comprises an inorganic material, the inorganic material, fluorinated ethylene-propylene (FEP), tetrafluoroethylene hexafluoropropylene vinylidene fluoride (Tetra fluoro ethylene Hexa fluoro propylene vinylidene fluoride (THV).

상기 반도체 소자는, 자외선 파장대의 광을 방출할 수 있다.The semiconductor device may emit light in an ultraviolet wavelength band.

상기 기판은 상기 제3 투광부와 수직 방향으로 중첩되는 영역에서 10점 평균 거칠기가 0.6㎛ 내지 1.0㎛인 반도체 소자 패키지.The substrate has a 10-point average roughness of 0.6 μm to 1.0 μm in a region overlapping with the third light transmitting part in a vertical direction.

상기 기판 및 상기 전극 상부에 배치되는 접착층을 더 포함하고, 상기 접착층은 공극을 포함할 수 있다.The substrate may further include an adhesive layer disposed on the substrate and the electrode, and the adhesive layer may include a void.

상기 접착층은 그라파이트 시트(Graphite sheet)를 포함할 수 있다.The adhesive layer may include a graphite sheet.

실시예에 따르면, 부착력이 개선된 반도체 소자 패키지를 구현할 수 있다.According to the embodiment, it is possible to implement a semiconductor device package with improved adhesion.

또한, 자외선 광에 대한 투과율 및 내성이 개선된 반도체 소자 패키지를 구현할 수 있다.In addition, a semiconductor device package having improved transmittance and resistance to ultraviolet light may be implemented.

본 발명의 다양하면서도 유익한 장점과 효과는 상술한 내용에 한정되지 않으며, 본 발명의 구체적인 실시형태를 설명하는 과정에서 보다 쉽게 이해될 수 있을 것이다.The various and advantageous advantages and effects of the present invention are not limited to the above description, and will be more readily understood in the course of describing specific embodiments of the present invention.

도 1은 일실시예에 따른 반도체 소자 패키지의 상면도이고,
도 2는 도 1에서 AA'로 절단된 단면도이고,
도 3은 도 1에서 BB'로 절단된 단면도이고,
도 4는 일실시예에 따른 반도체 소자의 하면도이고,
도 5는 반도체 소자의 개념도이고,
도 6은 다른 실시예에 따른 반도체 소자 패키지의 단면도이고,
도 7은 또 다른 실시예에 따른 반도체 소자 패키지의 단면도이고,
도 8a 내지 도 8e는 일실시예에 따른 반도체 소자 패키지의 제조 순서를 설명하는 도면이다.
1 is a top view of a semiconductor device package according to an embodiment;
FIG. 2 is a cross-sectional view taken along line AA ′ in FIG. 1;
3 is a cross-sectional view taken along line BB ′ of FIG. 1;
4 is a bottom view of a semiconductor device according to an embodiment;
5 is a conceptual diagram of a semiconductor device,
6 is a cross-sectional view of a semiconductor device package according to another embodiment;
7 is a cross-sectional view of a semiconductor device package according to still another embodiment;
8A through 8E are diagrams illustrating a manufacturing procedure of a semiconductor device package according to example embodiments.

이하, 첨부된 도면을 참조하여 본 발명의 바람직한 실시예를 상세히 설명한다.Hereinafter, exemplary embodiments of the present invention will be described in detail with reference to the accompanying drawings.

다만, 본 발명의 기술 사상은 설명되는 일부 실시예에 한정되는 것이 아니라 서로 다른 다양한 형태로 구현될 수 있고, 본 발명의 기술 사상 범위 내에서라면, 실시예들간 그 구성 요소들 중 하나 이상을 선택적으로 결합, 치환하여 사용할 수 있다.However, the technical spirit of the present invention is not limited to some embodiments described, but may be implemented in various forms, and within the technical spirit of the present invention, one or more of the components between the embodiments may be selectively selected. Can be combined and substituted.

또한, 본 발명의 실시예에서 사용되는 용어(기술 및 과학적 용어를 포함)는, 명백하게 특별히 정의되어 기술되지 않는 한, 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자에게 일반적으로 이해될 수 있는 의미로 해석될 수 있으며, 사전에 정의된 용어와 같이 일반적으로 사용되는 용어들은 관련 기술의 문맥상의 의미를 고려하여 그 의미를 해석할 수 있을 것이다.In addition, the terms (including technical and scientific terms) used in the embodiments of the present invention may be generally understood by those skilled in the art to which the present invention pertains, unless specifically defined and described. The terms commonly used, such as terms defined in advance, may be interpreted as meanings in consideration of the contextual meaning of the related art.

또한, 본 발명의 실시예에서 사용된 용어는 실시예들을 설명하기 위한 것이며 본 발명을 제한하고자 하는 것은 아니다.In addition, the terms used in the embodiments of the present invention are intended to describe the embodiments and are not intended to limit the present invention.

본 명세서에서, 단수형은 문구에서 특별히 언급하지 않는 한 복수형도 포함할 수 있고, "A 및(와) B, C 중 적어도 하나(또는 한 개 이상)"로 기재되는 경우 A, B, C로 조합할 수 있는 모든 조합 중 하나 이상을 포함할 수 있다.As used herein, the singular forms may also include the plural unless specifically stated otherwise, and may be combined as A, B, C when described as "at least one (or more than one) of A and B, C". It can include one or more of all possible combinations.

또한, 본 발명의 실시예의 구성 요소를 설명하는 데 있어서, 제1, 제2, A, B, (a), (b) 등의 용어를 사용할 수 있다.In addition, in describing the components of the embodiment of the present invention, terms such as first, second, A, B, (a), and (b) may be used.

이러한 용어는 그 구성 요소를 다른 구성 요소와 구별하기 위한 것일 뿐, 그 용어에 의해 해당 구성 요소의 본질이나 차례 또는 순서 등으로 한정되지 않는다.These terms are only to distinguish the components from other components, and the terms are not limited to the nature, order, order, or the like of the components.

그리고, 어떤 구성 요소가 다른 구성요소에 '연결', '결합' 또는 '접속'된다고 기재된 경우, 그 구성 요소는 그 다른 구성 요소에 직접적으로 연결, 결합 또는 접속되는 경우뿐만 아니라, 그 구성 요소와 그 다른 구성 요소 사이에 있는 또 다른 구성 요소로 인해 '연결', '결합' 또는 '접속' 되는 경우도 포함할 수 있다.And when a component is described as being 'connected', 'coupled' or 'connected' to another component, the component is not only connected, coupled or connected directly to the other component, It may also include the case of 'connected', 'coupled' or 'connected' due to another component between the other components.

또한, 각 구성 요소의 "상(위) 또는 하(아래)"에 형성 또는 배치되는 것으로 기재되는 경우, 상(위) 또는 하(아래)는 두 개의 구성 요소들이 서로 직접 접촉되는 경우뿐만 아니라 하나 이상의 또 다른 구성 요소가 두 개의 구성 요소들 사이에 형성 또는 배치되는 경우도 포함한다. 또한, "상(위) 또는 하(아래)"으로 표현되는 경우 하나의 구성 요소를 기준으로 위쪽 방향뿐만 아니라 아래쪽 방향의 의미도 포함할 수 있다.In addition, when described as being formed or disposed on the "top" or "bottom" of each component, the top (bottom) or the bottom (bottom) is not only when two components are in direct contact with each other, but also one. It also includes a case where the above-described further components are formed or disposed between two components. In addition, when expressed as "up (up) or down (down)" may include the meaning of the down direction as well as the up direction based on one component.

도 1은 일실시예에 따른 반도체 소자 패키지의 상면도이고, 도 2는 도 1에서 AA'로 절단된 단면도이고, 도 3은 도 1에서 BB'로 절단된 단면도이고, 도 4는 일실시예에 따른 반도체 소자의 하면도이고, 도 5는 반도체 소자의 개념도이다.1 is a top view of a semiconductor device package according to an embodiment, FIG. 2 is a cross-sectional view taken along line AA ′ of FIG. 1, FIG. 3 is a cross-sectional view taken along line BB ′ of FIG. 1, and FIG. 4 is an embodiment of the present invention. Is a bottom view of the semiconductor device, and FIG. 5 is a conceptual diagram of the semiconductor device.

도 1 내지 도 4을 참조하면, 일실시예에 따른 반도체 소자 패키지는 몸체(110), 전극(120), 반도체 소자(130), 투광층(140)을 포함할 수 있다.1 to 4, a semiconductor device package according to an embodiment may include a body 110, an electrode 120, a semiconductor device 130, and a light transmitting layer 140.

먼저, 몸체(110)는 플레이트 형상으로 구현될 수 있다. 그리고 몸체(110) 상에는 전극(120), 반도체 소자(130), 투광층(140)이 배치될 수 있다. 다만, 전극(120) 및 투광층(140)은 후술하는 바와 같이 기판(110)을 관통하여 기판(110) 하부에도 배치될 수 있다.First, the body 110 may be implemented in a plate shape. The electrode 120, the semiconductor device 130, and the light transmitting layer 140 may be disposed on the body 110. However, the electrode 120 and the light transmitting layer 140 may be disposed below the substrate 110 through the substrate 110 as described below.

그리고 몸체(110)는 방열성이 우수한 절연재질 또는 금속화합물을 포함할 수 있다. 예를 들어, 몸체(110)는 절연재질로 저온 소성 세라믹(LTCC: low temperature co-fired ceramic) 또는 고온 소성 세라믹(HTCC: high temperature co-fired ceramic) 등을 포함할 수 있다. 또한, 몸체(110)는 수지계열의 절연 물질 예컨대, 리프탈아미드(PPA: Polyphthalamide)와 같은 수지 재질로 형성될 수 있다. 또한 몸체(110)는 실리콘, 또는 에폭시 수지, 또는 플라스틱 재질을 포함하는 열 경화성 수지, 또는 고내열성, 고 내광성 재질로 형성될 수 있다. 그리고 몸체(110)는 금속화합물로 질화알루미늄(AlN) 또는 알루미나(Al2O3) 등을 포함할 수 있으며, 열 전도도가 140 W/mK 이상인 금속 산화물을 포함할 수 있다. 또한, 몸체(110)는 산화 방지제, 광 반사재, 무기 충전재, 경화 촉매, 광 안정제, 윤활제, 이산화티탄 중에서 적어도 하나 이상을 포함할 수 있다.The body 110 may include an insulating material or a metal compound having excellent heat dissipation. For example, the body 110 may include a low temperature co-fired ceramic (LTCC) or a high temperature co-fired ceramic (HTCC) as an insulating material. In addition, the body 110 may be formed of a resin material such as resin material such as polyphthalamide (PPA). In addition, the body 110 may be formed of a silicone, epoxy resin, or a thermosetting resin including a plastic material, or a high heat resistance and high light resistance material. The body 110 may include aluminum nitride (AlN) or alumina (Al 2 O 3) as a metal compound, and may include a metal oxide having a thermal conductivity of 140 W / mK or more. In addition, the body 110 may include at least one or more of an antioxidant, a light reflector, an inorganic filler, a curing catalyst, a light stabilizer, a lubricant, and titanium dioxide.

전극(120)은 몸체(110) 상에 배치될 수 있다. 보다 구체적으로, 전극(120)은 제1 전극부(121)와 제2 전극부(122)를 포함할 수 있다. 더 나아가, 전극(120)은 제3 전극부(123)을 더 포함할 수 있다.The electrode 120 may be disposed on the body 110. More specifically, the electrode 120 may include a first electrode portion 121 and a second electrode portion 122. Furthermore, the electrode 120 may further include a third electrode part 123.

먼저, 제1 전극부(121)와 제2 전극부(122)는 이격 배치되어 전기적으로 분리될 수 있다. 예컨대, 제1 전극부(121)는 몸체(110)의 일측에 배치되고, 제2 전극부(122)는 몸체(110)의 타측에 배치될 수 있다.First, the first electrode 121 and the second electrode 122 may be spaced apart from each other to be electrically separated from each other. For example, the first electrode part 121 may be disposed on one side of the body 110, and the second electrode part 122 may be disposed on the other side of the body 110.

 제1 전극부(121)와 제2 전극부(122)는 티타늄(Ti), 구리(Cu), 니켈(Ni), 금(Au), 크롬(Cr), 탄탈늄(Ta), 백금(Pt), 주석(Sn), 은(Ag), 인(P) 중 적어도 하나 이상을 포함한 단층 또는 다층으로 형성될 수 있다. 예를 들어, 제1 전극부(121)와 제2 전극부(122)의 표면에는 은(Ag) 또는 알루미늄(Ag)이 형성되어, 입사되는 광의 반사 효율을 향상시켜 광 효율을 증대시킬 수 있다. 또한 제1 전극부(121)와 제2 전극부(122)가 금층(Au layer)을 포함하여 습기에 의한 부식을 방지할 수 있고, 전기적인 신뢰성을 향상시킬 수 있다.The first electrode part 121 and the second electrode part 122 include titanium (Ti), copper (Cu), nickel (Ni), gold (Au), chromium (Cr), tantalum (Ta), and platinum (Pt). ), Tin (Sn), silver (Ag), phosphorus (P) may be formed in a single layer or multiple layers containing at least one. For example, silver (Ag) or aluminum (Ag) is formed on the surfaces of the first electrode portion 121 and the second electrode portion 122, thereby improving the reflection efficiency of incident light, thereby increasing the light efficiency. . In addition, the first electrode 121 and the second electrode 122 may include an Au layer to prevent corrosion due to moisture and to improve electrical reliability.

실시예에서 상기 제1 전극부(221) 또는 제2 전극부(122) 중 어느 하나에는 극성 마크가 배치될 수 있다. 극성 마크는 제2 전극부(122)의 상부 모서리 영역에 제1 전극부(221)와 구별되도록 형성될 수 있다. 또한, 극성 마크(CP)는 후술하는 제2 전극부(122) 에 위치할 수 있다. 이러한 극성 마크는 애노드 마크 또는 캐소드 마크일 수 있다. 다만, 이러한 위치 및 형상에 한정되는 것은 아니다.In an exemplary embodiment, a polarity mark may be disposed on either the first electrode portion 221 or the second electrode portion 122. The polarity mark may be formed to be distinguished from the first electrode portion 221 in the upper edge region of the second electrode portion 122. In addition, the polarity mark CP may be positioned on the second electrode part 122 described later. This polar mark may be an anode mark or a cathode mark. However, it is not limited to this position and shape.

제1 전극부(121)는 제1 상부 전극(121a), 제1 연결 전극(122b), 제1 하부 전극(121c)를 포함할 수 있다. 마찬가지로, 제2 전극부(122)는 제2 상부 전극(122a), 제2 연결 전극(122b), 제2 하부 전극(122c)를 포함할 수 있다. The first electrode unit 121 may include a first upper electrode 121a, a first connection electrode 122b, and a first lower electrode 121c. Similarly, the second electrode part 122 may include a second upper electrode 122a, a second connection electrode 122b, and a second lower electrode 122c.

제1 상부 전극(121a)과 제2 상부 전극(122a)은 기판(110) 상부에 배치될 수 있다. 그리고 제1 상부 전극(121a)과 제2 상부 전극(122a)은 서로 이격 배치되어, 전기적으로 분리될 수 있다. 또한, 제1 상부 전극(121a)과 제2 상부 전극(122a)의 상부에는 반도체 소자(130)가 배치되고, 반도체 소자(130)는 제1 상부 전극(121a) 및 제2 상부 전극(122a)과 각각 전기적으로 연결될 수 있다.The first upper electrode 121a and the second upper electrode 122a may be disposed on the substrate 110. The first upper electrode 121a and the second upper electrode 122a may be spaced apart from each other to be electrically separated from each other. In addition, the semiconductor device 130 is disposed on the first upper electrode 121a and the second upper electrode 122a, and the semiconductor device 130 includes the first upper electrode 121a and the second upper electrode 122a. And may be electrically connected to each other.

그리고 기판(110)은 복수 개의 관통홀을 포함할 수 있다. 예컨대, 기판(110)은 전극홀(h1) 및 투광홀(h2)을 포함할 수 있다. 전극홀(h1)과 투광홀(h2)은 복수 개일 수 있다.In addition, the substrate 110 may include a plurality of through holes. For example, the substrate 110 may include an electrode hole h1 and a light transmitting hole h2. The electrode hole h1 and the light emitting hole h2 may be plural in number.

전극홀(h1)에는 제1 연결 전극(121b) 및 제2 연결 전극(122b)가 배치될 수 있다. 이를 통해, 반도체 소자(130)와 전극(120) 간의 전기적 패스는 기판(110) 상부에서 하부로 이루어질 수 있다.The first connection electrode 121b and the second connection electrode 122b may be disposed in the electrode hole h1. Through this, an electrical path between the semiconductor device 130 and the electrode 120 may be made from the top of the substrate 110 to the bottom.

그리고 제1 하부 전극(121c)과 제2 하부 전극(122c)은 기판(110) 하부에 배치되어, 제1 연결 전극(121b) 및 제2 연결 전극(122b)와 각각 전기적으로 연결될 수 있다. 그리고 제1 하부 전극(121c)과 제2 하부 전극(122C)는 서로 이격 배치되어 전기적으로 분리될 수 있다.The first lower electrode 121c and the second lower electrode 122c may be disposed under the substrate 110 to be electrically connected to the first connection electrode 121b and the second connection electrode 122b, respectively. The first lower electrode 121c and the second lower electrode 122C may be spaced apart from each other to be electrically separated from each other.

즉, 일실시예에서 제1 전극부(121)와 제2 전극부(122)는 기판(110) 상하 및 내부에서 서로 중첩되지 않도록 배치될 수 있다. 예컨대, 상부 전극, 연결 전극 및 하부 전극은 수직 방향으로 연결되고, 제1 전극부(121)와 제2 전극부(122)는 수평 방향으로 이격 배치될 수 있다. 여기서, 수직 방향은 제1 방향(X축 방향)으로 기판(110)의 하부에서 상부를 향한 방향으로 정의한다. 그리고 수평 방향은 제2 방향(Y축 방향)으로 제1 방향에 수직한 방향으로 정의한다. 그리고 제3 방향(Z축 방향)은 제1 방향 및 제2 방향에 모두 수직한 방향으로 정의한다.That is, in one embodiment, the first electrode portion 121 and the second electrode portion 122 may be disposed so as not to overlap each other on the upper and lower sides and the inside of the substrate 110. For example, the upper electrode, the connecting electrode, and the lower electrode may be connected in the vertical direction, and the first electrode portion 121 and the second electrode portion 122 may be spaced apart in the horizontal direction. Here, the vertical direction is defined as the direction from the lower side to the upper side of the substrate 110 in the first direction (X-axis direction). The horizontal direction is defined as a direction perpendicular to the first direction in the second direction (Y-axis direction). The third direction (Z-axis direction) is defined as a direction perpendicular to both the first direction and the second direction.

그리고 제1 상부 전극(121a), 제1 연결 전극(121b) 및 제1 하부 전극(121c)은 서로 동일한 물질로 이루어질 수 있다. 다만, 이에 한정되는 것은 아니다. 마찬가지로, 제2 상부 전극(122a), 제2 연결 전극(122b) 및 제2 하부 전극(122c)은 서로 동일한 물질로 이루어질 수 있다. 또한, 제1 전극부(121)와 제2 전극부(122)는 동일한 물질로 이루어질 수 있으나, 이에 한정되는 것은 아니다.The first upper electrode 121a, the first connection electrode 121b, and the first lower electrode 121c may be made of the same material. However, the present invention is not limited thereto. Similarly, the second upper electrode 122a, the second connection electrode 122b, and the second lower electrode 122c may be made of the same material. In addition, the first electrode 121 and the second electrode 122 may be made of the same material, but are not limited thereto.

상부 전극(121a), 제1 연결 전극(121b) 및 제1 하부 전극(121c)은 티타늄(Ti), 구리(Cu), 니켈(Ni), 금(Au), 크롬(Cr), 탄탈늄(Ta), 백금(Pt), 주석(Sn), 은(Ag), 인(P) 중 적어도 하나 이상을 포함한 단층 또는 다층으로 형성될 수 있다.The upper electrode 121a, the first connection electrode 121b, and the first lower electrode 121c may include titanium (Ti), copper (Cu), nickel (Ni), gold (Au), chromium (Cr), and tantalum ( Ta, platinum (Pt), tin (Sn), silver (Ag), phosphorus (P) may be formed in a single layer or multiple layers containing at least one.

또한, 전극(120)은 상술한 바와 같이 기판(110) 하부에서 제1 하부 전극(121c)과 제2 하부 전극(122c) 사이에 배치되는 더미 전극으로 제3 전극부(123)을 더 포함할 수 있다. 또한, 제3 전극부(123)는 제1 하부 전극(121c) 및 제2 하부 전극(122c)과 이격 배치될 수 있다. In addition, the electrode 120 may further include a third electrode part 123 as a dummy electrode disposed between the first lower electrode 121c and the second lower electrode 122c under the substrate 110 as described above. Can be. In addition, the third electrode part 123 may be spaced apart from the first lower electrode 121c and the second lower electrode 122c.

그리고 제3 전극부(123)는 제2 방향으로 길이(이하 폭으로 설명함)가 제1 하부 전극(121c) 및 제2 하부 전극(122c)의 폭보다 클 수 있다. 이에 따라, 제3 전극부(123)는 면적이 제1 하부 전극(121c) 또는 상기 제2 하부 전극(122c)의 면적보다 커 기판(110)에서 발생한 열을 용이하게 외부로 방출할 수 있다. 즉, 제3 전극부(123)는 반도체 소자 패키지의 방열효율을 향상시킬 수 있다. 또한, 제3 전극부(123)는 제1 방향으로 길이(이하 두께로 설명함)제1 하부 전극(121c) 또는 제1 하부 전극(122c)의 두께와 동일할 수 있으나, 이에 한정되는 것은 아니다.In addition, the length of the third electrode unit 123 may be greater than the width of the first lower electrode 121c and the second lower electrode 122c in the second direction. Accordingly, the area of the third electrode part 123 is larger than that of the first lower electrode 121c or the second lower electrode 122c so that heat generated from the substrate 110 can be easily discharged to the outside. That is, the third electrode unit 123 may improve heat dissipation efficiency of the semiconductor device package. In addition, the third electrode part 123 may have the same length as the thickness of the first lower electrode 121c or the first lower electrode 122c in the first direction (described as thickness hereinafter), but is not limited thereto. .

또한, 제3 전극부(123)는 반도체 소자(130)와 수직 방향으로 중첩되도록 배치되어 반도체 소자(130)에서 발생되는 열을 효율적으로 방열할 수 있다.In addition, the third electrode part 123 may be disposed to overlap the semiconductor device 130 in the vertical direction, thereby efficiently dissipating heat generated from the semiconductor device 130.

상술한, 제1 전극부(121), 제2 전극부(122) 및 제3 전극부(123)는 소정의 회로 기판(미도시) 상에 솔더(solder)와 같은 접착 부재로 접착될 수 있다.The first electrode part 121, the second electrode part 122, and the third electrode part 123 may be attached to a predetermined circuit board (not shown) by an adhesive member such as a solder. .

반도체 소자(130)는 몸체(110)의 상부에 배치될 수 있다. 즉, 반도체 소자(130)는 몸체(110) 및 전극(12) 상부에 배치된다.The semiconductor device 130 may be disposed above the body 110. That is, the semiconductor device 130 is disposed above the body 110 and the electrode 12.

도 5를 참조하면, 반도체 소자(130)는 광을 방출한다. 구체적으로, 반도체 소자(130)는 자외선 파장대의 광을 방출할 수 있다. 예시적으로 반도체 소자(130)는 근자외선 파장대의 광(UV-A)을 출력할 수도 있고, 원자외선 파장대의 광(UV-B)을 출력할 수 도 있고, 심자외선 파장대의 광(UVC)을 출력할 수 있다. 예시적으로, 근자외선 파장대의 광(UV-A)는 320nm 내지 420nm 범위의 파장을 가질 수 있고, 원자외선 파장대의 광(UV-B)은 280nm 내지 320nm 범위의 파장을 가질 수 있으며, 심자외선 파장대의 광(UV-C)은 100nm 내지 280nm 범위의 파장을 가질 수 있다.Referring to FIG. 5, the semiconductor device 130 emits light. Specifically, the semiconductor device 130 may emit light in the ultraviolet wavelength band. For example, the semiconductor device 130 may output light (UV-A) in the near ultraviolet wavelength band, may output light (UV-B) in the far ultraviolet wavelength band, or light (UVC) in the deep ultraviolet wavelength band. You can output For example, the light of the near ultraviolet wavelength range (UV-A) may have a wavelength in the range of 320 nm to 420 nm, the light of the far ultraviolet wavelength range (UV-B) may have a wavelength in the range of 280 nm to 320 nm, deep ultraviolet Light in the wavelength band (UV-C) may have a wavelength in the range of 100nm to 280nm.

반도체 소자(130)는 상부에 기판(131)이 배치될 수 있다. 실시 예에 따른 반도체 소자(130)는 기판(131), 제1 도전형 반도체층(132), 활성층(133), 및 제2 도전형 반도체층(134)을 포함할 수 있다. 각 반도체층은 자외선 파장대의 광을 방출할 수 있도록 알루미늄 조성을 가질 수 있다. 그리고 파장범위는 제1 도전형 반도체층(132), 활성층(133), 및 제2 도전형 반도체층(134)을 포함하는 발광구조물의 Al의 조성비에 의해 결정될 수 있다.The substrate 131 may be disposed on the semiconductor device 130. The semiconductor device 130 according to the embodiment may include a substrate 131, a first conductivity type semiconductor layer 132, an active layer 133, and a second conductivity type semiconductor layer 134. Each semiconductor layer may have an aluminum composition so as to emit light in the ultraviolet wavelength range. The wavelength range may be determined by the composition ratio of Al of the light emitting structure including the first conductive semiconductor layer 132, the active layer 133, and the second conductive semiconductor layer 134.

기판(131)은 전도성 기판(131) 또는 절연성 기판(131)를 포함한다. 기판(131)은 반도체 물질 성장에 적합한 물질이나 캐리어 웨이퍼일 수 있다. 기판(131)은 사파이어(Al2O3), SiC, GaAs, GaN, ZnO, Si, GaP, InP 및 Ge 중 선택된 물질로 형성될 수 있으며, 이에 대해 한정하지는 않는다. The substrate 131 includes a conductive substrate 131 or an insulating substrate 131. The substrate 131 may be a material or a carrier wafer suitable for growing a semiconductor material. The substrate 131 may be formed of a material selected from sapphire (Al 2 O 3), SiC, GaAs, GaN, ZnO, Si, GaP, InP, and Ge, but is not limited thereto.

제1 도전형 반도체층(132)과 기판(131) 사이에는 버퍼층(미도시)이 더 구비될 수 있다. 버퍼층은 기판(131) 상에 구비된 발광 구조물과 기판(131)의 격자 부정합을 완화할 수 있다.A buffer layer (not shown) may be further provided between the first conductive semiconductor layer 132 and the substrate 131. The buffer layer may mitigate lattice mismatch between the light emitting structure provided on the substrate 131 and the substrate 131.

제1 도전형 반도체층(132)은 Ⅲ-Ⅴ족, Ⅱ-Ⅵ족 등의 화합물 반도체로 구현될 수 있으며, 제1 도전형 반도체층(132)에 제1도펀트가 도핑될 수 있다. 제1 도전형 반도체층(132)은 Inx1Aly1Ga1-x1-y1N (0≤x1≤1, 0≤y1≤1, 0≤x1+y1≤1)의 조성식을 갖는 반도체 재료, 예를 들어 GaN, AlGaN, InGaN, InAlGaN 등에서 선택될 수 있다. 그리고, 제1도펀트는 Si, Ge, Sn, Se, Te와 같은 n형 도펀트일 수 있다. 제1도펀트가 n형 도펀트인 경우, 제1도펀트가 도핑된 제1 도전형 반도체층(132)은 n형 반도체층일 수 있다.The first conductive semiconductor layer 132 may be formed of a compound semiconductor such as a III-V group or a II-VI group, and the first dopant may be doped into the first conductive semiconductor layer 132. The first conductive semiconductor layer 132 is a semiconductor material having a composition formula of Inx1Aly1Ga1-x1-y1N (0 ≦ x1 ≦ 1, 0 ≦ y1 ≦ 1, 0 ≦ x1 + y1 ≦ 1), for example, GaN, AlGaN, InGaN, InAlGaN and the like can be selected. The first dopant may be an n-type dopant such as Si, Ge, Sn, Se, or Te. When the first dopant is an n-type dopant, the first conductive semiconductor layer 132 doped with the first dopant may be an n-type semiconductor layer.

활성층(133)은 제1 도전형 반도체층(132)을 통해서 주입되는 전자(또는 정공)와 제2 도전형 반도체층(134)을 통해서 주입되는 정공(또는 전자)이 만나는 층이다. 활성층(133)은 전자와 정공이 재결합함에 따라 낮은 에너지 준위로 천이하며, 그에 상응하는 파장을 가지는 빛을 생성할 수 있다. 활성층(133)은 단일 우물 구조, 다중 우물 구조, 단일 양자 우물 구조, 다중 양자 우물(Multi Quantum Well; MQW) 구조, 양자점 구조 또는 양자선 구조 중 어느 하나의 구조를 가질 수 있으며, 활성층(133)의 구조는 이에 한정하지 않는다.The active layer 133 is a layer where electrons (or holes) injected through the first conductive semiconductor layer 132 meet holes (or electrons) injected through the second conductive semiconductor layer 134. The active layer 133 transitions to a low energy level as electrons and holes recombine, and may generate light having a wavelength corresponding thereto. The active layer 133 may have any one of a single well structure, a multi well structure, a single quantum well structure, a multi quantum well (MQW) structure, a quantum dot structure, or a quantum line structure, and the active layer 133. The structure of is not limited to this.

제2 도전형 반도체층(134)은 활성층(133) 상에 형성되며, Ⅲ-Ⅴ족, Ⅱ-Ⅵ족 등의 화합물 반도체로 구현될 수 있으며, 제2 도전형 반도체층(134)에 제2도펀트가 도핑될 수 있다. 제2 도전형 반도체층(134)은 Inx5Aly2Ga1-x5-y2N (0≤x5≤1, 0≤y2≤1, 0≤x5+y2≤1)의 조성식을 갖는 반도체 물질 또는 AlInN, AlGaAs, GaP, GaAs, GaAsP,AlGaInP 중 선택된 물질로 형성될 수 있다. 제2도펀트가 Mg, Zn, Ca, Sr, Ba 등과 같은 p형 도펀트인 경우, 제2 도펀트가 도핑된 제2 도전형 반도체층(134)은 p형 반도체층일 수 있다.The second conductivity type semiconductor layer 134 is formed on the active layer 133, and may be implemented as a compound semiconductor such as a group III-V group or a group II-VI. Dopants may be doped. The second conductive semiconductor layer 134 may be a semiconductor material having a composition formula of Inx5Aly2Ga1-x5-y2N (0≤x5≤1, 0≤y2≤1, 0≤x5 + y2≤1) or AlInN, AlGaAs, GaP, GaAs , GaAsP, AlGaInP may be formed of a material selected from. When the second dopant is a p-type dopant such as Mg, Zn, Ca, Sr, or Ba, the second conductive semiconductor layer 134 doped with the second dopant may be a p-type semiconductor layer.

그리고 반도체 소자(130)는 제1 전극패드(135) 및 제2 전극패드(136)을 더 포함할 수 있다. 제1 전극패드(135)는 제1 도전형 반도체층(132)과 전기적으로 연결되고, 제2 전극패드(136)는 제2 도전형 반도체층(134)과 전기적으로 연결될 수 있다. 이를 위해, 제1 전극패드(135)는 제1 도전형 반도체층(132) 상에 배치되고, 제2 전극패드(136)는 제2 도전형 반도체층(134) 상에 배치될 수 있다.The semiconductor device 130 may further include a first electrode pad 135 and a second electrode pad 136. The first electrode pad 135 may be electrically connected to the first conductive semiconductor layer 132, and the second electrode pad 136 may be electrically connected to the second conductive semiconductor layer 134. To this end, the first electrode pad 135 may be disposed on the first conductive semiconductor layer 132, and the second electrode pad 136 may be disposed on the second conductive semiconductor layer 134.

제1 전극패드(135) 및 제2 전극패드(136)는 전도성의 다양한 금속을 포함할 수 있다. 예컨대, 제1 전극패드(135) 및 제2 전극패드(136)는 Cu, Pt, Al, Au, Ag 등을 포함할 수 있다. 다만, 이러한 재질에 한정되는 것은 아니다.The first electrode pad 135 and the second electrode pad 136 may include various conductive metals. For example, the first electrode pad 135 and the second electrode pad 136 may include Cu, Pt, Al, Au, Ag, or the like. However, it is not limited to these materials.

그리고 도 5에서는 플립형 구조의 반도체 소자에 대한 구조를 개시하나, 상술한 반도체 소자(130)는 수평형(lateral), 수직형(vertical), 플립형(flip) 등 다양한 구조로 이루어질 수 있다.In FIG. 5, a structure of a flip-type semiconductor device is disclosed, but the above-described semiconductor device 130 may have various structures such as a lateral, vertical, and flip type.

다시 도 1 내지 도 4을 참조하면, 투광층(140)은 몸체(110)의 상부에 배치되며, 반도체 소자(130)가 배치되는 캐비티(C)를 포함할 수 있다. 투광층(140)은 몸체(110)와 결합하는 하부면에 캐비티(C)가 배치되어, 캡(cap) 형상으로 구현될 수 있다. 캐비티(C)에는 반도체 소자(130)가 배치되므로, 캐비티(C)의 폭은 반도체 소자(130)의 폭보다 크거나 같을 수 있다. 다만, 이러한 구조에 한정되는 것은 아니다.Referring back to FIGS. 1 through 4, the light transmitting layer 140 may be disposed on the body 110 and may include a cavity C in which the semiconductor device 130 is disposed. The light transmission layer 140 may be disposed in the shape of a cap C on the lower surface coupled with the body 110. Since the semiconductor device 130 is disposed in the cavity C, the width of the cavity C may be greater than or equal to the width of the semiconductor device 130. However, it is not limited to this structure.

상술한 투광층(140)의 구조에 따르면, 투광층(140)은 반도체 소자(130)의 상부면과 측면을 감싸도록 배치될 수 있다. 이에 따라, 반도체 소자(130)가 방출한 광은 투광층(140)의 상부면 뿐만 아니라 측면을 통해서도 출력될 수 있다. 따라서, 일실시예에 따른 발광 소자 패키지(100)는 발광면적이 증가하는 효과를 제공한다. According to the structure of the light-transmitting layer 140 described above, the light-transmitting layer 140 may be disposed to surround the upper surface and the side surface of the semiconductor device 130. Accordingly, the light emitted by the semiconductor device 130 may be output not only through the upper surface of the light transmitting layer 140 but also through the side surface. Therefore, the light emitting device package 100 according to an embodiment provides an effect of increasing the light emitting area.

또한, 투광층(140)은 무기 재료를 통해 구현될 수 있으며, 자외선 파장대의 광을 투과할 수 있는 재질로 구현될 수 있다. 무기 재료는 플루오린 폴리머(fluorine polymer)일 수 있다. 상세하게는 폴리테트라 플루오로에틸렌(Polytetrafluoroethylene, PTFE), 폴리클로로트리플루오로에틸렌(Poly Chloro Tri Fluoro Ethylene, PCTFE), 폴리플루오린화비닐리덴(Polyvinylidene fluoride, PVDF), 클로로트리플루오르에틸렌 (Ethylene chlorotrifluoroethylene, ECTFE), 에틸렌테트라플루오르에틸렌ETFE (Ethylene Tetra fluoro Ethylene), 퍼플루오르알콕시(perfluoroalkoxy, PFA), 플루오르네이티드 에틸렌-프로필렌(fluorinated ethylene-propylene, FEP), 테트라플루오로에틸렌 헥사플루오로프로필렌 비닐리덴플루오라이드(Tetra fluoro ethylene Hexa fluoro propylene Vinylidene fluoride, THV) 중 적어도 하나를 포함할 수 있다. 특히, FEP 및 THV의 경우, 자외선 광에 대한 투과율과 기판에의 부착력이 모두 높아, 발광 소자 패키지(100)의 성능 및 내구성을 향상시킬 수 있다.In addition, the light transmission layer 140 may be implemented through an inorganic material, and may be implemented with a material capable of transmitting light in the ultraviolet wavelength range. The inorganic material may be a fluorine polymer. Specifically, polytetrafluoroethylene (PTFE), polychlorotrifluoroethylene (PCTFE), polyvinylidene fluoride (PVDF), chlorotrifluoroethylene (Ethylene chlorotrifluoroethylene, ECTFE), ethylene tetrafluoro ethylene (FEFE), perfluoroalkoxy (PFA), fluorinated ethylene-propylene (FEP), tetrafluoroethylene hexafluoropropylene vinylidene fluorine It may include at least one of a ride (Tetra fluoro ethylene Hexa fluoro propylene Vinylidene fluoride, THV). In particular, in the case of FEP and THV, both the transmittance to ultraviolet light and the adhesion to the substrate are high, thereby improving performance and durability of the light emitting device package 100.

보다 구체적으로, 투광층(140)은 제1 투광부(141), 제2 투광부(142), 제3 투광부(143) 제4 투광부(144)를 포함할 수 있다.More specifically, the light transmitting layer 140 may include a first light transmitting part 141, a second light transmitting part 142, a third light transmitting part 143, and a fourth light transmitting part 144.

먼저, 제1 투광부(141)는 기판(110) 하부에 배치될 수 있다. 제1 투광부(141)는 제1 하부 전극(121c) 및 제3 전극부(123) 사이에 또는 제2 하부 전극(122c) 및 제3 전극부(123) 사이에 배치될 수 있다. 뿐만 아니라, 제1 투광부(141)는 제3 전극부(123)가 없는 구조에서 제1 하부 전극(121c)과 제2 하부 전극(122c) 사이에 배치될 수도 있다.First, the first light transmitting part 141 may be disposed under the substrate 110. The first light transmitting part 141 may be disposed between the first lower electrode 121c and the third electrode part 123 or between the second lower electrode 122c and the third electrode part 123. In addition, the first light transmitting part 141 may be disposed between the first lower electrode 121c and the second lower electrode 122c in a structure without the third electrode part 123.

예컨대, 제1 투광부(141)는 제1-1 투광부(141a)와 제1-2 투광부(141b)를 포함할 수 있다. 그리고 제1-1 투광부(141a)는 제1 하부 전극(121c) 및 제3 전극부(123) 사이에 배치될 수 있다. 그리고 제1-2 투광부(141b)는 제2 하부 전극(122c) 및 제3 전극부(123) 사이에 배치될 수 있다. 이 때, 제1-2 투광부(141a)와 제1-2 투광부(141b)는 제3 전극부(123)를 기준으로 대칭으로 배치될 수 있다. 이러한 구성에 의하여, 반도체 소자 패키지는 투광부(140)가 반도체 소자(130)를 둘러싸면서 기판(110) 간의 결합력을 균형 있게 유지하므로, 패키지의 신뢰성을 개선할 수 있다.For example, the first light transmitting part 141 may include a 1-1 light transmitting part 141a and a 1-2 second light emitting part 141b. In addition, the first-first light transmitting part 141a may be disposed between the first lower electrode 121c and the third electrode part 123. In addition, the 1-2th light transmitting part 141b may be disposed between the second lower electrode 122c and the third electrode part 123. In this case, the 1-2th light transmitting part 141a and the 1-2th light transmitting part 141b may be symmetrically disposed with respect to the third electrode part 123. In this configuration, the semiconductor device package may improve the reliability of the package since the light transmitting part 140 maintains the bonding force between the substrates 110 while surrounding the semiconductor device 130.

또한, 제1 투광부(141)는 제3 방향으로 연장할 수 있다. 이에 따라, 제1 투광부(141)는 제3 방향으로 길이가 제1 하부 전극(121c) 및 제3 전극(123)과 제3 방향으로 길이와 동일할 수 있다. 다만, 이러한 구조에 한정되는 것은 아니다.In addition, the first light transmitting part 141 may extend in the third direction. Accordingly, the first light transmitting part 141 may have a length equal to a length in the third direction with the first lower electrode 121c and the third electrode 123 in the third direction. However, it is not limited to this structure.

그리고 제1 투광부(141)는 제2 투광부(142)의 면적보다 클 수 있다. 즉, 제1 투광부(141)는 투광홀(h2)의 크기보다 클 수 있다. 이러한 구성에 의하여, 투광층(140)은 제1 투광부(141)를 통해 기판(110)과의 결합력을 개선할 수 있다. 또한, 제1 투광부(141)는 반도체 소자 패키지의 신뢰성도 향상시킬 수 있다.The first light transmitting part 141 may be larger than the area of the second light transmitting part 142. That is, the first light transmitting part 141 may be larger than the size of the light transmitting hole h2. By such a configuration, the light transmitting layer 140 may improve the bonding force with the substrate 110 through the first light transmitting part 141. In addition, the first light transmitting part 141 may improve reliability of the semiconductor device package.

또한, 제1 투광부(141)는 제1 하부 전극(121c)과 제2 하부 전극(122c)보다 내측에 위치하여, 제1 투광부(141)의 내측에 위치하는 반도체 소자(130)와의 결합력을 향상시켜 반도체 소자(130)가 이동하는 현상을 방지할 수 있다.In addition, the first light transmitting part 141 is located inside the first lower electrode 121c and the second lower electrode 122c and has a bonding force with the semiconductor element 130 positioned inside the first light transmitting part 141. As a result, the phenomenon in which the semiconductor device 130 is moved may be prevented.

제2 투광부(142)는 기판(110) 및 전극(120)을 관통하는 투광홀(h2) 내에 배치될 수 있다. 투광홀(h2)은 기판(110) 및 전극(120)을 모두 관통하도록 배치될 수 있다. 뿐만 아니라, 투광홀(h2)은 기판(110)을 관통하도록 배치될 수 있다. 그리고 투광홀(h2)은 전극홀(h1) 내측(전극홀(h1)보다 반도체 소자에 가까운 위치)에 위치할 수 있으며, 내부에 제2 투광부(142)가 배치될 수 있다.The second light transmitting part 142 may be disposed in the light transmitting hole h2 penetrating the substrate 110 and the electrode 120. The light transmission hole h2 may be disposed to penetrate both the substrate 110 and the electrode 120. In addition, the light transmission hole h2 may be disposed to penetrate the substrate 110. The light transmission hole h2 may be located inside the electrode hole h1 (a position closer to the semiconductor device than the electrode hole h1), and the second light transmission part 142 may be disposed therein.

그리고 투광홀(h2)은 제1 상부 전극(121a) 및 제2 상부 전극(122a) 각각의 중앙부에 위치할 수 있다. 그리고 상기 중앙부는 상기 전극을 폭 또는 길이 방향으로 3등분을 했을 때 중앙에 위치하는 영역을 의미한다. 이에 따라, 투광층(140)과 기판(110) 및 전극(120) 간의 결합력을 균형 있게 유지할 수 있다. 다만, 이러한 구조에 한정되는 것은 아니며, 투광홀(h2)은 제1 상부 전극(121a) 및 제2 상부 전극(122a) 각각에서 복수 개일 수 있으며, 다양한 위치에 배치될 수도 있다.The light transmission hole h2 may be positioned at the center of each of the first upper electrode 121a and the second upper electrode 122a. In addition, the center part means an area located at the center when the electrode is divided into three equal parts in the width or length direction. Accordingly, the bonding force between the light transmitting layer 140 and the substrate 110 and the electrode 120 can be maintained in a balanced manner. However, the structure of the present invention is not limited thereto, and the light emitting hole h2 may be provided in plural in each of the first upper electrode 121a and the second upper electrode 122a, and may be disposed at various positions.

제3 투광부(143)는 기판(110) 상에서 제1,2 상부 전극(121a, 122a)과 수평 방향으로 중첩되도록 배치될 수 있다. 제3 투광부(143)는 기판(110)의 가장자리에 배치될 수 있다. 즉, 제3 투광부(143)는 제1 상부 전극(121a), 제2 상부 전극(122a) 보다 외측에 배치될 수 있다. 그리고 제3 투광부(143)는 전극(120)을 평면(ZY 평면) 상으로 둘러싸도록 배치될 수 있다. 이러한 구조에 의하여, 제3 투광부(143)는 전극(120) 및 기판(110) 간의 결합력을 향상시켜 반도체 소자 패키지의 신뢰성을 향상시킬 수 있다.The third light transmitting part 143 may be disposed on the substrate 110 to overlap the first and second upper electrodes 121a and 122a in a horizontal direction. The third light transmitting part 143 may be disposed at the edge of the substrate 110. That is, the third light transmitting part 143 may be disposed outside the first upper electrode 121a and the second upper electrode 122a. In addition, the third light transmitting part 143 may be disposed to surround the electrode 120 on a plane (ZY plane). By this structure, the third light transmitting part 143 may improve the bonding force between the electrode 120 and the substrate 110 to improve the reliability of the semiconductor device package.

제4 투광부(144)는 기판(110) 및 전극(120) 상부에 배치될 수 있다. 제4 투광부(144)는 상술한 바와 같이 반도체 소자(130)가 배치되는 캐비티(C)를 포함할 수 있다. 그리고 제4 투광부(143)는 제1 투광부(141), 제2 투광부(142) 및 제3 투광부(143)의 상부에 배치되고 제1 투광부(141), 제2 투광부(142) 및 제3 투광부(143)와 연결될 수 있다.The fourth light transmitting part 144 may be disposed on the substrate 110 and the electrode 120. As described above, the fourth light transmitting part 144 may include a cavity C in which the semiconductor device 130 is disposed. The fourth light projector 143 is disposed on the first light projector 141, the second light projector 142, and the third light projector 143, and the first light projector 141 and the second light projector ( 142 and the third light transmitting part 143.

제4 투광부(144)는 면적이 제1 투광부(141), 제2 투광부(142) 및 제3 투광부(143) 각각의 면적보다 클 수 있다. 이러한 구성에 의하여, 제4 투광부(144)는 반도체 소자(130)를 기판(110) 및 전극(120) 상에 용이하게 고정하면서, 기판(110) 및 전극(120)과의 결합력도 개선할 수 있다.The area of the fourth light projector 144 may be larger than that of each of the first light projector 141, the second light projector 142, and the third light projector 143. By such a configuration, the fourth light transmitting part 144 easily fixes the semiconductor element 130 on the substrate 110 and the electrode 120, and also improves the bonding force between the substrate 110 and the electrode 120. Can be.

또한, 투광층(140)은 기판의 접착력을 더 높이기 위해 제 5 투광부(145)를 더 포함할 수 있다. 상기 제5 투광부(145)는 반도체 소자(130) 하부 및 제1 상부 전극(121a)과 제2 상부 전극(122a) 사이에 배치될 수 있다. 즉, 제5 투광부(145)는 반도체 소자(130)와 수직 방향으로 중첩되도록 배치되어, 반도체 소자(130)에 대한 결합력을 더욱 개선할 수 있다.In addition, the light transmitting layer 140 may further include a fifth light transmitting part 145 to further increase the adhesion of the substrate. The fifth light transmitting part 145 may be disposed under the semiconductor device 130 and between the first upper electrode 121a and the second upper electrode 122a. That is, the fifth light transmitting part 145 may be disposed to overlap the semiconductor device 130 in the vertical direction, thereby further improving the coupling force to the semiconductor device 130.

도 6은 다른 실시예에 따른 반도체 소자 패키지의 단면도이고, 도 7은 또 다른 실시예에 따른 반도체 소자 패키지의 단면도이다.6 is a cross-sectional view of a semiconductor device package according to another embodiment, and FIG. 7 is a cross-sectional view of a semiconductor device package according to another embodiment.

도 6을 참조하면, 다른 실시예에 따른 반도체 소자 패키지는 상술한 일실시예에 따른 반도체 소자 패키지의 몸체(110), 전극(120), 반도체 소자(130), 투광층(140)을 포함할 수 있다. 이 때, 투광층(140)은 제1 투광부(141) 및 제2 투광부(142)가 존재하지 않을 수 있다. 다만, 이에 한정되지 않고 본 명세서에서 상술하는 반도체 소자 패키지는 상기 구성을 포함할 수도 있다.Referring to FIG. 6, a semiconductor device package according to another embodiment may include a body 110, an electrode 120, a semiconductor device 130, and a light transmitting layer 140 of the semiconductor device package according to the above-described embodiment. Can be. In this case, the light transmitting layer 140 may not include the first light transmitting portion 141 and the second light transmitting portion 142. However, the present invention is not limited thereto, and the semiconductor device package described above may include the above configuration.

이 때, 기판(110)은 투광층(140)과 접하는 영역에서 표면 거칠기(Rz)가 0.6㎛ 내지 1.0㎛일 수 있다. 즉, 기판(110)은 제3 투광부(143)와 수직 방향으로 중첩되는 영역에서 10점 평균 거칠기가(Rz)가 상기 범위로 이루어질 수 있다.In this case, the substrate 110 may have a surface roughness Rz of about 0.6 μm to about 1.0 μm in a region in contact with the light transmitting layer 140. That is, the substrate 110 may have a ten-point average roughness Rz in the above range in the region overlapping with the third light transmitting part 143 in the vertical direction.

이에 따라, 기판(110)의 상면(110a)의 표면적이 다른 영역보다 증가하여, 기판(110)과 투광층(140)은 서로 접합하는 면적이 증가할 수 있다. 이로 인해, 결합력도 향상될 수 있다. As a result, the surface area of the upper surface 110a of the substrate 110 may be increased than that of other regions, and thus the area of the substrate 110 and the light transmitting layer 140 may be increased. Due to this, the bonding force can also be improved.

또한, 투광층(140)은 상술한 바와 같이 수지로 이루어지는 경우 자외선 파장 대역의 광에 대해 투과율 및 내성 등이 높으나, 기판(110)과의 결합력이 강하지 못할 수 있다. 이에, 다른 실시예에 따른 반도체 소자 패키지는 기판(110)과 투광층(140) 간의 결합력을 개선하여 박리 및 마모를 용이하게 방지할 수 있다. 또한, 기판(110)의 상면(110a)은 샌드 블라스트(sandblast) 등의 방법을 이용하여 10점 평균 조도 등을 조절할 수 있다.In addition, when the light-transmitting layer 140 is made of a resin as described above, the transmittance and resistance to light in the ultraviolet wavelength band are high, but the bonding force with the substrate 110 may not be strong. Accordingly, the semiconductor device package according to another embodiment may easily prevent peeling and abrasion by improving the bonding force between the substrate 110 and the light transmitting layer 140. In addition, the top surface 110a of the substrate 110 may adjust a ten point average roughness using a method such as sandblast.

도 7을 참조하면, 또 다른 실시예에 따른 반도체 소자 패키지는 상술한 다른 실시예에 따른 반도체 소자 패키지에서 몸체(110), 전극(120), 반도체 소자(130), 투광층(140)을 포함할 수 있다. 그리고 또 다른 실시예에 따른 반도체 소자 패키지는 접착층(150)을 더 포함할 수 있다.Referring to FIG. 7, a semiconductor device package according to another embodiment includes a body 110, an electrode 120, a semiconductor device 130, and a light transmitting layer 140 in the semiconductor device package according to another embodiment described above. can do. The semiconductor device package according to another embodiment may further include an adhesive layer 150.

접착층(150)은 몸체(110)와 전극(120) 상부에 배치될 수 있다. 구체적으로, 접착층(150)은 몸체(110)와 투광층(140) 사이 및 전극(120)과 투광층(140) 사이에 배치되어, 투광층(140)의 위치를 고정시킬 수 있다. 그리고 투광층(140)에는 캐비티(C)가 존재하므로, 접착층(150)은 몸체(110)와 투광층(140)이 접하는 영역 또는 전극(120)과 투광층(140)이 접하는 영역에 배치될 수 있다.The adhesive layer 150 may be disposed on the body 110 and the electrode 120. Specifically, the adhesive layer 150 may be disposed between the body 110 and the light transmitting layer 140 and between the electrode 120 and the light transmitting layer 140 to fix the position of the light transmitting layer 140. Since the cavity C is present in the light transmitting layer 140, the adhesive layer 150 may be disposed in an area in which the body 110 and the light transmitting layer 140 contact or in an area in which the electrode 120 and the light transmitting layer 140 contact. Can be.

접착층(150)은 열압착을 통해 생성될 수 있다. 구체적으로, 접착층(150)은 열압착을 통해 몸체(110)와 투광층(140)의 접촉부위가 용융되어 생성될 수 있다. 이때, 열압착은 투광층(140)의 융점 이하의 온도에서 수행될 수 있다. The adhesive layer 150 may be generated through thermocompression bonding. Specifically, the adhesive layer 150 may be generated by melting the contact portion of the body 110 and the light transmitting layer 140 through thermocompression bonding. In this case, thermocompression may be performed at a temperature below the melting point of the light transmitting layer 140.

또 다른 실시예에 따른 반도체 소자 패키지는 투광층(140)을 용융시켜 접착층(150)을 배치하므로, 발광 소자 패키지(100)의 발광면적을 증가시킬 수 있다. In the semiconductor device package according to another embodiment, since the transparent layer 140 is melted to arrange the adhesive layer 150, the light emitting area of the light emitting device package 100 may be increased.

또한, 반도체 소자(130)가 방출하는 광이 자외선 영역대의 광일 경우 자외선 광에 의해 유기 본딩재료가 분해되어 부품간 결합이 이탈될 수 있으나, 본 발명의 실시예에 따른 접착층(150)은 자외선 광에 내성이 강한 투광층(140)과 동일한 소재로 구성되므로 투광층(140)과 몸체(110)의 이탈을 방지할 수 있다.In addition, when the light emitted from the semiconductor device 130 is light in the ultraviolet region, the organic bonding material may be decomposed by the ultraviolet light, and thus the coupling between the components may be separated, but the adhesive layer 150 according to the embodiment of the present invention may be ultraviolet light. Since it is made of the same material as the light-transmissive layer 140 that is resistant to the light, it is possible to prevent the separation of the light-transmitting layer 140 and the body 110.

그리고 접착층(150)은 그라파이트 시트(graphite sheet)를 포함할 수 있다. 이에 따라, 접착층(150)은 자외선 광에 대한 내성이 개선될 수 있다. 또한, 접착층(150)은 공극(P)을 포함할 수 있다. 그리고 접착층(150)은 공극(P)에 의해 투광층(140)의 수지가 공극(P)으로 이동하여 투광층(140)과 접착층(150) 간의 결합력을 개선할 수 있다. 또한, 접착층(150)은 기판(110) 상에서 기판(110)과 결합하는 경우에도 공극(P)에 의해 증가된 표면적으로 기판(110)과의 결합력도 개선할 수 있다.The adhesive layer 150 may include a graphite sheet. Accordingly, the adhesive layer 150 may have improved resistance to ultraviolet light. In addition, the adhesive layer 150 may include a void P. In addition, the adhesive layer 150 may improve the bonding force between the light transmitting layer 140 and the adhesive layer 150 by moving the resin of the light transmitting layer 140 to the space P by the air gap P. In addition, even when the adhesive layer 150 is bonded to the substrate 110 on the substrate 110, the adhesive force with the substrate 110 may be improved by the surface area increased by the voids P.

도 8a 내지 도 8e는 일실시예에 따른 반도체 소자 패키지의 제조 순서를 설명하는 도면이다.8A through 8E are diagrams illustrating a manufacturing process of a semiconductor device package according to example embodiments.

도 8a 및 도 8b를 참조하면, 플레이트 형상의 기판(110)을 배치할 수 있다. 그리고 기판(110)에 전극(120)을 배치할 수 있다. 상술한 바와 같이, 기판(110)은 전극홀(h1)을 포함할 수 있다. 그리고 전극(120)은 서로 이격 배치되는 제1 전극부(121)와 제2 전극부(122)를 포함하며, 제1 전극부(121)는 기판(110)의 일측에 배치되고, 제2 전극부(122)는 기판(110)의 타측에 배치될 수 있다. 보다 구체적으로, 기판(110) 상부에서 일측에 제1 상부 전극(121a)을 배치하고, 기판(110) 하부에서 일측에 제1 하부 전극(121c)을 배치할 수 있다. 그리고 기판(110) 일측에 위치하는 전극홀(h1) 내부에 제1 연결 전극(121b)을 배치할 수 있다. 제1 전극부(121)와 마찬가지로, 기판(110) 상부에서 타측에 제2 상부 전극(122a)을 배치하고, 기판(110) 하부에서 타측에 제2 하부 전극(122c)을 배치할 수 있다. 그리고 기판(110) 타측에 위치하는 전극홀(h1) 내부에 제2 연결 전극(122b)을 배치할 수 있다. 또한, 제3 전극부(123)도 기판(110) 하부에 배치할 수 있다.8A and 8B, the plate-shaped substrate 110 may be disposed. In addition, the electrode 120 may be disposed on the substrate 110. As described above, the substrate 110 may include an electrode hole h1. The electrode 120 includes a first electrode portion 121 and a second electrode portion 122 spaced apart from each other, and the first electrode portion 121 is disposed on one side of the substrate 110 and the second electrode. The part 122 may be disposed on the other side of the substrate 110. More specifically, the first upper electrode 121a may be disposed on one side of the substrate 110, and the first lower electrode 121c may be disposed on one side of the substrate 110. The first connection electrode 121b may be disposed in the electrode hole h1 positioned at one side of the substrate 110. Similar to the first electrode 121, the second upper electrode 122a may be disposed on the other side of the substrate 110, and the second lower electrode 122c may be disposed on the other side of the substrate 110. The second connection electrode 122b may be disposed in the electrode hole h1 positioned on the other side of the substrate 110. In addition, the third electrode part 123 may also be disposed under the substrate 110.

도 8c 및 도 8d를 참조하면, 기판(110) 및 전극(120)을 관통하는 투광홀(h2)을 형성할 수 있다. 투광홀(h2)은 전극홀(h1) 내측에 배치될 수 있다. 8C and 8D, a light transmitting hole h2 penetrating the substrate 110 and the electrode 120 may be formed. The light transmission hole h2 may be disposed inside the electrode hole h1.

그리고 제1 상부 전극(121a)과 제2 상부 전극(121b) 상부에 반도체 소자(130)를 배치할 수 있다. 반도체 소자(130)의 제1 전극은 제1 상부 전극(121a)과 전기적으로 연결되고, 제2 전극은 제2 상부 전극(121b)과 전기적으로 연결될 수 있다. 다만, 이러한 구성에 한정되는 것은 아니다.The semiconductor device 130 may be disposed on the first upper electrode 121a and the second upper electrode 121b. The first electrode of the semiconductor device 130 may be electrically connected to the first upper electrode 121a, and the second electrode may be electrically connected to the second upper electrode 121b. However, it is not limited to this structure.

도 8e를 참조하면, 필름의 수지를 열압착하여 용융시켜 투광홀(h2)을 통해 투광층(140)을 형성할 수 있다. 투광층(140)은 제1 하부 전극(121c)과 제3 전극부(123) 사이 및 제2 하부 전극(122c)과 제3 전극부(123) 사이에 배치될 수 있다. 이 때, 용융된 수지가 외부로 흐르지 않도록 지그 등의 구조물을 이용하여 투광층(140)을 형성할 수 있다. 이러한 방식에 의해, 투광층(140)은 기판(110) 하부, 기판(110) 내부(예컨대, 투광홀(h2) 내부), 기판(110)과 전극(120) 상부에 배치될 수 있다. 그리고 투광층(140)은 반도체 소자(130) 하부에 배치되고 제1 상부 전극(122a)과 제2 상부 전극(122a) 사이에 배치되는 제5 투광부(145)를 포함할 수 있다. 또한, 투광층(140)은 반도체 소자(130)를 둘러싸도록 소정의 캐비티(c)를 가지도록 이루어질 수 있다.Referring to FIG. 8E, the resin of the film may be thermocompressed and melted to form the light transmitting layer 140 through the light transmitting hole h2. The light transmitting layer 140 may be disposed between the first lower electrode 121c and the third electrode part 123 and between the second lower electrode 122c and the third electrode part 123. At this time, the light transmitting layer 140 may be formed using a structure such as a jig so that the molten resin does not flow to the outside. In this manner, the light transmitting layer 140 may be disposed under the substrate 110, inside the substrate 110 (eg, inside the light transmitting hole h2), on the substrate 110, and on the electrode 120. The light transmitting layer 140 may include a fifth light transmitting part 145 disposed under the semiconductor device 130 and disposed between the first upper electrode 122a and the second upper electrode 122a. In addition, the light transmitting layer 140 may be formed to have a predetermined cavity (c) to surround the semiconductor device 130.

실시예에 따른 반도체 소자 패키지의 제조 방법에 따르면, 몸체(110) 상에 전극(120), 반도체 소자(130)을 배치하고, 투광층(140)을 기판(110) 등에 접착한 후에 이를 패키지 단위로 다이싱(dicing)할 수 있다. 이에 따라, 공정이 간소화된다. 또한, 공정에서의 불량률 및 비용이 감소하고 제조 시간을 크게 줄일 수 있다. According to the method of manufacturing a semiconductor device package according to an embodiment, the electrode 120 and the semiconductor device 130 are disposed on the body 110, the light-transmitting layer 140 is adhered to the substrate 110, and the like and then packaged. Can be diced. Thus, the process is simplified. In addition, defect rates and costs in the process can be reduced and manufacturing time can be significantly reduced.

그리고 발광 소자 패키지는 수지(resin)나 레지스트(resist)나 SOD 또는 SOG의 경화용 광원으로 사용될 수 있다. 또는, 발광 소자 패키지는 치료용 의료용으로 사용되거나 공기 청정기나 정수기 등의 살균에 사용될 수도 있다.The light emitting device package may be used as a light source for curing a resin, a resist, a SOD, or a SOG. Alternatively, the light emitting device package may be used for medical treatment or sterilization such as an air purifier or a water purifier.

그러나 반드시 이에 한정하는 것은 아니고 상술한 발광 소자 패키지는 조명 시스템의 광원으로 사용될 수 있는데, 예를 들어 영상표시장치의 광원이나 조명 장치 등의 광원으로 사용될 수 있다.However, the present invention is not limited thereto, and the above-described light emitting device package may be used as a light source of an illumination system.

영상표시장치의 백라이트 유닛으로 사용될 때 에지 타입의 백라이트 유닛으로 사용되거나 직하 타입의 백라이트 유닛으로 사용될 수 있고, 조명 장치의 광원으로 사용될 때 등기구나 벌브 타입으로 사용될 수도 있으며, 또한 이동 단말기의 광원으로 사용될 수도 있다. When used as a backlight unit of an image display device can be used as an edge type backlight unit or a direct type backlight unit, when used as a light source of the lighting device may be used as a luminaire or bulb type, and also used as a light source of a mobile terminal It may be.

Claims (8)

기판;
상기 기판에 배치되는 전극;
상기 전극 상에 배치되는 반도체 소자; 및
투광층;을 포함하고,
상기 기판은 상기 기판을 관통하는 투광홀을 포함하며,
상기 투광층은,
상기 기판 하부에 배치되는 제1 투광부;
상기 투광홀 내에 배치되는 제2 투광부;
상기 기판 상에서 상기 전극과 수평 방향으로 중첩되는 제3 투광부; 및
상기 전극 상에 배치되고 상기 반도체 소자를 덮는 제4 투광부;를 포함하고,
상기 제1 투광부의 면적은 상기 제2 투광부의 면적보다 큰 반도체 소자 패키지.
Board;
An electrode disposed on the substrate;
A semiconductor device disposed on the electrode; And
Including a light transmitting layer;
The substrate includes a light transmitting hole penetrating the substrate,
The light transmitting layer,
A first light transmitting part disposed under the substrate;
A second light transmitting part disposed in the light transmitting hole;
A third light transmitting portion overlapping the electrode in a horizontal direction on the substrate; And
And a fourth light transmitting part disposed on the electrode and covering the semiconductor device.
The area of the first light transmitting portion is larger than the area of the second light transmitting portion.
제1항에 있어서,
상기 전극은,
상기 기판의 일측에 배치되는 제1 전극부; 및
상기 제1 전극부와 이격 배치되는 제2 전극부;를 포함하고,
상기 제1 전극은,
상기 기판 상부에 배치되는 제1 상부 전극;
상기 기판을 관통하는 전극홀 내에 배치되는 제1 연결 전극; 및
상기 기판 하부에 배치되는 제1 하부 전극;을 포함하고,
상기 제2 전극은,
상기 기판 상부에 배치되는 제2 상부 전극;
상기 기판을 관통하는 전극홀 내에 배치되는 제2 연결 전극; 및
상기 기판 하부에 배치되는 제2 하부 전극;을 포함하는 반도체 소자 패키지.
The method of claim 1,
The electrode,
A first electrode part disposed on one side of the substrate; And
And a second electrode portion spaced apart from the first electrode portion.
The first electrode,
A first upper electrode disposed on the substrate;
A first connection electrode disposed in the electrode hole penetrating the substrate; And
A first lower electrode disposed under the substrate;
The second electrode,
A second upper electrode disposed on the substrate;
A second connection electrode disposed in the electrode hole penetrating the substrate; And
And a second lower electrode disposed under the substrate.
제2항에 있어서,
상기 투광층은,
상기 제1 상부 전극 및 상기 제2 상부 전극 사이에 배치되는 제5 투광부를 더 포함하는 반도체 소자 패키지.
The method of claim 2,
The light transmitting layer,
The semiconductor device package further comprises a fifth light transmitting part disposed between the first upper electrode and the second upper electrode.
제1항에 있어서,
상기 투광층은 무기 재료를 포함하고,
상기 무기 재료는,
플루오르네이티드 에틸렌-프로필렌(fluorinated ethylene-propylene, FEP), 테트라플루오로에틸렌 헥사플루오로프로필렌 비닐리덴플루오라이드(Tetra fluoro ethylene Hexa fluoro propylene Vinylidene fluoride, THV) 중 적어도 하나를 포함하는 발광 소자 패키지.
The method of claim 1,
The light transmitting layer comprises an inorganic material,
The inorganic material,
A light emitting device package comprising at least one of fluorinated ethylene-propylene (FEP) and tetrafluoroethylene hexafluoropropylene vinylidene fluoride (THV).
제1항에 있어서,
상기 반도체 소자는,
자외선 파장대의 광을 방출하는 발광 소자 패키지.
The method of claim 1,
The semiconductor device,
A light emitting device package that emits light in the ultraviolet wavelength range.
제1항에 있어서,
상기 기판은 상기 제3 투광부와 수직 방향으로 중첩되는 영역에서 10점 평균 거칠기가 0.6㎛ 내지 1.0㎛인 반도체 소자 패키지.
The method of claim 1,
The substrate has a 10-point average roughness of 0.6 μm to 1.0 μm in a region overlapping with the third light transmitting part in a vertical direction.
제1항에 있어서,
상기 기판 및 상기 전극 상부에 배치되는 접착층을 더 포함하고,
상기 접착층은 공극을 포함하는 반도체 소자 패키지.
The method of claim 1,
Further comprising an adhesive layer disposed on the substrate and the electrode,
The adhesive layer is a semiconductor device package including a gap.
제7항에 있어서,
상기 접착층은 그라파이트 시트(Graphite sheet)를 포함하는 반도체 소자 패키지.
The method of claim 7, wherein
The adhesive layer is a semiconductor device package including a graphite sheet (Graphite sheet).
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