KR20190113798A - 동기화 신호 블록 송신 및 수신 - Google Patents

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KR20190113798A
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로버트 러브
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모토로라 모빌리티 엘엘씨
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Abstract

장치들, 방법들, 및 시스템들은 동기화 신호 블록을 송신 및/또는 수신하고 있다. 일 방법(900)은 동기화 신호 블록을 수신하는 단계(902)를 포함한다. 방법(900)은 동기화 신호 블록의 1차 동기화 신호 및 브로드캐스트 채널을 검출하는 단계(904)를 포함한다. 동기화 신호 블록을 수신하는 단계는, 시간 윈도우 내에서 다수의 동기화 신호 블록들 중 적어도 하나의 동기화 신호 블록을 수신하는 단계(906)를 포함하며, 브로드캐스트 채널은 다수의 서브 대역들을 포함한다.

Description

동기화 신호 블록 송신 및 수신
본 출원은 정 혜정(Hyejung Jung)의 이름으로 2017년 2월 6일자로 출원된 "플렉시블 무선 통신을 위한 광대역 PBCH 및 SS 블록 위치"라는 명칭의 미국 특허 출원 62/455,542에 대한 우선권을 주장하며, 이 미국 출원은 그 전체가 본원에 참고로 포함된다.
본원에 개시되는 대상은 일반적으로 무선 통신에 관한 것으로, 보다 상세하게는 동기화 신호 블록을 송신 및/또는 수신하는 것에 관한 것이다.
아래에는 용어들이 그 약어들과 함께 정의되며, 이들 중 적어도 일부는 아래의 설명에서 참조된다: 3세대 파트너쉽 프로젝트(Third Generation Partnership Project)(“3GPP”), 5세대(Fifth Generation)(“5G”), 인증, 승인 및 과금(Authentication Authorization and Accounting)(“AAA”), 긍정 확인응답(Positive-Acknowledgment)(“ACK”), 확인 모드(Acknowledged Mode)(“AM”), 액세스 및 이동성 관리 기능(Access and Mobility Management Function)(“AMF”), 액세스 서버(Access Server)(“AS”), 인증 서브 기능(Authentication Server Function)(“AUSF”), 대역폭(Bandwidth)(“BW”), 셀 무선 네트워크 임시 식별자(Cell Radio Network Temporary Identifier)(“C-RNTI”), 공통 물리적 다운링크 제어 채널(Common Physical Downlink Control Channel)(“C-PDCCH”), 전용 제어 채널(Dedicated Control Channel)(“DCCH”), 다운링크(Downlink)(“DL”), 복조 기준 신호(Demodulation Reference Signal)(“DMRS”), 도메인 네임 시스템(Domain Name System)(“DNS”), 강화된 모바일 광대역(Enhanced Mobile Broadband)(“eMBB”), 진화된 노드 B (Evolved Node B)(“eNB”), 강화된 가입자 식별 모듈(Enhanced Subscriber Identification Module)(“eSIM”), 장비 식별자 레지스터(Equipment Identity Register)(“EIR”), 진화된 패킷 코어(Evolved Packet Core)(“EPC”), 유럽 전기통신 표준 협회(European Telecommunications Standards Institute)(“ETSI”), E-UTRAN 무선 액세스 베어러(E-UTRAN Radio Access Bearer)(“E-RAB”), 진화된 범용 지상 무선 액세스 네트워크(Evolved-Universal Terrestrial Radio Access Network)(“E-UTRAN”), 주파수 분할 듀플렉스(Frequency Division Duplex)(“FDD”), 주파수 분할 다중 액세스(Frequency Division Multiple Access)(“FDMA”), 전체 주소 도메인 네임(Fully Qualified Domain Name)(“FQDN”), 세계 모바일 통신 시스템 협회(Global System For Mobile Communications Association)(“GSMA”), 하이브리드 자동 반복 요청(Hybrid Automatic Repeat Request)(“HARQ”), 홈 정책 제어 기능(Home Policy Control Function)(“H-PCF”), 홈 퍼블릭 랜드 모바일 네트워크(Home Public Land Mobile Network)(“HPLMN”), 식별자(Identity or Identifier or Identification)(“ID”), 국제 모바일 장비 식별자(International Mobile Equipment Identity)(“IMEI”), 국제 모바일 가입자 식별자(International Mobile Subscriber Identity)(“IMSI”), 사물 인터넷(Internet-of-Things)(“IoT”), 논리 채널 식별자(Logical Channel Identifier)(“LCID”), 롱텀에볼루션(Long Term Evolution)(“LTE”), 다중 액세스(Multiple Access)(“MA”), 매체 액세스 제어(Medium Access Control)(“MAC”), 변조 코딩 방식(Modulation Coding Scheme)(“MCS”), 모바일 국가 코드(Mobile Country Code)(“MCC”), 모바일 네트워크 코드(Mobile Network Code)(“MNC”), 머신 타입 통신(Machine Type Communication)(“MTC”), 마스터 정보 블록(Master Information Block)(“MIB”), 이동성 관리(Mobility Management)(“MM”), 이동성 관리 엔티티(Mobility Management Entity)(“MME”), 비-액세스 계층(Non-Access Stratum)(“NAS”), 협대역(Narrowband)(“NB”), 부정 확인응답(Negative-Acknowledgment)(“NACK”) 또는 (“NAK”), 네트워크 엔티티(Network Entity)(“NE”), 차세대 노드 B (Next Generation Node B)(“gNB”), 직교 주파수 분할 다중화(Orthogonal Frequency Division Multiplexing)(“OFDM”), 오버디에어(Over-the-Air)(“OTA”), 물리적 브로드캐스트 채널(Physical Broadcast Channel)(“PBCH”), 정책 제어 기능(Policy Control Function)(“PCF”), 패킷 데이터 컨버전스 프로토콜(Packet Data Convergence Protocol)(“PDCP”), 프로토콜 데이터 유닛(Protocol Data Unit)(“PDU”), 퍼블릭 랜드 모바일 네트워크(Public Land Mobile Network)(“PLMN”), 1차 동기화 신호(Primary Synchronization Signal)(“PSS”), 포인터(Pointer)(“PTR”), 서비스 품질(Quality of Service)(“QoS”), 랜덤 액세스 채널(Random Access Channel)(“RACH”), 무선 액세스 기술(Radio Access Technology)(“RAT”), 리소스 블록(Resource Block)(“RB”), 무선 링크 제어(Radio Link Control)(“RLC”), 무선 링크 실패(Radio Link Failure)(“RLF”), 무선 네트워크 계층(Radio Network Layer)(“RNL”), 무선 리소스 제어(Radio Resource Control)(“RRC”), 무선 리소스 관리(Radio Resource Management)(“RRM”), 무선 액세스 네트워크(Radio Access Network)(“RAN”), 기준 신호 수신 전력(Reference Signal Received Power)(“RSRP”), 기준 신호 수신 품질(Reference Signal Received Quality)(“RSRQ”), 수신(Receive)(“RX”), 2차 동기화 신호(Secondary Synchronization Signal)(“SSS”), 서비스 데이터 유닛(Service Data Unit)(“SDU”), 시퀀스 번호(Sequence Number)(“SN”), 단일 캐리어 주파수 분할 다중 액세스(Single Carrier Frequency Division Multiple Access)(“SC-FDMA”), 가입자 관리 기능(Subscriber Management Function)(“SMF”), 신호대 잡음비(Signal-to-Noise Ratio)(“SNR”), 가입자 식별 모듈(Subscriber Identity Module)(“SIM”), 시스템 정보 블록(System Information Block)(“SIB”), 사이드 링크(Sidelink)(“SL”), 공유 채널(Shared Channel)(“SCH”), 동기화 신호(Synchronization Signal)(“SS”), 가입 은닉 식별자(Subscription Concealed Identifier)(“SUCI”), 가입 영구 식별자(Subscription Permanent Identifier)(“SUPI”), 타이밍 어드밴스 그룹(Timing Advance Group)(“TAG”), 트래킹 구역(Tracking Area)(“TA”), 시분할 듀플렉스(Time Division Duplex)(“TDD”), 전송 네트워크 계층(Transport Network Layer)(“TNL”), 송신 시간 간격(Transmission Time Interval)(“TTI”), 송신(Transmit)(“TX”), 통합 데이터 관리(Unified Data Management)(“UDM”), 사용자 데이터 저장소(User Data Repository)(“UDR”), 사용자 엔티티/장비(모바일 단말기)(User Entity/Equipment (Mobile Terminal))(“UE”), 범용 통합 회로 카드(Universal Integrated Circuit Card)(“UICC”), 업링크(Uplink)(“UL”), 범용 모바일 전기 통신 시스템(Universal Mobile Telecommunications System)(“UMTS”), 사용자 평면 기능(User Plane Function)(“UPF”), 초신뢰성 저지연 통신(Ultra-Reliable Low-Latency Communication)(“URLLC”), 범용 가입자 식별 모듈(Universal Subscriber Identity Module)(“USIM”), 방문 정책 제어 기능(Visited Policy Control Function)(“V-PCF”), 방문 퍼블릭 랜드 모바일 네트워크(Visited Public Land Mobile Network)(“VPLMN”), 및 와이맥스(Worldwide Interoperability for Microwave Access)(“WiMAX”). 본원에서 사용되는 "HARQ-ACK"는 긍정 확인응답( "ACK") 및 부정 확인응답( "NAK")을 집합적으로 나타낼 수 있다. ACK는 TB가 올바르게 수신되었음을 의미하지만 NAK는 TB가 잘못 수신되었음을 의미한다.
특정 무선 통신 네트워크들에서, 동기화 신호 블록이 송신 및/또는 수신될 수 있다. 이러한 네트워크들에서, 동기화 신호 블록은 1차 동기화 신호를 포함할 수 있다.
동기화 신호 블록을 수신하는 방법들이 개시된다. 장치들 및 시스템들은 또한 장치의 기능들을 수행한다. 일 실시예에서, 상기 방법은 동기화 신호 블록을 수신하는 단계를 포함한다. 다양한 실시예들에서, 상기 방법은 동기화 신호 블록의 1차 동기화 신호 및 브로드캐스트 채널을 검출하는 단계를 포함한다. 일부 실시예들에서, 동기화 신호 블록을 수신하는 단계는, 시간 윈도우 내에서 다수의 동기화 신호 블록들 중 적어도 하나의 동기화 신호 블록을 수신하는 단계를 포함하며, 브로드캐스트 채널은 다수의 서브 대역들을 포함한다.
특정 실시예들에서, 다수의 서브 대역들 중 적어도 하나의 서브 대역은 자체 디코딩 가능 유닛(self-decodable unit)을 운반한다. 일 실시예에서, 상기 방법은 동기화 신호 블록의 적어도 하나의 2차 동기화 신호를 검출하는 단계를 포함한다. 추가의 실시예에서, 다수의 서브 대역들 중의 각각의 서브 대역은 적어도 하나의 자체 디코딩 가능 유닛을 운반한다. 특정 실시예들에서, 다수의 서브 대역들 중의 제1 서브 대역은 다수의 서브 대역들 중의 제2 서브 대역과 동일한 크기이다. 다양한 실시예들에서, 다수의 서브 대역들 중의 제1 서브 대역은 다수의 서브 대역들 중의 제2 서브 대역과는 상이한 크기이다. 일부 실시예들에서, 다수의 서브 대역들 중의 제1 서브 대역은 브로드캐스트 채널의 중앙부에 위치하고, 다수의 서브 대역들 중의 제2 서브 대역은 중앙부의 양측에 위치한다. 특정 실시예들에서, 상기 방법은 제1 서브 대역만을 수신하고 제1 서브 대역 상에서 송신된 채널 비트들을 디코딩하는 단계를 포함한다.
다양한 실시예들에서, 적어도 하나의 자체 디코딩 가능 유닛은 코딩된 및 레이트 매칭된 채널 비트들을 포함한다. 일부 실시예들에서, 1차 동기화 신호, 적어도 하나의 2차 동기화 신호, 및 브로드캐스트 채널은 하나의 슬롯에서 송신된다. 특정 실시예들에서, 상기 방법은 동기화 신호 블록으로부터 슬롯 및 프레임 타이밍 정보를 결정하는 단계를 포함한다. 다양한 실시예들에서, 다수의 동기화 신호 블록들을 포함하는 시간 윈도우는 주기적으로 발생한다. 일부 실시예들에서, 시간 윈도우는 5ms 또는 10ms를 포함한다. 특정 실시예들에서, 브로드캐스트 채널은 시스템 프레임 번호를 운반한다. 다양한 실시예들에서, 브로드캐스트 채널은 슬롯 및 프레임 타이밍 관련 정보를 운반한다.
일부 실시예들에서, 상기 방법은, 제1 슬롯에서 공통 제어 채널을 수신하는 단계; 공통 제어 채널에 기초하여 제1 슬롯의 다운링크 영역에서 동기화 신호 블록이 송신되는지를 결정하는 단계; 및 제1 슬롯의 다운링크 영역에서 물리적 다운링크 공유 채널 또는 물리적 다운링크 제어 채널에 대한 가용 다운링크 리소스 요소들을 식별하는 단계를 포함한다. 특정 실시예들에서, 제1 슬롯은 동기화 신호 블록 송신 윈도우 내에 있고, 동기화 신호 블록 송신 윈도우는 동기화 신호 블록들을 송신하기 위한 적어도 하나의 슬롯을 포함한다. 다양한 실시예들에서, 제1 슬롯의 다운링크 제어 영역의 크기는 제2 슬롯의 다운링크 제어 영역의 크기와는 상이하고, 제2 슬롯은 동기화 신호 블록 송신 윈도우 내에 있지 않다.
동기화 신호 블록을 수신하기 위한 장치는, 일 실시예에서, 동기화 신호 블록을 수신하는 수신기를 포함한다. 상기 장치는, 특정 실시예들에서, 동기화 신호 블록의 1차 동기화 신호 및 브로드캐스트 채널을 검출하는 프로세서를 포함한다. 일부 실시예들에서, 동기화 신호 블록을 수신하는 것은, 시간 윈도우 내에서 다수의 동기화 신호 블록들 중 적어도 하나의 동기화 신호 블록을 수신하는 것을 포함하며, 브로드캐스트 채널은 다수의 서브 대역들을 포함한다.
동기화 신호 블록을 송신하는 하나의 방법은 1차 동기화 신호 및 브로드캐스트 채널을 포함하는 동기화 신호 블록을 결정하는 단계를 포함한다. 다양한 실시예들에서, 상기 방법은 동기화 신호 블록을 송신하는 단계를 포함한다. 특정 실시예들에서, 동기화 신호 블록을 송신하는 단계는 시간 윈도우 내에서 다수의 동기화 신호 블록들을 송신하는 단계를 포함하며, 브로드캐스트 채널은 다수의 서브 대역들을 포함한다.
특정 실시예들에서, 다수의 서브 대역들 중 적어도 하나의 서브 대역은 자체 디코딩 가능 유닛을 운반한다. 일 실시예에서, 상기 방법은 동기화 신호 블록의 적어도 하나의 2차 동기화 신호를 결정하는 단계를 포함한다. 추가의 실시예에서, 다수의 서브 대역들 중의 각각의 서브 대역은 적어도 하나의 자체 디코딩 가능 유닛을 운반한다. 특정 실시예들에서, 다수의 서브 대역들 중의 제1 서브 대역은 다수의 서브 대역들 중의 제2 서브 대역과 동일한 크기이다. 다양한 실시예들에서, 다수의 서브 대역들 중의 제1 서브 대역은 다수의 서브 대역들 중의 제2 서브 대역과는 상이한 크기이다. 일부 실시예들에서, 다수의 서브 대역들 중의 제1 서브 대역은 브로드캐스트 채널의 중앙부에 위치하고, 다수의 서브 대역들 중의 제2 서브 대역은 중앙부의 양측에 위치한다.
다양한 실시예들에서, 적어도 하나의 자체 디코딩 가능 유닛은 코딩된 및 레이트 매칭된 채널 비트들을 포함한다. 일부 실시예들에서, 1차 동기화 신호, 적어도 하나의 2차 동기화 신호, 및 브로드캐스트 채널은 하나의 슬롯에서 송신된다. 특정 실시예들에서, 슬롯 및 프레임 타이밍 정보는 동기화 신호 블록으로부터 결정된다. 다양한 실시예들에서, 다수의 동기화 신호 블록들을 포함하는 시간 윈도우는 주기적으로 발생한다. 일부 실시예에서, 시간 윈도우는 5ms 또는 10ms를 포함한다. 특정 실시예들에서, 브로드캐스트 채널은 시스템 프레임 번호를 운반한다. 다양한 실시예들에서, 브로드캐스트 채널은 슬롯 및 프레임 타이밍 관련 정보를 운반한다.
일부 실시예들에서, 상기 방법은 제1 슬롯에서 공통 제어 채널을 송신하는 단계를 포함한다. 특정 실시예들에서, 제1 슬롯은 동기화 신호 블록 송신 윈도우 내에 있고, 동기화 신호 블록 송신 윈도우는 동기화 신호 블록들을 송신하기 위한 적어도 하나의 슬롯을 포함한다. 다양한 실시예들에서, 제1 슬롯의 다운링크 제어 영역의 크기는 제2 슬롯의 다운링크 제어 영역의 크기와는 상이하고, 제2 슬롯은 동기화 신호 블록 송신 윈도우 내에 있지 않다.
동기화 신호 블록을 송신하는 장치는, 일 실시예에서, 1차 동기화 신호 및 브로드캐스트 채널을 포함하는 동기화 신호 블록을 결정하는 프로세서를 포함한다. 특정 실시예들에서, 상기 장치는 동기화 신호 블록을 송신하는 송신기를 포함한다. 다양한 실시예들에서, 동기화 신호 블록을 송신하는 송신기는 시간 윈도우 내에서 다수의 동기화 신호 블록들을 송신하는 송신기를 포함하며, 브로드캐스트 채널은 다수의 서브 대역들을 포함한다.
위에서 간략하게 기술된 실시예들의 보다 특정의 설명은 첨부된 도면들에 도시된 특정 실시예들을 참조하여 제공될 것이다. 이들 도면들은 단지 일부의 실시예들만을 도시하고 따라서 범위를 제한하는 것으로 간주되지 않는다는 것을 이해하면, 이 실시예들은 첨부된 도면들의 사용을 통해 추가적인 특이성 및 세부 사항으로 기술되고 설명된다.
도 1은 동기화 신호 블록을 송신 및/또는 수신하기 위한 무선 통신 시스템의 일 실시예를 나타내는 개략적인 블록도이다.
도 2는 동기화 신호 블록을 수신하는 데 사용될 수 있는 장치의 일 실시예를 나타내는 개략적인 블록도이다.
도 3은 동기화 신호 블록을 송신하는 데 사용될 수 있는 장치의 일 실시예를 나타내는 개략적인 블록도이다.
도 4는 4 개의 심볼들에 의해 운반되는 광대역 PBCH의 일 실시예를 나타낸다.
도 5는 2 개의 심볼들에 의해 운반되는 광대역 PBCH의 일 실시예를 나타낸다.
도 6은 DMRS 다중화의 일 실시예를 나타낸다.
도 7은 슬롯에서의 송신들의 일 실시예를 나타낸다.
도 8은 SS 블록 송신들의 일 실시예를 나타낸다.
도 9는 동기화 신호 블록을 수신하기 위한 방법의 일 실시예를 나타내는 개략적인 흐름도이다.
도 10은 동기화 신호 블록을 송신하기 위한 방법의 일 실시예를 나타내는 개략적인 흐름도이다.
본 기술 분야의 기술자라면 알 수 있는 바와 같이, 본 실시예들의 양태들은 시스템, 장치, 방법, 또는 프로그램 제품으로서 구현될 수 있다. 따라서, 실시예들은 완전한 하드웨어 실시예, (펌웨어, 상주 소프트웨어, 마이크로 코드 등을 포함하는) 완전한 소프트웨어 실시예 또는 소프트웨어 및 하드웨어 양태를 결합한 실시예의 형태를 취할 수 있으며, 이들 모두는 일반적으로 본원에서 "회로", "모듈" 또는 "시스템"으로 지칭될 수 있다. 또한, 실시예들은 머신 판독 가능 코드, 컴퓨터 판독 가능 코드, 및/또는 이후에 코드로 지칭되는 프로그램 코드를 저장하는 하나 이상의 컴퓨터 판독 가능 저장 디바이스들에서 구현되는 프로그램 제품의 형태를 취할 수 있다. 이들 저장 디바이스들은 유형적일 수 있고, 비일시적일 수 있고, 및/또는 비 전송적일 수 있다. 이들 저장 디바이스들은 신호들을 구현하지 않을 수 있다. 특정 실시예에서, 이들 저장 디바이스들은 코드에 액세스하기 위한 신호들만을 이용한다.
본 명세서에서 설명된 특정의 기능 유닛들은 그 구현의 독립성을 보다 특정적으로 강조하기 위해 모듈들로서 라벨링될 수 있다. 예를 들어, 모듈은 주문형 초대규모 집적(very-large-scale integration)(VLSI) 회로들 또는 게이트 어레이들, 로직 칩들, 트랜지스터들, 또는 다른 개별 컴포넌트들과 같은 기성품 반도체들을 포함하는 하드웨어 회로로서 구현될 수 있다. 모듈은 또한 필드 프로그래머블 게이트 어레이들(field programmable gate arrays), 프로그래머블 어레이 로직(programmable array logic), 프로그래머블 로직 디바이스들(programmable logic device) 등과 같은 프로그래머블 하드웨어 디바이스들로 구현될 수 있다.
모듈들은 또한 다양한 타입의 프로세서들에 의한 실행을 위해 코드 및/또는 소프트웨어로 구현될 수 있다. 식별된 코드 모듈은, 예를 들어, 객체, 절차, 또는 기능으로 조직화될 수 있는 실행 가능 코드의 하나 이상의 물리적 또는 논리적 블록들을 포함할 수 있다. 그럼에도 불구하고, 식별된 모듈의 실행 파일들은 물리적으로 함께 위치할 필요는 없지만, 논리적으로 함께 결합될 때 모듈을 포함하고 그 모듈에 대한 명시된 목적을 달성하는 서로 다른 위치들에 저장된 서로 다른 명령어를 포함할 수 있다.
실제로, 코드 모듈은 단일 명령어 또는 다수의 명령어일 수 있으며, 심지어는 여러 개의 코드 세그먼트들에 걸쳐, 서로 다른 프로그램들 사이에서, 그리고 여러 개의 메모리 디바이스들에 걸쳐 분산될 수도 있다. 유사하게, 동작 데이터는 본원에서 모듈들 내에서 식별되고 도시될 수 있으며, 임의의 적합한 형태로 구현될 수 있고 임의의 적합한 타입의 데이터 구조 내에 조직화될 수 있다. 동작 데이터는 단일 데이터 세트로서 수집될 수 있거나 서로 다른 컴퓨터 판독 가능 저장 디바이스들에 걸쳐 분산되는 것을 포함하여 서로 다른 위치들에 걸쳐 분산될 수 있다. 모듈 또는 모듈의 부분들이 소프트웨어로 구현되는 경우, 소프트웨어 부분들은 하나 이상의 컴퓨터 판독 가능 저장 디바이스들 상에 저장된다.
하나 이상의 컴퓨터 판독가능 매체의 임의의 조합이 이용될 수 있다. 컴퓨터 판독가능 매체는 컴퓨터 판독가능 저장 매체일 수 있다. 컴퓨터 판독가능 저장 매체는 코드를 저장하는 저장 디바이스일 수 있다. 저장 디바이스는, 예를 들어, 전자, 자기, 광학, 전자기, 적외선, 홀로그래픽, 마이크로기계, 또는 반도체 시스템, 장치, 또는 디바이스, 또는 전술한 것의 임의의 적절한 조합일 수 있지만, 이에 국한되는 것은 아니다.
저장 디바이스의 보다 특정된 예들(비제한적인 리스트)은 하나 이상의 와이어들을 갖는 전기적 접속, 휴대용 컴퓨터 디스켓, 하드 디스크, 랜덤 액세스 메모리(RAM), 판독 전용 메모리(ROM), 소거가능 프로그래머블 판독 전용 메모리(EPROM 또는 플래시 메모리), 휴대용 컴팩트 디스크 판독 전용 메모리(CD-ROM), 광학 저장 디바이스, 자기 저장 디바이스, 또는 전술한 것의 임의의 적절한 조합을 포함할 것이다. 본 명세서의 문맥에서, 컴퓨터 판독가능 저장 매체는 명령어 실행 시스템, 장치 또는 디바이스에 의해 사용하거나 그와 관련하여 사용하기 위한 프로그램을 포함하거나 저장할 수 있는 임의의 유형적인 매체(tangible medium)일 수 있다.
실시예들에 대한 동작을 수행하기 위한 코드는 임의의 수의 라인들일 수 있고, 파이썬(Python), 루비(Ruby), 자바(Java), 스몰토크(Smalltalk), C++ 등과 같은 객체 지향 프로그래밍 언어들, 및 "C" 프로그래밍 언어 등과 같은 종래의 절차형 프로그래밍 언어들, 및/또는 어셈블리 언어들과 같은 머신 언어들을 포함하는 하나 이상의 프로그래밍 언어들의 임의의 조합으로 작성될 수 있다. 코드는 전적으로는 사용자의 컴퓨터 상에서, 부분적으로는 사용자의 컴퓨터 상에서, 독립형 소프트웨어 패키지로서, 부분적으로는 사용자의 컴퓨터 상에서 그리고 부분적으로는 원격 컴퓨터 상에서, 또는 전적으로는 원격 컴퓨터 또는 서버 상에서 실행될 수 있다. 후자의 시나리오에서, 원격 컴퓨터는 근거리 네트워크(LAN) 또는 광역 네트워크(WAN)를 포함하는 임의의 타입의 네트워크를 통해 사용자의 컴퓨터에 접속될 수 있거나, 또는 외부 컴퓨터에 (예를 들어, 인터넷 서비스 제공자를 사용하는 인터넷을 통해) 접속이 행해질 수 있다.
본 명세서 전체에 걸쳐 "일 실시예", "실시예" 또는 유사한 언어에 대한 언급은 그 실시예와 관련하여 설명된 특정 특징, 구조 또는 특성이 적어도 하나의 실시예에 포함된다는 것을 의미한다. 따라서, 본 명세서 전체에 걸쳐 나타나는 문구인 "일 실시예에서", "실시예에서" 및 유사한 언어는 모두 동일한 실시예를 지칭할 수도 있지만, 반드시 그러한 것은 아니며, 명시적으로 달리 지정되지 않는 한, "하나 또는 그 이상의 실시예들이지만 모든 실시예를 지칭하는 것은 아님"을 의미한다. 용어 "포함하는", "구비하는", "갖는" 및 그 변형들은 명시적으로 달리 지정되지 않는 한, "포함하지만 이에 한정되지 않음"을 의미한다. 열거된 항목들의 목록은 명시적으로 달리 지정되지 않는 한, 일부 또는 모든 항목이 상호 배타적이라는 것을 의미하는 것은 아니다. 단수 형태의 용어들은 명시적으로 달리 지정되지 않는 한, "하나 이상"을 또한 지칭한다.
또한, 본 실시예들의 설명된 특징들, 구조들, 또는 특성들은 임의의 적절한 방식으로 결합될 수 있다. 다음의 설명에서, 실시예들의 완전한 이해를 제공하기 위해, 프로그래밍, 소프트웨어 모듈들, 사용자 선택들, 네트워크 트랜잭션들, 데이터베이스 질의들, 데이터베이스 구조들, 하드웨어 모듈들, 하드웨어 회로들, 하드웨어 칩들의 예들 등과 같은 다수의 특정 세부 사항들이 제공된다. 그러나, 관련 기술 분야의 기술자는 실시예들이 하나 이상의 특정 세부 사항들 없이 실시될 수 있거나 다른 방법들, 컴포넌트들, 자료들 등으로 실시될 수 있다는 것을 인식할 것이다. 다른 예들에서, 잘 알려진 구조들, 자료들, 또는 동작들은 실시예의 양태들을 모호하게 하는 것을 피하기 위해 상세하게 도시되거나 설명되지는 않는다.
본 실시예들의 양태들은 실시예들에 따른 방법들, 장치들, 시스템들, 및 프로그램 제품들의 개략적인 흐름도들 및/또는 개략적인 블록도들을 참조하여 아래에서 기술된다. 개략적인 흐름도들 및/또는 개략적인 블록도들의 각 블록, 및 개략적인 흐름도들 및/또는 개략적인 블록도들 내의 블록들의 조합들은 코드에 의해 구현될 수 있음이 이해될 것이다. 코드는 범용 컴퓨터, 특수 목적 컴퓨터 또는 다른 프로그래머블 데이터 처리 장치의 프로세서에 제공되어 머신을 생성할 수 있으며, 그에 따라, 컴퓨터 또는 프로그래머블 데이터 처리 장치의 프로세서를 통해 실행되는 명령어들은 개략적인 흐름도들 및/또는 개략적인 블록도들의 블록 또는 블록들에서 특정된 기능들/동작들을 구현하기 위한 수단을 생성하게 된다.
코드는 또한 컴퓨터, 다른 프로그래머블 데이터 처리 장치, 또는 다른 디바이스들에 지시하여 특정 방식으로 기능하게 할 수 있도록 저장 디바이스에 저장될 수 있으며, 그에 따라 저장 디바이스에 저장된 명령어들은 개략적인 흐름도들 및/또는 개략적인 블록도들의 블록 또는 블록들에서 특정된 기능/동작을 구현하는 명령어들을 포함하는 제조품을 생성하게 된다.
코드는 또한 컴퓨터, 다른 프로그래머블 데이터 처리 장치, 또는 다른 디바이스들 상에 로딩되어, 컴퓨터, 다른 프로그래머블 장치 또는 다른 디바이스들 상에서 일련의 동작 단계들이 수행되게 함으로써 컴퓨터로 구현되는 프로세스를 생성할 수 있으며, 그에 따라, 컴퓨터 또는 다른 프로그래머블 장치 상에서 실행되는 코드는 흐름도 및/또는 블록도의 블록 또는 블록들에서 특정된 기능들/동작들을 구현하기 위한 프로세스들을 제공하게 된다.
도면들에서 개략적인 흐름도들 및/또는 개략적인 블록도들은 다양한 실시예들에 따른 장치들, 시스템들, 방법들 및 프로그램 제품들의 가능한 구현예들의 아키텍처, 기능, 및 동작을 나타낸다. 이와 관련하여, 개략적인 흐름도들 및/또는 개략적인 블록도들 내의 각 블록은, 특정 논리 기능(들)을 구현하기 위한 하나 이상의 실행 가능 명령어들을 포함하는 모듈, 세그먼트, 또는 코드 부분을 나타낼 수 있다.
또한, 일부 대안의 구현예들에서, 블록에서 언급된 기능들은 도면들에서 언급된 순서를 벗어나 발생할 수 있음에 또한 주목해야 한다. 예를 들어, 연속적으로 도시된 두 개의 블록은 사실상 실질적으로 동시에 실행될 수 있거나, 관련된 기능에 따라 때때로 그 블록들이 역순으로 실행될 수도 있다. 도시된 도면들의 하나 이상의 블록들 또는 그 일부에 대한 기능, 로직 또는 효과가 등가인 다른 단계들 및 방법들이 고려될 수도 있다.
다양한 화살표 타입들 및 라인 타입들이 흐름도 및/또는 블록도들에 이용될 수 있지만, 대응하는 실시예들의 범위를 제한하지 않는 것으로 이해된다. 실제로, 일부 화살표 또는 다른 커넥터는 도시된 실시예의 로직 흐름만을 나타내기 위해 사용될 수 있다. 예를 들어, 화살표는 도시된 실시예의 열거된 단계들 사이의 불특정 지속시간의 대기 또는 모니터링 기간을 나타낼 수 있다. 또한, 주목할 것은, 블록도들 및/또는 흐름도들의 각각의 블록, 및 블록도들 및/또는 흐름도들 내의 블록들의 조합들은 특정 기능들 또는 동작들을 수행하는 특수 목적 하드웨어 기반 시스템들, 또는 특수 목적 하드웨어 및 코드의 조합들에 의해 구현될 수 있다는 것이다.
각 도면 내의 요소들의 설명은 앞선 도면들의 요소들을 참조할 수 있다. 유사한 번호는 유사한 요소들의 대안적인 실시예들을 포함하여 모든 도면들에서 유사한 요소를 지칭한다.
도 1은 동기화 신호 블록을 송신 및/또는 수신하기 위한 무선 통신 시스템(100)의 일 실시예를 도시한다. 일 실시예에서, 무선 통신 시스템(100)은 원격 유닛들(102) 및 네트워크 유닛들(104)을 포함한다. 특정 개수의 원격 유닛들(102) 및 네트워크 유닛들(104)이 도 1에 도시되어 있지만, 임의의 수의 원격 유닛들(102) 및 네트워크 유닛들(104)이 무선 통신 시스템(100)에 포함될 수 있음을 본 기술 분야의 기술자는 인식할 것이다.
일 실시예에서, 원격 유닛들(102)은, 데스크탑 컴퓨터들, 랩탑 컴퓨터들, PDA들(personal digital assistants), 태블릿 컴퓨터들, 스마트 폰들, 스마트 텔레비전들(예를 들어, 인터넷에 연결된 텔레비전들), 셋탑박스들, 게임 콘솔들, 보안 시스템들 (보안 카메라들을 포함), 차량 온보드 컴퓨터들, 네트워크 디바이스들(예를 들어, 라우터들, 스위치들, 모뎀들), IoT 디바이스들 등과 같은 컴퓨팅 디바이스들을 포함할 수 있다. 일부 실시예들에서, 원격 유닛들(102)은 스마트 시계들, 피트니스 밴드들, 광학 헤드 장착 디스플레이들 등과 같은 웨어러블 디바이스들을 포함한다. 또한, 원격 유닛들(102)은 가입자 유닛들, 모바일들, 모바일 스테이션들, 사용자들, 단말기들, 모바일 단말기들, 고정 단말기들, 가입자 스테이션들, UE, 사용자 단말기들, 또는 디바이스로 지칭될 수 있거나 또는 본 기술 분야에 사용되는 다른 용어에 의해 지칭될 수 있다. 원격 유닛들(102)은 UL 통신 신호들을 통해 하나 이상의 네트워크 유닛들(104)과 직접 통신할 수 있다. 다양한 실시예들에서, 원격 유닛들(102)은 하나 이상의 다른 원격 유닛들(102)과 직접 통신할 수 있다.
네트워크 유닛들(104)은 지리적 영역에 걸쳐 분산될 수 있다. 특정 실시예들에서, 네트워크 유닛(104)은 또한 액세스 포인트, 액세스 단말기, 베이스, 베이스 유닛, 기지국, 노드-B, eNB, gNB, 홈 노드-B, 중계 노드, 디바이스, 네트워크 디바이스, 또는 기반 구조 디바이스로 지칭될 수 있거나 또는 본 기술 분야에서 사용되는 임의의 다른 용어에 의해 지칭될 수도 있다. 네트워크 유닛들(104)은 일반적으로 하나 이상의 대응 네트워크 유닛들(104)에 통신 가능하게 연결된 하나 이상의 제어기들을 포함하는 무선 액세스 네트워크의 일부이다. 무선 액세스 네트워크는 일반적으로 다른 네트워크들 중에서 인터넷 및 공중 교환 전화 네트워크들과 같은 다른 네트워크들에 연결될 수 있는 하나 이상의 코어 네트워크들에 통신 가능하게 연결된다. 무선 액세스 및 코어 네트워크들의 이들 및 다른 요소들은 도시되지 않았지만 일반적으로 본 기술 분야의 기술자들에게는 잘 알려져 있다. 일부 실시예들에서, 네트워크 유닛(104)은 다음의 네트워크 컴포넌트들, 즉 eNB, gNB, AMF, DB, MME, PCF, UDR, UPF, 서빙 게이트웨이 및/또는 UDM 중의 하나 이상을 포함할 수 있다.
일 구현예에서, 무선 통신 시스템(100)은 3GPP 프로토콜의 LTE와 호환되며, 네트워크 유닛(104)은 DL 상에서 OFDM 변조 방식을 사용하여 송신하고, 원격 유닛들(102)은 UL 상에서 SC-FDMA 방식 또는 OFDM 방식을 사용하여 송신한다. 그러나, 보다 일반적으로, 무선 통신 시스템(100)은 다른 프로토콜들 중에서 몇몇 다른 개방형 또는 독점적인 통신 프로토콜, 예컨대, WiMAX를 구현할 수 있다. 본 개시 내용은 임의의 특정 무선 통신 시스템 아키텍처 또는 프로토콜의 구현에 한정되도록 의도되지는 않는다.
네트워크 유닛들(104)은 무선 통신 링크를 통해 서빙 영역, 예를 들어, 셀 또는 셀 섹터 내에서 다수의 원격 유닛들(102)을 서빙할 수 있다. 네트워크 유닛들(104)은 DL 통신 신호를 송신하여 시간, 주파수 및/또는 공간 도메인에서 원격 유닛들(102)을 서빙한다.
특정 실시예들에서, 원격 유닛(102)은 동기화 신호 블록을 수신할 수 있다. 다양한 실시예들에서, 원격 유닛(102)은 동기화 신호 블록의 1차 동기화 신호 및 브로드캐스트 채널을 검출할 수 있다. 일부 실시예들에서, 동기화 신호 블록을 수신하는 단계는, 시간 윈도우 내에서 다수의 동기화 신호 블록들 중 적어도 하나의 동기화 신호 블록을 수신하는 단계를 포함하며, 브로드캐스트 채널은 다수의 서브 대역들을 포함한다. 따라서, 원격 유닛(102)은 동기화 신호 블록을 수신하는 데 사용될 수 있다.
다양한 실시예들에서, 네트워크 유닛(104)은 1차 동기화 신호 및 브로드캐스트 채널을 포함하는 동기화 신호 블록을 결정할 수 있다. 다양한 실시예들에서, 네트워크 유닛(104)은 동기화 신호 블록을 송신할 수 있다. 특정 실시예들에서, 동기화 신호 블록을 송신하는 단계는 시간 윈도우 내에서 다수의 동기화 신호 블록들을 송신하는 단계를 포함하며, 브로드캐스트 채널은 다수의 서브 대역들을 포함한다. 따라서, 네트워크 유닛(104)은 동기화 신호 블록을 송신하는 데 사용될 수 있다.
도 2는 동기화 신호 블록을 수신하는 데 사용될 수 있는 장치(200)의 일 실시예를 도시한다. 장치(200)는 원격 유닛(102)의 일 실시예를 포함한다. 또한, 원격 유닛(102)은 프로세서(202), 메모리(204), 입력 디바이스(206), 디스플레이(208), 송신기(210), 및 수신기(212)를 포함할 수 있다. 일부 실시예들에서, 입력 디바이스(206) 및 디스플레이(208)는 터치 스크린과 같은 단일 디바이스로 조합된다. 특정 실시예들에서, 원격 유닛(102)은 임의의 입력 디바이스(206) 및/또는 디스플레이(208)를 포함하지 않을 수 있다. 다양한 실시예들에서, 원격 유닛(102)은 프로세서(202), 메모리(204), 송신기(210), 및 수신기(212) 중 하나 이상을 포함할 수 있으며, 입력 디바이스(206) 및/또는 디스플레이(208)를 포함하지 않을 수 있다.
프로세서(202)는, 일 실시예에서, 컴퓨터 판독가능 명령어들을 실행할 수 있고 그리고/또는 로직 동작들을 수행할 수 있는 임의의 공지된 제어기를 포함할 수 있다. 예를 들어, 프로세서(202)는 마이크로컨트롤러, 마이크로프로세서, 중앙 처리 유닛(CPU), 그래픽 처리 유닛(GPU), 보조 처리 유닛, 필드 프로그래머블 게이트 어레이(FPGA), 또는 유사한 프로그래머블 제어기일 수 있다. 일부 실시예들에서, 프로세서(202)는 메모리(204)에 저장된 명령어들을 실행하여 본원에 설명된 방법들 및 루틴들을 수행한다. 특정 실시예들에서, 상기 프로세서(202)는 동기화 신호 블록의 1차 동기화 신호 및 브로드캐스트 채널을 검출할 수 있다. 일부 실시예들에서, 브로드캐스트 채널은 적어도 하나의 서브 대역을 포함하며, 적어도 하나의 서브 대역은 자체 디코딩 가능 유닛을 운반한다. 프로세서(202)는 메모리(204), 입력 디바이스(206), 디스플레이(208), 송신기(210), 및 수신기(212)에 통신 가능하게 연결된다.
메모리(204)는, 일 실시예에서, 컴퓨터 판독가능 저장 매체이다. 일부 실시예들에서, 메모리(204)는 휘발성 컴퓨터 저장 매체를 포함한다. 예를 들어, 메모리(204)는 동적 RAM ("DRAM"), 동기식 동적 RAM ("SDRAM") 및/또는 정적 RAM ("SRAM")을 포함하는 RAM을 포함할 수 있다. 일부 실시예들에서, 메모리(204)는 비휘발성 컴퓨터 저장 매체를 포함한다. 예를 들어, 메모리(204)는 하드 디스크 드라이브, 플래시 메모리, 또는 임의의 다른 적절한 비휘발성 컴퓨터 저장 디바이스를 포함할 수 있다. 일부 실시예들에서, 메모리(204)는 휘발성 및 비휘발성 컴퓨터 저장 매체를 포함한다. 일부 실시예들에서, 메모리(204)는 동기화 신호 블록들에 관한 데이터를 저장한다. 일부 실시예들에서, 메모리(204)는 또한 원격 유닛(102) 상에서 동작하는 운영 체제 또는 다른 제어기 알고리즘들과 같은 프로그램 코드 및 관련 데이터를 저장한다.
입력 디바이스(206)는, 일 실시예에서, 터치 패널, 버튼, 키보드, 스타일러스, 마이크로폰 등을 포함하는 임의의 공지된 컴퓨터 입력 디바이스를 포함할 수 있다. 일부 실시예들에서, 입력 디바이스(206)는, 예를 들어, 터치 스크린 또는 유사한 터치 감지형 디스플레이로서 디스플레이(208)와 통합될 수 있다. 일부 실시예들에서, 입력 디바이스(206)는, 텍스트가 터치 스크린 상에 디스플레이된 가상 키보드를 사용하여 및/또는 터치 스크린 상에서의 필기(handwriting)에 의해 입력될 수 있도록 하는 터치 스크린을 포함한다. 일부 실시예들에서, 입력 디바이스(206)는 키보드 및 터치 패널과 같은 두 개 이상의 서로 다른 디바이스들을 포함한다.
디스플레이(208)는, 일 실시예에서, 임의의 공지된 전자 제어 가능한 디스플레이 또는 디스플레이 디바이스를 포함할 수 있다. 디스플레이(208)는 시각, 청각, 및/또는 햅틱 신호들을 출력하도록 설계될 수 있다. 일부 실시예들에서, 디스플레이(208)는 시각적 데이터를 사용자에게 출력할 수 있는 전자 디스플레이를 포함한다. 예를 들어, 디스플레이(208)는 LCD 디스플레이, LED 디스플레이, OLED 디스플레이, 프로젝터, 또는 이미지, 텍스트 등을 사용자에게 출력할 수 있는 유사한 디스플레이 디바이스를 포함할 수 있지만, 이에 한정되는 것은 아니다. 또 다른 비 한정적인 예로서, 디스플레이(208)는 스마트 시계, 스마트 안경, 헤드업 디스플레이 등과 같은 웨어러블 디스플레이를 포함할 수 있다. 또한, 디스플레이(208)는 스마트 폰, 개인 휴대 정보 단말기(PDA), 텔레비전, 테이블 컴퓨터, 노트북(랩탑) 컴퓨터, 퍼스널 컴퓨터, 차량 대시 보드 등의 컴포넌트일 수 있다.
특정 실시예들에서, 디스플레이(208)는 사운드를 생성하기 위한 하나 이상의 스피커들을 포함한다. 예를 들어, 디스플레이(208)는 가청 경보 또는 통지(예를 들어, 비프 또는 차임)를 생성할 수 있다. 일부 실시예들에서, 디스플레이(208)는 진동들, 움직임, 또는 다른 햅틱 피드백을 생성하기 위한 하나 이상의 햅틱 디바이스들을 포함한다. 일부 실시예들에서, 디스플레이(208)의 전부 또는 일부는 입력 디바이스(206)와 통합될 수 있다. 예를 들어, 입력 디바이스(206) 및 디스플레이(208)는 터치 스크린 또는 유사한 터치 감지형 디스플레이를 형성할 수 있다. 다른 실시예들에서, 디스플레이(208)는 입력 디바이스(206) 근처에 위치될 수 있다.
송신기(210)는 네트워크 유닛(104)에 UL 통신 신호를 제공하는 데 사용되고, 수신기(212)는 네트워크 유닛(104)으로부터 DL 통신 신호를 수신하는 데 사용된다. 일 실시예에서, 상기 수신기(212)는 동기화 신호 블록을 수신할 수 있다. 일부 실시예들에서, 동기화 신호 블록을 수신하는 수신기(212)는, 시간 윈도우 내에서 다수의 동기화 신호 블록들 중 적어도 하나의 동기화 신호 블록을 수신하는 수신기(212)를 포함하며, 브로드캐스트 채널은 다수의 서브 대역들을 포함한다. 일부 실시예들에서, 1차 동기화 신호, 적어도 하나의 2차 동기화 신호, 및 브로드캐스트 채널은 하나의 슬롯에서 송신된다. 특정 실시예들에서, 상기 방법은 동기화 신호 블록으로부터 슬롯 및 프레임 타이밍 정보를 결정하는 단계를 포함한다. 다양한 실시예들에서, 다수의 동기화 신호 블록들을 포함하는 시간 윈도우는 주기적으로 발생한다. 일부 실시예들에서, 시간 윈도우는 5ms 또는 10ms를 포함한다. 단 하나의 송신기(210) 및 하나의 수신기(212)가 도시되어 있지만, 원격 유닛(102)은 임의의 적절한 개수의 송신기들(210) 및 수신기들(212)을 가질 수 있다. 송신기(210) 및 수신기(212)는 임의의 적절한 타입의 송신기들 및 수신기들일 수 있다. 일 실시예에서, 송신기(210) 및 수신기(212)는 트랜시버의 일부일 수 있다.
도 3은 동기화 신호 블록을 송신하는 데 사용될 수 있는 장치(300)의 일 실시예를 도시한다. 장치(300)는 네트워크 유닛(104)의 일 실시예를 포함한다. 또한, 네트워크 유닛(104)은 프로세서(302), 메모리(304), 입력 디바이스(306), 디스플레이(308), 송신기(310), 및 수신기(312)를 포함할 수 있다. 이해될 수 있듯이, 프로세서(302), 메모리(304), 입력 디바이스(306), 디스플레이(308), 송신기(310), 및 수신기(312)는 각각 프로세서(202), 메모리(204), 입력 디바이스(206), 디스플레이(208), 송신기(210), 및 원격 유닛(102)의 수신기(212)와 실질적으로 유사할 수 있다.
다양한 실시예들에서, 프로세서(302)는 1차 동기화 신호 및 브로드캐스트 채널을 포함하는 동기화 신호 블록을 결정할 수 있다. 특정 실시예들에서, 송신기(310)는 동기화 신호 블록을 송신할 수 있다. 일부 실시예들에서, 동기화 신호 블록을 송신하는 송신기(310)는 시간 윈도우 내에서 다수의 동기화 신호 블록들을 송신하는 송신기(310)를 포함하며, 브로드캐스트 채널은 다수의 서브 대역들을 포함한다. 일부 실시예들에서, 1차 동기화 신호, 적어도 하나의 2차 동기화 신호, 및 브로드캐스트 채널은 하나의 슬롯에서 송신된다. 특정 실시예들에서, 슬롯 및 프레임 타이밍 정보는 동기화 신호 블록으로부터 결정된다. 다양한 실시예들에서, 다수의 동기화 신호 블록들을 포함하는 시간 윈도우는 주기적으로 발생한다. 일부 실시예들에서, 시간 윈도우는 5ms 또는 10ms를 포함한다. 다양한 실시예들에서, 브로드캐스트 채널은 적어도 하나의 서브 대역을 포함하며, 적어도 하나의 서브 대역은 자체 디코딩 가능 유닛을 운반한다. 단 하나의 송신기(310) 및 하나의 수신기(312)가 도시되어 있지만, 네트워크 유닛(104)은 임의의 적절한 개수의 송신기들(310) 및 수신기들(312)을 가질 수 있다. 송신기(310) 및 수신기(312)는 임의의 적절한 타입의 송신기들 및 수신기들일 수 있다. 일 실시예에서, 송신기(310) 및 수신기(312)는 트랜시버의 일부일 수 있다.
특정 실시예들에서, 다양한 네트워크들(예를 들어, 5G RAT)의 최소 채널 대역폭은 다른 네트워크들(예를 들어, LTE, 1.4 MHz)의 최소 채널 대역폭보다 클 수 있다. 다양한 실시예들에서, 특정 네트워크들(예를 들어, 5G RAT)의 SS 및/또는 PBCH의 송신 대역폭은 다른 네트워크들(예를 들어, LTE PSS 및/또는 SSS, 가드 서브 캐리어들을 포함하는 1.08MHz)의 송신 대역폭보다 더 클 수 있다. 일부 실시예들에서, 원격 유닛들(102)은 제한된 대역폭(예를 들어, 1.4MHz의 수신기 대역폭) 및/또는 광대역 대역폭(예를 들어, 1.4MHz보다 큰 수신기 대역폭)을 갖는 네트워크에서 동작할 수 있고, 제한된 대역폭 및 광대역 대역폭으로 동작하기 위한 공통 PBCH는 효율적인 무선 리소스 활용에 유리하다.
일부 실시예들에서, PSS 및/또는 SSS가 협폭 빔들로 송신될 때, 다수의 공간 방향들을 커버하기 위해 다수의 SS 블록들(이들 블록들의 각각은 빔 포밍된 PSS 및/또는 SSS를 운반함)이 송신될 수 있다. 일 실시예에서, 유휴 모드 원격 유닛(102)은 하나 이상의 SS 블록들(예를 들어, 최대 200 개의 SS 블록)을 포함하는 SS 버스트 세트가 80ms 주기로 송신된다는 것을 가정할 수 있고, 원격 유닛(102)은 원격 유닛(102)으로 향해 적절한 송신 빔들로 송신된 하나(또는 다수의) SS 블록을 검출할 수 있다. 이러한 실시예들에서, 200 개의 수직 및/또는 방위각 협폭 빔들이 하나의 섹터를 커버하는 것으로 간주될 수 있지만; TDD에서 동적인 UL 및/또는 DL 동작을 고려하여, 200 개의 SS 블록의 위치를 미리 결정하는 것이 어려울 수 있다. 다양한 실시예들에서, SS 블록들의 실제 수는 네트워크 구현예에 따라 변할 수 있다. 일부 실시예들에서, 네트워크 엔티티가 PSS 및/또는 SSS 송신을 위해 광폭 빔들을 사용하면, 네트워크 엔티티는 200 개의 SS 블록보다 작은 수의 SS 블록들을 송신할 수 있다. 이러한 실시예들에서, SS 블록 위치를 표시하기 위해 너무 많은 시그널링 오버헤드를 초래하지 않으면서 SS 블록들을 위치 확인하는(locate) 약간의 플렉시빌리티가 이용 가능할 수 있다. 다양한 실시예들에서, PBCH는 SS 블록들 내에서 송신될 수 있다.
특정 실시예들에서, PBCH는 1.08 MHz 대역폭의 6 개의 RB에서 송신될 수 있고, 채널 비트들의 하나의 자체 디코딩 가능 유닛이 4 개의 연속적인 OFDM 심볼 상에서 송신될 수 있다. 5G RAT의 동적 TDD 동작 및/또는 URLLC 서비스와 같은 일부 실시예들에서, 보다 긴 송신 지속시간은 미리 정의된 및/또는 알려진 위치들(예를 들어, PBCH) 상에서 송신되는 물리적 채널들용으로는 사용되지 않을 수 있는데, 그것은 UL 및/또는 DL 스위칭 플렉시빌리티를 제한할 수 있기 때문이다.
다양한 실시예들에서, PSS 및/또는 SSS는 5ms 주기마다 한번 씩 송신될 수 있고, 따라서 주기적으로 송신된 SS 버스트 세트 내에서 다수의 SS 블록들(예를 들어, 최대 200 개의 SS 블록)을 효율적으로 위치 확인하는 것이 어려울 수 있다.
일부 실시예들에서, 에너지 효율적인 네트워크 동작을 위해, 네트워크는 네트워크에서 "항시 온(always-on)" 신호를 최소화할 수 있다. 다양한 실시예들에서, NE는 하나 이상의 동기화 신호들 및 PBCH를 포함하는 SS 블록들의 주기성을 보다 큰 값으로 설정할 수 있다. 그러한 실시예들에서, 원격 유닛(102)은 시간상 SS 블록들의 NE의 스파스 송신(sparse transmission)인 경우에도 셀 네트워크를 신속하게 검출할 수 있다. 특정 실시예들에서, RRC 유휴 모드 원격 유닛들(102)의 경우, 원격 유닛들(102)은 각각 하나 이상의 SS 및 PBCH를 포함하는 하나 이상의 SS 블록들에 기초하여 셀 네트워크를 검출 및/또는 측정할 수 있다.
일부 실시예들에서, PSS 및/또는 SSS에 대한 송신 BW는 1 % 미만의 오 알람 레이트(false alarm rate)로 -6dB에서 수신된 기저 대역 SNR에서 양호한 원샷 검출 확률(one-shot detection probability)을 제공하도록 결정될 수 있다. 그러한 실시예들에서, 서브 캐리어 당 주어진 SNR 및 주어진 서브 캐리어 간격의 경우, PSS 및/또는 SSS에 대한 보다 큰 송신 BW (및 보다 많은 개수의 서브 캐리어들 및 보다 긴 PSS 및/또는 SSS 시퀀스)는 보다 큰 처리 이득을 제공할 수 있기 때문에 보다 양호한 검출 성능을 제공할 수 있다. 일부 실시예들에서, 길이-63 PSS 시퀀스들은 3dB SNR에서 1 % 손실된 검출 레이트를 달성할 수 있는 반면, 길이-251 Zadoff-Chu ("ZC") 시퀀스 기반 PSS는 1 % 손실된 검출 레이트에 대해 -4.5 dB SNR을 가질 수 있다. 일 실시예에서, PSS 및 15 KHz 서브 캐리어 간격의 서브 캐리어 매핑으로, PSS에 대한 송신 BW는 특정 SS 대역폭(예를 들어, 1.08 MHz, 6 개의 RB)보다 8 배 더 넓은 8.64 MHz (예를 들어, 1 개의 RB에서 12 개의 서브 캐리어를 가정할 때 48 개의 RB)로 설정될 수 있다. 그러한 실시예들에서, PSS 및 SSS 모두에 대해 동일한 송신 BW를 가정하면, 특정 SSS 시퀀스들은 다른 SSS보다 약 8 배 더 길 수 있으며, 이것은 원샷 검출 성능을 향상시키는 데 유익할 수 있다. 특정 실시예들에서, 전술한 특정 실시예들에서 사용된 것과 동일한 세트의 PSS 및/또는 SSS 시퀀스들을 6 GHz 초과의 주파수 범위에 적용하면, PSS 및/또는 SSS에 대한 송신 BW는 6 GHz 초과의 주파수 범위에서 120 KHz 서브 캐리어 간격과 함께 69.12 MHz일 수 있다.
도 4는 4 개의 심볼들에 의해 운반되는 광대역 PBCH(400)의 일 실시예를 나타낸다. 특히, 제1 송신(402)(예를 들어, PBCH 송신) 및 제2 송신(404)(예를 들어, PBCH 송신)이 도시된다. 제1 송신(402)은 SS 버스트 세트 주기성(408)의 일부인 제1 시간 간격(406)에서 송신될 수 있다. 일부 실시예들에서, 제1 시간 간격(406)은 대략 20 ms일 수 있지만; 다른 실시예들에서, 제1 시간 간격(406)은 상이한 시간 간격을 가질 수 있다. 다양한 실시예들에서, SS 버스트 세트 주기성(408)은 대략 80 ms일 수 있지만; 다른 실시예들에서, SS 버스트 세트 주기성(408)은 상이한 시간 간격을 가질 수 있다. 특정 실시예들에서, 제1 송신(402)은 제1 심볼(RV0)(410), 제2 심볼(RV1)(412), 제3 심볼(RV2)(414), 및 제4 심볼(RV3)(416)을 포함할 수 있다. 일부 실시예들에서, 제1 심볼(RV0)(410), 제2 심볼(RV1)(412), 제3 심볼(RV2)(414), 및 제4 심볼(RV3)(416)은 각각 대역폭(418)을 가질 수 있다. 다양한 실시예들에서, 대역폭(418)은 12 개의 RB일 수 있지만; 다른 실시예들에서, 대역폭(418)은 다른 수의 RB들을 가질 수 있다. 특정 실시예에서, 제1 심볼(RV0)(410) 및 제2 심볼(RV1)(412)(예를 들어, 제1 서브 대역)은 제1 송신(402)의 중심 주파수 부분에 위치되고, 제3 심볼(RV2)(414) 및 제4 심볼(RV3)(416)(예를 들어, 제2 서브 대역)은 중심 주파수 부분의 양측에 위치한다. 이러한 실시예들에서, 제1 서브 대역 및 제2 서브 대역은 실질적으로 동일한 크기일 수 있지만; 다른 실시예들에서, 제1 서브 대역 및 제2 서브 대역은 크기가 다를 수 있다. 일부 실시예들에서, 제1 서브 대역만이 원격 유닛(102)에 의해 수신 및/또는 디코딩될 수 있지만; 다른 실시예들에서, 제1 서브 대역 및 제2 서브 대역 모두가 원격 유닛(102)에 의해 수신 및/또는 디코딩될 수 있다. 다양한 실시예들에서, 제1 서브 대역 및 제2 서브 대역은 모두 자체 디코딩 가능 유닛들이다.
특정 실시예들에서, 제2 송신(404)은 제1 심볼(RV0)(410), 제2 심볼(RV1)(412), 제3 심볼(RV2)(414), 및 제4 심볼(RV3)(416)을 포함할 수 있다. 일부 실시예들에서, 제1 심볼(RV0)(410), 제2 심볼(RV1)(412), 제3 심볼(RV2)(414), 및 제4 심볼(RV3)(416)은 각각 대역폭(418)을 가질 수 있다. 특정 실시예들에서, 제3 심볼(RV2)(414) 및 제4 심볼(RV3)(416)(예를 들어, 제1 서브 대역)은 제2 송신(404)의 중심 주파수 부분에 위치되고, 제1 심볼(RV0)(410) 및 제2 심볼(RV1)(412)(예를 들어, 제2 서브 대역)은 중심 주파수 부분의 양측에 위치한다. 이러한 실시예들에서, 제1 서브 대역 및 제2 서브 대역은 실질적으로 동일한 크기일 수 있지만; 다른 실시예들에서, 제1 서브 대역 및 제2 서브 대역은 크기가 다를 수 있다. 일부 실시예들에서, 제1 서브 대역만이 원격 유닛(102)에 의해 수신 및/또는 디코딩될 수 있지만; 다른 실시예들에서, 제1 서브 대역 및 제2 서브 대역 모두가 원격 유닛(102)에 의해 수신 및/또는 디코딩될 수 있다. 다양한 실시예들에서, 제1 서브 대역 및 제2 서브 대역은 모두 자체 디코딩 가능 유닛들이다. 이해될 수 있듯이, 제1 송신(402)의 제1 서브 대역 및 제2 송신(404)의 제1 서브 대역을 수신하는 원격 유닛(102)은 제1 심볼(RV0)(410), 제2 심볼(RV1)(412), 제3 심볼(RV2)(414), 및 제4 심볼(RV3)(416)을 수신할 수 있다. 또한, 제1 송신(402)의 제1 및 제2 서브 대역과 제2 송신(404)의 제1 및 제2 서브 대역을 수신하는 원격 유닛(102)은 제1 심볼(RV0)(410), 제2 심볼(RV1)(412), 제3 심볼(RV2)(414), 및 제4 심볼(RV3)(416)을 수신할 수 있으며, 각각의 심볼은 상이한 시간 및 주파수 리소스들에서 2 회 수신된다.
도 5는 2 개의 심볼들에 의해 운반되는 광대역 PBCH(500)의 일 실시예를 나타낸다. 특히, 제1 송신(502)(예를 들어, PBCH 송신) 및 제2 송신(504)(예를 들어, PBCH 송신)이 도시된다. 제1 송신(502)은 SS 버스트 세트 주기성(508)의 일부인 제1 시간 간격(506)에서 송신될 수 있다. 일부 실시예들에서, 제1 시간 간격(506)은 대략 20 ms일 수 있지만; 다른 실시예들에서, 제1 시간 간격(506)은 상이한 시간 간격을 가질 수 있다. 다양한 실시예들에서, SS 버스트 세트 주기성(508)은 대략 80 ms일 수 있지만; 다른 실시예들에서, SS 버스트 세트 주기성(508)은 상이한 시간 간격을 가질 수 있다. 특정 실시예들에서, 제1 송신(502)은 제1 심볼(RV0)(510) 및 제2 심볼(RV1)(512)을 포함할 수 있다. 다양한 실시예들에서, 제2 송신(504)은 제3 심볼(RV2)(514) 및 제4 심볼(RV3)(516)을 포함할 수 있다. 일부 실시예들에서, 제1 심볼(RV0)(510), 제2 심볼(RV1)(512), 제3 심볼(RV2)(514), 및 제4 심볼(RV3)(516)은 각각 대역폭(518)을 가질 수 있다. 다양한 실시예들에서, 대역폭(518)은 24 개의 RB일 수 있지만; 다른 실시예들에서, 대역폭(518)은 다른 수의 RB들을 가질 수 있다. 특정 실시예들에서, 제1 심볼(RV0)(510)(예를 들어, 제1 서브 대역)은 제1 송신(502)의 중심 주파수 부분에 위치되고, 제2 심볼(RV1)(512)(예를 들어, 제2 서브 대역)은 중심 주파수 부분의 양측에 위치한다. 이러한 실시예들에서, 제1 서브 대역 및 제2 서브 대역은 실질적으로 동일한 크기일 수 있지만; 다른 실시예들에서, 제1 서브 대역 및 제2 서브 대역은 크기가 다를 수 있다. 일부 실시예들에서, 제1 서브 대역만이 원격 유닛(102)에 의해 수신 및/또는 디코딩될 수 있지만; 다른 실시예들에서, 제1 서브 대역 및 제2 서브 대역 모두가 원격 유닛(102)에 의해 수신 및/또는 디코딩될 수 있다. 다양한 실시예들에서, 제1 서브 대역 및 제2 서브 대역은 모두 자체 디코딩 가능 유닛들이다.
특정 실시예들에서, 제2 송신(504)은 제3 심볼(RV2)(514) 및 제4 심볼(RV3)(516)을 포함할 수 있다. 일부 실시예들에서, 제3 심볼(RV2)(514)(예를 들어, 제1 서브 대역)은 제2 송신(504)의 중심 주파수 부분에 위치되고, 제4 심볼(RV3)(516)(예를 들어, 제2 서브 대역)은 중심 주파수 부분의 양측에 위치한다. 이러한 실시예들에서, 제1 서브 대역 및 제2 서브 대역은 실질적으로 동일한 크기일 수 있지만; 다른 실시예들에서, 제1 서브 대역 및 제2 서브 대역은 크기가 다를 수 있다. 일부 실시예들에서, 제1 서브 대역만이 원격 유닛(102)에 의해 수신 및/또는 디코딩될 수 있지만; 다른 실시예들에서, 제1 서브 대역 및 제2 서브 대역 모두가 원격 유닛(102)에 의해 수신 및/또는 디코딩될 수 있다. 다양한 실시예들에서, 제1 서브 대역 및 제2 서브 대역은 모두 자체 디코딩 가능 유닛들이다. 이해될 수 있듯이, 제1 송신(502)의 제1 서브 대역 및 제2 송신(504)의 제1 서브 대역을 수신하는 원격 유닛(102)은 제1 심볼(RV0)(510) 및 제3 심볼(RV2)(514)을 수신할 수 있다. 또한, 제1 송신(502)의 제1 및 제2 서브 대역 및 제2 송신(504)의 제1 및 제2 서브 대역을 수신하는 원격 유닛(102)은 제1 심볼(RV0)(510), 제2 심볼(RV1)(512), 제3 심볼(RV2)(514), 및 제4 심볼(RV3)(516)을 수신할 수 있다.
일부 실시예들에서, PSS 및/또는 SSS와 유사하게, PBCH는 미리 정의된 서브 캐리어 간격 및 미리 정의된 송신 BW로 송신될 수 있고, PBCH 송신 BW는 SS 송신 BW와 동일할 수 있다. 다양한 실시예들에서, 광대역 PBCH 송신은 PBCH TTI 당 2 개의 OFDM 심볼(예를 들어, 도 5) 상에서 행해질 수 있고, 예를 들어, 6 GHz 미만의 주파수 범위에 대해서는 8.64 MHz PBCH BW 및 6 GHz 초과의 주파수 범위에 대해서는 69.12 MHz PBCH BW와 같은 48 RB PBCH BW일 수 있고, LTE PBCH(예를 들어, 6 RB PBCH BW, 프레임 당 4 개의 OFDM 심볼, 4 프레임 TTI)와 유사한 코딩 레이트를 달성할 수 있다. 2 개의 PBCH OFDM 심볼이 도 5에 도시된 바와 같이 서로 다른 프레임 상에서 송신되면, 시간 다이버시티가 달성될 수 있다. 또한, 광대역 송신은 주파수 다이버시티를 이용할 수 있으며, 짧은 PBCH 송신 지속시간은 PBCH가 미리 정의된 시간 인스턴스에서 송신되는 경우에도 플렉시블한 UL 및/또는 DL TDD 동작을 가능하게 할 수 있다.
일 실시예에서, PBCH는 미리 정의된 시간(예를 들어, 프레임, 슬롯, 서브 프레임, 및/또는 OFDM 심볼들) 및 주파수 무선 리소스들에서 송신될 수 있다. 일부 실시예들에서, 원격 유닛(102)이 SS 블록을 검출하고 검출된 SS 블록으로부터 심볼, 슬롯, 및/또는 프레임 타이밍 정보를 획득하면, 원격 유닛(102)은 획득된 타이밍 정보에 기초하여 PBCH를 위치 확인 및/또는 수신할 수 있다. 그러한 실시예들에서, 이것은 PBCH 송신이 SS보다 시간적으로 더 희소하게 행해질 수 있게 한다. 특정 실시예들에서, PBCH의 페이로드는 슬롯 및/또는 프레임 타이밍 관련 정보(예를 들어, 심볼 인덱스 및/ 또는 슬롯 인덱스)를 포함할 수 있다. 그러한 실시예들에서, 원격 유닛(102)은 슬롯 및/또는 프레임 타이밍 정보를 획득하기 위해, 상기 검출된 SS 블록으로부터 심볼 타이밍 정보를 획득하고 상기 획득된 심볼 타이밍에 기초하여 PBCH를 디코딩할 수 있다.
일 실시예에서, 광대역 PBCH는 동일하거나 서로 다른 크기를 갖는 2 개의 서브 대역 및 각 서브 대역 상에서 송신되는 코딩된 및/또는 레이트 매칭된 PBCH 채널들 비트들의 하나 이상의 자체 디코딩 가능 세그멘테이션 유닛을 포함한다. 예를 들어, 도 4는 4 개의 심볼 PBCH를 나타내고, 도 5는 2 개의 심볼 PBCH를 나타낸다. 일부 실시예들에서, 2 개의 서브 대역들 간의 몇 개의 서브 캐리어들은 가드 서브 캐리어들로서 예약된다. 다양한 실시예들에서, 보다 작은 대역폭(예를 들어, 24 개의 RB), 협폭의 대역폭(예를 들어, 24 개의 RB), 및/또는 대역 제한된 대역폭(예를 들어, 24 개의 RB)으로 동작하는 원격 유닛(102)의 경우, 원격 유닛(102)은 광대역 PBCH의 중앙 서브 대역만을 수신할 수 있고, 중앙 서브 대역 상에서 송신된 리던던시 버전들("RVs")의 디코딩을 수행할 수 있다. 가령, 도 5에 도시된 2 개의 심볼 PBCH를 갖는 특정 실시예들에서, 협대역 원격 유닛(102)은 PBCH 디코딩을 위해 RV0 (510) 및 RV2 (514) 채널 비트들을 조합할 수 있다. 그러한 실시예들에서, 제한된 대역폭 성능을 갖는 원격 유닛들(102) 및/또는 절전 모드의 원격 유닛들(102)에 대해서는 협대역 동작이 발생할 수 있다. 가령, 절전 원격 유닛(102)에 대한 일부 실시예들에서, 원격 유닛(102)이 10MHz 대역폭으로 초기 액세스를 수행한 후에 원격 유닛(102)의 동작 대역폭은 5MHz로 감소될 수 있다. 또 다른 실시예에서, 레이트 매칭된 PBCH 채널 코딩된 비트들을 서브 대역의 RE들에 맵핑하는 것, PBCH 채널 코딩된 비트들의 부분을 서브 대역의 RE들에 맵핑하는 것, 및/또는 하나 이상의 레이트 매칭된 PBCH 채널 코딩된 비트들을 (캐리어 상의 PBCH 송신의 중심 주파수 부분에 대응할 수 있는 동기화 래스터 위치를 중심으로 대략 대칭적으로 위치하는) 서브 대역의 RE들의 부분에 매핑하는 것은 PBCH 송신 대역폭에 대해 불변일 수 있다. 특정 실시예들에서, 서브 대역 주위의 몇 개의 서브 캐리어들은 가드 서브 캐리어들로서 예약된다. 이러한 실시예들에서, 이는 협폭의 대역폭이 가능한 원격 유닛(102), 대역 제한이 가능 원격 유닛(102), 및/또는 협폭의 대역폭으로 동작하는 원격 유닛(102)이 협폭의 대역폭에서 PBCH를 수신할 수 있게 하고, 및/또는 다수의 PBCH 송신 대역폭들에 대한 서로 다른 PBCH RE 매핑없이도 다수의 PBCH 심볼들 상에서 수신된 PBCH RE들을 조합할 수 있게 할 수 있다.
다양한 실시예들에서, PBCH 주기성 및 빔 포밍으로부터 PSS 및/또는 SSS 주기성 및 빔 포밍을 분리하기 위해, PBCH에 대한 DMRS로서 PSS 및/또는 SSS를 사용하는 대신, PBCH DMRS가 PBCH 데이터와 함께 송신될 수 있다. 일 실시예에서, 하나의 송신 빔이 하나의 PSS 및/또는 SSS 인스턴스용으로 사용되고, 48 개의 PSS 및/또는 SSS 인스턴스가 80ms의 SS 주기 내에 존재하지만, 48 개의 송신 빔이 빔 순환을 통해 하나의 광대역 PBCH 심볼 상에서 사용될 수 있고, 4 개의 PBCH 심볼은 80ms TTI 내에 존재할 수 있다. 가령, 도 4의 4 개의 심볼 광대역 PBCH에 대한 일부 실시예들에서, PBCH의 DMRS는 도 6에 도시된 바와 같이 주파수 도메인에서 PBCH 데이터와 다중화될 수 있다.
구체적으로, 도 6은 DMRS 다중화(600)의 일 실시예를 나타낸다. 도 6은 시간 주기(606)(예를 들어, 2 개의 OFDM 심볼 지속시간) 동안 대역폭(604)(예를 들어, 1 RB)에 걸쳐 있는 2 개의 인접한 OFDM 심볼들(602)을 도시한다. 대역폭으로 인해, OFDM 심볼들(602) 중 일부는 DMRS를 운반하는 데 사용된다. 특히, OFDM 서브 캐리어들(608)은 DMRS를 운반하는 데 사용된다. DMRS는 2 개의 연속적인 OFDM 심볼들(602)의 동일한 서브 캐리어들 상에서 송신될 수 있기 때문에, 원격 유닛(102)은 2 개의 OFDM 심볼들(602)의 동일한 DMRS 서브 캐리어들 상에서 DMRS의 위상 회전을 비교함으로써 주파수 도메인 주파수 오프셋 추정 및/또는 보상을 수행할 수 있다.
도 7은 대역폭(704) 동안 슬롯(702)에서의 송신들(700)의 일 실시예를 도시한다. 특히, 슬롯(702)은 PBCH(706), PSS(708), SSS(710), C-PDCCH(712), 및 데이터(714)를 포함할 수 있다. 특정 실시예들에서, PBCH(706), PSS(708), SSS(710)(예를 들어, 하나 이상의 SSS를 포함함), 및 C-PDCCH(712)는 하나의 SS 블록의 일부일 수 있다. 도시된 실시예에서, PBCH(706)는 서브 대역폭(716)(예를 들어, 12 개의 RB)을 통해 송신된다. 또한, PSS(708) 및 SSS(710)는 제1 제어 리소스 세트(718), 제2 제어 리소스 세트(720), 및 제3 제어 리소스 세트(722)로부터 일부 RE들을 점유한다.
일 실시예에서, 원격 유닛(102)은 NE가 SS 블록 송신 윈도우 내에서 SS 블록들을 송신한다고 가정할 수 있다. 이러한 실시예에서, SS 블록 송신 윈도우는 SS 버스트 세트 주기 내에 하나 이상의 슬롯들을 포함할 수 있다. 또한, 특정 실시예들에서, PSS(708), SSS(710)(예를 들어, 하나 이상의 SSS, 3차 동기화 채널 "TSCH" 등), 및 PBCH(706)를 포함하는 SS 블록은 SS 블록 송신 윈도우 내의 슬롯(702)의 DL 제어 영역에서 송신될 수 있다. 다양한 실시예들에서, 최대 하나의 SS 블록이 주어진 슬롯에서 송신될 수 있다. 일부 실시예들에서, SS 블록 송신 윈도우의 정의는 SS 블록 위치를 표시하기 위한 시그널링 오버헤드를 제한하는 것을 가능하게 할 수 있다. 그러나, 특정 실시예들에서, 네트워크는 UL 및/또는 DL 트래픽에 대한 스케줄링 필요에 따라 SS 블록 송신 윈도우 내의 임의의 슬롯에서 SS 블록을 위치 확인할 수 있다. 다양한 실시예들에서, 네트워크가 UL 우세 트래픽을 서빙하는 경우에도, 네트워크는 모든 슬롯에서 구성될 수 있는 DL 제어 영역을 이용함으로써 시간 윈도우 내에서 SS 블록을 여전히 송신할 수 있다.
일 실시예에서, DL 제어 영역은 슬롯(702)의 전방 부분에 위치하고, PBCH(706), PSS(708), SSS(710), 및 C-PDCCH(712)는 도 7에 도시된 바와 같이 시간 도메인 다중화된다. 또 다른 실시예에서, DL 제어 영역은 슬롯(702)의 후방 부분(예를 들어, 도 7에서 데이터(714)가 도시된 곳)에 위치하며, PBCH(706), PSS(708), SSS(710), 및 C-PDCCH(712)는 슬롯(702)의 상기 후방 부분에서 시간 도메인 다중화된다. 특정 실시예들에서, PBCH(706)는 하나 또는 두개의 PBCH 심볼을 포함할 수 있다. 다양한 실시예들에서, PBCH(706)는 도시된 바와 같이 DL 제어 영역에서 PSS(708)에 앞서 진행될 수 있지만; 다른 실시예들에서, PBCH(706)는 DL 제어 영역에서 SSS(710)에 후속되거나 PSS(708)와 SSS(710) 사이에 위치할 수 있다.
도 8은 SS 블록 송신들(800)의 일 실시예를 나타낸다. SS 블록 송신들(800)은 제1 그룹의 SS 블록들(802) 및 제2 그룹의 SS 블록들(803)을 포함한다. 제1 그룹의 SS 블록들(802) 및 제2 그룹의 SS 블록들(803)의 각각은 (A로 표시되고 PSS 및 하나 이상의 SSS를 포함하는) 하나의 타입의 SS 블록 및 (B로 표시되고 PSS, 하나 이상의 SSS, 및 PBCH를 포함하는) 다른 타입의 SS 블록을 포함한다. 제1 그룹의 SS 블록들(802)은 송신 시간(804)(예를 들어, 20 ms)을 통해 송신된다. 또한, 제1 그룹의 SS 블록들(802) 및 제2 그룹의 SS 블록들(803)은 모두 SS 블록 송신 윈도우(806)(예를 들어, 40 ms) 내에서 송신된다. 또한, SS 버스트 세트 주기성(808)(예를 들어, 80ms의 디폴트)이 도시된다.
일부 실시예들에서, 최대 200 개의 SS 블록들이 SS 버스트 세트 주기성(808) 내에서 송신될 수 있다. 특정 실시예들에서, 네트워크가 6GHz 초과의 주파수 범위에서 120kHz의 디폴트 서브 캐리어 간격으로 배치되는 경우, 슬롯 지속 시간은 0.125ms일 수 있고, 10ms 지속 기간의 무선 프레임 당 80 개의 슬롯이 이용 가능할 수 있다. 이러한 실시예들에서, 잠재적으로 최대 200 개의 SS 블록들의 송신을 위해 360 개의 슬롯들이 이용 가능할 수 있다. 다양한 실시예들에서, 80ms TTI의 PBCH는 80ms SS 버스트 세트 주기성(808) 내에서 제1 그룹의 SS 블록들(802) 중의 하나의 SS 블록 및 제2 그룹의 SS 블록들(803) 중의 하나의 SS 블록 상에서 송신된다. 이러한 실시예들에서, PBCH를 운반하는 제1 및 제2 그룹의 SS 블록들(802 및 803)은 nf mod 8 = 0 및 nf mod 8 = 2를 수행하는 무선 프레임들 nf의 슬롯 0에서 송신된다. 이러한 실시예들에서 PBCH TTI는 80 ms이기 때문에, PBCH의 페이로드는 SFN이 0에서 1023까지 변하는 시스템 프레임 번호(SFN)를 나타내는 7 개의 비트를 운반할 수 있다. 특정 실시예들에서, 원격 유닛(102)은 먼저, 검출된 SS 블록의 일부를 디코딩함으로써 80ms PBCH TTI 내에서 무선 프레임 인덱스를 결정할 수 있다. 검출된 SS 블록의 일부는 40ms SS 블록 송신 윈도우(806) 내에서 (예를 들어, 4 가지 가능성을 갖는) 무선 프레임 인덱스를 나타내는 2 개의 비트, 무선 프레임 내에서 (예를 들어, 80 가지 가능성을 갖는) 슬롯 인덱스를 나타내는 7 개의 비트, 및 순환 리던던시 체크 (Cyclic Redundancy Check)(“CRC”) 비트를 포함할 수 있다. 이러한 실시예들에서, 원격 유닛(102)은 PSS 및/또는 SSS를 검출하고, SS 블록의 일부를 디코딩하고, SS 블록의 디코딩된 부분으로부터 슬롯 및/또는 프레임 타이밍 정보를 식별하고, 그리고 SS 블록으로부터 PBCH를 디코딩할 수 있다.
일부 실시예들에서, NE는 C-PDCCH를 통해 SS 블록 송신 윈도우(806)의 슬롯이 SS 블록을 운반하는지의 여부를 나타낼 수 있어서, 슬롯의 DL 제어 영역을 모니터링하는 원격 유닛(102)은, SS 블록이 상기 PDCCH 및/또는 PDSCH 영역의 일부에 매핑되는 경우, PDSCH에 이용 가능한 가용 제어 채널 요소들 및/또는 RE들을 적절히 식별할 수 있다. 특정 실시예들에서, 원격 유닛(102)이 SS 블록 송신 윈도우(806) 내의 슬롯을 모니터링하는 것에 응답하여, 원격 유닛(102)은 먼저 C-PDCCH를 수신 및 디코딩할 수 있고, 그 후 SS 블록이 상기 슬롯의 DL 제어 영역(또는 상기 슬롯 내의 임의의 위치)에서 송신되는지를 결정할 수 있다. 다양한 실시예들에서, PSS 및/또는 SSS 송신용으로 사용되는 리소스 요소들을 배제하는 슬롯의 제어 채널 요소들이 결정될 수 있다. PSS 및/또는 SSS 송신이 PDSCH 영역의 일부에 매핑되는 일 실시예에서, PSS 및/또는 SSS 송신용으로 사용되는 PDSCH 리소스 요소들을 배제하는 PDSCH에 이용 가능한 RE들이 결정될 수 있다. 일부 실시예들에서, C-PDCCH는 슬롯의 제1 DL OFDM 심볼에서 송신될 수 있고, C-PDCCH 송신의 일 예가 도 7에 도시된다. 다양한 실시예들에서, 네트워크는, 잠재적인 제어 채널 리소스 결함 및/또는 제어 채널 차단 문제를 피하기 위해, SS 블록 송신 윈도우(806)에 대응하는 슬롯들에 대한 보다 큰 DL 제어 영역을 구성한다.
도 9는 동기화 신호 블록을 수신하기 위한 방법(900)의 일 실시예를 나타내는 개략적인 흐름도이다. 일부 실시예들에서, 방법(900)은 원격 유닛(102)과 같은 장치에 의해 수행된다. 특정 실시예들에서, 방법(900)은, 예를 들어, 마이크로컨트롤러, 마이크로프로세서, CPU, GPU, 보조 처리 유닛, FPGA 등과 같이 프로그램 코드를 실행하는 프로세서에 의해 수행될 수 있다.
방법(900)은 동기화 신호 블록을 수신하는 단계(902)를 포함할 수 있다. 다양한 실시예들에서, 상기 방법(900)은 동기화 신호 블록의 1차 동기화 신호 및 브로드캐스트 채널을 검출하는 단계(904)를 포함한다. 일부 실시예들에서, 동기화 신호 블록을 수신하는 단계는, 시간 윈도우 내에서 다수의 동기화 신호 블록들 중 적어도 하나의 동기화 신호 블록을 수신하는 단계(906)를 포함하며, 브로드캐스트 채널은 다수의 서브 대역들을 포함한다.
특정 실시예들에서, 다수의 서브 대역들 중 적어도 하나의 서브 대역은 자체 디코딩 가능 유닛을 운반한다. 일 실시예에서, 상기 방법(900)은 동기화 신호 블록의 적어도 하나의 2차 동기화 신호를 검출하는 단계를 포함한다. 추가의 실시예에서, 다수의 서브 대역들 중의 각각의 서브 대역은 적어도 하나의 자체 디코딩 가능 유닛을 운반한다. 특정 실시예들에서, 다수의 서브 대역들 중의 제1 서브 대역은 다수의 서브 대역들 중의 제2 서브 대역과 동일한 크기이다. 다양한 실시예들에서, 다수의 서브 대역들 중의 제1 서브 대역은 다수의 서브 대역들 중의 제2 서브 대역과는 상이한 크기이다. 일부 실시예들에서, 다수의 서브 대역들 중의 제1 서브 대역은 브로드캐스트 채널의 중앙부에 위치하고, 다수의 서브 대역들 중의 제2 서브 대역은 중앙부의 양측에 위치한다. 특정 실시예들에서, 상기 방법(900)은 제1 서브 대역만을 수신하고 제1 서브 대역 상에서 송신된 채널 비트들을 디코딩하는 단계를 포함한다.
다양한 실시예들에서, 적어도 하나의 자체 디코딩 가능 유닛은 코딩된 및 레이트 매칭된 채널 비트들을 포함한다. 일부 실시예들에서, 1차 동기화 신호, 적어도 하나의 2차 동기화 신호, 및 브로드캐스트 채널은 하나의 슬롯에서 송신된다. 특정 실시예들에서, 상기 방법(900)은 동기화 신호 블록으로부터 슬롯 및 프레임 타이밍 정보를 결정하는 단계를 포함한다. 다양한 실시예들에서, 다수의 동기화 신호 블록들을 포함하는 시간 윈도우는 주기적으로 발생한다. 일부 실시예들에서, 시간 윈도우는 5ms 또는 10ms를 포함한다. 특정 실시예들에서, 브로드캐스트 채널은 시스템 프레임 번호를 운반한다. 다양한 실시예들에서, 브로드캐스트 채널은 슬롯 및 프레임 타이밍 관련 정보를 운반한다.
일부 실시예들에서, 상기 방법(900)은, 제1 슬롯에서 공통 제어 채널을 수신하는 단계; 공통 제어 채널에 기초하여 제1 슬롯의 다운링크 영역에서 동기화 신호 블록이 송신되는지를 결정하는 단계; 및 제1 슬롯의 다운링크 영역에서 물리적 다운링크 공유 채널 또는 물리적 다운링크 제어 채널에 대한 가용 다운링크 리소스 요소들을 식별하는 단계를 포함한다. 특정 실시예들에서, 제1 슬롯은 동기화 신호 블록 송신 윈도우 내에 있고, 동기화 신호 블록 송신 윈도우는 동기화 신호 블록들을 송신하기 위한 적어도 하나의 슬롯을 포함한다. 다양한 실시예들에서, 제1 슬롯의 다운링크 제어 영역의 크기는 제2 슬롯의 다운링크 제어 영역의 크기와는 상이하고, 제2 슬롯은 동기화 신호 블록 송신 윈도우 내에 있지 않다.
도 10은 동기화 신호 블록을 송신하기 위한 방법(1000)의 일 실시예를 나타내는 개략적인 흐름도이다. 일부 실시예들에서, 방법(1000)은 네트워크 유닛(104)과 같은 장치에 의해 수행된다. 특정 실시예들에서, 방법(1000)은, 예를 들어, 마이크로컨트롤러, 마이크로프로세서, CPU, GPU, 보조 처리 유닛, FPGA 등과 같이 프로그램 코드를 실행하는 프로세서에 의해 수행될 수 있다.
방법(1000)은 1차 동기화 신호 및 브로드캐스트 채널을 포함하는 동기화 신호 블록을 결정하는 단계(1002)를 포함할 수 있다. 다양한 실시예들에서, 상기 방법(1000)은 동기화 신호 블록을 송신하는 단계(1004)를 포함한다. 특정 실시예들에서, 동기화 신호 블록을 송신하는 단계는 시간 윈도우 내에서 다수의 동기화 신호 블록들을 송신하는 단계(1006)를 포함하며, 브로드캐스트 채널은 다수의 서브 대역들을 포함한다.
특정 실시예들에서, 다수의 서브 대역들 중 적어도 하나의 서브 대역은 자체 디코딩 가능 유닛을 운반한다. 일 실시예에서, 상기 방법(1000)은 동기화 신호 블록의 적어도 하나의 2차 동기화 신호를 결정하는 단계를 포함한다. 추가의 실시예에서, 다수의 서브 대역들 중의 각각의 서브 대역은 적어도 하나의 자체 디코딩 가능 유닛을 운반한다. 특정 실시예들에서, 다수의 서브 대역들 중의 제1 서브 대역은 다수의 서브 대역들 중의 제2 서브 대역과 동일한 크기이다. 다양한 실시예들에서, 다수의 서브 대역들 중의 제1 서브 대역은 다수의 서브 대역들 중의 제2 서브 대역과는 상이한 크기이다. 일부 실시예들에서, 다수의 서브 대역들 중의 제1 서브 대역은 브로드캐스트 채널의 중앙부에 위치하고, 다수의 서브 대역들 중의 제2 서브 대역은 중앙부의 양측에 위치한다.
다양한 실시예들에서, 적어도 하나의 자체 디코딩 가능 유닛은 코딩된 및 레이트 매칭된 채널 비트들을 포함한다. 일부 실시예들에서, 1차 동기화 신호, 적어도 하나의 2차 동기화 신호, 및 브로드캐스트 채널은 하나의 슬롯에서 송신된다. 특정 실시예들에서, 슬롯 및 프레임 타이밍 정보는 동기화 신호 블록으로부터 결정된다. 다양한 실시예들에서, 다수의 동기화 신호 블록들을 포함하는 시간 윈도우는 주기적으로 발생한다. 일부 실시예들에서, 시간 윈도우는 5ms 또는 10ms를 포함한다. 특정 실시예들에서, 브로드캐스트 채널은 시스템 프레임 번호를 운반한다. 다양한 실시예들에서, 브로드캐스트 채널은 슬롯 및 프레임 타이밍 관련 정보를 운반한다.
일부 실시예들에서, 상기 방법(1000)은 제1 슬롯에서 공통 제어 채널을 송신하는 단계를 포함한다. 특정 실시예들에서, 제1 슬롯은 동기화 신호 블록 송신 윈도우 내에 있고, 동기화 신호 블록 송신 윈도우는 동기화 신호 블록들을 송신하기 위한 적어도 하나의 슬롯을 포함한다. 다양한 실시예들에서, 제1 슬롯의 다운링크 제어 영역의 크기는 제2 슬롯의 다운링크 제어 영역의 크기와는 상이하고, 제2 슬롯은 동기화 신호 블록 송신 윈도우 내에 있지 않다.
실시예들은 다른 특정 형태로 실시될 수 있다. 설명된 실시예들은 모든 면에서 예시적인 것에 불과하며 제한적이지 않은 것으로 간주될 것이다. 그러므로, 본 발명의 범위는 전술한 설명보다는 첨부된 청구 범위에 의해 표시된다. 청구 범위와 균등한 의미 및 범위 내에 있는 모든 변경들은 그 범위 내에 포함되어야 한다.

Claims (24)

  1. 방법으로서,
    동기화 신호 블록을 수신하는 단계; 및
    상기 동기화 신호 블록의 1차 동기화 신호 및 브로드캐스트 채널을 검출하는 단계
    를 포함하고;
    상기 동기화 신호 블록을 수신하는 단계는 시간 윈도우 내에서 복수의 동기화 신호 블록들 중 적어도 하나의 동기화 신호 블록을 수신하는 단계를 포함하며, 상기 브로드캐스트 채널은 복수의 서브 대역들을 포함하는 방법.
  2. 제1항에 있어서,
    상기 동기화 신호 블록의 적어도 하나의 2차 동기화 신호를 검출하는 단계를 추가로 포함하는 방법.
  3. 제1항에 있어서, 상기 복수의 서브 대역들 중의 각각의 서브 대역은 적어도 하나의 자체 디코딩 가능 유닛(self-decodable unit)을 운반하는 방법.
  4. 제1항에 있어서, 상기 복수의 서브 대역들 중의 제1 서브 대역은 상기 복수의 서브 대역들 중의 제2 서브 대역과 동일한 크기인 방법.
  5. 제1항에 있어서, 상기 복수의 서브 대역들 중의 제1 서브 대역은 상기 복수의 서브 대역들 중의 제2 서브 대역과는 상이한 크기인 방법.
  6. 제1항에 있어서, 상기 복수의 서브 대역들 중의 제1 서브 대역은 상기 브로드캐스트 채널의 중앙부에 위치하고, 상기 복수의 서브 대역들 중의 제2 서브 대역은 상기 중앙부의 양측에 위치하는 방법.
  7. 제6항에 있어서,
    상기 제1 서브 대역만을 수신하고 상기 제1 서브 대역 상에서 송신된 채널 비트들을 디코딩하는 단계를 추가로 포함하는 방법.
  8. 제3항에 있어서, 상기 적어도 하나의 자체 디코딩 가능 유닛은 코딩된 및 레이트 매칭된 채널 비트들을 포함하는 방법.
  9. 제1항에 있어서, 상기 1차 동기화 신호, 적어도 하나의 2차 동기화 신호, 및 상기 브로드캐스트 채널은 하나의 슬롯에서 송신되는 방법.
  10. 제1항에 있어서,
    상기 동기화 신호 블록으로부터 슬롯 및 프레임 타이밍 정보를 결정하는 단계를 추가로 포함하는 방법.
  11. 제1항에 있어서, 상기 복수의 동기화 신호 블록들을 포함하는 상기 시간 윈도우는 주기적으로 발생하는 방법.
  12. 제1항에 있어서, 상기 시간 윈도우는 5 ms 또는 10 ms를 포함하는 방법.
  13. 제1항에 있어서, 상기 브로드캐스트 채널은 시스템 프레임 번호를 운반하는 방법.
  14. 제1항에 있어서, 상기 브로드캐스트 채널은 슬롯 및 프레임 타이밍 관련 정보를 운반하는 방법.
  15. 제1항에 있어서,
    제1 슬롯에서 공통 제어 채널을 수신하는 단계;
    상기 공통 제어 채널에 기초하여 상기 제1 슬롯의 다운링크 영역에서 동기화 신호 블록이 송신되는지를 결정하는 단계; 및
    상기 제1 슬롯의 다운링크 영역에서 물리적 다운링크 공유 채널 또는 물리적 다운링크 제어 채널에 대한 가용 다운링크 리소스 요소들을 식별하는 단계
    를 추가로 포함하는 방법.
  16. 제15항에 있어서, 상기 제1 슬롯은 동기화 신호 블록 송신 윈도우 내에 있고, 상기 동기화 신호 블록 송신 윈도우는 동기화 신호 블록들을 송신하기 위한 적어도 하나의 슬롯을 포함하는 방법.
  17. 제16항에 있어서, 상기 제1 슬롯의 다운링크 제어 영역의 크기는 제2 슬롯의 다운링크 제어 영역의 크기와는 상이하고, 상기 제2 슬롯은 상기 동기화 신호 블록 송신 윈도우 내에 있지 않는 방법.
  18. 장치로서,
    동기화 신호 블록을 수신하는 수신기; 및
    상기 동기화 신호 블록의 1차 동기화 신호 및 브로드캐스트 채널을 검출하는 프로세서
    를 포함하고;
    상기 동기화 신호 블록을 수신하는 것은 시간 윈도우 내에서 복수의 동기화 신호 블록들 중 적어도 하나의 동기화 신호 블록의 수신하는 것을 포함하며, 상기 브로드캐스트 채널은 복수의 서브 대역들을 포함하는 장치.
  19. 제18항에 있어서, 상기 복수의 서브 대역들 중의 각각의 서브 대역은 적어도 하나의 자체 디코딩 가능 유닛을 운반하는 장치.
  20. 방법으로서,
    1차 동기화 신호 및 브로드캐스트 채널을 포함하는 동기화 신호 블록을 결정하는 단계; 및
    상기 동기화 신호 블록을 송신하는 단계
    를 포함하고;
    상기 동기화 신호 블록을 송신하는 단계는 시간 윈도우 내에서 복수의 동기화 신호 블록들을 송신하는 단계를 포함하며, 상기 브로드캐스트 채널은 복수의 서브 대역들을 포함하는 방법.
  21. 제20항에 있어서, 상기 1차 동기화 신호, 적어도 하나의 2차 동기화 신호, 및 상기 브로드캐스트 채널은 하나의 슬롯에서 송신되는 방법.
  22. 장치로서,
    1차 동기화 신호 및 브로드캐스트 채널을 포함하는 동기화 신호 블록을 결정하는 프로세서; 및
    상기 동기화 신호 블록을 송신하는 송신기
    를 포함하고;
    상기 동기화 신호 블록을 송신하는 송신기는 시간 윈도우 내에서 복수의 동기화 신호 블록들을 송신하는 송신기를 포함하며, 상기 브로드캐스트 채널은 복수의 서브 대역들을 포함하는 장치.
  23. 제22항에 있어서, 상기 복수의 동기화 신호 블록들을 포함하는 상기 시간 윈도우는 주기적으로 발생하는 장치.
  24. 제22항에 있어서, 상기 시간 윈도우는 5 ms 또는 10 ms를 포함하는 장치.
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