KR20160046003A - 표시 기판 및 이를 포함하는 표시 패널 - Google Patents

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KR20160046003A
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Abstract

본 발명은 박막 트랜지스터의 게이트 전극과 스토리지 라인 사이에 형성되는 전계로 인하여 화소의 가장자리에서 발생되는 휘선 불량을 방지하여 표시 품질을 향상시킬 수 있는 표시 기판 및 이를 포함하는 표시 패널을 제공한다. 본 발명의 표시 기판은, 제1기판; 상기 제1기판 상에 배치되는 게이트 라인; 상기 게이트 라인과 교차 배열되는 데이터 라인; 상기 게이트 라인 및 상기 데이터 라인의 교차영역에 배치되는 박막 트랜지스터; 상기 박막 트랜지스터와 전기적으로 연결되는 화소 전극; 상기 게이트 라인과 평행하게 이격되는 제1스토리지 라인; 및 상기 제1스토리지 라인에서 수직하게 연장되는 제2스토리지 라인을 포함하고, 상기 박막 트랜지스터는 상기 게이트 라인과 연결되고 상기 제2스토리지 라인을 향하여 돌출된 돌출부를 갖는 게이트 전극, 상기 데이터 라인과 연결되는 소스 전극 및 상기 화소 전극과 연결되는 드레인 전극을 포함하고, 상기 제2스토리지 라인은 상기 돌출부와 대응되는 함몰부를 갖는다.

Description

표시 기판 및 이를 포함하는 표시 패널{DISPLAY SUBSTRATE AND DISPLAY PANEL COMPRISING THE SAME}
본 발명은 표시 기판 및 이를 포함하는 표시 패널에 관한 것으로, 보다 상세하게는, 휘선 불량을 방지하여 표시 품질을 향상시킬 수 있는 표시 기판 및 이를 포함하는 표시 패널에 관한 것이다.
액정 표시 장치(liquid crystal display, LCD)는 현재 가장 널리 사용되고 있는 평판 표시 장치(flat panel display, FPD) 중 하나로서, 전극이 형성되어 있는 두 장의 기판과 그 사이에 삽입되어 있는 액정층으로 이루어져, 전극에 전압을 인가하여 액정층의 액정 분자들을 재배열시킴으로써 투과되는 빛의 양을 조절하는 표시 장치이다.
본 발명은 박막 트랜지스터의 게이트 전극과 스토리지 라인 사이에 형성되는 전계로 인하여 화소의 가장자리에서 발생되는 휘선 불량을 방지하여 표시 품질을 향상시킬 수 있는 표시 기판 및 이를 포함하는 표시 패널을 제안하고자 한다.
본 발명의 표시 기판은, 제1기판; 상기 제1기판 상에 배치되는 게이트 라인; 상기 게이트 라인과 교차 배열되는 데이터 라인; 상기 게이트 라인 및 상기 데이터 라인의 교차영역에 배치되는 박막 트랜지스터; 상기 박막 트랜지스터와 전기적으로 연결되는 화소 전극; 상기 게이트 라인과 평행하게 이격되는 제1스토리지 라인; 및 상기 제1스토리지 라인에서 수직하게 연장되는 제2스토리지 라인을 포함하고, 상기 박막 트랜지스터는 상기 게이트 라인과 연결되고 상기 제2스토리지 라인을 향하여 돌출된 돌출부를 갖는 게이트 전극, 상기 데이터 라인과 연결되는 소스 전극 및 상기 화소 전극과 연결되는 드레인 전극을 포함하고, 상기 제2스토리지 라인은 상기 돌출부와 대응되는 함몰부를 갖는다.
상기 돌출부는 상기 제2스토리지 라인 보다 좁은 폭을 가질 수 있다.
상기 돌출부는 상기 제2스토리지 라인 방향으로 폭이 좁아질 수 있다.
상기 돌출부는 삼각형, 사다리꼴 또는 반원형 형태일 수 있다.
상기 돌출부는 상기 함몰부와 중첩될 수 있다.
상기 함몰부는 상기 돌출부와 동일한 형태를 가질 수 있다.
상기 함몰부는 삼각형, 사다리꼴 또는 반원형 형태일 수 있다.
상기 제2스토리지 라인은 상기 데이터 라인 또는 상기 화소 전극과 중첩될 수 있다.
본 발명의 표시 패널은, 제1기판; 상기 제1기판 상에 배치되는 게이트 라인; 상기 게이트 라인과 교차 배열되는 데이터 라인; 상기 게이트 라인 및 상기 데이터 라인과 전기적으로 연결되는 박막 트랜지스터; 상기 박막 트랜지스터와 전기적으로 연결되는 화소 전극; 상기 게이트 라인과 평행하게 이격되는 제1스토리지 라인; 상기 제1스토리지 라인에서 수직하게 연장되는 제2스토리지 라인; 상기 제1기판과 대향되게 배치되는 제2기판; 및 상기 제1기판과 상기 제2기판 사이에 개재되는 액정층을 포함하고, 상기 박막 트랜지스터는 상기 게이트 라인과 연결되고 상기 제2스토리지 라인을 향하여 돌출된 돌출부를 갖는 게이트 전극, 상기 데이터 라인과 연결되는 소스 전극 및 상기 화소 전극과 연결되는 드레인 전극을 포함하고, 상기 제2스토리지 라인은 상기 돌출부와 대응되는 함몰부를 갖는다.
상기 돌출부는 상기 제2스토리지 라인 보다 좁은 폭을 가질 수 있다.
상기 돌출부는 상기 제2스토리지 라인 방향으로 폭이 좁아질 수 있다.
상기 돌출부는 삼각형, 사다리꼴 또는 반원형 형태일 수 있다.
상기 돌출부는 상기 함몰부와 중첩될 수 있다.
상기 함몰부는 상기 돌출부와 동일한 형태를 가질 수 있다.
상기 함몰부는 삼각형, 사다리꼴 또는 반원형 형태일 수 있다.
상기 제2스토리지 라인은 상기 데이터 라인 또는 상기 화소 전극과 중첩될 수 있다.
본 발명의 표시 패널은 상기 제2기판 상에 배치되는 공통 전극을 더 포함할 수 있다.
본 발명은 박막 트랜지스터의 게이트 전극과 스토리지 라인 사이에 형성되는 전계로 인하여 화소의 가장자리에서 발생되는 휘선 불량을 방지하여 표시 품질을 향상시킬 수 있는 효과가 있다.
도 1은 본 발명의 표시 장치의 블록도이다.
도 2는 도 1의 표시 패널의 구조 및 화소에 대한 등가 회로도이다.
도 3은 본 발명의 일 실시예에 따른 표시 패널의 화소를 나타낸 평면도이다.
도 4는 도 3의 Ι- Ι'선을 따라 잘라 도시한 단면도이다.
도 5는 도 3의 A영역을 확대한 평면도이다.
도 6은 본 발명의 다른 실시예에 따른 표시 패널의 화소를 나타낸 평면도이다.
도 7은 도 6의 B영역을 확대한 평면도이다.
도 8은 본 발명의 또 다른 실시예에 따른 표시 패널의 화소를 나타낸 평면도이다.
도 9는 도 8의 C영역을 확대한 평면도이다.
본 발명의 이점 및 특징, 그리고 그것들을 달성하는 방법은 첨부되는 도면과 함께 상세하게 후술되어 있는 실시예들을 참조하면 명확해질 것이다. 그러나 본 발명은 이하에서 개시되는 실시예들에 한정되는 것이 아니라 서로 다른 다양한 형태로 구현될 것이며, 단지 본 실시예들은 본 발명의 개시가 완전하도록 하며, 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자에게 발명의 범주를 완전하게 알려주기 위해 제공되는 것이며, 본 발명은 청구항의 범주에 의해 정의될 뿐이다. 따라서, 몇몇 실시예에서, 잘 알려진 공정 단계들, 잘 알려진 소자 구조 및 잘 알려진 기술들은 본 발명이 모호하게 해석되는 것을 피하기 위하여 구체적으로 설명되지 않는다. 명세서 전체에 걸쳐 동일 참조 부호는 동일 구성 요소를 지칭한다.
공간적으로 상대적인 용어인 "아래(below)", "아래(beneath)", "하부(lower)", "위(above)", "상부(upper)" 등은 도면에 도시되어 있는 바와 같이 하나의 소자 또는 구성 요소들과 다른 소자 또는 구성 요소들과의 상관관계를 용이하게 기술하기 위해 사용될 수 있다. 공간적으로 상대적인 용어는 도면에 도시되어 있는 방향에 더하여 사용시 또는 동작시 소자의 서로 다른 방향을 포함하는 용어로 이해되어야 한다. 예를 들면, 도면에 도시되어 있는 소자를 뒤집을 경우, 다른 소자의 "아래(below)"또는 "아래(beneath)"로 기술된 소자는 다른 소자의 "위(above)"에 놓여질 수 있다. 따라서, 예시적인 용어인 "아래"는 아래와 위의 방향을 모두 포함할 수 있다. 소자는 다른 방향으로도 배향될 수 있고, 이에 따라 공간적으로 상대적인 용어들은 배향에 따라 해석될 수 있다.
본 명세서에서 사용된 용어는 실시예들을 설명하기 위한 것이며 본 발명을 제한하고자 하는 것은 아니다. 본 명세서에서, 단수형은 문구에서 특별히 언급하지 않는 한 복수형도 포함한다. 명세서에서 사용되는 "포함한다(comprises)" 및/또는 "포함하는(comprising)"은 언급된 구성요소, 단계, 동작 및/또는 소자는 하나 이상의 다른 구성요소, 단계, 동작 및/또는 소자의 존재 또는 추가를 배제하지 않는다.
다른 정의가 없다면, 본 명세서에서 사용되는 모든 용어(기술 및 과학적 용어를 포함)는 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자에게 공통적으로 이해될 수 있는 의미로 사용될 수 있을 것이다. 또 일반적으로 사용되는 사전에 정의되어 있는 용어들은 명백하게 특별히 정의되어 있지 않은 한 이상적으로 또는 과도하게 해석되지 않는다.
도 1은 본 발명의 표시 장치의 블록도이고, 도 2는 도 1의 표시 패널의 구조 및 화소에 대한 등가 회로도이다.
도 1 및 도 2를 참조하면, 본 발명의 표시 장치는 복수의 화소(PX)를 갖는 표시 패널(10), 외부로부터 수신된 영상신호(DATA)와 제어신호(CS)를 처리하여 각종 신호로 출력하는 제어부(20), 게이트 신호를 화소(PX)에 연결된 게이트 라인(GL1~GLn)에 공급하는 게이트 드라이버(30), 데이터 전압을 화소(PX)에 연결된 데이터 라인(DL1~DLm)에 공급하는 데이터 드라이버(40), 및 스토리지 전압을 화소(PX)에 연결된 스토리지 라인(SL1~SLn)에 공급하는 스토리지 드라이버(50)을 포함한다.
표시 패널(10)은 행 방향으로 게이트 신호를 전달하는 복수의 게이트 라인(GL1~GLn), 행 방향으로 스토리지 전압을 전달하는 복수의 스토리지 라인(SL1~SLn), 열 방향으로 데이터 전압을 전달하는 복수의 데이터 라인(DL1~DLm) 및 게이트 라인과 데이터 라인이 교차하는 영역에 매트릭스 방식으로 배열된 복수의 화소(PX)를 포함한다.
표시 패널(10)은 서로 분리되어 있는 제1기판(100), 제1기판(100)과 대향하게 배치되는 제2기판(200), 및 제1기판(100)과 제2기판(200) 사이에 개재된 액정층(300)을 포함한다.
화소 전극(PE)은 제1기판(100)에 배치되고, 컬러 필터(210) 및 공통 전극(230)은 제2기판(200)에 배치된다. 화소 전극(PE), 공통 전극(230) 및 액정층(300)은 액정 커패시터(Clc)를 형성할 수 있다. 다만, 이에 한정되지 않고 컬러 필터(210)는 제1기판(100) 상에 배치될 수 있다.
제어부(20)는 외부로부터 수신된 영상신호(DATA)에 기초하여 보정 영상신호(DATA')를 데이터 드라이버(40)에 출력한다. 또한, 제어부(20)는 외부로부터 수신된 제어신호(CS)에 기초하여 게이트 제어신호(GCS)를 게이트 드라이버(30)에 제공하고, 데이터 제어신호(DCS)를 데이터 드라이버(40)에 제공하고, 스토리지 제어신호(SCS)를 스토리지 드라이버(50)에 제공한다. 예컨대, 제어신호(CS)는 수직동기신호(Vsync), 수평동기신호(Hsync), 클럭신호(CLK) 및 데이터 인에이블신호(DE) 등의 타이밍 신호일 수 있고, 영상 신호(DATA)는 화소(PX)에서 출력되는 광의 계조를 나타내는 디지털 신호일 수 있다.
게이트 드라이버(30)는 제어부(20)로부터 게이트 제어신호(GCS)를 제공받아 게이트 신호를 생성하고, 게이트 신호를 복수의 게이트 라인(GL1~GLn)에 각각에 연결된 화소(PX)에 제공한다. 게이트 신호가 순차적으로 화소(PX)에 입력됨에 따라 데이터 전압이 화소(PX)에 순차적으로 제공될 수 있다.
데이터 드라이버(40)는 제어부(20)로부터 데이터 제어신호(DCS) 및 보정 영상신호(DATA')를 수신하고, 데이터 제어신호(DCS)에 응답하여 보정 영상신호(DATA')에 대응하는 데이터 전압을 복수의 데이터 라인(DL1~DLm) 각각에 연결된 화소(PX)에 제공한다.
스토리지 드라이버(50)는 제어부(20)로부터 스토리지 제어신호(SCS)를 제공받아 스토리지 전압을 생성하고, 스토리지 전압을 복수의 스토리지 라인(SL1~SLn)에 제공한다.
도 3은 본 발명의 일 실시예에 따른 표시 패널의 한 화소(PX)를 나타낸 평면도이고, 도 4는 도 3의 Ι- Ι'선을 따라 잘라 도시한 단면도이다.
도 3 및 도 4를 참조하면, 본 발명의 일 실시예에 따른 표시 기판은 제1기판(100), 제1기판(100) 상에 배치된 게이트 라인(110), 게이트 라인(110)과 교차 배열되는 데이터 라인(120), 게이트 라인(110) 및 데이터 라인(120)의 교차영역에 배치되는 박막 트랜지스터(130), 박막 트랜지스터(130)와 전기적으로 연결되는 화소 전극(140), 게이트 라인(110)과 평행하게 이격되는 제1스토리지 라인(152) 및 제1스토리지 라인(152)에서 수직하게 연장되는 제2스토리지 라인(154)을 포함한다.
제1기판(100)은 투명한 유리 또는 플라스틱 등으로 이루어질 수 있으며, 제1기판(100)은 평판 또는 소정의 곡률 반경(radius of curvature)을 갖는 곡면형일 수 있다.
게이트 라인(110)은 제1기판(100) 상에 가로방향으로 다수가 이격되어 배치된다. 게이트 라인(110)은 알루미늄(Al)이나 알루미늄 합금 등 알루미늄 계열 금속, 은(Ag)이나 은 합금 등 은계열 금속, 구리(Cu)나 구리 합금 등 구리 계열 금속, 몰리브덴(Mo)이나 몰리브덴 합금 등 몰리브덴 계열 금속, 크롬(Cr), 탄탈륨(Ta) 및 티타늄(Ti)으로 이루어질 수 있으나, 이에 한정되지 않고 물리적 성질이 다른 적어도 두 개의 도전막을 포함하는 다중막 구조일 수 있다.
데이터 라인(120)은 게이트 라인(110)과 교차 배열되도록 세로방향으로 다수가 이격되어 배치되며, 게이트 절연막(102)에 의해 게이트 라인(110)과 절연된다. 데이터 라인(120)은 몰리브덴, 크롬, 탄탈륨 및 티타늄 등 내화성 금속(refractory metal) 또는 이들의 합금으로 이루어질 수 있으나, 이에 한정되지 않고 내화성 금속막과 저저항 도전막을 포함하는 다중막 구조일 수 있다.
박막 트랜지스터(130)는 게이트 라인(110)에 연결되는 게이트 전극(132), 데이터 라인(120)에 연결되는 소스 전극(134) 및 화소 전극(140)에 연결되는 드레인 전극(136)을 포함한다.
게이트 전극(132)은 게이트 절연막(102)에 의해 소스 전극(134) 및 드레인 전극(136)과 절연되며, 게이트 절연막(102)과 소스 전극(134) 사이 및 게이트 절연막(102)과 드레인 전극(136) 사이에는 반도체층(138)이 배치된다. 또한 소스 전극(134) 및 드레인 전극(136) 상에는 유기 절연 물질 또는 무기 절연 물질 등으로 이루어진 보호층(104)이 배치된다.
게이트 전극(132)은 게이트 라인(110)으로부터 연장되며, 게이트 라인(100)과 일체로 형성될 수 있다. 게이트 전극(132)은 상측변으로부터 제2스토리지 라인(154)을 향하여 돌출된 돌출부(162)를 갖는다. 돌출부(162)에 대한 자세한 설명은 도 5를 참조하여 후술하기로 한다.
화소 전극(140)은 보호층(104) 상에 배치되며, 컨택홀(142)을 통해 드레인 전극(136)과 연결된다. 화소 전극(140)은 광학적으로 투명하고 전기적으로 전도성이 있는 물질로 이루어질 수 있다.
도시하지는 않았지만, 화소 전극(140) 상에는 배향막(미도시)이 배치될 수 있으며, 배향막은 수직 배향막 또는 광중합 물질을 이용하여 광배향된 배향막일 수 있다. 광중합 물질은 반응성 모노머(reactive monomer) 또는 반응성 메조겐(reactive mesogen)일 수 있다.
제1스토리지 라인(152) 및 제2스토리지 라인(154)은 게이트 라인(110)과 동일층에 배치된다. 제1스토리지 라인(152)은 게이트 라인(110)과 실질적으로 평행하게 이격되며, 제2스토리지 라인(154)은 제1스토리지 라인(152)에서 수직하게 연장된다. 다만, 이에 한정되지 않고 제1스토리지 라인(152)과 제2스토리지 라인(154)은 일체로 형성될 수 있다.
제2스토리지 라인(154)은 데이터 라인(120) 또는 화소 전극(140)과 중첩될 수 있다. 제2스토리지 라인(154)은 게이트 절연층(102)을 사이에 두고 데이터 라인(120)과 중첩하여 데이터 라인(120)에서 화소 전극(140)으로의 프린지 필드를 막을 수 있으며, 또한 데이터 라인(120)과 화소 전극(140) 사이에서 발생되는 빛샘을 차단할 수 있다.
제2스토리지 라인(154)은 게이트 전극(132)의 돌출부(162)와 대응되는 함몰부(164)를 갖는다. 함몰부(164)에 대한 자세한 설명은 도 5를 참조하여 후술하기로 한다.
제2기판(200)은 투명한 유리 또는 플라스틱 등으로 이루어질 수 있으며, 제2기판(200)은 평판 또는 제1기판(100)에 대응하는 곡률 반경을 갖는 곡면형일 수 있다.
제2기판(200) 상에는 컬러 필터(210), 블랙 매트릭스(220) 및 공통 전극(230)이 배치된다. 다만, 이에 한정되지 않고 컬러 필터(210), 블랙 매트릭스(220) 및 공통 전극(230)은 제1기판(100) 상에 배치될 수 있다.
컬러 필터(210)는 적색, 녹색 및 청색의 삼원색 등 기본색 중 하나를 표시할 수 있으나, 이에 한정되지 않고 청록색(cyan), 자홍색(magenta), 엘로우(yellow) 및 화이트(white) 중 어느 하나의 색을 표시할 수 있다.
블랙 매트릭스(220)는 게이트 라인(110), 데이터 라인(120) 및 박막 트랜지스터(130)를 따라 배치되어 빛샘을 방지하는 역할을 하며, 블랙 매트릭스(220)는 CrO나 CrOx 등과 같은 금속산화물 또는 블랙수지 등으로 형성될 수 있다.
공통 전극(230)은 컬러 필터(210) 및 블랙 매트릭스(220)를 덮도록 제2기판(200)의 전면에 위에 통판으로 배치될 수 있고, 소정의 패턴이 형성될 수 있다. 공통 전극(230)은 광학적으로 투명하고 전기적으로 전도성이 있는 물질로 이루어질 수 있다.
도시하지는 않았지만, 공통 전극(230) 상에는 배향막(미도시)이 배치될 수 있으며, 배향막은 수직 배향막 또는 광중합 물질을 이용하여 광배향된 배향막일 수 있다. 광중합 물질은 반응성 모노머(reactive monomer) 또는 반응성 메조겐(reactive mesogen)일 수 있다.
도 5는 도 3의 A영역을 확대한 평면도이다.
도 5를 참조하면, 돌출부(162)는 게이트 전극(132)의 상측변으로부터 제2스토리지 라인(154)을 향하여 돌출되며, 함몰부(164)는 제2스토리지 라인(154)의 하측변으로부터 돌출부(162)의 돌출 방향과 동일한 방향으로 함몰된다.
돌출부(162)의 폭(W1)은 제2스토리지 라인(154)의 폭(W3) 보다 좁고, 게이트 전극(132)의 폭(W2)은 제2스토리지 라인(154)의 폭(W3) 보다 넓다. 다만, 이에 한정되지 않고 돌출부(162)와 게이트 전극(132)은 화소 전극(140)의 크기 또는 배치 형태에 따라 동일한 폭을 가질 수 있고, 마찬가지로 게이트 전극(132)과 제2스토리지 라인(154)은 화소 전극(140)의 크기 또는 배치 형태에 따라 동일한 폭을 가질 수 있다.
돌출부(162)는 게이트 전극(132)과 제2스토리지 라인(154) 사이에 형성되는 전계를 보다 효과적으로 제어하기 위하여 제2스토리지 라인(154) 방향으로 폭이 좁아지는 형태를 갖는 것이 바람직하다.
본 발명의 일 실시예에서, 돌출부(162)는 제2스토리지 라인(154) 방향으로 폭이 좁아지는 삼각형 형태이며, 다만 이에 한정되지 않고 사다리꼴, 반원형을 포함한 다각형 형태일 수 있다.
돌출부(162)는 게이트 전극(132)과 제2스토리지 라인(154) 사이에 형성되는 전계(electric field)를 함몰부(164) 영역 내로 제어하기 위하여 함몰부(164)와 중첩될 수 있다. 또한, 돌출부(162)는 게이트 전극(132)과 제2스토리지 라인(154) 사이에 형성되는 전계를 보다 효과적으로 제어하기 위하여 좌우 대칭 형태인 것이 바람직하다.
따라서 게이트 전극(132)과 제2스토리지 라인(154) 사이에 형성되는 전계는 함몰부(164) 영역 내에서 화살표 방향으로 제어할 수 있고, 화살표 방향으로 발생되는 전계는 서로 상쇄될 수 있다. 따라서 화소의 가장 자리에서 게이트 라인(110) 또는 데이터 라인(120)을 따라 발생되는 휘선 불량을 방지할 수 있다.
함몰부(164)는 돌출부(162)와 마찬가지로 돌출부(162)의 돌출 방향으로 폭이 좁아진다. 또한 함몰부(164)는 돌출부(162)와 동일한 형태를 갖는 것이 바람직하다. 다만, 이에 한정되지 않고 함몰부(164)는 돌출부(162)의 돌출 방향으로 폭이 좁아 지면서 돌출부(162)와 다른 형태를 가질 수 있다. 본 발명의 일 실시예에서, 함몰부(164)는 돌출부(162)의 돌출 방향으로 폭이 좁아지는 삼각형 형태이다.
도 6은 본 발명의 다른 실시예에 따른 표시 패널의 화소를 나타낸 평면도이고, 도 7은 도 6의 B영역을 확대한 평면도이다.
도 6 및 도 7을 참조하면, 본 발명의 다른 실시예에 따른 표시 기판은 도 3의 표시 기판과 비교하여 돌출부(162) 및 함몰부(164)의 형태를 제외하고는 동일하므로 중복된 구성에 대한 자세한 설명은 명세서의 간결함을 위하여 생략하기로 한다.
돌출부(162)는 제2스토리지 라인(154) 방향으로 폭이 좁아지고 좌우 대칭인 사다리꼴 형태이다. 함몰부(164)는 돌출부(162)의 돌출 방향으로 폭이 좁아지고 돌출부(162)와 동일한 사다리꼴 형태이다.
돌출부(162)는 함몰부(164)와 중첩되며, 따라서 게이트 전극(132)과 제2스토리지 라인(154) 사이에 발생되는 전계는 함몰부(164) 영역 내에서 상쇄될 수 있다.
도 8은 본 발명의 또 다른 실시예에 따른 표시 패널의 화소를 나타낸 평면도이고, 도 9는 도 8의 C영역을 확대한 평면도이다.
도 8 및 도 9을 참조하면, 본 발명의 또 다른 실시예에 따른 표시 기판은 도 3의 표시 기판과 비교하여 돌출부(162) 및 함몰부(164)의 형태를 제외하고는 동일하므로 중복된 구성에 대한 자세한 설명은 명세서의 간결함을 위하여 생략하기로 한다.
돌출부(162)는 제2스토리지 라인(154) 방향으로 폭이 좁아지고 좌우 대칭인 반원형 형태이다. 함몰부(164)는 돌출부(162)의 돌출 방향으로 폭이 좁아지고 돌출부(162)와 동일한 반원형 형태이다.
돌출부(162)는 함몰부(164)와 중첩되며, 따라서 게이트 전극(132)과 제2스토리지 라인(154) 사이에 발생되는 전계는 함몰부(164) 영역 내에서 상쇄될 수 있다.
이상에서 설명된 본 발명의 실시예는 예시적인 것에 불과하며, 본 발명의 보호범위는 본 발명 기술분야의 통상의 지식을 가진 자라면 이로부터 다양한 변형 및 균등예를 포함할 수 있다.
10: 표시 패널 152: 제1스토리지 라인
20: 제어부 154: 제2스토리지 라인
30: 게이트 드라이버 162: 돌출부
40: 데이터 드라이버 164: 함몰부
50: 스토리지 드라이버 200: 제2기판
100: 제1기판 210: 컬러 필터
110: 게이트 라인 220: 블랙 매트릭스
120: 데이터 라인 230: 공통 전극
130: 박막 트랜지스터 300: 액정층
140: 화소 전극

Claims (17)

  1. 제1기판;
    상기 제1기판 상에 배치되는 게이트 라인;
    상기 게이트 라인과 교차 배열되는 데이터 라인;
    상기 게이트 라인 및 상기 데이터 라인의 교차영역에 배치되는 박막 트랜지스터;
    상기 박막 트랜지스터와 전기적으로 연결되는 화소 전극;
    상기 게이트 라인과 평행하게 이격되는 제1스토리지 라인; 및
    상기 제1스토리지 라인에서 수직하게 연장되는 제2스토리지 라인을 포함하고,
    상기 박막 트랜지스터는 상기 게이트 라인과 연결되고 상기 제2스토리지 라인을 향하여 돌출된 돌출부를 갖는 게이트 전극, 상기 데이터 라인과 연결되는 소스 전극 및 상기 화소 전극과 연결되는 드레인 전극을 포함하고,
    상기 제2스토리지 라인은 상기 돌출부와 대응되는 함몰부를 갖는 표시 기판.
  2. 제1항에 있어서,
    상기 돌출부는 상기 제2스토리지 라인 보다 좁은 폭을 갖는 표시 기판.
  3. 제1항에 있어서,
    상기 돌출부는 상기 제2스토리지 라인 방향으로 폭이 좁아지는 표시 기판.
  4. 제1항에 있어서,
    상기 돌출부는 삼각형, 사다리꼴 또는 반원형 형태인 표시 기판.
  5. 제1항에 있어서,
    상기 돌출부는 상기 함몰부와 중첩되는 표시 기판.
  6. 제1항에 있어서,
    상기 함몰부는 상기 돌출부와 동일한 형태를 갖는 표시 기판.
  7. 제1항에 있어서,
    상기 함몰부는 삼각형, 사다리꼴 또는 반원형 형태인 표시 기판.
  8. 제1항에 있어서,
    상기 제2스토리지 라인은 상기 데이터 라인 또는 상기 화소 전극과 중첩되는 표시 기판.
  9. 제1기판;
    상기 제1기판 상에 배치되는 게이트 라인;
    상기 게이트 라인과 교차 배열되는 데이터 라인;
    상기 게이트 라인 및 상기 데이터 라인과 전기적으로 연결되는 박막 트랜지스터;
    상기 박막 트랜지스터와 전기적으로 연결되는 화소 전극;
    상기 게이트 라인과 평행하게 이격되는 제1스토리지 라인;
    상기 제1스토리지 라인에서 수직하게 연장되는 제2스토리지 라인;
    상기 제1기판과 대향되게 배치되는 제2기판; 및
    상기 제1기판과 상기 제2기판 사이에 개재되는 액정층을 포함하고,
    상기 박막 트랜지스터는 상기 게이트 라인과 연결되고 상기 제2스토리지 라인을 향하여 돌출된 돌출부를 갖는 게이트 전극, 상기 데이터 라인과 연결되는 소스 전극 및 상기 화소 전극과 연결되는 드레인 전극을 포함하고,
    상기 제2스토리지 라인은 상기 돌출부와 대응되는 함몰부를 갖는 표시 패널.
  10. 제9항에 있어서,
    상기 돌출부는 상기 제2스토리지 라인 보다 좁은 폭을 갖는 표시 패널.
  11. 제9항에 있어서,
    상기 돌출부는 상기 제2스토리지 라인 방향으로 폭이 좁아지는 표시 패널.
  12. 제9항에 있어서,
    상기 돌출부는 삼각형, 사다리꼴 또는 반원형 형태인 표시 패널.
  13. 제9항에 있어서,
    상기 돌출부는 상기 함몰부와 중첩되는 표시 패널.
  14. 제9항에 있어서,
    상기 함몰부는 상기 돌출부와 동일한 형태를 갖는 표시 패널.
  15. 제9항에 있어서,
    상기 함몰부는 삼각형, 사다리꼴 또는 반원형 형태인 표시 패널.
  16. 제9항에 있어서,
    상기 제2스토리지 라인은 상기 데이터 라인 또는 상기 화소 전극과 중첩되는 표시 패널.
  17. 제9항에 있어서,
    상기 제2기판 상에 배치되는 공통 전극을 더 포함하는 표시 패널.
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