KR20130064127A - Ｐｕｃｃｈ 및 ｐｕｓｃｈ 인코딩을 위한 방법 및 장치 - Google Patents

Ｐｕｃｃｈ 및 ｐｕｓｃｈ 인코딩을 위한 방법 및 장치 Download PDF

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Abstract

정보 비트들을 제 1 세트의 정보 비트들 및 제 2 세트의 정보 비트들로 분할하는 단계를 포함하는 무선 업링크 통신이 개시된다. 제 1 세트의 정보 비트들은 제 1세트의 코딩된 비트들로 인코딩되며, 제 2 세트의 정보 비트들은 제 2 세트의 코딩된 비트들로 인코딩된다. 제 1 및 제 2 세트들의 코딩된 비트들은 제 1 및 제 2 세트들의 레이트-매칭된 코딩된 비트들을 생성하는 정의된 수의 비트들로 레이트 매칭된다. 제 1 및 제 2 세트들의 레이트-매칭된 코딩된 비트들은 인터리빙된 세트의 코딩된 비트들을 생성하기 위해 다양한 인터리빙된 방법들을 이용하여 인터리빙된다.

Description

ＰＵＣＣＨ 및 ＰＵＳＣＨ 인코딩을 위한 방법 및 장치{METHOD AND APPARATUS FOR PUCCH AND PUSCH ENCODING}
관련 출원들에 대한 참조
본 출원은, 2010년 10월 4일자로 출원된 발명의 명칭이 "METHOD AND APPARATUS FOR PUCCH ENCODING"인 미국 가 특허 출원 제61/389,560호, 및 2011년 2월 14일자로 출원된 발명의 명칭이 "METHOD AND APPARATUS FOR PUCCH AND PUSCH ENCODING"인 미국 가 특허 출원 제61/442,702호를 우선권으로 주장하며, 이들 전체가 인용에 의해 본원에 포함된다.
I. 분야
본 개시물은 일반적으로 통신에 관한 것이고, 더욱 구체적으로는 무선 통신 시스템에서 인코딩하는 물리적 업링크 제어 채널(PUCCH; Physical Uplink Control Channel) 및 물리적 업링크 공유 채널(PUSCH; Physical Uplink Shared Channel)에 대한 기술들에 관한 것이다.
무선 통신 시스템들은, 다양한 통신 콘텐츠, 예컨대, 음성, 비디오, 패킷 데이터, 메시징, 브로드캐스트 등을 제공하기 위해 광범위하게 배치된다. 이러한 무선 시스템들은 가용 시스템 자원들을 공유함으로써 다수의 사용자들을 지원할 수 있는 다중-액세스 시스템들일 수 있다. 이러한 다중 액세스 시스템들의 예시들은 코드 분할 다중 액세스(CDMA: Code Division Multiple Access) 시스템들, 시분할 다중 액세스(TDMA: Time Division Multiple Access) 시스템들, 주파수 분할 다중 액세스(FDMA: Frequency Division Multiple Access) 시스템들, 직교 FDMA(OFDMA: Orthogonal Frequency Division Multiple Access) 시스템들, 및 단일-캐리어 FDMA(SC-FDMA) 시스템들을 포함한다.
무선 통신 시스템은 다수의 사용자 장비들(UE들)에 대한 통신을 지원할 수 있는 다수의 기지국들을 포함할 수 있다. 기지국은 다수의 송신 및/또는 수신 안테나들을 포함할 수 있다. 각각의 UE는 다수의 송신 및/또는 수신 안테나들을 포함할 수 있다. UE는 PUCCH 및 PUSCH를 통해서 다양한 제어 정보를 송신한다. LTE-A에서, 새로운 포맷인 PUCCH 포맷 3이 캐리어 어그리게이션(carrier aggregation)을 위해 도입된다. PUCCH 포맷 3은 각각의 SC-FDM 심볼에서 이산 푸리에 변환 단일-캐리어 직교 주파수 분할 멀티플렉싱(DFT-S-OFDM) 파형을 송신한다. PUCCH 포맷 3은 QPSK 변조를 통해서 48개의 코딩된 비트들을 반송할 수 있다. 그러나, 포맷 3에 대응하는 제어 정보 비트들을 인코딩하는 것은 아직 확립되지 않았다.
또한, 제어 정보는 PUSCH에서 송신될 수 있다. 제어 정보에 대한 상이한 코딩 레이트들은 자신의 송신을 위해 상이한 수의 코딩된 심볼들을 할당함으로써 달성될 수 있다. 예를 들어, 제어 정보가 PUSCH에서 송신될 때, HARQ-ACK, 랭크 표시자(RI) 및 채널 품질 정보(CQI)에 대한 채널 코딩은 독립적으로 행해질 수 있다. 그러나, 11개 초과 비트들의 HARQ-ACK 정보에 대한 채널 코딩은 아직 확립되지 않았다.
종래 기술의 11개 비트들을 초과하는 정보 비트들은 업링크 물리적 채널 상에서 인코딩될 수 있다. 이 정보 비트들은 물리적 업링크 공유 채널(PUSCH) 또는 물리적 업링크 제어 채널(PUCCH) 상에서 운반될 업링크 제어 정보를 포함할 수 있다. 정보 비트들은 2개 세트들로 분할될 수 있고, 이 2개 세트들 블록 각각은 인코딩되고 그리고 레이트-매치된다. 레이트-매칭 이후에, 2개 세트들의 비트들은 슬롯 다이버시티(slot diversity)를 획득하기 위해 인터리빙될 수 있다.
일 예시적인 양상에서, 무선 통신을 위한 방법은, 정보 비트들을 제 1 및 제 2 세트들의 정보 비트들로 분할하는 단계, 제 1 세트의 정보 비트들을 제 1 세트의 코딩된 비트들로 인코딩하는 단계, 제 2 세트의 정보 비트들을 제 2 세트의 코딩된 비트들로 인코딩하는 단계를 포함한다. 이 방법은 또한 제 1 세트의 레이트-매칭된 코딩된 비트들 및 제 2 세트의 레이트-매칭된 코딩된 비트들을 생성하기 위해 제 1 및 제 2 세트들의 코딩된 비트들을 정의된 수의 비트들로 레이트 매칭하는 단계를 포함한다. 이 방법은 또한 인터리빙된 세트의 코딩된 비트들을 생성하기 위해 제 1 및 제 2 세트들의 레이트-매칭된 코딩된 비트들을 인터리빙하는 단계를 포함한다.
다른 예시적인 양상에서, 컴퓨터 프로그램 물건은 프로그램 코드가 기록된 비-일시적인 컴퓨터-판독가능 저장 매체를 포함한다. 프로그램 코드는, 정보 비트들을 제 1 및 제 2 세트들의 정보 비트들로 분할하기 위한 코드, 제 1 세트의 정보 비트들을 제 1 세트의 코딩된 비트들로 인코딩하기 위한 코드, 제 2 세트의 정보 비트들을 제 2 세트의 코딩된 비트들로 인코딩하기 위한 코드, 제 1 및 제 2 세트들의 코딩된 비트들을 미리결정된 수의 비트들로 레이트 매칭하기 위한 코드, 및 인터리빙된 세트의 코딩된 비트들을 생성하기 위해 제 1 및 제 2 세트들의 코딩된 비트들을 인터리빙하기 위한 코드를 포함한다.
다른 예시적인 양상에서, 무선 통신을 위해 구성된 장치는 메모리에 커플링된 적어도 하나의 프로세서를 포함한다. 프로세서는, 정보 비트들을 제 1 및 제 2 세트들의 정보 비트들로 분할하고, 제 1 세트의 정보 비트들을 제 1 세트의 코딩된 비트들로 인코딩하고, 제 2 세트의 정보 비트들을 제 2 세트의 코딩된 비트들로 인코딩하고, 제 1 및 제 2 세트들의 코딩된 비트들을 미리결정된 수의 비트들로 레이트 매칭하고, 그리고 인터리빙된 세트의 코딩된 비트들을 생성하기 위해 제 1 및 제 2 세트들의 코딩된 비트들을 인터리빙하도록 구성된다.
다른 예시적인 양상에서, 무선 통신을 위한 장치는, 정보 비트들을 제 1 세트의 정보 비트들 및 제 2 세트의 정보 비트들로 분할하기 위한 수단, 제 1 세트의 정보 비트들을 제 1 세트의 코딩된 비트들로 인코딩하기 위한 수단, 제 2 세트의 정보 비트들을 제 2 세트의 코딩된 비트들로 인코딩하기 위한 수단, 제 1 세트의 레이트-매칭된 코딩된 비트들 및 제 2 세트의 레이트-매칭된 코딩된 비트들을 생성하기 위해 제 1 및 제 2 세트들의 코딩된 비트들을 정의된 수의 비트들로 레이트 매칭하기 위한 수단, 및 인터리빙된 세트의 코딩된 비트들을 생성하기 위해 제 1 및 제 2 세트들의 레이트-매칭된 코딩된 비트들을 인터리빙하기 위한 수단을 포함한다.
본 개시물의 다양한 양상들 및 특징들이 이하 더욱 상세하게 설명된다.
도 1은 예시적인 무선 통신 시스템을 개념적으로 예시하는 블록도이다.
도 2는 예시적인 송신 구조를 개념적으로 예시하는 도면이다.
도 3은 무선 통신 시스템에서 업링크 제어 정보의 송신의 일례를 개념적으로 예시하는 도면이다.
도 4는 본 개시물의 일 양상을 구현하기 위해 실행된 예시적인 블록들을 개념적으로 예시하는 기능적인 블록도이다.
도 5는 본 개시물의 일 양상에 따라서 구성된 장치를 개념적으로 예시하는 블록도이다.
도 6은 본 개시물의 일 양상에 따라서 구성된 무선 통신 시스템에서 업링크 공유 데이터 채널을 통해서 제어 정보의 송신의 일례를 개념적으로 예시하는 도면이다.
이하 상세하게 논의되는 바와 같이, 업링크 제어 정보에 대한 다양한 인코딩 옵션들이 개시된다. 본원에 설명된 기술들은 CDMA, TDMA, FDMA, OFDMA, SC-FDMA 및 다른 시스템들과 같은 다양한 무선 통신 시스템들에 대해 이용될 수 있다. 용어들 "시스템" 및 "네트워크"은 종종 상호교환가능하게 사용된다. CDMA 시스템은 유니버셜 지상 라디오 액세스(UTRA), cdma2000 등과 같은 라디오 기술을 구현할 수 있다. UTRA는 광대역 CDMA(WCDMA), 및 CDMA의 다른 변형들을 포함한다. cdma2000은 IS-2000, IS-95 및 IS-856 표준들을 커버한다. TDMA 시스템은 이동 통신을 위한 글로벌 시스템(GSM)과 같은 라디오 기술을 구현할 수 있다. OFDMA 시스템은 이볼브드 UTRA(E-UTRA), UMB(Ultra Mobile Broadband), IEEE 802.11(Wi-Fi), IEEE 802.16(WiMAX), IEEE 802.20, 플래시-OFDM® 등과 같은 라디오 기술을 구현할 수 있다. UTRA 및 E-UTRA는 유니버셜 이동 텔레커뮤니케이션 시스템(UMTS)의 일부이다. 3GPP 롱 텀 에볼루션(LTE) 및 LTE-Advanced(LTE-A)는 E-UTRA를 이용하는 UMTS의 새로운 릴리스들이며, 여기서 E-UTRA는 다운링크 상에서 OFDMA 그리고 업링크 상에서 SC-FDMA를 채용한다. UTRA, E-UTRA, UMTS, LTE, LTE-A 및 GSM은 "제 3 세대 파트너십 프로젝트"(3GPP)로 명명된 기구로부터의 문헌들에 설명된다. cdma2000 및 UMB는 "제 3 세대 파트너십 프로젝트 2"(3GPP2)란 명칭의 기구로부터의 문헌들에 설명된다. 본원에 설명된 기술들은 상기에 언급된 시스템들 및 라디오 기술들뿐 아니라 다른 시스템들 및 다른 라디오 기술들에 대해 이용될 수 있다. 명료함을 위해, 이 기술들의 특정 양상들이 LTE에 대해 이하 설명되고, LTE 용어는 이하의 설명의 대부분에서 사용된다.
도 1은 LTE 시스템 또는 몇몇 다른 시스템일 수 있는 무선 통신 시스템(100)을 나타낸다. 시스템(100)은 수많은 이볼브드 Node B들(eNB들)(110) 및 다른 네트워크 엔티티들을 포함할 수 있다. eNB는 UE들과 통신하는 엔티티일 수 있고, 또한 기지국, Node B, 액세스 포인트 등으로 지칭될 수 있다. 각각의 eNB(110)은 특정 지리적 영역에 대한 통신 커버리지를 제공할 수 있고, 커버리지 영역 내에 위치된 UE들에 대한 통신을 지원할 수 있다. 성능을 개선시키기 위해, eNB의 전반적인 커버리지 영역은 다수의 (예를 들어, 3개) 더 작은 영역들로 파티셔닝될 수 있다. 각각의 더 작은 영역은 개별적인 eNB 서브시스템에 의해 서빙될 수 있다. 3GPP에서, 용어 "셀"은 이 커버리지 영역을 서빙하는 eNB(110) 및/또는 eNB 서브시스템의 가장 작은 커버리지 영역을 지칭할 수 있다.
UE들(120)은 시스템 전반에 걸쳐 분산될 수 있고, 각각의 UE(120)는 고정형(stationary) 또는 이동형(mobile)일 수 있다. UE는 또한, 이동국, 단말, 액세스 단말, 가입자 유닛, 스테이션 등으로 지칭될 수 있다. UE(120)는 셀룰러 전화, 개인 정보 단말(PDA), 무선 모뎀, 무선 통신 디바이스, 핸드헬드 디바이스, 랩톱 컴퓨터, 코드리스 전화, 무선 로컬 루프(WLL) 스테이션, 스마트 폰, 넷북, 스마트북, 태블릿 등일 수 있다.
LTE는 다운링크 상에서는 직교 주파수 분할 다중화(OFDM; orthogonal frequency division multiplexing)를 그리고 업링크 상에서는 단일-캐리어 주파수 분할 다중화(SC-FDM; single-carrier frequency division multiplexing)를 활용한다. OFDM 및 SC-FDM는 주파수 범위를 다수의 (Ks개) 직교 서브캐리어들로 파티셔닝하고, 이 직교 서브캐리어들은 또한 통상적으로 톤(tone)들, 빈(bin)들, 등으로 지칭된다. 각각의 서브캐리어는 데이터를 이용하여 변조될 수 있다. 일반적으로, 변조 심볼(modulation symbol)들은 주파수 도메인(frequency domain)에서 OFDM를 이용하여 그리고 시간 도메인(time domain)에서 SC-FDM을 이용하여 전송된다. 인접하는 서브캐리어들 사이의 간격(spacing)은 고정될 수 있고, 서브캐리어들의 총 수(Ks)는 시스템 대역폭에 의존적일 수 있다. 예를 들어, Ks는 1.25, 2.5, 5, 10, 또는 20 메가헤르츠(MHz)의 시스템 대역폭에 대해 각각, 128, 256, 512, 1024 또는 2048과 동일할 수 있다. 시스템 대역폭은 Ks개의 전체 서브캐리어들의 서브세트에 대응할 수 있다.
도 2는 도 1에서의 eNB들 중 하나 및 UE들 중 하나일 수 있는, 예시적인 기지국/eNB(110) 및 UE(120)의 설계의 블록 다이어그램을 나타낸다. UE(120)에는 T개의 안테나들(1234a 내지 1234t)이 구비될 수 있고, 기지국(110)에는 R개의 안테나들(1252a 내지 1252r)이 구비될 수 있으며, 일반적으로 T≥1 및 R≥1이다.
UE(120)에서, 송신 프로세서(1220)는 데이터 소스(1212)로부터 데이터를, 그리고 컨트롤러/프로세서(1240)로부터 제어 정보를 수신할 수 있다. 송신 프로세서(1220)는 데이터 및 제어 정보를 프로세싱(예를 들어, 인코딩, 인터리빙, 및 심볼 매핑)할 수 있고, 데이터 심볼들 및 제어 심볼들을 각각 제공할 수 있다. 송신 프로세서(1220)는 또한, UE(120)에 할당된 하나 또는 둘 이상의 RS 시퀀스들에 기초하여 다수의 접경하지 않는 클러스터들에 대한 하나 또는 둘 이상의 복조 기준 신호들을 생성할 수 있고, 기준 심볼들을 제공할 수 있다. 송신(TX) 다중-입력 다중-출력(MIMO; multiple-input multiple-output) 프로세서(1230)는, 적용가능한 경우, 송신 프로세서(1220)로부터의 데이터 심볼들, 제어 심볼들, 및/또는 기준 심볼들에 대한 공간 프로세싱(예를 들어, 프리코딩(precoding))을 수행할 수 있고, 그리고 T개의 출력 심볼 스트림들을 T개의 변조기들(MODs)(1232a 내지 1232t)에 제공할 수 있다. 각각의 변조기(1232)는 출력 샘플 스트림을 획득하기 위해 (예를 들어, SC-FDMA, OFDM 등을 위한) 각각의 출력 심볼 스트림을 프로세싱할 수 있다. 각각의 변조기(1232)는 업링크 신호를 획득하기 위해 출력 샘플 스트림을 더 프로세싱(예를 들어, 아날로그로 변환, 증폭, 필터링, 및 상향변환(upconvert))할 수 있다. 변조기들(1232a 내지 1232t)로부터의 T개의 업링크 신호들은 각각, T개의 안테나들(1234a 내지 1234t)을 통해 송신될 수 있다.
기지국(110)에서, 안테나들(1252a 내지 1252r)은 UE(120)로부터 업링크 신호들을 수신할 수 있고, 수신된 신호들을 각각 복조기들(DEMODs)(1254a 내지 1254r)에 제공할 수 있다. 각각의 복조기(1254)는 수신된 샘플들을 획득하기 위해 각각의 수신된 신호를 컨디셔닝(예를 들어, 필터링, 증폭, 하향변환(downconvert), 및 디지털화)할 수 있다. 각각의 복조기(1254)는 수신된 심볼들을 획득하기 위해 수신된 샘플들을 더 프로세싱할 수 있다. 채널 프로세서/MIMO 검출기(1256)는 수신된 심볼들을 모든 R개의 복조기들(1254a 내지 1254r)로부터 획득할 수 있다. 채널 프로세서(1256)는 UE(120)로부터 수신된 복조 기준 신호들에 기초하여 UE(120)로부터 기지국(110)으로 무선 채널을 위한 채널 추정을 유도한다. MIMO 검출기(1256)는 채널 추정에 기초하여 수신된 심볼들에 대해 MIMO 검출/복조를 수행할 수 있고, 검출된 심볼들을 제공할 수 있다. 수신 프로세서(1258)는 검출된 심볼들을 프로세싱(예를 들어, 심볼 디매핑, 디인터리빙, 및 디코딩)할 수 있고, 디코딩된 데이터를 데이터 싱크(1260)에 제공할 수 있으며, 디코딩된 제어 정보를 컨트롤러/프로세서(1280)에 제공할 수 있다.
다운링크 상에서는, 기지국(110)에서, 데이터 소스(data source; 1262)로부터의 데이터를, 그리고 컨트롤러/프로세서(1280)로부터의 제어 정보를 송신 프로세서(1264)에 의해 프로세싱할 수 있고, TX MIMO 프로세서(1266)에 의해 프리코딩될 수 있으며, 적용가능한 경우, 변조기들(1254a 내지 1254r)에 의해 컨디셔닝될 수 있고, 그리고 UE(120)에 송신될 수 있다. UE(120)에서, 기지국(110)으로부터의 다운링크 신호들은 안테나들(1234)에 의해 수신될 수 있고, 복조기들(1232)에 의해 컨디셔닝될 수 있고, 채널 추정기/MIMO 검출기(1236)에 의해 프로세싱될 수 있고, 그리고 수신 프로세서(1238)에 의해 더 프로세싱되어 UE(120)에 전송된 데이터 및 제어 정보를 획득할 수 있다. 프로세서(1238)는 디코딩된 데이터를 데이터 싱크(1239)에, 그리고 디코딩된 제어 정보를 컨트롤러/프로세서(1240)에 제공할 수 있다.
컨트롤러들/프로세서들(1240 및 1280)은 각각, UE(120) 및 기지국(110)에서의 동작을 지시할 수 있다. 프로세서(1220), 프로세서(1240), 및/또는 UE(120)에서의 다른 프로세서들 및 모듈들은 본원에 설명된 기술들에 대한 프로세스를 수행하거나 또는 지시할 수 있다. 메모리들(1242 및 1282)은 각각 UE(120) 및 기지국(110)을 위한 데이터 및 프로그램 코드들을 저장할 수 있다.
PUCCH에서 운반되는 업링크 제어 정보 및 PUSCH에서 운반되는 업링크 제어 정보에 대한 인코딩 옵션들이 LTE에 제공된다. LTE Rel-8 및 LTE Rel-9에서, PUCCH 포맷 1 및 포맷 2가 지원된다. 예를 들어, PUCCH 포맷 1은 요청을 스케줄링하는데 이용될 수 있다. PUCCH 포맷 1a/1b은 1 또는 2-비트 ACK/NACK(긍정확인응답/부정확인응답)에 대해 이용될 수 있다. 또한, PUCCH 포맷 2/2a/2b은 ACK/NACK을 통해/ACK/NACK 없이 CQI에 대해 이용될 수 있다. PUCCH 상의 메시지들은 각각의 SC-FDM 심볼의 시퀀스의 순환 시프트 상에서 변조될 수 있다.
LTE Rel-10에서, 소위 PUCCH 포맷 3(또한, DFT-S-OFDM 포맷으로 지칭됨)으로 지칭되는 새로운 포맷이 캐리어 어그리게이션을 위해 도입된다. 포맷 3 송신들은 각각의 SC-DFM 심볼의 DFT-S-OFDM 파형을 포함한다. 일 설계에서, PUCCH 포맷 3은 각각의 타임 슬롯에서 데이터 SC-FDM 심볼들에 걸쳐서 길이-5 직교 커버 코드들(OCC)을 이용한다. 다른 설계에서, PUCCH 포맷 3은 제 2 타임 슬롯에서 데이터 SC-FDM 심볼들에 걸쳐서 길이-4 OCC를 이용한다. 게다가, PUCCH 포맷 3은 QPSK 변조 방식으로 48개의 코딩된 비트들을 반송할 수 있다. 따라서, 24개의 코딩된 비트들은 각각의 타임 슬롯에서 전송될 수 있다. 또한, PUCCH에 대한 데이터의 송신이 이하 설명되지만, 아래에 설명되는 방법은 PUSCH와 같은 다른 채널들에서의 데이터의 송신에 적용할 수 있다.
도 3은 PUCCH 포맷 3을 이용하여 DFT-S-OFDM 파형의 예시적인 송신을 각각의 SC-FDM 심볼로 도시한다. 수평 방향(축 302)에서 시간이 플로팅되고, 수직 방향(축 304)에서 주파수 리소스들이 플로팅된다. 서브프레임의 2개의 타임 슬롯들(306 및 308)에서 송신된 PUCCH 신호들이 도시된다. 각각의 타임 슬롯(306, 308)은 데이터(예를 들어, 심볼 (310)) 및 기준 신호 RS(예를 들어, 심볼 (312))에 할당된 심볼들을 포함한다. RS는 복조 기준 신호로서 지칭될 수 있다. ACK/NACK 비트들과 같은 정보 비트들은 채널 코딩 및 변조 블록(322)을 통해서 프로세싱되어 제 1 세트의 변조 심볼들(318) 및 제 2 세트의 변조 심볼들(324)을 생성할 수 있다. 변조 심볼들(318 및 324)은 각각 이산 푸리에 변환 (DFT) 프리코딩 모듈들(316 및 326)을 통해서 프리코딩될 수 있다.
DFT 프리코딩의 결과 출력은 가중치들(w0 내지 w4)을 이용하는 시간 도메인에 산재될 수 있다. 가중치들(w0 내지 w4)(참조 번호(314, 320))은 직교 커버 코드(OCC; orthogonal cover code)의 계수들을 나타낸다. 가중치들(w0 내지 w4)은 예를 들어 5x5 이산 푸리에 변환(DFT) 매트릭스의 일 컬럼을 나타낼 수 있다. 그후, 출력은 상이한 심볼들로 매핑될 수 있다. 일 양상에 따르면, RS 심볼들은 순환 시프트(도 3에는 도시되지 않음) 상에서 변조될 수 있다. 24개의 코딩된 비트들은 타임 슬롯(306)에서 전송될 수 있고, 24개의 코딩된 비트들은 타임 슬롯(308)에서 송신될 수 있다. 48개의 코딩된 비트들은 QPSK로 변조될 수 있다.
인코딩될 정보가 1과 11 비트들 사이일 때, Rel-8에서 정의된 것과 같은 (32, O) 블록 인코더가 정보 비트들에 적용될 수 있고, 여기서 O은 인코더에 대한 입력 비트들의 수이다. 그러나, 인코딩될 정보가 12 또는 그 이상의 비트들일 때, 추가적인 프로세싱이 수행될 수 있다.
일 양상에 따르면, 테일-바이팅 콘볼루션 코딩(TBCC; tail-biting convolutional coding)이 정보 비트들에 대해 수행될 수 있다. 다이버시티를 개선시키기 위해, 인코딩된 정보 비트들에 대해 슬롯-바운더리 주파수 호핑이 수행될 수 있다.
제 2 양상에 따르면, (48, O) 블록 인코더가 정보 비트들에 적용될 수 있고, 여기서 O은 인코더로의 입력 비트들의 수이다. 슬롯-바운더리 주파수 호핑이 인코딩된 정보 비트들에 대해 수행되어 다이버시티를 개선시킬 수 있다.
제 3 양상에 따르면, 그 정보 비트들을 제 1 세트의 정보 비트들 및 제 2 세트의 정보 비트들로 분할한 후, 2개의 (32, 0) 블록 인코더들이 그 정보 비트들에 적용될 수 있다. 그후, 블록 인코더들 각각은 제 1 세트의 비트들 또는 제 2 세트의 비트들 중 하나를 수신하고 제 1 세트의 인코딩된 비트들 및 제 2 세트의 인코딩된 비트들 각각을 생성한다. 그 결과로 초래되는 제 1 및 제 2 세트의 인코딩된 비트들이 레이트 매칭되어 송신될 수 있다. 레이트 매칭은 정의된 크기로 인코딩된 비트들을 레이트 매칭할 수 있다. 예를 들어, 제 1 세트의 인코딩된 비트들 및 제 2세트의 인코딩된 비트들 각각은 24개의 비트들로 레이트 매칭되어 전체 48개의 비트들을 생성할 수 있다. 제 1 세트의 인코딩된 비트들 및 제 2 세트의 인코딩된 비트들이 별도의 타임 슬롯들에서 송신될 수 있다.
제 4 양상에 따르면, 인코딩된 비트들의 송신시에 다이버시티를 제공하기 위해 제 3 양상에 인터리빙이 적용될 수 있다. 예를 들어, 복수의 정보 비트들은 제 1 세트의 정보 비트들 및 제 2 세트의 정보 비트들로 분할될 수 있다. 제 1 및 제 2 세트의 정보 비트들은 제 1 및 제 2 세트의 코딩된 비트들을 형성하기 위해 예를 들어 하나 또는 둘 이상의 블록 인코더들을 이용하여 인코딩될 수 있다. 2개의 블록 인코더들이 존재하는 경우, (32, 0) 인코더들로의 입력 비트들의 수는 동일하거나 또는 상이할 수 있다. 예를 들어, 12 비트들에 대해, 6개의 비트들은 각각의 인코더에 의해 인코딩될 수 있다. 13 비트들에 대해, 7개의 비트들은 제 1 인코더에 의해 인코딩될 수 있고, 6개의 비트들은 제 2 인코더에 의해 인코딩될 수 있다.
그후, 제 1 및 제 2 세트의 인코딩된 비트들은 정의된 수의 비트들로 레이트 매칭될 수 있다. 예를 들어, 인코딩된 비트들이 송신을 위해 PUCCH 포맷 3 상에 있을 때, 비트들의 수는 48개의 비트들로서 선택될 수 있다. 다른 예에서, 인코딩된 비트들이 송신을 위해 PUSCH 상에 있을 때, 비트들의 수는 이동국에 할당된 리소스 블록들의 수에 기초하여 선택될 수 있다.
제 1 및 제 2 세트들의 코딩된 비트들이 레이트 매칭된 후, 제 1 및 제 2 세트들의 코딩된 비트들은 인터리빙되어 송신을 위한 제 3 세트의 코딩된 비트들을 생성할 수 있다. 인터리빙은 비트-레벨 인터리빙 또는 심볼-레벨 인터리빙 둘 중 하나일 수 있고, 비트들은 의사-랜덤 또는 짝수/홀수 방식으로 타임 슬롯들에 인터리빙될 수 있다. 즉, 코딩된 비트들이 인터리빙을 위해 선택될 때, 제 1 및 제 2 세트들의 코딩된 비트들로부터의 비트들이 제 1 타임 슬롯 또는 제 2 타임 슬롯에 랜덤으로 포함하도록 선택될 수 있다. 대안으로, 코딩된 비트들은 제 1 세트의 코딩된 비트들과 제 2 세트의 코딩된 비트들 사이에서 비트들을 교번함으로써 제 1 및 제 2 타임 슬롯들에 대해 선택될 수 있다: 제 1 세트의 짝수 비트들은 제 1 타임 슬롯에 위치될 수 있고, 제 1 세트의 홀수 비트들은 제 2 타임 슬롯에 위치될 수 있는 한편, 제 2 세트의 짝수 비트들은 제 1 타임 슬롯에 위치될 수 있고 제 2 세트의 홀수 비트들은 제 2 타임 슬롯에 위치될 수 있다. 인터리빙은 또한 제 1 및 제 2 세트들의 코딩된 비트들을 연쇄시키는 것을 포함할 수 있다.
제 1 및 제 2 세트들의 코딩된 비트들로의 적용을 위한 인터리빙 방법의 결정은 송신을 위한 채널에 부분적으로 기초할 수 있다. 예를 들어, 제 1 및 제 2 세트들의 코딩된 비트들이 송신을 위해 PUSCH 상에 있으면, 제 1 및 제 2 세트의 코딩된 비트들을 인터리빙하기 위해 연쇄(concatenation)가 적용될 수 있다. 다른 예시에서, 제 1 및 제 2 세트들의 코딩된 비트들이 송신을 위해 PUCCH 상에 있으면, 짝수/홀수 인터리빙이 제 1 및 제 2 세트의 코딩된 비트들을 인터리빙하기 위해 적용될 수 있다. 제 1 및 제 2 코딩된 비트들을 인터리빙함으로써 제 3 세트의 코딩된 비트들을 생성한 후, 제 3 세트의 코딩된 비트들이 송신될 수 있다. 제 3 세트의 코딩된 비트들은 인터리빙에 따라서 서브프레임의 제 1 타임 슬롯 및 제 2타임 슬롯에서 송신될 수 있다.
도 4는 본 개시물의 다양한 양상들에 따르면 정보 비트들을 인코딩하기 위한 프로세스(400)의 플로우차트를 나타낸다. 블록(402)에서, 프로세스(400)는 정보 비트들을 제 1 및 제 2 세트들의 정보 비트들로 분할한다. 프로세스(400)는, 제 1 세트의 정보 비트들이 제 1 세트의 코딩된 비트들로 인코딩되고, 제 2 세트의 정보 비트들이 제 2 세트의 코딩된 비트들로 인코딩되는 블록(404)에서 계속된다. 예를 들어, 표준-정의된 2개의 (32, 0) 블록 코드 인코더들은 정보 비트들을 인코딩하는데 이용될 수 있다. 이에 따라, 2개 세트들의 32개의 코딩된 비트들이 생성된다. 프로세스(400)는, 제 1 세트의 코딩된 비트들 및 제 2 세트의 코딩된 비트들은 제 1 세트의 레이트-매칭된 코딩된 비트들 및 제 2세트의 레이트-매칭된 코딩된 비트들을 생성하기 위해 정의된 수의 비트들로 레이트 매칭되는 블록(406)에서 계속된다. 프로세스(400)는, 제 1 및 제 2 세트들의 레이트-매칭된 코딩된 비트들이 인터리빙되어 인터리빙된 세트의 코딩된 비트들을 생성하는, 블록(408)에서 계속된다.
도 5는 본 개시물의 일 양상에 따라서 구성된 UE(120)의 블록도 표현이다. UE(120)는 업링크 제어 정보를 인코딩하기 위해 인코딩 프로세스(500)를 포함한다. 신호 분할기(501)는 입력 정보 비트들을 인코딩 프로세스(500)에 의해 프로세스하기 위한 2개의 세트들로 분할한다. 인코딩 프로세스(500)는 2개의 (32, 0) 블록 코드 인코더들(502a, 502b)을 이용하여 UE(120) 내에서 동작하며, 여기서 0은 인코더로의 입력 비트들의 수를 나타낸다. 예를 들어, 제 1 세트의 A개의 정보 비트들 b(0), b(1),..., b(A-1)은 인코더(502a)에 입력되고, 제 2 세트의 B개의 정보 비트들 b(A), b(A+1),..., b(A+B-1)은 인코더(502b)에 입력된다. A와 B는 동일하거나 상이할 수 있다. 일 양상에서, (32, 0) 인코더(502a, 502b)는 표준-정의된 인코더이다. 인코더(502a)는 레이트 매칭 모듈(504a)에 32개의 코딩된 비트들 c(0), c(1),..., c(31)을 출력하고, 인코더(502b)는 레이트 매칭 모듈(504b)에 32개의 코딩된 비트들 c(32), c(33),..., c(63)을 출력한다.
코딩된 비트들 c(0), c(1),..., c(31)은 레이트 매칭 모듈(504a)에 의해 24개의 비트들 c'(0), c'(1),..., c'(23)로 레이트 매칭되고, 코딩된 비트들 c(32), c(33),..., c(63)은 레이트 매칭 모듈(504b)에 의해 24개의 비트들 c'(24), c'(25),..., c'(47)로 레이트 매칭된다. 결과로 나타나는 레이트-매칭된 코딩된 비트들은, 48개의 인터리빙된-그리고-코딩된 비트들 d(0), d(l),..., d(47) 중 코딩된 비트들 c'(0), c'(1),..., c'(23) 및 코딩된 비트들 c'(24), c'(25),..., c'(47)를 분배하는 인터리버(508)로 입력된다. 이에 따라, 최종 48개의 코딩된 비트들 중 24개는 서브프레임의 하나의 타임 슬롯에서 송신될 수 있고, 최종 48개의 코딩된 비트들 중 다른 24개는 서브프레임의 제 2 타임 슬롯에서 송신될 수 있다. 따라서, 각각의 정보 비트는 슬롯-바운더리 주파수 호핑 방식으로 다이버시티를 즐길 수 있다.
또한, 일 양상에서, 채널 코딩을 위한 전술한 기술들이, 예를 들어, HARQ-ACK 정보와 같은 제어 정보를 포함하는 PUSCH에서 송신되는 정보에 대해 구현될 수 있다. HARQ-ACK에 대한 채널 코딩 정보는, 참조에 의해 본원에 통합된, 3GPP TS 36.212 기술 사양에 위치된다. 앞선 도 5와 유사하게, 정보 비트들은 2개 세트들의 코딩된 비트들을 생성하기 위해 인코더에 각각 입력되는 2개의 시퀀스들의 비트들로 분할될 수 있다. 각각의 세트의 코딩된 비트들은 2개의 개별적인 레이트-매칭된 코드블록들을 생성하기 위해 미리결정된 수의 비트들로 레이트 매칭된다. 개별적인 레이트-매칭된 코드블록들은 인터리버에 의해 인터리빙될 수 있다. 그러나, PUSCH에서 "체커-보드(checker-board)" 또는 교번 패턴을 생성하도록 변조 심볼 레벨에서 인터리빙이 수행될 수 있다. 매핑될 변조 심볼들의 수는 예를 들어 PUSCH의 스펙트럼 효율에 의존하여 변화할 수 있다는 것에 유의해야 한다.
일 양상에 따르면, 변조 심볼들은 '체커-보드' 또는 교번 패턴으로 대안적으로 매핑될 수 있다.
제 2 양상에 따르면, 변조 심볼들은 제 1 실시예에서와 같이 매핑될 수 있지만, 변조 심볼들은 별도의 QAM 심볼들 내의 2개의 개별적인 레이트-매칭된 코드블록들로부터 정보 비트들을 유지하면서, 레이트-매칭된 코드 블록 입력 정보 비트들
Figure pct00001
및
Figure pct00002
로 대략적으로 비례하여 분할될 수 있다.
제 3 양상에 따르면, 변조 심볼-레벨 인터리빙은 '체커-보드' 또는 교번 패턴을 초래할 수 있다.
PUSCH 상에서 변조를 위한 예시적인 양상들과 관련된 추가적인 세부사항들이 HARQ-ACK 정보의 11개 초과 비트들의 채널 코딩을 위한 (의사 코드(pseudo code)를 포함하는) 텍스트 제안(text proposal)으로 이하 설명된다. 약어들이 TS 36.212의 대응 섹션 5.2.2.6에 정의되며, 그 전체는 본원에 참조로 통합된다.
채널 코딩 블록에 입력된 HARQ-ACK 비트들은,
Figure pct00003
로 나타나며, 여기서
Figure pct00004
은 비트들의 수이다.
비트들의 시퀀스들
Figure pct00005
및
Figure pct00006
은 후술하는 바와 같이 인코딩된다.
Figure pct00007
그리고
Figure pct00008
여기서 i = 0, 1, 2,..., 31 이며, 기본 시퀀스들
Figure pct00009
이 TS 36.212의 표 5.2.2.6.4-1 에서와 같이 정의된다.
출력 비트 시퀀스
Figure pct00010
는 후술하는 바와 같이 비트 시퀀스들
Figure pct00011
및
Figure pct00012
의 연쇄(concatenation) 및 순환 반복(circular repetition)에 의해 획득된다.
제 1 대안적인 양상:
Figure pct00013
제 2 대안적인 양상:
Figure pct00014
제 3 대안적인 양상:
Figure pct00015
Figure pct00016
도 6은 업링크 공유 채널을 통한 예시적인 송신(600)을 도시한다. 송신(600)은 수평 방향에서 SC-FDM 심볼들을 도시하고 수직 방향에서 각각의 SC-FDM 심볼에 대한 시간 변조된 심볼들을 도시한다. 도시된 바와 같이, 기준 신호(RS)는 2개의 SC-FDM 심볼들에서 송신될 수 있다. RS는 복조 기준 신호로 지칭될 수 있다. 이 예에서, 제 1 및 제 2 레이트-매칭된 코드블록들로부터의 Q'=20 (HARQ-ACK에 대한 코딩된 심볼들의 전체 수) 및 코딩된 비트들 Qm(예를 들어, 2, 4, 6 등)의 수는 이용된 변조 순서에 의존할 수 있다. 송신(600)은 제 1 레이트-매칭된 코드블록(602)으로부터의 코딩된 비트들 및 제 2 레이트-매칭된 코드블록(604)으로부터의 코딩된 비트들이 변조 심볼 레벨에서 인터리빙되고 '체커-보드' 또는 교번 패턴으로 매핑되는 것으로 예시된다. 즉, 각각의 SC-FDM 심볼(610, 612, 614, 616)에서, 제 1 레이트-매칭된 코드블록으로부터의 코딩된 비트들(602) 및 제 2 레이트-매칭된 코드블록으로부터의 코딩된 비트들(604)의 교번 패턴이 존재한다. 4개의 SC-FDM 심볼들에 대한 짝수 타임 인덱스에서의 교번 패턴들은 동일할 수 있고, 그리고 4개의 SC-FDM 심볼들에 대한 홀수 타임 인덱스에서의 교번 패턴들도 동일할 수 있다.
본 개시물은 사용자 장비(UE)와 같은 장치 또는 하나 또는 둘 이상의 프로세서들을 갖는 e Node B(eNB)에서 구현될 수 있다. 도 5을 다시 참조하여, UE(120)는 동작들을 실행하고 UE(120)의 기능 및 동작을 제공하는 컴포넌트들을 제어하는 컨트롤러/프로세서(1280)를 포함한다. 컨트롤러/프로세서(1280)는 복수의 정보 비트들을 제 1 세트의 정보 비트들 및 제 2 세트의 정보 비트들로 분할하기 위한 수단을 제공하는 신호 분할기(501)를 제어한다. 또한, 컨트롤러/프로세서(1280)는 제 1 세트의 정보 비트들을 제 1 세트의 코딩된 비트들로 인코딩하기 위한 수단을 제공하기 위해 블록 코드 인코더들(502a 및 502b)을 제어한다. UE(120)는 또한 제 1 및 제 2 세트들의 레이트-매칭된 코딩된 비트들을 생성하는 정의된 수의 비트들로 제 1 및 제 2 세트들의 코딩된 비트들을 레이트 매칭하기 위한 수단을 제공하는 레이트 매칭 모듈들(504a 및 504b)을 포함한다. 컨트롤러/프로세서(1280)에 의해 제어된 인터리버(508)는 인터리빙된 세트의 코딩된 비트들을 생성하기 위해 제 1 및 제 2 세트의 레이트-매칭된 코딩된 비트들을 인터리빙하기 위한 수단을 제공한다. 컨트롤러/프로세서(1280)를 포함하는 임의의 또는 모든 프로세서들은 단일 프로세서로 통합될 수 있다. 이 기능들은 디지털 신호 프로세서들(DSP) 및 주문형 집적 회로들(ASIC)과 같은 디바이스들을 포함하는 디지털 또는 아날로그 회로에 의해 대안적으로 수행될 수 있다.
당업자들은 정보 및 신호들이 임의의 다양한 상이한 기술들 및 기법들을 이용하여 표현될 수 있다는 것을 이해할 것이다. 예를 들어, 전술한 설명을 통해서 참조될 수 있는 데이터, 명령들, 커맨드들, 정보, 신호들, 비트들, 심볼들 및 칩들은 전압들, 전류들, 전자기파들, 자기장들 또는 자기 입자들, 광 필드들 또는 광 입자들, 또는 이들의 임의의 결합에 의해 표현될 수 있다.
당업자들은 본원의 개시물과 관련하여 설명된 다양한 예시적인 논리 블록들, 모듈들, 및 알고리즘 단계들이 전자 하드웨어, 컴퓨터 소프트웨어 또는 이들의 조합에 의해 구현될 수 있다는 것을 더 이해할 것이다. 하드웨어 및 소프트웨어의 이러한 상호 호환성을 명확하게 설명하기 위해, 다양한 예시적인 컴포넌트들, 블록들, 모듈들, 회로들, 단계들이 이들의 기능과 관련하여 위에서 일반적으로 설명되었다. 이러한 기능이 하드웨어 또는 소프트웨어로서 구현되는지 여부는 특정한 애플리케이션 및 전체 시스템에 대하여 부과되는 설계 제약들에 따라 좌우된다. 당업자들은 각각의 특정한 애플리케이션에 대하여 다양한 방식들로 설명된 기능을 구현할 수 있으나, 이러한 구현 결정들은 본 개시물의 범위를 벗어나는 것으로 해석되어서는 안 될 것이다.
본원의 개시물과 관련하여 설명된 다양한 예시적인 논리 블록들, 모듈들 및 회로들은 범용 프로세서, 디지털 신호 프로세서(DSP), 주문형 집적 회로(ASIC), 필드 프로그래머블 게이트 어레이(FPGA) 또는 다른 프로그래머블 로직 디바이스, 이산 게이트 또는 트랜지스터 로직, 이산 하드웨어 컴포넌트들 또는 본원에서 설명된 기능들을 수행하도록 설계된 이들의 임의의 조합을 통해 구현되거나 또는 수행될 수 있다. 범용 프로세서는 마이크로프로세서일 수 있지만, 대안적으로 이 범용 프로세서는 임의의 기존의 프로세서, 컨트롤러, 마이크로컨트롤러 또는 상태 머신일 수 있다. 프로세서는 또한 컴퓨팅 디바이스들의 조합, 예를 들어, DSP 및 마이크로프로세서의 조합, 복수의 마이크로프로세서들, DSP 코어와 연결된 하나 또는 둘 이상의 마이크로프로세서들 또는 임의의 다른 이러한 구성으로서 구현될 수 있다.
본원의 개시물과 관련하여 설명된 방법 또는 알고리즘의 단계들은 직접 하드웨어로 구현되거나, 프로세서에 의해 실행되는 소프트웨어 모듈로 구현되거나, 또는 이 둘의 조합에 의해 구현될 수 있다. 소프트웨어 모듈은 RAM 메모리, 플래시 메모리, ROM 메모리, EPROM 메모리, EEPROM 메모리, 레지스터들, 하드 디스크, 탈착식 디스크, CD-ROM, 또는 당업계에 공지된 저장 매체 임의의 다른 형태로 상주할 수 있다. 예시적인 저장 매체는, 프로세서가 저장 매체로부터 정보를 판독하고 저장 매체에 정보를 기록할 수 있도록, 프로세서에 커플링될 수 있다. 대안적으로, 저장 매체는 프로세서에 통합될 수 있다. 프로세서 및 저장 매체는 ASIC 내에 상주할 수 있다. ASIC는 사용자 단말 내에 상주할 수 있다. 대안적으로, 프로세서 및 저장 매체는 사용자 단말 내에 이산 컴포넌트들로서 상주할 수 있다.
하나 또는 둘 이상의 예시적인 설계들에서, 설명된 기능들은 하드웨어, 소프트웨어, 펌웨어 또는 이들의 임의의 조합으로 구현될 수 있다. 소프트웨어로 구현되는 경우, 상기 기능들은 컴퓨터-판독가능 매체 상의 하나 또는 둘 이상의 명령들 또는 코드로서 저장되거나 또는 이들을 통해 송신될 수 있다. 컴퓨터-판독가능 매체는 컴퓨터 저장 매체 및 한 장소에서 다른 장소로 컴퓨터 프로그램의 전달을 용이하게 하는 임의의 유형의 매체를 포함하는 비-일시적인 컴퓨터 저장 매체 및 통신 매체 모두를 포함한다. 비-일시적인 저장 매체는 범용 또는 특수 목적 컴퓨터에 의해 액세스될 수 있는 임의의 이용가능한 매체일 수 있다. 한정이 아닌 예시에 의해, 이러한 비-일시적인 컴퓨터-판독가능 매체는 RAM, ROM, EEPROM, CD-ROM 또는 다른 광학 디스크 스토리지, 자기 디스크 스토리지 또는 다른 자기 저장 디바이스들, 또는 명령들 또는 데이터 구조들의 형태로 원하는 프로그램 코드 수단을 운반하거나 또는 저장하기 위해 사용될 수 있고 범용 또는 특수-목적 컴퓨터, 또는 범용 또는 특수-목적 프로세서에 의해 액세스될 수 있는 임의의 다른 매체를 포함할 수 있다. 본원에 사용되는 디스크(disk) 및 디스크(disc)는 콤팩트 디스크(CD: compact disc), 레이저 디스크(laser disc), 광학 디스크(optical disc), 디지털 다기능 디스크(DVD: digital versatile disc), 플로피 디스크(floppy disk) 및 블루-레이 디스크(blu-ray disc)를 포함하며, 여기서 디스크(disk)들은 통상적으로 자기적으로 데이터를 재생하는 반면에 디스크(disc)들은 레이저들을 통해 데이터를 광학적으로 재생한다. 전술한 것들의 조합들이 또한 컴퓨터-판독가능 매체의 범위 내에 포함되어야 할 것이다.
본 개시의 이전의 설명은 당업자가 본 개시를 이용하거나 또는 실시할 수 있도록 제공된다. 이 개시에 대한 다양한 변형들은 당업자들에게 용이하게 명백할 것이며, 본원에 설명된 신규의 양상들은 본 발명의 범위 또는 사상을 벗어나지 않고 다른 실시예들에 적용될 수 있다. 그리하여, 본 개시는 본원에 설명된 예시들 및 설계들로 제한되는 것으로 의도되지 않지만, 본원에 개시된 원리들 및 신규한 특징들과 일관되는 최광의의 범위에 부합할 것이다.

Claims (30)

  1. 무선 통신을 위한 방법으로서,
    복수의 정보 비트들을 제 1 세트의 정보 비트들 및 제 2 세트의 정보 비트들로 분할하는 단계;
    제 1 세트의 코딩된 비트들로 상기 제 1 세트의 정보 비트들을 인코딩하는 단계;
    제 2 세트의 코딩된 비트들로 상기 제 2 세트의 정보 비트들을 인코딩하는 단계;
    제 1 세트의 레이트-매칭된 코딩된 비트들 및 제 2 세트의 레이트-매칭된 코딩된 비트들을 생성하기 위해 상기 제 1 세트의 코딩된 비트들 및 상기 제 2 세트의 코딩된 비트들을 정의된 수의 비트들로 레이트 매칭(rate matching)하는 단계; 및
    인터리빙된 세트의 코딩된 비트들을 생성하기 위해 상기 제 1 세트의 레이트-매칭된 코딩된 비트들 및 상기 제 2세트의 레이트-매칭된 코딩된 비트들을 인터리빙하는 단계를 포함하는, 무선 통신을 위한 방법.
  2. 제 1 항에 있어서,
    상기 제 1 세트의 정보 비트들을 인코딩하는 단계는 블록 코드를 이용하여 상기 제 1 세트의 정보 비트들을 인코딩하는 단계를 포함하고,
    상기 제 2 세트의 정보 비트들을 인코딩하는 단계는 상기 블록 코드를 이용하여 상기 제 2 세트의 정보 비트들을 인코딩하는 단계를 포함하는, 무선 통신을 위한 방법.
  3. 제 2 항에 있어서,
    상기 블록 코드는 (32, O) 블록 코드를 포함하는, 무선 통신을 위한 방법.
  4. 제 1 항에 있어서,
    물리적 업링크 공유 채널(PUSCH) 상에서 상기 인터리빙된 세트의 코딩된 비트들을 송신하는 단계를 더 포함하는, 무선 통신을 위한 방법.
  5. 제 4 항에 있어서,
    상기 제 1 세트의 코딩된 비트들 및 상기 제 2 세트의 코딩된 비트들을 레이트 매칭하기 위한 상기 정의된 수의 비트들은, 상기 PUSCH의 스펙트럼 효율에 적어도 부분적으로 기초하는 수(number)를 포함하는, 무선 통신을 위한 방법.
  6. 제 4 항에 있어서,
    상기 인터리빙하는 단계는 상기 제 1 세트의 코딩된 비트들 및 상기 제 2세트의 코딩된 비트들을 연쇄시키는(concatenating) 단계를 포함하는, 무선 통신을 위한 방법.
  7. 제 1 항에 있어서,
    물리적 업링크 제어 채널(PUCCH) 상에서 상기 인터리빙된 세트의 코딩된 비트들을 송신하는 단계를 더 포함하는, 무선 통신을 위한 방법.
  8. 제 7 항에 있어서,
    상기 제 1 세트의 코딩된 비트들 및 상기 제 2 세트의 코딩된 비트들을 레이트 매칭하는데 이용된 상기 정의된 수의 비트들은 48 비트인, 무선 통신을 위한 방법.
  9. 제 7 항에 있어서,
    상기 인터리빙하는 단계는: 비트-레벨 인터리빙 및 심볼-레벨 인터리빙 중 하나를 포함하는, 무선 통신을 위한 방법.
  10. 제 1 항에 있어서,
    하이브리드 자동 반복 요청(HARQ)-확인응답(ACK) 정보에 대응하는 복수의 정보 비트들을 제공하는 단계를 더 포함하는, 무선 통신을 위한 방법.
  11. 컴퓨터 프로그램 물건으로서,
    상기 컴퓨터 프로그램 물건은 프로그램 코드가 기록된 비-일시적 컴퓨터-판독가능 저장 매체를 포함하고,
    상기 프로그램 코드는:
    복수의 정보 비트들을 제 1 세트의 정보 비트들 및 제 2 세트의 정보 비트들로 분할하기 위한 프로그램 코드;
    제 1 세트의 코딩된 비트들로 상기 제 1 세트의 정보 비트들을 인코딩하기 위한 프로그램 코드;
    제 2 세트의 코딩된 비트들로 상기 제 2 세트의 정보 비트들을 인코딩하기 위한 프로그램 코드;
    상기 제 1 세트의 코딩된 비트들 및 상기 제 2 세트의 코딩된 비트들을 정의된 수의 비트들로 레이트 매칭(rate match)하기 위한 프로그램 코드; 및
    인터리빙된 세트의 코딩된 비트들을 생성하기 위해 상기 제 1 세트의 코딩된 비트들 및 상기 제 2 세트의 코딩된 비트들을 인터리빙하기 위한 프로그램 코드를 포함하는, 컴퓨터 프로그램 물건.
  12. 제 11 항에 있어서,
    상기 제 1 세트의 정보 비트들을 인코딩하기 위한 상기 프로그램 코드는, 블록 코드를 이용하여 상기 제 1 세트의 정보 비트들을 인코딩하기 위한 프로그램 코드를 포함하고,
    상기 제 2 세트의 정보 비트들을 인코딩하기 위한 상기 프로그램 코드는, 상기 블록 코드를 이용하여 상기 제 2 세트의 정보 비트들을 인코딩하기 위한 프로그램 코드를 포함하는, 컴퓨터 프로그램 물건.
  13. 제 11 항에 있어서,
    상기 프로그램 코드는, 물리적 업링크 공유 채널(PUSCH) 상에서 상기 인터리빙된 세트의 코딩된 비트들을 송신하기 위한 프로그램 코드를 더 포함하는, 컴퓨터 프로그램 물건.
  14. 제 13 항에 있어서,
    상기 제 1 세트의 코딩된 비트들 및 상기 제 2 세트의 코딩된 비트들을 레이트 매칭하는데 이용하기 위한 상기 정의된 수의 비트들은, 상기 PUSCH의 스펙트럼 효율에 적어도 부분적으로 기초하는 수(number)를 포함하는, 컴퓨터 프로그램 물건.
  15. 제 11 항에 있어서,
    상기 프로그램 코드는 물리적 업링크 제어 채널(PUCCH) 상에서 상기 인터리빙된 세트의 코딩된 비트들을 송신하기 위한 프로그램 코드를 더 포함하고,
    상기 인터리빙하기 위한 프로그램 코드는: 비트-레벨 인터리빙하기 위한 프로그램 코드 및 심볼-레벨 인터리빙하기 위한 프로그램 코드 중 하나를 포함하는, 컴퓨터 프로그램 물건.
  16. 무선 통신을 위해 구성된 장치로서,
    상기 장치는, 메모리에 커플링된 적어도 하나의 프로세서를 포함하고,
    상기 적어도 하나의 프로세서는:
    복수의 정보 비트들을 제 1 세트의 정보 비트들 및 제 2 세트의 정보 비트들로 분할하고;
    상기 제 1 세트의 정보 비트들을 제 1 세트의 코딩된 비트들로 인코딩하고;
    상기 제 2 세트의 정보 비트들을 제 2 세트의 코딩된 비트들로 인코딩하고;
    상기 제 1 세트의 코딩된 비트들 및 상기 제 2 세트의 코딩된 비트들을 정의된 수의 비트들로 레이트 매칭(rate match)하고; 그리고
    인터리빙된 세트의 코딩된 비트들을 생성하기 위해 상기 제 1 세트의 코딩된 비트들 및 상기 제 2 세트의 코딩된 비트들을 인터리빙하도록
    구성되는, 무선 통신을 위해 구성된 장치.
  17. 제 16 항에 있어서,
    상기 적어도 하나의 프로세서는 물리적 업링크 공유 채널(PUSCH) 상에서 상기 인터리빙된 세트의 코딩된 비트들을 송신하도록 더 구성되는, 무선 통신을 위해 구성된 장치.
  18. 제 17 항에 있어서,
    상기 제 1 세트의 코딩된 비트들 및 상기 제 2 세트의 코딩된 비트들을 레이트 매칭하기 위해 사용된 상기 정의된 수의 비트들은, 상기 PUSCH의 스펙트럼 효율에 적어도 부분적으로 기초하는 수(number)를 포함하는, 무선 통신을 위해 구성된 장치.
  19. 제 16 항에 있어서,
    상기 적어도 하나의 프로세서는 물리적 업링크 제어 채널(PUCCH) 상에서 상기 인터리빙된 세트의 코딩된 비트들을 송신하도록 더 구성되는, 무선 통신을 위해 구성된 장치.
  20. 제 19 항에 있어서,
    상기 적어도 하나의 프로세서는: 비트-레벨 인터리빙 및 심볼-레벨 인터리빙 중 하나를 하도록 더 구성되는, 무선 통신을 위해 구성된 장치.
  21. 무선 통신을 위한 장치로서,
    복수의 정보 비트들을 제 1 세트의 정보 비트들 및 제 2 세트의 정보 비트들로 분할하기 위한 수단;
    제 1 세트의 코딩된 비트들로 상기 제 1 세트의 정보 비트들을 인코딩하기 위한 수단;
    제 2 세트의 코딩된 비트들로 상기 제 2 세트의 정보 비트들을 인코딩하기 위한 수단;
    상기 제 1 세트의 코딩된 비트들 및 상기 제 2 세트의 코딩된 비트들을 정의된 수의 비트들로 레이트 매칭(rate matching)하여 제 1 세트의 레이트-매칭된 코딩된 비트들 및 제 2 세트의 레이트-매칭된 코딩된 비트들을 생성하기 위한 수단; 및
    인터리빙된 세트의 코딩된 비트들을 생성하기 위해 상기 제 1 세트의 레이트-매칭된 코딩된 비트들 및 상기 제 2 세트의 레이트-매칭된 코딩된 비트들을 인터리빙하기 위한 수단을 포함하는, 무선 통신을 위한 장치.
  22. 제 21 항에 있어서,
    상기 제 1 세트의 정보 비트들을 인코딩하기 위한 수단은 블록 코드를 이용하여 상기 제 1 세트의 정보 비트들을 인코딩하기 위한 수단을 더 포함하고,
    상기 제 2 세트의 정보 비트들을 인코딩하기 위한 수단은 상기 블록 코드를 이용하여 상기 제 2 세트의 정보 비트들을 인코딩하기 위한 수단을 더 포함하는, 무선 통신을 위한 장치.
  23. 제 22 항에 있어서,
    상기 블록 코드는 (32, O) 블록 코드를 포함하는, 무선 통신을 위한 장치.
  24. 제 21 항에 있어서,
    물리적 업링크 공유 채널(PUSCH) 상에서 상기 인터리빙된 세트의 코딩된 비트들을 송신하기 위한 수단을 더 포함하는, 무선 통신을 위한 장치.
  25. 제 24 항에 있어서,
    상기 제 1 세트의 코딩된 비트들 및 상기 제 2 세트의 코딩된 비트들을 레이트 매칭하기 위한 수단에 이용된 상기 정의된 수의 비트들은, 상기 PUSCH의 스펙트럼 효율에 적어도 부분적으로 기초하는 수(number)를 포함하는, 무선 통신을 위한 장치.
  26. 제 24 항에 있어서,
    상기 인터리빙하기 위한 수단은, 상기 제 1 세트의 코딩된 비트들 및 상기 제 2 세트의 코딩된 비트들을 연쇄시키기 위한 수단을 포함하는, 무선 통신을 위한 장치.
  27. 제 21 항에 있어서,
    물리적 업링크 제어 채널(PUCCH) 상에서 상기 인터리빙된 세트의 코딩된 비트들을 송신하기 위한 수단을 더 포함하는, 무선 통신을 위한 장치.
  28. 제 27 항에 있어서,
    상기 제 1 세트의 코딩된 비트들 및 상기 제 2 세트의 코딩된 비트들을 레이트 매칭하는데 이용된 상기 정의된 수의 비트들은 48 비트인, 무선 통신을 위한 장치.
  29. 제 27 항에 있어서,
    상기 인터리빙하기 위한 수단은: 비트-레벨 인터리빙을 위한 수단 및 심볼-레벨 인터리빙을 위한 수단 중 하나를 포함하는, 무선 통신을 위한 장치.
  30. 제 21 항에 있어서,
    하이브리드 자동 반복 요청(HARQ)-확인응답(ACK) 정보에 대응하는 복수의 정보 비트들을 제공하기 위한 수단을 더 포함하는, 무선 통신을 위한 장치.
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