KR20120045949A - 적층형 인덕터 및 그 제조방법 - Google Patents

적층형 인덕터 및 그 제조방법 Download PDF

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Abstract

본 발명은 적층형 인덕터 및 그 제조방법에 관한 것으로, 본 발명에 따른 적층형 인덕터는 비자성 및 자성 중 어느 하나의 특성을 갖는 인덕터 본체; 상기 인덕터 본체에 형성된 도체 패턴 및 도전성 비아를 갖는 코일부; 및 상기 코일부의 내부에 형성되며, 비자성 및 자성 중 상기 인덕터 본체와 반대의 특성을 갖는 코어부;를 포함한다.

Description

적층형 인덕터 및 그 제조방법{A layered inductor and a manufacturing method thereof}
본 발명은 적층형 인덕터 및 그 제조방법에 관한 것으로, 보다 구체적으로는 우수한 전기적 특성을 가지며, 양산이 용이한 적층형 인덕터 및 그 제조방법에 관한 것이다.
인덕터는 저항, 커패시터와 더불어 전자 회로를 이루는 중요한 수동 소자 중의 하나로써, 노이즈(noise)를 제거하거나 LC 공진 회로를 이루는 부품으로 사용된다. 이러한 인덕터는 페라이트(ferrite) 코어에 코일을 감거나 인쇄를 하고 양단에 전극을 형성하여 제조되거나 자성체 또는 유전체에 내부 전극을 인쇄한 후 적층하여 제조될 수 있다.
인덕터는 구조에 따라서 적층형, 권선형, 박막형 등 여러 가지로 분류할 수 있는데, 이 중에서도 적층형이 널리 보급되는 추세이다. 적층형 인덕터는 다수의 (페라이트 또는 저율전율의 유전체로 이루어진) 세라믹 시트들이 적층된 적층체 형태로 제조된다. 세라믹 시트 상에는 코일 형태의 금속 패턴이 형성되어 있는데, 각각의 세라믹 시트 상에 형성된 코일 형태의 금속 패턴은 각 세라믹 시트에 형성된 도전성 비아에 의해 순차적으로 접속되고, 적층방향에 따라 중첩되어 나선구조를 갖는 코일을 이룬다. 상기 코일의 양단은 적층체의 외부면에 인출되어 외부단자와 접속된다.
적층형 인덕터는 칩 형태의 별개 부품으로 제조될 수도 있고, 기판에 내장된 상태로 다른 모듈과 함께 형성될 수도 있다.
일반적인 적층형 인덕터는 금속 패턴이 형성된 복수의 자성체 층을 적층한 구조를 가지며, 상기 금속 패턴은 각 자성체 층에 형성된 비아 전극에 의해 순차적으로 접속되어 적층 방향에 따라 중첩되면서 나선구조를 갖는 코일을 이룬다.
이러한 적층형 인덕터의 코일은 자성체로 둘러싸여 있으므로, 고전류가 인가되면 코일 주변의 자성체가 자화되는 경향이 있다. 코일 주변이 자화됨으로써, 인덕터의 인덕턴스(L) 값을 변화시켜 인덕터의 용량 특성을 저해하는 문제점이 있다.
본 발명은 우수한 전기적 특성을 가지며, 양산이 용이한 적층형 인덕터 및 그 제조방법을 제공하는 것이다.
본 발명의 일 실시형태는 비자성 및 자성 중 어느 하나의 특성을 갖는 인덕터 본체; 상기 인덕터 본체에 형성된 도체 패턴 및 도전성 비아를 갖는 코일부; 및 상기 코일부의 내부에 형성되며, 비자성 및 자성 중 상기 인덕터 본체와 반대의 특성을 갖는 코어부;를 포함하는 적층형 인덕터를 제공한다.
상기 인덕터 본체는 비자성의 특성을 가지며, 상기 코어부는 자성의 특성을 가질 수 있다.
상기 인덕터 본체는 자성의 특성을 가지며, 상기 코어부는 비자성의 특성을 가질 수 있다.
상기 코어부는 상기 코일부의 내부를 관통하는 코어, 상기 인덕터 본체의 하부에 형성된 하부 커버시트 및 상기 인덕터 본체의 상부에 형성되는 상부 커버시트로 구성될 수 있다.
본 발명의 다른 실시형태는 도체 패턴 및 도전성 비아가 형성되며, 비자성 및 자성 중 어느 하나의 특성을 갖는 복수 개의 시트를 마련하는 단계; 상기 각 시트에 형성된 도체 패턴의 일단이 인접하는 시트에 형성된 도전성 비아와 접촉하여 코일부가 형성되도록 상기 복수 개의 시트를 적층하여 인덕터 본체를 형성하는 단계; 상기 코일부의 내부를 관통하는 관통 홀을 형성하는 단계; 및 상기 관통 홀에 비자성 및 자성 중 상기 인덕터 본체와 반대의 특성을 갖는 코어부를 형성하는 단계;를 포함하는 적층형 인덕터의 제조방법을 제공한다.
상기 적층형 인덕터의 제조방법에 있어서, 상기 코어부를 형성하는 단계는 상기 인덕터 본체의 하부에 하부 커버시트를 적층하고, 상기 코일부의 내부를 관통하는 코어를 충진하며, 상기 인덕터 본체의 상부에 상부 커버시트를 적층하여 수행될 수 있다.
본 발명의 또 다른 실시형태는 도전 패턴 및 도전성 비아와 상기 도전 패턴의 내측에 관통 홀이 형성되며, 비자성 및 자성 중 어느 하나의 특성을 갖는 복수 개의 시트를 마련하는 단계; 상기 각 시트에 형성된 도체 패턴의 일단이 인접하는 시트에 형성된 도전성 비아와 접촉하여 코일부가 형성되도록 상기 복수 개의 시트를 적층하여 인덕터 본체를 형성하는 단계; 및 상기 관통 홀에 비자성 및 자성 중 상기 인덕터 본체와 반대의 특성을 갖는 코어부를 형성하는 단계;를 포함하는 적층형 인덕터의 제조방법을 제공한다.
상기 적층형 인덕터의 제조방법에 있어서, 상기 코어부를 형성하는 단계는 상기 인덕터 본체의 하부에 하부 커버시트를 적층하고, 상기 코일부의 내부를 관통하는 코어를 충진하며, 상기 인덕터 본체의 상부에 상부 커버시트를 적층하여 수행될 수 있다.
본 발명의 일 실시예에 따른 적층형 인덕터는 코일부의 내부는 자성의 특성을 갖고, 코일부의 외부는 비자성의 특성을 가지는 복합 구조로써, 권선형 인덕터와 유사한 형태를 갖는다. 본 실시예에 따른 적층형 인덕터는 코일부에 의하여 유도된 자속이 코어부로 집중되어 코일부의 주변이 자화되는 현상이 방지될 수 있다. 이에 따라 자성체의 자기포화에 의하여 인덕턴스가 저하되는 것을 방지할 수 있다.
또한, 본 발명의 다른 실시예에 따른 적층형 인덕터는 코일부의 내부는 비자성의 특성을 갖고, 코일부의 외부는 자성의 특성을 가지는 복합 구조로써, 자성체의 자기포화에 의하여 인덕턴스가 저하되는 것을 방지할 수 있다.
본 발명의 일 실시예에 따른 적층형 인덕터의 제조방법은 기존의 적층 공정을 이용할 수 있어 양산이 용이하며, 코일부의 내부 및 외부에 서로 다른 특성을 갖는 물질을 형성할 수 있다.
도 1a은 본 발명의 일 실시예에 따른 적층형 인덕터를 나타내는 개략적인 사시도이고, 도 1b는 도 1a의 A-A’선을 따라 취한 적층형 인덕터의 단면도이고, 도 1c는 도 1a에 도시된 적층형 인덕터를 나타내는 분해 사시도이다.
도 2는 본 발명의 다른 실시예에 따른 적층형 인덕터를 나타내는 개략적인 단면도이다.
도 3a 내지 도 3e는 본 발명의 일 실시예에 따른 적층형 인덕터의 제조방법을 설명하기 위한 공정별 단면도이다.
도 4는 본 발명의 일 실시예에 따른 적층형 인덕터의 DC 바이어스 특성을 나타내는 그래프이다.
이하, 첨부된 도면을 참조하여 본 발명의 바람직한 실시형태들을 설명한다. 다만, 본 발명의 실시형태는 여러 가지 다른 형태로 변형될 수 있으며, 본 발명의 범위가 이하 설명하는 실시형태로 한정되는 것은 아니다. 또한, 본 발명의 실시형태는 당업계에서 평균적인 지식을 가진 자에게 본 발명을 더욱 완전하게 설명하기 위해서 제공되는 것이다. 따라서, 도면에서의 요소들의 형상 및 크기 등은 보다 명확한 설명을 위해 과장될 수 있으며, 도면상의 동일한 부호로 표시되는 요소는 동일한 요소이다.
도 1a은 본 발명의 일 실시예에 따른 적층형 인덕터를 나타내는 개략적인 사시도이고, 도 1b는 도 1a의 A-A’선을 따라 취한 적층형 인덕터의 단면도이고, 도 1c는 도 1a에 도시된 적층형 인덕터를 나타내는 분해 사시도이다.
도 1a 내지 도 1c를 참조하면, 본 발명의 일 실시예에 따른 적층형 인덕터는 인덕터 본체(10), 상기 인덕터 본체에 형성된 코일부(20), 및 상기 코일부의 내부에 형성된 코어부(30)를 포함한다. 상기 인덕터 본체의 외부면에는 제1 및 제2 외부 전극(40a, 40b)이 형성될 수 있다.
상기 인덕터 본체(10)는 비자성의 특성을 가질 수 있고, 복수 개의 비자성체 시트(11)가 적층되어 형성될 수 있다.
상기 비자성체 시트(11)는 이에 제한되는 것은 아니나, 비자성체 분말, 바인더, 가소제 등을 볼 밀에 의해 분쇄 혼합하여 슬러리를 제조하고, 상기 슬러리를 시트 형태로 형성하여 마련될 수 있다.
인덕터 본체(10)를 형성하는 각 비자성체 시트(11)의 일면에는 도체 패턴(21)이 형성되고, 비자성체 시트의 두께 방향으로 관통되는 도전성 비아(V)가 형성된다. 각 비자성체 시트에 형성된 도체 패턴(21)의 일단은 인접하는 시트에 형성된 도전성 비아(V)와 접촉된다. 각 비자성체 시트에 형성된 도체 패턴(21)은 도전성 비아(V)에 의해 접속되어 주회하는 코일부(20)를 형성한다.
상기 도체 패턴(21)이 형성된 비자성체 시트(11)의 개수는 적층형 인덕터에 요구되는 인덕턴스 등의 전기적 특성에 따라서 결정될 수 있다.
상기 코일부(20)의 양단은 인덕터 본체의 외부로 인출되어 제1 및 제2 외부 전극(40a, 40b)과 각각 전기적으로 연결된다.
상기 도체 패턴(21)은 이에 제한되는 것은 아니나, 예를 들면 후막인쇄, 도포, 증착, 스퍼터링 등의 방법으로 형성될 수 있다. 또한, 상기 도전성 비아(V) 는 시트에 관통 구멍을 형성한 후, 그 관통 구멍에 도전성 페이스트 등을 충전함으로써 형성될 수 있다. 상기 도전성 페이스트는 Ag, Ag-Pd, Ni, Cu 등의 금속을 포함할 수 있다.
상기 코일부(20)의 내부에는 코어부(30)가 형성될 수 있다. 상기 코어부(30)는 인덕터 본체(10)와 다른 특성인 자성의 특성을 가질 수 있다. 상기 코어부(30)는 이에 제한되는 것은 아니나, 자성체 분말, 바인더, 가소제 등을 볼 밀에 의해 분쇄 혼합하여 슬러리를 제조하고, 상기 슬러리를 코어부 내부에 충진하여 형성될 수 있다.
상기 코어부(30)는 상기 인덕터 본체의 하부에 형성되는 하부커버 시트(32a), 코일부 내부를 관통하는 코어(31), 상기 인덕터 본체의 상부에 형성되는 상부 커버시트(32b)로 구성될 수 있다.
제1 및 제2 외부 전극(40a, 40b)은 인덕터 본체(10)의 외부면에 형성되는 것으로, 코일부(20)의 양단과 각각 전기적으로 연결된다.
상기 제1 및 제2 외부 전극(40a, 40b)은 도전성 페이스트에 인덕터 본체를 침지하는 방법, 인쇄 방법, 증착, 스퍼터링 등에 의해 형성될 수 있다. 상기 도전성 페이스트는 Ag, Ag-Pd, Ni, Cu 등의 금속을 포함할 수 있다. 또한, 상기 제1 및 제2 외부전극(40a, 40b)의 표면에는 Ni 도금층 및 Sn 도금층이 형성될 수 있다.
권선형 인덕터는 I자 단면의 코어에 코일이 권선되는 에어 갭(Air Gap)이 형성되고, 이에 의하여 우수한 DC 바이어스 특성을 갖는다.
그러나, 일반적으로 적층형 인덕터는 인덕터 본체 및 코일부 내부 모두가 자성체로 형성된다. 이러한 적층형 인덕터는 전류의 증가에 의하여 자성체의 자기 포화가 발생하고, 이에 따라 급격한 인덕턴스의 저하(DC 바이어스 특성 저하)가 발생한다.
본 실시예에 따른 적층형 인덕터는 코일부의 내부는 자성의 특성을 갖고, 코일부의 외부는 비자성의 특성을 가지는 복합 구조로써, 권선형 인덕터와 유사한 형태를 갖는다.
또한, 코일부에 의하여 유도된 자속은 코어부로 집중되어 코일부의 주변이 자화되는 현상을 방지할 수 있다.
즉, 자성체의 자기포화에 의하여 인덕턴스가 저하되는 것을 방지할 수 있다.
도 4는 본 실시예에 따른 적층형 인덕터의 DC 바이어스 특성을 나타내는 그래프이다. 이를 참조하면, 본 실시예에 따른 적층형 인덕터는 권선형 인덕터와 유사한 DC 바이어스 특성을 나타냄을 알 수 있다.
도 2는 본 발명의 다른 실시예에 따른 적층형 인덕터를 나타내는 개략적인 단면도이다. 상술한 실시예와 동일한 부호는 같은 구성을 나타내는 것으로, 다른 구성요소를 중심으로 설명한다.
도 2를 참조하면, 본 실시예에 따른 적층형 인덕터는 인덕터 본체(10), 상기 인덕터 본체의 형성된 코일부(20), 및 상기 코일부의 내부에 형성된 코어부(30)를 포함한다. 상기 인덕터 본체의 외부면에는 제1 및 제2 외부 전극(40a, 40b)이 형성될 수 있다.
상기 인덕터 본체(10)는 자성의 특성을 가질 수 있고, 복수 개의 자성체 시트가 적층되어 형성될 수 있다.
상기 코일부(20)의 내부에 형성된 코어부(30)는 인덕터 본체(10)와 다른 특성인 비자성의 특성을 가질 수 있다.
본 실시예에 따른 적층형 인덕터는 코일부의 내부는 비자성의 특성을 갖고, 코일부의 외부는 자성의 특성을 가지는 복합 구조로써, 자성체의 자기포화에 의하여 인덕턴스가 저하되는 것을 방지할 수 있다.
이하, 본 발명의 일 실시예에 따른 적층형 인덕터의 제조방법을 설명한다.
도 3a 내지 도 3e는 본 발명의 일 실시예에 따른 적층형 인덕터의 제조방법을 설명하기 위한 공정별 단면도이다.
우선, 도 3a에 도시된 바와 같이, 비자성체 시트(11)에 도체 패턴(21) 및 도전성 비아(미도시)를 형성한다. 상기 도체 패턴(21)은 이에 제한되는 것은 아니나, 예를 들면 후막인쇄, 도포, 증착, 스퍼터링 등의 방법으로 형성될 수 있다. 또한, 도전성 비아(미도시)는 비자성체 시트(11)에 관통 구멍을 형성한 후, 그 관통 구멍에 도전성 페이스트 등을 충전함으로써 형성될 수 있다. 상기 도전성 페이스트는 Ag, Ag-Pd, Ni, Cu 등의 금속을 포함할 수 있다.
이후, 도 3b에 도시된 바와 같이, 복수 개의 비자성체 시트(11)를 적층하여 인덕터 본체(10)를 형성한다. 이에 따라, 비자성의 특성을 갖는 인덕터 본체가 형성된다.
이때, 상기 각 시트에 형성된 도체 패턴(21)의 일단이 인접하는 시트에 형성된 도전성 비아와 접촉되도록 적층하여, 도체 패턴(21)이 도전성 비아에 의해 접속되어 주회하는 코일부(20)를 형성한다.
이후, 도 3c에 도시된 바와 같이, 코일부(20)의 내부에 관통 홀(h)을 형성한다. 상기 관통 홀(h)은 이에 제한되는 것은 아니나, 예를 들면 레이저 또는 펀칭기를 이용하여 형성할 수 있다.
도 3d 및 도 3e에 도시된 바와 같이, 하부 커버시트(32a)상에 관통 홀(h)이 형성된 인덕터 본체(10)를 적층한다. 이후, 코일부의 내부에 형성된 관통 홀에 자성체를 충진시켜 코어(31)를 형성한다. 상기 인덕터 본체(10) 상에 상부 커버시트(32b)를 적층한다. 상기 하부 커버시트(32a), 코어(31), 및 상부 커버시트(32b)는 코어부(30)를 형성하게 된다. 상기 하부 커버시트(32a), 코어(31), 및 상부 커버시트(32b)의 형성 순서는 특별히 제한되지 않는다.
본 실시예에서, 상기 인덕터 본체는 비자성의 특성을 가지므로, 하부 커버시트(32a), 코어(31), 및 상부 커버시트(32b)는 자성체로 형성될 수 있다.
이에 제한되는 것은 아니나, 상기 코어부(30)는 자성체 분말, 바인더, 가소제 등을 볼 밀에 의해 분쇄 혼합하여 슬러리를 제조하고, 상기 슬러리를 코어부 내부에 충진하여 형성될 수 있다.
이후, 코어부가 형성된 인덕터 본체를 소성하고, 인덕터 본체의 외부면에 제1 및 제2 외부 전극을 형성할 수 있다.
상기 제1 및 제2 외부전극은 코일부의 양단과 각각 전기적으로 연결되도록 형성된다.
상기 제1 및 제2 외부 전극은 도전성 페이스트에 인덕터 본체를 침지하는 방법, 인쇄 방법, 증착, 스퍼터링 등에 의해 형성될 수 있다. 상기 도전성 페이스트는 Ag, Ag-Pd, Ni, Cu 등의 금속을 포함할 수 있다. 상기 제1 및 제2 외부전극의 표면에는 Ni 도금층 및 Sn 도금층을 형성할 수 있다.
또한, 도시되지 않았으나 자성체 시트에 도체 패턴 및 도전성 비아를 형성하고, 이를 적층하여 자성의 특성을 갖는 인덕터 본체를 형성할 수 있다. 상기 자성의 특성을 갖는 인덕터 본체에 관통홀을 형성하고, 관통 홀에 비자성체를 충전하여 적층형 인덕터를 형성할 수 있다.
이하, 본 발명의 다른 실시예에 따른 적층형 인덕터의 제조방법을 설명한다.
우선, 비자성 및 자성 중 어느 하나의 특성을 갖는 시트를 마련하고, 상기 시트에 도체 패턴 및 도전성 비아을 형성할 수 있다. 이때, 도체 패턴의 내측에 관통 홀을 형성할 수 있다.
이후, 각 시트에 형성된 도체 패턴의 일단이 인접하는 시트에 형성된 도전성 비아와 접촉하여 코일부가 형성되도록 복수 개의 시트를 적층할 수 있다. 이에 따라, 자성 또는 비자성의 특성을 갖는 인덕터 본체가 형성될 수 있다.
다음으로, 인덕터 본체에 형성된 관통 홀에 비자성 또는 자성의 물질을 충진하여 코어부를 형성할 수 있다.
보다 구체적으로, 인덕터 본체가 비자성의 특성을 갖는 경우에는 관통 홀에 자성의 물질을 충진하고, 인덕터 본체가 자성의 특성을 갖는 경우에는 관통 홀에 비자성의 물질을 충진할 수 있다.
상술한 실시예와 같이 상기 코어부는 하부 커버시트, 코어, 및 상부 커버시트로 형성될 수 있다.
코어부가 형성된 인덕터 본체를 소성하고, 인덕터 본체의 외부면에 제1 및 제2 외부 전극을 형성할 수 있다. 상기 제1 및 제2 외부전극은 코일부의 양단과 각각 전기적으로 연결되도록 형성된다.
본 실시예에 따른 적층형 인덕터의 제조방법은 복수 개의 시트를 적층하여 인덕터 본체를 형성한다. 이후 인덕터 본체에 관통 홀을 형성하고, 인덕터 본체와 다른 특성을 갖는 물질을 충진한다.
본 실시예에 따른 적층형 인덕터의 제조방법은 기존의 적층 공정을 이용할 수 있어 양산이 용이하며, 코일부의 내부 및 외부에 서로 다른 특성을 갖는 물질이 형성될 수 있다.
본 발명은 상술한 실시 형태 및 첨부된 도면에 의해 한정되는 것이 아니며, 첨부된 청구범위에 의해 한정하고자 한다. 따라서, 청구범위에 기재된 본 발명의 기술적 사상을 벗어나지 않는 범위 내에서 당 기술분야의 통상의 지식을 가진 자에 의해 다양한 형태의 치환, 변형 및 변경이 가능할 것이며, 이 또한 본 발명의 범위에 속한다고 할 것이다.
10: 인덕터 본체 11: 시트
20: 코일부 21: 도체 패턴
V: 도전성 비아 30: 코어부
40a, 40b: 제1 및 제2 외부 전극

Claims (8)

  1. 비자성 및 자성 중 어느 하나의 특성을 갖는 인덕터 본체;
    상기 인덕터 본체에 형성된 도체 패턴 및 도전성 비아를 갖는 코일부; 및
    상기 코일부의 내부에 형성되며, 비자성 및 자성 중 상기 인덕터 본체와 반대의 특성을 갖는 코어부;
    를 포함하는 적층형 인덕터.
  2. 제1항에 있어서,
    상기 인덕터 본체는 비자성의 특성을 가지며, 상기 코어부는 자성의 특성을 갖는 적층형 인덕터.
  3. 제1항에 있어서,
    상기 인덕터 본체는 자성의 특성을 가지며, 상기 코어부는 비자성의 특성을 갖는 적층형 인덕터.
  4. 제1항에 있어서,
    상기 코어부는 상기 코일부의 내부를 관통하는 코어, 상기 인덕터 본체의 하부에 형성된 하부 커버시트 및 상기 인덕터 본체의 상부에 형성되는 상부 커버시트로 구성되는 적층형 인덕터.
  5. 도체 패턴 및 도전성 비아가 형성되며, 비자성 및 자성 중 어느 하나의 특성을 갖는 복수 개의 시트를 마련하는 단계;
    상기 각 시트에 형성된 도체 패턴의 일단이 인접하는 시트에 형성된 도전성 비아와 접촉하여 코일부가 형성되도록 상기 복수 개의 시트를 적층하여 인덕터 본체를 형성하는 단계;
    상기 코일부의 내부를 관통하는 관통 홀을 형성하는 단계; 및
    상기 관통 홀에 비자성 및 자성 중 상기 인덕터 본체와 반대의 특성을 갖는 코어부를 형성하는 단계;
    를 포함하는 적층형 인덕터의 제조방법.
  6. 제5항에 있어서,
    상기 코어부를 형성하는 단계는
    상기 인덕터 본체의 하부에 하부 커버시트를 적층하고, 상기 코일부의 내부를 관통하는 코어를 충진하며, 상기 인덕터 본체의 상부에 상부 커버시트를 적층하여 수행되는 적층형 인덕터의 제조방법.
  7. 도전 패턴 및 도전성 비아와 상기 도전 패턴의 내측에 관통 홀이 형성되며, 비자성 및 자성 중 어느 하나의 특성을 갖는 복수 개의 시트를 마련하는 단계;
    상기 각 시트에 형성된 도체 패턴의 일단이 인접하는 시트에 형성된 도전성 비아와 접촉하여 코일부가 형성되도록 상기 복수 개의 시트를 적층하여 인덕터 본체를 형성하는 단계; 및
    상기 관통 홀에 비자성 및 자성 중 상기 인덕터 본체와 반대의 특성을 갖는 코어부를 형성하는 단계;
    를 포함하는 적층형 인덕터의 제조방법.
  8. 제7항에 있어서,
    상기 코어부를 형성하는 단계는
    상기 인덕터 본체의 하부에 하부 커버시트를 적층하고, 상기 코일부의 내부를 관통하는 코어를 충진하며, 상기 인덕터 본체의 상부에 상부 커버시트를 적층하여 수행되는 적층형 인덕터의 제조방법.
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