KR20120037120A - Solar cell and method for manufacturing the same - Google Patents
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Abstract
Description
본 발명은 태양 전지 및 그 제조 방법에 관한 것이다The present invention relates to a solar cell and a method of manufacturing the same.
최근 석유나 석탄과 같은 기존 에너지 자원의 고갈이 예측되면서 이들을 대체할 대체 에너지에 대한 관심이 높아지고, 이에 따라 태양 에너지로부터 전기 에너지를 생산하는 태양 전지가 주목 받고 있다. Recently, as energy resources such as oil and coal are expected to be depleted, interest in alternative energy to replace them is increasing, and solar cells that produce electric energy from solar energy are attracting attention.
일반적인 태양 전지는 p형과 n형처럼 서로 다른 도전성 타입(conductive type)에 의해 p-n 접합을 형성하는 반도체부, 그리고 서로 다른 도전성 타입의 반도체부에 각각 연결된 전극을 구비한다.Typical solar cells have a semiconductor portion that forms a p-n junction by different conductive types, such as p-type and n-type, and electrodes connected to semiconductor portions of different conductivity types, respectively.
이러한 태양 전지에 빛이 입사되면 반도체에서 복수의 전자-정공 쌍이 생성되고, 생성된 전자-정공 쌍은 광기전력 효과(photovoltaic effect)에 의해 전하인 전자와 정공으로 각각 분리되어, 전자는 n형의 반도체부 쪽으로 이동하고 정공은 p형 반도체부 쪽으로 이동한다. 이동한 전자와 정공은 각각 p형의 반도체부와 n형의 반도체부에 연결된 서로 다른 전극에 의해 수집되고 이 전극들을 전선으로 연결하여 전력을 얻는다.When light is incident on the solar cell, a plurality of electron-hole pairs are generated in the semiconductor, and the generated electron-hole pairs are separated into electrons and holes charged by the photovoltaic effect, respectively, and the electrons are n-type. It moves toward the semiconductor portion and holes move toward the p-type semiconductor portion. The transferred electrons and holes are collected by the different electrodes connected to the p-type semiconductor portion and the n-type semiconductor portion, respectively, and the electrodes are connected by a wire to obtain electric power.
본 발명이 이루고자 하는 기술적 과제는 태양 전지의 제조 비용을 줄이기 위한 것이다.The technical problem to be achieved by the present invention is to reduce the manufacturing cost of the solar cell.
본 발명이 이루고자 하는 다른 기술적 과제는 태양 전지의 생산 효율을 향상시키기 위한 것이다. Another technical problem to be achieved by the present invention is to improve the production efficiency of solar cells.
본 발명의 한 특징에 따른 태양 전지는 제1 도전성 타입의 제1 불순물을 함유하고 있고, 결정질 반도체로 이루어진 기판, 상기 기판의 제1 면 위에 위치하고 비결정질 반도체 재료로 이루어진 제1 보호막, 상기 제1 보호막에 상기 제1 도전성 타입과 반대인 제2 불순물을 확산시켜 상기 제1 보호막 내에 상기 제2 불순물이 확산된 적어도 하나의 에미터부, 상기 에미터부에 전기적으로 연결되어 있는 제1 전극, 그리고 상기 기판에 전기적으로 연결되어 있는 제2 전극을 포함한다.A solar cell according to an aspect of the present invention contains a first impurity of a first conductivity type, a substrate made of a crystalline semiconductor, a first protective film made of an amorphous semiconductor material located on a first surface of the substrate, and the first protective film. At least one emitter portion in which the second impurity is diffused in the first passivation layer by diffusing a second impurity opposite to the first conductivity type, a first electrode electrically connected to the emitter portion, and the substrate And a second electrode that is electrically connected.
상기 제1 보호막은 상기 제2 불순물이 확산되지 않은 영역을 구비할 수 있다.The first passivation layer may include a region where the second impurity is not diffused.
상기 불순물이 확산되지 않은 영역은 상기 기판과 상기 적어도 하나의 에미터부 사이에 위치할 수 있다.The region where the impurities are not diffused may be located between the substrate and the at least one emitter portion.
상기 특징에 따른 태양 전지는 상기 기판의 제1 면의 반대편에 위치하는 상기 기판의 제2 면 위에 위치하고 상기 비결정질 반도체 재료로 이루어진 제2 보호막, 그리고 상기 제2 보호막에 상기 제1 불순물을 확산시켜 상기 제2 보호막 내에 상기 제1 불순물이 확산된 제1 전계부를 더 포함할 수 있다.The solar cell according to the above aspect is disposed on a second surface of the substrate opposite to the first surface of the substrate, and the second impurity film is made of the amorphous semiconductor material, and the first impurity is diffused to the second protective film. The display device may further include a first electric field unit in which the first impurity is diffused in the second passivation layer.
상기 제2 보호막은 상기 제1 불순물이 확산되지 않은 영역을 구비할 수 있고, 상기 제1 불순물이 확산되지 않은 영역은 상기 기판과 상기 적어도 하나의 제1 전계부 사이에 위치할 수 있다.The second passivation layer may include a region where the first impurity is not diffused, and a region where the first impurity is not diffused may be located between the substrate and the at least one first electric field portion.
상기 제1 면은 빛이 입사되는 입사면이고, 상기 제2 면은 빛이 입사되지 않는 비입사면일 수 있다.The first surface may be an incident surface to which light is incident, and the second surface may be a non-incident surface to which light is not incident.
상기 특징에 따른 태양 전지는 상기 제1 보호막에 상기 제1 불순물을 확산시켜 상기 제1 보호막 내에 상기 제1 불순물이 확산된 적어도 하나의 제1 전계부를 더 포함할 수 있다.The solar cell may further include at least one first electric field in which the first impurity is diffused in the first passivation layer to diffuse the first impurity.
상기 적어도 하나의 제1 전계부는 상기 적어도 하나의 에미터부와 이격될 수 있다.The at least one first electric field part may be spaced apart from the at least one emitter part.
상기 제1 보호막은 상기 제1 불순물이 확산되지 않은 영역을 구비할 수 있고, 상기 제1 불순물이 확산되지 않은 영역은 상기 기판과 상기 적어도 하나의 제1 전계부 사이에 위치할 수 있다.The first passivation layer may include a region where the first impurity is not diffused, and a region where the first impurity is not diffused may be positioned between the substrate and the at least one first electric field portion.
상기 적어도 하나의 제1 전계부는 상기 적어도 하나의 에미터부와 접해 있을 수 있다.The at least one first electric field part may be in contact with the at least one emitter part.
상기 특징에 따른 태양 전지는 상기 제1 보호막에 상기 제1 불순물과 상기 제2 불순물이 혼합되어 있는 적어도 하나의 혼합부를 더 포함할 수 있다.The solar cell according to the above feature may further include at least one mixing unit in which the first impurity and the second impurity are mixed in the first passivation layer.
상기 특징에 따른 태양 전지는 상기 기판의 제1 면의 반대편에 위치하는 상기 기판의 제2 면 위에 위치하는 제2 보호부를 더 포함할 수 있다.The solar cell according to the above feature may further include a second protection part disposed on the second surface of the substrate positioned opposite to the first surface of the substrate.
상기 특징에 따른 태양 전지는 상기 제2 보호부 위에 위치하는 반사 방지부를 더 포함할 수 있다.The solar cell according to the above feature may further include an anti-reflection portion positioned on the second protection portion.
상기 특징에 따른 태양 전지는 상기 제2 보호부와 상기 반사 방지부 사이에 위치하고, 상기 제1 불순물을 함유하고 있는 제2 전계부를 더 포함할 수 있다.The solar cell according to the above feature may further include a second electric field part disposed between the second protection part and the anti-reflection part and containing the first impurity.
상기 제1 면은 빛이 입사되지 않는 비입사면이고, 상기 제2 면은 빛이 입사되는 입사면일 수 있다.The first surface may be a non-incident surface in which light is not incident, and the second surface may be an incident surface in which light is incident.
상기 특징에 따른 태양 전지는 상기 기판의 제1 면의 반대편에 위치하는 상기 기판의 제2 면 위에 위치하고 상기 비결정질 반도체 재료로 이루어진 제2 보호막, 그리고 상기 제2 보호막에 상기 제1 불순물을 확산시켜 상기 제2 보호막 내에 상기 제1 불순물이 확산된 제2 전계부를 더 포함할 수 있다.The solar cell according to the above aspect is disposed on a second surface of the substrate opposite to the first surface of the substrate, and the second impurity film is made of the amorphous semiconductor material, and the first impurity is diffused to the second protective film. The second protective layer may further include a second electric field part in which the first impurity is diffused.
상기 제2 보호막은 상기 제1 불순물이 확산되지 않은 영역을 구비할 수 있고, 상기 제1 불순물이 확산되지 않은 영역은 상기 기판과 상기 제2 전계부 사이에 위치할 수 있다.The second passivation layer may include a region where the first impurity is not diffused, and a region where the first impurity is not diffused may be located between the substrate and the second electric field portion.
상기 특징에 따른 태양 전지는 상기 제2 전계부 위에 반사 방지부를 더 포함할 수 있다.The solar cell according to the above feature may further include an anti-reflection portion on the second electric field portion.
상기 제1 면은 빛이 입사되지 않는 비입사면이고, 상기 제2 면은 빛이 입사되는 입사면일 수 있다.The first surface may be a non-incident surface in which light is not incident, and the second surface may be an incident surface in which light is incident.
본 발명의 다른 특징에 따른 태양 전지의 불순물부 형성 방법은 제1 불순물을 함유한 기판의 위에 비결정질 반도체 재료로 이루어진 보호막을 형성하는 단계, 상기 보호막 위에 제2 불순물을 함유한 불순물막을 형성하는 단계, 그리고 상기 보호막과 상기 불순물막을 구비한 상기 기판을 열처리하여, 상기 불순물막에 함유된 상기 불순물을 상기 보호막 내부로 확산시켜, 적어도 하나의 불순물부와 보호부를 형성하는 단계를 포함하고, 상기 적어도 하나의 불순물부는 상기 보호막 중 상기 제2 불순물이 확산된 부분이고, 상기 보호부는 상기 보호막 중 상기 제2 불순물이 확산되지 않은 부분이다.According to another aspect of the present invention, a method of forming an impurity portion of a solar cell includes forming a protective film made of an amorphous semiconductor material on a substrate containing a first impurity, forming an impurity film containing a second impurity on the protective film, And heat-treating the substrate having the protective film and the impurity film to diffuse the impurities contained in the impurity film into the protective film to form at least one impurity portion and a protection portion. The impurity portion is a portion in which the second impurity is diffused in the protective film, and the protection portion is a portion in which the second impurity is not diffused in the protective film.
상기 제1 불순물과 상기 제2 불순물은 서로 다른 도전성 타입을 가지거나 동일한 도전성 타입을 가질 수 있다.The first impurity and the second impurity may have different conductivity types or the same conductivity type.
상기 기판의 상기 제1 불순물의 농도는 상기 적어도 하나의 불순물부의 상기 제2 불순물의 농도보다 낮을 수 있다. The concentration of the first impurity in the substrate may be lower than the concentration of the second impurity in the at least one impurity portion.
상기 제1 불순물막은 상기 제1 보호막의 전체면 위에 형성되거나 상기 제1 보호막 위에 선택적으로 형성될 수 있다.The first impurity layer may be formed on the entire surface of the first passivation layer or selectively formed on the first passivation layer.
본 발명의 또 다른 특징에 따른 태양 전지의 제조 방법은 제1 도전성 타입의 기판의 제1 면 위에 비전도성 반도체 재료로 이루어진 제1 보호막을 형성하는 단계, 상기 제1 보호막 위에 상기 제1 도전성 타입과 반대인 제2 도전성 타입의 제1 불순물을 함유한 제1 불순물막을 형성하는 단계, 상기 제1 보호막과 상기 제1 불순물막을 구비한 상기 기판을 열처리하여, 상기 제1 불순물막에 함유된 상기 제1 불순물을 상기 제1 보호막 내부로 확산시켜, 적어도 하나의 에미터부와 제1 보호부를 형성하는 단계, 그리고 상기 적어도 하나의 에미터부와 전기적으로 연결되어 있는 제1 전극과 상기 기판과 전기적으로 연결되어 있는 제2 전극을 형성하는 단계를 포함하고, 상기 적어도 하나의 에미터부는 상기 제1 보호막 중 상기 제1 불순물이 확산된 부분이고, 상기 제1 보호부는 상기 제1 보호막 중 상기 제1 불순물이 확산되지 않은 부분이다.According to still another aspect of the present invention, there is provided a method of manufacturing a solar cell, including forming a first passivation layer formed of a nonconductive semiconductor material on a first surface of a substrate of a first conductivity type, and forming the first passivation layer on the first passivation layer. Forming a first impurity film containing a first impurity of a second conductivity type opposite to the other, and heat treating the substrate having the first passivation film and the first impurity film, thereby forming the first impurity film contained in the first impurity film. Diffusing impurities into the first passivation layer to form at least one emitter portion and a first passivation portion, and a first electrode electrically connected to the at least one emitter portion and electrically connected to the substrate And forming a second electrode, wherein the at least one emitter part is a portion in which the first impurity is diffused in the first passivation layer, and the first Arc portion is a portion not diffuse the first dopant of the first protective film.
상기 특징에 따른 태양 전지의 제조 방법은 상기 제1 보호막 위에 상기 제1 불순물막과 이격되게, 상기 제1 도전성 타입의 제2 불순물을 함유한 제2 불순물막을 형성하는 단계를 더 포함하고, 상기 적어도 하나의 에미터부와 상기 제1 보호부 형성 단계는 상기 열처리 시 상기 제2 불순물막에 함유된 상기 제2 불순물을 상기 제1 보호막 내부로 확산시켜, 상기 적어도 하나의 에미터부와 함께 적어도 하나의 제1 전계부를 형성할 수 있다. The method of manufacturing a solar cell according to the above feature further includes forming a second impurity film containing a second impurity of the first conductivity type on the first passivation film, the second impurity film being spaced apart from the first impurity film. The forming of one emitter part and the first protective part may diffuse the second impurity contained in the second impurity film into the first protective film during the heat treatment, thereby forming at least one first material together with the at least one emitter part. One electric field part can be formed.
상기 특징에 따른 태양 전지의 제조 방법은 상기 제1 면의 반대편인 상기 기판의 제2 면 위에 비결정질 반도체로 이루어진 제2 보호부를 형성하는 단계를 더 포함할 수 있다. The method of manufacturing a solar cell according to the above feature may further include forming a second protective part made of an amorphous semiconductor on a second surface of the substrate opposite to the first surface.
상기 특징에 따른 태양 전지의 제조 방법은 상기 제2 보호부 위에 반사 방지부를 형성하는 단계를 더 포함할 수 있다. The method of manufacturing a solar cell according to the above feature may further include forming an anti-reflection portion on the second protection portion.
상기 특징에 따른 태양 전지의 제조 방법은 상기 제1 면의 반대편인 상기 기판의 제2 면 위에 상기 비결정질 반도체 재료로 이루어진 제2 보호막을 형성하는 단계, 상기 제2 보호막 위에 상기 제2 불순물을 함유한 제2 불순물막을 형성하는 단계, 상기 제2 보호막과 상기 제2 불순물막을 구비한 상기 기판을 열처리하여, 상기 제2 불순물막에 함유된 상기 제2 불순물을 상기 제2 보호막 내부로 확산시켜, 상기 제2 불순물이 확산된 전계부와 제2 보호부를 형성하는 단계를 더 포함할 수 있고, 상기 전계부는 상기 제2 보호막 중 상기 제2 불순물이 확산된 부분이고, 상기 제2 보호부는 상기 제2 보호막 중 상기 제2 불순물이 확산되지 않은 부분일 수 있다. A method of manufacturing a solar cell according to the above aspect comprises forming a second protective film made of the amorphous semiconductor material on a second surface of the substrate opposite to the first surface, and containing the second impurity on the second protective film. Forming a second impurity film, heat treating the substrate having the second passivation film and the second impurity film to diffuse the second impurity contained in the second impurity film into the second passivation film, and The method may further include forming an electric field portion and a second protection portion in which impurities are diffused, wherein the electric field portion is a portion in which the second impurity is diffused in the second protection layer, and the second protection portion is in the second protection layer. The second impurity may not be diffused.
상기 특징에 따른 태양 전지의 제조 방법은 상기 전계부 위에 반사 방지부를 형성하는 단계를 더 포함할 수 있다.The method of manufacturing a solar cell according to the above feature may further include forming an anti-reflection portion on the electric field portion.
상기 제1 면은 빛이 입사되지 않는 비입사면이고, 상기 제2 면은 빛이 입사되는 입사면일 수 있다.The first surface may be a non-incident surface in which light is not incident, and the second surface may be an incident surface in which light is incident.
상기 특징에 따른 태양 전지의 제조 방법은 상기 제1 면의 반대편인 상기 기판의 제2 면 위에 상기 비결정질 반도체 재료로 이루어진 제2 보호막을 형성하는 단계, 그리고 상기 제2 보호막 위에 상기 제1 도전성 타입의 제2 불순물을 함유한 제2 불순물막을 형성하는 단계를 더 포함할 수 있고, 상기 적어도 하나의 에미터부와 상기 제1 보호부 형성 단계는 상기 열처리 시 상기 제2 불순물막에 함유된 상기 제2 불순물을 상기 제2 보호막 내부로 확산시켜, 전계부와 상기 제1 보호부를 형성하고, 상기 전계부는 상기 제2 보호막 중 상기 제2 불순물이 확산된 부분이고, 상기 제2 보호부는 상기 제2 보호막 중 상기 제2 불순물이 확산되지 않은 부분이고, 상기 제2 전극은 상기 전계부를 통해 상기 기판과 전기적으로 연결되어 있을 수 있다.A method of manufacturing a solar cell according to the above aspect comprises forming a second protective film made of the amorphous semiconductor material on a second surface of the substrate opposite to the first surface, and on the second protective film of the first conductive type. The method may further include forming a second impurity film containing a second impurity, and the forming of the at least one emitter part and the first protection part may include the second impurity contained in the second impurity film during the heat treatment. Diffusing into the second passivation layer to form an electric field portion and the first passivation portion, wherein the electric field portion is a portion in which the second impurity is diffused in the second passivation layer, and the second passivation portion is formed in the second passivation layer. The second impurity is a portion not diffused, and the second electrode may be electrically connected to the substrate through the electric field part.
상기 특징에 따른 태양 전지의 제조 방법은 상기 적어도 하나의 에미터부 위에 투명한 도전막으로 이루어진 반사 방지부를 더 형성하는 단계를 포함할 수 있고, 상기 제1 전극은 상기 반사 방지부를 통해 상기 적어도 하나의 에미터부와 전기적으로 연결될 수 있다. The method of manufacturing a solar cell according to the above feature may further include forming an anti-reflection portion formed of a transparent conductive film on the at least one emitter portion, wherein the first electrode is formed through the anti-reflection portion. It may be electrically connected with the tab.
상기 제1 면은 빛이 입사되는 입사면이고, 상기 제2 면은 빛이 입사되지 않은 비입사면일 수 있다.The first surface may be an incident surface to which light is incident, and the second surface may be a non-incident surface to which light is not incident.
본 발명의 특징에 따르면, 태양 전지의 제조 비용과 제조 시간이 줄어든다. According to a feature of the invention, the manufacturing cost and manufacturing time of the solar cell is reduced.
도 1은 본 발명의 한 실시예에 따른 태양 전지의 일부 사시도이다.
도 2는 도 1에 도시한 태양 전지를 II-II선을 따라 잘라 도시한 단면도이다.
도 3a 내지 도 3g는 도 1 및 도 2에 도시한 태양 전지의 제조 방법을 순차적으로 나타낸 공정도이다.
도 4는 본 발명의 다른 실시예에 따른 태양 전지의 일부 사시도이다.
도 5는 도 4에 도시한 태양 전지를 V-V선을 따라 잘라 도시한 단면도이다.
도 6a 내지 도 6h는 도 4 및 도 5에 도시한 태양 전지의 제조 방법을 순차적으로 나타낸 공정도이다.
도 7 및 도 8은 각각 본 발명의 또 다른 실시예에 따른 태양 전지의 일부 단면도이다. 1 is a partial perspective view of a solar cell according to an embodiment of the present invention.
FIG. 2 is a cross-sectional view of the solar cell shown in FIG. 1 taken along line II-II.
3A to 3G are process diagrams sequentially illustrating a method of manufacturing the solar cell shown in FIGS. 1 and 2.
4 is a partial perspective view of a solar cell according to another embodiment of the present invention.
5 is a cross-sectional view of the solar cell illustrated in FIG. 4 taken along the line VV.
6A to 6H are process diagrams sequentially showing the method of manufacturing the solar cells shown in FIGS. 4 and 5.
7 and 8 are partial cross-sectional views of solar cells according to still another embodiment of the present invention, respectively.
아래에서는 첨부한 도면을 참고로 하여 본 발명의 실시예에 대하여 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자가 용이하게 실시할 수 있도록 상세히 설명한다. 그러나 본 발명은 여러 가지 상이한 형태로 구현될 수 있으며 여기에서 설명하는 실시예에 한정되지 않는다. 그리고 도면에서 본 발명을 명확하게 설명하기 위해서 설명과 관계없는 부분은 생략하였으며, 명세서 전체를 통하여 유사한 부분에 대해서는 유사한 도면 부호를 붙였다.DETAILED DESCRIPTION Hereinafter, exemplary embodiments of the present invention will be described in detail with reference to the accompanying drawings so that those skilled in the art may easily implement the present invention. The present invention may, however, be embodied in many different forms and should not be construed as limited to the embodiments set forth herein. In the drawings, parts irrelevant to the description are omitted in order to clearly describe the present invention, and like reference numerals designate like parts throughout the specification.
도면에서 여러 층 및 영역을 명확하게 표현하기 위하여 두께를 확대하여 나타내었다. 명세서 전체를 통하여 유사한 부분에 대해서는 동일한 도면 부호를 붙였다. 층, 막, 영역, 판 등의 부분이 다른 부분 "위에" 있다고 할 때, 이는 다른 부분 "바로 위에" 있는 경우뿐 아니라 그 중간에 다른 부분이 있는 경우도 포함한다. 반대로 어떤 부분이 다른 부분 "바로 위에" 있다고 할 때에는 중간에 다른 부분이 없는 것을 뜻한다. 또한 어떤 부분이 다른 부분 위에 "전체적"으로 형성되어 있다고 할 때에는 다른 부분의 전체 면(또는 전면)에 형성되어 있는 것뿐만 아니라 가장 자리 일부에는 형성되지 않은 것을 뜻한다.In the drawings, the thickness of layers, films, panels, regions, etc., are exaggerated for clarity. Like parts are designated by like reference numerals throughout the specification. When a layer, film, region, plate, or the like is referred to as being "on" another portion, it includes not only the case directly above another portion but also the case where there is another portion in between. On the contrary, when a part is "just above" another part, there is no other part in the middle. Also, when a part is formed as "whole" on the other part, it means not only that it is formed on the entire surface (or the front surface) of the other part but also not on the edge part.
그러면 첨부한 도면을 참고로 하여 본 발명의 한 실시예인 태양 전지 및 그 제조 방법에 대하여 설명한다.Next, a solar cell and a manufacturing method thereof according to an embodiment of the present invention will be described with reference to the accompanying drawings.
먼저, 도 1 및 도 2를 참고로 하여 본 발명의 한 실시예에 따른 태양 전지에 대하여 상세하게 설명한다.First, a solar cell according to an exemplary embodiment of the present invention will be described in detail with reference to FIGS. 1 and 2.
도 1 및 도 2에 도시한 것처럼, 본 발명의 한 실시예에 따른 태양 전지(11)는 기판(110), 빛이 입사되는 기판(110)의 면인 입사면[이하, '전면(front surface)'라 함] 위에 위치하고 전면 보호부(191)와 전면 보호부(191) 위에 위치하는 에미터부(121)를 구비한 전면 보호막(190a1), 에미터부(121) 위에 위치하는 반사 방지부(130), 반사 방지부(130) 위에 위치하는 전면 전극부(140), 빛이 입사되지 않고 입사면의 반대쪽 면인 기판(110)의 비입사면[이하, '후면(rear surface)'라 함] 위에 위치하고후면 보호부(192)와 후면 보호부(192) 위에 위치하는 후면 전계부(172)를 구비한 후면 보호막(190a), 그리고 후면 전계부(172) 위에 위치하는 후면 전극(151)을 구비한다.1 and 2, the
기판(110)은 제1 도전성 타입, 예를 들어 n형 도전성 타입의 실리콘으로 이루어진 반도체 기판이다. 이때, 실리콘은 단결정 실리콘 또는 다결정 실리콘과 같은 결정질 실리콘이다. The
기판(110)이 n형의 도전성 타입을 가질 경우, 인(P), 비소(As), 안티몬(Sb) 등과 같이 5가 원소의 불순물이 기판(110)에 도핑(doping)된다. When the
하지만, 이와는 달리, 기판(110)은 p형 도전성 타입일 수 있고, 실리콘 이외의 다른 반도체 물질로 이루어질 수도 있다. 기판(110)이 p형의 도전성 타입을 가질 경우, 기판(110)은 붕소(B), 갈륨(Ga), 인듐(In) 등과 같은 3가 원소의 불순물이 기판(110)에 도핑된다. Alternatively, the
이러한 기판(110)은 전면에 요철면인 텍스처링 표면을 갖는다. 편의상 도 1에서, 기판(110)의 가장자리 부분만 요철면으로 도시하여 그 위에 위치하는 전면 보호부(191), 에미터부(121), 반사 방지부(130) 역시 그 가장자리 부분만 요철면으로 도시한다. 하지만, 실질적으로 기판(110)의 전면 전체가 요철면을 갖고 있으며, 이로 인해 기판(110)의 전면 위에 위치한 전면 보호부(191), 에미터부(121) 및 반사 방지부(130) 역시 전체가 요철면을 갖는다. 대안적인 예에서, 기판(110)의 전면뿐만 아니라 후면에도 텍스처링 표면을 가질 수 있다.This
기판(110)의 전면 위에 위치한 전면 보호부(191)는 전면 보호막(190a1) 중 에미터부(121)가 위치하지 않은 영역이고, 비결정질의 반도체 재료로 이루어져 있다. 이때, 전면 보호막(190a1)의 기판(110)의 전면에 전체적으로 위치하거나 가장 자리 부분을 제외한 기판(110)의 전면에 위치할 수 있다.The
비결정질의 반도체는 비정질 실리콘(amorphous silicon, a-Si), 실리콘 산화물(SiOx), 비정질 실리콘 산화물(amorphous SiOx, a-SiOx), 수소화된 실리콘 산화물(SiOx:H) 및 이들의 화합물, 수소화된 비정질 실리콘 산화물(a-SiOx:H), 실리콘 질화물(SiNx), 수소화된 실리콘 질화물(SiNx:H), 비정질 실리콘 질화물(amorphous SiNx), 수소화된 비정질 실리콘 질화물(a-SiNx:H) 및 이들의 화합물일 수 있다. Amorphous semiconductors include amorphous silicon (a-Si), silicon oxide (SiOx), amorphous silicon oxide (amorphous SiOx, a-SiOx), hydrogenated silicon oxide (SiOx: H) and compounds thereof, hydrogenated amorphous Silicon oxide (a-SiOx: H), silicon nitride (SiNx), hydrogenated silicon nitride (SiNx: H), amorphous silicon nitride (amorphous SiNx), hydrogenated amorphous silicon nitride (a-SiNx: H) and compounds thereof Can be.
이때, 비결정질의 반도체 재료는 기판(110)의 도전성 타입과 반대인 제2 도전성 타입, 예를 들어, p형의 도전성 타입의 불순물이 도핑되지 않은 진성(intrinsic) 반도체 재료이거나 제2 도전성 타입의 불순물이 도핑된 반도체 재료이다. 이때, 반도체 재료에 도핑된 제2 도전성 타입의 불순물 도핑 농도는 기판(110)의 불순물 도핑 농도보다 낮다. In this case, the amorphous semiconductor material is an intrinsic semiconductor material that is not doped with a second conductive type, for example, a p-type conductive type, which is opposite to the conductive type of the
이러한 전면 보호부(191)는 기판(110)의 표면 및 그 근처에 주로 존재하는 댕글링 결합(dangling bond)과 같은 결함(defect)을 안정한 결합으로 바꾸어 결함에 의해 기판(110)의 표면 쪽으로 이동한 전하가 소멸되는 것을 감소시키는 페시베이션 기능(passivation function)을 수행하여 결함에 의해 기판(110)의 표면 및 그 근처에서 손실되는 전하의 양을 감소시킨다. The
본 실시예에서, 전면 보호부(191)는 약 2㎚ 내지 5㎚의 두께를 가질 수 있다. In the present embodiment, the front
전면 보호부(191)의 두께가 약 2nm 이상이면 기판(110) 전면에 전면 보호부(191)가 균일하게 도포되므로 패시베이션 기능을 양호하게 수행할 수 있으며, 약 5nm 이하이면 기판(110)에서부터 상부에 위치한 에미터부(121)로의 전하 이동이 좀더 원활하게 행해지고 전면 보호부(191) 내에서 흡수되는 빛의 양을 감소시켜 기판(110) 내로 입사되는 빛의 양을 증가시킬 수 있다. If the thickness of the front
기판(110)의 전면 위의 전면 보호부(191) 위에 위치하는 에미터부(121)는 제2 도전성 타입(예를 들어, p형의 도전성 타입)을 갖고 있고, 기판(110)과 다른 비결정질 반도체로 이루어져 있다. 따라서, 에미터부(121)는 기판(110)과 p-n 접합뿐만 아니라 이종 접합(hetero junction)을 형성한다. The
기판(110)과 복수의 에미터부(121) 간에 형성된 p-n 접합에 인한 내부 전위차(built-in potential difference)에 의해, 기판(110)에 입사된 빛에 의해 생성된 전하인 전자-정공 쌍은 전자와 정공으로 분리되어 전자는 n형 쪽으로 이동하고 정공은 p형 쪽으로 이동한다. 따라서, 기판(110)이 n형이고 에미터부(121)가 p형일 경우, 분리된 정공은 에미터부(121)쪽으로 이동하고 분리된 전자는 기판(110)의 후면 쪽으로 이동한다.The electron-hole pair, which is a charge generated by light incident on the
에미터부(121)는 기판(110)과 p-n접합을 형성하므로, 본 실시예와 달리, 기판(110)이 p형의 도전성 타입을 가질 경우, 에미터부(121)은 n형의 도전성 타입을 가진다. 이 경우, 분리된 정공은 기판(110)의 후면 쪽으로 이동하고 분리된 전자는 에미터부(121) 쪽으로 이동한다.Since the
에미터부(121)가 p형의 도전성 타입을 가질 경우, 에미터부(121)에는 3가 원소의 불순물이 도핑될 수 있고, 반대로 에미터부(121)가 n형의 도전성 타입을 가질 경우 에미터부(121)에는 5가 원소의 불순물이 도핑될 수 있다. When the
본 실시예에서, 에미터부(121)는 제2 도전성 타입의 불순물 도핑 상태를 제외하면, 전면 보호부(191)와 동일한 재료로 이루어져 있다.In the present embodiment, the
이러한 에미터부(121)는 약 10㎚ 내지 15㎚의 두께를 가질 수 있다. The
에미터부(121)의 두께가 약 10㎚ 이상이면 p-n 접합이 좀더 안정적으로 형성되어 좀더 안정적인 에미터부(121)의 기능이 이루어질 수 있고, 에미터부(121)의 두께가 약 15㎚ 이하이면 입사되는 빛의 흡수 없이 에미터부(121)의 기능을 실행하여 기판(110)으로 입사되는 빛의 양을 좀더 증가시킬 수 있다. When the thickness of the
본 실시예에서, 에미터부(121)의 불순물 도핑 농도는 에미터부(121)의 상부면, 즉 반사 방지부(130)와 접해 있는 에미터부(121)의 면에서부터 에미터부(121)의 하부면, 즉 상부면의 반대편에 위치하고 전면 보호부(191)와 접해 있는 면으로 갈수록 불순물의 도핑 농도는 감소한다. 이로 인해, 전면 전극부(140)와 접해 있는 반사 방지부(130) 쪽으로 갈수록 불순물의 도핑 농도가 증가하므로 에미터부(121)의 전도도가 증가하고, 이로 인해, 에미터부(121)에서 전면 전극부(140)로의 전하 전송율이 향상되고, 패시베이션 기능을 수행하는 전면 보호부(191) 쪽으로 갈수록 불순물의 도핑 농도가 감소하므로, 불순물로 인한 결함 발생이 감소하여 페시베이션 효과가 향상된다. In this embodiment, the impurity doping concentration of the
에미터부(121) 위에 위치한 반사 방지부(130)은 태양 전지(11)로 입사되는 빛의 반사도를 줄이고 특정한 파장 영역의 선택성을 증가시켜, 태양 전지(11)의 효율을 높인다.The
반사 방지부(130)는 비저항값이 낮고 전도도(conductivity)가 좋은 투명한 재료로 이루어져 있다. 예를 들어, 반사 방지부(130)는 ITO, ZnO 등의 투명한 도전성 산화물(transparent conductive oxide, TCO)과 같은 투명한 도전 물질로 이루어져 있다. The
이러한 반사 방지부(130)가 도전성 물질로 이루어져 있으므로, 반사 방지부(130)는 하부에 위치한 에미터부(121)와 전기적으로 연결되어 있다.Since the
전면 전극부(140)는 복수의 전면 전극(141)과 복수의 전면 전극(141)과 연결되어 있는 복수의 전면 버스바(142)를 구비한다.The
복수의 전면 전극(141)은 반사 방지부(130) 위에 위치하고, 서로 이격되어 정해진 방향으로 나란히 뻗어있다. 복수의 전면 전극(141)은 에미터부(121)쪽으로 이동한 전하, 예를 들면, 정공을 연결된 반사 방지부(130)를 통해 수집한다.The
복수의 전면 버스바(142)는 반사 방지부(130) 위에 위치하고, 복수의 전면 전극(141)과 교차하는 방향으로 나란하게 뻗어 있다.The plurality of front bus bars 142 are positioned on the
이때, 복수의 전면 버스바(142)는 복수의 전면 전극(141)과 동일 층에 위치하여 각 전면 전극(141)과 교차하는 지점에서 해당 전면 전극(141)과 전기적 및 물리적으로 연결되어 있다. In this case, the plurality of front bus bars 142 are positioned on the same layer as the plurality of
따라서, 도 1에 도시한 것처럼, 복수의 전면 전극(141)은 가로 또는 세로 방향으로 뻗어 있는 스트라이프(stripe) 형상을 갖고, 복수의 전면 버스바(142)는 세로 또는 가로 방향으로 뻗어 있는 스트라이프 형상을 갖고 있어, 전면 전극부(140)는 기판(110)의 전면에 격자 형태로 위치한다.Accordingly, as shown in FIG. 1, the plurality of
복수의 전면 버스바(142)는 에미터부(121)으로 이동하여 반사 방지부(130)를 통해 전달된 이동한 전하(예, 정공)뿐만 아니라 복수의 전면 전극(141)에 의해 수집되어 이동하는 전하(예, 정공)를 수집한다. The plurality of
각 전면 버스바(142)는 교차하는 복수의 전면 전극(141)에 의해 수집된 전하를 모아서 원하는 방향으로 이동시켜야 되므로, 각 전면 버스바(142)의 폭은 각 전면 전극(141)의 폭보다 크다.Since each
복수의 전면 버스바(142)는 외부 장치와 연결되어, 수집된 전하(예, 정공)를 외부 장치로 출력한다. The plurality of
복수의 전면 전극(141)과 복수의 전면 버스바(142)를 구비한 전면 전극부(140)는 은(Ag)과 같은 적어도 하나의 도전 물질로 이루어져 있다. 하지만, 대안적인 실시예에서, 도전 물질은 니켈(Ni), 구리(Cu), 알루미늄(Al), 주석(Sn), 아연(Zn), 인듐(In), 티타늄(Ti), 금(Au) 및 이들의 조합으로 이루어진 군으로부터 선택된 적어도 하나일 수 있지만, 이외의 다른 도전 물질로 이루어질 수 있다.The
도 1에서, 기판(110)에 위치하는 전면 전극(141)과 전면 버스바(142)의 개수는 한 예에 불과하고, 경우에 따라 변경 가능하다.In FIG. 1, the number of
반도체 물질로 이루어진 에미터부(121)와 금속 물질로 이루어진 전면 전극부(140) 사이에 투명한 도전성 물질로 이루어진 반사 방지부(130)가 존재하여 접착력(접촉 특성)이 약한 반도체 물질과 금속 물질 간의 접착력이 향상된다. 이로 인해, 에미터부(121)와 전면 전극부(140) 사이에 오믹 콘택(ohmic contact)이 형성되어 접촉 저항이 감소하고, 후면 전계부(172)과 후면 전극(151) 사이의 전기 전도도가 향상되어, 태양 전지(11)의 직렬 저항이 감소하여 기판(110)에서 후면 전극(151)으로의 전하의 전송 효율이 증가한다. 이러한 반사 방지부(130)는 필요에 따라 생략 가능하다.Between the
기판(110)의 후면 위에 위치한 후면 보호부(192)는 후면 보호막(190a2) 중 후면 전계부(172)가 위치하지 않은 영역이고, 전면 보호부(191)와 동일하게 패시베이션 기능을 수행하여, 기판(110)의 후면 쪽으로 이동한 전하가 결함에 의해 소멸되는 것을 감소한다. 대안적인 예에서, 후면 보호부(192)는 기판(110) 후면의 가장 자리 부분에는 위치하지 않을 수 있다. The rear
후면 보호부(192)는 전면 보호부(191)와 동일하게 비결정질의 반도체 재료로 이루어진다. The
이 경우, 전면 보호부(191)의 경우와 유사하게, 비결정질의 반도체 재료는 기판(110)의 도전성 타입과 동일한 제1 도전성 타입(예, p형의 도전성 타입)의 불순물이 도핑되지 않은 진성 반도체 재료이거나 제1 도전성 타입의 불순물이 도핑된 반도체 재료이다. 이때, 반도체 재료에 도핑된 제1 도전성 타입의 불순물 도핑 농도는 기판(110)의 불순물 도핑 농도보다 낮다. In this case, similar to the case of the front
후면 보호부(192)는 기판(110)의 후면 쪽으로 이동한 전하가 후면 보호부(192)를 통과하여 후면 전계부(172)로 이동할 수 있는 두께를 갖는다. 본 실시예에서, 후면 보호부(192)의 두께의 한 예는 약 2㎚ 내지 5㎚일 수 있다. The
후면 보호부(192)의 두께가 약 2nm 이상이면 기판(110) 후면에 후면 보호부(192)가 균일하게 도포되므로 패시베이션 효과를 좀더 안정적으로 얻을 수 있고, 약 5nm 이하이면, 기판(110)에서부터 후면 전계부(172)로의 전하 이동이 좀더 용이하게 이루어지고, 기판(110)을 통과한 빛이 후면 보호부(192) 내에서 흡수되는 빛의 양이 감소시켜 기판(110) 내로 재입사되는 빛의 양을 더욱 증가시킬 수 있다.If the thickness of the rear
후면 전계부(172)는 기판(110)과 동일한 도전성 타입의 불순물이 기판(110)보다 고농도로 도핑된 불순물 영역이다. 예를 들어, 복수의 후면 전계부(172)는 n+의 불순물 영역일 수 있다. 에미터부(121)와 유사하게, 후면 전계부(172)가 n형의 도전성 타입을 가질 경우, 후면 전계부(172)에는 5가 원소의 불순물이 도핑될 수 있고, 후면 전계부(172)가 p형의 도전성 타입을 가질 경우 후면 전계부(172)에는 3가 원소의 불순물이 도핑될 수 있다. The back
따라서, 본 실시예의 태양 전지(11)에서, n형 또는 p형의 불순물 도핑 상태를 제외하면, 전면 보호부(191), 후면 보호부(192), 에미터부(121) 및 후면 전계부(172)는 같은 재료로 이루어져 있다. Therefore, in the
이러한 후면 전계부(172)와 기판(110)과의 불순물 농도 차이로 인해 전위 장벽이 형성되고, 이 전위 장벽에 의해 전자와 정공 중 하나(예, 전자)의 이동 방향인 후면 전계부(172) 쪽으로 나머지 전하(예, 정공)의 이동은 방해되는 반면, 후면 전계부(172) 쪽으로의 전하(예, 전자) 이동은 용이하게 된다. 따라서, 후면 전계부(172) 및 그 부근 또는 후면 전극(151)에서 전자와 정공의 재결합으로 손실되는 전하의 양은 감소하고, 기판(110)에서 후면 전계부(172)로의 전자 이동은 가속화되어 후면 전계부(172)로의 전자 이동량은 증가한다. Due to the impurity concentration difference between the backside
후면 전계부(172)는 약 15㎚ 내지 18㎚의 두께를 가질 수 있다. 후면 전계부(172)의 두께가 약 15nm 이상이면 정공의 이동을 방해하는 전위 장벽을 좀더 양호하게 형성할 수 있어 전하 손실을 좀더 감소시킬 수 있고, 후면 전계부(172)의 두께가 약 18nm 이하이면 후면 전계부(172) 내에서 흡수되는 빛의 양을 더욱 감소시켜 기판(110) 내로 재입사되는 빛의 양을 좀더 증가시킬 수 있다. The
이미 설명한 것에 기초하면, 전면 보호부(191)와 그 위에 에미터부(121)를 합한 두께인 전면 보호막(190a1)의 두께는 약 15nm이고, 후면 보호부(192)와 그 위에 후면 전계부(172)를 합한 두께인 후면 보호막(190a2)의 두께는 약 20nm로서, 입사면인 기판(110)의 전면에 위치하는 전면 보호부(191)와 에미터부(121)의 두께가 비입사면인 기판(110)의 후면에 위치하는 후면 보호부(192)와 후면 전계부(172)의 두께보다 작다. 따라서, 기판(110) 전면에서의 두께 감소로 인해 전면 보호부(191)와 에미터부(121)에 의해 흡수되는 빛의 양이 감소하고, 기판(110) 후면에서의 두께 증가로 인해, 후면 전계부(172)로 인한 전계 세기가 증가하여 전계 효과가 좀더 효율적이 된다.Based on what has already been described, the thickness of the front passivation layer 190a1, which is the thickness of the
에미터부(121)와 유사하게, 후면 전계부(172)의 불순물 도핑 농도는 후면 전계부(172)의 상부면, 즉 보조 전극(161)과 접해 있는 후면 전계부(172)의 면에서부터 후면 전계부(172)의 하부면, 즉 상부면의 반대편에 위치하고 후면 보호부(192)와 접해 있는 면으로 갈수록 불순물의 도핑 농도는 감소한다. 이로 인해, 보조 전극(161)과 접해 있는 면으로 갈수록 불순물의 도핑 농도가 증가하므로 후면 전계부(172)의 전도도가 증가하여 기판(110)에서 보조 전극(161)으로의 전하 전송율이 향상되고, 패시베이션 기능을 수행하는 후면 보호부(192) 쪽으로 갈수록 불순물의 도핑 농도가 감소하여 불순물로 인한 결함 발생이 감소하여 페시베이션 효과가 향상된다. Similar to the
후면 전계부(172) 위에 위치한 보조 전극(161)은 반사 방지부(130)와 유사하게, ITO, IZO 등과 같이 저항이 낮고 전도도가 좋은 투명한 도전성 물질로 이루어져 있다. 이로 인해, 보조 전극(161)은 하부에 위치한 후면 전계부(172)와 전기적으로 연결되어 있다. 따라서, 보조 전극(161)은 후면 전계부(172) 쪽으로 이동한 전하(예, 전자)를 후면 전극(151) 쪽으로 전달하고, 또한, 기판(110), 후면 보호부(192) 및 후면 전계부(172)를 통과한 빛을 기판(110) 쪽으로 반사시켜 기판(110)으로 입사되는 빛의 양을 증가시킨다. Similar to the
이처럼, 반도체 물질로 이루어진 후면 전계부(172)와 금속 물질로 이루어진 후면 전극(151) 사이에 투명한 금속 물질로 이루어진 보조 전극(161)이 존재하여 접착력(접촉 특성)이 약한 반도체 물질과 금속 물질 간의 접착력이 향상된다. 이로 인해, 후면 전계부(172)와 후면 전극(151) 사이의 접착력이 향상되고, 후면 전계부(172)과 후면 전극(151) 사이에 오믹 콘택(ohmic contact)이 형성되어, 후면 전계부(172)과 후면 전극(151) 사이의 전기 전도도가 향상되고, 이로 인해, 후면 전극(151)으로의 전하의 전송 효율이 증가한다. 이러한 보조 전극(161)은 생략 가능하다.As such, an
보조 전극(161) 위에 위치한 후면 전극(151)은 알루미늄(Al)과 같은 적어도 하나의 도전 물질로 이루어져 있다. 하지만, 대안적인 실시예에서, 도전 물질은 니켈(Ni), 구리(Cu), 주석(Sn), 아연(Zn), 인듐(In), 티타늄(Ti), 은(Ag), 금(Au) 및 이들의 조합으로 이루어진 군으로부터 선택된 적어도 하나일 수 있지만, 이외의 다른 도전 물질로 이루어질 수 있다.The
이처럼, 후면 전극(151)이 금속 물질로 이루어져 있으므로, 보조 전극(161)과 유사하게, 후면 전극(151)은 기판(110)을 통과한 빛을 기판(110)쪽으로 반사시킨다.As such, since the
본 실시예와 달리, 태양 전지(11)는 후면 전극(151) 위에 또는 후면 전극(151)이 위치하지 않은 보조 전극(161) 위에 복수의 후면 버스바를 더 구비할 수 있다. 복수의 후면 버스바는 복수의 전면 버스바(142)와 대응하게 위치하고, 후면 전극(151)과 전기적 및 물리적으로 연결되어 있다. 이러한 복수의 후면 버스바는 복수의 전면 버스바(142)와 동일하게 외부 장치와 연결되어 있으므로, 인접한 후면 전극(151) 부분으로부터 전달되는 전하(예, 전자)를 외부 장치로 전달한다. 복수의 전면 버스바(142)와 유사하게 후면 전극(151)에 수집된 전하를 외부 장치로 전달해야 하므로, 복수의 후면 버스바는 은(Ag)과 같이 후면 전극(151)보다 전도도가 양호한 재료로 이루어질 수 있다. Unlike the present exemplary embodiment, the
이와 같은 구조를 갖는 태양 전지(11)는 기판(110)과 에미터부(121)가 서로 다른 종류의 반도체로 이루어져 있는 태양 전지로서, 그 동작은 다음과 같다.The
태양 전지(11)로 빛이 조사되어 보조 전극(161)과 전면 보호부(191)를 통과한 후 기판(110)으로 입사되면 빛 에너지에 의해 기판(110)에서 전자-정공 쌍이 발생한다. 이때, 기판(110)의 표면이 텍스처링 표면을 갖고 있고 반사 방지부(130)를 구비하고 있으므로, 기판(110) 전면에서의 빛 반사 손실이 감소하여 기판(110) 내로 입사되는 빛의 양이 증가하고, 이로 인해 태양 전지(11)의 효율이 향상된다. When light is irradiated to the
이들 전자-정공 쌍은 기판(110)과 에미터부(121)의 p-n 접합에 의해 서로 분리되어, 정공은 p형의 도전성 타입을 갖는 에미터부(121) 쪽으로 이동하고 전자는 n형의 도전성 타입을 갖는 후면 전계부(172) 쪽으로 이동하며, 이동한 정공은 반사 방지부(130)를 통해 복수의 전면 전극(141)과 복수의 전면 버스바(142)로 전달되고, 이동한 전자는 보조 전극(161)을 통해 후면 전극(151)으로 전달되어, 복수의 전면 버스바(142)와 후면 전극(151)에 의해 수집된다. 이러한 복수의 전면 버스바(142)와 후면 전극(151)을 도선으로 연결하면 전류가 흐르게 되고, 이를 외부에서 전력으로 이용하게 된다.These electron-hole pairs are separated from each other by the pn junction of the
이때, 기판(110)의 후면뿐만 아니라 기판(110)의 전면에 보호부(192, 191)가 위치하므로, 기판(110)의 전면 및 후면 표면 그리고 그 근처에 존재하는 결함으로 인한 전하 손실량이 줄어들어 태양 전지(11)의 효율이 향상된다.In this case, since the
이때, 에미터부(121)와 후면 전계부(172)의 불순물 도핑 농도가 전면 전극부(140)와 후면 전극(151) 쪽에 가까워질수록 증가하므로, 전하의 전송 효율은 더욱더 향상된다. At this time, since the impurity doping concentrations of the
이러한 태양 전지(11)를 제조하는 제조 방법에 대하여 도 3a 내지 도 3g를 참고로 하여 설명한다.A manufacturing method of manufacturing such a
도 3a를 참고로 하면, 예를 들어 n형의 단결정 실리콘으로 이루어진 기판(110)의 한 면에 식각 방지막(60)을 형성하고, 이 식각 방지막(60)을 마스크로 하여 식각 방지막(60)이 형성되지 않은 기판(110)의 면(예, 입사면)을 식각하여, 입사면인 기판(110)의 전면에 복수의 돌출부를 구비한 텍스처링 표면(textured surface)을 형성한 후, 식각 방지막(60)을 제거한다. Referring to FIG. 3A, an
대안적인 예에서, 식각 방지막(60)을 형성하지 않고 식각을 원하는 기판(110)의 면을 식각액이나 식각 가스에 노출시켜, 기판(110)의 전면과 후면 중 적어도 하나의 면에 텍스처링 표면을 형성할 수 있다.In an alternative example, the surface of the
그런 다음, 도 3b에 도시한 것처럼, 기판(110)의 전면과 후면에 플라즈마 기상 증착법(plasma enhanced vapor deposition, PECVD) 등과 같은 막 형성법을 이용하여 반도체 재료로 이루어진 보호막(190)을 형성한다. 이때, 반도체 재료는 비정질 실리콘(amorphous silicon, a-Si), 실리콘 산화물(SiOx), 비정질 실리콘 산화물(amorphous SiOx, a-SiOx), 수소화된 실리콘 산화물(SiOx:H) 및 이들의 화합물, 수소화된 비정질 실리콘 산화물(a-SiOx:H), 실리콘 질화물(SiNx), 수소화된 실리콘 질화물(SiNx:H), 비정질 실리콘 질화물(amorphous SiNx, a-SiNx), 수소화된 비정질 실리콘 질화물(a-SiNx:H) 및 이들의 화합물일 수 있다. 이때, 보호막(190)은 p형 또는 n형의 불순물이 도핑된 막이거나 진성 반도체 막일 수 있다. 불순물이 도핑된 막일 경우, 불순물의 도핑 농도는 기판(110)의 불순물 도핑 농도보다 작다. Next, as shown in FIG. 3B, a
이때, 기판(110)의 전면 위에 형성되는 보호막(190)의 두께는 약 15nm일 수 있고, 기판(110)의 후면 위에 형성되는 보호막(190)의 두께는 약 20nm일 수 있다.In this case, the thickness of the
기판(110)의 전면과 후면에 보호막(190)을 형성할 경우, 기판(110)의 전면 또는 후면을 공정실에 노출시켜 기판(110)의 전면 또는 후면 위에 보호막(190)을 형성한 후, 다시 기판(110)의 후면 또는 전면을 동일한 공정실에 노출시켜 기판(110)의 후면 또는 전면 위에 보호막(190)을 형성한다. 이때, 기판(110)의 전면과 후면에 형성되는 보호막(190)의 형성 순서는 변경 가능하다.When the
그런 다음, 도 3c에 도시한 것처럼, 기판(110)의 전면에 위치한 보호막(190) 위에 제2 도전성 타입의 불순물, 예를 들어, 붕소(B)와 같은 3가 원소의 불순물이 함유된 도핑 페이스트(doping paste)를 스크린 인쇄법(screen printing)이나 직접 인쇄법(direct printing) 등을 이용하여 도포한 후 건조시키고, 기판(110)의 후면에 위치한 보호막(190) 위에 제1 도전성 타입의 불순물, 예를 들어, 인(P)와 같은 5가 원소의 불순물이 함유된 도핑 페이스트를 스크린 인쇄법이나 직접 인쇄법 등을 이용하여 도포한 후 건조시켜, 기판(110)의 전면에 제2 도전성 타입의 불순물막(120)과 기판(110)의 후면에 제1 도전성 타입의 불순물막(170)을 형성한다. 이때, 제2 도전성 타입의 불순물막(120)과 제1 도전성 타입의 불순물막(170)의 형성 순서는 변경 가능하다. Then, as illustrated in FIG. 3C, a doping paste containing impurities of the second conductivity type, for example, trivalent elements such as boron (B), is formed on the
다음, 도 3d를 참고로 하여, 불순물막(120, 170)이 형성된 기판(110)을 정해진 공정 조건에 맞게 열처리하여, 불순물막(120)에 함유된 제2 도전성 타입의 불순물을 기판(110)의 전면에 위치한 보호막(190) 내부로 확산시켜 기판(110)의 전면에 제2 도전성 타입의 불순물이 도핑된 에미터부(121)를 형성하고, 불순물막(170)에 함유된 제1 도전성 타입의 불순물을 기판(110)의 후면에 위치한 보호막(190) 내부로 확산시켜 기판(110)의 후면에 제1 도전성 타입의 불순물이 도핑된 후면 전계부(172)를 형성한다. 그런 다음, 기판(110) 위에 남아있는 불순물막(120, 170)의 잔여물을 습식 식각법 등으로 제거한다. 이때, 물(water), 아세톤(acetone), 알코올(alcohol) 등을 이용하여 잔여물을 제거할 수 있다.Next, referring to FIG. 3D, the
이때, 에미터부(121)와 접해 있는 에미터부(121)의 표면 및 부근에 위치하고 제2 도전성 타입의 불순물이 도핑되지 않은 기판(110) 전면에 위치한 보호막(190)의 부분은 전면 보호부(191)가 되고, 후면 전계부(172)와 접해 있는 후면 전계부(172)의 표면 및 부근에 위치하고 제2 도전성 타입의 불순물이 도핑되지 않은 기판(110) 후면에 위치한 보호막(190)의 부분은 후면 보호부(192)가 되어, 에미터부(121)와 전면 보호부(191)를 구비한 전면 보호막(190a1)과 후면 전계부(172)와 후면 보호부(192)를 구비한 후면 보호막(190a2)를 형성한다. In this case, the portion of the
이와 같이, 보호막(190)을 형성한 후 확산 공정을 통해 전면 보호부(191) 및 후면 보호부(192)와 에미터부(121) 및 후면 전계부(172)가 형성되므로, 태양 전지(11)의 제조 공정이 단순해지고, 이로 인해, 태양 전지(11)의 제조 시간이 줄어든다. 즉, 별도의 막 형성 공정을 통해 전면 보호부(191), 에미터부(121), 후면 보호부(192) 및 후면 전계부(172)를 형성하는 대신, 하나의 공정실에서 동일한 재료로 기판(110)의 전면과 후면에 보호막(190)을 형성한 후, 도핑 페이스트를 이용한 열 확산 공정을 통해 전면 전면 보호부(191)와 에미터부(121) 그리고 후면 보호부(192)와 후면 전계부(172)가 형성되므로, 태양 전지(11)의 제조 공정이 단순해진다.As such, after forming the
이때, 제1 및 제2 도전성 타입의 불순물의 확산 상태(예, 확산 속도 등)는 보호막(190) 위에 도포되는 도핑 페이스트의 양, 열처리 시간, 열처리 온도 등에 따라 달라진다. 본 실시예에서, 열처리 온도는 결정질 반도체로 이루어진 기판(110) 내부에 불순물을 확산시키는 경우(예, 약 400℃ 내지 500℃)에 비해 낮은 온도, 예를 들어, 약 150℃ 내지 300℃에서 행해진다. 즉, 에미터부(121)와 후면 전계부(172)는 결정질 기판(110)이 아닌 비결정질 반도체로 이루어진 보호막(190)에 형성된다. 따라서 결정질 기판(110) 내부로 불순물이 확산될 때보다 비결정질 반도체 내부로 불순물이 확산될 때 불순물의 확산이 용이하게 행해지고, 기판(110) 내부까지 불순물의 확산이 불필요하므로, 약 400℃ 내지 약 500℃의 높은 온도에서의 확산 동작이 불필요하다. 이로 인해, 약 400℃ 내지 약 500℃보다 훨씬 낮은 약 150℃ 내지 약 300℃의 저온에서 열 확산 동작이 이루어지므로, 고온에서의 열처리 공정으로 인한 기판(110) 등의 열화 현상이 줄어든다.In this case, the diffusion state (eg, diffusion rate, etc.) of the impurities of the first and second conductivity types may vary depending on the amount of the doping paste applied on the
불순물 확산을 위한 열처리 온도가 약 150℃ 이상이면, 불순물의 확산 동작이 좀더 안정적으로 이루어져 에미터부(121)와 후면 전계부(172)의 안정적인 불순물 확산 두께가 얻어지고, 불순물 확산을 위한 열처리 온도가 약 300℃ 이하이면, 열화 현상 없이 보호막(190)에만 불순물의 확산 동작이 좀더 안정적으로 행해진다.When the heat treatment temperature for impurity diffusion is about 150 ° C. or more, the diffusion operation of impurities is more stable to obtain a stable impurity diffusion thickness of the
대안적인 예에서, 에미터부(121)와 후면 전계부(172)의 형성 공정은 별개로 이루어질 수 있다. In an alternative example, the process of forming the
이 경우, 기판(110)의 전면 위에 형성된 보호막(190) 위에, 제2 도전성 타입의 불순물막(120)을 형성한 후 열처리 하여, 기판(110) 전면의 보호막(190) 내에 불순물을 확산시켜 에미터부(121)와 전면 보호부(191)를 형성하고, 기판(110)의 후면 위에 형성된 보호막(190) 위에, 제1 도전성 타입의 불순물막(170)을 형성한 후 열처리 하여, 기판(110) 후면의 보호막(190) 내에 불순물을 확산시켜 후면 전계부(172)와 후면 보호부(192)를 형성한 후, 기판(110)의 표면에 남아 있는 보호막(190)의 잔여물을 제거한다.In this case, the
이때, 전면 보호부(191)에는 두 번의 열처리 동작이 행해지므로, 전면 보호부(191)를 위한 1차 열처리 시 열처리 시간이나 열처리 온도 등을 정상적인 열처리 공정 시보다 좀더 낮게 제어할 수 있다. 이 경우, 열처리 공정에 기판(110)이 노출되는 온도나 시간이 줄어들기 때문에, 기판(110)의 열화 현상이 좀더 줄어든다. 이 경우, 에미터부(121)와 후면 전계부(121)의 형성 순서는 변경 가능하다.In this case, since the two heat treatment operations are performed on the
이 경우, 별도의 열처리 공정에 의해, 에미터부(121)와 후면 전계부(172)의 특성 차이 그리고, 기판(110)의 전면과 후면에 형성되는 보호막(190)의 두께 차이 등과 같은 특성 차이 등에 맞게 열처리 조건이 정해지므로, 에미터부(121)와 후면 전계부(172)의 확산 정도 등의 제어가 용이하고, 이로 인해, 에미터부(121)와 후면 전계부(172) 그리고 전/후면 보호부(191, 192)의 동작 특성이 좀더 안정되고 향상된다. In this case, due to a separate heat treatment process, a difference in characteristics between the
도 3e에 도시한 것처럼, 에미터부(121) 위에 PECVD 등으로 ITO나 IZO와 같은 투명한 도전막을 형성하여, 반사 방지부(130)를 형성하고, 다음, 도 3f에 도시한 것처럼, PECVD 등으로 ITO나 IZO와 같은 투명한 도전막을 형성하여 기판(110)의 후면 전계부(172) 위에 보조 전극(161)을 형성한다.As shown in FIG. 3E, a transparent conductive film such as ITO or IZO is formed on the
이때, 반사 방지부(130)와 보조 전극(161)의 형성 순서는 변경 가능하며, 반사 방지부(130)와 보조 전극(161)은 스퍼터링법(sputtering) 등과 같이 다른 막 형성법으로 형성 가능하다.In this case, the order of forming the
다음, 도 3g에 도시한 것처럼, 스크린 인쇄법을 이용하여, 반사 방지부(130) 위에 은(Ag)이 함유된 도전성 페이스트(paste)인 전면전극부용 페이스트(40)를 도포한 후 건조시키고 보조 전극(161) 위에 알루미늄(Al)이나 은(Ag)을 함유한 도전성 페이스트인 후면전극용 페이스트(50)를 도포한 후 건조시켜, 반사 방지부(130) 위에 위치하는 복수의 전면 전극(141) 및 복수의 전면 버스바(142)와 보조 전극(161) 위에 위치하는 후면 전극(151)을 형성하여, 태양 전지(11)를 완성한다(도 1 및 도 2).Next, as illustrated in FIG. 3G, the
보조 전극(161) 위에 도포된 전면전극부용 페이스트(40)는, 도 3g에 도시한 것처럼, 전면전극용 부분(41)과 전면버스바용 부분(42)을 구비하고 있고, 전면전극부용 페이스트(40)의 건조 동작에 의해, 전면전극용 부분(41)은 복수의 전면 전극(141)이 되고, 전면버스바용 부분(42)은 복수의 전면 버스바(142)가 된다.The front
다음, 도 4 및 도 5를 참고로 하여, 본 발명의 다른 실시예에 따른 태양 전지(12)에 대하여 설명한다.Next, the
도 1 및 도 2와 비교하여, 동일한 기능을 수행하는 구성요소에 대해서는 같은 도면 부호를 부여하고, 그에 대한 자세한 설명은 생략한다.In comparison with FIGS. 1 and 2, the same reference numerals are assigned to components that perform the same function, and detailed description thereof will be omitted.
도 1 및 도 2에 도시한 태양 전지(11)와 비교할 때, 도 4 및 도 5에 도시한 태양 전지(12)는 에미터부와 이 에미터부에 연결된 전극이 빛이 입사되지 않는 기판의 후면에 위치한다.Compared with the
이러한 태양 전지(12)의 구조는 다음과 같다.The structure of such a
도 4 및 도 5에 도시한 것처럼, 본 실시예에 따른 태양 전지(12)는 기판(110), 기판(110)의 전면 위에 위치하는 전면 보호부(191a), 전면 보호부(191a) 위에 위치하는 반사 방지부(130), 기판(110)의 후면 위에 위치하는 후면 보호부(192a), 후면 보호부(192a) 위에 위치하는 복수의 에미터부(121a), 그리고 후면 보호부(192a) 위에 위치하고 복수의 에미터부(121a)와 이격되어 있는 복수의 후면 전계부(172a)를 구비한 보호막(190b), 복수의 에미터부(121a) 위에 각각 위치하는 복수의 제1 전극(141a), 그리고 복수의 후면 전계부(172a) 위에 각각 위치하는 복수의 제2 전극(151a)을 포함한다. As shown in FIGS. 4 and 5, the
도 1 및 도 2를 참고로 하여 설명한 것처럼, 기판(110)은 제1 도전성 타입(예, n형)의 결정질 반도체로 이루어진다.As described with reference to FIGS. 1 and 2, the
기판(110)의 전면에 위치한 표면이 요철면이므로, 기판(110)의 전면 위에 위치한 전면 보호부(191a)와 반사 방지부(130) 역시 요철면을 갖는다.Since the surface disposed on the front surface of the
기판(110)의 전면 위에 위치한 전면 보호부(191a)는 보호막(190b) 중에서 복수의 에미터부(121a)와 복수의 후면 전계부(172a)를 제외한 영역으로서, 비정질 실리콘(a-Si)과 같은 비결정질 반도체로 이루어져 있고 패시베이션 기능을 수행하여 결함에 의해 기판(110)의 표면 및 그 근처에서 손실되는 전하의 양을 감소시킨다. 이때, 전면 보호부(191a)의 두께는 약 1nm 내지 10nm일 수 있다.The
전면 보호부(191a)의 두께가 약 1nm 이상이면 기판(110) 전면에 전면 보호부(191a)가 좀더 균일하게 도포되므로 패시베이션 기능을 좀더 양호하게 수행할 수 있으며, 전면 보호부(191a)의 두께가 약 10nm 이하이면 전면 보호부(191a) 내에서 흡수되는 빛의 양을 좀더 감소시켜 기판(110) 내로 입사되는 빛의 양을 좀더 증가시킬 수 있다. 전면 보호부(191a)는 필요에 따라 생략 가능하다.If the thickness of the
전면 보호부(191a) 위에 위치한 반사 방지부(130)는 태양 전지(12)로 입사되는 빛의 반사도를 줄이고 특정한 파장 영역의 선택성을 증가시켜, 태양 전지(12)의 효율을 높인다. 이러한 반사 방지부(130)는 실리콘 질화막(SiNx), 실리콘 산화막(SiOx) 등으로 이루어지고, 약 70㎚ 내지 90㎚의 두께를 가질 수 있다. 이러한 반사 방지부(130)는 필요에 따라 생략 가능하다.The
후면 보호부(192a)는, 도 1 및 도 2의 후면 보호부(192)와 동일하게, 기판(110)의 후면에 전체적으로 위치하고 비결정질 반도체 재료로 이루어진다. 경우에 따라, 후면 보호부(192a) 역시 기판(110)의 후면 가장 자리 부분에는 위치하지 않을 수 있다.The
기판(110)과 접해 있는 후면 보호부(192a)의 면인 후면 보호부(192a)의 하부면은 기판(110)의 표면과 동일한 형상을 갖고 있어, 기판(110)과 동일하게 평탄면을 갖고 있고, 하부면의 반대 편에 위치하는 후면 보호부(192a)의 상부면은 복수의 함몰부(1921, 1922)를 갖고 있다.The lower surface of the rear
함몰부들(1921)의 위치는 복수의 에미터부(121a)의 형성 위치에 대응하고, 함몰부들(1922)의 위치는 복수의 후면 전계부(172a)의 형성 위치에 대응한다. 이때, 함몰부(1921)와 함몰부(1922)는 번갈아 위치하고 서로 나란해 정해진 방향으로 뻗어 있다. The positions of the
함몰부(1921, 1922)의 영향으로 후면 보호부(192a)는 제1 부분(1923)과 제1 부분(1923)보다 두께가 낮은 제2 부분(1924a, 1924b)을 갖고 있다. 제2 부분(1924a)은 에미터부(121a) 하부에 위치한 후면 보호부(192a)의 제2 부분이고, 제2 부분(1924b)은 후면 전계부(172a) 하부에 위치한 후면 보호부(192a)의 제2 부분이다. Under the influence of the
이때, 제1 부분(1923)의 두께는 약 20nm 내지 약 40nm이고, 제2 부분(1924a, 1924b)의 최대 두께는 약 5nm이다.At this time, the thickness of the
후면 보호부(192a)는, 도 1 및 도 2의 후면 보호부(192)와 동일하게, 비결정질 반도체 재료로 이루어져 있고, 후면 보호부(192a)는 불순물이 도핑되지 않은 진성 반도체 재료일 수 있다. The
이러한 후면 보호부(192a)는 패시베이션 기능을 수행하여, 기판(110)의 후면 쪽으로 이동한 전하가 불안정한 결합에 의해 소멸되는 것을 감소한다.The rear
복수의 에미터부(121a)는 후면 보호부(192a)의 복수의 함몰부(1921) 위에 각각 위치하고, 복수의 함몰부(1921)를 따라 길게 뻗어 있다.The plurality of
도 1 및 도 2의 에미터부(121)와 유사하게, 각 에미터부(121a)는 기판(110)의 도전성 타입과 반대인 제2 도전성 타입(예, p형)을 갖고 있고 비결정질의 반도체 재료로 이루어져 있는 불순물부이다. 따라서, 복수의 에미터부(121a)는 기판(110)과 이종 접합 및 p-n 접합을 형성한다.Similar to the
따라서, 기판(110)과 에미터부(121a)와의 p-n 접합에 의해 전자와 전하가 생성되어, 후면 보호부(192a) 쪽으로 이동한다.Accordingly, electrons and charges are generated by the p-n junction between the
각 에미터부(121a)의 하부면은 후면 보호부(192a)의 각 함몰부(1921)의 표면과 접해 있고, 각 하부면의 반대편에 위치하는 각 에미터부(121a)의 상부면은, 후면 보호부(192a)의 제1 부분(1923)과 동일한 높이에 위치하다.The lower surface of each
이들 복수의 에미터부(121a)는 후면 보호부(192a)와 함께 패시베이션 기능을 수행할 수 있고, 이 경우 결함에 의해 기판(110)의 후면에서 소멸되는 전하의 양이 감소하여 태양 전지(12)의 효율이 향상된다.The plurality of
복수의 후면 전계부(172a)는 후면 보호부(192a)의 복수의 함몰부(1922) 위에 각각 위치하고, 복수의 함몰부(1922)를 따라 길게 뻗어 있다. 따라서, 도 4 및 도 5에 도시한 것처럼, 기판(110)의 후면 위에는 서로 이격되어 있는 후면 전계부(172a)와 에미터부(121a)가 번갈아 위치한다.The plurality of rear
이러한 복수의 후면 전계부(172a)는 기판(110)과 동일한 도전성 타입(예, n형)의 불순물이 기판(110)보다 고농도로 도핑된 불순물부이다. 예를 들어, 복수의 후면 전계부(172)는 n+의 불순물 영역일 수 있다.The plurality of rear
본 실시예에서, 복수의 후면 전계부(172a)는 비결정질의 반도체 재료로 이루어져, 기판(110)과 이종 접합을 형성한다.In the present embodiment, the plurality of backside
이러한 후면 전계부(172a)는, 도 1 및 도 2의 후면 전계부(172)와 동일하게, 기판(110)과 후면 전계부(172a)와의 불순물 농도 차이로 인한 전위 장벽에 의해 전자의 이동 방향인 후면 전계부(172a) 쪽으로의 정공 이동을 방해하는 반면, 후면 전계부(172a) 쪽으로의 전하(예, 전자) 이동을 용이하게 한다. 따라서, 후면 보호부(192a)를 통과한 전하, 예를 들어, 전자가 후면 전계부(172a) 및 그 부근에서 정공과 재결합되어 손실되는 양을 감소시키고, 후면 보호부(192a)로부터 후면 전계부(172a)로의 전자 이동을 가속화시켜 기판(110)에서부터 후면 전계부(172a)로의 전자 이동량을 증가시킨다.The rear
각 후면 전계부(172a)의 하부면은 후면 보호부(192a)의 각 함몰부(1922)의 표면과 접해 있고, 각 하부면의 반대편에 위치하는 각 후면 전계부(172a)의 상부면은 후면 보호부(192a)의 제1 부분(1923)과 동일한 높이에 위치하다. The lower surface of each rear
복수의 후면 전계부(172a) 역시 후면 보호부(192a)와 함께 패시베이션 기능을 수행할 수 있고, 이 경우 결함에 의해 기판(110)의 후면에서 소멸되는 전하의 양이 감소하여 태양 전지(12)의 효율이 향상된다. 이러한 후면 전계부(172a)는 필요에 따라 생략 가능하다.The plurality of rear
각 에미터부(121a)와 각 후면 전계부(172a)의 두께는 동일할 수 있지만, 서로 다를 수 있다.The thickness of each
예를 들어, 원하는 전하의 이동을 방해하기 위한 전계의 생성을 원활히 하기 위해, 각 후면 전계부(172a)의 두께가 각 에미터부(121a)의 두께보다 더 클 수 있다. 이로 인해, 각 후면 전계부(172a) 하부에 위치하는 후면 보호부(192a)의 제2 부분(1924b)은 약 2.5nm 내지 5nm일 수 있고, 각 에미터부(121a) 하부에 위치하는 후면 보호부(192a)의 제2 부분(1924a)은 약 3.5nm 내지 5nm일 수 있다.For example, in order to facilitate generation of an electric field to hinder the movement of a desired charge, the thickness of each backside
본 예에서, 각 에미터부(121a)의 두께는 양호한 p-n 접합의 형성과 각 에미터부(121a) 자체에서의 빛 흡수 정도를 고려하여 정해지고, 각 후면 전계부(172a)의 두께는 양호한 크기의 전계 생성과 각 에미터부(121a) 자체에서의 빛 흡수 정도를 고려하여 정해진다. In this example, the thickness of each
후면 보호부(192a)의 제1 부분(1923)의 두께가 약 20nm이면 안정적으로 원하는 두께를 갖는 후면 전계부(172a)와 에미터부(121a)를 형성하면서 패시베이션 기능을 수행할 있고, 제1 부분(1923)의 두께가 약 40nm 이하이면 재료의 낭비와 공정 시간을 좀더 줄일 수 있으며 후면 보호부(192a) 내에 흡수되는 빛의 양을 좀더 감소시킬 수 있다. 후면 보호부(192a)의 제2 부분(1924a, 1924b)의 두께가 약 5nm이하이면, 후면 보호부(192a)의 제2 부분(1924a, 1924b)을 통과하여 좀더 안정적으로 전하가 에미터부(121a)와 후면 전계부(172a) 쪽으로 이동할 수 있다.If the thickness of the
본 실시예에서, 각 에미터부(121a)와 각 후면 전계부(172a)의 최대 폭(W1, W2)은 서로 상이하다. 즉, 에미터부(121a)의 최대 폭(W1)이 후면 전계부(172a)의 최대 폭(W2)보다 크다. 이로 인해, p-n 접합 영역이 증가하므로 전자-정공 쌍의 발생량이 증가하고, p-n 접합 부분에서의 전류 손실을 줄일 수 있으며, 전자에 비해 이동도가 낮은 정공의 수집에 유리하다. In this embodiment, the maximum widths W1 and W2 of each
하지만, 이와는 달리, 후면 전계부(172a)의 최대 폭(W2)이 에미터부(121a)의 최대 폭(W1)보다 클 수 있다. 이 경우, 후면 전계부(172a)의 면적이 증가하여, 후면 전계부(172a)로 인한 후면 전계 효과가 증가한다.However, alternatively, the maximum width W2 of the rear
이미 설명한 것처럼, 후면 보호부(192a), 복수의 에미터부(121a) 및 복수의 후면 전계부(172a)는 모두 비결정질 반도체 재료로 이루어져 있고, 에미터부(121a)와 후면 전계부(172a)에 도핑된 불순물을 제외하면 후면 보호부(192a), 복수의 에미터부(121a) 및 복수의 후면 전계부(172a)는 동일한 재료로 이루어져 있다.As described above, the rear
복수의 에미터부(121a) 위에 위치하는 복수의 제1 보조 전극(162)은 각 에미터부(121a)를 따라서 연장되어 있고, 복수의 에미터부(121a)와 전기적으로 연결되어 있다. 이로 인해, 각 에미터부(121a)는 그 상부에 위치한 제1 보조 전극(162)에 의해 대기 중의 산소로부터 보호되어, 산화 현상 등으로 인한 특성 변화가 방지된다. The plurality of first
복수의 후면 전계부(172a) 위에 위치하는 복수의 제2 보조 전극(163)은 각 후면 전계부(172a)를 따라서 연장되어 있고, 복수의 후면 전계부(172a)와 전기적으로 연결되어 있다. 각 에미터부(121a)와 유사하게, 각 후면 전계부(172a)는 제2 보조 전극(163)에 의해 대기 중의 산소로부터 보호되어, 산화 현상 등으로 인한 특성 변화가 방지된다. The plurality of second
복수의 제1 및 제2 보조 전극(162, 163)은 도전성이 있는 투명한 도전 물질로 이루어진다. 투명한 도전 물질의 예는 ITO나, ZnO 등일 수 있다.The plurality of first and second
복수의 제1 및 제2 보조 전극(162, 163)은 복수의 에미터부(121a)와 복수의 후면 전계부(172a) 쪽으로 각각 이동한 전하, 예를 들어 정공과 전자를 각각 전달하고, 기판(110)과 후면 보호부(192a)를 통과한 빛을 기판(110) 쪽으로 반사시켜 기판(110)으로 입사되는 빛의 양을 증가시키는 반사막(reflector)으로서 기능한다. 하지만, 대안적인 실시예에서, 복수의 제1 및 제2 보조 전극(162, 163)은 생략 가능하다.The plurality of first and second
도 4 및 도 5에서, 제1 보조 전극(162) 및 제2 보조 전극(163) 각각의 최대 폭(W21, W22)은 에미터부(121a)와 후면 전계부(172a) 각각의 최대 폭(W1, W2)보다 작지만 동일할 수 있다. 각 제1 및 제2 보조 전극(162, 163)의 최대 폭(W21, W22)이 각 에미터부(121a)와 후면 전계부(172a)의 최대 폭(W1, W2)보다 작을 경우, 에미터부(121a)와 후면 전계부(172a)의 영역 내에 안정적으로 제1 및 제2 보조 전극(162, 163)이 각각 위치하여, 전하의 손실을 방지할 수 있다. 이때, 제1 및 제2 보조 전극(162, 163)과 에미터부(121a) 및 후면 전계부(172a)와의 접촉 면적이 증가할수록 제1 및 제2 보조 전극(162, 163)과 에미터부(121a) 및 후면 전계부(172a) 간의 접촉 저항이 감소하여, 에미터부(121a) 및 후면 전계부(172a)에서 제1 및 제2 보조 전극(162, 163)으로 이동하는 전하의 양이 증가하고, 이로 인해 제1 및 제2 보조 전극(162, 163)으로 이동하는 전하의 전송율이 향상된다. 4 and 5, the maximum widths W21 and W22 of the first
복수의 제1 보조 전극(162) 위에 위치하는 복수의 제1 전극(141a)과 복수의 제2 보조 전극(163) 위에 위치하는 복수의 제2 전극(151a)은 도 1 및 도 2에 위치한 복수의 전면 전극(141) 및 후면 전극(151)과 비교할 때, 형성 위치와 개수를 제외하면 동일하다.The plurality of
예를 들어, 복수의 제1 전극(141a)은 복수의 제1 보조 전극(162) 위에서 복수의 제1 보조 전극(162)을 따라서 길게 연장되어 있고, 복수의 제1 보조 전극(162)과 물리적 및 전기적으로 연결되어 있다. For example, the plurality of
각 제1 전극(141a)은 해당 제1 보조 전극(162) 쪽으로 이동하는 전하, 예를 들어, 정공을 수집한다.Each
복수의 제2 보조 전극(163) 위에 위치하는 복수의 제2 전극(152a)은 복수의 제2 보조 전극(163)을 따라서 길게 연장되어 있고, 복수의 제2 보조 전극(163)과 전기적 및 물리적으로 연결되어 있다. The plurality of second electrodes 152a positioned on the plurality of second
각 제2 전극(151a)은 해당 제2 보조 전극(163) 쪽으로 이동한 전하, 예를 들어, 전자를 수집한다.Each
복수의 제1 및 제2 전극(141a, 151a)은 알루미늄(Al)이나 은(Ag)과 같은 적어도 하나의 금속 물질을 함유하고 있지만, 니켈(Ni), 구리(Cu), 주석(Sn), 아연(Zn), 인듐(In), 티타늄(Ti), 금(Au) 및 이들의 조합으로 이루어진 군으로부터 선택된 적어도 하나의 도전성 금속 물질 또는 이외의 다른 도전성 금속 물질로 이루어질 수 있다.The plurality of first and
이처럼, 복수의 제1 및 제2 전극(141a, 152a)이 금속 물질로 이루어져 있으므로, 복수의 제1 및 제2 전극(141a, 151a)은 복수의 제1 및 제2 보조 전극(162, 163)을 각각 통과한 빛을 기판(110) 쪽으로 반사시킨다.As described above, since the plurality of first and
도 4 및 도 5에서, 제1 전극(141a) 및 제2 전극(151a)은 하부에 각각 위치하는 제1 및 제2 보조 전극(162, 163)과 동일한 폭을 갖고 있어, 제1 및 제2 보조 전극(162, 163)과 동일한 평면 형상을 갖고 있다. 하지만, 제1 전극(141a) 및 제2 전극(151a)은 제1 및 제1 보조 전극(162, 163)의 위에 선택적으로 위치하여, 제1 및 제1 보조 전극(162, 163)의 폭보다 적은 폭을 가질 수 있다. 이때, 제1 및 제2 전극(141a, 151a)과 제1 및 제2 보조 전극(162, 163)과의 접촉 면적이 증가할수록 제1 및 제2 전극(141a, 151a)과 제1 및 제2 보조 전극(162, 163) 간의 접촉 저항이 감소하여, 제1 및 제2 보조 전극(162, 163)으로부터 제1 및 제2 전극(141a, 151a)으로 각각 이동하는 전하의 양이 증가한다. In FIGS. 4 and 5, the
이미 설명한 것처럼, 반도체 물질로 이루어진 복수의 에미터부(121a)와 후면 전계부(172a) 그리고 금속 물질로 이루어진 복수의 제1 및 제2 전극(141a, 151a) 사이에 투명한 금속 물질로 이루어진 복수의 제1 및 제2 보조 전극(162, 163)이 존재하므로, 복수의 에미터부(121a)와 복수의 제1 전극(141a) 사이 그리고 복수의 후면 전계부(172a)와 복수의 제2 전극(151a) 사이에 오믹 콘택이 형성되어, 복수의 에미터부(121a)와 복수의 제1 전극(141a) 사이 그리고 복수의 후면 전계부(172a)과 복수의 제2 전극(151a) 사이의 전기 전도도가 향상된다. As described above, the plurality of emitters made of a transparent metal material is formed between the
도 1 및 도 2에 도시한 태양 전지(11)과 비교할 때, 본 실시예의 태양 전지(12)는 복수의 제1 전극(141a)과 복수의 제2 전극(151a)이 빛이 입사되지 않는 기판(110)의 후면에 위치하므로, 기판(110) 내로 입사되는 빛의 양이 증가하여, 태양 전지(11)의 효율이 향상된다.Compared with the
다음, 도 6a 내지 도 6f를 참고로 하여, 이러한 태양 전지(12)를 제조하는 방법에 대하여 설명한다.Next, with reference to FIGS. 6A to 6F, a method of manufacturing the
도 3a를 참고로 하여 설명한 것처럼, 기판(110)을 식각하여 기판(110)의 표면에 요철면을 형성하다(도 6a).As described with reference to FIG. 3A, the
그런 다음, 도 6b에 도시한 것처럼, 비결정질 반도체 재료로 이루어진 보호막(190)을 기판(110)의 후면으로 작용할 기판(110)의 한 면에만 형성한다. 이미 도 3b를 참고로 하여 설명한 것처럼, 보호막(190)은 플라즈마 기상 증착법 등으로 형성되며, 비결정질 반도체 재료는 비정질 실리콘(a-Si), 실리콘 산화물(SiOx), 비정질 실리콘 산화물(a-SiOx), 수소화된 실리콘 산화물(SiOx:H) 및 이들의 화합물, 수소화된 비정질 실리콘 산화물(a-SiOx:H), 실리콘 질화물(SiNx), 수소화된 실리콘 질화물(SiNx:H), 비정질 실리콘 질화물(a-SiNx), 수소화된 비정질 실리콘 질화물(a-SiNx:H) 및 이들의 화합물일 수 있다. Then, as shown in FIG. 6B, a
이때, 형성되는 보호막(190)의 두께는 약 20nm 내지 약 40nm일 수 있다.In this case, the thickness of the
다음, 도 6c에 도시한 것처럼, 제1 도전성 타입의 불순물을 함유한 도핑 페이스트를 스크린 인쇄법이나 직접 인쇄법 등을 이용하여 보호막(190) 위에 선택적으로 도포한 후 건조시켜 제1 도전성 타입의 불순물막인 불순물부(170a)를 형성하고, 제2 도전성 타입의 불순물을 함유한 도핑 페이스트를 스크린 인쇄법이나 직접 인쇄법 등으로 보호막(190) 위에 선택적으로 도포한 후 건조시켜 제2 도전성 타입의 불순물막인 불순물부(120a)를 형성한다.Next, as illustrated in FIG. 6C, a doping paste containing an impurity of the first conductivity type is selectively coated on the
이때, 보호막(190a) 위에 도포되는 제1 도전성 타입의 불순물부(170a)은 일정한 간격으로 이격되어 있고 정해진 방향으로 길게 뻗어 있고, 제2 도전성 타입의 불순물부(120a)은 제1 도전성 타입의 불순물부(170a)와 이격되어 있으며 제1 도전성 타입의 불순물부(170a)를 따라 나란하게 뻗어 있다. 이로 인해, 보호막(190a) 위에는 제1 도전성 타입의 불순물부(170a)와 제2 도전성 타입의 불순물부(120a)가 번갈아 위치한다.In this case, the
보호막(190a) 위에 도포되는 제1 도전성 타입의 불순물부(170a)의 최대 폭(W31)은 제2 도전성 타입의 불순물부(120a)의 최대폭(W32)보다 적다.The maximum width W31 of the
제1 도전성 타입의 불순물부(170a)와 제2 도전성 타입의 불순물부(120a)의 도포 순서는 변경 가능하다.The application order of the
다음, 도 6d에 도시한 것처럼, 제1 도전성 타입의 불순물부(170a)와 제2 도전성 타입의 불순물부(120a)를 구비한 기판(110)을 열처리하여, 불순물부(170a)에 함유된 제1 도전성 타입의 불순물과 불순물부(120a)에 함유된 제2 도전성 타입의 불순물을 보호막(190) 내부로 확산시킨다. 그런 다음, 습식 식각법 등으로 보호막(190) 위에 남아있는 잔여물을 제거한다. Next, as illustrated in FIG. 6D, the
이로 인해, 불순물부(120a)와 접해 있는 보호막(190)의 부분에 제2 도전성 타입의 불순물이 확산되어 제2 도전성 타입의 불순물이 도핑된 부분이 형성되고 이 불순물이 도핑된 부분은 복수의 에미터부(121a)가 되고, 유사하게, 불순물부(170a)와 접해 있는 보호막(190)의 부분에 제1 도전성 타입의 불순물이 확산되어 제1 도전성 타입의 불순물이 도핑된 부분이 형성되고 이 불순물이 도핑된 부분은 복수의 후면 전계부(172a)가 된다.As a result, impurities of the second conductivity type are diffused into portions of the
이러한 불순물 확산 동작에 의해, 보호막(190)의 일부가 복수의 에미터부(121a)와 복수의 후면 전계부(172a)가 되면, 제1 및 제2 도전성 타입의 불순물이 확산되지 않은 보호막(190)의 나머지 부분은 후면 보호부(192a)가 되어, 후면 보호부(192a), 복수의 에미터부(121a) 및 복수의 후면 전계부(172a)를 구비한 보호막(190b)을 형성한다.When a part of the
도 3d를 참고로 하여 이미 설명한 것처럼, 제1 및 제2 도전성 타입의 불순물의 확산 동작을 위한 열처리 온도는 약 150℃ 내지 250℃의 저온에서 행해진다. 이로 인해, 고온의 열처리 공정으로 인한 기판(110) 등의 열화 현상이 줄어든다.As already described with reference to FIG. 3D, the heat treatment temperature for the diffusion operation of the impurities of the first and second conductivity types is performed at a low temperature of about 150 ° C to 250 ° C. As a result, deterioration of the
이와 같이, 한 번의 열 확산 동작에 의해, 복수의 에미터부(121a), 복수의 후면 전계부(172a) 및 후면 보호부(192a)가 동시에 형성되므로, 태양 전지(12)의 제조 공정이 줄어들고 이로 인해, 태양 전지(12)의 제조 시간이 단축된다.As described above, since the plurality of
대안적인 실시예에 따른 태양 전지가 복수의 후면 전계부(172a)를 구비하지 않을 경우, 도 6d를 참고로 하여 설명한 공정 중에서, 보호막(190) 위에 제1 도전성 타입의 불순물을 함유한 도핑 페이스트의 도포 및 건조 공정은 생략된다. When the solar cell according to an alternative embodiment does not include the plurality of backside
다음, 도 6e 및 도 6f에 도시한 것처럼, PECVD 등을 이용하여 기판(110) 전면 위에 비정질 실리콘으로 이루어진 전면 보호부(191a)를 형성하고, 전면 부호부(191a) 위에 실리콘 질화물이나 실리콘 산화물 등으로 이루어진 반사 방지부(130)를 형성한다. 이때, 전면 보호부(191)와 반사 방지부(130)는 동일한 공정실에서 형성되거나 별개의 공정실에서 형성될 수 있다. Next, as shown in FIGS. 6E and 6F, a front
다음, 도 6g에 도시한 것처럼, 복수의 후면 전계부(172a)와 복수의 에미터부(121a)를 구비한 기판(110)의 후면 전체에 PECVD 등으로 투명한 도전막을 형성한 후 투명 도전막의 일부를 습식 식각 공정 등으로 제거하여, 복수의 에미터부(121a)와 연결되는 복수의 제1 보조 전극(162)과 복수의 후면 전계부(172a)와 연결되는 복수의 제2 보조 전극(163)을 형성한다. Next, as illustrated in FIG. 6G, a transparent conductive film is formed on the entire rear surface of the
그런 다음, 도 6h에 도시한 것처럼, 복수의 제1 보조 전극(162)과 복수의 제2 보조 전극(163) 위에 스크린 인쇄법을 이용하여 전극 페이스트(paste)(51)를 도포한 후 열처리하여 복수의 제1 보조 전극(162)을 따라 길게 연장하는 복수의 제1 전극(141a)과 복수의 제2 보조 전극(163)을 따라 길게 연장하는 복수의 제2 전극(151a)을 형성한다. 이때, 전극 페이스트(51)는 알루미늄(Al)과 같은 도전성 물질을 함유한다. 이로 인해, 도 4 및 도 5에 도시한 태양 전지(12)가 완성된다. 다른 예에서, 복수의 제1 및 제2 보조 전극(162, 163)과 복수의 제1 및 제2 전극(141a, 151a)을 형성한 후, 전면 보호부(191a)와 반사 방지부(130)를 형성할 수도 있다.Then, as illustrated in FIG. 6H, the
본 발명의 또 다른 실시예에 따른 태양 전지(13)가 도 7에 도시한다.A
도 7에 도시한 태양 전지(13)는, 도 4 및 도 5에 도시한 태양 전지(12)와 비교할 때, 기판(110)의 전면에 위치한 전면 보호부(191a)와 반사 방지부(130) 사이에 위치한 전면 전계부(171)를 구비하고 있는 것을 제외하면, 도 4 및 도 5의 태양 전지(12)와 동일한 구조를 갖고 있다. 이때, 보호막(190c)은 전면 보호부(191a)와 전면 전계부(171)를 구비하고, 보호막(190c) 중 불순물이 도핑된 부분은 전면 전계부(171)를 이루고 나머지 부분은 전면 보호부(191a)를 형성한다.The
따라서, 동일한 구성요소에 대해서는 같은 도면 부호를 부여하였고, 그에 대한 자세한 설명은 생략한다. Therefore, like reference numerals refer to like elements, and a detailed description thereof will be omitted.
전면 전계부(171)는, 복수의 후면 전계부(172a)와 유사하게, 기판(110)과 동일한 도전성 타입의 불순물(예, n형)이 기판(110)보다 높은 농도로 함유된 불순물부이다. The front
따라서 이러한 전면 전계부(171)는 기판(110)과의 불순물 농도 차이로 인한 전위 장벽이 형상되어, 기판(110)의 전면 쪽으로 전자와 정공 중 하나(예, 정공)의 이동을 방해하여, 기판(110)의 전면 및 그 부근에서 전자와 정공의 재결합으로 손실되는 전하의 양을 감소시켜, 태양 전지(13)의 효율을 향상시킨다.Therefore, the front
이러한 태양 전지(13)는 이러한 전면 전계부(171)는 이미 도 3b 내지 도 3d를 참고로 하여 설명한 에미터부(121) 형성 방법과 유사하게 형성될 수 있다. 예를 들어, 기판(110)의 전면 위에 비결정질의 반도체 재료로 이루어진 보호막을 형성하고, 그 보호막 위에 기판(110)과 동일한 도전성 타입의 불순물을 함유한 도핑 페이스트를 도포한 후 건조시킨다. 이미 설명한 것처럼, 보호막은 진성 반도체이거나 기판(110)과 동일한 도전성 타입의 불순물이 기판(110) 보다 낮은 농도로 도핑된 반도체일 수 있다.In the
그런 다음, 약 150℃ 내지 약 300℃의 온도에서 열처리 공정을 실시하여, 도핑 페이스트에 함유된 불순물을 보호막 내부로 확산시켜, 기판(110)과 동일한 제1 도전성 타입의 불순물이 기판(110)보다 높은 농도를 갖는 불순물부를 형성하여 전면 전계부(171)를 형성하고, 불순물이 도핑되지 않고 전면 전계부(171) 하부에 위치한 보호막 부분은 전면 보호부(191a)가 되어, 보호막(190c)은 전면 보호부(191a)와 전면 전계부(171)를 구비한다. 이 경우, 한 번의 열처리 공정으로, 전면 보호부(191a)와 전면 전계부(171)가 형성되고 하나의 공정실이 사용되므로, 태양 전지(13)의 제조 시간과 제조 비용이 절감된다. 이때, 열처리 확산이 행해지는 횟수에 따라 열처리 온도나 열처리 시간 등이 제어된다. 즉, 두 번의 열 확산 공정이 행해지는 기판(110)의 전면이나 후면 쪽에 형성되는 불순물부의 열처리 온도나 열처리 시간 등은 한번의 열처리 확산 공정이 행해지는 기판(110)의 후면이나 전면 쪽에 형성되는 불순물부의 열처리 온도나 열처리 시간 등보다 적을 수 있다. Then, a heat treatment process is performed at a temperature of about 150 ° C. to about 300 ° C. to diffuse impurities contained in the doping paste into the protective film, so that impurities of the first conductivity type that are the same as those of the
대안적인 예에서, 한번의 열 확산 공정을 통해, 기판(110)의 전면에 전면 보호부(191a) 및 전면 전계부(171)와 기판(110)의 후면에 후면 보호부(192a)와 복수의 후면 전계부(172a) 및 복수의 에미터부(121a)를 형성할 수 있다. 즉, 기판(110)의 전면과 후면에 보호막(190)을 형성한 후, 기판(110)의 전면에 전면 전계부(171)용 도핑 페이스트와 기판(110)의 후면에 후면 전계부(172a)용 도핑 페이스트 그리고 에미터부(121a)용 도핑 페이스트를 도포한 후 한번의 열 확산 공정을 실시할 수 있다.In an alternative example, through one heat diffusion process, the front
하지만, 이와는 달리, 기판(110)의 전면 위에 비정질 실리콘 등으로 이루어진 전면 보호부(191a)를 PECVD 등으로 형성한 후, PECVD 등으로 전면 보호부(191a) 위에 비정질 실리콘 등으로 이루어진 전면 전계부(171)를 형성한다. 이 경우, 전면 전계부(171)를 형성하는 공정실에 제1 도전성 타입을 갖는 불순물, 예를 들어, 인(P) 등과 같은 5가 원소의 불순물을 포함하는 불순물 도핑 물질(예, POCl3나 PH3)을 주입하여, 기판(110)과 동일한 도전성 타입의 불순물이 기판(110)보다 높은 농도로 전면 전계부(171)에 도핑될 수 있도록 한다. 이 경우, 전면 전계부(171)의 불순물 도핑 농도의 제어가 정확하게 이루어질 수 있으므로, 전면 전계부(171)의 특성이 좀더 향상될 수 있다. However, unlike this, after forming the front
이때, 전면 전계부(171)는 기판(110)의 후면에 복수의 에미터부(121a)와 복수의 후면 전계부(172a)를 형성 후 또는 형성 전에 형성될 수 있다.In this case, the front
복수의 에미터부(121a)와 복수의 후면 전계부(172a)를 형성하기 전에 전면 전계부(171)를 형성할 경우, 동일한 공정실에서 PECVD 공정을 통해 전면 전계부(192a)와 기판(110) 후면의 보호막(90)을 형성할 수 있다. 이로 인해, 태양 전지(13)의 공정 시간과 제조 비용이 단축된다.When the
반면, 복수의 에미터부(121a)와 복수의 후면 전계부(172a)를 형성한 후 전면 전계부(171)를 형성할 경우, 전면 전계부(171)를 형성하기 전에 기판(110)의 전면에 세정 공정을 실시한 후 PECVD 공정 등을 통해 전면 전계부(171)를 형성한다. 이럴 경우, 세정 공정 후 전면 전계부(171)가 형성되므로, 전면 전계부(171)의 특성이 향상된다.On the other hand, when the front
이처럼, 전면 전계부(171)를 제외한 나머지 구성 요소는 이미 도 6a 내지 도 6f를 참고로 하여 설명한 것과 동일하므로, 자세한 설명은 생략한다. As described above, other components except for the front
도 8에 도시한 또 다른 실시예에 따른 태양 전지(14)는 기판(110)의 후면에 위치한 복수의 에미터부(121b)와 후면 전계부(172b)의 형상을 제외하면 도 7에 도시한 태양 전지(13)와 동일하다. The
즉, 도 8의 태양 전지(14)는 후면의 보호막(190d) 내에 복수의 에미터부(121b)와 복수의 후면 전계부(172b)가 위치하고, 인접한 에미터부(121b)와 후면 전계부(172b)가 서로 붙여 있다. 따라서, 인접한 인접한 에미터부(121b)와 후면 전계부(172b) 사이에 제1 및 제2 도전성 타입의 불순물이 혼합되어 있는 혼합부(181)가 존재하다. 이러한 혼합부(181)의 존재로 인해, p-n 접합 영역이 증가하고, 이 부분에서의 전하 재결합이 발생하지 않아 태양 전지(14)의 효율은 향상된다. That is, in the
이 경우, 도 7과는 달리, 기판(110)의 후면 전체에 에미터부(121b)와 후면 전계부(172b)가 형성되므로, p-n 접합의 영역과 후면 전계 형성 영역이 증가하여, 태양 전지(14)의 효율이 향상된다. 이 경우, 후면 전계부(172b)의 전계 효과에 의해, 후면 전계부(172b)와 에미터부(121b)의 접촉 부분에서의 전하 손실을 발생하지 않는다. 이러한 에미터부(121b)와 후면 전계부(172b)의 형성은, 도 6a 내지 도 6h의 공정에서, 열 확산 횟수나 시간의 증가시켜 용이하게 달성될 수 있으므로, 이에 대한 자세한 설명은 생략한다. In this case, unlike FIG. 7, since the
이상에서 본 발명의 바람직한 실시예에 대하여 상세하게 설명하였지만 본 발명의 권리범위는 이에 한정되는 것은 아니고 다음의 청구범위에서 정의하고 있는 본 발명의 기본 개념을 이용한 당업자의 여러 변형 및 개량 형태 또한 본 발명의 권리범위에 속하는 것이다.Although the preferred embodiments of the present invention have been described in detail above, the scope of the present invention is not limited thereto, and various modifications and improvements of those skilled in the art using the basic concepts of the present invention defined in the following claims are also provided. It belongs to the scope of rights.
110: 기판 121, 121a, 121b: 에미터부
130: 반사 방지부 140: 전극부,
141, 141a, 151, 151a: 전극 142: 전면 버스바
171: 전면 전계부 172, 172a, 172b: 후면 전계부
181: 혼합부 191, 192, 191a, 192a: 보호부110:
130: antireflection portion 140: electrode portion,
141, 141a, 151, 151a: electrode 142: front busbar
171: front
181: mixing
Claims (38)
상기 기판의 제1 면 위에 위치하고 비결정질 반도체 재료로 이루어진 제1 보호막,
상기 제1 보호막에 상기 제1 도전성 타입과 반대인 제2 불순물을 확산시켜 상기 제1 보호막 내에 상기 제2 불순물이 확산된 적어도 하나의 에미터부,
상기 에미터부에 전기적으로 연결되어 있는 제1 전극, 그리고
상기 기판에 전기적으로 연결되어 있는 제2 전극
을 포함하는 태양 전지.A substrate containing a first impurity of a first conductivity type and comprising a crystalline semiconductor,
A first passivation film disposed on the first surface of the substrate and made of an amorphous semiconductor material,
At least one emitter portion in which the second impurity is diffused in the first passivation layer by diffusing a second impurity opposite to the first conductivity type in the first passivation layer;
A first electrode electrically connected to the emitter unit, and
A second electrode electrically connected to the substrate
Solar cell comprising a.
상기 제1 보호막은 상기 제2 불순물이 확산되지 않은 영역을 구비한 태양 전지.In claim 1,
The first protective film is a solar cell having a region in which the second impurity is not diffused.
상기 불순물이 확산되지 않은 영역은 상기 기판과 상기 적어도 하나의 에미터부 사이에 위치하는 태양 전지.In claim 2,
The region in which the impurities are not diffused is located between the substrate and the at least one emitter portion.
상기 기판의 제1 면의 반대편에 위치하는 상기 기판의 제2 면 위에 위치하고 상기 비결정질 반도체 재료로 이루어진 제2 보호막, 그리고
상기 제2 보호막에상기 제1 불순물을 확산시켜 상기 제2 보호막 내에 상기 제1 불순물이 확산된 제1 전계부를 더 포함하는 태양 전지.In claim 1,
A second passivation film made of the amorphous semiconductor material and positioned on the second face of the substrate opposite the first face of the substrate, and
And a first electric field part in which the first impurity is diffused in the second passivation layer and the first impurity is diffused in the second passivation layer.
상기 제2 보호막은 상기 제1 불순물이 확산되지 않은 영역을 구비한 태양 전지.5. The method of claim 4,
The second protective film has a region in which the first impurity is not diffused.
상기 제1 불순물이 확산되지 않은 영역은 상기 기판과 상기 적어도 하나의 제1 전계부 사이에 위치하는 태양 전지.The method of claim 5,
The region in which the first impurity is not diffused is positioned between the substrate and the at least one first electric field part.
상기 제1 면은 빛이 입사되는 입사면이고, 상기 제2 면은 빛이 입사되지 않는 비입사면인 태양 전지.5. The method of claim 4,
The first surface is an incident surface to which light is incident, and the second surface is a non-incident surface to which light is not incident.
상기 제1 보호막에 상기 제1 불순물을 확산시켜 상기 제1 보호막 내에 상기 제1 불순물이 확산된 적어도 하나의 제1 전계부
를 더 포함하는 태양 전지.In claim 1,
At least one first electric field part in which the first impurity is diffused in the first passivation layer to diffuse the first impurity in the first passivation layer.
Solar cell comprising more.
상기 적어도 하나의 제1 전계부는 상기 적어도 하나의 에미터부와 이격되어 있는 태양 전지.9. The method of claim 8,
The at least one first electric field part is spaced apart from the at least one emitter part.
상기 제1 보호막은 상기 제1 불순물이 확산되지 않은 영역을 구비한 태양 전지.In claim 9,
The first protective film has a region in which the first impurity is not diffused.
상기 제1 불순물이 확산되지 않은 영역은 상기 기판과 상기 적어도 하나의 제1 전계부 사이에 위치하는 태양 전지.11. The method of claim 10,
The region in which the first impurity is not diffused is positioned between the substrate and the at least one first electric field part.
상기 적어도 하나의 제1 전계부는 상기 적어도 하나의 에미터부와 접해 있는 태양 전지.9. The method of claim 8,
The at least one first electric field portion is in contact with the at least one emitter portion.
상기 제1 보호막에 상기 제1 불순물과 상기 제2 불순물이 혼합되어 있는 적어도 하나의 혼합부를 더 포함하는 태양 전지.The method of claim 12,
And at least one mixing unit in which the first impurity and the second impurity are mixed in the first passivation layer.
상기 기판의 제1 면의 반대편에 위치하는 상기 기판의 제2 면 위에 위치하는 보호부를 더 포함하는 태양 전지.The method according to any one of claims 8 to 13,
And a protector positioned on the second side of the substrate opposite the first side of the substrate.
상기 보호부 위에 위치하는 반사 방지부를 더 포함하는 태양 전지.The method of claim 14,
The solar cell further comprises an anti-reflection portion positioned on the protection portion.
상기 보호부와 상기 반사 방지부 사이에 위치하고, 상기 제1 불순물을 함유하고 있는 제2 전계부를 더 포함하는 태양 전지.16. The method of claim 15,
And a second electric field portion disposed between the protection portion and the anti-reflection portion and containing the first impurity.
상기 제1 면은 빛이 입사되지 않는 비입사면이고, 상기 제2 면은 빛이 입사되는 입사면인 태양 전지.The method of claim 14,
The first surface is a non-incident surface to which light is not incident, and the second surface is an incident surface to which light is incident.
상기 기판의 제1 면의 반대편에 위치하는 상기 기판의 제2 면 위에 위치하고 상기 비결정질 반도체 재료로 이루어진 제2 보호막, 그리고
상기 제2 보호막에 상기 제1 불순물을 확산시켜 상기 제2 보호막 내에 상기 제1 불순물이 확산된 제2 전계부를 더 포함하는 태양 전지.The method according to any one of claims 8 to 13,
A second passivation film made of the amorphous semiconductor material and positioned on the second face of the substrate opposite the first face of the substrate, and
And a second electric field part in which the first impurity is diffused in the second passivation layer, and the first impurity is diffused in the second passivation layer.
상기 제2 보호막은 상기 제1 불순물이 확산되지 않은 영역을 구비한 태양 전지.The method of claim 18,
The second protective film has a region in which the first impurity is not diffused.
상기 제1 불순물이 확산되지 않은 영역은 상기 기판과 상기 제2 전계부 사이에 위치하는 태양 전지.The method of claim 19,
The region in which the first impurity is not diffused is located between the substrate and the second electric field part.
상기 제2 전계부 위에 반사 방지부를 더 포함하는 태양 전지.The method of claim 18,
The solar cell further comprises an anti-reflection portion on the second electric field portion.
상기 제1 면은 빛이 입사되지 않는 비입사면이고, 상기 제2 면은 빛이 입사되는 입사면인 태양 전지.The method of claim 18,
The first surface is a non-incident surface to which light is not incident, and the second surface is an incident surface to which light is incident.
상기 보호막 위에 제2 불순물을 함유한 불순물막을 형성하는 단계, 그리고
상기 보호막과 상기 불순물막을 구비한 상기 기판을 열처리하여, 상기 불순물막에 함유된 상기 불순물을 상기 보호막 내부로 확산시켜, 적어도 하나의 불순물부와 보호부를 형성하는 단계
를 포함하고,
상기 적어도 하나의 불순물부는 상기 보호막 중 상기 제2 불순물이 확산된 부분이고, 상기 보호부는 상기 보호막 중 상기 제2 불순물이 확산되지 않은 부분인
태양 전지의 불순물부 형성 방법. Forming a protective film made of an amorphous semiconductor material on the substrate containing the first impurity,
Forming an impurity film containing a second impurity on the protective film, and
Heat-treating the substrate including the protective film and the impurity film to diffuse the impurities contained in the impurity film into the protective film to form at least one impurity portion and a protective portion
Including,
The at least one impurity portion is a portion in which the second impurity is diffused in the passivation layer, and the passivation portion is a portion in which the second impurity is not diffused in the passivation layer.
Impurity part formation method of a solar cell.
상기 제1 불순물과 상기 제2 불순물은 서로 다른 도전성 타입을 갖는 태양 전지의 불순물부 형성 방법.The method of claim 23,
The method of claim 1, wherein the first impurity and the second impurity have different conductivity types.
상기 제1 불순물과 상기 제2 불순물은 동일한 도전성 타입을 갖는 태양 전지의 불순물부 형성 방법.The method of claim 23,
The impurity portion forming method of a solar cell having the first impurity and the second impurity have the same conductivity type.
상기 기판의 상기 제1 불순물의 농도는 상기 적어도 하나의 불순물부의 상기 제2 불순물의 농도보다 낮은 태양 전지의 불순물부 형성 방법.26. The method of claim 25,
And a concentration of the first impurity in the substrate is lower than that of the second impurity in the at least one impurity.
상기 제1 불순물막은 상기 제1 보호막의 전체면 위에 형성되는 태양 전지의 불순물부 형성 방법.27. The method of any of claims 23 to 26,
And the first impurity film is formed on the entire surface of the first passivation film.
상기 제1 불순물막은 상기 제1 보호막 위에 선택적으로 형성되는 태양 전지의 불순물부 형성 방법.27. The method of any of claims 23 to 26,
And the first impurity layer is selectively formed on the first passivation layer.
상기 제1 보호막 위에 상기 제1 도전성 타입과 반대인 제2 도전성 타입의 제1 불순물을 함유한 제1 불순물막을 형성하는 단계,
상기 제1 보호막과 상기 제1 불순물막을 구비한 상기 기판을 열처리하여, 상기 제1 불순물막에 함유된 상기 제1 불순물을 상기 제1 보호막 내부로 확산시켜, 적어도 하나의 에미터부와 제1 보호부를 형성하는 단계, 그리고
상기 적어도 하나의 에미터부와 전기적으로 연결되어 있는 제1 전극과 상기 기판과 전기적으로 연결되어 있는 제2 전극을 형성하는 단계
를 포함하고,
상기 적어도 하나의 에미터부는 상기 제1 보호막 중 상기 제1 불순물이 확산된 부분이고, 상기 제1 보호부는 상기 제1 보호막 중 상기 제1 불순물이 확산되지 않은 부분인
태양 전지의 제조 방법. Forming a first passivation film made of a nonconductive semiconductor material on the first surface of the substrate of the first conductivity type,
Forming a first impurity film containing a first impurity of a second conductivity type opposite to the first conductivity type on the first passivation film,
The substrate including the first passivation layer and the first impurity layer is heat-treated to diffuse the first impurity contained in the first impurity layer into the first passivation layer, thereby forming at least one emitter portion and the first passivation portion. Forming step, and
Forming a first electrode electrically connected to the at least one emitter portion and a second electrode electrically connected to the substrate
Including,
The at least one emitter part is a portion in which the first impurity is diffused in the first passivation layer, and the first passivation part is a portion in which the first impurity is not diffused in the first passivation layer.
Method for manufacturing a solar cell.
상기 제1 보호막 위에 상기 제1 불순물막과 이격되게, 상기 제1 도전성 타입의 제2 불순물을 함유한 제2 불순물막을 형성하는 단계를 더 포함하고,
상기 적어도 하나의 에미터부와 상기 제1 보호부 형성 단계는 상기 열처리 시 상기 제2 불순물막에 함유된 상기 제2 불순물을 상기 제1 보호막 내부로 확산시켜, 상기 적어도 하나의 에미터부와 함께 적어도 하나의 제1 전계부를 형성하는
태양 전지의 제조 방법.The method of claim 29,
Forming a second impurity film containing the second impurity of the first conductivity type on the first passivation film, the second impurity film being spaced apart from the first impurity film;
The forming of the at least one emitter part and the first protective part may include diffusing the second impurity contained in the second impurity film into the first protective film during the heat treatment, thereby forming at least one emitter part together with the at least one emitter part. Forming the first electric field of
Method for manufacturing a solar cell.
상기 제1 면의 반대편인 상기 기판의 제2 면 위에 비결정질 반도체로 이루어진 제2 보호부를 형성하는 단계를 더 포함하는 태양 전지의 제조 방법.The method of claim 29,
And forming a second protective part made of an amorphous semiconductor on the second side of the substrate opposite to the first side.
상기 제2 보호부 위에 반사 방지부를 형성하는 단계를 더 포함하는 태양 전지의 제조 방법.The method of claim 31,
And forming an anti-reflection portion over the second protection portion.
상기 제1 면의 반대편인 상기 기판의 제2 면 위에 상기 비결정질 반도체 재료로 이루어진 제2 보호막을 형성하는 단계,
상기 제2 보호막 위에 상기 제2 불순물을 함유한 제2 불순물막을 형성하는 단계,
상기 제2 보호막과 상기 제2 불순물막을 구비한 상기 기판을 열처리하여, 상기 제2 불순물막에 함유된 상기 제2 불순물을 상기 제2 보호막 내부로 확산시켜, 상기 제2 불순물이 확산된 전계부와 제2 보호부를 형성하는 단계를 더 포함하고,
상기 전계부는 상기 제2 보호막 중 상기 제2 불순물이 확산된 부분이고, 상기 제2 보호부는 상기 제2 보호막 중 상기 제2 불순물이 확산되지 않은 부분인
태양 전지의 제조 방법.The method of claim 29,
Forming a second passivation film made of the amorphous semiconductor material on the second surface of the substrate opposite the first surface,
Forming a second impurity film containing the second impurity on the second passivation film,
Heat-treating the substrate including the second passivation layer and the second impurity layer to diffuse the second impurity contained in the second impurity layer into the second passivation layer to diffuse the second impurity; Further comprising forming a second protective part,
The electric field part is a portion in which the second impurity is diffused in the second passivation layer, and the second protection part is a portion in which the second impurity is not diffused in the second passivation layer.
Method for manufacturing a solar cell.
상기 전계부 위에 반사 방지부를 형성하는 단계를 더 포함하는 태양 전지의 제조 방법.The method of claim 33,
And forming an anti-reflection portion over the electric field portion.
상기 제1 면은 빛이 입사되지 않는 비입사면이고, 상기 제2 면은 빛이 입사되는 입사면인 태양 전지의 제조 방법.35. The method of any of claims 29-34,
The first surface is a non-incident surface to which no light is incident, and the second surface is an incident surface to which light is incident.
상기 제1 면의 반대편인 상기 기판의 제2 면 위에 상기 비결정질 반도체 재료로 이루어진 제2 보호막을 형성하는 단계, 그리고
상기 제2 보호막 위에 상기 제1 도전성 타입의 제2 불순물을 함유한 제2 불순물막을 형성하는 단계
를 더 포함하고,
상기 적어도 하나의 에미터부와 상기 제1 보호부 형성 단계는 상기 열처리 시 상기 제2 불순물막에 함유된 상기 제2 불순물을 상기 제2 보호막 내부로 확산시켜, 전계부와 상기 제1 보호부를 형성하고,
상기 전계부는 상기 제2 보호막 중 상기 제2 불순물이 확산된 부분이고, 상기 제2 보호부는 상기 제2 보호막 중 상기 제2 불순물이 확산되지 않은 부분이고,
상기 제2 전극은 상기 전계부를 통해 상기 기판과 전기적으로 연결되어 있는
태양 전지의 제조 방법.The method of claim 29,
Forming a second passivation film made of the amorphous semiconductor material on the second face of the substrate opposite the first face, and
Forming a second impurity film containing the second impurity of the first conductivity type on the second passivation film
Further comprising:
In the forming of the at least one emitter part and the first protective part, the second impurity contained in the second impurity film is diffused into the second protective film during the heat treatment to form an electric field part and the first protective part. ,
The electric field portion is a portion in which the second impurity is diffused in the second passivation layer, and the second protection portion is a portion in which the second impurity is not diffused in the second passivation layer,
The second electrode is electrically connected to the substrate through the electric field portion
Method for manufacturing a solar cell.
상기 적어도 하나의 에미터부 위에 투명한 도전막으로 이루어진 반사 방지부를 더 형성하는 단계를 포함하고,
상기 제1 전극은 상기 반사 방지부를 통해 상기 적어도 하나의 에미터부와 전기적으로 연결되어 있는
태양 전지의 제조 방법. The method of claim 36,
Forming an anti-reflection portion made of a transparent conductive film on the at least one emitter portion,
The first electrode is electrically connected to the at least one emitter portion through the anti-reflection portion.
Method for manufacturing a solar cell.
상기 제1 면은 빛이 입사되는 입사면이고, 상기 제2 면은 빛이 입사되지 않은 비입사면인 태양 전지의 제조 방법.38. The method of claim 36 or 37,
The first surface is an incident surface to which light is incident, and the second surface is a non-incident surface to which light is not incident.
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