KR20100045779A - Plasma display device thereof - Google Patents
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Abstract
Description
본 발명은 플라즈마 디스플레이(Plasma Display) 장치에 관한 것으로서, 보다 상세하게는 플라즈마 디스플레이 장치에 구비되는 패널(Panel)의 전극 구조에 관한 것이다.The present invention relates to a plasma display device, and more particularly, to an electrode structure of a panel provided in the plasma display device.
일반적으로 플라즈마 디스플레이 패널은 상부기판과 하부기판 사이에 형성된 격벽이 하나의 단위 셀을 이루는 것으로, 각 셀 내에는 네온(Ne), 헬륨(He) 또는 네온 및 헬륨의 혼합기체(Ne+He)와 같은 주 방전 기체와 소량의 크세논을 함유하는 불활성 가스가 충진되어 있다. 고주파 전압에 의해 방전이 될 때, 불활성 가스는 진공자외선(Vacuum Ultraviolet rays)을 발생하고, 격벽 사이에 형성된 형광체를 발광시켜 화상이 구현된다. 이와 같은 플라즈마 디스플레이 패널은 얇고 가벼운 구성이 가능하므로 차세대 표시 장치로서 각광받고 있다.In general, a plasma display panel is a partition wall formed between an upper substrate and a lower substrate to form one unit cell, and each cell includes neon (Ne), helium (He), or a mixture of neon and helium (Ne + He) and An inert gas containing the same main discharge gas and a small amount of xenon is filled. When discharged by a high frequency voltage, the inert gas generates vacuum ultraviolet rays and emits phosphors formed between the partition walls to realize an image. Such a plasma display panel has a spotlight as a next generation display device because a thin and light configuration is possible.
일반적인 플라즈마 디스플레이 패널의 경우 상부기판에 스캔 전극 및 서스테인 전극이 형성되어 있으며, 상기 스캔 전극 및 서스테인 전극은 패널의 개구율 확보를 위해 고가의 ITO(Indium Tin Oxide)로 이루어진 투명 전극과 버스 전극이 적층된 구조를 가진다.In a typical plasma display panel, a scan electrode and a sustain electrode are formed on an upper substrate, and the scan electrode and the sustain electrode are laminated with a transparent electrode and a bus electrode made of expensive indium tin oxide (ITO) to secure an aperture ratio of the panel. Has a structure.
최근에는 제조 비용을 줄이면서 사용자가 시청하는데 충분한 시감 특성 및 구동 특성 등을 확보할 수 있는 플라즈마 디스플레이 패널을 제조하는데 주안점을 두고 있다.Recently, the focus is on manufacturing a plasma display panel that can secure sufficient viewing characteristics, driving characteristics, and the like, while reducing manufacturing costs.
본 발명은 플라즈마 디스플레이 장치에 구비되는 패널에 있어, ITO로 이루어진 투명 전극을 제거하여 패널의 제조 원가를 감소시키는 동시에 디스플레이 영상의 휘도를 개선할 수 있는 플라즈마 디스플레이 장치를 제공하는 것을 목적으로 한다.SUMMARY OF THE INVENTION An object of the present invention is to provide a plasma display device capable of reducing the manufacturing cost of a panel and improving the brightness of a display image by removing the transparent electrode made of ITO in a panel provided in the plasma display device.
상기한 기술적 과제를 해결하기 위한 본 발명에 의한 플라즈마 디스플레이 장치는, 상부기판과, 상부기판에 형성되는 제1 전극 및 2 전극과, 상부기판과 대향하여 배치되는 하부기판과, 하부기판에 형성되는 제3 전극을 포함하고, 제1 전극은, 단일 층(one layer)으로 형성되며, 제3 전극과 교차하는 방향으로 형성된 제1 전극 라인과, 제1 전극 라인과 평행한 방향으로 형성된 제1 평행 전극과, 제1 전극 라인과 제1 평행 전극을 연결하는 제1 연결 전극을 포함한다.Plasma display device according to the present invention for solving the above technical problem, the upper substrate, the first electrode and the second electrode formed on the upper substrate, the lower substrate disposed to face the upper substrate, the lower substrate is formed A first electrode line including a third electrode, the first electrode being formed in a single layer, and formed in a direction crossing the third electrode, and a first parallel formed in a direction parallel to the first electrode line And a first connection electrode connecting the electrode and the first electrode line and the first parallel electrode.
상기한 바와 같이 구성되는 본 발명에 따른 플라즈마 디스플레이 장치에 의하면, ITO(Indium Tin Oxide)로 이루어진 투명 전극을 제거하여 플라즈마 디스플레이 패널의 제조 원가를 감소시킬 수 있다. According to the plasma display device according to the present invention configured as described above, the manufacturing cost of the plasma display panel can be reduced by removing the transparent electrode made of indium tin oxide (ITO).
또한, 전극 라인에 평행한 평행 전극이 배치됨에 따라 방전셀 내에 전기장이 집중되는 영역의 분포를 넓힐 수 있게 되어, 방전 볼륨이 확대되며, 방전셀 내의 유지전극 사이의 쇼트 현상 또는 전극 마모 현상을 막을 수 있게 된다. In addition, as the parallel electrodes parallel to the electrode lines are disposed, the distribution of the areas where electric fields are concentrated in the discharge cells can be widened, thereby increasing the discharge volume and preventing short or electrode wear between the sustain electrodes in the discharge cells. It becomes possible.
이하, 첨부된 도면을 참조하여 본 발명에 따른 플라즈마 디스플레이 장치에 관하여 상세히 설명한다. 도 1은 본 발명에 따른 플라즈마 디스플레이 패널의 구조에 대한 일실시예를 사시도로 도시한 것이다.Hereinafter, a plasma display device according to the present invention will be described in detail with reference to the accompanying drawings. 1 is a perspective view illustrating an embodiment of a structure of a plasma display panel according to the present invention.
도 1을 참조하면, 플라즈마 디스플레이 패널은 소정의 간격을 두고 합착되는 상부패널(10)과 하부패널(20)을 포함한다.Referring to FIG. 1, the plasma display panel includes an
상부패널(10)은 상부기판(11)상에 쌍을 이루며 형성되는 유지전극쌍(12, 13)을 포함한다. 유지전극쌍(12, 13)은 그 기능에 따라 스캔전극(12)과 서스테인전극(13)으로 구분된다. 유지전극쌍(12, 13)은 방전 전류를 제한하며 전극 쌍간을 절연시켜주는 상부유전체층(14)에 의해 덮혀지고, 상부유전체층(204) 상면에는 보호막층(15)이 형성되어, 가스 방전 시에 발생되는 하전입자들의 스퍼터링으로부터 상부유전체층(14)을 보호하고, 2차 전자의 방출효율을 높이게 된다.The
상부기판(11), 하부기판(21) 및 격벽(22) 사이에 마련된 방전 공간에는 방전 가스가 주입된다. 방전 가스에는 크세논(Xe)이 10% 이상 포함되는 것이 바람직하다. 크세논(Xe)이 상기와 같은 혼합비를 가지고 방전 가스에 포함되는 경우, 플라즈마 디스플레이 패널의 방전/발광효율 및 휘도가 향상시킬 수 있다.Discharge gas is injected into the discharge space provided between the
하부패널(20)은 하부기판(21)상에 복수 개의 방전공간 즉, 방전셀을 구획하는 격벽(22)이 형성된다. 또한, 어드레스전극(23)이 유지전극쌍(12, 13)에 교차하는 방향으로 배치되고, 하부유전체층(25)과 격벽(22)의 표면에는 가스방전시 발생된 자외선에 의해 발광되어 가시광이 발생되는 형광체(24)가 도포된다. The
이때, 격벽(22)은 어드레스전극(23)과 나란한 방향으로 형성된 세로격벽(22a)과, 어드레스전극(23)과 교차하는 방향으로 형성된 가로격벽(22b)으로 구성되고, 방전셀을 물리적으로 구분하며, 방전에 의해 생성된 자외선과 가시광이 인접한 방전셀에 누설되는 것을 방지한다.In this case, the partition wall 22 includes a
또한, 본 발명에 따른 플라즈마 디스플레이 패널에서, 유지전극쌍(12, 13)은 불투명한 금속 전극만으로 이루어진다. 즉, 종래의 투명전극 재질인 ITO는 사용하지 않고, 종래의 버스전극의 재질인 은(Ag), 구리(Cu) 또는 크롬(Cr)등을 사용하여 유지전극쌍(12, 13)을 형성한다. 즉, 본 발명에 따른 플라즈마 디스플레이 패널의 유진전극쌍(12, 13) 각각은 종래의 ITO전극을 포함하지 아니하고, 버스전극 하나의 단일층(one layer)으로 이루어진다.Further, in the plasma display panel according to the present invention, the
예컨대, 본 발명의 실시에에 따른 유지전극쌍(12, 13) 각각은 은으로 형성되는 것이 바람직하며, 은(Ag)은 감광성 성질을 갖는 것이 바람직하다. 또한, 본 발명의 실시예에 따른 유지전극쌍(12, 13) 각각은 상부기판(11)에 형성되는 상부유전체층(14) 또는 하부유전체층(14)보다 색이 더 어둡고, 빛의 투과도가 더 낮은 성질을 가질 수 있다.For example, each of the sustain electrode pairs 12 and 13 according to the embodiment of the present invention is preferably formed of silver, and silver (Ag) preferably has photosensitive properties. In addition, each of the
방전셀은 R(Red), G(Green), B(Blue) 각각의 형광체층(24)은 폭(pitch)이 서로 동일한 대칭 구조이거나, 폭(pitch)이 서로 상이한 비대칭 구조일 수 있다. 방전셀이 비대칭 구조를 가지는 경우, R(Red) 셀의 폭 < G(Green) 셀의 폭 < B(Blue) 셀의 폭의 크기 순을 가지도록 할 수 있다.In the discharge cells, the
도 1에 도시된 바와 같이, 하나의 방전셀 내에 유지 전극(12, 13)이 각각 복 수 개의 전극 라인으로 형성될 수 있다. 즉, 제1 유지 전극(12)이 두 개의 전극 라인(12a, 12b)으로 형성되고, 제2 유지 전극(13)이 방전셀의 중심을 기준으로 제1 유지 전극(12)과 대칭하여 배열되며 두 개의 전극 라인(13a, 13b)으로 형성될 수 있다.As shown in FIG. 1, the
제1, 2 유지 전극(12, 13)은 각각 스캔 전극과 서스테인 전극인 것이 바람직하다. 이는 불투명한 유지 전극 쌍(12, 13)을 사용함에 따른 개구율과 방전 확산 효율을 고려한 것이다. 즉, 개구율을 고려하여 좁은 폭을 갖는 전극 라인을 사용하는 한편, 방전 확산 효율을 고려하여 복수 개의 전극 라인을 사용한다. 이때, 전극 라인의 개수는 개구율과 방전 확산 효율을 동시에 고려하도록 하여 결정할 수 있다.It is preferable that the first and second sustain
도 1에 도시된 구조는 본 발명에 따른 플라즈마 패널의 구조에 대한 일실시예에 불과하므로, 본 발명은 도 1에 도시된 플라즈마 디스플레이 패널 구조에 한정되지 아니한다. 예컨대, 외부에서 발생하는 외부광을 흡수하여 반사를 줄여주는 광차단의 기능과 상부 기판(11)의 퓨리티(Purity) 및 콘트라스트를 향상시키는 기능을 하는 블랙 매트릭스(Black Matrix, BM)가 상부 기판(11) 상에 형성될 수 있으며, 블랙 매트릭스는 분리형 및 일체형 BM 구조가 모두 가능하다.Since the structure shown in FIG. 1 is only an embodiment of the structure of the plasma panel according to the present invention, the present invention is not limited to the structure of the plasma display panel shown in FIG. For example, a black matrix (BM) that absorbs external light generated from the outside to reduce reflection and improves the purity and contrast of the
또한, 도 1에 도시된 패널의 격벽 구조는 세로격벽(22a)과 가로격벽(22b)에 의해 방전셀이 폐쇄 구조를 가지는 클로즈 타입(Close Type)을 나타내고 있으나, 세로격벽만을 포함하는 스트라이프 타입(Stripe Type) 또는 세로격벽 상에 소정의 간격을 가지고 돌출부가 형성된 피쉬본(Fish Bone) 등의 구조도 가능하다.In addition, although the barrier rib structure of the panel shown in FIG. Stripe Type) or a structure such as a Fish Bone having a protrusion formed at a predetermined interval on the vertical partition wall.
도 2는 플라즈마 디스플레이 패널의 전극 배치에 대한 일실시예를 도시한 것으로, 플라즈마 디스플레이 패널을 구성하는 복수의 방전셀들은 도 2에 도시된 바와 같이 매트릭스 형태로 배치되는 것이 바람직하다. 복수의 방전셀들은 각각 스캔 전극 라인(Y1 내지 Ym), 서스테인 전극 라인(Z1 내지 Zm) 및 어드레스 전극 라인(X1 내지 Xn)의 교차부에 마련된다. 스캔 전극 라인(Y1 내지 Ym)은 순차적으로 구동되거나 동시에 구동될 수 있고, 서스테인 전극 라인(Z1 내지 Zm)은 동시에 구동될 수 있다. 어드레스 전극라인(X1 내지 Xn)은 기수 번째 라인들과 우수 번째 라인들로 분할되어 구동되거나 순차적으로 구동될 수 있다.FIG. 2 illustrates an embodiment of an electrode arrangement of a plasma display panel, and a plurality of discharge cells constituting the plasma display panel are preferably arranged in a matrix form as shown in FIG. 2. The plurality of discharge cells are provided at the intersections of the scan electrode lines Y1 to Ym, the sustain electrode lines Z1 to Zm, and the address electrode lines X1 to Xn, respectively. The scan electrode lines Y1 to Ym may be driven sequentially or simultaneously, and the sustain electrode lines Z1 to Zm may be driven simultaneously. The address electrode lines X1 to Xn may be driven by being divided into odd-numbered lines and even-numbered lines, or sequentially driven.
도 2에 도시된 전극 배치는 본 발명에 따른 플라즈마 패널의 전극 배치에 대한 일실시예에 불과하므로, 본 발명은 도 2에 도시된 플라즈마 디스플레이 패널의 전극 배치 및 구동 방식에 한정되지 아니한다. 예컨데, 스캔 전극 라인(Y1 내지 Ym)들 중 2 개의 스캔 전극 라인이 동시에 스캐닝되는 듀얼 스캔(dual scan) 방식도 가능하다. 또한, 어드레스 전극 라인(X1 내지 Xn)은 패널의 중앙 부분에서 상하 또는 좌우로 분할되어 구동될 수도 있다.Since the electrode arrangement shown in FIG. 2 is only an embodiment of the electrode arrangement of the plasma panel according to the present invention, the present invention is not limited to the electrode arrangement and driving method of the plasma display panel shown in FIG. 2. For example, a dual scan method in which two scan electrode lines among the scan electrode lines Y1 to Ym are simultaneously scanned is possible. In addition, the address electrode lines X1 to Xn may be driven by being divided up and down or left and right in the center portion of the panel.
도 3은 하나의 프레임(frame)을 복수의 서브필드로 나누어 시분할 구동시키는 방법에 대한 일실시예를 타이밍도로 도시한 것이다. 단위 프레임은 시분할 계조 표시를 실현하기 위하여 소정 개수 예컨대 8개의 서브필드들(SF1, ..., SF8)로 분할될 수 있다. 또한, 각 서브필드(SF1, ...SF8)는 리셋 구간(미도시)과, 어드레스 구간(A1, ..., A8)및, 서스테인 구간(S1, ..., S8)로 분할된다.3 is a timing diagram illustrating an embodiment of a time division driving method by dividing a frame into a plurality of subfields. The unit frame may be divided into a predetermined number, for example, eight subfields SF1, ..., SF8 to realize time division gray scale display. Each subfield SF1, ... SF8 is divided into a reset section (not shown), an address section A1, ..., A8 and a sustain section S1, ..., S8.
여기서, 본 발명의 일실시예에 따르면 리셋 구간은 복수 개의 서브필드 중 적어도 하나에서 생략될 수 있다. 예컨대, 리셋 구간은 최초의 서브필드에서만 존재하거나, 최초의 서브필드와 전체 서브필드 중 중간 정도의 서브필드에서만 존재할 수도 있다.Here, according to an embodiment of the present invention, the reset period may be omitted in at least one of the plurality of subfields. For example, the reset period may exist only in the first subfield or may exist only in a subfield about halfway between the first subfield and all the subfields.
각 어드레스 구간(A1, ..., A8)에서는, 어드레스 전극(X)에 표시 데이터 신호가 인가되고, 각 스캔 전극(Y)에 상응하는 스캔 펄스가 순차적으로 인가된다.In each address section A1, ..., A8, a display data signal is applied to the address electrode X, and scan pulses corresponding to each scan electrode Y are sequentially applied.
각 서스테인 구간(S1, ...,S8)에서는, 스캔 전극(Y)과 서스테인 전극(Z)에 서스테인 펄스가 교호하게 인가되어, 어드레스 구간(A1, ..., A8)에서 벽전하들이 형성된 방전셀들에서 서스테인 방전을 일으킨다.In each of the sustain periods S1, ..., S8, a sustain pulse is alternately applied to the scan electrode Y and the sustain electrode Z to form wall charges in the address periods A1, ..., A8. Sustain discharge occurs in the discharge cells.
플라즈마 디스플레이 패널의 휘도는 단위 프레임에서 차지하는 서스테인 방전 구간(S1, ..., S8)내의 서스테인 방전 펄스 개수에 비례한다. 1 화상을 형성하는 하나의 프레임이, 8개의 서브필드와 256계조로 표현되는 경우에, 각 서브필드에는 차례대로 1, 2, 4, 8, 16, 32, 64, 128의 비율로 서로 다른 서스테인 펄스의 수가 할당될 수 있다. 만일 133계조의 휘도를 얻기 위해서는, 서브필드1 구간, 서브필드3 구간 및 서브필드8 구간 동안 셀들을 어드레싱하여 서스테인 방전하면 된다.The luminance of the plasma display panel is proportional to the number of sustain discharge pulses in the sustain discharge periods S1, ..., S8 occupied in the unit frame. When one frame forming one image is represented by eight subfields and 256 gradations, each subfield in turn has different sustains at a ratio of 1, 2, 4, 8, 16, 32, 64, and 128. The number of pulses can be assigned. In order to obtain luminance of 133 gradations, cells may be sustained by addressing the cells during the
각 서브필드에 할당되는 서스테인 방전 수는, APC(Automatic Power Control)단계에 따른 서브필드들의 가중치에 따라 가변적으로 결정될 수 있다. 즉, 도 3에서는 한 프레임을 8개의 서브필드로 분할하는 경우를 예로 들어 설명하였으나 본 발명은 그에 한정되지 아니하며, 한 프레임을 형성하는 서브필드의 수를 설계사양에 따라 다양하게 변형하는 것이 가능하다. 예를 들어, 한 프레임을 12 또는 16 서브필드 등과 같이, 8 서브필드 이상으로 분할하여 플라즈마 디스플레이 패널을 구 동시킬 수 있다.The number of sustain discharges allocated to each subfield may be variably determined according to weights of the subfields according to the APC (Automatic Power Control) step. That is, in FIG. 3, a case in which one frame is divided into eight subfields has been described as an example. However, the present invention is not limited thereto, and the number of subfields forming one frame may be variously modified according to design specifications. . For example, the plasma display panel may be driven by dividing one frame into eight or more subfields, such as 12 or 16 subfields.
또한 각 서브필드에 할당되는 서스테인 방전 수는 감마특성이나 패널특성을 고려하여 다양하게 변형하는 것이 가능하다. 예컨대, 서브필드 4에 할당된 계조도를 8에서 6으로 낮추고, 서브필드 6 에 할당된 계조도를 32 에서 34 로 높일 수 있다.The number of sustain discharges allocated to each subfield can be variously modified in consideration of gamma characteristics and panel characteristics. For example, the gray level assigned to subfield 4 may be lowered from 8 to 6, and the gray level assigned to subfield 6 may be increased from 32 to 34.
도 4는 플라즈마 디스플레이 패널을 구동시키기 위한 구동 신호에 대한 일실시예를 타이밍도로 도시한 것이다.4 is a timing diagram illustrating an embodiment of a drive signal for driving a plasma display panel.
서브필드는 스캔 전극들(Y) 상에 정극성 벽전하를 형성하고 서스테인 전극들(Z) 상에 부극성 벽전하를 형성하기 위한 프리 리셋(pre reset) 구간, 프리 리셋 구간에 의해 형성된 벽전하 분포를 이용하여 전 화면의 방전셀들을 초기화하기 위한 리셋(reset) 구간, 방전셀을 선택하기 위한 어드레스(address) 구간 및 선택된 방전셀들의 방전을 유지시키기 위한 서스테인(sustain) 구간을 포함할 수 있다.The subfield forms a wall reset formed by a pre-reset section and a pre-reset section for forming the positive wall charges on the scan electrodes Y and the negative wall charges on the sustain electrodes Z. It may include a reset section for initializing the discharge cells of the entire screen by using the distribution, an address section for selecting the discharge cells, and a sustain section for maintaining the discharge of the selected discharge cells. .
리셋 구간은 셋업(setup) 구간 및 셋 다운(setdown) 구간으로 이루어지며, 셋업 구간에서는 모든 스캔 전극으로 상승 램프 파형(Ramp-up)이 동시 인가되어 모든 방전셀에서 미세 방전이 발생되고, 이에 따라 벽전하가 생성된다. 셋다운 구간에는 상승 램프 파형(Ramp-up)의 피크 전압보다 낮은 정극성 전압에서 하강하는 하강 램프파형(Ramp-down)이 모든 스캔 전극(Y)으로 동시에 인가되어 모든 방전셀에서 소거방전이 발생되고, 이에 따라 셋업 방전에 의해 생성된 벽전하 및 공간전하 중 불요 전하를 소거시킨다.The reset section is composed of a setup section and a setdown section. In the setup section, rising ramp waveforms (Ramp-up) are simultaneously applied to all scan electrodes to generate fine discharge in all discharge cells. Wall charges are generated. In the set-down period, a falling ramp waveform (Ramp-down) falling at a positive voltage lower than the peak voltage of the rising ramp waveform (Ramp-up) is simultaneously applied to all the scan electrodes (Y), thereby erasing discharge in all the discharge cells. Therefore, the unnecessary charges of the wall charges and the space charges generated by the setup discharges are eliminated.
어드레스 구간에는 스캔 전극으로 부극성의 스캔 전압(Vsc)을 가지는 스캔 신호가 순차적으로 인가되고, 이와 동시에 어드레스 전극(X)으로 정극성의 데이터 신호가 인가된다. 이러한 스캔 신호와 데이터 신호 간의 전압 차와 리셋 구간 동안 생성된 벽전압에 의해 어드레스 방전이 발생 되어 셀이 선택된다. 한편, 어드레스 방전의 효율을 높이기 위해, 어드레스 구간 동안 서스테인 바이어스 전압(Vzb)이 서스테인 전극에 인가된다.In the address period, a scan signal having a negative scan voltage Vsc is sequentially applied to the scan electrode, and a positive data signal is applied to the address electrode X at the same time. The address discharge is generated by the voltage difference between the scan signal and the data signal and the wall voltage generated during the reset period, thereby selecting the cell. On the other hand, in order to increase the efficiency of the address discharge, the sustain bias voltage Vzb is applied to the sustain electrode during the address period.
어드레스 구간동안, 복수의 스캔 전극들(Y)은 2 이상의 그룹으로 나뉘어 그룹별로 순차적으로 스캔 신호들이 공급될 수 있으며, 분할된 그룹들 각각은 다시 2 이상의 서브 그룹으로 나뉘어 서브 그룹별로 순차적으로 스캔 신호들이 공급될 수 있다. 예를 들어 복수의 스캔 전극들(Y)은 제1 그룹 및 제2 그룹으로 분할되고, 제1 그룹에 속하는 스캔 전극들에 스캔 신호들이 순차적으로 공급된 후, 제2 그룹에 속하는 스캔 전극들에 스캔 신호들이 순차적으로 공급될 수 있다.During the address period, the plurality of scan electrodes Y may be divided into two or more groups, and scan signals may be sequentially supplied to each group, and each of the divided groups may be further divided into two or more subgroups, and the scan signals may be sequentially processed for each subgroup. Can be supplied. For example, the plurality of scan electrodes Y may be divided into a first group and a second group, and scan signals are sequentially supplied to scan electrodes belonging to the first group, and then to scan electrodes belonging to the second group. Scan signals may be supplied sequentially.
본 발명에 따른 일실시예로서 복수의 스캔 전극들(Y)은 패널 상에 형성된 위치에 따라 우수(even) 번째에 위치하는 제1 그룹과 기수(odd) 번째에 위치하는 제2 그룹으로 분할될 수 있으며, 또 다른 실시예로서 패널의 중심을 기준으로 상측에 위치하는 제1 그룹과 하측에 위치하는 제2 그룹으로 분할될 수 있다.According to an embodiment of the present invention, the plurality of scan electrodes Y may be divided into a first group located at an even number and a second group located at an odd number according to a position formed on a panel. In another embodiment, the panel may be divided into a first group positioned above and a second group positioned below the center of the panel.
상기와 같은 방법에 의해 분할된 제1 그룹에 속하는 스캔 전극들을 다시 우수(even) 번째에 위치하는 제1 서브 그룹과 기수(odd) 번째에 위치하는 제2 서브 그룹으로 분할되거나, 제1 그룹의 중심을 기준으로 상측에 위치하는 제1 서브 그룹과 하측에 위치하는 제2 그룹으로 분할될 수 있다.The scan electrodes belonging to the first group divided by the above method are further divided into a first subgroup located at the even-th and a second subgroup located at the odd (odd), or It may be divided into a first subgroup positioned above and a second group located below, based on the center.
서스테인 구간에는 스캔 전극과 서스테인 전극에 교번적으로 서스테인 전 압(Vs)을 가지는 서스테인 펄스가 인가되어 스캔 전극과 서스테인 전극 사이에 면방전 형태로 서스테인 방전이 발생된다.In the sustain section, a sustain pulse having a sustain voltage Vs is alternately applied to the scan electrode and the sustain electrode to generate sustain discharge in the form of surface discharge between the scan electrode and the sustain electrode.
서스테인 구간에서 스캔 전극과 서스테인 전극에 교번적으로 공급되는 복수의 서스테인 신호들 중 첫번째 서스테인 신호 또는 마지막 서스테인 신호의 폭은 나머지 서스테인 펄스의 폭보다 클 수 있다.The width of the first sustain signal or the last sustain signal among the plurality of sustain signals alternately supplied to the scan electrode and the sustain electrode in the sustain period may be greater than the width of the remaining sustain pulses.
서스테인 방전이 발생한 후, 어드레스 구간에서 선택된 온셀(ON cell)의 스캔 전극 또는 서스테인 전극에 남아있는 벽전하를 약한 방전을 발생시킴에 의해 소거시키는 소거 구간이 서스테인 구간 이후에 더 포함될 수 있다.After the sustain discharge occurs, an erase period for erasing the wall charge remaining in the scan electrode or the sustain electrode of the selected ON cell in the address period by generating a weak discharge may be further included after the sustain period.
소거 구간은 복수의 서브필드 전체 또는 그 중 일부의 서브필드에 포함될 수 있으며, 서스테인 구간에서 마지막 서스테인 펄스가 인가되지 않은 전극에 약한 방전을 위한 소거 신호가 인가되는 것이 바람직하다.The erase period may be included in all or some of the plurality of subfields, and it is preferable that an erase signal for weak discharge is applied to an electrode to which the last sustain pulse is not applied in the sustain period.
소거 신호는 점진적으로 증가하는 램프(ramp) 형태의 신호, 저전압 광폭 펄스(low-voltage wide pulse), 고전압 협폭 펄스(high-voltage narrow pulse), 기하급수적으로 증가하는 신호(exponential signal) 또는 half-sinusoidal pulse 등이 사용될 수 있다.The cancellation signal is a ramp-type signal that gradually increases, a low-voltage wide pulse, a high-voltage narrow pulse, an exponential signal, or a half- sinusoidal pulses can be used.
또한, 약한 방전을 발생시키기 위해 스캔 전극 또는 서스테인 전극에 복수의 펄스가 순차적으로 인가될 수도 있다.In addition, a plurality of pulses may be sequentially applied to the scan electrode or the sustain electrode to generate a weak discharge.
도 4에 도시된 구동 파형들은 본 발명에 따른 플라즈마 디스플레이 패널을 구동시키기 위한 신호들에 대한 일실시예로서, 도 4에 도시된 파형들에 의해 본 발명은 한정되지 아니한다. 예컨데, 프리 리셋 구간이 생략될 수 있으며, 도 4에 도 시된 구동 신호들의 극성 및 전압 레벨은 필요에 따라 변경이 가능하고, 서스테인 방전이 완료된 후에 벽전하 소거를 위한 소거 신호가 서스테인 전극에 인가될 수도 있다. 또한, 서스테인 신호가 스캔 전극(Y)과 서스테인(Z) 전극 중 어느 하나에만 인가되어 서스테인 방전을 일으키는 싱글 서스테인(single sustain) 구동도 가능하다.The driving waveforms shown in FIG. 4 are examples of signals for driving the plasma display panel according to the present invention, and the present invention is not limited by the waveforms shown in FIG. 4. For example, the pre-reset period may be omitted, and the polarity and the voltage level of the driving signals illustrated in FIG. 4 may be changed as necessary, and an erase signal for erasing wall charge may be applied to the sustain electrode after the sustain discharge is completed. It may be. In addition, a single sustain drive in which a sustain signal is applied to only one of the scan electrode (Y) and the sustain (Z) electrode to generate a sustain discharge is also possible.
도 5는 본 발명의 일실시예에 따른 플라즈마 디스플레이 패널의 상부기판에 형성된 전극 구조를 단면도로 간략히 도시한 것으로, 도 1에 도시된 플라즈마 디스플레이 패널 중 하나의 방전셀에 형성되는 유지 전극 쌍의 구조만을 간략하게 도시한 것이다.FIG. 5 is a schematic cross-sectional view of an electrode structure formed on an upper substrate of a plasma display panel according to an embodiment of the present invention. The structure of a sustain electrode pair formed in one discharge cell of the plasma display panel shown in FIG. It is a simplified illustration of the bay.
도 5를 참조하면, 본 발명의 일실시예에 따른 유지 전극(110,120), 즉 스캔 전극 및 서스테인 전극은 기판 상에 방전셀의 중심을 기준으로 대칭되게 쌍을 이루며 형성된다. 여기서 방전셀은, 유지 전극(110,120), 가로 격벽(102,104)과 세로 격벽(106,108), 어드레스 전극(미도시)과 형광체(미도시)를 포함한다.Referring to FIG. 5, the sustain
유지 전극(110,120) 각각은, 단일 층(one layer)으로 형성되며, 방전셀을 가로지르는 전극 라인(111,121), 연결전극(113,123), 및 평행 전극(115,125)을 포함할 수 있다. Each of the
전극 라인들(111,121)은 방전셀을 가로지르며, 방전셀을 구획하는 격벽 중 가로 격벽(102,104)과 평행한 방향으로 연장될 수 있다. 평행 전극(115,125)은, 방전셀 내에서 전극 라인들(111,121)과 평행하게 형성된다. 연결전극(113,123)은, 어드레스 전극(미도시)과 교차하는 방향, 즉 세로 격벽(106,108)과 평행한 방향으로 연장될 수 있다. 이러한 연결전극(113,123)은, 전극 라인(111,121)과, 평행 전극(115,125)을 연결한다.The electrode lines 111 and 121 may cross the discharge cell and may extend in a direction parallel to the
본 발명의 실시예에 따라, 유지 전극(110,120)이 전극 라인(111,121), 연결전극(113,123), 및 평행 전극(115,125)을 포함하는 경우에, 평행 전극 사이(115와125)에서 일정한 전기장이 형성되게 된다. 평행 전극 사이(115와125)에서 일정한 전기장이 형성됨으로써, 유지 전극(110,120) 사이의 방전은, 일정한 전기장이 집중되는 평행 전극 사이(115와125)에서 개시되게 되며, 연결 전극(113,123) 및 전극 라인(111,121) 방향으로 확대되게 된다. According to an embodiment of the present invention, when the sustain
이러한 평행 전극(115,125)으로 인해, 일정한 전기장이 집중되는 영역의 분포를 넓힐 수 있게 되며, 이에 따라 방전 볼륨이 확대되게 된다. 따라서 가시광 휘도 등의 특성이 향상되는 등 전체적으로 플라즈마 디스플레이 패널의 발광 효율을 향상시킬 수 있다. 결국, 플라즈마 디스플레이 패널의 휘도를 감소시키지 아니하고 ITO 투명 전극을 제거할 수 있게 된다.Due to the
한편, 평행 전극 사이(115와125)의 간격을 조정함으로써, 방전개시전압 및 휘도 특성을 향상시킬 수 있게 된다. 예를 들어, 평행 전극 사이(115와125)의 간격이 좁을수록, 방전개시전압은 낮아질 수 있으나, 도전성 물질로 구성되는 평행 전극(115,125)로 인하여 방전셀 중심부에서 휘도 특성이 나빠질 수 있게 된다. 따라서, 평행 전극 사이(115와125)의 간격은 소정 간격으로 설정되는 것이 바람직하다.On the other hand, by adjusting the distance between the
한편, 평행 전극(115,125)의 대향 면적을 조정함으로써, 방전개시전압 및 방전볼륨을 조정할 수 있게 된다. 예를 들어, 평행 전극(115,125)의 대향 면적이 커 질수록, 방전개시전압은 낮아질 수 있으나, 방전이 평행 전극 사이(115와125)에 집중되어 방전 볼륨이 더 이상 확대되지 않을 수 있게 된다. 따라서, 평행 전극(115,125)의 대향 면적은 소정 면적으로 설정되는 것이 바람직하다.On the other hand, by adjusting the opposing areas of the
도 6은 본 발명의 일실시예에 따른 플라즈마 디스플레이 패널의 상부기판에 형성된 전극 구조를 단면도로 간략히 도시한 것으로, 도 1에 도시된 플라즈마 디스플레이 패널 중 하나의 방전셀에 형성되는 유지 전극 쌍의 구조만을 간략하게 도시한 것이다.6 is a schematic cross-sectional view of an electrode structure formed on an upper substrate of a plasma display panel according to an exemplary embodiment of the present invention. The structure of a sustain electrode pair formed in one discharge cell of the plasma display panel shown in FIG. It is a simplified illustration of the bay.
도 6을 참조하면, 본 발명의 일실시예에 따른 유지 전극(210,220), 즉 스캔 전극 및 서스테인 전극은 기판 상에 방전셀의 중심을 기준으로 대칭되게 쌍을 이루며 형성된다. 여기서 방전셀은, 유지 전극(210,220), 가로 격벽(202,204)과 세로 격벽(206,208), 어드레스 전극(미도시)과 형광체(미도시)를 포함한다.Referring to FIG. 6, the sustain
유지 전극(210,220) 각각은, 단일 층(one layer)으로 형성되며, 방전셀을 가로지르는 전극 라인(211,221), 연결전극(213,223), 및 평행 전극(215,225)을 포함할 수 있다. 또한, 도 6의 유지 전극(210,220) 각각은, 평행 전극(215,225)의 양 단부에 연결되어 전극 라인(211,221) 방향으로 돌출되는 복수개의 돌출 전극(217,219,227,229)을 더 포함할 수 있다.Each of the sustain
도 6의 유지 전극(210,220) 각각은, 도 5의 유지전극(110,120) 각각과 거의 유사하므로, 이하에서는 그 차이점만을 기술한다.Since each of the sustain
도 6의 복수개의 돌출 전극(217,219,227,229)이, 평행 전극(215,225)의 양 단부에 연결되어 연장됨으로써, 평행 전극 사이(215와225)에서 개시되게 되며, 연 결 전극(213,223) 및 전극 라인(211,221) 방향으로 확대되는 방전이, 복수개의 돌출 전극(217,219,227,229)을 따라서도 확대되므로, 방전 확대가 더욱 용이하게 된다. 따라서, 방전 효율이 향상되게 된다.The plurality of protruding
한편, 도 6의 복수개의 돌출 전극(217,219,227,229)은, 전극 라인(211,221)에 직교 하는 방향으로 돌출될 수 있다. 따라서, 돌출 전극(217,219,227,229)에서의 방전 확대는 전극 라인(211,221)에 직교 하는 방향으로 확대되게 된다.Meanwhile, the plurality of protruding
도 7은 도 6의 전극 구조에 따른 방전셀 내의 전기장 분포를 도시한 도면이다.7 is a diagram illustrating an electric field distribution in a discharge cell according to the electrode structure of FIG. 6.
도면을 참조하여 설명하면, 도 7(a)의 유지 전극(260,270) 각각은, 단일 층(one layer)으로 형성되며, 방전셀을 가로지르는 복수개의 전극 라인(261,262,271,272), 연결전극(264,274), 및 돌출 전극(266,276)을 포함한다. Referring to the drawings, each of the sustain
한편, 도 7(b)의 유지전극은, 도 6에서와 같이, 방전셀을 가로지르는 전극 라인(211,221), 연결전극(213,223), 평행 전극(215,225), 및 복수개의 돌출 전극(217,219,227,229)을 포함한다.Meanwhile, as shown in FIG. 6, the sustain electrode of FIG. 7B includes
도 7(a)의 전기장 분포를 살펴보면, 방전셀의 중심부에서 서로 대향하는 전극 라인(262,272) 사이에는 일정한 전기장이 배치되나, 돌출 전극(266,276)이 형성된 부분에 전기장이 상당히 집중되는 것을 볼 수 있다. 이러한 돌출 전극(266,276) 구조로 인하여, 방전이 돌출 전극 사이(266과276)에 집중되는 경향이 있으며, 따라서 방전 볼륨이 작게되며, 나아가 돌출 전극 사이(266과276)에서 쇼트 현상 또는 돌출 전극(266,276)의 마모 현상이 발생하게 된다.Referring to the electric field distribution of FIG. 7A, a constant electric field is disposed between the
한편, 도 7(b)는 평행 전극 사이(215와225)에서 일정한 전기장이 형성됨으로써, 유지 전극(210,220) 사이의 방전은, 일정한 전기장이 집중되는 평행 전극 사이(215와225)에서 개시되게 되며, 연결 전극(213,223) 및 전극 라인(211,221) 방향으로 확대되게 되며, 또한 돌출 전극(266,276)에 의해서 전극 라인(211,221) 방향으로 확대되게 된다. 나아가, 유지 전극(210,220)에서 돌출로 인한 쇼트 현상 또는 마모 현상이 일어나지 않게 된다.On the other hand, Figure 7 (b) is a constant electric field is formed between the parallel electrodes (215 and 225), the discharge between the sustain electrode (210, 220) is initiated between the parallel electrodes (215 and 225) where a constant electric field is concentrated. In this case, the
도 8은 본 발명의 일실시예에 따른 플라즈마 디스플레이 패널의 상부기판에 형성된 전극 구조를 단면도로 간략히 도시한 것으로, 도 1에 도시된 플라즈마 디스플레이 패널 중 하나의 방전셀에 형성되는 유지 전극 쌍의 구조만을 간략하게 도시한 것이다.FIG. 8 is a schematic cross-sectional view of an electrode structure formed on an upper substrate of a plasma display panel according to an embodiment of the present invention. The structure of a sustain electrode pair formed in one discharge cell of the plasma display panel shown in FIG. It is a simplified illustration of the bay.
도 8을 참조하면, 본 발명의 일실시예에 따른 유지 전극(310,320), 즉 스캔 전극 및 서스테인 전극은 기판 상에 방전셀의 중심을 기준으로 대칭되게 쌍을 이루며 형성된다. 여기서 방전셀은, 유지 전극(310,320), 가로 격벽(302,304)과 세로 격벽(306,308), 어드레스 전극(미도시)과 형광체(미도시)를 포함한다.Referring to FIG. 8, the sustain
유지 전극(310,320) 각각은, 단일 층(one layer)으로 형성되며, 방전셀을 가로지르는 전극 라인(311,321), 연결전극(313,323), 및 평행 전극(315,325)을 포함할 수 있다. 또한, 도 8의 유지 전극(310,320) 각각은, 평행 전극(315,325)의 양 단부에 연결되어 전극 라인(311,321) 방향으로 돌출되는 복수개의 돌출 전극(317,319,327,329)을 더 포함할 수 있다.Each of the sustain
도 8의 유지 전극(310,320) 각각은, 도 5의 유지전극(110,120) 각각과 거의 유사하므로, 이하에서는 그 차이점만을 기술한다.Since each of the sustain
도 8의 복수개의 돌출 전극(317,319,327,329)이, 평행 전극(315,325)의 양 단부에 연결되어 연장됨으로써, 평행 전극 사이(315와325)에서 개시되게 되며, 연결 전극(313,323) 및 전극 라인(311,321) 방향으로 확대되는 방전이, 복수개의 돌출 전극(317,319,327,329)을 따라서도 확대되므로, 방전 확대가 더욱 용이하게 된다. 따라서, 방전 효율이 향상되게 된다.The plurality of protruding
한편, 도 8의 복수개의 돌출 전극(317,319,327,329)은, 전극 라인(311,321)에 비스듬히 교차하는 방향으로 돌출될 수 있다. 따라서, 돌출 전극(317,319,327,329)에서의 방전 확대는 전극 라인(311,321)에 비스듬히 교차하는 방향으로 확대되게 된다.Meanwhile, the plurality of protruding
도 9는 본 발명의 일실시예에 따른 플라즈마 디스플레이 패널의 상부기판에 형성된 전극 구조를 단면도로 간략히 도시한 것으로, 도 1에 도시된 플라즈마 디스플레이 패널 중 하나의 방전셀에 형성되는 유지 전극 쌍의 구조만을 간략하게 도시한 것이다.FIG. 9 is a schematic cross-sectional view of an electrode structure formed on an upper substrate of a plasma display panel according to an embodiment of the present invention. The structure of a sustain electrode pair formed in one discharge cell of the plasma display panel shown in FIG. It is a simplified illustration of the bay.
도 9를 참조하면, 본 발명의 일실시예에 따른 유지 전극(410,420), 즉 스캔 전극 및 서스테인 전극은 기판 상에 방전셀의 중심을 기준으로 대칭되게 쌍을 이루며 형성된다. 여기서 방전셀은, 유지 전극(410,420), 가로 격벽(402,404)과 세로 격벽(406,408), 어드레스 전극(미도시)과 형광체(미도시)를 포함한다.Referring to FIG. 9, sustain
유지 전극(410,420) 각각은, 단일 층(one layer)으로 형성되며, 방전셀을 가로지르는 전극 라인(411,421), 연결전극(413,423), 및 평행 전극(415,425)을 포함 할 수 있다. 또한, 도 9의 유지 전극(410,420) 각각은, 평행 전극(415,425)의 양 단부에 연결되어 전극 라인(411,421) 방향으로 돌출되는 복수개의 돌출 전극(417,419,427,429)을 더 포함할 수 있다.Each of the sustain
도 9의 유지 전극(410,420) 각각은, 도 5의 유지전극(110,120) 각각과 거의 유사하므로, 이하에서는 그 차이점만을 기술한다.Since each of the sustain
도 9의 복수개의 돌출 전극(417,419,427,429)이, 평행 전극(415,425)의 양 단부에 연결되어 연장됨으로써, 평행 전극 사이(415와425)에서 개시되게 되며, 연결 전극(413,423) 및 전극 라인(411,421) 방향으로 확대되는 방전이, 복수개의 돌출 전극(417,419,427,429)을 따라서도 확대되므로, 방전 확대가 더욱 용이하게 된다. 따라서, 방전 효율이 향상되게 된다.The plurality of protruding
한편, 도 9의 복수개의 돌출 전극(417,419,427,429)은, 전극 라인(411,421) 방향으로 굴곡되어 형성될 수 있다. 따라서, 돌출 전극(417,419,427,429)에서의 방전 확대는 전극 라인(411,421)에 굴곡되는 방향으로 확대되게 된다.Meanwhile, the plurality of protruding
이상 본 발명의 바람직한 실시예에 대해 상세히 기술하였지만, 본 발명이 속하는 기술분야에 있어서 통상의 지식을 가진 사람이라면, 첨부된 청구범위에 정의된 본 발명의 정신 및 범위에 벗어나지 않으면서 본 발명을 여러 가지로 변형 또는 변경하여 실시할 수 있음을 알 수 있을 것이다. 따라서, 본 발명의 앞으로의 실시예들의 변경은 본 발명의 기술을 벗어날 수 없을 것이다.Although a preferred embodiment of the present invention has been described in detail above, those skilled in the art to which the present invention pertains can make various changes without departing from the spirit and scope of the invention as defined in the appended claims. It will be appreciated that modifications or variations may be made to the branches. Accordingly, modifications of the embodiments of the present invention will not depart from the scope of the present invention.
도 1은 본 발명에 따른 플라즈마 디스플레이 패널의 구조에 대한 일실시예를 나타내는 사시도이다.1 is a perspective view showing an embodiment of the structure of a plasma display panel according to the present invention.
도 2 는 플라즈마 디스플레이 패널의 전극 배치에 대한 일실시예를 도시한 도면이다. 2 is a diagram illustrating an embodiment of an electrode arrangement of a plasma display panel.
도 3은 하나의 프레임(frame)을 복수의 서브필드(subfield)로 나누어 플라즈마 디스플레이 패널을 시분할 구동시키는 방법에 대한 일실시예를 나타내는 타이밍도이다.FIG. 3 is a timing diagram illustrating an embodiment of a method of time-divisionally driving a plasma display panel by dividing one frame into a plurality of subfields.
도 4는 플라즈마 디스플레이 패널을 구동시키기 위한 구동 신호의 파형에 대한 일실시예를 나타내는 타이밍도이다.4 is a timing diagram illustrating an embodiment of a waveform of a driving signal for driving a plasma display panel.
도 5는 본 발명의 일실시예에 따른 플라즈마 디스플레이 패널의 상부기판에 형성된 전극 구조를 단면도이다.5 is a cross-sectional view of an electrode structure formed on an upper substrate of a plasma display panel according to an exemplary embodiment of the present invention.
도 6은 본 발명의 일실시예에 따른 플라즈마 디스플레이 패널의 상부기판에 형성된 전극 구조를 단면도이다.6 is a cross-sectional view of an electrode structure formed on an upper substrate of a plasma display panel according to an exemplary embodiment of the present invention.
도 7은 도 6의 전극 구조에 따른 방전셀 내의 전기장 분포를 도시한 도면이다.7 is a diagram illustrating an electric field distribution in a discharge cell according to the electrode structure of FIG. 6.
도 8은 본 발명의 일실시예에 따른 플라즈마 디스플레이 패널의 상부기판에 형성된 전극 구조를 단면도이다.8 is a cross-sectional view of an electrode structure formed on an upper substrate of a plasma display panel according to an embodiment of the present invention.
도 9는 본 발명의 일실시예에 따른 플라즈마 디스플레이 패널의 상부기판에 형성된 전극 구조를 단면도이다.9 is a cross-sectional view of an electrode structure formed on an upper substrate of a plasma display panel according to an exemplary embodiment of the present invention.
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KR101029660B1 (en) * | 2011-01-25 | 2011-04-15 | (주)새론테크 | Polyurea paint composition having excellent workability and superior toughness and method using the same |
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2008
- 2008-10-24 KR KR1020080104880A patent/KR20100045779A/en not_active Application Discontinuation
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Publication number | Priority date | Publication date | Assignee | Title |
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KR101029660B1 (en) * | 2011-01-25 | 2011-04-15 | (주)새론테크 | Polyurea paint composition having excellent workability and superior toughness and method using the same |
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Legal Events
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WITN | Withdrawal due to no request for examination |