KR20100024211A - Fringe field switching mode liquid crystal display device - Google Patents

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KR20100024211A
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Abstract

PURPOSE: A fringe field switching mode liquid crystal display is provided to improve penetration ratio and aperture ratio by controlling foreground generation. CONSTITUTION: A fringe field switching mode liquid crystal display includes a gate line(105), a gate insulating layer, a data line(130), a thin film transistor(Tr), a pixel electrode(155), a protective layer, a common electrode(170), a second substrate, a black matrix(184), a color filter layer, and a liquid crystal layer. The gate line is formed on a first substrate. The gate insulating layer is formed on the gate line. The data line crosses with the gate line and defines a pixel area. The thin film transistor is electrically connected with the gate line and data line. The pixel electrode is contacted with drain electrode of the thin film transistor. The protective layer covers the thin film transistor and the data line. The common electrode has multiple aperture units with a bar shape formed to overlap with the gate line. The second substrate faces with the first substrate. The color filter lay covers the block matrix. The liquid crystal layer is inserted between the first substrate and the second substrate.

Description

프린지 필드 스위칭 모드 액정표시장치{Fringe field switching mode liquid crystal display device} Fringe field switching mode liquid crystal display device

본 발명은 액정표시장치(Liquid Crystal Display Device)에 관한 것으로 특히, 프린지 필드 효과를 가지며, 전경 발생을 억제하여 개구율 및 투과율을 향상시킨 프린지 필드 스위칭 모드 액정표시장치에 관한 것이다.BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a liquid crystal display device, and more particularly, to a fringe field switching mode liquid crystal display device having a fringe field effect and suppressing foreground generation to improve aperture ratio and transmittance.

일반적으로, 액정표시장치는 액정의 광학적 이방성과 분극성질을 이용하여 구동된다. 상기 액정은 구조가 가늘고 길기 때문에 분자의 배열에 방향성을 가지고 있으며, 인위적으로 액정에 전기장을 인가하여 분자배열의 방향을 제어할 수 있다.In general, the liquid crystal display device is driven by using the optical anisotropy and polarization of the liquid crystal. Since the liquid crystal is thin and long in structure, the liquid crystal has directivity in the arrangement of molecules, and the direction of the molecular arrangement can be controlled by artificially applying an electric field to the liquid crystal.

따라서, 상기 액정의 분자배열 방향을 임의로 조절하면, 액정의 분자배열이 변하게 되고, 광학적 이방성에 의해 상기 액정의 분자배열 방향으로 빛이 굴절하여 화상정보를 표현할 수 있다.Accordingly, if the molecular arrangement direction of the liquid crystal is arbitrarily adjusted, the molecular arrangement of the liquid crystal is changed, and light is refracted in the molecular arrangement direction of the liquid crystal due to optical anisotropy to express image information.

현재에는 박막트랜지스터와 상기 박막트랜지스터에 연결된 화소전극이 행렬방식으로 배열된 능동행렬 액정표시장치(AM-LCD : Active Matrix LCD 이하, 액정표 시장치로 약칭함)가 해상도 및 동영상 구현능력이 우수하여 가장 주목받고 있다.Currently, an active matrix liquid crystal display device (AM-LCD: below Active Matrix LCD, abbreviated as liquid crystal table market value), in which a thin film transistor and pixel electrodes connected to the thin film transistor are arranged in a matrix manner, has the best resolution and video performance. It is attracting attention.

상기 액정표시장치는 공통전극이 형성된 컬러필터 기판과 화소전극이 형성된 어레이 기판과, 상기 두 기판 사이에 개재된 액정으로 이루어지는데, 이러한 액정표시장치에서는 공통전극과 화소전극이 상하로 걸리는 전기장에 의해 액정을 구동하는 방식으로 투과율과 개구율 등의 특성이 우수하다.The liquid crystal display includes a color filter substrate on which a common electrode is formed, an array substrate on which pixel electrodes are formed, and a liquid crystal interposed between the two substrates. In such a liquid crystal display, the common electrode and the pixel electrode are caused by an electric field applied up and down. It is excellent in the characteristics, such as transmittance | permeability and aperture ratio, by the method of driving a liquid crystal.

그러나, 상하로 걸리는 전기장에 의한 액정구동은 시야각 특성이 우수하지 못한 단점을 가지고 있다. However, the liquid crystal drive due to the electric field applied up and down has a disadvantage that the viewing angle characteristics are not excellent.

따라서, 상기의 단점을 극복하기 위해 시야각 특성이 우수한 횡전계형 액정표시장치가 제안되었다. Accordingly, a transverse field type liquid crystal display device having excellent viewing angle characteristics has been proposed to overcome the above disadvantages.

이하, 도 1을 참조하여 일반적인 횡전계형 액정표시장치에 관하여 상세히 설명한다.Hereinafter, a general transverse electric field type liquid crystal display device will be described in detail with reference to FIG. 1.

도 1은 일반적인 횡전계형 액정표시장치의 단면을 도시한 도면이다.1 is a cross-sectional view of a general transverse electric field type liquid crystal display device.

도시한 바와 같이, 컬러필터 기판인 상부기판(9)과 어레이 기판인 하부기판(10)이 서로 이격되어 대향하고 있으며, 이 상부 및 하부기판(9, 10)사이에는 액정층(11)이 개재되어 있다. As shown, the upper substrate 9, which is a color filter substrate, and the lower substrate 10, which is an array substrate, are spaced apart from each other, and the liquid crystal layer 11 is interposed between the upper and lower substrates 9, 10. It is.

상기 하부기판(10)상에는 공통전극(17)과 화소전극(30)이 동일 평면상에 형성되어 있으며, 이때, 상기 액정층(11)은 상기 공통전극(17)과 화소전극(30)에 의한 수평전계(L)에 의해 작동된다.The common electrode 17 and the pixel electrode 30 are formed on the lower substrate 10 on the same plane. In this case, the liquid crystal layer 11 is formed by the common electrode 17 and the pixel electrode 30. It is operated by the horizontal electric field (L).

도 2a와 2b는 일반적인 횡전계형 액정표시장치의 온(on), 오프(off) 상태의 동작을 각각 도시한 단면도이다.2A and 2B are cross-sectional views illustrating operations of on and off states of a general transverse electric field type liquid crystal display device, respectively.

우선, 전압이 인가된 온(on)상태에서의 액정의 배열상태를 도시한 도 2a를 참조하면, 상기 공통전극(17) 및 화소전극(30)과 대응하는 위치의 액정(11a)의 상변이는 없지만 공통전극(17)과 화소전극(30)사이 구간에 위치한 액정(11b)은 이 공통전극(17)과 화소전극(30)사이에 전압이 인가됨으로써 형성되는 수평전계(L)에 의하여, 상기 수평전계(L)와 같은 방향으로 배열하게 된다. 즉, 상기 횡전계형 액정표시장치는 액정이 수평전계에 의해 이동하므로, 시야각이 넓어지는 특성을 띠게 된다. First, referring to FIG. 2A, which illustrates an arrangement of liquid crystals in an on state where a voltage is applied, a phase change of a liquid crystal 11a at a position corresponding to the common electrode 17 and the pixel electrode 30 is performed. Although the liquid crystal 11b positioned in the section between the common electrode 17 and the pixel electrode 30 is formed by the horizontal electric field L formed by applying a voltage between the common electrode 17 and the pixel electrode 30, It is arranged in the same direction as the horizontal electric field (L). That is, in the transverse electric field type liquid crystal display device, since the liquid crystal moves by the horizontal electric field, the viewing angle is widened.

그러므로, 상기 횡전계형 액정표시장치를 정면에서 보았을 때, 상/하/좌/우방향으로 약 80∼85o방향에서도 반전현상 없이 가시 할 수 있다.Therefore, when the transverse electric field type liquid crystal display device is viewed from the front, it can be seen in the up / down / left / right directions even in the about 80 to 85 o direction without inversion phenomenon.

다음, 도 2b를 참조하면, 상기 액정표시장치에 전압이 인가되지 않은 오프(off)상태이므로 상기 공통전극과 화소전극 간에 수평전계가 형성되지 않으므로 액정층(11)의 배열 상태가 변하지 않는다.Next, referring to FIG. 2B, since no voltage is applied to the liquid crystal display, a horizontal electric field is not formed between the common electrode and the pixel electrode, so that the arrangement state of the liquid crystal layer 11 does not change.

하지만 이러한 횡전계형 액정표시장치는 시야각을 향상시키는 장점을 갖지만 개구율 및 투과율이 낮은 단점을 갖는다.However, such a transverse field type liquid crystal display device has an advantage of improving the viewing angle, but has a disadvantage of low aperture ratio and low transmittance.

따라서 이러한 횡전계형 액정표시장치의 단점을 개성하기 위하여 프린지 필드(Fringe field)에 의해 액정이 동작하는 것을 특징으로 하는 프린지 필드 스위칭 모드 액정표시장치(fringe field switching mode LCD)가 제안되었다. Therefore, in order to characterize the shortcomings of the transverse electric field type liquid crystal display, a fringe field switching mode LCD is characterized in that the liquid crystal is operated by a fringe field.

도 3은 종래의 프린지 필드 스위칭 모드 액정표시장치의 하나의 화소영역에 대한 평면도이다. 3 is a plan view of one pixel area of a conventional fringe field switching mode liquid crystal display device.

도시한 바와 같이, 종래의 프린지 필드 스위칭 모드 액정표시장치(40)는 크게 어레이 기판(41)과 컬러필터 기판(미도시) 그리고 이들 두 기판(41, 미도시) 사이에 개재된 액정층(미도시)으로 구성되고 있다.As shown in the drawing, the conventional fringe field switching mode liquid crystal display 40 has a large liquid crystal layer (not shown) interposed between the array substrate 41 and the color filter substrate (not shown) and the two substrates 41 (not shown). City).

우선, 어레이 기판(41)에는 도시한 바와 같이, 일방향으로 다수의 게이트 배선(43)이 연장하며 구성되어 있으며, 이러한 다수의 게이트 배선(43)과 교차하여 다수의 화소영역(P)을 정의하며 다수의 데이터 배선(51)이 구성되고 있다. First, as shown in the drawing, a plurality of gate lines 43 extend and extend in one direction, and the plurality of pixel regions P are defined by crossing the plurality of gate lines 43. Many data wirings 51 are formed.

또한, 상기 다수의 화소영역(P) 각각에는 이를 정의한 상기 데이터 배선(51)및 게이트 배선(43)과 연결되며, 게이트 전극(45)과 게이트 절연막(미도시)과 반도체층(미도시)과 소스 및 드레인 전극(55, 58)을 포함하는 스위칭 소자인 박막트랜지스터(Tr)가 형성되어 있다. In addition, each of the plurality of pixel regions P is connected to the data line 51 and the gate line 43 defining the gate electrode 45, the gate insulating layer (not shown), the semiconductor layer (not shown), and the like. The thin film transistor Tr, which is a switching element including the source and drain electrodes 55 and 58, is formed.

또한, 각 화소영역(P)에는 상기 박막트랜지스터(Tr)의 드레인 전극(58)과 전기적으로 연결되며 다수의 바(bar) 형태의 개구부(op)를 갖는 판 형태의 화소전극(60)이 형성되어 있다. 이때 상기 판 형태의 화소전극(60)은 각 화소영역(P)의 내측으로, 즉 각 화소영역(P)을 정의하는 게이트 및 데이터 배선(43, 51)과 중첩되지 않으며 이들 배선(43, 51)으로부터 소정폭 이격하여 형성되고 있다. 이렇게 화소전극(60)을 게이트 및 데이터 배선(43, 51)과 중첩하지 않도록 형성한 이유는 게이트 절연막(미도시)을 사이에 두고 상기 화소전극(60)과, 게이트 배선(43) 또는 데이터 배선(51)과 중첩하는 경우, 기생 용량 등이 발생하며 이는 각 층간 커플링에 의해 화소전극(60)과 공통전극(75)간의 전계 왜곡이 유발될 수 있기에 이를 방지하기 위함이다. In addition, in each pixel region P, a plate-shaped pixel electrode 60 electrically connected to the drain electrode 58 of the thin film transistor Tr and having a plurality of bar-shaped openings op is formed. It is. In this case, the plate-shaped pixel electrode 60 does not overlap with the gate and data lines 43 and 51 defining each pixel area P, that is, inside the pixel area P. ) Is spaced apart from the predetermined width. The reason why the pixel electrode 60 is formed so as not to overlap the gate and the data lines 43 and 51 is that the pixel electrode 60 and the gate line 43 or the data line are interposed with a gate insulating film (not shown) therebetween. In the case of overlapping with 51, parasitic capacitance and the like are generated. This is to prevent the electric field distortion between the pixel electrode 60 and the common electrode 75 by coupling between layers.

또한, 상기 다수의 화소영역(P)이 형성된 표시영역 전면에는 각 화소영역(P)에 대응하여 상기 판 형태의 화소전극(60)과 중첩하며 상기 공통전극(75)이 형성되고 있다. 이때 상기 공통전극(75)은 표시영역 전면에 형성되나 하나의 화소영역(P)에 대응되는 부분을 점선으로 나타내었다.In addition, the common electrode 75 is formed on the entire display area in which the plurality of pixel areas P is formed, overlapping the plate-shaped pixel electrode 60 corresponding to each pixel area P. In this case, the common electrode 75 is formed on the entire surface of the display area, but a portion corresponding to one pixel area P is indicated by a dotted line.

이러한 구성을 갖는 프린지 필드 스위칭 모드 액정표시장치용 어레이 기판(41)은 상기 각 화소영역(P)별로 상기 다수의 바(bar) 형태의 개구부(op)를 갖는 화소전극(60)과 상기 공통전극(75)에 전압이 인가됨으로써 프린지 필드(Fringe field)를 형성하게 된다.The array substrate 41 for a fringe field switching mode liquid crystal display device having such a configuration includes a pixel electrode 60 having the plurality of bar-shaped openings op for each pixel region P, and the common electrode. A voltage is applied to the 75 to form a fringe field.

한편, 전술한 구조를 갖는 어레이 기판(41)에 대응하여 이와 마주하며 컬러필터 기판(미도시)이 구비되고 있으며, 이때 상기 컬러필터 기판(미도시)에는 각 화소영역(P)에 대응하여 적, 녹, 청의 컬러필터 패턴이 순차 반복하며 컬러필터층(미도시)이 형성되어 있으며, 각 화소영역(P)의 경계를 이루는 상기 게이트 배선(43) 및 데이터 배선(51)과 상기 박막트랜지스터(Tr)에 대응하여 블랙매트릭스(85)가 형성되어 있다. Meanwhile, a color filter substrate (not shown) is provided to face the array substrate 41 having the above-described structure, and the color filter substrate (not shown) corresponds to each pixel region P. Color filter patterns of green, green, and blue are repeated in sequence, and a color filter layer (not shown) is formed, and the gate line 43, the data line 51, and the thin film transistor Tr forming a boundary of each pixel area P are formed. ), A black matrix 85 is formed.

하지만 전술한 구성을 갖는 종래의 프린지 필드 스위칭 액정표시장치(40)에 있어 상기 어레이 기판(41)은 상기 공통전극(75)에 대응하여 상기 다수의 바(bar) 형태의 개구부(op)를 갖는 화소전극(60), 특히 상기 다수의 개구부(op)가 완전히 중첩하는 형태로 형성되고 있음을 알 수 있다. 이 경우 화소전극(60)과 공통전극(75)의 형태상 상기 개구부(op)의 장축 방향의 양 끝단에서는 전계가 일정한 한 방향으로 형성되지 않기 때문에 액정분자(미도시)가 서로 다른 방향으로 움직이는 경계부, 즉 전경 영역(disclination area : DA)이 발생하게 된다. 이러한 전경 영역(DA)은 액정표시장치가 완전한 온(on) 상태에서 빛을 투과시키지 못하기 때문에 주변 대비 불규칙적으로 어둡게 표시되게 된다. However, in the conventional fringe field switching liquid crystal display 40 having the above-described configuration, the array substrate 41 has the openings op of the plurality of bars in correspondence with the common electrode 75. It can be seen that the pixel electrode 60, in particular, the plurality of openings op is completely overlapped. In this case, liquid crystal molecules (not shown) move in different directions because the electric field is not formed in one direction at both ends of the major axis of the opening op in the shape of the pixel electrode 60 and the common electrode 75. The boundary, that is, the foreground area DA, is generated. The foreground area DA is displayed irregularly dark compared to the surroundings because the liquid crystal display does not transmit light in a completely on state.

이러한 전경영역(DA)이 발생한 부분에서는 빛을 정상적으로 투과시키지 못하게 되므로 사용자가 화상을 바라다 볼 때 표시품위를 저하시킨다. 따라서 이들 전경이 발생한 부분에 대응해서는 상기 게이트 배선(43)에 대응하여 형성된 블랙매트릭스(85)를 더욱 확장하여, 즉 그 폭을 더욱 넓게하여 컬러필터 기판(미도시)에 구성함으로써 상기 전경이 발생한 부분으로부터 나오는 빛을 차단시키고 있다.In the area where the foreground area DA is generated, light cannot be transmitted normally, thereby degrading the display quality when the user looks at the image. Therefore, in response to the portion where the foreground occurs, the foreground is generated by further expanding the black matrix 85 formed corresponding to the gate wiring 43, that is, making the width wider and forming the color filter substrate (not shown). I block the light coming out of the part.

하지만, 이렇게 전경이 발생한 부분에 대응하여 블랙매트릭스(85)를 구성하는 경우, 하나의 화소영역(P) 내에서 정상적인 빛이 투과하는 영역, 즉 개구율이 저하되며, 나아가 빛의 실질적인 투과율이 저하되는 문제가 발생하고 있다. However, when the black matrix 85 is configured to correspond to the portion where the foreground occurs, the area through which normal light transmits, that is, the aperture ratio of the pixel matrix P, is reduced, and thus the actual transmittance of the light is reduced. There is a problem.

본 발명은 이러한 종래의 프린지 필드 스위칭 모드 액정표시장치의 문제점을 해결하기 위해 안출된 것으로, 개구부 끝단의 전경 발생 영역을 최소화하거나 또는 그 발생을 억제하여 전경 발생 부분에 형성되는 블랙매트릭스를 생략함으로써 투과율을 향상시키고 나아가 고 품위의 화상을 제공하는 것을 그 목적으로 한다. The present invention has been made to solve the problems of the conventional fringe field switching mode liquid crystal display, and the transmittance by omitting the black matrix formed in the foreground generating portion by minimizing or suppressing the foreground generating region at the end of the opening The purpose is to improve the quality of the image and to provide a high quality image.

전술한 바와 같은 목적을 달성하기 위한 본 발명의 일실시예에 따른 프린지 필드 스위칭 모드 액정표시장치는, 제 1 기판 상에 일방향으로 연장하며 형성된 게이트 배선과; 상기 게이트 배선 위로 형성된 게이트 절연막과; 상기 게이트 절연막 위로 상기 게이트 배선과 교차하여 화소영역을 정의하는 데이터 배선과; 상기 게이트 배선 및 데이터 배선과 전기적으로 연결되며 형성된 박막트랜지스터와; 상기 게이트 절연막 위로 상기 화소영역 내부에 상기 박막트랜지스터의 드레인 전극과 접촉하며 형성되며, 전단의 게이트 배선과 제 1 폭 중첩하며 형성된 판 형태의 화소전극과; 상기 화소전극 위로 상기 박막트랜지스터와 상기 데이터 배선을 덮으며 형성된 보호층과; 상기 보호층 위로 상기 화소전극에 대응하여 그 장축은 상기 데이터 배선과 나란하며 상기 장축 양 끝단이 상기 게이트 배선과 중첩하도록 형성된 바(bar) 형태의 다수의 개구부를 갖는 공통전극과; 상기 제 1 기판과 대향하는 제 2 기판과; 상기 제 2 기판의 내측면에 상기 게이트 배선 및 화소영역에 대응해서는 패터닝되어 제거된 형태를 가지며 상기 데이터 배선에 대응하여 형성된 블랙매트릭스와; 상기 블랙매트릭스를 덮으며 상기 화소영역에 대응하여 형성된 컬러필터층과; 상기 제 1 기판과 제 2 기판에 사이에 개재된 액정층을 포함한다. A fringe field switching mode liquid crystal display device according to an embodiment of the present invention for achieving the above object includes a gate wiring formed extending in one direction on the first substrate; A gate insulating film formed over the gate wiring; A data line on the gate insulating layer, the data line crossing the gate line to define a pixel area; A thin film transistor electrically connected to the gate line and the data line; A plate-shaped pixel electrode formed on the gate insulating layer in contact with the drain electrode of the thin film transistor and overlapping a first gate line with a first gate line; A protective layer formed over the pixel electrode and covering the thin film transistor and the data line; A common electrode on the passivation layer corresponding to the pixel electrode, the long axis of which is parallel to the data line and having a plurality of bar openings formed at both ends of the long axis to overlap the gate line; A second substrate facing the first substrate; A black matrix formed on the inner surface of the second substrate so as to be patterned and removed to correspond to the gate line and the pixel area and formed to correspond to the data line; A color filter layer covering the black matrix and formed to correspond to the pixel area; And a liquid crystal layer interposed between the first substrate and the second substrate.

본 발명의 또 다른 실시예에 따른 프린지 필드 스위칭 모드 액정표시장치는, 제 1 기판과; 상기 제 1 기판 상에 일방향으로 연장하며 형성된 게이트 배선과; 상기 게이트 배선 위로 형성된 게이트 절연막과; 상기 게이트 절연막 위로 상기 게이트 배선과 교차하여 화소영역을 정의하는 데이터 배선과; 상기 게이트 배선 및 데이터 배선과 전기적으로 연결되며 형성된 박막트랜지스터와; 상기 게이트 절연막 위로 상기 화소영역 내부에 상기 박막트랜지스터의 드레인 전극과 접촉하며 형성되며, 전단의 게이트 배선과 제 1 폭 중첩하며 형성된 판 형태의 화소전극과; 상기 화소전극 위로 상기 박막트랜지스터와 상기 데이터 배선을 덮으며 형성된 보호층과; 상기 보호층 위로 상기 화소전극에 대응하여 상기 데이터 배선이 연장한 방향으로 서로 이웃하는 화소영역 간에는 그 장축 끝단이 서로 연결되어 스트라이프(strip) 타입으로 형성된 다수의 개구부를 갖는 공통전극과; 상기 제 1 기판과 대향하는 제 2 기판과; 상기 제 2 기판의 내측면에 상기 게이트 배선 및 화소영역에 대응해서는 패터닝되어 제거된 형태를 가지며 상기 데이터 배선에 대응하여 형성된 블랙매트릭스와; 상기 블랙매트릭스를 덮으며 상기 화소영역에 대응하여 형성된 컬러필터층과; 상기 제 1 기판과 제 2 기판에 사이에 개재된 액정층을 포함한다. A fringe field switching mode liquid crystal display device according to still another embodiment of the present invention includes a first substrate; A gate wiring formed extending in one direction on the first substrate; A gate insulating film formed over the gate wiring; A data line on the gate insulating layer, the data line crossing the gate line to define a pixel area; A thin film transistor electrically connected to the gate line and the data line; A plate-shaped pixel electrode formed on the gate insulating layer in contact with the drain electrode of the thin film transistor and overlapping a first gate line with a first gate line; A protective layer formed over the pixel electrode and covering the thin film transistor and the data line; A common electrode having a plurality of openings formed in a stripe type with end portions of the long axis connected to each other in the direction in which the data line extends in correspondence with the pixel electrode on the protective layer; A second substrate facing the first substrate; A black matrix formed on the inner surface of the second substrate so as to be patterned and removed to correspond to the gate line and the pixel area and formed to correspond to the data line; A color filter layer covering the black matrix and formed to correspond to the pixel area; And a liquid crystal layer interposed between the first substrate and the second substrate.

이때, 상기 블랙매트릭스는 상기 박막트랜지스터에 대응하는 영역에 대해서 연장 형성된 것이 특징이며, 상기 제 1 폭은 상기 게이트 배선 폭의 50% 이하인 것이 특징이다.At this time, the black matrix is characterized in that it is formed extending in the region corresponding to the thin film transistor, the first width is characterized in that less than 50% of the gate wiring width.

본 발명에 따른 프린지 필드 스위칭 모드 액정표시장치는 바(bar) 형태의 개구부 끝단에서 전경 발생이 억제되기 때문에 특히 게이트 배선과 상기 개구부 끝단을 가리기 위한 블랙매트릭스를 생략함으로써 투과율을 향상시키는 효과가 있으며, 나아가 개구율을 향상시키는 효과가 있다.In the fringe field switching mode liquid crystal display according to the present invention, since the occurrence of the foreground is suppressed at the end of the bar-shaped opening, the transmittance is improved by omitting the gate matrix and the black matrix for covering the opening end. Furthermore, there is an effect of improving the aperture ratio.

나아가, 각 화소영역에 있어 화소전극을 전단의 게이트 배선과 소정 폭 중첩하도록 형성함으로써 전계 발생 영역을 확장시켜 개구율을 더욱 향상시키는 효과가 있다. Furthermore, in each pixel region, the pixel electrode is formed to overlap the gate wiring at the front end by a predetermined width, thereby extending the electric field generating region to further improve the aperture ratio.

또한, 각 화소영역 내의 개구부 끝단에서 전경 발생이 억제됨으로써 고 품위의 화상을 제공하는 효과가 있다. In addition, the generation of the foreground at the end of the opening in each pixel region is suppressed, thereby providing an image of high quality.

이하, 첨부한 도면을 참조하여 본 발명의 바람직한 실시예를 설명한다.Hereinafter, preferred embodiments of the present invention will be described with reference to the accompanying drawings.

도 4는 본 발명의 실시예에 따른 프린지 필드 스위칭 모드 액정표시장치의 하나의 화소영역에 대한 평면도이며, 도 5는 도 4를 절단선 Ⅴ-Ⅴ를 따라 절단한 부분에 대한 단면도이며, 도 6은 도 4를 절단선 Ⅵ-Ⅵ를 따라 절단한 부분에 대한 단면도이다. 설명의 편의를 위해 다수의 화소영역이 형성된 영역을 표시영역이라 정의한다. 4 is a plan view of one pixel area of a fringe field switching mode liquid crystal display according to an exemplary embodiment of the present invention, FIG. 5 is a cross-sectional view of a portion taken along the cutting line V-V of FIG. FIG. 4 is a cross-sectional view of a portion cut along the cutting line VI-VI. For convenience of description, an area in which a plurality of pixel areas are formed is defined as a display area.

도 5를 참조하면, 본 발명의 실시예에 따른 프린지 필드 스위칭 모드 액정표시장치(100)는 어레이 기판(101)과 컬러필터 기판(미도시) 그리고 이들 두 기판(101, 미도시) 사이에 개재된 액정층(미도시)을 포함하여 구성되고 있다.Referring to FIG. 5, a fringe field switching mode liquid crystal display device 100 according to an embodiment of the present invention is interposed between an array substrate 101, a color filter substrate (not shown), and two substrates 101 (not shown). It is comprised including the liquid crystal layer (not shown).

우선, 어레이 기판(101)에는 제 1 방향으로 게이트 배선(105)이 연장하며 구성되어 있으며, 제 2 방향으로 연장하며 상기 게이트 배선(105)과 교차하여 화소영역(P)을 정의하는 데이터 배선(130)이 구성되고 있다. First, the gate wiring 105 extends and extends in the first direction of the array substrate 101, and extends in the second direction and crosses the gate wiring 105 to define the pixel area P. 130 is configured.

또한, 상기 화소영역(P)에는 상기 게이트 배선(105) 및 데이터 배선(130)과 연결되며, 게이트 전극(108)과, 게이트 절연막(미도시)과, 순수 비정질 실리콘의 액티브층(미도시)과 불순물 비정질 실리콘의 오믹콘택층(미도시)으로 구성된 반도체층(미도시)과, 서로 이격하는 소스 및 드레인 전극(133, 136)을 포함하는 박막트랜지스터(Tr)가 형성되어 있다. 이때, 도면에 있어서 상기 박막트랜지스터(Tr)는 하나의 화소영역(P)의 개구율을 더욱 향상시키고자 상기 게이트 배선(105) 상에 형성됨으로써 상기 게이트 배선(105) 자체를 게이트 전극(108)으로 구성함을 일례로 보이고 있으나, 상기 게이트 전극(108)은 게이트 배선(105)에서 분기한 형태로 형성될 수도 있다. In addition, the pixel region P is connected to the gate wiring 105 and the data wiring 130, and has a gate electrode 108, a gate insulating film (not shown), and an active layer of pure amorphous silicon (not shown). And a thin film transistor Tr including a source layer and a drain electrode 133 and 136 spaced apart from each other and a semiconductor layer (not shown) including an ohmic contact layer (not shown) of impurity amorphous silicon. In this case, in the drawing, the thin film transistor Tr is formed on the gate wiring 105 to further improve the aperture ratio of one pixel region P, thereby converting the gate wiring 105 itself into the gate electrode 108. Although the configuration is shown as an example, the gate electrode 108 may be formed in a branched shape from the gate wiring 105.

또한, 본 발명의 가장 특징적인 부분으로 상기 화소영역(P) 내측으로 판 형태의 화소전극(155)이 상기 박막트랜지스터(Tr)의 드레인 전극(136)과 접촉하며 동시에 전단의 게이트 배선(105)과 일부 중첩하며 형성되고 있다. 이때, 상기 판 형태의 화소전극(155)과 상기 전단의 게이트 배선(105)과의 중첩되는 폭(t1)은 상기 게이트 배선(105)의 폭(t2)의 50%이하인 것이 바람직하다. 통상적으로 상기 게이트 배선(105)의 폭(t2)은 8㎛ 내지 12㎛정도가 되고 있으며, 이 경우 중첩되는 최대폭(t1)은 4㎛ 내지 6㎛ 정도가 되도록 하는 것이 바람직하다. 이렇게 전단의 게이트 배선(105)과 상기 화소전극(155)과의 중첩폭(t1)을 상기 게이트 배선 폭(t2)의 50%이하가 되도록 형성하는 이유는 서로 이웃하는 화소전극(105)간 커플링에 의한 전계 왜곡을 방지하기 위함이다. 종래의 경우 전계왜곡 방지를 위해 각 화소영역 내측에 위치하도록 화소전극을 형성하였지만, 시뮬레이션 결과 상기 화소전극(155)을 전단의 게이트 배선(105)과 특정 범위내에서 중첩하도록 형성하여도 상기 화소전극(155)과 게이트 배선(105)의 중첩으로 인해 생성된 기생용량 또는 이웃한 화소전극(155)과 커플링에 의한 전계 왜곡 현상은 거의 발생하지 않음을 알게 되었으며, 이를 바탕으로 그 중첩 폭(t1)이 게이트 배선 폭(t2)의 50%이하가 되는 특정 범위에서 중첩하도록 형성한 것이다. In addition, the most characteristic feature of the present invention is a plate-shaped pixel electrode 155 in contact with the drain electrode 136 of the thin film transistor Tr inside the pixel region P, and at the same time, the gate wiring 105 of the front end. And some overlapping. In this case, the width t1 overlapping the plate-shaped pixel electrode 155 and the gate wiring 105 of the front end is preferably 50% or less of the width t2 of the gate wiring 105. Typically, the width t2 of the gate wiring 105 is about 8 μm to about 12 μm, and in this case, it is preferable that the maximum width t1 overlapping is about 4 μm to about 6 μm. The reason why the overlap width t1 between the gate wiring 105 and the pixel electrode 155 at the front end is formed to be 50% or less of the gate wiring width t2 is because of the coupling between the neighboring pixel electrodes 105. This is to prevent electric field distortion caused by the ring. In the related art, the pixel electrode is formed to be located inside each pixel region to prevent electric field distortion. However, the pixel electrode 155 is formed to overlap the gate wiring 105 of the front end within a specific range. The parasitic capacitance generated by the overlapping of the gate wiring 105 and the gate wiring 105 or the electric field distortion caused by the coupling with the neighboring pixel electrode 155 is hardly generated. ) Is overlapped in a specific range that is 50% or less of the gate wiring width t2.

또한, 상기 다수의 화소영역(P)을 포함하는 표시영역 전면에는 각 화소영역(P)내에 형성된 상기 판 형태의 화소전극(155)에 대응하여 바(bar) 형태의 다수의 개구부(op)를 갖는 공통전극(170)이 형성되고 있다. 이때 상기 공통전극(170)은 표시영역 전면에 형성되며, 도 4에는 설명의 편의를 위해 하나의 화소영역(P)에 대해 점선 형태로 도면부호 170을 부여하여 나타내었다. In addition, a plurality of bar openings op may be formed in front of the display area including the plurality of pixel areas P to correspond to the plate-shaped pixel electrodes 155 formed in each pixel area P. FIG. The common electrode 170 is formed. In this case, the common electrode 170 is formed on the entire display area, and in FIG. 4, one pixel area P is denoted by a reference numeral 170 in a dotted line for convenience of description.

상기 화소영역(P) 내에 형성된 판 형태의 화소전극(155)에 대응하여 형성되는 상기 바(bar) 형태의 다수의 개구부(op)의 그 장축 방향의 양 끝단은 각각 상기 게이트 배선(105)과 중첩하도록 형성되고 있는 것이 특징이다. 이 경우 상기 공통 전극(170) 내에 형성된 바(bar) 형태의 다수의 개구부(op)는 종래보다 화소영역 내에서 최대한 길게 형성될 수 있으므로 투과율을 향상시키는 효과를 갖게 된다.Both ends of the plurality of bar-shaped openings OP formed in the pixel region P corresponding to the plate-shaped pixel electrodes 155 in the major axis direction are respectively formed in the gate wiring 105 and the gate wiring 105. It is characterized by being formed to overlap. In this case, a plurality of bar openings (ops) having a bar shape formed in the common electrode 170 may be formed as long as possible in the pixel area than in the prior art, thereby improving the transmittance.

전술한 판 형태의 화소전극(155)과 바(bar) 형태의 다수의 개구부(op)의 형태에 의해 상기 바(bar) 형태의 다수의 개구부(op) 일 끝단에서 소정폭의 전경이 발생한다 하여도 이는 상기 불투명 금속물질로 형성되는 게이트 배선(105)에 대응해서는 그 하부로부터 나온 빛이 통과하지 않게 되므로 빛이 투과되지 않는 영역이 되는 바, 자연적으로 가려지게 됨을 알 수 있다. The foreground having a predetermined width is generated at one end of the bar-shaped openings op by the shape of the plate-shaped pixel electrode 155 and the bar-shaped openings op. Even if this corresponds to the gate wiring 105 formed of the opaque metal material, since the light from the lower portion does not pass through, the light is not transmitted through the bar, it can be seen that it is naturally masked.

한편, 본 발명의 변형예에 따른 프린지 필드 스위칭 모드 액정표시장치의 하나의 화소영역에 대한 평면도인 도 7(실시예와 동일한 구성요소에 대해서는 동일한 도면부호를 부여함)을 참조하면, 표시영역 전체에 형성된 공통전극(170) 내에 형성된 바(bar) 형태의 다수의 개구부(op)는 도시한 바와 같이, 데이터 배선(130)의 연장방향으로 이웃하는 화소영역(P) 간에는 서로 연결된 구조를 갖는 형태로 형성될 수도 있다. 즉, 상기 공통전극(170) 내에 형성된 바(bar) 형태의 다수의 개구부(op)는 표시영역 전체에 있어 화소영역(P) 구분없이 스트라이프(strip) 형태로 상기 데이터 배선(130)과 나란하게 형성될 수도 있다. Meanwhile, referring to FIG. 7 (the same components as in the embodiment are denoted by the same reference numerals), which is a plan view of one pixel area of a fringe field switching mode liquid crystal display device according to a modification of the present invention, the entire display area The plurality of bar openings op having a bar shape formed in the common electrode 170 may have a structure in which the pixel areas P adjacent to each other in the extending direction of the data line 130 are connected to each other. It may be formed as. That is, a plurality of bar-shaped openings (ops) formed in the common electrode 170 are parallel to the data line 130 in a stripe form without dividing the pixel region P in the entire display area. It may be formed.

이 경우, 본 발명의 변형예에 따른 구성에 있어서는 표시영역 내의 최외각에 위치하는 화소영역(미도시)을 제외하고는 개구부(op)의 장축 양끝단이 존재하지 않는다. 따라서, 최외각 화소영역(미도시)을 제외한 각 화소영역(P) 내부에는 상기 다수의 각 개구부(op)의 장축 양 끝단의 단측면이 존재하지 않으므로 상기 양끝단 단측면에 의한 전계가 전혀 형성되지 않는다. 따라서 이 부분에 위치하는 액정분 자(미도시)들은 상기 개구부(op)의 장측면에 의한 전계에 영향을 받게 되는 바, 일정한 방향으로 움직이게 됨으로써 정상적인 구동을 하게 된다. In this case, in the configuration according to the modified example of the present invention, except for the pixel area (not shown) located at the outermost part of the display area, both ends of the long axis of the opening op do not exist. Accordingly, since there is no short side surface at both ends of the long axis of each of the plurality of openings OP, except for the outermost pixel area (not shown), no electric field is formed at both ends. It doesn't work. Therefore, the liquid crystal molecules (not shown) positioned in this portion are affected by the electric field due to the long side surface of the opening op, so that the liquid crystal molecules (not shown) are driven in a predetermined direction so as to operate normally.

따라서, 종래에서와 같은 전경은 발생하지 않게 되거나 또는 전경 발생 영역이 상기 게이트 배선(105)에 중첩하는 부분에 형성되므로, 자연적으로 전경 발생 부분이 게이트 배선(105)에 가려지게 됨으로써 개구율을 향상시키는 동시에 투과율을 향상시키게 된다.Therefore, the foreground as in the prior art does not occur or the foreground generating region is formed in the portion overlapping the gate wiring 105, so that the foreground generating portion is naturally hidden by the gate wiring 105 to improve the aperture ratio. At the same time, the transmittance is improved.

한편, 도 4를 다시 참조하면, 상기 바(bar) 형태의 다수의 개구부(op)를 포함하는 공통전극은 표시영역에 전면에 형성되고 있음을 보이고 있지만, 상기 박막트랜지스터(Tr)에 대응해서는 상기 바(bar) 형태의 다수의 개구부(op)를 형성한 것과 같이 제거되는 형태로 형성될 수도 있다. 이는 상기 박막트랜지스터(Tr)의 게이트 전극(108)과 중첩됨으로써 기생 커패시터를 이루어 상기 박막트랜지스터(Tr)의 스위칭 동작에 악영향을 끼칠 수 있기 때문에 이를 방지하기 위함이다. Meanwhile, referring back to FIG. 4, although the common electrode including a plurality of bar-shaped openings (ops) is formed on the entire surface of the display area, the thin film transistor Tr corresponds to the thin film transistor Tr. It may be formed in a shape that is removed, such as forming a plurality of openings (op) in the form of a bar (bar). This is because the parasitic capacitor may be overlapped with the gate electrode 108 of the thin film transistor Tr to adversely affect the switching operation of the thin film transistor Tr.

한편, 전술한 구성을 갖는 실시예 및 변형예에 따른 어레이 기판(101)에 대응하여 각 화소영별로 적, 녹, 청색의 컬러필터 패턴이 순차 반복하는 형태의 컬러필터층(미도시)과 상기 데이터 배선(130)과 박막트랜지스터(Tr)에 대응하여 블랙매트릭스(184)가 형성되며, 상기 컬러필터층(미도시)을 덮으며 전면에 형성된 오버코트층(미도시)을 포함하는 컬러필터 기판(미도시)이 구성되어 있다. 또한 상기 어레이 기판(101)과 컬러필터 기판(미도시) 사이에는 액정층(미도시)이 구비되고 있다. 이때 본 발명의 또 다른 특징적인 구성으로서 상기 블랙매트릭스(184)는 종래의 경우 게이트 및 데이터 배선과 박막트랜지스터에 대응하여 각 화소영역의 둘러싸듯이 형성되고 있지만, 본 발명의 경우 게이트 배선(105)에 대응해서는 생략되고 데이터 배선(130)과 박막트랜지스터(Tr)에 대응해서만 형성됨으로써 화소영역(P)의 개구율을 향상시키고 있는 것이 특징이다. On the other hand, the color filter layer (not shown) and the data having a form in which the red, green, and blue color filter patterns are sequentially repeated for each pixel area corresponding to the array substrate 101 according to the embodiments and modifications having the above-described configuration A black matrix 184 is formed corresponding to the wiring 130 and the thin film transistor Tr, and includes a color filter substrate (not shown) covering the color filter layer (not shown) and including an overcoat layer (not shown) formed on the entire surface. ) Is configured. In addition, a liquid crystal layer (not shown) is provided between the array substrate 101 and the color filter substrate (not shown). In this case, the black matrix 184 is formed so as to surround each pixel region corresponding to the gate and data lines and the thin film transistor in the related art, but in the case of the present invention, the black matrix 184 is formed in the gate line 105. In this case, the aperture ratio of the pixel region P is improved by being omitted only and corresponding to the data line 130 and the thin film transistor Tr.

이렇게 본 발명의 실시예 및 변형예에 있어서 게이트 배선(105)에 대응하여 블랙매트릭스(184)를 형성하지 않아도 되는 이유는, 화소전극(155)을 전단의 게이트 배선(105)과 소정폭 중첩하여 형성하고, 각 화소영역(P) 내에서의 바(bar) 형태의 다수의 개구부(op)의 양끝단까지 게이트 배선과 중첩하도록 형성(도 4 참도)하거나, 또는 표시영역 전체에 대해 스트라이프 타입으로 연결된 형태로 형성(도 7 참조)하고 있으므로 상기 각 개구부(op) 장축 양 끝단에서의 전경 발생이 최소화되거나 억제됨으로써 게이트 배선(105)에 대응해서 이보다 더 넓은 폭을 갖는 별도의 블랙매트릭스(184)를 형성하지 않아도 표시품질에 있어 문제되지 않기 때문이다. The reason why the black matrix 184 is not required to correspond to the gate wiring 105 in the embodiment and the modification of the present invention is that the pixel electrode 155 overlaps the gate wiring 105 of the previous stage by a predetermined width. And overlap the gate wiring to both ends of the bar-shaped openings op in each pixel region P (refer to FIG. 4), or stripe type for the entire display region. 7 is formed in a shape connected to each other (see FIG. 7), so that the occurrence of foreground at both ends of the long axis of each opening (op) is minimized or suppressed, so that a separate black matrix 184 having a wider width than that of the gate wiring 105 is provided. This is because the display quality is not a problem even if a) is not formed.

이후에는 도 5 및 6을 참조하여 본 발명의 실시예에 따른 프린지 필드 스위칭 모드 액정표시장치의 단면 구조에 대해 설명한다. 변형예의 경우, 개구부의 게이트 배선과 중첩되는 부분에서의 단면구조만이 차이가 있을 뿐 그 외의 단면구조는 실시예와 동일하므로 차별점이 있는 부분에 대해서만 간단히 언급한다. 이때 설명의 편의를 위해 화소영역 내에 박막트랜지스터가 형성되는 영역을 스위칭 영역이라 정의한다.Hereinafter, the cross-sectional structure of the fringe field switching mode liquid crystal display according to the exemplary embodiment of the present invention will be described with reference to FIGS. 5 and 6. In the case of the modification, only the cross-sectional structure at the portion overlapping with the gate wiring of the opening is different, and other cross-sectional structures are the same as in the embodiment, so only the portions having the difference point are mentioned briefly. In this case, for convenience of description, an area in which the thin film transistor is formed in the pixel area is defined as a switching area.

도시한 바와 같이, 본 발명의 실시예에 따른 프린지 필드 스위칭 모드 액정표시장치(100)에 있어, 어레이 기판(101)은, 투명한 절연기판(101) 상에 저저항 특 성을 갖는 금속물질 예를들면 알루미늄(Al), 알루미늄 합금(AlNd), 구리(Cu), 구리합금 중 선택되는 하나의 금속물질로써 제 1 방향으로 연장하는 게이트 배선(미도시)과 이와 연결되어 스위칭 영역(TrA)에 게이트 전극(108)이 형성되어 있다. As shown, in the fringe field switching mode liquid crystal display device 100 according to the exemplary embodiment of the present invention, the array substrate 101 may include an example of a metal material having low resistance characteristics on the transparent insulating substrate 101. For example, a metal material selected from aluminum (Al), aluminum alloy (AlNd), copper (Cu), and copper alloy may be connected to a gate wiring (not shown) extending in the first direction and connected to the gate to the switching region TrA. The electrode 108 is formed.

한편, 도면에 있어서는 상기 게이트 배선(미도시)과 상기 게이트 전극(108)은 단일층 구조인 것을 일례로 보이고 있으나, 이중층 구조를 갖도록 형성될 수도 있다. 이중층 구조를 이루는 경우 하부층은 저저항 금속물질인 알루미늄(Al), 알루미늄 합금(AlNd), 구리(Cu), 구리합금 중 선택되는 하나의 금속물질로 이루어지며, 상부층은 몰리브덴(Mo)으로 이루어지는 것이 바람직하다. Meanwhile, in the drawing, the gate wiring (not shown) and the gate electrode 108 are shown as an example of a single layer structure, but may be formed to have a double layer structure. In the case of forming a double layer structure, the lower layer is made of one metal material selected from among aluminum (Al), aluminum alloy (AlNd), copper (Cu), and copper alloy, and the upper layer is made of molybdenum (Mo). desirable.

또한, 상기 게이트 배선(105)과 게이트 전극(108) 위로 상기 기판(101) 전면에 무기절연물질 예를들면 산화실리콘(SiO2) 또는 질화실리콘(SiNx)으로 이루어지는 게이트 절연막(115)이 형성되어 있다. In addition, a gate insulating film 115 made of an inorganic insulating material such as silicon oxide (SiO 2 ) or silicon nitride (SiNx) is formed on the entire surface of the substrate 101 over the gate wiring 105 and the gate electrode 108. have.

또한, 상기 게이트 절연막(115) 위로 스위칭 영역(TrA)에 있어 상기 게이트 전극(108)에 대응하여 순수 비정질 실리콘의 액티브층(120a)과 불순물 비정질 실리콘의 오믹콘택층(120b)을 포함하는 반도체층(120)이 형성되어 있으며, 상기 반도체층(120) 상부로 제 2 금속물질 예를들면 몰리브덴(Mo), 크롬(Cr), 알루미늄(Al), 알루미늄 합금(AlNd), 구리(Cu), 구리합금 중 어느 하나의 물질로 이루어지며 서로 이격하는 소스 및 드레인 전극(133, 136)이 형성되어 있다. 이때, 상기 서로 이격하는 소스 및 드레인 전극(133, 136) 사이로 상기 액티브층(120a)이 노출되고 있으며, 상기 스위칭 영역(TrA)에 순차 적층된 상기 게이트 전극(108)과 게이트 절연 막(115)과 반도체층(120)과 소스 및 드레인 전극(133, 136)은 박막트랜지스터(Tr)를 이룬다.In addition, a semiconductor layer including an active layer 120a of pure amorphous silicon and an ohmic contact layer 120b of impurity amorphous silicon in the switching region TrA on the gate insulating layer 115, corresponding to the gate electrode 108. 120 is formed on the semiconductor layer 120, and a second metal material such as molybdenum (Mo), chromium (Cr), aluminum (Al), aluminum alloy (AlNd), copper (Cu), copper Source and drain electrodes 133 and 136 made of any one material of the alloy and spaced apart from each other are formed. In this case, the active layer 120a is exposed between the source and drain electrodes 133 and 136 spaced apart from each other, and the gate electrode 108 and the gate insulating film 115 sequentially stacked in the switching region TrA. The semiconductor layer 120 and the source and drain electrodes 133 and 136 form a thin film transistor Tr.

또한, 상기 게이트 절연막(115) 상부에는 상기 게이트 배선(105)과 교차하여 화소영역(P)을 정의하는 데이터 배선(130)이 제 2 방향으로 연장하며 형성되어 있다. 이때, 상기 박막트랜지스터(Tr)의 소스 전극(133)은 상기 데이터 배선(130)과 연결되어 있다. 이때, 상기 데이터 배선(130)과 소스 및 드레인 전극(133, 136) 또한 이중층 구조를 갖도록 구성될 수도 있다.In addition, a data line 130 extending in the second direction is formed on the gate insulating layer 115 to cross the gate line 105 to define the pixel region P. In this case, the source electrode 133 of the thin film transistor Tr is connected to the data line 130. In this case, the data line 130 and the source and drain electrodes 133 and 136 may also be configured to have a double layer structure.

한편, 상기 데이터 배선(130)과 상기 게이트 절연막(115) 사이에는 상기 반도체층(120)을 구성하고 있는 동일한 반도체 물질로써 제 1 패턴(121a)과 제 2 패턴(121b)의 이중층 구조의 반도체 패턴(121)이 더욱 형성되고 있다. 이러한 반도체 패턴(121)은 어레이 기판(101)의 제조 방법에 기인한 것으로, 도시한 바와 같이 상기 데이터 배선(130) 하부에 형성될 수도 있고 또는 생략될 수도 있다. 즉, 상기 반도체층(120)과, 상기 데이터 배선(130)과 소스 및 드레인 전극(133, 136)을 1회의 마스크 공정을 통해 동시에 형성하는 경우는 도시한 바와 같이 상기 데이터 배선(130) 하부에 이중층 구조의 반도체 패턴(121)이 형성되며, 상기 반도체층(120)과, 상기 데이터 배선(130)과 소스 및 드레인 전극(133, 136)을 서로 다른 마스크 공정, 즉 2회의 마스크 통해 각각 형성하는 경우는 상기 데이터 배선(130) 하부에 반도체 패턴(121)은 형성되지 않는다. Meanwhile, a semiconductor pattern having a double layer structure of the first pattern 121a and the second pattern 121b as the same semiconductor material constituting the semiconductor layer 120 between the data line 130 and the gate insulating layer 115. 121 is further formed. The semiconductor pattern 121 is due to the method of manufacturing the array substrate 101, and may be formed under the data line 130 or may be omitted as shown. That is, when the semiconductor layer 120, the data line 130, and the source and drain electrodes 133 and 136 are simultaneously formed through one mask process, the semiconductor layer 120 and the data line 130 are formed under the data line 130 as shown. The semiconductor pattern 121 having a double layer structure is formed, and the semiconductor layer 120, the data line 130, and the source and drain electrodes 133 and 136 are formed through different mask processes, that is, two masks, respectively. In this case, the semiconductor pattern 121 is not formed below the data line 130.

또한, 각 화소영역(P) 내에는 상기 게이트 절연막(115) 위로 투명 도전성 물질 예를들면, 인듐-틴-옥사이드(ITO) 또는 인듐-징크-옥사이드(IZO)로 이루어지고, 상기 드레인 전극(136)과 직접 접촉하며 판 형태를 갖는 화소전극(155)이 전단의 게이트 배선(미도시)과 소정폭 중첩하며 형성되어 있다. 이때 상기 화소전극(155)과 전단의 게이트 배선(미도시)이 중첩하는 폭은 상기 게이트 배선 폭의 50% 이하인 것이 바람직하다. In addition, each pixel region P is formed of a transparent conductive material, for example, indium tin oxide (ITO) or indium zinc oxide (IZO), on the gate insulating layer 115, and the drain electrode 136. The pixel electrode 155 which is in direct contact with each other and has a plate shape overlaps with a gate wiring (not shown) of a previous stage and is formed to overlap a predetermined width. In this case, the width of the pixel electrode 155 and the gate wirings (not shown) overlapping with each other may be 50% or less of the gate wiring width.

한편, 상기 데이터 배선(130)과 박막트랜지스터(Tr) 위로 무기절연물질 예를들면 산화실리콘(SiO2) 또는 질화실리콘(SiNx) 중 선택되는 하나 또는 유기절연물질 예를들면 벤조사이클로부텐(BCB) 또는 포토아크릴(photo acryl)로 이루어지는 보호층(160)이 전면에 형성되어 있다. 도면에 있어서는 무기절연물질로서 형성되어 그 하부의 구성요소의 단차를 반영하여 형성된 상태를 보이고 있지만, 유기절연물질로 형성될 경우 그 표면이 평탄한 상태가 되게 된다. Meanwhile, an inorganic insulating material such as silicon oxide (SiO 2 ) or silicon nitride (SiNx) or an organic insulating material such as benzocyclobutene (BCB) is disposed on the data line 130 and the thin film transistor Tr. Alternatively, the protective layer 160 made of photo acryl is formed on the entire surface. In the figure, the inorganic insulating material is formed to reflect the step of the components below it, but the state is formed. However, when the organic insulating material is formed, the surface becomes flat.

또한, 상기 보호층(160) 위로 투명 도전성 물질 예를들면 인듐-틴-옥사이드(ITO) 또는 인듐-징크-옥사이드(IZO)로써 화소영역(P)들로 이루어진 표시영역 전면에 대해 판 형태의 공통전극(170)이 형성되어 있다. 이때, 상기 공통전극(170)은 각 화소영역(P)에 형성된 각 화소전극(155)에 대해 바(bar) 형태를 갖는 다수의 개구부(op)가 상기 데이터 배선(130)과 나란하게 형성되고 있다. 도면에 있어서는 각 화소영역(P)별로 상기 공통전극(170) 내에 상기 바(bar) 형태의 다수의 개구부(op)가 서로 동일 간격으로 이격하며 3개(도 4 참조) 구성되어 있는 것으로 도시되고 있지만, 효율적인 프린지 필드 형성을 위해 상기 각 화소영역(P)에 대응되는 개구부(op)는 2개 내지 10개 정도의 범위 내에서 적당한 개수로 형성될 수 있다. In addition, the protective layer 160 has a common plate shape for the entire display area including the pixel areas P as a transparent conductive material such as indium tin oxide (ITO) or indium zinc oxide (IZO). The electrode 170 is formed. In this case, in the common electrode 170, a plurality of openings op having a bar shape are formed in parallel with the data line 130 for each pixel electrode 155 formed in each pixel area P. have. In the drawing, the plurality of openings op of the bar shape are formed in the common electrode 170 in the common electrode 170 by spaced apart from each other at equal intervals, and are configured as three (see FIG. 4). However, in order to form an efficient fringe field, an opening op corresponding to each pixel area P may be formed in an appropriate number within a range of about 2 to about 10.

한편, 도 5에 있어서는 상기 판 형태의 공통전극(170)은 상기 보호층(160) 위로 각 화소영역(P) 내의 박막트랜지스터(Tr)를 덮으며 바(bar) 형태의 다수의 개구부(op)를 갖는 것으로 도시되고 있지만, 그 변형예로서 상기 박막트랜지스터(Tr)에 대응해서는 제거되어 상기 보호층(160)을 노출시키는 형태로 형성될 수도 있다.Meanwhile, in FIG. 5, the plate-shaped common electrode 170 covers the thin film transistor Tr in each pixel region P on the passivation layer 160 and has a plurality of bar openings op. Although illustrated as having a, as a modification, the thin film transistor Tr may be removed to correspond to the protective layer 160.

또한, 전술한 구성을 갖는 어레이 기판(101)에 대응하여 이와 이격하여 위치하는 컬러필터 기판(181)에 있어서는 그 내측면에 상기 어레이 기판(101)의 데이터 배선(130)과 박막트랜지스터(Tr)에 대응하여 블랙매트릭스(184)가 형성되어 있다. 또한 상기 블랙매트릭스(184)를 덮으며 상기 각 화소영역(P)에 대응하여 적, 녹, 청색 컬러필터 패턴(186a, 186b, 미도시)이 순차 반복하는 형태의 컬러필터층(186)이 형성되어 있으며, 상기 컬러필터층(186)을 덮으며 투명한 유기절연물질로써 전면에 그 표면이 평탄한 형태로 오버코트층(188)이 형성되어 있다. 이때 상기 오버코트층(188)을 생략될 수도 있다.In addition, in the color filter substrate 181 spaced apart from and corresponding to the array substrate 101 having the above-described configuration, the data line 130 and the thin film transistor Tr of the array substrate 101 are disposed on the inner surface thereof. In response to this, the black matrix 184 is formed. In addition, a color filter layer 186 is formed to cover the black matrix 184 and repeat the red, green, and blue color filter patterns 186a, 186b (not shown) corresponding to each pixel area P. The overcoat layer 188 is formed on the entire surface of the color filter layer 186 with a transparent organic insulating material. In this case, the overcoat layer 188 may be omitted.

또한, 전술한 구성을 갖는 상기 어레이 기판(101)과 컬러필터 기판(181) 사이의 이격영역에는 액정층(191)이 개재됨으로 본 발명에 따른 프린지 필드 스위칭 모드 액정표시장치(100)를 이루고 있다.In addition, the liquid crystal layer 191 is interposed between the array substrate 101 and the color filter substrate 181 having the above-described configuration to form the fringe field switching mode liquid crystal display device 100 according to the present invention. .

본 발명은 전술한 실시예에 한정되지 아니하며, 본 발명의 정신을 벗어나지 않는 이상 다양한 변화와 변형이 가능하다. The present invention is not limited to the above-described embodiments, and various changes and modifications can be made without departing from the spirit of the present invention.

도 1은 일반적인 횡전계형 액정표시장치의 일부를 개략적으로 도시한 단면도.1 is a cross-sectional view schematically showing a part of a general transverse electric field type liquid crystal display device.

도 2a, 2b는 일반적인 횡전계형 액정표시장치의 온(on), 오프(off) 상태의 동작을 각각 도시한 단면도.2A and 2B are cross-sectional views showing operations of on and off states of a general transverse electric field type liquid crystal display device, respectively.

도 3은 종래의 프린지 필드 스위칭 모드 액정표시장치의 하나의 화소영역에 대한 평면도.3 is a plan view of one pixel area of a conventional fringe field switching mode liquid crystal display device;

도 4는 본 발명의 실시예에 따른 프린지 필드 스위칭 모드 액정표시장치의 하나의 화소영역에 대한 평면도.4 is a plan view of one pixel area of a fringe field switching mode liquid crystal display according to an exemplary embodiment of the present invention.

도 5는 도 4를 절단선 Ⅴ-Ⅴ를 따라 절단한 부분에 대한 단면도.FIG. 5 is a cross-sectional view of a portion cut along the cutting line VV of FIG. 4. FIG.

도 6은 도 4를 절단선 Ⅵ-Ⅵ를 따라 절단한 부분에 대한 단면도.FIG. 6 is a cross-sectional view of a portion cut along the cutting line VI-VI of FIG. 4. FIG.

도 7은 본 발명의 변형에에 따른 프린지 필드 스위칭 모드 액정표시장치의 하나의 화소영역에 대한 평면도.7 is a plan view of one pixel area of a fringe field switching mode liquid crystal display according to a modification of the present invention;

<도면의 주요부분에 대한 간단한 설명><Brief description of the main parts of the drawing>

100 : 프린지 필드 스위칭 모드 액정표시장치100: fringe field switching mode liquid crystal display device

101 : 어레이 기판 105 : 게이트 배선101: array substrate 105: gate wiring

108 : 게이트 전극 130 : 데이터 배선108: gate electrode 130: data wiring

133 : 소스 전극 136 : 드레인 전극133: source electrode 136: drain electrode

155 : 화소전극 170 : 공통전극 155: pixel electrode 170: common electrode

184 : 블랙매트릭스 184: Black Matrix

P : 화소영역 op : 개구부 P: pixel area op: opening

Tr : 박막트랜지스터Tr: Thin Film Transistor

Claims (4)

제 1 기판 상에 일방향으로 연장하며 형성된 게이트 배선과; A gate wiring formed extending in one direction on the first substrate; 상기 게이트 배선 위로 형성된 게이트 절연막과;A gate insulating film formed over the gate wiring; 상기 게이트 절연막 위로 상기 게이트 배선과 교차하여 화소영역을 정의하는 데이터 배선과;A data line on the gate insulating layer, the data line crossing the gate line to define a pixel area; 상기 게이트 배선 및 데이터 배선과 전기적으로 연결되며 형성된 박막트랜지스터와;A thin film transistor electrically connected to the gate line and the data line; 상기 게이트 절연막 위로 상기 화소영역 내부에 상기 박막트랜지스터의 드레인 전극과 접촉하며 형성되며, 전단의 게이트 배선과 제 1 폭 중첩하며 형성된 판 형태의 화소전극과;A plate-shaped pixel electrode formed on the gate insulating layer in contact with the drain electrode of the thin film transistor and overlapping a first gate line with a first gate line; 상기 화소전극 위로 상기 박막트랜지스터와 상기 데이터 배선을 덮으며 형성된 보호층과;A protective layer formed over the pixel electrode and covering the thin film transistor and the data line; 상기 보호층 위로 상기 화소전극에 대응하여 그 장축은 상기 데이터 배선과 나란하며 상기 장축 양 끝단이 상기 게이트 배선과 중첩하도록 형성된 바(bar) 형태의 다수의 개구부를 갖는 공통전극과;A common electrode on the passivation layer corresponding to the pixel electrode, the long axis of which is parallel to the data line and having a plurality of bar openings formed at both ends of the long axis to overlap the gate line; 상기 제 1 기판과 대향하는 제 2 기판과;A second substrate facing the first substrate; 상기 제 2 기판의 내측면에 상기 게이트 배선 및 화소영역에 대응해서는 패터닝되어 제거된 형태를 가지며 상기 데이터 배선에 대응하여 형성된 블랙매트릭스와;A black matrix formed on the inner surface of the second substrate so as to be patterned and removed to correspond to the gate line and the pixel area and formed to correspond to the data line; 상기 블랙매트릭스를 덮으며 상기 화소영역에 대응하여 형성된 컬러필터층과;A color filter layer covering the black matrix and formed to correspond to the pixel area; 상기 제 1 기판과 제 2 기판에 사이에 개재된 액정층 Liquid crystal layer interposed between the first substrate and the second substrate 을 포함하는 프린지 필드 스위칭 모드 액정표시장치. Fringe field switching mode liquid crystal display comprising a. 제 1 기판과;A first substrate; 상기 제 1 기판 상에 일방향으로 연장하며 형성된 게이트 배선과; A gate wiring formed extending in one direction on the first substrate; 상기 게이트 배선 위로 형성된 게이트 절연막과;A gate insulating film formed over the gate wiring; 상기 게이트 절연막 위로 상기 게이트 배선과 교차하여 화소영역을 정의하는 데이터 배선과;A data line on the gate insulating layer, the data line crossing the gate line to define a pixel area; 상기 게이트 배선 및 데이터 배선과 전기적으로 연결되며 형성된 박막트랜지스터와;A thin film transistor electrically connected to the gate line and the data line; 상기 게이트 절연막 위로 상기 화소영역 내부에 상기 박막트랜지스터의 드레인 전극과 접촉하며 형성되며, 전단의 게이트 배선과 제 1 폭 중첩하며 형성된 판 형태의 화소전극과;A plate-shaped pixel electrode formed on the gate insulating layer in contact with the drain electrode of the thin film transistor and overlapping a first gate line with a first gate line; 상기 화소전극 위로 상기 박막트랜지스터와 상기 데이터 배선을 덮으며 형성된 보호층과;A protective layer formed over the pixel electrode and covering the thin film transistor and the data line; 상기 보호층 위로 상기 화소전극에 대응하여 상기 데이터 배선이 연장한 방향으로 서로 이웃하는 화소영역 간에는 그 장축 끝단이 서로 연결되어 스트라이 프(strip) 타입으로 형성된 다수의 개구부를 갖는 공통전극과;A common electrode having a plurality of openings formed in a stripe type with ends of the long axis connected to each other in a direction in which the data line extends in correspondence with the pixel electrode on the protective layer; 상기 제 1 기판과 대향하는 제 2 기판과;A second substrate facing the first substrate; 상기 제 2 기판의 내측면에 상기 게이트 배선 및 화소영역에 대응해서는 패터닝되어 제거된 형태를 가지며 상기 데이터 배선에 대응하여 형성된 블랙매트릭스와;A black matrix formed on the inner surface of the second substrate so as to be patterned and removed to correspond to the gate line and the pixel area and formed to correspond to the data line; 상기 블랙매트릭스를 덮으며 상기 화소영역에 대응하여 형성된 컬러필터층과;A color filter layer covering the black matrix and formed to correspond to the pixel area; 상기 제 1 기판과 제 2 기판에 사이에 개재된 액정층 Liquid crystal layer interposed between the first substrate and the second substrate 을 포함하는 프린지 필드 스위칭 모드 액정표시장치. Fringe field switching mode liquid crystal display comprising a. 제 1 항 또는 제 2 항에 있어서, The method according to claim 1 or 2, 상기 블랙매트릭스는 상기 박막트랜지스터에 대응하는 영역에 대해서 연장 형성된 것이 특징인 프린지 필드 스위칭 모드 액정표시장치. And the black matrix extends over an area corresponding to the thin film transistor. 제 1 항 또는 제 2 항에 있어서, The method according to claim 1 or 2, 상기 제 1 폭은 상기 게이트 배선 폭의 50% 이하인 것이 특징인 프린지 필드 스위칭 모드 액정표시장치.And the first width is 50% or less of the gate wiring width.
KR1020080082964A 2008-06-25 2008-08-25 Fringe field switching mode liquid crystal display device KR101170950B1 (en)

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