KR20070119239A - Liquid crystal display apparatus and method of fabricating the same - Google Patents

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KR20070119239A KR1020060053598A KR20060053598A KR20070119239A KR 20070119239 A KR20070119239 A KR 20070119239A KR 1020060053598 A KR1020060053598 A KR 1020060053598A KR 20060053598 A KR20060053598 A KR 20060053598A KR 20070119239 A KR20070119239 A KR 20070119239A
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Abstract

An LCD(Liquid Crystal Display) and a manufacturing method thereof are provided to set a correct joining position of an array substrate and a color filter substrate by enabling an alignment device to recognize exactly first and second align keys, thereby improving production yield by preventing join failure between the array substrate and the color filter substrate. An LCD(700) includes an array substrate(100), an opposite substrate(200), and a liquid crystal layer. The array substrate includes a first base substrate(110), a pixel unit, at least one align key(AK1~AK4), and a first protective pad. The first base substrate is divided into a display area(DA) and a surrounding area surrounding the display area. The pixel unit is formed in the display area to display an image. The align key is formed in the surrounding area. The first protective pad covers the upper side of the first align key and the circumference of the first align key. The opposite substrate includes a second base substrate, a common electrode, and at least one second align key. The liquid crystal layer is interposed between the array substrate and the opposite substrate to control the transmission rate of light.

Description

액정표시장치 및 제조 방법{LIQUID CRYSTAL DISPLAY APPARATUS AND METHOD OF FABRICATING THE SAME}Liquid crystal display and manufacturing method {LIQUID CRYSTAL DISPLAY APPARATUS AND METHOD OF FABRICATING THE SAME}

도 1은 본 발명의 일 실시예에 따른 액정표시장치를 나타낸 평면도이다.1 is a plan view illustrating a liquid crystal display according to an exemplary embodiment of the present invention.

도 2는 도 1의 절단선 I-I'에 따른 단면도이다.FIG. 2 is a cross-sectional view taken along the line II ′ of FIG. 1.

도 3은 도 1의 'A'부분을 확대하여 나타낸 평면도이다.3 is an enlarged plan view illustrating a portion 'A' of FIG. 1.

도 4는 도 3의 절단선 Ⅱ-Ⅱ'에 따른 단면도이다.4 is a cross-sectional view taken along the line II-II ′ of FIG. 3.

도 5a 내지 도 5c는 도 1에 도시된 어레이 기판을 형성하는 과정을 나타낸 공정도이다.5A through 5C are process diagrams illustrating a process of forming the array substrate illustrated in FIG. 1.

도 6a 내지 도 6c는 도 1에 도시된 컬러필터 기판을 형성하는 과정을 나타낸 공정도이다.6A through 6C are process diagrams illustrating a process of forming the color filter substrate illustrated in FIG. 1.

*도면의 주요 부분에 대한 부호의 설명** Description of the symbols for the main parts of the drawings *

100 -- 어레이 기판 180 : 제1 얼라인 키100-array substrate 180: first alignment key

190 -- 제1 보호 패드 200 : 대향 기판190-first protective pad 200: facing substrate

260 -- 제2 얼라인 키 270 : 제2 보호 패드260-Second alignment key 270: Second protective pad

본 발명은 액정표시장치 및 이의 제조 방법에 관한 것으로, 더욱 상세하게는 기판들의 결합 오차를 최소화하여 제품의 수율을 향상시킬 수 있는 액정표시장치 및 이의 제조 방법에 관한 것이다.The present invention relates to a liquid crystal display device and a manufacturing method thereof, and more particularly, to a liquid crystal display device and a manufacturing method thereof that can improve the yield of the product by minimizing the coupling error of the substrates.

액정표시장치는 다수의 화소가 어레이 형태로 형성된 어레이 기판, 어레이 기판과 마주하여 결합하는 컬러필터 기판 및 액정층을 포함한다. 컬러필터 기판은 소정의 색을 발현하는 다수의 색화소 및 각 색화소를 둘러싼 블랙 매트릭스를 포함한다.The liquid crystal display includes an array substrate in which a plurality of pixels are formed in an array form, a color filter substrate and a liquid crystal layer coupled to face the array substrate. The color filter substrate includes a plurality of color pixels expressing a predetermined color and a black matrix surrounding each color pixel.

여기서, 다수의 화소와 다수의 색화소는 서로 유기적인 관계를 맺고 있다. 즉, 다수의 화소는 액정에 화소 전압을 인가하여 다수의 색화소로 제공되는 광의 투과율을 조절하고, 다수의 색화소는 조절된 광을 제공받아 소정의 색을 발현한다. 이와 같이, 다수의 색화소는 다수의 화소로부터 출력된 화소 전압에 대응하여 입사되는 광량이 다르다. 따라서, 다수의 화소와 다수의 색화소의 위치가 정확하게 매칭되지 않으면, 영상을 정상적으로 표시할 수 없다.Here, the plurality of pixels and the plurality of color pixels have an organic relationship with each other. That is, the plurality of pixels adjust the transmittance of light provided to the plurality of color pixels by applying a pixel voltage to the liquid crystal, and the plurality of color pixels receive the adjusted light to express a predetermined color. As described above, the plurality of color pixels differ in the amount of incident light corresponding to the pixel voltages output from the plurality of pixels. Therefore, if the positions of the plurality of pixels and the plurality of color pixels do not exactly match, the image cannot be displayed normally.

이를 방지하기 위해, 어레이 기판은 제1 얼라인 키를 구비하고, 컬러필터 기판은 제1 얼라인 키에 대응하는 제2 얼라인 키를 구비한다. 즉, 제1 얼라인 키와 제2 얼라인 키 간의 위치를 조정하여 어레이 기판과 컬러필터 기판의 결합 위치를 설정한다.To prevent this, the array substrate has a first alignment key, and the color filter substrate has a second alignment key corresponding to the first alignment key. That is, the position of the alignment between the array substrate and the color filter substrate is set by adjusting the position between the first alignment key and the second alignment key.

일반적으로, 어레이 기판과 컬러필터 기판은 러빙포가 감겨진 러빙 장치를 이용하여 액정을 배향한다. 제1 및 제2 얼라인 키는 러빙 장치가 누르는 압력에 의해 그 형태가 변형될 수 있다. 또한, 각 얼라인 키의 상면에는 어레이 기판 및 컬 러필터 기판을 형성하는 박막들이 구비되지 않고, 각 얼라인 키와 얼라인 키의 주변부 간에 단차가 발생한다. 이로 인해, 러빙포에 묻은 이물이 각 얼라인 키의 주변부에 잔존할 수 있다.In general, the array substrate and the color filter substrate align the liquid crystal using a rubbing device in which a rubbing cloth is wound. The first and second alignment keys may be modified in shape by the pressure that the rubbing device presses. In addition, the thin film forming the array substrate and the color filter substrate are not provided on the upper surface of each alignment key, and a step is generated between each alignment key and the periphery of the alignment key. For this reason, the foreign material which adhered to the rubbing cloth may remain in the periphery of each alignment key.

이와 같이, 제1 및 제2 얼라인 키의 형태가 변형되거나, 제1 및 제2 얼라이 키의 주변부에 이물이 잔존하면, 제1 및 제2 얼라인 키의 형상을 정확하게 인식할 수 없다. 이로 인해, 어레이 기판과 컬러필터 기판 간의 정렬이 정확하게 이루어질 수 없으므로, 액정표시패널의 결합 불량이 발생하고, 제품의 수율이 저하된다.As such, when the shape of the first and second alignment keys is deformed or foreign matter remains on the periphery of the first and second alignment keys, the shapes of the first and second alignment keys may not be correctly recognized. As a result, since the alignment between the array substrate and the color filter substrate cannot be accurately performed, the coupling failure of the liquid crystal display panel occurs, and the yield of the product is reduced.

본 발명의 목적은 어레이 기판과 대향 기판의 결합 위치를 정확하게 설정하여 제품의 수율을 향상시킬 수 있는 액정표시장치를 제공하는 것이다.An object of the present invention is to provide a liquid crystal display device which can improve the yield of the product by accurately setting the bonding position of the array substrate and the opposing substrate.

또한, 본 발명의 목적은 상기한 액정표시장치를 제조하는 방법을 제공하는 것이다.It is also an object of the present invention to provide a method of manufacturing the above liquid crystal display device.

상기한 본 발명의 목적을 실현하기 위한 하나의 특징에 따른 액정표시장치는, 어레이 기판, 컬러필터 기판 및 액정층으로 이루어진다.A liquid crystal display device according to one feature for realizing the above object of the present invention comprises an array substrate, a color filter substrate, and a liquid crystal layer.

어레이 기판은 제1 베이스 기판, 화소부, 적어도 하나의 제1 얼라인 키 및 제1 보호 패드를 구비한다. 제1 베이스 기판은 영상이 표시되는 표시 영역 및 상기 표시 영역을 둘러싼 주변 영역으로 구획된된다. 화소부는 상기 표시 영역에 형성되어 상기 영상을 표시한다. 제1 얼라인 키는 상기 주변 영역에 형성된다. 제1 보호 패드는 상기 제1 얼라인 키의 상면 및 상기 제1 얼라인 키의 주변부를 커버한다.The array substrate includes a first base substrate, a pixel portion, at least one first alignment key, and a first protection pad. The first base substrate is partitioned into a display area in which an image is displayed and a peripheral area surrounding the display area. A pixel portion is formed in the display area to display the image. A first alignment key is formed in the peripheral area. The first protective pad covers an upper surface of the first alignment key and a periphery of the first alignment key.

한편, 대향 기판은 제2 베이스 기판, 공통 전극 및 적어도 하나의 제2 얼라인 키를 구비한다. 제2 베이스 기판은 상기 제1 베이스 기판과 마주하여 결합한다. 공통 전극은 상기 제2 베이스 기판의 상부에 형성된다. 제2 얼라인 키는 상기 제1 얼라인 키에 대응하여 상기 제2 베이스 기판의 상부에 형성되고, 상기 제1 베이스 기판과 상기 제2 베이스 기판의 결합 시 상기 제1 얼라인 키와 정렬된다.On the other hand, the opposing substrate includes a second base substrate, a common electrode and at least one second alignment key. The second base substrate is coupled to face the first base substrate. The common electrode is formed on the second base substrate. The second alignment key is formed on the second base substrate in correspondence with the first alignment key, and is aligned with the first alignment key when the first base substrate and the second base substrate are coupled to each other.

액정층은 상기 어레이 기판과 상기 대향 기판과의 사이에 개재되어 광의 투과율을 조절한다.The liquid crystal layer is interposed between the array substrate and the counter substrate to adjust the light transmittance.

바람직하게는, 상기 대향 기판은 상기 제2 얼라인 키의 상면 및 상기 제2 얼라인 키의 주변부를 커버하는 제2 보호 패드를 더 포함한다.Advantageously, said opposing substrate further comprises a second protective pad covering an upper surface of said second alignment key and a periphery of said second alignment key.

또한, 어레이 기판은 화소부, 제1 얼라인 및 제1 보호 패드가 형성된 제1 베이스 기판 상에 형성된 제1 배향막을 더 포함하고, 대향 기판은 공통 전극의 상부에 형성된 제2 배향막을 더 포함한다. 제1 및 제2 배향막의 상면에는 액정 분자를 배향하는 제1 및 제2 러빙 패턴이 각각 형성된다.The array substrate may further include a first alignment layer formed on the first base substrate on which the pixel portion, the first alignment, and the first protection pad are formed, and the opposing substrate further includes a second alignment layer formed on the common electrode. . First and second rubbing patterns for aligning liquid crystal molecules are formed on upper surfaces of the first and second alignment layers, respectively.

또한, 상기한 본 발명의 목적을 실현하기 위한 하나의 특징에 따른 액정표시장치 제조 방법은 다음과 같다.In addition, the liquid crystal display device manufacturing method according to one feature for realizing the above object of the present invention is as follows.

먼저, 어레이 기판을 제조하고, 상기 어레이 기판과 결합하여 영상을 표시하는 대향 기판을 제조한다.First, an array substrate is manufactured, and an opposing substrate that displays an image by combining with the array substrate is manufactured.

여기서, 상기 어레이 기판은 다음과 같은 과정을 통해 제조된다. 먼저, 제1 베이스 기판상에 적어도 하나의 스위칭 소자 및 적어도 하나의 제1 얼라인 키를 형성한다. 상기 스위칭 소자 및 상기 제1 얼라인 키가 형성된 상기 제1 베이스 기판 상에 제1 투명 도전층을 형성한다. 상기 제1 투명 도전층을 패터닝하여 상기 제1 얼라인 키의 상면 및 상기 제1 얼라인 키의 주변에 제1 보호 패드를 형성하고, 상기 스위칭 소자와 전기적으로 연결된 화소 전극을 형성한다. 상기 제1 보호 패드 및 상기 스위칭 소자가 형성된 상기 제1 베이스 기판의 상부에 제1 배향막을 형성한다. 상기 제1 배향막을 러빙하여 상기 제1 배향막의 상면에 제1 러빙 패턴을 형성한다.Here, the array substrate is manufactured through the following process. First, at least one switching element and at least one first alignment key are formed on the first base substrate. A first transparent conductive layer is formed on the first base substrate on which the switching element and the first alignment key are formed. The first transparent conductive layer is patterned to form a first protection pad on an upper surface of the first alignment key and around the first alignment key, and to form a pixel electrode electrically connected to the switching element. A first alignment layer is formed on the first base substrate on which the first protective pad and the switching element are formed. The first alignment layer is rubbed to form a first rubbing pattern on an upper surface of the first alignment layer.

이러한 액정표시장치 및 그 제조 방법에 따르면, 제1 및 제2 얼라인 키를 각각 커버하는 제1 및 제2 보호 패드를 구비함으로써, 러빙 과정에서 제1 및 제2 얼라인 키의 주변부에 이물이 잔존하는 것을 방지한다. 이에 따라, 제1 및 제2 얼라인 키를 외부에서 정확하게 인식할 수 있으므로, 어레이 기판과 대향 기판의 결합 불량을 방지할 수 있다.According to such a liquid crystal display and a method of manufacturing the same, the first and second protective pads respectively covering the first and second alignment keys are provided, so that foreign matter is formed on the periphery of the first and second alignment keys during the rubbing process. To prevent it from remaining. As a result, since the first and second alignment keys can be accurately recognized from the outside, the coupling failure between the array substrate and the counter substrate can be prevented.

이하, 첨부한 도면을 참조하여, 본 발명을 보다 상세하게 설명하고자 한다.Hereinafter, with reference to the accompanying drawings, it will be described in detail the present invention.

도 1은 본 발명의 일 실시예에 따른 액정표시장치를 나타낸 평면도이고, 도 2는 도 1의 절단선 I-I'에 따른 단면도이다.1 is a plan view illustrating a liquid crystal display according to an exemplary embodiment of the present invention, and FIG. 2 is a cross-sectional view taken along the line II ′ of FIG. 1.

도 1 및 도 2를 참조하면, 액정표시장치(700)는 어레이 기판(100), 컬러필터 기판(200), 액정층(300), 제1 및 제2 구동부(400, 500), 및 연성 회로부(600)를 포함한다.1 and 2, the liquid crystal display 700 may include an array substrate 100, a color filter substrate 200, a liquid crystal layer 300, first and second drivers 400 and 500, and a flexible circuit unit. And 600.

상기 어레이 기판(100)은 제1 베이스 기판(110), 다수의 데이터 라인(DL1, ..., DLm), 다수의 게이트 라인(GL1, ..., GLn), 다수의 화소부, 게이트 절연막(140), 보호막(150), 유기 절연막(160) 및 제1 배향막(170)을 포함한다.The array substrate 100 may include a first base substrate 110, a plurality of data lines DL1, DLm, a plurality of gate lines GL1, GLn, a plurality of pixel units, and a gate insulating layer. 140, a passivation layer 150, an organic insulating layer 160, and a first alignment layer 170.

상기 제1 베이스 기판(110)은 광을 투과시킬 수 있는 재질, 예컨대, 유리, 석영, 사파이어나 실리콘 등과 같은 재질로 이루어진다. 상기 제1 베이스 기판(110)은 영상이 표시되는 표시 영역(DA) 및 상기 표시 영역(PA)을 둘러싼 주변 영역(PA)으로 구획된다. 상기 주변 영역(PA)에는 상기 영상이 표시되지 않는다.The first base substrate 110 is made of a material capable of transmitting light, such as glass, quartz, sapphire or silicon. The first base substrate 110 is divided into a display area DA in which an image is displayed and a peripheral area PA surrounding the display area PA. The image is not displayed in the peripheral area PA.

상기 제1 베이스 기판(110)의 상부에는 상기 다수의 데이터 라인(DL1, ..., DLm) 및 상기 다수의 게이트 라인(GL1, ..., GLn)이 형성된다. 상기 다수의 데이터 라인(DL1, ..., DLm)은 상기 제1 구동부(400)와 전기적으로 연결되고, 상기 영상에 대응하는 데이터 신호를 각 화소부에 제공한다. 상기 다수의 게이트 라인(GL1, ..., GLn)은 상기 다수의 데이터 라인(DL1, ..., DLm)과 절연되어 교차한다. 상기 다수의 게이트 라인(GL1, ..., GLm)은 상기 제2 구동부(500)와 전기적으로 연결되어 게이트 신호를 상기 각 화소부에 제공한다.The plurality of data lines DL1,..., DLm and the plurality of gate lines GL1,..., GLn are formed on the first base substrate 110. The plurality of data lines DL1,..., DLm are electrically connected to the first driver 400, and provide a data signal corresponding to the image to each pixel unit. The plurality of gate lines GL1 to GLn are insulated from and cross the plurality of data lines DL1 to DLm. The plurality of gate lines GL1,..., GLm are electrically connected to the second driver 500 to provide a gate signal to each pixel unit.

상기 다수의 화소부는 상기 제1 베이스 기판(110)의 상부에 형성되고, 어레이 형상으로 배치된다. 각 화소부는 상기 다수의 데이터 라인(DL1, ..., DLm) 및 상기 다수의 게이트 라인(GL1, ..., GLn)에 의해 정의된다.The plurality of pixel units are formed on the first base substrate 110 and are arranged in an array shape. Each pixel portion is defined by the plurality of data lines DL1, ..., DLm and the plurality of gate lines GL1, ..., GLn.

화소부(Px)는 화소 전압을 상기 액정층(300)에 인가하고 차단하는 박막 트랜지스터(Thin Film Transistor : 이하, TFT)(120) 및 화소 전극(130)을 구비한다.The pixel portion Px includes a thin film transistor (TFT) 120 and a pixel electrode 130 that apply and block a pixel voltage to the liquid crystal layer 300.

상기 TFT(120)는 상기 제1 베이스 기판(110) 상에 형성된 게이트 전극(121), 상기 게이트 전극(121)의 상부에 형성된 액티브 층(122), 상기 액티브 층(122) 상에 형성된 오믹 콘택층(123), 및 상기 오믹 콘택층(123) 상부에 구비되는 소오스 및 드레인 전극(124, 125)을 포함한다.The TFT 120 may include a gate electrode 121 formed on the first base substrate 110, an active layer 122 formed on the gate electrode 121, and an ohmic contact formed on the active layer 122. The layer 123 includes source and drain electrodes 124 and 125 provided on the ohmic contact layer 123.

구체적으로, 상기 게이트 전극(121)은 상기 화소부(Px)를 정의하는 게이트 라인으로부터 분기되어 형성되고, 상기 게이트 라인으로부터 상기 게이트 신호를 인가받는다.In detail, the gate electrode 121 is formed by branching from a gate line defining the pixel portion Px, and receives the gate signal from the gate line.

상기 게이트 전극(121)이 형성된 상기 제1 베이스 기판(110)의 상면에는 상기 게이트 절연막(140)이 형성된다.The gate insulating layer 140 is formed on an upper surface of the first base substrate 110 on which the gate electrode 121 is formed.

상기 게이트 절연막(140)의 상면에는 상기 액티브 층(122)이 형성된다. 상기 액티브 층(122)은 상기 게이트 전극(121)에 대응하여 위치하고, 비정질 실리콘으로 이루어진다. 상기 액티브 층(122)의 상면에는 n+ 아몰퍼스 실리콘으로 이루어진 상기 오믹 콘택층(123)이 형성된다. 상기 액티브 층(122)은 상기 오믹 콘택층(123)이부분적으로 제거되어 형성된 채널 영역(CA)을 통해 노출된다.The active layer 122 is formed on an upper surface of the gate insulating layer 140. The active layer 122 is positioned to correspond to the gate electrode 121 and is made of amorphous silicon. The ohmic contact layer 123 made of n + amorphous silicon is formed on an upper surface of the active layer 122. The active layer 122 is exposed through the channel region CA formed by partially removing the ohmic contact layer 123.

상기 오믹 콘택층(123)의 상면에는 상기 소오스 전극(124) 및 드레인 전극(125)이 형성된다. 상기 소오스 전극(124)은 상기 화소부(Px)를 정의하는 데이터 라인으로부터 분기된다. 상기 드레인 전극(125)은 상기 채널 영역(CA)을 사이에 두고 상기 소오스 전극(124)과 마주한다.The source electrode 124 and the drain electrode 125 are formed on an upper surface of the ohmic contact layer 123. The source electrode 124 is branched from a data line defining the pixel portion Px. The drain electrode 125 faces the source electrode 124 with the channel region CA therebetween.

상기 TFT(120)가 형성된 상기 제1 베이스 기판(110)의 상부에는 상기 보호막(150) 및 상기 유기 절연막(160)이 순차적으로 형성된다. 상기 드레인 전극(125)은 상기 보호막(150) 및 상기 유기 절연막(160)이 부분적으로 제거되어 형성된 콘택홀(CH)을 통해 노출된다.The passivation layer 150 and the organic insulating layer 160 are sequentially formed on the first base substrate 110 on which the TFT 120 is formed. The drain electrode 125 is exposed through the contact hole CH formed by partially removing the passivation layer 150 and the organic insulating layer 160.

상기 화소 전극(130)은 상기 유기 절연막(160)의 상면에 형성된다. 상기 화소 전극(130)은 상기 콘택홀(CH)을 통해 상기 드레인 전극(125)과 전기적으로 연결 된다. 상기 화소 전극(130)은 투명한 도전성 물질, 예컨대, 인듐 틴 옥사이드(Indium Tin Oxide; 이하, ITO) 또는 인듐 징크 옥사이드(Indium Zinc Oxide; 이하, IZO)와 같은 물질로 이루어진다.The pixel electrode 130 is formed on the top surface of the organic insulating layer 160. The pixel electrode 130 is electrically connected to the drain electrode 125 through the contact hole CH. The pixel electrode 130 is made of a transparent conductive material, for example, indium tin oxide (ITO) or indium zinc oxide (IZO).

상기 화소 전극(130)이 형성된 상기 유리 절연막(160)의 상부에는 상기 제1 배향막(170)이 형성된다. 상기 제1 배향막(170)의 상면은 상기 액정층(300)의 각 액정 분자를 특정 방향으로 배향하기 위한 제1 러빙 패턴이 형성된다.The first alignment layer 170 is formed on the glass insulating layer 160 on which the pixel electrode 130 is formed. A first rubbing pattern is formed on an upper surface of the first alignment layer 170 to orient the liquid crystal molecules of the liquid crystal layer 300 in a specific direction.

한편, 상기 컬러필터 기판(200)은 상기 어레이 기판(100)과 마주하여 결합한다. 상기 컬러필터 기판(200)은 제2 베이스 기판(210), 컬러필터 층(220), 오버 코트층(230), 공통전극(240) 및 제2 배향막(250)을 포함한다.The color filter substrate 200 is coupled to face the array substrate 100. The color filter substrate 200 includes a second base substrate 210, a color filter layer 220, an overcoat layer 230, a common electrode 240, and a second alignment layer 250.

상기 제2 베이스 기판(210)은 상기 제1 베이스 기판(110)과 마주하고, 광을 투과시킬 수 있는 투명한 재질, 예컨대, 유리, 석영 등으로 이루어진다.The second base substrate 210 may be formed of a transparent material, for example, glass or quartz, which faces the first base substrate 110 and may transmit light.

상기 제2 베이스 기판(210)의 상면에는 상기 컬러필터 층(220)이 형성된다. 상기 컬러필터 층(220)은 광을 이용하여 소정의 색을 발현하는 색화소들(221) 및 각 색화소를 둘러싼 블랙 매트릭스(222)로 이루어진다. 상기 블랙 매트릭스(222)는 각 색화소로부터 누설되는 광을 차단하여 색 대비비를 향상시킨다.The color filter layer 220 is formed on an upper surface of the second base substrate 210. The color filter layer 220 includes color pixels 221 expressing a predetermined color by using light and a black matrix 222 surrounding each color pixel. The black matrix 222 blocks light leaking from each color pixel to improve color contrast ratio.

상기 오버 코트층(230)은 상기 컬러필터 층(220)의 상면에 형성되어 상기 컬러필터 기판(200)을 평탄화하고, 이에 따라, 상기 액정표시장치(700)는 균일한 셀갭을 유지할 수 있다.The overcoat layer 230 may be formed on the upper surface of the color filter layer 220 to planarize the color filter substrate 200, and thus the liquid crystal display 700 may maintain a uniform cell gap.

상기 공통 전극(240)은 상기 오버 코트층(230)의 상면에 형성되어 공통전압을 상기 액정층(300)에 제공한다. 상기 공통 전극(240)은 ITO, IZO와 같이 투명한 도전성 물질로 이루어진다.The common electrode 240 is formed on an upper surface of the overcoat layer 230 to provide a common voltage to the liquid crystal layer 300. The common electrode 240 is made of a transparent conductive material such as ITO and IZO.

상기 공통 전극(240)의 상면에는 상기 제2 배향막(250)이 형성된다. 상기 제2 배향막(250)의 상면에는 상기 각 액정 분자를 특정 방향으로 배향하기 위한 제2 러빙 패턴이 형성된다. 여기서, 상기 제2 러빙 패턴은 상기 제1 러빙 패턴과 서로 직교하는 방향으로 형성된다.The second alignment layer 250 is formed on an upper surface of the common electrode 240. A second rubbing pattern is formed on the top surface of the second alignment layer 250 to align the liquid crystal molecules in a specific direction. Here, the second rubbing pattern is formed in a direction perpendicular to the first rubbing pattern.

상기 어레이 기판(100) 및 상기 컬러필터 기판(200)은 두 기판(100, 200) 간의 결합 위치를 조정하기 위한 제1 내지 제4 얼라인부(AK1, AK2, AK3, AK4)를 구비한다.The array substrate 100 and the color filter substrate 200 include first to fourth alignment units AK1, AK2, AK3, and AK4 for adjusting a coupling position between the two substrates 100 and 200.

이 실시예에 있어서, 상기 액정표시장치(700)는 네 개의 얼라인부(AK1, AK2, AK3, AK4)를 구비하나 상기 얼라인부의 개수는 상기 액정표시장치(700)의 크기 및 구조에 따라 증가하거나 감소할 수 있다.In this embodiment, the liquid crystal display 700 includes four alignment parts AK1, AK2, AK3, and AK4, but the number of the alignment parts increases according to the size and structure of the liquid crystal display device 700. Can be reduced.

상기 제1 내지 제4 얼라인부(AK1, AK2, AK3, AK4)는 상기 주변 영역(PA)에 위치한다. 바람직하게는, 상기 제1 내지 제4 얼라인 부(AK1, AK2, AK3, AK4)는 각각 상기 컬러필터 기판(200)의 각 모서리에 인접하여 위치한다.The first to fourth alignment parts AK1, AK2, AK3, and AK4 are positioned in the peripheral area PA. Preferably, the first to fourth alignment units AK1, AK2, AK3, and AK4 are positioned adjacent to each corner of the color filter substrate 200, respectively.

이 실시예에 있어서, 상기 제1 내지 제4 얼라인부(AK1, AK2, AK3, AK4)는 서로 동일한 구조를 갖는다. 따라서, 이하, 상기 제1 내지 제4 얼라인부(AK1, AK2, AK3, AK4)의 구조에 대한 구체적인 설명에 있어서, 상기 제1 얼라인부(AK1)를 일례로 하여 설명한다.In this embodiment, the first to fourth alignment portions AK1, AK2, AK3, and AK4 have the same structure. Therefore, hereinafter, in the detailed description of the structures of the first to fourth alignment units AK1, AK2, AK3, and AK4, the first alignment unit AK1 will be described as an example.

도 3은 도 1의 'A'부분을 확대하여 나타낸 평면도이고, 도 4는 도 3의 절단선 Ⅱ-Ⅱ'에 따른 단면도이다.3 is an enlarged plan view of portion 'A' of FIG. 1, and FIG. 4 is a cross-sectional view taken along the line II-II 'of FIG. 3.

도 3 및 도 4를 참조하면, 상기 제1 얼라인부(AK1)는 상기 어레이 기판(100)에 형성된 제1 얼라인 키(180) 및 상기 컬러필터 기판(200)에 형성된 제2 얼라인 키(260)를 구비한다.3 and 4, the first alignment unit AK1 may include a first alignment key 180 formed on the array substrate 100 and a second alignment key formed on the color filter substrate 200. 260.

구체적으로, 상기 제1 얼라인 키(180)는 상기 제1 베이스 기판(110)의 상면에 형성되고, 광을 반사하는 금속 재질로 이루어진다. 상기 제1 얼라인 키(180)는 사각 형상을 갖고, 중앙부가 제거되어 개구부가 형성된다.In detail, the first alignment key 180 is formed on an upper surface of the first base substrate 110 and is made of a metal material that reflects light. The first alignment key 180 has a quadrangular shape, and a central portion thereof is removed to form an opening.

상기 제1 얼라인 키(180)의 상면에는 제1 보호 패드(190)가 형성된다. 상기 제1 보호 패드(190)는 상기 제1 얼라인 키(180)를 외부에서 인식할 수 있도록 ITO 또는 IZO와 같은 투명한 도전성 재질로 이루어진다.A first protective pad 190 is formed on the top surface of the first alignment key 180. The first protection pad 190 is made of a transparent conductive material such as ITO or IZO to recognize the first alignment key 180 from the outside.

상기 제1 보호 패드(190)는 상기 제1 배향막(170)(도 2 참조)에 상기 제1 러빙 패턴을 형성하는 과정에서 상기 제1 얼라인 키(180)의 주변부에 이물이 잔존하는 것을 방지한다.The first protection pad 190 prevents foreign matter from remaining on the periphery of the first alignment key 180 in the process of forming the first rubbing pattern on the first alignment layer 170 (see FIG. 2). do.

즉, 상기 제1 얼라인 키(180)와 상기 제1 얼라인 키(180)의 주변부 간의 단차로 인해 상기 제1 얼라인 키(180)의 주변부에 상기 이물이 잔존할 수 있다. 상기 제1 보호 패드(190)는 상기 제1 얼라인 키(180)의 상면 및 상기 제1 얼라인 키(180)의 주변부를 커버하여 상기 제1 얼라인 키(180)의 주변부에 상기 이물이 잔존하는 것을 방지한다. 이에 따라, 상기 어레이 기판(100)과 상기 컬러필터 기판(200)의 결합 위치를 조정하는 얼라인 먼트 장치(미도시)가 상기 제1 얼라인 키(180)의 형상을 정확하게 인식할 수 있으므로, 상기 어레이 기판(100)과 상기 컬러필터 기판(200)의 결합 불량을 방지할 수 있다.That is, the foreign matter may remain in the periphery of the first alignment key 180 due to the step between the first alignment key 180 and the peripheral portion of the first alignment key 180. The first protection pad 190 covers the upper surface of the first alignment key 180 and the periphery of the first alignment key 180 so that the foreign material is disposed on the periphery of the first alignment key 180. To prevent it from remaining. Accordingly, an alignment device (not shown) for adjusting the coupling position of the array substrate 100 and the color filter substrate 200 may accurately recognize the shape of the first alignment key 180. A poor coupling of the array substrate 100 and the color filter substrate 200 may be prevented.

여기서, 상기 제1 얼라인 키(180)의 상부에는 절연막, 예컨대, 상기 보호막(150) 또는 상기 유기 절연막(160) 등이 형성되지 않는다. 이러한 절연막은 상기 ITO나 상기 IZO와 같은 도전성 투명 전극보다 그 성질이 무르기 때문에, 상기 제1 얼라인 키(180)의 주변부에 상기 이물이 더 많이 남을 수 있다.In this case, an insulating layer, for example, the passivation layer 150 or the organic insulating layer 160, is not formed on the first alignment key 180. Since the insulating film is softer than a conductive transparent electrode such as the ITO or the IZO, more foreign matter may remain in the periphery of the first alignment key 180.

또한, 상기 제1 보호 패드(190)은 상기 제1 러빙 패턴을 형성하는 과정에서 상기 제1 얼라인 키(180)의 형상이 변형되는 것을 방지한다. 즉, 상기 제1 러빙 패턴을 형성하기 위한 러빙 장치(미도시)가 누르는 압력 때문에 상기 제1 얼라인 키(180)의 형상이 변형될 수 있다. 상기 제1 보호 패드(190)는 상기 러빙 장치가 누르는 압력을 흡수하여 상기 제1 얼라인 키(180)의 형상 변형을 방지한다.In addition, the first protective pad 190 prevents the shape of the first alignment key 180 from being deformed in the process of forming the first rubbing pattern. That is, the shape of the first alignment key 180 may be deformed due to the pressure pressed by the rubbing device (not shown) for forming the first rubbing pattern. The first protective pad 190 absorbs the pressure applied by the rubbing device to prevent deformation of the first alignment key 180.

한편, 상기 제2 얼라인 키(260)는 상기 제2 베이스 기판(210)의 상면에 형성되고, 상기 블랙 매트릭스(222)(도 2 참조)와 동일한 재질로 이루어진다. 상기 제2 얼라인 키(260)는 메인 키(261) 및 다수의 서브 키(262a, 262b, 262c, 262d)로 이루어진다.The second alignment key 260 is formed on the upper surface of the second base substrate 210 and is made of the same material as the black matrix 222 (see FIG. 2). The second alignment key 260 includes a main key 261 and a plurality of sub keys 262a, 262b, 262c, and 262d.

상기 메인 키(261)는 사각 형상을 갖고, 상기 제1 얼라인 키(180)의 개구부와 대응하는 영역에 위치한다. 따라서, 상기 제1 얼라인 키(180)는 상기 메인 키(261)의 주변부와 대응하는 영역에 위치한다. 상기 메인 키(261)의 크기는 상기 제1 얼라인 키(180)의 개구부보다 작게 형성된다.The main key 261 has a rectangular shape and is positioned in an area corresponding to the opening of the first alignment key 180. Therefore, the first alignment key 180 is located in an area corresponding to the periphery of the main key 261. The size of the main key 261 is smaller than the opening of the first alignment key 180.

상기 다수의 서브 키(262a, 262b, 262c, 262d)는 상기 제1 얼라인 키(180)의 주변부와 대응하는 영역에 위치하고, 각 서브 키(262a, 262b, 262c, 262d)는 상기 제1 얼라인 키(180)의 각 모서리와 대응하여 위치한다.The plurality of sub keys 262a, 262b, 262c, and 262d are located in an area corresponding to the periphery of the first align key 180, and each of the sub keys 262a, 262b, 262c, and 262d is the first key. In correspondence with each corner of the in key 180.

상기 어레이 기판(100)과 상기 컬러필터 기판(200) 결합 시, 상기 제1 얼라인 키(180)와 상기 제2 얼라인 키(260) 간의 위치 관계, 예컨대, 상기 컬러필터 기판(200)의 상측에서 상기 액정표시장치(700)를 봤을 때, 상기 제1 얼라인 키(180)와 상기 메인 키(261) 간의 거리를 조절하여 결합한다.When the array substrate 100 is coupled to the color filter substrate 200, a positional relationship between the first alignment key 180 and the second alignment key 260, for example, the color filter substrate 200 When the liquid crystal display 700 is viewed from above, the distance between the first align key 180 and the main key 261 is adjusted and combined.

상기 제2 얼라인 키(260)가 형성된 상기 제2 베이스 기판(210)의 상면에는 제2 보호 패드(270)가 형성된다. 상기 제2 보호 패드(270)는 상기 제2 얼라인 키(260)를 외부에서 인식할 수 있도록 ITO 또는 IZO와 같은 투명한 도전성 재질로 이루어진다.A second protective pad 270 is formed on an upper surface of the second base substrate 210 on which the second alignment key 260 is formed. The second protective pad 270 is made of a transparent conductive material such as ITO or IZO to externally recognize the second alignment key 260.

상기 제2 보호 패드(270)는 상기 제2 배향막(250)(도 2 참조)에 상기 제2 러빙 패턴을 형성하는 과정에서 상기 제2 얼라인 키(260)의 주변부에 이물이 잔존하는 것을 방지한다.The second protective pad 270 prevents foreign matter from remaining in the periphery of the second alignment key 260 in the process of forming the second rubbing pattern on the second alignment layer 250 (see FIG. 2). do.

즉, 상기 제2 얼라인 키(260)와 상기 제2 얼라인 키(260)의 주변부 간의 단차로 인해 상기 제2 얼라인 키(260)의 주변부에 상기 이물이 잔존할 수 있다. 상기 제2 보호 패드(270)는 상기 제2 얼라인 키(260)의 상면 및 상기 제2 얼라인 키(260)의 주변부를 커버하여 상기 제2 얼라인 키(260)의 주변부에 상기 이물이 잔존하는 것을 방지한다. 이에 따라, 상기 얼라인 먼트 장치가 상기 제2 얼라인 키(260)의 형상을 정확하게 인식할 수 있으므로, 상기 어레이 기판(100)과 상기 컬러필터 기판(200)의 결합 불량을 방지할 수 있다.That is, the foreign matter may remain in the periphery of the second alignment key 260 due to the step between the second alignment key 260 and the peripheral portion of the second alignment key 260. The second protection pad 270 covers the upper surface of the second alignment key 260 and the periphery of the second alignment key 260 so that the foreign material is surrounded by the periphery of the second alignment key 260. To prevent it from remaining. Accordingly, since the alignment device can accurately recognize the shape of the second alignment key 260, the coupling failure of the array substrate 100 and the color filter substrate 200 can be prevented.

또한, 상기 제2 보호 패드(270)는 상기 제2 러빙 패턴을 형성하는 과정에서 상기 제2 얼라인 키(260)의 형상이 변형되는 것을 방지한다. 즉, 상기 제2 러빙 패 턴을 형성하는 과정에서 상기 러빙 장치가 누르는 압력 때문에, 상기 제2 얼라인 키(260)의 형상이 변형될 수 있다. 상기 제2 보호 패드(270)는 상기 러빙 장치가 누르는 압력을 흡수하여 상기 제2 얼라인 키(260)의 형상 변형을 방지한다.In addition, the second protective pad 270 prevents the shape of the second alignment key 260 from being deformed in the process of forming the second rubbing pattern. That is, the shape of the second alignment key 260 may be deformed due to the pressure pressed by the rubbing device in the process of forming the second rubbing pattern. The second protective pad 270 absorbs the pressure applied by the rubbing device to prevent deformation of the second alignment key 260.

다시, 도 1 및 도 2를 참조하면, 상기 어레이 기판(100)과 상기 컬러필터 기판(200)과의 사이에는 상기 액정층(300)이 개재된다. 상기 액정층(300)은 상기 표시 영역(DA)에 위치하고, 상기 화소 전극(130)과 상기 공통 전극(240)과의 사이에 형성된 전계에 따라 광의 투과율을 조절한다. 상기 액정 분자들은 상기 제1 및 제2 배향막(170, 250)에 각각 형성된 상기 제1 및 제2 러빙 패턴에 따라 특정 방향으로 배향된다.1 and 2, the liquid crystal layer 300 is interposed between the array substrate 100 and the color filter substrate 200. The liquid crystal layer 300 is positioned in the display area DA and adjusts light transmittance according to an electric field formed between the pixel electrode 130 and the common electrode 240. The liquid crystal molecules are aligned in a specific direction according to the first and second rubbing patterns formed on the first and second alignment layers 170 and 250, respectively.

한편, 상기 어레이 기판(100)의 상기 주변 영역(PA)에는 상기 제1 및 제2 구동부(400, 500)가 실장된다.The first and second drivers 400 and 500 are mounted on the peripheral area PA of the array substrate 100.

상기 제1 구동부(400)는 상기 연성회로부(600)와 상기 다수의 데이터 라인(DL1, ..., DLm)과의 사이에서 상기 연성회로부(600) 및 상기 다수의 데이터 라인(DL1, ..., DLm)과 전기적으로 연결된다. 상기 제1 구동부(400)는 상기 연성회로부(600)로부터 상기 영상에 대응하는 영상 신호를 수신하고, 상기 데이터 신호를 상기 다수의 데이터 라인(DL1, ..., DLm)에 출력한다.The first driver 400 may include the flexible circuit unit 600 and the plurality of data lines DL1,... Between the flexible circuit unit 600 and the plurality of data lines DL1,..., DLm. , DLm) is electrically connected. The first driver 400 receives an image signal corresponding to the image from the flexible circuit unit 600, and outputs the data signal to the plurality of data lines DL1, DLm.

상기 제2 구동부(500)는 상기 다수의 게이트 라인(GL1, ..., GLn)와 전기적으로 연결되어 상기 게이트 신호를 상기 다수의 게이트 라인(GL1, ..., GLn)에 출력한다.The second driver 500 is electrically connected to the plurality of gate lines GL1,..., GLn to output the gate signals to the plurality of gate lines GL1,..., GLn.

이하, 도면을 참조하여서 상기 액정표시장치(700)를 제조하는 방법을 구체적 으로 설명한다.Hereinafter, a method of manufacturing the liquid crystal display device 700 will be described in detail with reference to the accompanying drawings.

도 5a 내지 도 5c는 도 1에 도시된 어레이 기판을 형성하는 과정을 나타낸 공정도이다.5A through 5C are process diagrams illustrating a process of forming the array substrate illustrated in FIG. 1.

도 5a를 참조하면, 상기 제1 베이스 기판(100)의 상면에 제1 금속층(미도시)을 증착한다. 이어, 상기 금속층을 패터닝하여 상기 표시 영역(DA)에 상기 게이트 전극(121)을 형성하고, 상기 주변 영역(PA)에 상기 제1 얼라인 키(180)를 형성한다. 도 5a에는 도시하지 않았으나, 상기 게이트 전극(121)을 형성하는 과정에서 상기 다수의 게이트 라인(GL1, ..., GLn)도 함께 형성된다.Referring to FIG. 5A, a first metal layer (not shown) is deposited on the upper surface of the first base substrate 100. Subsequently, the metal layer is patterned to form the gate electrode 121 in the display area DA, and the first alignment key 180 is formed in the peripheral area PA. Although not shown in FIG. 5A, the plurality of gate lines GL1,..., GLn are also formed in the process of forming the gate electrode 121.

이 실시예에 있어서, 상기 제1 얼라인 키(180)는 상기 게이트 전극(121)을 형성하는 공정과 동일한 공정으로 형성되고, 상기 게이트 전극(121)을 형성하는 과정에서 함께 형성된다. 그러나, 상기 제1 얼라인 키(180)는 상기 소오스 전극(124) 및 상기 드레인 전극(125)을 형성하는 공정과 동일한 공정을 통해 상기 소오스 전극(124) 및 상기 드레인 전극(125)을 형성하는 과정에서 함께 형성될 수도 있다.In this embodiment, the first alignment key 180 is formed in the same process as the process of forming the gate electrode 121 and is formed together in the process of forming the gate electrode 121. However, the first alignment key 180 may form the source electrode 124 and the drain electrode 125 through the same process as the process of forming the source electrode 124 and the drain electrode 125. It may be formed together in the process.

도 2, 도 5b 및 도 5c를 참조하면, 상기 게이트 전극(121) 및 상기 제1 얼라인 키(180)가 형성된 상기 제1 베이스 기판(110) 상에 상기 게이트 절연막(140), 상기 액티브 층(122), 상기 오믹 콘택층(123), 상기 소오스 전극(124), 상기 드레인 전극(125)을 형성하여 상기 TFT(120)를 완성한다. 상기 TFT(120)가 형성된 상기 제1 베이스 기판(110) 상에 상기 보호막(150) 및 상기 유기 절연막(160)을 순차적으로 형성한다.2, 5B and 5C, the gate insulating layer 140 and the active layer on the first base substrate 110 on which the gate electrode 121 and the first alignment key 180 are formed. The TFT 120 is completed by forming the ohmic contact layer 123, the source electrode 124, and the drain electrode 125. The passivation layer 150 and the organic insulating layer 160 are sequentially formed on the first base substrate 110 on which the TFT 120 is formed.

상기 게이트 절연막(140), 상기 보호막(150) 및 상기 유기 절연막(160)은 상 기 제1 얼라인 키(180)가 형성된 영역에서 제거된다.The gate insulating layer 140, the passivation layer 150, and the organic insulating layer 160 are removed in a region where the first alignment key 180 is formed.

상기 유기 절연막(160)이 형성된 상기 제1 베이스 기판(110)의 상부에는 도전성 물질로 이루어진 제1 투명 도전층(EL1)을 증착한다. 상기 제1 투명 도전층(EL1)은 상기 제1 베이스 기판(110)의 전 영역에 형성된다.A first transparent conductive layer EL1 made of a conductive material is deposited on the first base substrate 110 on which the organic insulating layer 160 is formed. The first transparent conductive layer EL1 is formed on the entire area of the first base substrate 110.

도 5c에 도시된 바와 같이, 상기 제1 투명 도전층(EL1)을 패터닝하여 상기 화소 전극(130) 및 상기 제1 보호 패드(190)를 형성한다.As illustrated in FIG. 5C, the first transparent conductive layer EL1 is patterned to form the pixel electrode 130 and the first protective pad 190.

도 2에 도시된 바와 같이, 상기 화소 전극(130) 및 상기 제1 투면 전극(190)이 형성된 상기 제1 베이스 기판(110)의 상부에 상기 제1 배향막(170)을 증착하고, 상기 제1 배향막(170)의 상면에 상기 제1 러빙 패턴을 형성한다. 이로써, 상기 어레이 기판(100)이 완성된다.As illustrated in FIG. 2, the first alignment layer 170 is deposited on the first base substrate 110 on which the pixel electrode 130 and the first projection electrode 190 are formed. The first rubbing pattern is formed on the top surface of the alignment layer 170. As a result, the array substrate 100 is completed.

도 6a 내지 도 6c는 도 1에 도시된 컬러필터 기판을 형성하는 과정을 나타낸 공정도이다.6A through 6C are process diagrams illustrating a process of forming the color filter substrate illustrated in FIG. 1.

도 6a를 참조하면, 상기 제2 베이스 기판(210)의 상면에 제2 금속층(미도시)을 증착한다. 상기 제2 금속층을 패터닝하여 상기 블랙 매트릭스(222) 및 상기 제2 얼라인 키(260)를 형성한다. 이 실시예에 있어서, 상기 블랙 매트릭스(222) 및 상기 제2 얼라인 키(260)는 금속 재질로 이루어지나, 유기 물질로 이루어질 수도 잇다.Referring to FIG. 6A, a second metal layer (not shown) is deposited on the top surface of the second base substrate 210. The black metal layer 222 and the second alignment key 260 are formed by patterning the second metal layer. In this embodiment, the black matrix 222 and the second alignment key 260 is made of a metal material, but may be made of an organic material.

도 6b를 참조하면, 상기 블랙 매트릭스(222) 및 상기 제2 얼라인 키(260)가 형성된 상기 제2 베이스 기판(210)의 상부에 상기 색화소들(221)을 형성한다. 이어, 상기 컬러필터 층(220)의 상면에 오버 코트층(230)을 형성한다.Referring to FIG. 6B, the color pixels 221 are formed on the second base substrate 210 on which the black matrix 222 and the second alignment key 260 are formed. Subsequently, an overcoat layer 230 is formed on the top surface of the color filter layer 220.

도 2 및 도 6c를 참조하면, 상기 오버 코트층(230)의 상부에 제2 투명 도전층을 형성하여 상기 공통 전극(240) 및 상기 제2 보호 패드(270)를 형성한다.2 and 6C, a second transparent conductive layer is formed on the overcoat layer 230 to form the common electrode 240 and the second protective pad 270.

이 실시예에 있어서, 상기 제2 보호 패드(270)는 상기 공통 전극(240)과 일체로 형성되나, 상기 제2 보호 패드(270)는 상기 공통 전극(240)과 분리되어 형성될 수도 있다.In this embodiment, the second protection pad 270 is integrally formed with the common electrode 240, but the second protection pad 270 may be formed separately from the common electrode 240.

도 2에 도시된 바와 같이, 상기 공통 전극(240) 및 상기 제2 보호 패드(270)가 형성된 상기 제2 베이스 기판(210)의 상부에 상기 제2 배향막(250)을 증착하고, 상기 제2 배향막(250)의 상면에 상기 제2 러빙 패턴을 형성한다. 이로써, 상기 컬러필터 기판(200)이 완성된다.As illustrated in FIG. 2, the second alignment layer 250 is deposited on the second base substrate 210 on which the common electrode 240 and the second protection pad 270 are formed. The second rubbing pattern is formed on the top surface of the alignment layer 250. Thus, the color filter substrate 200 is completed.

도 5a 내지 도 5c에 도시된 공정 과정을 통해 형성된 상기 어레이 기판(100)과 상기 도 6a 내지 도 6c에 도시된 공정 과정을 통해 형성된 상기 컬러필터 기판(200)을 결합하고, 상기 어레이 기판(100)과 상기 컬러필터 기판(200)과의 사이에 상기 액정층(300)을 주입하여 상기 액정표시장치(700)를 완성한다.The array substrate 100 formed through the process illustrated in FIGS. 5A to 5C and the color filter substrate 200 formed through the process illustrated in FIGS. 6A to 6C are combined to form the array substrate 100. ) And the color filter substrate 300 are injected between the color filter substrate 200 to complete the liquid crystal display device 700.

상술한 본 발명에 따르면, 액정표시장치는 어레이 기판과 컬러필터 기판의 결합 위치를 조정하는 제1 및 제2 얼라인 키를 각각 커버하는 제1 및 제2 보호 패드를 구비한다. 이에 따라, 액정표시장치는 각 얼라인 키와 각 얼라인 키의 주변부와의 단차 때문에, 러빙 패턴을 형성하는 과정에서 발생된 이물이 각 얼라인 키의 주변부에 잔존하는 것을 방지한다. 또한, 제1 및 제2 보호 패드는 러빙 장치가 누르는 압력을 흡수하여 제1 및 제2 얼라인 키의 형상이 러빙 장치에 의해 변형되는 것을 방지할 수 있다.According to the present invention described above, the liquid crystal display device includes first and second protective pads respectively covering first and second alignment keys for adjusting the coupling position of the array substrate and the color filter substrate. Accordingly, the liquid crystal display prevents foreign substances generated in the process of forming the rubbing pattern from remaining at the periphery of each alignment key because of the step difference between each alignment key and the peripheral portion of each alignment key. Further, the first and second protective pads can absorb the pressure that the rubbing device presses to prevent the shape of the first and second alignment keys from being deformed by the rubbing device.

이에 따라, 얼라인 먼트 장치가 제1 및 제2 얼라인 키를 정확하게 인식할 수 있으므로, 어레이 기판과 컬러필터 기판의 결합 위치를 정확하게 설정할 수 있다. 따라서, 액정표시장치는 어레이 기판과 컬러필터 기판의 결합 불량을 방지할 수 있으므로, 제품의 수율을 향상시킬 수 있다.Accordingly, since the alignment device can accurately recognize the first and second alignment keys, the alignment position of the array substrate and the color filter substrate can be accurately set. Therefore, the liquid crystal display device can prevent the coupling failure between the array substrate and the color filter substrate, thereby improving the yield of the product.

이상 실시예를 참조하여 설명하였지만, 해당 기술 분야의 숙련된 당업자는 하기의 특허 청구의 범위에 기재된 본 발명의 사상 및 영역으로부터 벗어나지 않는 범위 내에서 본 발명을 다양하게 수정 및 변경시킬 수 있음을 이해할 수 있을 것이다.Although described with reference to the embodiments above, those skilled in the art will understand that the present invention can be variously modified and changed without departing from the spirit and scope of the invention as set forth in the claims below. Could be.

Claims (9)

영상이 표시되는 표시 영역 및 상기 표시 영역을 둘러싼 주변 영역으로 구획된 제1 베이스 기판, 상기 표시 영역에 형성되어 상기 영상을 표시하는 화소부, 상기 주변 영역에 형성된 적어도 하나의 제1 얼라인 키, 및 상기 제1 얼라인 키의 상면 및 상기 제1 얼라인 키의 주변부를 커버하는 제1 보호 패드을 구비하는 어레이 기판;A first base substrate partitioned into a display area in which an image is displayed and a peripheral area surrounding the display area, a pixel portion formed in the display area to display the image, at least one first alignment key formed in the peripheral area, And a first protective pad covering an upper surface of the first alignment key and a periphery of the first alignment key. 상기 제1 베이스 기판과 마주하여 결합하는 제2 베이스 기판, 상기 제2 베이스 기판상에 형성된 공통 전극, 및 상기 제1 얼라인 키와 대응하게 상기 제2 베이스 기판상에 형성되고, 상기 제1 베이스 기판과 상기 제2 베이스 기판의 결합시에 상기 제1 얼라인 키와 정렬되는 적어도 하나의 제2 얼라인 키를 구비하는 대향 기판; 및A second base substrate facing the first base substrate and coupled to the first base substrate, a common electrode formed on the second base substrate, and formed on the second base substrate so as to correspond to the first alignment key; An opposing substrate having at least one second alignment key aligned with the first alignment key upon joining of the substrate and the second base substrate; And 상기 어레이 기판과 상기 대향 기판과의 사이에 개재되어 광의 투과율을 조절하는 액정층을 포함하는 것을 특징으로 하는 액정표시장치.And a liquid crystal layer interposed between the array substrate and the opposing substrate to control light transmittance. 제1항에 있어서, 상기 화소부는,The method of claim 1, wherein the pixel unit, 상기 영상에 대응하는 화소 전압을 출력하는 스위칭 소자; 및A switching element configured to output a pixel voltage corresponding to the image; And 상기 스위칭 소자와 전기적으로 연결되고, 상기 화소 전압을 상기 액정층에 제공하는 화소 전극을 포함하는 것을 특징으로 하는 액정표시장치.And a pixel electrode electrically connected to the switching element and providing the pixel voltage to the liquid crystal layer. 제2항에 있어서, 상기 제1 보호 패드는 상기 화소 전극과 동일한 재질로 이루어진 것을 특징으로 하는 액정표시장치.The liquid crystal display of claim 2, wherein the first protective pad is made of the same material as the pixel electrode. 제1항에 있어서,The method of claim 1, 상기 어레이 기판은, 상기 화소부, 상기 제1 얼라인 키 및 상기 제1 보호 패드가 형성된 상기 제1 베이스 기판 상에 형성되고, 상면에 상기 액정층의 액정 분자를 배향하는 제1 러빙 패턴이 형성된 제1 배향막을 더 포함하고,The array substrate may be formed on the first base substrate on which the pixel portion, the first alignment key, and the first protective pad are formed, and a first rubbing pattern may be formed on the upper surface thereof to orient the liquid crystal molecules of the liquid crystal layer. Further comprising a first alignment layer, 상기 대향 기판은, 상기 공통 전극의 상부에 형성되고, 상면에 상기 액정층의 액정 분자를 배향하는 제2 러빙 패턴이 형성된 제2 배향막을 더 포함하는 것을 특징으로 하는 액정표시장치.The counter substrate further includes a second alignment layer formed on the common electrode and having a second rubbing pattern formed on the upper surface thereof to orient the liquid crystal molecules of the liquid crystal layer. 제4항에 있어서, 상기 대향 기판은,The method of claim 4, wherein the opposing substrate, 상기 제2 얼라인 키의 상면 및 상기 제2 얼라인 키의 주변부를 커버하는 제2 보호 패드를 더 포함하는 것을 특징으로 하는 액정표시장치.And a second protection pad covering an upper surface of the second alignment key and a periphery of the second alignment key. 제5항에 있어서, 상기 제2 보호 패드는 상기 공통 전극과 동일한 재질로 이루어진 것을 특징으로 하는 액정표시장치.The liquid crystal display of claim 5, wherein the second protection pad is made of the same material as the common electrode. 제6항에 있어서, 상기 제2 보호 패드는 상기 공통 전극과 일체로 형성된 것을 특징으로 하는 액정표시장치.The liquid crystal display of claim 6, wherein the second protective pad is formed integrally with the common electrode. 어레이 기판을 제조하는 단계; 및Manufacturing an array substrate; And 상기 어레이 기판과 결합하여 영상을 표시하는 대향 기판을 제조하는 단계를 포함하고,Manufacturing an opposing substrate in combination with the array substrate to display an image; 상기 어레이 기판을 제조하는 단계는,Manufacturing the array substrate, 제1 베이스 기판상에 적어도 하나의 스위칭 소자 및 적어도 하나의 제1 얼라인 키를 형성하는 단계;Forming at least one switching element and at least one first alignment key on the first base substrate; 상기 스위칭 소자 및 상기 제1 얼라인 키가 형성된 상기 제1 베이스 기판 상에 제1 투명 도전층을 형성하는 단계;Forming a first transparent conductive layer on the first base substrate on which the switching element and the first alignment key are formed; 상기 제1 투명 도전층을 패터닝하여 상기 제1 얼라인 키의 상면 및 상기 제1 얼라인 키의 주변에 제1 보호 패드를 형성하고, 상기 스위칭 소자와 전기적으로 연결된 화소 전극을 형성하는 단계;Patterning the first transparent conductive layer to form a first protection pad on an upper surface of the first alignment key and around the first alignment key, and forming a pixel electrode electrically connected to the switching element; 상기 제1 보호 패드 및 상기 스위칭 소자가 형성된 상기 제1 베이스 기판의 상부에 제1 배향막을 형성하는 단계; 및Forming a first alignment layer on the first base substrate on which the first protection pad and the switching element are formed; And 상기 제1 배향막을 러빙하여 상기 제1 배향막의 상면에 제1 러빙 패턴을 형성하는 단계를 포함하는 것을 특징으로 하는 액정표시장치 제조 방법.And rubbing the first alignment layer to form a first rubbing pattern on an upper surface of the first alignment layer. 제8항에 있어서, 상기 대향 기판을 제조하는 단계는,The method of claim 8, wherein the manufacturing of the opposing substrate comprises: 제2 베이스 기판에 상기 제1 얼라인 키와 대응하는 적어도 하나의 제2 얼라인 키를 형성하는 단계;Forming at least one second alignment key corresponding to the first alignment key on a second base substrate; 상기 제2 얼라인 키가 형성된 상기 제2 베이스 기판의 상부에 제2 투명 도전층을 형성하여 상기 제2 얼라인 키의 상면과 상기 제2 얼라인 키의 주변부를 커버하는 제2 보호 패드 및 공통 전극을 형성하는 단계;A second protective pad covering the upper surface of the second alignment key and a periphery of the second alignment key by forming a second transparent conductive layer on the second base substrate on which the second alignment key is formed; Forming an electrode; 상기 제2 보호 패드 및 상기 공통 전극이 형성된 상기 제2 베이스 기판의 상부에 제2 배향막을 형성하는 단계;Forming a second alignment layer on the second base substrate on which the second protection pad and the common electrode are formed; 상기 제2 배향막을 러빙하여 상기 제2 배향막의 상면에 제2 러빙 패턴을 형성하는 단계;Rubbing the second alignment layer to form a second rubbing pattern on an upper surface of the second alignment layer; 상기 제1 얼라인 키와 상기 제2 얼라인 키를 정렬하여 상기 제1 베이스 기판과 상기 제2 베이스 기판을 결합하는 단계; 및Coupling the first base substrate and the second base substrate by aligning the first alignment key and the second alignment key; And 상기 제1 베이스 기판과 상기 제2 베이스 기판과의 사이에 액정층을 형성하는 단계를 포함하는 것을 특징으로 하는 액정표시장치 제조 방법.And forming a liquid crystal layer between the first base substrate and the second base substrate.
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