KR20080049346A - Liquid crystal display panel - Google Patents

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엘지디스플레이 주식회사
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Abstract

An LCD panel is provided to achieve equipotential of upper and lower array substrates, thereby removing a transparent electrode pattern forming process performed on the upper array substrate. An LCD(Liquid Crystal Display) panel comprises upper and lower array substrates(170,180) and at least one of a silver dot(145) and a conductive sealant. In the upper array substrate, a conductive black matrix(104) is formed in a non-display area(P2). In the lower array substrate, a conductive line is formed in an area corresponding to the conductive black matrix. At least one of the silver dot and the conductive sealant electrically connects the conductive black matrix with the conductive line. The conductive line is connected to the ground of an external driving unit.

Description

액정표시패널{Liquid Crystal Display Panel}Liquid Crystal Display Panel

도 1는 종래 IPS 액정표시패널을 나타내는 단면도. 1 is a cross-sectional view showing a conventional IPS liquid crystal display panel.

도 2는 본 발명의 제1 실시예에 따른 IPS 액정표시패널을 나타내는 단면도. 2 is a cross-sectional view showing an IPS liquid crystal display panel according to a first embodiment of the present invention.

도 3은 본 발명의 제2 실시예에 따른 IPS 액정표시패널을 나타내는 평면도. 3 is a plan view illustrating an IPS liquid crystal display panel according to a second exemplary embodiment of the present invention.

도 4는 도 3에서 Ⅰ-Ⅰ'선을 절취하여 도시한 단면도. 4 is a cross-sectional view taken along the line II ′ of FIG. 3.

<도면의 주요 부분에 대한 부호의 설명>         <Explanation of symbols for the main parts of the drawings>

2,102:상부기판 4,104:블랙 매트릭스2,102: upper substrate 4,104: black matrix

3 : 투명전극 패턴 18,118:공통전극 3: transparent electrode pattern 18,118: common electrode

32,132:하부기판 6,106:컬러필터 32,132: lower substrate 6,106: color filter

7,107: 오버코트층 145 : 은도트 7,107: overcoat layer 145: silver dot

13,113:스페이서 70,170 : 상부 어레이 기판 13,113: spacer 70,170: upper array substrate

80,180 : 하부 어레이 기판 155 : 도전성 실런트80,180: lower array substrate 155: conductive sealant

156 : 접촉홀 154 : 도전볼 156: contact hole 154: conductive ball

본 발명은 액정표시패널에 관한 것으로, 특히 구조를 단순화하고 비용을 절감하며 박형화할 수 있는 액정표시패널에 관한 것이다. BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a liquid crystal display panel, and more particularly, to a liquid crystal display panel which can simplify the structure, reduce the cost, and reduce the thickness.

통상적으로, 액정표시장치(Liquid Crystal Display; LCD)는 비디오신호에 따라 액정셀들의 광투과율을 조절함으로써 액정셀들이 매트릭스 형태로 배열되어진 액정표시패널에 비디오신호에 해당하는 화상을 표시하게 된다. 이를 위하여, 액정표시장치는 액정셀들이 액티브 매트릭스(Active Matrix) 형태로 배열된 액정표시패널과, 액정표시패널을 구동하기 위한 구동회로들을 포함하게 된다. In general, a liquid crystal display (LCD) displays an image corresponding to a video signal on a liquid crystal display panel in which liquid crystal cells are arranged in a matrix form by adjusting light transmittance of liquid crystal cells according to a video signal. To this end, the liquid crystal display device includes a liquid crystal display panel in which liquid crystal cells are arranged in an active matrix form, and driving circuits for driving the liquid crystal display panel.

이러한 액정표시장치는 액정을 구동시키는 전계방향에 따라 수직방향 전계를 용하는 TN(Twisted Nematic)모드와 IPS(In plan Switch)모드로 대별된다.Such liquid crystal displays are roughly classified into twisted nematic (TN) mode and in plan switch (IPS) mode using a vertical electric field according to the electric field driving the liquid crystal.

TN모드는 상부기판에 대항하게 배치된 화소전극과 공통전극간의 수직전계에 의해 액정을 구동하는 모드로 개구율이 큰 장점을 가지는 반면에 시야각이 접은 단점을 가진다. IPS모드는 하부기판상에 나란하게 배치된 화소전극, 공통전극간의 수평전계에 의해 액정을 구동하는 모드로 시야각이 큰 장점이 있는 반면에 개구율이 작은 단점이 있다. The TN mode is a mode in which a liquid crystal is driven by a vertical electric field between a pixel electrode and a common electrode arranged to face the upper substrate. The TN mode has an advantage that the aperture ratio is large while the viewing angle is folded. The IPS mode is a mode in which a liquid crystal is driven by a horizontal electric field between a pixel electrode and a common electrode arranged side by side on a lower substrate, and has a large viewing angle, but a small aperture ratio.

도 1은 종래 IPS모드의 액정표시패널을 나타내는 단면도이다. 1 is a cross-sectional view showing a liquid crystal display panel of a conventional IPS mode.

도 1을 참조하면, IPS모드의 액정표시패널(90)은 상부기판(2) 상에 순차적으로 형성된 블랙 매트릭스(4), 컬러필터(6), 평탄화층(7), 스페이서(13), 상부 배향막(8)으로 구성되는 상부 어레이 기판(또는 컬러필터 어레이 기판)(70)과, 하부기판(32)상에 형성된 박막 트랜지스터(이하"TFT" 라고 한다)(15), 공통전극(18), 화 소전극(16) 및 하부 배향막(38)으로 구성되는 하부 어레이 기판(또는 박막 트랜지스터 어레이 기판)(80)과, 상부 어레이 기판(70) 및 하부 어레이 기판(80) 사이의 내부공간에 주입되는 액정(51)을 구비한다. Referring to FIG. 1, the liquid crystal display panel 90 in the IPS mode includes a black matrix 4, a color filter 6, a planarization layer 7, a spacer 13, and an upper part sequentially formed on the upper substrate 2. An upper array substrate (or color filter array substrate) 70 composed of an alignment layer 8, a thin film transistor (hereinafter referred to as " TFT ") 15 formed on the lower substrate 32, a common electrode 18, Implanted into an inner space between the lower array substrate (or thin film transistor array substrate) 80 formed of the pixel electrode 16 and the lower alignment layer 38 and the upper array substrate 70 and the lower array substrate 80. The liquid crystal 51 is provided.

상부 어레이 기판(70)에 있어서, 블랙 매트릭스(4)는 하부기판(2)의 TFT(15) 영역과 도시하지 않은 게이트라인들 및 데이터라인들 영역과 중첩되게 형성되며 컬러필터(6)가 형성될 셀영역을 구획한다. 블랙 매트릭스(4)는 빛샘을 방지함과 아울러 외부광을 흡수하여 콘트라스트를 높이는 역할을 한다. 컬러필터(6)는 상기 블랙 매트릭스(4)에 의해 분리된 셀영역에 형성된다. 이 컬러필터(6)는 R,G,B 별로 형성되어 R, G, B 색상을 구현한다. 오버코트층(7)은 컬러필터(6)를 덮도록 형성되어 상부기판(2)을 평탄화한다. 스페이서(13)는 상부기판(2)과 하부기판(32)사이에 셀 갭을 유지하는 역할을 한다. In the upper array substrate 70, the black matrix 4 is formed to overlap the TFT 15 region of the lower substrate 2 and the region of gate lines and data lines not shown, and the color filter 6 is formed. Partition the cell area to be used. The black matrix 4 prevents light leakage and absorbs external light to increase contrast. The color filter 6 is formed in the cell region separated by the black matrix 4. The color filter 6 is formed for each of R, G, and B to implement R, G, and B colors. The overcoat layer 7 is formed to cover the color filter 6 to planarize the upper substrate 2. The spacer 13 serves to maintain a cell gap between the upper substrate 2 and the lower substrate 32.

하부 어레이 기판(80)에 있어서, TFT(15)는 게이트라인(도시하지 않음)과 함께 하부기판(32)위에 형성되는 게이트전극(9)과, 이 게이트전극(9)과 게이트 절연막(44)을 사이에 두고 중첩되는 반도체층(14,47)과, 반도체층(14,47)을 사이에 두고 데이터라인(도시하지 않음)과 함께 형성되는 소스/드레인전극(40,42)을 구비한다. 이러한 TFT(15)는 게이트라인으로 부터의 스캔신호에 응답하여 데이터라인으로부터 화소신호를 화소전극(16)에 공급한다. 화소전극(16)은 광투과율이 높은 투명전도성 물질로 보호막(50)을 사이에 두고 TFT(15)의 드레인 전극(42)과 접촉된다. 공통전극(18)은 화소전극(16)과 교번되도록 스트라입형태로 형성된다. 공통전극(18)은 액정구동시 기준이 되는 공통전압을 공급한다. 이 공통전압과 화소전 극(16)에 공급되는 화소전압과의 수평전계에 의해 액정은 수평방향을 기준으로 회전하게 된다.In the lower array substrate 80, the TFT 15 includes a gate electrode 9 formed on the lower substrate 32 together with a gate line (not shown), the gate electrode 9 and the gate insulating film 44. Semiconductor layers 14 and 47 overlapping each other, and source / drain electrodes 40 and 42 formed together with data lines (not shown) with semiconductor layers 14 and 47 interposed therebetween. The TFT 15 supplies the pixel signal from the data line to the pixel electrode 16 in response to the scan signal from the gate line. The pixel electrode 16 is a transparent conductive material having a high light transmittance and is in contact with the drain electrode 42 of the TFT 15 with the protective film 50 interposed therebetween. The common electrode 18 is formed in a stripe shape so as to alternate with the pixel electrode 16. The common electrode 18 supplies a common voltage which is a reference when driving the liquid crystal. The liquid crystal rotates with respect to the horizontal direction by the horizontal electric field between the common voltage and the pixel voltage supplied to the pixel electrode 16.

액정배향을 위한 상/하부 배향막(8,38)은 폴리이미드 등과 같은 배향물질을 도포한 후 러빙공정을 수행함으로써 형성된다. The upper and lower alignment layers 8 and 38 for liquid crystal alignment are formed by applying an alignment material such as polyimide and then performing a rubbing process.

한편, TN 모드의 액정표시패널은 상부 어레이 기판과 하부 어레이 기판 간의 수직전계에 의해 액정이 구동됨으로써 상부 어레이 기판과 하부 어레이 기판간의 등전위 루프 형성이 가능하게 됨으로써 정전기의 발생 정도가 IPS 모드에 비하여 훨씬 작고 정전기의 배출 또한 용이하다. 이에 비하여, IPS 모드의 액정표시패널(90)은 수평전계에 의해 액정(51)을 구동시킴으로써 상부 어레이 기판(70)과 하부 어레이 기판(80)이 각각 전기적으로 고립됨으로써 정전기의 발생량이 상대적으로 많으며 배출 또한 용이하지 않다. On the other hand, in the TN mode liquid crystal display panel, the liquid crystal is driven by the vertical electric field between the upper array substrate and the lower array substrate, so that an equipotential loop can be formed between the upper array substrate and the lower array substrate. Small and easy discharge of static electricity. On the other hand, the liquid crystal display panel 90 in the IPS mode is driven by the liquid crystal 51 by a horizontal electric field so that the upper array substrate 70 and the lower array substrate 80 are electrically isolated from each other, and thus the amount of static electricity generated is relatively high. Emissions are also not easy.

이러한, 정전기 발생에 대한 문제를 해결하기 위하여 상부 어레이 기판(70)의 배면에 투명전극 패턴(3)을 형성하여 정전기를 회부로 배출시킨다. In order to solve the problem of static electricity generation, the transparent electrode pattern 3 is formed on the rear surface of the upper array substrate 70 to discharge static electricity to the outside.

그러나, 이러한 종래의 액정표시패널(90)은 투명전극 패턴(3)을 형성함으로서 공정 및 비용이 증가되는 단점이 있고 투명전극 패턴(3)이 형성되는 만큼 액정표시패널을 박형화할 수 없는 단점이 있다. However, the conventional liquid crystal display panel 90 has a disadvantage in that the process and cost are increased by forming the transparent electrode pattern 3, and the liquid crystal display panel cannot be thinned as the transparent electrode pattern 3 is formed. have.

따라서, 본 발명의 목적은 구조를 단순화하고 비용을 절감하며 박형화할 수 있는 액정표시패널 및 그 제조방법을 제공하는 데 있다. Accordingly, an object of the present invention is to provide a liquid crystal display panel and a method of manufacturing the same, which can simplify the structure, reduce the cost, and reduce the thickness.

상기 목적을 달성하기 위하여, 본 발명의 실시예에 따른 액정표시패널은 비표시영역에 도전성 블랙 매트릭스가 형성된 상부 어레이 기판과; 상기 도전성 블랙 매트릭스와 대응되는 영역에 도전성 배선이 형성된 하부 어레이 기판과; 상기 도전성 블랙 매트릭스와 도전성 배선을 전기적으로 연결시키는 은도트 및 도전성 실런트 중 적어도 어느 하나를 구비하는 것을 특징으로 한다. In order to achieve the above object, a liquid crystal display panel according to an embodiment of the present invention includes an upper array substrate formed with a conductive black matrix in a non-display area; A lower array substrate having conductive lines formed in a region corresponding to the conductive black matrix; And at least one of a silver dot and a conductive sealant for electrically connecting the conductive black matrix and the conductive wiring.

여기서, 본 발명에 도전성 배선은 외부 구동부의 그라운드와 연결되는 것을 특징으로 한다.Here, in the present invention, the conductive wiring is connected to the ground of the external driving unit.

본 발명에 따른 하부 어레이 기판은, 서로 교차되게 형성되는 신호라인들과; The lower array substrate according to the present invention comprises: signal lines formed to cross each other;

상기 신호라인의 교차영역에 위치하는 박막 트랜지스터와; 상기 박막 트랜지스터와 접속된 화소전극과; 상기 화소전극과 수평전계를 이루는 공통전극을 구비하는 것을 특징으로 한다.A thin film transistor positioned at an intersection area of the signal line; A pixel electrode connected to the thin film transistor; And a common electrode forming a horizontal electric field with the pixel electrode.

본 발명에 따른 도전성 배선은 상기 공통전극과 연결된 것을 특징으로 한다.The conductive wire according to the present invention is characterized in that it is connected to the common electrode.

본 발명에 따른 하부 어레이 기판의 비표시영역에는 게이트 절연막 및 보호막이 더 형성되고, 상기 도전성 실런트는 상기 게이트 절연막 및 보호막을 관통하여 상기 도전성 배선을 노출시키는 접촉홀을 통해 상기 도전성 배선과 접촉되는 것을 특징으로 한다.A gate insulating film and a protective film are further formed in the non-display area of the lower array substrate according to the present invention, and the conductive sealant contacts the conductive wire through a contact hole through the gate insulating film and the protective film to expose the conductive wire. It features.

본 발명에 따른 블랙 매트릭스는 크롬을 포함하는 것을 특징으로 한다. The black matrix according to the invention is characterized in that it comprises chromium.

본 발명에 따른 도전성 실런트는 도전볼들을 포함하는 것을 특징으로 한다.The conductive sealant according to the present invention is characterized by including conductive balls.

상기 목적 외에 본 발명의 다른 목적 및 특징들은 첨부도면을 참조한 실시예에 대한 설명을 통하여 명백하게 드러나게 될 것이다. Other objects and features of the present invention in addition to the above objects will become apparent from the description of the embodiments with reference to the accompanying drawings.

이하, 도 2 내지 도 3을 참조하여 본 발명의 바람직한 실시 예에 대하여 설명하기로 한다. Hereinafter, exemplary embodiments of the present invention will be described with reference to FIGS. 2 to 3.

도 2는 본 발명의 제1 실시예에 따른 IPS모드의 액정표시패널을 개략적으로 나타내는 도면이다. 2 is a view schematically showing a liquid crystal display panel in an IPS mode according to a first embodiment of the present invention.

본 발명에 따른 IPS모드의 액정표시패널은 화상이 구현되는 표시영역(P1) 및 표시영역(P1)을 제외하는 비표시영역(P2)으로 구분된다.The liquid crystal display panel of the IPS mode according to the present invention is divided into a display area P1 where an image is implemented and a non-display area P2 excluding the display area P1.

표시영역(P1)은 종래 도 1에 도시된 구조와 실질적으로 동일한 구조를 가진다. 즉, 상부기판(102) 상에 순차적으로 형성된 블랙 매트릭스(104), 컬러필터(106), 오버코트층(107), 스페이서(113), 상부 배향막(108)으로 구성되는 상부 어레이 기판(또는 컬러필터 어레이 기판)(170)과, 하부기판(132)상에 형성된 TFT(115), 공통전극(118), 화소전극(116) 및 하부 배향막(138)으로 구성되는 하부 어레이 기판(또는 박막 트랜지스터 어레이 기판)(180)과, 상부 어레이 기판(170) 및 하부 어레이 기판(180) 사이의 내부공간에 주입되는 액정(도시되지 않음)을 구비한다. The display area P1 has a structure substantially the same as that shown in FIG. 1. That is, an upper array substrate (or color filter) including a black matrix 104, a color filter 106, an overcoat layer 107, a spacer 113, and an upper alignment layer 108 sequentially formed on the upper substrate 102. Array substrate) 170, a lower array substrate (or thin film transistor array substrate) composed of a TFT 115, a common electrode 118, a pixel electrode 116, and a lower alignment layer 138 formed on the lower substrate 132; ) 180 and a liquid crystal (not shown) injected into an inner space between the upper array substrate 170 and the lower array substrate 180.

상부 어레이 기판(170)에 있어서, 블랙 매트릭스(14)는 하부기판(102)의 TFT(115) 영역과 도시하지 않은 게이트라인들 및 데이터라인들 영역과 중첩되게 형성되며 컬러필터(106)가 형성될 셀영역을 구획한다. 블랙 매트릭스(104)는 빛샘을 방지함과 아울러 외부광을 흡수하여 콘트라스트를 높이는 역할을 한다. 여기서 블 랙 매트릭스(104)는 크롬(Cr) 등의 금속물질로 형성된다. 이에 따라, 블랙 매트릭스(104)는 도전성을 가지게 된다.In the upper array substrate 170, the black matrix 14 is formed to overlap the TFT 115 region of the lower substrate 102 and the gate line and data line regions (not shown) and the color filter 106 is formed. Partition the cell area to be used. The black matrix 104 prevents light leakage and absorbs external light to increase contrast. The black matrix 104 is formed of a metal material such as chromium (Cr). As a result, the black matrix 104 becomes conductive.

컬러필터(106)는 상기 블랙 매트릭스(104)에 의해 분리된 셀영역에 형성된다. 이 컬러필터(106)는 R,G,B 별로 형성되어 R, G, B 색상을 구현한다. 오버코트층(106)를 덮도록 형성되어 상부기판(102)을 평탄화한다. 스페이서(113)는 상부기판(102)과 하부기판(132)사이에 셀 갭을 유지하는 역할을 한다. The color filter 106 is formed in the cell region separated by the black matrix 104. The color filter 106 is formed for each of R, G, and B to implement R, G, and B colors. It is formed to cover the overcoat layer 106 to planarize the upper substrate 102. The spacer 113 serves to maintain a cell gap between the upper substrate 102 and the lower substrate 132.

하부 어레이 기판(180)에 있어서, TFT(115)는 게이트라인(도시하지 않음)과 함께 하부기판(132)위에 형성되는 게이트전극(109)과, 이 게이트전극(109)과 게이트 절연막(144)을 사이에 두고 중첩되는 반도체층(114,147)과, 반도체층(114,147)을 사이에 두고 데이터라인(도시하지 않음)과 함께 형성되는 소스/드레인전극(140,142)을 구비한다. 이러한 TFT(115)는 게이트라인으로 부터의 스캔신호에 응답하여 데이터라인으로부터 화소신호를 화소전극(116)에 공급한다. 화소전극(116)은 광투과율이 높은 투명전도성 물질로 보호막(150)을 사이에 두고 TFT(115)의 드레인 전극(142)과 접촉된다. 공통전극(118)은 화소전극(116)과 교번되도록 스트라입형태로 형성된다. 공통전극(118)은 액정구동시 기준이 되는 공통전압을 공급한다. 이 공통전압과 화소전극(116)에 공급되는 화소전압과의 수평전계에 의해 액정은 수평방향을 기준으로 회전하게 된다. In the lower array substrate 180, the TFT 115 includes a gate electrode 109 formed on the lower substrate 132 along with a gate line (not shown), the gate electrode 109, and the gate insulating layer 144. Semiconductor layers 114 and 147 overlapping each other, and source / drain electrodes 140 and 142 formed together with data lines (not shown) with the semiconductor layers 114 and 147 interposed therebetween. The TFT 115 supplies a pixel signal from the data line to the pixel electrode 116 in response to a scan signal from the gate line. The pixel electrode 116 is a transparent conductive material having a high light transmittance and contacts the drain electrode 142 of the TFT 115 with the passivation layer 150 therebetween. The common electrode 118 is formed in a stripe shape so as to alternate with the pixel electrode 116. The common electrode 118 supplies a common voltage which is a reference when driving the liquid crystal. The liquid crystal rotates with respect to the horizontal direction by the horizontal electric field between the common voltage and the pixel voltage supplied to the pixel electrode 116.

액정배향을 위한 상/하부 배향막(108,138)은 폴리이미드 등과 같은 배향물질을 도포한 후 러빙공정을 수행함으로써 형성된다. 한편, 본 발명에서는 공통전극(118)이 게이트 금속층으로 게이트 전극(109) 등과 동시에 형성됨을 나타내었지 만 필요에 따라 화소전극(116)과 동시에 투명전극 물질로 형성될 수 있다. 여기서, 화소전극(116)과 공통전극(118)이 투명전극 물질로 형성되는 경우 공통전극(118)은 화소전극(116)과 동일 평면상에서 보호막(150) 상에 위치하게 되고, 보호막(150) 및 게이트 절연막(144)을 관통하는 별도의 관통홀을 통해 공통라인과 접속되어 기준전압을 공급받는다. The upper and lower alignment layers 108 and 138 for liquid crystal alignment are formed by applying an alignment material such as polyimide and then performing a rubbing process. Meanwhile, although the common electrode 118 is formed at the same time as the gate electrode 109 as the gate metal layer, the common electrode 118 may be formed of a transparent electrode material simultaneously with the pixel electrode 116 as necessary. When the pixel electrode 116 and the common electrode 118 are formed of a transparent electrode material, the common electrode 118 is positioned on the passivation layer 150 on the same plane as the pixel electrode 116 and the passivation layer 150. And a reference voltage to be connected to the common line through a separate through hole penetrating through the gate insulating layer 144.

비표시영역(P2)에서의 상부 어레이 기판(170)에는 상부기판(102) 상에 형성된 블랙 매트릭스(104) 만이 위치하게 되고, 하부 어레이 기판(180)에는 하부기판(132)에는 외부 구동부의 그라운드(GND)와 연결되는 기전전압공급라인(135)이 형성되어 있다. 그리고, 기전전압공급라인(135)과 도전성 블랙 매트릭스(104)는 은도트(145)를 통해 전기적으로 연결시킨다. Only the black matrix 104 formed on the upper substrate 102 is positioned in the upper array substrate 170 in the non-display area P2, and the lower substrate 132 is grounded in the lower array substrate 180 in the lower array substrate 180. An electromotive voltage supply line 135 connected to the GND is formed. The electromotive voltage supply line 135 and the conductive black matrix 104 are electrically connected through the silver dot 145.

상부 어레이 기판(170)과 하부 어레이 기판(180)은 은도트(145) 통해 등전위 구조를 이룰 수 있게 된다. 이에 따라, 액정표시패널(90)의 상부 어레이 기판(170)에서 발생된 정전기는 은도트(145) 및 기전전압공급라인(135)을 경유하여 구동부의 그라운드(GND)를 통해 외부로 배출될 수 있게 된다. 한편, 은도트(145) 대신에 도전성 실런트(155) 등에 이용되는 도전볼이 이용될 수도 있다. The upper array substrate 170 and the lower array substrate 180 may form an equipotential structure through the silver dot 145. Accordingly, the static electricity generated in the upper array substrate 170 of the liquid crystal display panel 90 may be discharged to the outside through the ground GND of the driving unit via the silver dot 145 and the electromotive voltage supply line 135. Will be. Instead of the silver dot 145, a conductive ball used for the conductive sealant 155 may be used.

이와 같이 본 발명의 제1 실시예에 따른 액정표시패널(90)은 도전성의 블랙 매트릭스(104)를 상부 어레이 기판(170)의 기전전압공급라인(135)과 전기적으로 연결시켜 정전기를 외부로 배출시킬 수 있게 된다. 그 결과, 투명전극 패턴(3)이 필요 없게 됨에 따라 구조가 단순해지고 비용을 절감되며 박형화할 수 있게 된다. As described above, the liquid crystal display panel 90 according to the first exemplary embodiment of the present invention electrically connects the conductive black matrix 104 with the electromotive voltage supply line 135 of the upper array substrate 170 to discharge static electricity to the outside. You can do it. As a result, as the transparent electrode pattern 3 is not required, the structure can be simplified, the cost can be reduced, and the thickness can be reduced.

도 2 및 도 3은 본 발명의 제2 실시예에 따른 액정표시패널을 나타낸다. 도 2는 액정표시패널을 개략적으로 나타내는 평면도이고, 도 3은 도 2에서 Ⅰ-Ⅰ'선을 절취하여 도시한 단면도이다.2 and 3 show a liquid crystal display panel according to a second embodiment of the present invention. FIG. 2 is a plan view schematically illustrating a liquid crystal display panel, and FIG. 3 is a cross-sectional view taken along line II ′ of FIG. 2.

도 2 및 도 3에 도시된 액정표시패널은 도 2에 도시된 액정표시패널과 비교하여 하부 어레이 기판(180)의 비표시영역(P2)에 기전전압공급라인(135) 대신 표시영역(P1)에서의 신장된 공통전극(118)이 위치할 수도 있고 은도트(145)가 아닌 도전볼(154)들을 함유하는 도전성 실런트(155)를 통해 상부 어레이 기판(170) 및 하부 어레이 기판(180)을 등전위되는 것을 제외하고는 도 2에 도시된 액정표시패널과 동일한 구성요소를 구비한다. 따라서, 도 2와 동일한 구성을 가지는 구성요소들은 동일 번호를 부여하고 상세한 설명은 생략한다.The liquid crystal display panel shown in FIGS. 2 and 3 has a display area P1 instead of the electromotive voltage supply line 135 in the non-display area P2 of the lower array substrate 180 compared to the liquid crystal display panel shown in FIG. 2. The upper array substrate 170 and the lower array substrate 180 may be disposed through the conductive sealant 155 including the conductive balls 154 instead of the silver dot 145. Except for the equipotential, the same components as those of the liquid crystal display panel shown in FIG. 2 are provided. Therefore, components having the same configuration as those of FIG. 2 are given the same numerals and detailed description thereof will be omitted.

도 3에서의 하부 어레이 기판(180)의 비표시영역(P2)에 표시영역(P1)에서의 신장된 공통전극(118)이 위치할 수도 있고 도 2와 같이 기전전압공급라인(135)이 위치할 수도 있다. 예들 들어, 액정표시패널(190)이 라인 인버전(Line Inversion) 또는 프레임 인버전(Flame Inversion) 방식에 의해 구동하는 경우 공통전극(118) 및 기전전압공급라인(135) 중 어느 하나가 형성되는 것이 효과적이고 도트 인버전(Dot Inversion) 방식의 경우에는 기전전압공급라인(135)이 형성되는 것이 더욱 효과적이다. The extended common electrode 118 in the display area P1 may be located in the non-display area P2 of the lower array substrate 180 in FIG. 3, or the electromotive voltage supply line 135 is positioned as shown in FIG. 2. You may. For example, when the liquid crystal display panel 190 is driven by a line inversion or frame inversion method, one of the common electrode 118 and the electromotive voltage supply line 135 is formed. In the case of the dot inversion method, it is more effective that the electromotive voltage supply line 135 is formed.

공통전극(118) 또한 외부 구동부와 연결됨으로써 상부 어레이 기판(170)에서 발생되어 도전성 실런트(155)을 경유하는 정전기를 외부로 배출시킬 수 있게 된다.The common electrode 118 is also connected to the external driver so that the static electricity generated in the upper array substrate 170 can be discharged to the outside via the conductive sealant 155.

실런트(155)는 도 3에 도시된 바와 같이 상부 어레이 기판(170) 및 하부 어레이 기판(180)을 합착시키는 역할을 한다. 이러한 실런트(155)에 도전볼(154)을 첨가함에 따라 상부 어레이 기판(170) 및 하부 어레이 기판(180)을 합착시키는 역할뿐만 아니라 상부 어레이 기판(170)의 블랙 매트릭스(104)을 하부 어레이 기판(180)의 공통전극(118) 또는 기전전압공급라인(135)과 전기적으로 연결시킨다.The sealant 155 serves to bond the upper array substrate 170 and the lower array substrate 180 as shown in FIG. 3. As the conductive balls 154 are added to the sealant 155, the black matrix 104 of the upper array substrate 170 may be attached to the lower array substrate as well as the upper array substrate 170 and the lower array substrate 180 may be bonded to each other. Electrically connected to the common electrode 118 or the electromotive voltage supply line 135 of 180.

한편, 하부 어레이 기판(180)의 비표시영역(P2)에 게이트 절연막(144) 및 보호막(150)이 형성되어 있는 구조에서는 게이트 절연막(144) 및 보호막(150)을 모두 관통하여 공통전극(118) 또는 기전전압공급라인(135)을 노출시키는 접촉홀(156)이 형성되어 있게 된다. 이때, 도전성 실런트(155)는 접촉홀(156)을 통해 공통전극(118) 또는 기전전압공급라인(135)와 접촉될 수 있게 된다. Meanwhile, in the structure in which the gate insulating layer 144 and the passivation layer 150 are formed in the non-display area P2 of the lower array substrate 180, the common electrode 118 passes through the gate insulating layer 144 and the passivation layer 150. Or a contact hole 156 exposing the electromotive voltage supply line 135 is formed. In this case, the conductive sealant 155 may be in contact with the common electrode 118 or the electromotive voltage supply line 135 through the contact hole 156.

한편, 접촉홀(156)을 형성하는 공정은 하부 어레이 기판(180)의 게이트 패드부 및 데이터 패드부를 형성하는 공정에서 동시에 진행될 수 있게 됨에 따라 별도의 마스크 추가공정 없이 형성할 수 있게 된다. Meanwhile, the process of forming the contact hole 156 may be simultaneously performed in the process of forming the gate pad portion and the data pad portion of the lower array substrate 180, so that the contact hole 156 may be formed without a separate mask addition process.

상술한 바와 같이, 본 발명의 실시예에 따른 액정표시패널은 상부 어레이 기판의 비표시영역에 블랙 매트릭스를 도전성 금속으로 형성하고 하부 어레이 기판의 비표시영역에 외부 구동부의 그라운드(GND)와 연결되는 공통전극 또는 기전전압공급라인을 형성한다. 이와 동시에 도전성 블랙 매트릭스와 공통전극 또는 기전전압공급라인을 은도트 또는 도전성 실런트를 통해 전기적으로 연결시킴에 따라 상부 어레이 기판과 하부 어레이 기판이 등전위를 이룰 수 있게 된다. 이에 따라, 상부 어레이 기판에 형성되었던 투명전극 패턴 형성 공정이 제거됨에 따라 액정표시패널 을 박형화할 수 있고 제조공정이 단순화되고 비용이 절감된다. As described above, the liquid crystal display panel according to the embodiment of the present invention forms a black matrix in the non-display area of the upper array substrate with a conductive metal and is connected to the ground GND of the external driver in the non-display area of the lower array substrate. A common electrode or electromotive voltage supply line is formed. At the same time, the upper array substrate and the lower array substrate are equipotential as the conductive black matrix and the common electrode or the electromotive voltage supply line are electrically connected through silver dots or conductive sealants. Accordingly, as the transparent electrode pattern forming process formed on the upper array substrate is removed, the liquid crystal display panel can be thinned, the manufacturing process is simplified, and the cost is reduced.

이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여져야만 할 것이다.Those skilled in the art will appreciate that various changes and modifications can be made without departing from the technical spirit of the present invention. Therefore, the technical scope of the present invention should not be limited to the contents described in the detailed description of the specification but should be defined by the claims.

Claims (7)

비표시영역에 도전성 블랙 매트릭스가 형성된 상부 어레이 기판과; An upper array substrate having a conductive black matrix formed in the non-display area; 상기 도전성 블랙 매트릭스와 대응되는 영역에 도전성 배선이 형성된 하부 어레이 기판과; A lower array substrate having conductive lines formed in a region corresponding to the conductive black matrix; 상기 도전성 블랙 매트릭스와 도전성 배선을 전기적으로 연결시키는 은도트 및 도전성 실런트 중 적어도 어느 하나를 구비하는 것을 특징으로 하는 액정표시패널. And at least one of a silver dot and a conductive sealant for electrically connecting the conductive black matrix and the conductive wiring. 제 1 항에 있어서, The method of claim 1, 상기 도전성 배선은 외부 구동부의 그라운드와 연결되는 것을 특징으로 하는 액정표시패널. The conductive line is connected to the ground of the external driving unit, the liquid crystal display panel. 제 2 항에 있어서, The method of claim 2, 상기 하부 어레이 기판은 The lower array substrate 서로 교차되게 형성되는 신호라인들과; Signal lines formed to cross each other; 상기 신호라인의 교차영역에 위치하는 박막 트랜지스터와; A thin film transistor positioned at an intersection area of the signal line; 상기 박막 트랜지스터와 접속된 화소전극과; A pixel electrode connected to the thin film transistor; 상기 화소전극과 수평전계를 이루는 공통전극을 구비하는 것을 특징으로 하는 액정표시패널. And a common electrode forming a horizontal electric field with the pixel electrode. 제 3 항에 있어서, The method of claim 3, wherein 상기 도전성 배선은 상기 공통전극과 연결된 것을 특징으로 하는 액정표시패널. And the conductive line is connected to the common electrode. 제 3 항에 있어서, The method of claim 3, wherein 상기 하부 어레이 기판의 비표시영역에는 게이트 절연막 및 보호막이 더 형성되고,A gate insulating film and a protective film are further formed in the non-display area of the lower array substrate. 상기 도전성 실런트는 상기 게이트 절연막 및 보호막을 관통하여 상기 도전성 배선을 노출시키는 접촉홀을 통해 상기 도전성 배선과 접촉되는 것을 특징으로 하는 액정표시패널. And the conductive sealant is in contact with the conductive wire through a contact hole through the gate insulating film and the protective film to expose the conductive wire. 제 1 항에 있어서, The method of claim 1, 상기 블랙 매트릭스는 크롬을 포함하는 것을 특징으로 하는 액정표시패널. And the black matrix comprises chromium. 제 1 항에 있어서, The method of claim 1, 상기 도전성 실런트는 도전볼들을 포함하는 것을 특징으로 하는 액정표시패널.And the conductive sealant comprises conductive balls.
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