KR20070111585A - The inspection device for semi-conductor - Google Patents
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Abstract
Description
도 1은 본 발명의 사시도.1 is a perspective view of the present invention.
도 2는 본 발명의 정면도.2 is a front view of the present invention.
도 3은 본 발명의 디바이스 검사를 실시하는 접점의 확대를 보인 정면도.3 is an enlarged front view of a contact for performing the device inspection of the present invention;
도 4는 플렉시블 케이블로 연결된 테스트 핀을 나타낸 상태의 사시도.4 is a perspective view showing a test pin connected with a flexible cable.
도 5는 종래의 디바이스 검사장치의 사시도.5 is a perspective view of a conventional device inspection apparatus.
<도면의주요부분에대한부호의설명>Explanation of symbols on the main parts of the drawing
본 발명은 반도체 디바이스 검사 장치에 관한 것으로, 더욱 상세하게는 반도체 디바이스 리드(lead)의 상하에서 테스트 핀을 접촉하는 방식으로 검사를 실시하여 접촉면 유격의 영향의 받지 않아 2접점 접촉이 가능하여 접점의 수명이 길고 검사 수율이 높은 검사 장치를 제공함을 목적으로 한다.The present invention relates to an apparatus for inspecting a semiconductor device, and more particularly, a test is performed by contacting test pins above and below a semiconductor device lead, thereby making it possible to make two-contact contact without being affected by contact surface clearance. An object of the present invention is to provide an inspection apparatus having a long life and a high inspection yield.
최근 미세가공 기술의 발전과 더불어 반도체 디바이스의 극 미세화 또한 점차 발전하는 추세에 있다. 이와 같이, 반도체 디바이스가 극 미세화 될수록 반도체 디바이스에는 회로패턴의 단락, 회로패턴 사이의 전류누설 등의 다양한 불량이 야 기될 소지가 점차 증가하고 있으며, 이에 따라, 최종 완성된 반도체 디바이스의 특성을 정확히 테스트하는 과정은 반도체 디바이스의 우수한 품질을 확보하는데 있어서 없어서는 않될 매우 중요한 요소로 자리 잡고 있다.In recent years, with the development of microfabrication technology, the miniaturization of semiconductor devices is also gradually progressing. As such, as semiconductor devices become more miniaturized, various defects such as short circuits of circuit patterns and current leakage between circuit patterns are gradually increasing in semiconductor devices. Accordingly, the characteristics of the final semiconductor device are accurately tested. This process is indispensable for securing excellent quality of semiconductor devices.
이에 맞추어 최근에 다양한 반도체 디바이스 특성 테스트 장치들이 개발되어 실 공정에 널리 사용되고 있다.Recently, various semiconductor device characteristic test apparatuses have been developed and widely used in actual processes.
예컨대, 이러한 반도체 디바이스 특성 테스트 장치는 반도체 디바이스의 특성을 직접 테스트하는 테스터와, 테스터에서 진행된 테스트 결과에 따라, 반도체 디바이스를 등급별로 자동 분류하는 핸들러로 나뉘어 구성된다.For example, such a semiconductor device characteristic test apparatus is divided into a tester for directly testing the characteristics of the semiconductor device, and a handler for automatically classifying the semiconductor devices by grades according to test results conducted in the tester.
이때, 특성을 테스트 받고자 하는 반도체 디바이스를 특성 테스트 장치 본체에 직접 로딩 시킨 후 테스트 할 수도 있으나, 이 경우, 전체적인 장치의 구조가 복잡해지고, 예측하지 못한 신호왜곡이 발생되는 문제점이 야기된다.In this case, the semiconductor device to be tested for characteristics may be directly loaded onto the characteristic test apparatus main body and then tested. In this case, however, the structure of the entire apparatus becomes complicated and an unexpected signal distortion occurs.
따라서, 종래의 경우에는 장치 본체에서 반도체 디바이스를 직접 테스트하는 방식을 지양하는 대신, 본체의 인접부에 반도체 디바이스 테스트에 적합한 구조를 갖는 테스트 헤드를 별도로 배치하고 이를 테스터와 연결시켜, 장비 본체와의 신속한 테스트 신호 송ㅇ수신이 이루어지도록 함으로써, 장치 본체의 구조를 현저히 단순화 시키면서도, 원활한 반도체 디바이스 테스트를 진행시키고 있다.Therefore, in the conventional case, instead of refraining from directly testing the semiconductor device in the apparatus main body, a test head having a structure suitable for testing the semiconductor device is separately disposed in the vicinity of the main body and connected to the tester, so that By enabling rapid test signal transmission and reception, a smooth semiconductor device test is being conducted while greatly simplifying the structure of the apparatus main body.
도 5에 반도체 디바이스 테스트 장치를 도시하고 있다. 이 테스트 장비는 디바이스 리드에 좌우 접점이 접촉되면서 일정한 테스트 신호를 송ㅇ수신시킴으로써, 반도체 디바이스의 특성을 신속히 테스트한다. The semiconductor device test apparatus is shown in FIG. The test equipment quickly tests the characteristics of semiconductor devices by sending a constant test signal as the left and right contacts come into contact with the device leads.
그러나, 이러한 종래의 반도체 디바이스 테스트 장치에는 중대한 문제점이 있다.However, there is a serious problem with this conventional semiconductor device test apparatus.
상술한 바와 같은, 반도체 디바이스가 테스트를 진행받기 위하여 테스트기에 진입한 경우 좌우의 실린더가 테스트 핀을 밀어 디바이스 접점에 접촉하는 1접점 방식으로 테스트를 실시하므로 테스트 핀은 단지 자신의 테두리만 가압 받게 됨으로써, 테스트 핀이 오픈되는 현상에 따라 접촉이 불량을 일으키게 되고, 결국, 테스터로부터 전달되는 테스트 신호의 송ㅇ수신이 장애를 받게 된다.As described above, when the semiconductor device enters the tester to proceed with the test, the test pins are pressurized only by their edges because the left and right cylinders push the test pins to contact the device contacts. As a result of the test pin being opened, the contact is bad, and the transmission and reception of the test signal transmitted from the tester is interrupted.
이러한 테스트 신호의 송ㅇ수신 장애에 의해 테스터는 정확한 반도체 디바이스 테스트를 진행할 수 없는 문제점을 유발한다. 이 경우, 최종 완성되는 반도체 디바이스의 신뢰성이 현저히 저하되는 또 다른 문제점이 유발된다. This disturbance of the test signal causes the tester to be unable to conduct accurate semiconductor device testing. In this case, another problem is caused that the reliability of the finally completed semiconductor device is significantly lowered.
또한 테스트 핀을 직접 미는 방식이므로 테스트 핀의 수명이 현저하게 짧아짐은 물론 검사 수율이 떨어지는 문제점이 있다.In addition, since the test pins are directly pushed, the test pins have a significantly shorter lifespan, and test yields are lowered.
본 발명은 상기한 종래의 문제점을 해결하기 위하여 안출한 것으로서, 본 발명의 목적은 반도체 디바이스 리드(lead)의 상하에서 테스트 핀을 접촉하는 방식으로 검사를 실시하여 접촉면 유격의 영향의 받지 않는 2접점 접촉이 가능하여 접점의 수명이 길고 검사 수율이 높은 검사 장치를 제공함을 목적으로 한다.SUMMARY OF THE INVENTION The present invention has been made to solve the above-mentioned conventional problems, and an object of the present invention is to inspect the test pins in contact with the test pins above and below the semiconductor device lead, thereby not being affected by contact surface clearance. It is an object of the present invention to provide an inspection device having a long contact life and a high inspection yield since contact is possible.
본 발명의 또 다른 목적은 테스핀과 테스트 기를 연결하는 케이블을 바이킹 소켓 방식으로 구성하여 좌우 폭의 조정 가능하도록 하여 보다 다양한 반도체 디바이스를 테스트 할 수 있도록 함을 목적으로 한다.Another object of the present invention is to configure the cable connecting the test pin and the tester in the Viking socket method to be able to adjust the left and right widths to test a variety of semiconductor devices.
이와 같은 본 발명은 테스트 신호의 송ㅇ수신 장애를 억제시킴으로써, 완벽 한 테스터에 의한 정확한 반도체 디바이스를 제공함을 목적으로 한다. This invention aims to provide an accurate semiconductor device by a perfect tester by suppressing the transmission / reception of a test signal.
이하 첨부된 도면을 참조하면서 본 발명에 따른 바람직한 실시예를 상세히 설명한다. 우선, 각 도면을 설명함에 있어, 동일한 구성 요소들에 한해서는 비록 다른 도면상에 도시되더라도 가능한 한 동일한 참조부호를 갖는다.Hereinafter, exemplary embodiments of the present invention will be described in detail with reference to the accompanying drawings. First, in describing each of the drawings, the same components have the same reference numerals as much as possible even though they are shown in different drawings.
도 1은 본 발명의 사시도, 도 2는 본 발명의 정면도, 도 3은 본 발명의 디바이스 검사를 실시하는 접점의 확대를 보인 정면도, 도 4는 플렉시블 케이블로 연결된 테스트 핀을 나타낸 상태의 사시도이다.1 is a perspective view of the present invention, FIG. 2 is a front view of the present invention, FIG. 3 is a front view showing an enlarged view of a contact for performing the device inspection of the present invention, and FIG. 4 is a perspective view showing a test pin connected with a flexible cable. to be.
첨부도면을 참조하여 본 발명을 상세히 설명하면 먼저, 도 1을 참조하면 본 발명의 반도체 디바이스 검사 장치는 상하 1조로 이루어지는 테스트 부(2)가 본체 베드(A) 상면과 유/공압 실린더에 의하여 작동되는 지그(4)에 나사로 고정되어 실린더의 작동에 의하여 테스트 부가 디바이스 핀에 2접점으로 접촉되도록 구성한 것이다.Referring to the accompanying drawings, the present invention will be described in detail. First, referring to FIG. 1, in the semiconductor device inspection apparatus of the present invention, a
상기한 테스트 부는 복수개의 테스트 핀(6)이 컨텍트 몸체(8)에 균일한 간격으로 일체로 형성되며 컨텍트 몸체와 테스트 핀의 사이에 컨텍트 리드 몸체(10)가 소켓형으로 삽입될 수 있도록 구성되며 상기 컨텍드 리드 몸체는 플렉시블 케이블(12)로 연결되어 좌우 폭의 조정이 가능하도록 구성한다.The test part is configured such that a plurality of
이때 테스트 부에 형성되는 테스트 핀(6)은 지그(4)에 고정되는 테스트 핀(6)은 하단으로 꺾여지도록 구성되며, 베드 상면에 고정되는 하단의 테스트 핀(6a)은 상부로 꺾여지도록 구성되어 상하 작동 시 균일한 압력으로 디바이스 핀 에 안정적으로 접촉할 수 있는 것이다.In this case, the
또한 본체 베드 상면과 지그에 테스트 부의 고정은 컨텍트 리드 몸체의 좌우에 나산산(16)을 가공하여 이를 지그(4)와 본체의 베드(A)에 나사 결합하여 컨텍트 몸체의 교체가 용이하도록 구성한다.In addition, the test part is fixed to the upper surface of the main body bed and the jig to process the Nasan acid (16) on the left and right sides of the contact lead body and screwed it to the jig (4) and the bed (A) of the main body so that the contact body can be easily replaced. .
상기와 같이 구성된 본 발명은 자동으로 이송되는 디바이스 패키지가 테스트부(2)에 진입되면 센서가 감지하여 유/공압 실린더가 작동하고 유공압 실린더의 작동에 따라 지그(4) 몸체가 하측으로 눌려지게 되고 이에 따라 지그 몸체에 결합된 상하의 테스트부에 일체로 된 테스트 핀(6)(6a)이 서로 맞닿게 되면서 디바이스 핀의 상하에 2접점으로 접촉하게 되고 이때 전기적인 신호를 보내 디바이스 패키지의 불량 유무를 검사하면 되는 것이다.According to the present invention configured as described above, when the device package to be automatically transported enters the
한편 디바이스 패키지의 종류에 따라 테스트부의 교체시 또는 테스트 부의 마모에 다른 교체시 바이킹 소켓형으로 되어있는 컨텍트 몸체(8)를 분리하고 다른 컨텍트 몸체를 쉽게 결합할 수 있어 고장 및 수리가 간편하고 보다 다양한 용도로의 사용이 간편하다.On the other hand, depending on the type of device package, when the test part is replaced or the wear of the test part is different, the
이상과 같이 본 발명은 접촉면에 스페이스 영향을 받지 않아 상하 2점점 방식으로 구성할 수 있어 테스트 신호의 송ㅇ수신 장애를 억제시킴으로써, 완벽한 테스터에 의한 정확한 반도체 디바이스를 제공할 수 있으며, 소켓 방식으로 컨텍트 몸체를 분리 결합으로 좌우 폭 조정이 가능한 장점이 있는 발명인 것이다.As described above, the present invention can be configured in a two-point system up and down without being affected by the space of the contact surface, thereby suppressing transmission and reception disturbances of the test signal, thereby providing an accurate semiconductor device by a perfect tester, and by using a socket method. The invention is an advantage that can be adjusted to the left and right width by separating the body.
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