KR20060126269A - Plasma display apparatus and driving method thereof - Google Patents

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KR20060126269A
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조기덕
김원재
최윤창
정경진
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엘지전자 주식회사
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Abstract

A plasma display device and a driving method thereof are provided to increase the contrast characteristic by making the absolute value of the gradient of ramp-down pulse included in setdown pulse supplied to a scan electrode during a setdown period of a reset period in a subfield where setup pulse including ramp-up pulse is supplied to the scan electrode during a setup period of the reset period, smaller than that of the other subfield. A plasma display device includes a plasma display panel(500) having scan electrodes(Y1~Yn); a scan driving unit(503) driving the scan electrodes; and a setdown pulse control unit(501) controlling the gradient of ramp-down pulse applied during a setdown period of a reset period of at least one subfield, differently from the gradient of ramp-down pulse applied during the setdown period of the reset period of the rest subfields, by controlling the scan driving unit.

Description

플라즈마 디스플레이 장치 및 그의 구동 방법{Plasma Display Apparatus and Driving Method Thereof}Plasma Display Apparatus and Driving Method Thereof

도 1은 일반적인 플라즈마 디스플레이 패널의 구조를 도시한 도.1 is a diagram showing the structure of a typical plasma display panel.

도 2는 플라즈마 디스플레이 패널과 구동부와의 결합관계를 나타낸 도.2 is a view showing a coupling relationship between a plasma display panel and a driver;

도 3은 종래 플라즈마 디스플레이 장치에서 플라즈마 디스플레이 패널을 구동시키기 위한 구동 파형을 나타낸 도.3 is a view showing a driving waveform for driving a plasma display panel in a conventional plasma display device.

도 4는 종래의 구동 파형에서 하나의 프레임 내에서 상승 램프가 한번 공급되는 방법을 설명하기 위한 도.4 is a view for explaining a method in which the rising ramp is supplied once in one frame in the conventional driving waveform.

도 5는 본 발명의 플라즈마 디스플레이 장치의 구조를 설명하기 위한 도.5 is a diagram for explaining the structure of a plasma display device of the present invention;

도 6은 본 발명의 플라즈마 디스플레이 패널의 구동 방법의 일실시예를 설명하기 위한 도.6 is a view for explaining an embodiment of a method of driving a plasma display panel of the present invention.

도 7은 도 6의 본 발명의 플라즈마 디스플레이 패널의 구동 방법에 따라 나타난 광 파형을 도 4의 종래 구동 파형에 따라 나타난 광 파형과 비교하기 위한 도.FIG. 7 is a view for comparing an optical waveform shown according to the driving method of the plasma display panel of the present invention of FIG. 6 with an optical waveform shown according to the conventional driving waveform of FIG. 4.

<도면의 주요 부분에 대한 부호의 설명><Explanation of symbols for the main parts of the drawings>

500 : 플라즈마 디스플레이 패널 501 : 셋 다운 펄스 제어부500: plasma display panel 501: set-down pulse control unit

502 : 데이터 구동부 503 : 스캔 구동부502: data driver 503: scan driver

504 : 서스테인 구동부 505 : 구동 전압 발생부504: sustain driver 505: drive voltage generator

본 발명은 플라즈마 디스플레이 패널(Plasma Display Panel)에 관한 것으로, 보다 상세하게는 리셋 기간의 스캔 전극으로 공급되는 셋 다운 펄스의 기울기를 조절하여 콘트라스트(Contrast) 특성을 향상시키는 플라즈마 디스플레이 장치 및 그의 구동방법에 관한 것이다.BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a plasma display panel, and more particularly, to a plasma display device and a method of driving the same, which improve contrast by adjusting a slope of a set down pulse supplied to a scan electrode during a reset period. It is about.

일반적으로 플라즈마 디스플레이 패널은 전면 패널과 후면 패널 사이에 형성된 격벽이 하나의 단위 셀을 이루는 것으로, 각 셀 내에는 네온(Ne), 헬륨(He) 또는 네온 및 헬륨의 혼합기체(Ne+He)와 같은 주 방전 기체와 소량의 크세논을 함유하는 불활성 가스가 충진되어 있다. 고주파 전압에 의해 방전이 될 때, 불활성 가스는 진공자외선(Vacuum Ultra Violet rays)을 발생하고 격벽 사이에 형성된 형광체를 발광시켜 화상이 구현된다. 이와 같은 플라즈마 디스플레이 패널은 얇고 가벼운 구성이 가능하므로 차세대 표시장치로서 각광받고 있다.In general, a plasma display panel is a partition wall formed between a front panel and a rear panel to form one unit cell, and each cell includes neon (Ne), helium (He), or a mixture of neon and helium (Ne + He) and An inert gas containing the same main discharge gas and a small amount of xenon is filled. When discharged by a high frequency voltage, the inert gas generates vacuum ultra violet rays and emits phosphors formed between the partition walls to realize an image. Such a plasma display panel has a spotlight as a next generation display device because of its thin and light configuration.

도 1은 일반적인 플라즈마 디스플레이 패널의 구조를 나타낸 도이다.1 illustrates a structure of a general plasma display panel.

도 1에 도시된 바와 같이, 플라즈마 디스플레이 패널은 화상이 디스플레이되는 표시 면인 전면 글라스(101)에 스캔 전극(102)과 서스테인 전극(103)이 쌍을 이뤄 형성된 복수의 유지 전극 쌍이 배열된 전면 패널(100) 및 배면을 이루는 후면 글라스(111) 상에 전술한 복수의 유지 전극 쌍과 교차 되도록 복수의 어드레스 전 극(113)이 배열된 후면 패널(110)이 일정거리를 사이에 두고 평행하게 결합 된다.As shown in FIG. 1, the plasma display panel includes a front panel in which a plurality of sustain electrode pairs formed by pairing a scan electrode 102 and a sustain electrode 103 are arranged on the front glass 101, which is a display surface on which an image is displayed. 100 and the rear panel 110 having a plurality of address electrodes 113 arranged to intersect the plurality of storage electrode pairs described above on the rear glass 111 forming the rear surface are coupled in parallel with a predetermined distance therebetween. .

전면 패널(100)은 하나의 방전 셀에서 상호 방전시키고 셀의 발광을 유지하기 위한 스캔 전극(102) 및 서스테인 전극(103), 즉 투명한 ITO 물질로 형성된 투명 전극(a)과 금속재질로 제작된 버스 전극(b)으로 구비된 스캔 전극(102) 및 서스테인 전극(103)이 쌍을 이뤄 포함된다. 스캔 전극(102) 및 서스테인 전극(103)은 방전 전류를 제한하며 전극 쌍 간을 절연시켜주는 하나 이상의 상부 유전체 층(104)에 의해 덮여지고, 상부 유전체 층(104) 상면에는 방전 조건을 용이하게 하기 위하여 산화마그네슘(MgO)을 증착한 보호층(105)이 형성된다.The front panel 100 is made of a scan electrode 102 and a sustain electrode 103, that is, a transparent electrode (a) formed of a transparent ITO material and a metal material to mutually discharge and maintain light emission of the cells in one discharge cell. The scan electrode 102 and the sustain electrode 103 provided as the bus electrode b are included in pairs. The scan electrode 102 and the sustain electrode 103 are covered by one or more upper dielectric layers 104 that limit the discharge current and insulate the electrode pairs, and facilitate discharge conditions on top of the upper dielectric layer 104. In order to do this, a protective layer 105 on which magnesium oxide (MgO) is deposited is formed.

후면 패널(110)은 복수 개의 방전 공간 즉, 방전 셀을 형성시키기 위한 스트라이프 타입(또는 웰 타입)의 격벽(112)이 평행을 유지하여 배열된다. 또한, 어드레스 방전을 수행하여 진공자외선을 발생시키는 다수의 어드레스 전극(113)이 격벽(112)에 대해 평행하게 배치된다. 후면 패널(110)의 상측 면에는 어드레스 방전시 화상표시를 위한 가시광선을 방출하는 R, G, B 형광체(114)가 도포 된다. 어드레스 전극(113)과 형광체(114) 사이에는 어드레스 전극(113)을 보호하기 위한 하부 유전체 층(115)이 형성된다.The rear panel 110 is arranged in such a manner that a plurality of discharge spaces, that is, barrier ribs 112 of a stripe type (or well type) for forming discharge cells are maintained in parallel. In addition, a plurality of address electrodes 113 which perform address discharge to generate vacuum ultraviolet rays are arranged in parallel with the partition wall 112. The upper surface of the rear panel 110 is coated with R, G, and B phosphors 114 that emit visible light for image display during address discharge. A lower dielectric layer 115 is formed between the address electrode 113 and the phosphor 114 to protect the address electrode 113.

이러한 구조의 플라즈마 디스플레이 패널은 방전 셀이 매트릭스(Matrix) 구조로 복수 개가 형성되고, 방전 셀에 소정의 펄스를 공급하기 위한 구동회로를 포함하는 구동부가 부착되어 구동된다. 이러한 플라즈마 디스플레이 패널과 구동부와의 결합관계를 살펴보면 도 2와 같다.The plasma display panel having the above-described structure is provided with a plurality of discharge cells in a matrix structure, and a driving unit including a driving circuit for supplying a predetermined pulse to the discharge cells is attached and driven. The coupling relationship between the plasma display panel and the driving unit is illustrated in FIG. 2.

도 2는 플라즈마 디스플레이 패널과 구동부와의 결합관계를 나타낸 도면이 다.2 is a diagram illustrating a coupling relationship between a plasma display panel and a driver.

도 2에 도시된 바와 같이, 구동부는 예컨대, 데이터 구동부(201), 스캔 구동부(202), 서스테인 구동부(203)를 포함하여 구성된다. 이러한 구동부들(201, 202, 203)이 플라즈마 디스플레이 패널(200)과 연결되어 하나의 플라즈마 디스플레이 장치를 이룬다.As shown in FIG. 2, the driver includes, for example, a data driver 201, a scan driver 202, and a sustain driver 203. These driving units 201, 202, and 203 are connected to the plasma display panel 200 to form one plasma display device.

여기서, 전술한 플라즈마 디스플레이 패널(200)은 데이터 구동부(201)로부터 데이터 펄스를 공급받는다. 이러한 데이터 펄스는 외부로부터 입력된 영상신호가 소정의 신호 처리 과정을 거침으로써 생성된다. 또한, 전술한 플라즈마 디스플레이 패널(200)은 스캔 구동부(202)로부터 출력된 스캔 펄스 및 서스테인 펄스를 입력받고, 서스테인 구동부(203)로부터 출력된 서스테인 펄스를 입력받는다. 이와 같이 데이터 펄스, 스캔 펄스, 서스테인 펄스 등을 입력받은 플라즈마 디스플레이 패널(200)에 포함된 다수의 셀 중에서 스캔 펄스에 의해 선택된 셀에 방전이 발생하고, 방전이 발생한 셀은 소정의 휘도로 발광한다. 여기서 데이터 구동부(201), 스캔 구동부(202), 서스테인 구동부(203)는 FPC(Flexible Printed Circuit)(미도시)와 같은 연결 체를 통해 플라즈마 디스플레이 패널(200)의 어드레스 전극, 스캔 전극, 서스테인 전극에 각각 연결된다.Here, the plasma display panel 200 is supplied with a data pulse from the data driver 201. These data pulses are generated when an image signal input from the outside goes through a predetermined signal processing process. The plasma display panel 200 receives the scan pulse and the sustain pulse output from the scan driver 202, and the sustain pulse output from the sustain driver 203. As described above, a discharge occurs in a cell selected by the scan pulse among a plurality of cells included in the plasma display panel 200 that receives the data pulse, the scan pulse, the sustain pulse, and the like, and the discharged cell emits light with a predetermined luminance. . The data driver 201, the scan driver 202, and the sustain driver 203 may be formed of an address electrode, a scan electrode, and a sustain electrode of the plasma display panel 200 through a connection such as a flexible printed circuit (FPC) (not shown). Are each connected to.

이러한 플라즈마 디스플레이 장치에서 플라즈마 디스플레이 패널을 구동시키기 위한 구동 파형을 살펴보면 다음 도 3과 같다.The driving waveform for driving the plasma display panel in the plasma display apparatus is shown in FIG. 3.

도 3은 종래 플라즈마 디스플레이 장치에서 플라즈마 디스플레이 패널을 구동시키기 위한 구동 파형을 나타낸 도면이다.3 is a view showing a driving waveform for driving a plasma display panel in a conventional plasma display device.

도 3에 도시된 바와 같이, 플라즈마 디스플레이 패널은 모든 셀 들을 초기화시키기 위한 리셋 기간, 방전할 셀을 선택하기 위한 어드레스 기간, 선택된 셀의 방전을 유지시키기 위한 서스테인 기간 및 방전된 셀 내의 벽 전하를 소거하기 위한 소거 기간으로 나뉘어 구동된다.As shown in Fig. 3, the plasma display panel erases a reset period for initializing all cells, an address period for selecting a cell to be discharged, a sustain period for maintaining the discharge of the selected cell, and a wall charge in the discharged cell. It is divided into an erase period for driving.

리셋 기간에 있어서, 셋 업 기간에는 모든 스캔 전극들에 상승 램프 파형(Ramp-up)이 동시에 인가된다. 이 상승 램프 파형에 의해 전 화면의 방전 셀 들 내에는 약한 암 방전(Dark Discharge)이 일어난다. 이 셋 업 방전에 의해 어드레스 전극과 서스테인 전극 상에는 정 극성 벽 전하가 쌓이게 되며, 스캔 전극 상에는 부극성의 벽 전하가 쌓이게 된다.In the reset period, a rising ramp waveform Ramp-up is simultaneously applied to all scan electrodes in the setup period. This rising ramp waveform causes weak dark discharge in the discharge cells of the entire screen. By this setup discharge, positive wall charges are accumulated on the address electrode and the sustain electrode, and negative wall charges are accumulated on the scan electrode.

셋 다운 기간에는 상승 램프 파형이 공급된 후, 상승 램프 파형의 피크 전압보다 낮은 정 극성 전압에서 떨어지기 시작하여 그라운드(GND)레벨 전압 이하의 특정 전압레벨까지 떨어지는 하강 램프 파형(Ramp-down)이 셀 들 내에 미약한 소거방전을 일으킴으로써 스캔 전극에 과도하게 형성된 벽 전하를 충분히 소거시키게 된다. 이 셋 다운 방전에 의해 어드레스 방전이 안정되게 일어날 수 있을 정도의 벽 전하가 셀 들 내에 균일하게 잔류 된다.During the set-down period, after the rising ramp waveform is supplied, the falling ramp waveform (Ramp-down) begins to fall from the positive polarity voltage lower than the peak voltage of the rising ramp waveform and falls to a specific voltage level below the ground (GND) level voltage. By generating a weak erase discharge in the cells, the wall charges excessively formed in the scan electrode are sufficiently erased. By this set down discharge, the wall charges to the extent that the address discharge can be stably generated remain uniformly in the cells.

어드레스 기간에는 부 극성 스캔 펄스가 스캔 전극들에 순차적으로 인가됨과 동시에 스캔 펄스에 동기 되어 어드레스 전극에 정 극성의 데이터 펄스가 인가된다. 이 스캔 펄스와 데이터 펄스의 전압 차와 리셋 기 간에 생성된 벽 전압이 더해지면서 데이터 펄스가 인가되는 방전 셀 내에는 어드레스 방전이 발생 된다. 어드레스 방전에 의해 선택된 셀 들 내에는 서스테인 전압(Vs)이 인가될 때 방전이 일 어날 수 있게 하는 정도의 벽 전하가 형성된다. 서스테인 전극에는 셋 다운 기간 또는 어드레스 기간 동안 중 하나 이상의 기간에서 스캔 전극과의 전압 차를 줄여 스캔 전극과의 오 방전이 일어나지 않도록 정극성 전압(Vz)이 공급된다.In the address period, negative polarity scan pulses are sequentially applied to the scan electrodes, and data pulses of positive polarity are applied to the address electrodes in synchronization with the scan pulses. As the voltage difference between the scan pulse and the data pulse and the wall voltage generated between the reset periods are added, an address discharge is generated in the discharge cell to which the data pulse is applied. In the cells selected by the address discharge, wall charges are formed such that a discharge can occur when the sustain voltage Vs is applied. The sustain electrode is supplied with a positive voltage Vz so as to reduce the voltage difference with the scan electrode in at least one of the set down period and the address period so that no misdischarge occurs with the scan electrode.

서스테인 기간에는 스캔 전극과 서스테인 전극들에 교번적으로 서스테인 펄스(Sus)가 인가된다. 어드레스 방전에 의해 선택된 셀은 셀 내의 벽 전압과 서스테인 펄스가 더해지면서 매 서스테인 펄스가 인가될 때마다 스캔 전극과 서스테인 전극 사이에 서스테인 방전 즉, 표시방전이 일어나게 된다.In the sustain period, a sustain pulse Su is applied to the scan electrode and the sustain electrodes alternately. In the cell selected by the address discharge, as the wall voltage and the sustain pulse in the cell are added, a sustain discharge, that is, a display discharge, occurs between the scan electrode and the sustain electrode every time the sustain pulse is applied.

서스테인 방전이 완료된 후, 소거 기간에서는 펄스 폭과 전압레벨이 작은 소거 램프 파형(Ramp-ers)의 전압이 서스테인 전극에 공급되어 전 화면의 셀 들 내에 잔류하는 벽 전하를 소거시키게 된다.After the sustain discharge is completed, in the erase period, the voltage of the erase ramp waveform Ramp-ers having a small pulse width and voltage level is supplied to the sustain electrode to erase the wall charge remaining in the cells of the entire screen.

종래의 플라즈마 디스플레이 패널에는 이러한 구동 파형이 프레임의 매 서브필드마다 공급된다.In the conventional plasma display panel, such a driving waveform is supplied for every subfield of the frame.

한편, 전술한 리셋 기간에서 스캔 전극으로 공급되는 상승 램프(Ramp-Up)는 통상 400V정도의 고 전압 펄스로서, 이에 따라 상승 램프에 의해 발생하는 방전에 따라 생성되는 광의 양이 상대적으로 많게 된다. 따라서 플라즈마 디스플레이 패널의 모든 방전 셀을 오프(Off)시킨 상태에서의 휘도, 즉 블랙(Black) 휘도가 상대적으로 크게 되어 콘트라스트(Contrast) 특성이 악화 된다.On the other hand, the ramp-up supplied to the scan electrode in the above-mentioned reset period is a high voltage pulse of about 400V, so that the amount of light generated by the discharge generated by the ramp is relatively large. Therefore, the luminance in the state where all the discharge cells of the plasma display panel are turned off, that is, the black luminance is relatively large, resulting in deteriorated contrast characteristics.

이러한 콘트라스트 특성의 악화를 방지하기 위해 종래에는 하나의 프레임에서 상승 램프가 한번 공급되도록 하는 방법이 제시되었다. 이를 살펴보면 다음 도 4와 같다.In order to prevent such deterioration of contrast characteristics, a method of allowing the rising ramp to be supplied once in one frame has been conventionally proposed. Looking at it as shown in FIG.

도 4는 종래의 구동 파형에서 하나의 프레임 내에서 상승 램프가 한번 공급되는 방법을 설명하기 위한 도면이다.FIG. 4 is a diagram for describing a method of supplying a rising ramp once in one frame in a conventional driving waveform.

도 4에 도시된 바와 같이, 하나의 프레임이 복수의 서브필드로 이루어지는 경우에, 이러한 복수의 서브필드 중에서 어느 하나의 서브필드의 리셋 기간의 셋 업 기간에서 공급되는 리셋 펄스만이 상승 램프를 포함한다. 예를 들면, 도 4와 같이 하나의 프레임의 복수의 서브필드 중에서 가중치가 가장 작은 서브필드 예컨대, 제 1 서브필드의 리셋 기간에서 셋 업 기간에 상승 램프를 포함하는 리셋 펄스가 공급되고, 나머지 다른 서브필드에서는 리셋 기간의 셋 업 기간에서 소정의 정 극성 전압, 예컨대 서스테인 전압(Vs)을 유지하는 리셋 펄스가 공급된다. 이에 따라 도 3의 구동 파형에 비해 하나의 프레임 내에서 공급되는 상승 램프 펄스의 개수를 상당부분 줄임으로써 콘트라스트 특성을 개선하였다.As shown in Fig. 4, when one frame consists of a plurality of subfields, only the reset pulses supplied in the setup period of the reset period of any one of the plurality of subfields include the rising ramp. do. For example, as shown in FIG. 4, a reset pulse including a rising ramp is supplied to a set-up period in a reset period of a subfield having the smallest weight among the plurality of subfields of one frame, for example, the first subfield. In the subfield, a reset pulse for maintaining a predetermined positive polarity voltage, for example, the sustain voltage Vs, is supplied in the setup period of the reset period. Accordingly, the contrast characteristics are improved by substantially reducing the number of rising ramp pulses supplied in one frame compared to the driving waveform of FIG. 3.

한편, 여기서, 프레임의 서브필드 중 리셋 기간에서 상승 램프 펄스를 포함하는 서브필드에서는 셋 다운 기간에서 공급되는 셋 다운 펄스의 기울기(ΔV/Δt)는 나머지 다른 서브필드의 셋 다운 기간에서 공급되는 셋 다운 펄스의 기울기와 동일하다. 이러한 셋 다운 기간에서 공급되는 셋 다운 펄스의 기울기의 절대값이 클수록 즉, 시간당 전압변화율이 클수록 셋 다운 기간에서 발생하는 광의 양이 증가하게 된다. 이에 따라 셋 다운 기간에서의 광 파형의 변화에 더 큰 영향을 주게 된다.Meanwhile, in the subfield including the rising ramp pulse in the reset period among the subfields of the frame, the slope ΔV / Δt of the setdown pulse supplied in the setdown period is set in the setdown period of the other subfields. It is equal to the slope of the down pulse. The greater the absolute value of the slope of the set down pulse supplied in this set down period, that is, the greater the rate of change in voltage per hour, the greater the amount of light generated in the set down period. This has a greater influence on the change of the optical waveform in the set down period.

특히, 프레임의 서브필드 중 리셋 기간의 셋업 기간에서 상승 램프 펄스를 포함하는 서브필드에서는 이러한 리셋 기간의 셋업 기간에서 공급되는 상승 램프 펄스에 의해 온(On) 셀 및 오프(Off) 셀 모두에서 방전이 발생한다. 이에 따라, 이러한 프레임의 서브필드 중 리셋 기간의 셋업 기간에서 상승 램프 펄스를 포함하는 서브필드에서는 셋 다운 기간에서 공급되는 셋 다운 펄스에 의해서도 온(On) 셀 및 오프(Off) 셀 모두에서 방전이 발생한다.Specifically, in a subfield including a rising ramp pulse in the setup period of the reset period among the subfields of the frame, discharge is performed in both the on and off cells by the rising ramp pulse supplied in the setup period of the reset period. This happens. Accordingly, in the subfield including the rising ramp pulse in the setup period of the reset period among the subfields of such a frame, discharge is generated in both the on and off cells by the set down pulse supplied in the set down period. Occurs.

결국, 전술한 바와 같이 프레임의 서브필드 중 리셋 기간의 셋업 기간에서 상승 램프 펄스를 포함하는 서브필드에서는 셋 다운 기간에서 공급되는 셋 다운 펄스의 기울기의 절대값이 커질수록 이러한 셋 다운 기간에서 발생하는 광의 양을 증가시켜 블랙 휘도를 상대적으로 크게 함으로써, 콘트라스트 특성을 악화시키는 문제점이 있다.As described above, in the subfield including the rising ramp pulse in the set-up period of the reset period among the subfields of the frame, the absolute value of the slope of the set-down pulse supplied in the set-down period increases in this set-down period. There is a problem that the contrast characteristics are deteriorated by increasing the amount of light to make the black luminance relatively large.

이러한 문제점을 해결하기 위해 본 발명은 리셋 기간의 스캔 전극으로 공급되는 셋 다운 펄스의 기울기를 조절하여 콘트라스트(Contrast) 특성을 향상시키는 플라즈마 디스플레이 장치 및 그의 구동 방법을 제공하는데 그 목적이 있다.SUMMARY OF THE INVENTION In order to solve this problem, an object of the present invention is to provide a plasma display device and a method of driving the same, which improve contrast characteristics by adjusting a slope of a set down pulse supplied to a scan electrode during a reset period.

상기한 목적을 이루기 위한 본 발명의 플라즈마 디스플레이 장치는 스캔 전극을 포함하는 플라즈마 디스플레이 패널과, 스캔 전극을 구동시키기 위한 스캔 구동부 및 스캔 구동부를 제어하여 하나 이상의 소정 서브필드의 리셋 기간의 셋 다운 기간에 인가되는 하강 램프(Ramp-Down) 펄스의 기울기를 소정 서브필드를 제외한 나머지 서브필드의 리셋 기간의 셋 다운 기간에 인가되는 하강 램프(Ramp-Down) 펄스의 기울기와 다르게 제어하는 셋 다운 펄스 제어부를 포함하는 것을 특징으로 한다.The plasma display apparatus of the present invention for achieving the above object is controlled in the set-down period of the reset period of the at least one predetermined subfield by controlling the plasma display panel including the scan electrode, the scan driver and the scan driver for driving the scan electrode A set-down pulse control unit for controlling the slope of the applied ramp-down pulse differently from the slope of the ramp-down pulse applied in the set-down period of the reset period of the remaining subfields except for the predetermined subfield. It is characterized by including.

또한, 셋 다운 펄스 제어부는 소정 서브필드의 리셋 기간의 셋 다운 기간에 인가되는 하강 램프(Ramp-Down) 펄스의 기울기의 절대값을 소정 서브필드를 제외한 나머지 서브필드의 리셋 기간의 셋 다운 기간에 인가되는 하강 램프(Ramp-Down) 펄스의 기울기의 절대값 보다 작도록 제어하는 것을 특징으로 한다.Further, the set down pulse controller controls the absolute value of the slope of the ramp-down pulse applied in the set down period of the reset period of the predetermined subfield to the set down period of the reset period of the remaining subfields except for the predetermined subfield. It characterized in that the control to be smaller than the absolute value of the slope of the applied ramp-down pulse (Ramp-Down) pulse.

또한, 셋 다운 펄스 제어부는 소정 서브필드의 리셋 기간의 셋 업 기간에 스캔 전극으로 상승 램프(Ramp-Up) 펄스를 포함하는 셋 업 펄스가 공급될 때, 셋 업 기간에 이어지는 리셋 기간의 셋 다운 기간에서 스캔 전극으로 공급되는 셋 다운 펄스에 포함된 하강 램프(Ramp-Down) 펄스의 기울기를 다른 서브필드보다 더 작도록 하는 것을 특징으로 한다.In addition, the set-down pulse controller controls the set-down of the reset period following the set-up period when the set-up pulse including the ramp-up pulse is supplied to the scan electrode in the set-up period of the reset period of the predetermined subfield. It is characterized in that the slope of the ramp-down pulse included in the set-down pulse supplied to the scan electrode in the period is smaller than the other subfields.

또한, 상기 소정의 서브필드는 한 프레임의 서브필드 중 첫 번째 서브필드인 것을 특징으로 한다.The predetermined subfield may be the first subfield among the subfields of one frame.

또한, 상기 소정의 서브필드는 한 프레임의 서브필드 중 계조 가중치가 가장 낮은 서브필드인 것을 특징으로 한다.The predetermined subfield may be a subfield having the lowest gray scale weight among the subfields of one frame.

또한, 상기 소정 서브필드의 리셋 기간의 셋 다운 기간에 인가되는 하강 램프 펄스의 기울기와 소정 서브필드를 제외한 나머지 서브필드의 리셋 기간의 셋 다운 기간에 인가되는 하강 램프 펄스의 기울기 차이는 0.1V/us이상인 것을 특징으로 한다.Further, the slope difference of the falling ramp pulse applied in the set down period of the reset period of the predetermined subfield and the falling ramp pulse applied in the set down period of the reset period of the remaining subfields except for the predetermined subfield is 0.1V /. It is characterized by more than us.

이하 첨부된 도면을 참조하여 본 발명의 플라즈마 디스플레이 장치 및 구동 방법의 실시 예들을 상세히 설명한다.Hereinafter, exemplary embodiments of the plasma display apparatus and the driving method will be described in detail with reference to the accompanying drawings.

도 5는 본 발명의 플라즈마 디스플레이 장치의 구조를 설명하기 위한 도이다.5 is a view for explaining the structure of the plasma display device of the present invention.

도 5에 도시된 바와 같이, 본 발명의 플라즈마 디스플레이 장치는 스캔 전극(Y1 내지 Yn) 및 서스테인 전극(Z)과, 스캔 전극 및 서스테인 전극(Z)과 교차하는 복수의 어드레스 전극(X1 내지 Xm)을 포함하고, 리셋 기간, 어드레스 기간 및 서스테인 기간에 어드레스 전극(X1 내지 Xm), 스캔 전극(Y1 내지 Yn) 및 서스테인 전극(Z)에 구동 펄스가 인가되는 적어도 하나 이상의 서브필드의 조합에 의하여 프레임으로 이루어지는 화상을 표현하는 플라즈마 디스플레이 패널(500)과, 플라즈마 디스플레이 패널(500)에 형성된 어드레스 전극들(X1 내지 Xm)에 데이터를 공급하기 위한 데이터 구동부(502)와, 스캔 전극들(Y1 내지 Yn)을 구동하기 위한 스캔 구동부(503)와, 공통전극인 서스테인 전극들(Z)을 구동하기 위한 서스테인 구동부(504)와, 플라즈마 디스플레이 패널(500) 구동 시 스캔 구동부(503)의 셋 다운 기간에서의 동작을 제어하기 위한 셋 다운 펄스 제어부(501)와, 각각의 구동부(502, 503, 504)에 필요한 구동전압을 공급하기 위한 구동전압 발생부(505)를 포함한다.As shown in FIG. 5, the plasma display apparatus of the present invention includes scan electrodes Y 1 to Yn and sustain electrodes Z, and a plurality of address electrodes X 1 to X that intersect the scan electrodes and sustain electrodes Z. As shown in FIG. Xm) and at least one subfield to which a driving pulse is applied to the address electrodes X 1 to Xm, the scan electrodes Y 1 to Yn, and the sustain electrode Z in the reset period, the address period and the sustain period. A combination of a plasma display panel 500 representing a frame-shaped image, a data driver 502 for supplying data to address electrodes X 1 to Xm formed in the plasma display panel 500, and a scan electrode s (Y 1 to Yn) and the scan driver 503 for driving the common electrode and the sustain driver 504 for driving the sustain electrodes (Z), a plasma display panel 500 is driven A set-down pulse controller 501 for controlling the operation of the scan driver 503 in the set-down period, and a drive voltage generator 505 for supplying a drive voltage necessary for each of the drivers 502, 503, 504. It includes.

여기서, 전술한 플라즈마 디스플레이 패널(500)은 전면 패널(미도시)과 후면 패널(미도시)이 일정한 간격을 두고 합착되고, 다수의 전극들 예를 들어, 스캔 전극(Y1 내지 Yn) 및 서스테인 전극(Z)을 포함하는 유지 전극이 복수 개 형성되고, 또한 스캔 전극들(Y1 내지 Yn) 및 서스테인 전극(Z)을 포함하는 유지 전극과 교차 되 게 어드레스 전극(X1 내지 Xm)이 형성된다.Here, the aforementioned plasma display panel 500 is bonded to the front panel (not shown) and the rear panel (not shown) at regular intervals, and a plurality of electrodes, for example, scan electrodes (Y 1 to Yn) and sustain. A plurality of sustain electrodes including the electrodes Z are formed, and the address electrodes X 1 to Xm are formed to intersect the sustain electrodes including the scan electrodes Y 1 to Yn and the sustain electrode Z. do.

데이터 구동부(502)에는 도시하지 않은 역 감마 보정회로, 오차확산회로 등에 의해 역 감마보정 및 오차확산된 후, 서브필드 맵핑 회로에 의해 각 서브필드에 맵핑된 데이터가 공급된다. 이러한 데이터 구동부(502)는 타이밍 컨트롤부(미도시)로부터의 데이터 타이밍 제어신호(CTRX)에 응답하여 데이터를 샘플링하고 래치한 다음, 그 데이터를 어드레스 전극들(X1 내지 Xm)에 공급하게 된다.The data driver 502 is subjected to inverse gamma correction and error diffusion by an inverse gamma correction circuit, an error diffusion circuit, and the like not shown, and then data mapped to each subfield is supplied by the subfield mapping circuit. The data driver 502 samples and latches data in response to a data timing control signal CTRX from a timing controller (not shown), and then supplies the data to the address electrodes X 1 to Xm. .

스캔 구동부(503)는 리셋 기간의 셋 업 기간 동안 셋업 펄스, 예컨대 상승 램프 파형(Ramp-up)을 스캔 전극들(Y1 내지 Yn)로 공급하고, 또한 셋 다운 펄스 제어부(501)의 제어 하에 리셋 기간의 셋 다운 기간 동안 하강 램프 파형(Ramp-down)을 스캔 전극들(Y1 내지 Yn)에 공급한다. 또한, 스캔 구동부(503)는 어드레스 기간 동안 스캔 전압(-Vy)의 스캔 펄스(Sp)를 스캔 전극들(Y1 내지 Yn)에 순차적으로 공급하고, 서스테인 구간 동안에는 서스테인 펄스(SUS)를 스캔전극 들(Y1 내지 Yn)에 공급한다.The scan driver 503 supplies a setup pulse, for example, a rising ramp waveform Ramp-up, to the scan electrodes Y 1 to Yn during the set up period of the reset period, and also under the control of the set down pulse controller 501. The falling ramp waveform Ramp-down is supplied to the scan electrodes Y 1 to Yn during the set down period of the reset period. In addition, the scan driver 503 sequentially supplies the scan pulse Sp of the scan voltage (-Vy) to the scan electrodes Y 1 to Yn during the address period, and supplies the sustain pulse SUS during the sustain period. To Y (Y 1 to Yn).

서스테인 구동부(504)는 타이밍 컨트롤부(미도시)의 제어 하에 셋 다운 기간 또는 어드레스 기간 중 하나 이상의 기간 동안 바이어스 전압(Vz)을 서스테인 전극(Z)들에 공급하고 서스테인 기간 동안 스캔 구동부(503)와 교대로 동작하여 서스테인 펄스(SUS)를 서스테인 전극(Z)들에 공급하게 된다.The sustain driver 504 supplies the bias voltage Vz to the sustain electrodes Z during at least one of a set down period or an address period under the control of a timing controller (not shown), and the scan driver 503 during the sustain period. It alternately operates to supply the sustain pulse SUS to the sustain electrodes Z.

셋 다운 펄스 제어부(501)는 리셋 기간의 셋 다운 기간에서 스캔 구동부 (503)의 동작 타이밍과 동기화를 제어하기 위한 타이밍 제어신호(CTRY)를 발생하고 그 타이밍 제어신호(CTRY)를 스캔 구동부(503)에 공급함으로써 스캔 구동부(503)를 제어한다. 특히, 전술한 셋 다운 펄스 제어부(501)는 전술한 스캔 구동부(503)를 제어하여, 한 프레임의 서브필드 중 하나 이상의 소정 서브필드의 리셋 기간의 셋 다운 기간에 인가되는 하강 램프(Ramp-Down) 펄스의 기울기를 소정 서브필드를 제외한 나머지 서브필드의 리셋 기간의 셋 다운 기간에 인가되는 하강 램프 펄스의 기울기와 다르게 한다.The set down pulse control unit 501 generates a timing control signal CTRY for controlling the operation timing and synchronization of the scan driver 503 in the set down period of the reset period, and transmits the timing control signal CTRY to the scan driver 503. ), The scan driver 503 is controlled. In particular, the set-down pulse controller 501 described above controls the scan driver 503 described above to apply the ramp down to the set-down period of the reset period of one or more predetermined subfields of one frame subfield. The slope of the pulse is different from the slope of the falling ramp pulse applied to the set-down period of the reset period of the remaining subfields except the predetermined subfield.

여기서, 더욱 바람직하게는 상술한 소정의 서브필드에 리셋 기간의 셋 업 기간에서 상승 램프(Ramp-up) 펄스가 공급될 때, 셋 업 기간에 이어지는 리셋 기간의 셋 다운 기간에서 스캔 전극으로 공급되는 셋 다운 펄스인 하강 램프(Ramp-Down) 펄스의 기울기의 절대값을 다른 서브필드보다 더 작도록 한다.Here, more preferably, when the ramp-up pulse is supplied to the predetermined subfield in the set-up period of the reset period, it is supplied to the scan electrode in the set-down period of the reset period following the set-up period. The absolute value of the slope of the ramp-down pulse, which is a set-down pulse, is smaller than other subfields.

한편, 전술한 데이터 제어신호(CTRX)에는 데이터를 샘플링하기 위한 샘플링 클럭, 래치 제어신호와 구동 스위치소자의 온/오프 타임을 제어하기 위한 스위치제어신호가 포함된다. 스캔 제어신호(CTRY)에는 스캔 구동부(503) 내의 에너지 회수회로와 구동 스위치소자의 온/오프 타임을 제어하기 위한 스위치제어신호가 포함되고, 서스테인 제어신호(CTRZ)에는 서스테인 구동부(504) 내의 에너지 회수회로와 구동 스위치소자의 온/오프 타임을 제어하기 위한 스위치제어신호가 포함된다.The data control signal CTRX described above includes a sampling clock for sampling data, a latch control signal, and a switch control signal for controlling on / off time of the driving switch element. The scan control signal CTRY includes an energy recovery circuit in the scan driver 503 and a switch control signal for controlling the on / off time of the driving switch element. The sustain control signal CTRZ includes the energy in the sustain driver 504. A switch control signal for controlling the on / off time of the recovery circuit and the drive switch element is included.

구동전압 발생부(505)는 셋업 전압(Vsetup), 스캔 기준 전압(Vscan), 스캔전압(-Vy), 서스테인 전압(Vs), 데이터전압(Vd) 등을 발생한다. 이러한 구동전압들은 방전가스의 조성이나 방전 셀 구조에 따라 변할 수 있다.The driving voltage generator 505 generates a setup voltage Vsetup, a scan reference voltage Vscan, a scan voltage -Vy, a sustain voltage Vs, a data voltage Vd, and the like. These driving voltages may vary depending on the composition of the discharge gas or the structure of the discharge cell.

이러한 구조의 본 발명의 플라즈마 디스플레이 장치의 구동은 이하의 본 발명의 플라즈마 디스플레이 패널의 구동방법의 설명을 통해 보다 명확히 될 것이다.The driving of the plasma display device of the present invention having such a structure will be more apparent through the following description of the driving method of the plasma display panel of the present invention.

도 6은 본 발명의 플라즈마 디스플레이 패널의 구동 방법의 일실시예를 설명하기 위한 도면이다.6 is a view for explaining an embodiment of a method of driving a plasma display panel of the present invention.

도 6을 살펴보면, 본 발명의 플라즈마 디스플레이 패널의 구동 방법의 일실시예는 프레임의 서브필드 중 하나 이상의 소정 서브필드의 리셋 기간의 셋 다운 기간에 인가되는 하강 램프(Ramp-Down) 펄스의 기울기가 전술한 소정 서브필드를 제외한 나머지 서브필드의 리셋 기간의 셋 다운 기간에 인가되는 하강 램프(Ramp-Down) 펄스의 기울기와 다르다. 여기서, 바람직하게는 전술한 소정 서브필드의 리셋 기간의 셋 다운 기간에 인가되는 하강 램프(Ramp-Down) 펄스의 기울기의 절대값이 소정 서브필드를 제외한 나머지 서브필드의 리셋 기간의 셋 다운 기간에 인가되는 하강 램프(Ramp-Down) 펄스의 기울기의 절대값 보다 작다.Referring to FIG. 6, in one embodiment of the method of driving a plasma display panel, a slope of a ramp-down pulse applied to a set-down period of a reset period of one or more predetermined subfields of one or more subfields of a frame is determined. It is different from the slope of a ramp-down pulse applied in the set-down period of the reset period of the remaining subfields except the above-described predetermined subfield. Here, preferably, the absolute value of the slope of the ramp-down pulse applied in the set down period of the reset period of the predetermined subfield is set in the set down period of the reset period of the remaining subfields except the predetermined subfield. It is less than the absolute value of the slope of the applied ramp-down pulse.

여기서, 셋 업 기간에 이어지는 리셋 기간의 셋 다운 기간에서 스캔 전극으로 공급되는 셋 다운 펄스에 포함된 하강 램프(Ramp-Down) 펄스의 기울기의 절대값이 다른 서브필드보다 더 작은 서브필드는, 프레임의 서브필드 중 리셋 기간의 셋 업 기간에 스캔 전극(Y)으로 상승 램프(Ramp-Up) 펄스를 포함하는 셋 업 펄스가 공급되는 서브필드인 것이 바람직하다. 다르게 표현하면, 프레임의 서브필드 중 리셋 기간의 셋 업 기간에 스캔 전극(Y)으로 상승 램프(Ramp-Up) 펄스를 포함하는 셋 업 펄스가 공급되는 서브필드에서는 리셋 기간의 셋 다운 기간에서 스캔 전극(Y)으로 공급되는 셋 다운 펄스에 포함된 하강 램프(Ramp-Down) 펄스의 기울기의 절대값을 다른 서브필드보다 더 작도록 한다.Herein, a subfield in which the absolute value of the slope of the ramp-down pulse included in the set-down pulse supplied to the scan electrode in the set-down period of the reset period following the set-up period is smaller than the other subfields is a frame. It is preferable that the subfield be a set-up pulse including a ramp-up pulse to the scan electrode Y in the set-up period of the reset period. In other words, in the subfield in which the setup pulse including the ramp-up pulse is supplied to the scan electrode Y in the setup period of the reset period among the subfields of the frame, the scan is performed in the setdown period of the reset period. The absolute value of the slope of the ramp-down pulse included in the set-down pulse supplied to the electrode Y is made smaller than other subfields.

여기서, 바람직하게는 전술한 바와 같이 리셋 기간의 셋 업 기간에 스캔 전극(Y)으로 상승 램프(Ramp-Up) 펄스를 포함하는 셋 업 펄스가 공급되는 서브필드는 프레임의 서브필드 중 계조 가중치가 가장 낮은 서브필드이다.Preferably, as described above, the subfield to which the set-up pulse including the ramp-up pulse is supplied to the scan electrode Y in the set-up period of the reset period has a gray scale weight among the subfields of the frame. It is the lowest subfield.

또한, 리셋 기간의 셋 업 기간에 스캔 전극(Y)으로 상승 램프(Ramp-Up) 펄스를 포함하는 셋 업 펄스가 공급되는 서브필드는 프레임의 서브필드 중 첫 번째 서브필드인 것이 바람직하다.In addition, the subfield to which the setup pulse including the ramp-up pulse is supplied to the scan electrode Y in the setup period of the reset period is preferably the first subfield of the subfield of the frame.

예를 들면, 도 6과 같이 프레임의 서브필드 중 제 1 서브필드에서 셋 다운 펄스의 기울기의 절대값의 크기가 다른 서브필드, 즉 제 2 서브필드로부터 제 8 서브필드까지의 서브필드에서의 셋 다운 펄스의 기울기의 절대값의 크기보다 더 작다.For example, as shown in FIG. 6, a subfield having a different magnitude of the absolute value of the slope of the set-down pulse in the first subfield of the frame, that is, a set in the subfield from the second subfield to the eighth subfield. It is smaller than the magnitude of the absolute value of the slope of the down pulse.

이와 같이, 프레임의 서브필드 중 하나 이상의 서브필드에서 셋 다운 기간에 공급되는 셋 다운 펄스의 기울기의 절대값을 다른 서브필드보다 작게, 즉 기울기를 완만하게 하는 이유는, 이러한 셋 다운 펄스의 기울기의 절대값이 작을수록 시간당 전압 변화율이 작게되어 셋 다운 기간에서 발생하는 광의 양을 감소시킴으로써 콘트라스트 특성을 개선하기 위해서이다. 이와 같이 셋 다운 펄스의 기울기의 절대값이 작을수록, 즉 기울기가 완만할수록 셋 다운 기간에서 발생하는 광의 양이 감소하는 이유에 대해서는 이후의 도 7의 설명에서 보다 명확히 한다.As such, the reason for making the absolute value of the slope of the set down pulse supplied in the set down period in one or more of the subfields of the frame smaller than other subfields, i.e., make the slope gentle, is due to the slope of the set down pulse. The smaller the absolute value is, the smaller the rate of change of the voltage per hour is to improve the contrast characteristic by reducing the amount of light generated in the set-down period. As described above, the reason why the amount of light generated in the set-down period decreases as the absolute value of the slope of the set-down pulse is smaller, that is, when the slope is gentle, will be clarified in the following description of FIG. 7.

또한, 프레임의 서브필드 중 리셋 기간의 셋업 기간에서 상승 램프 펄스가 공급되는 서브필드에서만 셋 다운 펄스의 기울기의 절대값을 작게, 즉 기울기를 완 만하게 하는 이유는, 프레임의 서브필드 중 리셋 기간의 셋업 기간에서 상승 램프 펄스가 공급되지 않는 서브필드에서는 리셋 기간에서 공급되는 리셋 펄스가 어드레스 방전에 의해 선택되지 않은 오프(Off) 방전 셀에서 방전을 일으킬 만큼의 전압 값을 갖지 않으므로, 이러한 리셋 펄스의 셋 다운 펄스에 의해 셋 다운 기간에서 발생하는 광의 양이 상대적으로 적어 콘트라스트 특성의 악화에 기여하는 정도가 상대적으로 약하기 때문에, 전술한 바와 같이 프레임의 서브필드 중 리셋 기간의 셋업 기간에서 상승 램프 펄스가 공급되는 서브필드에서만 셋 다운 펄스의 기울기의 절대값을 작게, 즉 기울기를 완만하게 하는 것이다.In addition, the reason why the absolute value of the slope of the set-down pulse is small, that is, the slope is gentle only in the subfield to which the rising ramp pulse is supplied in the setup period of the reset period among the subfields of the frame is because In the subfield in which the rising ramp pulse is not supplied in the setup period, the reset pulse supplied in the reset period does not have a voltage value sufficient to cause a discharge in an off discharge cell not selected by the address discharge. Since the amount of light generated in the set-down period by the set-down pulse is relatively small, which contributes to the deterioration of the contrast characteristic, the rising ramp pulse is generated in the setup period of the reset period among the subfields of the frame as described above. The absolute value of the slope of the set down pulse is made small, i.e. only in the subfield to be supplied. To have a gentler cry.

또한, 여기서 프레임의 서브필드 중 리셋 기간의 셋 업 기간에 스캔 전극(Y)으로 상승 램프(Ramp-Up) 펄스를 포함하는 셋 업 펄스가 공급되는 서브필드에서는 리셋 기간의 셋 다운 기간에서 스캔 전극(Y)으로 공급되는 셋 다운 펄스에 포함된 하강 램프(Ramp-Down) 펄스의 기울기의 절대값과 다른 서브필드의 하강 램프 펄스의 기울기의 절대값의 차이는 0.1V/us이상 이도록 하여 효과를 보다 향상시킬 수 있다. 즉, 프레임의 서브필드 중 리셋 기간의 셋업 기간에서 상승 램프 펄스가 공급되는 서브필드의 셋 다운 펄스의 기울기의 절대값은 다른 서브필드의 셋 다운 펄스의 기울기의 절대값보다 0.1V/us이상 더 작은 것이다.In addition, in the subfield in which the setup pulse including the ramp-up pulse is supplied to the scan electrode Y in the setup period of the reset period among the subfields of the frame, the scan electrode in the setdown period of the reset period The difference between the absolute value of the slope of the ramp-down pulse included in the set down pulse supplied to (Y) and the absolute value of the slope of the ramp ramp of the other subfield is 0.1 V / us or more. It can improve more. That is, the absolute value of the slope of the set down pulse of the subfield to which the rising ramp pulse is supplied in the setup period of the reset period among the subfields of the frame is 0.1 V / us or more than the absolute value of the slope of the set down pulse of the other subfield. It is small.

이러한 도 6과 같이 종래에 비해 리셋 기간 중 셋 다운 기간에서의 기울기의 변화로 광파형의 변화를 개선 시키는 것을 도 7을 참조하여 보다 상세히 살펴보면 다음과 같다.Referring to FIG. 7, the change in the optical waveform is improved by changing the inclination in the set-down period during the reset period as shown in FIG. 6.

도 7은 도 6의 본 발명의 플라즈마 디스플레이 패널의 구동 방법에 따라 나 타난 광 파형을 도 4의 종래 구동 파형에 따라 나타난 광 파형과 비교하기 위한 도면이다.FIG. 7 is a diagram for comparing an optical waveform shown according to the driving method of the plasma display panel of the present invention of FIG. 6 with an optical waveform shown according to the conventional driving waveform of FIG. 4.

도 7을 살펴보면, (a)는 종래의 도 4의 구동 파형의 셋 다운 펄스에 의한 광 파형이고, (b)는 본 발명의 도 6에서의 서브필드 중 리셋 기간의 셋업 기간에서 상승 램프 펄스가 공급되는 서브필드, 즉 제 1 서브필드의 셋 다운 펄스에 의한 광 파형을 나타낸 것이다.Referring to FIG. 7, (a) is an optical waveform generated by a set down pulse of the conventional drive waveform of FIG. 4, and (b) shows a rising ramp pulse in a setup period of a reset period among subfields of FIG. The optical waveform of the set-down pulse of the supplied subfield, that is, the first subfield, is shown.

여기서, (a)를 살펴보면 (b)에 비해 셋 다운 펄스의 기울기의 절대값이 더 크다. 즉, 기울기가 더 급하다. 이는 시간당 전압변화율이 크게 되어 셋 다운 펄스가 하강 하기 시작하는 시점에서 상대적으로 많은 양의 광이 발생되고, 또한 셋 다운 기간 전체에서 발생하는 광의 양이 상대적으로 많게 된다. 이러한 (a)와 같은 경우는 광 파형의 변화를 불안정하게 하여 블랙 휘도를 상대적으로 증가시킴으로써, 콘트라스트 특성을 악화시키는 경우이다.Here, looking at (a), the absolute value of the slope of the set-down pulse is larger than (b). That is, the slope is more urgent. This causes a relatively large amount of light to be generated at the time when the set-down pulse starts to fall due to a large rate of change in voltage per hour, and a relatively large amount of light is generated throughout the set-down period. Such a case (a) is a case where the contrast characteristic is deteriorated by making the change of the optical waveform unstable and relatively increasing the black luminance.

한편, (b)의 경우는 (a)에 비해 셋 다운 펄스의 기울기의 절대값이 더 작다. 즉, 기울기가 더 완만하다. 이러한 (b)에서는 시간당 전압변화율이 작게 되어 셋 다운 펄스가 하강 하기 시작하는 시점에서도 상대적으로 적은 양의 광이 발생되고, 또한 셋 다운 기간 전체에서 발생하는 광의 양이 상대적으로 적게 된다. 이에 따라 (b)에서와 같이 광 파형의 변화가 안정하게 되어 블랙 휘도를 상대적으로 감소시킴으로써, 콘트라스트 특성이 향상된다.On the other hand, in the case of (b), the absolute value of the slope of the set-down pulse is smaller than that of (a). That is, the slope is more gentle. In (b), the rate of change in voltage per hour is small, so that a relatively small amount of light is generated even when the set-down pulse starts to fall, and the amount of light generated in the entire set-down period is relatively small. As a result, as shown in (b), the change in the optical waveform is stabilized and the black luminance is relatively decreased, thereby improving the contrast characteristic.

이와 같이, 상술한 본 발명의 기술적 구성은 본 발명이 속하는 기술분야의 당업자가 본 발명의 그 기술적 사상이나 필수적 특징을 변경하지 않고서 다른 구체 적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다.As such, the technical configuration of the present invention described above can be understood by those skilled in the art that the present invention can be implemented in other specific forms without changing the technical spirit or essential features of the present invention.

그러므로 이상에서 기술한 실시예들은 모든 면에서 예시적인 것이며 한정적인 것이 아닌 것으로서 이해되어야 하고, 본 발명의 범위는 전술한 상세한 설명보다는 후술하는 특허청구범위에 의하여 나타내어지며, 특허청구범위의 의미 및 범위 그리고 그 등가개념으로부터 도출되는 모든 변경 또는 변형된 형태가 본 발명의 범위에 포함되는 것으로 해석되어야 한다.Therefore, the exemplary embodiments described above are to be understood as illustrative and not restrictive in all respects, and the scope of the present invention is indicated by the appended claims rather than the foregoing detailed description, and the meaning and scope of the claims are as follows. And all changes or modifications derived from the equivalent concept should be interpreted as being included in the scope of the present invention.

이상에서 상세히 설명한 바와 같이, 본 발명은 한 프레임의 서브필드 중 리셋 기간의 셋 업 기간에 스캔 전극으로 상승 램프(Ramp-Up) 펄스를 포함하는 셋 업 펄스가 공급되는 서브필드에서는 리셋 기간의 셋 다운 기간에서 스캔 전극으로 공급되는 셋 다운 펄스에 포함된 하강 램프(Ramp-Down) 펄스의 기울기의 절대값을 다른 서브필드보다 더 작도록 함으로써 콘트라스트 특성을 향상시키는 효과가 있다.As described in detail above, the present invention provides a set of reset periods in a subfield in which a setup pulse including a ramp-up pulse is supplied to a scan electrode in a set-up period of a reset period among subfields of one frame. The absolute value of the slope of the ramp-down pulse included in the set-down pulse supplied to the scan electrode in the down period is smaller than other subfields, thereby improving contrast characteristics.

Claims (6)

스캔 전극을 포함하는 플라즈마 디스플레이 패널;A plasma display panel including a scan electrode; 상기 스캔 전극을 구동시키기 위한 스캔 구동부; 및A scan driver for driving the scan electrode; And 상기 스캔 구동부를 제어하여 하나 이상의 소정 서브필드의 리셋 기간의 셋 다운 기간에 인가되는 하강 램프(Ramp-Down) 펄스의 기울기를 상기 소정 서브필드를 제외한 나머지 서브필드의 리셋 기간의 셋 다운 기간에 인가되는 하강 램프(Ramp-Down) 펄스의 기울기와 다르게 제어하는 셋 다운 펄스 제어부를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 장치.By controlling the scan driver, a slope of a ramp-down pulse applied to the set-down period of the reset period of one or more predetermined subfields is applied to the set-down period of the reset period of the remaining subfields except the predetermined subfield. And a set down pulse controller configured to control the slope of the ramp-down pulse different from the slope of the ramp-down pulse. 제 1 항에 있어서,The method of claim 1, 상기 셋 다운 펄스 제어부는 상기 소정 서브필드의 리셋 기간의 셋 다운 기간에 인가되는 하강 램프(Ramp-Down) 펄스의 기울기의 절대값을 상기 소정 서브필드를 제외한 나머지 서브필드의 리셋 기간의 셋 다운 기간에 인가되는 하강 램프(Ramp-Down) 펄스의 기울기의 절대값 보다 작도록 제어하는 것을 특징으로 하는 플라즈마 디스플레이 장치.The set down pulse control unit sets the absolute value of the slope of the ramp-down pulse applied in the set down period of the reset period of the predetermined subfield to the set down period of the reset period of the remaining subfields except the predetermined subfield. Plasma display device characterized in that it is controlled to be smaller than the absolute value of the slope of the ramp-down pulse applied to. 제 1 항에 있어서,The method of claim 1, 상기 셋 다운 펄스 제어부는The set down pulse controller is 상기 소정 서브필드의 리셋 기간의 셋 업 기간에 상기 스캔 전극으로 상승 램프(Ramp-Up) 펄스를 포함하는 셋 업 펄스가 공급될 때, 상기 셋 업 기간에 이어지는 상기 리셋 기간의 셋 다운 기간에서 상기 스캔 전극으로 공급되는 셋 다운 펄스에 포함된 하강 램프(Ramp-Down) 펄스의 기울기의 절대값을 다른 서브필드보다 더 작도록 하는 것을 특징으로 하는 플라즈마 디스플레이 장치.When a set-up pulse including a ramp-up pulse is supplied to the scan electrode in the set-up period of the reset period of the predetermined subfield, in the set-down period of the reset period following the set-up period, And an absolute value of a slope of a ramp-down pulse included in the set-down pulse supplied to the scan electrode is smaller than other subfields. 제 3 항에 있어서,The method of claim 3, wherein 상기 소정의 서브필드는 한 프레임의 서브필드 중 첫 번째 서브필드인 것을 특징으로 하는 플라즈마 디스플레이 장치.And the predetermined subfield is the first subfield among the subfields of one frame. 제 3 항에 있어서,The method of claim 3, wherein 상기 소정의 서브필드는 한 프레임의 서브필드 중 계조 가중치가 가장 낮은 서브필드인 것을 특징으로 하는 플라즈마 디스플레이 장치.And the predetermined subfield is a subfield having the lowest gray scale weight among the subfields of one frame. 제 1 항 내지 제 3 항 중 어느 한 항에 있어서,The method according to any one of claims 1 to 3, 상기 소정 서브필드의 리셋 기간의 셋 다운 기간에 인가되는 하강 램프 펄스의 기울기와 상기 소정 서브필드를 제외한 나머지 서브필드의 리셋 기간의 셋 다운 기간에 인가되는 하강 램프 펄스의 기울기 차이는 0.1V/us이상인 것을 특징으로 하는 플라즈마 디스플레이 장치.The slope difference of the falling ramp pulse applied in the set down period of the reset period of the predetermined subfield and the falling ramp pulse applied in the set down period of the reset period of the remaining subfields except for the predetermined subfield are 0.1 V / us. The above is a plasma display apparatus characterized by the above-mentioned.
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