KR20060003166A - 자동 전력 제어가 효율적으로 수행되는 방전 디스플레이장치 - Google Patents

자동 전력 제어가 효율적으로 수행되는 방전 디스플레이장치 Download PDF

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Abstract

본 발명에 따른 방전 디스플레이 장치에서는 단위 프레임이 복수의 서브필드들로 시분할된다. 서브필드들 각각은 어드레싱 및 유지-방전 주기를 포함한다. 어드레싱 주기에서는 선택된 디스플레이 셀들에서 설정 벽전압이 발생된다. 유지-방전 주기에서는 어드레싱 주기에서 설정 벽전압이 발생된 디스플레이 셀들에서 유지-방전이 일어난다. 또한, 유지-방전 주기는 단위 프레임의 평균 계조에 반비례한다. 여기에서, 유지-방전 주기가 단위 프레임의 평균 계조에 반비례함으로 인하여 단위 프레임에서 휴지 시간이 발생되는 경우, 휴지 시간이 어드레싱 주기에 포함된다.

Description

자동 전력 제어가 효율적으로 수행되는 방전 디스플레이 장치{Discharge display apparatus wherein automatic power control is efficiently performed}
도 1은 본 발명에 따른 방전 디스플레이 패널로서의 3-전극 면방전 방식의 플라즈마 디스플레이 패널의 구조를 보여주는 내부 사시도이다.
도 2는 도 1의 패널의 단위 셀의 구성을 보여주는 단면도이다.
도 3은 본 발명에 따른 방전 디스플레이 장치로서의 플라즈마 디스플레이 장치를 전체적으로 보여주는 블록도이다.
도 4는 도 3의 플라즈마 디스플레이 장치에서 수행되는 자동 전력 제어의 알고리듬을 보여주는 그래프이다.
도 5는 도 3의 플라즈마 디스플레이 장치에서 플라즈마 디스플레이 패널을 구동하는 방식을 보여주는 타이밍도이다.
도 6은 제N 프레임의 마지막 서브필드에서 도 1의 플라즈마 디스플레이 패널의 전극 라인들에 인가되는 신호들을 보여주는 파형도이다.
도 7은 제N+1 프레임의 제1 서브필드에서 도 1의 플라즈마 디스플레이 패널의 전극 라인들에 인가되는 신호들을 보여주는 파형도이다.
도 8은 도 6 및 7의 t5 시점에서의 어느 한 디스플레이 셀의 벽전하 분포를 보여주는 단면도이다.
도 9는 도 6 및 7의 t8 시점에서의 어느 한 디스플레이 셀의 벽전하 분포를 보여주는 단면도이다.
<도면의 주요 부분에 대한 부호의 설명>
1...플라즈마 디스플레이 패널, 10...앞쪽 글라스 기판,
11, 15...유전체층, 12...보호층,
13...뒤쪽 글라스 기판, 14...방전 공간,
16...형광체, 17...격벽,
X1, ..., Xn...X 전극 라인, Y1, ..., Yn...Y 전극 라인,
AR1, ..., ABm...어드레스 전극 라인, Xna, Yna...투명 전극 라인,
Xnb, Ynb...금속 전극 라인,
SF1, ...SF8, SF1, ...SF8...서브-필드,
52...제어부, 53...어드레스 구동부,
54...X 구동부, 55...Y 구동부,
56...영상 처리부,.
본 발명은, 방전 디스플레이 장치에 관한 것으로서, 보다 상세하게는, 단위 프레임이 복수의 서브필드들로 시분할되는 방전 디스플레이 장치에 관한 것이다.
통상적인 방전 디스플레이 장치 예를 들어, 플라즈마 디스플레이 장치에 있어서, 단위 프레임이 복수의 서브필드들로 시분할되어 디스플레이된다(미국 특허 제5,541,618호 참조). 각각의 서브필드에서는 리셋(reset), 어드레싱 (addressing), 및 유지-방전(display-sustain) 주기들이 순차적으로 진행된다. 리셋 주기에서는 모든 방전 셀들의 전하 상태들이 균일해진다. 어드레싱 주기에서는, 선택된 방전 셀들에 설정 벽전압이 생성된다. 유지-방전 주기에서는, 어드레싱 주기에서 설정 벽전압이 형성된 방전 셀들에서 유지-방전이 일어난다.
한편, 상기와 같은 방전 디스플레이 장치에 있어서, 상대적으로 높은 구동 전력이 사용되므로, 상기 유지-방전 주기가 단위 프레임의 평균 계조에 반비례하게 하는 자동 전력 제어가 수행된다. 이로 인하여, 단위 프레임에서 휴지 시간이 존재한다. 하지만, 상기 휴지 시간이 길어질수록 다음 프레임의 첫번째 서브필드에서 리셋 주기의 동작이 원활하게 수행되지 못하는 문제점이 있다.
본 발명의 목적은, 자동 전력 제어가 수행되면서도 주 구동 동작이 원활하게 수행될 수 있는 방전 디스플레이 장치를 제공하는 것이다.
상기 목적을 이루기 위한 본 발명의 방전 디스플레이 장치에서는 단위 프레임이 복수의 서브필드들로 시분할된다. 상기 서브필드들 각각은 어드레싱 및 유지 -방전 주기를 포함한다. 상기 어드레싱 주기에서는 선택된 디스플레이 셀들에서 설정 벽전압이 발생된다. 상기 유지-방전 주기에서는 상기 어드레싱 주기에서 설정 벽전압이 발생된 디스플레이 셀들에서 유지-방전이 일어난다. 또한, 상기 유지-방전 주기는 상기 단위 프레임의 평균 계조에 반비례한다. 여기에서, 상기 유지-방전 주기가 상기 단위 프레임의 평균 계조에 반비례함으로 인하여 상기 단위 프레임에서 휴지 시간이 발생되는 경우, 상기 휴지 시간이 상기 어드레싱 주기에 포함된다.
본 발명의 상기 방전 디스플레이 장치에 의하면, 자동 전력 제어에 의하여 발생되는 상기 휴지 시간이 상기 어드레싱 주기에 포함된다. 이에 따라, 상기 휴지 시간의 존재로 인하여 주 구동 동작이 제한됨을 방지할수 있을 뿐만 아니라, 상기 어드레싱 주기가 효율적으로 길어짐에 따라 상기 어드레싱 주기의 동작이 보다 안정화될 수 있다.
이하, 본 발명에 따른 바람직한 실시예가 상세히 설명된다.
도 1은 본 발명에 따른 방전 디스플레이 패널로서의 3-전극 면방전 방식의 플라즈마 디스플레이 패널의 구조를 보여준다. 도 2는 도 1의 패널의 한 셀의 예를 보여준다. 도 1 및 2를 참조하면, 본 발명에 따른 면방전 플라즈마 디스플레이 패널(1)의 앞쪽 및 뒤쪽 글라스 기판들(10, 13) 사이에는, 어드레스 전극 라인들(AR1, ..., ABm), 유전체층(11, 15), Y 전극 라인들(Y1, ..., Yn ), X 전극 라인들(X1, ..., Xn), 형광체(16), 격벽(17) 및 보호층으로서의 일산화마그네슘(MgO)층(12)이 마련되어 있다.
어드레스 전극 라인들(AR1, ..., ABm)은 뒤쪽 글라스 기판(13)의 앞쪽에 일정한 패턴으로 형성된다. 하부 유전체층(15)은 어드레스 전극 라인들(AR1, ..., ABm )의 앞쪽에서 전면(全面) 도포된다. 하부 유전체층(15)의 앞쪽에는 격벽(17)들이 어드레스 전극 라인들(AR1, ..., ABm)과 평행한 방향으로 형성된다. 이 격벽(17)들은 각 셀의 방전 영역을 구획하고 각 셀 사이의 광학적 간섭(cross talk)을 방지하는 기능을 한다. 형광체(16)는, 격벽(17)들 사이에 도포된다.
X 전극 라인들(X1, ..., Xn)과 Y 전극 라인들(Y1, ..., Yn)은 어드레스 전극 라인들(AR1, ..., ABm)과 직교되도록 앞쪽 글라스 기판(10)의 뒤쪽에 일정한 패턴으로 형성된다. 각 교차점은 상응하는 셀을 설정한다. 각 X 전극 라인(X1, ..., Xn )과 각 Y 전극 라인(Y1, ..., Yn)은 ITO(Indium Tin Oxide) 등과 같은 투명한 도전성 재질의 투명 전극 라인(도 2의 Xna, Yna)과 전도도를 높이기 위한 금속 전극 라인(도 2의 Xnb, Ynb)이 결합되어 형성된다. 앞쪽 유전체층(11)은 X 전극 라인들(X 1, ..., Xn)과 Y 전극 라인들(Y1, ..., Yn)의 뒤쪽에 전면(全面) 도포되어 형성된다. 강한 전계로부터 패널(1)을 보호하기 위한 보호층(12) 예를 들어, 일산화마그네슘(MgO)층은 앞쪽 유전체층(11)의 뒤쪽에 전면 도포되어 형성된다. 방전 공간(14)에는 플라즈마 형성용 가스가 밀봉된다.
도 3을 참조하면, 본 발명에 따른 방전 디스플레이 장치로서의 플라즈마 디스플레이 장치는 방전 디스플레이 패널로서의 플라즈마 디스플레이 패널(1), 영상 처리부(56), 제어부(52), 어드레스 구동부(53), X 구동부(54) 및 Y 구동부(55)를 포함한다. 방전 디스플레이 패널로서의 플라즈마 디스플레이 패널(1)의 구성은 도 1을 참조하여 설명된 바와 같다. 영상 처리부(56)는 외부 아날로그 영상 신호를 디지털 신호로 변환하여 내부 영상 신호 예를 들어, 각각 8 비트의 적색(R), 녹색(G) 및 청색(B) 영상 데이터, 클럭 신호, 수직 및 수평 동기 신호들을 발생시킨다.
제어부(52)는 영상 처리부(56)로부터의 내부 영상 신호에 따라 구동 제어 신호들(SA, SY, SX)을 발생시킨다. 어드레스 구동부(53)는, 제어부(52)로부터의 구동 제어 신호들(SA, SY, SX)중에서 어드레스 신호(SA)를 처리하여 디스플레이 데이터 신호를 발생시키고, 발생된 디스플레이 데이터 신호를 어드레스 전극 라인들에 인가한다. X 구동부(54)는 제어부(52)로부터의 구동 제어 신호들(SA, SY, SX )중에서 X 구동 제어 신호(SX)를 처리하여 X 전극 라인들에 인가한다. Y 구동부(55)는 제어부(52)로부터의 구동 제어 신호들(SA, SY, SX)중에서 Y 구동 제어 신호(S Y)를 처리하여 Y 전극 라인들에 인가한다.
도 4는 도 3의 플라즈마 디스플레이 장치에서 수행되는 자동 전력 제어의 알고리듬을 보여준다. 도 4를 참조하면, 각각의 서브필드에 할당된 계조 가중치에 비례하면서 각각의 프레임의 평균 신호 레벨(ASL)에 반비례하도록 각 프레임의 유 지-방전 주기로서의 유지-방전 펄스 수(NS)를 설정하여 방전 횟수 데이터(NS)를 출력한다.
이로 인하여 단위 프레임에서 휴지 시간이 발생되지만, 이 휴지 시간은 등분되어 다음 프레임의 서브필드들 각각의 어드레싱 주기들에 포함된다. 도 5 내지 7을 참고하면 휴지 시간이 존재하지 않음을 볼 수 있다. 따라서, 자동 전력 제어에 따른 휴지 시간의 존재로 인하여 주 구동 동작이 제한됨을 방지할수 있을 뿐만 아니라, 어드레싱 주기가 효율적으로 길어짐에 따라 어드레싱 주기의 동작이 보다 안정화될 수 있다.
도 5는 도 3의 플라즈마 디스플레이 장치에서 플라즈마 디스플레이 패널(1)을 구동하는 방식을 보여준다. 도 5를 참조하면, 모든 단위 프레임들 각각은 시분할 계조 디스플레이를 실현하기 위하여 8 개의 서브-필드들(SF1, ..., SF8)로 분할된다. 또한, 각 서브-필드(SF1, ..., SF8)는 리셋팅 주기(R1, ..., R8), 어드레싱 주기(A1, ..., A8), 및 유지-방전 주기(S1, ..., S8)로 분할된다.
모든 디스플레이 셀들의 방전 조건들은 각 리셋팅 주기(R1, ..., R8)에서 균일해지면서 동시에 다음 단계에서 수행될 어드레싱에 적합해지도록 된다.
각 어드레싱 주기(A1, ..., A8)에서는, 어드레스 전극 라인들(도 1의 AR1, ..., ABm)에 디스플레이 데이터 신호가 인가됨과 동시에 각 Y 전극 라인(Y1, ..., Yn)에 상응하는 주사 펄스가 순차적으로 인가된다. 이에 따라 주사 펄스가 인가되는 동안에 높은 레벨의 디스플레이 데이터 신호가 인가되면 상응하는 방전셀에서 어드레싱 방전에 의하여 벽전하들이 형성되며, 그렇지 않은 방전셀에서는 벽전하들이 형성되지 않는다.
각 유지-방전 주기(S1, ..., S8)에서는, 모든 Y 전극 라인들(Y1, ..., Yn)과 모든 X 전극 라인들(X1, ..., Xn)에 유지-방전용 펄스가 교호하게 인가되어, 상응하는 어드레싱 주기(A1, ..., A8)에서 벽전하들이 형성된 방전셀들에서 디스플레이 방전을 일으킨다. 따라서 플라즈마 디스플레이 패널의 휘도는 단위 프레임에서 차지하는 유지-방전 주기(S1, ..., S8)의 길이에 비례한다. 단위 프레임에서 차지하는 유지-방전 주기(S1, ..., S8)의 길이는 255T(T는 단위 시간)이다. 따라서 단위 프레임에서 한 번도 디스플레이되지 않은 경우를 포함하여 256 계조로써 디스플레이할 수 있다.
여기서, 제1 서브-필드(SF1)의 유지-방전 주기(S1)에는 20에 상응하는 시간(1T)이, 제2 서브-필드(SF2)의 유지-방전 주기(S2)에는 21에 상응하는 시간(2T)이, 제3 서브-필드(SF3)의 유지-방전 주기(S3)에는 22에 상응하는 시간(4T)이, 제4 서브-필드(SF4)의 유지-방전 주기(S4)에는 23에 상응하는 시간(8T)이, 제5 서브-필드(SF5)의 유지-방전 주기(S5)에는 24에 상응하는 시간(16T)이, 제6 서브-필드(SF6)의 유지-방전 주기(S6)에는 25에 상응하는 시간(32T)이, 제7 서브-필드(SF7)의 유지-방전 주기(S7)에는 26에 상응하는 시간(64T)이, 그리고 제8 서브-필드(SF8)의 유지-방 전 주기(S8)에는 27에 상응하는 시간(128T)이 각각 설정된다.
이에 따라, 8 개의 서브-필드들중에서 디스플레이될 서브-필드를 적절히 선택하면, 어느 서브-필드에서도 디스플레이되지 않는 0(영) 계조를 포함하여 모두 256 계조의 디스플레이가 수행될 수 있다.
도 6은 제N 프레임의 마지막 서브필드(SFN)에서 도 1의 플라즈마 디스플레이 패널(1)의 전극 라인들에 인가되는 신호들을 보여준다. 도 7은 제N+1 프레임의 제1 서브필드(SFN +1)에서 도 1의 플라즈마 디스플레이 패널(1)의 전극 라인들에 인가되는 신호들을 보여준다. 도 8은 도 6 및 7의 t5 시점에서의 어느 한 디스플레이 셀의 벽전하 분포를 보여준다. 도 9는 도 6 및 7의 t8 시점에서의 어느 한 디스플레이 셀의 벽전하 분포를 보여준다. 도 6 및 7에서 참조 부호 SAR1..ABm은 각 어드레스 전극 라인(도 1의 AR1, AG 1, ..., AGm, ABm)에 인가되는 구동 신호를, SX 1.. Xn은 X 전극 라인들(도 1의 X1, ...Xn)에 인가되는 구동 신호를, 그리고 SY 1 , ..., SYn은 각 Y 전극 라인(도 1의 Y1, ...Yn)에 인가되는 구동 신호를 가리킨다.
도 6 내지 9를 참조하여 단위 서브필드들(SFN,SFN +1)의 공통적인 동작 과정을 먼저 설명하면 다음과 같다.
단위 서브필드(SFN,SFN +1)의 리셋팅 시간(RN,RN +1)의 초기 시간(t1 ~ t2)에서 는, 먼저 X 전극 라인들(X1, ..., Xn)에 인가되는 전위가 접지 전위(VG )로부터 제1 전위(VS)까지 지속적으로 상승된다. 여기에서, Y 전극 라인들(Y1, ..., Yn )과 어드레스 전극 라인들(AR1, ..., ABm)에는 접지 전위(VG)가 인가된다. 이에 따라, X 전극 라인들(X1, ..., Xn)과 Y 전극 라인들(Y1, ..., Yn) 사이, 및 X 전극 라인들(X1, ..., Xn)과 어드레스 전극 라인들(A1, ..., Am) 사이에 약한 방전이 일어나면서 X 전극 라인들(X1, ..., Xn) 주위에 부극성의 벽전하들이 형성된다.
벽전하 축적 시간(t2 ~ t5)에서는, Y 전극 라인들(Y1, ..., Yn )에 인가되는 전위가 제1 전위(VS)로부터 제2 전위(V_PR)까지 지속적으로 상승된다. 여기에서, X 전극 라인들(X1, ..., Xn)과 어드레스 전극 라인들(AR1, ..., ABm )에는 접지 전위(VG)가 인가된다.
상기와 같은 벽전하 축적 시간(t2 ~ t5)에서는, Y 전극 라인들(Y1, ..., Yn)과 X 전극 라인들(X1, ..., Xn) 사이에 약한 방전이 일어나는 한편, Y 전극 라인들(Y1, ..., Yn)과 어드레스 전극 라인들(AR1, ..., ABm) 사이에 더욱 약한 방전이 일어난다. 여기에서, Y 전극 라인들(Y1, ..., Yn)과 어드레스 전극 라인들(AR1 , ..., ABm) 사이의 방전보다 Y 전극 라인들(Y1, ..., Yn)과 X 전극 라인들(X 1, ..., Xn) 사이의 방전이 더 강해지는 이유는, X 전극 라인들(X1, ..., Xn) 주위에 부극성의 벽 전하들이 형성되어 있었기 때문이다. 이에 따라, Y 전극 라인들(Y1, ..., Yn) 주위에는 부극성 벽전하들이 많이 형성되고, X 전극 라인들(X1, ..., Xn) 주위에는 정극성의 벽전하들이 형성되며, 어드레스 전극 라인들(AR1, ..., ABm) 주위에는 정극성의 벽전하들이 적게 형성된다(도 8 참조).
이어지는 전위 변환 시간(t5 ~ t6)에서는, Y 전극 라인들(Y1, ..., Y n)에 제1 전위(VS)가 인가됨과 동시에, X 전극 라인들(X1, ..., Xn)에도 제1 전위(V S)가 인가된다.
벽전하 배분 시간(t6 ~ t8)에서는, X 전극 라인들(X1, ..., Xn )에 인가되는 전위가 제1 전위(VS)로 유지되고, 어드레스 전극 라인들(AR1, ..., ABm )에 인가되는 전위가 접지 전위(VG)로 유지된 상태에서, Y 전극 라인들(Y1, ..., Yn)에 인가되는 전위가 제1 전위(VS)로부터 접지 전위(VG)보다 낮은 제5 전위(V_ PF )까지 지속적으로 하강된다.
상기와 같은 벽전하 배분 시간(t6 ~ t8)에서는, X 전극 라인들(X1, ..., Xn)과 Y 전극 라인들(Y1, ..., Yn) 사이의 약한 방전으로 인하여, Y 전극 라인들(Y 1, ..., Yn) 주위의 부극성의 벽전하들의 일부가 X 전극 라인들(X1, ..., Xn ) 주위로 이동한다(도 8 참조). 이에 따라, X 전극 라인들(X1, ..., Xn)의 벽전위(wall electric-potential)가 어드레스 전극 라인들(AR1, ..., ABm)의 벽전위보다 낮고 Y 전극 라인들(Y1, ..., Yn)의 벽전위보다 높아진다. 이에 따라, 이어지는 어드레싱 시간(A)에서 선택된 어드레스 전극 라인들과 Y 전극 라인 사이의 대향 방전에 요구되는 어드레싱 전압(VA-VSC _L)이 낮아질 수 있다. 한편, 모든 어드레스 전극 라인들(AR1, ..., ABm)에는 접지 전위(VG)가 인가되므로, 어드레스 전극 라인들(A R1, ..., ABm)은 X 전극 라인들(X1, ..., Xn)과 Y 전극 라인들(Y1, ..., Yn)에 대하여 방전을 수행하고, 이 방전으로 인하여 어드레스 전극 라인들(AR1, ..., ABm) 주위의 정극성의 벽전하들이 약간 소멸한다(도 9 참조).
한편, 어드레싱 시간(AN,AN +1)에서, 어드레스 전극 라인들(AR1 , ..., ABm)에 표시 데이터 신호가 인가되고, 접지 전위(VG)보다 낮은 제7 전위(VSC _H)로 바이어싱된 Y 전극 라인들(Y1, ..., Yn)에 제7 전위(VSC _H)보다 낮은 주사 전위(VSC _L)의 주사 신호가 순차적으로 인가됨에 따라, 원활한 어드레싱이 수행될 수 있다. 각 어드레스 전극 라인(AR1, ..., ABm)에 인가되는 표시 데이터 신호는 디스플레이 셀들을 선택할 경우에 정극성 어드레싱 전위(VA)가, 그렇지 않을 경우에 접지 전위(VG)가 인가된다. 이에 따라 주사 전위(VSC _L)의 주사 펄스가 인가되는 동안에 정극성 어드레싱 전위(VA)의 표시 데이터 신호가 인가되면 상응하는 디스플레이 셀에서 어드레싱 방 전에 의하여 벽전하들이 형성되며, 그렇지 않은 디스플레이 셀에서는 벽전하들이 형성되지 않는다. 여기에서, 보다 정확하고 효율적인 어드레싱 방전을 위하여, X 전극 라인들(X1, ...Xn)에 제1 전위(VS)가 유지된다.
이어지는 디스플레이-유지 시간(SN,SN +1)에서는, 모든 Y 전극 라인들(Y 1, ...Yn)과 X 전극 라인들(X1, ...Xn)에 제1 전위(VSH)의 디스플레이-유지 펄스들이 교호하게 인가되어, 상응하는 어드레싱 시간(A)에서 벽전하들이 형성된 디스플레이 셀들에서 디스플레이-유지를 위한 방전을 일으킨다.
도 6 및 7을 비교하면, 도 7의 제N+1 프레임의 제1 서브필드(SFN+1)의 어드레싱 주기(AN+1)가 도 6의 제N 프레임의 마지막 서브필드(SFN)의 어드레싱 주기(A N)보다 길다. 즉, 도 7의 어드레싱 주기(AN+1)에서의 주사 펄스폭(TSC)과 데이터 펄스폭(TAD)이 도 6의 어드레싱 주기(AN)의 것들에 비하여 길다. 그 이유는, 제N-1 프레임(미도시)의 평균 계조가 제N 프레임(그 마지막 서브필드가 도 6에 도시됨)의 평균 계조보다 낮아서, 제N 프레임의 서브필드(SFN)의 어드레싱 주기(AN)에 추가되는 휴지 시간이 제N+1 프레임의 서브필드(SFN +1)의 어드레싱 주기(AN+1)에 추가되는 휴지 시간보다 짧기 때문이다.
이상 설명된 바와 같이, 본 발명에 따른 방전 디스플레이 장치에 의하면, 자 동 전력 제어에 의하여 발생되는 휴지 시간이 어드레싱 주기에 포함된다. 이에 따라, 휴지 시간의 존재로 인하여 주 구동 동작이 제한됨을 방지할수 있을 뿐만 아니라, 어드레싱 주기가 효율적으로 길어짐에 따라 어드레싱 주기의 동작이 보다 안정화될 수 있다.
본 발명은, 상기 실시예에 한정되지 않고, 청구범위에서 정의된 발명의 사상 및 범위 내에서 당업자에 의하여 변형 및 개량될 수 있다.

Claims (3)

  1. 단위 프레임이 복수의 서브필드들로 시분할되는 방전 디스플레이 장치에 있어서,
    상기 서브필드들 각각이,
    선택된 디스플레이 셀들에서 설정 벽전압이 발생되는 어드레싱 주기, 및
    상기 어드레싱 주기에서 설정 벽전압이 발생된 디스플레이 셀들에서 유지-방전이 일어나는 유지-방전 주기를 포함하고,
    상기 유지-방전 주기가 상기 단위 프레임의 평균 계조에 반비례하며,
    상기 유지-방전 주기가 상기 단위 프레임의 평균 계조에 반비례함으로 인하여 상기 단위 프레임에서 휴지 시간이 발생되는 경우, 상기 휴지 시간이 상기 어드레싱 주기에 포함되는 방전 디스플레이 장치.
  2. 제1항에 있어서,
    어느 한 프레임에서의 상기 휴지 시간이 그 다음 프레임의 상기 어드레싱 주기에 포함되는 방전 디스플레이 장치.
  3. 제2항에 있어서,
    상기 어느 한 프레임에서의 상기 휴지 시간이 등분되어 상기 그 다음 프레임의 서브필드들의 어드레싱 주기들에 포함되는 방전 디스플레이 장치.
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