KR20040062046A - 액정표시장치 - Google Patents

Abstract

본 발명에 의한 액정표시장치는, 화상 표시부 및 패드부가 구비된 하부기판과; 상기 화상 표시부 외곽부에 상기 화상표시부를 둘러싸도록 형성된 실패턴과; 상기 패드부에 형성된 게이트 라인 및 데이터 라인과 게이트 패드 및 데이터 패드 사이에 접속된 게이트 링크 및 데이터 링크와; 상기 패드부 반대편의 화상 표시부 외곽부에 형성된 공통전극라인 및 더미라인과; 상기 실런트와 접촉되는 상기 게이트 링크 및 데이터 링크의 교차 영역에 소정 간격으로 형성된 홀로 구성된 것을 특징으로 한다.

이와 같은 본 발명에 의하면, 상부기판과 하부기판의 합착력이 향상되어 외부 충격에 의한 액정 누수 불량을 방지되며, 이에 따라 액정표시장치의 제조 수율이 향상되는 장점이 있다.

Description

액정표시장치{Liquid Crystal Display Device}

본 발명은 액정표시장치에 관한 것으로, 특히 상부기판과 하부기판과의 합착시 실런트와 하부기판과의 접착력이 향상되도록 하는 액정표시장치에 관한 것이다.

일반적으로 액정표시장치는 박막 트랜지스터가 배열된 기판인 하부기판과, 컬러필터가 인쇄된 상부기판으로 구성되며, 상기 상부기판과 하부기판 사이에는 액정이 위치한다.

좀 더 상세히 설명하면, 상기 상부기판과 하부기판이 마주보는 각 내측의 한쪽 면에는 공통전극을 형성하고, 다른 한쪽 면에는 화소전극을 형성한 후, 각 전극이 서로 대향 하도록 배열하여 상기 상부기판과 하부기판 사이의 간격에 액정을 주입시키고, 주입구를 봉합한다. 이에 상기 상부기판과 하부기판의 외측에 각각 편광판을 붙임으로써, 액정 패널이 완성된다.

또한, 상기 액정 패널의 광 투과량을 각 전극(화소전극, 공통전극)에 인가하는 전압으로 제어하고, 광 셔터(Shutter) 효과에 의해 문자/화상을 표시하게 된다.

도 1은 종래의 액정 패널의 구조를 개략적으로 나타낸 평면도이다.

도 1을 참조하면, 종래의 액정 패널(2)은 하부기판(4)과 상부기판(6)이 평행하게 대향 하도록 접합된 구조로서, 액정셀들이 매트릭스 형태로 배열된 화상표시부(8)와, 구동 IC들(미도시)과 화상표시부(8) 사이에 접속되는 게이트 패드(12) 및 데이터 패드(14)와, 게이트 패드(12) 및 데이터 패드(14)를 화상표시부(8)에 접속시키는 게이트 링크(34) 및 데이터 링크(16)와, 하부기판(4)과 상부기판(6)을 접합시키기 위해 화상표시부(8)의 외곽 테두리에 형성되는 실 패턴(10)을 포함하게 된다.

상기 화상표시부(8)에 있어서, 하부기판(4)에는 데이터 패드(14) 및 데이터 링크(16)를 경유하여 비디오신호가 인가되는 다수의 데이터 라인(13)들과, 게이트 패드(12) 및 게이트 링크(34)를 경유하여 게이트 신호가 인가되는 다수의 게이트 라인(11)들이 상호 교차되도록 배치된다. 그 교차부들마다 액정셀들이 위치하게 되고, 각 액정셀들에는 데이터 신호의 인가 여부를 스위칭하기 위한 박막 트랜지스터(Thin Film Transistor : 이하 'TFT')와, TFT에 접속되어 액정셀을 구동하는 화소전극이 형성되어진다.

또한, 상기 상부기판(6)에는 블랙 매트릭스에 의해 액정셀 별로 분리되어 형성된 적, 녹, 청색의 컬러필터들과, 컬러필터들의 표면에 형성된 공통 투명전극이 포함되어 있다. 이러한 상부기판 및 하부기판(6,4)은 스페이서(Spacer)에 의해 일정 간격 이격됨으로써 셀 갭(Gap)이 마련되고, 이셀 갭 영역은 상부기판(6)과 하부기판(4)의 합착시 액정이 주입될 액정층을 형성하게 된다.

이러한 상부기판(6)과 하부기판(4)은 화상표시부(8) 외곽의 실 패턴(10)에도포된 실런트(Sealant)에 의해 접합된다. 스페이서에 의해 이격된 상부기판(6)과 하부기판(4) 사이의 액정층에는 액정이 주입된 후 봉지된다.

또한, 상기 게이트 패드(12)와 데이터 패드(14)는 상부기판(6)과 중첩되지 않는 하부기판(4)의 가장자리영역에 형성되며, 상기 게이트 패드(12)는 TCP 필름 내의 배선 라인을 통해 게이트 구동 IC로부터 공급되는 주사 신호를 게이트 링크(34)를 경유하여 화상표시부(8)의 게이트라인(11)들에 공급한다. 또한, 상기 데이터 패드(14)는 데이터 구동 IC로부터 공급되는 비디오 데이터 신호를 데이터 링크(16)를 경유하여 화상표시부(8)의 데이터라인(13)들에 공급한다.

이러한 구조를 갖는 액정 패널(2)에서 하부기판(6)에는 액정으로부터 금속전극라인과 박막 트랜지스터를 보호하기 위한 보호막이 전면 도포 되어 있다. 상기 보호막 위에는 콘택홀을 통해 액정셀의 박막 트랜지스터에 접속되는 화소전극이 액정셀 별로 형성되게 된다. 상기 화소전극은 인듐-틴-옥사이드(Indium Tin Oxide; 이하 'ITO')로 이루어진 투명전극으로서 액정 물질에 대해 비교적 강한 내구적 특성을 나타낸다.

여기서, 종래에는 보호막으로서 SiNx, SiOx와 같은 무기 절연막을 주로 이용하였으나, 종래의 액정패널에서는 무기 보호막의 유전율이 크기 때문에 무기 보호막을 사이에 둔 화소전극과 데이터라인(13) 간에 형성된 기생 커패시터에 의한 커플링 효과가 증가되는 문제점을 가지고 있었다.

이로 인해 무기 보호막을 사용하는 경우에는 이러한 커플링 효과를 최소화하기 위하여 화소전극과 데이터라인(13)이 중첩되지 않도록 비교적 긴 간격, 예컨대3??5㎛의 간격을 유지해야만 하였다. 이에 따라, 종래의 액정패널에서는 액정층에 전압을 인가하는 화소전극의 면적을 되도록 좁게 형성하여야만 하였고, 화소전극의 면적에 따라 좌우되는 액정셀의 개구율이 그 만큼 낮아질 수밖에 없었다.

이러한 문제를 해결하기 위하여, 최근에는 BCB(Benzocyclobutene), SOG(Spin On Glass), Acryl 등과 같이 비교적 유전율이 낮은 유기 물질을 보호막으로 이용하게 되었다. 이러한 유기 보호막은 약 2.7 정도의 낮은 유전율을 가짐에 따라 화소전극과 데이터라인을 어느 정도 중첩 시키는 것이 가능해졌고, 이에 따라 그 만큼 화소전극의 면적을 넓힘으로써 액정셀의 개구율을 향상시킬 수 있게 되었다.

상기 유기 보호막을 적용한 고개구율 액정표시소자에서는 실 패턴(10)에 도포되는 실런트를 이용하여 상부기판(6)과 하부기판(4)을 합착하는 과정에 있어서, 실런트가 하부기판(4)의 유기 보호막과 접촉되게 된다.

그러나, 에폭시 수지 등이 주로 이용되는 상기 실런트는 유리 및 종래의 무기 보호막과는 강한 접착 특성을 갖는 반면에 유기 보호막과는 약한 접착 특성을 가지고 있다. 이로 인하여, 유기 보호막을 적용한 고개구율 액정표시소자에서는 액정패널에 충격이 가해졌을 경우 실런트와 유기 보호막 간의 접착력이 양호하지 않은 실 패턴(10)을 통해 액정이 누수되는 문제점이 초래되고 있다.

아울러 유기 보호막은 그 하부에 형성된 게이트 절연막과도 양호하지 않은 접착 특성을 가지고 있다. 이에 따라 작은 충격에도 유기 보호막과 게이트 절연막 사이에서 쉽게 균열이 발생하여 유기 보호막이 들뜨거나 액정이 누수되는 등의 문제가 초래되고 있다.

이하, 첨부도면을 참조하여 종래의 액정표시장치의 문제점을 상세히 살펴보기로 한다.

도 2는 도 1에서 데이터 링크와 실 패턴의 교차 부분을 확대하여 도시한 평면도이다.

도 2를 참조하면, 도 2에서 데이터 링크(16)는 데이터패드(14) 및 화상표시부(8)의 데이터 라인(13)이 형성될 때 함께 형성된다. 데이터 링크(16)의 하부에는 반도체층(18)이 데이터 라인(13)으로부터 데이터 패드(14)까지 연장되어 형성된다. 단, 상기 반도체층(18)이 상기 영역에 형성되는 것은 상기 하부기판을 4마스크로 제조하는 경우에 의하며, 5마스크로 제조하는 경우는 상기 데이터 링크(16) 하부에 상기 반도체층(18)이 형성되지 않을 수 있다.

또한, 실런트가 도포되는 실 패턴(10)는 유기 보호막 상에서 데이터링크(16)를 가로지르는 방향으로 형성된다. 상기 데이터 패드(14)는 유기 보호막에 형성되는 컨택홀(19)을 통해 유기보호막 상의 투명전극(17)에 접속된다. 이 때 TCP 필름에 실장된 데이터 드라이버 IC에 접속되는 투명전극(17)은 TAB 과정에서 요구되는 TCP 필름의 접착 과정 반복 시에 데이터 패드(14)인 금속전극을 보호함과 아울러 금속전극의 산화를 방지하는 역할을 한다.

도 3a 및 도 3b는 도 2에서 A-A' 선을 따라 절단한 액정패널의 수직 단면도 및 B-B' 선을 따라 절단한 액정패널의 수직 단면도이다.

도 3a 및 도 3b를 참조하면, 하부기판(4)은 하부 유리기판(20) 상에 게이트 절연막(22), 반도체층(18) 및 데이터 링크(16)가 적층되어 형성되고, 그 위에 유기보호막(24)이 전면 도포된 구조를 갖는다. 또한, 상부기판(6)은 상부 유리기판(30)의 배면에 컬러필터 및 블랙 매트릭스(28)가 형성되고, 그 위에 공통 투명전극(26)이 전면 형성된 구조를 갖는다. 이러한 하부기판(4)과 상부기판(6)은 실 패턴(10)에 도포된 실런트에 의해 합착된다. 이 경우, 실 패턴(10)의 실런트가 유기 보호막(24)에 접촉됨으로 인하여 약한 접착력을 갖게 된다. 아울러, 유기 보호막(24)은 그 하부에 무기 물질로 형성된 게이트절연막(22)과도 접착 특성이 취약하여 외부 충격에 의해 균열이 발생하는 경우 유기 보호막(24)이 들뜨거나 액정(32)이 누출되는 현상이 초래된다. 도 3b에서 실 패턴(10)의 안쪽은 화상표시부(8)로서 액정(32)이 주입되어 있다.

도 4는 도 1에서 실 패턴와 교차하는 게이트 링크의 일부분을 확대하여 도시한 평면도이다.

도 4에서 게이트 링크(34)는 게이트 패드(12) 및 화상표시부(8)의 게이트라인(11)이 형성될 때 함께 형성된다. 상기 게이트 패드(12)는 게이트 절연막과 유기 보호막에 형성된 컨택홀(19)을 통해 투명전극(17)에 접속된다. 상기 실런트가 도포되는 실 패턴(10)은 상기 게이트 링크(34)와 교차하는 방향으로 형성된다.

도 5a 및 도 5b는 도 4에서 A-A' 선을 따라 절단한 액정패널의 수직 단면도 및 B-B' 선을 따라 절단한 액정패널의 수직 단면도이다.

도 5a 및 도 5b에서 하부기판(4)은 하부 유리기판(20) 상에 게이트 링크(34)와 게이트 절연층(22)이 순차적으로 적층되고, 그 위에 유기 보호막(24)이 전면 도포된 구조를 갖는다. 또한 상부기판(6)은 상부 유리기판(30) 상에 컬러필터 및 블랙 매트릭스(28)가 형성되고, 그 위에 공통 투명전극(26)이 전면 형성된 구조를 갖는다. 하부기판(4)과 상부기판(6)은 실 패턴(10)에 도포된 실런트에 의해 합착된다.

이 경우도 마찬가지로 실 패턴(10)의 실런트가 유기 보호막(24)에 접착됨으로 인하여 약한 접착력을 갖게 된다.

또한, 상기 데이터 및 게이트 패드부 외에 상기 실 패턴이 형성되는 영역 즉, 상기 화상표시부의 외곽부에 있어서도 상기 실 패턴(10)의 실런트가 유기 보호막(24)에 접착됨으로 인하여 약한 접착력을 갖게 되는 단점이 있다.

결과적으로, 종래의 유기 보호막이 적용된 고개구율 액정패널은 실런트와 유기보호막, 그리고 유기보호막과 게이트 절연막 간의 약한 접착력으로 인해 외부 충격이 가해질 경우 균열이 발생하여 액정이 누수되는 문제점이 초래되고 있다.

본 발명은 실 패턴을 형성하는 실런트와 접촉되는 하부기판 영역에 있어서 상기 실런트와의 접촉 면적을 넓히기 위하여 상기 영역에 소정 간격으로 홀을 형성함으로써 상기 실 패턴과 하부기판 간의 접착력이 향상되는 액정표시장치를 제공함에 그 목적이 있다.

도 1은 종래의 액정 패널의 구조를 개략적으로 나타낸 평면도.

도 2는 도 1에서 데이터 링크와 실 패턴의 교차 부분을 확대하여 도시한 평면도.

도 3a 및 도 3b는 도 2에서 A-A' 선을 따라 절단한 액정패널의 수직 단면도 및 B-B' 선을 따라 절단한 액정패널의 수직 단면도.

도 4는 도 1에서 실 패턴와 교차하는 게이트 링크의 일부분을 확대하여 도시한 평면도.

도 5a 및 도 5b는 도 4에서 A-A' 선을 따라 절단한 액정패널의 수직 단면도 및 B-B' 선을 따라 절단한 액정패널의 수직 단면도.

도 6은 본 발명에 의한 액정표시장치의 하부기판을 개략적으로 나타낸 평면도.

도 7은 도 6의 특정영역(A-A')을 포함한 액정패널의 단면도.

도 8a 및 도 8b는 도 6의 특정부분(B-B')에 대한 확대 평면도 및 이를 포함한 액정 패널의 단면도.

도 9는 본 발명의 다른 실시예에 의한 액정 패널의 단면도(B-B').

<도면의 주요 부분에 대한 부호의 설명>

54 : 실 패턴 56 : 홀

72 : 하부 유리기판 73, 73' : 게이트 금속

74 : 게이트 절연막 79, 79' : 반도체층

78 : 유기절연막

상기 목적을 달성하기 위하여 본 발명에 의한 액정표시장치는, 화상 표시부 및 패드부가 구비된 하부기판과; 상기 화상 표시부 외곽부에 상기 화상표시부를 둘러싸도록 형성된 실패턴과; 상기 패드부에 형성된 게이트 라인 및 데이터 라인과게이트 패드 및 데이터 패드 사이에 접속된 게이트 링크 및 데이터 링크와; 상기 패드부 반대편의 화상 표시부 외곽부에 형성된 공통전극라인 및 더미라인과; 상기 실런트와 접촉되는 상기 게이트 링크 및 데이터 링크의 교차 영역에 소정 간격으로 형성된 홀로 구성된 것을 특징으로 한다.

또한, 상기 공통전극라인 상부 영역에 특정패턴의 반도체층이 개재되어 있고,상기 홀에 의해 상기 실런트가 상기 하부기판의 유리기판과 직접 접촉됨을 특징으로 한다.

또한, 상기 홀은 상기 공통전극라인 및 더미라인의 상부영역에 더 형성되며,상기 홀에 의해 상기 실런트가 상기 공통전극라인을 이루는 게이트 금속과 직접 접촉되거나, 또는 상기 공통전극라인의 상부에 픽셀전극을 형성하여 상기 실런트가 상기 픽셀전극과 직접 접촉됨을 특징으로 한다.

또한, 상기 공통전극라인의 상부 영역의 상기 홀에 의해 상기 실런트가 상기 하부기판의 유리기판과 직접 접촉되거나, 상기 공통전극라인의 상부에 픽셀전극을 형성하여 상기 실런트가 상기 픽셀전극과 직접 접촉됨을 특징으로 한다.

이와 같은 본 발명에 의하면, 상부기판과 하부기판의 합착력이 향상되어 외부 충격에 의한 액정 누수 불량을 방지되며, 이에 따라 액정표시장치의 제조 수율이 향상되는 장점이 있다.

이하 첨부된 도면을 참조하여 본 발명에 의한 실시예를 상세히 설명하도록 한다.

도 6은 본 발명에 의한 액정표시장치의 하부기판을 개략적으로 나타낸 평면도이며, 이는 하부기판 상에 실런트와 합착되는 영역을 나타내고 있다.

도 6을 참조하면, 상기 하부기판은 액정셀(11)들이 매트릭스 형태로 배열된 화상표시부(13)와, 구동 IC들(미도시)과 화상표시부(13) 사이에 접속되는 게이트 패드(50 ) 및 데이터 패드(50)와, 게이트 패드(50') 및 데이터 패드(50)를 화상표시부(13)에 접속시키는 게이트 링크(52') 및 데이터 링크(52)와, 하부기판과 상부기판을 접합시키기 위해 화상표시부(13)의 외곽 테두리에 형성되는 실 패턴(54)을 포함하게 된다.

또한, 상기 게이트 패드부(50') 반대편의 화상표시부(13)의 외곽부에는 더미 라인(55)이 형성되어 있고, 상기 데이터 패드부(50) 반대편 화상표시부(13) 외곽부에는 공통전극 라인(53)이 형성되어 있다.

이 때 상기 더미라인(55)과 게이트 라인(G), 공통전극 라인(53)과 데이터 라인(D) 사이에는 이들과 각각 접속된 정전기 방지회로(51)가 형성되어 있으며, 상기와 같이 공통전압(Vcom)이 공급되는 공통전극 라인(53)과 각각의 데이터 라인(D)들 사이에 접속되어진 정전기 방지회로(51)는 통상 다수개의 박막트랜지스터로 구성되고, 정전기 등에 의한 고전압영역에서는 낮은 임피던스를 가져 과전류가 방전되게 하여, 정상적인 구동환경에서는 높은 임피던스를 가져 신호라인을 통해 공급되는 구동신호에 영향을 주지 않게 하는 역할을 한다.

여기서, 본 발명에 의한 실 패턴(54)은 상기 하부기판 상에 있어서 게이트 라인(G) 및 데이터 라인(D)과 게이트 패드(50') 및 데이터 패드(50) 사이에 접속된 게이트 링크(52') 및 데이터 링크(52)와 교차되는 영역과, 상기 패드부 반대편의화상 표시부 외곽부에 형성된 공통전극라인(53) 및 더미라인(55)의 상부 영역에 형성되며, 또한 상기 실 패턴(54)과 접촉되는 상기 하부기판 상의 영역에 소정 간격으로 홀(56)이 형성됨을 그 특징으로 한다.

도 7은 도 6의 특정영역(A-A')을 포함한 액정패널의 단면도로서, 이는 상기 데이터 라인과 데이터 패드 사이에 접속된 데이터 링크와 교차되는 실 패턴 영역에 대한 단면도이며, 상기 게이트 링크와 교차되는 실 패턴 영역도 동일한 구조를 갖는다.

도 7을 참조하면, 하부기판의 유리기판(72) 상에 게이트 절연막(74), 반도체층(76) 및 데이터 링크(52)가 적층되어 형성되고, 그 위에 유기 보호막(78)이 전면 도포된 구조를 갖는다. 단, 상기 반도체층(76)이 상기 영역에 형성되는 것은 상기 하부기판을 4마스크로 제조하는 경우에 의하며, 5마스크로 제조하는 경우는 상기 데이터 링크(52) 하부에 상기 반도체층(76)이 형성되지 않을 수 있다.

또한, 본 발명의 경우 종래와는 달리 상기 데이터 링크(52) 사이 마다 홀이 형성되어 있으며, 이는 상기 유기 보호막(78)과 게이트 절연막(74)이 에칭되어 홀(56)이 형성된 구조를 갖는다. 상기 홀(56)은 포토레지스트 및 노광 마스크를 이용하여 노광, 현상 및 식각 공정을 통해 일정한 패턴으로 형성된다.

이에 상부기판(80)은 상부 유리기판(82)의 배면에 컬러필터 및 블랙 매트릭스(84)가 형성되고, 그 위에 공통 투명전극(86)이 전면 형성된 구조를 갖는다. 이러한 하부기판(70)과 상부기판(80)은 실 패턴(54)에 도포된 실런트에 의해 합착되며, 이 때 실 패턴(54)의 실런트는 상기 하부기판에 소정 간격으로 형성된 홀(56)을 통하여 하부 유리기판(72)에 직접 접촉된다.

이와 같은 구조의 본 발명에 의하면 에폭시 수지 등이 사용되는 상기 실런트는 무기 물질인 유리기판(72)과 강한 접착 특성을 갖기 때문에 상부기판(80)과 하부기판(70)의 접합 특성이 크게 향상되며, 또한 상기 홀에 의해 상기 실런트와 상기 하부기판(70)과의 접촉 면적이 넓어지게 되어 접합 특성이 더욱 향상되는 것이다.

도 8a 및 도 8b는 도 6의 특정부분(B-B')에 대한 확대 평면도 및 이를 포함한 액정 패널의 단면도이다. 단, 이는 데이터 패드부 반대편의 화상 표시부 외곽부에 형성된 공통전극라인 상의 영역을 도시한 것이다.

도 8a를 참조하면, 상기 공통전극라인(53) 상부에 특정 패턴의 반도체층(79)이 개재되어 있음을 알 수 있다. 상기 공통전극라인(53)은 게이트 라인을 이루는 게이트 전극으로 형성되고, 상기 게이트 금속 위에는 게이트 절연막, 반도체층, 보호막이 순차적으로 형성될 수 있으며, 이 때 종래의 경우 상기 반도체층(79)은 상기 하부기판을 4마스크로 제조할 때 적층되고, 5마스크로 제조하는 경우는 적층되지 않을 수 있으나, 본 발명에 의할 경우에는 어떠한 제조공정을 거치는 경우에도 상기 반도체층(79)이 반드시 형성되며, 단 특정의 패턴을 갖고 상기 공통전극라인(53) 위에 형성됨을 그 특징으로 한다.

도 8a에서는 W 모양으로 상기 반도체층(79)이 패터닝되어 형성되어 있으나, 반드시 이에 한정되는 것은 아니며, 이와 같이 상기 반도체층(79)을 특정의 패턴으로 형성하여 상기 공통전극라인(53) 상에 형성하는 것은 상기 반도체층(79)의패턴에 의해 상기 공통전극라인(53) 상부 영역에 굴곡을 형성함으로써 그 위에 접촉되는 실런트와의 면적을 넓혀 접합 특성을 향상시키기 위함이다.

도 8b는 상기 공통전극라인을 포함한 영역에 대한 단면도로 이를 참고하면, 하부기판의 유리기판(72) 상에 게이트 금속(73), 게이트 절연막(74), 반도체층(79)이 적층 형성되고 그 위에 유기 보호막(78)이 전면 도포된 구조를 갖는다. 이 때 상기 반도체층(79)은 앞서 설명한 바와 같이 특정한 패턴으로 형성되어 있다.

또한, 본 발명의 경우 상기 공통전극라인의 상부 영역에 있어 소정 간격 홀(56)이 형성되어 있으며, 이는 상기 유기 보호막(78)과 게이트 절연막(74)이 에칭되어 홀(56)이 형성된 구조를 갖는다. 상기 홀(56)은 포토레지스트 및 노광 마스크를 이용하여 노광, 현상 및 식각 공정을 통해 일정한 패턴으로 형성된다.

이에 상부기판(80)은 상부 유리기판(82)의 배면에 컬러필터 및 블랙 매트릭스(84)가 형성되고, 그 위에 공통 투명전극(86)이 전면 형성된 구조를 갖는다. 이러한 하부기판(70)과 상부기판(80)은 실 패턴(54)에 도포된 실런트에 의해 합착되며, 이 때 실 패턴(54)의 실런트는 상기 하부기판에 소정 간격으로 형성된 홀(56)을 통하여 하부 게이트 금속(73)에 직접 접촉된다.

이와 같은 구조의 본 발명에 의하면 에폭시 수지 등이 사용되는 상기 실런트는 게이트 금속(73)과 강한 접착 특성을 갖기 때문에 상부기판(80)과 하부기판(70)의 접합 특성이 크게 향상되며, 또한 상기 홀에 의해 상기 실런트와 상기 하부기판(70)과의 접촉 면적이 넓어지게 되어 접합 특성이 더욱 향상되는 것이다.

또한, 상기 홀을 형성함에 있어 습식 식각에 의해 노출되는 게이트 금속의산화를 방지하기 위해 상기 공통전극라인의 상부에 픽셀전극(미도시) 즉, 인듐-틴-옥사이드(ITO)층을 더 형성할 수 있으며, 이에 따라 실 패턴(54)의 실런트는 상기 하부기판에 소정 간격으로 형성된 홀(56)을 통하여 하부 게이트 금속(73) 위에 형성된 상기 픽셀 전극과 직접 접촉하게 된다.

도 9는 본 발명의 다른 실시예에 의한 액정 패널의 단면도(B-B')로서, 이는 도 8b에 도시된 영역과 동일하므로 동일한 구성요소에 대해서는 동일한 도면부호를 사용한다.

도 9를 참조하면, 하부기판의 유리기판(72) 상에 소정 간격으로 홀이 형성된 게이트 금속(73'), 게이트 절연막(74), 반도체층(79')이 적층 형성되고 그 위에 유기 보호막(78)이 전면 도포된 구조를 갖는다. 이 때 상기 반도체층(79')은 앞서 설명한 바와 같이 특정한 패턴으로 형성되어 있다.

이 때 상기 게이트 금속(73')은 최초 형성될 때에 소정 간격 홀이 구비된 상태로 형성되며, 상기 홀(56) 영역을 제외한 게이트 금속(73') 위로 상기 게이트 절연막(74) 및 유기 보호막(78)이 형성되도록 한다.

단, 상기 반도체층(79')은 상기 게이트 전극(73')에 형성된 홀에 관계 없이 특정의 패턴으로 형성되며, 이에 따라 하부기판 상의 공통전극라인의 상부 영역은 소정 간격으로 홀이 형성되고, 상기 홀(56) 영역 내부에는 유리 기판(72) 및 상기 반도체 패턴(79')이 형성되어 있다.

이에 상부기판(80)은 상부 유리기판(82)의 배면에 컬러필터 및 블랙 매트릭스(84)가 형성되고, 그 위에 공통 투명전극(86)이 전면 형성된 구조를 갖는다. 이러한 하부기판(70)과 상부기판(80)은 실 패턴(54)에 도포된 실런트에 의해 합착되며, 이 때 실 패턴(54)의 실런트는 상기 하부기판에 소정 간격으로 형성된 홀(56)을 통하여 하부 유리기판(72) 및 반도체 패턴에 직접 접촉된다.

이와 같은 구조의 본 발명에 의하면 에폭시 수지 등이 사용되는 상기 실런트는 무기 물질인 유리기판(72) 및 반도체 패턴(79')과 강한 접착 특성을 갖기 때문에 상부기판(80)과 하부기판(70)의 접합 특성이 크게 향상되며, 또한 상기 홀에 의해 상기 실런트와 상기 하부기판(70)과의 접촉 면적이 넓어지게 되어 접합 특성이 더욱 향상되는 것이다.

또한, 상기 홀을 형성함에 있어 측면에 노출되는 게이트 금속의 산화를 방지하기 위해 상기 공통전극라인의 상부에 픽셀전극(미도시) 즉, 인듐-틴-옥사이드(ITO)층을 더 형성할 수 있으며, 이에 따라 실 패턴(54)의 실런트는 상기 하부기판에 소정 간격으로 형성된 홀(56)을 통하여 하부 게이트 금속(72) 위에 형성된 상기 픽셀 전극과 직접 접촉하게 된다.

또한, 게이트 패드부 반대편의 화상 표시부 외곽부에 형성된 더미전극라인 상의 영역도 앞서 설명한 공통전극라인 상부의 구조와 일치하며, 단 액정 주입구가 형성되는 부분은 개방되도록 한다.

이상의 설명에서와 같이 본 발명에 의한 액정표시장치에 의하면, 상부기판과 하부기판의 합착력이 향상되어 외부 충격에 의한 액정 누수 불량을 방지되며, 이에 따라 액정표시장치의 제조 수율이 향상되는 장점이 있다.

Claims (8)

1. 화상 표시부 및 패드부가 구비된 하부기판과;

   상기 화상 표시부 외곽부에 상기 화상표시부를 둘러싸도록 형성된 실패턴과;

   상기 패드부에 형성된 게이트 라인 및 데이터 라인과 게이트 패드 및 데이터 패드 사이에 접속된 게이트 링크 및 데이터 링크와;

   상기 패드부 반대편의 화상 표시부 외곽부에 형성된 공통전극라인 및 더미라인과;

   상기 실런트와 접촉되는 상기 게이트 링크 및 데이터 링크의 교차 영역에 소정 간격으로 형성된 홀로 구성된 것을 특징으로 하는 액정표시장치.
2. 제 1항에 있어서,

   상기 공통전극라인 상부 영역에 특정패턴의 반도체층이 개재되어 있음을 특징으로 하는 액정표시장치.
3. 제 1항에 있어서,

   상기 홀에 의해 상기 실런트가 상기 하부기판의 유리기판과 직접 접촉됨을 특징으로 하는 액정표시장치.
4. 제 1항에 있어서,

   상기 홀은 상기 공통전극라인 및 더미라인의 상부영역에 더 형성된 것을 특징으로 하는 액정표시장치.
5. 제 4항에 있어서,

   상기 홀에 의해 상기 실런트가 상기 공통전극라인을 이루는 게이트 금속과 직접 접촉됨을 특징으로 하는 액정표시장치.
6. 제 5항에 있어서,

   상기 공통전극라인의 상부에 픽셀전극을 형성하여 상기 실런트가 상기 픽셀전극과 직접 접촉됨을 특징으로 하는 액정표시장치.
7. 제 4항에 있어서,

   상기 공통전극라인의 상부 영역의 상기 홀에 의해 상기 실런트가 상기 하부기판의 유리기판과 직접 접촉됨을 특징으로 하는 액정표시장치.
8. 제 7항에 있어서,

   상기 공통전극라인의 상부에 픽셀전극을 형성하여 상기 실런트가 상기 픽셀전극과 직접 접촉됨을 특징으로 하는 액정표시장치.