KR102580836B1 - Interposer and package structure having the same - Google Patents
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Abstract
본 발명의 일 측면에 따른 인터포저는, 세라믹을 포함하는 재질의 바디; 및 상기 바디를 관통하여 상기 바디의 상하측으로 각각 돌출되는 금속핀을 포함한다.An interposer according to an aspect of the present invention includes a body made of a material including ceramic; and metal pins that penetrate the body and protrude from the upper and lower sides of the body, respectively.
Description
본 발명은 인터포저와 이를 포함하는 패키지 구조물에 관한 것이다.The present invention relates to an interposer and a package structure including the same.
각종 전자기기의 사용이 폭발적으로 증가함과 동시에 디지털 기술과 반도체 기술 등의 발달로 정밀하고 복잡한 전자기기 응용 분야가 광범위해지고 있다. 전자기기 내부 부품들의 밀집도가 높아지면서, 개개의 부품(active, passive)들을 연결해주기 위해 필요한 PCB 면적이 커지고 있다. 한편, 배터리의 크기는 커지는 추세에 있고, 따라서, 전자기기의 한정된 공간 내에서 PCB를 효율적으로 배치, 장착할 필요가 있다. As the use of various electronic devices increases explosively, the application fields of precise and complex electronic devices are expanding due to the development of digital technology and semiconductor technology. As the density of internal components in electronic devices increases, the PCB area required to connect individual components (active and passive) is increasing. Meanwhile, the size of batteries is increasing, and therefore, there is a need to efficiently arrange and mount PCBs within the limited space of electronic devices.
본 발명의 일 측면에 따르면, 세라믹을 포함하는 재질의 바디; 및 상기 바디를 관통하여 상기 바디의 상하측으로 각각 돌출되는 금속핀을 포함하는 인터포저가 제공된다. According to one aspect of the present invention, a body made of a material containing ceramic; and an interposer including metal pins that penetrate the body and protrude to the upper and lower sides of the body, respectively.
본 발명의 다른 측면에 따르면, 인터포저; 상기 인터포저 상면에 결합된 제1 기판; 및 상기 인터포저 하면에 결합된 제2 기판을 포함하고, 상기 인터포저는, 세라믹을 포함하는 재질의 바디; 및 상기 바디를 관통하여 상기 바디의 상하측으로 각각 돌출되는 금속핀을 포함하고, 상기 금속핀은 상기 제1 기판 및 상기 제2 기판 각각과 전기적으로 연결되는 패키지 구조물이 제공된다.According to another aspect of the invention, an interposer; a first substrate coupled to the upper surface of the interposer; and a second substrate coupled to a lower surface of the interposer, wherein the interposer includes: a body made of a material including ceramic; and a metal pin penetrating the body and protruding from the upper and lower sides of the body, wherein the metal pin is electrically connected to each of the first substrate and the second substrate.
도 1은 인쇄회로기판이 장착된 전자기기를 나타낸 도면.
도 2 및 도 3은 본 발명의 일 실시예에 따른 패키지 구조물을 나타낸 도면.
도 4는 본 발명의 일 실시예에 따른 인터포저를 나타낸 도면.
도 5는 도 4의 인터포저를 이용하여 패키지 구조물을 구현하는 방법을 나타낸 도면.
도 6 및 도 7은 본 발명의 다른 실시예에 따른 패키지 구조물을 나타낸 도면.
도 8은 본 발명의 다른 실시예에 따른 인터포저를 나타낸 도면.
도 9는 도 8의 인터포저를 이용하여 패키지 구조물을 구현하는 방법을 나타낸 도면.
도 10은 본 발명의 또 다른 실시예에 따른 인터포저를 나타낸 도면.
도 11은 도 10의 인터포저를 이용하여 패키지 구조물을 구현하는 방법을 나타낸 도면.1 is a diagram showing an electronic device equipped with a printed circuit board.
2 and 3 are diagrams showing a package structure according to an embodiment of the present invention.
Figure 4 is a diagram showing an interposer according to an embodiment of the present invention.
FIG. 5 is a diagram showing a method of implementing a package structure using the interposer of FIG. 4.
6 and 7 are diagrams showing a package structure according to another embodiment of the present invention.
Figure 8 is a diagram showing an interposer according to another embodiment of the present invention.
FIG. 9 is a diagram showing a method of implementing a package structure using the interposer of FIG. 8.
Figure 10 is a diagram showing an interposer according to another embodiment of the present invention.
FIG. 11 is a diagram showing a method of implementing a package structure using the interposer of FIG. 10.
본 발명에 따른 인터포저와 이를 포함하는 패키지 구조물의 실시예를 첨부도면을 참조하여 상세히 설명하기로 하며, 첨부 도면을 참조하여 설명함에 있어, 동일하거나 대응하는 구성 요소는 동일한 도면번호를 부여하고 이에 대한 중복되는 설명은 생략하기로 한다.Embodiments of the interposer and the package structure including the same according to the present invention will be described in detail with reference to the accompanying drawings. In the description with reference to the accompanying drawings, identical or corresponding components are assigned the same drawing numbers and Redundant explanations will be omitted.
또한, 이하 사용되는 제1, 제2 등과 같은 용어는 동일 또는 상응하는 구성 요소들을 구별하기 위한 식별 기호에 불과하며, 동일 또는 상응하는 구성 요소들이 제1, 제2 등의 용어에 의하여 한정되는 것은 아니다.In addition, terms such as first, second, etc. used below are merely identifiers to distinguish identical or corresponding components, and the same or corresponding components are not limited by terms such as first, second, etc. no.
또한, 결합이라 함은, 각 구성 요소 간의 접촉 관계에 있어, 각 구성 요소 간에 물리적으로 직접 접촉되는 경우만을 뜻하는 것이 아니라, 다른 구성이 각 구성 요소 사이에 개재되어, 그 다른 구성에 구성 요소가 각각 접촉되어 있는 경우까지 포괄하는 개념으로 사용하도록 한다.In addition, coupling does not mean only the case of direct physical contact between each component in the contact relationship between each component, but also means that another component is interposed between each component, and the component is in that other component. It should be used as a concept that encompasses even the cases where each is in contact.
스마트폰을 포함한 다양한 전자기기(1)에 장착되는 패키지 구조물(10)은 인쇄회로기판과 전자부품을 포함한다. 인쇄회로기판에는 전자기기에 필요한 많은 전자부품이 실장되며, 인쇄회로기판에는 회로가 인쇄되어 있어, 전자부품들은 인쇄회로기판의 회로에 의해 전기적으로 연결될 수 있다. The
도 1을 참조하면, 전자기기(1)는 하우징, 패키지 구조물(10) 및 배터리(battery)(20) 등을 포함한다. 패키지 구조물(10)과 배터리(20)는 하우징 내의 공간에 배치되는데, 전자기기(1)의 디스플레이의 크기가 커지고, 카메라가 고해상도 기능을 가지는 등, 전자기기(1)의 사양이 높아지면, 그에 따른 전력 소비량이 증가하기 때문에 배터리(20)의 용량과 크기도 커져야 한다. 배터리(20)의 크기가 커지게 되면, 하우징 내에서 상대적으로 패키지 구조물(10)이 차지할 수 있는 면적이 줄어들게 된다. 거꾸로, 패키지 구조물(10)이 차지하는 면적을 줄일 수 있다면, 배터리(20)에 할당될 수 있는 면적이 커지기 때문에 배터리(20)의 대형화가 가능해진다.Referring to FIG. 1, the
본 발명의 실시예에 따른 패키지 구조물은 두 개 이상의 기판으로 이루어진 인쇄회로기판을 포함하며, 인쇄회로기판은 복층구조, 스택(stack)구조 또는 샌드위치(sandwich)구조를 가진다. 인쇄회로기판이 두 개 이상의 기판을 포함하면, 인쇄회로기판으로 사용할 수 있는 면적은 증가하지만, 패키지 구조물이 전자기기의 하우징 내에서 차지하는 공간은 최소화되고, 나아가 배터리가 차지할 수 있는 면적이 커질 수 있다.The package structure according to an embodiment of the present invention includes a printed circuit board consisting of two or more substrates, and the printed circuit board has a multi-layer structure, a stack structure, or a sandwich structure. When a printed circuit board includes two or more boards, the area that can be used as a printed circuit board increases, but the space that the package structure occupies within the housing of the electronic device is minimized, and the area that the battery can occupy can increase. .
도 2 및 도 3은 본 발명의 일 실시예에 따른 패키지 구조물을 나타낸 도면이다.2 and 3 are diagrams showing a package structure according to an embodiment of the present invention.
도 2 및 도 3을 참조하면, 본 발명의 일 실시예에 따른 패키지 구조물은, 인터포저(300), 제1 기판(100) 및 제2 기판(200)을 포함할 수 있다. 먼저 인터포저(300)에 대해 자세하게 설명하기로 한다. Referring to FIGS. 2 and 3 , the package structure according to an embodiment of the present invention may include an
도 4는 본 발명의 일 실시예에 따른 인터포저(300)를 나타낸 도면이다.Figure 4 is a diagram showing the
인터포저(300)는, 바디(body)(310) 및 금속핀(320)을 포함할 수 있다.The
바디(310)는 무기재료로 형성되며, 특히 세라믹을 포함하는 재질로 이루어질 수 있다. 즉, 바디(310)는 산화 알루미늄(Al2O3), 알루미늄질화물(AlN) 등의 물질을 포함하여 제조될 수 있다.The
도 4(a)에 도시된 바와 같이, 바디(310)는 내부에 중공부(330)를 구비할 수 있고, 중공부(330)는 바디(310)의 상하면을 관통한다. 이에 따라 바디(310)는 고리 형상으로 형성될 수 있으며, 다각형의 고리, 원형의 고리 등 다양한 형상으로 구현될 수 있다. 또한, 바디(310)는 복수의 조각으로 이루어질 수 있으며, 복수의 조각이 하나의 고리 형상을 만들도록 배치될 수 있다.As shown in FIG. 4(a), the
바디(310)는 소정의 높이(두께)를 가지며, 바디(310)의 높이는 제1 기판(100)과 제2 기판(200)의 이격 거리에 따라 결정될 수 있다. 또한, 바디(310)의 상하면은 각각 평평한 면으로 이루어질 수 있다.The
금속핀(320)은 금속으로 형성되는 기둥상 구조물로, 바디(310)를 관통하고, 바디(310)의 상하측으로 각각 돌출될 수 있다. 금속핀(320)은 바디(310)의 두께보다 길게 형성되어 바디(310)의 상하측으로 각각 돌출된다. 금속핀(320)의 돌출된 부분은 제1 기판(100) 및 제2 기판(200)과 전기적으로 연결되며, 금속핀(320)은 패키지 구조물의 상하 방향으로 연장되어 제1 기판(100) 및 제2 기판(200) 간에 신호 전달을 할 수 있다. The
금속핀(320)에 있어서, 바디(310) 내부에 위치하는 부분과 바디(310)보다 돌출된 부분이 일체로 형성된다는 점에서, 본 발명에서의 금속핀(320)은, 일반적으로 (유기) 절연층으로 형성된 인터포저(300) 내에 형성되는 비아와 구별된다. 또한, 금속핀(320)은 전체적으로 균일한 굵기를 가질 수 있다.In the
금속핀(320)은 복수로 형성될 수 있고, 복수의 금속핀(320)은 서로 이격되어 바디(310) 내에서 서로 절연될 수 있다. 바디(310)가 중공부(330)를 가지고 고리 형상으로 형성되는 경우, 복수의 금속핀(320)은 바디(310)의 고리 형상을 따라 소정의 간격으로 배치될 수 있다. 복수의 금속핀(320) 중 일부는 제1 기판(100) 및 제2 기판(200) 간에 파워(power)를 전달할 수 있고, 또 다른 일부는 전자소자 구동을 위한 유효한 전기 신호를 전달할 수 있고, 또 다른 일부는 그라운드로 사용될 수 있다.The
금속핀(320)을 이루는 금속은 구리(Cu), 알루미늄(Al), 니켈(Ni) 등 다양할 수 있으며 제한되지 않는다. 금속핀(320)은 금속 재료를 녹여 균일한 굵기로 성형하면서 소정의 길이로 절단하여 제조될 수 있다. 또한, 복수의 금속핀(320)은 금속 재료를 녹여 균일한 굵기로 성형하면서 소정의 길이로 반복 절단하여 제조될 수 있으며, 복수의 금속핀(320) 각각의 굵기가 서로 동일하고, 길이가 동일할 수 있다. 한편, 인터포저(300) 제조 시, 틀(몰드) 내에 금속핀(320)을 위치시킨 후 세라믹 재료를 틀 내에 충전하고 소결하는 방식이 이용될 수 있다.The metal that makes up the
금속핀(320)은 바디(310) 내부에 위치하는 제1 영역(321)과 바디(310)보다 상하로 각각 돌출된 제2 영역(322)으로 구분될 수 있다. 단, 제1 영역(321)과 제2 영역(322)은 일체로 형성된다. 한편, 본 실시예에서, 제2 영역(322)은 도 4(b)에 자세히 도시되어 있다. 제2 영역(322)의 길이에는 제한이 없으나, 본 실시예에서는 제2 영역(322)이 제1 기판(100) 및 제2 기판(200)에 충분히 삽입될 수 있을 정도의 길이를 가진다.The
인터포저(300)의 상측에는 제1 기판(100)이 배치되고, 인터포저(300)의 하측에는 제2 기판(200)이 배치된다. 여기서, 상하의 개념은 상대적인 개념을 이해할 수 있다. 제1 기판(100)과 제2 기판(200) 각각은, 판상으로 이루어지고, 복수의 절연재층과 복수의 회로층으로 구성된 다층기판일 수 있고, 회로층을 기준으로 8층 또는 10층인 다층기판일 수 있다.The
제1 기판(100) 및 제2 기판(200)의 절연재층은 에폭시 수지, 폴리이미드 수지, BT 수지, LCP(Liquid Crystal Polymer) 등과 같은 절연물질로 이루어진 층이다. 회로층은 구리(Cu)와 같은 금속 등의 전도성물질로 이루어지고 특정 패턴을 가지도록 설계된다. 회로층(C1, C2)은 절연재층의 단면 또는 양면에 형성되고, 서로 다른 층의 회로층은 절연재층을 관통하는 비아도체(V1, V2)를 통하여 전기적으로 연결될 수 있다.The insulating material layer of the
제1 기판(100) 및 제2 기판(200)에 있어서, 최외층 회로층은 솔더레지스트(SR)로 커버될 수 있다. 솔더레지스트(SR)는 제1 기판(100) 및 제2 기판(200)의 최외층 회로층을 보호할 수 있다. 솔더레지스트(SR)에는 개구가 형성되고, 개구를 통해 상기 최외층 회로층 일부가 노출될 수 있다.In the
제1 기판(100)의 일면에는 전자소자(이하, 제1 소자(E1))가 실장된다. 여기서, 제1 기판(100)의 일면은 제2 기판(200)을 바라보는 면이다. 제1 소자(E1)는 능동소자, 수동소자, 집적회로 중 적어도 하나일 수 있고, 제1 소자(E1)는 복수로 구현될 수 있고, 복수의 제1 소자(E1)는 능동소자, 수동소자, 집적회로 중 다양하게 선택될 수 있다. 구체적으로 제1 소자(E1)는 AP, Memory, BGA(Ball Grid Array), CSP(Chip Scale Package), LGA(Land Grid Array)와 같은 다수의 집적회로와, 커패시터(capacitor)와 같은 다수의 수동소자를 포함할 수 있다. 제1 소자(E1)는 제1 기판(100)의 표면에 솔더부재(미도시)에 의해 실장될 수 있다. 구체적으로 제1 소자(E1)는 제1 기판(100)의 회로층(C1)에 실장될 수 있다. 특히, 제1 소자(E1)는 제1 기판(100)의 일면 측 최외층 회로층 중 솔더레지스트(SR) 개구를 통해 노출되는 부분에 실장될 수 있다.An electronic device (hereinafter referred to as first device E1) is mounted on one side of the
인터포저(300)가 내측에 중공부(330)를 포함하는 경우, 제1 소자(E1)는 인터포저(300) 중공부(330) 내에 위치할 수 있다. 여기서 인터포저(300)는 제1 소자(E1)를 보호하는 기능을 할 수 있다. 제1 소자(E1)가 복수로 형성되는 경우, 적어도 일부의 제1 소자(E1)가 인터포저(300) 중공부(330) 내에 위치할 수 있다. When the
제2 기판(200)의 일면에는 전자소자(이하, 제2 소자(E2))가 실장된다. 여기서, 제2 기판(200)의 일면은 제1 기판(100)을 바라보는 면이다. 제2 소자(E2)는 능동소자, 수동소자, 집적회로 중 적어도 하나일 수 있고, 제2 소자(E2)는 복수로 구현될 수 있고, 복수의 제2 소자(E2)는 능동소자, 수동소자, 집적회로 중 다양하게 선택될 수 있다. 구체적으로 제2 소자(E2)는 AP, Memory, BGA(Ball Grid Array), CSP(Chip Scale Package), LGA(Land Grid Array)와 같은 다수의 집적회로와, 커패시터(capacitor)와 같은 다수의 수동소자를 포함할 수 있다. 제2 소자(E2)는 제2 기판(200)의 표면에 솔더부재(미도시)에 의해 실장될 수 있다. 구체적으로 제2 소자(E2)는 제2 기판(200)의 회로층(C2)에 실장될 수 있다. 특히, 제2 소자(E2)는 제2 기판(200)의 일면 측 최외층 회로층 중 솔더레지스트(SR) 개구를 통해 노출되는 부분에 실장될 수 있다.An electronic device (hereinafter referred to as a second device E2) is mounted on one side of the
인터포저(300)가 내측에 중공부(330)를 포함하는 경우, 제2 소자(E2)는 인터포저(300) 중공부(330) 내에 위치할 수 있다. 여기서 인터포저(300)는 제2 소자(E2)를 보호하는 기능을 할 수 있다. 제2 소자(E2)가 복수로 형성되는 경우, 적어도 일부의 제2 소자(E2)가 인터포저(300) 중공부(330) 내에 위치할 수 있다. When the
제1 기판(100)과 제2 기판(200)의 면적은 서로 다를 수 있다. 예를 들어, 도 2에 도시된 바와 같이, 제2 기판(200)의 면적이 제1 기판(100)의 면적보다 클 수 있다. 이 경우, 인터포저(300)는 제1 기판(100)과 제2 기판(200)이 중첩되는 영역에 배치되며, 복수의 제2 소자(E2)의 일부는 인터포저(300)의 중공부(330) 내에 위치하고, 복수의 제2 소자(E2)의 다른 일부는 인터포저(300) 외측에 위치할 수 있다. 한편, 도 2와 달리, 제1 기판(100)의 면적이 제2 기판(200)의 면적보다 더 클 수 있고, 복수의 제1 소자(E1)의 일부는 인터포저(300)의 중공부(330) 내에 위치하고, 복수의 제1 소자(E1)의 다른 일부는 인터포저(300) 외측에 위치할 수 있다. 제1 기판(100)과 제2 기판(200) 중 면적이 큰 기판은 메인보드이고, 면적이 작은 기판은 서브기판일 수 있다.The areas of the
한편, 제1 기판(100)의 타면에는 전자소자(이하, 제3 소자(E3))가 실장될 수 있고, 제3 소자(E3)는 복수로 구현되고, 능동소자, 수동소자, 집적회로 중 다양하게 선택될 수 있다. 제3 소자(E3)는 제1 기판(100)의 타면 측 최외층 회로층에 실장될 수 있다. 제1 소자(E1)와 제3 소자(E3)는 제1 기판(100)에 형성된 회로층(C1)과 비아도체(V1)를 통해 전기적으로 연결될 수 있다.Meanwhile, an electronic device (hereinafter referred to as a third device (E3)) may be mounted on the other side of the
또한, 제2 기판(200)의 타면에는 전자소자(이하, 제4 소자(E4))가 실장될 수 있고, 제4 소자(E4)는 복수로 구현되고, 능동소자, 수동소자, 집적회로 중 다양하게 선택될 수 있다. 제4 소자(E4)는 제2 기판(200)의 타면 측 최외층 회로층에 실장될 수 있다. 제2 소자(E2)와 제4 소자(E4)는 제2 기판(200)에 형성된 회로층(C2)과 비아도체(V2)를 통해 전기적으로 연결될 수 있다.Additionally, an electronic device (hereinafter referred to as a fourth device (E4)) may be mounted on the other side of the
도 5는 도 4의 인터포저(300)를 이용하여 패키지 구조물을 구현하는 방법을 나타낸 도면이다. 이하, 도 1 내지 도 5를 참조하여 더 설명하기로 한다.FIG. 5 is a diagram showing a method of implementing a package structure using the
제1 기판(100) 및 제2 기판(200) 각각에는 관통홀이 구비된다. 제1 기판(100)의 관통홀을 제1 관통홀(H1), 제2 기판(200)의 관통홀을 제2 관통홀(H2)이라 칭하기로 한다. Each of the
제1 관통홀(H1)은 제1 기판(100)의 전체 두께를 관통할 수 있다. 이 경우, 제1 관통홀(H1)은 제1 기판(100)의 절연재층 전체를 관통할 수 있다. 제1 관통홀(H1)의 내벽에는 금속층(M1)이 형성될 수 있고, 금속층(M1)은 도금으로 형성될 수 있다. 제1 관통홀(H1)의 금속층(M1)은 제1 기판(100)의 회로층(C1)과 전기적으로 연결될 수 있다. 제1 관통홀(H1)의 금속층(M1)은 제1 기판(100)의 상하면까지 연장되어 랜드(land)를 형성할 수 있다. 한편, 제1 관통홀(H1)의 폭은 금속핀(320)의 폭보다 클 수 있다. The first through hole H1 may penetrate the entire thickness of the
제2 관통홀(H2)은 제2 기판(200)의 전체 두께를 관통할 수 있다. 이 경우, 제2 관통홀(H2)은 제2 기판(200)의 절연재층 전체를 관통할 수 있다. 제2 관통홀(H2)의 내벽에는 금속층(M2)이 형성될 수 있고, 금속층(M2)은 도금으로 형성될 수 있다. 제2 관통홀(H2)의 금속층(M2)은 제2 기판(200)의 회로층(C2)과 전기적으로 연결될 수 있다. 제2 관통홀(H2)의 금속층(M2)은 제2 기판(200)의 상하면까지 연장되어 랜드(land)를 형성할 수 있다. 한편, 제1 관통홀(H1)의 폭은 금속핀(320)의 폭보다 클 수 있다.The second through hole H2 may penetrate the entire thickness of the
도 5(a)를 참조하면, 도 4를 참조하여 설명한 인터포저(300)가 마련된다. 인터포저(300)는 제1 기판(100)과 제2 기판(200) 사이에 위치하고, 인터포저(300)의 금속핀(320), 특히 제2 영역(322)은 제1 기판(100)과 제2 기판(200) 내부로 삽입될 수 있는데, 금속핀(320)의 제2 영역(322)은 제1 기판(100)의 제1 관통홀(H1)과 제2 기판(200)의 제2 관통홀(H2) 내부로 삽입된다. 여기서, 인터포저(300)의 상면은 제1 기판(100)의 일면(하면)과 접촉되고, 인터포저(300)의 하면은 제2 기판(200)의 일면(상면)과 접촉된다. 구체적으로, 인터포저(300)의 상면은 제1 기판(100)의 일면에 형성된 솔더레지스트(SR)와 접촉되고, 인터포저(300)의 하면은 제2 기판(200)의 일면에 형성된 솔더레지스트(SR)와 접촉된다.Referring to FIG. 5(a), the
관통홀(H1, H2)의 폭이 금속핀(320)의 폭보다 큰 경우, 금속핀(320)은 관통홀(H1, H2)에 끼움결합되지 않고, 관통홀(H1, H2) 내부에서 고정되지 않을 수 있다.If the width of the through holes (H1, H2) is larger than the width of the
도 5(b)를 참조하면, 금속핀(320)의 제2 영역(322)은 관통홀(H1, H2)에 고정된다. 구체적으로, 관통홀(H1, H2) 내부는 저융점금속(LM)으로 충전된다. 관통홀(H1, H2)의 폭이 금속핀(320)의 폭보다 큰 경우, 관통홀(H1, H2)의 내부 중 금속핀(320)이 차지하는 공간을 제외한 부분이 저융점금속(LM)으로 충전된다. 저융점금속(LM)은 납, 주석 중 적어도 하나의 금속을 포함할 수 있다. 저융점금속(LM)은 금속페이스트가 관통홀(H1, H2)을 충전한 후 리플로우(reflow) 공정을 거쳐 경화된 것일 수 있다.Referring to FIG. 5(b), the
저융점금속(LM)이 제1 관통홀(H1)과 제2 관통홀(H2)을 충전하기 때문에, 금속핀(320)의 제2 영역(322)은 제1 관통홀(H1)의 금속층(M1)과 제2 관통홀(H2)의 금속층(M2)과 전기적으로 연결될 수 있다. 이에 따라, 인터포저(300)는 제1 기판(100)과 제2 기판(200)을 전기적으로 연결할 수 있다.Since the low melting point metal (LM) fills the first through hole (H1) and the second through hole (H2), the
한편, 금속핀(320)의 제2 영역(322)의 길이는 관통홀(H1, H2)의 길이보다 길 수 있고, 이 경우, 인터포저(300)가 제1 기판(100) 및 제2 기판(200)과 결합되었을 때, 금속핀(320)의 단부는 제1 기판(100) 및/또는 제2 기판(200)보다 돌출될 수 있다. 저융점금속(LM)은 돌출된 금속핀(320)의 단부의 측면을 커버할 수 있다. 도 1과 도 5에서는 금속핀(320)이 관통홀(H1, H2)을 완전히 관통하여 금속핀(320)의 단부가 제1 기판(100) 및 제2 기판(200)보다 돌출되고 있다. 또한, 저융점금속(LM)은 돌출된 단부의 측면을 커버한다. 한편, 저융점금속(LM)은 제1 기판(100) 및 제2 기판(200)의 상하면에 형성된 랜드를 모두 커버할 수 있다.Meanwhile, the length of the
또한, 금속핀(320)의 제2 영역(322)의 길이는 제1 관통홀(H1) 및/또는 제2 관통홀(H2)의 길이보다 작을 수 있고, 이에 따라, 금속핀(320)의 단부는 제1 기판(100) 및/또는 제2 기판(200) 내에 위치할 수 있다. 이 경우에도, 저융점금속(LM)은 제1 기판(100) 및 제2 기판(200)의 상하면에 형성된 랜드를 모두 커버하도록 제1 관통홀(H1) 및 제2 관통홀(H2)을 과충전할 수 있다. 이에 따라 최외측에 위치하는 저융점금속(LM)의 폭은 관통홀(H1, H2)의 폭보다 클 수 있다. 이러한 저융점금속(LM)은 도 3에 도시되어 있다.Additionally, the length of the
인터포저(300)의 바디(310)가 세라믹을 포함하는 경우, 세라믹의 견고한 성질 때문에 유기물을 함유하는 인터포저(300)보다 큰 강성을 가질 수 있으므로, 패키지 구조물의 휨을 저감시킬 수 있다.When the
또한, 인터포저(300)의 바디(310)가 세라믹을 포함하는 경우, 인터포저(300)의 바디(310)는 소결 공정을 통해 단단해지고, 저융점금속(LM) 및 전자소자(E1 내지 E4)의 실장을 위한 솔더부재의 리플로우는 인터포저(300) 바디(310)의 소결 온도보다 낮은 온도에서 이루어질 수 있기 때문에, 리플로우 공정은 인터포저(300) 형상에 영향을 주지 않는다. 이에 따라, 패키지 구조물의 휨이 저감될 수 있다.In addition, when the
또한, 인터포저(300)의 상하 연결이 금속핀(320)으로 이루어지는 경우, 금속핀(320)은 다양한 길이로 용이하게 제조될 수 있으므로 인터포저(300) 바디(310)의 두께에 구애받지 않으므로, 절연층의 두께에 따라 형상이 제한되는 일반 비아보다 자유도가 높고, 얼라인먼트(alignment)도 스택 비아(stack via)에 비하여 용이하다.In addition, when the upper and lower connections of the
도 6 및 도 7은 본 발명의 다른 실시예에 따른 패키지 구조물을 나타낸 도면이고, 도 8은 본 발명의 다른 실시예에 따른 인터포저(300)를 나타낸 도면이고, 도 9는 도 8의 인터포저(300)를 이용하여 패키지 구조물을 구현하는 방법을 나타낸 도면이다.FIGS. 6 and 7 are diagrams showing a package structure according to another embodiment of the present invention, FIG. 8 is a diagram showing an
도 6 및 도 7을 참조하면, 본 발명의 다른 실시예에 따른 패키지 구조물은, 인터포저(300), 제1 기판(100) 및 제2 기판(200)을 포함할 수 있다. 먼저 도 8을 참조하여 인터포저(300)에 대해 자세하게 설명하기로 한다. Referring to FIGS. 6 and 7 , a package structure according to another embodiment of the present invention may include an
인터포저(300)는, 바디(body)(310) 및 금속핀(320)을 포함할 수 있다.The
바디(310)는 무기재료로 형성되며, 특히 세라믹을 포함하는 재질로 이루어질 수 있다. 즉, 바디(310)는 산화 알루미늄(Al2O3), 알루미늄질화물(AlN) 등의 물질을 포함하여 제조될 수 있다.The
도 8(a)에 도시된 바와 같이, 바디(310)는 내부에 중공부(330)를 구비할 수 있고, 중공부(330)는 바디(310)의 상하면을 관통한다. 이에 따라 바디(310)는 고리 형상으로 형성될 수 있으며, 다각형의 고리, 원형의 고리 등 다양한 형상으로 구현될 수 있다. 또한, 바디(310)는 복수의 조각으로 이루어질 수 있으며, 복수의 조각이 하나의 고리 형상을 만들도록 배치될 수 있다.As shown in FIG. 8(a), the
바디(310)는 소정의 높이(두께)를 가지며, 바디(310)의 높이는 제1 기판(100)과 제2 기판(200)의 이격 거리에 따라 결정될 수 있다. 또한, 바디(310)의 상하면은 각각 평평한 면으로 이루어질 수 있다.The
금속핀(320)은 금속으로 형성되는 기둥상 구조물로, 바디(310)를 관통하고, 바디(310)의 상하측으로 각각 돌출될 수 있다. 금속핀(320)은 바디(310)의 두께보다 길게 형성되어 바디(310)의 상하측으로 각각 돌출된다. 금속핀(320)의 돌출된 부분은 제1 기판(100) 및 제2 기판(200)과 전기적으로 연결되며, 금속핀(320)은 패키지 구조물의 상하 방향으로 연장되어 제1 기판(100) 및 제2 기판(200) 간에 신호 전달을 할 수 있다. The
금속핀(320)에 있어서, 바디(310) 내부에 위치하는 부분과 바디(310)보다 돌출된 부분이 일체로 형성된다는 점에서, 본 발명에서의 금속핀(320)은 일반적으로 절연층 내에 형성되는 비아와 구별된다. 또한, 금속핀(320)은 전체적으로 균일한 굵기를 가질 수 있다.In the
금속핀(320)은 복수로 형성될 수 있고, 복수의 금속핀(320)은 서로 이격되어 바디(310) 내에서 서로 절연될 수 있다. 바디(310)가 중공부(330)를 가지고 고리 형상으로 형성되는 경우, 복수의 금속핀(320)은 바디(310)의 고리 형상을 따라 소정의 간격으로 배치될 수 있다. 복수의 금속핀(320) 중 일부는 제1 기판(100) 및 제2 기판(200) 간에 파워(power)를 전달할 수 있고, 또 다른 일부는 전자소자 구동을 위한 유효한 전기 신호를 전달할 수 있고, 또 다른 일부는 그라운드로 사용될 수 있다.The metal pins 320 may be formed in plurality, and the plurality of
금속핀(320)을 이루는 금속은 구리(Cu), 알루미늄(Al), 니켈(Ni) 등 다양할 수 있으며 제한되지 않는다. 금속핀(320)은 금속 재료를 녹여 균일한 굵기로 성형하면서 소정의 길이로 절단하여 제조될 수 있다. 또한, 복수의 금속핀(320)은 금속 재료를 녹여 균일한 굵기로 성형하면서 소정의 길이로 반복 절단하여 제조될 수 있으며, 복수의 금속핀(320) 각각의 굵기가 서로 동일하고, 길이가 동일할 수 있다. 한편, 인터포저(300) 제조 시, 틀(몰드) 내에 금속핀(320)을 위치시킨 후 세라믹 재료를 틀 내에 충전하고 소결하는 방식이 이용될 수 있다.The metal that makes up the
금속핀(320)은 바디(310) 내부에 위치하는 제1 영역(321)과 바디(310)보다 상하로 각각 돌출된 제2 영역(322)으로 구분될 수 있다. 단, 제1 영역(321)과 제2 영역(322)은 일체로 형성된다. 본 실시예에서의 제2 영역(322)은, 도 1 내지 도 5를 참조하여 설명한 이전 실시예에 따른 인터포저(300)에서의 제2 영역(322)보다 짧으며, 제1 기판(100) 및 제2 기판(200)에 형성된 회로층(C1, C2)의 두께보다 작을 수 있다. 본 실시예에서의 제2 영역(322)은 도 9(a)에 도시되어 있다.The
본 실시예에서 인터포저(300)는 패드(P1, P2)를 더 포함한다. 패드(P1, P2)는 인터포저(300)의 상하면에 각각 형성되며, 금속핀(320)과 전기적으로 연결된다. 즉, 패드(P1, P2)는 금속핀(320)과 접촉되도록 인터포저(300)의 상하면에 각각 형성된다. 금속핀(320)이 복수로 형성되는 경우, 패드(P1, P2)는 복수의 금속핀(320)에 대응하여 복수로 형성된다. 복수의 패드(P1, P2)는 서로 이격되게 배치될 수 있다.In this embodiment, the
패드(P1, P2)는 금속핀(320)의 바디(310)보다 돌출된 부분의 외주면(또는 측면)을 둘러싸도록 형성될 수 있다. 즉, 패드(P1, P2)는 금속핀(320)의 제2 영역(322)의 외주면(또는 측면)을 둘러싸도록 형성될 수 있다. 여기서, 패드(P1, P2)는 금속핀(320)의 바디(310)보다 돌출된 부분의 전체, 즉 금속핀(320)의 제2 영역(322)의 표면 전체를 커버할 수 있다. 이 경우, 금속핀(320)의 제2 영역(322)은 외부로 노출되지 않는다. 또한 이 경우, 패드(P1, P2)의 표면은 외측으로 볼록한 면을 포함할 수 있다. 도 8(b)에는 중앙에 볼록한 면을 구비한 패드(P1, P2)가 도시되어 있다. 이처럼 금속핀(320)의 제2 영역(322)이 바디(310)보다 돌출되고 패드(P1, P2)가 제2 영역(322)을 둘러싸도록 형성되면, 금속핀(320)과 패드(P1, P2) 간의 접촉 면적이 충분히 확보될 수 있다. 한편, 패드(P1, P2)는 구리 등의 금속으로 이루어질 수 있고, 도금으로 형성될 수 있다. The pads P1 and P2 may be formed to surround the outer peripheral surface (or side surface) of a portion of the
본 실시예에서 인터포저(300)는 솔더레지스트(SR)를 더 포함할 수 있다.In this embodiment, the
솔더레지스트(SR)는 인터포저(300) 바디(310)의 상하면에 각각 적층되어 패드(P1, P2)를 커버하며, 패드(P1, P2)의 적어도 일부를 노출시킨다. 특히, 인터포저(300)의 상부 패드(P1)의 상면과 하부 패드(P2)의 하면 각각에 있어서, 적어도 일부가 솔더레지스트(SR)에 대해 노출될 수 있다. 솔더레지스트(SR)는 패드(P1, P2)를 보호하고, 패드(P1, P2)가 복수로 형성되는 경우, 복수의 패드(P1, P2) 간의 불필요한 쇼트를 방지할 수 있다.Solder resist SR is stacked on the upper and lower surfaces of the
도 1 내지 도 5를 참조하여 설명한 이전 실시예에 따른 인터포저(300)에서는 금속핀(320)의 제2 영역(322)이 상방향으로 곧게 뻗고, 금속핀(320)의 제2 영역(322)이 제1 기판(100)과 제2 기판(200)에 삽입되기 때문에, 복수의 금속핀(320)을 서로 절연시키는 솔더레지스트(SR)가 필요하지 않을 수 있다. In the
그러나, 본 실시예에서는 패드(P1, P2)가 인터포저(300) 바디(310)의 상하면에 각각 형성되고, 패드(P1, P2)가 금속핀(320)의 제2 영역(322)의 외주면을 둘러싸기 위해서는 패드(P1, P2)의 외경이 금속핀(320)의 직경보다 클 수밖에 없고, 이에 따라 복수의 패드(P1, P2) 간에 불필요한 쇼트가 발생할 가능성이 높다. 따라서, 솔더레지스트(SR)가 인터포저(300) 바디(310)의 상하면에 적층되면, 복수의 패드(P1, P2) 간의 불필요한 쇼트를 방지할 수 있다.However, in this embodiment, the pads P1 and P2 are formed on the upper and lower surfaces of the
본 실시예에서 인터포저(300)는 도전성부재(CM)를 더 포함할 수 있다.In this embodiment, the
도전성부재(CM)는 인터포저(300)의 패드(P1, P2) 상에 접합되며, 구체적으로 솔더레지스트(SR)를 통해 노출되는 패드(P1, P2)에 접합된다. 금속핀(320)의 제2 영역(322)이 바디(310)보다 돌출되고, 패드(P1, P2)가 볼록한 면을 가지는 경우, 도전성부재(CM)와 패드(P1, P2)의 접합 면적이 증가할 수 있다. 도전성부재(CM)는 주석, 납 등의 금속으로 형성될 수 있고, 솔더볼일 수 있다.The conductive member (CM) is bonded to the pads (P1, P2) of the
인터포저(300)의 상측에는 제1 기판(100)이 배치되고, 인터포저(300)의 하측에는 제2 기판(200)이 배치된다. 여기서, 상하의 개념은 상대적인 개념을 이해할 수 있다. 제1 기판(100)과 제2 기판(200) 각각은, 판상으로 이루어지고, 복수의 절연재층과 복수의 회로층으로 구성된 다층기판일 수 있고, 회로층을 기준으로 8층 또는 10층인 다층기판일 수 있다.The
제1 기판(100) 및 제2 기판(200)의 절연재층은 에폭시 수지, 폴리이미드 수지, BT 수지, LCP(Liquid Crystal Polymer) 등과 같은 절연물질로 이루어진 층이다. 회로층은 구리(Cu)와 같은 금속 등의 전도성물질로 이루어지고 특정 패턴을 가지도록 설계된다. 회로층(C1, C2)은 절연재층의 단면 또는 양면에 형성되고, 서로 다른 층의 회로층은 절연재층을 관통하는 비아도체(V1, V2)를 통하여 전기적으로 연결될 수 있다.The insulating material layer of the
제1 기판(100) 및 제2 기판(200)에 있어서, 최외층 회로층은 솔더레지스트(SR)로 커버될 수 있다. 솔더레지스트(SR)는 제1 기판(100) 및 제2 기판(200)의 최외층 회로층을 보호할 수 있다. 솔더레지스트(SR)에는 개구가 형성되고, 개구를 통해 상기 최외층 회로층 일부가 노출될 수 있다. 여기서, 솔더레지스트(SR)의 개구를 통해 노출되는 최외층 회로층 일부는 인터포저(300)와 결합하기 위한 단자(제1 단자(T1) 및 제2 단자(T2))가 될 수 있다.In the
제1 기판(100)의 일면에는 전자소자(이하, 제1 소자(E1))가 실장된다. 여기서, 제1 기판(100)의 일면은 제2 기판(200)을 바라보는 면이다. 제1 소자(E1)는 능동소자, 수동소자, 집적회로 중 적어도 하나일 수 있고, 제1 소자(E1)는 복수로 구현될 수 있고, 복수의 제1 소자(E1)는 능동소자, 수동소자, 집적회로 중 다양하게 선택될 수 있다. 구체적으로 제1 소자(E1)는 AP, Memory, BGA(Ball Grid Array), CSP(Chip Scale Package), LGA(Land Grid Array)와 같은 다수의 집적회로와, 커패시터(capacitor)와 같은 다수의 수동소자를 포함할 수 있다. 제1 소자(E1)는 제1 기판(100)의 표면에 솔더부재(미도시)에 의해 실장될 수 있다. 구체적으로 제1 소자(E1)는 제1 기판(100)의 회로층(C1)에 실장될 수 있다. 특히, 제1 소자(E1)는 제1 기판(100)의 일면 측 최외층 회로층 중 솔더레지스트(SR) 개구를 통해 노출되는 부분에 실장될 수 있다.An electronic device (hereinafter referred to as first device E1) is mounted on one side of the
인터포저(300)가 내측에 중공부(330)를 포함하는 경우, 제1 소자(E1)는 인터포저(300) 중공부(330) 내에 위치할 수 있다. 여기서 인터포저(300)는 제1 소자(E1)를 보호하는 기능을 할 수 있다. 제1 소자(E1)가 복수로 형성되는 경우, 적어도 일부의 제1 소자(E1)가 인터포저(300) 중공부(330) 내에 위치할 수 있다. When the
제2 기판(200)의 일면에는 전자소자(이하, 제2 소자(E2))가 실장된다. 여기서, 제2 기판(200)의 일면은 제1 기판(100)을 바라보는 면이다. 제2 소자(E2)는 능동소자, 수동소자, 집적회로 중 적어도 하나일 수 있고, 제2 소자(E2)는 복수로 구현될 수 있고, 복수의 제2 소자(E2)는 능동소자, 수동소자, 집적회로 중 다양하게 선택될 수 있다. 구체적으로 제2 소자(E2)는 AP, Memory, BGA(Ball Grid Array), CSP(Chip Scale Package), LGA(Land Grid Array)와 같은 다수의 집적회로와, 커패시터(capacitor)와 같은 다수의 수동소자를 포함할 수 있다. 제2 소자(E2)는 제2 기판(200)의 표면에 솔더부재(미도시)에 의해 실장될 수 있다. 구체적으로 제2 소자(E2)는 제2 기판(200)의 회로층(C2)에 실장될 수 있다. 특히, 제2 소자(E2)는 제2 기판(200)의 일면 측 최외층 회로층 중 솔더레지스트(SR) 개구를 통해 노출되는 부분에 실장될 수 있다.An electronic device (hereinafter referred to as a second device E2) is mounted on one side of the
인터포저(300)가 내측에 중공부(330)를 포함하는 경우, 제2 소자(E2)는 인터포저(300) 중공부(330) 내에 위치할 수 있다. 여기서 인터포저(300)는 제2 소자(E2)를 보호하는 기능을 할 수 있다. 제2 소자(E2)가 복수로 형성되는 경우, 적어도 일부의 제2 소자(E2)가 인터포저(300) 중공부(330) 내에 위치할 수 있다. When the
제1 기판(100)과 제2 기판(200)의 면적은 서로 다를 수 있다. 예를 들어, 도 6 및 도 7에 도시된 바와 같이, 제2 기판(200)의 면적이 제1 기판(100)의 면적보다 클 수 있다. 이 경우, 인터포저(300)는 제1 기판(100)과 제2 기판(200)이 중첩되는 영역에 배치되며, 복수의 제2 소자(E2)의 일부는 인터포저(300)의 중공부(330) 내에 위치하고, 복수의 제2 소자(E2)의 다른 일부는 인터포저(300) 외측에 위치할 수 있다. 한편, 도 6 및 도 7과 달리, 제1 기판(100)의 면적이 제2 기판(200)의 면적보다 더 클 수 있고, 복수의 제1 소자(E1)의 일부는 인터포저(300)의 중공부(330) 내에 위치하고, 복수의 제1 소자(E1)의 다른 일부는 인터포저(300) 외측에 위치할 수 있다. 제1 기판(100)과 제2 기판(200) 중 면적이 큰 기판은 메인보드이고, 면적이 작은 기판은 서브기판일 수 있다.The areas of the
한편, 제1 기판(100)의 타면에는 전자소자(이하, 제3 소자(E3))가 실장될 수 있고, 제3 소자(E3)는 복수로 구현되고, 능동소자, 수동소자, 집적회로 중 다양하게 선택될 수 있다. 제3 소자(E3)는 제1 기판(100)의 타면 측 최외층 회로층에 실장될 수 있다. 제1 소자(E1)와 제3 소자(E3)는 제1 기판(100)에 형성된 회로층(C1)과 비아도체(V1)를 통해 전기적으로 연결될 수 있다.Meanwhile, an electronic device (hereinafter referred to as a third device (E3)) may be mounted on the other side of the
또한, 제2 기판(200)의 타면에는 전자소자(이하, 제4 소자(E4))가 실장될 수 있고, 제4 소자(E4)는 복수로 구현되고, 능동소자, 수동소자, 집적회로 중 다양하게 선택될 수 있다. 제4 소자(E4)는 제2 기판(200)의 타면 측 최외층 회로층에 실장될 수 있다. 제2 소자(E2)와 제4 소자(E4)는 제2 기판(200)에 형성된 회로층(C2)과 비아도체(V2)를 통해 전기적으로 연결될 수 있다.Additionally, an electronic device (hereinafter referred to as a fourth device (E4)) may be mounted on the other side of the
도 9(a)를 참조하면, 도 8을 참조하여 설명한 인터포저(300)가 마련된다. Referring to FIG. 9(a), the
도 9(b)를 참조하면, 인터포저(300)는 제1 기판(100)과 제2 기판(200) 사이에 위치하고, 인터포저(300)의 금속핀(320)(제2 영역(322))은 제1 기판(100) 및 제2 기판(200)의 단자(제1 단자(T1) 및 제2 단자(T2))와 대응된다. 특히, 금속핀(320)과 접촉되게 형성된 패드(P1, P2)가 제1 기판(100) 및 제2 기판(200)의 단자(제1 단자(T1) 및 제2 단자(T2))와 대응된다. 인터포저(300)의 패드(P1, P2)와, 제1 기판(100) 및 제2 기판(200)의 단자(제1 단자(T1) 및 제2 단자(T2))는 도전성부재(CM)로 서로 결합될 수 있다. 즉, 인터포저(300)의 상면 패드(P1)는 제1 기판(100)의 단자(제1 단자(T1))와 서로 결합되고, 인터포저(300)의 하면 패드(P2)는 제2 기판(200)의 단자(제2 단자(T2))와 서로 결합된다. Referring to FIG. 9(b), the
도전성부재(CM)는 리플로우 공정을 거쳐 완전히 경화될 수 있고, 패드(P1, P2)와 단자(T1, T2)는 견고하게 결합될 수 있다. 도전성부재(CM) 및 전자소자(E1 내지 E4)의 실장을 위한 솔더부재의 리플로우는 인터포저(300) 바디(310)의 소결 온도보다 낮은 온도에서 이루어질 수 있기 때문에, 리플로우 공정은 인터포저(300) 형상에 영향을 주지 않는다. 이에 따라, 패키지 구조물의 휨이 저감될 수 있다.The conductive member (CM) can be completely cured through a reflow process, and the pads (P1, P2) and the terminals (T1, T2) can be firmly coupled. Since the reflow of the solder member for mounting the conductive member (CM) and the electronic devices (E1 to E4) can be performed at a temperature lower than the sintering temperature of the
도 10은 본 발명의 또 다른 실시예에 따른 인터포저(300)를 나타낸 도면이고, 도 11은 도 10의 인터포저(300)를 이용하여 패키지 구조물을 구현하는 방법을 나타낸 도면이다.FIG. 10 is a diagram showing an
본 발명의 또 다른 실시예에 따른 패키지 구조물은, 인터포저(300), 제1 기판(100) 및 제2 기판(200)을 포함할 수 있다. 먼저 인터포저(300)에 대해 자세하게 설명하기로 한다. A package structure according to another embodiment of the present invention may include an
인터포저(300)는, 바디(body)(310) 및 금속핀(320)을 포함할 수 있다.The
바디(310)는 무기재료로 형성되며, 특히 세라믹을 포함하는 재질로 이루어질 수 있다. 즉, 바디(310)는 산화 알루미늄(Al2O3), 알루미늄질화물(AlN) 등의 물질을 포함하여 제조될 수 있다.The
바디(310)는 내부에 중공부(330)를 구비할 수 있고, 중공부(330)는 바디(310)의 상하면을 관통한다. 이에 따라 바디(310)는 고리 형상으로 형성될 수 있으며, 다각형의 고리, 원형의 고리 등 다양한 형상으로 구현될 수 있다. 또한, 바디(310)는 복수의 조각으로 이루어질 수 있으며, 복수의 조각이 하나의 고리 형상을 만들도록 배치될 수 있다.The
바디(310)는 소정의 높이(두께)를 가지며, 바디(310)의 높이는 제1 기판(100)과 제2 기판(200)의 이격 거리에 따라 결정될 수 있다. 또한, 바디(310)의 상하면은 각각 평평한 면으로 이루어질 수 있다.The
금속핀(320)은 금속으로 형성되는 기둥상 구조물로, 바디(310)를 관통하고, 바디(310)의 상하측으로 각각 돌출될 수 있다. 금속핀(320)은 바디(310)의 두께보다 길게 형성되어 바디(310)의 상하측으로 각각 돌출된다. 금속핀(320)의 돌출된 부분은 제1 기판(100) 및 제2 기판(200)과 전기적으로 연결되며, 금속핀(320)은 패키지 구조물의 상하 방향으로 연장되어 제1 기판(100) 및 제2 기판(200) 간에 신호 전달을 할 수 있다. The
금속핀(320)에 있어서, 바디(310) 내부에 위치하는 부분과 바디(310)보다 돌출된 부분이 일체로 형성된다는 점에서, 본 발명에서의 금속핀(320)은 일반적으로 절연층 내에 형성되는 비아와 구별된다. 또한, 금속핀(320)은 전체적으로 균일한 굵기를 가질 수 있다.In the
금속핀(320)은 복수로 형성될 수 있고, 복수의 금속핀(320)은 서로 이격되어 바디(310) 내에서 서로 절연될 수 있다. 바디(310)가 중공부(330)를 가지고 고리 형상으로 형성되는 경우, 복수의 금속핀(320)은 바디(310)의 고리 형상을 따라 소정의 간격으로 배치될 수 있다. 복수의 금속핀(320) 중 일부는 제1 기판(100) 및 제2 기판(200) 간에 파워(power)를 전달할 수 있고, 또 다른 일부는 전자소자 구동을 위한 유효한 전기 신호를 전달할 수 있고, 또 다른 일부는 그라운드로 사용될 수 있다.The metal pins 320 may be formed in plurality, and the plurality of
금속핀(320)을 이루는 금속은 구리(Cu), 알루미늄(Al), 니켈(Ni) 등 다양할 수 있으며 제한되지 않는다. 금속핀(320)은 금속 재료를 녹여 균일한 굵기로 성형하면서 소정의 길이로 절단하여 제조될 수 있다. 또한, 복수의 금속핀(320)은 금속 재료를 녹여 균일한 굵기로 성형하면서 소정의 길이로 반복 절단하여 제조될 수 있으며, 복수의 금속핀(320) 각각의 굵기가 서로 동일하고, 길이가 동일할 수 있다. 한편, 인터포저(300) 제조 시, 틀(몰드) 내에 금속핀(320)을 위치시킨 후 세라믹 재료를 틀 내에 충전하고 소결하는 방식이 이용될 수 있다.The metal that makes up the
금속핀(320)은 바디(310) 내부에 위치하는 제1 영역(321)과 바디(310)보다 상하로 각각 돌출된 제2 영역(322)으로 구분될 수 있다. 단, 제1 영역(321)과 제2 영역(322)은 일체로 형성된다. 제2 영역(322)의 폭은 제1 영역(321)의 폭보다 크다. 또한, 제2 영역(322)은 바디(310)에 접촉될 수 있다. 즉, 제2 영역(322)은 바디(310)의 상하면 각각에 접촉될 수 있다. 또한, 제2 영역(322)의 표면은 내측으로 함몰된 면을 포함할 수 있다. 제2 영역(322)의 함몰된 면은 도 10(b)에 도시되어 있다. 이러한 제2 영역(322)은 도 6 내지 도 9를 참조하여 설명한 이전 실시예에 따른 인터포저(300)의 패드(P1, P2)와 유사한 역할을 할 수 있다.The
본 실시예에서 인터포저(300)는 솔더레지스트(SR)를 더 포함할 수 있다.In this embodiment, the
솔더레지스트(SR)는 인터포저(300) 바디(310)의 상하면에 각각 적층되어 제2 영역(322)을 커버하며, 제2 영역(322)의 적어도 일부를 노출시킨다. 솔더레지스트(SR)는 제2 영역(322)을 보호하고, 금속핀(320)이 복수로 형성되는 경우, 복수의 제2 영역(322) 간의 불필요한 쇼트를 방지할 수 있다.Solder resist SR is stacked on the upper and lower surfaces of the
본 실시예에서 인터포저(300)는 도전성부재(CM)를 더 포함할 수 있다.In this embodiment, the
도전성부재(CM)는 금속핀(320)의 제2 영역(322) 상에 접합된다. 금속핀(320)의 제2 영역(322)이 함몰된 면을 가지는 경우, 도전성부재(CM)와 제2 영역(322)의 접합 면적이 증가할 수 있다. 도전성부재(CM)는 주석, 납 등의 금속으로 형성될 수 있고, 솔더볼일 수 있다.The conductive member (CM) is bonded to the
인터포저(300)의 상측에는 제1 기판(100)이 배치되고, 인터포저(300)의 하측에는 제2 기판(200)이 배치된다. 여기서, 상하의 개념은 상대적인 개념을 이해할 수 있다. 한편, 본 실시예의 제1 기판(100)과 제2 기판(200)과 관련하여서, 도 6 내지 도 9를 참조하여 설명한 것과 동일하므로, 설명을 생략한다.The
도 11(a)를 참조하면, 도 10을 참조하여 설명한 인터포저(300)가 마련된다.Referring to FIG. 11(a), the
도 11(b)를 참조하면, 인터포저(300)는 제1 기판(100)과 제2 기판(200) 사이에 위치하고, 인터포저(300)의 금속핀(320)(제2 영역(322))은 제1 기판(100) 및 제2 기판(200)의 단자(제1 단자(T1) 및 제2 단자(T2))와 대응된다. 금속핀(320)의 제2 영역(322)과 제1 기판(100) 및 제2 기판(200)의 단자(제1 단자(T1) 및 제2 단자(T2))는 도전성부재(CM)로 서로 결합될 수 있다. 즉, 인터포저(300)의 상면에 위치한 제2 영역(322)은 제1 기판(100)의 단자(제1 단자(T1))와 서로 결합되고, 인터포저(300)의 하면에 위치한 제2 영역(322)은 제2 기판(200)의 단자(제2 단자(T2))와 서로 결합된다.Referring to FIG. 11(b), the
도전성부재(CM)는 리플로우 공정을 거쳐 완전히 경화될 수 있고, 제2 영역(322)과 단자(T1, T2)는 견고하게 결합될 수 있다. 도전성부재(CM) 및 전자소자(E1 내지 E4)의 실장을 위한 솔더부재의 리플로우는 인터포저(300) 바디(310)의 소결 온도보다 낮은 온도에서 이루어질 수 있기 때문에, 리플로우 공정은 인터포저(300) 형상에 영향을 주지 않는다. 이에 따라, 패키지 구조물의 휨이 저감될 수 있다.The conductive member (CM) can be completely hardened through a reflow process, and the
이상, 본 발명의 일 실시예에 대하여 설명하였으나, 해당 기술 분야에서 통상의 지식을 가진 자라면 특허청구범위에 기재된 본 발명의 사상으로부터 벗어나지 않는 범위 내에서, 구성 요소의 부가, 변경, 삭제 또는 추가 등에 의해 본 발명을 다양하게 수정 및 변경시킬 수 있을 것이며, 이 또한 본 발명의 권리범위 내에 포함된다고 할 것이다.Above, an embodiment of the present invention has been described, but those skilled in the art can add, change, delete or add components without departing from the spirit of the present invention as set forth in the patent claims. The present invention may be modified and changed in various ways, and this will also be included within the scope of rights of the present invention.
100: 제1 기판
H1: 제1 관통홀
T1: 제1 단자
E1: 제1 소자
200: 제2 기판
H2: 제2 관통홀
T2: 제2 단자
E2: 제2 소자
300: 인터포저
310: 바디
320: 금속핀
330: 중공부
LM: 저융점금속
CM: 도전성부재100: first substrate
H1: first through hole
T1: first terminal
E1: first element
200: second substrate
H2: Second through hole
T2: second terminal
E2: second element
300: Interposer
310: body
320: metal pin
330: Ministry of SMEs and Startups
LM: low melting point metal
CM: conductive member
Claims (26)
상기 바디를 관통하여 상기 바디의 상하측으로 각각 돌출되는 금속핀; 및
상기 금속핀과 접촉되도록 상기 바디의 상하면에 각각 형성되며, 상기 금속핀과 구별되는 패드; 를 포함하는 인터포저.
A body made of a material containing ceramic;
Metal pins that penetrate the body and protrude from the upper and lower sides of the body, respectively; and
Pads formed on the upper and lower surfaces of the body to contact the metal pins, respectively, and distinct from the metal pins; An interposer containing .
상기 바디의 내측에는 상기 바디의 상하면을 관통하는 중공부가 형성된 인터포저.
According to paragraph 1,
An interposer having a hollow portion formed inside the body, penetrating the upper and lower surfaces of the body.
상기 금속핀은 복수로 형성되고,
상기 복수의 금속핀은 서로 이격되어 배치되는 인터포저.
According to paragraph 1,
The metal pins are formed in plural,
An interposer in which the plurality of metal pins are arranged to be spaced apart from each other.
상기 패드는 상기 금속핀의 상기 바디보다 돌출된 부분의 외주면을 둘러싸는 인터포저.
According to paragraph 1,
The pad is an interposer surrounding the outer peripheral surface of a portion of the metal pin that protrudes from the body.
상기 패드는 상기 금속핀의 상기 바디보다 돌출된 부분의 전체를 커버하는 인터포저.
According to paragraph 1,
The pad covers the entire portion of the metal pin that protrudes from the body.
상기 패드의 표면은 외측으로 볼록한 면을 포함하는 인터포저.
According to clause 6,
An interposer wherein the surface of the pad includes an outwardly convex surface.
상기 패드를 노출시키도록 상기 바디의 상하면에 각각 적층되는 솔더레지스트를 더 포함하는 인터포저.
According to paragraph 1,
An interposer further comprising solder resist stacked on the upper and lower surfaces of the body to expose the pad.
상기 바디를 관통하여 상기 바디의 상면 및 하면으로 각각 돌출되는 금속핀; 을 포함하고,
상기 금속핀은, 상기 바디 내부에 위치하는 제1 영역 및 상기 바디의 상면 및 하면으로 각각 돌출된 제2 영역을 포함하고,
상기 제2 영역의 폭은 상기 제1 영역의 폭보다 크고,
상기 제2 영역의 표면은 내측으로 함몰된 면을 포함하되, 상기 제2 영역의 표면은 상기 바디의 상면 및 하면보다 돌출된 인터포저.
A body with flat upper and lower surfaces and made of a material containing ceramic; and
Metal pins that penetrate the body and protrude from the upper and lower surfaces of the body, respectively; Including,
The metal pin includes a first region located inside the body and a second region protruding from the upper and lower surfaces of the body, respectively,
The width of the second area is greater than the width of the first area,
An interposer wherein the surface of the second region includes a surface that is recessed inward, and the surface of the second region protrudes from the upper and lower surfaces of the body.
상기 제2 영역은 상기 바디에 접촉되는 인터포저.
According to clause 9,
The second area is an interposer in contact with the body.
상기 인터포저 상면에 결합된 제1 기판; 및
상기 인터포저 하면에 결합된 제2 기판을 포함하고,
상기 인터포저는,
세라믹을 포함하는 재질의 바디,
상기 바디를 관통하여 상기 바디의 상하측으로 각각 돌출되는 금속핀, 및
상기 금속핀과 접촉되도록 상기 바디의 상하면에 각각 형성되며, 상기 금속핀과 구별되는 패드를 포함하고,
상기 금속핀은 상기 제1 기판 및 상기 제2 기판 각각과 전기적으로 연결되는 패키지 구조물.
interposer;
a first substrate coupled to the upper surface of the interposer; and
It includes a second substrate coupled to the lower surface of the interposer,
The interposer is,
A body made of a material containing ceramic,
Metal pins that penetrate the body and protrude from the upper and lower sides of the body, respectively, and
It is formed on the upper and lower surfaces of the body to be in contact with the metal pin, and includes a pad that is distinct from the metal pin,
The metal pin is a package structure electrically connected to each of the first substrate and the second substrate.
상기 제1 기판과 상기 제2 기판 중 적어도 하나에는 전자소자가 실장되고,
상기 바디의 내측에는 상기 바디의 상하면을 관통하며, 상기 전자소자를 수용하는 중공부가 형성된 패키지 구조물.
According to clause 12,
Electronic devices are mounted on at least one of the first substrate and the second substrate,
A package structure in which a hollow portion is formed inside the body, penetrates the upper and lower surfaces of the body, and accommodates the electronic device.
상기 금속핀은 복수로 형성되고,
상기 복수의 금속핀은 서로 이격되어 배치되는 패키지 구조물.
According to clause 12,
The metal pins are formed in plural,
A package structure in which the plurality of metal pins are arranged to be spaced apart from each other.
상기 제1 기판 및 상기 제2 기판에는 단자가 각각 형성되고,
상기 단자는 상기 패드와 도전성부재로 접합되는 패키지 구조물.
According to clause 12,
Terminals are formed on each of the first and second substrates,
A package structure in which the terminal is joined to the pad and a conductive member.
상기 패드는 상기 금속핀의 상기 바디보다 돌출된 부분의 외주면을 둘러싸는 패키지 구조물.
According to clause 12,
The pad is a package structure surrounding the outer peripheral surface of a portion of the metal pin that protrudes from the body.
상기 패드는 상기 금속핀의 상기 바디보다 돌출된 부분의 전체를 커버하는 패키지 구조물.
According to clause 12,
The pad is a package structure that covers the entire portion of the metal pin that protrudes beyond the body.
상기 패드의 표면은 외측으로 볼록한 면을 포함하는 패키지 구조물.
According to clause 20,
A package structure wherein the surface of the pad includes an outwardly convex surface.
상기 인터포저는, 상기 패드를 노출시키도록 상기 바디의 상하면에 각각 적층되는 솔더레지스트를 더 포함하는 패키지 구조물.
According to clause 12,
The interposer is a package structure further comprising solder resist stacked on the upper and lower surfaces of the body to expose the pad.
상기 인터포저 상면에 결합된 제1 기판; 및
상기 인터포저 하면에 결합된 제2 기판;을 포함하고,
상기 인터포저는,
상면 및 하면이 평평하며, 세라믹을 포함하는 재질의 바디, 및
상기 바디를 관통하여 상기 바디의 상면 및 하면으로 각각 돌출되는 금속핀을 포함하고,
상기 금속핀은, 상기 바디 내부에 위치하는 제1 영역, 및 상기 바디의 상면 및 하면으로 각각 돌출된 제2 영역을 포함하고,
상기 제2 영역의 폭은 상기 제1 영역의 폭보다 크고,
상기 제2 영역의 표면은 내측으로 함몰된 면을 포함하되, 상기 제2 영역의 표면은 상기 바디의 상면 및 하면보다 돌출되고,
상기 금속핀은 상기 제1 기판 및 상기 제2 기판 각각과 연결되는 패키지 구조물.
interposer;
a first substrate coupled to the upper surface of the interposer; and
Includes a second substrate coupled to the lower surface of the interposer,
The interposer is,
A body with flat upper and lower surfaces and made of a material containing ceramic, and
Includes metal pins that penetrate the body and protrude from the upper and lower surfaces of the body, respectively;
The metal pin includes a first region located inside the body and a second region protruding from the upper and lower surfaces of the body, respectively,
The width of the second area is greater than the width of the first area,
The surface of the second region includes a surface that is recessed inward, and the surface of the second region protrudes from the upper and lower surfaces of the body,
The metal pin is a package structure connected to each of the first substrate and the second substrate.
상기 제2 영역은 상기 바디에 접촉되는 패키지 구조물.
According to clause 23,
The second area is a package structure in contact with the body.
상기 제1 기판 및 상기 제2 기판에는 단자가 각각 형성되고,
상기 단자는 상기 제2 영역과 도전성부재로 접합되는 패키지 구조물.
According to clause 23,
Terminals are formed on each of the first and second substrates,
A package structure in which the terminal is joined to the second region with a conductive member.
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