KR102388820B1 - 표시 장치 - Google Patents

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Abstract

표시 장치의 화소들 각각은 제1 화소 전극, 제2 화소 전극, 및 공통 전극을 포함한다. 제1 화소 전극 및 제2 화소 전극은 데이터 라인의 연장 방향으로 서로 이격된다. 제2 화소 전극은 제1 내지 제4 줄기부들을 포함한다. 상기 제3 및 제4 줄기부들은 상기 제1 및 제2 줄기부들에 비해 상기 제1 화소 전극으로부터 제2 방향으로 더 멀리 이격된다. 상기 제1 및 제2 줄기부들은 V 형상을 이루고, 제3 및 제4 줄기부들은 뒤집어진 V 형상을 이룰 수 있다.

Description

표시 장치{DISPLAY APPARATUS}
본 발명은 표시 장치에 관한 것으로, 좀 더 상세하게는 액정 분자의 배향이 블랙 매트릭스의 배치 영역을 감소시켜 표시 신뢰성을 향상시킬 수 있는 표시 장치에 관한 것이다.
표시 장치는 복수의 화소들에 대응되는 복수의 화소 전극들을 포함하는 제1 기판, 제1 기판과 마주보며 공통 전극이 형성된 제2 기판, 및 제1 기판과 제2 기판 사이에 개재된 액정층을 포함한다. 화소 전극들에 인가되는 데이터 전압과 공통 전극에 인가되는 공통 전압에 의해 형성된 전기장에 의해 액정층의 액정 분자들의 배열이 변화된다. 액정 분자들의 배열에 따라서 광 투과율이 조절되어 영상이 표시된다.
표시 장치는 다른 표시장치에 비해 낮은 시야각 성능을 갖는다. 측면 시인성이 정면 시인성에 가까워져야 시야각 성능이 개선될 수 있다. 시야각 문제를 개선하기 위해 화소를 복수 개의 서브 화소로 나누어 휘도를 달리 구동하는 기술과 표시 장치의 화소 전극들과 공통 전극들 중 적어도 일부에 복수의 슬릿을 형성한 구조가 개발되었다. 화소를 휘도가 서로 상이한 복수개의 서브 화소로 나누어 구동하는 경우에, 화소 전극과 공통 전극 형상에 따라 일부 영역에서 정면 및 측면 휘도 차이에 의해 얼룩이 시인될 수 있다.
본 발명의 목적은 시야각에 의한 표시 품질 저하 문제를 해결할 수 있는 표시 장치를 제공하는데 있다.
본 발명의 실시 예에 따른 표시 장치는 게이트 라인들 및 데이터 라인들에 연결된 복수의 화소들이 배치된 표시 패널을 포함하고, 상기 화소들 각각은, 제1 화소 영역에 배치된 제1 화소 전극, 제2 화소 영역에 배치된 제2 화소 전극, 상기 제1 화소 영역 및 상기 제2 화소 영역 사이의 제1 경계 영역의 소정의 영역에 배치된 블랙 매트릭스, 제1 방향으로 배열된 상기 제1 화소 영역들 사이 및 상기 제2 화소 영역들 사이에 배치되어 상기 제1 방향과 교차하는 제2 방향으로 연장된 차폐 전극, 및 상기 차폐 전극으로부터 상기 제1 방향으로 분기되어 상기 제1 경계 영역에서 상기 블랙 매트릭스를 사이에 두고 배치된 제1 및 제2 서브 차폐 전극들을 포함한다.


본 발명의 실시예에 따른 표시 장치는, 제1 방향으로 연장된 게이트 라인, 상기 제1 방향과 교차하는 제2 방향으로 연장하는 데이터 라인들, 및 상기 게이트 라인 및 상기 데이터 라인들 중 대응하는 데이터 라인에 연결된 화소를 포함할 수 있다.
상기 화소는, 제1 화소 전극; 상기 제1 화소 전극과 상기 제2 방향으로 이격된 제2 화소 전극; 및 상기 제1 및 제2 화소 전극들과 마주하는 공통 전극을 포함할 수 있다.
상기 데이터 라인들 중 인접한 두 개의 데이터 라인들 사이에서 상기 두 개의 데이터 라인들 사이의 중심을 지나고 상기 제2 방향에 평행한 가상의 선을 기준으로 좌측 영역과 우측 영역이 정의될 수 있다.
상기 제1 및 제2 방향들에 의해 정의된 사분면의 중심으로부터 상기 사분면의 제1 사분면으로 연장되는 제3 방향 및 상기 사분면의 중심으로부터 상기 사분면의 제2 사분면으로 연장되는 제4 방향이 정의될 수 있다.
상기 제2 화소 전극은, 제1 내지 제4 줄기부들 및 제1 내지 제4 가지부들을 포함할 수 있다.
상기 제1 줄기부는 상기 우측 영역에 배치되고 상기 제3 방향으로 연장될 수 있다.
상기 제2 줄기부는 상기 제1 줄기부와 상기 제1 방향으로 인접하고, 상기 좌측 영역에 배치되고 상기 제4 방향으로 연장될 수 있다.
상기 제3 줄기부는 상기 제2 방향으로 상기 제1 줄기부에 비해 상기 제1 화소 전극으로부터 더 멀리 이격되고, 상기 우측 영역에 배치되고 상기 제4 방향으로 연장될 수 있다.
상기 제4 줄기부는 상기 제2 방향으로 상기 제2 줄기부에 비해 상기 제1 화소 전극으로부터 더 멀리 이격되고, 상기 좌측 영역에 배치되고 상기 제3 방향으로 연장될 수 있다.
상기 제1 가지부들은 상기 제1 줄기부로부터 상기 제4 방향으로 돌출되고 서로 이격될 수 있다.
상기 제2 가지부들은 상기 제2 줄기부로부터 상기 제3 방향으로 돌출되고 서로 이격될 수 있다.
상기 제3 가지부들은 상기 제3 줄기부로부터 상기 제3 방향으로 돌출되고 서로 이격될 수 있다.
상기 제4 가지부들은 상기 제4 줄기부로부터 상기 제4 방향으로 돌출되고 서로 이격될 수 있다.
상기 제1 내지 제4 줄기부들의 단부들은 서로 연결될 수 있다.
상기 제1 가지부들은 상기 제3 방향으로 연장된 상기 제1 줄기부의 일변으로부터 돌출된 제1 서브 가지부 및 상기 제3 방향으로 연장된 상기 제1 줄기부의 타변으로부터 돌출된 제2 서브 가지부를 포함할 수 있다.
상기 제2 가지부들은 상기 제4 방향으로 연장된 상기 제2 줄기부의 일변으로부터 돌출된 제3 서브 가지부 및 상기 제4 방향으로 연장된 제2 줄기부의 타변으로부터 돌출된 제4 서브 가지부를 포함할 수 있다.
상기 제3 가지부들은 상기 제3 방향으로 연장된 상기 제3 줄기부의 일변으로부터 돌출된 제5 서브 가지부 및 상기 제3 방향으로 연장된 상기 제3 줄기부의 타변으로부터 돌출된 제6 서브 가지부를 포함할 수 있다.
상기 제4 가지부들은 상기 제4 방향으로 연장된 상기 제4 줄기부의 일변으로부터 돌출된 제7 서브 가지부 및 상기 제4 방향으로 연장된 제4 줄기부의 타변으로부터 돌출된 제8 서브 가지부를 포함할 수 있다.
상기 제1 내지 제8 서브 가지부들 각각은 순서대로, 증가 가지들, 유지 가지들, 및 감소 가지들을 포함할 수 있다.
상기 증가 가지들은 상기 제1 내지 제4 줄기부들 중 대응되는 줄기부의 연장방향으로 상기 대응되는 줄기부의 일단에서 타단으로 갈수록 길이가 증가할 수 있다. 상기 유지 가지들은 일정한 길이를 가질 수 있다. 상기 감소 가지들은 상기 대응되는 줄기부의 상기 일단에서 상기 타단으로 갈수록 길이가 감소할 수 있다.
상기 제1 화소 전극은, 제5 줄기부, 제6 줄기부, 제5 가지부들 및 제6 가지부들을 더 포함할 수 있다. 상기 제5 줄기부는 상기 상기 우측 영역에 배치되고, 상기 제3 방향으로 연장될 수 있다. 상기 제6 줄기부는 상기 제5 줄기부와 상기 제1 방향으로 인접하고, 상기 좌측 영역에 배치되고 상기 제4 방향으로 연장될 수 있다. 상기 제5 가지부들은 상기 제5 줄기부로부터 상기 제4 방향으로 돌출되고 서로 이격될 수 있다. 상기 제6 가지부들은 상기 제6 줄기부로부터 상기 제3 방향으로 돌출되고 서로 이격될 수 있다.
상기 제5 및 제6 줄기부들의 단부들은 서로 연결될 수 있다.
상기 제5 가지부들은 상기 제3 방향으로 연장된 상기 제5 줄기부의 일변으로부터 돌출된 제9 서브 가지부 및 상기 제3 방향으로 연장된 상기 제5 줄기부의 타변으로부터 돌출된 제10 서브 가지부를 포함할 수 있다. 상기 제6 가지부들은 상기 제4 방향으로 연장된 상기 제6 줄기부의 일변으로부터 돌출된 제11 서브 가지부 및 상기 제4 방향으로 연장된 제6 줄기부의 타변으로부터 돌출된 제12 서브 가지부를 포함할 수 있다.
상기 제9 내지 제12 서브 가지부들 각각은 순서대로, 증가 가지들, 유지 가지들, 및 감소 가지들을 포함할 수 있다. 상기 증가 가지들은 상기 제5 및 제6 줄기부들 중 대응되는 줄기부의 연장방향으로 상기 대응되는 줄기부의 일단에서 타단으로 갈수록 길이가 증가할 수 있다. 상기 유지 가지들은 일정한 길이를 가질 수 있다. 상기 감소 가지들은 상기 대응되는 줄기부의 상기 일단에서 상기 타단으로 갈수록 길이가 감소할 수 있다.
상기 공통 전극은, 제1 공통 전극 및 제2 공통 전극을 포함할 수 있다. 상기 제1 공통 전극은 상기 제1 줄기부과 중첩하고 상기 제3 방향으로 연장된 제1 연장부 및 상기 제1 연장부의 일단에 연결되고 상기 제2 줄기부와 중첩하고 상기 제4 방향으로 연장된 제2 연장부를 포함할 수 있다. 상기 제2 공통 전극은 상기 제3 줄기부와 중첩하고 상기 제4 방향으로 연장된 제3 연장부 및 상기 제3 연장부의 일단에 연결되고 상기 제4 줄기부와 중첩하고 상기 제3 방향으로 연장된 제4 연장부를 포함할 수 있다.
상기 제1 공통 전극은, 제1 날개부, 제2 날개부, 및 제1 세로 연장부를 더 포함할 수 있다. 상기 제1 날개부는 상기 제1 연장부의 상기 일단과 이격된 상기 제1 연장부의 타단으로부터 상기 제2 방향으로 연장되고, 상기 제1 줄기부와 중첩할 수 있다. 상기 제2 날개부는 상기 제1 연장부의 상기 일단과 연결된 상기 제2 연장부의 일단과 이격된 상기 제2 연장부의 타단으로부터 상기 제2 방향으로 연장되고, 상기 제2 줄기부와 중첩할 수 있다. 상기 제1 세로 연장부는 상기 제1 및 제2 연장부들의 상기 일단들로부터 상기 제2 방향으로 연장될 수 있다.
상기 제2 공통 전극은, 제3 날개부, 제4 날개부, 및 제2 세로 연장부를 더 포함할 수 있다. 상기 제3 날개부는 상기 제3 연장부의 상기 일단과 이격된 상기 제3 연장부의 타단으로부터 상기 제4 방향으로 연장되고, 상기 제3 줄기부와 중첩할 수 있다. 상기 제4 날개부는 상기 제4 연장부의 상기 일단과 연결된 상기 제4 연장부의 일단과 이격된 상기 제4 연장부의 타단으로부터 상기 제2 방향으로 연장되고, 상기 제4 줄기부와 중첩할 수 있다. 상기 제2 세로 연장부는 상기 제3 및 제4 연장부들의 상기 일단들로부터 상기 제2 방향으로 연장될 수 있다.
상기 제1 내지 제4 날개부들 각각은 제1 내지 제4 연장부들 각각과 둔각을 형성할 수 있다. 상기 제1 세로 연장부는 상기 제1 및 제2 줄기부들 각각과 둔각을 형성할 수 있다. 상기 제2 세로 연장부는 상기 제3 및 제4 줄기부들 각각과 둔각을 형성할 수 있다.
상기 제1 화소 전극은, 제5 줄기부, 제6 줄기부, 제5 가지부들, 및 제6 가지부들을 포함할 수 있다. 상기 제5 줄기부는 상기 상기 우측 영역에 배치되고, 상기 제3 방향으로 연장될 수 있다. 상기 제6 줄기부는 상기 제5 줄기부와 상기 제1 방향으로 인접하고, 상기 좌측 영역에 배치되고 상기 제4 방향으로 연장될 수 있다. 상기 제5 가지부들은 상기 제5 줄기부로부터 상기 제4 방향으로 돌출되고 서로 이격될 수 있다. 상기 제6 가지부들은 상기 제6 줄기부로부터 상기 제3 방향으로 돌출되고 서로 이격될 수 있다.
상기 공통 전극은, 상기 제5 줄기부과 중첩하고 상기 제3 방향으로 연장된 제5 연장부 및 상기 제5 연장부의 일단에 연결되고 상기 제6 줄기부와 중첩하고 상기 제4 방향으로 연장된 제6 연장부를 포함하는 제3 공통 전극을 더 포함할 수 있다.
상기 제3 공통 전극은, 제5 날개부, 제6 날개부, 및 제3 세로 연장부를 더 포함할 수 있다. 상기 제5 날개부는 상기 제5 연장부의 상기 일단과 이격된 상기 제5 연장부의 타단으로부터 상기 제2 방향으로 연장되고, 상기 제5 줄기부와 중첩할 수 있다. 상기 제6 날개부는 상기 제6 연장부의 상기 일단과 연결된 상기 제6 연장부의 일단과 이격된 상기 제6 연장부의 타단으로부터 상기 제2 방향으로 연장되고, 상기 제6 줄기부와 중첩할 수 있다. 상기 제3 세로 연장부는 상기 제5 및 제6 연장부들의 상기 일단들로부터 상기 제2 방향으로 연장될 수 있다.
상기 제5 및 제6 날개부들 각각은 제5 및 제6 연장부들 각각과 둔각을 형성할 수 있다. 상기 제3 세로 연장부는 상기 제5 및 제6 줄기부들 각각과 둔각을 형성할 수 있다.
상기 화소는, 제1 트랜지스터, 제2 트랜지스터, 및 제3 트랜지스터를 포함할 수 있다. 상기 제1 트랜지스터는 상기 게이트 라인, 상기 대응하는 데이터 라인, 및 상기 제1 화소 전극에 연결될 수 있다. 상기 제2 트랜지스터는 상기 게이트 라인, 상기 대응하는 데이터 라인, 및 상기 제2 화소 전극에 연결될 수 있다. 상기 제3 트랜지스터는 상기 게이트 라인, 상기 제2 화소 전극, 및 상기 대응하는 데이터 라인과 동일층에 배치된 스토리지 라인에 연결될 수 있다.
상기 제1 내지 제3 트랜지스터들은 상기 제2 방향으로 상기 제1 및 제2 화소 전극들 사이의 제1 경계 영역에 배치될 수 있다.
상기 화소는, 상기 데이터 라인들을 커버하고, 상기 제1 및 제2 화소 전극들과 동일한 층상에 배치되는 차폐 전극을 더 포함할 수 있다.
본 발명의 실시예에 따른 표시 장치는 제1 방향으로 연장된 게이트 라인, 상기 제1 방향과 교차하는 제2 방향으로 연장하는 데이터 라인들, 및 상기 게이트 라인 및 상기 데이터 라인들 중 대응하는 데이터 라인에 연결된 화소를 포함할 수 있다.
상기 화소는, 제1 화소 전극, 제2 화소 전극, 및 공통 전극을 포함할 수 있다. 상기 제2 화소 전극은 상기 제1 화소 전극과 상기 제2 방향으로 이격될 수 있다. 상기 공통 전극은 상기 제1 및 제2 화소 전극들과 마주할 수 있다.
상기 데이터 라인들 중 인접한 두 개의 데이터 라인들 사이에서 상기 두 개의 데이터 라인들 사이의 중심을 지나고 상기 제2 방향에 평행한 가상의 선을 기준으로 좌측 영역과 우측 영역이 정의될 수 있다.
상기 제1 및 제2 방향들에 의해 정의된 사분면의 중심으로부터 상기 사분면의 제1 사분면으로 연장되는 제3 방향 및 상기 사분면의 중심으로부터 상기 사분면의 제2 사분면으로 연장되는 제4 방향이 정의될 수 있다.
상기 제2 화소 전극은, 제1 줄기부, 제2 줄기부, 제3 줄기부, 및 제4 줄기부를 포함할 수 있다. 상기 제1 줄기부는 상기 우측 영역에 배치되고 상기 제3 방향으로 연장될 수 있다. 상기 제2 줄기부는 상기 제1 줄기부와 상기 제1 방향으로 인접하고, 상기 좌측 영역에 배치되고 상기 제4 방향으로 연장될 수 있다. 상기 제3 줄기부는 상기 제1 줄기부와 상기 제2 방향으로 인접하고, 상기 우측 영역에 배치되고 상기 제4 방향으로 연장될 수 있다. 상기 제4 줄기부는 상기 제2 줄기부와 상기 제2 방향으로 인접하고, 상기 좌측 영역에 배치되고 상기 제3 방향으로 연장될 수 있다.
상기 제1 줄기부 및 상기 제2 줄기부는 서로 연결되어 V 형상을 가질 수 있다. 상기 제3 줄기부 및 상기 제4 줄기부는 서로 연결되어 뒤집어진 V 형상을 가질 수 있다.
본 발명의 표시 장치는 화소 전극과 공통 전극의 형상으로 인해 표시 영역에서 정면 및 측면 휘도 차이로 인한 얼룩이 시인되는 문제를 해결할 수 있다.
도 1은 본 발명의 일 실시 예에 따른 표시 장치의 평면도이다.
도 2는 도 1에 도시된 화소의 레이 아웃이다.
도 3은 도 2에 도시된 I-I'선의 단면도이다.
도 4는 도 2에 도시된 화소의 등가 회로도이다.
도 5는 하나의 화소에 대응하는 화소 전극과 차폐 전극을 도시한 평면도이다.
도 6은 제2 화소 전극의 제1 줄기부 및 제1 가지부를 확대하여 도시한 평면도이다.
도 7은 하나의 화소에 대응하는 공통 전극을 도시한 평면도이다.
도 8은 본 발명의 비교예에 따른 화소 전극의 일부와 공통 전극의 일부를 도시한 도면이다.
도 9는 본 발명의 다른 실시예에서 하나의 화소에 대응하는 공통 전극을 도시한 평면도이다
본 발명의 이점 및 특징, 그리고 그것들을 달성하는 방법은 첨부되는 도면과 함께 상세하게 후술되어 있는 실시 예들을 참조하면 명확해질 것이다. 그러나 본 발명은 이하에서 개시되는 실시 예들에 한정되는 것이 아니라 서로 다른 다양한 형태로 구현될 것이며, 단지 본 실시 예들은 본 발명의 개시가 완전하도록 하며, 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자에게 발명의 범주를 완전하게 알려주기 위해 제공되는 것이며, 본 발명은 청구항의 범주에 의해 정의될 뿐이다. 명세서 전체에 걸쳐 동일 참조 부호는 동일 구성 요소를 지칭한다.
소자(elements) 또는 층이 다른 소자 또는 층의 "위(on)" 또는 "상(on)"으로 지칭되는 것은 다른 소자 또는 층의 바로 위뿐만 아니라 중간에 다른 층 또는 다른 소자를 개재한 경우를 모두 포함한다. 반면, 소자가 "직접 위(directly on)" 또는 "바로 위"로 지칭되는 것은 중간에 다른 소자 또는 층을 개재하지 않은 것을 나타낸다. "및/또는"은 언급된 아이템들의 각각 및 하나 이상의 모든 조합을 포함한다.
공간적으로 상대적인 용어인 "아래(below)", "아래(beneath)", "하부(lower)", "위(above)", "상부(upper)" 등은 도면에 도시되어 있는 바와 같이 하나의 소자 또는 구성 요소들과 다른 소자 또는 구성 요소들과의 상관관계를 용이하게 기술하기 위해 사용될 수 있다. 공간적으로 상대적인 용어는 도면에 도시되어 있는 방향에 더하여 사용시 또는 동작 시 소자의 서로 다른 방향을 포함하는 용어로 이해되어야 한다. 명세서 전체에 걸쳐 동일 참조 부호는 동일 구성 요소를 지칭한다.
비록 제 1, 제 2 등이 다양한 소자, 구성요소 및/또는 섹션들을 서술하기 위해서 사용되나, 이들 소자, 구성요소 및/또는 섹션들은 이들 용어에 의해 제한되지 않음은 물론이다. 이들 용어들은 단지 하나의 소자, 구성요소 또는 섹션들을 다른 소자, 구성요소 또는 섹션들과 구별하기 위하여 사용하는 것이다. 따라서, 이하에서 언급되는 제 1 소자, 제 1 구성요소 또는 제 1 섹션은 본 발명의 기술적 사상 내에서 제 2 소자, 제 2 구성요소 또는 제 2 섹션일 수도 있음은 물론이다.
본 명세서에서 기술하는 실시 예들은 본 발명의 이상적인 개략도인 평면도 및 단면도를 참고하여 설명될 것이다. 따라서, 제조 기술 및/또는 허용 오차 등에 의해 예시도의 형태가 변형될 수 있다. 따라서, 본 발명의 실시 예들은 도시된 특정 형태로 제한되는 것이 아니라 제조 공정에 따라 생성되는 형태의 변화도 포함하는 것이다. 따라서, 도면에서 예시된 영역들은 개략적인 속성을 가지며, 도면에서 예시된 영역들의 모양은 소자의 영역의 특정 형태를 예시하기 위한 것이고, 발명의 범주를 제한하기 위한 것은 아니다.
이하, 첨부된 도면들을 참조하여 본 발명의 바람직한 실시 예를 보다 상세하게 설명한다.
도 1은 본 발명의 일 실시 예에 따른 표시 장치의 평면도이다.
도 1을 참조하면, 본 발명의 실시 예에 따른 표시장치(500)는 표시 패널(100), 게이트 구동부(200), 데이터 구동부(300), 및 구동 회로 기판(400)을 포함한다.
표시 패널(100)은 복수의 화소들(PX11~PXnm), 복수의 게이트 라인들(GL1~GLn), 및 복수의 데이터 라인들(DL1~DLm)을 포함한다. 표시 패널(100)의 평면상의 영역은 표시 영역(DA) 및 표시 영역(DA) 주변의 비 표시 영역(NDA)을 포함한다.
화소들(PX11~PXnm)은 매트릭스 형태로 배열되어 표시 영역(DA)에 배치된다. 예를 들어 화소들(PX11~PXnm)은 서로 교차하는 n개의 행들 및 m개의 열들로 배열될 수 있다. m 및 n은 0보다 큰 정수이다.
게이트 라인들(GL1~GLn) 및 데이터 라인들(DL1~DLm)은 서로 절연되어 교차하도록 배치된다. 게이트 라인들(GL1~GLn)은 게이트 구동부(200)에 연결되어 순차적인 게이트 신호들을 수신할 수 있다. 데이터 라인들(DL1~DLm)은 데이터 구동부(300)에 연결되어 아날로그 형태의 데이터 전압들을 수신할 수 있다.
화소들(PX11~PXnm)은 대응하는 게이트 라인들(GL1~GLn) 및 대응하는 데이터 라인들(DL1~DLm)에 연결된다. 화소들(PX11~PXnm)은 대응하는 게이트 라인들(GL1~GLn)을 통해 제공받은 게이트 신호들에 응답하여 대응하는 데이터 라인들(DL1~DLm)을 통해 데이터 전압들을 제공받는다. 화소들(PX11~PXnm)은 데이터 전압들에 대응하는 계조를 표시한다.
게이트 구동부(200)는 구동 회로 기판(400)에 실장된 타이밍 컨트롤러(미 도시됨)로부터 제공된 게이트 제어 신호에 응답하여 게이트 신호들을 생성한다. 게이트 신호들은 게이트 라인들(GL1~GLn)을 통해 순차적으로 그리고 행 단위로 화소들(PX11~PXnm)에 제공된다. 그 결과 화소들(PX11~PXnm)은 행 단위로 구동될 수 있다.
게이트 구동부(200)는 표시 영역(DA)의 좌측에 인접한 비표시 영역(NDA)에 배치될 수 있다. 게이트 구동부(200)는 표시 영역(DA)의 좌측에 인접한 비표시 영역(NDA)에 ASG(Amorphous Silicon TFT Gate driver circuit) 형태로 실장 될 수 있다.
그러나, 이에 한정되지 않고, 게이트 구동부(200)는 복수의 게이트 구동 칩들을 포함할 수 있다. 게이트 구동 칩들은 표시 영역(DA)의 좌측에 인접한 비표시 영역(NDA)에 칩 온 글래스(COG: Chip on Glass) 방식으로 실장되거나 테이프 캐리어 패키지(TCP: Tape Carrier Package) 방식으로 연결될 수 있다.
데이터 구동부(300)는 타이밍 컨트롤러로부터 영상 신호들 및 데이터 제어 신호를 제공받는다. 데이터 구동부(300)는 데이터 제어 신호에 응답하여 영상 신호들에 대응하는 아날로그 데이터 전압들을 생성한다. 데이터 구동부(300)는 데이터 전압들을 데이터 라인들(DL1~DLm)을 통해 화소들(PX11~PXnm)에 제공한다.
데이터 구동부(300)는 복수의 소스 구동칩들(310_1~310_k)을 포함한다. k는 0보다 크고 m보다 작은 정수이다. 소스 구동칩들(310_1~310_k)은 대응하는 연성회로기판들(320_1~320_k) 상에 실장되어 구동 회로 기판(400)과 표시영역(DA)의 상부에 인접한 비 표시 영역(NDA)에 연결된다. 즉, 데이터 구동부(300)는 테이프 캐리어 패키지 방식으로 표시 패널(100)에 연결될 수 있다.
그러나 이에 한정되지 않고, 소스 구동칩들(310_1~310_k)은 표시영역(DA)의 상부에 인접한 비 표시 영역(NDA)에 칩 온 글래스 방식으로 실장될 수 있다.
도 2는 도 1에 도시된 화소의 레이 아웃이다.
도 2에는 하나의 화소(PXij)만을 도시하였으나, 도 1에 도시된 다른 화소들 역시 동일한 구성을 가질 것이다. 이하, 설명의 편의를 위해 하나의 화소(PXij)의 구성이 설명될 것이다.
도 2를 참조하면, 화소(PXij)는 대응하는 게이트 라인(GLi) 및 대응하는 데이터 라인(DLj)에 연결된다. 게이트 라인(GLi)은 제1 방향(DR1)으로 연장된다. 데이터 라인(DLj)은 제1 방향(D1)과 교차하는 제2 방향(DR2)으로 연장된다. 제1 방향(DR1)은 행 방향에 대응되고, 제2 방향(DR2)은 열 방향에 대응된다.
화소(PXij)는 제1 서브 화소 및 제2 서브 화소를 포함한다. 제1 서브 화소는 제1 트랜지스터(T1), 제1 화소 전극(PE1), 및 공통 전극(CE)의 일부를 포함한다. 제2 서브 화소는 제2 트랜지스터(T2), 제3 트랜지스터(T3), 제2 화소 전극(PE2), 및 공통 전극(CE)의 다른 일부를 포함한다.
제1 서브 화소에서 영상이 표시되는 영역은 제1 화소 영역(PA1)으로 정의될 수 있다. 제2 서브 화소에서 영상이 표시되는 영역은 제2 화소 영역(PA2)으로 정의될 수 있다. 제1 화소 전극(PE1)은 제1 화소 영역(PA1)에 배치된다. 제2 화소 전극(PE2)은 제2 화소 영역(PA2)에 배치된다.
공통 전극(CE)은 제1 내지 제3 공통 전극(CE1~CE3)을 포함한다. 제1 및 제2 공통 전극들(CE1, CE2)은 제2 서브 화소에 포함되는 구성으로, 제2 화소 영역(PA2)에 배치된다. 제1 및 제2 공통 전극들(CE1, CE2)은 제2 화소 전극(PE2)과 마주할 수 있다. 제3 공통 전극(CE3)은 제1 서브 화소에 포함되는 구성으로, 제1 화소 영역(PA1)에 배치된다.
제1 및 제2 화소 전극들(PE1, PE2) 및 제1 내지 제3 공통 전극들(CE1~CE3)의 구체적인 형상에 대해서는 후술한다.
화소(PXij)의 제1 화소 영역(PA1)과 제2 화소 영역(PA2) 사이의 영역은 제1 경계 영역(BA1)으로 정의될 수 있다. 제1 경계 영역(BA1)은 제1 방향(DR1)으로 연장된다. 게이트 라인(GLi) 및 제1 내지 제3 트랜지스터들(T1,T2,T3)은 제1 경계 영역(BA1)에 배치된다.
화소들 사이의 영역은 제2 경계 영역(BA2) 및 제3 경계 영역(BA3)을 포함한다. 제2 경계 영역(BA2)은 제1 방향(DR1)으로 배열된 화소들 사이에 배치되어 제2 방향(DR2)으로 연장된다. 구체적으로 제2 경계 영역(BA2)은 제1 방향(DR1)으로 배열된 제1 화소 영역들(PA1) 사이 및 제2 화소 영역들(PA2) 사이에 배치되어 제2 방향(DR2)으로 연장된다. 데이터 라인들(DLj, DLj+1)은 제2 경계 영역(BA2)에 배치된다.
제3 경계 영역(BA3)은 제2 방향(DR2)으로 배열된 화소들 사이에 배치되어 제1 방향(DR1)으로 연장된다. 예를 들어, 제3 경계 영역(BA3)은 제2 방향(DR2)에서 화소(PXij)의 제1 화소 영역(PA1) 및 화소(PXij)와 인접한 다른 화소의 제2 화소 영역(PA2) 사이에 배치되어 제1 방향(DR1)으로 연장된다.
제1 경계 영역(BA1)과 및 제2 경계 영역(BA2)은 서로 교차할 수 있다. 제1 경계 영역(BA1)과 및 제2 경계 영역(BA2)의 교차 영역에서 게이트 라인(GLi) 및 데이터 라인들(DLj, DLj+1)이 서로 교차할 수 있다.
제1 서브 화소의 제1 트랜지스터(T1)는 게이트 라인(GLi)으로부터 분기된 제1 게이트 전극(GE1), 데이터 라인(DLj)으로부터 분기된 제1 소스 전극(SE1), 및 제1 화소 전극(PE1)에 연결된 제1 드레인 전극(DE1)을 포함한다. 제1 드레인 전극(DE1)은 연장되어 제1 컨택홀(H1)을 통해 제1 화소 전극(PE1)으로부터 분기된 제1 연결 전극(CNE1)에 전기적으로 연결된다.
제2 서브 화소의 제2 트랜지스터(T2)는 게이트 라인(GLi)으로부터 분기된 제2 게이트 전극(GE2), 데이터 라인(DLj)으로부터 분기된 제2 소스 전극(SE2), 및 제2 화소 전극(PE2)에 연결된 제2 드레인 전극(DE2)을 포함한다. 제2 드레인 전극(DE2)은 연장되어 제2 컨택홀(H2)을 통해 제2 화소 전극(PE2)으로부터 분기된 제2 연결 전극(CNE2)에 전기적으로 연결된다.
제2 서브 화소의 제3 트랜지스터(T3)는 게이트 라인(GLi)으로부터 분기된 제3 게이트 전극(GE3), 스토리지 라인(SL)으로부터 분기된 제3 소스 전극(SE3), 및 제2 화소 전극(PE2)에 연결된 제3 드레인 전극(DE3)을 포함한다. 제3 드레인 전극(DE3)은 제2 드레인 전극(DE2)으로부터 연장되어 형성될 수 있다. 제3 드레인 전극(DE3)은 연장되어 제2 컨택홀(H2)을 통해 제2 화소 전극(PE2)으로부터 분기된 제2 연결 전극(CNE2)에 전기적으로 연결된다.
스토리지 라인(SL)은 제2 방향(DR2)으로 연장되어 제1 화소 전극(PE1)의 중앙부 및 제2 화소 전극(PE2)의 중앙부와 오버랩된다. 또한, 스토리지 라인(SL)은 제1 화소 영역(PA1) 및 제1 경계영역(BA1)의 경계와 제2 화소 영역(PA2) 및 제1 경계영역(BA1)의 경계에서 제1 방향(DR1)으로 소정의 길이만큼 연장된 후, 제1 경계 영역(BA1)에서 제2 방향(DR2)으로 연장된다. 스토리지 라인(SL)은 데이터 라인들(DLj,DLj+1)과 동일한 층에 배치되며, 스토리지 전압을 인가받는다.
표시 장치(500, 도 1)는 차폐 전극(SHE)을 더 포함할 수 있다.
차폐 전극(SHE)은 제1 내지 제3 경계 영역(BA1~BA3)에 배치될 수 있다. 차폐 전극(SHE)은 데이터 라인들(DLj, DLj+1)을 커버할 수 있다.
차폐 전극(SHE)은 제1 화소 전극(PE1) 및 제2 화소 전극(PE2)과 동일한 층상에 배치되고, 동일한 물질을 포함한다.
차폐 전극(SHE)은 공통 전극(CE)과 동일한 공통 전압을 수신할 수 있다.
차폐 전극(SHE)은 입사되는 광을 차단하는 역할을 한다. 또한, 차폐 전극(SHE)은 데이터 전압이 인가된 데이터 라인들(DLj, DLj+1)이 차폐 전극(SHE) 상부의 다른 신호 라인 및 회로에 커플링 등 전기적 영향을 미치는 것을 차단한다.
표시 장치(500, 도 1)는 차단 전극(BE)을 더 포함할 수 있다.
차단 전극(BE)은 제1 화소 전극(PE1)의 경계와 인접하게 배치될 수 있다. 차단 전극(BE)은 스토리지 라인(SL)과 중첩하게 배치될 수 있다.
차단 전극(BE)은 게이트 라인(GLi)과 동일한 층상에 배치되고, 동일한 물질을 포함한다.
차단 전극(BE)은 데이터 라인들(DLj, DLj+1)과 제1 및 제2 화소 전극들(PE1, PE2) 사이에 전기적 커플링이 발생하는 것을 방지할 수 있다. 또한, 차단 전극(BE)은 스토리지 라인(SL)과 제1 및 제2 화소 전극들(PE1, P2) 사이에 전기적 커플링이 발생하는 것을 방지할 수 있다.
도 3은 도 2에 도시된 I-I'선의 단면도이다.
도 3을 참조하면, 표시패널(100)은는 제1 기판(110), 제1 기판(110)과 마주보는 제2 기판(120), 및 제1 기판(110)과 제2 기판(120) 사이에 배치된 액정층(LC)을 포함한다.
제1 기판(110)은 제1 베이스 기판(111), 및 제1 베이스 기판(111) 상에 배치된 제1 트랜지스터(T1) 및 제1 화소 전극(PE1)을 포함한다.
제2 및 제3 트랜지스터들(T2,T3)의 단면 구성은 제1 트랜지스터(T1)와 실질적으로 동일하다. 따라서, 이하 제1 트랜지스터(T1)의 단면 구성이 상세히 설명되고, 제2 및 제3 트랜지스터들(T2, T3)의 단면 구성에 대한 설명은 생략된다.
제1 베이스 기판(111) 상에 제1 트랜지스터(T1)의 제1 게이트 전극(GE1)이 배치된다. 제1 베이스 기판(111)은 투명 또는 불투명한 절연 기판일 수 있다. 예를 들어, 제1 베이스 기판(111)은 실리콘 기판, 유리 기판, 및 플라스틱 기판일 수 있다.
제1 베이스 기판(111) 상에 제1 게이트 전극(GE1)을 덮도록 제1 절연막(INS1)이 배치된다. 제1 절연막(INS1)은 게이트 절연막으로 정의될 수 있다. 제1 절연막(INS1)은 무기 물질을 포함하는 무기 절연막일 수 있다.
제1 게이트 전극(GE1)을 덮고 있는 제1 절연막(INS1) 상에 제1 트랜지스터(T1)의 제1 반도체 층(SM1)이 배치된다. 도시하지 않았으나, 제1 반도체 층(SM1)은 액티브 층 및 오믹 콘택층을 포함할 수 있다.
제2 경계 영역(BA2)에서 제1 절연막(INS1) 상에 데이터 라인들(DLj,DLj+1)이 배치된다. 제1 화소 영역(PA1)에서 제1 화소 전극(PE1)과 오버랩되도록 제1 절연막(INS1) 상에 스토리지 라인(SL)이 배치된다.
제1 반도체 층(SM1) 및 제1 절연막(INS1) 상에 제1 트랜지스터(T1)의 제1 소스 전극(SE1) 및 제1 드레인 전극(DE1)이 서로 이격되어 배치된다. 제1 반도체 층(SM1)은 제1 소스 전극(SE1) 및 제1 드레인 전극(DE1) 사이에서 전도 채널(conductive channel)을 형성한다.
제1 절연막(INS1) 상에 제1 트랜지스터(T1), 데이터 라인들(DLj,DLj+1), 및 스토리지 라인(SL)을 덮도록 제2 절연막(INS2)이 배치된다. 제2 절연막(INS2)은 패시베이션(passivation)막으로 정의될 수 있다. 제2 절연막(INS2)은 노출된 제1 반도체 층(SM1)의 상부를 커버 한다.
제1 화소 전극(PE1)은 제2 절연막(INS2) 상에 배치된다. 제1 화소 전극(PE1)은 제2 절연막(INS2)에 제공된 제1 컨택홀(H1)을 통해 제1 트랜지스터(T1)의 제1 드레인 전극(DE1)에 연결될 수 있다.
제1 화소 전극(PE1)은 투명 도전성 물질을 포함할 수 있다. 예를 들어, 제1 화소 전극(PE1)은 ITO(indium tin oxide), IZO(indium zinc oxide), ITZO(indium tin zinc oxide) 등의 투명 도전성 물질로 형성될 수 있다.
제2 기판(120)은 제2 베이스 기판(121), 컬러 필터(CF), 블랙 매트릭스(BM), 및 제3 공통 전극(CE3)을 포함한다.
제2 베이스 기판(121)은 투명 또는 불투명한 절연 기판 일 수 있다.
블랙 매트릭스(BM)는 제2 베이스 기판(121) 상에 배치된다. 블랙 매트릭스(BM)는 제1 경계 영역(BA1) 및 제2 경계 영역(BA2)에서 불필요한 광을 차단한다. 도시하지는 않았으나, 블랙 매트릭스(BM)는 제3 경계 영역(BA3)에도 배치될 수 있다.
컬러 필터(CF)는 블랙 매트릭스(BM) 상에 배치된다. 컬러 필터(CF)는 화소를 투과하는 광에 색을 제공한다. 컬러 필터(CF)는 적색 컬러 필터, 녹색 컬러 필터, 및 청색 컬러 필터 중 어느 하나일 수 있다. 컬러 필터(CF)는 화소 마다 구비될 수 있다.
제3 공통 전극(CE3)은 제1 화소 전극(PE1)과 마주보도록 제2 베이스 기판(121)의 하부에 배치될 수 있다. 구체적으로, 제3 공통 전극(CE3)은 블랙 매트릭스(BM) 및 컬러 필터(CF) 하부에 배치될 수 있다.
제3 공통 전극(CE3)은 투명 도전성 물질을 포함할 수 있다. 예를 들어, 제3 공통 전극(CE3)은 ITO(indium tin oxide), IZO(indium zinc oxide), ITZO(indium tin zinc oxide) 등의 투명 도전성 물질로 형성될 수 있다.
표시 패널(100)은 제1 기판(110) 및 제2 기판(120) 사이에 배치된 스페이서(CS)를 더 포함한다. 스페이서(CS)는 제1 기판(110) 및 제2 기판(120) 사이의 셀갭을 유지하는 역할을 할 수 있다. 스페이서(CS)는 제1 경계 영역(BA1)에 중첩하게 배치될 수 있다. 다만, 이에 제한되는 것은 아니고, 스페이서(CS)는 도 2에 도시된 제2 경계 영역(BA2) 및 제3 경계 영역(BA3)에 중첩하게 배치될 수 있다.
도시하지 않았으나, 표시 패널(100)에 광을 제공하기 위한 백라이트 유닛이 표시 패널(100)의 하부에 배치될 수 있다.
도 4는 도 2에 도시된 화소의 등가 회로도이다.
도 2 및 도 4를 참조하면, 화소(PXij)는 제1 서브 화소(SPX1) 및 제2 서브 화소(SPX2)를 포함한다.
제1 서브 화소(SPX1)는 제1 트랜지스터(T1) 및 제1 액정 커패시터(Clc1)를 포함한다. 제1 트랜지스터(T1)는 대응하는 게이트 라인(GLi)에 연결된 제1 게이트 전극(GE1), 대응하는 데이터 라인(DLj)에 연결된 제1 소스 전극(SE1), 및 제1 액정 커패시터(Clc1)에 연결된 제1 드레인 전극(DE1)을 포함한다.
앞서 설명한 바와 같이 제1 트랜지스터(T1)의 제1 드레인 전극(DE1)은 제1 화소 전극(PE1)에 연결된다. 제1 액정 커패시터(Clc1)는 액정층(LC)을 사이에 두고 제1 화소 전극(PE1)과 제3 공통 전극(CE3)에 의해 형성된다.
제2 서브 화소(SPX2)는 제2 트랜지스터(T2), 제3 트랜지스터(T3), 및 제2 액정 커패시터(Clc2)를 포함한다. 제2 트랜지스터(T2)는 대응하는 게이트 라인(GLi)에 연결된 제2 게이트 전극(GE2), 대응하는 데이터 라인(DLj)에 연결된 제2 소스 전극(SE2), 및 제2 액정 커패시터(Clc2)에 연결된 제2 드레인 전극(DE2)을 포함한다.
앞서 설명한 바와 같이 제2 트랜지스터(T2)의 제2 드레인 전극(DE2)은 제2 화소 전극(PE2)에 연결된다. 제2 액정 커패시터(Clc2)는 액정층(LC)을 사이에 두고 제2 화소 전극(PE2)과 제1 및 제2 공통 전극(CE1, CE2)에 의해 형성된다.
제3 트랜지스터(T3)는 대응하는 게이트 라인(GLi)에 연결된 제3 게이트 전극(GE3), 스토리지 전압(Vcst)을 제공받는 제3 소스 전극(SE3), 및 제2 트랜지스터(T2)의 제2 드레인 전극(DE2)과 공통으로 제2 액정 커패시터(Clc2)에 연결된 제3 드레인 전극(DE3)을 포함한다.
앞서 설명한 바와 같이 제3 트랜지스터(T3)의 제3 드레인 전극(DE3)은 제2 드레인 전극(DE2)과 공통으로 제2 화소 전극(PE2)에 연결된다. 또한, 제3 소스 전극(SE3)은 스토리지 라인(SL)으로부터 분기되어 형성된다. 스토리지 라인(SL)은 스토리지 전압(Vcst)을 제공받는다.
게이트 라인(GLi)을 통해 제공된 게이트 신호에 의해 제1 내지 제3 트랜지스터들(T1,T2,T3)은 턴 온 된다. 턴 온된 제1 트랜지스터(T1)를 통해 데이터 전압이 제1 서브 화소(SPX1)에 제공된다. 구체적으로 데이터 라인(DLj)을 통해 수신된 데이터 전압은 턴 온된 제1 트랜지스터(T1)를 통해 제1 서브 화소(SPX1)의 제1 화소 전극(PE1)에 제공된다.
제1 액정 커패시터(Clc1)에는 데이터 전압에 대응되는 제1 화소 전압이 충전된다. 구체적으로, 제1 화소 전극(PE1)에 제공되는 데이터 전압과 제3 공통 전극(CE3)에 제공되는 공통 전압(Vcom)의 레벨 차이에 대응되는 제1 화소 전압이 제1 액정 커패시터(Clc1)에 충전된다. 따라서, 제1 서브 화소(SPX1)에는 제1 화소 전압이 충전된다.
턴온 된 제2 트랜지스터(T2)를 통해 데이터 전압이 제2 서브 화소(SPX2)에 제공된다. 또한, 턴온 된 제3 트랜지스터(T3)를 통해 스토리지 전압(Vcst)이 제2 서브 화소(SPX2)에 제공된다.
데이터 전압의 전압 레벨의 범위는 스토리지 전압(Vcst)의 전압 레벨의 범위보다 넓게 설정된다. 공통 전압(Vcom)은 데이터 전압의 전압 레벨의 범위의 중간 값을 갖도록 설정될 수 있다. 데이터 전압과 공통 전압(Vcom)의 전압 레벨의 차이의 절대값은 스토리지 전압(Vcst)과 공통 전압(Vcom)의 전압 레벨의 차이의 절대값보다 크게 설정될 수 있다.
제2 트랜지스터(T2) 및 제3 트랜지스터(T3) 사이의 접점(N1) 전압은 제2 트랜지스터(T2) 및 제3 트랜지스터(T3)의 턴 온시 저항 상태의 저항값에 의해 분압된 전압이다. 즉, 제2 트랜지스터(T2) 및 제3 트랜지스터(T3) 사이의 접점(N1) 전압은 대략 턴 온된 제2 트랜지스터(T2)를 통해 제공되는 데이터 전압 및 턴 온된 제3 트랜지스터(T3)를 통해 제공되는 스토리지 전압(Vcst)의 중간 정도의 전압 값을 가진다.
제2 트랜지스터(T2) 및 제3 트랜지스터(T3) 사이의 접점(N1) 전압이 제2 화소 전극(PE2)에 제공된다. 즉, 데이터 전압과 스토리지 전압(Vcst)의 중간값에 대응하는 전압이 제2 화소 전극(PE2)에 제공된다.
제2 화소 전극(PE2)에 제공되는 전압과 제1 및 제2 공통 전극들(CE1, CE2)에 제공되는 공통 전압(Vcom)의 레벨차이에 대응되는 제2 화소 전압이 제2 액정 커패시터(Clc2)에 충전된다. 즉, 제1 화소 전압보다 작은 값을 갖는 제2 화소 전압이 제2 액정 커패시터(Clc2)에 충전된다. 따라서, 제2 서브 화소(SPX2)에 제1 화소 전압보다 작은 제2 화소 전압이 충전된다.
화소(PXij)의 제1 및 제2 서브 화소들(SPX1, SPX2)에 서로 다른 크기의 제1 및 제2 화소 전압들이 충전될 경우, 표시 장치(500)를 바라보는 사람의 눈은 제1 및 제2 화소 전압들의 중간값에 대응하는 계조를 시인한다. 이러한 경우, 중간 계조 이하에서 감마 커브의 왜곡에 의해 발생되는 측면 시야각의 저하가 방지될 수 있어 측면 시인성이 개선될 수 있다.
도 5는 하나의 화소에 대응하는 화소 전극과 차폐 전극을 도시한 평면도이고, 도 6은 제2 화소 전극의 제1 줄기부 및 제1 가지부를 확대하여 도시한 평면도이고, 도 7은 하나의 화소에 대응하는 공통 전극을 도시한 평면도이다.
도 2, 도 5, 및 도 6을 참조하여, 화소 전극의 형상을 설명한다.
제1 방향(DR1)으로 인접한 두 개의 데이터 라인들(DLj, DLj+1) 사이의 영역에서 두 개의 데이터 라인들 사이의 중심을 지나고 제2 방향(DR2)으로 평행한 가상선(AX1)을 기준으로 좌측 영역(ARL) 및 우측 영역(ARR)이 정의된다. 좌측 영역(ARL) 및 우측 영역(ARR)은 제1 및 제2 화소 영역들(PA1, PA2) 내에서 정의되는 영역일 수 있다.
제1 방향(DR1) 및 제2 방향(DR2)과 교차하는 제3 방향(DR3) 및 제4 방향(DR4)이 정의될 수 있다. 제3 방향(DR3)은 제1 방향(DR1) 및 제2 방향(DR2)에 의해 정의된 사분면의 중심으로부터 사분면의 제1 사분면으로 연장되는 방향일 수 있다. 제4 방향(DR4)은 제1 방향(DR1) 및 제2 방향(DR2)에 의해 정의된 사분면의 중심으로부터 사분면의 제2 사분면으로 연장되는 방향일 수 있다. 제3 방향(DR3) 및 제4 방향(DR4)은 서로 직교할 수 있다.
화소 전극(PE)의 제1 화소 전극(PE1) 및 제2 화소 전극(PE2)은 서로 제2 방향(DR2)으로 이격된다.
제2 화소 전극(PE2)은 제1 화소 전극(PE1) 보다 큰 면적을 가질 수 있다.
제2 화소 전극(PE2)은 제1 내지 제4 줄기부들(ST1~ST4) 및 제1 내지 제4 가지부들(BR1~BR4)을 포함할 수 있다.
제1 줄기부(ST1)는 우측 영역(ARR)에 배치되고, 제3 방향(DR3)으로 연장될 수 있다. 제1 줄기부(ST1)는 제3 방향(DR3)으로 연장된 일변(11) 및 타변(12)을 가질 수 있다.
제2 줄기부(ST2)는 제1 줄기부(ST1)와 제1 방향(DR1)으로 인접한다. 제2 줄기부(ST2)는 좌측 영역(ARL)에 배치되고, 제4 방향(DR4)으로 연장될 수 있다. 제2 줄기부(ST2)는 제4 방향(DR4)으로 연장된 일변(21) 및 타변(22)을 가질 수 있다.
제3 줄기부(ST3)는 제1 줄기부(ST1)와 제2 방향(DR2)으로 인접한다. 제3 줄기부(ST3)는 우측 영역(ARR)에 배치되고, 제4 방향(DR4)으로 연장될 수 있다. 제3 줄기부(ST3)는 제4 방향(DR4)으로 연장된 일변(31) 및 타변(32)을 가질 수 있다. 제3 줄기부(ST3)는 제1 줄기부(ST1)에 비해 제1 화소 전극(PE1)으로부터 더 멀리 배치될 수 있다.
제4 줄기부(ST4)는 제2 줄기부(ST2)와 제2 방향(DR2)으로 인접한다. 제4 줄기부(ST4)는 좌측 영역(ARL)에 배치되고, 제3 방향(DR3)으로 연장될 수 있다. 제4 줄기부(ST4)는 제3 방향(DR3)으로 연장된 일변(41) 및 타변(42)을 가질 수 있다. 제4 줄기부(ST4)는 제2 줄기부(ST2)에 비해 제1 화소 전극(PE1)으로부터 더 멀리 배치될 수 있다.
제1 내지 제4 줄기부들(ST1~ST4)은 가상선(AX1)과 인접한 영역에서 서로 연결될 수 있다. 제1 내지 제4 줄기부들(ST1~ST4) 각각은 대략적인 평행사변형 형상을 가질 수 있다.
제1 및 제2 줄기부들(ST1, ST2)은 제3 및 제4 줄기부들(ST3, ST4)과 제1 방향(DR1)으로 연장된 선을 기준으로 대칭될 수 있다.
제1 및 제2 줄기부들(ST1, ST2)은 서로 연결되어 V 형상을 갖는다. 제1 및 제2 줄기부들(ST1, ST2)은 제1 공통 전극(CE1)을 커버할 수 있다.
제3 및 제4 줄기부들(ST3, ST4)은 서로 연결되어 뒤집어진 V 형상을 갖는다. 제3 및 제4 줄기부들(ST3, ST4)은 제2 공통 전극(CE2)을 커버할 수 있다.
제1 가지부들(BR1)은 제1 줄기부(ST1)의 제3 방향(DR3)으로 연장된 변으로부터 제4 방향(DR4)으로 돌출된다. 제1 가지부들(BR1)은 서로 이격된 복수 개로 제공될 수 있다. 제1 가지부들(BR1)은 마이크로미터 단위의 거리로 서로 이격되어 복수의 미세 슬릿들을 형성한다.
제1 가지부들(BR1)은 제3 방향(DR3)으로 연장된 제1 줄기부(ST1)의 일변(11)으로부터 돌출된 제1 서브 가지부(SBR1) 및 제1 줄기부(ST1)의 타변(12)으로부터 돌출된 제2 서브 가지부(SBR2)를 포함한다.
제1 서브 가지부(SBR1)는 제3 방향(DR3)으로 차례로 배치된 제1 증가 가지들(BH11), 제1 유지 가지들(BH12), 및 제1 감소 가지들(BH13)을 포함할 수 있다.
제1 증가 가지들(BH11)은 제1 줄기부(ST1)의 일변(11)의 일단에서부터 타단으로 갈수록 제4 방향(DR4)으로 길이가 증가할 수 있다. 제1 유지 가지들(BH12)은 제4 방향(DR4)으로 일정한 길이를 가질 수 있다. 제1 유지 가지들(BH12)은 제3 방향(DR3)으로 제1 증가 가지들(BH11)과 제1 감소 가지들(BH13) 사이에 배치될 수 있다. 제1 감소 가지들(BH13)은 제1 줄기부(ST1)의 일변(11)의 일단에서부터 타단으로 갈수록 제4 방향(DR4)으로 길이가 감소할 수 있다.
제2 서브 가지부(SBR2)는 제3 방향(DR3)으로 차례로 배치된 제2 증가 가지들(BH21), 제2 유지 가지들(BH22), 및 제2 감소 가지들(BH23)을 포함할 수 있다. 제2 증가 가지들(BH21), 제2 유지 가지들(BH22), 및 제2 감소 가지들(BH23)은 제1 증가 가지들(BH11), 제1 유지 가지들(BH12), 및 제1 감소 가지들(BH13)과 유사한 형상을 가지므로, 구체적인 설명을 생략한다.
제2 가지부들(BR2)은 제2 줄기부(ST2)의 제3 방향(DR3)으로 연장된 변으로부터 제4 방향(DR4)으로 돌출된다. 제1 가지부들(BR1)은 서로 이격된 복수 개로 제공될 수 있다.
제2 가지부들(BR2)은 제4 방향(DR4)으로 연장된 제2 줄기부(ST2)의 일변(21)으로부터 돌출된 제3 서브 가지부(SBR3) 및 제2 줄기부(ST2)의 타변(22)으로부터 돌출된 제4 서브 가지부(SBR4)를 포함한다.
제3 서브 가지부(SBR3) 및 제4 서브 가지부(SBR4) 각각의 형상은 제1 서브 가지부(SBR1) 및 제2 서브 가지부(SBR2) 각각의 형상과 실질적으로 동일하므로, 구체적인 설명을 생략한다.
제3 가지부들(BR3)은 제3 줄기부(ST3)의 제4 방향(DR4)으로 연장된 변으로부터 제3 방향(DR3)으로 돌출된다. 제3 가지부들(BR3)은 서로 이격된 복수 개로 제공될 수 있다.
제3 가지부들(BR3)은 제4 방향(DR4)으로 연장된 제3 줄기부(ST3)의 일변(31)으로부터 돌출된 제5 서브 가지부(SBR5) 및 제3 줄기부(ST3)의 타변(32)으로부터 돌출된 제6 서브 가지부(SBR6)를 포함한다.
제5 서브 가지부(SBR5) 및 제6 서브 가지부(SBR6) 각각의 형상은 제1 서브 가지부(SBR1) 및 제2 서브 가지부(SBR2) 각각의 형상과 실질적으로 동일하므로, 구체적인 설명을 생략한다.
제4 가지부들(BR4)은 제4 줄기부(ST4)의 제3 방향(DR3)으로 연장된 변으로부터 제4 방향(DR4)으로 돌출된다. 제4 가지부들(BR4)은 서로 이격된 복수 개로 제공될 수 있다.
제4 가지부들(BR4)은 제3 방향(DR3)으로 연장된 제4 줄기부(ST4)의 일변(41)으로부터 돌출된 제7 서브 가지부(SBR7) 및 제4 줄기부(ST4)의 타변(42)으로부터 돌출된 제8 서브 가지부(SBR8)을 포함한다.
제7 서브 가지부(SBR7) 및 제8 서브 가지부(SBR8) 각각의 형상은 제1 서브 가지부(SBR1) 및 제2 서브 가지부(SBR2) 각각의 형상과 실질적으로 동일하므로, 구체적인 설명을 생략한다.
제1 화소 전극(PE1)은 제5 및 제6 줄기부들(ST5, ST6) 및 제5 및 제6 가지부들(BR5, BR6)을 포함할 수 있다.
제5 줄기부(ST5)는 우측 영역(ARR)에 배치되고, 제3 방향(DR3)으로 연장될 수 있다. 제5 줄기부(ST5)는 제3 방향(DR3)으로 연장된 일변(51) 및 타변(52)을 가질 수 있다.
제6 줄기부(ST6)는 제5 줄기부(ST5)와 제1 방향(DR1)으로 인접한다. 제6 줄기부(ST6)는 좌측 영역(ARL)에 배치되고, 제4 방향(DR4)으로 연장될 수 있다. 제6 줄기부(ST6)는 제4 방향(DR4)으로 연장된 일변(61) 및 타변(62)을 가질 수 있다.
제5 줄기부(ST5) 및 제6 줄기부(ST6)는 가상선(AX1)과 인접한 영역에서 서로 연결될 수 있다. 제5 줄기부(ST5) 및 제6 줄기부(ST6)가 연결된 형상은 제1 줄기부(ST1) 및 제2 줄기부(ST2)가 연결된 형상과 실질적으로 유사한 형상을 가질 수 있다.
제5 및 제6 줄기부들(ST5, ST6)은 서로 연결되어 V 형상을 갖는다. 제5 및 제6 줄기부들(ST5, ST6)은 제3 공통 전극(CE3)을 커버할 수 있다.
제5 가지부들(BR5)은 제5 줄기부(ST5)의 일변(51)으로부터 돌출된 제9 서브 가지부(SBR9) 및 제5 줄기부(ST5)의 타변(52)으로부터 돌출된 제10 서브 가지부(SBR10)를 포함한다.
제9 서브 가지부(SBR9) 및 제10 서브 가지부(SBR10) 각각의 형상은 제1 서브 가지부(SBR1) 및 제2 서브 가지부(SBR2) 각각의 형상과 실질적으로 동일하므로, 구체적인 설명을 생략한다.
제6 가지부들(BR6)은 제6 줄기부(ST6)의 일변(61)으로부터 돌출된 제11 서브 가지부(SBR11) 및 제6 줄기부(ST6)의 타변(62)으로부터 돌출된 제12 서브 가지부(SBR12)를 포함한다.
제11 서브 가지부(SBR11) 및 제12 서브 가지부(SBR12) 각각의 형상은 제1 서브 가지부(SBR1) 및 제2 서브 가지부(SBR2) 각각의 형상과 실질적으로 동일하므로, 구체적인 설명을 생략한다.
도 5 및 도 7을 참조하면, 공통 전극(CE)은 제1 내지 제3 공통 전극(CE1~CE3)을 포함한다.
제1 공통 전극(CE1) 및 제2 공통 전극(CE2)은 제2 화소 영역(PA2)에 배치되어 제2 화소 전극(PE2)과 중첩하고, 제3 공통 전극(CE3)은 제1 화소 영역(PA1)에 배치되어 제1 화소 전극(PE1)과 중첩할 수 있다.
제1 공통 전극(CE1)은 제1 연장부(ET1) 및 제2 연장부(ET2)를 포함할 수 있다.
제1 연장부(ET1)는 우측 영역(ARR)에 배치되고, 제1 줄기부(ST1)와 중첩하고, 제3 방향(DR3)으로 연장될 수 있다. 제2 연장부(ET2)는 좌측 영역(ARL)에 배치되고, 제2 줄기부(ST2)와 중첩하고, 제4 방향(DR4)으로 연장될 수 있다. 제1 연장부(ET1)와 제2 연장부(ET2)는 가상선(AX1)과 인접한 영역에서 서로 연결될 수 있다. 제1 연장부(ET1)의 일단과 제2 연장부(ET2)의 일단은 연결되어 V 형상을 가질 수 있다.
제1 연장부(ET1) 및 제2 연장부(ET2)에는 절개 패턴(CTP)이 제공될 수 있다. 절개 패턴(CTP)은 제1 연장부(ET1) 및 제2 연장부(ET2) 각각의 양변에 제공될 수 있다. 절개 패턴(CTP)이 제공된 영역에서 제1 연장부(ET1) 및 제2 연장부(ET2)의 폭은 감소될 수 있다.
제1 공통 전극(CE1)은 제1 날개부(WG1), 제2 날개부(WG2), 및 제1 세로 연장부(VT1)를 포함할 수 있다.
제1 날개부(WG1)는 가상선(AX1)과 상대적으로 먼 제1 연장부(ET1)의 타단으로부터 연장된다. 제1 날개부(WG1)는 우측 영역(ARR)에 배치되고, 제1 줄기부(ST1)와 중첩한다. 제1 날개부(WG1)는 제2 방향(DR2)으로 연장될 수 있다. 제1 날개부(WG1)는 제1 연장부(ET1)와 둔각을 형성한다.
제2 날개부(WG2)는 가상선(AX1)과 상대적으로 먼 제2 연장부(ET2)의 타단으로부터 연장된다. 제2 날개부(WG2)는 좌측 영역(ARL)에 배치되고, 제2 줄기부(ST2)와 중첩한다. 제2 날개부(WG2)는 제2 방향(DR2)으로 연장될 수 있다. 제2 날개부(WG2)는 제2 연장부(ET2)와 둔각을 형성한다.
제1 세로 연장부(VT1)는 서로 연결된 제1 연장부(ET1) 및 제2 연장부(ET2) 각각의 일단들로부터 제2 방향(DR2)으로 연장된다. 제1 세로 연장부(VT1)는 제1 연장부(ET1) 및 제2 연장부(ET2) 각각과 둔각을 형성한다.
제2 공통 전극(CE2)은 제1 공통 전극(CE1)과 제1 방향(DR1)으로 연장된 가상의 선을 기준으로 대칭된 형상을 가질 수 있다.
제2 공통 전극(CE2)은 제3 연장부(ET3), 제4 연장부(ET4), 제3 날개부(WG3), 제4 날개부(WG4), 및 제2 세로 연장부(VT2)를 포함할 수 있다.
제3 연장부(ET3)는 우측 영역(ARR)에 배치되고, 제3 줄기부(ST3)와 중첩하고, 제4 방향(DR4)으로 연장될 수 있다. 제4 연장부(ET4)는 좌측 영역(ARL)에 배치되고, 제4 줄기부(ST4)와 중첩하고, 제3 방향(DR3)으로 연장될 수 있다. 제3 연장부(ET3)의 일단과 제4 연장부(ET4)의 일단은 가상선(AX1)과 인접한 영역에서 서로 연결될 수 있다. 제3 연장부(ET3)와 제4 연장부(ET4)는 연결되어 뒤집어진(inversed) V 형상을 가질 수 있다.
제3 연장부(ET3) 및 제4 연장부(ET4)에는 절개 패턴(CTP)이 제공될 수 있다. 절개 패턴(CTP)의 형상은 제1 연장부(ET1) 및 제2 연장부(ET4)를 참조하여 설명하였으므로, 구체적인 설명은 생략한다.
제3 날개부(WG3)는 가상선(AX1)과 상대적으로 먼 제3 연장부(ET3)의 타단으로부터 연장된다. 제3 날개부(WG3)는 우측 영역(ARR)에 배치되고, 제3 줄기부(ST3)와 중첩한다. 제3 날개부(WG3)는 제2 방향(DR2)으로 연장될 수 있다. 제3 날개부(WG3)는 제3 연장부(ET3)와 둔각을 형성한다.
제4 날개부(WG4)는 가상선(AX1)과 상대적으로 먼 제4 연장부(ET4)의 타단으로부터 연장된다. 제4 날개부(WG4)는 좌측 영역(ARL)에 배치되고, 제4 줄기부(ST4)와 중첩한다. 제4 날개부(WG4)는 제2 방향(DR2)으로 연장될 수 있다. 제4 날개부(WG4)는 제4 연장부(ET4)와 둔각을 형성한다.
제2 세로 연장부(VT2)는 서로 연결된 제3 연장부(ET3) 및 제4 연장부(ET4) 각각의 일단들로부터 제2 방향(DR2)으로 연장된다. 제2 세로 연장부(VT2)는 제3 연장부(ET3) 및 제4 연장부(ET4) 각각과 둔각을 형성한다.
제3 공통 전극(CE3)은 제1 공통 전극(CE1)과 실질적으로 동일한 형상을 갖는다.
제3 공통 전극(CE3)은 제5 연장부(ET5), 제6 연장부(ET6), 제5 날개부(WG5), 제6 날개부(WG6), 및 제3 세로 연장부(VT3)를 포함할 수 있다.
제5 연장부(ET5)는 우측 영역(ARR)에 배치되고, 제5 줄기부(ST5)와 중첩하고, 제3 방향(DR3)으로 연장될 수 있다. 제6 연장부(ET6)는 좌측 영역(ARL)에 배치되고, 제6 줄기부(ST6)와 중첩하고, 제4 방향(DR4)으로 연장될 수 있다. 제5 연장부(ET5)와 제6 연장부(ET6)는 가상선(AX1)과 인접한 영역에서 서로 연결될 수 있다. 제5 연장부(ET5)의 일단과 제6 연장부(ET6)의 일단은 연결되어 V 형상을 가질 수 있다.
제5 연장부(ET5) 및 제5 연장부(ET5)에는 절개 패턴(CTP)이 제공될 수 있다. 절개 패턴(CTP)의 형상은 제1 연장부(ET1) 및 제2 연장부(ET4)를 참조하여 설명하였으므로, 구체적인 설명은 생략한다.
제5 날개부(WG5)는 가상선(AX1)과 상대적으로 먼 제5 연장부(ET5)의 타단으로부터 연장된다. 제5 날개부(WG5)는 우측 영역(ARR)에 배치되고, 제5 줄기부(ST5)와 중첩한다. 제5 날개부(WG5)는 제2 방향(DR2)으로 연장될 수 있다. 제5 날개부(WG5)는 제5 연장부(ET5)와 둔각을 형성한다.
제6 날개부(WG6)는 가상선(AX1)과 상대적으로 먼 제6 연장부(ET6)의 타단으로부터 연장된다. 제6 날개부(WG6)는 좌측 영역(ARL)에 배치되고, 제6 줄기부(ST6)와 중첩한다. 제6 날개부(WG6)는 제2 방향(DR2)으로 연장될 수 있다. 제6 날개부(WG6)는 제6 연장부(ET6)와 둔각을 형성한다.
제3 세로 연장부(VT3)는 서로 연결된 제5 연장부(ET5) 및 제6 연장부(ET6) 각각의 일단들로부터 제2 방향(DR2)으로 연장된다. 제3 세로 연장부(VT3)는 제5 연장부(ET5) 및 제6 연장부(ET6) 각각과 둔각을 형성한다.
도 8은 본 발명의 비교예에 따른 화소 전극의 일부와 공통 전극의 일부를 도시한 도면이다. 도 8에 도시된 비교예의 구조를 가정하여 도 1 내지 도 7을 참조하여 설명한 본 발명의 실시예에 따른 표시 장치가 갖는 효과를 설명한다.
도 8에는 도 5 내지 7의 제2 화소 영역(PA2)에 대응하는 제1 및 제2 비교 화소 전극들(PE1C, PE2C)과 제1 및 제2 비교 공통 전극들(CE1C, CE2C)을 도시하였다.
도 8을 참조하면, 비교예에 따른 표시 장치는 본 발명의 실시예에 따른 표시 장치와 비교하여 제1 줄기부(ST1), 제2 줄기부(ST2), 제1 가지부(BR1), 및 제2 가지부(BR2)가 연결된 제2 화소 전극(PE2)의 일부가 제3 줄기부(ST3), 제4 줄기부(ST4), 제3 가지부(BR3), 및 제4 가지부(BR4)가 연결된 제2 화소 전극(PE2)의 다른 일부와 위치를 서로 변경한 구조이다.
도 8에서, 제1 비교 화소 전극(PE1C)은 도 5의 제3 줄기부(ST3), 제4 줄기부(ST4), 제3 가지부(BR3), 및 제4 가지부(BR4)가 연결된 형상과 동일한 형상을 갖는다. 또한, 제2 비교 화소 전극(PE2C)은 제1 줄기부(ST1), 제2 줄기부(ST2), 제1 가지부(BR1), 및 제2 가지부(BR2)가 연결된 형상과 동일한 형상을 갖는다.
제1 비교 공통 전극들(CE1C, CE2C) 역시 마찬가지로, 본 발명의 실시예 따른 표시 장치에서 제1 및 제2 공통 전극(CE1, CE2)이 서로 위치를 변경한 구조를 갖는다.
도 8을 참조하면, 얼룩 영역(ARX)에서 제1 비교 화소 전극(PE1C) 및 제2 비교 화소 전극(PE2C)는 제1 방향(DR1)으로 연장된 에지들(EG1~EG4)를 갖는다. 제1 방향(DR1)으로 에지들(EG1~EG4)의 길이는 7.5 um 이상일 수 있다. 제1 및 제2 비교 화소 전극(PE1C, PE2C)의 에지들(EG1~EG4) 주변을 얼룩 영역(ARX)으로 정의할 수 있다. 얼룩 영역(ARX)에서 액정 분자들이 제어되지 않고, 정면과 측면 휘도가 상이하게 시인되고, 얼룩으로 시인되는 문제가 있다.
본 발명의 실시예에 따른 표시 장치에 의하면, 화소 전극(PE)은 제1 방향(DR1)으로 7.5 um 이상 연장되는 에지를 갖지 않거나, 제1 내지 제3 경계 영역들(BA1~BA3)과 인접한 영역에서 7.5 um 이상 연장되는 에지를 가질 수 있다. 따라서, 본 발명의 실시예에 따른 표시 장치는 화소 전극(PE)과 공통 전극(CE)의 형상으로 인해, 제1 및 제2 화소 영역들(PA1, PA2)에서 정면 휘도와 측면 휘도 차이에 의한 얼룩 시인 문제가 해결되고, 표시 품질을 향상시킬 수 있다.
도 9는 본 발명의 다른 실시예에서 하나의 화소에 대응하는 공통 전극을 도시한 평면도이다.
도 9의 공통 전극(CE-1)은 도 7을 참조하여 설명한 공통 전극(CE)에 비해 연장 가지부(CBH)를 더 포함하는 데 차이가 있다. 따라서, 공통 전극(CE-1)을 설명함에 있어서, 도 7에 도시된 공통 전극(CE)의 구성들은 동일한 참조 부호를 부여하고, 구체적인 설명을 생략한다.
연장 가지부(CBH)는 제1 내지 제6 연장 가지부들(CBH1~CBH6)를 포함할 수 있다.
제1 연장 가지부들(CBH1)는 제1 연장부(ET1)에 연결되어, 제4 방향(DR4)으로 연장될 수 있다. 제1 연장 가지부들(CBH1)은 복수 개로 제공되고, 마이크로미터 단위의 거리로 서로 이격되어 복수의 미세 슬릿들을 형성한다.
제2 연장 가지부들(CBH2)는 제2 연장부(ET2)에 연결되어, 제3 방향(DR3)으로 연장될 수 있다. 제2 연장 가지부들(CBH2)은 복수 개로 제공되고, 마이크로미터 단위의 거리로 서로 이격되어 복수의 미세 슬릿들을 형성한다.
제3 연장 가지부들(CBH3)는 제3 연장부(ET3)에 연결되어, 제3 방향(DR3)으로 연장될 수 있다. 제3 연장 가지부들(CBH3)은 복수 개로 제공되고, 마이크로미터 단위의 거리로 서로 이격되어 복수의 미세 슬릿들을 형성한다.
제4 연장 가지부들(CBH4)는 제4 연장부(ET4)에 연결되어, 제4 방향(DR4)으로 연장될 수 있다. 제4 연장 가지부들(CBH4)은 복수 개로 제공되고, 마이크로미터 단위의 거리로 서로 이격되어 복수의 미세 슬릿들을 형성한다.
제5 연장 가지부들(CBH5)는 제5 연장부(ET5)에 연결되어, 제4 방향(DR4)으로 연장될 수 있다. 제5 연장 가지부들(CBH5)은 복수 개로 제공되고, 마이크로미터 단위의 거리로 서로 이격되어 복수의 미세 슬릿들을 형성한다.
제6 연장 가지부들(CBH6)는 제6 연장부(ET6)에 연결되어, 제3 방향(DR3)으로 연장될 수 있다. 제6 연장 가지부들(CBH6)은 복수 개로 제공되고, 마이크로미터 단위의 거리로 서로 이격되어 복수의 미세 슬릿들을 형성한다.
이상 실시 예를 참조하여 설명하였지만, 해당 기술 분야의 숙련된 당업자는 하기의 특허 청구의 범위에 기재된 본 발명의 사상 및 영역으로부터 벗어나지 않는 범위 내에서 본 발명을 다양하게 수정 및 변경시킬 수 있음을 이해할 수 있을 것이다. 또한 본 발명에 개시된 실시 예는 본 발명의 기술 사상을 한정하기 위한 것이 아니고, 하기의 특허 청구의 범위 및 그와 동등한 범위 내에 있는 모든 기술 사상은 본 발명의 권리범위에 포함되는 것으로 해석되어야 할 것이다.
100: 표시 패널 200: 게이트 구동부
300: 데이터 구동부 400: 구동 회로 기판
500: 표시 장치
PE1, PE2, PE3: 제1, 제2, 및 제3 화소 전극
CE1, CE2, CE3: 제1, 제2, 및 제3 공통 전극

Claims (20)

  1. 제1 방향으로 연장된 게이트 라인, 상기 제1 방향과 교차하는 제2 방향으로 연장하는 데이터 라인들, 및 상기 게이트 라인 및 상기 데이터 라인들 중 대응하는 데이터 라인에 연결된 화소를 포함하고,
    상기 화소는,
    제1 화소 전극;
    상기 제1 화소 전극과 상기 제2 방향으로 이격된 제2 화소 전극; 및
    상기 제1 및 제2 화소 전극들과 마주하는 공통 전극을 포함하고,
    상기 데이터 라인들 중 인접한 두 개의 데이터 라인들 사이에서 상기 두 개의 데이터 라인들 사이의 중심을 지나고 상기 제2 방향에 평행한 가상의 선을 기준으로 좌측 영역과 우측 영역이 정의되고,
    상기 제1 및 제2 방향들에 의해 정의된 사분면의 중심으로부터 상기 사분면의 제1 사분면으로 연장되는 제3 방향 및 상기 사분면의 중심으로부터 상기 사분면의 제2 사분면으로 연장되는 제4 방향이 정의되고,
    상기 제2 화소 전극은,
    상기 우측 영역에 배치되고 상기 제3 방향으로 연장된 제1 줄기부;
    상기 제1 줄기부와 상기 제1 방향으로 인접하고, 상기 좌측 영역에 배치되고 상기 제4 방향으로 연장된 제2 줄기부;
    상기 제2 방향으로 상기 제1 줄기부에 비해 상기 제1 화소 전극으로부터 더 멀리 이격되고, 상기 우측 영역에 배치되고 상기 제4 방향으로 연장된 제3 줄기부;
    상기 제2 방향으로 상기 제2 줄기부에 비해 상기 제1 화소 전극으로부터 더 멀리 이격되고, 상기 좌측 영역에 배치되고 상기 제3 방향으로 연장된 제4 줄기부;
    상기 제1 줄기부로부터 상기 제4 방향으로 돌출되고 서로 이격된 제1 가지부들;
    상기 제2 줄기부로부터 상기 제3 방향으로 돌출되고 서로 이격된 제2 가지부들;
    상기 제3 줄기부로부터 상기 제3 방향으로 돌출되고 서로 이격된 제3 가지부들; 및
    상기 제4 줄기부로부터 상기 제4 방향으로 돌출되고 서로 이격될 제4 가지부들을 포함하는 표시 장치.
  2. 제 1 항에 있어서,
    상기 제1 내지 제4 줄기부들의 단부들은 서로 연결된 표시 장치.
  3. 제 1 항에 있어서,
    상기 제1 가지부들은 상기 제3 방향으로 연장된 상기 제1 줄기부의 일변으로부터 돌출된 제1 서브 가지부 및 상기 제3 방향으로 연장된 상기 제1 줄기부의 타변으로부터 돌출된 제2 서브 가지부를 포함하고,
    상기 제2 가지부들은 상기 제4 방향으로 연장된 상기 제2 줄기부의 일변으로부터 돌출된 제3 서브 가지부 및 상기 제4 방향으로 연장된 제2 줄기부의 타변으로부터 돌출된 제4 서브 가지부를 포함하고,
    상기 제3 가지부들은 상기 제3 방향으로 연장된 상기 제3 줄기부의 일변으로부터 돌출된 제5 서브 가지부 및 상기 제3 방향으로 연장된 상기 제3 줄기부의 타변으로부터 돌출된 제6 서브 가지부를 포함하고,
    상기 제4 가지부들은 상기 제4 방향으로 연장된 상기 제4 줄기부의 일변으로부터 돌출된 제7 서브 가지부 및 상기 제4 방향으로 연장된 제4 줄기부의 타변으로부터 돌출된 제8 서브 가지부를 포함하는 표시 장치.
  4. 제 3 항에 있어서,
    상기 제1 내지 제8 서브 가지부들 각각은 순서대로,
    상기 제1 내지 제4 줄기부들 중 대응되는 줄기부의 연장방향으로 상기 대응되는 줄기부의 일단에서 타단으로 갈수록 길이가 증가하는 증가 가지들;
    일정한 길이를 갖는 유지 가지들; 및
    상기 대응되는 줄기부의 상기 일단에서 상기 타단으로 갈수록 길이가 감소하는 감소 가지들을 포함하는 표시 장치.
  5. 제 1 항에 있어서,
    상기 제1 화소 전극은,
    상기 우측 영역에 배치되고, 상기 제3 방향으로 연장된 제5 줄기부;
    상기 제5 줄기부와 상기 제1 방향으로 인접하고, 상기 좌측 영역에 배치되고 상기 제4 방향으로 연장된 제6 줄기부;
    상기 제5 줄기부로부터 상기 제4 방향으로 돌출되고 서로 이격된 제5 가지부들; 및
    상기 제6 줄기부로부터 상기 제3 방향으로 돌출되고 서로 이격된 제6 가지부들을 포함하는 표시 장치.
  6. 제 5 항에 있어서,
    상기 제5 및 제6 줄기부들의 단부들은 서로 연결된 표시 장치.
  7. 제 5 항에 있어서,
    상기 제5 가지부들은 상기 제3 방향으로 연장된 상기 제5 줄기부의 일변으로부터 돌출된 제9 서브 가지부 및 상기 제3 방향으로 연장된 상기 제5 줄기부의 타변으로부터 돌출된 제10 서브 가지부를 포함하고,
    상기 제6 가지부들은 상기 제4 방향으로 연장된 상기 제6 줄기부의 일변으로부터 돌출된 제11 서브 가지부 및 상기 제4 방향으로 연장된 제6 줄기부의 타변으로부터 돌출된 제12 서브 가지부를 포함하는 표시 장치.
  8. 제 7 항에 있어서,
    상기 제9 내지 제12 서브 가지부들 각각은 순서대로,
    상기 제5 및 제6 줄기부들 중 대응되는 줄기부의 연장방향으로 상기 대응되는 줄기부의 일단에서 타단으로 갈수록 길이가 증가하는 증가 가지들;
    일정한 길이를 갖는 유지 가지들; 및
    상기 대응되는 줄기부의 상기 일단에서 상기 타단으로 갈수록 길이가 감소하는 감소 가지들을 포함하는 표시 장치.
  9. 제 1 항에 있어서,
    상기 공통 전극은,
    상기 제1 줄기부과 중첩하고 상기 제3 방향으로 연장된 제1 연장부 및 상기 제1 연장부의 일단에 연결되고 상기 제2 줄기부와 중첩하고 상기 제4 방향으로 연장된 제2 연장부를 포함하는 제1 공통 전극; 및
    상기 제3 줄기부와 중첩하고 상기 제4 방향으로 연장된 제3 연장부 및 상기 제3 연장부의 일단에 연결되고 상기 제4 줄기부와 중첩하고 상기 제3 방향으로 연장된 제4 연장부를 포함하는 제2 공통 전극을 포함하는 표시 장치.
  10. 제 9 항에 있어서,
    상기 제1 공통 전극은,
    상기 제1 연장부의 상기 일단과 이격된 상기 제1 연장부의 타단으로부터 상기 제2 방향으로 연장되고, 상기 제1 줄기부와 중첩하는 제1 날개부;
    상기 제1 연장부의 상기 일단과 연결된 상기 제2 연장부의 일단과 이격된 상기 제2 연장부의 타단으로부터 상기 제2 방향으로 연장되고, 상기 제2 줄기부와 중첩하는 제2 날개부; 및
    상기 제1 및 제2 연장부들의 상기 일단들로부터 상기 제2 방향으로 연장되는 제1 세로 연장부를 더 포함하고,
    상기 제2 공통 전극은,
    상기 제3 연장부의 상기 일단과 이격된 상기 제3 연장부의 타단으로부터 상기 제4 방향으로 연장되고, 상기 제3 줄기부와 중첩하는 제3 날개부;
    상기 제4 연장부의 상기 일단과 연결된 상기 제4 연장부의 일단과 이격된 상기 제4 연장부의 타단으로부터 상기 제2 방향으로 연장되고, 상기 제4 줄기부와 중첩하는 제4 날개부; 및
    상기 제3 및 제4 연장부들의 상기 일단들로부터 상기 제2 방향으로 연장되는 제2 세로 연장부를 더 포함하는 표시 장치.
  11. 제 10 항에 있어서,
    상기 제1 내지 제4 날개부들 각각은 제1 내지 제4 연장부들 각각과 둔각을 형성하고,
    상기 제1 세로 연장부는 상기 제1 및 제2 줄기부들 각각과 둔각을 형성하고,
    상기 제2 세로 연장부는 상기 제3 및 제4 줄기부들 각각과 둔각을 형성하는 표시 장치.
  12. 제 10 항에 있어서,
    상기 제1 화소 전극은,
    상기 우측 영역에 배치되고, 상기 제3 방향으로 연장된 제5 줄기부;
    상기 제5 줄기부와 상기 제1 방향으로 인접하고, 상기 좌측 영역에 배치되고 상기 제4 방향으로 연장된 제6 줄기부;
    상기 제5 줄기부로부터 상기 제4 방향으로 돌출되고 서로 이격된 제5 가지부들; 및
    상기 제6 줄기부로부터 상기 제3 방향으로 돌출되고 서로 이격된 제6 가지부들을 포함하고,
    상기 공통 전극은,
    상기 제5 줄기부과 중첩하고 상기 제3 방향으로 연장된 제5 연장부 및 상기 제5 연장부의 일단에 연결되고 상기 제6 줄기부와 중첩하고 상기 제4 방향으로 연장된 제6 연장부를 포함하는 제3 공통 전극을 더 포함하는 표시 장치.
  13. 제 12 항에 있어서,
    상기 제3 공통 전극은,
    상기 제5 연장부의 상기 일단과 이격된 상기 제5 연장부의 타단으로부터 상기 제2 방향으로 연장되고, 상기 제5 줄기부와 중첩하는 제5 날개부;
    상기 제6 연장부의 상기 일단과 연결된 상기 제6 연장부의 일단과 이격된 상기 제6 연장부의 타단으로부터 상기 제2 방향으로 연장되고, 상기 제6 줄기부와 중첩하는 제6 날개부; 및
    상기 제5 및 제6 연장부들의 상기 일단들로부터 상기 제2 방향으로 연장되는 제3 세로 연장부를 더 포함하는 표시 장치.
  14. 제 13 항에 있어서,
    상기 제5 및 제6 날개부들 각각은 제5 및 제6 연장부들 각각과 둔각을 형성하고,
    상기 제3 세로 연장부는 상기 제5 및 제6 줄기부들 각각과 둔각을 형성하는 표시 장치.
  15. 제 1 항에 있어서,
    상기 화소는,
    상기 게이트 라인, 상기 대응하는 데이터 라인, 및 상기 제1 화소 전극에 연결된 제1 트랜지스터;
    상기 게이트 라인, 상기 대응하는 데이터 라인, 및 상기 제2 화소 전극에 연결된 제2 트랜지스터; 및
    상기 게이트 라인, 상기 제2 화소 전극, 및 상기 대응하는 데이터 라인과 동일층에 배치된 스토리지 라인에 연결된 제3 트랜지스터를 더 포함하는 표시 장치.
  16. 제 15 항에 있어서,
    상기 제1 내지 제3 트랜지스터들은 상기 제2 방향으로 상기 제1 및 제2 화소 전극들 사이의 제1 경계 영역에 배치되는 표시 장치.
  17. 제 1 항에 있어서,
    상기 화소는, 상기 데이터 라인들을 커버하고, 상기 제1 및 제2 화소 전극들과 동일한 층상에 배치되는 차폐 전극을 더 포함하는 표시 장치.
  18. 제1 방향으로 연장된 게이트 라인, 상기 제1 방향과 교차하는 제2 방향으로 연장하는 데이터 라인들, 및 상기 게이트 라인 및 상기 데이터 라인들 중 대응하는 데이터 라인에 연결된 화소를 포함하고,
    상기 화소는,
    제1 화소 전극;
    상기 제1 화소 전극과 상기 제2 방향으로 이격된 제2 화소 전극; 및
    상기 제1 및 제2 화소 전극들과 마주하는 공통 전극을 포함하고,
    상기 데이터 라인들 중 인접한 두 개의 데이터 라인들 사이에서 상기 두 개의 데이터 라인들 사이의 중심을 지나고 상기 제2 방향에 평행한 가상의 선을 기준으로 좌측 영역과 우측 영역이 정의되고,
    상기 제1 및 제2 방향들에 의해 정의된 사분면의 중심으로부터 상기 사분면의 제1 사분면으로 연장되는 제3 방향 및 상기 사분면의 중심으로부터 상기 사분면의 제2 사분면으로 연장되는 제4 방향이 정의되고,
    상기 제2 화소 전극은,
    상기 우측 영역에 배치되고 상기 제3 방향으로 연장된 제1 줄기부;
    상기 제1 줄기부와 상기 제1 방향으로 인접하고, 상기 좌측 영역에 배치되고 상기 제4 방향으로 연장된 제2 줄기부;
    상기 제1 줄기부와 상기 제2 방향으로 인접하고, 상기 우측 영역에 배치되고 상기 제4 방향으로 연장된 제3 줄기부; 및
    상기 제2 줄기부와 상기 제2 방향으로 인접하고, 상기 좌측 영역에 배치되고 상기 제3 방향으로 연장된 제4 줄기부를 포함하고,
    상기 제1 줄기부 및 상기 제2 줄기부는 서로 연결되어 V 형상을 갖고,
    상기 제3 줄기부 및 상기 제4 줄기부는 서로 연결되어 뒤집어진 V 형상을 갖는 표시 장치.
  19. 제 18 항에 있어서,
    상기 제1 화소 전극은,
    상기 우측 영역에 배치되고, 상기 제3 방향으로 연장된 제5 줄기부; 및
    상기 제5 줄기부와 상기 제1 방향으로 인접하고, 상기 좌측 영역에 배치되고 상기 제4 방향으로 연장된 제6 줄기부를 포함하고,
    상기 제5 줄기부 및 상기 제6 줄기부는 서로 연결되어 V 형상을 갖는 표시 장치.
  20. 제 19 항에 있어서,
    상기 공통 전극은,
    상기 제1 줄기부과 중첩하고 상기 제3 방향으로 연장된 제1 연장부 및 상기 제1 연장부의 일단에 연결되고 상기 제2 줄기부와 중첩하고 상기 제4 방향으로 연장된 제2 연장부를 포함하고, V 형상을 갖는 제1 공통 전극;
    상기 제3 줄기부와 중첩하고 상기 제4 방향으로 연장된 제3 연장부 및 상기 제3 연장부의 일단에 연결되고 상기 제4 줄기부와 중첩하고 상기 제3 방향으로 연장된 제4 연장부를 포함하고, 뒤집어진 V 형상을 갖는 제2 공통 전극; 및
    상기 제5 줄기부과 중첩하고 상기 제3 방향으로 연장된 제5 연장부 및 상기 제5 연장부의 일단에 연결되고 상기 제6 줄기부와 중첩하고 상기 제4 방향으로 연장된 제6 연장부를 포함하고, V 형상을 갖는 제3 공통 전극을 포함하는 표시 장치.

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