KR101747721B1 - 액정 표시 장치 및 그의 제조 방법 - Google Patents

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Abstract

본 발명은 액정 표시 장치 및 그의 제조 방법에 관한 것으로, 특히 균일한 공통 전압을 공급하여 표시 품질을 향상시킬 수 있는 액정 표시 장치 및 그의 제조 방법에 관한 것이다.
본 발명에 따른 액정 표시 장치는 상부 기판 상에 형성된 공통 전극과, 상기 상부 기판과 마주보는 하부 기판 상에 형성된 박막 트랜지스터와, 상기 박막 트랜지스터의 드레인 전극과 접속된 화소 전극과, 상기 공통 전극으로 공급하는 공통 전압을 생성하는 공통 전압 생성부가 실장된 인쇄회로기판과, 상기 인쇄회로기판으로부터 먼 영역과 대응되는 위치에 형성된 상기 공통 전극에 공통 전압을 공급하는 제1 공통 전압 라인과, 지그-재그(Zig-Zag) 형태로 형성되어 상기 인쇄회로기판으로부터 가까운 영역에 위치하는 공통 전극에 상기 제1 공통 전압 라인의 저항 값과 동일한 공통 전압을 공급하는 제2 공통 전압 라인을 포함하는 것을 특징으로 한다.

Description

액정 표시 장치 및 그의 제조 방법{LIQUID CRYSTAL DISPLAY DEVICE AND MANUFACTURING METHOD THEREOF}
본 발명은 액정 표시 장치 및 그의 제조 방법에 관한 것으로, 특히 균일한 공통 전압을 공급하여 표시 품질을 향상시킬 수 있는 액정 표시 장치 및 그의 제조 방법에 관한 것이다.
도 1은 종래 불균일한 공통 전압 인가에 따른 액정 표시 패널의 평면도이다.
액정 표시 장치(Liquid Crystal Display; LCD)는 전계를 이용하여 유전 이방성을 갖는 액정의 광투과율을 조절함으로써 화상을 표시한다. 이를 위하여 액정 표시 장치는 화소 영역들이 매트릭스 형태로 배열된 액정 표시 패널(200)과 액정 표시 패널을 구동하기 위한 구동 회로부를 구비한다.
액정 표시 패널(260)은 액정을 사이에 두고 합착된 박막 트랜지스터 기판과 컬러 필터 기판을 구비한다.
박막 트랜지스터 기판은 하부 기판 위에 게이트 절연막을 사이에 두고 교차하게 형성된 게이트 라인 및 데이터 라인과, 그 교차부마다 형성된 박막 트랜지스터(TFT)와, 그 교차 구조로 마련된 화소 영역에 형성된 화소 전극을 포함한다.
컬러 필터 기판은 상부 기판 위에 컬러 구현을 위한 컬러 필터와, 빛샘 방지를 위한 블랙 매트릭스와, 컬러 필터에 의한 단차를 보상하기 위한 오버 코트층과, 화소 전극과 수직 전계를 이루는 공통 전극을 포함한다.
구동 회로부는 액정 표시 패널(260)의 게이트 라인을 구동하는 게이트 구동부와, 데이터 라인을 구동하는 데이터 구동부(264)와, 게이트 구동부 및 데이터 구동부(264)의 구동 타이밍을 제어하는 타이밍 제어부와, 액정 표시 패널(260)과 상기 구동부의 구동에 필요한 전원 신호들을 공급하는 전원부를 포함한다. 이때, 타이밍 제어부 및 공통 전압 공급부는 인쇄회로기판(262)에 실장된다.
이때, 공통 전압 공급부로부터 생성된 공통 전압(Vcom)은 공통 전압 라인(266,268)을 통해 칼러 필터 기판의 공통 전극으로 공급된다. 도 1에 도시된 바와 같이 인쇄회로기판(262)으로부터 먼 영역에 위치한 공통 전극에 공통 전압(Vcom)을 공급하는 공통 전압 라인(266)과, 인쇄회로기판(262)으로부터 가까운 영역에 위치한 공통 전극에 공통 전압(Vcom)을 공급하는 공통 전압 라인(268) 간의 저항 차이로 인해 불균일한 공통 전압(Vcom)이 공급된다. 이와 같이, 경로에 따른 저항 차이로 불균일한 공통 전압이 공통 전극에 인가됨으로써 불균일하게 화상을 표시하게 되며, 불균형한 색감차를 표시하게 된다.
본 발명은 상기 문제점을 해결하기 위해 창안된 것으로서, 균일한 공통 전압을 공급하여 표시 품질을 향상시킬 수 있는 액정 표시 장치 및 그의 제조 방법을 제공하는 것이다.
이를 위하여, 본 발명에 따른 액정 표시 장치는 상부 기판 상에 형성된 공통 전극과, 상기 상부 기판과 마주보는 하부 기판 상에 형성된 박막 트랜지스터와, 상기 박막 트랜지스터의 드레인 전극과 접속된 화소 전극과, 상기 공통 전극으로 공급하는 공통 전압을 생성하는 공통 전압 생성부가 실장된 인쇄회로기판과, 상기 인쇄회로기판으로부터 먼 영역과 대응되는 위치에 형성된 상기 공통 전극에 공통 전압을 공급하는 제1 공통 전압 라인과, 지그-재그(Zig-Zag) 형태로 형성되어 상기 인쇄회로기판으로부터 가까운 영역에 위치하는 공통 전극에 상기 제1 공통 전압 라인의 저항 값과 동일한 공통 전압을 공급하는 제2 공통 전압 라인을 포함하는 것을 특징으로 한다.
여기서, 상기 제2 공통 전압 라인은 ITO(Indum Tin Oxide), TO(Tin Oxide), IZO(Indum Zinc Oxide), ITZO(Indum Tin Zinc Oxide)와 같은 투명 도전 재질로 형성되는 것을 특징으로 한다.
그리고, 상기 제2 공통 전압 라인은 상기 화소 전극 형성시 동시에 형성되는 것을 특징으로 한다.
또한, 상기 제2 공통 전압 라인의 선폭은 상기 제1 공통 전압 라인의 라인 저항 값과 동일하도록 좁게 형성되는 것을 특징으로 한다.
본 발명에 따른 액정 표시 장치의 제조 방법은 하부 기판 상에 박막 트랜지스터를 형성하는 단계와, 상기 박막 트랜지스터 상에 컨택홀이 형성된 보호막을 형성하는 단계와, 상기 보호막 상에 화소 전극, 제1 공통 전압 라인과 상기 제1 공통 전압 라인과 동일한 저항 값을 가지도록 지그-재그 형태로 제2 공통 전압 라인을 형성하는 단계와, 상기 하부 기판과 마주보는 상부 기판 상에 공통 전극을 형성하는 단계와, 상기 공통 전극과 상기 제1 및 제2 공통 전압 라인이 접속하도록 상기 하부 기판과 상부 기판을 합착하는 단계를 포함하는 것을 특징으로 한다.
여기서, 상기 제2 공통 전압 라인은 상기 화소 전극과 동일층에 동일 재질로 형성되는 것을 특징으로 한다.
그리고, 상기 제2 공통 전압 라인은 ITO(Indum Tin Oxide), TO(Tin Oxide), IZO(Indum Zinc Oxide), ITZO(Indum Tin Zinc Oxide)와 같은 투명 도전 재질로 형성되는 것을 특징으로 한다.
본 발명에 따른 액정 표시 장치 및 그의 제조 방법은 전원 공급부가 실장된 인쇄회로기판으로부터 먼 영역과 대응되는 위치에 형성된 공통 전극에 공급 전압을 공급하는 제1 공통 전압 라인과, 인쇄회로기판으로부터 가까운 영역에 대응되는 위치에 형성된 공통 전극에 공통 전압을 공급하는 제2 공통 전압 라인을 포함하며, 제2 공통 전압 라인은 제1 공통 전압 라인의 저항 값과 균일하게 하기 위해 지그-패턴으로 형성된다. 이와 같이, 지그-재그 형태로 제2 공통 전압 라인을 형성함으로써 경로에 따른 저항 차이를 개선하여 균일한 공통 전압을 공통 전극에 인가될 수 있고, 불균일한 색감차도 보상할 수 있다.
따라서, 본 발명에 따른 액정 표시 장치 및 그의 제조 방법은 균일한 공통 전압을 공통 전극에 공급함으로써 표시 품질을 향상시킬 수 있다.
또한, 본 발명에 따른 액정 표시 장치 및 그의 제조 방법은 화소 전극 형성시 동시에 제2 공통 전압 라인을 형성함으로써 그에 따른 추가 소자나 추가 공정이 필요없다.
도 1은 종래 불균일한 공통 전압 인가에 따른 액정 표시 패널의 평면도이다.
도 2는 본 발명의 실시 예에 따른 액정 표시 장치의 평면도를 도시하고 있다.
도 3은 도 2에 도시된 액정 표시 장치를 A-B,Ⅰ-Ⅰ' 선을 따라 절단한 단면도와, 화상 표시부에 해당되는 액정 표시 패널을 도시한 단면도이다.
도 4a 내지 도 4g는 도 3에 도시된 액정 표시 패널의 제조 방법을 나타낸 단면도들이다.
이하, 첨부된 도면을 참조하여 본 발명에 따른 실시 예를 상세하게 설명한다. 본 발명의 구성 및 그에 따른 작용 효과는 이하의 상세한 설명을 통해 명확하게 이해될 것이다. 본 발명의 상세한 설명에 앞서, 동일한 구성 요소에 대해서는 다른 도면 상에 표시되더라도 가능한 동일한 부호로 표시하며, 공지된 구성에 대해서는 본 발명의 요지를 흐릴 수 있다고 판단되는 경우 구체적인 설명은 생략하기로 함에 유의한다.
이하, 본 발명의 바람직한 실시 예를 도 2 내지 도 4g를 참조하여 상세히 설명하기로 한다.
도 2는 본 발명의 실시 예에 따른 액정 표시 장치의 평면도를 도시하고 있으며, 도 3은 도 2에 도시된 액정 표시 장치를 A-B,Ⅰ-Ⅰ' 선을 따라 절단한 단면도와, 화상 표시부에 해당되는 액정 표시 패널을 도시한 단면도이다.
본 발명에 따른 액정 표시 장치는 도 2 및 도 3에 도시된 바와 같이 액정 표시 패널(102, 104), 액정 표시 패널(102, 104)의 화상 표시부의 게이트 라인(GL)을 구동하는 게이트 드라이버(114)와, 화상 표시부의 데이터 라인(DL)을 구동하는 데이터 드라이버(112)와, 게이트 드라이버(114)와 데이터 드라이버(112)를 제어하는 타이밍 제어부 및 공통 전압을 생성하는 공통 전압 공급부를 가지는 인쇄회로기판(100)을 포함한다.
액정 표시 패널은 박막 트랜지스터가 형성된 박막 트랜지스터 기판(102)과, 칼러 필터가 형성된 칼러 필터 기판(104)과, 박막 트랜지스터 기판(102)과 칼러 필터 기판(104)을 접합하기 위한 실런트(128)를 구비한다.
박막 트랜지스터 기판(102)은 게이트 라인(GL) 및 데이터 라인(DL) 각각과 접속된 박막 트랜지스터와, 그 교차 구조로 마련된 화소 영역에 형성된 화소 전극(214)과, 칼러 필터 기판(104)의 공통 전극(248)으로 공통 전압을 공급하기 위한 제1 및 제2 공통 전압 라인(124, 126)을 포함한다.
박막 트랜지스터는 게이트 라인(GL)의 스캔 신호에 응답하여 데이터 라인(DL)의 비디오 신호를 화소 전극(214)에 공급한다. 이를 위하여, 박막 트랜지스터는 게이트 라인(GL)에 접속된 게이트 전극(202), 데이터 라인(DL)과 접속된 소스 전극(210), 화소 전극(214)과 접속된 드레인 전극(208), 게이트 절연막(206)을 사이에 두고 게이트 전극(202과 중첩되어 소스 전극(210)과 드레인 전극(208) 사이에 채널을 형성하는 반도체 패턴의 활성층(214), 소스 전극(210) 및 드레인 전극(208)과의 오믹 접촉을 위하여 채널부를 제외한 활성층(214) 위에 형성된 반도체 패턴의 오믹 접촉층(216)을 구비한다. 또한, 게이트 라인(GL)은 게이트 라인들을 구동시키기 위해 게이트 집적회로(Drive Integrated Circuit;114)와 전기적으로 연결되고, 데이터 라인(DL)은 데이터 라인들을 구동시키기 위해 데이터 집적 회로(Drive Integrated Circuit; 112)와 전기적으로 연결된다.
칼러 필터 기판(104)에는 빛샘 방지를 위한 블랙 매트릭스(242)와, 칼러 구현을 위한 칼러 필터(244)와, 그 컬러 필터(244)에 의한 단차를 보상하는 오버코트층(246)과, 화소 전극(214)과 수직 전계를 이루는 공통 전극(248)를 포함하는 컬러필터 어레이가 상부 기판(240) 상에 형성된다.
칼라 필터(244)는 색을 구현하기 위해 적색, 녹색, 청색 칼라 필터(R, G, B)를 포함한다. 적색, 녹색, 청색 칼라 필터(R, G, B)는 각각 자신이 포함하고 있는 적색, 녹색, 청색 안료를 통해 특정 파장의 광을 흡수 또는 투과시킴으로써 적색, 녹색, 청색을 띄게 된다.
블랙 매트릭스(242)는 칼러 필터(244)가 형성될 화소 영역을 구분하도록 상부 기판(240) 상에 형성되며, 박막 트랜지스터 기판(102)의 게이트 라인(GL)과 데이터 라인(DL), 박막 트랜지스터와 중첩되도록 형성된다. 이러한 블랙 매트릭스(242)는 원하지 않는 액정 배열로 인해 생긴 투과광을 차단하여 액정 표시 장치의 콘트라스트를 향상시키고 박막 트랜지스터로 직접적인 광조사를 차단하여 박막 트랜지스터의 광누설 전류를 막는다.
오버코트층(246)은 칼러 필터(244) 및 블랙 매트릭스(242) 위에 아크릴 수지 등의 투명한 유기 절연 물질로 형성된다. 오버코트층(246)은 칼러 필터(244)와 블랙 매트릭스(242)의 단차를 보상하여 평탄한 표면을 제공한다.
공통 전극(248)은 오버코트(246)층 위에 전면 도포된 투명 도전층으로 액정 구동시 기준이 되는 공통 전압(Vcom)이 공급된다. 이와 같이, 공통 전극(248)은 화소 전극(214)과 서로 다른 기판 상에 동일 재질 또는 다른 재질로 형성되어 수직 전계를 이룰 수 있다.
공통 전극(248)은 도 2에 도시된 바와 같이 제1 및 제2 공통 전압 라인(124,126)을 통해 공통 전압(Vcom)을 공급받는다. 도 2 및 도 3에 도시된 바와 같이 제1 및 제2 공통 전압 라인(124,126)과 공통 전극(248)을 전기적으로 접속시키도록 실런트(128)에 도전성 스페이서(122)가 포함된다. 여기서, 도전성 스페이서(122)는 도전성 글래스 파이버(Glass Fiber) 또는 도전성 볼 등이 된다.
제1 공통 전압 라인(126)은 공통 전압 공급부가 실장된 인쇄회로기판(100)으로부터 먼 영역에 위치하는 공통 전극(248)과 접속하여 공통 전압(Vcom)을 공급하며, 제2 공통 전압 라인(124)은 공통 전압 공급부가 실장된 인쇄회로기판(100)으로부터 가까운 영역에 위치하는 공통 전극(248)과 접속하여 공통 전압(Vcom)을 공급한다. 이와 같이, 제1 공통 전압 라인(126)은 제2 공통 전압 라인(124)과 라인 저항 값이 다르다. 다시 말하여, 경로에 따른 저항 차이로 상부 기판(240)의 공통 전극(248)으로 인가되는 공통 전압(Vcom)의 차이가 발생되어 불균일하게 화상을 표시하게 되며, 불균형한 색감차를 표시하게 된다. 하지만, 본 발명의 제1 공통 전압 라인(126)과 제2 공통 전압 라인(124) 간의 저항을 균일하게 하여 균일한 화상을 표시하게 된다. 구체적으로, 인쇄회로기판(100)으로부터 가까운 A-B 구간에 형성된 제2 공통 전압 라인(124)을 지그-재그 라인(Zig-Zag)으로 형성하여 인쇄회로기판(100)으로부터 먼 C-D 구간에 형성된 제1 공통 전압 라인(126)의 저항 값을 동일하게 한다. 다시 말하여, 저항(R)은 하기 [수학식 1]과 같이 길이(l)에 비례하며, 면적(A)에 반비례한다.
Figure 112010072226891-pat00001
따라서, 제2 공통 전압 라인(124)은 지그-재그 라인으로 형성하여 저항 값을 크게 하며, 도 2에 확대한 도면과 같이 지그-재그 라인의 폭(W)은 좁게 형성하여 면적은 반비례하도록 한다. 또한, 제2 공통 전압 라인(124)은 저항 값을 크게 하기 위해 저항 값이 작은 금속 재질이 아닌 금속 재질보다 저항 값이 큰 투명 도전 재질을 사용한다. 따라서, 인쇄회로기판(100)으로부터 가까운 A-B 구간에 형성된 제2 공통 전압 라인(124)과 인쇄회로기판(100)으로부터 먼 C-D 구간 및 하부 표시 영역에 형성된 제1 공통 전압 라인(126) 간의 저항 값이 동일하게 되어 균일한 화상이 표시되며, 불균일한 색감차를 개선하여 표시 품질이 향상된다. 또한, 본 발명은 균일한 라인 저항 값을 가지기 위해 저항과 같은 소자를 이용하지 않고 화소 전극 형성시 동시에 형성한다. 또한, 화소 전극(214)과 동일한 재질로 형성하므로 다른 추가 공정이 있거나 저항과 같은 소자를 이용하지 않아도 되므로 추가 소자 비용이 들지 않는다. 이와 같이, 추가 비용이나 추가 공정 없이도 라인 저항의 문제를 해결할 수 있다.
도 4a 내지 도 4g는 도 3에 도시된 액정 표시 패널의 제조 방법을 나타낸 단면도들이다.
도 4a를 참조하면, 하부 기판(201) 상에 게이트 라인(GL), 게이트 전극(202)을 포함하는 게이트 금속 패턴이 형성된다.
구체적으로, 하부 기판(201) 상에 스퍼터링 방법 등의 증착 방법을 통해 게이트 금속층이 형성된다. 게이트 금속층으로는 Mo, Ti, Cu, AlNd, Al, Cr, Mo 합금, Cu 합금, Al 합금 등과 같이 금속 물질이 단일층으로 이용되거나, 상기 금속을 이용하여 이중층 이상이 적층된 구조로 이용된다. 이어서, 포토리소그래피 공정 및 식각 공정으로 게이트 금속층이 패터닝됨으로써 게이트 라인(GL), 게이트 전극(202)을 포함하는 게이트 금속 패턴이 형성된다.
도 4b를 참조하면, 게이트 금속 패턴이 형성된 기판(201) 상에 게이트 절연막(206)이 형성되고, 활성층(214) 및 오믹 접촉층(216)을 포함하는 반도체 패턴(212)이 형성된다.
구체적으로, 게이트 금속 패턴이 형성된 기판(201) 상에 PECVD(Plasma Enhanced Chemical Vapor Deposition)등의 증착 방법 통해 무기 절연 물질이 전면 증착됨으로써 게이트 절연막(206)이 형성된다. 게이트 절연막(206) 상에 증착 공정을 통해 비정질 실리콘층, 불순물이 도핑된 비정질 실리콘층이 순차적으로 증착된다. 이이서, 포토리소그래피 공정 및 식각 공정으로 비정질 실리콘층 및 불순물이 도핑된 비정질 실리층이 패터닝됨으로써 활성층(214) 및 오믹 접촉층(216)을 포함하는 반도체 패턴(212)이 형성된다. 게이트 절연막(206)으로는 질화 실리콘(SiOx), 산화 실리콘(SiNx) 등과 같은 무기 절연 물질이 이용된다.
도 4c를 참조하면, 반도체 패턴(212)이 형성된 게이트 절연막(206) 상에 데이터 라인(DL), 소스 전극(210), 드레인 전극(208)을 포함하는 소스 및 드레인 패턴이 형성된다.
구체적으로, 반도체 패턴(212)이 형성된 게이트 절연막(206) 위에 소스/드레인 금속층은 스퍼터링 등의 증착 방법으로 형성된다. 소스/드레인 금속층으로는 몰리브덴(Mo), 몰리브덴 텅스텐(MoW), 구리(Cu)으로 이용된다. 이 소스/드레인 금속층이 포토리소그래피 공정 및 식각 공정으로 패터닝됨으로써 데이터 라인(114), 소스 전극(210), 드레인 전극(208)을 포함하는 소스 및 드레인 패턴이 형성된다. 이어서, 소스 전극(210)과 드레인 전극(208)을 마스크로 하여 두 전극(208,210) 사이로 노출된 오믹 접촉층(216)을 제거하여 활성층(214)이 노출되게 한다.
도 4d를 참조하면, 소스 및 드레인 패턴이 형성된 게이트 절연막(206) 상에 컨택홀(220)을 포함하는 보호막(212)이 형성된다.
구체적으로, 소스 및 드레인 패턴이 형성된 게이트 절연막(206) 상에 PECVD(Plasma Enhanced Chemical Vapor Deposition), 스핀 코팅(Spin Coating), 스핀리스 코팅(Spinless Coating) 등의 방법으로 보호막(212)이 형성된다. 그리고 보호막(212)은 포토리소그래피 공정 및 식각 공정으로 패터닝됨으로써 컨택홀(220)이 형성된다.
도 4e를 참조하면, 보호막(120) 상에 화소 전극(214), 제1 공통 전압 라인(미도시), 제2 공통 전압 라인(124)을 포함하는 투명 도전 패턴이 형성된다.
구체적으로, 보호막(212) 상에 투명 도전층이 스퍼터링 등과 같은 증착 방법으로 형성된다. 투명 도전층으로는 ITO(Indum Tin Oxide), TO(Tin Oxide), IZO(Indum Zinc Oxide), ITZO(Indum Tin Zinc Oxide)등이 이용된다. 이 투명 도전층은 포토리소그래피 공정 및 식각 공정으로 패터닝됨으로써 화소 전극(214), 제1 공통 전압 라인(미도시), 제2 공통 전압 라인(124)이 형성된다. 화소 전극(214)은 컨택홀(220)을 통해 드레인 전극(208)과 접속된다. 인쇄회로기판(100)의 공통 전압 공급부로부터 가까운 위치의 공통 전극(248)과 접속될 제2 공통 전압 라인(124)은 지그-재그(Zig-Zag) 라인으로 패터닝되어 형성되며, 인쇄회로기판(100)의 공통 전압 공급부로부터 먼 공통 전극과 접속될 제1 공통 전압 라인(126)은 패턴 형상 없이 라인으로 형성된다. 그리고, 제2 공통 전압 라인(124)의 지그-재그 패턴의 폭(W)은 제1 공통 전압 라인(126)의 저항 값과의 차이를 줄이기 위해 좁게 형성한다. 이는, 위에서 서술한 [수학식 1]에 근거한 것이다.
이와 같이, 제2 공통 전압 라인(124)은 제1 공통 전압 라인(126)의 저항 값과 동일하게 하기 위해 지그-재그 형태로 길게 형성하며, 지그-재그의 폭(W)은 좁게하여 저항 값을 높인다. 또한, 제2 공통 전압 라인(124)은 화소 전극(214) 형성시 동시에 형성함으로 추가 공정이나 추가 저항 소자가 필요없다.
도 4f를 참조하면, 화소 영역을 구분하도록 상부 기판(240) 상에 형성된 블랙 매트릭스(242)와, 적색(R), 녹색(G), 청색(B) 칼러 필터(242)와, 아크릴 수지 등과 같은 투명한 유기 물질(246)로 형성되어 블랙 매트릭스(242)와 R,G,B 칼러 필터(244)를 덮도록 형성된 오버코트층(246)과, 오버코트층(246) 상에 투명 도전층으로 형성된 공통 전극(248)과, 도전성 스페이서(128)가 형성된 칼라 필터 기판을 마련한다.
도 4g를 참조하면, 도 4a 내지 도 4e의 제조 방법으로 형성된 박막 트랜지스터 기판과 칼라 필터 기판을 실런트(128)를 이용하여 서로 합착하여 액정 표시 패널을 형성한다. 합착 공정시, 상부 기판(240)의 공통 전극(248)과 하부 기판(201)의 제1 및 제2 공통 전압 라인(126, 124)은 도전성 스페이서(122)에 의해 서로 전기적으로 연결된다.
이상의 설명은 본 발명을 예시적으로 설명한 것에 불과하며, 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자에 의해 본 발명의 기술적 사상에서 벗어나지 않는 범위에서 다양한 변형이 가능할 것이다. 따라서 본 발명의 명세서에 개시된 실시 예들은 본 발명을 한정하는 것이 아니다. 본 발명의 범위는 아래의 특허청구범위에 의해 해석되어야 하며, 그와 균등한 범위 내에 있는 모든 기술도 본 발명의 범위에 포함되는 것으로 해석해야 할 것이다.
100 : 인쇄회로기판 102 : 박막 트랜지스터 기판
104 : 칼러 필터 기판 112 : 데이터 드라이버
114 : 게이트 드라이버 122 : 도전성 스페이서
124 : 제2 공통 전압 라인 126 : 제1 공통 전압 라인
128 : 실런트 201 : 상부 기판
202 : 게이트 전극 206 : 게이트 절연막
210 : 소스 전극 208 : 드레인 전극
212 : 반도체 패턴 214 : 화소 전극
220 : 컨택홀 240 : 하부 기판
242 : 블랙 매트릭스 244 : 칼러 필터
246 : 오버코트층 248 : 공통 전극

Claims (7)

  1. 상부 기판 상에 형성된 공통 전극과;
    상기 상부 기판과 마주는 하부 기판 상에 형성된 박막 트랜지스터와;
    상기 박막 트랜지스터의 드레인 전극과 접속된 화소 전극과;
    상기 공통 전극으로 공급하는 공통 전압을 생성하는 공통 전압 생성부가 실장된 인쇄회로기판과;
    상기 인쇄회로기판으로부터 먼 영역과 대응되는 위치에 형성된 상기 공통 전극에 공통 전압을 공급하는 제1 공통 전압 라인과;
    지그-재그(Zig-Zag) 형태로 형성되어 상기 인쇄회로기판으로부터 가까운 영역에 위치하는 공통 전극에 상기 제1 공통 전압 라인의 저항 값과 동일한 공통 전압을 공급하는 제2 공통 전압 라인을 포함하며,
    상기 제2 공통 전압 라인은 상기 화소 전극 형성시 동시에 형성된 것을 특징으로 하는 액정 표시 장치.
  2. 제1항에 있어서,
    상기 제2 공통 전압 라인은 ITO(Indum Tin Oxide), TO(Tin Oxide), IZO(Indum Zinc Oxide), ITZO(Indum Tin Zinc Oxide)와 같은 투명 도전 재질로 형성되는 것을 특징으로 하는 액정 표시 장치.
  3. 삭제
  4. 제1항에 있어서,
    상기 제2 공통 전압 라인의 선폭은 상기 제1 공통 전압 라인의 라인 저항 값과 동일하도록 좁게 형성되는 것을 특징으로 하는 액정 표시 장치.
  5. 하부 기판 상에 박막 트랜지스터를 형성하는 단계와;
    상기 박막 트랜지스터 상에 컨택홀이 형성된 보호막을 형성하는 단계와;
    상기 보호막 상에 화소 전극, 제1 공통 전압 라인과 상기 제1 공통 전압 라인과 동일한 저항 값을 가지도록 지그-재그(Zig-Zag) 형태로 제2 공통 전압 라인을 형성하는 단계와;
    상기 하부 기판과 마주보는 상부 기판 상에 공통 전극을 형성하는 단계와;
    상기 공통 전극과 상기 제1 및 제2 공통 전압 라인이 접속하도록 상기 하부 기판과 상부 기판을 합착하는 단계를 포함하며,
    상기 제2 공통 전압 라인은 상기 화소 전극과 동일층에 동일 재질로 형성된 것을 특징으로 하는 액정 표시 장치의 제조 방법.
  6. 삭제
  7. 제5항에 있어서,
    상기 제2 공통 전압 라인은 ITO(Indum Tin Oxide), TO(Tin Oxide), IZO(Indum Zinc Oxide), ITZO(Indum Tin Zinc Oxide)와 같은 투명 도전 재질로 형성되는 것을 특징으로 하는 액정 표시 장치의 제조 방법.
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