KR101686154B1 - Ｇｐｓ를 포함하는 다기능 셀률러 애플리케이션에서 원하는 수의 레퍼런스 소스들을 최소화시키기 위한 시스템 및 송수신기 클럭킹 - Google Patents

Ｇｐｓ를 포함하는 다기능 셀률러 애플리케이션에서 원하는 수의 레퍼런스 소스들을 최소화시키기 위한 시스템 및 송수신기 클럭킹 Download PDF

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Abstract

자동 주파수 보정(AFC)을 사용하여 보정되지 않는 제 1 클럭 레퍼런스를 발생시키도록 구성된 제 1 클럭 모듈을 포함하는 시스템이 제공된다. 위성위치확인 시스템(GPS) 모듈은 제 1 클럭 레퍼런스를 수신하도록 구성된다. 셀률러 송수신기를 위한 집적 회로가 시스템 위상 잠금 루프를 포함하고, 시스템 위상 잠금 루프는 제 1 클럭 레퍼런스를 수신하고, AFC를 수행하고, 그리고 AFC 보정된 제 2 클럭 레퍼런스를 발생시키도록 구성된다.

Description

ＧＰＳ를 포함하는 다기능 셀률러 애플리케이션에서 원하는 수의 레퍼런스 소스들을 최소화시키기 위한 시스템 및 송수신기 클럭킹{SYSTEM AND TRANSCEIVER CLOCKING TO MINIMIZE REQUIRED NUMBER OF REFERENCE SOURCES IN MULTI-FUNCTION CELLULAR APPLICATIONS INCLUDING GPS}
관련 출원의 상호 참조
본 출원은 미국특허출원 번호 제12/821,595호(2010년 6월 23일 출원), 미국 가특허출원 번호 제61/220,102호(2009년 6월 24일 출원)에 대해 우선권 혜택을 주장한다. 이러한 특허출원들의 개시내용은 그 전체가 참조로 본 명세서에 통합된다.
본 개시내용은 다기능 셀률러 애플리케이션(multi-functional cellular application)들에 관한 것으로, 특히 위성위치확인 시스템(global positioning system)들을 갖는 다기능 셀률러 애플리케이션들을 위한 클럭 레퍼런스(clock reference)들의 발생에 관한 것이다.
본 명세서에서 제공되는 배경기술은 본 개시내용의 배경 상황을 전반적으로 설명하기 위한 것이다. 현재 본 발명의 발명자로 명명된 사람들이 행한 작업은, 이러한 작업이 본 배경기술 부분에서 설명되는 한, 뿐만 아니라 (만약 본 배경 기술 부분에서 설명되지 않은 경우 본 출원의 출원시 종래 기술로서의 자격이 없는) 여러 양상의 설명으로 제공되는 한, 본 개시내용에 대한 종래 기술로서 명백하게 인정되는 것이 아니면 암시적으로 인정되는 것도 아니다.
이제 도 1을 참조하면, 셀률러 애플리케이션(50)은 셀률러 송수신기 모듈(52) 및 위성위치확인 시스템(Global Positioning System, GPS) 수신기 모듈(54)과 관련된 수신기들을 위한 정확한 클럭 레퍼런스들을 필요로 한다. 셀률러 송수신기 모듈(52)은 전압 제어 온도 보상 수정 발진기(Voltage Controlled, Temperature Compensated Crystal Oscillator, VC-TCXO) 클럭 모듈(60)로부터 제 1 클럭 레퍼런스(ClklnXCVR)를 수신한다.
셀률러 송수신기 모듈(52)은 하나 이상의 안테나들(53)을 통해 레퍼런스 톤(reference tone)들을 포함하는 RF 신호들 혹은 타이밍 정보를 보유하는 다른 신호들을 수신한다. RF 신호들은 베이스밴드(baseband)로 다운컨버트(downconvert)된다. 베이스밴드 모듈(baseband module)(68)은 다운컨버트된 신호들을 수신하고, 그리고 디지털 자동 주파수 제어(Automatic Frequency Control, AFC) 신호들을 발생시킨다. 셀률러 송수신기 모듈(52)은 VC-TCXO 클럭 모듈(60)로의 출력을 위해 디지털 AFC 신호들을 아날로그 AFC 신호들로 컨버트하는 DAC(66)를 포함한다. VC-TCXO 클럭 모듈(60)은 아날로그 AFC 신호들에 근거하여 제 1 클럭 레퍼런스(ClklnXCVR)를 보정한다. 클럭 레퍼런스(ClklnXCVR)는 도플러 효과, 온도, 및 다른 영향들을 보상하도록 조정된다.
그러나, GPS 수신기 모듈(54)은, AFC 보정 동안 VC-TCXO 클럭 모듈(60)로부터의 제 1 클럭 레퍼런스(ClklnXCVR)에서 일어나는 갑작스런 주파수 변화를 견딜 수 없기 때문에, 제 1 클럭 레퍼런스를 사용할 수 없다. 결과적으로, GPS 수신기 모듈(54)을 위한 제 2 클럭 레퍼런스(ClklnGPS)를 발생시키기 위해 추가적인 TCXO 클럭 모듈(58)이 전형적으로 사용된다. 제 2 클럭 레퍼런스는 AFC 보정되지 않는다. (셀률러 송수신기 모듈(52)을 위해 사용되는) AFC 보정된 VC-TCXO 클럭 모듈(60)에 추가하여 TCXO 클럭 모듈(58)이 구현된다.
이제 도 2를 참조하면, 셀률러 애플리케이션(75)은 제 1 클럭 모듈(77)을 포함하고, 제 1 클럭 모듈(77)은 GPS 수신기 모듈(79)에 제 1 클럭 레퍼런스를 제공한다. 제 2 클럭 모듈(82)은 셀률러 송수신기 모듈(81)의 클럭 분배 모듈(clock distribution module)(80)에 제 2 클럭 레퍼런스를 제공한다. 클럭 분배 모듈(80)은, 제 2 클럭 레퍼런스가 내부 클럭 분배 모듈(86)에 의해 수신되기 이전에, 제 2 클럭 레퍼런스를 버퍼링하기 위한 버퍼(84)를 포함할 수 있다.
수신기 위상 잠금 루프(Receiver Phase Lock Loop, RxPLL) 모듈(94)은 클럭 분배 모듈(80)로부터 제 2 클럭 레퍼런스를 수신한다. RxPLL 모듈(94)은 위상 주파수 검출기(Phase Frequency Detector, PFD)(96)를 포함하고, 위상 주파수 검출기(PFD)(96)는 분할기(104)에 의해 출력되는 제 3 클럭 레퍼런스와 제 2 클럭 레퍼런스 간의 위상차를 검출한다. PFD(96)는 이러한 위상차를 차지 펌프(charge pump)(98)에 출력한다. 차지 펌프(98)의 출력은 로우 패스 필터(Low Pass Filter, LPF)(100)에 의해 필터링되고, 그 다음에 전압 제어 발진기(Voltage Controlled Oscillator, VCO)(102)에 출력된다. VCO(102)는 분할기(104)에 제 4 클럭 레퍼런스를 출력하고, 분할기(104)는 제 3 클럭 레퍼런스를 발생시키기 위해 하나 이상의 정수값들의 세트로부터 선택된 값으로 제 4 클럭 레퍼런스를 분할한다.
수신기 모듈(109)은 저잡음 증폭기(Low Noise Amplifier, LNA)(110)를 포함하고, 저잡음 증폭기(LNA)(110)는 무선 주파수(Radio Frequency, RF) 입력을 수신하여 증폭시킨다. 다운컨버터(downconverter)(112)는 RF 입력 신호를 베이스밴드 신호로 다운컨버트시킨다. 결합되어 있는 필터 및 프로그래밍가능 이득 증폭기(Programmable Gain Amplifier, PGA)(118)는 베이스밴드 신호를 필터링 및 증폭시킨다.
결합되어 있는 아날로그대디지털 컨버터(Analog to Digital Converter, ADC) 및 디지털 신호 프로세서(Digital Signal Processor, DSP) 모듈(124)은 ADC 모듈(128)과 수신기 DSP(130)를 포함한다. ADC 모듈(128)은 필터링 및 증폭된 그러한 베이스밴드 신호를 디지털 베이스밴드 신호로 컨버트한다. 수신기 DSP(130)는 디지털 베이스밴드 신호에 관한 디지털 신호 프로세싱을 수행한다.
수신기 DSP(130)의 출력은 디지털 인터페이스 모듈(134)에 의해 수신되고, 디지털 인터페이스 모듈(134)은 베이스밴드 모듈(135)과 셀률러 송수신기 모듈(81) 간의 인터페이스를 제공한다. 베이스밴드 모듈(135)은 디지털 베이스밴드 신호에 관한 베이스밴드 프로세싱을 수행한다. 베이스밴드 모듈(135)은 또한, 버퍼(136)를 통해 내부 클럭 분배 모듈(86)로부터 시스템 클럭(SYSCLOCK)을 수신한다.
베이스밴드 모듈(135)은 자동 주파수 보정(Automatic Frequency Correction, AFC) 모듈(137)을 포함하고, 자동 주파수 보정(AFC) 모듈(137)은 제 2 클럭 레퍼런스의 주파수 에러를 회복시키기 위해 디지털 베이스밴드 신호를 프로세싱한다. AFC 모듈(137)은 주파수 에러를 보정하기 위해 디지털 AFC 신호를 발생시킨다. 디지털 AFC 신호는 디지털 인터페이스 모듈(134)을 통해 디지털대아날로그 컨버터(Digital to Analog Converter, DAC)(140)로 출력된다. DAC(140)는 아날로그 AFC 신호를 발생시키기고, 이러한 아날로그 AFC 신호는 제 2 클럭 모듈(82)에 출력된다. 제 2 클럭 모듈(82)은 아날로그 AFC 신호에 근거하여 제 2 클럭 레퍼런스를 보정한다.
아날로그 AFC 신호에 응답하여 수행된 조정은 제 2 클럭 레퍼런스에서의 갑작스런 주파수 혹은 위상 변화를 일으킬 수 있다. 이러한 갑작스런 클럭 레퍼런스 변화는 셀률러 송수신기 모듈(81)에 대해서는 허용될 수 있지만, 이러한 변화는 GPS 수신기 모듈(79)에 대해서는 허용되지 않는다. 결과적으로, 제 1 클럭 모듈(77)과 제 2 클럭 모듈(82) 양쪽 모두가 구현되게 된다.
자동 주파수 보정(AFC)을 사용하여 보정되지 않는 제 1 클럭 레퍼런스를 발생시키도록 구성된 제 1 클럭 모듈을 포함하는 시스템이 제공된다. 위성위치확인 시스템(GPS) 모듈은 제 1 클럭 레퍼런스를 수신하도록 구성된다. 셀률러 송수신기를 위한 집적 회로가 시스템 위상 잠금 루프(system phase lock loop)를 포함하고, 시스템 위상 잠금 루프는 제 1 클럭 레퍼런스를 수신하고, AFC를 수행하고, 그리고 AFC 보정된 제 2 클럭 레퍼런스를 발생시키도록 구성된다.
다른 특징으로서, 집적 회로는 아날로그 무선 주파수(RF) 신호들을 수신하고 디지털 베이스밴드 신호(digital baseband signal)들을 출력하도록 구성된 수신기 모듈을 더 포함한다. 수신기 모듈은 수신기 디지털 신호 프로세서(receiver digital signal processor)와 아날로그대디지털 컨버터(analog to digital converter) 중 적어도 하나를 포함하며, 수신기 디지털 신호 프로세서와 아날로그대디지털 컨버터 중 적어도 하나는 제 2 클럭 레퍼런스와 이러한 제 2 클럭 레퍼런스에 근거하는 제 3 클럭 레퍼런스 중 하나를 수신하도록 구성된다. 송신기 모듈은 디지털 베이스밴드 신호들을 수신하고 아날로그 전송 RF 신호들을 출력하도록 구성된다. 송신기 모듈은 송신기 디지털 신호 프로세서(transmitter digital signal processor)와 디지털대아날로그 컨버터(digital to analog converter) 중 적어도 하나를 포함하며, 송신기 디지털 신호 프로세서와 디지털대아날로그 컨버터 중 적어도 하나는 제 2 클럭 레퍼런스와 이러한 제 2 클럭 레퍼런스에 근거하는 제 4 클럭 레퍼런스 중 하나를 수신하도록 구성된다.
다른 특징으로서, 집적 회로는 제 1 클럭 모듈로부터 제 1 클럭 레퍼런스를 수신하고 GPS 모듈에 제 1 클럭 레퍼런스를 출력하도록 구성된다. 집적 회로는 제 1 클럭 레퍼런스를 수신하고 제 1 클럭 레퍼런스에 근거하여 제 3 클럭 레퍼런스를 발생시키도록 구성된 수신기 위상 잠금 루프 모듈(receiver phase lock loop module)을 더 포함한다. 송신기 위상 잠금 루프 모듈(transmitter phase lock loop module)은 제 1 클럭 레퍼런스를 수신하고 제 1 클럭 레퍼런스에 근거하여 제 4 클럭 레퍼런스를 발생시키도록 구성된다.
다른 특징으로서, 수신기 모듈은 또한, 제 3 클럭 레퍼런스를 수신하도록 구성된 다운컨버터(downconverter)를 포함한다. 송신기 모듈은 또한, 제 4 클럭 레퍼런스를 수신하도록 구성된 업컨버터(upconverter)를 포함한다. 집적 회로는, 제 2 클럭 레퍼런스를 수신하고 제 2 클럭 레퍼런스에 근거하여 제 3 클럭 레퍼런스를 발생시키도록 구성된 수신기 위상 잠금 루프 모듈을 포함한다. 송신기 위상 잠금 루프 모듈은, 제 2 클럭 레퍼런스를 수신하고 제 2 클럭 레퍼런스에 근거하여 제 4 클럭 레퍼런스를 발생시키도록 구성된다.
다른 특징으로서, 수신기 모듈은 또한, 제 3 클럭 레퍼런스를 수신하도록 구성된 다운컨버터를 포함한다. 송신기 모듈은 또한, 제 4 클럭 레퍼런스를 수신하도록 구성된 업컨버터를 포함한다. 베이스밴드 모듈이 집적 회로로부터 디지털 베이스밴드 신호들을 수신하고 AFC 신호들을 발생시키도록 구성된다. 베이스밴드 모듈은 제 2 집적 회로로 구현된다.
다른 특징으로서, 멀티플렉서(multiplexer)는 제 1 클럭 레퍼런스와 제 2 클럭 레퍼런스 중 하나를 베이스밴드 모듈에 선택적으로 출력하도록 구성된다. WiFi 모듈과 블루투스 모듈(Bluetooth module) 중 적어도 하나가 상기 집적 회로로부터 제 1 클럭 레퍼런스를 수신하도록 구성된다.
시스템 위상 잠금 루프는 제 1 클럭 레퍼런스와 제 3 클럭 레퍼런스 간의 차이를 결정하도록 구성된 위상 주파수 검출기를 포함한다. 차지 펌프가 위상 주파수 검출기의 출력을 수신하도록 구성된다. 필터가 차지 펌프의 출력을 필터링하도록 구성된다. 전압 제어 발진기(voltage controlled oscillator)가 제 2 클럭 레퍼런스를 발생시키도록 구성된다. 분할기(divider)가 제 2 클럭 레퍼런스를 수신하고 나눗수(divisor)에 근거하여 제 3 클럭 레퍼런스를 출력하도록 구성된다. 분수 조정 모듈(fractional adjusting module)이 연속적인 간격들 동안 2 이상의 정수값들 중 하나로 나눗수의 비(ratio)를 조정하도록 구성된다.
다른 특징으로서, 전압 제어 발진기(voltage controlled oscillator)는 링 발진기(ring oscillator), 완화 발진기(relaxation oscillator), LC 발진기 중 하나를 포함한다. 제 1 클럭 모듈은 온도 제어 수정 발진기(temperature controlled crystal oscillator)를 포함한다.
자동 주파수 보정(AFC)을 사용하여 보정되지 않는 제 1 클럭 레퍼런스를 발생시키는 것과, 위성위치확인 시스템(GPS) 모듈에서 제 1 클럭 레퍼런스를 수신하는 것과, 셀률러 송수신기용 집적 회로에서 제 1 클럭 레퍼런스를 수신하는 것과, 그리고 집적 회로를 사용하여 자동 주파수 보정(AFC)을 수행하고, AFC 보정된 제 2 클럭 레퍼런스를 발생시키는 것을 포함하는 방법이 제공된다.
본 개시내용의 응용가능성의 또 다른 영역은 다음의 상세한 설명, 특허청구범위 및 도면으로부터 명백하게 될 것이다. 이러한 상세한 설명 및 특정 예들은 단지 예시적 목적으로 제공되는 것이지, 본 개시내용의 범위를 한정하려는 것이 아니다.
본 개시내용은 다음의 상세한 설명 및 첨부되는 도면을 통해 보다 완전히 이해될 것이다.
도 1은 종래 기술에 따른 셀률러 송수신기 및 위성위치확인 시스템을 포함하는 셀률러 애플리케이션의 간단한 기능블록도이다.
도 2는 종래 기술에 따른 셀률러 송수신기 및 위성위치확인 시스템을 포함하는 셀률러 애플리케이션의 보다 상세한 기능블록도이다.
도 3은 본 개시내용에 따른 셀률러 송수신기 및 위성위치확인 시스템을 포함하는 셀률러 애플리케이션의 간단한 기능블록도이다.
도 4는 본 개시내용에 따른 셀률러 송수신기 및 위성위치확인 시스템을 포함하는 셀률러 애플리케이션의 보다 상세한 기능블록도이다.
도 5는 본 개시내용에 따른 시스템 위상 잠금 루프(system phase lock loop)의 기능블록도이다.
도 6은 프로그래밍가능 슬루율(programmable slew rate)을 갖는 버퍼의 기능블록도이다.
도 7은 본 개시내용에 따른 셀률러 송수신기 및 위성위치확인 시스템을 포함하는 또 다른 셀률러 애플리케이션의 보다 상세한 기능블록도이다.
도 8은 본 개시내용에 따른 또 다른 시스템 위상 잠금 루프의 기능블록도이다.
다음의 설명은 본질적으로 단지 예시적인 것이며, 본 개시내용, 그 응용, 혹은 용도를 한정하려하는 것이 아니다. 명료한 설명을 위해, 도면에서 유사한 요소를 식별하기 위해 동일한 참조 번호가 사용된다. 본 명세서에서 사용되는 바와 같이, A, B, 및 C 중 적어도 하나라는 어구는, 비배타적 로직 연산자(OR)를 사용하여, 로직(A OR B OR C)을 의미하는 것으로 해석돼야 한다. 본 개시내용의 원리를 변경시킴 없이 본 명세서에서 설명되는 방법에서의 단계들은 서로 다른 순서로 실행될 수 있음을 이해해야 한다.
본 명세서에서 사용되는 바와 같이, 모듈(module)이라는 용어는, 애플리케이션 특정 집적 회로(Application Specific Integrated Circuit, ASIC), 전자 회로, 조합 로직 회로(combinational logic circuit), 필드 프로그래밍가능 게이트 어레이(Field Programmable Gate Array, FPGA), 코드를 실행하는 (공유된 혹은 전용의 혹은 그룹) 프로세서, 원하는 기능을 제공하는 다른 적절한 컴포넌트들, 또는 예를 들어 시스템온칩(system-on-chip)과 같은 곳에서의 앞서 설명된 것들의 일부 혹은 모두의 조합을 말하거나, 그 일부이거나, 혹은 이러한 것들을 포함할 수 있다. 모듈이라는 용어는 프로세서에 의해 실행되는 코드를 저장하는 (공유된 혹은 전용의 혹은 그룹) 메모리를 포함할 수 있다.
앞에서 사용되는 바와 같은 코드(code)라는 용어는, 소프트웨어, 펌웨어 및/또는 마이크로코드를 포함할 수 있고, 그리고 프로그램, 루틴, 함수, 클래스 및/또는 오브젝트를 말할 수 있다. 앞에서 사용되는 바와 같은 공유된(shared)이라는 용어는 복수의 모듈들로부터의 일부 혹은 모든 코드가 단일의 (공유된) 프로세서를 사용하여 실행될 수 있음을 의미한다. 추가적으로, 복수의 모듈들로부터의 일부 혹은 모든 코드는 단일의 (공유된) 메모리에 의해 저장될 수 있다. 앞에서 사용되는 바와 같은 그룹(group)이라는 용어는 단일의 모듈로부터의 일부 혹은 모든 코드가 프로세서들의 그룹을 사용하여 실행될 수 있음을 의미한다. 추가적으로, 단일의 모듈로부터의 일부 혹은 모든 코드는 메모리들의 그룹을 사용하여 저장될 수 있다.
본 명세서에서 설명되는 장치 및 방법은 하나 이상의 프로세서들에 의해 실행되는 하나 이상의 컴퓨터 프로그램들에 의해 구현될 수 있다. 컴퓨터 프로그램들은 영구적인 유형의 컴퓨터 판독가능 매체에 저장되는 프로세서 실행가능 명령들을 포함한다. 컴퓨터 프로그램들은 또한 저장된 데이터를 포함할 수 있다. 영구적인 유형의 컴퓨터 판독가능 매체의 비한정적 예는 비휘발성 메모리, 자기 저장소, 및 광학 저장소이다.
본 개시내용에 따른 다기능 셀률러 디바이스는 클럭 레퍼런스를 공유하는 셀률러 송수신기 모듈과 위성위치확인 시스템(GPS) 수신기 모듈을 포함한다. 클럭 레퍼런스는 또한, 다기능 셀률러 디바이스의 다른 모듈들과 공유될 수도 있다. 결과적으로, 다기능 셀률러 디바이스의 전체 비용이 감소될 수 있다.
단지 예시적인 것으로서, 본 개시내용에 따른 하나의 다기능 셀률러 디바이스는 GPS 수신기에 대해 적절한 온도 드리프트(temperature drift)를 갖는 단일의 온도 보상 수정 발진기(TCXO) 클럭 모듈을 사용한다. TCXO 클럭 모듈로부터의 클럭 레퍼런스는 셀률러 송수신기에 입력된다. 셀률러 송수신기는 내부적으로 클럭 레퍼런스를 사용하고, 그리고 또한, GPS 수신기의 구동을 위해 클럭 레퍼런스를 버퍼링 및 출력한다. TCXO 클럭 모듈 자체는 자동 주파수 제어(AFC)를 구현하지 못한다. 따라서, 클럭 레퍼런스는 (GPS 성능에 영향을 미치는) AFC로 인한 갑작스런 변화를 나타내지 않는다. 반면, 셀률러 송수신기는 내부적으로 사용되는 임의 버전의 클럭 레퍼런스를 발생시키기 위해 AFC를 수행한다.
이제 도 3을 참조하면, 다기능 셀률러 디바이스(200)는, AFC 보정을 갖는 셀률러 송수신기 모듈(204) 및 위성위치확인 시스템(GPS) 수신기 모듈(208)을 포함한다. 클럭 모듈(216)은 셀률러 송수신기 모듈(204)에 대한 클럭 레퍼런스(Clkln)를 발생시킨다. 클럭 모듈(216)은 온도 보상 수정 발진기(TCXO)를 포함할 수 있다(하지만 다른 타입의 클럭 모듈들이 사용될 수도 있음). 셀률러 송수신기 모듈(204)은 클럭 레퍼런스를 GPS 수신기 모듈(208)에 출력하는 버퍼(210)를 포함한다.
셀률러 송수신기 모듈(204)은 수신된 신호를 베이스밴드로 다운컨버트하고, 베이스밴드 신호를 베이스밴드 모듈(218)에 출력한다. 베이스밴드 모듈은 AFC 모듈(219)을 포함하는바, AFC 모듈(219)은 베이스밴드 신호를 프로세싱함으로써 주파수 에러를 회복시키고, 자동 주파수 보정(AFC) 신호들을 발생시킨다. 그 다음에, AFC 신호들은 셀률러 송수신기 모듈(204)에 전송된다. 클럭 모듈(216)은, 이하에서 더 설명되는 바와 같이, AFC 보정된 하나 이상의 추가적인 클럭 레퍼런스들을 내부적으로 발생시킨다.
이제 도 4를 참조하면, 셀률러 디바이스(200)의 구현이 제시된다. 셀률러 디바이스(200)는 셀률러 송수신기 모듈(204)의 구현을 포함하는바, 셀률러 송수신기 모듈(204)은, 클럭 분배 모듈(clock distribution module)(250), 송신기 위상 잠금 루프(Transmitter Phase Lock Loop, TxPLL) 모듈(260), 수신기 위상 잠금 루프(Receiver Phase Lock Loop, RxPLL) 모듈(270), 시스템 위상 잠금 루프(PLL) 모듈(275), 수신기 모듈(280), 및 송신기 모듈(290)을 포함한다. 셀률러 송수신기 모듈(204)은 또한 디지털 인터페이스 모듈(292)을 포함하는바, 디지털 인터페이스 모듈(292)은 베이스밴드 모듈(293)과 셀률러 송수신기 모듈(204) 간의 인터페이스를 제공한다. 클럭 분배 모듈(250), TxPLL 모듈(260), RxPLL 모듈(270), 시스템 PLL 모듈(275), 수신기 모듈(280), 송신기 모듈(290), 디지털 인터페이스 모듈(292) 중 하나 이상이 제 1 집적 회로로서 구현될 수 있다.
베이스밴드 모듈(293)은 AFC 모듈(294)을 포함하고, AFC 모듈(294)은 수신된 베이스밴드 신호들의 디지털 프로세싱에 근거하여 AFC 신호들을 발생시킨다. 베이스밴드 모듈(293)은 제 1 집적 회로와는 별개일 수 있는 제 2 집적 회로로서 구현될 수 있다.
클럭 모듈(300)은 버퍼(302)를 통해 내부 클럭 분배 모듈(303)에 클럭 레퍼런스를 전송한다. 일부 구현에서, 클럭 모듈(300)은 온도 제어 수정 발진기(TCXO)를 포함할 수 있다. 버퍼(302)의 출력은 또한 하나 이상의 버퍼들(304-1, 304-2, ..., 및 304-T)(집합적으로는 버퍼들(304))을 통해 다른 모듈들(306-1, 306-2, ..., 및 306-T)(집합적으로는 모듈들(306))에 출력된다. 단지 예시적인 것으로, 모듈들(306)은 오프 칩(off chip)일 수 있고, 그리고 단지 예시적인 것으로, 모듈들(306)은 GPS 모듈, 블루투스(BlueTooth, BT) 모듈, 무선 로컬 영역 네트워크(예를 들어, WiFi) 모듈, 및/또는 추가적인 모듈들을 포함할 수 있다.
내부 클럭 분배 모듈(303)은 TxPLL 모듈(260)의 위상 주파수 검출기(PFD)(310)에 제 1 클럭 레퍼런스를 출력한다. PFD(310)는 또한 분할기(314)의 출력을 수신한다. PFD(310)는 이러한 클럭 레퍼런스와 분할기(314)로부터 출력된 제 2 클럭 레퍼런스 간의 위상차를 검출한다. PFD(310)는 차신호(difference signal)들을 발생시키고, 이 차신호들은 차지 펌프(316)에 출력된다. 차지 펌프의 출력은 로우 패스 필터(LPF)와 같은 필터(320)에 의해 수신된다. 필터(320)의 출력은 전압 제어 발진기(VCO)(322)에 의해 수신된다. VCO(322)에 의해 출력된 제 3 클럭 레퍼런스는 분할기(314)에 출력된다. 정수 N 혹은 분수 N 분할기일 수 있는 분할기(314)는 VCO(322)로부터의 제 3 클럭 레퍼런스에 근거하여 제 2 클럭 레퍼런스를 발생시킨다.
내부 클럭 분배 모듈(303)은 또한 RxPLL 모듈(270)의 PFD(330)에 제 1 클럭 레퍼런스를 출력한다. PFD(330)는 또한, 분할기(334)로부터 출력된 제 4 클럭 레퍼런스를 수신한다. PFD(330)는 제 1 클럭 레퍼런스와 분할기(334)로부터의 제 4 클럭 레퍼런스 간의 위상차를 검출한다. PFD(330)는 차신호들을 발생시키고, 이 차신호들은 차지 펌프(336)에 출력된다. 차지 펌프(336)의 출력은 필터(340)(로우 패스 필터일 수 있음)를 통과해 VCO(342)에 출력된다. VCO(342)는 분할기(334)에 제 5 클럭 레퍼런스를 출력한다. 정수 N 혹은 분수 N 분할기일 수 있는 분할기(334)는 VCO(342)로부터의 제 5 클럭 레퍼런스에 근거하여 제 4 클럭 레퍼런스를 발생시킨다.
내부 클럭 분배 모듈(303)은 또한 시스템 PLL 모듈(275)에 제 1 클럭 레퍼런스를 출력한다. 시스템 PLL 모듈(275)은 AFC 보정을 갖는 제 6 클럭 레퍼런스를 발생시키는바, 수신기 모듈(280), 송신기 모듈(290), 베이스밴드 모듈(293) 중 하나 이상의 모듈에 대한 클럭 레퍼런스들이 이것에 근거하고 있다.
수신기 모듈(280)은 저잡음 증폭기(LNA)(360)를 포함하는바, 저잡음 증폭기(LNA)(360)는 안테나와 같은 소스로부터 RF 입력을 수신한다. LNA(360)의 출력은 다운컨버터(362)로 입력되고, 다운컨버터(362)는 신호를 베이스밴드로 다운컨버트한다. 필터/프로그래밍가능 이득 증폭기(PGA) 모듈(364)은 다운컨버터(362)의 출력을 수신하고, 필터링 및 이득 조정을 수행한다. 필터/PGA 모듈(364)의 출력은 아날로그대디지털 컨버터(ADC)(366)로 입력되고, ADC(366)는 RF 입력을 디지털 RF 신호로 컨버트시킨다. ADC(366)의 출력은 수신기 디지털 신호 프로세서(DSP)(370)로 입력되고, 수신기 DSP(370)는 디지털 신호 프로세싱을 수행하고, 디지털 수신 데이터를 디지털 인터페이스 모듈(292)에 출력한다.
송신기 모듈(290)은 디지털 인터페이스 모듈(292)로부터 디지털 전송 데이터를 수신한다. 송신기 DSP(380)는 디지털 인터페이스 모듈(292)로부터의 디지털 전송 데이터에 관해 디지털 신호 프로세싱을 수행하고, 프로세싱된 디지털 데이터를 디지털대아날로그 컨버터(384)에 출력한다. DAC(384)의 아날로그 출력이 필터 모듈(386)에 입력된다. 필터 모듈(386)의 출력은 업컨버터(388)에 입력되는바, 업컨버터(388)는 신호를 RF 신호로 업컨버트한다. 업컨버터(388)의 출력은 파워 증폭기(power amlifier)(390)에 입력되는바, 파워 증폭기(390)는 증폭을 수행하고 증폭된 RF 신호를 안테나(미도시)에 출력한다. 파워 증폭기(390)는 셀률러 송수신기 모듈(204) 외부에 위치할 수 있다.
멀티플렉서(394)는 버퍼(302)로부터 제 1 클럭 레퍼런스를 수신하고, 시스템 PLL 모듈(275)로부터 AFC 보정된 클럭 레퍼런스(SYSCLK)를 수신한다. 멀티플렉서(394)는 제 1 클럭 레퍼런스와 AFC 보정된 클럭 레퍼런스 중 하나를 선택하여 버퍼(396)에 출력한다. 베이스밴드 모듈(293)은 버퍼(396)로부터 그 선택된 클럭 레퍼런스를 수신한다.
이제 도 5를 참조하면, 도 4의 시스템 PLL 모듈(275)의 구현이 보다 상세히 제시된다. 시스템 PLL 모듈(275)은, 내부 클럭 분배 모듈(303)로부터의 제 1 클럭 레퍼런스와 분할기(402)로부터의 제 7 클럭 레퍼런스 간의 위상차를 검출하는 PFD(400)를 포함한다. PFD(400)는 차지 펌프(404)에 차신호들을 출력한다. 차지 펌프(404)의 출력은 필터(408)에 의해 필터링되는바, 필터(408)는 로우 패스 필터(LPF)일 수 있다. 필터(408)의 출력은 VCO(410)에 의해 입력되는바, VCO(410)는 분할기(402)에 피드백될 제 6 클럭 레퍼런스를 발생시킨다. 다양한 구현에서, 제 6 클럭 레퍼런스는 또한 시스템 PLL 모듈(275)로부터 출력될 수 있다.
시스템 PLL 모듈(275)은 또한, 분수 조정 모듈(fractional adjusting module)(428)을 포함한다. 분수 조정 모듈(428)은 분수 주파수(fractional frequency)를 변경시키기 위해 분할기(402)의 정수 나숫수(integer divisor)를 조정한다. 단지 예시적인 것으로서, 분수 조정 모듈(428)은 AFC 신호들에 근거하여 M개의 연속적인 클럭 싸이클들의 반복되는 싸이클 동안 2 이상의 값 중 하나로 분할기(402)의 정수 나눗수를 조정할 수 있고, 여기서 M은 2보다 큰 정수이다. 단지 예시적인 것으로서, 분수 조정 모듈(428)은 M개의 연속적인 클럭 싸이클 동안 2 이상의 정수 나눗수들 중 하나로 분할을 수행하는 분할기(402)의 동작들을 토글(toggle)시켜 분수 주파수 분할을 근사화시킬 수 있다. 도 4를 다시 참조하면, 분할기들(314 및 334)은 또한 분수 조정 모듈들을 포함할 수 있고, AFC 신호들을 수신할 수 있고, 그리고 분할기(402)와 유사한 방식으로 동작할 수 있다. 일부 구현에서, 분수 조정 모듈들은 AFC를 수신할 수 있고, 그리고 분할기들(314 및 334)의 정수 나눗수들을 조정할 수 있다.
시스템 PLL 모듈(275)은, 제 6 클럭 레퍼런스의 정수 나눗수들에서 추가적인 AFC 보정된 클럭 레퍼런스들을 제공하는, 하나 이상의 추가적 분할기들(430-1, 430-2, 430-3)(집합적으로는 분할기들(430))을 포함할 수 있다. 단지 예시적인 것으로서, 분할기들(430) 중 두 개는 수신기 모듈(280) 및 송신기 모듈(290)에 대한 AFC 보정된 클럭 레퍼런스들(RxCLK 및 TxCLK)을 각각 발생시킬 수 있다. 다양한 구현에서, 제 6 클럭 레퍼런스는 시스템 PLL 모듈(275)로부터 하나 이상의 클럭 레퍼런스들(RxCLK, TxCLK 및 SYSCLK)로서 대신 출력될 수 있다.
다양한 종래의 방법들이, 기판 커플링(substrate coupling), 전기적 커플링(electrical coupling), 자기적 커플링(magnetic coupling) 등으로 인한 전자파 간섭(electromagnetic interference, EMI)을 감소시키기 위해 사용될 수 있다. 단지 예시적인 것으로 이제 도 6을 참조하면, 하나 이상의 버퍼들이, 프로그래밍가능 슬루율 제어(programmable slew rate control)를 갖는 버퍼로서 구현될 수 있다. 예를 들어, 버퍼(302)에 의해 출력되는 클럭 레퍼런스는 프로그래밍가능 슬루율 제어를 갖는 버퍼(304-1')에 공급될 수 있다. 버퍼(304-1')의 슬루율은 슬루율 조정 신호에 의해 조정될 수 있다. 슬루율 조정 신호는, 클럭 분배 모듈(250')에 의해 외부적으로, 국부적으로 발생될 수 있고, 하나 이상의 다른 모듈들(306)(예를 들어, 도 6에서 GPS 수신기 모듈(306-1')과 같은 것)에 의해 외부적으로 발생될 수 있고, 셀률러 송수신기의 다른 컴포넌트들에 의해 발생될 수 있거나, 또는 임의의 다른 적절한 방식으로 발생될 수 있다. 이런 방식으로 슬루율을 제어하는 것은 EMI, 스퍼(spurs) 등을 감소시키는 경향이 있다. EMI를 감소시키는 다른 기술들이 특정 애플리케이션의 세부적 구현에 따라 사용될 수 있다.
이제 도 7 및 도 8을 참조하면, 셀률러 디바이스(200')의 또 다른 구현이 제시된다. 앞에서 설명된 요소들과 유사한 것은 프라임 심벌(prime symbol)(')을 갖는 동일한 참조 번호를 사용하여 표시되었다. 도 7에서, AFC 보정된 클럭 레퍼런스들이 또한, 시스템 PLL 모듈(275')에 의해 TxPLL 모듈(260') 및 RxPLL 모듈(270)에 출력된다. 도 8에서, 추가적인 분할기들(430-4 및 430-5)이 VCO(410)로부터 출력된 제 6 클럭 레퍼런스의 다른 정수 나눗수들이 가능하도록 제공될 수 있다. 단지 예시적인 것으로서, 분할기들(430-4 및 430-5)은 TxPLL 및 RxPLL 모듈들(260' 및 270')에 대한 클럭 레퍼런스들(TxPLLCLK 및 RxPLLCLK)을 각각 발생시킬 수 있다.
앞에서 설명된 VCO들 각각은, 링 발진기, 완화 발진기, LC 발진기 및/또는 임의의 다른 적절한 발진기로서 구현될 수 있다. WiFi 모듈(306-T) 및 BT 모듈(306-2)은 다음과 같은 IEEE 표준, 즉 802.11, 802.11a, 802.11b, 802.11g, 802.11h, 802.11n, 802.16, 802.20, 및 802.15.1 중 하나 이상을 따를 수 있다.
본 개시내용의 광범위한 설명은 다양한 형태로 구현될 수 있다. 따라서, 본 개시내용이 특정 예를 포함하지만 본 개시내용의 진정한 범위는 이러한 것에만 한정돼서는 안 되는데, 왜냐하면 본 개시내용의 도면, 상세한 설명 및 다음의 특허청구범위를 학습함으로 다른 수정들이 명백하게 가능하기 때문이다.

Claims (24)

  1. 시스템으로서,
    자동 주파수 보정(Automatic Frequency Correction, AFC)을 사용하여 보정되지 않는 제 1 클럭 레퍼런스(clock reference)를 발생시키도록 되어 있는 제 1 클럭 모듈과;
    상기 제 1 클럭 레퍼런스에 응답하여 동작하도록 되어 있는 위성위치확인 시스템(Global Positioning System, GPS) 모듈과;
    셀률러 송수신기(cellular transceiver)용 집적 회로와, 여기서 상기 집적 회로는 시스템 위상 잠금 루프(Phase Lock Loop, PLL)를 포함하고, 상기 시스템 위상 잠금 루프(PLL)는, (i) 상기 제 1 클럭 레퍼런스에 응답하여 동작하도록 되어 있고 그리고 (ii) AFC 신호에 응답하여 상기 제 1 클럭 레퍼런스에 AFC를 수행함으로써 제 2 클럭 레퍼런스를 발생시키도록 되어 있으며;
    상기 제 1 클럭 레퍼런스와 상기 제 2 클럭 레퍼런스에 양자택일적으로 근거하는 선택 레퍼런스를 출력하도록 되어 있는 선택 모듈과; 그리고
    (i) 상기 선택 레퍼런스를 수신하고 (ii) 상기 AFC 신호를 발생시키도록 되어 있는 베이스밴드 모듈(baseband module)을 포함하는 것을 특징으로 하는 시스템.
  2. 제1항에 있어서,
    상기 집적 회로는,
    아날로그 무선 주파수(Radio Frequency, RF) 신호들을 수신하고, 상기 아날로그 RF 신호들에 응답하여 디지털 베이스밴드 신호(digital baseband signal)들을 출력하도록 되어 있는 수신기 모듈과, 그리고
    디지털 베이스밴드 신호들을 수신하고, 상기 디지털 베이스밴드 신호들에 응답하여 아날로그 전송 RF 신호들을 출력하도록 되어 있는 송신기 모듈을 더 포함하며,
    상기 수신기 모듈은 수신기 디지털 신호 프로세서(Digital Signal Processor, DSP)와 아날로그대디지털 컨버터(Analog to Digital Converter, ADC) 중 적어도 하나를 포함하며,
    상기 수신기 디지털 신호 프로세서(DSP)는 수신기 클럭 레퍼런스(receiver clock reference)에 응답하여 동작하도록 되어 있고,
    상기 아날로그대디지털 컨버터(ADC)는 상기 수신기 클럭 레퍼런스에 응답하여 동작하도록 되어 있으며,
    상기 송신기 모듈은 송신기 DSP와 디지털대아날로그 컨버터(Digital to Analog Converter, DAC) 중 적어도 하나를 포함하며,
    상기 송신기 DSP는 송신기 클럭 레퍼런스(transmitter clock reference)에 응답하여 동작하도록 되어 있고,
    상기 디지털대아날로그 컨버터(DAC)는 상기 송신기 클럭 레퍼런스에 응답하여 동작하도록 되어 있는 것을 특징으로 하는 시스템.
  3. 제1항에 있어서,
    상기 집적 회로는, (i) 상기 제 1 클럭 모듈로부터 상기 제 1 클럭 레퍼런스를 수신하도록 되어 있고, 그리고 (ii) 상기 GPS 모듈에 상기 제 1 클럭 레퍼런스를 출력하도록 되어 있는 것을 특징으로 하는 시스템.
  4. 제1항에 있어서,
    상기 집적 회로는,
    (i) 상기 제 1 클럭 레퍼런스를 수신하도록 되어 있음과 아울러 (ii) 상기 제 1 클럭 레퍼런스에 응답하여 제 3 클럭 레퍼런스를 발생시키도록 되어 있는 수신기 위상 잠금 루프(PLL) 모듈과, 그리고
    (i) 상기 제 1 클럭 레퍼런스를 수신하도록 되어 있음과 아울러 (ii) 상기 제 1 클럭 레퍼런스에 응답하여 제 4 클럭 레퍼런스를 발생시키도록 되어 있는 송신기 위상 잠금 루프(PLL) 모듈을 더 포함하는 것을 특징으로 하는 시스템.
  5. 제4항에 있어서,
    상기 집적 회로는,
    수신된 아날로그 무선 주파수(RF) 신호들 및 상기 제 3 클럭 레퍼런스에 응답하여 아날로그 베이스밴드 신호들을 발생시키도록 되어 있는 다운컨버터(downconverter)와, 그리고
    상기 제 4 클럭 레퍼런스에 응답하여 전송을 위한 아날로그 RF 신호들을 발생시키도록 되어 있는 업컨버터(upconverter)를 더 포함하는 것을 특징으로 하는 시스템.
  6. 제1항에 있어서,
    상기 집적 회로는,
    (i) 상기 제 2 클럭 레퍼런스를 수신하도록 되어 있음과 아울러 (ii) 상기 제 2 클럭 레퍼런스에 응답하여 제 3 클럭 레퍼런스를 발생시키도록 되어 있는 수신기 위상 잠금 루프(PLL) 모듈과, 그리고
    (i) 상기 제 2 클럭 레퍼런스를 수신하도록 되어 있음과 아울러 (ii) 상기 제 2 클럭 레퍼런스에 응답하여 제 4 클럭 레퍼런스를 발생시키도록 되어 있는 송신기 위상 잠금 루프(PLL) 모듈을 포함하는 것을 특징으로 하는 시스템.
  7. 제6항에 있어서,
    상기 집적 회로는,
    수신된 아날로그 무선 주파수(RF) 신호들 및 상기 제 3 클럭 레퍼런스에 응답하여 아날로그 베이스밴드 신호들을 발생시키도록 되어 있는 다운컨버터와, 그리고
    상기 제 4 클럭 레퍼런스에 응답하여 전송을 위한 아날로그 RF 신호들을 발생시키도록 되어 있는 업컨버터를 더 포함하는 것을 특징으로 하는 시스템.
  8. 제1항에 있어서,
    상기 베이스밴드 모듈을 포함하는 제 2 집적 회로를 더 포함하는 것을 특징으로 하는 시스템.
  9. 삭제
  10. 제1항에 있어서,
    상기 집적 회로로부터 상기 제 1 클럭 레퍼런스를 수신하도록 되어 있는 WiFi 모듈,
    상기 집적 회로로부터 상기 제 1 클럭 레퍼런스를 수신하도록 되어 있는 블루투스 모듈(Bluetooth module) 중 적어도 하나를 더 포함하는 것을 특징으로 하는 시스템.
  11. 제1항에 있어서,
    상기 시스템 위상 잠금 루프(PLL)는,
    상기 제 1 클럭 레퍼런스와 제 3 클럭 레퍼런스 간의 차이를 결정하도록 되어 있는 위상 주파수 검출기(phase frequency detector)와,
    상기 위상 주파수 검출기의 출력을 수신하도록 되어 있는 차지 펌프(charge pump)와,
    상기 차지 펌프의 출력을 필터링하도록 되어 있는 필터와,
    상기 제 2 클럭 레퍼런스를 발생시키도록 되어 있는 전압 제어 발진기(voltage controlled oscillator)와,
    (i) 상기 제 2 클럭 레퍼런스를 수신하도록 되어 있음과 아울러 (ii) 나눗수(divisor)에 근거하여 상기 제 3 클럭 레퍼런스를 출력하도록 되어 있는 분할기(divider)와, 그리고
    연속적인 간격들 동안 2 이상의 정수값들 중 하나로 상기 나눗수의 비(ratio)를 조정하도록 되어 있는 분수 조정 모듈(fractional adjusting module)을 포함하는 것을 특징으로 하는 시스템.
  12. 제11항에 있어서,
    상기 전압 제어 발진기는 링 발진기(ring oscillator), 완화 발진기(relaxation oscillator), LC 발진기 중 하나를 포함하는 것을 특징으로 하는 시스템.
  13. 제1항에 있어서,
    상기 제 1 클럭 모듈은 온도 제어 수정 발진기(temperature controlled crystal oscillator)를 포함하는 것을 특징으로 하는 시스템.
  14. 자동 주파수 보정(AFC)을 사용하여 보정되지 않는 제 1 클럭 레퍼런스를 발생시키는 단계와;
    위성위치확인 시스템(GPS) 모듈에서 상기 제 1 클럭 레퍼런스를 수신하는 단계와;
    상기 제 1 클럭 레퍼런스에 응답하여 상기 GPS 모듈을 동작시키는 단계와;
    셀률러 송수신기용 집적 회로에서 상기 제 1 클럭 레퍼런스를 수신하는 단계와;
    AFC 신호에 대한 응답으로, 상기 집적 회로의 위상 잠금 루프(PLL)를 사용하여 상기 제 1 클럭 레퍼런스에 AFC를 수행함으로써 제 2 클럭 레퍼런스를 발생시키는 단계와;
    선택 레퍼런스로서 상기 제 1 클럭 레퍼런스와 상기 제 2 클럭 레퍼런스 중 하나를 양자택일적으로 선택하는 단계와;
    상기 선택 레퍼런스를 베이스밴드 모듈에 제공하는 단계와; 그리고
    상기 베이스밴드 모듈을 사용하여 상기 AFC 신호를 발생시키는 단계를 포함하는 것을 특징으로 하는 방법.
  15. 삭제
  16. 제14항에 있어서,
    수신기 위상 잠금 루프(PLL)를 사용하여, 상기 제 1 클럭 레퍼런스에 대한 응답으로 제 3 클럭 레퍼런스를 발생시키는 단계와; 그리고
    송신기 위상 잠금 루프(PLL)를 사용하여, 상기 제 1 클럭 레퍼런스에 대한 응답으로 제 4 클럭 레퍼런스를 발생시키는 단계를 더 포함하는 것을 특징으로 하는 방법.
  17. 제16항에 있어서,
    상기 제 3 클럭 레퍼런스에 응답하여, 수신된 아날로그 무선 주파수(RF) 신호들을 아날로그 베이스밴드 신호들로 다운컨버트(downconvert)하는 단계와, 그리고
    상기 제 4 클럭 레퍼런스에 응답하여, 전송을 위한 베이스밴드 신호들을 전송을 위한 아날로그 RF 신호들로 업컨버트(upconvert)하는 단계를 더 포함하는 것을 특징으로 하는 방법.
  18. 제14항에 있어서,
    수신기 위상 잠금 루프(PLL)를 사용하여, 상기 제 2 클럭 레퍼런스에 대한 응답으로 제 3 클럭 레퍼런스를 발생시키는 단계와; 그리고
    송신기 위상 잠금 루프(PLL)를 사용하여, 상기 제 2 클럭 레퍼런스에 대한 응답으로 제 4 클럭 레퍼런스를 발생시키는 단계를 더 포함하는 것을 특징으로 하는 방법.
  19. 제18항에 있어서,
    상기 제 3 클럭 레퍼런스에 응답하여, 수신된 아날로그 무선 주파수(RF) 신호들을 아날로그 베이스밴드 신호들로 다운컨버트하는 단계와; 그리고
    상기 제 4 클럭 레퍼런스에 응답하여, 전송을 위한 베이스밴드 신호들을 전송을 위한 아날로그 RF 신호들로 업컨버트하는 단계를 더 포함하는 것을 특징으로 하는 방법.
  20. 삭제
  21. 삭제
  22. 제14항에 있어서,
    상기 집적 회로로부터의 상기 제 1 클럭 레퍼런스와 상기 제 2 클럭 레퍼런스 중 하나를 상기 베이스밴드 모듈에 선택적으로 출력하는 단계를 더 포함하는 것을 특징으로 하는 방법.
  23. 제14항에 있어서,
    상기 GPS 모듈에 제공된 상기 제 1 클럭 레퍼런스의 슬루율(slew rate)을 버퍼링 및 제어하는 단계를 더 포함하는 것을 특징으로 하는 방법.
  24. 제2항에 있어서,
    상기 수신기 클럭 레퍼런스는 상기 제 2 클럭 레퍼런스의 제1의 정수의 배수이고, 여기서 상기 제1의 정수는 1이거나 1보다 크며, 그리고
    상기 송신기 클럭 레퍼런스는 상기 제 2 클럭 레퍼런스의 제2의 정수의 배수이고, 여기서 상기 제2의 정수는 1이거나 1보다 큰 것을 특징으로 하는 시스템.
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