KR101385467B1 - 액정표시장치 - Google Patents

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Abstract

본 발명은 센터부와 에지부에 배치된 데이터 링크부의 저항차를 줄이고, 데이터 링크부의 개구영역을 확보하기에 알맞은 액정표시장치를 제공하기 위한 것으로, 이와 같은 목적을 달성하기 위한 액정표시장치는 게이트 배선과 데이터 배선이 교차 배치되며, 화소영역이 정의되어 있는 액티브 영역과; 상기 액티브 영역 외곽부에 상기 데이터 배선과 연결되며, 데이터 드라이브 IC를 기준으로 센터부와 에지부에 서로 다른 길이로 배치된 복수개의 데이터 링크선과; 상기 액티브 영역 외곽부에 상기 게이트 배선에서 연장되어 복수개 배치된 게이트 링크선과; 상기 액티브영역 외곽부에 상기 게이트 링크선과 상기 데이터 링크선에 신호를 전달하도록 배치된 게이트 패드 및 데이터 패드와; 상기 데이터 링크선의 일측에만 요(凹)부가 형성되며, 상기 요(凹)부는 상기 에지부에 배치된 데이터 링크선 보다 상기 센터부에 배치된 데이터 링크선에 더 많이 형성되어 더 넓은 개구영역을 확보하도록 구성한다.
Figure R1020070053888
데이터 링크선, 저항

Description

액정표시장치{LIQUID CRYSTAL DISPLAY DEVICE}
도 1은 종래 기술에 따른 액정표시장치의 박막 어레이 기판의 평면도
도 2a와 도 2b는 종래 기술에 따른 1층 구조의 데이터 링크선을 포함한 구조 단면도 및 데이터 링크선의 공정 피치를 나타낸 평면도
도 3a와 도 3b는 종래 기술에 따른 2층 구조의 데이터 링크선을 포함한 구조 단면도 및 데이터 링크선의 공정 피치를 나타낸 평면도
도 4는 본 발명의 실시예에 따른 액정표시장치의 박막 어레이 기판의 평면도
도 5는 본 발명의 2층 구조의 데이터 링크선을 포함한 구조 단면도
도 6a와 도 6b는 에지부와 센터부의 데이터 링크선의 공정 피치를 나타낸 평면도
도 7a와 도 7b는 센터부의 데이터 링크선의 공정 피치를 예시한 평면도
* 도면의 주요 부분에 대한 부호의 설명 *
111 : 박막 어레이 기판 112 : 게이트 배선
112a : 게이트 전극 113 : 게이트 절연막
115 : 데이터 배선 115a : 소스 전극
115b : 드레인 전극 116 : 보호막
117 : 화소전극 125 : 데이터 패드
135a, 135b, 135c, 135d : 제 1, 제 2, 제 3, 제 4 데이터 링크선
140 : 데이터 드라이브 IC
본 발명은 액정표시장치에 대한 것으로, 특히 패드 링크 설계에 따라 데이터 드라이브 IC의 수를 감소시킬 수 있고, 링크선의 길이에 대한 센터부와 에지부의 저항차를 줄이고, 씨일재의 UV 경화를 용이하게 하기에 알맞은 액정표시장치에 관한 것이다.
평판표시장치로서 최근 각광받고 있는 액정표시장치는 콘트라스트(contrast) 비가 크고, 계조 표시나 동화상 표시에 적합하며 전력소비가 작다는 장점 때문에 활발한 연구가 이루어지고 있다.
특히, 얇은 두께로 제작될 수 있어 장차 벽걸이 TV와 같은 초박형(超薄形) 표시장치로 사용될 수 있을 뿐만 아니라, 무게가 가볍고, 전력소비도 CRT 브라운관에 비해 상당히 적어 배터리로 동작하는 노트북 컴퓨터의 디스플레이로 사용되는 등, 차세대 표시장치로서 각광을 받고 있다.
이와 같은 액정표시장치는 일반적으로, 게이트 배선 및 데이터 배선에 의해 정의된 각 화소 영역에 박막트랜지스터와 화소전극이 구비되어 있는 박막 어레이 기판과, 컬러필터층, 블랙 매트릭스 및 공통전극이 구비되어 있는 컬러필터 기판과, 상기 두 기판 사이에 개재된 액정층으로 구성되어, 전극에 전압을 인가하여 액 정층의 액정 분자들을 재배열시킴으로써 투과되는 빛의 양을 조절하여 화상을 표시한다.
이때, 상기 컬러필터 기판과 박막 어레이 기판은 에폭시 수지와 같은 씨일재에 의해 합착되며, 인쇄회로기판(PCB; Printed Circuit Board) 상의 구동회로는 드라이브 IC를 이용한 TCP(Tape Carrier Package)방식에 의해 박막 어레이 기판에 연결된다. 상기 인쇄회로기판에는 기판 상에 집적회로와 같은 다수의 소자가 형성되어 있어, 액정표시소자를 구동시키기 위한 여러 가지 제어신호 및 데이터신호 등을 생성한다.
이하, 첨부된 도면을 참조하여 종래의 액정표시장치에 대하여 설명하면 다음과 같다.
도 1은 종래 기술에 따른 액정표시장치의 박막 어레이 기판의 평면도이고, 도 2a와 도 2b는 종래 기술에 따른 1층 구조의 데이터 링크선을 포함한 구조 단면도 및 데이터 링크선의 공정 피치를 나타낸 평면도이며, 도 3a와 도 3b는 종래 기술에 따른 2층 구조의 데이터 링크선을 포함한 구조 단면도 및 데이터 링크선의 공정 피치를 나타낸 평면도이다.
상기 박막 어레이 기판(11)은, 도 1에 도시된 바와 같이, 게이트 배선(12) 및 데이터 배선(15)에 의해 매트릭스 구조의 단위 화소(P)가 정의된 액티브 영역과, 게이트 패드(22) 및 데이터 패드(25)가 형성되어 별도로 제작된 인쇄회로기판 상의 구동회로와 연결되는 패드부 영역으로 구분된다.
이때, 패드부 영역은 게이트 패드부 및 데이터 패드부로 분할되어, 상기 게 이트 패드부에는 게이트 배선(12)에서 연장 형성된 게이트 링크선(32)과 상기 게이트 링크선(32) 끝단에 형성된 게이트 패드(22)가 형성되어 있고, 상기 데이터 패드부에는 데이터 배선(15)에서 연장 형성된 데이터 링크선(35)과 상기 데이터 링크선(35) 끝단에 형성된 데이터 패드(25)가 형성되어 있다.
구체적으로, 도 1 내지 도 2b에 도시된 바와 같이, 액티브 영역의 유리 기판(11) 상에는 복수개의 게이트 배선(12) 및 데이터 배선(15)이 교차 형성되어 단위 화소(P)가 정의되고, 상기 각 화소영역 내에는 상기 게이트 배선(12)과 데이터 배선(15)의 교차 부위에서 신호를 스위칭하는 박막트랜지스터(TFT : Thin Film Transistor)와, 단위 화소영역이 다음에 어드레싱(addressing)될 때까지 충전 상태를 유지하게 하는 스토리지 커패시터(storage capacitor, 도시하지 않음)와, 상기 박막트랜지스터(TFT)의 드레인 전극(15b)에 연결되어 액정 방향자를 제어하기 위한 전계를 형성하는 화소전극(17)이 형성되어 있다.
이때, 상기 게이트 배선(12) 및 데이터 배선(15) 사이에는 두 층간의 절연을 위한 게이트 절연막(13)이 더 형성되어 있고, 상기 박막트랜지스터(TFT)와 화소전극(17) 사이에는 보호막(16)이 더 형성되어 있다.
그리고, 패드부 영역에는 게이트 드라이버의 게이트 구동신호를 상기 각 게이트 배선(12)에 인가하기 위해 상기 게이트 배선(12)에서 연장 형성된 복수개의 게이트 링크선(32) 및 게이트 패드(22)와, 데이터 드라이버의 데이터 신호를 상기 각 데이터 배선(15)에 인가하기 위해 상기 게이트 배선(12) 형성시 형성된 복수개의 데이터 링크선(35) 및 데이터 패드(25)가 형성되어 각각 외부 구동회로와 전기 적 신호를 인터페이싱한다.
이때, 상기 게이트 패드(22) 및 데이터 패드(25)는 복수개씩 한 그룹이 되어 기판 가장자리에 형성되고, 각 그룹에 게이트 드라이브 IC 및 데이터 드라이브 IC가 각각 TCP방식에 의해 실장되며, 상기 드라이브 IC를 통해 인쇄회로기판으로부터 각종 신호를 전달받는다.
상기 게이트 드라이브 IC 및 데이터 드라이브 IC의 숫자는 액정표시소자의 모델 또는 크기에 따라 달라지는데, 도 1은 1개의 게이트 드라이브 IC 및 2개의 데이터 드라이브 IC가 실장될 게이트 패드(22) 및 데이터 패드(25)를 간단하게 도시한 것이다.
이와 같이, 패드전극이 그룹지어 드라이브 IC가 실장될 부분에 형성되므로, 도 1에 도시된 바와 같이, 데이터 드라이브 IC가 실장될 부분에서 멀리 떨어져 있는 데이터 링크선(35)의 길이는 보다 길어지고, 데이터 드라이브 IC가 실장될 부분에 가까이 있는 데이터 링크선(35)의 길이는 보다 짧아지게 된다. 결국, 데이터 링크선(35)의 길이가 서로 달라진다. 이는 게이트 링크선(32)의 경우에도 마찬가지이다.
그러나, 링크선의 길이가 각각 달라지게 되면 링크선의 저항치도 각각 달라져 링크선을 통과하는 전류의 흐름 속도가 불균일해진다. 즉, 링크선이 길어지면 저항치가 높아져 전류가 늦게 흐르게 되고, 링크선이 짧아지면 저항치가 낮아져 전류가 빨리 흐르게 된다.
따라서, 드라이브 IC로부터 가장 멀리 있는 배선과 가장 가까이에 있는 배선 에 흐르는 전류가 동일하지 않게 되므로 동일한 신호가 동시에 전달되지 못하는 문제점이 있다.
또한, 박막 어레이 기판에서 1개의 데이터 링크선(35)이 1개의 화소영역을 구동할 경우, 데이터 링크선을 형성하기 위한 실제 공정 피치는 대략 15㎛는 되어야 하며, 데이터 링크선 간의 간격은 데이터 링크선의 폭보다 더 큰 것이 바람직하다.
그러나, 실제로 도 2b에 도시된 데이터 링크선(35)의 피치는 대략 9㎛ 정도밖에 확보되질 않는다.
그리고, 박막 어레이 기판에서 데이터 링크선의 피치 확보를 위해서 데이터 링크선을 2층 구조로 형성하였다.
2층 구조로 데이터 링크선을 형성할 때의 데이터 링크선은, 제 1, 제 2 데이터 링크선(35a, 35b)으로 나누어 제시하였는데, 도 3a와 도 3b에 도시한 바와 같이, 제 1 데이터 링크선(35a)은 게이트 배선 형성시에 형성된 것이고, 제 2 데이터 링크선(35b)은 데이터 배선 형성시에 형성된 것이다.
이와 같이, 박막 어레이 기판에서 데이터 링크선의 피치 확보를 위해서 2층 구조로 데이터 링크선을 형성할 경우에는, 각각의 데이터 링크선의 폭은 대략 6㎛ 정도이고, 제 1, 제 2 데이터 링크선(35a, 35b) 간의 간격은 대략 1.5㎛이므로, 데이터 링크선의 피치는 확보되지만, 제 1, 제 2 데이터 링크선(35a, 35b) 간의 개구율 미확보로 차후에 씨일재를 UV 경화할 때 UV가 잘 조사되지 않는 문제가 발생할 수 있다.
본 발명은 상기와 같은 문제를 해결하기 위하여 안출한 것으로, 본 발명의 목적은 센터부와 에지부에 배치된 데이터 링크부의 저항차를 줄이고, 데이터 링크부의 개구영역을 확보하기에 알맞은 액정표시장치를 제공하는데 있다.
상기와 같은 목적을 달성하기 위한 본 발명에 따른 액정표시장치는 게이트 배선과 데이터 배선이 교차 배치되며, 화소영역이 정의되어 있는 액티브 영역과; 상기 액티브 영역 외곽부에 상기 데이터 배선과 연결되며, 데이터 드라이브 IC를 기준으로 센터부와 에지부에 서로 다른 길이로 배치된 복수개의 데이터 링크선과; 상기 액티브 영역 외곽부에 상기 게이트 배선에서 연장되어 복수개 배치된 게이트 링크선과; 상기 액티브영역 외곽부에 상기 게이트 링크선과 상기 데이터 링크선에 신호를 전달하도록 배치된 게이트 패드 및 데이터 패드와; 상기 에지부에 배치된 데이터 링크선 보다 상기 센터부에 배치된 데이터 링크선에 요(凹)부를 더 많이 구비하여 더 넓은 개구영역을 확보하도록 구성한 것을 특징으로 한다.
상기 화소영역은 상기 데이터 배선을 기준으로 그 양측에 각각 정의되는 것을 특징으로 한다.
상기 데이터 배선은 상기 데이터 배선을 기준으로 양측에 위치한 2개의 화소영역에 신호를 전달하도록 구성된 것을 특징으로 한다.
상기 데이터 링크선들 중 이웃하는 데이터 링크선들은 상기 게이트 배선 및 상기 데이터 배선과 동일층에 각각 형성되어 2층 구조를 이루는 것을 특징으로 한 다.
상기 센터부와 에지부의 데이터 링크선들의 요부는 일측면 또는 양측면에 복수개의 구성됨을 특징으로 한다.
이하, 첨부 도면을 참조하여 본 발명의 바람직한 실시예에 따른 액정표시장치에 대하여 설명하면 다음과 같다.
도 4는 본 발명의 실시예에 따른 액정표시장치의 박막 어레이 기판의 평면도이고, 도 5는 본 발명의 2층 구조의 데이터 링크선을 포함한 구조 단면도이다.
도 6a와 도 6b는 에지부와 센터부의 데이터 링크선의 공정 피치를 나타낸 평면도이고, 도 7a와 도 7b는 센터부의 데이터 링크선의 공정 피치를 예시한 평면도이다.
액정표시소자는 전술한 바와 같이, 색상구현을 위한 컬러필터층이 형성된 컬러필터 기판과, 액정분자의 배열 방향을 변환시킬 수 있는 스위칭 소자가 형성된 액티브 영역과 외부 구동회로와 접속되는 패드부 영역으로 구분되는 박막 어레이 기판과, 상기 두 기판 사이에 형성된 액정층으로 구성되는바, 이하에서는 본 발명의 특징이 있는 상기 박막 어레이 기판에 한정하여 설명하기로 한다.
본 발명의 실시예에 따른 액정표시장치의 박막 어레이 기판은, 도 4와 도 5 및 도 6a와 도 6b에 도시한 바와 같이, 서로 수직 교차하는 복수개의 게이트 배선(112) 및 데이터 배선(115)에 의해 복수개의 화소가 정의되는 액티브 영역과, 상기 게이트 배선(112)에서 연장되는 복수개의 게이트 링크선(미도시)과 그 끝단에 형성되는 게이트 패드 및 상기 데이터 배선(115)에서 연장되는 복수개의 데이터 링 크선들과 그 끝단에 형성되는 데이터 패드(125)들을 포함하는 패드부 영역으로 구분된다.
이때 데이터 링크선들은 복수개의 제 1, 제 2, 제 3, 제 4 데이터 링크선(135a, 135b, 135c, 135d)들로 구성된다.
구체적으로, 액티브 영역에는 복수개의 게이트 배선(112) 및 데이터 배선(115)이 교차하고, 데이터 배선(115)을 공통으로 사용하도록 양쪽에 각각 한쌍을 이루는 화소영역이 정의되어 있으며, 상기 게이트 배선(112)과 데이터 배선(112)이 교차하는 양쪽의 화소영역에는 각각 스위칭 소자로서 박막트랜지스터(TFT : Thin Film Transistor)가 형성되며, 각 화소영역에는 화소전극(117)이 형성된다. 이때 데이터 배선(115) 양쪽에 형성된 박막 트랜지스터는 게이트가 서로 다른 게이트 배선(112)에 연결된다.
그리고, 이웃하는 데이터 배선에 형성된 한쌍의 박막 트랜지스터들은 이웃하는 화소영역의 박막 트랜지스터와 서로 대칭을 이루도록 구성될 수도 있다.
상기와 같이 1개의 데이터 배선(115)이 데이터 배선 양측의 2개의 화소영역을 구동하도록 구성되어 있다. 이와 같이 하면, 데이터 드라이브 IC의 수를 감소시킬 수 있는 효과가 있다.
이때, 상기 단위 박막트랜지스터는 상기 게이트 배선(112)에서 분기되는 게이트 전극(112a)과, 상기 게이트 전극(112a)을 포함한 전면에 실리콘 산화물(SiOx) 또는 실리콘 질화물(SiNx)의 무기절연물질을 증착하여 형성된 게이트 절연막(113)과, 상기 게이트 전극(112a) 상부의 게이트 절연막(113) 상에 형성된 비정질 실리 콘(Amorphous Silicon;a-Si:H)의 반도체층(114)과, 상기 데이터 배선(115)에서 분기되어 상기 반도체층(114) 상부에 형성된 소스/드레인 전극(115a,115b)의 적층막으로 구성되며, 상기 드레인 전극(115b)이 보호막(116)을 관통하여 상기 화소전극(117)과 연결된다.
그리고, 상기 게이트 배선(112) 및 데이터 배선(115)은 구리(Cu), 알루미늄(Al), 알루미늄 합금(AlNd : Aluminum Neodymium), 몰리브덴(Mo), 크롬(Cr), 티타늄(Ti), 탄탈륨(Ta), 몰리브덴-텅스텐(MoW) 등의 저저항 금속 물질을 스퍼터링 방법으로 증착하고 패터닝하여 형성되고, 상기 화소전극(117)은 상기 보호막 상에 ITO(Indium Tin Oxide) 또는 IZO(Indium Zinc Oxide) 등의 투명한 도전 물질을 증착하고 패터닝하여 형성된다.
한편, 패드부 영역에는 게이트 구동신호를 상기 각 게이트 배선(112)에 인가하기 위한 게이트 패드(미도시)와, 데이터 신호를 상기 각 데이터 배선(112)에 인가하기 위한 데이터 패드(125)가 형성되어 외부 구동회로와 전기적 신호를 인터페이싱하는데, 상기 게이트 패드 및 데이터 패드(125)는 각각 게이트 드라이버 IC(미도시)와 데이터 드라이버 IC(140)가 실장되는 부분에 복수개씩 그룹지어 형성된다.
이때, 상기 게이트 배선(112) 및 게이트 패드는 게이트 링크선(미도시)에 의해 연결되고, 상기 데이터 배선(112) 및 데이터 패드(125)는 데이터 링크선들에 의해 연결된다.
그리고, 상기 데이터 링크선들은 도 5 및 도 6a와 도 6b에 도시한 바와 같이, 2층 구조로 나뉘어 형성되어 있다.
이때, 상기 데이터 링크선들은 데이터 드라이브 IC(140)를 기준으로 멀리 있는 데이터 배선(115)과 가까이 있는 데이터 배선(115)으로 나누어 볼 수 있다. 데이터 드라이브 IC(140)를 기준으로 멀리 있는 데이터 배선(115)과 연결되는 데이터 링크선들 에지부에 배치되었다고 하고, 가까이 있는 데이터 배선(115)과 연결되는 데이터 링크선들은 센터부에 배치되었다고 정의하여 설명한다.
부연하면, 에지부의 데이터 링크선들은 제 1, 제 2 데이터 링크선(135a, 135b)으로 나누어 제시하였는데, 제 1 데이터 링크선(135a)은 게이트 배선(112) 형성시에 형성된 것(동일층에 형성된 것)이고, 제 2 데이터 링크선(135b)은 데이터 배선(115) 형성시에 형성된 것(동일층에 형성된 것)이다.
그리고, 센터부의 데이터 링크선들은 제 3, 제 4 데이터 링크선(135c, 135d)으로 나누어 제시하였는데, 제 3 데이터 링크선(135c)은 게이트 배선(112) 형성시에 형성된 것(동일층에 형성된 것)이고, 제 4 데이터 링크선(135d)은 데이터 배선(115) 형성시에 형성된 것(동일층에 형성된 것)이다.
상기에 따라서, 데이터 링크선들 중, 제 1, 제 3 데이터 링크선(135a, 135c)은 도면에는 도시되지 않았지만, 별도의 연결 배선을 통해서 해당 데이터 배선에 연결되고, 제 2, 제 4 데이터 링크선(135b, 135d)은 직접 해당 데이터 배선에 연결된다.
상기 2층 구조로 구성된 제 1, 제 2, 제 3, 제 4 데이터 링크선(135a, 135b, 135c, 135d)들은 각각 1개의 데이터 배선(115)에 일대일 대응되어 연결되어 있다.
상기에서 데이터 드라이브 IC(140)를 기준으로 멀리 있는 데이터 배선(115) 과 연결된 데이터 링크선들과 가까이 있는 데이터 링크선들은 그 링크선들의 길이가 다르다. 다시 말해서, 에지부에 배치된 데이터 링크선의 길이가 센터부에 배치된 데이터 링크선의 길이보다 길어지게 된다.
상기와 같이, 에지부에 배치된 데이터 링크선의 길이가 센터부에 연결된 데이터 링크선들의 길이보다 길어지면, 센터부 대비 에지부에 배치된 데이터 링크선의 저항이 커져서, 센터부와 에지부에 배치된 데이터 링크선에 흐르는 전류의 속도가 달라지게 된다.
본 발명에서는 데이터 링크선들을 2층 구조로 형성하여 공정 피치를 확보함과 동시에, 에지부와 센터부의 데이터 링크선들의 저항차에 따른 전류 속도를 맞추기 위해서, 에지부와 센터부에 위치한 데이터 링크선들의 요부의 개수를 조절하여(선폭 및 그 면적을 다르게 하여) 구성시켰다.
전체적으로는 센터부와 에지부에 형성된 각 제 1, 제 2, 제 3, 제 4 데이터 링크선(135a, 135b, 135c, 135d)들이 일측면 또는 양측면에 내부로 복수개의 요철을 갖도록 구성하였다. 이에 따라서, 개구영역이 늘어났고, 차후에 씨일재를 UV 경화시킬 때, UV 조사를 문제없이 진행할 수 있도록 하였다.
또한, 도 6a와 도 6b에 도시한 바와 같이, 에지부에 배치된 제 1, 제 2 데이터 링크선(135a, 135b)은 센터부에 배치된 제 3, 제 4 데이터 링크선(135c, 135d) 대비 측면 요철의 개수를 특히, 요(凹)부를 적게 형성하여서 저항차를 줄였다. 이때 에지부의 제 1, 제 2 데이터 링크선(135a, 135b)은 차후에 UV 경화시 문제가 발생되지 않는 한도의 개구영역을 확보할 정도로만 요(凹)부를 형성할 수 있다.
그리고, 센터부에 배치된 제 3, 제 4 데이터 링크선(135c, 135d)은 개구영역을 확보하기 위해서 요부 및 각 링크선간의 간격을 조정할 수 있는데, 예를 들어 제시하면 다음과 같다.
먼저, 도 7a에 도시한 바와 같이, 제 3, 제 4 데이터 링크선(135c, 135d)은 요부는 3.0㎛가 되도록 하고, 그 사이의 간격은 1.5㎛가 되도록 구성할 수도 있는데, 이와 같이 구성하면, 제 3, 제 4 데이터 링크선(135c, 135d)의 최대 간격은 4.5㎛가 된다. 이와 같이 구성하면 개구율이 대략 40.4%정도 개선되는 효과가 있다.
그리고, 도 7b에 도시한 바와 같이, 제 3, 제 4 데이터 링크선(135c, 135d)의 요부는 3.0㎛가 되도록 하고, 그 사이의 간격은 2.5㎛가 되도록 구성할 수도 있는데, 이와 같이 구성하면, 제 3, 제 4 데이터 링크선(135c, 135d)의 최대 간격은 5.5㎛가 된다. 이와 같이 구성하면 개구율이 대략 45.9%정도 개선되는 효과가 있다.
상기에서와 같이, 서로 다른 길이를 갖는 센터부와 에지부에 배치된 데이터 링크선의 측면에 요철(특히, 요(凹)부)의 개수를 조절하면, 즉, 요철을 데이터 링크선의 길이에 반비례하게 형성하면, 센터부와 에지부의 데이터 링크선의 저항차를 줄일 수 있고, 개구 영역도 확보할 수 있다.
이상에서 설명한 본 발명은 전술한 실시예 및 첨부된 도면에 의해 한정되는 것이 아니고, 본 발명의 기술적 사상을 벗어나지 않는 범위 내에서 여러 가지 치환, 변형 및 변경이 가능하다는 것이 본 발명이 속하는 기술분야에서 통상의 지식 을 가진 자에게 있어 명백할 것이다.
상기와 같은 본 발명에 따른 액정표시장치는 다음과 같은 효과가 있다.
첫째, 데이터 링크선들을 2층 구조로 형성하여 공정 피치를 확보하였다.
둘째, 서로 다른 길이를 갖는 센터부와 에지부에 배치된 데이터 링크선의 측면에 요철(특히, 요(凹)부)의 개수를 조절하여, 센터부와 에지부의 데이터 링크선의 저항차를 줄였고, 개구 영역도 확보하였다.

Claims (5)

  1. 게이트 배선과 데이터 배선이 교차 배치되며, 화소영역이 정의되어 있는 액티브 영역과;
    상기 액티브 영역 외곽부에 상기 데이터 배선과 연결되며, 데이터 드라이브 IC를 기준으로 센터부와 에지부에 서로 다른 길이로 배치된 복수개의 데이터 링크선과;
    상기 액티브 영역 외곽부에 상기 게이트 배선에서 연장되어 복수개 배치된 게이트 링크선과;
    상기 액티브영역 외곽부에 상기 게이트 링크선과 상기 데이터 링크선에 신호를 전달하도록 배치된 게이트 패드 및 데이터 패드와;
    상기 데이터 링크선의 일측에만 요(凹)부가 형성되며, 상기 요(凹)부는 상기 에지부에 배치된 데이터 링크선 보다 상기 센터부에 배치된 데이터 링크선에 더 많이 형성되어 더 넓은 개구영역을 확보하도록 구성한 것을 특징으로 하는 액정표시장치.
  2. 제 1 항에 있어서,
    상기 화소영역은 상기 데이터 배선을 기준으로 그 양측에 각각 정의되는 것을 특징으로 하는 액정표시장치.
  3. 제 2 항에 있어서,
    상기 데이터 배선은 상기 데이터 배선을 기준으로 양측에 위치한 2개의 화소영역에 신호를 전달하도록 구성된 것을 특징으로 하는 액정표시장치.
  4. 제 1 항에 있어서,
    상기 데이터 링크선들 중 이웃하는 데이터 링크선들은 상기 게이트 배선 및 상기 데이터 배선과 동일층에 각각 형성되어 2층 구조를 이루는 것을 특징으로 하는 액정표시장치.
  5. 삭제
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