KR101376844B1 - 역률 보정 회로 및 이를 포함하는 전원 장치 - Google Patents

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Abstract

본 발명은 역률 보정 회로 및 이를 포함하는 전원 장치에 관한 것이다. 본 발명의 역률 보정 회로는 입력 전원의 전류와 전압의 위상차를 조절하는 메인 스위치; 상기 메인 스위치의 스위칭에 따라 에너지를 축적 또는 방출하는 메인 인덕터; 상기 메인 스위치의 온 동작 전에 존재하는 잉여 전원의 전달 경로를 형성하는 스너버 스위치 및 상기 스너버 스위치에 인가되는 전류량을 조절하는 스너버 인덕터를 구비하는 스너버 회로부; 및 상기 스너버 인덕터의 인덕턴스를 가변하여 상기 스너버 스위치에 부과되는 과도 전원을 저감하는 저감 회로부; 를 포함할 수 있다.

Description

역률 보정 회로 및 이를 포함하는 전원 장치{POWER FACTOR CORRECTION CIRCUIT AND POWER SUPPLY HAVING THE SAME}
본 발명은 역률 보정 회로 및 이를 포함하는 전원 장치에 관한 것이다.
최근 들어, 여러 국가의 각 정부에서 에너지 효율 정책에 따른 에너지의 효율적인 사용을 권장하고 있으며, 특히 이러한 에너지의 효율적인 사용은 전자 제품, 가전 제품에 널리 권장되고 있다.
이러한 권장에 따라 에너지를 효율적으로 사용하는 데 있어서, 전자 제품, 가전 제품 등에 전원을 공급하는 전원 장치가 주로 에너지의 효율적인 사용에 따른 개선 회로가 적용되고 있다.
이러한 개선 회로로는 역률 보정 회로를 예로 들 수 있는데, 역률 보정 회로는 입력된 전원을 스위칭하여 입력된 전원의 전류와 전압의 위상차(역률)를 조정하여 후단에 전달되는 전원이 효율적으로 전달되도록 하는 회로이다.
다만, 이러한 역률 보정 회로가 입력 전원의 위상차를 조절하기 위하여 스위칭 동작하는 과정에서 피크성 전압이 발생함으로써, 스위칭 소자가 파손될 수 있으며, 스위칭 손실이 발생할 수 있다.
하기 선행기술문헌에 기재된 특허문헌 1은, 스너버 회로부의 인덕터에 축적된 에너지를 이용해 역률을 개선시키기 위한 역률 개선 회로에 관한 것이나, 스위칭시에 발생하는 스파이크 전압을 저감하기 위한 사항을 개시하고 있지 않다.
미국 공개특허공보 2011/0199066
본 발명의 과제는 전술한 종래 기술의 문제점을 해결하기 위한 것으로서, 본 발명은 입력 전원을 스위칭하여 역률을 개선하는 메인 스위치에 영 전압 턴 온 조건을 제공하는 스너버 스위치의 턴 오프 시점에 발생하는 피크성 전압을 저감할 수 있는 역률 보정 회로 및 이를 포함하는 전원 장치를 제공한다.
본 발명의 제1 기술적인 측면에 따르면, 입력 전원의 전류와 전압의 위상차를 조절하는 메인 스위치; 상기 메인 스위치의 스위칭에 따라 에너지를 축적 또는 방출하는 메인 인덕터; 상기 메인 스위치의 온 동작 전에 존재하는 잉여 전원의 전달 경로를 형성하는 스너버 스위치 및 상기 스너버 스위치에 인가되는 전류량을 조절하는 스너버 인덕터를 구비하는 스너버 회로부; 및 상기 스너버 인덕터의 인덕턴스를 가변하여 상기 스너버 스위치에 부과되는 과도 전원을 저감하는 저감 회로부; 를 포함하는 역률 보정 회로를 제안한다.
또한, 상기 저감 회로부는, 상기 스너버 인덕터와 유도 결합하는 보조 인덕터; 상기 보조 인덕터에 전원을 공급하는 직류 전원; 상기 직류 전원에 의해 상기 보조 인덕터로 공급되는 전류량을 조절하는 가변 저항; 및 상기 직류 전원을 공급 또는 차단하는 보조 스위치를 포함하는 역률 보정 회로를 제안한다.
또한, 상기 스너버 스위치는 사전에 설정된 제1 시간 동안 온 동작하고, 상기 메인 스위치는 상기 스너버 스위치의 턴 온 시점으로부터 사전에 설정된 제1 지연시간 경과 후 턴 온 되는 역률 보정 회로를 제안한다.
또한, 상기 제1 시간은 상기 제1 지연시간 보다 긴 역률 보정 회로를 제안한다.
또한, 상기 스너버 스위치는 사전에 설정된 제1 시간 동안 온 동작하고, 상기 보조 스위치는 상기 스너버 스위치의 턴 온 시점에서부터 사전에 설정된 제2 지연시간 경과 후 턴 온 되어 사전에 설정된 제2 시간 동안 온 동작하는 역률 보정 회로를 제안한다.
또한, 상기 제2 시간 및 상기 제2 지연시간의 합은 상기 제1 시간 보다 긴 역률 보정회로를 제안한다.
또한, 상기 메인 스위치의 역전류를 방지하는 역전류 방지 다이오드를 더 포함하는 역률 보정 회로를 제안한다.
또한, 상기 메인 스위치의 스위칭 동작에 따라 상기 메인 인덕터로부터 방출되는 전원의 전달 경로를 제공하는 다이오드; 를 더 포함하는 역률 보정 회로를 제안한다.
또한, 상기 다이오드로부터 전달되는 전원을 안정화시키는 캐패시터; 를 더 포함하는 역률 보정 회로를 제안한다.
또한, 상기 메인 스위치, 상기 스너버 스위치 및 상기 보조 스위치의 스위칭 동작을 제어하는 스위칭 제어 신호를 제공하는 제어부; 를 더 포함하는 역률 보정 회로를 제안한다.
또한, 상기 입력 전원은 정류된 전원인 역률 보정 회로를 제안한다.
또한, 상기 메인 스위치, 상기 스너버 스위치 및 상기 보조 스위치는 트랜지스터, IGBT(Insulated gate bipolar transistor) 및 MOS-FET(Metal Oxide Semiconductor Field-Effect Transistor) 중 적어도 하나를 포함하는 역률 보정 회로를 제안한다.
본 발명의 제2 기술적인 측면에 따르면, 입력 전원의 전류와 전압의 위상차를 조절하는 메인 스위치와, 상기 메인 스위치의 스위칭에 따라 에너지를 축적 또는 방출하는 메인 인덕터와, 상기 메인 스위치의 온 동작 전에 존재하는 잉여 전원의 전달 경로를 형성하는 스너버 스위치 및 상기 스너버 스위치에 인가되는 전류량을 조절하는 스너버 인덕터를 구비하는 스너버 회로부 및 상기 스너버 인덕터의 인덕턴스를 가변하여 상기 스너버 스위치에 부과되는 과도 전원을 저감하는 저감 회로부를 포함하는 역률 보정 회로; 상기 역률 보정 회로로부터의 전원을 스위칭하여 사전에 설정된 전원으로 변환하는 전원 변환부; 및 상기 전원 변환부의 전원 스위칭을 제어하는 스위칭 제어부; 를 포함하는 전원 장치를 제안한다.
또한, 상기 저감 회로부는, 상기 스너버 인덕터와 유도 결합하는 보조 인덕터; 상기 보조 인덕터에 전원을 공급하는 직류 전원; 상기 직류 전원에 의해 상기 보조 인덕터로 공급되는 전류량을 조절하는 가변 저항; 및 상기 직류 전원을 공급 또는 차단하는 보조 스위치를 포함하는 전원 장치를 제안한다.
또한, 상기 스너버 스위치는 사전에 설정된 제1 시간 동안 온 동작하고, 상기 메인 스위치는 상기 스너버 스위치의 턴 온 시점으로부터 사전에 설정된 제1 지연시간 경과 후 턴 온 되는 전원 장치를 제안한다.
또한, 상기 제1 시간은 상기 제1 지연시간 보다 긴 전원 장치를 제안한다.
또한, 상기 스너버 스위치는 사전에 설정된 제1 시간 동안 온 동작하고, 상기 보조 스위치는 상기 스너버 스위치의 턴 온 시점에서부터 사전에 설정된 제2 지연시간 경과 후 턴 온 되어 사전에 설정된 제2 시간 동안 온 동작하는 전원 장치를 제안한다.
또한, 상기 제2 시간 및 상기 제2 지연시간의 합은 상기 제1 시간 보다 긴 전원 장치를 제안한다.
또한, 상기 역률 보정 회로는, 상기 메인 스위치의 역전류를 방지하는 역전류 방지 다이오드를 더 포함하는 전원 장치를 제안한다.
또한, 상기 역률 보정 회로는, 상기 메인 스위치의 스위칭 동작에 따라 상기 메인 인덕터로부터 방출되는 전원의 전달 경로를 제공하는 다이오드; 를 더 포함하는 전원 장치를 제안한다.
또한, 상기 역률 보정 회로는, 상기 다이오드로부터 전달되는 전원을 안정화시키는 캐패시터; 를 더 포함하는 전원 장치를 제안한다.
또한, 상기 역률 보정 회로는, 상기 메인 스위치, 상기 스너버 스위치 및 상기 보조 스위치의 스위칭 동작을 제어하는 스위칭 제어 신호를 제공하는 제어부; 를 더 포함하는 전원 장치를 제안한다.
또한, 교류 전원을 정류하여 생성한 상기 입력 전원을 상기 역률 보정 회로에 전달하는 정류부; 를 더 포함하는 전원 장치를 제안한다.
또한, 상기 메인 스위치, 상기 스너버 스위치 및 상기 보조 스위치는 트랜지스터, IGBT(Insulated gate bipolar transistor) 및 MOS-FET(Metal Oxide Semiconductor Field-Effect Transistor) 중 적어도 하나를 포함하는 전원 장치를 제안한다.
본 발명에 따르면, 입력 전원을 스위칭하여 역률을 개선하는 메인 스위치에 영 전압 턴 온 조건을 제공함으로써 메인 스위치의 파손을 방지할 수 있고, 스위칭 손실을 감소할 수 있다.
또한, 메인 스위치에 영 전압 턴 온 조건을 제공하는 스너버 스위치에 연결되는 스너버 인덕터의 인덕턴스를 낮춤으로써 피크성 전압을 제거하여 스너버 스위치의 파손을 방지할 수 있다.
도 1 및 도 2는 본 발명의 역률 보정 회로의 개략적인 회로도.
도 3는 본 발명의 역률 보정 회로에 채용된 메인 스위치, 스너버 스위치 및 보조 스위치의 스위칭 제어 신호 그래프.
도 4는 본 발명의 역률 보상 회로에 채용되는 스너버 스위치의 양단에서 발생하는 전압을 나타낸 그래프.
도 5은 본 발명의 역률 보정 회로를 포함하는 전원 장치의 개략적인 구성도.
후술하는 본 발명에 대한 상세한 설명은, 본 발명이 실시될 수 있는 특정 실시예를 예시로서 도시하는 첨부 도면을 참조한다. 이들 실시예는 당업자가 본 발명을 실시할 수 있기에 충분하도록 상세히 설명된다. 본 발명의 다양한 실시예는 서로 다르지만 상호 배타적일 필요는 없음이 이해되어야 한다. 예를 들어, 여기에 기재되어 있는 특정 형상, 구조 및 특성은 일 실시예에 관련하여 본 발명의 정신 및 범위를 벗어나지 않으면서 다른 실시예로 구현될 수 있다. 또한, 각각의 개시된 실시예 내의 개별 구성요소의 위치 또는 배치는 본 발명의 정신 및 범위를 벗어나지 않으면서 변경될 수 있음이 이해되어야 한다. 따라서, 후술하는 상세한 설명은 한정적인 의미로서 취하려는 것이 아니며, 본 발명의 범위는, 적절하게 설명된다면, 그 청구항들이 주장하는 것과 균등한 모든 범위와 더불어 첨부된 청구항에 의해서만 한정된다. 도면에서 유사한 참조부호는 여러 측면에 걸쳐서 동일하거나 유사한 기능을 지칭한다.
도 1 및 도 2는 본 발명의 역률 보정 회로(100)의 개략적인 회로도이다.
도 1을 참조하면, 본 발명의 역률 보정 회로(100)는 메인 인덕터(L), 메인 스위치(S), 스너버 회로부(110) 및 저감 회로부(120)를 포함할 수 있으며, 다이오드(D), 캐패시터(C), 역전류 방지 다이오드(DR) 및 제어부(130)를 더 포함할 수 있다.
메인 스위치(S)는 스위칭 동작함으로써, 입력단(IN)으로부터 입력되는 입력 전원의 전압과 전류의 위상차를 조절할 수 있다. 이 때, 입력 전원은 정류된 전원일 수 있다.
역전류 방지 다이오드(DR)은 메인 스위치(S)에 역전류가 인가되는 경우, 역전류 방지 다이오드(DR)의 애노드에서 캐소드로 바이패스 경로를 제공함으로써, 메인 스위치(S)의 역전류를 방지할 수 있다. 역전류 방지 다이오드(DR)은 메인 스위치(S)가 트랜지스터로 구성되는 경우에 바디에 형성되는 다이오드일 수 있으나 이에 한정되는 것은 아니고 별도로 부가된 다이오드일 수 있다.
인덕터(L)는 입력 전원이 인가되는 입력단(IN)과 메인 스위치(S)의 사이에 배치되어, 상기 메인 스위치(S)의 스위칭에 따라 에너지를 축적 또는 방출할 수 있으며, 다이오드(D)는 메인 스위치(S)의 스위칭 동작에 따라 인덕터(L)로부터 방출되는 전원의 전달 경로를 제공할 수 있다. 또한, 캐패시터(C)는 출력단(OUT)에 병렬 연결되어 다이오드(D)로부터 출력되는 전원을 안정화할 수 있다.
스너버 회로부(110)는 메인 스위치와 병렬로 연결되는 스너버 스위치(Sn) 및 스너버 스위치와 메인 스위치 사이에 마련되어 스너버 스위치에 흐르는 전류량을 조절하는 스너버 인덕터(Ln)를 포함할 수 있다.
저감 회로부(120)는 스너버 인덕터(Ln)와 유도 결합하는 보조 인덕터(La), 보조 인덕터에 전원을 공급하는 직류 전원(Va), 직류 전원(Va)에 의해 보조 인덕터(La)로 공급되는 전류량 조절하는 가변저항(Ra) 및 직류 전원(Va)을 공급 또는 차단하는 보조 스위치(Sa)를 포함할 수 있다.
제어부(130)는 메인 스위치(S), 스너버 스위치(Sn) 및 보조 스위치(Sa)의 스위칭 동작을 제어하는 스위칭 제어신호(G, Gn, Ga)를 생성할 수 있다.
본 발명의 메인 스위치(S), 스너버 스위치(Sn), 및 보조 스위치(Sa)는 IGBT(Insulated gate bipolar transistor), MOS-FET(metal oxide semiconductor field-effect transistor), 및 BJT(bipolar junction transistor) 중 하나로 구성될 수 있다. 도 2를 참조하면, 메인 스위치(S), 스너버 스위치(Sn) 및 보조 스위치(Sa)가 BJT로 구성된 예를 도시하였으나, 본 발명이 이에 한정되는 것은 아니다.
도 3는 본 발명의 역률 보정 회로(100)에 채용된 메인 스위치(S), 스너버 스위치(Sn) 및 보조 스위치(Sa)의 스위칭 제어 신호 그래프이다. 스위칭 제어신호(G, Gn, Ga)이 하이 레벨일 경우, 메인 스위치(S), 스너버 스위치(Sn) 및 보조 스위치(Sa)는 온 동작하고, 스위칭 제어 신호(G, Gn, Ga)이 로우 레벨일 경우, 메인 스위치(S), 스너버 스위치(Sn) 및 보조 스위치(Sa)는 오프 동작한다.
본 발명의 역률 보정 회로(100)의 메인 스위치(S)는 스위칭 동작하여 입력 전원의 전압과 전류간의 위상차를 조정함으로써 입력 전원의 역률을 개선하는데, 이 때, 스너버 스위치(Sn)는 메인 스위치(S)의 스위칭 온 및 오프시에 남은 잉여 전원을 접지로 바이패스함으로써, 메인 스위치(S)에 영전압 스위칭 조건을 제공할 수 있다. 이로써, 메인 스위치(S)의 스위칭 손실이 제거될 수 있다.
도 3에 도시되어 있듯이, 스너버 스위치(Sn)은 메인 스위치(S)가 턴 온되기 전에 제1 지연시간(TD1)만큼 더 빨리 턴 온 되어 잉여 전원의 전달 경로 형성하게 된다. 이 때, 스너버 스위치(Sn)은 제1 시간(T1) 동안 온 동작할 수 있다. 이 경우, 제1 시간(T1)은 제1 지연 시간(TD1) 보다 길게 설정됨으로써, 스너버 스위치(Sn)는 메인 스위치(S)가 턴 오프 되기 전에 턴 오프될 수 있다.
한편, 스너버 스위치(Sn)의 턴 온 시, 스너버 스위치(Sn)에 높은 전류가 급격히 인가되는 것을 방지하기 위하여, 스너버 스위치(Sn)와 메인 스위치(S) 사이에 스너버 인덕터(Ln)가 마련되는데, 스너버 스위치(Sn)의 턴 오프시, 스너버 인덕터(Ln)에 흐르던 전류가 도통될 패스가 없으므로 스너버 스위치(Sn)의 양 단에는 피크성 전압이 발생되어 스너버 스위치(Sn)의 파손 및 스위칭 손실이 발생할 수 있다.
도 4는 본 발명의 역률 보상 회로에 채용되는 스너버 스위치(Sn)의 양단에서 발생하는 전압을 나타낸 그래프이다. 도 4(a)는 스너버 스위치(Sn)의 턴 오프시 스너버 인덕터(Ln)에 흐르던 전류가 도통될 패스가 없는 경우 스너버 스위치(Sn)의 양단에서 발생하는 전압을 나타낸 그래프이다.
t1 시점 이전에 스너버 스위치(Sn)는 오프 동작을 유지하여 양단의 전압은 높게 형성된다. 이후, t1 시점에서 스너버 스위치(Sn)는 턴 온 되어 양단의 전압은 낮게 형성되게 된다. 다만, t2 시점에서 스너버 스위치(Sn)가 턴 오프되는 경우 스너버 인덕터(Ln)에 흐르던 전류가 도통될 패스가 없으므로 높은 피크성 전압이 발생되게 된다.
이러한 피크성 전압을 저감하기 위하여, 도 1을 참조하면, 본 발명의 역률 보상 회로는 저감 회로부(120)를 채용할 수 있다. 저감 회로부는 스너버 인덕터의 인덕턴스를 가변하여 스너버 스위치에 부과하는 과도 전원, 즉 피크성 전압을 제거할 수 있다.
전술한 바와 같이, 도 1을 참조하면, 저감 회로부(120)는 스너버 인덕터(Ln)와 유도 결합하는 보조 인덕터(La), 보조 인덕터에 전원을 공급하는 직류 전원(Va), 직류 전원(Va)에 의해 보조 인덕터(La)로 공급되는 전류량 조절하는 가변저항(Ra) 및 직류 전원(Va)을 공급 또는 차단하는 보조 스위치(Sa)를 포함할 수 있다.
다시 도 3을 참조하면, 보조 스위치(Sa)는 스너버 스위치(Sn)의 턴 온 시점에서부터 사전에 설정된 제2 지연 시간(TD2) 경과 후 턴 온 되어 사전에 설정된 제2 시간(T2) 동안 온 동작할 수 있다. 이 때, 제2 시간(T2) 및 제2 지연시간(TD2)의 합은 제1 시간(T1)보다 길게 설정되어, 보조 스위치(Sa)는 스너버 스위치(Sn)이 턴 오프된 후에, 턴 오프될 수 있다. 또한, 제2 지연시간(TD2)은 전술한 제1 지연시간(TD1) 보다 길게 설정될 수 있다.
보조 스위치(Sa)가 오프 동작하는 경우에는, 저감 회로부(120)는 전기적으로 오프된 상태이므로, 저감 회로부(120)는 스너버 회로부(110)에 영향을 미치지 않게 되어, 스너버 인덕터(Ln)은 정상적인 인덕턴스를 유지할 수 있게 된다. 따라서, 스너버 회로부(110)는 메인 스위치(S)에 영 전압 턴 온 조건을 제공하여 메인 스위치(S)의 스위칭 손실을 제거할 수 있다.
다만, 위와 달리 보조 스위치(Sa)가 온 동작하는 경우에는 직류 전원(Va)은 스너버 인덕터(Ln)와 유도 결합된 보조 인덕터(La)에 전원을 공급하게 되어, 스너버 인덕터(Ln)의 인덕턴스에 영향을 주게 된다. 즉, 직류 전원(Va)에 의해 생성되는 직류 전류를 공급받는 보조 인덕터(La)는 스너버 인덕터(Ln)에 구비되는 코어의 자속을 포화시켜 스너버 인덕터(Ln)의 인덕턴스를 낮출 수 있으며, 이상적으로는 스너버 인덕턴스(Sa)의 값을 0까지 낮출 수 있다. 이로써, 저감 회로부(120)는 스너버 인덕터(Ln)의 인덕턴스를 낮출 수 있고, 스너버 인덕터(Ln)의 인덕턴스를 낮아지게 되어 스너버 스위치(Sn)는 턴 오프시 스너버 스위치(Sn)의 양단에 발생하는 피크성 전압은 제거될 수 있다.
보조 저항(Ra)은 설정에 의해 가변될 수 있는데, 보조 저항(Ra)의 레지스턴스를 가변함으로써 직류 전원(Va)에 의해 보조 인덕터(La)에 공급되는 전류량이 결정되고, 이는 스너버 인덕터(Ln)에 구비되는 코어의 포화 자속을 결정하는데 영향을 미칠 수 있다.
종합하면, 본 발명의 역률 보정 회로는 메인 스위치(S)의 턴 온 및 스너버 스위치(Sn)의 턴 오프시 발생하는 스위칭 손실을 제거함으로써 역률 효율 및 EMI 노이즈 레벨을 크게 개선할 수 있다.
도 4(b)는 본 발명의 역률 보상 회로가 저감 회로부(120)를 이용하여 스너버 스위치(Sn)의 턴 오프시, 스너버 스위치(Sn)의 양단에서 발생하는 피크성 전압을 제거한 그래프를 나타낸 도이다. 도 4(a)와 도 4(b)를 비교하면, t2시점에서 피크성 전압이 저감된 것을 알 수 있다.
도 5은 본 발명의 역률 보정 회로(100)를 포함하는 전원 장치의 개략적인 구성도이다.
도 5을 참조하면, 전원 장치는 역률 보정 회로(100), 전원 변환부(200), 스위칭 제어부(300) 및 정류부(400)를 포함할 수 있다.
도 5의 역률 보정 회로(100)는 도 1에서 도시된 역률 보정 회로(100)와 동일하므로 자세한 설명은 생략하도록 한다.
전원 변환부(200)는 역률 보정회로부터의 직류 전원을 스위칭하여 사전에 설정된 전압 레벨을 갖는 직류 전원으로 변환하여 부하에 공급할 수 있으며, 스위칭 제어부(300)는 출력되는 직류 전원의 전압 또는 전류 레벨에 따라 전원 변환부(200)의 스위칭을 제어할 수 있으며, 정류부(400)는 교류 전원(AC)을 정류하여 생성한 입력 전원을 상기 역률 보정 회로(100)에 전달할 수 있다.
이상에서 본 발명이 구체적인 구성요소 등과 같은 특정 사항들과 한정된 실시예 및 도면에 의해 설명되었으나, 이는 본 발명의 보다 전반적인 이해를 돕기 위해서 제공된 것일 뿐, 본 발명이 상기 실시예들에 한정되는 것은 아니며, 본 발명이 속하는 기술분야에서 통상적인 지식을 가진 자라면 이러한 기재로부터 다양한 수정 및 변형을 꾀할 수 있다.
따라서, 본 발명의 사상은 상기 설명된 실시예에 국한되어 정해져서는 아니 되며, 후술하는 특허청구범위뿐만 아니라 이 특허청구범위와 균등하게 또는 등가적으로 변형된 모든 것들은 본 발명의 사상의 범주에 속한다고 할 것이다.
100: 역률 보정 회로
110: 스너버 회로부
120: 저감 회로부
130: 제어부
200: 전원 변환부
300: 스위칭 제어부
400: 정류부

Claims (24)

  1. 입력 전원의 전류와 전압의 위상차를 조절하는 메인 스위치;
    상기 메인 스위치의 스위칭에 따라 에너지를 축적 또는 방출하는 메인 인덕터;
    상기 메인 스위치의 온 동작 전에 존재하는 잉여 전원의 전달 경로를 형성하는 스너버 스위치 및 상기 스너버 스위치에 인가되는 전류량을 조절하는 스너버 인덕터를 구비하는 스너버 회로부; 및
    상기 스너버 인덕터의 인덕턴스를 가변하여 상기 스너버 스위치에 부과되는 과도 전원을 저감하는 저감 회로부; 를 포함하는 역률 보정 회로.
  2. 제1항에 있어서, 상기 저감 회로부는,
    상기 스너버 인덕터와 유도 결합하는 보조 인덕터;
    상기 보조 인덕터에 전원을 공급하는 직류 전원;
    상기 직류 전원에 의해 상기 보조 인덕터로 공급되는 전류량을 조절하는 가변 저항; 및
    상기 직류 전원을 공급 또는 차단하는 보조 스위치; 를 포함하는 역률 보정 회로.
  3. 제2항에 있어서,
    상기 스너버 스위치는 사전에 설정된 제1 시간 동안 온 동작하고, 상기 메인 스위치는 상기 스너버 스위치의 턴 온 시점으로부터 사전에 설정된 제1 지연시간 경과 후 턴 온 되는 역률 보정 회로.
  4. 제3항에 있어서,
    상기 제1 시간은 상기 제1 지연시간 보다 긴 역률 보정 회로.
  5. 제2항에 있어서,
    상기 스너버 스위치는 사전에 설정된 제1 시간 동안 온 동작하고, 상기 보조 스위치는 상기 스너버 스위치의 턴 온 시점에서부터 사전에 설정된 제2 지연시간 경과 후 턴 온 되어 사전에 설정된 제2 시간 동안 온 동작하는 역률 보정 회로.
  6. 제5항에 있어서,
    상기 제2 시간 및 상기 제2 지연시간의 합은 상기 제1 시간 보다 긴 역률 보정회로.
  7. 제1항에 있어서,
    상기 메인 스위치의 역전류를 방지하는 역전류 방지 다이오드를 더 포함하는 역률 보정 회로.
  8. 제1항에 있어서,
    상기 메인 스위치의 스위칭 동작에 따라 상기 메인 인덕터로부터 방출되는 전원의 전달 경로를 제공하는 다이오드; 를 더 포함하는 역률 보정 회로.
  9. 제8항에 있어서,
    상기 다이오드로부터 전달되는 전원을 안정화시키는 캐패시터; 를 더 포함하는 역률 보정 회로.
  10. 제2항에 있어서,
    상기 메인 스위치, 상기 스너버 스위치 및 상기 보조 스위치의 스위칭 동작을 제어하는 스위칭 제어 신호를 제공하는 제어부; 를 더 포함하는 역률 보정 회로.
  11. 제1 항에 있어서,
    상기 입력 전원은 정류된 전원인 역률 보정 회로.
  12. 제2 항에 있어서,
    상기 메인 스위치, 상기 스너버 스위치 및 상기 보조 스위치는 트랜지스터, IGBT(Insulated gate bipolar transistor) 및 MOS-FET(Metal Oxide Semiconductor Field-Effect Transistor) 중 적어도 하나를 포함하는 역률 보정 회로.
  13. 입력 전원의 전류와 전압의 위상차를 조절하는 메인 스위치와, 상기 메인 스위치의 스위칭에 따라 에너지를 축적 또는 방출하는 메인 인덕터와, 상기 메인 스위치의 온 동작 전에 존재하는 잉여 전원의 전달 경로를 형성하는 스너버 스위치 및 상기 스너버 스위치에 인가되는 전류량을 조절하는 스너버 인덕터를 구비하는 스너버 회로부 및 상기 스너버 인덕터의 인덕턴스를 가변하여 상기 스너버 스위치에 부과되는 과도 전원을 저감하는 저감 회로부를 포함하는 역률 보정 회로;
    상기 역률 보정 회로로부터의 전원을 스위칭하여 사전에 설정된 전원으로 변환하는 전원 변환부; 및
    상기 전원 변환부의 전원 스위칭을 제어하는 스위칭 제어부; 를 포함하는 전원 장치.
  14. 제13항에 있어서, 상기 저감 회로부는,
    상기 스너버 인덕터와 유도 결합하는 보조 인덕터;
    상기 보조 인덕터에 전원을 공급하는 직류 전원;
    상기 직류 전원에 의해 상기 보조 인덕터로 공급되는 전류량을 조절하는 가변 저항; 및
    상기 직류 전원을 공급 또는 차단하는 보조 스위치; 를 포함하는 전원 장치.
  15. 제14항에 있어서,
    상기 스너버 스위치는 사전에 설정된 제1 시간 동안 온 동작하고, 상기 메인 스위치는 상기 스너버 스위치의 턴 온 시점으로부터 사전에 설정된 제1 지연시간 경과 후 턴 온 되는 전원 장치.
  16. 제15항에 있어서,
    상기 제1 시간은 상기 제1 지연시간 보다 긴 전원 장치.
  17. 제14항에 있어서,
    상기 스너버 스위치는 사전에 설정된 제1 시간 동안 온 동작하고, 상기 보조 스위치는 상기 스너버 스위치의 턴 온 시점에서부터 사전에 설정된 제2 지연시간 경과 후 턴 온 되어 사전에 설정된 제2 시간 동안 온 동작하는 전원 장치.
  18. 제17항에 있어서,
    상기 제2 시간 및 상기 제2 지연시간의 합은 상기 제1 시간 보다 긴 전원 장치.
  19. 제13항에 있어서, 상기 역률 보정 회로는,
    상기 메인 스위치의 역전류를 방지하는 역전류 방지 다이오드를 더 포함하는 전원 장치.
  20. 제13항에 있어서, 상기 역률 보정 회로는,
    상기 메인 스위치의 스위칭 동작에 따라 상기 메인 인덕터로부터 방출되는 전원의 전달 경로를 제공하는 다이오드; 를 더 포함하는 전원 장치.
  21. 제20항에 있어서, 상기 역률 보정 회로는,
    상기 다이오드로부터 전달되는 전원을 안정화시키는 캐패시터; 를 더 포함하는 전원 장치.
  22. 제14항에 있어서, 상기 역률 보정 회로는,
    상기 메인 스위치, 상기 스너버 스위치 및 상기 보조 스위치의 스위칭 동작을 제어하는 스위칭 제어 신호를 제공하는 제어부; 를 더 포함하는 전원 장치.
  23. 제13항에 있어서,
    교류 전원을 정류하여 생성한 상기 입력 전원을 상기 역률 보정 회로에 전달하는 정류부; 를 더 포함하는 전원 장치.
  24. 제14항에 있어서,
    상기 메인 스위치, 상기 스너버 스위치 및 상기 보조 스위치는 트랜지스터, IGBT(Insulated gate bipolar transistor) 및 MOS-FET(Metal Oxide Semiconductor Field-Effect Transistor) 중 적어도 하나를 포함하는 전원 장치.
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