KR101308295B1 - 표시장치 및 그 구동방법 - Google Patents
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Abstract
Description
도 1은 본 발명의 일 실시예에 따른 타일드 방식의 액정표시장치를 도시한 사시도.
도 2는 도 1의 타일드 방식의 액정표시장치를 개략적으로 도시한 블럭도.
도 3은 도 2의 영상출력 시스템을 도시한 블럭도.
도 4는 본 발명의 다른 실시예에 따른 영상출력 시스템을 도시한 블럭도.
<주요부분에 대한 부호의 설명>
300 : 영상출력 시스템 310 : 멀티플렉서
330 : 스위칭 제어부 350 : 메모리부
350a : 제 1 메모리 350b : 제 2 메모리
350c : 제 3 메모리 350d : 제 4 메모리
370 : 메모리 제어부 390 : 타이밍 제어신호 발생부
430 : 액정표시모듈 430a : 제 1 액정표시패널 드라이버
430b : 제 2 액정표시패널 드라이버 430c : 제 3 액정표시패널 드라이버
430d : 제 4 액정표시패널 드라이버 530 : 디코더
550 : 스위칭부
본 발명은 표시장치에 관한 것으로, 특히 타일드 방식의 표시장치에 있어서, 구동 회로를 간소화할 수 있는 표시장치 및 그 구동방법에 관한 것이다.
근래에 들어 사회가 본격적인 정보화 시대로 접어듦에 따라 전기적 정보신호를 시각적으로 표현하는 디스플레이(display) 분야가 급속도로 발전해 왔고, 박형화, 경량화, 저소비전력화의 우수한 성능을 지닌 여러 가지 다양한 평판표시장치(flat panel display device)가 개발되어 기존의 브라운관(CRT : cathode ray tube)을 빠르게 대체하고 있다.
상기 평판표시장치 중의 하나로서 박형화, 경량화, 저 소비전력을 특징으로 응용 시장을 확대해온 액정표시장치(LCD : liquid crystal display device)는 그 수요가 급속히 확대될 뿐만 아니라, 최근에는 소비자들의 생활 수준 향상으로 점점 더 큰 사이즈의 고화질 제품이 요구되고, 이에 따라 대화면 컬러 액정의 양상기술확립을 위한 설비채용이 본격화되고 있다.
대화면 액정표시장치는 그 특성상 화면 사이즈를 가져가는데 한계가 따르게 되는데, 지금까지 알려진 최대 패널사이즈는 100인치인 것으로 알려져 있다.
이에 따라, 작은 액정표시패널에 광학계를 장착하여 스크린에 큰 화상이 형성되도록 하는 이른바 투사형 TV가 등장하고 있다. 이와 같은 발전추세를 따른다 하더라도 액정표시장치의 실제 화면 사이즈를 크게 가져 가는데에는 한계가 있는바, 현재는 대화면 표시장치를 만들기 위해 여러 장의 액정표시패널을 접합한 타일 드 방식의 액정표시장치(tiled liquid crystal display device)가 실용화되고 있다.
타일드 방식의 액정표시장치는 다수의 액정표시패널이 구비됨에 따라 각각의 액정표시패널 구동부에 제어신호 및 데이터 신호를 인가하는 영상출력 시스템이 상기 액정표시패널의 수량만큼 구비된다.
종래의 타일드 방식의 액정표시장치는 다수의 액정표시모듈의 영상을 디스플레이하기 위해 상기 액정표시모듈의 수량만큼 다수의 영상출력 시스템을 구비해야 하기 때문에 구동 회로의 구성이 복잡한 문제가 있었다.
본 발명은 타일드 방식의 표시장치에 있어서, 구동 회로의 구성을 간소화 시킬 수 있는 표시장치 및 그 구동방법을 제공함에 그 목적이 있다.
상기한 목적을 달성하기 위한 본 발명의 일 실시예에 따른 표시장치는,
적어도 두개 이상의 표시패널;
상기 적어도 두개 이상의 표시모듈을 구동시키는 적어도 두개 이상의 표시패널 드라이버;
외부로부터 입력되는 영상 신호를 상기 적어도 두개 이상의 표시패널 드라이버에 입력되도록 분리하는 분리부; 및
상기 적어도 두개 이상의 표시패널 드라이버에 공통적으로 공급되는 타이밍 제어신호를 생성하는 타이밍 제어신호 발생부를 포함하여 이루어진다.
또한, 표시장치의 구동방법은,
외부로부터 데이터 신호가 입력되는 단계;
외부로부터 입력된 데이터 신호를 분배하여 복수의 메모리에 저장하는 단계;
상기 복수의 메모리에 저장된 상기 데이터 신호들을 해당하는 복수의 표시패널 드라이버에 전송하는 단계; 및
복수의 표시패널의 해상도에 맞도록 제어신호를 생성하여 상기 복수의 표시패널 드라이버에 전송하는 단계를 포함하여 이루어진다.
이하, 첨부한 도면을 참조하여 본 발명을 상세히 설명하도록 한다.
도 1은 본 발명의 일 실시예에 따른 타일드 방식의 액정표시장치를 도시한 사시도이고, 도 2는 도 1의 타일드 방식의 액정표시장치를 개략적으로 도시한 블럭도이다.
도 1에 도시된 바와 같이, 본 발명의 일 실시예에 따른 타일드 방식의 액정표시장치는 복수의 액정표시모듈들(130a 내지 130d)과, 상기 액정표시모듈들(130a 내지 130d)은 프레임(120)에 고정되어 설치된다.
각각의 액정표시모듈들(130a 내지 130b)은 백라이트 유닛, 기판, 액정층, 편광부재들이 부착되어져 하나의 단위체를 형성한다. 그리고, 상기 프레임(120)은 외벽을 형성하는 외벽프레임(120a)과, 액정표시모듈들(130a 내지 130b) 사이에 개재 되는 격벽프레임(120b)과 외벽 프레임(120a)에 의해 구획된 공간(120c)에 안착된다.
도 2에 도시된 바와 같이, 본 발명의 타일드 방식의 액정표시장치를 설명하면, 타일드 방식의 액정표시장치는 제어신호 및 데이터 신호를 생성하는 영상출력 시스템(300)과, 상기 영상출력 시스템(300)으로부터 입력된 제어신호 및 데이터 신호를 이용하여 영상을 디스플레이하는 복수의 액정표시모듈(130a 내지 130d)을 포함한다.
복수의 액정표시모듈(130a 내지 130b)들의 상세한 구성요소는 모두 동일함으로 제 1 액정표시모듈(130a)을 일 예로 설명하도록 한다.
제 1 액정표시모듈(130a)은 영상이 디스플레이되는 액정표시패널(250)과, 상기 액정표시패널(250)을 구동시키는 게이트 드라이버(220) 및 데이터 드라이버(230)를 포함한다.
액정표시패널(250)의 배면에는 광을 제공하는 백라이트 유닛(260)이 구비된다.
액정표시패널(250)은 다수의 게이트 라인(GL1, GL2, ..., GLn)과 다수의 데이터 라인(DL1, DL2, ..., DLm)이 배열되고, 이들 간의 교차부들 각각에는 스위칭 소자로서 박막 트랜지스터(TFT)가 형성된다. 상기 박막 트랜지스터(TFT)의 게이트 전극은 상기 게이트 라인(GL1, GL2, ..., GLn)과 전기적으로 연결되고, 상기 박막 트랜지스터(TFT)의 소스 전극은 상기 데이터 라인(DL1, DL2, ..., DLm)과 전기적으로 연결된다. 상기 박막 트랜지스터(TFT)의 드레인 전극은 화소전극(미도시)과 전 기적으로 연결된다.
박막 트랜지스터(TFT)는 게이트 라인(GL1, GL2, ..., GLn)으로 스캔 신호 즉, 게이트 하이 전압(VGH) 또는 게이트 로우 전압(VGL)이 공급되어 턴-온 또는 턴-오프 된다.
박막 트랜지스터(TFT)가 턴-온 되면, 이와 대응되는 데이터 라인(DL1, DL2, ..., DLm)으로 데이터 전압이 상기 박막 트랜지스터(TFT)의 소스 및 드레인 전극을 경유하여 화소전극에 공급된다. 상기 데이터 전압은 다음 프레임에서 게이트 하이 전압(VGH)이 공급되기 전까지 화소 전극에 유지된다.
게이트 드라이버(220)는 영상출력 시스템(300)으로부터 공급된 게이트 제어신호에 따라 게이트 하이 전압(VGH) 또는 게이트 로우 전압(VGL)을 순차적으로 게이트 라인(GL1, GL2, ..., GLn)에 공급한다.
데이터 드라이버(230)는 영상출력 시스템(300)으로부터 공급된 데이터 제어신호에 따라 데이터 전압을 데이터 라인(DL1, DL2, ..., DLm)으로 공급한다. 또한, 데이터 드라이버(230)는 영상제어 시스템(300)으로부터 공급된 적색(R), 녹색(G) 및 청색(B)의 데이터를 아날로그 데이터 전압으로 변환한다.
영상출력 시스템(300)은 수직/수평 동기신호(Vsync, Hsync)와 데이터 이네이블 신호(DE) 및 데이터 클럭신호(Dclk) 등을 이용하여 게이트 드라이버(220)를 제어하는 게이트 제어신호(GCS) 및 데이터 드라이버(230)를 제어하는 데이터 제어신호(DCS)를 생성한다.
또한, 상기 영상출력 시스템(300)은 외부로부터 공급된 적색(R), 녹색(G) 및 청색(B)의 데이터를 해당하는 복수의 액정표시모듈(130a 내지 130d)의 데이터 드라이버(230)에 공급한다.
영상출력 시스템(300)은 복수의 액정표시패널(250)을 구동시키는 복수의 액정표시패널 구동부에 제어신호 및 데이터 신호를 공급하는 역할을 한다. 즉, 영상출력 시스템(300)은 수직/수평 동기신호(Vsync, Hsync), 데이터 이네이블 신호(DE), 데이터 클럭신호(Dclk) 및 데이터 신호(R,G,B)를 복수의 구동 드라이버에 공급한다. 상기 구동 드라이버는 도면에 도시된 게이트 드라이버(220) 및 데이터 드라이버(230)이다.
영상출력 시스템(300)은 외부에서 입력된 데이터 신호(R,G,B)를 복수의 메모리에 분배하고, 상기 복수의 메모리에 저장된 데이터 신호(R,G,B)를 해당하는 액정표시모듈(130a 내지 130d)의 데이터 드라이버(230)에 공급한다. 또한, 영상출력 시스템(300)은 외부로부터 입력되는 수직/수평 동기신호(Vsync, Hsync), 데이터 이네이블 신호(DE) 및 데이터 클럭신호(Dclk)를 이용하여 복수의 액정표시모듈(130a 내지 130b)에 공통으로 입력되는 제어신호를 생성하고, 상기 데이터 신호(R,G,B)가 입력될 때 함께 공급된다.
본 발명은 타일드 방식의 액정표시장치로서 영상출력 시스템(300)로부터 복수의 액정표시모듈(130a 내지 130d)의 게이트 드라이버(220) 및 데이터 드라이버(230)를 각각 제어하는 제어신호가 공급되는 것으로 한정하여 설명하고 있지만, 이에 한정하지 않고, 게이트 드라이버(220) 및 데이터 드라이버(230)를 제어하기 위한 제어신호를 생성하는 별도의 타이밍 컨트롤러(미도시)를 각각 포함할 수도 있 다.
또한, 본 발명은 타일드 방식의 액정표시장치를 일 실시예로 한정하여 설명하고 있지만, 이에 한정하지 않고, 타일드 방식의 전계방출 표시패널(FED : feild emission display), 타일드 방식의 플라즈마 표시패널(PDP : plasma display panel), 타일드 방식의 일렉트로루미네센스 표시패널(EL : electroluminescence display panel)등이 사용될 수 있다.
이상에서 설명한 본 발명의 일 실시예에 따른 타일드 방식의 액정표시장치는 하나의 영상출력 시스템(300)으로 복수의 액정표시모듈(130a 내지 130d)을 디스플레이할 수 있는 구조로써, 구동 회로의 구조를 간소화할 수 있다. 또한, 본 발명은 간소화된 구조로써, 비용을 절감할 수 있다.
도 3은 도 2의 영상출력 시스템을 도시한 블럭도이다.
도 3에 도시된 바와 같이, 본 발명의 영상출력 시스템(도2의 300)은 외부로부터 입력된 데이터 신호를 일정한 시간 간격을 두고 다수의 출력라인으로 출력되도록 스위칭하는 멀티플렉서(MUX, 310)와, 상기 멀티플렉서(310)로부터 출력되는 데이터 신호들이 저장되는 메모리부(350)를 포함한다.
영상출력 시스템(도2의 300)은 상기 멀티플렉서(310)를 제어하는 스위칭 제어부(330)와, 상기 메모리부(350)를 제어하는 메모리 제어부(370) 및 제 1 내지 제 4 액정표시패널 드라이버(430a 내지 430d)에 공통적으로 입력되는 타이밍 제어신호를 생성하는 타이밍 제어신호 발생부(390)를 포함한다.
스위칭 제어부(330)는 외부로부터 입력되는 수직/수평 동기신호(Vsync, Hsync), 데이터 이네이블 신호(DE) 및 데이터 클럭신호(Dclk)를 이용하여 상기 멀티플렉서(310)를 제어한다.
상기 스위칭 제어부(330) 및 멀티플렉서(310)를 데이터 분리부라고 정의하여 설명하면, 상기 데이터 분리부는 수직/수평 동기신호(Vsync, Hsync) 및 데이터 이네이블 신호(DE)를 이용하여 상부 패널들과 하부 패널들에 입력되어야 할 데이터 신호(R,G,B)를 분리한다. 즉, 데이터 분리부는 복수의 액정표시모듈(430)이 도 1에 도시된 바와 같이 순서대로 구비된 경우, 제 1 및 제 2 액정표시패널 드라이버(430a, 430b)와, 제 3 및 제 4 액정표시패널 드라이버(430c, 430d)에 입력되는 데이터 신호(R,G,B)를 분리할 수 있다.
데이터 분리부는 수평 동기신호(Hsync), 데이터 이네이블 신호(DE) 및 데이터 클럭신호(Dclk)를 이용하여 제 1 및 제 3 액정표시패널 드라이버(430a, 430c)와, 제 2 및 제 4 액정표시패널 드라이버(430b, 430d)에 입력되는 데이터 신호(R,G,B)를 분리할 수 있다.
데이터 분리부로부터 분리된 데이터 신호(R,G,B)는 메모리부(350)의 해당하는 제 1 내지 제 4 메모리(350a 내지 350d)에 입력된다. 상기 메모리부(350)는 EEPROM(electrically erasable programmable read only memory)으로 이루어진다.
메모리부(350)는 2 프레임의 데이터 신호를 저장할 수 있고, 기록(Writind) 및 읽기(Reading) 동작을 수행할 수 있는 듀얼 포트 메모리(dual port memory)로 이루어진다.
제 1 내지 제 4 메모리(350a 내지 350d)는 타일드 방식의 액정표시장치에 있 어서, 상기 복수의 액정표시모듈(430)에 포함된 액정표시패널들의 영상 데이터를 각각 저장하고 있다.
메모리 제어부(370)는 상기 메모리부(350)에 저장된 데이터 신호의 읽기(reading) 및 기록(writing) 동작을 수행할 수 있도록 제어한다.
메모리 제어부(370)가 기록(writing) 동작을 수행하는 경우, 상기 메모리 제어부(370)는 외부로부터 입력되는 데이터 신호를 데이터 클럭신호(Dclk)의 주기로 진행된다. 즉, 메모리 제어부(370)의 기록(writing) 동작은 해당하는 복수의 액정표시모듈(430)의 액정표시패널들 각각 화소별로 기록된다.
메모리 제어부(370)가 읽기(reading) 동작을 수행하는 경우, 상기 메모리 제어부(370)는 라인별 판독 후 라인 분의 화소 데이터가 입력된 데이터 클럭의 1/2에 해당하는 주파수(2배의 주기)로 출력되게 제어한다. 상기 데이터 클럭의 1/2에 해당하는 주파수는 타이밍 제어신호 발생부(390)로부터 생성된 변조 데이터 클럭신호(MDclk)를 이용한다.
여기서, 제 1 내지 제 4 메모리(350a 내지 350d)에 저장된 데이터 신호(R,G,B)의 판독(read-out)은 동시에 진행된다. 즉, 메모리 제어부(370)는 스위칭 제어부(330)에서 출력되는 스위칭 제어신호를 이용하여 복수의 액정표시모듈(340) 각각의 1 라인분의 데이터 신호(R,G,B)들을 판독하여 제 1 내지 제 4 액정표시패널 드라이버(430a 내지 430d)로 동시에 출력한다.
제 1 내지 제 4 메모리(350a 내지 350d)에 저장된 데이터 신호(R,G,B)는 상기 메모리 제어부(370)에 의해 해당하는 제 1 내지 제 4 액정표시패널 드라이 버(430a 내지 430d)에 입력된다. 보다 상세히 설명하면, 제 1 내지 제 4 매모리(350a 내지 350d)에 저장된 데이터 신호(R,G,B)는 제 1 내지 제 4 액정표시패널 드라이버(430a 내지 430d)에 포함된 데이터 드라이버(도2의 230)에 각각 입력된다.
타이밍 제어신호 발생부(390)는 외부로부터 입력된 수직/수평 동기신호(Vsync, Hsync), 데이터 이네이블 신호(DE) 및 데이터 클럭신호(Dclk)를 이용하여 복수의 액정표시모듈(430)의 해상도에 맞도록 변조된 각종 제어신호(MVsync, MHsync, MDE, MDclk)를 생성한다.
타이밍 제어신호 발생부(390)는 변조된 각종 제어신호(MVsync, MHsync, MDE, MDclk)를 이용하여 제 1 내지 제 4 액정표시패널 드라이버(430a 내지 430d)에 입력되는 게이트 제어신호들(GCS : GSP, GSC, GOE 등) 및 데이터 제어신호들(DCS : SSP, SSC, SOE, POL, REV 등) 생성한다.
타이밍 제어신호 발생부(390)는 생성된 게이트 제어신호들(GCS : GSP, GSC, GOE 등) 및 데이터 제어신호들(DCS : SSP, SSC, SOE, POL, REV 등)을 제 1 내지 제 4 액정표시패널 드라이버(430a 내지 430d)로 출력한다.
타이밍 제어신호 발생부(390)에서 출력된 제어신호 중 변조 데이터 클럭신호(MDclk)는 메모리 제어부(370)의 읽기(reading) 동작을 수행하기 위해 상기 메모리 제어부(370)로 입력된다.
복수의 액정표시모듈(430)의 해상도에 맞도록 생성된 변조 제어신호들(GCS, DCS)은 상기 제 1 내지 제 4 메모리(350a 내지 350d)에 저장된 데이터 신호(R,G,B)들이 제 1 내지 제 4 액정표시패널 드라이버(430a 내지 430d)에 입력될 때, 동시에 입력된다.
이상에서 설명한 본 발명의 일 실시예에 따른 타일드 방식의 액정표시장치의 영상출력 시스템은 외부로부터 입력된 데이터 신호(R,G,B)를 복수의 액정표시모듈(430)에 각각 입력되도록 분리하고, 분리된 데이터 신호(R,G,B)가 상기 복수의 액정표시모듈(430)로 입력될 때, 상기 복수의 액정표시모듈(430)의 해상도에 맞도록 변조된 제어신호(GCS, DCS)를 동시에 입력하는 구조로써, 액정표시모듈의 수량만큼 영상출력 시스템이 구비되었던 종래의 타일드 방식의 액정표시장치에 비해 구동 회로의 구조를 간소화할 수 있다.
또한, 하나의 영상출력 시스템으로 복수의 액정표시모듈(430)을 구동시킴으로써, 이에 따른 비용 절감의 효과가 있다.
본 발명에서는 4개의 액정표시모듈(430)을 가지는 타일드 방식의 액정표시장치를 한정하여 설명하고 있지만, 액정표시모듈(430)의 수량은 얼마든지 변경될 수 있고, 이에 따른 영상출력 시스템의 메모리부(350) 수량은 상기 액정표시모듈(430)의 수량만큼 변경될 수 있다.
본 발명의 영상출력 시스템은 타일드 방식의 액정표시장치를 일 예로 설명하고 있지만, 이에 한정하지 않고, 타일드 방식의 전계방출 표시패널(FED : feild emission display), 타일드 방식의 플라즈마 표시패널(PDP : plasma display panel), 타일드 방식의 일렉트로루미네센스 표시패널(EL : electroluminescence display panel)등이 사용될 수 있다.
도 4는 본 발명의 다른 실시예에 따른 영상출력 시스템을 도시한 블럭도이 다.
도 4에 도시된 바와 같이, 본 발명의 다른 실시예에 따른 영상출력 시스템은 도 3에 도시된 본 발명의 일 실시예에 따른 영상출력 시스템의 구성요소 중 스위칭부(550) 및 디코더(530)를 제외한 모든 구성요소는 동일함으로 동일한 부호를 병기하고 상세한 설명은 생략하기로 한다.
스위칭부(550)는 디코더(530)의 제어신호에 의해 외부로부터 입력되는 데이터 신호(R,G,B)를 제 1 내지 제 4 메모리(350a 내지 350d)에 각각 분배 저장되도록 턴-온 또는 턴-오프된다. 여기서, 상기 데이터 신호(R,G,B)는 외부로부터 입력되는 비디오 신호로써, 복수의 액정표시모듈(430) 각각에 해당하는 비디오 신호이다.
스위칭부(550)를 제어하는 디코더(530)는 외부로부터 입력되는 데이터 시분할 제어신호에 응답하여 상기 스위칭부(550)를 일정 시간(t1, t2, t3, t4) 분배되도록 스위칭부(550)를 제어한다. 이때, 상기 일정 시간(t1, t2, t3, t4)은 상기 데이터 시분할 제어신호에 의해 정해진 것으로 도시되지 않은 외부 시스템으로부터 미리 설정된다.
스위칭부(550) 및 디코더(530)를 분리부라고 정의하여 설명하면, 분리부는 외부로부터 입력되는 데이터 신호(R,G,B)를 복수의 액정표시모듈(430)과 각각 대응되도록 일정 시간(t1, t2, t3, t4) 간격으로 분리한다.
이상에서 설명한 본 발명의 다른 실시예에 따른 타일드 방식의 액정표시장치의 영상출력 시스템은 복수의 액정표시모듈(430)에 해당하는 영상 신호를 일정 시간(t1, t2, t3, t4) 간격으로 분리하여 저장 및 출력함으로써, 하나의 영상출력 시 스템으로 복수의 액정표시모듈(430)을 구동시킬 수 있다. 즉, 본 발명은 액정표시모듈의 수량만큼 영상출력 시스템이 구비되었던 종래의 타일드 방식의 액정표시장치에 비해 구동 회로의 구조를 간소화할 수 있다.
또한, 하나의 영상출력 시스템으로 복수의 액정표시모듈(430)을 구동시킴으로써, 이에 따른 비용 절감의 효과가 있다.
이상에서 살펴본 바와 같이, 본 발명은 타일드 방식의 표시장치에 있어서, 외부로부터 1 프레임을 기준으로 입력되는 데이터 신호를 분배하여 전송하는 하나의 영상출력 시스템으로 복수의 표시모듈을 구동시킬 수 있는 구조로써, 표시장치 구동 회로의 구조를 간소화시킬 수 있는 효과가 있다.
또한, 본 발명은 타일드 방식의 표시장치에 있어서, 하나의 영상출력 시스템으로 복수의 표시모듈을 구동시킬 수 있는 구조로써, 종래의 표시장치에 비해 제조 비용을 절감시킬 수 있는 효과가 있다.
이상 설명한 내용을 통해 통상의 지식을 가진 자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능할 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여져야만 할 것이다.
Claims (10)
- 적어도 두개 이상의 표시패널;상기 적어도 두개 이상의 표시모듈을 구동시키는 적어도 두개 이상의 표시패널 드라이버;외부로부터 입력되는 영상 신호를 상기 적어도 두개 이상의 표시패널 드라이버에 입력되도록 분리하는 분리부; 및상기 적어도 두개 이상의 표시패널 드라이버에 공통적으로 공급되는 타이밍 제어신호를 생성하는 타이밍 제어신호 발생부를 포함하고,상기 분리부는, 상기 영상 신호를 분리하기 위한 멀티플렉서(multiplexer);상기 멀티플렉서를 제어하는 스위칭 제어부; 상기 멀티플렉서로부터 분배된 영상 신호를 저장하는 복수의 메모리; 및 상기 복수의 메모리의 읽기 및 쓰기 동작을 제어하는 메모리 제어부를 포함하며,상기 복수의 메모리에 저장된 분배 영상 신호는 상기 적어도 두개 이상의 표시패널 드라이버에 각각 공급되어, 상기 표시패널들을 동시에 동작시키는 것을 특징으로 하는 표시장치.
- 삭제
- 제 1 항에 있어서,상기 스위칭 제어부는 외부로부터 입력된 수직/수평 제어신호(Vsync, Hsync)와, 데이터 이네이블 신호(DE) 및 데이터 클럭신호(Dclk)를 이용하여 상기 멀티플렉서를 제어하는 것을 특징으로 하는 표시장치.
- 제 1 항에 있어서,상기 메모리 제어부는 외부로부터 입력된 수직/수평 제어신호(Vsync, Hsync)와 데이터 이네이블 신호(DE) 및 데이터 클럭 신호(Dclk)와, 상기 타이밍 제어신호 발생부로부터 생성된 변조 데이터 클럭 신호(MDclk)와, 상기 스위칭 제어부로부터 입력되는 스위칭 제어신호를 이용하여 상기 메모리의 읽기 및 쓰기 동작을 제어하는 것을 특징으로 하는 표시장치.
- 제 1 항에 있어서,상기 복수의 메모리는 EEPROM(electrically erasable programmable read only memory)으로 이루어지는 것을 특징으로 하는 표시장치.
- 제 1 항에 있어서,상기 복수의 메모리는 각각 2 프레임 분의 데이터 용량을 가지는 듀얼 포트 메모리(dual port memory)를 포함하는 것을 특징으로 하는 표시장치.
- 제 1 항에 있어서,상기 타이밍 제어신호 발생부는 외부로부터 입력된 수직/수평 동기신호(Vsync, Hsync)와, 데이터 이네이블 신호(DE) 및 데이터 클럭 신호(Dclk)를 이용하여 상기 적어도 두개 이상의 표시패널의 해상도에 맞도록 변조된 제어신호를 생성하는 것을 특징으로 하는 표시장치.
- 제 1 항에 있어서,상기 분리부는 외부로부터 입력된 영상 신호를 상기 복수의 표시패널과 대응되도록 일정한 시간 간격을 두고 분리하는 것을 특징으로 하는 표시장치.
- 삭제
- 삭제
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