KR101058468B1 - 집적 회로용의 재구성 가능한 로직 패브릭과, 재구성 가능한 로직 패브릭을 구성하기 위한 시스템 및 방법 - Google Patents
집적 회로용의 재구성 가능한 로직 패브릭과, 재구성 가능한 로직 패브릭을 구성하기 위한 시스템 및 방법 Download PDFInfo
- Publication number
- KR101058468B1 KR101058468B1 KR1020087031271A KR20087031271A KR101058468B1 KR 101058468 B1 KR101058468 B1 KR 101058468B1 KR 1020087031271 A KR1020087031271 A KR 1020087031271A KR 20087031271 A KR20087031271 A KR 20087031271A KR 101058468 B1 KR101058468 B1 KR 101058468B1
- Authority
- KR
- South Korea
- Prior art keywords
- logic
- asynchronous
- fabric
- unit
- programmable
- Prior art date
Links
Images
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K19/00—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits
- H03K19/02—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits using specified components
- H03K19/173—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits using specified components using elementary logic circuits as components
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F30/00—Computer-aided design [CAD]
- G06F30/30—Circuit design
- G06F30/34—Circuit design for reconfigurable circuits, e.g. field programmable gate arrays [FPGA] or programmable logic devices [PLD]
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K19/00—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits
- H03K19/02—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits using specified components
- H03K19/173—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits using specified components using elementary logic circuits as components
- H03K19/177—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits using specified components using elementary logic circuits as components arranged in matrix form
- H03K19/17724—Structural details of logic blocks
- H03K19/17728—Reconfigurable logic blocks, e.g. lookup tables
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K19/00—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits
- H03K19/02—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits using specified components
- H03K19/173—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits using specified components using elementary logic circuits as components
- H03K19/177—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits using specified components using elementary logic circuits as components arranged in matrix form
- H03K19/17736—Structural details of routing resources
- H03K19/17744—Structural details of routing resources for input/output signals
Landscapes
- Engineering & Computer Science (AREA)
- Physics & Mathematics (AREA)
- Mathematical Physics (AREA)
- Computer Hardware Design (AREA)
- General Engineering & Computer Science (AREA)
- Computing Systems (AREA)
- Computer Networks & Wireless Communication (AREA)
- Theoretical Computer Science (AREA)
- Evolutionary Computation (AREA)
- Geometry (AREA)
- General Physics & Mathematics (AREA)
- Logic Circuits (AREA)
- Design And Manufacture Of Integrated Circuits (AREA)
Abstract
Description
Claims (15)
- 집적 회로 디바이스에서 이용하기 위한 재구성 가능한 패브릭으로서,상기 패브릭은 비동기식 로직 소자 단독으로 구성된 내장 어레이를 포함하고,상기 비동기식 로직 소자는 비동기식 로직 소자 입력에서 제공되는 신호에 대한 로직 동작을 수행하고 비동기식 로직 소자 출력에서 동작 결과를 비동기식으로 제공하도록 프로그래밍 가능하고,상기 비동기식 로직 소자는 복수의 승산기 구조로 프로그래밍 가능한 적어도 하나의 승산기 유닛을 포함하고,상기 복수의 승산기 구조는 각각 다른 메모리 배치와 연관되어 있고,상기 내장 어레이는 적어도 하나의 메모리 유닛을 포함하고,상기 적어도 하나의 메모리 유닛은 상기 적어도 하나의 승산기 유닛에 연결되어 있고, 상기 적어도 하나의 메모리 유닛은 복수의 메모리 배치로 프로그래밍 가능한,재구성 가능한 패브릭.
- 재구성 가능한 로직 패브릭을 포함하는 집적 회로로서,상기 재구성 가능한 로직 패브릭은,비동기식 로직 소자 입력에서 제공되는 신호에 대한 로직 동작을 수행하고 비동기식 로직 소자 출력에서 동작 결과를 비동기식으로 제공하도록 프로그래밍 가능하고, 복수의 승산기 구조로 프로그래밍 가능한 적어도 하나의 승산기 유닛을 포함하는 비동기식 로직 소자의 내장 어레이; 및상기 비동기식 로직 소자 입력 및 비동기식 로직 소자 출력을, 상기 집적 회로의 외부에 위치한 외부 회로에 연결하고, 상기 외부 회로와의 동기식 동작을 위하여 프로그래밍 가능한 프로그램가능 입력/출력 블럭을 포함하는, 재구성 가능한 로직 패브릭을 포함하고,상기 복수의 승산기 구조는 각각 다른 메모리 배치와 연관되어 있고,상기 내장 어레이는 적어도 하나의 메모리 유닛을 포함하고,상기 적어도 하나의 메모리 유닛은 상기 적어도 하나의 승산기 유닛에 연결되어 있고, 상기 적어도 하나의 메모리 유닛은 복수의 메모리 배치로 프로그래밍 가능한,집적 회로.
- 제 2 항에 있어서,상기 적어도 하나의 승산기 유닛 및 상기 적어도 하나의 메모리 유닛은 직접 연결되는, 재구성 가능한 로직 패브릭을 포함하는 집적 회로.
- 제 2 항에 있어서,상기 적어도 하나의 승산기 유닛 및 상기 적어도 하나의 메모리 유닛은 상호접속용 그리드에 의해 연결되는, 재구성 가능한 로직 패브릭을 포함하는 집적 회로.
- 제 2 항에 있어서,상기 적어도 하나의 승산기 유닛 및 상기 적어도 하나의 메모리 유닛은 직접 접속부 및 상호접속용 그리드를 각각 포함하는 제1 및 제2접속부에 의해 연결되는, 재구성 가능한 로직 패브릭을 포함하는 집적 회로.
- 제 5 항에 있어서,상기 재구성 가능한 로직 패브릭은 상기 직접 접속부 및 상기 상호 접속용 그리드 사이에서 선택하기 위한 적어도 하나의 프로그램가능 접속 유닛을 더 포함하는, 재구성 가능한 로직 패브릭을 포함하는 집적 회로.
- 삭제
- 제 2 항에 있어서,상기 프로그램가능 입력/출력 블럭은 상기 동작 결과를 수신하기 위하여, 상기 비동기식 로직 소자 출력에 연결된 변환기 입력을 갖는 적어도 하나의 변환기 유닛을 포함하고, 상기 적어도 하나의 변환기 유닛은 변환기 유닛 출력에서 상기 동작 결과를 동기식으로 제공하는, 재구성 가능한 로직 패브릭을 포함하는 집적 회로.
- 제 2 항에 있어서,상기 프로그램가능 입력/출력 블럭은 상기 동작 결과를 수신하기 위하여, 상기 비동기식 로직 소자 출력에 연결된 변환기 입력을 갖는 적어도 하나의 변환기 유닛을 포함하고, 상기 적어도 하나의 변환기 유닛은 변환기 유닛 출력에서 상기 동작 결과를 비동기식으로 제공하는, 재구성 가능한 로직 패브릭을 포함하는 집적 회로.
- 제 9 항에 있어서,상기 변환기 유닛 출력은 버퍼 레지스터에 연결되고, 상기 버퍼 레지스터는 상기 동작 결과를 누적 및 저장하도록 구성되고, 상기 버퍼 레지스터는, 상기 동작 결과가 상기 외부 회로에 스텝 방식으로 제공되어 상기 집적 회로의 고장진단을 가능하게 하도록, 상기 버퍼 레지스터의 스텝 동작을 위한 제어 입력을 포함하는, 재구성 가능한 로직 패브릭을 포함하는 집적 회로.
- 제 2 항에 있어서,상기 비동기식 로직 소자는 복수의 재구성 가능한 로직 블럭(RLB : reconfigurable logic block)을 더 포함하고, 각각의 RLB는 적어도 하나의 로직 클러스터를 포함하고, 상기 적어도 하나의 로직 클러스터는 적어도 하나의 룩업 테이블(LUT : look-up table)을 포함하고, 상기 적어도 하나의 LUT는 상기 비동기식 로직 소자 입력을 포함하는 입력을 가지는, 재구성 가능한 로직 패브릭을 포함하는 집적 회로.
- 비동기식의 재구성 가능한 로직 패브릭을 구성하는 방법으로서,적어도 하나의 승산기 유닛을 포함하는 전자 설계 도구를 제공하는 단계; 및병합, 복사, 함수, 분리, 싱크, 소스 또는 초기화 중의 적어도 하나를 포함하는 그룹으로부터 선택되는 비동기식 데이터 흐름 표시에 따라 동작하도록 상기 전자 설계 도구를 구성하는 단계를 포함하고,상기 전자 설계 도구를 구성하는 단계는, 복수의 승산기 구조 중 선택된 하나의 구조로 상기 적어도 하나의 승산기 유닛을 프로그래밍하는 단계를 포함하는,비동기식의 재구성 가능한 로직 패브릭을 구성하는 방법.
- 비동기식 반도체 패브릭은,로직 유닛 입력에서 제공되는 신호에 대한 비동기식 로직 동작을 수행하고 로직 유닛 출력에서 비동기식 로직 동작 결과를 제공하도록 프로그래밍 가능하고, 복수의 승산기 구조로 프로그래밍 가능한 적어도 하나의 승산기 유닛을 포함하는 복수의 비동기식 로직 유닛; 및상기 비동기식 로직 유닛을 상기 반도체 패브릭의 외부에 위치한 외부 회로에 연결하는 복수의 프로그램가능 로직 유닛 인터페이스를 포함하고,상기 프로그램가능 로직 유닛 인터페이스 중의 적어도 하나는 상기 로직 동작 결과를 상기 외부 회로에 제공하여, 상기 반도체 패브릭을 동기식 장치에 동작 가능하게 연결할 수 있도록 프로그래밍 가능한, 비동기식 반도체 패브릭을 포함하는 집적 회로.
- 삭제
- 삭제
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US81755206P | 2006-06-28 | 2006-06-28 | |
US60/817,552 | 2006-06-28 | ||
PCT/US2007/072300 WO2008008629A2 (en) | 2006-06-28 | 2007-06-27 | Reconfigurable logic fabrics for integrated circuits and systems and methods for configuring reconfigurable logic fabrics |
Publications (2)
Publication Number | Publication Date |
---|---|
KR20090028552A KR20090028552A (ko) | 2009-03-18 |
KR101058468B1 true KR101058468B1 (ko) | 2011-08-24 |
Family
ID=38924011
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1020087031271A KR101058468B1 (ko) | 2006-06-28 | 2007-06-27 | 집적 회로용의 재구성 가능한 로직 패브릭과, 재구성 가능한 로직 패브릭을 구성하기 위한 시스템 및 방법 |
Country Status (5)
Country | Link |
---|---|
US (4) | US7880499B2 (ko) |
EP (1) | EP2041872B1 (ko) |
JP (1) | JP5354427B2 (ko) |
KR (1) | KR101058468B1 (ko) |
WO (1) | WO2008008629A2 (ko) |
Families Citing this family (43)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US8983886B2 (en) | 2012-03-28 | 2015-03-17 | Knowmtech, Llc | Self-evolvable logic fabric |
US9269043B2 (en) | 2002-03-12 | 2016-02-23 | Knowm Tech, Llc | Memristive neural processor utilizing anti-hebbian and hebbian technology |
US7620917B2 (en) * | 2004-10-04 | 2009-11-17 | Synopsys, Inc. | Methods and apparatuses for automated circuit design |
KR101058468B1 (ko) * | 2006-06-28 | 2011-08-24 | 아크로닉스 세미컨덕터 코포레이션 | 집적 회로용의 재구성 가능한 로직 패브릭과, 재구성 가능한 로직 패브릭을 구성하기 위한 시스템 및 방법 |
US8542900B2 (en) * | 2007-03-08 | 2013-09-24 | Sync-Rx Ltd. | Automatic reduction of interfering elements from an image stream of a moving organ |
JP5251171B2 (ja) * | 2008-03-06 | 2013-07-31 | 富士通セミコンダクター株式会社 | 論理回路装置 |
US8964795B2 (en) | 2009-06-01 | 2015-02-24 | Achronix Semiconductor Corporation | Asynchronous pipelined interconnect architecture with fanout support |
CN101645055B (zh) * | 2009-09-10 | 2011-09-07 | 成都市华为赛门铁克科技有限公司 | 逻辑器件在线加载的方法、系统和处理器 |
US8300635B2 (en) | 2009-09-10 | 2012-10-30 | Achronix Semiconductor Corporation | Programmable crossbar structures in asynchronous systems |
US7900078B1 (en) | 2009-09-14 | 2011-03-01 | Achronix Semiconductor Corporation | Asynchronous conversion circuitry apparatus, systems, and methods |
EP2828741A4 (en) * | 2012-03-21 | 2016-06-29 | Nokia Technologies Oy | METHOD IN PROCESSOR, APPARATUS AND COMPUTER PROGRAM PRODUCT |
US8773166B1 (en) * | 2012-11-01 | 2014-07-08 | Xilinx, Inc. | Self-timed single track circuit |
US9519486B1 (en) * | 2012-11-21 | 2016-12-13 | Xilinx, Inc. | Method of and device for processing data using a pipeline of processing blocks |
US9588773B2 (en) | 2013-01-07 | 2017-03-07 | Wave Computing, Inc. | Software based application specific integrated circuit |
US10592444B2 (en) | 2013-01-07 | 2020-03-17 | Wave Computing, Inc. | Reconfigurable interconnected programmable processors |
US9430239B2 (en) * | 2013-03-12 | 2016-08-30 | Qualcomm Incorporated | Configurable multicore network processor |
US9425800B2 (en) * | 2013-04-02 | 2016-08-23 | Taiyo Yuden Co., Ltd. | Reconfigurable logic device |
US9152520B2 (en) * | 2013-09-26 | 2015-10-06 | Texas Instruments Incorporated | Programmable interface-based validation and debug |
WO2015066561A1 (en) * | 2013-11-02 | 2015-05-07 | Wave Semiconductor, Inc. | Logical elements with switchable connections |
US10203935B2 (en) | 2013-11-02 | 2019-02-12 | Wave Computing, Inc. | Power control within a dataflow processor |
US10218357B2 (en) | 2013-11-02 | 2019-02-26 | Wave Computing, Inc. | Logical elements with switchable connections for multifunction operation |
US9716491B2 (en) * | 2014-07-24 | 2017-07-25 | Lattice Semiconductor Corporation | Multiple mode device implementation for programmable logic devices |
US10073773B2 (en) | 2015-02-21 | 2018-09-11 | Wave Computing, Inc. | Instruction paging in reconfigurable fabric |
US10437728B2 (en) | 2015-02-21 | 2019-10-08 | Wave Computing, Inc. | Branchless instruction paging in reconfigurable fabric |
US10564929B2 (en) | 2016-09-01 | 2020-02-18 | Wave Computing, Inc. | Communication between dataflow processing units and memories |
US10505704B1 (en) | 2015-08-02 | 2019-12-10 | Wave Computing, Inc. | Data uploading to asynchronous circuitry using circular buffer control |
US10659396B2 (en) | 2015-08-02 | 2020-05-19 | Wave Computing, Inc. | Joining data within a reconfigurable fabric |
GR1008918B (el) * | 2015-12-22 | 2016-12-23 | Βασιλειος Μαργαριτη Μουζας | Η προγραμματιζομενη ψηφιακη συσκευη του φορμαλισμου των επαναδιαταξιμων λογικων γραφων |
JP6625943B2 (ja) * | 2016-08-01 | 2019-12-25 | 株式会社日立製作所 | 情報処理装置 |
US20180089117A1 (en) * | 2016-09-26 | 2018-03-29 | Wave Computing, Inc. | Reconfigurable fabric accessing external memory |
US10719079B2 (en) * | 2017-06-22 | 2020-07-21 | Nokomis, Inc. | Asynchronous clock-less digital logic path planning apparatus and method |
WO2019006119A1 (en) * | 2017-06-30 | 2019-01-03 | Wave Computing, Inc. | COMBINING DATA IN A RECONFIGURABLE MATRIX |
US10949328B2 (en) | 2017-08-19 | 2021-03-16 | Wave Computing, Inc. | Data flow graph computation using exceptions |
US11106976B2 (en) | 2017-08-19 | 2021-08-31 | Wave Computing, Inc. | Neural network output layer for machine learning |
WO2019169238A1 (en) * | 2018-03-02 | 2019-09-06 | Wave Computing, Inc. | Dynamic reconfiguration using data transfer control |
EP3776243A1 (en) * | 2018-03-31 | 2021-02-17 | Micron Technology, Inc. | Backpressure control using a stop signal for a multi-threaded, self-scheduling reconfigurable computing fabric |
US11645178B2 (en) * | 2018-07-27 | 2023-05-09 | MIPS Tech, LLC | Fail-safe semi-autonomous or autonomous vehicle processor array redundancy which permits an agent to perform a function based on comparing valid output from sets of redundant processors |
WO2020112992A1 (en) * | 2018-11-30 | 2020-06-04 | Wave Computing, Inc. | Reconfigurable fabric configuration using spatial and temporal routing |
US10997102B2 (en) | 2019-04-01 | 2021-05-04 | Wave Computing, Inc. | Multidimensional address generation for direct memory access |
US11227030B2 (en) | 2019-04-01 | 2022-01-18 | Wave Computing, Inc. | Matrix multiplication engine using pipelining |
US11481472B2 (en) | 2019-04-01 | 2022-10-25 | Wave Computing, Inc. | Integer matrix multiplication engine using pipelining |
US11934308B2 (en) | 2019-04-01 | 2024-03-19 | Wave Computing, Inc. | Processor cluster address generation |
CN113033133B (zh) * | 2021-03-17 | 2023-03-28 | 烽火通信科技股份有限公司 | 一种逻辑复用的电路设计方法及电路结构 |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US20050077918A1 (en) * | 2003-08-19 | 2005-04-14 | Teifel John R. | Programmable asynchronous pipeline arrays |
Family Cites Families (45)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4756010A (en) | 1985-11-07 | 1988-07-05 | Motorola, Inc. | Asynchronous/synchronous data receiver circuit |
US5396491A (en) | 1988-10-14 | 1995-03-07 | Network Equipment Technologies, Inc. | Self-routing switching element and fast packet switch |
US5633830A (en) * | 1995-11-08 | 1997-05-27 | Altera Corporation | Random access memory block circuitry for programmable logic array integrated circuit devices |
US5245605A (en) | 1991-10-04 | 1993-09-14 | International Business Machines Corporation | Integration of synchronous and asynchronous traffic on rings |
US5367209A (en) | 1992-01-07 | 1994-11-22 | Hauck Scott A | Field programmable gate array for synchronous and asynchronous operation |
JP2502920B2 (ja) | 1993-08-20 | 1996-05-29 | インターナショナル・ビジネス・マシーンズ・コーポレイション | Atmスイッチにおける調停機構 |
US5623502A (en) * | 1994-07-15 | 1997-04-22 | National Semiconductor Corporation | Testing of electronic circuits which typically contain asynchronous digital circuitry |
FI104858B (fi) | 1995-05-29 | 2000-04-14 | Nokia Networks Oy | Menetelmä ja laitteisto asynkronisen väylän sovittamiseksi synkroniseen piiriin |
US5666321A (en) | 1995-09-01 | 1997-09-09 | Micron Technology, Inc. | Synchronous DRAM memory with asynchronous column decode |
FI100571B (fi) | 1995-11-15 | 1997-12-31 | Nokia Telecommunications Oy | Asynkroninen datansiirtomenetelmä ja -järjestely |
US5724276A (en) * | 1996-06-17 | 1998-03-03 | Xilinx, Inc. | Logic block structure optimized for sum generation |
US5834957A (en) | 1996-12-20 | 1998-11-10 | Hewlett-Packard Company | Implementing asynchronous sequential circuits using synchronous design techniques and modules |
US5943288A (en) * | 1997-10-31 | 1999-08-24 | Integrated Silicon Solution, Inc. | Apparatus and method for minimizing address hold time in asynchronous SRAM |
WO2000052824A1 (en) * | 1999-03-04 | 2000-09-08 | Altera Corporation | Programmable logic device with carry-select addition |
US20020019904A1 (en) | 2000-05-11 | 2002-02-14 | Katz Abraham Yehuda | Three-dimensional switch providing packet routing between multiple multimedia buses |
DE10052210B4 (de) * | 2000-10-20 | 2004-12-23 | Infineon Technologies Ag | Integrierte Schaltung mit einer synchronen und asynchronen Schaltung sowie Verfahren zum Betrieb einer solchen integrierten Schaltung |
JP3803246B2 (ja) * | 2000-12-05 | 2006-08-02 | 松下電器産業株式会社 | 非同期fifo回路 |
US6961741B2 (en) * | 2001-02-15 | 2005-11-01 | Stmicroelectronics Ltd. | Look-up table apparatus to perform two-bit arithmetic operation including carry generation |
US6848060B2 (en) | 2001-02-27 | 2005-01-25 | International Business Machines Corporation | Synchronous to asynchronous to synchronous interface |
US6557161B2 (en) | 2001-06-28 | 2003-04-29 | Sun Microsystems, Inc. | Method for prototyping asynchronous circuits using synchronous devices |
US6934816B2 (en) * | 2001-08-07 | 2005-08-23 | Integrated Device Technology, Inc. | Integrated circuit memory devices having asynchronous flow-through capability |
US6986021B2 (en) * | 2001-11-30 | 2006-01-10 | Quick Silver Technology, Inc. | Apparatus, method, system and executable module for configuration and operation of adaptive integrated circuitry having fixed, application specific computational elements |
US6611469B2 (en) * | 2001-12-11 | 2003-08-26 | Texas Instruments Incorporated | Asynchronous FIFO memory having built-in self test logic |
US6950959B2 (en) | 2002-02-12 | 2005-09-27 | Fulcrum Microystems Inc. | Techniques for facilitating conversion between asynchronous and synchronous domains |
JP4158458B2 (ja) * | 2002-08-28 | 2008-10-01 | ソニー株式会社 | 情報処理装置、その情報処理方法 |
US6912860B2 (en) | 2003-08-08 | 2005-07-05 | Delphi Technologies, Inc. | Method of operating a directed relief valve in an air conditioning system |
JP3852437B2 (ja) | 2003-11-19 | 2006-11-29 | セイコーエプソン株式会社 | 同期・非同期インターフェース回路及び電子機器 |
JP4208751B2 (ja) * | 2004-03-09 | 2009-01-14 | 三洋電機株式会社 | データフローグラフ処理装置。 |
JP4712328B2 (ja) * | 2004-07-28 | 2011-06-29 | 独立行政法人情報通信研究機構 | フォールトトレラントなセル・アレイ |
JP4502792B2 (ja) | 2004-12-09 | 2010-07-14 | 富士通セミコンダクター株式会社 | データバッファ回路 |
US7418676B2 (en) * | 2005-01-19 | 2008-08-26 | Seiko Epson Corporation | Asynchronous circuit design tool and computer program product |
US7301824B1 (en) * | 2005-10-04 | 2007-11-27 | Xilinx, Inc. | Method and apparatus for communication within an integrated circuit |
JP4524662B2 (ja) | 2005-10-21 | 2010-08-18 | エルピーダメモリ株式会社 | 半導体メモリチップ |
KR101058468B1 (ko) | 2006-06-28 | 2011-08-24 | 아크로닉스 세미컨덕터 코포레이션 | 집적 회로용의 재구성 가능한 로직 패브릭과, 재구성 가능한 로직 패브릭을 구성하기 위한 시스템 및 방법 |
US7852866B2 (en) | 2006-12-29 | 2010-12-14 | Polytechnic Institute of New York Universiity | Low complexity scheduling algorithm for a buffered crossbar switch with 100% throughput |
US7765382B2 (en) | 2007-04-04 | 2010-07-27 | Harris Corporation | Propagating reconfiguration command over asynchronous self-synchronous global and inter-cluster local buses coupling wrappers of clusters of processing module matrix |
US7739628B2 (en) | 2008-02-15 | 2010-06-15 | Achronix Semiconductor Corporation | Synchronous to asynchronous logic conversion |
US8035414B2 (en) * | 2008-04-11 | 2011-10-11 | Massachusetts Institute Of Technology | Asynchronous logic automata |
US8013629B2 (en) * | 2008-04-11 | 2011-09-06 | Massachusetts Institute Of Technology | Reconfigurable logic automata |
US8362802B2 (en) | 2008-07-14 | 2013-01-29 | The Trustees Of Columbia University In The City Of New York | Asynchronous digital circuits including arbitration and routing primitives for asynchronous and mixed-timing networks |
US7759974B1 (en) | 2008-07-17 | 2010-07-20 | Xilinx, Inc. | Pipelined unidirectional programmable interconnect in an integrated circuit |
US7733123B1 (en) * | 2009-04-02 | 2010-06-08 | Xilinx, Inc. | Implementing conditional statements in self-timed logic circuits |
US8964795B2 (en) | 2009-06-01 | 2015-02-24 | Achronix Semiconductor Corporation | Asynchronous pipelined interconnect architecture with fanout support |
US8300635B2 (en) | 2009-09-10 | 2012-10-30 | Achronix Semiconductor Corporation | Programmable crossbar structures in asynchronous systems |
US7900078B1 (en) | 2009-09-14 | 2011-03-01 | Achronix Semiconductor Corporation | Asynchronous conversion circuitry apparatus, systems, and methods |
-
2007
- 2007-06-27 KR KR1020087031271A patent/KR101058468B1/ko active IP Right Grant
- 2007-06-27 JP JP2009518547A patent/JP5354427B2/ja active Active
- 2007-06-27 WO PCT/US2007/072300 patent/WO2008008629A2/en active Application Filing
- 2007-06-27 US US12/304,694 patent/US7880499B2/en active Active
- 2007-06-27 EP EP07840303.7A patent/EP2041872B1/en active Active
-
2011
- 2011-01-17 US US13/007,933 patent/US8125242B2/en active Active
-
2012
- 2012-01-19 US US13/354,117 patent/US8575959B2/en active Active
-
2013
- 2013-11-04 US US14/071,159 patent/US8949759B2/en active Active
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US20050077918A1 (en) * | 2003-08-19 | 2005-04-14 | Teifel John R. | Programmable asynchronous pipeline arrays |
Also Published As
Publication number | Publication date |
---|---|
WO2008008629A3 (en) | 2008-11-27 |
KR20090028552A (ko) | 2009-03-18 |
JP5354427B2 (ja) | 2013-11-27 |
JP2009543472A (ja) | 2009-12-03 |
US20110169524A1 (en) | 2011-07-14 |
US20100013517A1 (en) | 2010-01-21 |
WO2008008629A2 (en) | 2008-01-17 |
WO2008008629A4 (en) | 2009-01-15 |
EP2041872B1 (en) | 2018-03-14 |
US20120119781A1 (en) | 2012-05-17 |
US8575959B2 (en) | 2013-11-05 |
US20140137064A1 (en) | 2014-05-15 |
EP2041872A4 (en) | 2010-09-15 |
US7880499B2 (en) | 2011-02-01 |
EP2041872A2 (en) | 2009-04-01 |
US8125242B2 (en) | 2012-02-28 |
US8949759B2 (en) | 2015-02-03 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
KR101058468B1 (ko) | 집적 회로용의 재구성 가능한 로직 패브릭과, 재구성 가능한 로직 패브릭을 구성하기 위한 시스템 및 방법 | |
US6298472B1 (en) | Behavioral silicon construct architecture and mapping | |
US7532032B2 (en) | Configurable circuits, IC's, and systems | |
US7906987B2 (en) | Semiconductor integrated circuit, program transformation apparatus, and mapping apparatus | |
US7944236B2 (en) | High-bandwidth interconnect network for an integrated circuit | |
US20100219859A1 (en) | Non-Sequentially Configurable IC | |
US7062586B2 (en) | Method and apparatus for communication within a programmable logic device using serial transceivers | |
US9026967B1 (en) | Method and apparatus for designing a system on multiple field programmable gate array device types | |
US8402400B1 (en) | Method and apparatus for implementing a processor interface block with an electronic design automation tool | |
US8793629B1 (en) | Method and apparatus for implementing carry chains on FPGA devices | |
KR20230002937A (ko) | 컴퓨팅 데이터흐름 아키텍처 | |
US7800404B2 (en) | Field programmable application specific integrated circuit with programmable logic array and method of designing and programming the programmable logic array | |
Kumar et al. | FPGA Based Design of Area Efficient Router Architecture for Network on Chip (NoC) | |
US7827433B1 (en) | Time-multiplexed routing for reducing pipelining registers | |
CN117581195A (zh) | 可编程线性反馈移位寄存器系统和方法 | |
Morris et al. | A re-configurable processor for Petri net simulation | |
EP4383573A1 (en) | Clock insertion delay systems and methods | |
Morris et al. | A scalable re-configurable processor | |
Palchaudhuri et al. | High performance bit-sliced pipelined comparator tree for FPGAs | |
Warrier et al. | Reconfigurable DSP block design for dynamically reconfigurable architecture | |
Oliveira et al. | FPGA implementation of high-performance asynchronous pipelines with robust control | |
Vranesic | The FPGA challenge | |
Yoneda et al. | Coarse Grained versus Fine Grained Architectures for Asynchronous Reconfigurable Devices | |
Lee et al. | A new application-specific PLD architecture | |
Lee et al. | Design of an application-specific PLD architecture |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A201 | Request for examination | ||
AMND | Amendment | ||
E902 | Notification of reason for refusal | ||
AMND | Amendment | ||
E601 | Decision to refuse application | ||
AMND | Amendment | ||
J201 | Request for trial against refusal decision | ||
B701 | Decision to grant | ||
GRNT | Written decision to grant | ||
FPAY | Annual fee payment |
Payment date: 20140805 Year of fee payment: 4 |
|
FPAY | Annual fee payment |
Payment date: 20150804 Year of fee payment: 5 |
|
FPAY | Annual fee payment |
Payment date: 20160805 Year of fee payment: 6 |
|
FPAY | Annual fee payment |
Payment date: 20170808 Year of fee payment: 7 |
|
FPAY | Annual fee payment |
Payment date: 20180807 Year of fee payment: 8 |
|
FPAY | Annual fee payment |
Payment date: 20190806 Year of fee payment: 9 |