KR101035917B1 - 라인 온 글래스형 액정 표시 장치 - Google Patents

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    • G09G3/3648—Control of matrices with row and column drivers using an active matrix

Abstract

본 발명은 박형화를 이룰 수 있는 라인 온 글래스형 액정표시장치를 제공하기 위한 것으로, 본 발명에 의한 라인 온 글래스형 액정표시장치는, 다수의 게이트라인들 및 다수의 데이터라인들을 가지는 액정패널과, 상기 데이터라인들에 화소 데이터 전압을 공급하기 위한 다수의 데이터 집적회로들과, 상기 액정패널의 기판 상에 형성되며 상기 데이터 집적회로들 사이에 연결되어 상기 데이터 집적회로들에 구동신호를 전송하기 위한 신호라인과, 상기 데이터 집적회로들 간의 임피던스를 매칭시키기 위해 상기 데이터 집적회로들 중 적어도 어느 하나에 내장되는 저항과, 병렬 데이터를 직렬 데이터로 압축하여 정극성 데이터와 부극성 데이터로 구성된 차등 폐어 신호를 생성하여 상기 데이터 집적회로들로 공급하는 인터페이스 송신부가 내장된 타이밍 제어부를 구비한다.

Description

라인 온 글래스형 액정 표시 장치{LIQUID CRYSTAL DISPLAY OF LINE-ON-GLASS TYPE}
도 1은 종래 게이트 인쇄 회로 기판이 제거된 라인 온 글래스형 액정표시장치를 도시한 평면도이다.
도 2는 도 1에 도시된 액정표시장치에서 임피던스 매칭을 위해 터미네이션 저항을 설치한 도면.
도 3은 본 발명의 실시예에 의한 라인 온 글래스형 액정표시장치.
도 4는 도 3에 도시된 액정표시장치에서 데이터 드라이브 IC를 상세히 나타내는 도면.
도 5a는 도 4에 도시된 데이터 드라이브 IC에서 터미네이션 저항이 필요없는 경우의 배선도.
도 5b는 도 4에 도시된 데이터 드라이브 IC에서 터미네이션 저항이 필요한 경우의 배선도.
<도면의 주요부분에 대한 설명>
2,102 : 하부 어레이 기판 4,104 : 상부 어레이 기판
6,106 : 액정 표시 패널 8,108 : 게이트 TCP
10,110 : 게이트 드라이브 IC 12,112 : 데이터 TCP
14,114 : 데이터 드라이브 IC 16,116 : 데이터 PCB
18,118 : FPC 20,120 : 메인 PCB
22,122 : 타이밍 제어부 24,124 : 전원부
26,126 : 게이트 LOG 신호 라인군 40,140 : 데이터 LOG 신호 라인군
130 : 정극성 데이터 공급라인 132 : 부극성 데이터 공급라인
142 : GND 전원 공급라인 144 : 선택라인
146 : VCC 전원 공급라인 150 : 멀티플렉서
160 : LVDS 수신부
본 발명은 액정표시장치에 관한 것으로, 특히 박형화를 이룰 수 있는 LOG형 액정표시장치에 관한 것이다.
액정표시장치는 전계를 이용하여 유전 이방성을 갖는 액정의 광투과율을 조절함으로써 화상을 표시하게 된다. 이를 위하여, 액정표시장치는 액정셀들이 매트릭스형으로 배열된 액정표시패널과, 액정표시패널을 구동하기 위한 구동회로를 구비한다.
액정표시패널은 액정셀들이 화소 신호에 따라 광투과율을 조절함으로써 화상을 표시하게 된다.
구동회로는 액정표시패널의 게이트 라인들을 구동하기 위한 게이트 드라이버와, 데이터 라인들을 구동하기 위한 데이터 드라이버와, 게이트 드라이버 및 데이터 드라이버의 구동 타이밍을 제어하기 위한 타이밍 제어부와, 상기 액정표시패널과 상기 구동회로들의 구동에 필요한 전원 신호들을 공급하는 전원부를 구비한다.
데이터 드라이버와 게이트 드라이버는 다수개의 집적회로(Integrated Circuit;이하, IC라 함)들로 분리되어 칩 형태로 제작된다. 집적화된 드라이브 IC들 각각은 TCP(Tape Carrier Package) 상에서 오픈된 IC 영역에 실장되거나 COF(Chip On Film) 방식으로 TCP의 베이스 필름 상에 실장되고, TAB(Tape Automated Bonding) 방식으로 액정 표시 패널과 전기적으로 접속된다. 또한 드라이브 IC는 COG(Chip On Glass) 방식으로 액정 표시 패널 상에 직접 실장되기도 한다. 타이밍 제어부와 전원부는 칩 형태로 제작되어 메인 PCB(Printed Circuit Board) 상에 실장된다.
TCP에 의해 액정표시패널과 접속되는 드라이브 IC들은 FPC(Flexable Printed Circuit)와 서브 PCB를 통해 메인 PCB의 타이밍 제어부 및 전원부와 접속된다. 구체적으로, 데이터 드라이브 IC들은 FPC와 데이터 PCB를 통해 메인 PCB에 실장된 타이밍 제어부로부터의 데이터 제어 신호들 및 화소 데이터와, 전원부로부터의 전원 신호들을 공급받게 된다. 게이트 드라이브 IC들은 게이트 FPC와 게이트 PCB를 통해 메인 PCB 상에 실장된 타이밍 제어부로부터의 게이트 제어 신호들과 전원부로부 터의 전원 신호들을 공급받게 된다.
COG 방식으로 액정표시패널에 실장되는 드라이브 IC들은 FPC와 액정표시패널에 형성되는 라인 온 글래스(Line On Glass; 이하 LOG라 함)형 신호 라인들을 통해 메인 PCB에 실장된 타이밍 제어부로부터의 제어 신호들 및 화소 데이터와 전원부로부터의 전원 신호들을 공급받게 된다.
최근에는 드라이브 IC들이 TCP를 통해 액정 표시 패널과 접속되는 경우에도 LOG형 신호 라인들을 채택하여 PCB를 제거함으로써 액정 표시 장치가 더욱 박형화되게 하고 있다. 특히, 상대적으로 적은 신호를 전달하는 게이트 PCB를 제거하고 게이트 드라이브 IC들에 게이트 제어 신호들 및 전원 신호들을 공급하는 신호 라인들을 LOG형으로 액정표시패널 상에 형성하고 있다. 이에 따라, TCP에 실장된 게이트 드라이브 IC들은 메인 PCB->FPC->데이터 PCB->데이터 TCP->LOG 신호 라인->게이트 TCP를 경유하여 타이밍 제어부로부터의 게이트 제어 신호들과 전원부로부터의 전원 신호들을 공급받게 된다.
구체적으로, 게이트 PCB가 제거된 LOG형 액정표시장치는 도 1에 도시된 바와 같이 타이밍 제어부(22)와 전원부(24)를 포함하는 메인 PCB(20)와, FPC(18)를 통해 메인 PCB(20)와 접속된 데이터 PCB(16)와, 데이터 드라이브 IC(14)를 실장하여 데이터 PCB(16)와 액정표시패널(6) 사이에 접속된 데이터 TCP(12)와, 게이트 드라이브 IC(10)를 실장하여 액정표시패널(6)에 접속된 게이트 TCP(8)를 구비한다.
액정표시패널(6)은 하부 어레이 기판(2)과, 상부 어레이 기판(4)이 액정을 사이에 두고 접합되어 형성된다. 이러한 액정표시패널(6)은 게이트 라인(GL)들과 데이터 라인(DL)들의 교차로 정의되는 영역마다 박막 트랜지스터에 의해 독립적으로 구동되는 액정셀들이 마련된다. 박막 트랜지스터는 게이트 라인(GL)으로부터의 스캔 신호에 응답하여 데이터 라인(DL)으로부터의 화소 신호를 액정셀에 공급한다.
데이터 드라이브 IC(14)들은 데이터 TCP(12) 및 액정표시패널(6)의 데이터 패드부를 경유하여 데이터 라인(DL)들과 접속된다. 이러한 데이터 드라이브 IC(14)들은 화소 데이터를 아날로그 화소 신호로 변환하여 데이터 라인(DL)들에 공급한다. 이를 위하여, 데이터 드라이브 IC(14)들은 데이터 PCB(16)와 FPC(18)를 통해 메인 PCB(20) 상의 타이밍 제어부(22) 및 전원부(24)로부터 데이터 제어 신호, 화소 데이터, 그리고 전원 신호들을 공급받게 된다.
게이트 드라이브 IC(10)들은 게이트 TCP(8) 및 액정표시패널(6)의 게이트 패드부를 경유하여 게이트 라인(GL)들과 접속된다. 이러한 게이트 드라이브 IC(10)들은 게이트 하이 전압(VGH)의 스캔 신호를 게이트 라인(GL)들에 순차적으로 공급한다. 또한 게이트 드라이브 IC(10)들은 게이트 하이 전압(VGH)이 공급되는 기간을 제외한 나머지 기간에는 게이트 로우 전압(VGL)을 게이트 라인(GL)들에 공급한다.
이를 위하여, 메인 PCB(20) 상의 타이밍 제어부(22) 및 전원부(24)로부터의 게이트 제어 신호들과 전원 신호들은 FPC(18)와 데이터 PCB(16)를 경유하여 데이터 TCP(12)에 공급된다. 데이터 TCP(12)를 통해 공급되는 게이트 제어 신호들과 전원 신호들은 하부 어레이 기판(2)의 가장자리 영역에 형성된 LOG 신호 라인군(26)를 경유하여 게이트 TCP(8)에 공급된다. 게이트 TCP(12)에 공급된 게이트 제어 신호 들 및 전원 신호들은 게이트 드라이브 IC(10)의 입력 단자들을 통해 게이트 드라이브 IC(10) 내로 입력되어 이용된다. 그리고, 게이트 제어 신호들 및 전원 신호들은 게이트 드라이브 IC(10)의 출력 단자들을 통해 출력되어 게이트 TCP(8)와 LOG 신호 라인군(26)을 경유하여 다음 게이트 TCP(8)에 실장된 게이트 드라이브 IC(10)로 공급된다.
LOG형 신호라인군(26)은 통상 게이트 로우 전압(VGL), 게이트 하이 전압(VGH), 공통 전압(VCOM), 그라운드 전압(GND), 베이스 구동 전압(VCC)과 같이 전원부(24)로부터 공급되는 직류 구동 전압들과; 게이트 스타트 펄스(GSP), 게이트 쉬프트 클럭 신호(GSC), 게이트 이네이블 신호(GOE)와 같이 타이밍 제어부(22)로부터 공급되는 게이트 제어 신호들 각각을 공급하는 신호 라인들로 구성된다.
이와 같이, 종래 게이트 드라이브 IC(10)들에 필요한 게이트제어신호 및 전원신호들을 포함하는 게이트신호를 공급하는 게이트 공급라인의 수가 많지 않기 때문에 그 공급라인을 LOG형태로 액정표시패널(6) 상에 형성할 수 있다. 그 결과, 게이트 PCB를 제거할 수 있으므로 액정표시장치의 박형화를 이룰 수 있다. 그러나, 데이터 드라이브 IC(14)들에 필요한 데이터 제어 신호 및 화소 데이터를 포함하는 데이터신호를 공급하는 데이터 공급라인의 수가 많기 때문에 데이터 공급라인을 LOG형태로 적용할 수 없는 문제점이 있다. 따라서, 이를 해결하기 위해서는 LVDS(Low Voltage Differential Signal) 전송방식 등을 이용한 직렬 전송 방식를 선택해야 한다. 여기서, LVDS 전송방식은 타이밍 제어부(22)에 내장된 LVDS 송신부(도시하지 않음)에서 패러럴(Parallel) 디지털 데이터를 시리얼(Serial) 데이터로 압축하여 정극성 데이터와 부극성 데이터로 구성된 차등 폐어 신호(Differential Pair Signal)를 데이터 드라이브 IC(14)들에 내장된 LVDS 수신부(도시하지 않음)로 전송하는 방식이다. 이때, 데이터는 직렬로 전송되므로 타이밍 제어부(22)로부터 멀리 떨어진 데이터 드라이브 IC(14)들은 타이밍 제어부(22)와 임피던스가 달라지게 되는 문제점이 있다. 이러한 문제점을 해결하기 위하여, 도 2에 도시된 바와 같이 데이터 드라이버 IC(14)들로 공급되는 정극성의 데이터 공급라인(30)과 부극성의 데이터 공급라인(32) 간에 터미네이션 저항(Rt)을 연결하여 입력 임피던스를 맞추워야 한다. 다시말해서, 타이밍 제어부(22)의 LVDS 송신부로부터 데이터 드라이브 IC(14)들의 LVDS 수신부로 공급되는 시리얼 데이터는 직렬로 첫단의 데이터 드라이브 IC(14)로부터 마지막단의 데이터 드라이브 IC(14)로 공급된다. 이 때, 터미네이션 저항(Rt)이 존재하지 않는다면 정극성의 데이터 공급라인(30)과 부극성의 데이터 공급라인(32)을 통해 정극성의 데이터 전압 및 부극성의 데이터 전압이 다수의 데이터 드라이브 IC(14)들로 공급될 때 병렬회로가 되기 때문에 각각의 데이터 드라이브 IC(14)들로 인가되는 데이터 전압이 달라지게 된다. 이에 따라, 데이터 드라이브 IC(14)들이 타이밍 제어부(22)로부터 멀어질수록 임피던스가 맞지 않게 되어 액정표시장치는 불안정안 동작을 하게 된다. 따라서, 임피던스 매칭이 안되는 마지막 일부 데이터 드라이브 IC(14)들의 정극성의 데이터 공급라인(30)과 부극성의 데이터 공급라인(32) 간에 저항값이 작은 터미네이션 저항(Rt)을 연결시킴으로써 임피던스가 매칭되어 액정표시장치는 안정된 동작을 하게 된다.
그러나, 이와 같은 임피던스 매칭을 위한 터미네이션 저항(Rt)은 얇은 필름 형태인 데이터 TCP(12) 상에 실장하기 어렵기 때문에 데이터 드라이브 IC(14)들은 LOG형태로 적용할 수 없는 문제점이 있다.
따라서, 본 발명의 목적은 박형화할 수 있는 라인 온 글래스형 액정표시장치를 제공하는 것이다.
상기 목적을 달성하기 위하여, 본 발명의 실시예에 의한 라인 온 글래스형 액정표시장는 다수의 게이트라인들 및 다수의 데이터라인들을 가지는 액정패널과, 데이터라인들에 화소 데이터 전압을 공급하기 위한 다수의 데이터 집적회로들과, 액정패널의 기판 상에 형성되며 상기 데이터 집적회로들 사이에 연결되어 상기 데이터 집적회로들에 구동신호를 전송하기 위한 신호라인과, 상기 데이터 집적회로들 간의 임피던스를 매칭시키기 위해 상기 데이터 집적회로들 중 적어도 어느 하나에 내장되는 저항을 구비한다.
상기 라인 온 글래스형 액정표시장치는 병렬 데이터를 직렬 데이터로 압축하여 정극성 데이터와 부극성 데이터로 구성된 차등 폐어 신호를 생성하여 상기 데이터 집적회로들로 공급하는 인터페이스 송신부가 내장된 타이밍 제어부를 더 구비한다.
상기 라인 온 글래스형 액정표시장치에서 상기 신호라인은 상기 정극성 데이터가 공급되는 정극성 데이터 공급라인들과, 상기 부극성 데이터가 공급되는 부극성 데이터 공급라인들과, 디지털 전원이 공급되는 제1 전원 공급라인과, 그라운드 전원이 공급되는 제2 전원 공급라인을 구비한다.
상기 라인 온 글래스형 액정표시장치에서 상기 데이터 집적회로들은 상기 정극성 및 부극성 데이터 공급라인들과 접속되어 상기 직렬 데이터를 병렬 데이터로 변환하기 위한 인터페이스 수신부와, 상기 제1 및 제2 전원 공급라인 중 어느 하나에 접속되는 선택라인과, 상기 선택라인에 응답하여 상기 정극성 및 부극성 데이터 공급라인들 사이에 접속된 저항의 선택 여부를 결정하기 위한 멀티플레서를 구비한다.
상기 라인 온 글래스형 액정표시장치에서 상기 선택라인이 상기 제1 전원 공급라인과 접속될 경우 상기 멀티플레서는 상기 정극성 및 부극성 데이터 공급라인들 사이에 설치된 상기 저항을 선택하고, 그 이외의 경우에는 상기 정극성 및 부극성 데이터 공급라인들 사이를 오픈 시키는 것을 특징으로 한다.
상기 라인 온 글래스형 액정표시장치에서 상기 선택라인이 상기 제2 전원 공급라인과 접속될 경우 상기 멀티플레서는 상기 정극성 및 부극성 데이터 공급라인들 사이에 설치된 상기 저항을 선택하고, 그 이외의 경우에는 상기 정극성 및 부극성 데이터 공급라인들 사이를 오픈 시키는 것을 특징으로 한다.
상기 라인 온 글래스형 액정표시장치에서 상기 선택라인에 의해 상기 저항이 선택되는 데이터 집적회로는 상기 액정패널의 양 끝단에 위치하는 적어도 하나 이 상의 데이터 집적회로인 것을 특징으로 한다.
상기 목적 외에 본 발명의 다른 목적 및 이점들은 첨부한 도면들을 참조한 본 발명의 바람직한 실시예에 대한 설명을 통하여 명백하게 드러나게 될 것이다.
이하, 도 3 내지 도 5b를 참조하여 본 발명의 바람직한 실시예에 대하여 설명하기로 한다.
도 3은 본 발명에 따른 LOG형 액정표시장치를 나타내는 도면이다.
도 3를 참조하면, 본 발명에 따른 LOG형 액정표시장치는 타이밍 제어부(122)와 전원부(124)를 포함하는 메인 PCB(120)와, 데이터 드라이브 IC(114)를 실장하여 액정표시패널(106) 사이에 접속된 데이터 TCP(112)와, 게이트 드라이브 IC(110)를 실장하여 액정표시패널(106)에 접속된 게이트 TCP(108)를 구비한다.
메인 PCB의 전원부(124)는 시스템 전원부(도시하지 않음)로부터 입력되는 전압을 이용하여 액정표시장치의 구동에 필요한 구동전압들, 예를 들어 게이트 하이전압(VGH), 게이트 로우 전압신호(VGL), 기준전압(VCC), 공통전압(VCOM)을 발생하여 데이터 드라이브 IC(114) 및 게이트 드라이브 IC(110) 등에 공급한다.
메인 PCB(120)의 타이밍 제어부(122)는 그래픽 카드로부터의 비디오데이터(R, G, B)를 중계하여 데이터 드라이브 IC(114)에 공급한다. 아울러, 타이밍 제어부(122)는 그래픽카드로부터의 제어신호에 응답하여 데이터 및 게이트 드라이브 IC(114,110)의 타이밍을 제어하기 위한 타이밍 신호들과 제어신호들을 발생하게 된다. 이러한 타이밍 제어부(122)는 LVDS 송신부(도시하지 않음)를 내장하여 패러럴(Parallel) 디지털 데이터를 시리얼(Serial) 데이터로 압축하여 정극성 데이터와 부극성 데이터로 구성된 차등 폐어 신호(Differential Pair Signal)를 데이터 드라이브 IC들(114)에 내장된 LVDS 수신부로 전송하게 된다.
액정표시패널(106)은 하부 어레이 기판(102)과, 상부 어레이 기판(104)이 액정을 사이에 두고 접합되어 형성된다. 이러한 액정표시패널(106)은 게이트 라인(GL)들과 데이터 라인(DL)들의 교차로 정의되는 영역마다 박막 트랜지스터에 의해 독립적으로 구동되는 액정셀들이 마련된다. 박막 트랜지스터는 게이트 라인(GL)으로부터의 스캔 신호에 응답하여 데이터 라인(DL)으로부터의 화소 신호를 액정셀에 공급한다.
게이트 드라이브 IC(110)들은 게이트 TCP(18) 및 액정표시패널(106)의 게이트 패드부를 경유하여 게이트 라인(GL)들과 접속된다. 이러한 게이트 드라이브 IC(110)들은 게이트 하이 전압(VGH)의 스캔 신호를 게이트 라인(GL)들에 순차적으로 공급한다. 또한 게이트 드라이브 IC(110)들은 게이트 하이 전압(VGH)이 공급되는 기간을 제외한 나머지 기간에는 게이트 로우 전압(VGL)을 게이트 라인(GL)들에 공급한다.
이를 위하여, 메인 PCB(120) 상의 타이밍 제어부(122) 및 전원부(124)로부터의 게이트 제어 신호들과 전원 신호들은 FPC(118)를 경유하여 데이터 TCP(112)에 공급된다. 데이터 TCP(112)를 통해 공급되는 게이트 제어 신호들과 전원 신호들은 하부 어레이 기판(102)의 가장자리 영역에 형성된 LOG형 게이트 신호 라인(126)을 경유하여 게이트 TCP(108)에 공급된다. 게이트 TCP(108)에 공급된 게이트 제어 신호들 및 전원 신호들은 게이트 드라이브 IC(110)의 입력 단자들을 통해 게이트 드 라이브 IC(110) 내로 입력되어 이용된다. 그리고, 게이트 제어 신호들 및 전원 신호들은 게이트 드라이브 IC(110)의 출력 단자들을 통해 출력되어 게이트 TCP(108)와 LOG형 게이트 신호 라인(126)을 경유하여 다음 게이트 TCP(108)에 실장된 게이트 드라이브 IC(110)로 공급된다.
LOG형 게이트 신호 라인(126)은 통상 게이트 로우 전압(VGL), 게이트 하이 전압 (VGH), 공통 전압(VCOM), 그라운드 전압(GND), 베이스 구동 전압(VCC)과 같이 전원부(124)로부터 공급되는 직류 구동 전압들과; 게이트 스타트 펄스(GSP), 게이트 쉬프트 클럭 신호(GSC), 게이트 이네이블 신호(GOE)와 같이 타이밍 제어부(122)로부터 공급되는 게이트 제어 신호들 각각을 공급하는 신호 라인들로 구성된다.
데이터 드라이브 IC(114)들은 데이터 TCP(112) 및 액정표시패널(106)의 데이터 패드부를 경유하여 데이터 라인(DL)들과 접속된다. 이러한 데이터 드라이브 IC(114)들은 화소 데이터를 아날로그 화소 신호로 변환하여 데이터 라인(DL)들에 공급한다. 이를 위하여, 메인 PCB(120) 상의 타이밍 제어부(122) 및 전원부(124)로부터의 데이터 제어 신호들, 화소 데이터 및 전원 신호들은 FPC(118)를 경유하여 제1 데이터 TCP(112)에 공급된다. 제1 데이터 TCP(112)에 공급된 데이터 제어 신호들, 화소 데이터 및 전원 신호들은 데이터 드라이브 IC(114)의 입력 단자들을 통해 데이터 드라이브 IC(114) 내로 입력되어 이용된다. 그리고, 데이터 제어 신호들, 화소 데이터 및 전원 신호들은 데이터 드라이브 IC(114)의 출력 단자들을 통해 출력되어 데이터 TCP(112)와 LOG형 데이터 신호 라인(140)을 경유하여 다음 데이터 TCP(112)에 실장된 데이터 드라이브 IC(114)로 공급된다.
LOG형 데이터 신호라인은 전원부(124)에서 생성된 아날로그 전압(VDD), 디지털 전압(VCC), 공통전압(VCOM), 그라운드 전압(GND)과 같은 구동전압들과; 타이밍제어부(122)에서 생성된 소스 스타트 펄스(SSP), 소스 출력 이네이블(SOE), 극성 제어 신호(POL), 소스 쉬프트 클럭(SSC) 등과 같은 데이터 제어 신호들과; 타이밍 제어부(122)에서 정렬된 화소 데이터들 각각을 공급하는 신호라인들로 구성된다.
한편, 데이터 드라이브 IC(114)들은 타이밍 제어부(122)에 내장된 LVDS 송신부(미도시)로부터 직렬 전송방식인 LVDS 전송방식으로 전송되는 정극성 데이터와 부극성 데이터로 구성된 차등 폐어 신호(Differential Pair Signal)를 전송받는다. 이에 따라, 데이터 드라이브 IC(114)들은 도 4에 도시된 바와 같이 타이밍 제어부(122)의 LVDS 송신부로부터 정극성 및 부극성 데이터가 공급되는 정극성 및 부극성 데이터 공급라인(130,132)들과, 정극성 및 부극성 데이터 공급라인(130,132)들과 연결되어 시리얼한 정극성 및 부극성 데이터를 패러럴한 데이터로 복원하기 위한 LVDS 수신부(160)와, GND 신호라인(142) 및 VCC 신호라인(146) 중 어느 하나를 선택하기 위한 선택라인(144)과, 선택라인(144)에 응답하여 정극성 및 부극성 데이터 공급라인(130,132)들 사이에 터미네이션 저항(Rt)의 필요 여부에 따라 터미네이션 저항(Rt)을 선택하기 위한 멀티플렉서(Multiplexer ; 이하 "MUX"라 함)를 구비한다.
이와 같은 데이터 드라이브 IC(114)들의 동작에 대해 설명하면, 먼저 정극성 및 부극성 데이터가 공급되는 정극성 및 부극성 데이터 공급라인(130,132)들 사이에 터미네이션 저항(Rt)이 필요없는 경우, 도 5a에 도시된 바와 같이 선택라인(144)은 하부 어레이 기판(102) 상에서 GND 신호라인(142)과 접합된다. 따라서, MUX(150)의 제어단자는 GND 신호라인(142)과 연결되어 GND 신호가 공급된다. 이러한 GND 신호에 응답하여 MUX(150)는 제1 입력부(I1)로 공급되는 신호를 출력부로 출력하게 된다. 이 때, 제1 입력부(I1)는 정극성의 데이터 공급라인(130)과 오픈되어 있다. 이에 따라, MUX(150)의 출력부와 연결된 부극성의 데이터 공급라인(132)은 정극성의 데이터 공급라인(130)과 오픈된다.
한편, 정극성 및 부극성 데이터가 공급되는 정극성 및 부극성 데이터 공급라인(130,132)들 사이에 터미네이션 저항(Rt)이 필요한 경우, 도 5b에 도시된 바와 같이 선택라인(144)은 하부 어레이 기판(102)상에서 VCC 신호라인(146)과 접합된다. 따라서, MUX(150)의 입력단자는 VCC 신호라인(146)과 연결되어 VCC 신호가 공급된다. 이러한 VCC 신호에 응답하여 MUX(150)는 제2 입력부(I2)로 공급되는 신호를 출력부로 출력하게 된다. 이 때, 제2 입력부(I2)는 정극성의 데이터 공급라인(130)과 연결된 터미네이션 저항(Rt)과 연결되어 있다. 이에 따라, MUX(150)의 제2 입력부(I2)와 연결된 정극성의 데이터 공급라인(130)과 MUX(150)의 출력라인과 연결된 부극성의 데이터 공급라인(132)은 터미네이션 저항(Rt)을 사이에 두고 연결된다. 이러한 터미네이션 저항(Rt)이 필요한 데이터 드라이버 IC(114)는 양 끝단에 설치되는 데이터 드라이버 IC(114)들이다.
이와 같은 본 발명의 실시예에 의한 LOG형 액정표시장치는 임피던스 매칭을 위하여 터미네이션 저항(Rt)이 필요한 데이터 드라이브 IC(114)는 선택라인(144)을 하부 어레이 기판(102)상에서 VCC 신호라인(146)과 접합한다. 이에 따라, 정극성의 데이터 공급라인(130)과 부극성의 데이터 공급라인(132)은 터미네이션 저항(Rt)을 사이에 두고 연결된다. 그리고, 임피던스 매칭이 필요하지 않은 나머지 데이터 드라이브 IC(114)들은 선택라인(144)을 하부 어레이 기판(102)상에서 GND 신호라인(142)과 접합한다. 이에 따라, 정극성의 데이터 공급라인(130)과 부극성의 데이터 공급라인(132) 사이에는 터미네이션 저항(Rt)이 연결되지 않는다. 이 때, 임피던스 매칭을 위한 터미네이션 저항(Rt)을 데이터 드라이버 IC(114)들 내에 내장함으로써 데이터 드라이브 IC(114)들을 LOG형태로 적용할 수 있게 된다. 이에 따라, 본 발명의 실시예에 의한 LOG형 액정표시장치는 박형화가 가능하게 된다.
상술한 바와 같이, 본 발명에 따른 LOG형 액정 표시 장치는 임피던스 매칭을 위한 터미네이션 저항을 데이터 드라이브 IC 내에 내장함으로써 데이터 드라이브 IC들을 LOG형태로 적용할 수 있게 된다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여져야만 할 것이다.

Claims (7)

  1. 다수의 게이트라인들 및 다수의 데이터라인들을 가지는 액정패널;
    상기 데이터라인들에 화소 데이터 전압을 공급하기 위한 다수의 데이터 집적회로들;
    상기 액정패널의 기판 상에 형성되며 상기 데이터 집적회로들 사이에 연결되어 상기 데이터 집적회로들에 구동신호를 전송하기 위한 신호라인;
    상기 데이터 집적회로들 간의 임피던스를 매칭시키기 위해 상기 데이터 집적회로들 중 적어도 어느 하나에 내장되는 저항; 및
    병렬 데이터를 직렬 데이터로 압축하여 정극성 데이터와 부극성 데이터로 구성된 차등 폐어 신호를 생성하여 상기 데이터 집적회로들로 공급하는 인터페이스 송신부가 내장된 타이밍 제어부를 구비하는 것을 특징으로 하는 라인 온 글래스형 액정표시장치.
  2. 삭제
  3. 제 1 항에 있어서,
    상기 신호라인은,
    상기 정극성 데이터가 공급되는 정극성 데이터 공급라인들;
    상기 부극성 데이터가 공급되는 부극성 데이터 공급라인들;
    디지털 전원이 공급되는 제1 전원 공급라인; 및
    그라운드 전원이 공급되는 제2 전원 공급라인을 구비하는 것을 특징으로 하는 라인 온 글래스형 액정표시장치.
  4. 제 3 항에 있어서,
    상기 데이터 집적회로들은,
    상기 정극성 및 부극성 데이터 공급라인들과 접속되어 상기 직렬 데이터를 병렬 데이터로 변환하기 위한 인터페이스 수신부;
    상기 제1 및 제2 전원 공급라인 중 어느 하나에 접속되는 선택라인; 및
    상기 선택라인에 응답하여 상기 정극성 및 부극성 데이터 공급라인들 사이에 접속된 저항의 선택 여부를 결정하기 위한 멀티플레서를 구비하는 것을 특징으로 하는 라인 온 글래스형 액정표시장치.
  5. 제 4 항에 있어서,
    상기 선택라인이 상기 제1 전원 공급라인과 접속될 경우 상기 멀티플레서는 상기 정극성 및 부극성 데이터 공급라인들 사이에 설치된 상기 저항을 선택하고, 그 이외의 경우에는 상기 정극성 및 부극성 데이터 공급라인들 사이를 오픈 시키는 것을 특징으로 하는 라인 온 글래스형 액정표시장치.
  6. 제 4 항에 있어서,
    상기 선택라인이 상기 제2 전원 공급라인과 접속될 경우 상기 멀티플레서는 상기 정극성 및 부극성 데이터 공급라인들 사이에 설치된 상기 저항을 선택하고, 그 이외의 경우에는 상기 정극성 및 부극성 데이터 공급라인들 사이를 오픈 시키는 것을 특징으로 하는 라인 온 글래스형 액정표시장치.
  7. 제 4 항에 있어서,
    상기 선택라인에 의해 상기 저항이 선택되는 데이터 집적회로는 상기 액정패널의 양 끝단에 위치하는 적어도 하나 이상의 데이터 집적회로인 것을 특징으로 하는 라인 온 글래스형 액정표시장치.
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