KR100973807B1 - Liquid crystal display and driving method thereof - Google Patents
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Abstract
본 발명은 비정상 데이터 인에이블 신호에 대응할 수 있는 액정 표시 장치 및 그 구동 방법에 관한 것이다. 본 발명의 한 실시예에 따른 액정 표시 장치는 스위칭 소자를 포함하는 복수의 화소, 외부로부터 영상 신호 및 상기 영상 신호의 존재 유무를 나타내는 데이터 인에블 신호(DE)를 수신하며, 상기 데이터 인에이블 신호의 정상 여부를 판별하여 그 결과에 따른 복수의 제어 신호를 각각 출력하는 신호 제어부, 그리고 상기 신호 제어부로부터의 제어 신호에 따라 상기 스위칭 소자를 턴 온시키는 게이트 온 전압을 출력하는 게이트 구동부를 포함한다. 이런 방식으로, 이상 데이터 인에이블 신호가 입력된 경우에 출력 인에이블 신호를 하이로 마스킹하여 게이트 온 전압을 차단함으로써 비정상 화면이 표시되지 않게 한다.
데이터인에이블, 출력인에이블, 게이트신호, 신호제어부, 데이터구동부, 게이트구동부
The present invention relates to a liquid crystal display device capable of responding to an abnormal data enable signal and a driving method thereof. A liquid crystal display according to an exemplary embodiment of the present invention receives a plurality of pixels including a switching element, an image signal from the outside, and a data enable signal DE indicating whether the image signal is present, and the data enable A signal controller which determines whether the signal is normal and outputs a plurality of control signals according to the result, and a gate driver which outputs a gate-on voltage for turning on the switching element according to the control signal from the signal controller. . In this manner, when the abnormal data enable signal is input, the output enable signal is masked high to block the gate-on voltage so that the abnormal screen is not displayed.
Data enable, output enable, gate signal, signal controller, data driver, gate driver
Description
도 1은 본 발명의 한 실시예에 따른 액정 표시 장치의 블록도이다.1 is a block diagram of a liquid crystal display according to an exemplary embodiment of the present invention.
도 2는 본 발명의 한 실시예에 따른 액정 표시 장치의 한 화소에 대한 등가 회로도이다.2 is an equivalent circuit diagram of one pixel of a liquid crystal display according to an exemplary embodiment of the present invention.
도 3a 및 도 3b는 본 발명의 한 실시예에 따른 신호의 파형도이다.3A and 3B are waveform diagrams of signals in accordance with one embodiment of the present invention.
본 발명은 액정 표시 장치 및 그 구동 방법에 관한 것으로서, 특히 비정상 데이터 인에이블 신호에 대응할 수 있는 액정 표시 장치 및 그 구동 방법에 관한 것이다.BACKGROUND OF THE
일반적인 액정 표시 장치(liquid crystal display, LCD)는 화소 전극 및 공통 전극이 구비된 두 표시판과 그 사이에 들어 있는 유전율 이방성(dielectric anisotropy)을 갖는 액정층을 포함한다. 화소 전극은 행렬의 형태로 배열되어 있고 박막 트랜지스터(TFT) 등 스위칭 소자에 연결되어 한 행씩 차례로 데이터 전압을 인가 받는다. 공통 전극은 표시판의 전면에 걸쳐 형성되어 있으며 공통 전압을 인가 받는다. 화소 전극과 공통 전극 및 그 사이의 액정층은 회로적으로 볼 때 액정 축전기를 이루며, 액정 축전기는 이에 연결된 스위칭 소자와 함께 화소를 이루는 기본 단위가 된다.A typical liquid crystal display (LCD) includes two display panels provided with pixel electrodes and a common electrode, and a liquid crystal layer having dielectric anisotropy interposed therebetween. The pixel electrodes are arranged in a matrix and connected to switching elements such as thin film transistors (TFTs) to receive data voltages one by one in sequence. The common electrode is formed over the entire surface of the display panel and receives a common voltage. The pixel electrode, the common electrode, and the liquid crystal layer therebetween form a liquid crystal capacitor, and the liquid crystal capacitor becomes a basic unit that forms a pixel together with a switching element connected thereto.
이러한 액정 표시 장치에서는 두 전극에 전압을 인가하여 액정층에 전계를 형성하고, 이 전계의 세기를 조절하여 액정층을 통과하는 빛의 투과율을 조절함으로써 원하는 화상을 얻는다. In such a liquid crystal display, a voltage is applied to two electrodes to form an electric field in the liquid crystal layer, and the intensity of the electric field is adjusted to control the transmittance of light passing through the liquid crystal layer to obtain a desired image.
한편, LCD는 외부로부터의 영상 신호와 이의 표시를 제어하는 제어 신호를 처리하여 출력하는 신호 제어부와 이에 연결된 게이트 구동부 및 데이터 구동부를 포함한다. On the other hand, the LCD includes a signal controller for processing and outputting an image signal from the outside and a control signal for controlling its display, a gate driver and a data driver connected thereto.
신호 제어부는 입력 제어 신호로서 데이터의 존재 유무를 나타내는 데이터 인에이블 신호(DE) 신호를 받고 복수의 제어 신호를 만들기 위하여 다시 내부 데이터 인에이블 신호(이하에서는, "내부 DE"라 한다)를 생성한 다음 이를 기초로 각종 제어 신호를 만들어 게이트 구동부와 데이터 구동부에 각각 공급한다.The signal controller receives a data enable signal DE indicating the presence or absence of data as an input control signal and generates an internal data enable signal (hereinafter referred to as "internal DE") to generate a plurality of control signals. Next, various control signals are generated based on this and supplied to the gate driver and the data driver, respectively.
한편, 사용자가 표시 장치의 해상도를 바꾸거나 다른 이유 등으로 비정상적인 데이터 인에이블 신호(DE)가 입력되는 경우가 있다. On the other hand, an abnormal data enable signal DE may be input by the user by changing the resolution of the display device or by other reasons.
예를 들면, 해상도를 VGA(640×480)에서 XGA(1024×768)로 바꾸는 경우, 수직 해상도도 증가하지만 한 행의 화소 수에 해당하는 수평 해상도 또한 증가하게 된다. 이 때, 한 프레임 내에서 이전 데이터 인에이블 신호(DE)와 길이가 다른 이상 데이터 인에이블 신호(DE)가 발생하게 되면, 이 신호에 기초하여 내부 DE가 생 성되어 화면이 무너지거나 가로줄 등의 불량이 발생한다.For example, when changing the resolution from VGA (640 × 480) to XGA (1024 × 768), the vertical resolution also increases, but the horizontal resolution corresponding to the number of pixels in a row also increases. At this time, when an abnormal data enable signal DE having a length different from that of the previous data enable signal DE is generated within one frame, an internal DE is generated based on this signal, such that a screen collapses or a horizontal line is generated. Defect occurs.
따라서, 본 발명이 이루고자 하는 기술적 과제는 화면 불량이 표시되지 않도록 하는 액정 표시 장치의 구동 장치 및 방법을 제공하는 것이다.Accordingly, an object of the present invention is to provide a driving device and method for a liquid crystal display device to prevent display defects.
이러한 기술적 과제를 이루기 위한 본 발명의 한 실시예에 따른 액정 표시 장치는 스위칭 소자를 포함하는 복수의 화소, 신호 제어부 및 게이트 구동부를 포함한다. 상기 신호 제어부는 외부로부터 영상 신호 및 상기 영상 신호의 존재 유무를 나타내는 데이터 인에블 신호(DE)를 수신하며, 상기 데이터 인에이블 신호의 정상 여부를 판별하여 그 결과에 따른 복수의 제어 신호를 각각 출력하고, 상기 게이트 구동부는 상기 신호 제어부로부터의 제어 신호에 따라 상기 스위칭 소자를 턴 온시키는 게이트 온 전압을 출력한다. 여기서, 상기 복수의 제어 신호는 내부 데이터 인에이블 신호 및 출력 인에이블 신호(OE)를 포함하며, 상기 신호 제어부는 상기 데이터 인에이블 신호가 비정상인 경우에는 상기 내부 데이터 인에이블 신호 및 출력 인에이블 신호를 각각 로우(low) 및 하이(high)로 마스킹(masking)하는 것이 바람직하다. 또한, 상기 게이트 구동부는 상기 출력 인에이블 신호가 하이인 동안에는 상기 게이트 온 전압을 차단하는 것이 바람직하다.According to an exemplary embodiment of the present invention, a liquid crystal display includes a plurality of pixels including a switching element, a signal controller, and a gate driver. The signal controller receives an image signal and a data enable signal DE indicating whether the image signal is present from the outside, determines whether the data enable signal is normal, and supplies a plurality of control signals according to the result. The gate driver outputs a gate-on voltage for turning on the switching element according to a control signal from the signal controller. Here, the plurality of control signals include an internal data enable signal and an output enable signal OE, and the signal controller may be configured to output the internal data enable signal and the output enable signal when the data enable signal is abnormal. It is desirable to mask the low and high, respectively. The gate driver may block the gate-on voltage while the output enable signal is high.
본 발명의 다른 실시예에 따른 액정 표시 장치의 구동 방법은 외부로부터의 데이터 인에이블 신호의 정상 여부를 판별하는 단계, 상기 판별 결과에 따른 제어 신호를 출력하는 단계, 그리고 상기 제어 신호에 따라 게이트 온 전압을 출력하는 단계를 포함한다. 이 때, 상기 데이터 인에이블 신호의 정상 여부를 판별하는 단 계는 상기 데이터 인에이블 신호의 클록 수를 계수하는 단계, 그리고 소정 범위의 클록 수는 정상으로 판별하고, 그 이외의 클록 수는 비정상으로 판별하는 단계를 포함하는 것이 바람직하다. 또한, 상기 제어 신호는 내부 데이터 인에이블 신호 및 출력 인에이블 신호를 포함할 수 있으며, 상기 판별 결과에 따른 제어 신호를 출력하는 단계는 상기 데이터 인에이블 신호가 비정상인 경우에 상기 내부 데이터 인에이블 신호 및 출력 인에이블 신호를 로우 및 하이로 각각 마스킹하는 단계를 포함하는 것이 바람직하며, 상기 제어 신호에 따른 게이트 온 전압을 출력하는 단계는 상기 출력 인에이블 신호가 하이인 동안에는 상기 게이트 온 전압을 출력하지 않는 단계를 포함하는 것이 바람직하다.According to another exemplary embodiment of the present invention, a method of driving a liquid crystal display includes determining whether a data enable signal from an external device is normal, outputting a control signal according to the determination result, and gate-on according to the control signal. Outputting a voltage. In this case, the step of determining whether the data enable signal is normal may include counting the number of clocks of the data enable signal and determining the number of clocks in a predetermined range as normal, and the number of other clocks is abnormal. It is preferable to include the step of determining. The control signal may include an internal data enable signal and an output enable signal. The outputting of the control signal according to the determination result may include the internal data enable signal when the data enable signal is abnormal. And masking an output enable signal low and high, respectively, wherein outputting the gate on voltage according to the control signal does not output the gate on voltage while the output enable signal is high. It is preferred to include a step that does not.
첨부한 도면을 참고로 하여 본 발명의 실시예에 대하여 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자가 용이하게 실시할 수 있도록 상세히 설명한다. DETAILED DESCRIPTION Embodiments of the present invention will be described in detail with reference to the accompanying drawings so that those skilled in the art may easily implement the present invention.
도면에서 여러 층 및 영역을 명확하게 표현하기 위하여 두께를 확대하여 나타내었다. 명세서 전체를 통하여 유사한 부분에 대해서는 동일한 도면 부호를 붙였다. 층, 막, 영역, 판 등의 부분이 다른 부분 "위에" 있다고 할 때, 이는 다른 부분 "바로 위에" 있는 경우뿐 아니라 그 중간에 또다른 부분이 있는 경우도 포함한다. 반대로 어떤 부분이 다른 부분 "바로 위에" 있다고 할 때에는 중간에 다른 부분이 없는 것을 뜻한다.In the drawings, the thickness of layers, films, panels, regions, etc., are exaggerated for clarity. Like parts are designated by like reference numerals throughout the specification. When a portion of a layer, film, region, plate, etc. is said to be "on top" of another part, this includes not only when the other part is "right on" but also another part in the middle. On the contrary, when a part is "just above" another part, there is no other part in the middle.
이제 본 발명의 실시예에 따른 액정 표시 장치의 구동 장치 및 방법에 대하여 도면을 참고로 하여 상세하게 설명한다. Now, a driving apparatus and method of a liquid crystal display according to an exemplary embodiment of the present invention will be described in detail with reference to the accompanying drawings.
도 1은 본 발명의 한 실시예에 따른 액정 표시 장치의 블록도이고, 도 2는 본 발명의 한 실시예에 따른 액정 표시 장치의 한 화소에 대한 등가 회로도이다.FIG. 1 is a block diagram of a liquid crystal display device according to an embodiment of the present invention, and FIG. 2 is an equivalent circuit diagram of a pixel of a liquid crystal display device according to an embodiment of the present invention.
도 1에 도시한 바와 같이, 본 발명의 한 실시예에 따른 액정 표시 장치는 액정 표시판 조립체(liquid crystal panel assembly)(300) 및 이에 연결된 게이트 구동부(400), 데이터 구동부(500), 데이터 구동부(500)에 연결된 계조 전압 생성부(800) 그리고 이들을 제어하는 신호 제어부(600)를 포함한다.As shown in FIG. 1, a liquid crystal display according to an exemplary embodiment of the present invention includes a liquid
액정 표시판 조립체(300)는 등가 회로로 볼 때 복수의 표시 신호선(G1-Gn, D1-Dm)과 이에 연결되어 있으며 대략 행렬의 형태로 배열된 복수의 화소(pixel)를 포함한다.The liquid
표시 신호선(G1-Gn, D1-Dm)은 게이트 신호("주사 신호"라고도 함)를 전달하는 복수의 게이트선(G1-Gn)과 데이터 신호를 전달하는 데이터 신호선 또는 데이터선(D1-Dm)을 포함한다. 게이트선(G1-Gn)은 대략 행 방향으로 뻗어 있으며 서로가 거의 평행하고 데이터선(D1-Dm)은 대략 열 방향으로 뻗어 있으며 서로가 거의 평행하다.The display signal lines G 1 -G n and D 1 -D m are a plurality of gate lines G 1 -G n for transmitting a gate signal (also called a “scan signal”) and a data signal line or data for transmitting a data signal. Line D 1 -D m . The gate lines G 1 -G n extend substantially in the row direction and are substantially parallel to each other, and the data lines D 1 -D m extend substantially in the column direction and are substantially parallel to each other.
각 화소는 표시 신호선(G1-Gn, D1-Dm)에 연결된 스위칭 소자(Q)와 이에 연결된 액정 축전기(liquid crystal capacitor)(CLC) 및 유지 축전기(storage capacitor)(CST)를 포함한다. 유지 축전기(CST)는 필요에 따라 생략할 수 있다. Each pixel includes a switching element Q connected to a display signal line G 1 -G n , D 1 -D m , and a liquid crystal capacitor C LC and a storage capacitor C ST connected thereto. It includes. The holding capacitor C ST can be omitted as necessary.
스위칭 소자(Q)는 하부 표시판(100)에 구비되어 있으며, 삼단자 소자로서 그 제어 단자 및 입력 단자는 각각 게이트선(G1-Gn) 및 데이터선(D1-D
m)에 연결되어 있으며, 출력 단자는 액정 축전기(CLC) 및 유지 축전기(CST)에 연결되어 있다.The switching element Q is provided on the
액정 축전기(CLC)는 하부 표시판(100)의 화소 전극(190)과 상부 표시판(200)의 공통 전극(270)을 두 단자로 하며 두 전극(190, 270) 사이의 액정층(3)은 유전체로서 기능한다. 화소 전극(190)은 스위칭 소자(Q)에 연결되며 공통 전극(270)은 상부 표시판(200)의 전면에 형성되어 있고 공통 전압(Vcom)을 인가받는다. 도 2에서와는 달리 공통 전극(270)이 하부 표시판(100)에 구비되는 경우도 있으며 이때에는 두 전극(190, 270)이 모두 선형 또는 막대형으로 만들어진다.The liquid crystal capacitor C LC has two terminals, the
유지 축전기(CST)는 하부 표시판(100)에 구비된 별개의 신호선(도시하지 않음)과 화소 전극(190)이 중첩되어 이루어지며 이 별개의 신호선에는 공통 전압(Vcom) 따위의 정해진 전압이 인가된다. 그러나 유지 축전기(CST)는 화소 전극(190)이 절연체를 매개로 바로 위의 전단 게이트선과 중첩되어 이루어질 수 있다.The storage capacitor C ST is formed by overlapping a separate signal line (not shown) and the
한편, 색 표시를 구현하기 위해서는 각 화소가 색상을 표시할 수 있도록 하여야 하는데, 이는 화소 전극(190)에 대응하는 영역에 적색, 녹색, 또는 청색의 색 필터(230)를 구비함으로써 가능하다. 도 2에서 색 필터(230)는 상부 표시판(200)의 해당 영역에 형성되어 있지만 이와는 달리 하부 표시판(100)의 화소 전극(190) 위 또는 아래에 형성할 수도 있다.Meanwhile, in order to implement color display, each pixel must display color, which is possible by providing a red, green, or
액정 표시판 조립체(300)의 두 표시판(100, 200) 중 적어도 하나의 바깥 면에는 빛을 편광시키는 편광자(도시하지 않음)가 부착되어 있다.A polarizer (not shown) for polarizing light is attached to an outer surface of at least one of the two
계조 전압 생성부(800)는 화소의 투과율과 관련된 두 벌의 복수 계조 전압을 생성한다. 두 벌 중 한 벌은 공통 전압(Vcom)에 대하여 양의 값을 가지고 다른 한 벌은 음의 값을 가진다.The
게이트 구동부(400)는 액정 표시판 조립체(300)의 게이트선(G1-Gn)에 연결되어 외부로부터의 게이트 온 전압(Von)과 게이트 오프 전압(Voff)의 조합으로 이루어진 게이트 신호를 게이트선(G1-Gn)에 인가한다.The
데이터 구동부(500)는 액정 표시판 조립체(300)의 데이터선(D1-Dm)에 연결되어 계조 전압 생성부(800)로부터의 계조 전압을 선택하여 데이터 신호로서 화소에 인가하며 통상 복수의 집적 회로로 이루어진다. The
신호 제어부(600)는 게이트 구동부(400) 및 데이터 구동부(500) 등의 동작을 제어하는 제어 신호를 생성하여, 각 해당하는 제어 신호를 게이트 구동부(400) 및 데이터 구동부(500)에 제공한다.The
그러면 이러한 액정 표시 장치의 표시 동작에 대하여 좀더 상세하게 설명한다.Next, the display operation of the liquid crystal display will be described in more detail.
신호 제어부(600)는 외부의 그래픽 제어기(도시하지 않음)로부터 RGB 영상 신호(R, G, B) 및 이의 표시를 제어하는 입력 제어 신호, 예를 들면 수직 동기 신호(Vsync)와 수평 동기 신호(Hsync), 메인 클록(MCLK), 데이터 인에이블 신호(DE) 등을 제공받는다. 신호 제어부(600)는 입력 제어 신호를 기초로 게이트 제어 신호(CONT1) 및 데이터 제어 신호(CONT2) 등을 생성하고 영상 신호(R, G, B)를 액정 표시판 조립체(300)의 동작 조건에 맞게 적절히 처리한 후, 게이트 제어 신호(CONT1)를 게이트 구동부(400)로 내보내고 데이터 제어 신호(CONT2)와 처리한 영상 신호(R', G', B')는 데이터 구동부(500)로 내보낸다.The
게이트 제어 신호(CONT1)는 게이트 온 펄스(게이트 온 전압 구간)의 출력 시작을 지시하는 수직 동기 시작 신호(STV), 게이트 온 펄스의 출력 시기를 제어하는 게이트 클록 신호(CPV) 및 게이트 온 펄스의 폭을 한정하는 출력 인에이블 신호(OE) 등을 포함한다. The gate control signal CONT1 includes a vertical synchronization start signal STV indicating the start of output of the gate on pulse (gate on voltage section), a gate clock signal CPV for controlling the output timing of the gate on pulse, and a gate on pulse. An output enable signal OE or the like that defines a width.
여기서, 출력 제어 신호(OE)는 게이트 구동부(400)가 게이트 클록 신호(CPV)에 동기하여 게이트 온 전압(Von)을 출력하는 폭을 조절하기 위한 신호이다. 원래는 게이트 구동부(400)가 게이트 클록 신호(CPV)에 동기하여 게이트 전압(Von)을 1H 주기로 게이트선(G1-Gn)으로 공급하여야 하나, 게이트 구동부(400)는 출력 인에이블 신호(OE)가 특정 레벨인 시간 동안 게이트 전압(Von) 출력을 중지하여 각 게이트선(G1-Gn)으로 인가되는 게이트 온 전압(Von)이 중첩이 이루어지지 않도록 한다.
The output control signal OE is a signal for adjusting the width at which the
데이터 제어 신호(CONT2)는 영상 데이터(R', G', B')의 입력 시작을 지시하는 수평 동기 시작 신호(STH)와 데이터선(D1-Dm)에 해당 데이터 전압을 인가하라는 로드 신호(TP), 공통 전압(Vcom)에 대한 데이터 전압의 극성(이하 "공통 전압에 대한 데이터 전압의 극성"을 줄여 "데이터 전압의 극성"이라 함)을 반전시키는 반전 신호(RVS) 및 데이터 클록 신호(HCLK) 등을 포함한다.The data control signal CONT2 is a load for applying a corresponding data voltage to the horizontal synchronization start signal STH indicating the start of input of the image data R ', G', and B 'and the data lines D 1 -D m . Signal TP, inverted signal RVS and data inverting the polarity of the data voltage relative to the common voltage V com (hereinafter referred to as " polarity of data voltage " by reducing " polarity of data voltage relative to common voltage "). Clock signal HCLK and the like.
데이터 구동부(500)는 신호 제어부(600)로부터의 데이터 제어 신호(CONT2)에 따라 한 행의 화소에 대응하는 영상 데이터(R', G', B')를 차례로 입력받고, 계조 전압 생성부(800)로부터의 계조 전압 중 각 영상 데이터(R', G', B')에 대응하는 계조 전압을 선택함으로써, 영상 데이터(R', G', B')를 해당 데이터 전압으로 변환한다.The
게이트 구동부(400)는 신호 제어부(600)로부터의 게이트 제어 신호(CONT1)에 따라 게이트 온 전압(Von)을 게이트선(G1-Gn)에 인가하여 이 게이트선(G
1-Gn)에 연결된 스위칭 소자(Q)를 턴온시킨다.The
하나의 게이트선(G1-Gn)에 게이트 온 전압(Von)이 인가되어 이에 연결된 한 행의 스위칭 소자(Q)가 턴 온되어 있는 동안[이 기간을 "1H" 또는 "1 수평 주기(horizontal period)"이라고 하며 수평 동기 신호(Hsync), 데이터 인에이블 신호(DE), 게이트 클록(CPV)의 한 주기와 동일함], 데이터 구동부(500)는 각 데이터 전압을 해당 데이터선(D1-Dm)에 공급한다. 데이터선(D1-Dm )에 공급된 데이터 전 압은 턴온된 스위칭 소자(Q)를 통해 해당 화소에 인가된다.The gate-on voltage V on is applied to one gate line G 1 -G n so that a row of switching elements Q connected thereto is turned on (this period is "1H" or "1 horizontal period). (horizontal period) "and the same as one period of the horizontal sync signal (H sync ), the data enable signal (DE), and the gate clock (CPV)]. D 1 -D m ). The data voltage supplied to the data lines D 1 -D m is applied to the corresponding pixel through the turned-on switching element Q.
액정 분자들은 화소 전극(190)과 공통 전극(270)이 생성하는 전기장의 변화에 따라 그 배열을 바꾸고 이에 따라 액정층(3)을 통과하는 빛의 편광이 변화한다. 이러한 편광의 변화는 표시판(100, 200)에 부착된 편광자(도시하지 않음)에 의하여 빛의 투과율 변화로 나타난다.The liquid crystal molecules change their arrangement according to the electric field generated by the
이러한 방식으로, 한 프레임(frame) 동안 모든 게이트선(G1-Gn)에 대하여 차례로 게이트 온 전압(Von)을 인가하여 모든 화소에 데이터 전압을 인가한다. 한 프레임이 끝나면 다음 프레임이 시작되고 각 화소에 인가되는 데이터 전압의 극성이 이전 프레임에서의 극성과 반대가 되도록 데이터 구동부(500)에 인가되는 반전 신호(RVS)의 상태가 제어된다("프레임 반전"). 이때, 한 프레임 내에서도 반전 신호(RVS)의 특성에 따라 한 데이터선을 통하여 흐르는 데이터 전압의 극성이 바뀌거나("라인 반전"), 한 화소행에 인가되는 데이터 전압의 극성도 서로 다를 수 있다("도트 반전").In this manner, the gate-on voltages V on are sequentially applied to all the gate lines G 1 -G n during one frame to apply data voltages to all the pixels. At the end of one frame, the next frame starts and the state of the inversion signal RVS applied to the
한편, 본 발명의 한 실시예에 따른 신호 제어부(600)는 비정상 데이터 인에이블 신호(DE)가 입력되는 경우, 출력 인에이블 신호(OE)를 신호를 하이로 마스킹(masking)하여 출력하는데 이에 대하여 도 3a 및 도 3b를 참조하여 상세히 설명한다.Meanwhile, when the abnormal data enable signal DE is input, the
도 3a 및 도 3b는 본 발명의 한 실시예에 따른 신호의 파형도이다. 도 3a는 한 프레임 동안의 신호 파형도이고, 도 3b는 프레임과 프레임 사이의 신호 파형도 이다.3A and 3B are waveform diagrams of signals in accordance with one embodiment of the present invention. 3A is a signal waveform diagram for one frame, and FIG. 3B is a signal waveform diagram between frames.
신호 제어부(600)는 데이터 인에이블 신호(DE)를 받아 정상 여부를 판별한다. 이러한 판별은 데이터 인에이블 신호(DE)의 클록(MCLK)의 수효를 계수함으로써 이루어지며, 일정 범위를 정하여 이 범위에 속하면 정상으로 아니면 비정상으로 판별한다. The
데이터 인에이블 신호(DE)가 정상인 경우에는 통상의 동작과 마찬가지로 내부 데이터 인에이블 신호(DE)를 생성하고 이에 기초하여 출력 인에이블 신호(OE)를 비롯한 각종 제어 신호를 생성한 후, 게이트 구동부(400)와 데이터 구동부(500)로 내보낸다.When the data enable signal DE is normal, the internal data enable signal DE is generated in the same manner as in the normal operation, and various control signals including the output enable signal OE are generated based on the gate enable unit. 400 and the
한편, 데이터 인에이블 신호(DE)가 비정상인 경우에는 내부 데이터 인에이블 신호(DE)를 로우(low)로 마스킹한 후, 출력 인에이블 신호(OE)를 하이(high)로 마스킹한다. 전술한 바와 같이, 출력 인에이블 신호(OE)가 하이인 동안은 게이트 온 전압(Von)이 출력되지 않게 한다. 따라서, 게이트 온 전압(Von)이 스위칭 소자(Q)에 인가되지 않음으로써 결국 스위칭 소자(Q)는 턴 오프 상태를 유지하고, 데이터 구동부(500)가 내보내는 데이터 전압이 화소에 인가되지 않게 되어 화면에는 아무것도 표시되지 않는다. On the other hand, when the data enable signal DE is abnormal, the internal data enable signal DE is masked low, and then the output enable signal OE is masked high. As described above, the gate-on voltage V on is not output while the output enable signal OE is high. Therefore, the gate-on voltage V on is not applied to the switching element Q, so that the switching element Q is maintained in the turn-off state and the data voltage emitted from the
다시 말하면, 이상 데이터 인에이블 신호(DE)가 발생한 경우 신호 사이의 동기가 이루어지지 않아 화면의 무너짐 현상이나 깜박거림 현상이 화면에 표시되는데, 출력 인에이블 신호(OE)를 하이로 마스킹하여 게이트 온 전압(Von)의 출력을 차 단함으로써 이러한 현상이 화면에 표시되지 않게 한다. 즉, 도 3a에서, 로드 신호(TP)가 인가되어 데이터 구동부(500)가 데이터 전압을 공급하더라도 스위칭 소자(Q)가 턴 오프 상태를 유지하므로, 결국 화소에 데이터 전압이 인가되지 않음을 알 수 있다.In other words, when the abnormal data enable signal DE is generated, the screen is not synchronized and flickering occurs on the screen. The output enable signal OE is masked high to gate on. By blocking the output of voltage (V on ), this phenomenon is not displayed on the screen. That is, in FIG. 3A, even when the load signal TP is applied to the
한편, 도 3b에서, 프레임과 프레임 사이에도 출력 인에이블 신호(OE)를 하이로 마스킹하여 게이트 온 전압(Von)의 출력을 차단할 수 있으며, 출력 인에이블 신호(OE)의 마스킹 시기도 조절할 수 있다. 이는 이상 데이터 인에이블 신호(DE)가 발생하는 경우에는 데이터가 존재하지 않는 수직 블랭크 구간에도 계속적으로 게이트 구동부(400)가 동작하여 게이트 온 전압(Von)을 출력하는 경우에 이를 차단하기 위함이며, 도면에 점선으로 나타낸 부분과 같이 임의의 시기를 지정하여 출력 인에이블 신호(OE)를 마스킹함으로써 마스킹 시기를 조절하여 여유를 줄 수도 있다.Meanwhile, in FIG. 3B, the output enable signal OE may be masked high between the frame and the frame to block the output of the gate-on voltage V on , and the masking timing of the output enable signal OE may also be adjusted. have. This is to block when the
전술한 바와 같이, 이상 데이터 인에이블 신호(DE)가 입력되는 경우, 먼저 내부 데이터 인에이블 신호를 로우로 마스킹하고 이어 출력 인에이블 신호(OE)를 하이로 마스킹하여 게이트 온 전압(Von)의 출력을 차단함으로써, 화면 무너짐이나 가로줄 등의 이상 현상이 화면에 표시되는 것을 방지할 수 있다.As described above, when the abnormal data enable signal DE is input, the internal data enable signal is first masked low, and then the output enable signal OE is masked high so that the gate on voltage V on By blocking the output, abnormal phenomenon such as screen collapse or horizontal line can be prevented from being displayed on the screen.
이상에서 본 발명의 바람직한 실시예에 대하여 상세하게 설명하였지만 본 발명의 권리범위는 이에 한정되는 것은 아니고 다음의 청구범위에서 정의하고 있는 본 발명의 기본 개념을 이용한 당업자의 여러 변형 및 개량 형태 또한 본 발명의 권리범위에 속하는 것이다.
Although the preferred embodiments of the present invention have been described in detail above, the scope of the present invention is not limited thereto, and various modifications and improvements of those skilled in the art using the basic concepts of the present invention defined in the following claims are also provided. It belongs to the scope of rights.
Claims (7)
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