KR100920374B1 - Liquid crystal display and method of dirving the same - Google Patents

Liquid crystal display and method of dirving the same Download PDF

Info

Publication number
KR100920374B1
KR100920374B1 KR1020020080219A KR20020080219A KR100920374B1 KR 100920374 B1 KR100920374 B1 KR 100920374B1 KR 1020020080219 A KR1020020080219 A KR 1020020080219A KR 20020080219 A KR20020080219 A KR 20020080219A KR 100920374 B1 KR100920374 B1 KR 100920374B1
Authority
KR
South Korea
Prior art keywords
liquid crystal
pixel signal
gate lines
supplied
blank period
Prior art date
Application number
KR1020020080219A
Other languages
Korean (ko)
Other versions
KR20040052348A (en
Inventor
이상열
김우현
Original Assignee
엘지디스플레이 주식회사
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by 엘지디스플레이 주식회사 filed Critical 엘지디스플레이 주식회사
Priority to KR1020020080219A priority Critical patent/KR100920374B1/en
Publication of KR20040052348A publication Critical patent/KR20040052348A/en
Application granted granted Critical
Publication of KR100920374B1 publication Critical patent/KR100920374B1/en

Links

Images

Classifications

    • GPHYSICS
    • G09EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09GARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G3/00Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
    • G09G3/20Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
    • G09G3/34Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source
    • G09G3/36Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source using liquid crystals
    • G09G3/3611Control of matrices with row and column drivers
    • G09G3/3648Control of matrices with row and column drivers using an active matrix
    • GPHYSICS
    • G09EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09GARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G2300/00Aspects of the constitution of display devices
    • G09G2300/04Structural and physical details of display devices
    • G09G2300/0404Matrix technologies
    • G09G2300/0413Details of dummy pixels or dummy lines in flat panels
    • GPHYSICS
    • G09EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09GARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G2310/00Command of the display device
    • G09G2310/02Addressing, scanning or driving the display screen or processing steps related thereto
    • G09G2310/0202Addressing of scan or signal lines
    • G09G2310/0205Simultaneous scanning of several lines in flat panels

Landscapes

  • Engineering & Computer Science (AREA)
  • Chemical & Material Sciences (AREA)
  • Crystallography & Structural Chemistry (AREA)
  • Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • General Physics & Mathematics (AREA)
  • Theoretical Computer Science (AREA)
  • Control Of Indicators Other Than Cathode Ray Tubes (AREA)

Abstract

본 발명은 화질저하 없이 잔상을 방지할 수 있도록 한 액정 표시 장치에 관한 것이다.The present invention relates to a liquid crystal display device capable of preventing afterimages without deteriorating image quality.

본 발명의 액정표시장치는 게이트라인들과 데이터라인들의 교차부에 형성되는 액정셀들과, 공통전압 생성부로부터의 기준전압을 액정셀들로 공급하기 위한 공통전극라인과, 유효데이터 공급기간동안 유효한 화소신호를 데이터라인들에 공급함과 아울러 블랭크 기간동안 액정셀들에 잔존하는 전하들을 방전시키기 위한 방전전압을 갖는 더미 화소신호를 상기 데이터라인들로 공급하기 위한 데이터 드라이버와, 블랭크 기간동안 다수의 게이트라인들 중 적어도 하나 이상의 게이트라인으로 스캔펄스를 공급하기 위한 게이트 드라이버를 구비한다.
The liquid crystal display of the present invention includes liquid crystal cells formed at intersections of gate lines and data lines, a common electrode line for supplying a reference voltage from the common voltage generator to the liquid crystal cells, and a valid data supply period. A data driver for supplying a valid pixel signal to the data lines and supplying a dummy pixel signal having a discharge voltage for discharging charges remaining in the liquid crystal cells during the blank period to the data lines; And a gate driver for supplying scan pulses to at least one of the gate lines.

Description

액정표시장치 및 그 구동방법{LIQUID CRYSTAL DISPLAY AND METHOD OF DIRVING THE SAME} Liquid crystal display and its driving method {LIQUID CRYSTAL DISPLAY AND METHOD OF DIRVING THE SAME}             

도 1은 통상적은 인 플레인 스위치 모드의 액정표시장치를 나타내는 도면. 1 is a view showing a liquid crystal display device in a conventional in-plane switch mode.

도 2는 도 1에 도시된 공통전극라인에 공급되는 구동파형을 도시한 파형도.FIG. 2 is a waveform diagram illustrating driving waveforms supplied to a common electrode line illustrated in FIG. 1.

도 3a 및 도 3b는 본 발명의 실시예에 의해 데이터라인으로 공급되는 화소신호를 나타내는 파형도.3A and 3B are waveform diagrams showing pixel signals supplied to data lines according to an embodiment of the present invention.

도 4a 및 4b는 제 1실시예에 의하여 블랭크 기간에 게이트라인들로 스캔펄스가 공급되는 순서를 나타내는 도면4A and 4B illustrate an order in which scan pulses are supplied to gate lines in a blank period according to the first embodiment;

도 5a 및 도 5b는 제 2실시예에 의하여 블랭크 기간에 게이트라인들로 스캔펄스가 공급되는 순서를 나타내는 도면. 5A and 5B illustrate an order in which scan pulses are supplied to gate lines in a blank period according to a second embodiment;

도 6a 및 도 6b는 제 3실시에에 의하여 블랭크 기간에 게이트라인들로 스캔펄스가 공급되는 순서를 나타내는 도면.
6A and 6B illustrate an order in which scan pulses are supplied to gate lines in a blank period according to a third embodiment;

< 도면의 주요 부분에 대한 부호의 설명 ><Description of Symbols for Main Parts of Drawings>

12 : 액정패널 14 : 게이트 드라이버12 liquid crystal panel 14 gate driver

16 : 데이터 드라이버 18 : 공통전압 생성부
16: data driver 18: common voltage generator

본 발명은 액정표시장치 및 그 구동방법에 관한 것으로 특히, 화질저하 없이 잔상을 방지할 수 있도록 한 액정 표시 장치 및 그 구동방법에 관한 것이다.BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a liquid crystal display device and a driving method thereof, and more particularly, to a liquid crystal display device and a driving method thereof capable of preventing afterimages without deteriorating image quality.

액정표시장치는 전계를 이용하여 액정의 광투과율을 조절함으로써 화상을 표시하게 된다. 이를 위하여, 액정표시장치는 액정셀 매트릭스를 가지는 액정표시패널과, 그 액정표시패널을 구동하기 위한 구동회로를 구비한다.The liquid crystal display device displays an image by adjusting the light transmittance of the liquid crystal using an electric field. To this end, the liquid crystal display device includes a liquid crystal display panel having a liquid crystal cell matrix, and a driving circuit for driving the liquid crystal display panel.

이러한, 액정표시장치는 액정을 구동시키는 전계의 방향에 따라 수직방향 전계를 이용하여 액정을 구동하는 TN(Twisted Nematic)모드와 수평방향 전계를 이용하여 액정을 구동하는 인 플레인 스위치(In Plane Switch : 이하 "IPS"라 함)모드로 대별된다.Such a liquid crystal display device includes a twisted nematic (TN) mode for driving a liquid crystal using a vertical electric field according to a direction of an electric field for driving a liquid crystal, and an in-plane switch for driving a liquid crystal using a horizontal electric field. (Hereinafter referred to as " IPS ") mode.

TN 모드 액정표시장치는 상/하부 기판에 대향되게 배치된 화소전극과 공통전극간의 수직전계에 의해 액정을 구동하는 모드로 개구율이 큰 장점을 가지는 반면 시야각이 좁은 단점을 가진다. IPS 모드는 하부기판에 나란하게 배치된 화소전극과 공통전극간의 수평전계에 의해 액정을 구동하는 모드로 시야각이 큰 장점을 가지는 반면 개구율이 작은 단점을 가진다. The TN mode liquid crystal display is a mode in which a liquid crystal is driven by a vertical electric field between a pixel electrode and a common electrode disposed to face the upper and lower substrates, and has a large aperture ratio but a narrow viewing angle. The IPS mode is a mode in which a liquid crystal is driven by a horizontal electric field between a pixel electrode and a common electrode arranged side by side on a lower substrate, and has a large viewing angle, but a small aperture ratio.

도 1은 종래의 일반적은 IPS 모드 액정표시장치를 등가적으로 나타내는 평면도이다. 1 is a plan view equivalently showing a conventional general IPS mode liquid crystal display.                         

도 1을 참조하면, 종래의 IPS 모드 액정표시장치는 액정셀이 매트랙스 형태로 배열된 액정패널(12)과, 액정패널(12)의 게이트라인들(GL1 내지 GLn)을 구동하기 위한 게이트 드라이버(14)와, 액정패널(12)의 데이터라인들(DL1 내지 DLm)을 구동하기 위한 데이터 드라이버(16)와, 액정패널(12)의 공통전극라인들(CL1 내지 CLn)에 공통으로 접속된 공통전압 공급라인(CCL)과, 공통전압 공급라인(CCL)에 공통전압(Vcom)을 공급하기 위한 공통전압 생성부(18)를 구비한다. Referring to FIG. 1, a conventional IPS mode liquid crystal display device includes a liquid crystal panel 12 in which liquid crystal cells are arranged in a matrix form, and a gate driver for driving gate lines GL1 to GLn of the liquid crystal panel 12. 14, the data driver 16 for driving the data lines DL1 to DLm of the liquid crystal panel 12, and the common electrode lines CL1 to CLn of the liquid crystal panel 12 in common. The common voltage supply line CCL and a common voltage generator 18 for supplying the common voltage Vcom to the common voltage supply line CCL are provided.

액정패널(12)은 데이터라인들(DL1 내지 DLm)과 게이트라인들(GL1 내지 GLn)의 교차부마다 형성된 박막 트랜지스터(TFT)와, 박막 트랜지스터(TFT)와 공통전극라인(CL) 사이에 접속된 액정셀을 구비한다.The liquid crystal panel 12 is connected between the thin film transistor TFT formed at each intersection of the data lines DL1 to DLm and the gate lines GL1 to GLn, and is connected between the thin film transistor TFT and the common electrode line CL. Provided liquid crystal cell.

박막 트랜지스터(TFT)는 게이트라인(GL)으로부터의 스캔신호, 즉 게이트 하이 전압(VGH)이 공급되는 경우 턴-온되어 데이터라인(DL)으로부터의 화소신호를 액정셀에 공급한다. 그리고, 박막 트랜지스터(TFT)는 게이트라인(GL)으로부터 게이트 로우 전압(VGL)이 공급되는 경우 턴-오프되어 액정셀에 충전된 화소신호가 유지되게 한다.The thin film transistor TFT is turned on when the scan signal from the gate line GL, that is, the gate high voltage VGH is supplied, and supplies the pixel signal from the data line DL to the liquid crystal cell. The thin film transistor TFT is turned off when the gate low voltage VGL is supplied from the gate line GL to maintain the pixel signal charged in the liquid crystal cell.

액정셀은 박막 트랜지스터(TFT)의 드레인전극과 접속된 화소전극과, 화소전극과 액정을 사이에 두고 나란하게 배치되며 공통전극라인(CL)과 접속된 공통전극을 포함하게 되며, 등기적으로는 액정 캐패시터(Clc)로 표현된다. 또한, 액정셀은 충전된 화소신호가 다음 화소신호가 충전될 때까지 안정적으로 유지되게 하기 위하여 절연막을 사이에 두고 화소전극과 공통전극이 중첩되는 부분에 형성된 스토리지 캐패시터(Cst)를 더 구비한다. 이러한 액정셀은 공통전극라인(CL)을 통해 공통전 극에 공급된 공통전압(Vcom)과 박막 트랜지스터(TFT)를 통해 화소전극에 공급된 화소신호와의 전압차에 의해 형성되는 수평전계에 따라 액정셀의 배열상태를 가변하여 광 투과율을 조절함으로써 계조를 구현하게 된다.The liquid crystal cell includes a pixel electrode connected to the drain electrode of the thin film transistor TFT, a pixel electrode and a liquid crystal interposed therebetween, and a common electrode connected to the common electrode line CL. It is represented by liquid crystal capacitor Clc. In addition, the liquid crystal cell further includes a storage capacitor Cst formed at a portion where the pixel electrode and the common electrode overlap each other with an insulating layer therebetween so that the charged pixel signal is stably maintained until the next pixel signal is charged. The liquid crystal cell has a horizontal electric field formed by a voltage difference between the common voltage Vcom supplied to the common electrode through the common electrode line CL and the pixel signal supplied to the pixel electrode through the thin film transistor TFT. By adjusting the light transmittance by varying the arrangement of the liquid crystal cell to realize the gray scale.

게이트 드라이버(14)는 게이트라인들(GL1 내지 GLn)에 순차적으로 스캔신호를 공급하여 게이트라인(GL1 내지 GLn)에 접속된 박막 트랜지스터(TFT)가 게이트라인(GL) 단위로 구동되게 한다. The gate driver 14 sequentially supplies scan signals to the gate lines GL1 to GLn so that the thin film transistor TFT connected to the gate lines GL1 to GLn is driven in units of the gate line GL.

데이터 드라이버(16)는 타이밍 제어부(도시되지 않음)로부터 공급된 디지털 화소 데이터를 아날로그 화소신호로 변환하여 데이터라인들(DL1 내지 DLm)에 공급한다. The data driver 16 converts the digital pixel data supplied from the timing controller (not shown) into analog pixel signals and supplies them to the data lines DL1 to DLm.

공통전압 생성부(18)는 액정셀 구동시 기준전압이 되는 공통전압(Vcom)을 생성하여 공통전압공급라인(CCL)을 통해 공통전극라인들(CL1 내지 CLn)에 공급한다. The common voltage generator 18 generates a common voltage Vcom which becomes a reference voltage when driving the liquid crystal cell, and supplies the common voltage Vcom to the common electrode lines CL1 to CLn through the common voltage supply line CCL.

이러한, 종래의 IPS 액정표시장치의 액정셀 각각에서 화소전극과 공통전극에 의해 수평전계가 형성되는 경우 그 화소전극과 공통전극 사이의 절연막에 수평전계에 의한 전하가 축적되게 된다. 이렇게 절연막에 축적된 전하들로 인하여 화소전극 및 공통전극으로부터 액정으로 인가되는 구동전압이 지연됨으로써 IPS 모드의 액정표시장치에서는 잔상문제가 발생하고 있다. When the horizontal electric field is formed by the pixel electrode and the common electrode in each of the liquid crystal cells of the conventional IPS liquid crystal display device, the charge by the horizontal electric field is accumulated in the insulating film between the pixel electrode and the common electrode. Since the driving voltage applied to the liquid crystal from the pixel electrode and the common electrode is delayed due to the charges accumulated in the insulating layer, an afterimage problem occurs in the liquid crystal display of the IPS mode.

이러한 IPS모드 액정표시장치의 잔상문제를 해결하기 위하여 도 2에 도시된 바와 같이 프레임마다 유효한 화소신호가 액정패널(12)에 공급되지 않는 블랭크 기간(BP)에 공통전압(Vcom)을 펄스 구동하는 방법이 제안되었다.In order to solve the afterimage problem of the IPS mode liquid crystal display device, as shown in FIG. The method has been proposed.

도 2를 참조하면, 유효한 화소 데이터의 공급기간과 블랭크 기간(BP)을 지시 하는 데이터 이네이블 신호(DE)에 응답하여 블랭크 기간(BP)에서 공통전압(Vcom)을 레벨 다운시키게 된다. 이렇게 블랭크 기간(BP)에서 레벨 다운된 공통전압(Vcom)을 공통전극을 통해 모든 액정셀에 공급하여 화소전극과 공통전극 사이의 절연막에 축적된 전하들이 방전되게 함으로써 잔상문제를 해결할 수 있다. Referring to FIG. 2, the common voltage Vcom is lowered in the blank period BP in response to the data enable signal DE indicating the supply period of the valid pixel data and the blank period BP. The residual image problem can be solved by supplying the common voltage Vcom leveled down in the blank period BP to all liquid crystal cells through the common electrode to discharge the charges accumulated in the insulating film between the pixel electrode and the common electrode.

하지만, 이와 같은 종래의 공통전압(Vcom) 레벨 다운 방법에서는 이전 프레임((i-1)F)의 블랭크 기간(BP)에서 레벨 다운된 공통전압(Vcom)을 현재 프레임(iF)에서 정상 전압으로 레벨 업시키는 경우 소정의 지연시간(Δt)이 발생하게 된다. 이러한 지연시간(Δt)은 액정표시패널에 형성된 공통전극라인(CL)의 라인저항성분과, 그 공통전극라인(CL)과 데이터라인(DL) 간의 기생 캐패시터 성분의 의해 발생하게 된다. 이러한 지연시간(Δt)으로 인하여 현재 프레임(iF)에서 유효화소신호를 액정패널에 공급하기 시작하는 부분에서 공통전압(Vcom)이 왜곡됨으로써 화면의 상단부분이 상대적으로 밝아보이는 화질 저하 현상이 발생된다. 나아가, 공통전압(Vcom)의 지연시간(Δt)은 고해상도 화상을 표시하기 위하여 액정셀의 수가 증가하는 경우 더욱 길어지게 되므로 화면상단 밝음현상은 고해상도 액정표시장치의 경우 더욱 악화되게 된다.
However, in the conventional common voltage Vcom level down method, the common voltage Vcom leveled down in the blank period BP of the previous frame (i-1) F is changed from the current frame iF to the normal voltage. When the level is increased, a predetermined delay time Δt occurs. The delay time Δt is generated by the line resistance component of the common electrode line CL formed on the liquid crystal display panel and the parasitic capacitor component between the common electrode line CL and the data line DL. Due to this delay time Δt, the common voltage Vcom is distorted at the portion where the effective pixel signal starts to be supplied to the liquid crystal panel in the current frame iF, resulting in a deterioration of image quality in which the upper portion of the screen appears relatively bright. . Furthermore, since the delay time Δt of the common voltage Vcom becomes longer when the number of liquid crystal cells is increased to display a high resolution image, the brightness at the top of the screen becomes worse.

따라서, 본 발명의 목적은 화질저하 없이 잔상을 방지할 수 있도록 한 액정 표시 장치 및 그 구동방법을 제공하는 것이다.
Accordingly, an object of the present invention is to provide a liquid crystal display device and a driving method thereof capable of preventing afterimages without deteriorating image quality.

상기 목적을 달성하기 위하여 본 발명의 액정표시장치는 게이트라인들과 데이터라인들의 교차부에 형성되는 액정셀들과, 공통전압 생성부로부터의 기준전압을 액정셀들로 공급하기 위한 공통전극라인과, 유효데이터 공급기간동안 유효한 화소신호를 데이터라인들에 공급함과 아울러 블랭크 기간동안 액정셀들에 잔존하는 전하들을 방전시키기 위한 방전전압을 갖는 더미 화소신호를 상기 데이터라인들로 공급하기 위한 데이터 드라이버와, 블랭크 기간동안 다수의 게이트라인들 중 적어도 하나 이상의 게이트라인으로 스캔펄스를 공급하기 위한 게이트 드라이버를 구비한다. In order to achieve the above object, a liquid crystal display of the present invention includes liquid crystal cells formed at intersections of gate lines and data lines, a common electrode line for supplying a reference voltage from the common voltage generator to the liquid crystal cells; A data driver for supplying a pixel signal valid for a valid data supply period to the data lines and a dummy pixel signal having a discharge voltage for discharging charges remaining in the liquid crystal cells during the blank period to the data lines; And a gate driver for supplying scan pulses to at least one of the plurality of gate lines during the blank period.

상기 더미 화소신호는 다수의 그레이(Gray) 전압 중 잔존 전하들을 방전시킬 수 있는 전압레벨을 갖는 그레이 전압이 이용된다. As the dummy pixel signal, a gray voltage having a voltage level capable of discharging residual charges among a plurality of gray voltages is used.

상기 더미 화소신호는 화이트 화소신호 및 블랙 화소신호 중 어느 하나로 선택된다. The dummy pixel signal is selected from one of a white pixel signal and a black pixel signal.

상기 더미 화소신호는 정극성 및 부극성의 전압 중 어느 하나의 전압을 갖는다. The dummy pixel signal has one of positive and negative voltages.

상기 블랭크 기간동안 적어도 둘 이상의 게이트라인으로 스캔펄스가 공급될 때 스캔펄스는 동시에 공급된다. Scan pulses are simultaneously supplied when scan pulses are supplied to at least two gate lines during the blank period.

상기 게이트라인들은 다수의 블록으로 나뉘고, 블랭크 기간에는 다수의 블록 중 어느 하나의 블록에 포함된 게이트라인들로 동시에 스캔펄스가 공급된다. The gate lines are divided into a plurality of blocks, and a scan pulse is simultaneously supplied to gate lines included in any one of the plurality of blocks in a blank period.

상기 게이트라인들은 다수의 블록으로 나뉘고, 블랭크 기간에는 다수의 블록 에 각각 포함된 적어도 하나 이상의 게이트라인들로 동시에 스캔펄스가 공급된다. The gate lines are divided into a plurality of blocks, and a scan pulse is simultaneously supplied to at least one or more gate lines respectively included in the plurality of blocks in a blank period.

본 발명의 액정표시장치의 구동방법은 유효데이터 공급기간동안 유효한 화소신호가 데이터라인에 공급됨과 아울러 게이트라인에 스캔펄스가 공급되어 유효한 화소신호가 액정셀들로 공급되는 단계와, 블랭크 기간동안 다수의 게이트라인들 중 적어도 하나 이상의 게이트라인으로 스캔펄스가 공급되는 단계와, 블랭크 기간동안 데이터라인들로 액정셀에 잔존하는 전하들을 방전시키기 위한 방전전압을 갖는 더미 화소신호가 공급되는 단계를 포함한다. In the driving method of the liquid crystal display of the present invention, a valid pixel signal is supplied to a data line during a valid data supply period, a scan pulse is supplied to a gate line, and a valid pixel signal is supplied to liquid crystal cells, and a plurality of blank periods are provided during a blank period. A scan pulse is supplied to at least one of the gate lines of the gate lines, and a dummy pixel signal having a discharge voltage for discharging charges remaining in the liquid crystal cell to the data lines during the blank period is supplied. .

상기 블랭크 기간동안 적어도 둘 이상의 게이트라인으로 스캔펄스가 공급될 때 스캔펄스는 적어도 둘 이상의 게이트라인으로 동시에 공급된다. When the pulses are supplied to at least two gate lines during the blank period, the scan pulses are simultaneously supplied to at least two gate lines.

상기 목적 외에 본 발명의 다른 목적 및 특징들은 첨부도면을 참조한 실시예에 대한 설명을 통하여 명백하게 드러나게 될 것이다.Other objects and features of the present invention in addition to the above objects will become apparent from the description of the embodiments with reference to the accompanying drawings.

이하 도 3a 내지 도 6b를 참조하여 본 발명의 바람직한 실시예에 대하여 설명하기로 한다.Hereinafter, exemplary embodiments of the present invention will be described with reference to FIGS. 3A to 6B.

도 3a 및 도 3b는 본 발명의 실시예에 의한 액정표시장치의 구동파형을 나타내는 도면이다.3A and 3B illustrate driving waveforms of the liquid crystal display according to the exemplary embodiment of the present invention.

도 3a를 참조하면, 데이터 인에이블 신호(DE)로 인하여 액정표시장치는 유효데이터 공급기간과 블랭크 기간(BP)으로 나뉘어진다. 유효데이터 공급기간에는 액정셀들로 유효화소신호가 공급되어 소정의 화상을 표시한다. 블랭크 기간(BP)에는 액정셀들로 더미 화소신호가 공급되어 화소전극과 공통전극 사이의 절연막에 축적된 전하들이 방전된다. 이와 같이 블랭크 기간(BP)동안 절연막에 축적된 전하들이 제거되면 액정패널에서의 잔상문제를 해결할 수 있다.Referring to FIG. 3A, the liquid crystal display is divided into a valid data supply period and a blank period BP due to the data enable signal DE. In the valid data supply period, an effective pixel signal is supplied to the liquid crystal cells to display a predetermined image. In the blank period BP, the dummy pixel signal is supplied to the liquid crystal cells to discharge charges accumulated in the insulating film between the pixel electrode and the common electrode. As such, when the charges accumulated in the insulating layer are removed during the blank period BP, the afterimage problem in the liquid crystal panel may be solved.

이를 상세히 설명하면, 유효데이터 공급기간에는 인버젼 방식에 의하여 데이터 라인들로 소정의 정극성 및/또는 부극성 유효화소신호들이 공급된다. 이때 게이트라인들은 순차적으로 구동되면서 데이터라인들로 공급된 유효화소신호들이 액정셀들로 공급되게 하고, 이에 따라 액정셀들이 구동되면서 소정의 화상이 표시되게 된다.In detail, in the valid data supply period, predetermined positive and / or negative active pixel signals are supplied to the data lines by the inversion scheme. At this time, the gate lines are sequentially driven so that the effective pixel signals supplied to the data lines are supplied to the liquid crystal cells, and as a result, a predetermined image is displayed while the liquid crystal cells are driven.

블랭크 기간(BP)에는 도시되지 않은 데이터 드라이버로부터 데이터라인들로 더미 화소신호가 공급된다. 또한, 블랭크 기간(BP)에는 도시되지 않은 게이트 드라이버로부터 다수의 게이트라인들 중 적어도 하나 이상의 게이트라인으로 스캔신호가 공급된다. 이때, 스캔신호를 공급받은 게이트라인들과 접속된 액정셀들로 부극성의 더미 화소신호가 공급된다. 예를 들어, i(i는 자연수)번째 게이트라인으로 스캔신호가 공급되었다면 i번째 수평라인에 위치된 액정셀들로 부극성의 더미 화소신호가 공급된다. 여기서, 더미 화소신호를 공급받은 액정셀들은 각각은 자신의 화소전극과 공통전극 사이의 절연막에 축적된 전하들을 방전한다.In the blank period BP, a dummy pixel signal is supplied to data lines from a data driver (not shown). In addition, during the blank period BP, a scan signal is supplied from at least one gate driver to at least one of the plurality of gate lines. In this case, the negative dummy pixel signal is supplied to the liquid crystal cells connected to the gate lines receiving the scan signal. For example, when a scan signal is supplied to an i (i is a natural number) gate line, a negative dummy pixel signal is supplied to liquid crystal cells positioned on an i th horizontal line. Here, each of the liquid crystal cells supplied with the dummy pixel signal discharges the charges accumulated in the insulating film between its pixel electrode and the common electrode.

즉, 본 발명에서는 블랭크 기간(BP)동안 데이터라인들로 더미 화소신호를 공급하여 잔상이 발생되는 것을 방지한다. 따라서, 본 발명에서는 종래와 같이 공통전압(Vcom)의 딜레이로 인하여 액정패널의 상측부분이 밝아보이는 현상을 방지할 수 있다. 다시 말하여, 본 발명에서는 화질저하 현상없이 잔상문제를 해결할 수 있다. That is, in the present invention, after the dummy pixel signal is supplied to the data lines during the blank period BP, the afterimage is prevented from occurring. Therefore, in the present invention, it is possible to prevent the upper portion of the liquid crystal panel from appearing bright due to the delay of the common voltage Vcom. In other words, in the present invention, the afterimage problem can be solved without any deterioration in image quality.

한편, 부극성의 더미 화소신호는 액정셀의 절연막에 축적된 전하를 방전할 수 있는 어떠한 그레이(Gray)의 전압도 가능하다. 예를 들어, 더미 화소신호는 블랙 화소신호 또는 화이트 화소신호 중 어느 하나로 정해질 수 있다.On the other hand, the negative dummy pixel signal may be any gray voltage capable of discharging the charge accumulated in the insulating film of the liquid crystal cell. For example, the dummy pixel signal may be determined as either a black pixel signal or a white pixel signal.

아울러, 본 발명에서는 도 3b와 같이 블랭크 기간(BP)에 데이터라인으로 액정셀에 축적된 전하들을 방전할 수 있는 정극성의 더미 화소신호가 공급될 수 있다. 여기서, 정극성 더미 화소신호는 액정셀의 절연막에 축적된 전하를 방전할 수 있는 어떠한 그레이(Gray)의 전압도 가능하다. 예를 들어, 더미 화소신호는 블랙 화소신호 또는 화이트 화소신호 중 어느 하나로 정해질 수 있다.In addition, in the present invention, as shown in FIG. 3B, a dummy pixel signal having a positive polarity capable of discharging the charges stored in the liquid crystal cell as a data line may be supplied in the blank period BP. Here, the positive dummy pixel signal may be any gray voltage capable of discharging the charge accumulated in the insulating film of the liquid crystal cell. For example, the dummy pixel signal may be determined as either a black pixel signal or a white pixel signal.

도 4a 및 도 4b는 제 1실시예에 의하여 블랭크 기간에 게이트라인들로 스캔펄스가 공급되는 순서를 나타내는 도면이다. 4A and 4B are diagrams illustrating an order in which scan pulses are supplied to gate lines in a blank period according to the first embodiment.

도 4a 및 도 4b를 참조하면, 첫 번째 프레임의 블랭크 기간(BP)에 제 1게이트라인(GL1)으로 스캔펄스가 공급된다. 이때, 제 1게이트라인(GL1)에 접속되도록 설치된 첫 번째 수평라인의 액정셀들로 데이터라인들로부터 공급되는 더미 화소신호가 충전된다. 따라서, 유효데이터 공급기간 동안 첫 번째 수평라인의 액정셀들에 축적된 전하가 더미 화소신호에 의해 제거된다. 4A and 4B, the scan pulse is supplied to the first gate line GL1 in the blank period BP of the first frame. In this case, the dummy pixel signal supplied from the data lines is charged to the liquid crystal cells of the first horizontal line installed to be connected to the first gate line GL1. Therefore, the charge accumulated in the liquid crystal cells of the first horizontal line during the valid data supply period is removed by the dummy pixel signal.

이후, 두 번째 프레임의 블랭크 기간(BP)에 제 2게이트라인(GL2)으로 스캔펄스가 공급된다. 이때, 제 2게이트라인(GL2)에 접속되도록 설치된 두 번째 수평라인의 액정셀들로 데이터라인들로부터 공급되는 더미 화소신호가 충전된다. 따라서, 유효데이터 공급기간 동안 두 번째 수평라인의 액정셀들에 축적된 전하가 더미 화소신호에 의해 제거된다. 즉, 본 발명에서는 블랭크 기간(BP) 마다 순차적으로 하나의 수평라인에 형성된 액정셀들로 더미 화소신호를 공급하여 축적된 전하를 제 거하고, 이에 따라 잔상을 방지하게 된다. Thereafter, the scan pulse is supplied to the second gate line GL2 in the blank period BP of the second frame. At this time, the dummy pixel signal supplied from the data lines is charged to the liquid crystal cells of the second horizontal line installed to be connected to the second gate line GL2. Thus, the charge accumulated in the liquid crystal cells of the second horizontal line during the valid data supply period is removed by the dummy pixel signal. That is, in the present invention, the dummy pixel signal is sequentially supplied to the liquid crystal cells formed in one horizontal line for each blank period BP to remove the accumulated charge, thereby preventing afterimages.

한편, 본 발명에서는 블랭크 기간(BP) 동안 적어도 2개 이상의 게이트라인(GL)단위로 스캔펄스를 공급할 수 있다. 예를 들어, 첫 번째 블랭크 기간(BP) 동안 제 1 및 제 2게이트라인(GL1,GL2)에 스캔펄스를 공급하여 첫번째 및 두번째 수평라인의 액정셀들에 축적된 전하를 제거하고, 두 번째 블랭크 기간(BP) 동안 제 3 및 제 4게이트라인(GL3,GL4)에 스캔펄스를 공급하여 세번째 및 네번째 수평라인의 액정셀들에 축적된 전하를 제거할 수 있다. 이후, 블랭크 기간(BP) 마다 2개의 게이트라인에 스캔펄스를 공급함으로써 액정셀들에 축적된 전하를 제거할 수 있고, 이에 따라 잔상을 방지할 수 있다. Meanwhile, in the present invention, scan pulses may be supplied in units of at least two gate lines GL during the blank period BP. For example, a scan pulse is supplied to the first and second gate lines GL1 and GL2 during the first blank period BP to remove charges accumulated in the liquid crystal cells of the first and second horizontal lines, and the second blank. During the period BP, scan pulses may be supplied to the third and fourth gate lines GL3 and GL4 to remove charges accumulated in the liquid crystal cells of the third and fourth horizontal lines. Subsequently, by supplying scan pulses to the two gate lines every blank period BP, the charges accumulated in the liquid crystal cells can be removed, thereby preventing the afterimage.

도 5a 및 도 5b는 제 2실시예에 의하여 블랭크 기간에 게이트라인들로 스캔펄스가 공급되는 순서를 나타내는 도면이다.5A and 5B are diagrams illustrating an order in which scan pulses are supplied to gate lines in a blank period according to a second embodiment.

도 5a 및 도 5b를 참조하면, 본 발명의 제 2실시예에서는 게이트라인들(GL1 내지 GLn)을 j(j는 자연수)-1개의 게이트라인을 각각 포함하는 블록으로 나누고, 블랭크 기간(BP)동안 블록단위로 스캔펄스를 공급한다. 5A and 5B, in the second embodiment of the present invention, the gate lines GL1 to GLn are divided into blocks each including j (j is a natural number) -1 gate lines, and a blank period BP is used. Scan pulses are supplied in blocks.

상세히 설명하면, 첫 번째 프레임의 블랭크 기간(BP)에 첫 번째 블록에 포함된 게이트라인들(GL1 내지 GLj-1)로 스캔펄스가 공급된다. 이때, 게이트라인들(GL1 내지 GLj-1)에 접속된 액정셀들로 데이터라인으로부터 공급되는 더미 화소신호가 충전되고, 이에 따라 액정셀에 축적된 전하가 제거된다. In detail, the scan pulse is supplied to the gate lines GL1 to GLj-1 included in the first block in the blank period BP of the first frame. At this time, the dummy pixel signal supplied from the data line is charged to the liquid crystal cells connected to the gate lines GL1 to GLj-1, thereby removing the charge accumulated in the liquid crystal cell.

이후, 두 번째 프레임의 블랭크 기간(BP)에 두 번째 블록에 포함된 게이트라인들(GLj 내지 GL2j-1)로 스캔펄스가 공급된다. 이때, 게이트라인들(GLj 내지 GL2j-1)에 접속된 액정셀들로 데이터라인으로부터 공급되는 더미 화소신호가 충전된다. 이때, 유효데이터 공급기간동안 액정셀에 축적된 전하가 제거된다. 즉, 본 발명의 제 2실시예에서는 블랭크 기간(BP)마다 블록 단위로 스캔펄스를 공급하여 액정셀들에 축적된 전하를 제거하게 된다. Thereafter, the scan pulse is supplied to the gate lines GLj to GL2j-1 included in the second block in the blank period BP of the second frame. In this case, the dummy pixel signal supplied from the data line is charged to the liquid crystal cells connected to the gate lines GLj to GL2j-1. At this time, the charge accumulated in the liquid crystal cell during the valid data supply period is removed. That is, in the second embodiment of the present invention, the scan pulses are supplied in block units for each blank period BP to remove charges accumulated in the liquid crystal cells.

도 6a 및 도 6b는 제 3실시예에 의하여 블랭크 기간에 게이트라인들로 스캔펄스가 공급되는 순서를 나타내는 도면이다.6A and 6B illustrate a sequence in which scan pulses are supplied to gate lines in a blank period according to a third embodiment.

도 6a 및 도 6b를 참조하면, 본 발명의 제 3실시예에서는 게이트라인들((GL1 내지 GLn)을 j(j는 자연수)-1개의 게이트라인을 각각 포함하는 블록으로 나누고, 블랭크 기간(BP)동안 각각의 블록에 포함된 적어도 하나 이상의 게이트라인들로 스캔펄스를 공급한다. 6A and 6B, in the third embodiment of the present invention, the gate lines GL1 to GLn are divided into blocks each including j (j is a natural number) -1 gate lines, and a blank period BP Scan pulse is supplied to at least one gate line included in each block.

상세히 설명하면, 첫 번째 프레임의 블랭크 기간(BP)에 각각의 블록에 포함된 2개의 게이트라인들(GL1,GL2,GLj,GLj+1,...)로 스캔펄스가 공급된다. 이때, 게이트라인들(GL1,GL2,GLj,GLj+1,...)에 접속된 액정셀들로 데이터라인으로부터 공급되는 더미 화소신호가 충전되고, 이에 따라 액정셀에 축적된 전하가 제거된다. In detail, the scan pulse is supplied to two gate lines GL1, GL2, GLj, GLj + 1, ... included in each block in the blank period BP of the first frame. At this time, the dummy pixel signal supplied from the data line is charged to the liquid crystal cells connected to the gate lines GL1, GL2, GLj, GLj + 1, ..., thereby removing the charge accumulated in the liquid crystal cell. .

이후, 두 번째 프레임의 블랭크 기간(BP)에 두 번째 블록에 포함된 게이트라인들(GL3,GL4,GLj+2,GLj+3,...)로 스캔펄스가 공급된다. 이때, 게이트라인들(GL3,GL4,GLj+2,GLj+3,...)에 접속된 액정셀들로 데이터라인으로부터 공급되는 더미 화소신호가 충전되고, 이에 따라 액정셀에 축적된 전하가 제거된다. 즉, 본 발명의 제 3실시예에서는 게이트라인들(GL)을 다수의 블록으로 나누고, 블랭크 기간(BP)동안 각각의 블록에 포함된 적어도 하나 이상의 게이트라인들(GL)에 순차적으로 스캔펄스를 공급함으로써 액정셀들에 축적된 전하를 제거하게 된다.
Thereafter, the scan pulse is supplied to the gate lines GL3, GL4, GLj + 2, GLj + 3, ... included in the second block in the blank period BP of the second frame. At this time, the dummy pixel signal supplied from the data line is charged to the liquid crystal cells connected to the gate lines GL3, GL4, GLj + 2, GLj + 3, ..., and thus the charge accumulated in the liquid crystal cell Removed. That is, in the third embodiment of the present invention, the gate lines GL are divided into a plurality of blocks, and the scan pulse is sequentially applied to at least one gate line GL included in each block during the blank period BP. By supplying, charges accumulated in the liquid crystal cells are removed.

상술한 바와 같이, 본 발명에 따른 액정표시장치 및 그 구동방법에 의하면 블랭크 기간동안 데이터라인들로 더미 화소신호를 공급하여 액정패널에서 잔상이 발생되는 것을 방지할 수 있다. 아울러, 본 발명에서는 데이터라인들로 더미 화소신호를 공급하기 때문에 딜레이에 의하 화질저하 현상을 방지할 수 있다. 즉, 본 발명에서는 화질저하 현상없이 잔상을 개선할 수 있다. As described above, according to the liquid crystal display and the driving method thereof, the afterimage may be prevented from occurring in the liquid crystal panel by supplying the dummy pixel signal to the data lines during the blank period. In addition, in the present invention, since the dummy pixel signal is supplied to the data lines, image degradation may be prevented due to delay. That is, in the present invention, the afterimage can be improved without deterioration in image quality.

이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여져야만 할 것이다.Those skilled in the art will appreciate that various changes and modifications can be made without departing from the technical spirit of the present invention. Therefore, the technical scope of the present invention should not be limited to the contents described in the detailed description of the specification but should be defined by the claims.

Claims (9)

게이트라인들과 데이터라인들의 교차부에 형성되는 액정셀들과,Liquid crystal cells formed at an intersection of the gate lines and the data lines; 공통전압 생성부로부터의 기준전압을 상기 액정셀들로 공급하기 위한 공통전극라인과,A common electrode line for supplying a reference voltage from the common voltage generator to the liquid crystal cells; 유효데이터 공급기간동안 유효한 화소신호를 상기 데이터라인들에 공급함과 아울러 블랭크 기간동안 상기 액정셀들에 잔존하는 전하들을 방전시키기 위한 방전전압을 갖는 더미 화소신호를 상기 데이터라인들로 공급하기 위한 데이터 드라이버와,A data driver for supplying a valid pixel signal to the data lines during a valid data supply period and a dummy pixel signal having a discharge voltage for discharging charges remaining in the liquid crystal cells during the blank period to the data lines; Wow, 상기 블랭크 기간동안 상기 다수의 게이트라인들 중 적어도 하나 이상의 게이트라인으로 스캔펄스를 공급하기 위한 게이트 드라이버를 구비하고,A gate driver for supplying a scan pulse to at least one of the plurality of gate lines during the blank period; 상기 게이트라인들은 다수의 블록으로 나뉘고, The gate lines are divided into a plurality of blocks, 상기 블랭크 기간 동안, 상기 다수의 블록 중 어느 하나의 블록에 포함된 게이트라인들로 동시에 스캔펄스가 공급되거나, 상기 다수의 블록에 각각 포함된 적어도 하나 이상의 게이트라인들로 동시에 스캔펄스가 공급되는 것을 특징으로 하는 액정표시장치. During the blank period, scan pulses are simultaneously supplied to gate lines included in any one of the plurality of blocks, or scan pulses are simultaneously supplied to at least one or more gate lines respectively included in the plurality of blocks. A liquid crystal display device. 제 1항에 있어서,The method of claim 1, 상기 더미 화소신호는 다수의 그레이(Gray) 전압 중 상기 잔존 전하들을 방전시킬 수 있는 전압레벨을 갖는 그레이 전압이 이용되는 것을 특징으로 하는 액정표시장치. And the gray pixel having a voltage level capable of discharging the remaining charges among the plurality of gray voltages is used as the dummy pixel signal. 제 1항에 있어서,The method of claim 1, 상기 더미 화소신호는 화이트 화소신호 및 블랙 화소신호 중 어느 하나로 선 택되는 것을 특징으로 하는 액정표시장치. And the dummy pixel signal is selected from one of a white pixel signal and a black pixel signal. 제 1항에 있어서,The method of claim 1, 상기 더미 화소신호는 정극성 및 부극성의 전압 중 어느 하나의 전압을 갖는 것을 특징으로 하는 액정표시장치. And the dummy pixel signal has any one of a positive voltage and a negative voltage. 제 1항에 있어서,The method of claim 1, 상기 블랭크 기간동안 적어도 둘 이상의 게이트라인으로 스캔펄스가 공급될 때 스캔펄스는 동시에 공급되는 것을 특징으로 하는 액정표시장치. And the scan pulses are simultaneously supplied when the scan pulses are supplied to at least two gate lines during the blank period. 삭제delete 삭제delete 유효데이터 공급기간동안 유효한 화소신호가 데이터라인들에 공급됨과 아울러 게이트라인들에 스캔펄스가 공급되어 상기 유효한 화소신호가 액정셀들로 공급되는 단계와,A valid pixel signal is supplied to the data lines during the valid data supply period, and a scan pulse is supplied to the gate lines to supply the valid pixel signal to the liquid crystal cells; 블랭크 기간동안 상기 게이트라인들 중 적어도 하나 이상의 게이트라인으로 스캔펄스가 공급되는 단계와,Scanning pulse is supplied to at least one of the gate lines during a blank period; 상기 블랭크 기간동안 상기 데이터라인들로 상기 액정셀에 잔존하는 전하들을 방전시키기 위한 방전전압을 갖는 더미 화소신호가 공급되는 단계를 포함하고, Supplying a dummy pixel signal having a discharge voltage to discharge charges remaining in the liquid crystal cell to the data lines during the blank period; 상기 게이트라인들은 다수의 블록으로 나뉘고, The gate lines are divided into a plurality of blocks, 상기 블랭크 기간 동안, 상기 다수의 블록 중 어느 하나의 블록에 포함된 게이트라인들로 동시에 스캔펄스가 공급되거나, 상기 다수의 블록에 각각 포함된 적어도 하나 이상의 게이트라인들로 동시에 스캔펄스가 공급되는 것을 특징으로 하는 액정표시장치의 구동방법.During the blank period, scan pulses are simultaneously supplied to gate lines included in any one of the plurality of blocks, or scan pulses are simultaneously supplied to at least one or more gate lines respectively included in the plurality of blocks. A method of driving a liquid crystal display device. 삭제delete
KR1020020080219A 2002-12-16 2002-12-16 Liquid crystal display and method of dirving the same KR100920374B1 (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
KR1020020080219A KR100920374B1 (en) 2002-12-16 2002-12-16 Liquid crystal display and method of dirving the same

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
KR1020020080219A KR100920374B1 (en) 2002-12-16 2002-12-16 Liquid crystal display and method of dirving the same

Publications (2)

Publication Number Publication Date
KR20040052348A KR20040052348A (en) 2004-06-23
KR100920374B1 true KR100920374B1 (en) 2009-10-07

Family

ID=37346021

Family Applications (1)

Application Number Title Priority Date Filing Date
KR1020020080219A KR100920374B1 (en) 2002-12-16 2002-12-16 Liquid crystal display and method of dirving the same

Country Status (1)

Country Link
KR (1) KR100920374B1 (en)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US9316856B2 (en) 2011-07-07 2016-04-19 Samsung Display Co., Ltd. Method of driving touch sensing display panel and display apparatus for performing the same

Families Citing this family (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100866952B1 (en) 2006-05-09 2008-11-05 삼성전자주식회사 Apparatus and method for driving display panel of hold type
KR101301422B1 (en) * 2008-04-30 2013-08-28 엘지디스플레이 주식회사 Liquid Crystal Display and Driving Method thereof
KR102208386B1 (en) * 2014-01-22 2021-01-28 삼성디스플레이 주식회사 Method of driving a display panel, display panel driving apparatus performing the method and display apparatus having the display panel driving apparatus

Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH11296148A (en) * 1998-04-15 1999-10-29 Seiko Epson Corp Driving circuit and driving method of electrooptical device and electronic device
JP2001022326A (en) * 1999-07-08 2001-01-26 Advanced Display Inc Liquid crystal display device

Patent Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH11296148A (en) * 1998-04-15 1999-10-29 Seiko Epson Corp Driving circuit and driving method of electrooptical device and electronic device
JP2001022326A (en) * 1999-07-08 2001-01-26 Advanced Display Inc Liquid crystal display device

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US9316856B2 (en) 2011-07-07 2016-04-19 Samsung Display Co., Ltd. Method of driving touch sensing display panel and display apparatus for performing the same

Also Published As

Publication number Publication date
KR20040052348A (en) 2004-06-23

Similar Documents

Publication Publication Date Title
US6166714A (en) Displaying device
KR101318043B1 (en) Liquid Crystal Display And Driving Method Thereof
JP4330059B2 (en) Liquid crystal display device and drive control method thereof
US20040017344A1 (en) Liquid-crystal display device and driving method thereof
JP4790798B2 (en) Active matrix liquid crystal display device and driving method thereof
KR101281979B1 (en) Liquid crystal display
KR101296641B1 (en) Driving circuit of liquid crystal display device and method for driving the same
KR100770543B1 (en) Liquid Crystal Display Device And Driving Method Thereof
KR100389027B1 (en) Liquid Crystal Display and Driving Method Thereof
KR100496543B1 (en) Liquid crystal display and method of driving the same
KR100481217B1 (en) Method and apparatus for driving liquid crystal display device
KR100920374B1 (en) Liquid crystal display and method of dirving the same
US8411008B2 (en) Liquid crystal display having a plurality of common voltages applied during different driving time and driving method thereof
KR20090005424A (en) Liquid crystal display and driving method there
KR101167929B1 (en) In plane switching mode liquid crystal display device
KR101308442B1 (en) LCD and drive method thereof
KR100927014B1 (en) LCD and its driving method
KR101123075B1 (en) Method of compensating kickback voltage and liquid crystal display using the save
KR101186018B1 (en) LCD and drive method thereof
KR20120071743A (en) Active matrix display
KR100717183B1 (en) Method of driving for liquid crystal panel for 2 line dot inversion
KR100686220B1 (en) Thin film transistor for liquid crystal display
KR100920378B1 (en) Liquid Crystal Display
KR100839483B1 (en) Liquid crystal display device
KR100443830B1 (en) Liquid Crystal Display and Driving Method Thereof

Legal Events

Date Code Title Description
A201 Request for examination
E902 Notification of reason for refusal
E701 Decision to grant or registration of patent right
GRNT Written decision to grant
FPAY Annual fee payment

Payment date: 20130619

Year of fee payment: 5

FPAY Annual fee payment

Payment date: 20140630

Year of fee payment: 6

FPAY Annual fee payment

Payment date: 20150818

Year of fee payment: 7

FPAY Annual fee payment

Payment date: 20160816

Year of fee payment: 8

FPAY Annual fee payment

Payment date: 20170816

Year of fee payment: 9

FPAY Annual fee payment

Payment date: 20180816

Year of fee payment: 10

FPAY Annual fee payment

Payment date: 20190814

Year of fee payment: 11