KR100915260B1 - 오토믹 세마포어 연산을 수행하기 위한 방법 및 장치 - Google Patents
오토믹 세마포어 연산을 수행하기 위한 방법 및 장치Info
- Publication number
- KR100915260B1 KR100915260B1 KR1020077011341A KR20077011341A KR100915260B1 KR 100915260 B1 KR100915260 B1 KR 100915260B1 KR 1020077011341 A KR1020077011341 A KR 1020077011341A KR 20077011341 A KR20077011341 A KR 20077011341A KR 100915260 B1 KR100915260 B1 KR 100915260B1
- Authority
- KR
- South Korea
- Prior art keywords
- semaphore
- address
- bus
- processing components
- memory area
- Prior art date
Links
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F12/00—Accessing, addressing or allocating within memory systems or architectures
- G06F12/14—Protection against unauthorised use of memory or access to memory
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
- G06F13/14—Handling requests for interconnection or transfer
- G06F13/16—Handling requests for interconnection or transfer for access to memory bus
- G06F13/1605—Handling requests for interconnection or transfer for access to memory bus based on arbitration
- G06F13/1652—Handling requests for interconnection or transfer for access to memory bus based on arbitration in a multiprocessor architecture
- G06F13/1663—Access to shared memory
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
- G06F13/14—Handling requests for interconnection or transfer
- G06F13/16—Handling requests for interconnection or transfer for access to memory bus
Landscapes
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Computer Security & Cryptography (AREA)
- Multi Processors (AREA)
- Crystals, And After-Treatments Of Crystals (AREA)
- Analysing Materials By The Use Of Radiation (AREA)
- Bus Control (AREA)
Abstract
Description
Claims (23)
- 삭제
- 처리 시스템으로서,버스;상기 버스에 연결되는 메모리 영역; 및상기 버스를 통해서 상기 메모리 영역에 액세스하는 다수의 처리 구성소자들을 포함하고,상기 다수의 처리 구성소자들 각각은 상기 버스를 통해 세마포어 위치(semaphore location)에 대한 판독 및 기록 동작을 동시에 요청함으로써 상기 메모리 영역으로의 액세스를 획득하기 위한 세마포어 연산을 수행하도록 구성되며,상기 다수의 처리 구성소자들 각각은 또한 상기 버스를 통해 세마포어 위치에 세마포어 주소의 두 복사본을 동시에 방송함으로써 세마포어 연산을 위한 판독 및 기록 동작을 요청하도록 구성되는, 처리 시스템.
- 제 2항에 있어서, 상기 다수의 처리 구성소자들 각각은 또한 세마포어 주소의 한 복사본을 갖는 세마포어 위치에 판독 동작 요청 신호를 제공하고 또한 세마포어 주소의 다른 복사본을 갖는 세마포어 위치에 기록 동작 요청 신호를 제공함으로써 세마포어 연산을 위한 판독 및 기록 동작을 요청하도록 구성되는, 처리 시스템.
- 제 2항에 있어서, 상기 다수의 처리 구성소자들 각각은 또한 세마포어 주소의 두 복사본의 동시적인 방송에 이어서 세마포어 위치에 업데이팅된 세마포어를 방송함으로써 세마포어 연산을 수행하도록 구성되는, 처리 시스템.
- 제 4항에 있어서,상기 세마포어 위치는 상기 다수의 처리 구성소자들 중 하나의 처리 구성소자로부터의 세마포어 주소에 대한 판독 동작 요청에 응하여 세마포어를 검색하고 또한 상기 다수의 처리 구성소자들 중 상기 하나의 처리 구성소자에 상기 검색된 세마포어를 방송하도록 구성되고,상기 세마포어 위치는 또한 세마포어 주소에 대한 기록 동작 요청에 응하여 상기 업데이팅된 세마포어를 저장하도록 구성되는, 처리 시스템.
- 제 5항에 있어서,상기 버스는 전송 채널 및 수신 채널을 더 포함하고,상기 다수의 처리 구성소자들 각각은 또한 업데이팅된 세마포어가 후속하는 세마포어 주소의 두 복사본들을 전송 채널을 통해서 세마포어 위치에 방송하도록 구성되며,상기 세마포어 위치는 또한 검색된 세마포어를 수신 채널을 통해서 상기 다수의 처리 구성소자들 중 상기 하나의 처리 구성소자에 방송하도록 구성되는, 처리 시스템.
- 제 6항에 있어서, 상기 다수의 처리 구성소자들 각각은 또한 수신 채널을 통해 방송되는 검색된 세마포어로부터 상기 메모리 영역이 이용가능한지 여부를 결정하도록 구성되는, 처리 시스템.
- 제 7항에 있어서,상기 다수의 처리 구성소자들 각각은 또한 상기 메모리 영역이 이용가능하다고 결정된 경우에는 기록 데이터 주소 및 기록 데이터를 전송 채널을 통해 상기 메모리 영역에 방송함으로써 상기 메모리 영역에 데이터를 기록하도록 구성되고,상기 다수의 처리 구성소자들 각각은 또한 상기 메모리 영역이 이용가능하다고 결정된 경우에는 판독 데이터 주소를 전송 채널을 통해 상기 메모리 영역에 방송하고 또한 수신 채널로부터 판독 데이터를 판독함으로써 상기 메모리 영역으로부터 데이터를 판독하도록 구성되는, 처리 시스템.
- 제 2항에 있어서,상기 버스는 다수의 라인들을 구비한 전송 채널을 포함하고,상기 다수의 처리 구성소자들 각각은 또한 상기 라인들의 제 1 부분을 통해 세마포어 주소의 한 복사본을 방송하고 또한 상기 라인들의 제 2 부분을 통해 세마포어 주소의 다른 복사본을 방송함으로써 세마포어 연산을 위한 판독 및 기록 동작을 요청하도록 구성되는, 처리 시스템.
- 제 9항에 있어서, 상기 다수의 처리 구성소자들 각각은 또한 상기 라인들의 제 1 부분을 통해 세마포어 주소의 한 복사본을 갖는 판독 동작 요청 신호를 제공하고 또한 상기 라인들의 제 2 부분을 통해 세마포어 주소의 다른 복사본을 갖는 기록 동작 요청 신호를 제공하도록 구성되는, 처리 시스템.
- 제 10항에 있어서, 상기 세마포어 위치는 또한 요청된 기록 동작을 수행하기에 앞서서 요청된 판독 동작을 수행하도록 구성되는, 처리 시스템.
- 삭제
- 삭제
- 다수의 처리 구성소자들이 버스를 통해서 메모리 영역에 액세스하는 것을 관리하기 위한 방법으로서,상기 방법은 상기 메모리 영역으로의 액세스를 획득하기 위해서 상기 다수의 처리 구성소자들 중 하나의 처리 구성소자에 의한 세마포어 연산을 수행하는 단계를 포함하고,상기 세마포어 연산은 상기 버스를 통해 세마포어 위치에 대한 판독 및 기록 동작을 동시적으로 요청함으로써 수행되며,상기 세마포어 연산을 위한 판독 및 기록 동작 요청들은 세마포어 주소의 두 복사본들을 상기 다수의 처리 구성소자들 중 상기 하나의 처리 구성소자로부터 세마포어 위치에 버스를 통해서 방송하는 단계를 포함하는, 액세스 관리 방법.
- 제 14항에 있어서, 상기 세마포어 연산을 위한 판독 및 기록 동작 요청들은 또한 상기 다수의 처리 구성소자들 중 상기 하나의 처리 구성소자로부터 판독 동작 요청 신호를 세마포어 주소의 한 복사본을 갖는 세마포어 위치에 제공하는 단계와, 상기 처리 구성소자들 중 상기 하나의 처리 구성소자로부터 기록 동작 요청 신호를 세마포어 주소의 다른 복사본을 갖는 세마포어 위치에 제공하는 단계를 포함하는, 액세스 관리 방법.
- 제 14항에 있어서, 상기 다수의 처리 구성소자들 중 상기 하나의 처리 구성소자에 의한 세마포어 연산의 실행은 세마포어 주소의 두 복사본들의 동시적인 방송에 이어서 업데이팅된 세마포어를 세마포어 위치에 버스를 통해서 방송하는 단계를 포함하는, 액세스 관리 방법.
- 제 14항에 있어서,상기 다수의 처리 구성소자들 중 상기 하나의 처리 구성소자가 세마포어 주소에 대한 판독 동작을 요청한 것에 응하여 세마포어 위치로부터 세마포어를 검색하는 단계,상기 세마포어 위치로부터의 검색된 세마포어를 상기 처리 구성소자들 중 상기 하나의 처리 구성소자에 버스를 통해서 방송하는 단계, 및세마포어 주소에 대한 기록 동작 요청에 응하여 세마포어 위치에 업데이팅된 세마포어를 저장하는 단계를 더 포함하는, 액세스 관리 방법.
- 제 17항에 있어서,상기 버스는 전송 채널 및 수신 채널을 더 포함하고,상기 다수의 처리 구성소자들 중 상기 하나의 처리 구성소자는 업데이팅된 세마포어가 후속하는 세마포어 주소의 두 복사본들을 전송 채널을 통해서 세마포어 위치에 방송하며,상기 세마포어 위치는 검색된 세마포어를 상기 다수의 처리 구성소자들 중 상기 하나의 구성소자에 수신 채널을 통해서 방송하는, 액세스 관리 방법.
- 제 18항에 있어서, 상기 메모리 영역이 검색된 세마포어로부터 이용가능한지 여부를 상기 다수의 처리 구성소자들 중 상기 하나의 처리 구성소자에서 결정하는 단계를 더 포함하는, 액세스 관리 방법
- 제 19항에 있어서,상기 다수의 처리 구성소자들 중 상기 하나의 처리 구성소자는 상기 메모리 영역이 이용가능하다고 결정하고,상기 방법은 상기 다수의 처리 구성소자들 중 상기 하나의 처리 구성소자로부터 상기 메모리 영역으로 전송 채널을 통해 기록 데이터 주소 및 기록 데이터를 방송함으로써 상기 메모리 영역에 데이터를 기록하는 단계를 더 포함하는, 액세스 관리 방법.
- 제 19항에 있어서,상기 다수의 처리 구성소자들 중 상기 하나의 처리 구성소자는 상기 메모리 영역이 이용가능하다고 결정하고,상기 방법은 상기 다수의 처리 구성소자들 중 상기 하나의 처리 구성소자로부터 상기 메모리 영역으로 전송 채널을 통해 판독 데이터 주소를 방송하고 또한 상기 메모리 영역으로부터 판독 데이터를 상기 다수의 처리 구성소자들 중 상기 하나의 처리 구성소자에 방송함으로써 상기 메모리 영역으로부터 데이터를 판독하는 단계를 더 포함하는, 액세스 관리 방법.
- 제 14항에 있어서,상기 버스는 다수의 라인들을 구비한 전송 채널을 포함하고,상기 다수의 처리 구성소자들 각각은 또한 상기 라인들의 제 1 부분을 통해 세마포어 주소의 한 복사본을 방송하고 또한 상기 라인들의 제 2 부분을 통해 세마포어 주소의 다른 복사본을 방송함으로써 세마포어 연산을 위한 판독 및 기록 동작을 요청하도록 구성되는, 액세스 관리 방법.
- 제 22항에 있어서,상기 라인들의 제 1 부분을 통해 세마포어 주소의 상기 한 복사본을 갖는 세마포어 위치에 판독 동작 요청 신호를 제공하는 단계, 및상기 라인들의 제 2 부분을 통해 세마포어 주소의 상기 다른 복사본을 갖는 세마포어 위치에 기록 동작 요청 신호를 제공하는 단계를 포함하는, 액세스 관리 방법.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US10/971,740 US7610463B2 (en) | 2004-10-22 | 2004-10-22 | Method and apparatus for performing an atomic semaphore operation |
US10/971,740 | 2004-10-22 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR20070084362A KR20070084362A (ko) | 2007-08-24 |
KR100915260B1 true KR100915260B1 (ko) | 2009-09-03 |
Family
ID=36087815
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1020077011341A KR100915260B1 (ko) | 2004-10-22 | 2005-10-24 | 오토믹 세마포어 연산을 수행하기 위한 방법 및 장치 |
Country Status (15)
Country | Link |
---|---|
US (1) | US7610463B2 (ko) |
EP (1) | EP1812868B1 (ko) |
JP (2) | JP2008518329A (ko) |
KR (1) | KR100915260B1 (ko) |
CN (1) | CN101080706B (ko) |
AT (1) | ATE527601T1 (ko) |
DK (1) | DK1812868T3 (ko) |
ES (1) | ES2371767T3 (ko) |
HK (1) | HK1108297A1 (ko) |
IL (1) | IL182733A (ko) |
MX (1) | MX2007004870A (ko) |
PL (1) | PL1812868T3 (ko) |
PT (1) | PT1812868E (ko) |
TW (1) | TWI396088B (ko) |
WO (1) | WO2006047570A1 (ko) |
Families Citing this family (16)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US7631152B1 (en) * | 2005-11-28 | 2009-12-08 | Nvidia Corporation | Determining memory flush states for selective heterogeneous memory flushes |
US20080059674A1 (en) * | 2006-09-01 | 2008-03-06 | Jiaxiang Shi | Apparatus and method for chained arbitration of a plurality of inputs |
US20090292885A1 (en) * | 2008-05-22 | 2009-11-26 | Fujitsu Limited | Method and apparatus for providing atomic access to memory |
US8023345B2 (en) * | 2009-02-24 | 2011-09-20 | International Business Machines Corporation | Iteratively writing contents to memory locations using a statistical model |
US8751860B2 (en) | 2009-06-03 | 2014-06-10 | Micron Technology, Inc. | Object oriented memory in solid state devices |
US8386739B2 (en) * | 2009-09-28 | 2013-02-26 | International Business Machines Corporation | Writing to memory using shared address buses |
US8230276B2 (en) * | 2009-09-28 | 2012-07-24 | International Business Machines Corporation | Writing to memory using adaptive write techniques |
US8463985B2 (en) | 2010-03-31 | 2013-06-11 | International Business Machines Corporation | Constrained coding to reduce floating gate coupling in non-volatile memories |
US8599886B2 (en) | 2010-08-26 | 2013-12-03 | Qualcomm Incorporated | Methods and apparatus for reducing transfer qualifier signaling on a two-channel bus |
JP2012252490A (ja) * | 2011-06-02 | 2012-12-20 | Renesas Electronics Corp | マルチプロセッサおよびそれを用いた画像処理システム |
CN102523481A (zh) * | 2011-12-09 | 2012-06-27 | 成都东方盛行电子有限责任公司 | 一种节目播出系统用数据交换缓存的方法 |
KR102285749B1 (ko) | 2014-11-10 | 2021-08-05 | 삼성전자주식회사 | 세마포어 기능을 갖는 시스템 온 칩 및 그것의 세마포어 구현 방법 |
CN107148238A (zh) * | 2014-11-18 | 2017-09-08 | 索尼公司 | 信息处理装置、信息处理系统、信息处理方法及程序 |
CN105630714B (zh) * | 2014-12-01 | 2018-12-18 | 晨星半导体股份有限公司 | 接口资源分析装置及其方法 |
US9928174B1 (en) * | 2016-03-16 | 2018-03-27 | Amazon Technologies, Inc. | Consistent caching |
JP2019082897A (ja) * | 2017-10-31 | 2019-05-30 | 富士通株式会社 | 情報処理装置、情報処理システム及びプログラム |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR20040043683A (ko) * | 2002-11-19 | 2004-05-24 | 엘지전자 주식회사 | 공유 버스 시스템의 스케줄링 장치 및 그 방법 |
Family Cites Families (14)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4456965A (en) | 1980-10-14 | 1984-06-26 | Texas Instruments Incorporated | Data processing system having multiple buses |
US4594657A (en) | 1983-04-22 | 1986-06-10 | Motorola, Inc. | Semaphore for memory shared by two asynchronous microcomputers |
JPS60118961A (ja) * | 1983-11-30 | 1985-06-26 | Fujitsu Ltd | メモリの共通領域アクセス制御方式 |
GB9406477D0 (en) * | 1994-03-31 | 1994-05-25 | D2B Systems Co Ltd | Interconnection of local communication bus systems |
EP0695999A3 (en) * | 1994-06-30 | 1998-07-08 | Digital Equipment Corporation | System bus with separate address and data bus protocols |
US5548780A (en) * | 1994-07-21 | 1996-08-20 | Apple Computer, Inc. | Method for semaphore communication between incompatible bus locking architectures |
US5960441A (en) * | 1996-09-24 | 1999-09-28 | Honeywell Inc. | Systems and methods for providing dynamic data referencing in a generic data exchange environment |
JPH10177560A (ja) * | 1996-12-17 | 1998-06-30 | Ricoh Co Ltd | 記憶装置 |
US6745274B1 (en) * | 2000-04-25 | 2004-06-01 | Hewlett-Packard Development Company, L.P. | Apparatus and method for synchronizing multiple accesses to common resources |
US6513089B1 (en) * | 2000-05-18 | 2003-01-28 | International Business Machines Corporation | Dual burst latency timers for overlapped read and write data transfers |
US6587905B1 (en) * | 2000-06-29 | 2003-07-01 | International Business Machines Corporation | Dynamic data bus allocation |
US6603683B2 (en) * | 2001-06-25 | 2003-08-05 | International Business Machines Corporation | Decoding scheme for a stacked bank architecture |
JP3662233B2 (ja) * | 2002-03-06 | 2005-06-22 | 株式会社東芝 | 論理回路を含むバスバッファ回路 |
US7360035B2 (en) * | 2004-09-01 | 2008-04-15 | International Business Machines Corporation | Atomic read/write support in a multi-module memory configuration |
-
2004
- 2004-10-22 US US10/971,740 patent/US7610463B2/en active Active
-
2005
- 2005-10-21 TW TW094137044A patent/TWI396088B/zh active
- 2005-10-24 EP EP05820885A patent/EP1812868B1/en active Active
- 2005-10-24 ES ES05820885T patent/ES2371767T3/es active Active
- 2005-10-24 JP JP2007538182A patent/JP2008518329A/ja not_active Withdrawn
- 2005-10-24 MX MX2007004870A patent/MX2007004870A/es not_active Application Discontinuation
- 2005-10-24 PT PT05820885T patent/PT1812868E/pt unknown
- 2005-10-24 PL PL05820885T patent/PL1812868T3/pl unknown
- 2005-10-24 KR KR1020077011341A patent/KR100915260B1/ko active IP Right Grant
- 2005-10-24 AT AT05820885T patent/ATE527601T1/de active
- 2005-10-24 CN CN200580042911XA patent/CN101080706B/zh active Active
- 2005-10-24 WO PCT/US2005/038516 patent/WO2006047570A1/en active Application Filing
- 2005-10-24 DK DK05820885.1T patent/DK1812868T3/da active
-
2007
- 2007-04-22 IL IL182733A patent/IL182733A/en active IP Right Grant
-
2008
- 2008-02-29 HK HK08102276.3A patent/HK1108297A1/xx unknown
-
2010
- 2010-09-13 JP JP2010204843A patent/JP5558982B2/ja not_active Expired - Fee Related
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR20040043683A (ko) * | 2002-11-19 | 2004-05-24 | 엘지전자 주식회사 | 공유 버스 시스템의 스케줄링 장치 및 그 방법 |
Also Published As
Publication number | Publication date |
---|---|
PL1812868T3 (pl) | 2012-03-30 |
WO2006047570A1 (en) | 2006-05-04 |
KR20070084362A (ko) | 2007-08-24 |
TWI396088B (zh) | 2013-05-11 |
CN101080706B (zh) | 2013-01-02 |
JP5558982B2 (ja) | 2014-07-23 |
IL182733A0 (en) | 2007-07-24 |
PT1812868E (pt) | 2011-12-21 |
US20060090051A1 (en) | 2006-04-27 |
JP2011048834A (ja) | 2011-03-10 |
ES2371767T3 (es) | 2012-01-09 |
US7610463B2 (en) | 2009-10-27 |
ATE527601T1 (de) | 2011-10-15 |
IL182733A (en) | 2012-05-31 |
TW200634529A (en) | 2006-10-01 |
DK1812868T3 (da) | 2012-02-13 |
CN101080706A (zh) | 2007-11-28 |
JP2008518329A (ja) | 2008-05-29 |
HK1108297A1 (en) | 2008-05-02 |
EP1812868A1 (en) | 2007-08-01 |
EP1812868B1 (en) | 2011-10-05 |
MX2007004870A (es) | 2007-07-04 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
KR100915260B1 (ko) | 오토믹 세마포어 연산을 수행하기 위한 방법 및 장치 | |
RU2380743C1 (ru) | Способ и устройство для очистки резервирования семафоров | |
US6857035B1 (en) | Methods and apparatus for bus mastering and arbitration | |
EP1564646A2 (en) | Configurable embedded processor | |
US5293491A (en) | Data processing system and memory controller for lock semaphore operations | |
US6484240B1 (en) | Mechanism for reordering transactions in computer systems with snoop-based cache consistency protocols | |
US8386719B2 (en) | Method and apparatus for controlling shared memory and method of accessing shared memory | |
JP2591502B2 (ja) | 情報処理システムおよびそのバス調停方式 | |
US20080172510A1 (en) | Parallel bus architecture and related method for interconnecting sub-systems utilizing a parallel bus | |
JPH09153009A (ja) | 階層構成バスのアービトレーション方法 | |
JP2002024007A (ja) | プロセッサシステム | |
KR100441996B1 (ko) | 직접 메모리 액세스 제어기 및 제어 방법 | |
EP1984943B1 (en) | Selective transaction request processing at an interconnect during a lockout | |
JPH11203253A (ja) | 共有資源排他アクセス制御方式 | |
JP2001075826A (ja) | 並列計算機における高効率セマフォ処理方式 | |
JP2003280980A (ja) | 共有メモリ排他制御装置及び共有メモリ排他制御方法 | |
JPS5975354A (ja) | プロセッサ装置 | |
JPH05324533A (ja) | デュアルポートメモリ装置 | |
JP2004272488A (ja) | データ処理システム及びデータ処理装置 | |
JPH03164851A (ja) | データ処理装置 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A201 | Request for examination | ||
E902 | Notification of reason for refusal | ||
AMND | Amendment | ||
E601 | Decision to refuse application | ||
AMND | Amendment | ||
J201 | Request for trial against refusal decision | ||
B701 | Decision to grant | ||
GRNT | Written decision to grant | ||
FPAY | Annual fee payment |
Payment date: 20120727 Year of fee payment: 4 |
|
FPAY | Annual fee payment |
Payment date: 20130729 Year of fee payment: 5 |
|
FPAY | Annual fee payment |
Payment date: 20140730 Year of fee payment: 6 |
|
FPAY | Annual fee payment |
Payment date: 20160629 Year of fee payment: 8 |
|
FPAY | Annual fee payment |
Payment date: 20170629 Year of fee payment: 9 |
|
FPAY | Annual fee payment |
Payment date: 20180628 Year of fee payment: 10 |
|
FPAY | Annual fee payment |
Payment date: 20190624 Year of fee payment: 11 |