KR100866253B1 - Method for manufacturing of the image sensor - Google Patents
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Abstract
Description
도 1 내지 도 6은 종래의 이미지 센서의 제조 공정을 나타내는 도면이다.1 to 6 are diagrams illustrating a manufacturing process of a conventional image sensor.
도 7 내지 도 11은 실시예의 이미지 센서의 제조 공정을 나타내는 도면이다. 7 to 11 are diagrams illustrating a manufacturing process of the image sensor of the embodiment.
실시예에서는 이미지 센서의 제조방법이 개시된다.In an embodiment, a method of manufacturing an image sensor is disclosed.
이미지 센서는 광학적 영상(Optical Image)을 전기 신호로 변환시키는 반도체 소자로서, 크게 전하결합소자(charge coupled device:CCD) 이미지 센서와 씨모스(Complementary Metal Oxide Silicon:CMOS) 이미지 센서(CIS)로 구분된다. An image sensor is a semiconductor device that converts an optical image into an electrical signal, and is classified into a charge coupled device (CCD) image sensor and a complementary metal oxide silicon (CMOS) image sensor (CIS). do.
CCD 이미지 센서는 구동방식이 복잡하고, 전력소비가 클 뿐만 아니라, 다단계의 포토공정이 요구되므로 제조공정이 복잡한 단점을 갖고 있으므로, 최근에는 상기 전하결합소자의 단점을 극복하기 위한 차세대 이미지 센서로서 씨모스 이미지 센서가 주목을 받고 있다. CCD image sensor has complex driving method, high power consumption, multi-stage photo process, and manufacturing process has complicated disadvantage. Therefore, as a next generation image sensor to overcome the disadvantage of the charge coupling device, Morse image sensor is attracting attention.
씨모스 이미지 센서는 제어회로(control circuit) 및 신호 처리 회로(signal processing circuit)를 주변 회로로 사용하는 CMOS 기술을 이용하여 화소(pixel)수 만큼 MOS 트랜지스터를 만들고 이것을 이용하여 순차적으로 출력을 검출하는 스위 칭 방식을 채용하는 소자이다.CMOS image sensor uses CMOS technology that uses a control circuit and a signal processing circuit as peripheral circuits to make MOS transistors by the number of pixels and sequentially detects the output using them. The device adopts the switching method.
이러한, 씨모스 이미지 센서의 화소는 빛을 받아 광 전하를 생성하는 1개의 포토다이오드와 4개의 MOS 트랜지스터를 포함한다.The pixel of the CMOS image sensor includes one photodiode and four MOS transistors that receive light to generate photoelectric charges.
4개의 MOS 트랜지스터는 포토다이오드와 연결되어 모아진 광전하를 플로팅 확산부로 운송하는 트랜스퍼 트랜지스터와, 원하는 값으로 플로팅 확산부의 전위를 세팅하고 전하를 배출시켜 플로팅 확산부를 리셋시키는 리셋 트랜지스터와, 플로팅 확산부의 전압이 게이트로 인가되어 소스 팔로워 버퍼 증폭기(Source Follower Buffer Amplifier) 역할을 하는 드라이브 트랜지스터 및 스위칭(Switching) 역할로 어드레싱(Addressing) 역할을 수행하는 셀렉트 트랜지스터로 구성된다. The four MOS transistors include a transfer transistor that transfers the photocharges collected by the photodiode to the floating diffusion, a reset transistor that sets the potential of the floating diffusion to a desired value and discharges charge to reset the floating diffusion, and a voltage of the floating diffusion. The gate transistor includes a drive transistor applied to the gate and serving as a source follower buffer amplifier, and a select transistor serving as a switching role.
씨모스 이미지 센서 제조 공정에서 활성영역 및 폴리실리콘 게이트의 저항을 낮추기 위해 살리사이드(salicide) 공정을 채택하고 있다. 이 살리사이드 공정에 적용되는 금속막들은 빛에 대한 반사율이 높기 때문에 포토다이오드와 게이트가 인접하는 픽셀 구조에서는 게이트에만 살리사이드를 적용해야한다. In the CMOS image sensor manufacturing process, a salicide process is adopted to lower the resistance of the active region and the polysilicon gate. Since the metal films used in the salicide process have high reflectance to light, the salicide should be applied only to the gate in the pixel structure in which the photodiode and the gate are adjacent to each other.
도 1 및 도 6을 참조하여 종래의 이미지 센서의 제조공정을 설명한다.A manufacturing process of a conventional image sensor will be described with reference to FIGS. 1 and 6.
도 1을 참조하여, 소자분리막(11)이 형성된 반도체 기판(10) 상에 희생산화막(20)이 형성된다. 상기 희생 산화막(20)은 회로영역(미도시)의 웰 형성을 위한 이온 주입시 상기 반도체 기판(10)의 표면이 손상되는 것을 방지하기 위한 것이다.Referring to FIG. 1, a
그리고, 상기 희생 산화막(20)이 형성된 반도체 기판(10) 상에 웰 형성을 위한 이온주입 완료 후 상기 희생 산화막(20)은 습식식각 공정에 의해서 모두 제거된다.After completion of ion implantation for well formation on the
도 2 및 도 3을 참조하여, 상기 반도체 기판(10) 상에 산화막(30) 및 폴리실리콘막(40)이 형성된 후, 식각 공정을 통하여 게이트 산화막(31) 및 게이트 전극(41)이 형성된다. 상기 게이트 전극(41)은 포토다이오드에 인접하는 트랜스퍼 트랜지스터의 게이트 전극(141)이다. 2 and 3, after the
여기서, 상기 게이트 전극(41) 형성시 상기 게이트 산화막(31)도 패터닝 되지만 상기 반도체 기판의 표면에 있는 산화막(32)은 모두 제거되지는 않고 얇은 상태로 남아있게 된다.Here, the
그리고, 상기 게이트 전극(41) 및 별도의 감광막 패턴을 마스크로 이용한 불순물 이온주입을 통해 포토다이오드(60)가 형성된다.The
그리고, 상기 게이트 전극(41)의 양측벽에 접하는 스페이서(51)가 형성된 후, 상기 게이트 전극(41) 및 스페이서(51)를 이온주입 마스크로 이용하여 게이트 전극(41) 타측의 스페이서(51)에 정렬되는 플로팅 디퓨전 영역(70)이 형성된다. After the
도 4를 참조하여, 상기 반도체 기판(10) 상에 TEOS 물질을 증착한 후 포토레지스트 패턴을 형성하여 상기 포토다이오드(60) 상부에만 보호막(80)을 형성한다. Referring to FIG. 4, after the TEOS material is deposited on the
도 5 및 도 6을 참조하여, 상기 포토다이오드(60) 이외의 영역에 남아있는 산화막(32)은 세정공정을 통해 제거한 후 상기 게이트 전극(141) 및 소스/드레인 영역에 살리사이드막(90)이 형성된다. 5 and 6, the
상기와 같은 종래의 이미지 센서는 희생 산화막을 제거하기 위하여 습식식각 공정이 사용되는데, 상기 습식식각 시 식각액에 의하여 상기 포토다이오드 표면 영역이 손상되어 다크 커런트가 유발된다.In the conventional image sensor as described above, a wet etching process is used to remove the sacrificial oxide layer. In the wet etching, the photodiode surface region is damaged by the etchant to cause dark current.
또한, 상기 게이트 전극(141) 형성시 건식식각 공정에 의하여 상기 포토다이오드의 표면이 손상되어 다크 커런트를 유발시킨다. In addition, when the
또한, 상기 포토다이오드 상부의 보호막 형성시 이온식각(Reactive Ion Ecthing) 공정이 사용되는데 상기 이온 식각시 상기 반도체 기판 표면과 게이트 산화막에 손상이 가해져서 주변 회로영역의 문턱전압 지연 현상이 발생되어 품질이 저하되는 문제가 있다. In addition, when the protective layer is formed on the photodiode, a reactive ion etching process is used. The ion etching damages the surface of the semiconductor substrate and the gate oxide layer, causing a threshold voltage delay of the peripheral circuit region, thereby improving the quality. There is a problem of deterioration.
실시예에서는 식각 데미지로 인한 소자 특성의 열화를 방지하여 소자의 신뢰성을 확보할 수 있는 이미지 센서 및 그 제조방법을 제공한다.The embodiment provides an image sensor and a method of manufacturing the same, which can secure device reliability by preventing deterioration of device characteristics due to etching damage.
실시예의 이미지 센서의 제조방법은, 반도체 기판 상의 포토다이오드 형성 예정영역에 살리사이드 방지층을 형성하는 단계; 상기 반도체 기판 상에 산화막 및 폴리실리콘을 증착하고 패터닝하여 게이트 전극 및 게이트 절연막을 형성하는 단계; 상기 게이트 전극의 측벽에 스페이서를 형성하는 단계; 상기 게이트 전극 일측의 상기 반도체 기판 내에 포토다이오드를 형성하는 단계; 상기 게이트 전극의 타측에 플로팅 확산부를 형성하는 단계; 및 상기 게이트 전극의 상부표면 및 플로팅 확산부 상부 표면에 살리사이드층을 형성하는 단계를 포함한다.In another embodiment, a method of manufacturing an image sensor includes: forming a salicide prevention layer on a photodiode formation region on a semiconductor substrate; Depositing and patterning an oxide film and polysilicon on the semiconductor substrate to form a gate electrode and a gate insulating film; Forming a spacer on sidewalls of the gate electrode; Forming a photodiode in the semiconductor substrate on one side of the gate electrode; Forming a floating diffusion on the other side of the gate electrode; And forming a salicide layer on an upper surface of the gate electrode and an upper surface of the floating diffusion.
이하, 실시예에 따른 이미지 센서의 제조방법을 첨부된 도면을 참조하여 상세히 설명한다. Hereinafter, a method of manufacturing an image sensor according to an embodiment will be described in detail with reference to the accompanying drawings.
실시예의 설명에 있어서, 각 층의 "상/위(on/over)"에 형성되는 것으로 기재 되는 경우에 있어, 상/위(on/over)는 직접(directly)와 또는 다른 층을 개재하여(indirectly) 형성되는 것을 모두 포함한다. In the description of the embodiments, where described as being formed "on / over" of each layer, the on / over may be directly or through another layer ( indirectly) includes everything formed.
도면에서 각층의 두께나 크기는 설명의 편의 및 명확성을 위하여 과장되거나 생략되거나 또는 개략적으로 도시되었다. 또한 각 구성요소의 크기는 실제크기를 전적으로 반영하는 것은 아니다.In the drawings, the thickness or size of each layer is exaggerated, omitted, or schematically illustrated for convenience and clarity of description. In addition, the size of each component does not necessarily reflect the actual size.
도 7 내지 도 11을 참조하여 실시예의 이미지 센서의 제조방법을 설명한다.A method of manufacturing the image sensor of the embodiment will be described with reference to FIGS. 7 to 11.
도 7을 참조하여, 반도체 기판(100) 상에 희생 절연막(120)이 형성된다.Referring to FIG. 7, a sacrificial
상기 반도체 기판(100)은 고농도의 P++ 반도체 기판(100) 일 수 있으며, 상기 반도체 기판에 에피택셜 공정을 진행하여 저농도의 p형 에피층(미도시)이 형성될 수 있다.The
실시예에서는 반도체 기판(100)과 에피층을 p형으로 사용하지만 이에 한정하는 것은 아니다.In the exemplary embodiment, the
상기 p형 에피층이 형성된 반도체 기판(100)의 일정 영역에 액티브 영역과 필드 영역을 정의하고 단위화소를 분리하기 위한 소자분리막(110)이 형성된다. An
상기 희생 절연막(120)은 주변 회로영역(미도시)의 웰 형성을 위한 이온주입 시 상기 반도체 기판(100)의 표면을 보호하기 위하여 형성된다. 예를 들어, 상기 희생 절연막(120)은 산화막으로 형성될 수 있으며 약 100~200Å의 두께로 형성될 수 있다.The
상기 희생 절연막(120)이 형성된 반도체 기판(100) 상으로 이온을 주입하여 웰 영역(미도시)이 형성되면, 상기 희생 절연막(120) 상에 포토레지스트 패턴(200) 을 형성하여 상기 희생 절연막(120)을 식각한다. When a well region (not shown) is formed by implanting ions onto the
상기 포토레지스트 패턴(200)은 상기 희생 절연막(120) 상에 포토레지스트막을 도포한 후 패터닝하여 형성되는 것으로 포토다이오드 형성 예정영역 상에만 형성된다.The
도 8을 참조하여, 상기 반도체 기판(100)의 포토다이오드 형성 예정 영역 상에 살리사이드 방지막(121)이 형성된다. Referring to FIG. 8, a
상기 살리사이드 방지막(121)은 후 공정에서 포토다이오드의 살리사이드화를 방지하기 위한 것으로, 상기 포토레지스트 패턴(200)을 식각 마스크로 하여 상기 희생 절연막(120)을 식각함으로써 상기 포토다이오드 형성 예정영역에만 상기 희생 절연막(120)이 남아있게 되어 살리사이드 방지막(121)이 형성된다. . The
상기 살리사이드 방지막(121) 형성을 위한 희생 절연막(120)의 식각은 습식식각 공정으로 진행되어, 상기 포토다이오드 형성 예정 영역에만 상기 희생 절연막(120)이 남고 나머지 영역의 희생 절연막(120)은 모두 식각되어 씨모스 회로 및 주변 회로 영역이 형성되는 반도체 기판(100) 표면이 노출된다.Etching of the
상기 포토다이오드 형성 예정 영역에 살리사이드 방지막(121)이 형성되어 있으므로, 상기 희생 절연막(120)의 식각공정에 의해서 상기 포토다이오드 형성 예정영역의 반도체 기판(100)의 표면을 보호할 수 있다.Since the
도 9 및 도 10을 참조하여, 상기 반도체 기판(100) 상에 게이트 절연막(131) 및 게이트 전극(141)이 형성된다. 9 and 10, a
상기 게이트 절연막(131) 및 게이트 전극(141)은 상기 반도체 기판(100) 상 에 산화막(130) 및 폴리실리콘막(140)을 적층한 후 상기 폴리실리콘막(140) 상에 게이트용 포토레지스트 패턴(미도시)을 형성한다. 그리고, 상기 포토레지스트 패턴을 식각마스크로 사용하여 하부의 폴리실리콘막(140)을 식각하면 상기 게이트 전극(141)이 형성된다. The
상기 게이트 전극(141) 형성시 하부의 산화막(130)도 식각되어 상기 게이트 전극(141) 하부의 게이트 절연막(131)이 형성된다. When the
이때, 상기 반도체 기판(100) 상에 형성된 산화막(130)은 상기 게이트 전극(141) 형성시 식각되지만 모두 제거되지는 않으므로 상기 반도체 기판(100) 상에는 얇은 두께의 산화막(132)이 남아있는 상태가 된다. In this case, since the
또한, 상기 살리사이드 방지막(121) 상에도 상기 산화막(132)이 형성되므로 상기 살리사이드 방지막(121)의 두께는 두꺼워진다. In addition, since the
상기와 같이 게이트 전극(141) 형성을 위한 식각 시 상기 포토다이오드 형성 예정영역에는 상기 살리사이드 방지막(121)이 형성되어 있으므로 포토다이오드 형성 예정 영역의 반도체 기판(100)의 표면이 손상되는 것을 방지할 수 있다.As described above, since the
상기 게이트 전극(141) 및 별도의 감광막 패턴을 마스크로 이용한 불순물 주입을 통해 상기 게이트 전극(141)의 일측의 포토다이오드 형성 예정 영역에 n-영역 형성한다. 그리고, 상기 게이트 전극(141) 및 별도의 감막광 패턴을 마스크로 이용한 불순물 주입 공정을 통해 상기 포토다이오드 형성 예정 영역의 n- 영역 내에 얕은 깊이의 p0 영역이 형성됨으로써 포토다이오드(160)가 형성된다.The n-region is formed in the photodiode formation region on one side of the
그 다음, 상기 게이트 전극(141)의 양 측벽에 접하는 스페이서(151)를 형성하고, 상기 게이트 전극(141) 및 스페이서(151)를 이온주입 마스크로 이용한 불순물의 이온주입 공정을 통해 게이트 전극(141)의 타측에 플로팅 확산 영역(170)이 형성된다.Next, a
다시 도 9를 참조하여, 상기 반도체 기판(100)에 대한 표면 세정공정을 진행하여 상기 반도체 기판(100) 표면에 남아있는 산화막(132)을 게거한다. 그러면 도 10에 도시된 바와 같이 상기 반도체 기판(100) 상에는 살리사이드 방지막(121), 게이트 전극(141), 스페이서(151)가 남이있게 된다.9, an
예를 들어, 상기 산화막(132) 제거를 위한 세정공정 시 사용되는 세정액은 HF가 사용되며, 상기 산화막(132)은 약 100~125Å 정도 제거된다.For example, HF is used as the cleaning liquid used in the cleaning process for removing the
특히, 상기 살리사이드 방지막(121)의 두께는 상기 살리사이드 방지막(121)이외의 영역에 형성된 산화막(132) 보다 100Å 이상 두꺼운 두께로 형성되어 있으므로 상기 산화막(132)이 모두 제거되어도 상기 살리사이드 방지막(121)은 제거되지 않고 남아 있게 되어 상기 포토다이오드(160)의 표면을 보호할 수 있게 된다.In particular, since the thickness of the
도 11을 참조하여, 상기 게이트 전극(141) 및 플로팅 확산 영역(170)의 상면에 살리사이드층(190)이 형성된다. Referring to FIG. 11, a
상기 살리사이드층(190)은 상기 반도체 기판(100) 상으로 금속물질을 증착함으로써 상기 게이트 전극(141) 및 플로팅 확산 영역(170) 상에 형성된다. The
예를 들어 상기 살리사이드층(190)은 티타늄, 코발트 니켈, 몰리브덴 및 니켈 합급으로 이루어진 그룹 중 선택된 하나의 금속막을 상기 반도체 기판(100) 상으로 증착한다. 그리고, 금속막와 실리콘 사이의 실리사이드 반응을 유도하여 상기 게이트 전극(141) 및 플로팅 확산 영역(170) 상에 살리사이드층(190)을 형성할 수 있다.For example, the
이때, 상기 포토다이오드(160)의 상부에는 살리사이드 방지막(121)이 형성되 어 있으므로 상기 포토다이오드(160)는 살리사이드화 되지 않게 된다. In this case, since the
따라서, 상기 게이트 전극(141) 및 플로팅 확산 영역(170)의 상부는 살리사이드화되고 상기 포토다이오드(160) 상부는 살리사이드 방지막(121)에 의하여 넌살리사이드화되므로 상기 포토다이오드(160)의 집광율을 향상시킬 수 있다. Therefore, the upper portion of the
또한, 상기 살리사이드 방지막(121)은 희생 절연막(120)과 게이트 절연막(131) 형성을 위한 증착공정에 의해 형성된 것이므로, 종래의 포토다이오드(160) 상부에 보호막 형성시 진행되는 식각공정을 생략할 수 있으므로 공정을 단순화 시킬 수 있으며, 또한 상기 식각공정에 생략에 의하여 주변 회로영역의 문턱 전압 지연 불량을 방지할 수 있다. In addition, since the
이상에서 설명한 실시예는 전술한 실시에 및 도면에 한정되는 것이 아니고, 본 실시예의 기술적 사상을 벗어나지 않는 범위 내에서 여러 가지 치환, 변형 및 변경할 수 있다는 것은 본 실시예가 속하는 기술 분야에서 통상의 지식을 가진자에게 있어 명백할 것이다.The embodiments described above are not limited to the above-described embodiments and drawings, and it is to be understood that various changes, modifications, and changes can be made without departing from the technical spirit of the present embodiments. It will be obvious to those who have it.
실시예에 의한 이미지 센서 및 그의 제조방법은, 희생 산화막을 포토다이오드 표면에만 남겨둠으로써 상기 희생 산화막이 실리사이드 방지층이 되어 이후 식각공정에서 포토다이오드의 표면손상을 방지함으로써 다크 커런트 유발을 사전에 차단할 수 있는 효과가 있다.In the image sensor and the method of manufacturing the same, the sacrificial oxide is left on the surface of the photodiode so that the sacrificial oxide becomes a silicide prevention layer, thereby preventing the surface damage of the photodiode in the etching process, thereby preventing the occurrence of dark current in advance. It has an effect.
또한, 게이트 형성에 따른 식각 공정시 실리사이드 방지층에 포토다이오드 상부를 보호하고 있으므로 상기 식각 공정에 따른 포토다이오드의 표면 손상을 방지하여 소자의 신뢰성을 향상시킬 수 있는 효과가 있다. In addition, since the upper portion of the photodiode is protected on the silicide prevention layer during the etching process according to the gate formation, it is possible to prevent surface damage of the photodiode according to the etching process to improve the reliability of the device.
Claims (6)
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
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KR1020070047983A KR100866253B1 (en) | 2007-05-17 | 2007-05-17 | Method for manufacturing of the image sensor |
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Citations (2)
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KR20040007968A (en) * | 2002-07-15 | 2004-01-28 | 주식회사 하이닉스반도체 | Method for forming gate electrode of imase sensor |
KR20040036048A (en) * | 2002-10-23 | 2004-04-30 | 주식회사 하이닉스반도체 | Method of manufacturing image sensor using salicide process |
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2007
- 2007-05-17 KR KR1020070047983A patent/KR100866253B1/en not_active IP Right Cessation
Patent Citations (2)
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