KR100608427B1 - 무선 통신 시스템에 사용되는 전송기 - Google Patents

무선 통신 시스템에 사용되는 전송기 Download PDF

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Abstract

복수의 2진 스위치를 이용하는 2개의 개방 루프 전송 다이버시티 기법을 가진 공통 전송기 아키텍쳐가 개시되어 있다. 2진 스위치를 적용함으로써 상기 전송기가 직교 전송 다이버시터(orthogonal transmit diversity)(OTD) 기법 또는 공간 시간 분산(space time spreading)(STS) 기법 중 어느 기법을 이용하고 있는지에 따라 임의 소자를 공유할 수 있다. 따라서, 상기 전송기의 개수는 최소화되고, 한 개의 어플리케이션용 특정 집적 칩에서 실행될 수 있을 정도로 간단해진다.

Description

무선 통신 시스템에 사용되는 전송기{A TRANSMITTER ARCHITECTURE EMPLOYING SPACE TIME SPREADING AND ORTHOGONAL TRANSMIT DIVERSITY TECHNIQUES}
도 1은 본 발명에 따라 월쉬 함수를 이용하는 직교 전송 다이버시터 기법 및 공간 시간 분산 기법을 적용한 전송기에 대한 도시도.
도 2는 본 발명에 따라 월쉬 함수를 이용하는 직교 전송 다이버시티 및 공간 시간 분산 기법을 적용한 수신기의 한 개의 핑거에 대한 도시도.
본원의 동일한 양수인에게 양도된 미국 특허 출원 제09/294,661호는 발명가인 알 미켈 불러, 로버트 에트마람 소니 및 지안 트사이에 의해 1999년 4월 19일에 출원되었고 "월쉬 코드를 이용하는 CDMA의 다운링크 다이버시티용 방법 및 장치"란 명칭으로 관련된 발명의 주제가 개시되어 있다. 또한, 동시 출원이고 동일한 양수인에게 양도된 미국 특허 출원 번호 제 09/395,325 호는 알 미켈 불러, 로버트 에트마람 소니 및 스테판 에이 알프레스가 발명하였고 "공간 시간 분산 및 직교 전송 다이버시티 기법을 적용하는 수신기 아키텍쳐" 란 명칭으로 관련된 발명의 주제가 개시되어 있다.
본 발명은 일반적으로 무선 통신 시스템에 관한 것으로서, 특히 전송 다이버시티를 적용하는 무선 통신에 관한 것이다.
다수의 제 3 세대 무선 통신 시스템이 개발되고 있다. 그 중 하나의 제 3 세대 무선 통신 시스템은 CDMA 2000으로 알려져 있다. 통화 품질을 개선하기 위해 CDMA 2000의 다양한 기법이 도입되고 있다. 개방 루프 전송 다이버시티는 2개의 안테나를 이용하여 사용자 신호를 전송하는 그러한 기술이다. CDMA 2000의 제 1 단계에서, 개방 루프 전송 다이버시티는 직교 전송 다이버시티(OTD)의 형태로 현재 구현되고 있다. OTD에서는 분리된 안테나들이 짝수 데이터 비트 및 홀수 데이터 비트를 전송하여 전송 다이버시티 및 전송 품질을 향상시키기는데 이용된다.
CDMA 2000의 제 2 단계에서, 개방 루프 전송 다이버시티는 월쉬 함수 또는 코드를 이용하여 공간 시간 분산(STS)의 형태로 구현될 수 있다. STS는 사용되는 부호화 비율에 따라 OTD에 대해 가변 이득을 제공하는 것에 의해 통화 품질을 개선한다. 특히, STS에서, 홀수 데이터 비트 및 짝수 데이터 비트는 2개의 안테나를 걸쳐 결합 전송된다. 그러나, 한 개의 안테나를 통하여 전송되기 전에 상기 짝수 및 홀수 데이터 비트를 변조 처리하는 방법은 다른 안테나를 통하여 전송되고 있는 그 짝수 및 홀수 데이터 비트가 변조 처리되는 방법과 다를 것이다.
양(both) 개방 루프 전송 다이버시티 기법을 CDMA 2000에 옵션으로서 포함시키는 것은 공통 전송기 아키텍쳐내로 구현한다는 점에서 매우 복잡할 것이다. 따라서, 직교 전송 다이버시티 기법 및 공간 시간 분산 기법을 포함하는 공통 전송기 아키텍쳐를 간단히 구현할 필요성이 있다.
본 발명은 복수의 2진 스위치를 이용하는 2개의 개방 루프 전송 다이버시티 기법으로 이루어진 공통 전송기 아키텍쳐이다. 2진 스위치를 적용함으로써 상기 전송기가 직교 전송 다이버시터(orthogonal transmit diversity)(OTD) 기법을 이용하건 공간 시간 분산(space time spreading)(STS) 기법을 이용하건 임의 소자를 공유할 수 있다. 따라서, 상기 전송기의 개수는 최소화되고, 한 개의 어플리케이션 주문형 집적 회로(ASIC)에서 실행될 수 있을 정도로 간단해진다.
상기 전송기는 OTD 및 STS 모드를 포함하고, 제 1 및 제 2 안테나 시스템을 포함한다. 상기 제 1 안테나 시스템은 시간 멀티플렉서, 혼합기, 스위치 및 가산기를 포함한다. 상기 시간 멀티플렉서는 동위상 제 1 신호를 제 2 동위상 제 1 신호와 시간 멀티플렉싱하여 제 1 시간 멀티플렉싱 신호를 발생하고, 직교 위상 제 1 신호를 제 2 직교 위상 제 1 신호와 시간 멀티플렉싱하여 제 2 시간 멀티플렉싱 신호를 발생하고, 동위상 제 2 신호를 반전 동위상 제 2 신호와 시간 멀티플렉싱하여 제 3 시간 멀티플렉싱 신호를 발생하며, 직교 위상 제 2 신호를 반전 직교 위상 제 2 신호와 시간 멀티플렉싱하여 제 4 시간 멀티플렉싱 신호를 발생하는데 이용된다. 상기 혼합기는 상기 시간 멀티플렉서의 출력을 월쉬 함수와 혼합하여 제 1, 제 2, 제 3 및 제 4 혼합 시간 멀티플렉싱 신호를 발생하는데 이용된다. 상기 제 1 및 제 2 시간 멀티플렉싱 신호는 상기 가산기로 향한다. 상기 전송기가 STS 모드에 있으면, 그 스위치는 상기 제 3 및 제 4 혼합 시간 멀티플렉싱 신호를 가산기로 향하게 하여 상기 제 1 및 제 2 혼합 시간 멀티플렉싱 신호에 가산된다. 상기 전송기가 OTD 모드에 있으면, 그 스위치는 상기 제 3 및 제 4 혼합 시간 멀티플렉싱 신호를 상기 가산기로 향하게 하지 않는다.
상기 제 2 안테나 시스템은 시간 멀티플렉서, 혼합기, 스위치 및 가산기를 포함한다. 상기 시간 멀티플렉서는 동위상 제 2 신호를 상기 전송기가 제 1 동작 모드에 있을 때 반전 동위상 제 2 신호와 시간 멀티플렉싱하고, 그 전송기가 제 2 동작 모드에 있을 때 동위상 제 2 신호와 시간 멀티플렉싱하여 제 5 시간 멀티플렉싱 신호를 발생하며, 그 전송기가 상기 제 1 동작모드에 있을 때 직교 위상 제 2 신호를 반전 직교 위상 제 2 신호와 시간 멀티플렉싱하고, 제 2 동작 모드에 있을 때 직교 위상 제 2 신호와 시간 멀티플렉싱하여 제 6 멀티플렉싱 신호를 발생하며, 동위상 제 1 신호를 반전 동위상 제 1 신호와 시간 멀티플렉싱하여 제 7 멀티플렉싱 신호를 발생하며, 직교 위상 제 1 신호를 반전 직교 위상 제 1 신호와 시간 멀티플렉싱하여 제 8 시간 멀티플렉싱 신호를 발생한다. 상기 혼합기는 상기 시간 멀티플렉서의 출력을 월쉬 함수와 혼합하여 제 5, 제 6, 제 7 및 제 8 혼합 시간 멀티플렉싱 신호를 발생하는데 이용된다. 상기 제 5 및 제 6 시간 멀티플렉싱 신호는 상기 가산기로 지향된다. 그 전송기가 STS 모드에 있으면, 그 스위치는 상기 제 7 및 제 8 혼합 시간 멀티플렉싱 신호를 가산기로 향하게 하여 그 제 5 및 제 6 혼합 시간 멀티플렉싱 신호에 가산되게 한다. 상기 전송기가 OTD 모드에 있으면, 그 스위치는 상기 제 7 및 제 8 혼합 멀티플렉싱 신호가 가산기로 향하게 하지 않는다.
도 1은 본 발명에 따른 공통 전송기 아키텍쳐(10)를 도시한다. 전송기(10)는 통상적으로 기지국에서 합체되어, 직교 전송 다이버시티 기법 또는 공간 시간 분산(월쉬 또는 다른 직교 함수를 이용)기법 중 한 개를 사용하여 사용자 신호를 변조/처리하는 동작을 할 수 있다. 전송기(10)는 제 1 안테나 시스템(11) 및 제 2 안테나 시스템(28)을 포함한다. 논의를 용이하게 하기 위하여, 본 발명은 한 개의 사용자 신호에 관하여 본 명세서에서 기술될 것이다. 그러나, 본 발명은 복수의 사용자 신호에 적용될 수 있다는 것을 이해할 수 있을 것이다.
전송기(10)는 사용자 신호(Y)를 수신한다. 제 1 및/또는 제 2 안테나 시스템(11 및 28)에 의해 사용자 신호를 변조/처리하기 전에, 사용자 신호(Y)는 파스(parse)되고 짝수 데이터 비트 및 홀수 데이터 비트로 분할된 후 동위상 및 직교 위상 신호로 된다, 즉, 신호(Y)는 신호(YI1,YQ1,YI2,YQ2)로 변환되는데, I는 동위상 신호를 나타내고, Q는 직교 위상 신호를 나타내며, 1는 짝수 데이터 비트를 나타내고, 2는 홀수 데이터 비트를 나타낸다. 신호(YI1,YQ1,YI2,YQ2)는 제 1 및 제 2 안테나 시스템(11 및 28)에 입력으로 제공된다.
제 1 안테나 시스템(11)은 시간 멀티플렉서(12), 반전기(14), 스위치(16 및 26), 증폭기(18 및 20), 혼합기(22) 및 가산기(24)를 포함한다. 스위치(16 및 26)는 제 1 위치 및 제 2 위치를 갖는다. 스위치(16 및 26)가 모두 제 1 위치에 있을 때, 제 1 안테나 시스템(11)은 직교 전송 다이버시티 모드에서 동작한다. 이와 반대로, 스위치(16 및 26)가 모두 제 2 위치에 있을 때, 제 1 안테나 시스템(11)은 공간 시간 분산 모드에서 동작한다.
사용자 신호(YI1)는 시간 멀티플렉서(12-1)에 입력으로 제공된다. 그 시간 멀티플렉서(12-1)의 출력은 신호(YI1)의 자기 자신과의 시간 멀티플렉싱 신호(a time multiplexed signal of signal YI1 with itself)이다. 스위치(16-1)가 제 1 위치, 즉, OTD 모드에 있을 때, 시간 멀티플렉서(12-1)의 출력은 증폭기 (18-1)에 의해 이득(G)이 증폭되는 증폭기(18-1)로 지향된다. 스위치(16-1)가 제 2 위치, 즉, STS 모드에 있을 때, 시간 멀티플렉서(12-1)의 출력은 증폭기(20-1)에 의해 이득
Figure 112004001587986-pat00001
가 증폭된다.
증폭기(18-1) 및 증폭기(20-1)의 출력은 혼합기(22-1)에서 월쉬 함수를 혼합한 다음, 가산기(24-1)에 입력으로 제공된다. 혼합기(22-1)는 임의의 주어진 시간에 증폭기(18-1) 또는 (20-1) 중에서 한 개의 입력을 수신하여야 하며, 또한 어떤 다른 직교(또는 쿼시 직교) 함수(some other orthogonal(or quasi orthogonal) function)가 월쉬 함수 대신에 증폭기(18-1) 및 (20-1)의 출력을 혼합하는데 이용될 수 있다는 점에 유의해야 한다. 제 1 안테나 시스템(11)이 STS 모드, 즉, 스위치(16 및 26)가 모두 제 2 위치에 있으면, 혼합기(22-1)의 출력은 전송되기 전에 가산기(24-1)에 의해 혼합기(22-3)의 출력에 가산된다. 이와 반대로, 제 1 안테나 시스템(11)이 OTD 모드에 있으면, 즉, 스위치(16 및 26)이 모두 제 1 위치에 있으면, 혼합기(22-1)의 출력은 전송되기 전에 가산기(24-1)에 의해 혼합기(22-3)의 출력에 가산되지 않는다.
사용자 신호(YQ1)는 시간 멀티플렉서(12-2), 스위치(16-2), 증폭기(18-2 및 20-2), 혼합기(22-2), 가산기(24-2) 및 월쉬 함수(W1)를 사용하여 사용자 신호(YI1 )와 비슷한 방법으로 처리된다.
사용자 신호(YI2)는 YI2의 반전 신호(즉, 반전기 14-1의 출력)와 더불어 시간 멀티플렉서(12-3)에 입력으로 제공된다. 상기 시간 멀티플렉서(12-3)의 출력은 증폭기(20-3)에 입력으로 제공되는데, 그 증폭기는 이득
Figure 112004001587986-pat00002
가 증폭된다. 증폭기(20-3)의 출력은 혼합기(22-3)에 의해 월쉬 함수(W2)와 혼합된다. 스위치(26-1)가 제 2 위치에 있을 때, 혼합기(22-3)의 출력은 혼합기(22-1)의 출력에 가산될 수 있는 가산기(24-1)에 입력으로 제공된다. 이와 반대로, 스위치(26-1)가 제 1 위치에 있을 때, 혼합기(22-3)의 출력은 가산기(24-1)에 입력으로 제공되지 않는다.
제 1 안테나 시스템(11)에 의해 이용된 증폭기는 STS 모드에 있을 때 이득이
Figure 112004001587986-pat00003
이고, OTD 모드에 있을 때 이득은 G 인 것에 유의하라. 그러한 구성은 모드에 상관없이 제 1 안테나 시스템에 의한 동일한 출력 파워를 허용한다. 그러나, 제 1 안테나 시스템(11)이 OTD 모드에 있을 때, 짝수 데이터 비트만을 전송한다는 점에 주목해야 한다. 이와 반대로, 제 1 안테나 시스템(11)이 STS 모드에 있을 때, 짝수 및 홀수 데이터 비트 모두를 전송한다.
사용자 신호(YQ2)는 시간 멀티플렉서(12-4), 반전기(14-2), 증폭기(20-4), 혼합기(22-4), 스위치(26-2), 가산기(24-2) 및 월쉬 함수(W2)를 이용하여 신호 (YI2)와 비슷한 방법으로 처리된다.
제 2 안테나 시스템(28)은 스위치(29,33,40), 반전기(30), 시간 멀티플렉서 (32), 증폭기(34,36), 혼합기(38) 및 가산기(42)를 포함한다. 스위치(29,33,40)는 제 1 및 제 2 위치를 갖는다. 스위치(29,33,40)가 제 1 위치에 있을 때, 제 2 안테나 시스템(28)은 OTD 모드에서 동작한다. 이와 반대로, 스위치(29,33,40)가 제 2 위치에 있을 때, 제 2 안테나 시스템(28)은 STS 모드에서 동작한다.
스위치(29-1)가 제 1 위치에 있을 때, 사용자 신호(YI2)는 반전 사용자 신호 (YI2)(즉, 반전기 30-1의 출력)와 더불어 시간 멀티플렉서(32-1)에 입력으로 제공된다. 스위치(29-1)가 제 2 위치에 있을 때, 사용자 신호(YI2)는 시간 멀티플렉서(32-1)에 입력으로 2번 제공된다. 시간 멀티플렉서(32-1)내에서 사용자 신호(YI2)는 스위치(29-1)의 위치(제 2 안테나 시스템(28)의 모드)에 따라 그 자체의 신호 또는 반전된 신호와 시간 멀티플렉싱된다.
스위치(33-1)가 제 1 위치에 있을 때, 시간 멀티플렉서(32-1)의 출력은 증폭기(34-1)로 지향되는데, 그 시간 멀티플렉싱 신호는 증폭기(34-1)에 의해 이득 G로 증폭된다. 스위치(33-1)가 제 2 위치에 있을 때, 시간 멀티플렉서(32-1)의 출력은 시간 멀티플렉싱 신호가 증폭기(36-1)에 의해 이득
Figure 112004001587986-pat00004
으로 증폭되는 증폭기(36-1)로 지향된다.
증폭기(34-1 및 36-1)의 출력은 월쉬 함수(W3)와 혼합되는 혼합기(38-1)에 입력으로 제공된다. 혼합기(38-1)는 임의의 주어진 시간에 증폭기(34-1) 또는 (36-1) 중 한 개에서 제공된 입력만을 수신하여야 하며 동시에 양쪽에서 제공된 입력을 수신하여서는 안된다. 제 2 안테나 시스템 (28)이 STS 모드에 있으면, 즉, 스위치(29,33 및 40)가 모두 제 2 위치에 있으면, 상기 혼합기(38-1)의 출력은 전송되기 전에 가산기(42-1)에 의해 혼합기(38-3)의 출력에 가산된다. 이와 반대로, 제 2 안테나 시스템(28)이 OTD 모드에 있으면, 즉, 스위치(29,33,40)가 제 1 위치에 있으면, 혼합기(38-1)의 출력은 전송되기 전에 가산기(42-1)에 의해 혼합기(38-3)의 출력에 가산되지 않는다.
사용자 신호(YQ2)는 스위치(29-2, 33-2 및 40-2), 반전기(30-2), 시간 멀티플렉서 (32-2), 증폭기(34-2 및 36-2), 혼합기(38-2), 가산기(42-2) 및 월쉬 함수(W3)을 이용하여 사용자 신호(YI2)에 비슷한 방법으로 처리된다.
사용자 신호(YI1)는 반전 사용자 신호(YI2)와 더불어 시간 멀티플렉서(32-3)에 입력으로 제공된다. 시간 멀티플렉서(32-3)에서 사용자 신호(YI1)는 자체의 반전 신호와 시간 멀티플렉싱된다. 시간 멀티플렉서(32-3)의 출력은 증폭기(36-3)에 의해
Figure 112004001587986-pat00005
이득으로 증폭된다.
증폭기(36-3)의 출력은 월쉬 함수(W4)와 혼합기(38-3)에서 혼합된다. 스위치(40-1)가 제 2 위치에 있을 때, 혼합기(38-3)의 출력은 혼합기(38-1)의 출력에 가산되는 가산기(42-1)에 입력으로 제공된다. 스위치(40-1)가 제 1 위치에 있을 때, 상기 혼합기(38-3)의 출력은 가산기(42-1)의 입력으로 제공되지 않는다.
사용자 신호(YQ1)는 반전기(30-4), 시간 멀티플렉서(32-4), 증폭기(36-4), 혼합기(38-4), 스위치(40-2) 및 가산기(42-2)를 이용하여 사용자 신호(YI1)에 비슷한 방법으로 처리된다.
제 1 안테나 시스템(11)의 증폭기처럼, 제 2 안테나 시스템(28)의 증폭기는 STS 모드에 있을 때 이득이
Figure 112004001587986-pat00006
이고, OTD 모드에 있을 때 이득이 G 이다. 그러한 구성은 모드에 상관없이 제 2 안테나 시스템에 의한 동일한 출력 파워를 허용한다. 그러나, 증폭기의 임의의 배치 및 이득을 이용할 수 있다는 점을 이해해야 한다. 또한, 제 2 안테나 시스템(28)이 OTD 모드에 있을 때, 홀수 데이터 비트만 전송한다. 이와 반대로, 제 2 안테나 시스템(28)이 STS 모드에 있을 때, 홀수 및 짝수 데이터 비트를 모두 전송한다.
바람직한 실시예에 있어서, 월쉬 함수(W1,W2,W3,W4)는 동일하다. 논의를 편하게 하기 위하여, 월쉬 함수(W1,W2,W3,W4)가 동일하다는 것을 가정하는 공통 수신기 아키텍쳐가 본 명세서에 개시되어 있다는 것을 주목해야 한다. 다른 월쉬 함수(W1,W2, W3,W4) 또는 그들의 결합을 이용하고, 본 명세서에 개시된 공통 수신기 아키텍쳐가 다른 월쉬 함수(W1,W2,W3,W4) 또는 그들의 결합에 적응될 수 있다는 점을 이해해야 한다.
전송기(10)의 반대편에는 상기 전송기(10)에 의해 전송된 신호를 수신하여 복조처리하는 수신기가 있다(통상적으로 이동국에 포함). 도 2는 본 발명에 따른 공통 수신기 아키텍쳐의 한 개의 핑거(50)를 도시한다. 핑거(50)는 직교 전송 다이버시티 또는 공간 시간 분할(월쉬 또는 몇개의 다른 직교 기능) 기법 중 한 가지를 사용하는 (전송기(10) 또는 유사한 전송기를 사용하여 전송된) 수신 신호를 복조/처리하기 위하여 동작된다. 핑거(50)는 혼합기(52, 54, 56, 58, 60 및 62), 가산기(64, 66, 68 및 70), 시간 멀티플렉서(72), 반전기(59, 61, 63), 적분기(53 및 55) 및 스위치(74,76 및 78)를 포함한다. 스위치(74,76,78)는 제 1 및 제 2 위치를 갖는다. 스위치(74,76,78)가 제 1 위치에 있을 때, 핑거(50)는 OTD 모드에서 동작한다. 이와 반대로, 스위치 (74,76,78)가 모두 제 2 위치에 있을 때, 핑거(50)는 STS 모드에서 동작한다.
핑거(50)가 신호r(t)를 수신할 때, 그 수신 신호r(t)는 혼합기(52 및 54)에 입력으로 제공된다. 혼합기(52)에서, 수신 신호r(t)는 확장된 월쉬 함수W(t), 즉, 반복 월쉬 함수(repeated Walsh function) W(t)와 혼합된다. 혼합기(52)의 출력은 적분기(53)에 입력으로 제공된다. 혼합기(54)에서 수신된 신호r(t)는 상기 확장 월쉬 함수 W(t)의 보수(complement)인 함수
Figure 112004001587986-pat00007
와 혼합된다. 혼합기(54)의 출력은 적분기(55)에 입력으로 제공된다. 논의를 용이하게 하기 위하여 월쉬 함수(W1,W2,W3,W4)가 전송기(10)에서 동일하였음을 상기하라. 따라서, 월쉬 함수 W(t)은 월쉬 함수(W1,W2,W3,W4)와 동일하다.
적분기(53 및 55)에서, 혼합기(52 및 54)의 출력은 월쉬 함수 W(t) 또는
Figure 112004001587986-pat00008
(혹은 심볼 레이트)의 길이에 걸쳐 적분된 다음 덤프(dump)된다. 상기 혼합기(52 및 54)가 칩 레이트에서 혼합하는 것을 주목해라. 적분기(53)의 출력은 혼합기(56 및 62)에 입력으로 제공된다. 적분기(55)의 출력은 혼합기(58)에 입력으로 제공되고, 혼합기(54)의 출력의 쌍(conjugate)은 혼합기(60)의 입력으로 제공되고, 여기서 그 혼합기(54)의 출력의 쌍은 반전기(61)를 이용하여 혼합기(54)의 출력의 직교 스트림을 반전시킴으로써 얻어진다.
혼합기(56)에서, 혼합기(52)의 출력은 제 1 안테나 시스템(11)에 대한 채널 평가의 쌍을 나타내는 신호
Figure 112000019056476-pat00009
로 혼합된다. 혼합기(62)에서, 혼합기(52)의 출력은 제 2 안테나 시스템(28)에 대한 채널 평가의 쌍을 나타내는 신호
Figure 112000019056476-pat00010
와 혼합된다. 혼합기(58)에서, 혼합기(54)의 출력은 상기 신호
Figure 112000019056476-pat00011
와 혼합된다. 혼합기(60)에서, 혼합기(54)의 출력 쌍은 제 1 안테나 시스템(11)에 대한 채널 평가를 나타내는 신호
Figure 112000019056476-pat00012
와 혼합된다. 일 실시예에 있어서, 제 1 및 제 2 안테나 시스템(11 및 28)에 대한 채널 평가는 제 1 및 제 2 안테나 시스템(11 및 28)에서 전송된 파일럿 신호를 이용하여 얻어진다.
혼합기(56)의 출력은 가산기(64)의 입력으로 제공된다. 스위치(74)가 제 2 위치에 있을 때, 혼합기(58)의 출력 쌍은 상기 혼합기(58)의 출력 및 혼합기(56)의 출력의 쌍이 함께 가산되는 가산기(64)의 입력으로 제공된다. 상기 혼합기(58)의 출력 쌍이 반전기(59)를 이용하여 혼합기(58)의 출력의 직교 스트림을 반전시킴으로써 얻어진다는 점에 유의하기 바란다. 상기 가산기(64)의 출력은 다른 핑거로부터의 동일 관련 혼합기(same relative mixers)의 출력과 가산되는 가산기(68)에 입력으로 제공된다.
스위치(74)가 제 1 위치에 있을 때, 그 혼합기(58)의 출력은 가산기(66)에 입력으로 제공된다. 스위치(76 및 78)가 제 2 위치에 있을 때, 혼합기(60)의 출력(반전기(63)를 경유) 및 혼합기(62)의 출력은 가산기(66)에 입력으로 제공된다. 스위치 (76 및 78)가 제 1 위치에 있을 때, 혼합기(60)의 반전 출력 및 혼합기(62)의 출력은 가산기(66)에 입력으로 제공되지 않는다. 상기 출력 혼합기(58)가 혼합기(60)의 반전 출력 및 혼합기(62)의 출력과 동일한 시간에 가산기(66)에 입력으로 제공되지 않아야 한다는 점을 주목해야 한다. 상기 가산기(66)의 출력은 다른 핑거로부터의 동일 관련 혼합기의 출력에 가산되는 가산기(70)에 입력으로 제공된다.
가산기(68 및 70)의 출력은 시간 멀티플렉서(72)에 의해 서로 시간 멀티플렉스되어 디코더(도시 안함)로 지향된다. 2개의 모드 중에서, 혼합기(84)의 출력은 짝수 데이터 비트의 수신 버젼에 해당하고, 혼합기(66)의 출력은 홀수 데이터 비트의 수신 버젼에 해당하는 점을 주목해야 한다.
본 발명은 제 3 세대 코드 분할 다중 접속 기법에 기초한 무선 통신 시스템과 같은 임의의 실시예를 참조하여 본 명세서에서 기술되어 있다. 본 발명은 다른 다중 접속 기술에 기초한 무선 통신에 적용할 수 있다. 또한, 동일한 사용자 신호에 대한 짝수 및 홀수 데이터 비트 대신에, 본 발명은 다른 사용자 신호에 대한 짝수 및 홀수 데이터 비트 혹은 어떤 다른 조합에 적용할 수 있다. 또한, 본 발명은 2개의 동일한(짝수 및 홀수 데이터 비트로의) 비분할 사용자 신호에 적용될 수 있다. 따라서, 본 발명은 본원에 개시된 실시예에 국한되는 것은 아니다.

Claims (30)

  1. 개방 루프 송신 다이버시티를 이용하는 무선 통신 시스템에 사용되는 전송기에 있어서,
    동위상 제 1 신호(in-phase first signal)를 제 2 동위상 제 1 신호와 시간 멀티플렉싱(time multiplexing)하는 제 1 시간 멀티플렉서(12-1)와,
    상기 제 1 시간 멀티플렉서의 출력을 제 1 함수(function)와 혼합하는 제 1 혼합기(22-1)와,
    직교 위상 제 1 신호(quadrature phase first signal)를 제 2 직교 위상 제 1 신호와 시간 멀티플렉싱하는 제 2 시간 멀티플렉서(12-2)와,
    상기 제 2 시간 멀티플렉서의 출력을 상기 제 1 함수와 혼합하는 제 2 혼합기(22-2)와,
    동위상 제 2 신호를 반전(inverted) 동위상 제 2 신호와 시간 멀티플렉싱하는 제 3 시간 멀티플렉서(12-3)와,
    상기 제 3 시간 멀티플렉서의 출력을 제 2 함수와 혼합하는 제 3 혼합기(22-3)와,
    직교 위상 제 2 신호를 반전 직교 위상 제 2 신호와 시간 멀티플렉싱하는 제 4 시간 멀티플렉서(12-4)와,
    상기 제 4 시간 멀티플렉서의 출력을 상기 제 2 함수와 혼합하는 제 4 혼합기(22-4)와,
    제 1 및 제 2 위치를 가지며 상기 제 3 혼합기의 출력을 지향(direct)시키는 제 1 스위치(26-1)와,
    제 1 및 제 2 위치를 가지며 상기 제 4 혼합기의 출력을 지향시키는 제 2 스위치(26-2)- 상기 전송기는 상기 제 1 및 제 2 스위치가 상기 제 1 위치에 있을 경우 제 1 동작 모드로 존재하고 상기 제 1 및 제 2 스위치가 상기 제 2 위치에 있는 경우 제 2 동작 모드로 존재함 -와,
    상기 제 1 스위치가 상기 제 2 위치에 있을 때 제 1 혼합기의 출력 및 제 3 혼합기의 출력을 가산하고 상기 제 1 스위치가 상기 제 1 위치에 있을 때 가산하지 않는 제 1 가산기(24-1)와,
    상기 제 2 스위치가 상기 제 2 위치에 있을 때 상기 제 2 혼합기의 출력 및 상기 제 4 혼합기의 출력을 가산하고 상기 제 2 스위치가 상기 제 1 위치에 있을 때 가산하지 않는 제 2 가산기(24-2)와,
    상기 전송기가 상기 제 1 동작 모드에 있을 때 제 2 동위상 신호를 제 2 반전 동위상 제 2 신호와 시간 멀티플렉싱하고, 제 2 동작 모드에 있을 때 제 3 동위상 제 2 신호와 시간 멀티플렉싱하는 제 5 시간 멀티플렉서(32-1)와,
    상기 제 5 시간 멀티플렉서의 출력을 제 3 함수와 혼합하는 제 5 혼합기(38-1)와,
    상기 전송기가 상기 제 1 동작 모드에 있을 때 제 2 직교 위상 제 2 신호를 제 2 반전 직교 위상 제 2 신호와 시간 멀티플렉싱하고, 제 2 동작 모드에 있을 때 제 3 직교 위상 제 2 신호와 시간 멀티플렉싱하는 제 6 시간 멀티플렉서(32-2)와,
    상기 제 6 시간 멀티플렉서의 출력을 상기 제 3 함수와 혼합하는 제 6 혼합기(38-2)와,
    제 3 동위상 제 1 신호를 반전 동위상 제 1 신호와 시간 멀티플렉싱하는 제 7 시간 멀티플렉서(32-3)와,
    상기 제 7 시간 멀티플렉서의 출력을 제 4 함수와 혼합하는 제 7 혼합기(38-3)와,
    제 3 직교 위상 제 1 신호를 반전 직교 위상 제 1 신호와 시간 멀티플렉싱하는 제 8 시간 멀티플렉서(32-4)와,
    상기 제 8 시간 멀티플렉서의 출력을 상기 제 4 함수와 혼합하는 제 8 혼합기(38-4)와,
    상기 전송기가 상기 제 2 동작 모드에 있을 때 상기 제 5 혼합기의 출력 및 상기 제 7 혼합기의 출력을 가산하는 제 3 가산기(42-1)와,
    상기 전송기가 제 2 동작 모드에 있을 때 상기 제 6 혼합기의 출력 및 상기 제 8 혼합기의 출력을 가산하는 제 4 가산기(42-2)를
    포함하는 전송기.
  2. 삭제
  3. 삭제
  4. 삭제
  5. 삭제
  6. 삭제
  7. 삭제
  8. 삭제
  9. 삭제
  10. 삭제
  11. 삭제
  12. 삭제
  13. 제 1 항에 있어서,
    제 1 및 제 2 위치를 갖는 제 3 스위치(40-1)로서, 상기 제 3 스위치가 제 2 위치에 있을 때 상기 제 7 혼합기의 출력이 상기 제 3 가산기로 향하고, 상기 제 3 스위치가 제 1 위치에 있을 때 상기 제 3 가산기로 향하지 않는 제 3 스위치(40-1)와,
    제 1 및 제 2 위치를 갖는 제 4 스위치(40-2)로서, 상기 제 4 스위치가 제 2 위치에 있을 때 상기 제 8 혼합기의 출력이 상기 제 4 가산기로 향하고, 상기 제 4 스위치가 제 1 위치에 있을 때 상기 제 4 가산기로 향하지 않는 제 4 스위치(40-2)를
    더 포함하는 전송기.
  14. 삭제
  15. 제 1 항에 있어서,
    상기 제 3 동위상 제 2 신호를 반전시켜 상기 제 2 반전 동위상 제 2 신호를 발생하는 제 1 반전기(30-1)와,
    상기 제 3 직교 위상 제 2 신호를 반전시켜 상기 제 2 반전 직교 위상 제 2 신호를 발생하는 제 2 반전기(30-2)와,
    제 1 및 제 2 위치를 갖는 제 3 스위치로서, 상기 제 3 스위치가 제 2 위치에 있을 때 상기 제 3 동위상 제 2 신호가 상기 제 5 시간 멀티플렉서로 향하고, 상기 제 3 스위치가 제 1 위치에 있을 때 상기 제 1 반전기로 향하는 제 3 스위치(29-1)와,
    제 1 및 제 2 위치를 갖는 제 4 스위치로서, 상기 제 4 스위치가 제 2 위치에 있을 때 상기 제 3 직교 위상 제 2 신호가 상기 제 6 시간 멀티플렉서로 향하고, 상기 제 3 스위치가 제 1 위치에 있을 때 상기 제 2 반전기로 향하는 제 4 스위치(29-2)를
    더 포함하는 것을 특징으로 하는 전송기.
  16. 제 1 항에 있어서,
    상기 제 5 시간 멀티플렉서의 출력을 증폭하는 제 1 증폭기(34-1,36-1)와,
    상기 제 6 시간 멀티플렉서의 출력을 증폭하는 제 2 증폭기(34-2,36-2)와,
    상기 제 7 시간 멀티플렉서의 출력을 증폭하는 제 3 증폭기(34-3,36-3)와,
    상기 제 8 시간 멀티플렉서의 출력을 증폭하는 제 4 증폭기(34-4,36-4)를
    더 포함하는 전송기.
  17. 제 16 항에 있어서,
    상기 제 3 증폭기는 이득
    Figure 112006014810149-pat00017
    만큼 상기 제 7 시간 멀티플렉서의 출력을 증폭하고, 상기 제 4 증폭기는 이득
    Figure 112006014810149-pat00018
    만큼 상기 제 8 시간 멀티플렉서의 출력을 증폭하고, 상기 제 1 증폭기는 이득 G 만큼 상기 제 5 시간 멀티플렉서의 출력을 증폭하는 제 1 증폭기 A 및 이득
    Figure 112006014810149-pat00019
    만큼 상기 제 5 시간 멀티플렉서의 출력을 증폭하는 제 1 증폭기 B를 포함하고, 상기 제 2 증폭기는 이득 G 만큼 상기 제 6 시간 멀티플렉서의 출력을 증폭하는 제 2 증폭기 A 및 이득
    Figure 112006014810149-pat00020
    만큼 상기 제 6 시간 멀티플렉서의 출력을 증폭하는 제 2 증폭기 B를 포함하는 전송기.
  18. 제 17 항에 있어서,
    상기 제 5 시간 멀티플렉서의 출력을 상기 전송기가 제 1 동작 모드에 있을 때 상기 제 1 증폭기 A로 향하게 하고, 상기 전송기가 제 2 동작 모드에 있을 때 제 1 증폭기 B로 향하게 하는 제 1 스위치(33-1)와,
    상기 제 6 시간 멀티플렉서의 출력을 상기 전송기가 제 1 동작 모드에 있을 때 제 2 증폭기 A로 향하게 하고, 상기 전송기가 제 2 동작 모드에 있을 때 제 2 증폭기 B로 향하게 하는 제 2 스위치(33-2)를
    더 포함하는 전송기.
  19. 삭제
  20. 제 1 항에 있어서,
    상기 제 1 및 제 2 함수는 직교 또는 쿼시 직교 함수인 전송기.
  21. 제 1 항에 있어서,
    상기 제 1 및 제 2 함수는 월쉬 함수인 전송기.
  22. 제 1 항에 있어서,
    상기 제 1 및 제 2 함수는 상이한 전송기.
  23. 제 1 항에 있어서,
    상기 제 1 및 제 2 함수는 동일한 전송기.
  24. 삭제
  25. 제 1 항에 있어서,
    상기 제 1 시간 멀티플렉서의 출력을 증폭하는 제 1 증폭기(18-1,20-1)와,
    상기 제 2 시간 멀티플렉서의 출력을 증폭하는 제 2 증폭기(18-2,20-2)와,
    상기 제 3 시간 멀티플렉서의 출력을 증폭하는 제 3 증폭기(18-3,20-3)와,
    상기 제 4 시간 멀티플렉서의 출력을 증폭하는 제 4 증폭기(18-4,20-4)를
    더 포함하는 전송기.
  26. 제 25 항에 있어서,
    상기 제 3 증폭기는 이득
    Figure 112006014810149-pat00021
    만큼 제 3 시간 멀티플렉서의 출력을 증폭하고, 상기 제 4 증폭기는 이득
    Figure 112006014810149-pat00022
    만큼 제 4 시간 멀티플렉서의 출력을 증폭하고, 상기 제 1 증폭기는 이득 G 만큼 제 1 시간 멀티플렉서의 출력을 증폭하는 제 1 증폭기 A 및 이득
    Figure 112006014810149-pat00023
    만큼 제 1 시간 멀티플렉서의 출력을 증폭하는 제 1 증폭기 B를 포함하고, 상기 제 2 증폭기는 이득 G 만큼 제 2 시간 멀티플렉서의 출력을 증폭하는 제 2 증폭기 A 및 이득
    Figure 112006014810149-pat00024
    만큼 제 2 시간 멀티플렉서의 출력을 증폭하는 제 2 증폭기 B를 포함하는 전송기.
  27. 제 26 항에 있어서,
    상기 제 1 시간 멀티플렉서의 출력을 상기 전송기가 제 1 동작 모드에 있을 때 상기 제 1 증폭기 A로 향하게 하고, 상기 전송기가 제 2 동작 모드에 있을 때 상기 제 1 증폭기 B로 향하게 하는 제 3 스위치(16-1)와,
    상기 제 2 시간 멀티플렉서의 출력을 상기 전송기가 제 1 동작 모드에 있을 때 상기 제 2 증폭기 A로 향하게 하고, 상기 전송기가 제 2 동작 모드에 있을 때 상기 제 2 증폭기 B로 향하게 하는 제 4 스위치(16-2)를
    더 포함하는 전송기.
  28. 제 1 항에 있어서,
    상기 제 1 신호는 사용자 신호의 짝수 데이터 비트를 포함하고, 상기 제 2 신호는 상기 사용자 신호의 홀수 데이터 비트를 포함하는 전송기.
  29. 제 1 항에 있어서,
    상기 제 1 및 제 2 신호는 동일한 신호인 전송기.
  30. 제 1 항에 있어서,
    상기 제 1 및 제 2 신호는 상이한 신호인 전송기.
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