KR100508252B1 - 선택적 소거를 이용한 플라즈마 디스플레이 패널의구동방법 및 장치 - Google Patents

선택적 소거를 이용한 플라즈마 디스플레이 패널의구동방법 및 장치 Download PDF

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Abstract

본 발명은 콘트라스트비와 휘도를 높이도록 한 플라즈마 디스플레이 패널의 구동방법 및 장치에 관한 것이다.
이 플라즈마 디스플레이 패널의 구동방법은 제1 및 제2 전극을 각각 포함한 다수의 전극쌍이 형성된 상판과 상기 다수의 전극쌍과 교차하는 다수의 제3 전극이 형성된 하판을 구비하며 상기 전극들의 교차부에 셀들이 형성되는 PDP를 구동하기 위한 방법에 있어서, 리셋기간 동안 전압이 셋업전압까지 상승하는 상승 램프파형과 상기 셋업전압보다 낮고 OV보다 높은 직류전압을 상기 제1 전극에 공급하여 상기 셀들을 초기화하는 제1 단계와; 어드레스 기간 동안 상기 기준 바이어스전압으로부터 낮아지는 스캔전압을 상기 제1 전극에 공급하고 상기 제3 전극에 데이터전압을 공급하여 상기 셀을 선택하는 제2 단계와; 상기 제1 및 제2 전극에 상기 서스테인전압을 교대로 공급하여 표시를 행하는 제3 단계를 포함한다.

Description

선택적 소거를 이용한 플라즈마 디스플레이 패널의 구동방법 및 장치{Method and Apparatus for Driving Plasma Display Panel Using Selective Erasure}
본 발명은 플라즈마 디스플레이 패널의 구동방법 및 장치에 관한 것으로, 특히 콘트라스트비(contrast ratio)와 휘도를 높이도록 한 플라즈마 디스플레이 패널의 구동방법 및 장치에 관한 것이다.
플라즈마 디스플레이 패널(Plasma Display Panel : 이하 "PDP"라 함)은 He+Xe, Ne+Xe, He+Xe+Xe 가스의 방전시 발생하는 자외선에 의해 형광체를 발광시킴으로써 화상을 표시하게 된다. 이러한 PDP는 박막화와 대형화가 용이할 뿐만 아니라 최근의 기술 개발에 힘입어 크게 향상된 화질을 제공한다. 특히, 3전극 교류 면방전형 PDP는 방전시 표면에 축적된 벽전하를 이용하여 방전에 필요한 전압을 낮추게 되며, 방전에 의해 발생되는 스퍼터링으로부터 전극들을 보호하기 때문에 저전압 구동과 장수명의 장점을 가진다.
도 1 및 도 2를 참조하면, 3전극 교류 면방전형 PDP는 상부기판(10) 상에 형성되어진 스캔전극(Y1 내지 Yn) 및 서스테인전극(Z)과, 하부기판(18) 상에 형성되어진 어드레스전극(X1 내지 Xm)을 구비한다.
이 PDP의 방전셀들(1)은 스캔전극들(Y1 내지 Yn), 서스테인전극들(Z) 및 어드레스전극들(X1 내지 Xm)의 교차부에 형성된다.
스캔전극(Y1 내지 Yn)과 서스테인전극(Z) 각각은 투명전극(12)과, 투명전극(12)보다 작은 선폭을 가지며 투명전극의 일측 가장자리에 형성되는 금속버스전극(11)을 포함한다. 투명전극(12)은 통상 인듐틴옥사이드(Indium-Tin-Oxide : ITO)로 상부기판(10) 상에 형성된다. 금속버스전극(11)은 통상 금속으로 투명전극(12) 상에 형성되어 저항이 높은 투명전극(12)에 의한 전압강하를 줄이는 역할을 한다. 스캔전극(Y1 내지 Yn)과 서스테인전극(Z)이 형성된 상부기판(10)에는 상부 유전체층(13)과 보호막(14)이 적층된다. 상부 유전체층(13) 상에는 플라즈마 방전시 발생된 벽전하가 쌓이게 된다. 보호막(14)은 플라즈마 방전시 발생된 스퍼터링으로부터 전극들(Y1 내지 Yn, Z)과 상부 유전체층(13)을 보호하고 2차 전자의 방출 효율을 높이게 된다. 이 보호막(14)으로는 통상 산화마그네슘(MgO)이 이용된다.
어드레스전극(X1 내지 Xm)은 스캔전극(Y1 내지 Yn) 및 서스테인전극(Z)과 교차되는 방향으로 하부기판(18) 상에 형성된다. 하부기판(18) 상에는 하부 유전체층(17)과 격벽(15)이 형성된다. 하부 유전체층(17)과 격벽(15)의 표면에는 형광체층(16)이 형성된다. 격벽(15)은 어드레스전극(X1 내지 Xm)과 나란하게 형성되어 방전셀을 물리적으로 구분하며, 방전에 의해 생성된 자외선과 가시광이 인접한 방전셀에 누설되는 것을 차단한다. 형광체층(16)은 플라즈마 방전시 발생된 자외선에 의해 여기·발광되어 적색, 녹색 또는 청색 중 어느 하나의 가시광선을 발생한다.
상/하부기판(10,18)과 격벽(15) 사이에 마련된 방전셀의 방전공간에는 방전을 위한 He+Xe, Ne+Xe, He+Xe+Ne 등의 불활성 혼합가스가 주입된다.
이러한 3전극 교류 면방전형 PDP는 화상의 계조(Gray Level)를 구현하기 위하여 한 프레임을 발광횟수가 다른 여러 서브필드로 나누어 구동하고 있다. 256 계조로 화상을 표시하고자 하는 경우에 1/60 초에 해당하는 프레임 기간(16.67ms)은 도 3과 같이 8개의 서브필드들(SF1 내지 SF8)로 나누어지게 된다. 각 서브필드(SF1 내지 SF8)는 방전셀들을 초기화하기 위한 리셋 기간, 방전셀을 선택하기 위한 어드레스 기간 및 방전횟수에 따라 계조를 구현하는 서스테인 기간으로 나뉘어진다. 각 서브필드(SF1 내지 SF8)의 리셋기간 및 어드레스 기간은 각 서브필드마다 동일한 반면에, 서스테인 기간 및 그 방전횟수는 각 서브필드에서 2n(단, n=0,1,2,3,4,5,6,7)의 비율로 증가된다.
이와 같은 PDP의 구동방법은 어드레스 방전에 의해 선택되는 방전셀의 발광여부에 따라 선택적 쓰기(Selective writing) 방식과 선택적 소거(Selective erasing) 방식으로 대별된다.
선택적 쓰기방식은 리셋기간에 전화면을 끈 후, 어드레스 기간에 켜져야할 온셀들(on-cell)을 선택하고 서스테인 기간 동안 어드레스 방전에 의해 선택된 온셀들의 방전을 유지시킴으로써 화상을 표시하게 된다. 이 선택적 쓰기 방식에 있어서 스캔라인을 선택하고 어드레스 방전을 일으키기 위한 스캔펄스(Scan pulse)는 그 펄스폭이 비교적 넓게 설정된다. 이 때문에 선택적 쓰기 방식은 어드레스기간이 길기 때문에 서스테인기간의 확보가 어렵고 고해상도에 대처하기 어려울뿐 아니라 휘도가 낮고 동영상에서 나타날 수 있는 의사 윤곽노이즈(contour noise) 등의 화질 저하 요인을 줄이기 위하여 서브필드를 추가하기도 곤란한 문제점이 있다. 또한, 선택적 소거 방식은 도 4에서 알 수 있는 바와 같이 각 서브필드의 리셋기간마다 가시광의 방출을 수반하는 약방전(weak discharge)이 셋업 방전과 셋다운방전이 일어나게 되므로 콘트라스트비가 저하되어 선명한 화질로 화상을 표시하기가 어려운 문제점 있다. 즉, 비표시기간인 리셋기간에서 방전시에 방출되는 가시광에 의해 콘트라스트비에서 블랙 휘도레벨이 높아지게 된다.
도 4는 선택적 쓰기 방식에서 두 개의 서브필드(SF1, SF2)에 공급되는 PDP의 구동파형을 나타낸다.
도 4를 참조하면, 리셋기간의 셋업기간(SU)에는 모든 스캔전극들(Y)에 상승 램프파형(Ramp-up)이 동시에 공급된다. 이와 동시에, 서스테인전극(Z)과 어드레스전극(X)에는 0[V]가 공급된다. 상승 램프파형(Ramp-up)에 의해 전화면의 셀들 내에서 스캔전극(Y)과 어드레스전극(X) 사이와 스캔전극(Y)과 서스테인전극(Z) 사이에는 약방전으로 셋업방전이 일어난다. 이 셋업방전에 의해 어드레스전극(X)과 서스테인전극(Z) 상에는 정극성(+)의 벽전하가 쌓이게 되며, 스캔전극(Y) 상에는 부극성(-)의 벽전하가 쌓이게 된다. 리셋기간의 셋다운기간(SD)에는 대략 서스테인전압부터 떨어지기 시작하여 기저전압(GND)이나 0[V]까지 전압이 떨어지는 하강 램프파형(Ramp-dn)이 스캔전극들(Y)에 동시에 공급된다. 이 하강 램프파형(Ramp-dn)이 스캔전극들(Y)에 공급되는 동안, 서스테인전극(Z)에는 정극성의 서스테인전압(Vs)이 공급되고, 어드레스전극(X)에는 0[V]가 공급된다. 이렇게 하강 램프파형(Ramp-dn)이 공급될 때, 스캔전극(Y)과 서스테인전극(Z) 사이와 스캔전극(Y)과 어드레스전극(X) 사이에 약방전으로 셋다운방전이 일어난다. 이러한 셋다운방전에 의해 셋업방전시에 형성된 벽전하들 중에서 어드레스방전에 불필요한 과도한 벽전하들이 소거된다. 이러한 리셋기간에서의 벽전하 변화를 살펴보면, 어드레스전극(X) 상의 벽전하 변화는 거의 없으며, 셋업방전시 형성되었던 스캔전극(Y) 상의 부극성(-) 벽전하들이 셋다운방전에 의해 일부 감소된다. 반면에, 서스테인전극(Z) 상에는 셋업방전시 정극성 벽전하가 형성되었으나 셋다운방전시 스캔전극(Y)의 부극성 벽전하의 감소분만큼 자신에게 부극성 벽전하가 쌓이면서 부극성 벽전하가 쌓이게 된다.
어드레스기간에는 부극성 스캔펄스(scan)가 스캔전극들(Y)에 순차적으로 공급됨과 동시에 스캔펄스(scan)에 동기되어 어드레스전극들(X)에 정극성의 데이터펄스(data)가 공급된다. 스캔펄스(scan)와 데이터펄스(data)의 전압차와 리셋기간에 생성된 벽전압이 더해지면서 데이터펄스(data)가 공급되는 온셀 내에는 어드레스 방전이 발생된다. 어드레스방전에 의해 선택된 온셀들 내에는 서스테인전압(Vs)이 공급될 때 방전이 일어날 수 있게 하는 정도의 벽전하가 형성된다. 이 어드레스기간 동안 서스테인전극(Z)에는 정극성 직류전압(Zdc)이 공급된다.
서스테인기간에는 스캔전극들(Y)과 서스테인전극들(Z)에 교번적으로 서스테인펄스(sus)가 공급된다. 어드레스방전에 의해 선택된 온셀들은 셀 내의 벽전압과 서스테인펄스(sus)가 더해지면서 매 서스테인펄스(sus)가 공급될 때 마다 스캔전극(Y)과 서스테인전극(Z) 사이에 서스테인방전 즉, 표시방전이 발생된다. 서스테인방전이 완료된 후에는 펄스폭과 전압레벨이 작은 소거 램프파형(ramp-ers)이 서스테인전극(Z)에 공급되어 전화면의 셀들 내에 잔류하는 벽전하를 소거시키게 된다.
선택적 소거방식은 리셋기간에 전화면을 켠 후에, 어드레스 기간에 꺼져야 할 오프셀들(off-cell)을 선택하고 서스테인 기간 동안 어드레스 방전에 의해 선택되지 않은 온셀들의 방전을 유지시킴으로써 화상을 표시하게 된다. 이 선택적 소거 방식의 스캔펄스는 선택적 쓰기 방식의 그 것에 비하여 일반적으로 펄스폭이 좁다. 이 때문에 선택적 소거방식은 어드레스기간이 짧은 장점이 있으나 비표시기간인 리셋기간에 전화면의 셀들이 켜지기 때문에 콘트라스트비가 낮은 단점이다.
따라서, 본 발명의 목적은 콘트라스트비와 휘도를 높이도록 한 선택적 소거를 이용한 PDP의 구동방법 및 장치를 제공하는데 있다.
상기 목적을 달성하기 위하여, 본 발명의 실시예에 따른 PDP의 구동방법은 제1 및 제2 전극을 각각 포함한 다수의 전극쌍이 형성된 상판과 상기 다수의 전극쌍과 교차하는 다수의 제3 전극이 형성된 하판을 구비하며 상기 전극들의 교차부에 셀들이 형성되는 PDP를 구동하기 위한 방법에 있어서, 리셋기간 동안 전압이 셋업전압까지 상승하는 상승 램프파형과 상기 셋업전압보다 낮고 OV보다 높은 직류전압을 상기 제1 전극에 공급하여 상기 셀들을 초기화하는 제1 단계와; 어드레스 기간 동안 상기 기준 바이어스전압으로부터 낮아지는 스캔전압을 상기 제1 전극에 공급하고 상기 제3 전극에 데이터전압을 공급하여 상기 셀을 선택하는 제2 단계와; 상기 제1 및 제2 전극에 상기 서스테인전압을 교대로 공급하여 표시를 행하는 제3 단계를 포함한다. 상기 제2 단계는 오프셀을 선택한다. 상기 제3 단계는 상기 제2 단계에서 비선택된 온셀들에 대하여 서스테인방전을 일으킨다. 상기 직류전압은 상기 서스테인전압이나 상기 기준 바이어스전압이다. 본 발명의 실시예에 따른 PDP의 구동장치는 제1 및 제2 전극을 각각 포함한 다수의 전극쌍이 형성된 상판과 상기 다수의 전극쌍과 교차하는 다수의 제3 전극이 형성된 하판을 구비하며 상기 전극들의 교차부에 셀들이 형성되는 PDP를 구동하기 위한 장치에 있어서, 리셋기간 동안 전압이 셋업전압까지 상승하는 상승 램프파형과 상기 셋업전압보다 낮고 OV보다 높은 직류전압을 상기 제1 전극에 공급하여 상기 셀들을 초기화하는 초기화회로와; 어드레스 기간 동안 상기 기준 바이어스전압으로부터 낮아지는 스캔전압을 상기 제1 전극에 공급하고 상기 제3 전극에 데이터전압을 공급하여 상기 셀을 선택하는 어드레스회로와; 상기 제1 및 제2 전극에 상기 서스테인전압을 교대로 공급하여 표시를 행하는 서스테인회로를 구비한다.
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상기 목적 외에 본 발명의 다른 목적 및 이점들은 첨부한 도면들을 참조한 본 발명의 바람직한 실시예에 대한 설명을 통하여 명백하게 드러나게 될 것이다.
이하, 본 발명의 실시예를 첨부한 도 5 내지 도 8을 참조하여 상세히 설명하기로 한다.
도 5를 참조하면, 본 발명의 실시예에 따른 선택적 소거를 이용한 PDP의 구동방법에 있어서 하나의 선택적 소거 서프필드는 셋다운방전 없이 전화면의 방전셀들을 초기화하기 위한 리셋기간과, 오프셀들을 선택하기 위한 어드레스기간과, 어드레스방전이 일어나지 않은 온셀들에 대하여 서스테인 방전을 일으키기 위한 서스테인기간을 포함한다.
이러한 선택적 소거 서브필드는 한 프레임 기간 내에 포함된 모든 서브필드에 적용될 수 있고 일부 서브필드에만 적용될 수도 있다.
리셋기간에는 모든 스캔전극들(Y)에 전압이 셋업전압까지 상승하는 상승 램프파형(Rup)이 동시에 공급된다. 이와 동시에, 서스테인전극(Z)과 어드레스전극(X)에는 0[V]가 공급된다. 상승 램프파형(Rup)에 의해 전화면의 방전셀들 내에서 스캔전극(Y)과 어드레스전극(X) 사이와 스캔전극(Y)과 서스테인전극(Z) 사이에는 약방전으로 셋업방전이 일어난다. 이 셋업방전에 의해 어드레스전극(X)과 서스테인전극(Z) 상에는 정극성(+)의 벽전하가 쌓이게 되며, 스캔전극(Y) 상에는 부극성(-)의 벽전하가 쌓이게 된다. 이렇게 셋업방전이 일어난 후에 스캔전극들(Y)에는 리셋바이어스전압(Vrst)이 공급된다. 리셋바이어스전압(Vrst)은 셋업전압(Vsetup)으로부터 자가소거(self-erse)가 일어나지 않는 전압차만큼 낮아진 직류전압으로 설정된다. 이 리셋바이어스전압(Vrst)은 서스테인전압(Vs)으로 설정되거나 스캔펄스의 기준 바이어스전압(Vscan-com)으로 선택될 수도 있다.
어드레스기간에는 기준 바이어스전압(Vscan-com)으로부터 부극성 스캔전압(Vscan)이나 기저전압(GND) 또는 0[V]까지 낮아지는 스캔펄스(scan)가 스캔전극들(Y)에 순차적으로 공급됨과 동시에 스캔펄스(scan)에 동기되어 어드레스전극들(X)에 정극성의 데이터전압(Vd)까지 상승하는 데이터펄스(data)가 공급된다. 스캔펄스(scan)와 데이터펄스(data)의 전압차와 리셋기간에 생성된 벽전압이 더해지면서 데이터펄스(data)가 공급되는 오프셀 들내에는 소거 어드레스 방전이 발생된다. 이 소거 어드레스 방전에 의해 선택된 오프셀들 내에는 서스테인전압(Vs)이 공급될 때 도 6과 같이 스캔전극들(Y)과 어드레스전극들(X) 상의 벽전하가 소거된다. 반면에, 온셀들은 리셋기간에 의해 생성된 벽전하들이 각 전극들(X, Y, Z) 상에 거의 그대로 유지된다.
서스테인기간에는 서스테인전극들(Z)에 먼저 서스테인전압(Vs)의 서스테인펄스(sus)가 공급되고 이어서 스캔전극들(Y)과 서스테인전극들(Z)에 교번적으로 서스테인펄스(sus)가 공급된다. 서스테인펄스(sus)의 수는 해당 서브필드에 할당된 휘도 가중치에 따라 결정된다. 이렇게 서스테인펄스(sus)가 인가되는 온셀들은 셀 내의 벽전압과 서스테인전압이 더해지면서 매 서스테인펄스(sus)가 공급될 때 마다 스캔전극(Y)과 서스테인전극(Z) 사이에 서스테인방전 즉, 표시방전이 발생된다. 반면에, 소거 어드레스 방전에 의해 벽전압이 낮아진 오프셀들은 서스테인전압이 인가되더라도 방전이 일어나지 않는다.
서스테인방전이 완료된 후에는 다음 서브필드(또는 다음 프레임)의 리셋기간으로 바로 진입하여하거나 소거 램프파형이 스캔전극들(Y)과 서스테인전극들(Z) 중 적어도 어느 하나에 공급될 수 있다.
예컨대, 본 발명은 본원 출원인에 의해 기출원된 특허출원 제10-2000-0012669호, 특허출원 제10-2000-0053214호, 특허출원 제10-2001-0003003호, 특허출원 제10-2001-0006492호, 특허출원 제10-2002-0082512호, 특허출원 제10-2002-0082513호, 특허출원 제10-2002-0082576호 등을 통하여 제안된 소위 'SWSE(Selective Witing and Selective Erasure) 방식'의 선택적 소거 서브필드들에 적용될 수 있다. SWSE 방식에서는 선택적 소거 서브필드들 중에서 선택적 쓰기 서브필드에 선행하는 마지막 선택적 소거 서브필드에 서스테인방전에 이어서 소거신호를 스캔전극들(Y)이나 서스테인전극들(Z)에 인가하여 방전셀 내의 벽전하를 소거한다. 따라서, 본 발명이 SWSW 방식의 선택적 소거 서브필드에 적용되는 경우에 마지막 선택적 소거 서브필드에서 서스테인펄스(sus)에 이어서 소거신호가 스캔전극들(Y)과 서스테인전극들(Z) 중 적어도 어느 하나에 공급된다.
도 7은 본 발명의 실시예에 따른 PDP의 구동장치를 나타낸다.
도 7을 참조하면, 본 발명의 실시예에 따른 PDP의 구동장치는 PDP의 어드레스전극들(X1 내지 Xm)에 데이터를 공급하기 위한 데이터 구동부(72)와, 스캔전극들(Y1 내지 Yn)을 구동하기 위한 스캔 구동부(73)와, 공통전극인 서스테인전극들(Z)을 구동하기 위한 서스테인 구동부(74)와, 각 구동부(72, 73, 74)를 제어하기 위한 타이밍 콘트롤러(71)와, 각 구동부(72, 73, 74)에 필요한 구동전압을 공급하기 위한 구동전압 발생부(75)를 구비한다.
데이터 구동부(72)에는 도시하지 않은 역감마보정회로, 오차확산회로 등에 의해 역감마보정 및 오차확산 된 후, 서브필드맵핑회로에 의해 각 서브필드에 맵핑된 데이터가 공급된다. 이 데이터 구동부(72)는 타이밍 콘트롤러(71)로부터의 타이밍제어신호(CTRX)에 응답하여 데이터를 샘플링하고 래치한 다음, 그 데이터를 어드레스전극들(X1 내지 Xm)에 공급하게 된다.
스캔 구동부(73)는 타이밍 콘트롤러(71)의 제어 하에 리셋기간 동안 도 5에 도시된 상승 램프파형(Rup)과 자가소거가 되지 않게 설정된 직류전압(Vrst)을 스캔전극들(Y1 내지 Yn)에 공급한다. 그리고 스캔 구동부(73)는 어드레스기간 동안 스캔펄스를 스캔전극들(Y1 내지 Yn)에 순차적으로 공급하고 서스테인기간 동안 서스테인펄스(sus)를 스캔전극들(Y1 내지 Yn)에 공급한다.
서스테인 구동부(74)는 타이밍 콘트롤러(71)의 제어 하에 스캔 구동부(73)와 교대로 동작하여 서스테인펄스(sus)를 서스테인전극들(Z)에 공급하게 된다.
타이밍 콘트롤러(71)는 수직/수평 동기신호와 클럭신호를 입력받고 각 구동부에 필요한 타이밍 제어신호(CTRX, CTRY, CTRZ)를 발생하고 그 타이밍 제어신호(CTRX, CTRY, CTRZ)를 해당 구동부(72, 73, 74)에 공급함으로써 각 구동부(72, 73, 74)를 제어한다. 데이터 제어신호(CTRX)에는 데이터를 샘플링하기 위한 샘플링클럭, 래치제어신호, 에너지 회수회로와 구동 스위치소자의 온/오프타임을 제어하기 위한 스위치제어신호가 포함된다. 스캔 제어신호(CTRY)에는 스캔구동부(73) 내의 에너지 회수회로와 구동 스위치소자의 온/오프타임을 제어하기 위한 스위치제어신호가 포함된다. 그리고 서스테인 제어신호(CTRZ)에는 서스테인구동부(74) 내의 에너지 회수회로와 구동 스위치소자의 온/오프타임을 제어하기 위한 스위치제어신호가 포함된다.
구동전압 발생부(75)는 셋업전압(Vsetup), 자가소거가 되지 않는 전압으로 설정된 직류전압(Vrst), 스캔 바이어스전압(Vscan-com), 스캔전압(Vscan), 서스테인전압(Vs), 데이터전압(Vd) 등을 발생한다. 이러한 구동전압들은 방전가스의 조성이나 방전셀 구조에 따라 변할 수 있다.
도 8은 스캔 구동부(73)를 상세히 나타낸다.
도 8을 참조하면, 스캔 구동부(73)는 에너지 회수회로(81)와 구동 스위치 회로(82) 사이의 제1 노드에 접속된 제1 내지 제4 스위치소자(Q1 내지 Q4), 제7 스위치소자(Q7)를 구비한다.
에너지 회수회로(81)는 PDP에서 방전에 기여하지 않은 무효전력의 에너지를 회수하고 그 회수된 에너지를 이용하여 스캔전극들(Y)을 충전하게 된다. 이 에너지 회수회로(81)는 공지의 어떠한 에너지 회수회로로도 구현될 수 있다.
구동 스위치 회로(82)는 스캔 바이어스전압원(Vscan-com)과 제1 노드(n1) 사이에 푸쉬풀 형태로 접속되는 제5 및 제6 스위치소자들(Q5, Q6)을 포함한다. 제5 및 제6 스위치소자들(Q5, Q6) 각각은 타이밍 콘트롤러(71)의 제어 하에 스캔 바이어스전압(Vscan-com)이나 제1 노드(n1) 상의 전압을 스캔전극들(Y)에 공급한다.
제1 스위치소자(Q1)는 서스테인전압원(Vs)과 제1 노드(n1) 사이에 접속되어 타이밍 콘트롤러(71)의 제어 하에 서스테인전압(Vs)을 제1 노드(n1)에 공급한다.
제2 스위치소자(Q2)는 기저전압원(GND)과 제1 노드(n1) 사이에 접속되어 타이밍 콘트롤러(71)의 제어 하에 기저전압(GND)을 제1 노드(n1)에 공급한다.
제3 스위치소자(Q3)는 셋업전압원(Vsetup)과 제1 노드(n1) 사이에 접속되어 타이밍 콘트롤러(71)의 제어 하에 미리 설정된 RC 시정수에 따라 결정된 기울기로 상승 램프파형(Rup)을 제1 노드(n1)에 공급한다. 이 제3 스위치소자(Q3)의 제어단자에는 상승 램프파형(Rup)의 기울기를 조정하기 위한 가변저항(VR)과 도시하지 않은 캐패시터이 접속된다.
제4 스위치소자(Q4)는 리셋전압원(Vrst)과 제1 노드(n1) 사이에 접속되어 타이밍 콘트롤러(71)의 제어 하에 자가소거가 되지 않도록 설정된 직류전압의 리셋전압(Vrst)을 제1 노드(n1)에 공급한다.
제7 스위치소자(Q7)는 스캔전압원(Vscan)과 제1 노드(n1) 사이에 접속되어 타이밍 콘트롤러(71)의 제어 하에 스캔전압(Vscan)을 제1 노드(n1)에 공급한다.
상술한 바와 같이, 본 발명에 따른 선택적 소거를 이용한 PDP의 구동방법 및 장치는 상승 램프파형과 자가소거가 되지 않게 설정된 직류전압으로 초기화방전을 일으켜 방전셀들을 초기화하고 어드레스기간 동안 소거 방전을 이용하여 오프셀을 선택한 후에 서스테인기간 동안 어드레스기간에 비선택된 온셀들에 서스테인방전을 일으키게 된다. 따라서, 이 선택적 소거를 이용한 PDP의 구동방법 및 장치는 하강 램프파형에 의한 셋다운방전이 일어나지 않으므로 콘트라스트비를 높일 수 있고 하강 램프파형이 생략된 만큼 서스테인기간을 더 확보할 수 있으므로 휘도를 높일 수 있다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여져야만 할 것이다.
도 1은 종래의 3전극 교류 면방전형 플라즈마 디스플레이 패널의 전극배치를 개략적으로 나타내는 평면도이다.
도 2는 도 1에 도시된 방전셀의 구조를 상세히 나타내는 사시도이다.
도 3은 종래의 플라즈마 디스플레이 패널의 구동방법에 있어서 8 개의 서브필드들이 포함된 종래의 한 프레임을 나타내는 도면이다.
도 4는 종래의 선택적 쓰기 방식에 적용되는 구동 파형을 나타내는 파형도이다.
도 5는 본 발명의 실시예에 따른 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도이다.
도 6은 본 발명의 실시예에 따른 플라즈마 디스플레이 패널에서 벽전하 분포의 변화를 개략적으로 나타내는 도면이다.
도 7은 본 발명의 실시예에 따른 플라즈마 디스플레이 패널의 구동장치를 나타내는 블록도이다.
도 8은 도 7에 도시된 스캔 구동부를 상세히 나타내는 회로도이다.
< 도면의 주요 부분에 대한 부호의 설명 >
71 : 타이밍 콘트롤러 72 : 데이터 구동부
73 : 스캔 구동부 74 : 서스테인 구동부
75 : 구동전압 발생부

Claims (8)

  1. 제1 및 제2 전극을 각각 포함한 다수의 전극쌍이 형성된 상판과 상기 다수의 전극쌍과 교차하는 다수의 제3 전극이 형성된 하판을 구비하며 상기 전극들의 교차부에 셀들이 형성되는 플라즈마 디스플레이 패널을 구동하기 위한 방법에 있어서,
    리셋기간 동안 전압이 셋업전압까지 상승하는 상승 램프파형과 상기 셋업전압보다 낮고 OV보다 높은 직류전압을 상기 제1 전극에 공급하여 상기 셀들을 초기화하는 제1 단계와;
    어드레스 기간 동안 기준 바이어스전압으로부터 낮아지는 스캔전압을 상기 제1 전극에 공급하고 상기 제3 전극에 데이터전압을 공급하여 상기 셀을 선택하는 제2 단계와;
    상기 제1 및 제2 전극에 서스테인전압을 교대로 공급하여 표시를 행하는 제3 단계를 포함하는 것을 특징으로 하는 선택적 소거를 이용한 플라즈마 디스플레이 패널의 구동방법.
  2. 제 1 항에 있어서,
    상기 제2 단계는 오프셀을 선택하는 것을 특징으로 하는 선택적 소거를 이용한 플라즈마 디스플레이 패널의 구동방법.
  3. 제 1 항에 있어서,
    상기 제3 단계는 상기 제2 단계에서 비선택된 온셀들에 대하여 서스테인방전을 일으키는 것을 특징으로 하는 선택적 소거를 이용한 플라즈마 디스플레이 패널의 구동방법.
  4. 제 1 항에 있어서,
    상기 직류전압은 상기 서스테인전압이나 상기 기준 바이어스전압인 것을 특징으로 하는 선택적 소거를 이용한 플라즈마 디스플레이 패널의 구동방법.
  5. 제1 및 제2 전극을 각각 포함한 다수의 전극쌍이 형성된 상판과 상기 다수의 전극쌍과 교차하는 다수의 제3 전극이 형성된 하판을 구비하며 상기 전극들의 교차부에 셀들이 형성되는 플라즈마 디스플레이 패널을 구동하기 위한 장치에 있어서,
    리셋기간 동안 전압이 셋업전압까지 상승하는 상승 램프파형과 상기 셋업전압보다 낮고 OV보다 높은 직류전압을 상기 제1 전극에 공급하여 상기 셀들을 초기화하는 초기화회로와;
    어드레스 기간 동안 기준 바이어스전압으로부터 낮아지는 스캔전압을 상기 제1 전극에 공급하고 상기 제3 전극에 데이터전압을 공급하여 상기 셀을 선택하는 어드레스회로와;
    상기 제1 및 제2 전극에 서스테인전압을 교대로 공급하여 표시를 행하는 서스테인회로를 구비하는 것을 특징으로 하는 선택적 소거를 이용한 플라즈마 디스플레이 패널의 구동장치.
  6. 제 5 항에 있어서,
    상기 어드레스회로는 오프셀을 선택하는 것을 특징으로 하는 선택적 소거를 이용한 플라즈마 디스플레이 패널의 구동장치.
  7. 제 5 항에 있어서,
    상기 서스테인회로는 온셀들에 대하여 서스테인방전을 일으키는 것을 특징으로 하는 선택적 소거를 이용한 플라즈마 디스플레이 패널의 구동장치.
  8. 제 5 항에 있어서,
    상기 직류전압은 상기 서스테인전압이나 상기 기준 바이어스전압인 것을 특징으로 하는 선택적 소거를 이용한 플라즈마 디스플레이 패널의 구동장치.
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