KR100493450B1 - 전자 교환시스템의 과금 정보 저장 장치 - Google Patents

전자 교환시스템의 과금 정보 저장 장치 Download PDF

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Abstract

본 발명은 전자 교환기의 액세스 교환국과 중앙 제어국간의 IPC가 비정상적으로 동작하는 경우에 과금 정보의 유실을 방지 할 수 있는 전자 교환시스템의 과금 정보 저장 장치에 관한 것이다. 이와 같은 본 발명에 따른 전자 교환시스템의 과금 정보 저장 장치는, 전자교환기의 유지 및 보수 기능을 담당하는 중앙 제어국과;
상기 중앙 제어국과 연결되며, 가입자간 호처리 및 과금을 수행하는 액세스 교환국에 있어서,상기 액세스 교환국은 상기 중앙제어국과 호처리를 수행하고, 가입자 장치의 과금 정보 전달 및 제어를 수행하는 프로세서; 및 상기 프로세서와 통신을 실행하기 위한 인터페이스부와, 상기 인터페이스부와 연결되어 과금 정보를 임시로 저장하기 위한 과금용 메모리와, 상기 인터페이스부를 제어하는 중앙처리장치와, 상기 인터페이스부 및 중앙처리장치와 연결되어 상기 과금용 메모리를 제어하는 메모리 액세스 제어기 및 통신 제어기로 구성되는 과금 저장회로;를 포함하여 동작한다.

Description

전자 교환시스템의 과금 정보 저장 장치{Charge Information Storing Device in Electronic Switching System }
본 발명은 전자 교환시스템의 과금 정보 저장 장치에 관한 것으로, 특히 내부 프로세서간의 통신이 불가능한 상태에서 정상적인 과금 정보의 저장이 불가능할 때에 대응하기에 적당한 전자 교환시스템의 과금 정보 저장 장치에 관한 것이다.
도 1은 기존의 전화 교환 시스템의 과금 정보 저장장치의 구성을 보인 블록 구성도 이다. 도 1을 참조하면, 기존의 전화 교환 시스템의 과금 정보 저장장치는 크게 교환기의 유지 보수기능을 담당하는 중앙 제어국(Central Control Subsystem : CCS)(10)과, 각 가입자의 호 처리 기능을 수행하는 액세스 교환국(Access Switching Subsystem : ASS)(20)으로 구성된다. 중앙 제어국(10)은 일반적으로 하드 디스크인 범용 기억장치(1)와, 범용 기억 장치(1)와 SCSI 버스로 연결되며, 범용 기억 장치(1)를 효율적으로 제어하는 SCSI 제어 회로(2)와, SCSI 제어 회로(2)와 VME 버스로 연결되며, SCSI 제어 회로(2)를 제어하는 주 프로세서(4)와, 주 프로세서(4)와 VME 버스로 연결되며, 각 액세스 교환국(20)과 데이터를 송수신하는 IPC 통신용 회로(3)로 구성된다. 반면, 각 액세스 교환국(20)은 중앙 제어국(10)의 IPC 통신용 회로(3)와 IPC 케이블로 연결되며 해당 가입자의 과금 정보를 전달을 제어하는 주 프로세서(5)와, 주 프로세서(5)와 글로벌 버스(Global Bus)를 통하여 연결된 주변 프로세서(6)와, 주변 프로세서(6)와 TD 버스를 통하여 연결된 가입자 장치(7)로 구성된다. 여기서, IPC는 Inter Processor Communication의 약어로 전자 교환 시스템에 구비된 각 프로세서간 통신을 의미하며, VME 버스는 중앙 제어국(10)내 회로간의 통신에 사용되는 버스로서 주 프로세서(4)가 마스터로 동작하며 나머지는 슬래이브(slave)로 동작한다.
이와 같은 구성을 갖는 기존의 전화 교환 시스템의 과금 정보 저장장치의 동작을 설명하면 다음과 같다.
도 1에서는 편의상 하나의 액세스 교환국(20)을 도시하였지만, 실제적으로는 다수개가 연결된다. 중앙 제어국(10)의 주 프로세서(4)와 액세스 교환국(20)의 주 프로세서(5)가 정상적으로 통신을 할 수 있는 경우에는, 액세스 교환국(20)의 과금 정보를 중앙 제어국(10)의 범용 기억장치(1)에 저장한다. 즉, 액세스 교환국(20)의 가입자 장치(7)의 통신실시에 따라 발생된 과금 정보는 액세스 교환국(20)에서 IPC 케이블 경로를 통하여 중앙 제어국(10)의 주 프로세서(4)로 전송된다. 중앙 제어국(10)의 주 프로세서(4)는 SCSI 제어 회로(2)와 VME 버스로 상호간 송수신이 가능하며, SCSI 제어 회로(2)는 다시 SCSI 버스를 이용하여 범용 기억장치(1)로 과금 정보를 전송하여 저장시킨다.
그러나, 전자 교환 시스템에 이상이 발생하여 중앙 제어국(10)과 임의의 액세스 교환국의 주 프로세서가 서로 IPC 통신을 실행 할 수 없는 경우가 발생할 수 있는데, 이러한 경우에는 과금 정보를 저장하기 위한 내부 프로세서간 통신을 실시 할 수 없다. 따라서, 과금 정보의 유실을 발생되어 정확한 과금을 청구하지 못하는 경우가 발생할 수 있었다.
본 발명의 목적은 이상에서 언급한 종래 기술의 문제점을 해결하기 위하여 안출한 것으로서, 전자 교환기의 액세스 교환국과 중앙 제어국간의 IPC가 비정상적으로 동작하는 경우에 과금 정보의 유실을 방지 할 수 있는 전자 교환시스템의 과금 정보 저장 장치를 제공하기 위한 것이다.
이상과 같은 목적을 달성하기 위하여, 본 발명에 따른 전자 교환시스템의 과금 정보 저장 장치는,
전자교환기의 유지 및 보수 기능을 담당하는 중앙 제어국과;
상기 중앙 제어국과 연결되어 호처리 기능을 수행하고 임의의 가입자 장치의 과금 정보 전달을 제어하는 주 프로세서와, 상기 주 프로세서와 글로벌 버스(Global Bus)로 인터페이스하여 상기 중앙 제어국간 통신이 비정상적인 경우에 자국의 과금 정보를 임시적으로 저장한 후, 중앙 제어국간 통신이 정상적일 때 상기 저장된 과금 정보를 중앙 제어국으로 전송하는 과금 저장회로를 포함하는 하나 이상의 액세스 제어국을 포함하는 것을 특징으로 한다.
이상의 목적을 달성하기 위하여, 본 발명에 따른 전자 교환시스템의 과금 정보 저장 장치는 전자교환기의 유지 및 보수 기능을 담당하는 중앙 제어국과; 상기 중앙 제어국과 연결되며, 가입자간 호처리 및 과금을 수행하는 액세스 교환국에 있어서,상기 액세스 교환국은 상기 중앙제어국과 호처리를 수행하고, 가입자 장치의 과금 정보 전달 및 제어를 수행하는 프로세서; 및 상기 프로세서와 통신을 실행하기 위한 인터페이스부와, 상기 인터페이스부와 연결되어 과금 정보를 임시로 저장하기 위한 과금용 메모리와, 상기 인터페이스부를 제어하는 중앙처리장치와, 상기 인터페이스부 및 중앙처리장치와 연결되어 상기 과금용 메모리를 제어하는 메모리 액세스 제어기 및 통신 제어기로 구성되는 과금 저장회로;를 포함하여 동작한다.
이하에서, 첨부된 도면을 참조하여 본 발명의 구성 및 동작을 설명한다.
도 2은 본 발명에 따른 전화 교환 시스템의 과금 정보 저장장치의 구성을 보인 블록 구성도이다.
도 2를 참조하면, 교환기의 유지 보수기능을 담당하는 중앙 제어국(Central Control Subsystem : CCS)(30)과, 각 가입자의 호처리 기능을 수행하는 액세스 교환국(Access Switching Subsystem : ASS)(40)으로 구성된다.
중앙 제어국(30)은 일반적으로 하드 디스크인 범용 기억장치(31)와, 범용 기억 장치(31)와 SCSI 버스로 연결되며, 범용 기억 장치(31)를 효율적으로 제어하는 SCSI 제어 회로(32)와, SCSI 제어 회로(32)와 VME 버스로 연결되며, SCSI 제어 회로(32)를 제어하는 주 프로세서(34)와, 주 프로세서(34)와 VME 버스로 연결되며, 각 액세스 교환국(40)과 데이터를 송수신하는 IPC 통신용 회로(33)로 구성된다.
그리고, 각 액세스 교환국(40)은 중앙 제어국(30)의 IPC 통신용 회로(33)와 IPC 케이블로 연결되며 해당 가입자 장치(43)의 과금 정보를 전달을 제어하는 주 프로세서(41)와, 주 프로세서(41)와 글로벌 버스(Global Bus)를 통하여 연결된 주변 프로세서(42)와, 주변 프로세서(42)와 TD 버스를 통하여 연결된 가입자 장치(43)와, 주 프로세서(41)와 글로벌 버스(Global Bus)를 통하여 연결되며, 각 액세스 교환국(40)과 중앙 제어국(30)간 IPC가 비정상적으로 동작하는 경우에 각 액세스 교환국(40)의 과금 정보를 임시적으로 저장한 후, 각 액세스 교환국(40)과 중앙 제어국(30)간 IPC가 정상적으로 동작하는 경우 다시 전송하는 과금 저장회로(50)로 구성된다.
여기서, 과금 저장회로(50)는 별도의 제어 회로를 구비하지 않고, 기존의 주변 프로세서(42)와의 통신용으로 사용하던 글로벌 버스(Global Bus)를 데이터 전송 경로로 사용하였다. 또한, 글로벌 버스는 3중화로 구현된 메인 프로세서와 주변 프로세서간의 통신용 버스를 의미하며, 주변 프로세서는 스위치, 망 동기, 가입자 회로 등을 제어하기 위한 하위 프로세서를 각각 의미한다.
이러한 과금 저장회로(50)는 글로벌 버스를 통하여 주 프로세서(41)와 통신을 실행하기 위한 인터페이스부(53)와, 상기 인터페이스부(53)와 연결되어 과금 정보를 임시로 저장하기 위한 과금용 메모리(51)와, 인터페이스부(53)를 제어하는 중앙처리장치(CPU)(54)와; 인터페이스부(53) 및 중앙처리장치(CPU)(54)와 연결되어 과금용 메모리(51)를 직접 제어하는 메모리 액세스 제어기(Direct Memory Access Controller : DMAC)(51) 및 상호 범용 직렬 통신 제어기(Dual Universal Serial Communication Controller : DUSCC)(52)로 구성된다. 여기서, 과금용 메모리(51)는 전원이 인가되지 않아도 내용이 지워지지 않는 플레쉬 메모리나 NVRAM이 사용될 수 있다.
이와 같은 구성을 갖는 본 발명에 따른 전자 교환시스템의 과금 정보 저장 장치의 동작을 첨부된 도면을 참조하여 설명하면 다음과 같다.
도 2 및 도 3을 참조하면, 액세스 교환국(40)의 주 프로세서(41)는 중앙 제어국(30)의 주 프로세서(34)간 설정된 IPC 상태 및 케이블 상태를 확인하여(S1), 주 프로세서(41)가 정상적으로 통신을 실시할 수 있는지를 주기적으로 판단한다(S2).
상기 판단 결과, 정상적인 상태인 경우에는 현재의 과금 정보를 중앙 제어국(30)의 주 프로세서(34)로 전송하고(S6), 정상 상태가 아닌 경우 액세스 교환국(40)의 주 프로세서(41)는 현재의 과금 정보를 자국(액세스 교환국)의 과금용 메모리(51)에 저장한다(S3). 또한, 액세스 교환국(40)의 주 프로세서(41)는 과금의 전송과 저장에 필요한 플래그를 세팅한다.
그리고, 액세스 교환국(40)의 주 프로세서(41)는 중앙 제어국(30)의 주 프로세서(34)와 정상적으로 통신을 실시할 수 있는지를 미리 설정된 주기로 판단한다. 즉, IPC 상태가 정상적인지를 판단한다(S4).
상기 단계 S4의 판단 결과, 정상적인 상태인 경우 액세스 교환국(40)의 주 프로세서(41)는 과금용 메모리(51)에 저장된 과금 정보를 중앙 제어국(34)으로 전송한다(S5).
따라서, 중앙 제어국(30)의 주 프로세서(34)는 수신한 과금 정보를 범용 메모리에 저장한 후, 설정된 절차를 통하여 과금을 처리한다.
이상에서 설명한 본 발명에 따른 전자 교환시스템의 과금 정보 저장 장치에 따르면, 전자 교환기의 액세스 교환국과 중앙 제어국간의 IPC가 비정상적으로 동작하여 중앙 제어국내의 범용 기억장치에 과금 정보를 저장할 수 없는 경우에 발생하는 과금 정보의 유실을 방지 할 수 있는 효과가 있다. 이와 같은 효과는 중앙 제어국에 실장 되어 있는 여러 회로의 불량 상태 시에도 동일하게 적용될 수 있다.
또한, 본 발명에서 사용되는 과금 저장회로는 기존에 사용하던 글로벌 버스(Global Bus)를 이용하여 구현하였기 때문에 별도의 전원 공급회로나 제어회로가 불필요하기 때문에, 통신 장비의 소형화 경량화 경향에 부응한다.
이상에서 본 발명의 실시 형태와 이에 따른 효과에 대해 기술하였다. 그러나, 본 발명은 상기한 특정 실시 예에 국한되는 것은 아니며, 당업자라면 첨부하는 바와 같은, 본 발명의 취지와 범위를 벗어나지 않는 다양한 변형 실시가 가능할 것이며, 이러한 변형 실시는 본 발명의 범위 내에 포함되는 것으로 간주되어야 할 것이다.
도 1은 기존의 전화 교환 시스템의 과금 정보 저장장치의 구성을 보인 블록 구성도.
도 2는 본 발명에 따른 전화 교환 시스템의 과금 정보 저장장치의 구성을 보인 블록 구성도.
도 3은 본 발명에 따른 전화 교환 시스템의 과금 정보 저장장치의 동작을 보인 제어 흐름도.
*도면의 주요부분에 대한 부호의 설명*
30 : 중앙 제어국 31 : SCSI 제어기/기억장치
32 : SCSI 제어 회로 33 : IPC 통신용 회로
34 : 주 프로세서 35 : 전력 회로
40 : 액세스 교환국 41 : 주 프로세서
42 : 주변 프로세서 43 : 가입자 장치
51 : 과금용 메모리 52 : DUSCC
53 : 인터페이스부 54 : 중앙처리장치(CPU)
55 : DMAC

Claims (3)

  1. 전자교환기의 유지 및 보수 기능을 담당하는 중앙 제어국과;
    상기 중앙 제어국과 연결되며, 가입자간 호처리 및 과금을 수행하는 액세스 교환국에 있어서,
    상기 액세스 교환국은 상기 중앙제어국과 호처리를 수행하고, 가입자 장치의 과금 정보 전달 및 제어를 수행하는 프로세서; 및 상기 프로세서와 통신을 실행하기 위한 인터페이스부와, 상기 인터페이스부와 연결되어 과금 정보를 임시로 저장하기 위한 과금용 메모리와, 상기 인터페이스부를 제어하는 중앙처리장치와, 상기 인터페이스부 및 중앙처리장치와 연결되어 상기 과금용 메모리를 제어하는 메모리 액세스 제어기 및 통신 제어기로 구성되는 과금 저장회로;를 포함하는 것을 특징으로 하는 전자 교환시스템의 과금 정보 저장 장치.
  2. 제 1항에 있어서, 상기 과금 저장회로는 글로벌 버스를 통하여 주 프로세서(와 통신을 실행하기 위한 인터페이스부와, 상기 인터페이스부와 연결되어 과금 정보를 임시로 저장하기 위한 과금용 메모리와, 상기 인터페이스부를 제어하는 중앙처리장치와; 상기 인터페이스부 및 중앙처리장치와 연결되어 과금용 메모리를 직접 제어하는 메모리 액세스 제어기 및 상호 범용 직렬 통신 제어기로 구성되는 것을 특징으로 하는 전자 교환시스템의 과금 정보 저장 장치.
  3. 삭제
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