KR100358110B1 - 제로상관구간을 갖는 바이너리 확산코드 발생 방법 및 그장치 - Google Patents

제로상관구간을 갖는 바이너리 확산코드 발생 방법 및 그장치 Download PDF

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Abstract

1. 청구범위에 기재된 발명이 속하는 기술분야
본 발명은 제로상관구간을 갖는 바이너리 확산코드의 발생 방법 및 그 장치와 상기 방법을 실현시키기 위한 프로그램을 기록한 컴퓨터로 읽을 수 있는 기록매체에 관한 것임.
2. 발명이 해결하고자 하는 기술적 과제
본 발명은, 주기가 N칩(N은 자연수)인 코드에 대하여 자기상관치의 피크주변의 사이드 러브와 상호상관치가 (N/2 +1)칩 이하의 일정시간 구간동안에 제로가 되는 확산코드를 발생할 수 있도록 한 제로상관구간을 갖는 바이너리 확산코드 발생 방법 및 그 장치를 제공함에 그 목적이 있음.
3. 발명의 해결방법의 요지
본 발명은, 제로상관구간을 갖는 바이너리 확산코드 발생 방법에 있어서, 주기가 N칩(N은 자연수)인 코드에 대하여 코드주기를 확장하여 제로상관 특성이 유지되는 바이너리 제로상관구간 프리퍼드 페어코드를 생성하는 제 1 단계; 및 상기 생성된 바이너리 제로상관구간 프리퍼드 페어코드를 칩 쉬프트시켜 바이너리 제로상관구간 코드 세트를 생성하는 제 2 단계를 포함한다.
4. 발명의 중요한 용도
본 발명은 무선통신 등에 이용됨.

Description

제로상관구간을 갖는 바이너리 확산코드 발생 방법 및 그 장치{Construction method and apparatus of binary spreading code with zero correlation duration }
본 발명은 제로상관구간을 갖는 바이너리 확산코드 발생 방법 및 그 장치에 관한 것으로, 보다 상세하게는 넓은 시간구간에서 직교하는 제로상관 특성을 가지면서 많은 확산코드의 수를 유지할 수 있도록 한 제로상관구간을 갖는 바이너리 확산코드 발생 방법 및 그 장치에 관한 것이다.
일반적으로 코드분할 다중접속(CDMA)시스템에서 각 이동국(Mobile Station)이나 기지국(Base Station)은 직교특성을 가지는 확산코드로 왈쉬코드(Walsh Code)나 하다마드코드(Hadamard Code)를 사용하고 있으나, 이러한 직교코드들의 직교특성은 오로지 확산코드간의 동기가 확립되고 조금이라도 동기가 확립되지 않으면 직교특성이 파괴된다는 단점이 있다.
따라서, 이러한 단점으로 인해 코드동기가 확립된 조건하에서만 직교하는 코드를 사용해야 하고, 역방향 링크에서의 멀티플억세스(multiple access)에 의해 인접하는 유저채널간 간섭(co-channel interference)현상이 야기되며, 멀티패트에 의한 지연파에 의한 직교특성이 붕괴되어 시스템 특성이 열화된다는 문제점이 있었다.
그러므로, 일정시간 구간동안은 직교특성이 계속 유지되는 확산코드를 찾아내기 위한 연구들이 진행되어 왔고, 최근에는 직교골드 코드의 조합으로 구성된 QS(OG-r)라는 확산코드가 제안되어 있으나, 이 역시 제로상관구간이 넓어지면 확보할 수 있는 코드의 수가 너무나 적으므로 코드분할에 의한 다중화에 크게 기여하지 못한다는 문제점이 있었다.
이에 본 발명은, 종래의 문제점을 해결하기 위해 제안된 것으로, 주기가 N칩(N은 자연수)인 코드에 대하여 자기상관치의 피크주변의 사이드 러브와 상호상관치가 (N/2 +1)칩 이하의 일정시간 구간동안에 제로가 되는 확산코드를 발생할 수 있도록 한 제로상관구간을 갖는 바이너리 확산코드 발생 방법 및 그 장치를 제공함에 그 목적이 있다.
도 1은 본 발명에 따른 제로상관구간을 갖는 바이너리 확산코드의 발생과정을 설명하는 일실시예 블록 구성도.
도 2는 도 1에 도시된 바이너리 ZCD(Zero Correlation Duration) 프리퍼드 페어 발생부의 일실시예 블럭 구성도.
도 3은 도 1에 도시된 바이너리 ZCD 코드세트 발생기의 일실시예 상세 블럭 구성도.
도 4는 본 발명에 따른 확산코드의 자기상관특성 및 상호상관 특성을 보여주는 도면.
도 5는 본 발명에 적용되는 확산코드의 제로상관구간별 코드수를 준동기부호와 비교한 그래프.
<도면의 주요 부분에 대한 부호의 설명>
100 : 바이너리 ZCD 프러퍼드 페어코드 발생부 130 : 코드주기 확장기
150 : 페어코드 발생기 170 : 바이너리 ZCD 코드세트 발생기
상기와 같은 목적을 달성하기 위한 본 발명은, 제로상관구간을 갖는 바이너리 확산코드 발생 방법에 있어서, 주기가 N칩(N은 자연수)인 코드에 대하여 코드주기를 확장하여 제로상관 특성이 유지되는 바이너리 제로상관구간 프리퍼드 페어코드를 생성하는 제 1 단계; 및 상기 생성된 바이너리 제로상관구간 프리퍼드 페어코드를 칩 쉬프트시켜 바이너리 제로상관구간 코드 세트를 생성하는 제 2 단계를 포함하는 것을 특징으로 한다.
한편, 본 발명은, 제로상관구간을 갖는 바이너리 확산코드 발생 장치에 있어서, 주기가 N칩(N은 자연수)인 코드에 대하여 코드주기를 확장하여 제로상관 특성이 유지되는 바이너리 제로상관구간 프리퍼드 페어코드를 생성하기 위한 바이너리 자기상관구간 프리퍼드 페어코드 발생수단; 및 상기 바이너리 자기상관구간 프리퍼드 페어코드 발생수단에서 생성된 바이너리 제로상관구간 프리퍼드 페어코드를 칩 쉬프트시켜 바이너리 제로상관구간 코드 세트를 생성하기 위한 바이너리 자기상관구간 코드세트 발생수단을 포함하는 것을 특징으로 한다.
한편, 본 발명은, 프로세서를 구비한, 제로상관구간을 갖는 바이너리 확산코드 발생장치, 주기가 N칩(N은 자연수)인 코드에 대하여 코드주기를 확장하여 제로상관 특성이 유지되는 바이너리 제로상관구간 프리퍼드 페어코드를 생성하는 제 1 기능; 및 상기 생성된 바이너리 제로상관구간 프리퍼드 페어코드를 칩 쉬프트시켜 바이너리 제로상관구간 코드 세트를 생성하는 제 2 기능을 실현시키기 위한 프로그램을 기록한 컴퓨터로 읽을 수 있는 기록매체를 제공함을 특징으로 한다.
여기서 상술된 목적, 특징들 및 장점은 첨부된 도면과 관련한 다음의 상세한 설명을 통하여 보다 분명해 질 것이다. 이하 첨부된 도면을 참조하여 본 발명에 따른 바람직한 일실시예를 상세히 설명한다.
도 1 내지 도 3은 본 발명에 따른 제로상관구간을 갖는 바이너리 확산코드의 발생 방법 및 그 장치를 설명하는 일실시예 블록 구성도이다.
도 1 내지 도 3에 도시된 바와 같이, 바이너리 확산 코드의 발생 장치는 주기가 N칩(N은 자연수)인 코드에 대하여 코드주기를 확장하여 제로상관 특성이 유지되는 바이너리 제로상관구간 프리퍼드 페어코드를 생성하는 바이너리 자기상관구간 프리퍼드 페어코드 발생부(100) 및 상기 생성된 바이너리 제로상관구간 프리퍼드 페어코드를 칩 쉬프트시켜 바이너리 제로상관구간 코드 세트를 생성하는 바이너리 자기상관구간 코드세트 발생기(170)를 포함한다.
상기 바이너리 자기상관구간 프러퍼드 페어 발생부(100)는 초기의 기초 메트릭스로부터 형성한 기초 확산코드를 토대로 주기가 확장되어 소정 배수이상의 주기를 갖는 바이너리 제로상관구간 프리퍼드 페어코드 중 한쪽 확산코드를 생성하는 코드주기 확장기(130) 및 상기 생성된 한쪽 확산코드의 짝수항을 반전시켜 상기 코드주기 확장기(130)에서 생성된 코드에 대응하는 확산코드를 생성하는 페어코드 발생기(150)를 포함한다.
그리고, 상기 코드주기 확장기(130)는 직/병렬 변환기(110), 기준클럭 발생기(111), 분배기(112), 리피터(113), 부분블럭 인버터(114), 스위치 제어로직부(115) 및 병/직렬 변환기(116)를 포함한다.
상기 직/병렬 변환기(110)는 입력되는 직렬코드를 후술될 기준클럭 발생기(111)에서 발생한 클럭기준 신호에 의해 병렬로 변환하여 분배기(112)에 제공한다. 상기 분배기(112)는 직/병렬 변환기(110)에서 변환된 병렬 코드신호를 분배하여 리피터(113)로 제공한다. 상기 리피터(113)는 분배기(112)에서 분배되어 입력된 병렬 코드신호를 반복되어진 형태로 처리하여 부분블럭 인버터(114)에 제공한다. 부분블럭 인버터(114)는 리피터(113)로부터 반복되어진 형태의 병렬코드 신호를 스위치 제어로직부(115)의 스위칭 제어에 의해 전체블럭의 일부분(예 : 1/4)만을 임의로 선택해 반전하여 병/직렬 변환기(116)로 제공한다. 상기 병/직렬 변환기(116)는 부분블럭 인버터(114)로부터 입력되는 병렬의 코드신호를 직렬신호로 변환하여 출력하는데, 이때의 출력신호는 주기가 입력신호(직/병렬 변환기(112)로 입력되는 직렬 입력 코드)보다 2배가 더 길면서 동일한 제로상관 특성을 가지는 프리퍼드 페어코드를 구성하는 한쪽 코드이다.
여기서, 상기 제로상관이란 자기상관 피크의 사이드 러브와 상호상관함수가 0이 되는 것을 의미하며, 코드분할 다중접속 방식의 통신에서 확산코드의 특성평가에 사용된다.
한편, 상기 병/직렬 변환기(116)로부터 출력된 신호는 페어코드 발생기(150)로 입력되는데, 이 페어코드 발생기(150)는 입력되는 신호의 코드 구성요소 중 짝수항마다 인버터(157)에 의해 부호가 반전되고, 입력되는 신호의 코드 구성요소의 나머지 항은 버퍼(155)를 각각 거치면서 페어코드 신호를 생성한다. 이때, 페어코드 발생기(150)에서 생성된 페어코드 신호는 바이너리 ZCD 코드세트 발생기(170)로 입력되어 다양한 ZCD를 갖는 바이너리 ZCD 코드세트가 발생된다.
즉, 상기 페어코드 발생기(150)로부터 출력되는 코드신호는 다수의 지연 플립플롭(171)으로 이루어진 입력코드 순환부(173)로 입력된다. 그러면, 입력코드 순환부(173)의 지연 플립플롭(171a)으로 입력된 코드신호는 한 비트씩 우측으로 쉬프트하면서 순환하는데, 즉, 우측의 최종단에 위치한 지연 플립플롭(171b)의 출력이 다시 지연 플립플롭(171a)으로 귀환되어서 순환을 연속적으로 수행한다.
한편, 상기 입력코드 순환부(173)에 연결된 텝(TAP)신호로부터 출력되는 신호들은 시간제어 스위치로직(175)의 시간에 의한 스위치 제어에 의해 코드들을 연속적으로 생성하여 출력한다. 이때, 출력되는 코드 신호들은 상호간에 자기상관치의 피크주변의 사이드 러브와 상호상관치가 (N/2 +1)칩 이하의 일정시간 구간동안에 제로가 되는 바이너리 ZCD 코드세트(Binary ZCD Code Set: 이하 " BZCS" 라함)로 동작한다.
여기서, 코드의 주기가 N=4 ×2i( i=0,1,2,3....)에 대하여 (N/2 +1)칩이라는 제로상관 특성을 가진 바이너리 ZCD 프리퍼드 페어(Binary ZCD Preferred Pair : 이하 " BZPP"라 함) 및 다양한 ZCD를 갖는 바이너리 ZCD 코드세트의 생성과정을 더욱 구체적으로 살펴보면 다음과 같다.
우선, 초기 기초 매트릭스(initial basic matrix) G를 다음의 (수학식 1)에서와 같이 구현한다.
여기서, 매트릭스 G내에서는 편의상 각각 1 과 -1을 (+)와 (-)로 표기하였다. 상기 매트릭스 G 또는 -G를 구성하는 임의의 행을 주기 4칩의 확산코드라고 하면로부터 다른 확산코드을 생성할 수 있는데, 이때의의 관계는(q=0,1,2,3)과 같이 된다. 그리고, 이들 주기의 4의 1쌍의 코드는 (4/2 +1) 칩의 제로상관구간을 가지며, 이들을 초기 BZPP(initial Binary ZCD Preferred Pair)라고 정의한다.
여기서, 상기 제로상관구간(ZCD)은 자기상관 피크의 사이드 러브와 상호 상관함수가 0이 되는 연속적인 구간으로, 자기상관 함수의 피크치를 중심으로 한 국부적인 구간이나마 연속적으로 자기상관 함수의 피크치의 사이드 러브와 상호상관치가 0이 되는 구간을 의미한다.
다음으로, BZPP의 주기를 2배로 확장시켜 주는 확장 매트릭스에 대해 살펴보면 다음과 같다. 초기 BZPP를 구성하는에서 1개의 코드를 취해서 확장 매트릭스에 입력할 경우 그 출력된 매트릭스의 임의의 행을 획득하여 출력하면 이는 주기가 2배인 8칩으로 확장된 코드가 된다. 다음으로, 이을 이용하여 코드를 구성하는 짝수항의 부호를(q=0,1,2,3,4,5,6,7)과 같이 반전시키는 동작을 가하면가 생성된다. 여기서, BZPP의 주기를 확장하는 동작을 일반화하여 하기의 (수학식 2)로 표기할 수 있다.
즉, 주기 m을 가지는 임의의 BZPP가 주어졌을 때, 확장 매트릭스 D는 다음의 (수학식 2)와 같이 구성된다.
여기서, 코드의 주기가 m=4×2i,(i=0,1,2,3...)을 의미한다. D 또는 -D의 임의의 행은 2m의 주기를 가진이 되며,을 이용하면,이 생성된다. 이때,(q=0,1,...,2m-1)의 관계가 성립된다. 상기은 (2m/2+1) 칩의 제로상관구간을 가지는 BZPP가 된다. 따라서, N=4×2i(i=0,1,2,3...)의 주기에 대하여 (N/2 + 1) 칩의 제로상관구간을 가지는 BZPP가 발생된다.
여기서, 다음의 (수학식 3)은 33칩의 제로상관구간을 가지는 코드페어에 의한 예를 보여준 것이다.
= (u v u -v u v -u v u v u -v -u -v u -v),
= (c d c -d c d -c d c d c -d -c -d c -d)
여기서, u=(- - - +), v= (- - + -), c=(- + - - ) 및 d =(- + + +)가 된다.
다음으로, 코드의 주기가 4×2i(i=0,1,2,3....)에 대하여 (N/2 +1)칩이하의 제로상관구간(ZCD)을 가진 M개의 코드로 구성되는 바이너리 ZCD 코드세트인 BZCS를 생성하는 과정에 관하여 설명한다.
M개의 코드로 구성되는 BZCS는 M개의 코드 상호간의 동일한 ZCD를 가지고 있으며, 그 구간의 길이가 (N/2 +1)칩 이하인 바이너리 코드들의 세트를 의미한다. 상기한 BZCS는 BZPP(바이너리 ZCD 프리퍼드 페어코드)인 을 가지고 칩쉬프트동작(chip-shift operation)을 행함으로써 생성할 수 있다. 즉, Tl을 시계 반대방향으로 l칩씩 쉬프트시키는 칩 쉬프트 동작기라고 한다면,을 이용하여, M개의 코드로 구성되는 주기칩의 BZCS는 다음의 (수학식 4)와 같이 생성된다.
여기서,는 칩 쉬프트의 증분(chip-shift increment)이고, K는 주어진 코드에 대한 최대 쉬프트 가능수를 의미한다. 또한,와 k는 각각 양의 정수(positive integer) 및 비음의 정수(non-negative integer)이며, 반드시의 조건을 만족해야 한다. 그리고, M과 새로이 생성된 코드의 ZCD간에는 다음의 (수학식 5)와 같은 관계식이 성립한다.
그리고
한편, 다음의 (수학식 6)은 최대 쉬프트가능수가 2이고, 칩 쉬프트 증분가 3일때, 주기 32칩에서 ZCD칩인 6개의 코드들로 이뤄진 BZCS의 예를 나타내고 있다.
M1 = (- - + - + + + - + + - + + + + - + + - + - - - + + + - + + + + -)
M2= (- + + + + - + + + - - - + - + + + - - - - + - - + - - - + - + +)
M3= (- + + + - + + - + + + + - + + - + - - - + + + - + + + + - - - +)
M4 = (+ + - + + + - - - + - + + + - - - - + - - + - - - + - + + - + +)
M5 = (+ - + + - + + + + - + + - + - - - + + + - + + + + - - - + - + +)
M6 = (+ + + - - - + - + + + - - - - + - - + - - - + - + + - + + + + -)
또한, 다음의 (표 1)은 주기 32, 64, 128, 256칩에 대한 바이너리 ZCD코드들의 총 코드수를 보여주고 있다.
도 4는 본 발명에 따른 확산코드의 자기상관특성 및 상호상관 특성을 보여주는 도면이다.
도 4에 도시된 바와 같이, 64칩의 주기를 갖는 1쌍의 코드의 자기상관 함수값과 상호상관 함수값이 0이 되는 구간 즉, 제로상관구간을 표시하고 있으며, 64칩의 N/2 +1에 해당하는 33칩이라는 국부적인 구간내에서 자기상관 함수의 피크치 주변의 사이드 러브와 두 코드간의 상호상관치가 0이 되는 것을 알 수 있다.
도 5는 본 발명에 따른 확산코드의 제로상관구간별 코드수를 준동기부호와 비교한 그래프이다.
도 5에 도시된 바와 같이, ZCD가 3칩 이상이면, 상기 바이너리 ZCD 코드는 QS(OG-r)코드보다도 동일 ZCD에 있어서 월등히 더 많은 코드수의 확보가 가능하다는 것을 알 수 있다. 따라서, 더 많은 코드수의 확보로 인해 코드분할 다중접속(CDMA) 통신시스템에 있어 많은 사용자를 확보할 수 있으며, 넓은 ZCD로 코드분할 다중접속(CDMA)통신 시스템의 준동기 운용이 가능한 허용시간이 증가한다.
상술한 바와 같은 본 발명의 방법은 프로그램으로 구현되어 컴퓨터로 읽을 수 있는 기록매체(씨디롬, 램, 롬, 플로피 디스크, 하드 디스크, 광자기 디스크 등)에 저장될 수 있다.
이상에서 설명한 본 발명은 진술한 실시예 및 첨부된 도면에 의해 한정되는 것이 아니고, 본 발명의 기술적 사상을 벗어나지 않는 범위내에서 여러가지 치환, 변형 및 변경이 가능하다는 것이 본 발명이 속하는 기술분야에서 통상의 지식을 가진자에게 있어 명백할 것 이다.
상기와 같은 본 발명은, 넓은 제로상관구간(ZCD)를 갖는 확산코드를 발생시켜 순방향 링크에 적용하게 되면 일정시간 구간동안 직교성이 연속적으로 유지되므로 멀티패트 현상에 대한 저항력을 갖게 해주고, 역방향 링크에 쓰일 경우에는 코드분할시의 셀내의 각 유저용 확산코드로서 할당됨과 동시에 멀티플억세스(multiple access)에 따른 유저채널간 간섭현상을 제거시켜서 시스템의 효율을 높일 수 있는 효과가 있다.
또한, 본 발명은, 넓은 자기상관 피크주변의 넓은 구간에서 사이드 러브가 제로라는 특성을 이용해 매치트필터(matched filter)와 결부된 초기동기 포착용 코드로서도 활용도 가능하고, 코드 발생방법이 간단하여 하드웨어로서 구현이 간단하고, 코드주기의 지속적인 확장성이 용이한 효과가 있다.

Claims (8)

  1. 제로상관구간을 갖는 바이너리 확산코드 발생 방법에 있어서,
    주기가 N칩(N은 자연수)인 코드에 대하여 코드주기를 확장하여 제로상관 특성이 유지되는 바이너리 제로상관구간 프리퍼드 페어코드를 생성하는 제 1 단계; 및
    상기 생성된 바이너리 제로상관구간 프리퍼드 페어코드를 칩 쉬프트시켜 바이너리 제로상관구간 코드 세트를 생성하는 제 2 단계
    를 포함하는 제로상관구간을 갖는 바이너리 확산코드 발생 방법.
  2. 제 1 항에 있어서, 상기 제 1 단계는,
    초기의 기초 메트릭스로부터 기초 확산코드를 형성하는 제 3 단계;
    상기 형성된 기초 확산코드를 토대로 주기가 확장되어 소정 배수 이상의 주기를 갖는 바이너리 제로상관구간 프리퍼드 페어코드 중 한쪽 확산코드를 생성하는 제 4 단계; 및
    상기 생성된 한쪽 코드의 짝수항을 반전시켜 상기 제 4 단계에서 생성된 확산코드에 대응하는 확산코드를 생성하는 제 5 단계
    를 포함하는 제로상관구간을 갖는 바이너리 확산코드 발생 방법.
  3. 제 1 항 또는 제 2 항에 있어서, 상기 확산코드는,
    매치트 필터와 결부된 초기의 동기 포착용 코드로 사용되는 것을 특징으로 하는 제로상관구간을 갖는 바이너리 확산코드 발생 방법.
  4. 제 1 항 또는 제 2 항에 있어서, 상기 확산코드는,
    확장 매트릭스를 생성하여 각 행 또는 그 각 행의 부호의 일부를 반전시킨 행을 통해 코드를 확장하는 것을 특징으로 제로상관구간을 갖는 바이너리 확산코드 발생 방법.
  5. 제로상관구간을 갖는 바이너리 확산코드 발생 장치에 있어서,
    주기가 N칩(N은 자연수)인 코드에 대하여 코드주기를 확장하여 제로상관 특성이 유지되는 바이너리 제로상관구간 프리퍼드 페어코드를 생성하기 위한 바이너리 자기상관구간 프리퍼드 페어코드 발생수단; 및
    상기 바이너리 자기상관구간 프리퍼드 페어코드 발생수단에서 생성된 바이너리 제로상관구간 프리퍼드 페어코드를 칩 쉬프트시켜 바이너리 제로상관구간 코드 세트를 생성하기 위한 바이너리 자기상관구간 코드세트 발생수단
    을 포함하는 제로상관구간을 갖는 바이너리 확산코드 발생 장치.
  6. 제 5 항에 있어서, 상기 바이너리 자기상관구간 프리퍼드 페어코드 발생수단은,
    초기의 기초 메트릭스로부터 형성한 기초 확산코드를 토대로 주기가 확장되어 소정 배수이상의 주기를 갖는 바이너리 제로상관구간 프리퍼드 페어코드 중 한쪽 확산코드를 생성하는 코드주기 확장수단; 및
    상기 코드주기 확장수단에서 생성된 한쪽 확산코드의 짝수항을 반전시켜 상기 코드주기 확장수단에서 생성된 코드에 대응하는 확산코드를 생성하는 페어코드 발생수단
    을 포함하는 제로상관구간을 갖는 바이너리 확산코드 발생 장치.
  7. 제 5 항 또는 제 6 항에 있어서, 상기 확산코드는,
    확장 매트릭스를 생성하여 각 행 또는 그 각 행의 부호의 일부를 반전시킨 행을 통해 코드를 확장하는 것을 특징으로 제로상관구간을 갖는 바이너리 확산코드 발생 장치.
  8. 프로세서를 구비한, 제로상관구간을 갖는 바이너리 확산코드 발생 장치에,
    주기가 N칩(N은 자연수)인 코드에 대하여 코드주기를 확장하여 제로상관 특성이 유지되는 바이너리 제로상관구간 프리퍼드 페어코드를 생성하는 제 1 기능; 및
    상기 생성된 바이너리 제로상관구간 프리퍼드 페어코드를 칩 쉬프트시켜 바이너리 제로상관구간 코드 세트를 생성하는 제 2 기능
    을 실현시키기 위한 프로그램을 기록한 컴퓨터로 읽을 수 있는 기록매체.
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