KR100346548B1 - 표면 전도형 전자 방출원을 갖는 평판 디스플레이 장치 - Google Patents

표면 전도형 전자 방출원을 갖는 평판 디스플레이 장치 Download PDF

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Abstract

반도체로 이루어진 전자 방출층의 표면으로부터 방출된 전자를 이용해 소정의 이미지를 구현토록 하는 평판 디스플레이 장치로서, 문턱 전압의 변화에 의한 컨트라스트 저하 및 휘도 불균일 현상을 미연에 방지할 수 있도록 하기 위하여, 제1 기판과; 이 제1 기판의 일면 위에 소정의 패턴을 가지고 형성되는 복수의 제1 전극과; 이 제1 전극을 덮으면서 상기 기판 위로 형성되는 절연층과; 이 절연층 위로 소정의 패턴을 가지고 형성되는 복수의 제2 전극과; 소정의 패턴을 가지고 상기 제2 전극에 이웃하여 상기 절연층 위로 형성되는 복수의 제3 전극과; 전자 방출 영역을 갖는 박막으로 형성되어, 상기 제2 전극과 제3 전극에 연결되는 복수의 전자 방출층을 포함하는 전자 방출부와; 제2 기판과; 이 제2 기판의 어느 일면에 소정의 패턴을 가지고 형성되는 애노드 전극과; 이 애노드 전극 위로 형성되는 형광층을 포함하여 상기 전자 방출부와 함께 밀폐 진공 용기를 형성하는 이미지 형성부; 및 상기 용기 내로 상기 전자 방출부와 이미지 형성부에 지지되어 설치되는 복수의 스페이서를 포함하여 이루어진다.

Description

표면 전도형 전자 방출원을 갖는 평판 디스플레이 장치{FLAT PANEL DISPLAY DEVICE HAVING A SURFACE CONDUCTION TYPE ELECTRON EMITTING SOURCE}
본 발명은 평판 디스플레이 장치에 관한 것으로서, 보다 상세하게는 표면 전도형의 전자 방출원을 갖는 평판 디스플레이 장치에 관한 것이다.
냉음극 전자를 전자 방출원으로 사용하여 이미지 형성을 하는 장치의 하나로 표면 전도형 전자 방출장치가 알려져 있다. 이 표면 전도형 전자 방출장치는, 잘 알려진 바와 같이, 기판 상에 형성된 소면적의 박막에 막 표면으로 전류를 평행하게 흘리는 경우 전자 방출이 발생되는 현상을 이용한 것이다.
이러한 표면 전도형 전자 방출장치는, 냉음극 전자를 전자 방출원으로 갖는 다른 타입의 전자 방출장치(예: 전계 방출장치)와 함께 음극선관을 대신할 차세대의 디스플레이 장치로서 연구 개발되고 있다.
상기 표면 전도형 전자 방출장치의 주지된 구조를 살펴보면, 도 7에 도시한 바와 같이, 기판(1)의 일면에 전기적 접속을 위한 전극(3,5)을 형성하고, 이들 양 전극(3,5)의 사이에는 전자 방출 영역(7a)을 갖는 전자 방출층(7)을 연결 형성하고 있다. 여기서 상기 양 전극(3,5) 중 일측 전극(3)은 주사(scanning) 전극으로, 다른 일측 전극(5)은 신호(data) 전극으로서 역할을 하게 된다.
아울러, 상기 표면 전도형 전자 방출장치에는, 상기 기판(1)에 대향 배치되어 이 기판(1)과 함께 진공 밀폐 용기를 형성하는 글라스 기판(9)이 포함되며, 이 글라스 기판(9)의 일면에는 투명한 애노드 전극(11) 위로 형성된 형광층(13)이 배치된다.
이와 같은 종래의 표면 전도형 전자 방출장치는, 상기한 주사 전극(3) 및 신호 전극(5)으로 구동에 필요한 전압이 각기 인가되면, 이 전압 인가에 따라 상기 박막의 전자 방출층(7)에서는 지역적으로 막이 파괴, 변형 또는 변질되어 상기한전자 방출 영역(7a)이 형성되면서 전자가 방출되게 된다.
여기서 방출된 전자는, 상기 애노드 전극(11)으로 인가되는 고전압에 의해 상기 형광층(13)으로 유도되어 이 형광층(13)에 부딪치게 되고, 이 때 발광하는 빛에 의해 소정의 이미지가 구현되게 된다.
이러한 전자 방출장치를 실질적인 디스플레이 장치로 구현할 때에는, 다시 말해, 상기 표면 전도형 전자 방출원을 매트릭스와 같은 패턴으로 설계하여 장치를 대면적화하고 펄스 폭 변조(PWM: Pulse Width Modulation) 방식으로 상기 장치를 구동하는 경우, 상기 스캔닝 전극(3)으로는 문턱(threshold) 전압에 해당되는 네가티브 펄스(negative pulse)가 인가되고, 상기 신호 전극(5)으로는 장치의 목표 휘도를 고려하여 산출된 포지티브 펄스(negative pulse)가 인가된다.
그러나, 상기와 같은 구조의 전자 방출장치는, 대량 생산시 불가피하게 발생되는 구조적인 편차로 인해 각 장치별로 상기한 문턱 전압을 다르게 할 우려가 있는데, 이처럼 문턱 전압이 다르게 설정되면, 기준치에 비해 다른 문턱 전압을 갖는 전자 방출장치는 완전한 흑 계조(black gray)를 구현하지 못하거나(상기 문턱 전압이 기준치보다 작은 경우) 휘도를 떨어 뜨려(상기 문턱 전압이 기준치보다 큰 경우) 콘트라스트 저하 및 휘도 불균일 등의 문제점을 초래하게 된다.
이 밖에도 상기한 전자 방출장치에 있어서는, 상기 신호 전극(5)으로 고전류가 흐르게 됨에 따라, 상기 신호 전극(5)을 구동하기 위한 구동 IC도 고전류용으로 써야 하는 조건이 따르게 되는데, 여기에는 가격이 비싼 상기 고전류용 IC의 사용에 따라 장치의 단가를 높여 이의 대중화 실현을 어렵게 하는 문제가 내재되어 있다.
따라서, 본 발명은 상기와 같은 문제점을 감안하여 안출된 것으로서, 본 발명의 목적은, 제조 과정에 초래되는 구조적 편차로 인해 문턱 전압이 달라지게 되더라도 장치의 특성(컨트라스트, 휘도 등)이 저하되는 것을 방지할 수 있고, 고가의 부품 사용을 가급적 억제하여 단가 절감으로 인한 장치의 대중화를 실현할 수 있도록 한 표면 전도형 전자 방출원을 갖는 평판 디스플레이 장치를 제공함 있다.
도 1은 본 발명의 실시예에 따른 표면 전도형 전자 방출 소자를 도시한 단면도이고,
도 2는 본 발명의 실시예에 따른 표면 전도형 전자 방출원을 갖는 평판 디스플레이 장치를 도시한 분해 사시도이고,
도 3 및 도 4는 본 발명의 실시예에 따른 전자 방출층을 도시한 평면도이고,
도 5는 본 발명의 다른 실시예에 따른 표면 전도형 전자 방출원을 갖는 평판 디스플레이 장치를 도시한 분해 사시도이고,
도 6은 본 발명의 또 다른 실시예에 따른 저항층의 연결 상태를 설명하기 위해 도시한 사시도이고,
도 7은 종래 기술에 따른 표면 전도형 전자 방출원을 갖는 평판 디스플레이 장치를 도시한 부분 단면도이다.
이에 본 발명은 상기의 목적을 실현하기 위하여,
기판과; 이 기판의 일면 위에 형성되는 제1 전극과; 이 제1 전극을 덮으면서 상기 기판 위로 형성되는 절연층과; 이 절연층 위에 형성되는 제2 전극과; 이 제2 전극에 이웃하여 상기 절연층 위로 형성되는 제3 전극; 및 전자 방출 영역을 갖는 박막으로 이루어져, 상기 제2 전극과 제3 전극에 연결 형성되는 전자 방출층을 포함하는 표면 전도형 전자 방출 소자를 제공한다.
또한, 본 발명은 상기 목적을 실현하기 위하여,
제1 기판과; 이 제1 기판의 일면 위에 소정의 패턴을 가지고 형성되는 복수의 제1 전극과; 이 제1 전극을 덮으면서 상기 기판 위로 형성되는 절연층과; 이 절연층 위로 소정의 패턴을 가지고 형성되는 복수의 제2 전극과; 소정의 패턴을 가지고 상기 제2 전극에 이웃하여 상기 절연층 위로 형성되는 복수의 제3 전극과; 전자 방출 영역을 갖는 박막으로 형성되어, 상기 제2 전극과 제3 전극에 연결되는 복수의 전자 방출층을 포함하는 전자 방출부와;
제2 기판과; 이 제2 기판의 어느 일면에 소정의 패턴을 가지고 형성되는 애노드 전극과; 이 애노드 전극 위로 형성되는 형광층을 포함하여 상기 전자 방출부와 함께 밀폐 진공 용기를 형성하는 이미지 형성부; 및
상기 용기 내로 상기 전자 방출부와 이미지 형성부에 지지되어 설치되는 복수의 스페이서를 포함하는 평판 디스플레이 장치를 제공한다.
이러한 본 발명의 구성에서, 상기 제1 전극은, 계조(階調) 전압이 인가되는 신호(data) 전극으로 이루어지고, 상기 제2 전극은, 펄스 변조에 따른 주사 전압이 인가되는 주사 전극으로 이루어지고, 상기 제3 전극은, 그라운드 처리되는 공통 전극으로 이루어지게 된다.
또한, 상기 전자 방출층은, 폴리실리콘, 비결정성 실리콘, 탄화 규소 중 어느 하나로 이루어진 반도체로 형성되며, 이 전자 방출층은 바람직하게, 상기 전자 방출 영역을 중심부에 형성하고, 어느 일면에 대한 폭을 w라 할 때, 이 폭을 상기 전자 방출 영역을 향해 갈수록 축소시켜 이루어지게 된다.
아울러, 상기한 평판 디스플레이 장치는, 상기 제2 전극과 상기 전자 방출층 사이에 형성되어 상기 제2 전극을 따라 상기 전자 방출층으로 흐르는 전류를 조절하는 전류 조절수단을 더욱 포함하게 되는데, 이 전류 조절수단은 상기 제2 전극과 상기 전자 방출층 사이에 배치 형성되는 저항층으로 이루어짐이 바람직하다.
이하, 본 발명을 명확히 하기 위한 바람직한 실시예를 첨부한 도면을 참고하여 보다 상세하게 설명하면 다음과 같다.
도 1은 본 발명의 실시예에 따른 전자 방출 소자를 도시한 단면도이다.
도시된 바와 같이 상기 전자 방출 소자는, 기판(20) 위에 형성되는 박막의 전자 방출층(22)으로부터 전자를 방출시켜 작용하는 표면 전도형의 전자 방출원을 갖는 소자로 형성되는 바, 이의 구조는 다음과 같다.
상기 기판(20)의 일면에는 우선 제1 전극(24)이 형성되는 바, 이 전극(24)으로는 상기 전자 방출 소자가 실질적인 평판 디스플레이 장치로 구성시, 계조 전압에 비례하는 신호 전압이 인가된다.
상기 제1 전극(24) 위로는, 소정의 두께를 갖는 절연층(26)이 상기 제1 전극(24)을 덮어 형성되고, 이 절연층(26) 위로는 상기 전자 방출층(22)을 사이에 두고 제2 전극(28) 및 제3 전극(30)이 형성된다.
즉, 상기 전자 방출층(22)은 상기 절연층(26)에 접촉됨은 물론, 그 양단을 상기 제2 전극(28) 및 제3 전극(30)에 각기 연결하여 형성되게 되는데, 이 때, 상기 제2 전극(28)은 펄스 변조에 따른 주사 전압이 인가되는 주사 전극으로, 상기 제3 전극(30)은 그라운드(ground) 처리로 연결되는 공통(common) 전극으로 이루어진다.
이에 상기와 같이 구성되는 전자 방출 소자는, 상기 제1 전극(24)으로 계조에 비례하는 아날로그 전압이 인가되고, 상기 제2 전극(28)으로 문턱 전압이 인가되면, 상기 제2 전극(28)과 제3 전극(30) 사이에 형성되는 전계에 의해 상기 전자 방출층(22)의 중심부위에 형성되는 전자 방출 영역(22a)으로부터 전자를 방출시킬 수 있게 되는 바, 본 발명에 따라 상기한 전자 방출 소자가 적용되어 평판 디스플레이 장치가 구성되는 경우, 그 구조는 다음과 같다.
도 2는 본 발명의 실시예에 따른 평판 디스플레이 장치를 도시한 분해 사시도이다.
도시된 바와 같이 상기 평판 디스플레이 장치는, 상기한 전자 방출 소자로 구성되는 전자 방출부(40)와, 이 전자 방출부(40)와 함께 밀폐 용기를 형성하여 상기 전자 방출부(40)로부터 발생된 전자에 의해 소정의 이미지를 형성하는 이미지 형성부(42)를 포함하여 이루어지고 있다.
상기에서 전자 방출부(40)는, 전술한 바와 같이, 제1 기판(40a)의 일면에 스트라이프와 같은 소정의 패턴으로 형성되는 제1 전극인 복수의 신호 전극(40b)과, 이 신호 전극(40b) 위로 이 신호 전극(40b)을 덮으면서 상기 제1 기판(40a)에 전면적으로 걸쳐 배치되는 절연층(40c)을 포함하여 이루어진다.
또한, 상기 전자 방출부(40)에는 상기 절연층(40c) 위로 상기 신호 전극(40b)에 대해 교차 배치되어 복수로 형성되는 제2 전극인 주사 전극(40d)과, 이 주사 전극(40d)을 이웃하도록 소정의 패턴을 가지고 복수로 형성되는 제3 전극인 공통 전극(40e)이 포함된다.
아울러, 상기 전자 방출부(40)에는 상기 주사 전극(40d)과 공통 전극(40e)에 연결되어 상기 절연층(40c) 위에 복수로 형성되는 전자 방출층(40f)이 포함되는 바, 이 전자 방출층(40c)은 폴리 실리콘, 비결정성 실리콘, 탄화 규소와 같은 반도체가 박막으로 형성됨이 바람직하다.
이러한 상기 전자 방출부(40)에 비해, 상기한 이미지 형성부(42)는, 상기제1 기판(40a)과 소정의 간격을 두고 상기 제1 기판(40a)에 대해 평행하게 배치되는 제2 기판(42a)을 가지며, 이 제2 기판(42)의 일면(상기 제1 기판을 대향하는 면)으로는 소정의 패턴을 갖는 애노드 전극(42b)과 형광층(42c)을 형성해 놓고 있다.
이에 상기 전자 방출부(40)와 이미지 형성부(42)는, 상호 조합되어 진공 밀폐 용기를 형성하여 하나의 평판 디스플레이 장치를 구성하게 되는 바, 이 때, 상기 밀폐 용기 내로는 상기 평판 디스플레이 장치의 셀갭을 유지하도록 하는 복수의 스페이서(44)가 비표시 영역에 배치되어 상기 전자 방출부(40)와 이미지 형성부(42)에 지지 설치된다.
이와 같이 형성되는 평판 디스플레이 장치의 작용은 다음과 같다.
상기 평판 디스플레이 장치의 구동을 위해, 상기 각 전극을 소정의 전압이 인가되면, 다시 말해, 상기 주사 전극(40d)에 순차적으로 문턱 전압에 해당되는 포지티브 펄스가 인가되고, 상기 공통 전극(40e)이 통상 접지(ground)처리된 상태에서, 상기 신호 전극(40b)으로 계조에 비례하는 아날로그 전압이 인가되면, 상기 박막의 전자 방출층(40f)에서는 상기 주사 전극(40d)에서 상기 공통 전극(40e)으로 흐르는 전류에 의해 전자를 방출시키게 된다.
여기서 발생된 전자는 고전압이 인가되는 상기 이미지 형성부(42)의 애노드 전극(42b)측으로, 즉, 상기 형광층(42c)으로 유도되어 이와 충돌되는 바, 이에 상기 이미지 형성부(42)로부터는 상기 형광층(42c)에서 발광되는 빛에 의해 소정의 이미지가 구현될 수 있게 된다.
이와 같은 작용을 이루는 상기 평판 디스플레이 장치에 있어, 이 평판 디스플레이 장치가 개별로 형성될 때 갖는 구조적 편차로 인해 상기 문턱 전압에 편차를 발생시키더라도, 종래와 같이 컨트라스트를 저하시키거나 휘도를 불균일하게 이루는 일을 방지할 수 있게 된다.
이러한 방지 기능은, 상기 주사 전극(40d)과는 절연층(40c)에 의해 분리 배치된 상기 신호 전극(40b)으로 계조에 비례하는 아날로그 전압을 인가할 때, 이 전압을 조절하게 되면, 반도체로 이루어진 상기 전자 방출층(40f)의 채널(channel) 저항을 달리할 수 있게 되고 아울러 상기 형광층(42c)으로 방출되는 전자의 양을 조절할 수 있기 때문이다.
뿐만 아니라, 상기 평판 디스플레이 장치에 있어서는, 상기 신호 전극(40b)이 상기한 바와 같이, 상기 절연층(40c)에 의해 상기 주사 전극(40d)과는 분리된 구조를 갖게 됨에 따라, 상기 신호 전극(40b)으로 고전류가 흐르게 되는 것을 방지할 수 있게 되므로 이에 상기 신호 전극(40b)을 구동시키기 위한 구동 IC도 값이 저렴한 저전류,저전압 특성을 갖는 구동 IC를 적용할 수 있게 된다.
한편, 상기 전자 방출부(40f)에서 전자 방출되는 전자 방출 영역은 상기 전자 방출부(40f)로 고전류가 흐를 때, 주지된 바와 같이 대략 그 중앙부위에 형성되게 되는데, 본 발명에서는 이러한 전자 방출 영역(400f)을 도 3 및 도 4에 도시한 바와 같이, 상기 전자 방출부(40f)의 중심부에 형성되는 첨예부나 슬림(slim) 부위에 형성되도록 한다.
즉, 본 발명에서는 상기 전자 방출층(40f)의 어느 일면의 폭(도면을 기준으로 봤을 때, 단변부에 대한 폭)을 w라 할 때, 이 폭(w)이 상기 전자 방출층(40f)의 중심부로 갈수로 점차적으로 축소된 이른바 모래 시계 형상으로 상기 전자 방출층(40f)을 형성하고 있다.
본 발명에서 이처럼 상기 전자 방출층(40f)을 형성함은, 상기 평판 디스플레이 장치를 제조시, 상기한 전자 방출 영역(400f)이 상기 형광층(42c)의 발광 부위에 일정하게 대응되도록 하여, 종래와 같이 상기 전자 방출층(40f)이 단순하게 정사각형이나 직사각형으로 형성된 경우, 상기한 전자 방출 영역이 다르게 형성되어 실질적인 디스플레이 장치의 구동시, 전자 방출 영역이 형광층의 발광 부위에 제대로 대응되지 않아 발생되는 문제점을 방지하기 위함이다.
도 5는 본 발명의 다른 실시예에 따른 평판 디스플레이 장치를 도시한 분해 사시도이다. 이 도 5에 도시된 평판 디스플레이 장치는, 상기 전자 방출층에서 방출되는 전자의 방출을 균일하게 이루도록 수단을 더욱 포함하여 구성되는 바, 이의 구성을 알아 보면 다음과 같다.
먼저 상기 평판 디스플레이의 전체적인 구성은, 전술한 예의 평판 디스플레이 장치와 같으며, 다만 상기한 주사 전극이 제2 전극과 상기 전자 방출층 사이에 상기 제2 전극에서 상기 전자 방출층으로 흐르는 전류를 조절할 수 있는 전류 조절수단을 형성해 놓고 있는 것이 다르다. 이 실시예에서 전술한 실시예와 동일한 부분은 같은 부호를 사용하도록 한다.
도면을 참조하여 보면, 상기 전류 조절수단은, 상기 제2 전극(40d)과 상기 전자 방출층(40f) 사이에 배치 형성되는 저항층(40g)으로 이루어지게 되는데, 실질적으로 이 저항층(40g)은 도 5에 도시한 바와 같이 일부위를 상기 제2 전극(40d)에 연결하고, 다른 일부는 상기 전자 방출층(40f)에 직접 연결하여 형성될 수 있으며, 혹은 도 6에 도시한 바와 같이, 일부위는 상기 제2 전극(40d)에 연결하고 다른 일부위는 상기 전자 방출층(40f)에 부분적으로 연결된 섬형(island)의 상기 제2 전극(40d)에 연결하여 형성될 수도 있다.
이와 같이 상기 제2 전극(40d)과 상기 전자 방출층(40f) 사이에 상기한 저항층(40g)이 형성되면, 이 저항층(40g)의 작용으로 상기 제2 전극(40d)에서 상기 전자 방출층(40f)으로 흐르는 전류를 균일하게 조절할 수 있게 된다.
또한, 상기 저항층(40g)은 경우에 따라 상기 전자 방출층(40f)에 상기 전자 방출 영역(400f)이 제대로 형성되지 못해 상기 전자 방출층(40f)으로 과전류가 흐게 되어 이에 손상이 발생되는 것을 방지하는 기능도 갖게 된다.
이상을 통해 본 발명의 바람직한 실시예에 대하여 설명하였으나, 본 발명은 이에 한정되는 것은 아니고 특허 청구의 범위와 발명의 상세한 설명 및 첨부한 도면의 범위 안에서 여러 가지로 변형하는 실시하는 것이 가능하고, 이 또한 본 발명의 범위에 속하는 것은 당연하다.
이와 같이 본 발명에 의한 표면 전도형 전자 방출원을 갖는 평판 디스플레이 장치는, 전자 방출층으로부터 전자를 방출시키기 위한 전극 구조를 종래와 달리 함으로써, 디스플레이 장치마다 달라질 수 있는 문턱 전압의 변동으로 인한 장치의 컨트라스트 저하 및 휘도 불균일 현상을 방지하여 품질이 우수한 제품으로 제공될수 있는 효과를 갖는다.
또한, 본 발명은 전극(신호 전극)을 구동시키기 위한 구동 IC를 구비함에 있어서도 저가의 구동 IC를 사용할 수 있게 되어, 이에 제조 단가의 축소로 인한 제품 대중화 실현에도 효과를 갖는다.

Claims (18)

  1. (정정)
    기판과;
    이 기판의 일면 위에 형성되는 제1 전극과;
    이 제1 전극을 덮으면서 상기 기판 위로 형성되는 절연층과;
    이 절연층 위에 형성되는 제2 전극과;
    이 제2 전극에 이웃하여 상기 절연층 위로 형성되는 제3 전극; 및
    전자 방출 영역을 갖는 박막으로 이루어져, 상기 제2 전극과 제3 전극에 연결 형성되는 전자 방출층
    을 포함하고,
    상기 전자 방출층이 상기 전자 방출 영역을 중심부에 형성하고, 어느 일면에 대한 폭을 w라 할 때, 이 폭(w)을 상기 전자 방출 영역을 향해 갈수록 축소시켜 이루어는 표면 전도형 전자 방출 소자.
  2. 제 1 항에 있어서,
    상기 제1 전극이, 계조(階調) 전압이 인가되는 신호(data) 전극으로 이루어진 표면 전도형 전자 방출 소자.
  3. 제 1 항에 있어서,
    상기 제2 전극이, 펄스 변조에 따른 주사 전압이 인가되는 주사 전극으로 이루어진 표면 전도형 전자 방출 소자.
  4. 제 1 항에 있어서,
    상기 제3 전극이, 그라운드 처리되는 공통 전극으로 이루어진 표면 전도형 전자 방출 소자.
  5. 제 1 항에 있어서,
    상기 전자 방출층이, 폴리실리콘, 비결정성 실리콘, 탄화 규소 중 어느 하나로 이루어진 반도체로 형성된 표면 전도형 전자 방출 소자.
  6. (삭제)
  7. (정정)
    제 1 항에 있어서,
    상기 전자 방출 영역이 상기 전자 방출층의 중심부에 배치되는 첨예부 부위에 형성되는 표면 전도형 전자 방출 소자.
  8. (정정)
    제 1 항에 있어서,
    상기 전자 방출 영역이 상기 전자 방출층의 중심부에 배치되는 슬림(slim) 부위에 형성되는 표면 전도형 전자 방출 소자.
  9. 제 1 항에 있어서,
    상기 전자 방출층이 모래 시계형의 패턴을 가지고 형성되는 표면 전도형 전자 방출 소자.
  10. 제1 기판과;
    이 제1 기판의 일면 위에 소정의 패턴을 가지고 형성되는 복수의 제1 전극과;
    이 제1 전극을 덮으면서 상기 기판 위로 형성되는 절연층과;
    이 절연층 위로 소정의 패턴을 가지고 형성되는 복수의 제2 전극과;
    소정의 패턴을 가지고 상기 제2 전극에 이웃하여 상기 절연층 위로 형성되는 복수의 제3 전극과;
    전자 방출 영역을 갖는 박막으로 형성되어, 상기 제2 전극과 제3 전극에 연결되는 복수의 전자 방출층을 포함하는 전자 방출부와;
    제2 기판과;
    이 제2 기판의 어느 일면에 소정의 패턴을 가지고 형성되는 애노드 전극과;
    이 애노드 전극 위로 형성되는 형광층을 포함하여 상기 전자 방출부와 함께 밀폐 진공 용기를 형성하는 이미지 형성부; 및
    상기 용기 내로 상기 전자 방출부와 이미지 형성부에 지지되어 설치되는 복수의 스페이서
    를 포함하고,
    상기 전자 방출층이 상기 전자 방출 영역을 중심부에 형성하고, 어느 일면에 대한 폭을 w라 할 때, 이 폭(w)을 상기 전자 방출 영역을 향해 갈수록 축소시켜 이루어지는 평판 디스플레이 장치.
  11. 제 10 항에 있어서,
    상기 제1 전극이, 계조(階調) 전압이 인가되는 신호(data) 전극으로 이루어진 평판 디스플레이 장치.
  12. 제 10 항에 있어서,
    상기 제2 전극이, 펄스 변조에 따른 주사 전압이 인가되는 주사 전극으로 이루어진 평판 디스플레이 장치.
  13. 제 10 항에 있어서,
    상기 제3 전극이, 그라운드 처리되는 공통 전극으로 이루어진 평판 디스플레이 장치.
  14. 제 10 항에 있어서,
    상기 전자 방출층이, 폴리실리콘, 비결정성 실리콘, 탄화 규소 중 어느 하나로 이루어진 반도체로 형성된 평판 디스플레이 장치.
  15. 제 10 항에 있어서,
    상기 평판 디스플레이 장치가, 상기 제2 전극과 상기 전자 방출층 사이에 형성되어 상기 제2 전극을 따라 상기 전자 방출층으로 흐르는 전류를 조절하는 전류조절수단을 더욱 포함하는 평판 디스플레이 장치.
  16. 제 10 항에 있어서,
    상기 전류 조절수단이 상기 제2 전극과 상기 전자 방출층 사이에 배치 형성되는 저항층으로 이루어진 평판 디스플레이 장치.
  17. 제 16 항에 있어서,
    상기 저항층이 일부위를 상기 제2 전극에 연결하고, 다른 일부위는 상기 전자 방출층에 직접 연결하여 형성되는 평판 디스플레이 장치.
  18. 제 16 항에 있어서,
    상기 저항층이 일부위를 상기 제2 전극에 연결하고, 다른 일부위는 상기 전자 방출층에 연결된 상기 제2 전극에 연결하여 형성되는 평판 디스플레이 장치.
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