KR0119899B1 - 비디오 데이터의 압축/복원회로 - Google Patents
비디오 데이터의 압축/복원회로Info
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Abstract
본 발명은 비디오 데이터를 압축하면서 동시에 별개의 압축된 비디오 데이터를 입력받아 복원할 수 있는 비디오 데이터의 압축/복원회로에 관한 것으로서 보다 상세하게는 아이비엠 피시호환기종에 장착되며 장치의 픽셀버스 인티페이스를 통하여 별도의 전처리장치로부터 영상의 밝기 성분과 색상 성분 데이터 포맷의 비디오 데이터를 입력받아 압축한 후 피지의 메모리에 저장할 수 있고 피시 인터페이스를 통하여 이미 압축된 비디오 데이터를 입력받아 복원한 후 별도의 오버레이 장치나 비디오 출력장치로 영상의 밝기 성분과 색상 성분 데이터 포맷의 비디오 데이터를 출력하며 이러한 비디오 데이터의 압축과 복원을 각각 또는 동시에 수행할 수 있도록 한 것이다.
특징적인 구성으로는 영상의 밝기 성분과 색상 성분 데이터 라인과 비디오 데이터 동기신호 및 클럭 라인으로 구성되며 입력 비디오 데이터와 출력 비디오 데이터 각각을 위한 두 개의 신호그룹을 갖는 픽셀버스 인터페이스부와, 상기 픽셀버스 인터페이스부에서 입력되는 영상의 밝기 성분과 색상 성분 데이터를 한 필드만큼 저장하는 필드 메모리부와, 상기 필드 메모리부에서 입력된 비디오 데이터의 크기를 줄여 주거나 동일한 크기로 재출력해 주는 스케일러부와, 입력되는 클럭 및 비디오 데이터 동기신호를 이용하여 필드 메모리부와 스케일러부와 데이터 경로여부에서 사용하는 각종 동기 및 제어신호를 만들어내는 입력비디오 동기제어부와, 디스크 마이크로콘트롤러와 집적 메모리 접근 콘트롤러와 비디오 타이밍발생기와 호프만부호화기/복호화기 및 비디오전/후처리기를 내장하고 있으면서 비디오 데이터가 압축 또는 복원되는 경로를 제어하고 스케일러부에서 입력되는 비디오 데이터에 대하여 잡음 제거등의 전처리를 하며 알고리즘프로세서가 데이터를 압축하도록 관리하고 알고리즘프로세서에서의 압축 결과를 호프만 부호화하여 출력하며 또한 피시로부터 입력되는 압축 비디오 데이터를 호프만 복호화한 후 알고리즘프로세서가 데이터를 복원하도록 관리하고 복원된 비디오 데이터는 후처리기에서 화면크기를 조정한 다음 비디오 타이밍발생기의 타이밍에 따라 출력하는 제1-제2의 데이터 경로제어부와, 상기 데이터 경로제어부에서 출력되는 영상의 밝기 성분과 색상 성분 4 : 4 : 4 포맷의 데이터를 영상의 밝기 성분과 색상 성분 4 : 2 : 2 포맷의 비디오 데이터로 바꾸어 주기위하여 밝기성분과 색상성분의 데이터값을 교대로 멀티플렉싱하는 제1-제2의 밝기/색상멀티플렉서부와, 상기 픽셀버스인터페이스부로부터 입력된 클럭과 비디오동기신호를 이용하여 출력되는 비디오 데이터의 동기신호를 만드는 출력 비디오 동기제어부와, 제1-제2의 데이터 경로제어부로부터 마이크로코드 수행에 대한 감시 및 제어명령신호를 받아 디지탈 데이터처리 형태로 마이크로 코드에 따른 압축/복원 알고리즘 중 연산이 많은 부분의 수행을 담당하는 제1-제2의 알고리즘 프로세서부와, 피시로부터 다운로드되어 제1-제2의 데이터 경로제어부와 제1-제2의 알고리즘 프로세서부와, 피시로부터 다운로드되어 제1-제2의 데이터 경로제어부와 제1-제2의 알고리즘 프로세서부를 거쳐 입력되는 마이크로코드를 저장하는 제1-제2의 코드에스램부와, 처음 부팅시 필요한 부팅프로그램과 피시와의 데이터교환을 위해 필요한 프로그램을 저장하는 제1-제2의 롬부와, 피시로부터 다운로드되는 상기 제1-제2의 데이터 경로제어부가 수행할 코드를 저장하는 제1-제2의 에스램부와, 상기 제1-제2의 데이터 경로제어부와 제1-제2의 알고리즘프로세서가 공통으로 사용하는 비디오 데이터가 저장되는 디램영역인 제1-제2의 프레임 버퍼부와, 압축된 비디오 데이터를 피시에 전달해주기 위한 선입선출 메모리로서 제1의 데이터 경로제어부에서 데이터가 출력되는 속도와 피시에서 데이터를 읽어가는 속도간의 차이를 버퍼링해 주는 압축 선입선출부와, 피시와 빠른 속도로 데이터를 교환하면서 피시의 주 프로세서의 동작방해를 최소화하기 위한 집적 메모리 접근 인터럽트 제어부와, 피시와 데이터 경로제어부가 교환하는 데이터중 비디오 데이터를 제외한 모든 다른 데이터들을 완충시키는 입출력 버퍼부와, 피시와의 사이에서 교환되는 데이터를 제어하기 위한 입출력 제어신호들을 제어하는 입출력 제어부와, 복원하고자 하는 압축데이터를 피시에서 데이터 경로제어부로 전달해주기 위한 선입선출 메모리로서 데이터의 입출력 속도를 완충시켜 주는 제1-제2의 복원 선입선출부로 구성함에 있다.
Description
제1도는 본 발명에 의한 비디오 데이터의 압축/복원회로 블럭도.
제2도는 본 발명에 의한 비디오 데이터의 압축/복원동작 흐름도.
* 도면의 주요부분에 대한 부호의 설명
1 : 픽셀버스 인터페이스부 2 : 필드 메모리부
3 : 스케일러부 4 : 입력 비디오 동기제어부
5,6 : 제1-제2데이터 경로제어부
7,8 : 제1-제2밝기/색상(UV) 멀티플렉서부
9 : 출력 비디오 동기제어부 10,11 : 제1-제2알고리즘 프로세서부
12,13 : 제1-제2코드 에스램(SRAM)부
14,15 : 제1-제2롬(ROM)부 16,17 : 제1-제2에스램(SRAM)부
18,19 : 제1-제2프레임 버퍼부 20 : 압출 선입선출(FIFO)부
21 : 직접 메모리접근(DMA) 인터럽트 제어부
22 : 입출력 버퍼부 23 : 입출력 제어부
24,25 : 제1-제2복원 선입선출(FIFO)부
본 발명은 비디오 데이터를 압축하면서 동시에 별개의 압축된 비디오 데이터를 입력받아 복원할 수 있는 비디오 데이터 압축/복원 회로에 관한 것으로서 보다 상세하게는 아이비엠 피시(IBM PC)호환기종에 장착되며 장치의 픽셀버스 인터페이스를 통하여 별도의 전처리장치로부터 영상의 밝기 성분과 색상 성분 데이터 포맷의 비디오 데이터를 입력받아 압축한 후 피시(PC)의 메모리에 저장할 수 있고 피시(PC) 인터페이스를 통하여 이미 압축된 비디오 데이터를 입력받아 복원한 후 별도의 오버레이(overlay) 장치나 비디오 출력장치로 영상의 밝기 성분과 색상 성분 데이터 포맷의 비디오 데이터를 출력하며 이러한 비디오 데이터의 압축과 복원을 각각 또는 동시에 수행할 수 있도록 한 것이다.
일반적으로 우리 주변에는 비디오, 문자, 음성 데이터를 멀티미디어 데이터의 처리 및 통신요구가 증대되고 비디오 데이터는 그 양이 방대하므로 이러한 요구를 만족시켜 주기 위하여 효율적으로 데이터를 압축/복원할 수 있는 장치 또는 방법이 필요해짐에 따라 소프트웨어나 하드웨어에 의한 장치가 지원되었다.
그러나 소프트웨어에 의한 비디오 데이터의 압축/복원 방법은 실시간 처리에 어려움이 있으므로 하드웨어로 된 전용 압축/복원 장치가 지원되었으나 이러한 종래의 비디오 데이터 압축/복원 장치들은 대부분이 비디오 데이터의 압축/복원기능을 동시에 지원하지 못하고 있으며 또한 일부 지원가능한 장치에 있어서도 실시간 압축/복원을 해주지 못하는 문제점이 있을 뿐만아니라 특정 알고리즘 전용의 압축/복원용 칩을 사용할 경우 압축/복원 성능을 향상시킬 수는 있지만 다양한 압축/복원 알고리즘을 지원할 수 없다는 한계가 있었다.
본 발명은 상기와 같은 문제점을 해결하기 위해 안출한 것으로서 본 발명의 목적은 비디오 데이터의 압축과 복원을 위한 별도의 데이터 경로를 가지면서, 압축/복원 알고리즘을 구현한 코드를 피시에서 다운로드(download)할 수 있는 구조로 설계된 각각의 하드웨어를 채용하여 실시간에 압축과 복원이 동시에 가능하도록 압축/복원 회로를 구성함으로써 한 개의 비디오 데이터를 압축하면서 동시에 두 가지 압축된 비디오 데이터를 복원할 수 있게 하여 다양한 표준 및 사용자가 설계한 독자적인 압축/복원 방법을 지원할 수 있고 피시상에서의 3자 화상회의를 잘 지원해 줄 수 있는 비디오 데이터의 압축/복원 회로를 제공함에 있다.
상기와 같은 목적을 달성하기 위한 본 발명에 따른 비디오 데이터의 압축/복원 회로의 특징은 영상의 밝기 성분과 색상 성분 데이터 라인과 비디오 데이터 동기신호 및 클럭 라인으로 구성되어, 입력 비디오 데이터와 출력 비디오 데이터 각각을 위한 두 개의 신호 그룹을 갖는 픽셀버스 인터페이스부와, 상기 픽셀버스 인터페이스부에서 입력되는 영상의 밝기성분과 색상 성분 데이터를 한 필드만큼 저장하는 필드 메모리부와, 상기 필드 메모리부에서 입력된 비디오 데이터의 크기를 줄여주거나 동일한 크기로 제출력해 주는 스케일러부와, 입력되는 클럭 및 비디오 데이터 동기신호를 이용하여 필드 메모리부와 스케일러부와 데이터 경로제어부에서 사용하는 각종 동기 및 제어신호를 만들어내는 입력 비디오 동기제어부와, 리스크(RISC) 마이크로콘트롤러와 직접 메모리 접근(DMA) 콘트롤러와 비디오 타이밍발생기와 호프만 부호화기/복호화기 및 비디오 전/후처리기를 내장하고 있으면서 비디오 데이터가 압축 또는 복원되는 경로를 제어하고 스케일러부에서 입력되는 비디오 데이터에 대하여 잡음 제거등의 전처리를 하며 알고리즘프로세서가 데이터를 압축하도록 관리하고 알고리즘프로세서에서의 압축 결과를 호프만 부호화하여 출력하며 또한 피시로부터 입력되는 압축 비디오 데이터를 호프만 복호화한 후 알고리즘프로세서가 데이터를 복원하도록 관리하고 복원된 비디오 데이터는 후처리기에서 화면 크기를 조정한 다음 비디오 타이밍발생기의 타이밍에 따라 출력하는 제1-제2의 데이터 경로제어부와, 상기 데이터 경로제어부에서 출력되는 영상의 밝기 성분과 색상 성분 4 : 4 : 4 포맷의 데이터를 영상의 밝기성분과 색상 성분 4 : 2 : 2 포맷의 비디오 데이터로 바꾸어 주기 위하여 밝기 성분과 색상 성분의 데이터값을 교대로 멀티플렉싱하는 제1-제2의 밝기/색상멀티플렉서부와, 상기픽셀버스 인터페이스부로부터 입력된 클럭과 비디오 동기신호를 이용하여 출력되는 비디오 데이터의 동기신호를 만드는 출력 비디오 동기제어부와, 제1-제2의 데이터 경로제어부로부터 마이크로 코드 수행에 대한 감시 및 제어명령 신호를 받아 디지탈 데이터 처리 형태로 마이크로 코드에 따른 압축/복원 알고리즘 중 연산이 많은 부분의 수행을 담당하는 제1-제2의 알고리즘프로세서부와, 피시로부터 다운로드되어 제1-제2의 데이터 경로제어부와 제1-제2의 알고리즘프로세서부를 거쳐 입력되는 마이크로 코드를 저장하는 제1-제2의 코드 에스램(SRAM)부와, 처음 부팅시 필요한 부팅 프로그램과 피시와의 데이터 교환을 위해 필요한 프로그램을 저장하는 제1-제2의 롬부와, 피시로부터 다운로드되는 상기 제1∼제2의 데이터 경로제어부가 수행할 코드를 저장하는 제1-제2의 에스램(SRAM)부와, 상기 제1-제2의 데이터 경로제어부와 제1-제2의 알고리즘프로세서가 공통으로 사용하는 비디오 데이터가 저장되는 디램(DRAM)영역인 제1-제2의 프레임 버퍼부와, 압축된 비디오 데이터를 피시에 전달해주기 위한 선입선출 메모리로서 제1의 데이터경로제어부에서 데이터가 출력되는 속도와 피시에서 데이터를 읽어가는 속도간의 차이를 버퍼링해 주는 압축 선입선출부와, 피시와 빠른 속도로 데이터를 교환하면서 피시의 주 프로세서의 동작 방해를 최소화하기 위한 접적 메모리 접근 인터럽트 제어부와, 피시와 데이터 경로제어부가 교환하는 데이터중 비디오 데이터를 제외한 모든 다른 데이터들을 완충시키는 입출력 버퍼부와, 피시와의 사이에서 교환되는 데이터를 제어하기 위한 입출력 제어 신호들을 제어하는 입출력 제어부와, 복원하고자 하는 압축 데이터를 피시에서 데이터 경로제어부로 전달해주기 위한 선입선출 메모리로서 데이터의 입출력 속도를 완충시켜 주는 제1-제2으 복원 선입선출부로 구성함에 있다.
이하, 본 발명에 의한 비디오 데이터의 압축/복원 회로의 바람직한 하나의 실시예에 대하여 첨부도면을 참고하여 상세히 설명하면 다음과 같다.
제1도는 본 발명에 의한 비디오 데이터의 압축/복원 회로 블럭도이다.
도면에 도시된 바와 같이 픽셀버스 인터페이스부(1)는 영상의 밝기 성분과 색상 성분 데이터 라인과 비디오 데이터 동기신호 및 클럭 라인으로 구성되며 입력 비디오 데이터와 출력 비디오 데이터 각각을 위한 두 개의 신호그룹을 갖는다.
필드 메모리부(2)는 상기 픽셀버스 인터페이스부에서 입력되는 영상의 밝기 성분과 색상 성분 데이터를 한 필드만큼 저장하는 장소이다.
스케일러부(3)는 상기 필드 메모리부에서 입력된 비디오 데이터의 크기를 줄여 주거나 동일한 크기로 재출력해 주고 화면의 크기를 줄일 경우 압축해야 할 비디오 데이터의 양이 줄기 때문에 더 많은 수의 화면을 처리할 수 있다.
입력비디오 동기제어부(4)는 입력되는 클럭 및 비디오 데이터 동기신호를 이용하여 필드 메모리부와 스케일러부와 데이터 경로제어부에서 사용하는 각종 동기 및 제어신호를 만들어낸다.
제1-제2의 데이터 경로제어부(5)(6)는 리스크(RISC) 미이크로콘트롤러와 집적 메모리 접근(DMA)콘트롤러와 비디오 타이밍발생기와 호프만 부호화기/복호화기 및 비디오 전/후처리기를 내장하고 있으면서 비디오 데이터가 압축 또는 복원되는 경로를 제어하고 스케일러부에서 입력되는 비디오 데이터에 대하여 잡음 제거등의 전처리를 하며 알고리즘세서가 데이터를 압축하도록 관리하고 알고리즘프로세서에서의 압축결과를 호프만 부호화하여 출력하며 또한 피시로부터 입력되는 압축 비디오 데이터를 호프만 복호화한 후 알고리즘프로세서가 데이터를 복원하도록 관리하고 복원된 비디오 데이터는 후처리기에서 화면 크기를 조정한 다음 비디오 타이밍발생기의 타이밍에 따라 출력한다.
제1-제2의 밝기/색상멀티플렉서부(7)(8)는 상기 데이터 경로제어부에서 출력되는 영상의 밝기 성분과 색상 성분 4 : 4 : 4 포맷의 데이터를 영상의 밝기 성분과 색상 성분 4 : 2 : 2 포맷의 비디오 데이터로 바꾸어 주기 위하여 밝기 성분과 색상 성분의 데이터값을 교대로 멀티플랙싱한다.
출력 비디오 동기제어부(9)는 상기 픽셀버스 인터페이스로부터 입력된 클럭과 비디오 동기신호를 이용하여 출력되는 비디오 데이터의 동기신호를 만든다.
제1-제2의 알고리즘프로세서부(10)(11)는 제1-제2의 데이터 경로제어부로부터 해당 마이크로 코드 수행에 대한 감시 및 제어명령신호를 받아 디지털 데이터처리(DSP) 형태로 마이크로 코드에 따른 압축/복원 알고리즘 중 연산이 많은 부분의 수행을 담당한다.
제1-제2의 코드 에스램(SRAM)부(12)(13)는 피시로부터 다운로드되어 제1-제2의 데이터 경로제어부와 제1-제2의 알고리즘프로세서부를 거쳐 입력되는 마이크로 코드를 저장한다.
제1-제2의 롬부(14)(15)는 처음 부팅시 필요한 부팅 프로그램과 피시와의 데이터 교환을 위해 필요한 프로그램을 저장한다.
제1-제2의 에스램(SRAM)부(16)(17)는 피시로부터 다운로드되는 상기 제1-제2의 데이터 경로제어부가 수행할 코드를 저장한다.
제1-제2의 프레임 버퍼부(18)(19)는 상기 제1-제2의 데이터 경로제어부와 제1-제2의 알고리즘프로세서가 공통으로 사용하는 비디오 데이터가 저장되는 디램(DRAM) 영역이다.
압축선입선출부(20)는 압축된 비디오 데이터를 피시에 전달해주기 위한 선입선출메모리로서 제1의 데이터 경로제어부에서 데이터가 출력되는 속도와 피시에서 데이터를 읽어가는 속도간의 차이를 버퍼링해 준다.
집적 메모리 접근인터럽트 제어부(21)는 피시와 빠른 속도로 데이터를 교환하면서 피시의 주 프로세서의 동작 방해를 최소화하기 위해 필요한 조직들이며 피시와 주고받은 데이터의 양이 매우 크기 때문에 필수적인 부분이다.
입출력 버퍼부(22)는 피시와 데이터 경로제어부가 교환하는 데이터중 비디오 데이터를 제외한 모든 다른 데이터들을 완충시킨다.
입출력 제어부(23)는 피시와의 사이에서 교환되는 데이터를 제어하기 위한 입출력제어신호들을 제어한다.
제1-제2의 복원선입선출부(24)(25)는 복원하고자 하는 압축데이터를 피시에서 데이터 경로제어부로 전달해주기 위한 선입선출메모리로서 데이터의 입출력 속도를 완충시켜 준다.
제2도는 본 발명에 의한 비디오 데이터의 흐름을 나타내는 동작흐름도로서 1비디오 에이터 압축/2비디오데이터 복원시의 동작과정을 보인 것이며 그 동작설명은 다음과 같다.
압축될 비디오 데이터(S31)는 픽셀버스 인터페이스부(1)를 거쳐 입력(S32)되어 필드 메모리부(2)에 저장(S33)된다.
필드 메모리부(2)에 저장된 데이터는 스케일러부(3)에서 압축할 화면크기로 스케일링된 후 제1데이터 경로제어부(5)를 거쳐(S34) 제1프레임 버퍼부(18)에 저장(S35)된다.
제1알고리즘 프로세서부(10)는 제1프레임 버퍼부(18)에 저장된 비디오 데이터에 대하여 제1데이터 경로제어부(5)의 명령에 따라 압축 알고리즘을 수행(S36-S37)하고 압축된 비디오 데이터를 제1데이터 경로 제어부(5)가 읽어서(S38) 압축 선입선출부(20)로 출력한다.
압축 선입선출부(20)내에 저장(S39)된 데이터는 집적 메모리 접근 인터럽트 제어부(21)의 제어에 따라 피시인터페이스부(26)를 거쳐(S40) 피시내의 메모리로 전달된다.
복원될 제1비디오 데이터(S41)는 피시 메모리에서 피시인터페이스부(26)를 거쳐(S42) 집적 메모리 접근인터럽트 제어부(21)의 제어에 따라 제1복원 선입선출부(24)를 거쳐(S43) 제1데이터 경로제어부(5)에 입력(S34)된다.
제1데이터 경로제어부(5)는 입력되는 압축 제1비디오 데이터를 제1프레임 버퍼부(18)에 저장(S35)하고 제1알고리즘 프로세서부(10)에게 복원 명령을 내린다.
제1알고리즘 프로세수부(10)는 제1프레임 버퍼부(18)내의 압축 제1비디오 데이터를 읽어서 복원알고리즘을 수행(S36)하고 그 결과를 제1프레임 버퍼부(18)에 다시 저장(S37)한다.
제1데이터 경로제어부(5)는 복원된 비디오 데이터를 읽어서 출력비디오 동기제어부(9)신호에 의해 출력(S38)하고 출력된 데이터는 제1밝기/색상 멀티플랙서부(7)와 픽셀버스 인터페이스부(1)를 거쳐(S44-S45)별도의 오버레이장치로 출력된다.
복원될 제2비디오 데이터(S46)는 피시메모리에서 피시인터페이스부(26)를 거쳐(S42) 집적 메모리 접근인터럽트 제어부(21)의 제어에 따라 제2복원 선입선출부(25)를 거쳐(S47) 제2데이터 경로제어부(6)에 입력(S48)된다.
제2데이터 경로제어부(6)는 입력되는 압축 제2비디오 데이터를 제2프레임 버퍼부(19)에 저장(S49)하고 제2알고리즘프로세서부(11)에게 복원명령을 내린다.
제2알고리즘프로세서부(11)는 제2프레임 버퍼부(19)내의 압축 제2비디오 데이터를 읽어서 복원알고리즘을 수행(S50)하고 그 결과를 제2프레임 버퍼부(19)에 다시 저장(S51)한다.
제2데이터 경로제어부(6)는 복원된 비디오 데이터를 읽어서 출력(S52)하고 출력된 데이터는 제2밝기/색상 멀티플렉서부(8)와 픽셀버스 인터페이스부(1)를 거쳐(S53,S45)별도의 오버레이장치로 출력된다.
상기와 같은 세 과정은 동시에 수행되며 특히 비디오 데이터 압축과정과 제1비디오 데이터의 복원과정은 동일한 하드웨어상에서 동시에 수행되며 압축, 복원, 제1비디오 데이터 압축/제1비디오 데이터 복원과정은 상기 과정을 일부만 수행하는 것이 된다.
이상에서와 같이 본 발명에 따른 비디오 데이터의 압축/복원 회로에 의하면 비디오 데이터의 압축과 복원을 위한 각각의 하드웨어를 채용하였기 때문에 압축과 복원을 위한 별도의 데이터 경로를 가지고 있어서 실시간에 압축과 복원이 동시에 가능하며 압축/복원 알고리즘을 구현한 코드를 피시에서 다운로드(download)할 수 있는 구조로 설계되었기 때문에 다양한 표준 및 사용자가 설계한 독자적인 압축/복원 방법을 지원할 수 있고, 압축 알고리즘을 수행하는 하드웨어에 압축과 복원을 동시에 수행하는 알고리즘 코드를 다운로드로 하면 한 개의 비디오 데이터를 압축하면서 동시에 두 가지 압축된 비디오 데이터를 복원할 수 있어서 최대3가지의 비디오 데이터를 처리할 수 있으며 피시상에서 3자 화상회의를 잘 지원해 줄 수 있는 유용함이 있다.
Claims (1)
- 영상의 밝기 성분과 색상 성분 데이터 라인과 비디오 데이터 동기신호 및 클럭 라인으로 구성되며 입력 비디오 데이터와 출력 비디오 데이터 각각을 위한 두 개의 신호그룹을 갖는 픽셀버스 인터페이스부와, 상기 픽셀버스 인터페이스부에서 입력되는 영상의 밝기 성분과 색상 성분 데이터를 한 필드만큼 저장하는 필드 메모리부와, 상기 필드 메모리부에서 입력된 비디오 데이터의 크기를 줄여주거나 동일한 크기로 재출력해 주는 스케일러부와, 입력되는 클럭 및 비디오 데이터 동기신호를 이용하여 필드 메모리부와 스케일러부와 데이터 경로제의부에서 사용하는 각종 동기 및 제어신호를 만들어내는 입력 비디오 동기제어부와, 리스크 마이크로콘트롤러와 집적 메모리 접근 콘트롤러와 비디오 타이밍발생기와 호프만 부호화기/복호화기 및 비디오 전/후처리기를 내장하고 있으면서 비디오 데이터가 압축 또는 복원되는 경로를 제어하고 스케일러부에서 입력되는 비디오 데이터에 대하여 집음 제거등의 전처리를 하며 알고리즘프로세서가 데이터를 압축하도록 관리하고 알고리즘프로세서에서의 압축 결과를 호프만 부호화하여 출력하며 또한 피시로부터 입력되는 압축 비디오 데이터를 호프만 복호화한 후 알고리즘프로세서가 데이터를 복원하도록 관리하고 복원된 비디오 데이터는 후처리기에서 화면 크기를 조정한 다음 비디오 타이밍 발생기의 타이밍에 따라 출력하는 제1-제2의 데이터 경로제어부와, 상기 데이터 경로제어부에서 출력되는 영상의 밝기 성분과 색상 성분 4 : 4 : 4 포맷의 데이터를 영상의 밝기 성분과 색상 성분 4 : 2 : 2 포맷의 비디오 데이터로 바꾸어 주기 위하여 밝기 성분과 색상 성분의 데이터값을 교대로 멀티플렉싱하는 제1-제2의 밝기/색상 멀티플랙서부와, 상기픽셀버스인터페이스부로부터 입력된 클럭과 비디오동기신호를 이용하여 출력되는 비디오 데이터의 동기신호를 만드는 출력 비디오 동기제어부와, 제1-제2의 데이터 경로제어부로부터 마이크로 코드수행에 대한 감시 및 제어명령신호를 받아 디지털 데이터 처리형태로 마이크로 코드에 따른 압축/복원 알고리즘 중 연산이 많은 부분의 수행을 담당하는 제1-제2의 알고리즘프로세서부와, 피시로부터 다운로드되어 제1-제2의 데이터 경로제어부와 제1-제2의 알고리즘프로세서부를 거쳐 입력되는 마이크로 코드를 저장하는 제1-제2의 코드 에스램부와, 처음 부팅시 필요한 부팅프로그램과 피시와의 데이터교환을 위해 필요한 프로그램을 저장하는 제1-제2의 롬부와, 피시로부터 다운로드되는 상기 제1-제2의 데이터 경로제어부가 수행할 코드를 저장하는 제1-제2의 에스램부아와, 상기 제1-제2의 데이터 경로제어부와 제1-제2의 알고리즘프로세서가 공통으로 사용하는 비디오 데이터가 저장되는 디램영역인 제1-제2의 프레임 버퍼부와, 압축된 비디오 데이터를 피시에 전달해주기 위한 선입선출메모리로서 제1의 데이터 경로제어부에서 데이터가 출력되는 속도와 피시에서 데이터를 읽어가는 속도간의 차이를 버퍼링해주는 압축선입선출부와, 피시와 빠른 속도로 데이터를 교환하면서 피시의 주 프로세서의 동작 방해를 최소화하기 위한 접적 메모리 접근인터럽트제어부와, 피시와 데이터 경로제어부가 교환하는 데이터중 비디오 데이터를 제외한 모든 다른 데이터들을 완충시키는 입출력 버퍼부와, 피시와의 사이에서 교환되는 데이터를 제어하기 위한 입출력 제어신호들을 제어하는 입출력 제어부와, 복원하고자 하는 압축데이터를 피시에서 데이터 경로제어부로 전달해주기 위한 선입선출메모리로서 데이터의 입출력 속도를 완충시켜 주는 제1-제2의 복원선입선출부로 구성함을 특징으로 하는 비디오 데이터의 압축/복원 회로.
Priority Applications (1)
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|---|---|---|---|
| KR1019940029928A KR0119899B1 (ko) | 1994-11-15 | 1994-11-15 | 비디오 데이터의 압축/복원회로 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1019940029928A KR0119899B1 (ko) | 1994-11-15 | 1994-11-15 | 비디오 데이터의 압축/복원회로 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| KR960018942A KR960018942A (ko) | 1996-06-17 |
| KR0119899B1 true KR0119899B1 (ko) | 1997-10-30 |
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ID=19397948
Family Applications (1)
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| KR1019940029928A KR0119899B1 (ko) | 1994-11-15 | 1994-11-15 | 비디오 데이터의 압축/복원회로 |
Country Status (1)
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| KR (1) | KR0119899B1 (ko) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100863038B1 (ko) * | 2002-04-04 | 2008-10-13 | 엘지전자 주식회사 | 디지털 티브이의 데이터 전송 장치 |
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-
1994
- 1994-11-15 KR KR1019940029928A patent/KR0119899B1/ko not_active IP Right Cessation
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|---|---|---|---|---|
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| Publication number | Publication date |
|---|---|
| KR960018942A (ko) | 1996-06-17 |
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