JPWO2013145282A1 - データ処理装置 - Google Patents
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- 230000015654 memory Effects 0.000 claims abstract description 52
- 238000005070 sampling Methods 0.000 description 108
- 238000000034 method Methods 0.000 description 30
- 230000005540 biological transmission Effects 0.000 description 22
- 238000010586 diagram Methods 0.000 description 10
- 238000010248 power generation Methods 0.000 description 9
- 101001067830 Mus musculus Peptidyl-prolyl cis-trans isomerase A Proteins 0.000 description 5
- 101100365087 Arabidopsis thaliana SCRA gene Proteins 0.000 description 3
- 101000737052 Homo sapiens Coiled-coil domain-containing protein 54 Proteins 0.000 description 3
- 101000824971 Homo sapiens Sperm surface protein Sp17 Proteins 0.000 description 3
- 102100022441 Sperm surface protein Sp17 Human genes 0.000 description 3
- 101100438139 Vulpes vulpes CABYR gene Proteins 0.000 description 3
- 230000003111 delayed effect Effects 0.000 description 2
- 239000004065 semiconductor Substances 0.000 description 2
- -1 SP14 Proteins 0.000 description 1
- 230000004913 activation Effects 0.000 description 1
- 238000003306 harvesting Methods 0.000 description 1
- 230000003936 working memory Effects 0.000 description 1
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- G06—COMPUTING; CALCULATING OR COUNTING
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- G06F9/00—Arrangements for program control, e.g. control units
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- G06F15/163—Interprocessor communication
- G06F15/167—Interprocessor communication using a common memory, e.g. mailbox
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- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
- G06F9/30003—Arrangements for executing specific machine instructions
- G06F9/30007—Arrangements for executing specific machine instructions to perform operations on data operands
- G06F9/30036—Instructions to perform operations on packed data, e.g. vector, tile or matrix operations
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- G—PHYSICS
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- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
- G06F9/34—Addressing or accessing the instruction operand or the result ; Formation of operand address; Addressing modes
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Abstract
Description
図1は、第1の実施形態によるデータ処理装置101の構成例を示す図である。データ処理装置102は親機のデータ処理装置(携帯端末)であり、データ処理装置101は子機のデータ処理装置(センサノード)である。データ処理装置101は、センサ112を有し、データ処理装置102に対してセンシングデータを無線送信することができる。
図7は、第2の実施形態によるMCU群114の構成例を示す図である。以下、本実施形態が第1の実施形態と異なる点を説明する。第4のMCU204は、MCU201〜203と同様の構成を有し、バス211に接続される。本実施形態では、必要なMCUの数は3個であるが、耐故障性を考慮して4個のMCU201〜204を設ける。プログラムメモリ212は、第4の実行開始アドレス「FF」番地(16進数)に停止命令を記憶する。キュー213内の記憶部402は、エントリ番号「3」に第4の実行開始アドレス「FF」番地(16進数)を記憶する。例えば、MCU201〜204は、第1の実施形態と同様に、電力P2の供給が開始されると、ほぼ同時にキュー213にアクセスする。例えば、キュー213内の制御部401は、最初に第1のMCU201のアクセスを受け付け、2番目に第2のMCU202のアクセスを受け付け、3番目に第3のMCU203のアクセスを受け付け、4番目に第4のMCU204のアクセスを受け付ける。この場合、MCU201〜203の処理は、第1の実施形態と同じである。以下、第4のMCU204の処理を説明する。
Claims (9)
- データ処理する複数のコントローラと、
複数のアドレスにそれぞれ待機命令及びデータ処理命令を記憶するプログラムメモリと、
前記複数のコントローラの異なる実行開始アドレスを記憶するキューとを有し、
前記複数のコントローラは、前記キューに順次アクセスすると、前記順次アクセスした順番により前記キューから異なる実行開始アドレスを入力し、前記プログラムメモリ内の前記入力した異なる実行開始アドレスから命令の実行を開始し、前記データ処理命令及び前記待機命令を繰り返し実行し、
前記複数のコントローラは、相互に前記データ処理命令を実行するタイミングが異なることを特徴とするデータ処理装置。 - 前記複数のコントローラは、相互に、前記異なる実行開始アドレスの命令から前記データ処理命令までの間にある前記待機命令の数が異なることを特徴とする請求項1記載のデータ処理装置。
- 前記複数のコントローラは、相互に、前記データ処理命令を繰り返し実行する周期が同じであることを特徴とする請求項1記載のデータ処理装置。
- 前記キューは、
複数のエントリ番号に前記複数のコントローラの異なる実行開始アドレスを記憶する記憶部と、
前記記憶部のエントリ番号を記憶するオフセットレジスタと、
前記複数のコントローラから順次アクセスされると、前記記憶部内の前記オフセットレジスタに記憶されているエントリ番号から前記実行開始アドレスを読み出し、前記読み出した実行開始アドレスを前記アクセスしたコントローラに出力し、前記オフセットレジスタに記憶されているエントリ番号を次のエントリ番号に書き換える制御部と
を有することを特徴とする請求項1記載のデータ処理装置。 - 前記制御部は、前記コントローラからアクセスされると、前記オフセットレジスタに記憶されているエントリ番号をインクリメントすることを特徴とする請求項4記載のデータ処理装置。
- 前記プログラムメモリは、第1の実行開始アドレスに前記データ処理命令を記憶し、第2の実行開始アドレスに前記待機命令を記憶し、
前記複数のコントローラのうちの第1のコントローラは、前記第1の実行開始アドレスに記憶されているデータ処理命令から実行を開始し、
前記複数のコントローラのうちの第2のコントローラは、前記第2の実行開始アドレスに記憶されている待機命令から実行を開始し、その後に、前記第2の実行開始アドレスの次のアドレスである前記第1の実行開始アドレスに記憶されているデータ処理命令を実行することを特徴とする請求項1記載のデータ処理装置。 - 前記プログラムメモリは、第3の実行開始アドレスに前記待機命令を記憶し、
前記複数のコントローラのうちの第3のコントローラは、前記第3の実行開始アドレスに記憶されている待機命令から実行を開始し、その後に、前記第3の実行開始アドレスの次のアドレスである前記第2の実行開始アドレスに記憶されている待機命令を実行し、その後に、前記第2の実行開始アドレスの次のアドレスである前記第1の実行開始アドレスに記憶されているデータ処理命令を実行することを特徴とする請求項6記載のデータ処理装置。 - 前記プログラムメモリは、前記第1の実行開始アドレスの次のアドレスに待機命令を記憶し、その次のアドレスに前記第1の実行開始アドレスへのジャンプ命令を記憶することを特徴とする請求項6記載のデータ処理装置。
- 前記プログラムメモリは、第4の実行開始アドレスに停止命令を記憶し、
前記複数のコントローラのうちの第4のコントローラは、前記第4の実行開始アドレスに記憶されている停止命令を実行することを特徴とする請求項6記載のデータ処理装置。
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
PCT/JP2012/058652 WO2013145282A1 (ja) | 2012-03-30 | 2012-03-30 | データ処理装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPWO2013145282A1 true JPWO2013145282A1 (ja) | 2015-08-03 |
JP5900606B2 JP5900606B2 (ja) | 2016-04-06 |
Family
ID=49258645
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2014507243A Expired - Fee Related JP5900606B2 (ja) | 2012-03-30 | 2012-03-30 | データ処理装置 |
Country Status (3)
Country | Link |
---|---|
US (1) | US9459870B2 (ja) |
JP (1) | JP5900606B2 (ja) |
WO (1) | WO2013145282A1 (ja) |
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Publication number | Priority date | Publication date | Assignee | Title |
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-
2012
- 2012-03-30 JP JP2014507243A patent/JP5900606B2/ja not_active Expired - Fee Related
- 2012-03-30 WO PCT/JP2012/058652 patent/WO2013145282A1/ja active Application Filing
-
2014
- 2014-09-29 US US14/499,334 patent/US9459870B2/en not_active Expired - Fee Related
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Also Published As
Publication number | Publication date |
---|---|
US20150019837A1 (en) | 2015-01-15 |
WO2013145282A1 (ja) | 2013-10-03 |
JP5900606B2 (ja) | 2016-04-06 |
US9459870B2 (en) | 2016-10-04 |
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