JPWO2013046500A1 - Manufacturing method of electronic component module - Google Patents

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Abstract

第1配線パターンが形成された部品搭載面を有するコア層を準備する工程と、第1配線パターンの表面を粗化する工程と、粗化後の第1配線パターンの少なくともランドを覆う部分に、熱硬化性樹脂とはんだ粒子とを含む接合材を配置する工程と、端子を有する電子部品を準備し、端子を、接合材を介してランドに着地させて、電子部品を部品搭載面に搭載する工程と、電子部品を搭載したコア層を第1加熱して、はんだにより端子をランドに接合するとともに、熱硬化性樹脂を半硬化させる工程と、部品搭載面に実装された電子部品がプリプレグで囲われるように、コア層にプリプレグを積層する工程と、減圧雰囲気中で、コア層とプリプレグとの積層体を、積層方向に加圧するとともに、第2加熱することにより、プリプレグの硬化物により電子部品を封止するとともに、熱硬化性樹脂の硬化を更に進行させる工程と、を含む、電子部品モジュールの製造方法。A step of preparing a core layer having a component mounting surface on which a first wiring pattern is formed; a step of roughening a surface of the first wiring pattern; and a portion covering at least a land of the first wiring pattern after the roughening, A step of arranging a bonding material including a thermosetting resin and solder particles, and preparing an electronic component having a terminal, landing the terminal on the land via the bonding material, and mounting the electronic component on the component mounting surface First, the core layer on which the electronic component is mounted is heated first, the terminal is bonded to the land with solder, the thermosetting resin is semi-cured, and the electronic component mounted on the component mounting surface is a prepreg. The step of laminating the prepreg on the core layer and the laminated body of the core layer and the prepreg are pressurized in the laminating direction in the reduced pressure atmosphere, and secondly heated to form a cured prepreg. Ri together to seal the electronic component, comprising a step of further advancing the curing of the thermosetting resin, a method of manufacturing an electronic component module.

Description

本発明は、金属箔の配線パターンが形成された部品搭載面を有するコア層と、部品搭載面に実装された電子部品と、電子部品を封止する樹脂層とを具備する、電子部品モジュールの製造方法に関する。   The present invention provides an electronic component module comprising a core layer having a component mounting surface on which a metal foil wiring pattern is formed, an electronic component mounted on the component mounting surface, and a resin layer for sealing the electronic component. It relates to a manufacturing method.

半導体素子などの電子部品の多くは、電子部品モジュールの形で電子機器に組み込まれている。電子部品モジュールは、一般に、金属箔の配線パターンが形成された基板に電子部品を実装し、その後、電子部品を樹脂層により封止することで形成される。電子部品モジュールの実装密度の高度化が求められる中、複数の配線パターンが積層され、かつ内層の配線パターンに電子部品が実装された形態の電子部品モジュールが用いられるようになってきている(例えば特許文献1)。このような、電子部品モジュールは、部品内蔵基板とも称される。   Many electronic components such as semiconductor elements are incorporated in electronic devices in the form of electronic component modules. An electronic component module is generally formed by mounting an electronic component on a substrate on which a metal foil wiring pattern is formed, and then sealing the electronic component with a resin layer. While higher mounting density of electronic component modules is required, an electronic component module in which a plurality of wiring patterns are stacked and electronic components are mounted on an inner layer wiring pattern has been used (for example, Patent Document 1). Such an electronic component module is also referred to as a component built-in substrate.

特許文献1では、まず、内層基板(コア層)の配線パターンのランドに電子部品を実装した後、電子部品の端子とランドとの接合部を、耐薬品性を有する樹脂で被覆し、その後、配線パターンの粗化処理(黒化処理)が行われる。そして、電子部品をプリプレグで囲み、プリプレグを介してコア層と対向するように銅箔を配置し、積層体が形成される。この積層体を積層方向に加圧するとともに加熱することにより、部品を内蔵した積層板が形成される。その後、銅箔を加工することで、更なる配線パターンが形成され、更に配線パターン間を接続するビアが形成される。このような操作を必要回数行うことで、部品内蔵基板が完成する。   In Patent Document 1, first, after mounting an electronic component on the land of the wiring pattern of the inner layer substrate (core layer), the joint between the terminal of the electronic component and the land is covered with a chemical-resistant resin, A wiring pattern roughening process (blackening process) is performed. And an electronic component is enclosed with a prepreg, a copper foil is arrange | positioned so that a core layer may be opposed via a prepreg, and a laminated body is formed. By pressing the laminated body in the laminating direction and heating the laminated body, a laminated board containing components is formed. Thereafter, by processing the copper foil, a further wiring pattern is formed, and a via for connecting the wiring patterns is further formed. By performing such an operation as many times as necessary, the component-embedded substrate is completed.

コア層は、薄型の樹脂基板に銅箔などの金属箔を貼り合わせた後、金属箔にパターニングを施すことにより得ることができる。金属箔は、部品内蔵基板の内層の配線パターンを提供するとともに、薄く撓みやすい樹脂基板の剛性を補う役割を有している。一方、プリプレグは、半硬化状態の熱硬化性樹脂を含浸した繊維シートなどからなり、加熱により熱硬化性樹脂の更なる硬化が進行する。その結果、電子部品や内層の配線パターンは樹脂硬化物により封止される。   The core layer can be obtained by attaching a metal foil such as a copper foil to a thin resin substrate and then patterning the metal foil. The metal foil provides a wiring pattern in the inner layer of the component-embedded substrate and has a role of supplementing the rigidity of the thin and flexible resin substrate. On the other hand, the prepreg is made of a fiber sheet impregnated with a semi-cured thermosetting resin, and further curing of the thermosetting resin proceeds by heating. As a result, the electronic component and the inner layer wiring pattern are sealed with the cured resin.

良好な封止状態を得るためには、プリプレグを金属箔と密着させる必要がある。しかし、プリプレグを構成する熱硬化性樹脂は、配線パターンを形成する金属箔表面との密着性に乏しい。そこで、熱硬化性樹脂と配線パターンとの密着性を向上させるために、金属箔表面の粗化処理が行われる。プリプレグと配線パターンとの積層に先立って、金属箔もしくは配線パターンの表面を粗化し、微細なアンカーパターンを形成することにより、熱硬化性樹脂との密着性が向上する。粗化処理としては、金属箔表面を化学的に浸食する作用を有する処理液にコア層を浸漬する湿式処理が一般的である。   In order to obtain a good sealing state, it is necessary to make the prepreg adhere to the metal foil. However, the thermosetting resin constituting the prepreg has poor adhesion to the surface of the metal foil forming the wiring pattern. Therefore, in order to improve the adhesion between the thermosetting resin and the wiring pattern, the surface of the metal foil is roughened. Prior to the lamination of the prepreg and the wiring pattern, the surface of the metal foil or the wiring pattern is roughened to form a fine anchor pattern, thereby improving the adhesion with the thermosetting resin. As the roughening treatment, a wet treatment is generally used in which the core layer is immersed in a treatment solution having a function of chemically eroding the surface of the metal foil.

特開2004−311736号公報JP 2004-311736 A

特許文献1のように、金属箔の粗化処理を電子部品が実装されたコア層を対象に行うと、粗化処理の作用が接合部にも作用する場合がある。特に、接合部に形成されているフィレットの止端部は浸食を受けやすい。このような浸食により、止端部にマイクロクラックが形成されると、接合部が破断しやすくなる。特許文献1では、粗化処理の前に、接合部を熱硬化性樹脂で被覆し、加熱により樹脂を硬化させて接合部を保護しているが、樹脂の硬化が不十分である場合には、同様の問題が生じる。一方、接合部を被覆する樹脂の硬化を十分に進行させるためには、加熱時間を長く設定する必要があり、電子部品モジュールの生産性が阻害される。   If the roughening process of metal foil is performed for the core layer in which the electronic component was mounted like patent document 1, the effect | action of a roughening process may act also on a junction part. In particular, the toe portion of the fillet formed at the joint is susceptible to erosion. When micro cracks are formed at the toe due to such erosion, the joint is easily broken. In Patent Document 1, before the roughening treatment, the joint portion is covered with a thermosetting resin, and the resin is cured by heating to protect the joint portion. However, when the resin is not sufficiently cured, A similar problem arises. On the other hand, in order to sufficiently advance the curing of the resin that covers the joint portion, it is necessary to set the heating time longer, which impedes the productivity of the electronic component module.

電子部品の端子とランドとを接合する接合材として、熱硬化性樹脂に分散させたはんだ粒子を用いることも提案されている。この場合、リフローにより、電子部品のコア層への実装と同時に、はんだ接合部を熱硬化性樹脂の硬化物で被覆することができる。しかし、リフロー工程では、熱硬化性樹脂を十分に硬化させることが困難であり、接合部が半硬化状態の熱硬化性樹脂で被覆された状態となりやすい。従って、硬化を更に進行させるために、再加熱(アフターキュア)が必要となり、やはり電子部品モジュールの生産性が阻害される。   It has also been proposed to use solder particles dispersed in a thermosetting resin as a bonding material for bonding terminals and lands of an electronic component. In this case, the solder joint can be covered with the cured product of the thermosetting resin simultaneously with the mounting of the electronic component on the core layer by reflow. However, in the reflow process, it is difficult to sufficiently cure the thermosetting resin, and the joint is likely to be in a state of being covered with a semi-cured thermosetting resin. Therefore, reheating (after-cure) is required to further advance the curing, which also hinders the productivity of the electronic component module.

また、電子部品の実装と同時に、熱硬化性樹脂の硬化物ではんだ接合部を被覆する場合、電子部品とコア層との間にボイドが発生しやすい。ボイドが発生した状態のままでアフターキュアを行うと、ボイドが樹脂硬化物で囲まれた状態となり、その後の工程でボイドを除去することができなくなる。その結果、再リフロー時に、はんだが再溶融した場合、ボイド中にはんだが流れ込んで、接合不良が生じたりする。   In addition, when the solder joint is covered with a cured thermosetting resin simultaneously with the mounting of the electronic component, voids are likely to occur between the electronic component and the core layer. If after-curing is performed with the voids generated, the voids are surrounded by the cured resin, and the voids cannot be removed in subsequent steps. As a result, if the solder is remelted during reflow, the solder flows into the void, resulting in poor bonding.

上記のように、従来の方法では、信頼性の高い電子部品モジュールを効率的に生産することは困難である。   As described above, in the conventional method, it is difficult to efficiently produce a highly reliable electronic component module.

本発明は、電子部品接続用のランドを含む第1配線パターンが形成された部品搭載面を有するコア層を準備する工程と、
前記第1配線パターンの表面を粗化する工程と、
前記粗化後の前記第1配線パターンの少なくとも前記ランドを覆う部分に、熱硬化性樹脂と前記熱硬化性樹脂に分散させたはんだ粒子とを含む接合材を配置する工程と、
端子を有する電子部品を準備し、前記端子を、前記接合材を介して前記ランドに着地させて、前記電子部品を前記部品搭載面に搭載する工程と、
前記電子部品を搭載した前記コア層を第1加熱して、前記はんだにより前記端子を前記ランドに接合するとともに、前記熱硬化性樹脂を半硬化させる工程と、
前記部品搭載面に実装された前記電子部品がプリプレグで囲われるように、前記コア層に前記プリプレグを積層する工程と、
減圧雰囲気中で、前記コア層と前記プリプレグとの積層体を、積層方向に加圧するとともに、第2加熱することにより、前記プリプレグの硬化物により前記電子部品を封止するとともに、前記熱硬化性樹脂の硬化を更に進行させる工程と、を含む、電子部品モジュールの製造方法、に関する。
The present invention provides a step of preparing a core layer having a component mounting surface on which a first wiring pattern including lands for connecting electronic components is formed;
Roughening the surface of the first wiring pattern;
Disposing a bonding material including a thermosetting resin and solder particles dispersed in the thermosetting resin on at least a portion covering the land of the first wiring pattern after the roughening;
Preparing an electronic component having a terminal, landing the terminal on the land via the bonding material, and mounting the electronic component on the component mounting surface;
First heating the core layer on which the electronic component is mounted, joining the terminal to the land with the solder, and semi-curing the thermosetting resin;
Laminating the prepreg on the core layer so that the electronic component mounted on the component mounting surface is surrounded by the prepreg;
In a reduced pressure atmosphere, the laminate of the core layer and the prepreg is pressurized in the laminating direction and second heated to seal the electronic component with a cured product of the prepreg and the thermosetting And a step of further proceeding the curing of the resin.

本発明によれば、部品搭載面の配線パターンの表面を粗化した後に、コア層に電子部品を実装することから、粗化処理の際に、はんだ接合部にマイクロクラックが発生することを防止できる。また、リフロー後のはんだ接合部を被覆している熱硬化性樹脂は、半硬化状態であるため、コア層とプリプレグとの積層体を加熱する際に軟化し、流動可能な状態となる。よって、電子部品とコア層との間にボイドが発生している場合でも、減圧雰囲気中で積層体を加圧すると、ボイドが半硬化状態の熱硬化性樹脂中を移動して、外部に放出される。また、リフロー時に、はんだ接合部を被覆する熱硬化性樹脂を完全に硬化させる必要がなく、リフロー後にアフターキュアさせる必要もないため、電子部品モジュールの生産性が向上する。
本発明の新規な特徴を添付の請求の範囲に記述するが、本発明は、構成および内容の両方に関し、本願の他の目的および特徴と併せ、図面を照合した以下の詳細な説明によりさらによく理解されるであろう。
According to the present invention, since the electronic component is mounted on the core layer after the surface of the wiring pattern on the component mounting surface is roughened, it is possible to prevent the occurrence of micro cracks in the solder joint during the roughening process. it can. Moreover, since the thermosetting resin which coat | covers the solder joint part after reflow is a semi-hardened state, when heating the laminated body of a core layer and a prepreg, it will be in the state which can be softened and flowed. Therefore, even when a void is generated between the electronic component and the core layer, if the laminate is pressurized in a reduced-pressure atmosphere, the void moves through the semi-cured thermosetting resin and is released to the outside. Is done. In addition, it is not necessary to completely cure the thermosetting resin that covers the solder joint portion during reflow, and it is not necessary to perform after-curing after reflow, so that the productivity of the electronic component module is improved.
While the novel features of the invention are set forth in the appended claims, the invention will be better understood by reference to the following detailed description, taken in conjunction with the other objects and features of the present application, both in terms of construction and content. Will be understood.

本発明の一実施形態に係る電子部品モジュールの製造工程のうち、コア層の部品搭載面に接合材を配置するまでの工程((A)〜(C))を示す説明図である。It is explanatory drawing which shows the process ((A)-(C)) until it arrange | positions a joining material to the component mounting surface of a core layer among the manufacturing processes of the electronic component module which concerns on one Embodiment of this invention. 本発明の一実施形態に係る電子部品モジュールの製造工程のうち、接合材を介して部品搭載面に電子部品を搭載してからプリプレグを配置するまでの工程((D)〜(F))を示す説明図である。Among the manufacturing steps of the electronic component module according to the embodiment of the present invention, the steps ((D) to (F)) from the mounting of the electronic component on the component mounting surface through the bonding material to the placement of the prepreg are performed. It is explanatory drawing shown. 本発明の一実施形態に係る電子部品モジュールの製造工程のうち、コア層とプリプレグとの積層体から部品内蔵基板を完成させるまでの工程((G)〜(I))を示す説明図である。It is explanatory drawing which shows the process ((G)-(I)) until it completes a component built-in board | substrate from the laminated body of a core layer and a prepreg among the manufacturing processes of the electronic component module which concerns on one Embodiment of this invention. .

まず、電子部品モジュールの構造について説明する。
本発明の製造方法により製造される電子部品モジュールは、金属箔の配線パターンが形成された部品搭載面を有するコア層と、部品搭載面に実装された電子部品と、電子部品を封止する樹脂層とを具備する。なかでも部品内蔵基板と称される電子部品モジュールは、ベースとなるコア層を中心に、複数の配線パターン(金属箔)を積層した構造を有する。隣り合う配線パターンの間には、プリプレグを熱硬化させた硬化物の樹脂層が配置されている。樹脂層は、互いに隣接する配線パターン同士を貼り合わせる機能を有する。コア層の配線パターンには、チップ部品などの電子部品が実装されているので、樹脂層は電子部品を封止する機能も有する。電子部品の端子と配線パターンのランドとの接続には、はんだを用いることが一般的である。従って、電子部品モジュールの製造の際には、電子部品を配線パターンに実装するための加熱や、配線パターン同士を貼り合わせるための加熱が繰り返される。
First, the structure of the electronic component module will be described.
An electronic component module manufactured by the manufacturing method of the present invention includes a core layer having a component mounting surface on which a metal foil wiring pattern is formed, an electronic component mounted on the component mounting surface, and a resin that seals the electronic component A layer. In particular, an electronic component module called a component-embedded substrate has a structure in which a plurality of wiring patterns (metal foils) are stacked around a core layer serving as a base. Between the adjacent wiring patterns, a cured resin layer obtained by thermally curing the prepreg is disposed. The resin layer has a function of bonding wiring patterns adjacent to each other. Since an electronic component such as a chip component is mounted on the wiring pattern of the core layer, the resin layer also has a function of sealing the electronic component. In general, solder is used for connection between the terminal of the electronic component and the land of the wiring pattern. Therefore, when manufacturing the electronic component module, heating for mounting the electronic component on the wiring pattern and heating for bonding the wiring patterns together are repeated.

コア層は、薄型の樹脂基板を有し、その一方または両方の面に配線パターン(第1配線パターン)が形成されている。配線パターンの形状は様々であり、電子部品の端子と接続される部分はランドと称される。このようなコア層は、樹脂基板に銅箔などの金属箔を貼り合わせた後、金属箔にパターニングを施すことにより形成される。   The core layer has a thin resin substrate, and a wiring pattern (first wiring pattern) is formed on one or both surfaces thereof. The shape of the wiring pattern varies, and the portion connected to the terminal of the electronic component is called a land. Such a core layer is formed by attaching a metal foil such as a copper foil to a resin substrate and then patterning the metal foil.

次に、本発明の電子部品モジュールの製造方法について説明する。
その製造方法は、(a)電子部品接続用のランドを含む第1配線パターンが形成された部品搭載面を有するコア層を準備する工程と、(b)前記第1配線パターンの表面を粗化する工程と、(c)前記粗化後の前記第1配線パターンの少なくとも前記ランドを覆う部分に、熱硬化性樹脂と前記熱硬化性樹脂に分散させたはんだ粒子とを含む接合材を配置する工程と、(d)端子を有する電子部品を準備し、前記端子を、前記接合材を介して前記ランドに着地させて、前記電子部品を前記部品搭載面に搭載する工程と、(e)前記電子部品を搭載した前記コア層を第1加熱して、前記はんだにより前記端子を前記ランドに接合するとともに、前記熱硬化性樹脂を半硬化させる工程と、(f)前記部品搭載面に実装された前記電子部品がプリプレグで囲われるように、前記コア層に前記プリプレグを積層する工程と、(g)減圧雰囲気中で、前記コア層と前記プリプレグとの積層体を、積層方向に加圧するとともに、第2加熱することにより、前記プリプレグの硬化物により前記電子部品を封止するとともに、前記熱硬化性樹脂の硬化を更に進行させる工程と、を含む。
Next, the manufacturing method of the electronic component module of this invention is demonstrated.
The manufacturing method includes: (a) preparing a core layer having a component mounting surface on which a first wiring pattern including lands for connecting electronic components is formed; and (b) roughening the surface of the first wiring pattern. And (c) a bonding material including a thermosetting resin and solder particles dispersed in the thermosetting resin is disposed on at least a portion covering the land of the first wiring pattern after the roughening. (D) preparing an electronic component having a terminal, landing the terminal on the land via the bonding material, and mounting the electronic component on the component mounting surface; A step of first heating the core layer on which the electronic component is mounted, joining the terminal to the land with the solder, and semi-curing the thermosetting resin; and (f) mounted on the component mounting surface. The electronic component A step of laminating the prepreg on the core layer so as to be surrounded by, and (g) pressurizing the laminated body of the core layer and the prepreg in a laminating direction in a reduced pressure atmosphere and second heating. The step of sealing the electronic component with the cured product of the prepreg and further curing of the thermosetting resin is included.

なお、前記積層体を加圧するとともに第2加熱する前に、プリプレグを介してコア層と対向するように、銅箔などの金属箔を配置してもよい。この場合、第2加熱の後、配線パターン間を接続するビアの形成(h)や、金属箔のパターニング(i)を行うことで、第2配線パターンを形成することができる。同様の操作を繰り返すことで、複数の配線パターンが積層された実装密度の高い部品内蔵基板を得ることができる。   In addition, before pressurizing the said laminated body and carrying out 2nd heating, you may arrange | position metal foil, such as copper foil, so that a core layer may be opposed via a prepreg. In this case, after the second heating, the second wiring pattern can be formed by forming vias for connecting the wiring patterns (h) or patterning (i) the metal foil. By repeating the same operation, it is possible to obtain a component-embedded substrate having a high mounting density in which a plurality of wiring patterns are stacked.

以下、図面を参照しながら、各工程について詳細に説明する。
図1〜3は、本発明の一実施形態に係る電子部品モジュールの製造方法の工程を示す説明図である。
Hereafter, each process is demonstrated in detail, referring drawings.
1-3 is explanatory drawing which shows the process of the manufacturing method of the electronic component module which concerns on one Embodiment of this invention.

まず、電子部品接続用のランドを含む第1配線パターンが形成された部品搭載面を有するコア層(ベース配線層)を準備する(工程(a))。
図1(A)において、コア層1は、絶縁性の樹脂基板2と、樹脂基板2の上面2aに配置された第1配線パターン3と、樹脂基板2の下面2bに配置された配線パターン4とで構成されている。各配線パターンは、銅箔などの金属箔もしくは金属薄膜によって形成されている。コア層1の上面は、部品搭載面となっており、第1配線パターン3の一部は、電子部品の端子を接続するためのランド3aとなっている。ランド3aには、例えば、抵抗、コンデンサなど、両端に接続用端子が形成されたチップ型の小型電子部品や、下面に接続用端子となる金属バンプが形成された半導体を含む電子部品が実装される。
First, a core layer (base wiring layer) having a component mounting surface on which a first wiring pattern including lands for connecting electronic components is formed is prepared (step (a)).
In FIG. 1A, the core layer 1 includes an insulating resin substrate 2, a first wiring pattern 3 disposed on the upper surface 2a of the resin substrate 2, and a wiring pattern 4 disposed on the lower surface 2b of the resin substrate 2. It consists of and. Each wiring pattern is formed of a metal foil such as a copper foil or a metal thin film. The upper surface of the core layer 1 is a component mounting surface, and a part of the first wiring pattern 3 is a land 3a for connecting terminals of electronic components. On the land 3a, for example, a chip-type small electronic component in which connection terminals are formed at both ends, such as resistors and capacitors, and an electronic component including a semiconductor in which metal bumps to be connection terminals are formed on the lower surface are mounted. The

なお、配線パターン3、4には、実際に配線回路としての機能を有する部分以外に、パターニングの後にコア層1の表面に残置され、配線回路としての機能を有さない部分も含まれる。   Note that the wiring patterns 3 and 4 include not only a part that actually functions as a wiring circuit but also a part that remains on the surface of the core layer 1 after patterning and does not have a function as a wiring circuit.

次に、配線パターン3、4の表面の粗化が行われる(工程(b))。
粗化処理は、後の工程で、プリプレグと各配線パターンとの密着性を向上させるために行われる。粗化処理により、各配線パターンの表面に微細な凹凸が形成され、プリプレグに含まれる熱硬化性樹脂と配線パターンとの密着性が向上する。粗化処理の方法は、特に限定されないが、金属表面を化学的に浸食する作用を有する処理液(強酸性溶液や強アルカリ性溶液)にコア層を浸漬することで行うことができる。処理液により粗化された配線パターンの表面3b、4bは、黒色またはこれに近い色彩に変化することから、粗化処理は黒化処理とも称される(図1(B)参照)。なお、粗化処理の方法としては、処理液を用いる湿式の黒化処理の外に、プラズマ処理などを行ってもよい。
Next, the surface of the wiring patterns 3 and 4 is roughened (step (b)).
The roughening treatment is performed in a later step in order to improve the adhesion between the prepreg and each wiring pattern. By the roughening treatment, fine irregularities are formed on the surface of each wiring pattern, and the adhesion between the thermosetting resin contained in the prepreg and the wiring pattern is improved. The method of the roughening treatment is not particularly limited, but can be performed by immersing the core layer in a treatment solution (strongly acidic solution or strongly alkaline solution) having an action of chemically eroding the metal surface. Since the surfaces 3b and 4b of the wiring pattern roughened by the treatment liquid change to black or a color close thereto, the roughening treatment is also referred to as blackening treatment (see FIG. 1B). Note that as a roughening treatment method, plasma treatment or the like may be performed in addition to the wet blackening treatment using a treatment liquid.

このように、コア層1に電子部品が実装されていない状態で、配線パターンの粗化処理を行うことにより、コア層1に電子部品を実装した後に粗化処理を実施する場合に発生する不具合を回避することができる。すなわち、電子部品の端子と配線パターンのランドとの接合部(はんだ接合部)の表面が処理液により浸食されることを回避できる。よって、はんだ接合部におけるマイクロクラックなどの欠陥が起りにくくなる。   As described above, a problem occurs when the roughening process is performed after the electronic component is mounted on the core layer 1 by performing the roughening process of the wiring pattern in a state where the electronic component is not mounted on the core layer 1. Can be avoided. That is, it is possible to avoid the surface of the joint (solder joint) between the terminal of the electronic component and the land of the wiring pattern from being eroded by the processing liquid. Therefore, defects such as microcracks in the solder joint are less likely to occur.

次に、図1(C)に示すように、粗化後の配線パターンの少なくともランド3aを覆う部分に、熱硬化性樹脂と熱硬化性樹脂に分散させたはんだ粒子とを含む接合材を配置する(工程(c))。
接合材6をコア層1の表面に配置する方法としては、スクリーン印刷法、ディスペンサによる塗布する方法、予めフィルム状に成形された接合材を部品搭載面に貼り付ける方法などを挙げることができる。ただし、接合材6を配置する部位の形状や範囲に応じて、各種の方法を選択することができる。
Next, as shown in FIG. 1C, a bonding material including a thermosetting resin and solder particles dispersed in the thermosetting resin is disposed on at least a portion covering the land 3a of the roughened wiring pattern. (Step (c)).
Examples of the method of arranging the bonding material 6 on the surface of the core layer 1 include a screen printing method, a method of applying with a dispenser, and a method of pasting a bonding material previously formed into a film shape onto a component mounting surface. However, various methods can be selected according to the shape and range of the part where the bonding material 6 is disposed.

接合材6は、少なくともランド3aを覆う部分に配置されるが、ランド3aの表面のみならず、第1配線パターン3が全体的に覆われるように配置してもよい。例えば、樹脂基板2の上面において第1配線パターン3が形成された全範囲に接合材6を配置してもよい。この場合、フィルム状に成形された接合材6を部品搭載面に貼り付ける方法が便利である。   The bonding material 6 is disposed at least in a portion covering the land 3a. However, the bonding material 6 may be disposed so that not only the surface of the land 3a but also the first wiring pattern 3 is entirely covered. For example, the bonding material 6 may be disposed over the entire area where the first wiring pattern 3 is formed on the upper surface of the resin substrate 2. In this case, a method of sticking the bonding material 6 formed in a film shape to the component mounting surface is convenient.

熱硬化性樹脂と熱硬化性樹脂に分散させたはんだ粒子とを含む接合材6としては、いわゆる熱硬化性のクリームはんだを用いることができる。接合材6に含まれる熱硬化性樹脂は、はんだ粒子の表面の酸化膜を除去する活性作用を有する成分を含むことが望ましい。このような活性作用を有する成分としては、例えば有機酸、ハロゲン化水素酸塩などのように、フラックスに用いられる成分が挙げられる。熱硬化性樹脂の主成分としては、エポキシ樹脂、アクリレート樹脂、ポリイミド、ポリウレタン、フェノール樹脂、不飽和ポリエステル樹脂などが用いられる。熱硬化性樹脂は、硬化剤、硬化促進剤などを含んでもよい。硬化剤としては、酸無水物、脂肪族または芳香族アミン、イミダゾールまたはその誘導体などが好ましく用いられ、硬化促進剤としては、ジシアンジアミドなどを例示できる。熱硬化性樹脂の組成は、電子部品をコア層1に実装した後に半硬化状態になるように、はんだ接合の際の第1加熱の温度や、第1加熱の時間に応じて設計される。   As the bonding material 6 including the thermosetting resin and the solder particles dispersed in the thermosetting resin, a so-called thermosetting cream solder can be used. The thermosetting resin contained in the bonding material 6 preferably includes a component having an active action of removing the oxide film on the surface of the solder particles. Examples of the component having such an active action include components used for flux such as organic acids and hydrohalides. As the main component of the thermosetting resin, epoxy resin, acrylate resin, polyimide, polyurethane, phenol resin, unsaturated polyester resin, or the like is used. The thermosetting resin may contain a curing agent, a curing accelerator, and the like. As the curing agent, an acid anhydride, an aliphatic or aromatic amine, imidazole or a derivative thereof is preferably used, and examples of the curing accelerator include dicyandiamide. The composition of the thermosetting resin is designed according to the temperature of the first heating at the time of soldering and the time of the first heating so as to be in a semi-cured state after mounting the electronic component on the core layer 1.

はんだ粒子としては、特に限定されないが、後で行うプリプレグをコア層1に貼り合わせるための加熱工程において、溶融しない組成を有することが好ましい。例えば、Sn−Ag−Cu合金のように融点220℃程度のはんだを用いることができる。ただし、これに限られず、例えば、Sn−Bi合金のような低融点のはんだを用いることもできる。   Although it does not specifically limit as a solder particle, In the heating process for bonding the prepreg performed later to the core layer 1, it is preferable to have a composition which does not melt. For example, a solder having a melting point of about 220 ° C. can be used like an Sn—Ag—Cu alloy. However, the present invention is not limited thereto, and for example, a low melting point solder such as a Sn—Bi alloy can be used.

次に、端子7aを有する電子部品7を準備し、図2(D)に示すように、端子7aを、接合材6を介してランド3aに着地させて、電子部品7を部品搭載面に搭載する(工程(d))。図2(D)では、電子部品7としてチップ部品を搭載しているが、これに限定されない。   Next, an electronic component 7 having a terminal 7a is prepared. As shown in FIG. 2D, the terminal 7a is landed on the land 3a through the bonding material 6, and the electronic component 7 is mounted on the component mounting surface. (Step (d)). In FIG. 2D, a chip component is mounted as the electronic component 7, but the present invention is not limited to this.

電子部品7の搭載には、様々な電子部品搭載装置を用いることができる。一般的に、電子部品搭載装置は、吸引ノズルを備えた搭載ヘッドを有し、搭載ヘッドは3次元方向に自在に移動可能となっている。電子部品7は、テープフィーダなどにより、電子部品搭載装置の部品供給部に供給される。部品供給部では、搭載ヘッドが電子部品7をピックアップし、コア層1の部品搭載面の上方に移動させる。そして、電子部品7の端子7bと、第1配線パターン3のランド3aとの位置合わせが自動的に行われる。引き続き、端子7bが、接合材6を介してランド3aに着地するように、電子部品7の搭載が行われる。   Various electronic component mounting apparatuses can be used for mounting the electronic component 7. Generally, an electronic component mounting apparatus has a mounting head provided with a suction nozzle, and the mounting head can freely move in a three-dimensional direction. The electronic component 7 is supplied to the component supply unit of the electronic component mounting apparatus by a tape feeder or the like. In the component supply unit, the mounting head picks up the electronic component 7 and moves it above the component mounting surface of the core layer 1. Then, the alignment between the terminal 7b of the electronic component 7 and the land 3a of the first wiring pattern 3 is automatically performed. Subsequently, the electronic component 7 is mounted so that the terminal 7b is landed on the land 3a via the bonding material 6.

これにより、電子部品7は、粘着性の接合材6を介してベース配線層1によって保持される。このとき、図2(D)に示すように、コア層1の上面と電子部品7の下面との間には、隙間17が形成されていてもよい。   Thereby, the electronic component 7 is held by the base wiring layer 1 via the adhesive bonding material 6. At this time, as shown in FIG. 2D, a gap 17 may be formed between the upper surface of the core layer 1 and the lower surface of the electronic component 7.

次に、電子部品7を搭載したコア層1を加熱(第1加熱)して、接合材6に含まれているはんだにより、電子部品7の端子7aをランド3aに接合する。その際、接合材6に含まれる熱硬化性樹脂は、半硬化の状態になるまで硬化させる(工程(d))。   Next, the core layer 1 on which the electronic component 7 is mounted is heated (first heating), and the terminal 7a of the electronic component 7 is bonded to the land 3a by solder contained in the bonding material 6. At that time, the thermosetting resin contained in the bonding material 6 is cured until it becomes a semi-cured state (step (d)).

第1加熱では、接合材6に含まれているはんだ粒子をリフローさせる必要があり、はんだの融点よりも高い温度で加熱する必要がある。第1加熱により、はんだ粒子は溶融し、熱硬化性樹脂の粘度は低下する。溶融はんだは、粘度の低下した熱硬化性樹脂中を流動して、電子部品7の端子7aとランド3aとの間に移動し、端子7aとランド3aの表面に濡れ広がる。その後、冷却すると、はんだが固化し、図2(E)に示すように、電子部品7の端子7aと配線パターン3のランド3aとの間に、フィレット状のはんだ接合部6xが形成される。一方、熱硬化性樹脂は、半硬化状態となって、電子部品7とコア層1との間の隙間に充填され、その一部は、はんだ接合部6xを覆って、樹脂補強部6yを形成する。樹脂補強部6yは、はんだ接合部6xを保護するとともに、はんだ接合部6xによる電子部品7のコア層1への接合を補強する役割を果たす。   In the first heating, it is necessary to reflow the solder particles contained in the bonding material 6 and it is necessary to heat at a temperature higher than the melting point of the solder. By the first heating, the solder particles are melted and the viscosity of the thermosetting resin is lowered. The molten solder flows in the thermosetting resin having a reduced viscosity, moves between the terminal 7a of the electronic component 7 and the land 3a, and spreads wet on the surfaces of the terminal 7a and the land 3a. Thereafter, when cooled, the solder is solidified, and a fillet-like solder joint 6x is formed between the terminal 7a of the electronic component 7 and the land 3a of the wiring pattern 3 as shown in FIG. On the other hand, the thermosetting resin is in a semi-cured state and is filled in the gap between the electronic component 7 and the core layer 1, and a part thereof covers the solder joint portion 6 x to form the resin reinforcing portion 6 y. To do. The resin reinforcing portion 6y serves to protect the solder joint portion 6x and reinforce the joining of the electronic component 7 to the core layer 1 by the solder joint portion 6x.

熱硬化性樹脂の硬化反応は徐々に進行するが、はんだの溶融と固化は迅速に進行するため、はんだ接合部6xが形成された段階で、熱硬化性樹脂を半硬化の状態にすることは容易である。ここで、半硬化の状態とは、例えば、熱硬化性樹脂の硬化反応率が10〜70%である状態をいう。硬化反応率は、示差走査熱量計(DSC)によって、第1加熱に供する前の熱硬化性樹脂と、第1加熱後に常温まで冷却された半硬化状態の熱硬化性樹脂の熱量をそれぞれ測定することにより、以下の手法で求めることができる。   Although the curing reaction of the thermosetting resin progresses gradually, the melting and solidification of the solder proceeds rapidly, so that when the solder joint 6x is formed, the thermosetting resin cannot be brought into a semi-cured state. Easy. Here, the semi-cured state refers to, for example, a state in which the curing reaction rate of the thermosetting resin is 10 to 70%. The curing reaction rate is measured by a differential scanning calorimeter (DSC) for the heat amounts of the thermosetting resin before the first heating and the semi-cured thermosetting resin cooled to room temperature after the first heating. Therefore, it can be obtained by the following method.

第1加熱に供する前の熱硬化性樹脂の熱量をQ1、第1加熱後の半硬化状態の熱硬化性樹脂の熱量をQ2とするとき、Q1とQ2との差(Q1−Q2)は、反応済みの硬化反応の熱量に対応している。よって、この差を熱量Q1で除した比率R(R=(Q1−Q2)/Q1)を百分率で示した値が硬化反応率となる。熱硬化性樹脂の硬化反応がほとんど進行していない場合には、Q1とQ2とはほぼ等しくなるため、硬化反応率は0%となる。一方、硬化反応が完全に進行した後では、Q2は0となることから、硬化反応率は100%となる。熱硬化性樹脂の硬化反応の進行度合いは、熱硬化性樹脂に配合されている硬化剤の種類や量、加熱条件のプロファイルなどに依存する。   When the heat quantity of the thermosetting resin before being subjected to the first heating is Q1, and the heat quantity of the thermosetting resin in the semi-cured state after the first heating is Q2, the difference between Q1 and Q2 (Q1-Q2) is Corresponds to the amount of heat of the cured curing reaction. Therefore, a value indicating the ratio R (R = (Q1-Q2) / Q1) obtained by dividing this difference by the heat quantity Q1 is a curing reaction rate. When the curing reaction of the thermosetting resin has hardly progressed, Q1 and Q2 are substantially equal, and the curing reaction rate is 0%. On the other hand, after the curing reaction has completely progressed, Q2 becomes 0, so that the curing reaction rate becomes 100%. The degree of progress of the curing reaction of the thermosetting resin depends on the type and amount of the curing agent blended in the thermosetting resin, the heating condition profile, and the like.

半硬化状態の熱硬化性樹脂は、冷却前には溶融状態または柔軟性を有する状態であっても、常温まで冷却すると、流動性を有さない固形物になり、樹脂補強部6yとして機能する。よって、第1加熱の前に、コア層1の上面と電子部品7の下面との間に隙間17が形成されていると、その隙間17が原因となって、樹脂補強部6yに囲まれた状態のボイド8が形成されやすい。ただし、このようなボイド8は、後の工程において、外部に放出される。   Even if the semi-cured thermosetting resin is in a molten state or a flexible state before cooling, it becomes a solid having no fluidity when cooled to room temperature, and functions as a resin reinforcing portion 6y. . Therefore, if the gap 17 is formed between the upper surface of the core layer 1 and the lower surface of the electronic component 7 before the first heating, the gap 17 causes the gap to be surrounded by the resin reinforcing portion 6y. The void 8 in the state is easily formed. However, such a void 8 is discharged to the outside in a later process.

樹脂補強部6yが形成されることにより、電子部品7をコア層1に保持するはんだ接合部6xが保護され、はんだ接合部6xによる電子部品7の保持力が補強される。また、後の工程で、樹脂補強部6yが溶融してプリプレグと混和し、一体化されるため、電子部品7およびはんだ接合部6xのより確実な封止が可能となる。すなわち、樹脂補強部6yは、最終的には、電子部品7とコア層1との間を封止する役割を果たす。   By forming the resin reinforcing portion 6y, the solder joint portion 6x that holds the electronic component 7 on the core layer 1 is protected, and the holding force of the electronic component 7 by the solder joint portion 6x is reinforced. Further, since the resin reinforcing portion 6y is melted and mixed with the prepreg and integrated in the subsequent process, the electronic component 7 and the solder joint portion 6x can be more reliably sealed. In other words, the resin reinforcing portion 6y finally serves to seal between the electronic component 7 and the core layer 1.

次に、図2(F)に示すように、部品搭載面に実装された電子部品7が囲われるように、コア層1にプリプレグ9を積層する(工程(f))。   Next, as shown in FIG. 2F, a prepreg 9 is laminated on the core layer 1 so as to surround the electronic component 7 mounted on the component mounting surface (step (f)).

プリプレグ9を積層配置する際には、できるだけ電子部品7とプリプレグ9との間に隙間が生じないように配置することが望ましい。また、プリプレグ9は、電子部品7のみならず、第1配線パターン3が全体的に封止されるように配置することが望ましい。   When the prepregs 9 are stacked and arranged, it is desirable that the prepregs 9 be arranged so that no gap is generated between the electronic component 7 and the prepreg 9 as much as possible. The prepreg 9 is desirably arranged so that not only the electronic component 7 but also the first wiring pattern 3 is entirely sealed.

図2(F)では、樹脂基板2の上面および電子部品7に密着するように、かつ電子部品7を囲むように、電子部品7に対応する開口部9aを有するプリプレグ9が配置されている。更に、コア層1を両面から挟み込むように、一対のプリプレグ10a、10bが配置され、プリプレグ10a、10bのコア層1の側とは反対側の面には、金属箔11a、11bがそれぞれ貼り付けられている。このような構成とすることで、コア層1の両面を完全にプリプレグに由来する樹脂層で封止することができる。また、後の工程において、各金属箔11には、それぞれ所望の配線パターンを形成することができる。   In FIG. 2F, a prepreg 9 having an opening 9a corresponding to the electronic component 7 is disposed so as to be in close contact with the upper surface of the resin substrate 2 and the electronic component 7 and to surround the electronic component 7. Further, a pair of prepregs 10a and 10b are arranged so as to sandwich the core layer 1 from both sides, and metal foils 11a and 11b are respectively attached to the surfaces of the prepregs 10a and 10b opposite to the core layer 1 side. It has been. By setting it as such a structure, both surfaces of the core layer 1 can be completely sealed with the resin layer derived from a prepreg. In a later step, a desired wiring pattern can be formed on each metal foil 11.

次に、減圧雰囲気中で、コア層1とプリプレグ9、10a、10bとの積層体を、積層方向に加圧するとともに、加熱(第2加熱)する。これにより、プリプレグ9、10aにより、電子部品7が封止され、かつ接合材6に由来する半硬化状態の樹脂補強部6yの硬化が更に進行する(工程(g))。減圧雰囲気の圧力は、例えば13.3kPa(100Torr)以下であればよい。   Next, the laminated body of the core layer 1 and the prepregs 9, 10a, and 10b is pressurized in the laminating direction and heated (second heating) in a reduced pressure atmosphere. Thereby, the electronic component 7 is sealed by the prepregs 9 and 10a, and the curing of the semi-cured resin reinforcing portion 6y derived from the bonding material 6 further proceeds (step (g)). The pressure of the reduced pressure atmosphere may be, for example, 13.3 kPa (100 Torr) or less.

積層体の加熱は、一般的なプレス装置により、例えば30kgf/cm2程度の圧力で行えばよい。このとき、第2加熱の温度は、プリプレグに含まれている熱硬化性樹脂の硬化反応と、樹脂補強部6yの硬化反応が進行する温度であればよい。ただし、はんだ接合部6xにズレが生じないように、はんだの溶融温度未満に設定することが好ましい。例えば、はんだの融点が220℃程度である場合、第2加熱の温度は、150〜200℃程度とすることができる。The laminated body may be heated with a general press device at a pressure of about 30 kgf / cm 2 , for example. At this time, the temperature of the second heating may be a temperature at which the curing reaction of the thermosetting resin contained in the prepreg and the curing reaction of the resin reinforcing portion 6y proceed. However, it is preferable to set the temperature below the melting temperature of the solder so that the solder joint 6x is not displaced. For example, when the melting point of the solder is about 220 ° C., the temperature of the second heating can be about 150 to 200 ° C.

第2加熱により、図3(G)に示すように、プリプレグ9、10aに含まれる熱硬化性樹脂および樹脂補強部6yを構成する熱硬化性樹脂が軟化し、これらの接触界面が相互に融着して一体化し、部品内蔵基板14が形成される。このとき、第1配線パターン3および電子部品7は、隣接するプリプレグと密着する。そして、プリプレグ9、10aに含まれる熱硬化性樹脂と、樹脂補強部6yを構成する熱硬化性樹脂の硬化反応が進行し、樹脂層12が形成される。図3(G)では、樹脂補強部6yに由来する樹脂層部分とプリプレグに由来する樹脂層部分との界面を破線で示している。
同様に、コア層1の下面の配線パターン4と隣接するプリプレグ10bは、配線パターン4と密着した樹脂層13を形成する。
As shown in FIG. 3G, the second heating softens the thermosetting resin included in the prepregs 9 and 10a and the thermosetting resin constituting the resin reinforcing portion 6y, so that the contact interfaces melt together. The parts-embedded substrate 14 is formed by wearing and integrating. At this time, the first wiring pattern 3 and the electronic component 7 are in close contact with the adjacent prepreg. Then, the curing reaction of the thermosetting resin included in the prepregs 9 and 10a and the thermosetting resin constituting the resin reinforcing portion 6y proceeds, and the resin layer 12 is formed. In FIG. 3G, the interface between the resin layer portion derived from the resin reinforcing portion 6y and the resin layer portion derived from the prepreg is indicated by a broken line.
Similarly, the prepreg 10 b adjacent to the wiring pattern 4 on the lower surface of the core layer 1 forms a resin layer 13 in close contact with the wiring pattern 4.

配線パターン3、4の表面には、粗化処理により微細な凹凸が形成されていることから、配線パターン3、4と樹脂層12との良好な密着性が達成される。また、電子部品7とコア層1との間において、樹脂補強部6yに囲まれた状態のボイド8が存在する場合には、積層方向に印加される圧力と、減圧雰囲気の効果により、ボイド8が外部に押し出される。従って、ボイドに由来する接合不良等を防止することができる。   Since fine irregularities are formed on the surfaces of the wiring patterns 3 and 4 by the roughening treatment, good adhesion between the wiring patterns 3 and 4 and the resin layer 12 is achieved. Further, when there is a void 8 surrounded by the resin reinforcing portion 6y between the electronic component 7 and the core layer 1, the void 8 is caused by the pressure applied in the stacking direction and the effect of the reduced-pressure atmosphere. Is pushed out. Accordingly, it is possible to prevent a bonding failure or the like derived from voids.

すなわち、工程(g)では、プリプレグ9、10a、10bにより配線パターン3、4および電子部品7を封止するだけでなく、半硬化状態の樹脂補強部6yを流動させて、はんだ接合部付近のボイドを除去することができる。これにより、より良好な状態の封止を実現することができる。そして、半硬化状態の樹脂補強部6yの硬化と、プリプレグ9、10a、10bに含まれる熱硬化性樹脂の硬化とを、同じ工程で行うことから、アフターキュアを省くことが可能になり、電子部品モジュールの生産性も高められている。   That is, in the step (g), not only the wiring patterns 3, 4 and the electronic component 7 are sealed with the prepregs 9, 10 a, 10 b, but also the semi-cured resin reinforcing portion 6 y is flowed to Voids can be removed. Thereby, the sealing of a more favorable state is realizable. And since the curing of the semi-cured resin reinforcing portion 6y and the curing of the thermosetting resin contained in the prepregs 9, 10a, and 10b are performed in the same process, it becomes possible to omit after-cure, The productivity of component modules is also increased.

次に、図3(H)に示すように、得られた部品内蔵基板14に、これを厚さ方向に貫通するビアホールを形成し、ホールの内面にメッキ層15を形成する。これにより、コア層1の第1配線パターン3と、基板14の両面にそれぞれ配置されている金属箔11a、11bとを接続する層間配線が形成される。   Next, as shown in FIG. 3H, via holes are formed in the obtained component-embedded substrate 14 in the thickness direction, and a plated layer 15 is formed on the inner surface of the holes. Thereby, the interlayer wiring which connects the 1st wiring pattern 3 of the core layer 1 and the metal foil 11a, 11b arrange | positioned at both surfaces of the board | substrate 14, respectively is formed.

ビアホールの形成には、例えば、コンフォーマル工法を用いることができる。まず、フォトリソグラフィ等により、ビアホール形成部の表面に存在する金属箔のみをエッチングにより除去する。次に、金属箔が除去された箇所に、レーザを照射すると、残存している周囲の金属箔がコンフォーマルマスクとなり、金属箔が除去された箇所にビアホールを形成することができる。レーザ加工には、炭酸ガスレーザ、YAGレーザ等を用いることができる。   For example, a conformal method can be used for forming the via hole. First, only the metal foil present on the surface of the via hole forming portion is removed by etching by photolithography or the like. Next, when the portion where the metal foil is removed is irradiated with a laser, the remaining surrounding metal foil becomes a conformal mask, and a via hole can be formed in the portion where the metal foil is removed. For the laser processing, a carbon dioxide laser, a YAG laser, or the like can be used.

次に、レーザ加工ではスミア(樹脂の残渣)が発生するため、ビアホール内のデスミア処理を行う。デスミア処理の薬品としては、例えば、酸化剤水溶液等を用いることができる。具体的には、過マンガン酸カリウムや過マンガン酸ナトリウムのアルカリ水溶液、クロム酸や重クロム酸ナトリウムの硫酸水溶液等を用いることができる。これらの薬品で処理する前に、アルカリ膨潤液を用いてビアホール内の前処理を行っても良い。   Next, since smear (resin residue) is generated in laser processing, desmear processing in the via hole is performed. As the chemical for desmear treatment, for example, an oxidizing agent aqueous solution or the like can be used. Specifically, an alkaline aqueous solution of potassium permanganate or sodium permanganate, an aqueous sulfuric acid solution of chromic acid or sodium dichromate, or the like can be used. Prior to treatment with these chemicals, pretreatment in the via hole may be performed using an alkali swelling liquid.

デスミア処理後、所定の中和液で中和した後、デスミアしたビアホールの内面にメッキ層15を形成し、導通処理を施す。このとき、蒸着、スパッタリング、イオンプレーティング等の乾式工法による処理を施してもよいが、無電解メッキ、電解メッキ等の湿式工法による処理が、量産性等も考慮すると好ましい。   After the desmear process, after neutralizing with a predetermined neutralizing solution, a plating layer 15 is formed on the inner surface of the desmeared via hole, and a conduction process is performed. At this time, treatment by a dry method such as vapor deposition, sputtering, or ion plating may be performed, but treatment by a wet method such as electroless plating or electrolytic plating is preferable in consideration of mass productivity.

その後、図3(I)に示すように、一方の金属箔11aにパターニングを施すことにより、第2の配線パターンが形成される。当然、他方の金属箔11bにもパターニングを施してもよく、その場合は第3の配線パターンが形成される。このように形成された第2および第3の配線パターンは、さらに電子部品を実装するための対象となる。同様の操作を更に繰り返すことで、より多くの配線パターンが積層された実装密度の高い電子部品モジュールを得ることができる。   Thereafter, as shown in FIG. 3I, the second wiring pattern is formed by patterning one of the metal foils 11a. Naturally, the other metal foil 11b may be patterned, and in this case, a third wiring pattern is formed. The second and third wiring patterns formed in this way are further targets for mounting electronic components. By repeating the same operation further, an electronic component module having a high mounting density in which more wiring patterns are stacked can be obtained.

本発明は、金属箔の配線パターンが形成された部品搭載面を有するコア層と、部品搭載面に実装された電子部品と、電子部品を封止する樹脂層とを具備する電子部品モジュール、なかでも複数の配線パターンを積層した部品内蔵基板の製造分野において有用である。
本発明を現時点での好ましい実施態様に関して説明したが、そのような開示を限定的に解釈してはならない。種々の変形および改変は、上記開示を読むことによって本発明に属する技術分野における当業者には間違いなく明らかになるであろう。したがって、添付の請求の範囲は、本発明の真の精神および範囲から逸脱することなく、すべての変形および改変を包含する、と解釈されるべきものである。
The present invention relates to an electronic component module comprising a core layer having a component mounting surface on which a metal foil wiring pattern is formed, an electronic component mounted on the component mounting surface, and a resin layer for sealing the electronic component. However, it is useful in the field of manufacturing a component built-in board in which a plurality of wiring patterns are laminated.
While this invention has been described in terms of the presently preferred embodiments, such disclosure should not be construed as limiting. Various changes and modifications will no doubt become apparent to those skilled in the art to which the present invention pertains after reading the above disclosure. Accordingly, the appended claims should be construed to include all variations and modifications without departing from the true spirit and scope of this invention.

Claims (6)

電子部品接続用のランドを含む第1配線パターンが形成された部品搭載面を有するコア層を準備する工程と、
前記第1配線パターンの表面を粗化する工程と、
前記粗化後の前記第1配線パターンの少なくとも前記ランドを覆う部分に、熱硬化性樹脂と前記熱硬化性樹脂に分散させたはんだ粒子とを含む接合材を配置する工程と、
端子を有する電子部品を準備し、前記端子を、前記接合材を介して前記ランドに着地させて、前記電子部品を前記部品搭載面に搭載する工程と、
前記電子部品を搭載した前記コア層を第1加熱して、前記はんだにより前記端子を前記ランドに接合するとともに、前記熱硬化性樹脂を半硬化させる工程と、
前記部品搭載面に実装された前記電子部品がプリプレグで囲われるように、前記コア層に前記プリプレグを積層する工程と、
減圧雰囲気中で、前記コア層と前記プリプレグとの積層体を、積層方向に加圧するとともに、第2加熱することにより、前記プリプレグの硬化物により前記電子部品を封止するとともに、前記熱硬化性樹脂の硬化を更に進行させる工程と、を含む、電子部品モジュールの製造方法。
Preparing a core layer having a component mounting surface on which a first wiring pattern including lands for connecting electronic components is formed;
Roughening the surface of the first wiring pattern;
Disposing a bonding material including a thermosetting resin and solder particles dispersed in the thermosetting resin on at least a portion covering the land of the first wiring pattern after the roughening;
Preparing an electronic component having a terminal, landing the terminal on the land via the bonding material, and mounting the electronic component on the component mounting surface;
First heating the core layer on which the electronic component is mounted, joining the terminal to the land with the solder, and semi-curing the thermosetting resin;
Laminating the prepreg on the core layer so that the electronic component mounted on the component mounting surface is surrounded by the prepreg;
In a reduced pressure atmosphere, the laminate of the core layer and the prepreg is pressurized in the laminating direction and second heated to seal the electronic component with a cured product of the prepreg and the thermosetting A step of further curing the resin, and a method for producing an electronic component module.
前記第1加熱による前記熱硬化性樹脂の硬化反応率が、10〜70%である、請求項1記載の電子部品モジュールの製造方法。   The method for manufacturing an electronic component module according to claim 1, wherein a curing reaction rate of the thermosetting resin by the first heating is 10 to 70%. 前記第2加熱の温度が、前記はんだの溶融温度未満である、請求項1または2記載の電子部品モジュールの製造方法。   3. The method of manufacturing an electronic component module according to claim 1, wherein a temperature of the second heating is lower than a melting temperature of the solder. 前記接合材を、少なくとも前記第1配線パターンの全体が覆われるように、前記部品搭載面に配置する、請求項1〜3のいずれか1項に記載の電子部品モジュールの製造方法。   4. The method of manufacturing an electronic component module according to claim 1, wherein the bonding material is arranged on the component mounting surface so that at least the entire first wiring pattern is covered. 5. 前記プリプレグを介して、前記コア層と対向するように、金属箔を配置してから、前記積層体を積層方向に加圧するとともに、第2加熱する、請求項1〜4のいずれか1項に記載の電子部品モジュールの製造方法。   The metal foil is disposed so as to face the core layer via the prepreg, and then the laminated body is pressurized in the laminating direction and secondly heated. The manufacturing method of the electronic component module of description. 前記プリプレグの硬化物により前記電子部品を封止した後、前記金属箔のパターニングを行い、第2配線パターンを形成する、請求項1〜5のいずれか1項に記載の電子部品モジュールの製造方法。   The method for manufacturing an electronic component module according to claim 1, wherein after sealing the electronic component with a cured product of the prepreg, the metal foil is patterned to form a second wiring pattern. .
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Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2006324621A (en) * 2005-09-08 2006-11-30 Matsushita Electric Ind Co Ltd Substrate incorporating component and its manufacturing method
JP2009141246A (en) * 2007-12-10 2009-06-25 Panasonic Corp Method of manufacturing printed circuit board incorporating components
JP2009200376A (en) * 2008-02-25 2009-09-03 Panasonic Corp Method for manufacturing electronic component module

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2006324621A (en) * 2005-09-08 2006-11-30 Matsushita Electric Ind Co Ltd Substrate incorporating component and its manufacturing method
JP2009141246A (en) * 2007-12-10 2009-06-25 Panasonic Corp Method of manufacturing printed circuit board incorporating components
JP2009200376A (en) * 2008-02-25 2009-09-03 Panasonic Corp Method for manufacturing electronic component module

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