JPS643988U - - Google Patents
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- Publication number
- JPS643988U JPS643988U JP9762087U JP9762087U JPS643988U JP S643988 U JPS643988 U JP S643988U JP 9762087 U JP9762087 U JP 9762087U JP 9762087 U JP9762087 U JP 9762087U JP S643988 U JPS643988 U JP S643988U
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- JP
- Japan
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- predetermined time
- memory area
- storage means
- aggregated data
- timer means
- Prior art date
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- Pending
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- 230000004931 aggregating effect Effects 0.000 claims 1
- 230000002776 aggregation Effects 0.000 claims 1
- 238000004220 aggregation Methods 0.000 claims 1
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- 230000007704 transition Effects 0.000 description 1
Landscapes
- Debugging And Monitoring (AREA)
Description
第１図は本考案の機能ブロツク図、第２図は一
実施例のＥＣＲの回路ブロツク図、第３図は本実
施例のＥＣＲに用いられるＲＡＭの構成図、第４
図は本実施例のＥＣＲの回路動作を示すフローチ
ヤート、第５図は従来のＥＣＲ内のＲＡＭの構成
図である。 １…記憶手段、２…移行制御手段、３…タイマ
手段。
実施例のＥＣＲの回路ブロツク図、第３図は本実
施例のＥＣＲに用いられるＲＡＭの構成図、第４
図は本実施例のＥＣＲの回路動作を示すフローチ
ヤート、第５図は従来のＥＣＲ内のＲＡＭの構成
図である。 １…記憶手段、２…移行制御手段、３…タイマ
手段。
Claims (1)
- 入力されたデータを分類別に集計した集計デー
タを記憶する複数のメモリ領域を有する記憶手段
と、所定時間が設定されているタイマ手段と、該
タイマ手段が所定時間を計数すると前記記憶手段
内の１つのメモリ領域に記憶されている集計デー
タを前記記憶手段内の他のメモリ領域へ移行させ
る移行制御手段とを有することを特徴とするデー
タ集計装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9762087U JPS643988U (ja) | 1987-06-25 | 1987-06-25 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9762087U JPS643988U (ja) | 1987-06-25 | 1987-06-25 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS643988U true JPS643988U (ja) | 1989-01-11 |
Family
ID=31323207
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9762087U Pending JPS643988U (ja) | 1987-06-25 | 1987-06-25 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS643988U (ja) |
-
1987
- 1987-06-25 JP JP9762087U patent/JPS643988U/ja active Pending
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