JPS642448Y2 - - Google Patents
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- JPS642448Y2 JPS642448Y2 JP1391283U JP1391283U JPS642448Y2 JP S642448 Y2 JPS642448 Y2 JP S642448Y2 JP 1391283 U JP1391283 U JP 1391283U JP 1391283 U JP1391283 U JP 1391283U JP S642448 Y2 JPS642448 Y2 JP S642448Y2
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Description
【考案の詳細な説明】
この考案は複数の特性インピーダンスの電源負
荷に対して低VSWR特性を呈すモノシツクトラ
ンジスタ増幅器に関するものである。[Detailed Description of the Invention] This invention relates to a monosic transistor amplifier that exhibits low VSWR characteristics for power loads with a plurality of characteristic impedances.
ゲート電極とドレイン電極との間に抵抗および
直流阻止用コンデンサからなる負帰還回路をもつ
従来のモノシツクFET増幅器を一例として説明
する。 A conventional monosic FET amplifier having a negative feedback circuit consisting of a resistor and a DC blocking capacitor between a gate electrode and a drain electrode will be explained as an example.
第1図は、従来の帰還回路をもつモノシツク
FET増幅器の構造図である。第1図において1
はGaAsまたはsiなどの半導体の基板、2はFET
のソース電極、3はFETのゲート電極、4は
FETのドレイン電極、5は薄膜コンデンサを形
成する誘導体、6は抵抗体、7は金属膜である。 Figure 1 shows a monolith with a conventional feedback circuit.
FIG. 2 is a structural diagram of a FET amplifier. In Figure 1, 1
is a semiconductor substrate such as GaAs or Si, 2 is a FET
3 is the gate electrode of FET, 4 is the source electrode of
The drain electrode of the FET, 5 is a dielectric forming a thin film capacitor, 6 is a resistor, and 7 is a metal film.
第2図は第1図の等価回路図である。 FIG. 2 is an equivalent circuit diagram of FIG. 1.
図中、Rfは抵抗体6の抵抗値、RsはFETのソ
ース抵抗.gmはFETの相互コンダクタンス、Cf
は5による薄膜コンデンサの容量、Cgsはゲート
ソース間容量、Vgsはゲートソース間容量端に印
加される電圧であり、記号G、S、Dを付した端
子はそれぞれ第1図の2,3,4の電極に対応し
ている。Cfが大きく、Cgsが小さくて無視できる
場合には増幅器のSパラメータS11,S22は次式で
与えられる。 In the figure, Rf is the resistance value of resistor 6, and Rs is the FET source resistance. gm is the FET transconductance, Cf
is the capacitance of the thin film capacitor according to 5, Cgs is the gate-source capacitance, and Vgs is the voltage applied to the gate-source capacitance terminal. Compatible with 4 electrodes. When Cf is large and Cgs is small and can be ignored, the S parameters S 11 and S 22 of the amplifier are given by the following equations.
S11=S22=Rf(1+gmRs)−gmZo2/(Rf+2Zo)(1
+gmRs)+gmZo2(1)
ここでZoは入出力ポートの特性インピータン
スである。 S 11 = S 22 = Rf (1 + gmRs) - gmZo 2 / (Rf + 2Zo) (1
+gmRs) +gmZo 2 (1) Here, Zo is the characteristic impedance of the input/output port.
(1)式よりS11=S22=0となるRfが存在すること
が分る。 From equation (1), it can be seen that Rf exists such that S 11 =S 22 =0.
このようにドレイン電極とゲート電極との間に
上述のS11=S22=0となるような抵抗値の抵抗体
を挿入すると広帯域に入出力VSWR特性の良好
な増幅器がえられる。 In this way, by inserting a resistor having a resistance value such that S 11 =S 22 =0 as described above is inserted between the drain electrode and the gate electrode, an amplifier with good broadband input/output VSWR characteristics can be obtained.
広帯域特性をうるのに最適な抵抗値Rfは(1)式
に示すとおり、入出力ポートの特性インピーダン
スの関数であり、異なる特性インピーダンスに合
わせるには異なる値のRfが必要となる。 As shown in equation (1), the optimal resistance value Rf to obtain broadband characteristics is a function of the characteristic impedance of the input/output port, and different values of Rf are required to match different characteristic impedances.
しかしながら従来のゲート電極とドレイン電極
との間に抵抗および直流阻止用コンデンサからな
る負帰還回路をもつ従来のモノリシツク増幅器で
はある特定の特性インピーダンスに対してのみ入
出力VSWR特性を良好とすることができるが、
これと異なる特性インピーダンスに対しては新ら
たに抵抗値の異なる抵抗体をもつたモノシツク増
幅器を製作しなければならないという欠点があつ
た。 However, with conventional monolithic amplifiers that have a negative feedback circuit consisting of a resistor and a DC blocking capacitor between the gate electrode and drain electrode, it is possible to achieve good input/output VSWR characteristics only for a certain characteristic impedance. but,
For characteristic impedances different from this, there was a drawback in that a new monosonic amplifier having a resistor with a different resistance value had to be manufactured.
この考案はこのような従来の欠点を除去するた
め帰還回路の抵抗体の両端子に接続する金属膜間
の基板上に空間を介して金属膜(以下エアブリツ
ジと呼ぶ)を設け、必要に応じエアブリツジを切
断することにより複数の特性インピーダンスに対
し低VSWR特性を呈すモノシツク増幅器を得る
ようにしたもので以下図面について詳細に説明す
る。 In order to eliminate these conventional drawbacks, this invention provides a metal film (hereinafter referred to as an air bridge) on the substrate with a space between the metal films connected to both terminals of the resistor of the feedback circuit, and connects the air bridge as necessary. By disconnecting the amplifier, a monosonic amplifier exhibiting low VSWR characteristics for a plurality of characteristic impedances is obtained.The drawings will be described in detail below.
第3図はこの考案によるモノリシツクトランジ
スタ増幅器の一実施例の構造図である。第3図に
おいて8は抵抗体a、9は抵抗体b、10はエア
ブリツジである。 FIG. 3 is a structural diagram of one embodiment of a monolithic transistor amplifier according to this invention. In FIG. 3, 8 is a resistor a, 9 is a resistor b, and 10 is an air bridge.
第4図は第3図の等価回路図である。抵抗Rfa
は抵抗体a8の抵抗、抵抗Rfbは抵抗体b,9の
抵抗である。エアブリツジ10は抵抗体b,9の
両端を短絡している。 FIG. 4 is an equivalent circuit diagram of FIG. 3. Resistance Rfa
is the resistance of resistor a8, and resistance Rfb is the resistance of resistors b and 9. The air bridge 10 short-circuits both ends of the resistors b and 9.
金属膜7とドレイン電極4との間の抵抗Rfは
エアブリツジが抵抗体b,9の両端を短絡してい
る状態ではRaに等しい。エアブリツジを機械的
に切断した場合には金属膜7とドレイン電極との
間の抵抗RfはRa+Rbに等しくなる。 The resistance Rf between the metal film 7 and the drain electrode 4 is equal to Ra when the air bridge short-circuits both ends of the resistors b and 9. When the air bridge is mechanically cut, the resistance Rf between the metal film 7 and the drain electrode becomes equal to Ra+Rb.
したがつて、前述の(1)式に従つて異なるZoに
対して低VSWRがえられるように抵抗Ra、Rbを
設定しておけば必要に応じてエアブリツジの切断
をするだけで、入出力ポートの特性インピーダン
スZoを選択することができる。 Therefore, if the resistors Ra and Rb are set so that low VSWR can be obtained for different Zo according to equation (1) above, the input/output ports can be easily connected by simply disconnecting the air bridge as necessary. The characteristic impedance Zo can be selected.
なお、以上は一つの抵抗体に一つのエアブリツ
ジを付加した場合について説明したが、この考案
はこれに限らず複数の抵抗体に一つのエアブリツ
ジを付加する場合あるいは一つの抵抗体に対して
複数のエアブリツジを付加する場合に使用しても
よい。 Note that the above description has been made for the case where one air bridge is added to one resistor, but this invention is not limited to this, and can be applied to cases where one air bridge is added to multiple resistors, or when multiple air bridges are added to one resistor. May be used when adding an air bridge.
この考案に係るモノリシツクトランジスタ増幅
器では、帰還回路の抵抗体の両端子に接続する金
属膜間の基板上に空間を介して金属膜を設け、必
要に応じてこの金属膜を切断することにより複数
の特性インピーダンスに対し低VSWR特性が得
られる利点がある。 In the monolithic transistor amplifier according to this invention, a metal film is provided on the substrate with a space between the metal films connected to both terminals of the resistor of the feedback circuit, and by cutting this metal film as necessary, multiple The advantage is that low VSWR characteristics can be obtained compared to the characteristic impedance of .
第1図は従来の帰還回路をもつモノリシツク
FET増幅器の構造図、第2図は第1図の等価回
路図、第3図はこの考案によるモノリシツクトラ
ンジスタ増幅器の一実施例の構造図、第4図は第
3図に示すものの等価回路図である。
図中、1はGaAsまたはSiなどの半導体の基
板、2はFETのソース電極、3はFETのゲート
電極、4はFETのドレイン電極、5は薄膜コン
デンサを形成する誘電体、6は抵抗体、7は金属
膜、8は抵抗体a、9は抵抗体b、10はエアブ
リツジである。なお、図中、同一あるいは相当部
分には同一符号を付して示してある。
Figure 1 shows a monolithic circuit with a conventional feedback circuit.
A structural diagram of a FET amplifier, Fig. 2 is an equivalent circuit diagram of Fig. 1, Fig. 3 is a structural diagram of an embodiment of a monolithic transistor amplifier according to this invention, and Fig. 4 is an equivalent circuit diagram of the one shown in Fig. 3. It is. In the figure, 1 is a semiconductor substrate such as GaAs or Si, 2 is a source electrode of FET, 3 is a gate electrode of FET, 4 is a drain electrode of FET, 5 is a dielectric forming a thin film capacitor, 6 is a resistor, 7 is a metal film, 8 is a resistor a, 9 is a resistor b, and 10 is an air bridge. In the drawings, the same or corresponding parts are denoted by the same reference numerals.
Claims (1)
器において、基板上に形成した抵抗体の一端に接
続する金属膜と、上記の抵抗体の他端に接続する
金属膜との間の基板上に空間を介して電気導体で
ある金属膜を設けたことを特徴とするモノリシツ
クトランジスタ増幅器。 In a monolithic transistor amplifier having a resistor, electricity is transmitted through a space on the substrate between a metal film connected to one end of the resistor formed on the substrate and a metal film connected to the other end of the resistor. A monolithic transistor amplifier characterized by having a metal film that is a conductor.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1391283U JPS59121851U (en) | 1983-02-02 | 1983-02-02 | monolithic transistor amplifier |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1391283U JPS59121851U (en) | 1983-02-02 | 1983-02-02 | monolithic transistor amplifier |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS59121851U JPS59121851U (en) | 1984-08-16 |
JPS642448Y2 true JPS642448Y2 (en) | 1989-01-20 |
Family
ID=30145286
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1391283U Granted JPS59121851U (en) | 1983-02-02 | 1983-02-02 | monolithic transistor amplifier |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS59121851U (en) |
-
1983
- 1983-02-02 JP JP1391283U patent/JPS59121851U/en active Granted
Also Published As
Publication number | Publication date |
---|---|
JPS59121851U (en) | 1984-08-16 |
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