JPS6377205A - 送信電力制御回路 - Google Patents
送信電力制御回路Info
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- JPS6377205A JPS6377205A JP22093786A JP22093786A JPS6377205A JP S6377205 A JPS6377205 A JP S6377205A JP 22093786 A JP22093786 A JP 22093786A JP 22093786 A JP22093786 A JP 22093786A JP S6377205 A JPS6377205 A JP S6377205A
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- 238000003199 nucleic acid amplification method Methods 0.000 claims description 5
- 238000004891 communication Methods 0.000 description 10
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- 238000010586 diagram Methods 0.000 description 4
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- Control Of Amplification And Gain Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔概 要〕
衛星通信地球局内の送信用電力増幅部における送信電力
レベル制御を、衛星通信地球局の遠隔に設けられた基準
設定装置から、遠隔かつ正確に行なわせるものである。
レベル制御を、衛星通信地球局の遠隔に設けられた基準
設定装置から、遠隔かつ正確に行なわせるものである。
特に、断続する送信信号などの種類に応じて、有効信号
についてのみ送信電力レベル制御を行うものである。
についてのみ送信電力レベル制御を行うものである。
本発明は衛星通信地球局内の送信電力を制御する装置に
関する。
関する。
衛星通信地球局においては、大きな利得で高周波入力信
号を増幅し、送信電力を高精度に制御することが要望さ
れている。衛星通信地球局内の電力増幅器は高利得であ
るから、温度変動、経時変動に従う利得の自動制御が必
須となっている。
号を増幅し、送信電力を高精度に制御することが要望さ
れている。衛星通信地球局内の電力増幅器は高利得であ
るから、温度変動、経時変動に従う利得の自動制御が必
須となっている。
また送信電力のレベルを任意に設定することが要求され
ている。
ている。
第4図に上述の自動レベル制御(A L C>機能を有
する従来の送信電力制御回路を示す。送信すべき高周波
入力信号SINが一旦、可変増幅器1で増幅され、電力
増幅器2により再度増幅されて高周波出力信号S。u7
として出力される。電力増幅器2の出力信号S。LIT
はカプラ3を介して検出され検波器4により検波され、
検波信号Vdが演算増幅器71の入力端子に印加される
。一方、抵抗器77を介して基準電圧■7も演算増幅器
71の反転入力端子に印加される。演算増幅器71はコ
ンパレータとして動作し、(Va Va)に対応する
信号を可変増幅器1に印加する。これにより、電力増幅
器2の出力信号S。utの出力レベルが基準電圧vlで
設定された値になるように制御される。
する従来の送信電力制御回路を示す。送信すべき高周波
入力信号SINが一旦、可変増幅器1で増幅され、電力
増幅器2により再度増幅されて高周波出力信号S。u7
として出力される。電力増幅器2の出力信号S。LIT
はカプラ3を介して検出され検波器4により検波され、
検波信号Vdが演算増幅器71の入力端子に印加される
。一方、抵抗器77を介して基準電圧■7も演算増幅器
71の反転入力端子に印加される。演算増幅器71はコ
ンパレータとして動作し、(Va Va)に対応する
信号を可変増幅器1に印加する。これにより、電力増幅
器2の出力信号S。utの出力レベルが基準電圧vlで
設定された値になるように制御される。
すなわち、電力増幅器2に利得の変動が生じたとしても
第4図に図示の制御回路全体からの出力信号S。utは
所望のレベルに設定される。また可変抵抗器77を調節
し所望の基準電圧v8を演算増幅器71に印加すること
で、出力信号S。U7の出力レベルも調節することがで
きる。
第4図に図示の制御回路全体からの出力信号S。utは
所望のレベルに設定される。また可変抵抗器77を調節
し所望の基準電圧v8を演算増幅器71に印加すること
で、出力信号S。U7の出力レベルも調節することがで
きる。
第4図に図示の送信電力制御回路が収容されている衛星
通信地球局と基準レベルを設定する者が居る場所とは数
100メートル以上も離れている。
通信地球局と基準レベルを設定する者が居る場所とは数
100メートル以上も離れている。
従って、基準レベル設定のためには、衛星通信地球局ま
で出向き、抵抗器77を調整しなければならない、この
ため遠隔操作が望まれている。しかしながら、抵抗器7
7を単に遠隔したとすれば、電圧ドロップ、ノイズ等の
問題が生ずるので実現できない。
で出向き、抵抗器77を調整しなければならない、この
ため遠隔操作が望まれている。しかしながら、抵抗器7
7を単に遠隔したとすれば、電圧ドロップ、ノイズ等の
問題が生ずるので実現できない。
次に、第4図の如く可変抵抗器77を介してアナログ的
に処理を行っているのでは、演算増幅器71自体のドリ
フト等も含めた精度的な問題が生ずる。
に処理を行っているのでは、演算増幅器71自体のドリ
フト等も含めた精度的な問題が生ずる。
さらに、第4図の回路は連続的な送信出力信号5our
をフィードバックすることを前提としている。ループフ
ィルタの時定数は、キャパシタ76と抵抗器75とのC
Rで定まる。また検波器4は尖頭値保持形のものであり
、送信信号の最大振幅時にダイオードの比較的低い順方
向インピーダンスを経由してキャパシタ76に電荷を貯
え、送信信号の依存しない間は比較的大きな抵抗値を持
つ抵抗器75を経由しキャパシタ76に貯えられている
電荷を放電するように動作する。
をフィードバックすることを前提としている。ループフ
ィルタの時定数は、キャパシタ76と抵抗器75とのC
Rで定まる。また検波器4は尖頭値保持形のものであり
、送信信号の最大振幅時にダイオードの比較的低い順方
向インピーダンスを経由してキャパシタ76に電荷を貯
え、送信信号の依存しない間は比較的大きな抵抗値を持
つ抵抗器75を経由しキャパシタ76に貯えられている
電荷を放電するように動作する。
一方送倍信号の波形は通信方式により異なり、5CPC
(Single Channel Per Carri
er )のような固定回線接続における連続波のみなら
ず、TDMA通信方式の場合は周期的バースト波、パケ
ット通信方式の場合は孤立的バースト波となる。特に孤
立的バースト波の場合、信号断時間が不定のためキャパ
シタ76に貯えられている電荷が時間の経過により放電
され、出力制御ができなくなるという問題が生じる。例
えば、信号が長期間存在せずキャパシタの電荷かはパ零
の場合、演算増幅器71からの偏差信号は非常に大きく
なる。その結果、可変増幅器1の利得が非常に大きくな
る。高周波入力信号が存在しない場合は実害はないが、
そのような高利得状態である場合に高周波入力信号5l
)lが印加されると、その出力信号S。Uアのレベルは
非常に高くなってしまうという問題が生じる。
(Single Channel Per Carri
er )のような固定回線接続における連続波のみなら
ず、TDMA通信方式の場合は周期的バースト波、パケ
ット通信方式の場合は孤立的バースト波となる。特に孤
立的バースト波の場合、信号断時間が不定のためキャパ
シタ76に貯えられている電荷が時間の経過により放電
され、出力制御ができなくなるという問題が生じる。例
えば、信号が長期間存在せずキャパシタの電荷かはパ零
の場合、演算増幅器71からの偏差信号は非常に大きく
なる。その結果、可変増幅器1の利得が非常に大きくな
る。高周波入力信号が存在しない場合は実害はないが、
そのような高利得状態である場合に高周波入力信号5l
)lが印加されると、その出力信号S。Uアのレベルは
非常に高くなってしまうという問題が生じる。
従って上述の問題を解決する送信電力制御回路が要望さ
れている。
れている。
〔問題を解決するための手段、および、作用〕本発明の
送信電力制御回路の原理ブロック図を第1図に示す。
送信電力制御回路の原理ブロック図を第1図に示す。
同図において、信号増幅手段として可変増幅器1および
電力増幅器2が設けられ、検出手段としてカブラ3およ
び検波器4が設けられている。これらの機能および動作
は第4図を参照して述べた従来のものと同様である。本
発明の送信電力制御回路は、基準設定手段としての基準
設定装置5、および、利得制御手段としての利得制御回
路6を備えている。
電力増幅器2が設けられ、検出手段としてカブラ3およ
び検波器4が設けられている。これらの機能および動作
は第4図を参照して述べた従来のものと同様である。本
発明の送信電力制御回路は、基準設定手段としての基準
設定装置5、および、利得制御手段としての利得制御回
路6を備えている。
基準設定装置5と利得制御回路6とは相当離れていても
よ(、これらの間がディジタルで信号授受が行なわれる
。これら信号授受のうち本発明に係るものは、ディジタ
ルの基準設定値S RtFである。
よ(、これらの間がディジタルで信号授受が行なわれる
。これら信号授受のうち本発明に係るものは、ディジタ
ルの基準設定値S RtFである。
利得制御回路6は検波器4からの出力信号S。LITの
尖頭値SAを入力しディジタル量に変換する。
尖頭値SAを入力しディジタル量に変換する。
このディジタル変換値S^、と基準設定値S REFと
を比較し、S、l!r>SAdの場合はその差S Rl
F−8A4に対応した正のアナログ電圧を、逆の場合は
負のアナログ電圧を利得制御信号SGCとして可変増幅
器lに出力する。可変増幅器1は利得制御信号SGcに
応じて高周波入力信号SINの利得を制御し電力増幅器
2に印加する。
を比較し、S、l!r>SAdの場合はその差S Rl
F−8A4に対応した正のアナログ電圧を、逆の場合は
負のアナログ電圧を利得制御信号SGCとして可変増幅
器lに出力する。可変増幅器1は利得制御信号SGcに
応じて高周波入力信号SINの利得を制御し電力増幅器
2に印加する。
以下同様にフィードバック制御が行なわれる。
フィードバック系のサンプル周期は、高周波入力信号が
連続波の場合は比較的短かく、周期的バースト波の場合
はその周期により定める。
連続波の場合は比較的短かく、周期的バースト波の場合
はその周期により定める。
孤立的バースト波に対しては、利得制御回路6に検波器
4からの出力信号のしきい値を検出する回路と付加し、
出力信号がしきい値以上の有効な場合のみ上述の制御動
作を行なわせるようにする。
4からの出力信号のしきい値を検出する回路と付加し、
出力信号がしきい値以上の有効な場合のみ上述の制御動
作を行なわせるようにする。
しきい値検出回路は、周期的バースト波はもとより連続
波に対して適用してもよい。
波に対して適用してもよい。
第2図に第1図回路の第1実施例を示す。
同図において、利得制御回路6が、A/D変換器61、
マグニチュードコンパレータ62、アップ・ダウン・カ
ウンタ63、クロック発生器64およびD/A変換器6
5で構成されている。
マグニチュードコンパレータ62、アップ・ダウン・カ
ウンタ63、クロック発生器64およびD/A変換器6
5で構成されている。
出力信号S。LIT検波した信号SAがA/D変換され
、ディジタルのデータSa4としてマグニチュードコン
パレータ62に印加される。マグニチュードコンパレー
タ62には基準設定装置5から基準値S IIEFが印
加されており、マグニチュードコンパレータ62におい
て誤差E RR= S ++ty −5Aaが計算され
る。マグニチュードコンパレータ62は、ERRが正の
場合はERRの大きさに相当するインクリメンタルパル
スUPを、ERRが負の場合はERRの絶対値に相当す
るデクリメンタルパルスDWNを出力する。アップ・ダ
ウン・カウンタ63はインクリメンタルパルスUP又は
デクリメンタルパルスDWNを入力し、クロック発生器
64からのクロック信号CLKに基づいて、これらのパ
ルスを計数する。アンプ・ダウン・カウンタ63で計数
された誤差ERRに相当するカウント値が、D/A変換
器65において誤差ERRの正負に応じた符号を持った
アナログの利得制御信号SGCに変換され、可変増幅器
I印加される。
、ディジタルのデータSa4としてマグニチュードコン
パレータ62に印加される。マグニチュードコンパレー
タ62には基準設定装置5から基準値S IIEFが印
加されており、マグニチュードコンパレータ62におい
て誤差E RR= S ++ty −5Aaが計算され
る。マグニチュードコンパレータ62は、ERRが正の
場合はERRの大きさに相当するインクリメンタルパル
スUPを、ERRが負の場合はERRの絶対値に相当す
るデクリメンタルパルスDWNを出力する。アップ・ダ
ウン・カウンタ63はインクリメンタルパルスUP又は
デクリメンタルパルスDWNを入力し、クロック発生器
64からのクロック信号CLKに基づいて、これらのパ
ルスを計数する。アンプ・ダウン・カウンタ63で計数
された誤差ERRに相当するカウント値が、D/A変換
器65において誤差ERRの正負に応じた符号を持った
アナログの利得制御信号SGCに変換され、可変増幅器
I印加される。
可変増幅器1はこのようにして算出された利得制御信号
SGC基いて初段の利得制御を行う。以下は、従来と同
様である。
SGC基いて初段の利得制御を行う。以下は、従来と同
様である。
アップ・ダウン・カウンタ63は、マグニチュードコン
パレータ62の動作開始と共にリセットされ、一定時間
の間上述のインクリメント又はデクリメントパルスを計
数する。アップ・ダウン・カウンタ63のカウント終了
に応じて上記D/A変換器65が変換動作を行う。
パレータ62の動作開始と共にリセットされ、一定時間
の間上述のインクリメント又はデクリメントパルスを計
数する。アップ・ダウン・カウンタ63のカウント終了
に応じて上記D/A変換器65が変換動作を行う。
以上の如く構成することにより、先ず、基準設定装置5
と当該送信電力制御回路間が遠隔であっても高信頼度且
つ正確に、基準値設定動作が行える0次いで、フィード
バック制御動作の誤差信号算出部がディジタルで高精度
に行うことができる。
と当該送信電力制御回路間が遠隔であっても高信頼度且
つ正確に、基準値設定動作が行える0次いで、フィード
バック制御動作の誤差信号算出部がディジタルで高精度
に行うことができる。
すなわち演算増幅器を用いた場合における如きドリフト
等の問題が生じない。
等の問題が生じない。
なお、第2図においては出力検出信号の尖頭値の瞬時値
をA/D変換器61に用いてA/D変換したものを用い
ているが、A/D変化器61とマグニチュードコンパレ
ータ62との間に平均算出回路(図示せず)を設け、複
数の連続する尖頭値について平均をとり、この平均値に
ついて上述の誤差計算を行うことができる。これにより
、誤差ERR’!出の精度を上げることが可能となる。
をA/D変換器61に用いてA/D変換したものを用い
ているが、A/D変化器61とマグニチュードコンパレ
ータ62との間に平均算出回路(図示せず)を設け、複
数の連続する尖頭値について平均をとり、この平均値に
ついて上述の誤差計算を行うことができる。これにより
、誤差ERR’!出の精度を上げることが可能となる。
第3図に第2実施例回路を示す。
第3図回路は、第2図回路に対し、マグニチュードコン
パレータ62と並列に、且つ、A/D変換器61とアッ
プ・ダウン・カウンタ63との間にしきい値検出回路6
6を設けたものである。しきい値検出回路66はA/D
変換された出力検出信号SAdの振幅が所定の有効レベ
ルに達している場合のみ高レベルの有効信号AVLをア
ップ・ダウン・カウンタ63の制御端子に印加し、アッ
プ・ダウン計数を許可する。一方、出力検出信号SA4
の振幅が有効レベルに到達していない場合は有効信号A
VLを低レベルとし、アップ・ダウン・カウンタ63の
計数を禁止させる。
パレータ62と並列に、且つ、A/D変換器61とアッ
プ・ダウン・カウンタ63との間にしきい値検出回路6
6を設けたものである。しきい値検出回路66はA/D
変換された出力検出信号SAdの振幅が所定の有効レベ
ルに達している場合のみ高レベルの有効信号AVLをア
ップ・ダウン・カウンタ63の制御端子に印加し、アッ
プ・ダウン計数を許可する。一方、出力検出信号SA4
の振幅が有効レベルに到達していない場合は有効信号A
VLを低レベルとし、アップ・ダウン・カウンタ63の
計数を禁止させる。
これにより、孤立的バースト波に対しては、バースト波
が存在する期間のみ上述の制御動作を行うことになり、
バースト波が存在しない期間は制御動作を行なわない。
が存在する期間のみ上述の制御動作を行うことになり、
バースト波が存在しない期間は制御動作を行なわない。
これにより、従来の如く存在しない信号に基いて、誤動
作を生じさせるような制御動作が防止できる。
作を生じさせるような制御動作が防止できる。
しきい値検出回路66は周期的バースト波に対しても、
バースト波が存在する期間のみ制御を行うという効果が
得られる外、従来のように、周期に応じて充放電特性、
具体的にはキャパシタと抵抗器による時定数回路75.
76が定まるという制限を受けることなく、制御動作を
行なわせることができる。
バースト波が存在する期間のみ制御を行うという効果が
得られる外、従来のように、周期に応じて充放電特性、
具体的にはキャパシタと抵抗器による時定数回路75.
76が定まるという制限を受けることなく、制御動作を
行なわせることができる。
しきい値検出回路66は連続波に対しては常に高レベル
の有効信号AVLを出力するので、しきい値検出回路6
6の付加により悪影響が生じることはない。以上の如く
、しきい値検出回路66を付加することにより、孤立的
バースト波はもとより種々の波の制御に適用可能となる
。
の有効信号AVLを出力するので、しきい値検出回路6
6の付加により悪影響が生じることはない。以上の如く
、しきい値検出回路66を付加することにより、孤立的
バースト波はもとより種々の波の制御に適用可能となる
。
以上はディジタル式のしきい値検出回路66について述
べたが、検波器4の後段とカウンタ63との間に、包絡
線検波回路を有する比較器(図示せず)を設けて、アナ
ログ的に処理しても同様である。包路線検波回路は、例
えば1つのバースト波内の連続する波列の周期以上の検
波特性を持ち、有効信号AVLが瞬断するのを防止させ
る。
べたが、検波器4の後段とカウンタ63との間に、包絡
線検波回路を有する比較器(図示せず)を設けて、アナ
ログ的に処理しても同様である。包路線検波回路は、例
えば1つのバースト波内の連続する波列の周期以上の検
波特性を持ち、有効信号AVLが瞬断するのを防止させ
る。
以上に述べたように、本発明によれば基準設定が遠隔的
且つ、高精度に行うことができる。次に、送信電力制御
回路における制御が高精度且つ高信頼度で行うことがで
きる。さらに、真に有効な信号についてのみ制御動作を
行うので、無効な信号に対する誤った制御動作を行うこ
とが防止できる。
且つ、高精度に行うことができる。次に、送信電力制御
回路における制御が高精度且つ高信頼度で行うことがで
きる。さらに、真に有効な信号についてのみ制御動作を
行うので、無効な信号に対する誤った制御動作を行うこ
とが防止できる。
第1図は本発明の送信電力制御回路の原理ブロック図、
第2図および第3図は本発明の実施例の送信電力制御回
路図、 第4図は従来の送信電力制御回路図、である。 (符号の説明) 1・・・可変増幅器、 2・・・電力増幅器、3
・・・カプラ、 4・・・検波器、5・・・
基準設定装置、 6・・・利得制御回路、61・・・
A/D変換器、 62・・・マグニチュードコンパレータ、63・・・ア
ンプ・ダウン・カウンタ、64・・・クロック発生器、 65・・・D/A変換器、 66・・・しきい値検出
回路。
路図、 第4図は従来の送信電力制御回路図、である。 (符号の説明) 1・・・可変増幅器、 2・・・電力増幅器、3
・・・カプラ、 4・・・検波器、5・・・
基準設定装置、 6・・・利得制御回路、61・・・
A/D変換器、 62・・・マグニチュードコンパレータ、63・・・ア
ンプ・ダウン・カウンタ、64・・・クロック発生器、 65・・・D/A変換器、 66・・・しきい値検出
回路。
Claims (1)
- 【特許請求の範囲】 1、高周波入力信号が(S_I_N)が印加され、該高
周波入力信号を所定の利得で増幅すると共に可変利得機
能を有する信号増幅手段(1、2)、該信号増幅手段か
らの出力信号(S_O_U_T)を検出する手段(3、
4)、 該検出手段からの検出に基づき前記信号増幅手段の出力
信号(S_O_U_T)の振幅が所定の値になるよう利
得制御信号を前記信号増幅手段に印加する利得制御手段
(6)、および、 該利得制御手段の遠隔に設けられ、基準値を設定する基
準設定手段(5)、 を具備し、 前記基準手段からの基準値がディジタル信号として前記
利得制御手段に与えられ、前記制御利得手段は前記検出
手段からの検出信号をディジタル量に変換し、該ディジ
タル検出信号と前記ディジタル基準信号との差をアナロ
グ信号に変換し前記利得制御信号として送出するように
したことを特徴とする、送信電力制御回路。 2、前記利得制御手段が、前記検出手段からの検出信号
が有効レベル以上である場合にのみ利得制御信号を送出
するようにした、特許請求の範囲第1項に記載の送信電
力制御回路。 3、前記利得制御手段が、前記検出手段からの検出信号
をディジタル信号に変換するA/D変換器(61)、該
A/D変換器からの出力および前記基準設定手段からの
基準値を受け入れ該基準値と前記A/D変換器の出力と
を比較するコンパレータ(62)、該コンパレータの出
力によりアップダウン制御されるカウンタ(63)、お
よび該カウンタの出力をアナログ信号に変換し前記利得
制御信号として出力するD/A変換器(65)を有する
、特許請求の範囲第1項に記載の送信電力制御回路。 4、前記利得制御手段が、前記検出手段からの検出信号
をディジタル信号に変換するA/D変換器(61)、該
A/D変換器からの出力および前記基準設定手段からの
基準値を受け入れ該基準値と前記A/D変換器の出力の
最大値との差を算出するコンパレータ(62)、該コン
パレータの出力とを比較するカウンタ(63)、前記検
出手段からの検出信号の振幅が有効レベルにあることを
検出するしきい値検出回路(66)、および該カウンタ
の出力をアナログ信号に変換し前記利得制御信号として
出力するD/A変換器(65)、を有し、前記しきい値
検出回路の検出信号が有効レベルを示している場合のみ
前記カウンタを動作させる、特許請求の範囲第2項に記
載の送信電力制御回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP22093786A JPS6377205A (ja) | 1986-09-20 | 1986-09-20 | 送信電力制御回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP22093786A JPS6377205A (ja) | 1986-09-20 | 1986-09-20 | 送信電力制御回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6377205A true JPS6377205A (ja) | 1988-04-07 |
Family
ID=16758894
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP22093786A Pending JPS6377205A (ja) | 1986-09-20 | 1986-09-20 | 送信電力制御回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6377205A (ja) |
Cited By (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0276309A (ja) * | 1988-09-12 | 1990-03-15 | Kokusai Syst Kk | 自動利得制御回路 |
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