JPS635433Y2 - - Google Patents

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JPS635433Y2
JPS635433Y2 JP19160680U JP19160680U JPS635433Y2 JP S635433 Y2 JPS635433 Y2 JP S635433Y2 JP 19160680 U JP19160680 U JP 19160680U JP 19160680 U JP19160680 U JP 19160680U JP S635433 Y2 JPS635433 Y2 JP S635433Y2
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resistor
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Description

【考案の詳細な説明】 本考案は、各種電子回路の電源ラインに生ずる
電源リツプを除去するためのリツプル除去回路の
改良に関するものである。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to an improvement in a ripple removal circuit for removing power ripples occurring in power lines of various electronic circuits.

一般に、各種電子回路では、安定した動作状態
を得るために、電源電圧の直流的なレベル変動に
対しては直流安定化電源によつて電源電圧の安定
化を図り、また、電源ラインに生ずる交流的な電
源リツプに対しては受動素子にて構成したリツプ
ルフイルタや能動素子にて構成したリツプル除去
回路を用いて上記電源リツプを除去している。
In general, in various electronic circuits, in order to obtain a stable operating state, a DC stabilized power supply is used to stabilize the power supply voltage against DC level fluctuations in the power supply voltage. In order to eliminate the power supply rip, a ripple filter made up of passive elements and a ripple removal circuit made up of active elements are used to remove the power supply rip.

従来より、上述の如きリツプル除去回路として
は、例えば第1図に示す如き抵抗14とコンデン
サ15との時定数を利用したものや、第2図に示
す如き誤差増幅器24による負帰還制御ループを
利用したものが広く用いられている。
Conventionally, as the above-mentioned ripple removal circuit, for example, one using a time constant of a resistor 14 and a capacitor 15 as shown in FIG. 1, or a negative feedback control loop using an error amplifier 24 as shown in FIG. 2 has been used. are widely used.

第1図に示した従来のリツプル除去回路10
は、コレクタが入力端子11に接続されエミツタ
が出力端子12に接続されたNPNトランジスタ
13をいわゆるシリーズパスエレメントとして用
い、上記入力端子11と接地との間に直列接続し
た抵抗14とコンデンサ15との接続中点に上記
NPNトランジスタ13のベースを接続して成る。
このような構成の従来のリツプル除去回路10で
は、抵抗14による降下電圧VRとNPNトランジ
スタ13のベースエミツタ間電圧VBE(VBE
0.6V)との和電圧VR+VBE〓0.6Vが該リツプル除
去回路10による電源電圧の降下電圧となり、ま
た、電源リツプルの除去能力が上記抵抗14とコ
ンデンサ15との時定数によつて決つてしまう。
従つて、電源損失を小さくするために抵抗14の
抵抗値を小さくすると、電源リツプの除去能力が
下がつてしまい、低い周波数成分の電源リツプル
まで効率良く除去するためには上記コンデンサ1
5の容量を極めて大きくしなければならないとい
う欠点があつた。
Conventional ripple removal circuit 10 shown in FIG.
uses an NPN transistor 13 whose collector is connected to the input terminal 11 and whose emitter is connected to the output terminal 12 as a so-called series pass element, and a resistor 14 and a capacitor 15 connected in series between the input terminal 11 and ground Connect midpoint above
It is formed by connecting the base of an NPN transistor 13.
In the conventional ripple removal circuit 10 having such a configuration, the voltage drop V R due to the resistor 14 and the base-emitter voltage V BE (V BE
The sum voltage V R +V BE 〓0.6V is the voltage drop of the power supply voltage by the ripple removal circuit 10, and the power supply ripple removal ability is determined by the time constant of the resistor 14 and capacitor 15. I get tired.
Therefore, if the resistance value of the resistor 14 is made small in order to reduce power loss, the ability to remove power supply ripples will decrease, and in order to efficiently remove power supply ripples of low frequency components, it is necessary to use the capacitor 14.
The disadvantage was that the capacity of 5 had to be extremely large.

また、第2図に示した従来のリツプル除去回路
20はエミツタが入力端子21に接続されコレク
タが出力端子22に接続されたPNPトランジス
タ23をシリーズパスエレメントとして用い、出
力端子12側における電源リツプル成分を誤差増
幅器24にて増幅して上記PNPトランジスタ2
3のベースに帰還する構成となつている。このよ
うな構成のリツプル除去回路20では、シリーズ
パスエレメントとしてのPNPトランジスタ23
の動作状態が誤差増幅器24を介して帰還制御さ
れているので、上記PNPトランジスタ30のコ
レクタ・エミツタ間電圧VCEが該リツプル除去回
路20による降下電圧となり電源損失が少ないの
であるが、誤差増幅器24を必要とするので構成
が複雑であるとともに、上記コレクタエミツタ間
電圧VCEの設定が極めて難しいという欠点があ
る。
Further, the conventional ripple removal circuit 20 shown in FIG. 2 uses a PNP transistor 23 whose emitter is connected to the input terminal 21 and whose collector is connected to the output terminal 22 as a series pass element, and the power supply ripple component on the output terminal 12 side is is amplified by the error amplifier 24 and the above PNP transistor 2
It is structured to return to the base of 3. In the ripple removal circuit 20 having such a configuration, a PNP transistor 23 as a series pass element is used.
Since the operating state of the error amplifier 24 is feedback-controlled via the error amplifier 24, the collector-emitter voltage VCE of the PNP transistor 30 becomes a drop voltage due to the ripple removal circuit 20, resulting in less power loss. The structure is complicated, and it is also extremely difficult to set the collector-emitter voltage VCE .

一般に、リツプル除去回路は、直流安定電源に
より安定化された電源ラインにおける電源リツプ
の除去に用いられるので、該リツプル除去回路に
よる電源損失が大きいと、予じめ電源電圧を高く
設定しておかなければ各種の電子回路を駆動でき
なくなつてしまうので、上記電源損失をなるべく
少なくする必要がある。
Generally, a ripple removal circuit is used to remove power supply ripples in a power supply line stabilized by a stable DC power supply, so if the power loss caused by the ripple removal circuit is large, the power supply voltage must be set high in advance. In this case, it becomes impossible to drive various electronic circuits, so it is necessary to reduce the power loss as much as possible.

そこで、本考案は上述の如き各従来例の問題点
に鑑み、電源損失が小さく容量値の小さなコンデ
ンサにて能率良く電源リツプルの除去を行なうこ
とができる新規な構成のリツプル除去回路を提供
するものである。
Therefore, in view of the problems of the conventional examples as described above, the present invention provides a ripple removal circuit with a new configuration that can efficiently remove power supply ripples by using a capacitor with small power loss and small capacitance. It is.

以下、本考案について一実施例を示す図面に従
い詳細に説明する。
Hereinafter, the present invention will be described in detail with reference to the drawings showing one embodiment.

本考案に係るリツプル除去回路は、第3図に原
理的な回路構成を示すように、エミツタが入力端
子31に接続されコレクタが出力端子32に接続
された第1のトランジスタ33と、該第1のトラ
ンジスタ33と等しい導電構造を有しエミツタが
上記出力端子32に接続された第2のトランジス
タ34とを備え、上記第2のトランジスタ34の
コレクタを分流用の抵抗35および直列接続した
時定数用の抵抗36とコンデンサ37を介して接
地するとともに、該第2のトランジスタのベース
を上記コンデンサを介して接地し、上記第1のト
ランジスタ33のベースを上記第2のトランジス
タ34のコレクタに接続して成る。
The ripple removal circuit according to the present invention has a first transistor 33 whose emitter is connected to an input terminal 31 and whose collector is connected to an output terminal 32, as shown in the principle circuit configuration in FIG. a second transistor 34 having a conductive structure equal to that of the transistor 33 and whose emitter is connected to the output terminal 32, and the collector of the second transistor 34 is connected in series with a shunt resistor 35 for a time constant. is grounded via a resistor 36 and a capacitor 37, the base of the second transistor is grounded via the capacitor, and the base of the first transistor 33 is connected to the collector of the second transistor 34. Become.

上記第1のトランジスタ33は、シリーズパス
エレメントとして用いられるもので、第2のトラ
ンジスタ34を介して帰還制御されることによ
り、エミツタ側における電源リツプル成分を抑圧
した出力電圧Voutをコレクタから出力する。ま
た、上記第2のトランジスタ34は、交流的に上
記抵抗36とコンデンサ37とによる時定数をも
つた帰還回路の接続されたコレクタ帰還型の増幅
回路を構成しており、上記時定数により定まる周
波数特性をもつて上記第1のトランジスタ34の
帰還制御を行なう。
The first transistor 33 is used as a series pass element, and is feedback-controlled via the second transistor 34 to output from the collector an output voltage Vout in which the power supply ripple component on the emitter side is suppressed. Further, the second transistor 34 constitutes a collector feedback type amplifier circuit connected to a feedback circuit having a time constant formed by the resistor 36 and the capacitor 37 in an alternating current manner, and has a frequency determined by the time constant. Feedback control of the first transistor 34 is performed using the characteristics.

上述の如き原理的な構成の本考案に係るリツプ
ル除去回路30の作用効果について第4図に示す
具体的な実施例により詳細に説明する。
The effects of the ripple removal circuit 30 according to the present invention having the above-mentioned principle structure will be explained in detail with reference to a specific embodiment shown in FIG.

すなわち、第4図に示したリツプル除去回路3
0は、ともにPNP型の導電構造を有する第1の
トランジスタ33および第2のトランジスタ34
を備え、正の電源電圧+Vinの印加される入力端
子31にシリーズパスエレメントとして上記第1
のトランジスタ33のエミツタが接続され、該第
1のトランジスタ33のコレクタおよび第2のト
ランジスタ34のエミツタが出力端子32に接続
されている。そして、上記第1のトランジスタ3
3のベースは、第1の抵抗41を介して上記入力
端子31に接続されているとともに、第2の抵抗
42を介して上記第2のトランジスタ34のコレ
クタに接続されている。また、上記第2のPNP
トランジスタ34のコレクタは、第3の抵抗35
を介して接地されているとともに、直列接続した
第4の抵抗36とコンデンサ37とを介して接地
されている。さらに、上記第2のトランジスタ3
4のベースは、第5の抵抗43を介して上記第4
の抵抗36とコンデンサ37との接続点に接続さ
れている。
That is, the ripple removal circuit 3 shown in FIG.
0 is a first transistor 33 and a second transistor 34, both of which have a PNP conductive structure.
, and the above-mentioned first
The emitter of the first transistor 33 is connected to the output terminal 32, and the collector of the first transistor 33 and the emitter of the second transistor 34 are connected to the output terminal 32. Then, the first transistor 3
The base of No. 3 is connected to the input terminal 31 via a first resistor 41 and to the collector of the second transistor 34 via a second resistor 42 . In addition, the above second PNP
The collector of the transistor 34 is connected to a third resistor 35.
It is grounded via a fourth resistor 36 and a capacitor 37 connected in series. Furthermore, the second transistor 3
The base of No. 4 is connected to the fourth resistor 43 through the fifth resistor 43.
It is connected to the connection point between the resistor 36 and the capacitor 37.

上述の如き構成の実施例において、第2のトラ
ンジスタ34は、第4の抵抗36を帰還抵抗とす
るコレクタ帰還型の増幅回路を構成しており、直
流的にはコレクタ電圧Vcとベース電位VBとが略
等しい状態で動作する。従つて、第1のトランジ
スタ33におけるベース・コレクタ間電圧VCE1
第2のトランジスタ34におけるベースエミツタ
間電圧VBE2との和は、上記第1のトランジスタ3
3におけるベースエミツタ間電圧VBE1と第2の抵
抗42による降下電圧VDrとの和に略等しく、 VCE1+VBE2≒VBE1+VDr なる等式が成立する。そして、この実施例では、
上記第1のトランジスタ33および第2のトラン
ジスタ34として互い等しい導電構造を有する
PNP型トランジスタを用いているので、各ベー
スエミツタ間電圧VBE1,VBE2が略等しく、上記第
1のトランジスタ33のコレクタエミツタ間電圧
VCE1すなわちこのリツプル除去回路30による電
源降下電圧を上記第2の抵抗42の抵抗値によつ
て任意に設定することができ、0.1V以下にまで
低下させることができる。しかも、上記各ベー
ス・エミツタ間電圧VBE1,VBE2の温度依存性も略
等しくなるので、このリツプル除去回路30にお
ける温度変化による直流的な出力レベル変動を極
めて小さくすることができる。なお、上記第2の
抵抗42は、原理的にOΩとして省略することが
できる。
In the embodiment configured as described above, the second transistor 34 constitutes a collector feedback type amplifier circuit using the fourth resistor 36 as a feedback resistor, and in terms of direct current, the collector voltage Vc and the base potential V B It operates in a state where they are approximately equal. Therefore, the sum of the base-collector voltage V CE1 in the first transistor 33 and the base-emitter voltage V BE2 in the second transistor 34 is equal to
It is approximately equal to the sum of the base-emitter voltage V BE1 in No. 3 and the voltage drop V Dr due to the second resistor 42, and the following equation holds true: V CE1 +V BE2 ≈V BE1 +V Dr. And in this example,
The first transistor 33 and the second transistor 34 have the same conductive structure.
Since PNP type transistors are used, the base-emitter voltages V BE1 and V BE2 are approximately equal, and the collector-emitter voltage of the first transistor 33 is
V CE1 , that is, the voltage drop caused by the ripple removal circuit 30, can be arbitrarily set by the resistance value of the second resistor 42, and can be lowered to 0.1V or less. Furthermore, since the temperature dependence of each of the base-emitter voltages V BE1 and V BE2 is approximately equal, DC-like output level fluctuations due to temperature changes in the ripple removal circuit 30 can be made extremely small. Note that the second resistor 42 can be omitted as OΩ in principle.

また、上述の如き構成の実施例では、第2のト
ランジスタ34のベースがコンデンサ37を介し
て交流的に接地されているので、出力端子32側
における電源リツプル成分が上記第2のトランジ
スタ34により増幅され、第1のトランジスタ3
3のベースに帰還される。そこで、上記第2のト
ランジスタ34を介して形成される帰還ループの
働きによつて、入力端子32側における交流的な
電源リツプル成分が出力端子32側では除去さ
れ、電源リツプルの無い出力電圧+Voutが出力
端子32に得られる。
Furthermore, in the embodiment with the above-described configuration, the base of the second transistor 34 is grounded via the capacitor 37 in an AC manner, so that the power ripple component on the output terminal 32 side is amplified by the second transistor 34. and the first transistor 3
Returned to the base of 3. Therefore, by the action of the feedback loop formed via the second transistor 34, the AC power supply ripple component on the input terminal 32 side is removed on the output terminal 32 side, and the output voltage +Vout without power supply ripple is generated. is obtained at the output terminal 32.

なお、上述の如き構成の実施例において、入力
端子31側の電圧変動に対する出力端子32側の
電圧変動の比すなわちリツプル除去系数を実測し
たところ、20〜40dBの実験結果が得られた。
In the above-described embodiment, when the ratio of the voltage fluctuation on the output terminal 32 side to the voltage fluctuation on the input terminal 31 side, that is, the ripple removal coefficient, was actually measured, an experimental result of 20 to 40 dB was obtained.

さらに、上述の如き構成の実施例において、第
2のトランジスタ34の帰還抵抗となる第4の抵
抗36は、第1のトランジスタ33が第2のトラ
ンジスタ34の帰還制御に必要なだけ少ないコレ
クタ電流Icにて動作し、該第1のトランジスタ3
4の利得をαとすると、Ic/αなる微少電流を上記 第1のトランジスタ34のベースに帰還すれば良
いので、大きな抵抗値に設定することができる。
Furthermore, in the embodiment configured as described above, the fourth resistor 36 serving as the feedback resistor of the second transistor 34 is configured so that the first transistor 33 has a collector current Ic as small as necessary for feedback control of the second transistor 34. The first transistor 3
If the gain of 4 is α, a small current of Ic/α needs to be fed back to the base of the first transistor 34, so that a large resistance value can be set.

従つて、上記第4の抵抗36とコンデンサ37
とによる時定数を大きくすることができ、上述の
従来例に比較して小さな容量値のコンデンサ37
を用いて、低い周波数成分の電源リツプルまで除
去することができる。
Therefore, the fourth resistor 36 and capacitor 37
The capacitor 37 has a smaller capacitance than the conventional example described above.
can be used to eliminate power supply ripples of low frequency components.

なお、上述の実施例では各トランジスタ33,
34としてPNP型トランジスタを用いて正の電
源電圧+Vinラインについて電源リツプの除去を
行なうようにしたが、上記各トランジスタ33,
34としてNPNトランジスタを用いることによ
り負の電源電圧−Vinラインにおける電源リツプ
ルの除去を行なうように構成することができる。
Note that in the above embodiment, each transistor 33,
34, a PNP type transistor is used to remove the power supply voltage rip for the positive power supply voltage +Vin line, but each of the above transistors 33,
By using an NPN transistor as 34, it is possible to eliminate power supply ripples on the negative power supply voltage -Vin line.

上述の実施例の説明から明らかなように、本考
案によればエミツタが入力端子に接続されコレク
タが出力端子に接続された第1のトランジスタ
と、該第1のトランジスタと等しい導電構造を有
しエミツタが上記出力端子に接続された第2のト
ランジスタとを備え、上記第2のトランジスタの
コレクタを分流用の抵抗および直列接続した時定
数用の抵抗とコンデンサを介して接地するととも
に、該第2のトランジスタのベースを上記コンデ
ンサを介して接地し、上記第1のトランジスタの
ベースを上記第2のトランジスタのコレクタに接
続して成るリツプル除去回路としたことによつ
て、簡単な構成で電源損失が少なく、しかも、小
さな容量値のコンデンサを用いても低い周波数成
分の電源リツプまで効率良く除去できるリツプル
除去回路を提供することができ、所期の目的を十
分に達成できる。
As is clear from the description of the embodiments described above, according to the present invention, the transistor has a first transistor having an emitter connected to an input terminal and a collector connected to an output terminal, and a conductive structure equal to that of the first transistor. a second transistor whose emitter is connected to the output terminal; the collector of the second transistor is grounded via a shunt resistor, a time constant resistor connected in series, and a capacitor; The base of the first transistor is grounded via the capacitor, and the base of the first transistor is connected to the collector of the second transistor to form a ripple removal circuit, which reduces power loss with a simple configuration. It is possible to provide a ripple removal circuit that can efficiently remove power supply ripples of low frequency components even when using a small capacitance capacitor, and the intended purpose can be fully achieved.

【図面の簡単な説明】[Brief explanation of drawings]

第1図および第2図はリツプル除去回路の各従
来例を示す回路図である。第3図は本考案に係る
リツプル除去回路の原理的な回路構成を示す回路
図である。第4図は本考案の具体的な実施例を示
す回路図である。 30……リツプル除去回路、31……入力端
子、32……出力端子、33,34……第1およ
び第2のトランジスタ、35,36……抵抗、3
7……コンデンサ。
FIGS. 1 and 2 are circuit diagrams showing conventional examples of ripple removal circuits. FIG. 3 is a circuit diagram showing the basic circuit configuration of the ripple removal circuit according to the present invention. FIG. 4 is a circuit diagram showing a specific embodiment of the present invention. 30... Ripple removal circuit, 31... Input terminal, 32... Output terminal, 33, 34... First and second transistor, 35, 36... Resistor, 3
7... Capacitor.

Claims (1)

【実用新案登録請求の範囲】[Scope of utility model registration request] エミツタが入力端子に接続されコレクタが出力
端子に接続された第1のトランジスタと、該第1
のトランジスタと等しい導電構造を有しエミツタ
が上記出力端子に接続された第2のトランジスタ
とを備え、上記第2のトランジスタのコレクタを
分流用の抵抗および直列接続した時定数用の抵抗
とコンデンサを介して接地するとともに、該第2
のトランジスタのベースを上記コンデンサを介し
て接地し、上記第1のトランジスタのベースを上
記第2のトランジスタのコレクタに接続して成る
リツプル除去回路。
a first transistor whose emitter is connected to the input terminal and whose collector is connected to the output terminal;
a second transistor having a conductive structure equal to that of the transistor and having an emitter connected to the output terminal, and the collector of the second transistor is connected to a shunting resistor, a time constant resistor and a capacitor connected in series. and ground through the second
A ripple removal circuit comprising: a base of a transistor grounded via the capacitor; and a base of the first transistor connected to a collector of the second transistor.
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