JPS633629U - - Google Patents
Info
- Publication number
- JPS633629U JPS633629U JP9541286U JP9541286U JPS633629U JP S633629 U JPS633629 U JP S633629U JP 9541286 U JP9541286 U JP 9541286U JP 9541286 U JP9541286 U JP 9541286U JP S633629 U JPS633629 U JP S633629U
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- clock pulse
- input terminal
- multiplied
- exclusive
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000010586 diagram Methods 0.000 description 2
Landscapes
- Manipulation Of Pulses (AREA)
Description
第１図は本考案のクロツクパルスの逓倍回路の
一実施例のブロツク図、第２図は動作説明用の波
形図である。 １……逓倍の対象にされているクロツクパルス
の入力端子、２……出力端子、３……排他的論理
和回路、４……遅延回路。
一実施例のブロツク図、第２図は動作説明用の波
形図である。 １……逓倍の対象にされているクロツクパルス
の入力端子、２……出力端子、３……排他的論理
和回路、４……遅延回路。
Claims (1)
- Ｎを自然数とし、τを遅延時間とし、逓倍の対
象にされているクロツクパルスの周期をＴとした
ときに、遅延時間τがＮ・Ｔ／２以外となるよう
に設定された遅延回路の出力端子を排他的論理和
回路の一方の入力端子に接続し、また、前記した
排他的論理和回路の他方の入力端子と前記した遅
延回路の入力端子とに逓倍の対象とされているク
ロツクパルスをデユーテイ・フアクタが０．５の
パルスとして供給するようにしたクロツクパルス
の逓倍回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9541286U JPS633629U (ja) | 1986-06-24 | 1986-06-24 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9541286U JPS633629U (ja) | 1986-06-24 | 1986-06-24 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS633629U true JPS633629U (ja) | 1988-01-11 |
Family
ID=30959907
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9541286U Pending JPS633629U (ja) | 1986-06-24 | 1986-06-24 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS633629U (ja) |
-
1986
- 1986-06-24 JP JP9541286U patent/JPS633629U/ja active Pending
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