JPS6335324U - - Google Patents

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JPS6335324U
JPS6335324U JP12982486U JP12982486U JPS6335324U JP S6335324 U JPS6335324 U JP S6335324U JP 12982486 U JP12982486 U JP 12982486U JP 12982486 U JP12982486 U JP 12982486U JP S6335324 U JPS6335324 U JP S6335324U
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JP
Japan
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output signal
programmable timer
flip
pulse generation
flops
Prior art date
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JP12982486U
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  • Manipulation Of Pulses (AREA)

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【図面の簡単な説明】
第1図は本考案の一実施例を示すブロツク図、
第2図は実施例の動作を説明するためのタイムチ
ヤート、第3図は従来のフイルタ回路の一例を示
す回路図、第4図は第3図のフイルタ回路の各部
信号波形図である。 1…信号源、4…プログラマブルタイマ、5…
多数決回路、FF,FF,FF…フリツプ
フロツプ。

Claims (1)

  1. 【実用新案登録請求の範囲】 一定周波数のクロツクパルスを発生するクロツ
    クパルス発生源と、 コンピユータの指令により前記クロツクパルス
    発生源の出力信号周波数を任意に変化させるプロ
    グラマブルタイマと、 外部入力信号源に対して順次直列接続されると
    ともに、前記プログラマブルタイマの出力信号が
    クロツク入力として各々供給される複数のフリツ
    プフロツプと、 前記複数のフリツプフロツプの各出力信号の多
    数決をとる多数決回路とを備えたことを特徴とす
    るプログラマブルデイジタルフイルタ。
JP12982486U 1986-08-26 1986-08-26 Pending JPS6335324U (ja)

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JP12982486U JPS6335324U (ja) 1986-08-26 1986-08-26

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JP12982486U JPS6335324U (ja) 1986-08-26 1986-08-26

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JPS6335324U true JPS6335324U (ja) 1988-03-07

Family

ID=31026748

Family Applications (1)

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JP12982486U Pending JPS6335324U (ja) 1986-08-26 1986-08-26

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JP (1) JPS6335324U (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS63136881A (ja) * 1986-11-28 1988-06-09 Sony Corp 情報信号受信装置

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS63136881A (ja) * 1986-11-28 1988-06-09 Sony Corp 情報信号受信装置

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