JPS63263926A - 自動ｉｆ正接ロック制御回路を備えた無線受信機 - Google Patents
自動ｉｆ正接ロック制御回路を備えた無線受信機Info
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- JPS63263926A JPS63263926A JP63088344A JP8834488A JPS63263926A JP S63263926 A JPS63263926 A JP S63263926A JP 63088344 A JP63088344 A JP 63088344A JP 8834488 A JP8834488 A JP 8834488A JP S63263926 A JPS63263926 A JP S63263926A
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04B—TRANSMISSION
- H04B1/00—Details of transmission systems, not covered by a single one of groups H04B3/00 - H04B13/00; Details of transmission systems not characterised by the medium used for transmission
- H04B1/06—Receivers
- H04B1/16—Circuits
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03J—TUNING RESONANT CIRCUITS; SELECTING RESONANT CIRCUITS
- H03J7/00—Automatic frequency control; Automatic scanning over a band of frequencies
- H03J7/02—Automatic frequency control
- H03J7/04—Automatic frequency control where the frequency control is accomplished by varying the electrical characteristics of a non-mechanically adjustable element or where the nature of the frequency controlling element is not significant
- H03J7/08—Automatic frequency control where the frequency control is accomplished by varying the electrical characteristics of a non-mechanically adjustable element or where the nature of the frequency controlling element is not significant using varactors, i.e. voltage variable reactive diodes
- H03J7/10—Modification of automatic frequency control sensitivity or linearising automatic frequency control operation
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03D—DEMODULATION OR TRANSFERENCE OF MODULATION FROM ONE CARRIER TO ANOTHER
- H03D1/00—Demodulation of amplitude-modulated oscillations
- H03D1/22—Homodyne or synchrodyne circuits
- H03D1/2209—Decoders for simultaneous demodulation and decoding of signals composed of a sum-signal and a suppressed carrier, amplitude modulated by a difference signal, e.g. stereocoders
- H03D1/2236—Decoders for simultaneous demodulation and decoding of signals composed of a sum-signal and a suppressed carrier, amplitude modulated by a difference signal, e.g. stereocoders using a phase locked loop
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- Engineering & Computer Science (AREA)
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- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Superheterodyne Receivers (AREA)
- Channel Selection Circuits, Automatic Tuning Circuits (AREA)
- Circuits Of Receivers In General (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［産業上の利用分野］
本発明は、一般に無線受信機に関し、とくに■Ｆ処理お
よび正接ロック原理に関する。
よび正接ロック原理に関する。
［従来の技術］
フェーズロックループは所望のＲＦ送信された信号を検
波する手段として従来の技術上よく知られている。この
ようなループは同域内で発生された信号の値と受信信号
自体とを比較することにより信号を検波する。２つの信
号の７エーズエラーは低域ろ波され（すなわち積分され
）、かつ受信信号の平均の周波数と位相とをなぞるよう
周域の値を修正するために用いられる。
波する手段として従来の技術上よく知られている。この
ようなループは同域内で発生された信号の値と受信信号
自体とを比較することにより信号を検波する。２つの信
号の７エーズエラーは低域ろ波され（すなわち積分され
）、かつ受信信号の平均の周波数と位相とをなぞるよう
周域の値を修正するために用いられる。
一般に、多くの無線受信機においては、このようなフェ
ーズロックループは、当業者が周知のとおり、ＩＦ段を
介して周波数変更された最初に受信された搬送波信号か
ら成るＩ「信号にロックするために利用される。しかし
、少なくとも１つの従来の技術文献はフェーズミッタは
同域内で発生された値（ｅｓｔ ｉｍａｔｅ）とＩＦ段
への入り搬送波信号との関数とすることができ、それに
よりフェーズロックループが入り信号自体に対してロッ
クすることができることを示唆している。
ーズロックループは、当業者が周知のとおり、ＩＦ段を
介して周波数変更された最初に受信された搬送波信号か
ら成るＩ「信号にロックするために利用される。しかし
、少なくとも１つの従来の技術文献はフェーズミッタは
同域内で発生された値（ｅｓｔ ｉｍａｔｅ）とＩＦ段
への入り搬送波信号との関数とすることができ、それに
よりフェーズロックループが入り信号自体に対してロッ
クすることができることを示唆している。
１９６０年代初頭に正接関数（ｔａｎａｅｎｔｆｕｎｃ
ｔｉｏｎ）フェーズロックループが提案された。
ｔｉｏｎ）フェーズロックループが提案された。
このループフェーズは、ＩＦ倍信号その値との位相差の
正弦と余弦の双方を生成するデュアルフェーズ比較器で
ＩＦ段出力信号と、同域内発生された信号の値とを比較
するものであった。これらの出力は次に適切に組合わさ
れて正接関数（正弦十余弦）とされ、結果として得られ
た信号をループ用の修正信号として利用することが可能
であった。
正弦と余弦の双方を生成するデュアルフェーズ比較器で
ＩＦ段出力信号と、同域内発生された信号の値とを比較
するものであった。これらの出力は次に適切に組合わさ
れて正接関数（正弦十余弦）とされ、結果として得られ
た信号をループ用の修正信号として利用することが可能
であった。
正接関数は正接または余弦関数よりも著しくその振幅を
変えるので、正接関数の関数としてフェーズロックルー
プを動作させることにより、少なくとも特定の動作条件
の下では位相比較器レンジと直線性を高めることができ
た。ＩＦ倍信号とロックするため正接ロック原理を利用
した市販の無線受信機部品の一例には、モトローラ社の
ＭＣ１３○２０．ＡＭステレオデコーダ集積回路がある
。
変えるので、正接関数の関数としてフェーズロックルー
プを動作させることにより、少なくとも特定の動作条件
の下では位相比較器レンジと直線性を高めることができ
た。ＩＦ倍信号とロックするため正接ロック原理を利用
した市販の無線受信機部品の一例には、モトローラ社の
ＭＣ１３○２０．ＡＭステレオデコーダ集積回路がある
。
［発明が解決しようとする課題］
今日まで無線受信機のＩＦ段を介して満足できる正接準
拠フェーズロックループは達成されていない。このよう
な構成がもたらす安定性、速度、レンジおよび部品の改
善を考慮すれば、このような構成のフェーズロックルー
プの必要性は明らかに存在する。
拠フェーズロックループは達成されていない。このよう
な構成がもたらす安定性、速度、レンジおよび部品の改
善を考慮すれば、このような構成のフェーズロックルー
プの必要性は明らかに存在する。
［課題を解決するための手段］
これらの課題およびその他の課題は本明細書に開示する
装置により解決される。この装置はＩＦ段に周波数変換
装置（ＦＴＵ）と基準信号装置（Ｒ３Ｕ）とを含む。Ｆ
ＴＵは次の受信に応答する。（１）変調された情報信号
を有する搬送波信号から成る入力信号、および（２）Ｒ
３ＬＩからの基準信号である。ＦＴＵはこれらに応答し
て基準信号により変換された搬送波信号に関連する周波
数と位相とを有する出力信号を提供する。このＦＴＵ信
号は受信機のＩＦ倍信号ら成っている。ＩＦ倍信号通例
の方法で復調され、その結果生じる復調された信号の少
なくとも一部は制御信号をＲ３Ｕへと提供するために利
用される。この制御信号自体の少なくとも一部は、復調
された信号の少なくとも一部の正接関数として変化する
。
装置により解決される。この装置はＩＦ段に周波数変換
装置（ＦＴＵ）と基準信号装置（Ｒ３Ｕ）とを含む。Ｆ
ＴＵは次の受信に応答する。（１）変調された情報信号
を有する搬送波信号から成る入力信号、および（２）Ｒ
３ＬＩからの基準信号である。ＦＴＵはこれらに応答し
て基準信号により変換された搬送波信号に関連する周波
数と位相とを有する出力信号を提供する。このＦＴＵ信
号は受信機のＩＦ倍信号ら成っている。ＩＦ倍信号通例
の方法で復調され、その結果生じる復調された信号の少
なくとも一部は制御信号をＲ３Ｕへと提供するために利
用される。この制御信号自体の少なくとも一部は、復調
された信号の少なくとも一部の正接関数として変化する
。
その結果、受信機は正接関数として元の入り搬送波信号
にロックすることができ、一方、同時に元の入力信号の
周波数とはかかわりなく安定したＩＦ周波数をもたらす
。
にロックすることができ、一方、同時に元の入力信号の
周波数とはかかわりなく安定したＩＦ周波数をもたらす
。
したがって、ＩＦ倍信号正確に中心合せされ、ＩＦ段の
特性と著しく向上した性能で整合する。
特性と著しく向上した性能で整合する。
［実施例］
次に本発明の実施例を図面を参照しつつ詳細に説明する
。
。
さて第１図を参照すると、参照番号１０で一般的に示し
た装置が示しである。装置１０は入力１１にて入力信号
を受信する無線受信機と共に動作する。説明のため、入
力信号は（１＋Ｌ＋Ｒ）ＣＯＳ （ωｃｔ＋φ）の形式
のＡＭステレオ変調信号であるものと想定する。ここで
、φはａｒｃｔａｎ （（Ｌ−Ｒ＞／ （１十り十Ｒ）
）の形式を有し、Ｌはステレオ信号の左側の情報、Ｒは
右側の情報、また、ωｃｔは搬送波信号である。
た装置が示しである。装置１０は入力１１にて入力信号
を受信する無線受信機と共に動作する。説明のため、入
力信号は（１＋Ｌ＋Ｒ）ＣＯＳ （ωｃｔ＋φ）の形式
のＡＭステレオ変調信号であるものと想定する。ここで
、φはａｒｃｔａｎ （（Ｌ−Ｒ＞／ （１十り十Ｒ）
）の形式を有し、Ｌはステレオ信号の左側の情報、Ｒは
右側の情報、また、ωｃｔは搬送波信号である。
入力信号はＲ３Ｕ１３からの基準信号２６の関数として
ＦＴＬ１１２により受信されかつ処理されて、（１千Ｌ
＋Ｒ）ｃｏｓ （ωｉ ｔ＋φ）の形式のＩ［信号１４
が生成される。信号復調装置（ＳＤＬＩ）１６が、一部
は基準発振器１７により提供される復調信号２４の関数
として、このＩＦ信号１４を復調して、復調された情報
信＠（この場合は、Ｌ＋Ｒ（１８）およびＬ−Ｒ（１９
））を生成する。これらの復調信号は次に、当業者には
よく知られた従来の技術によってマトリクス２１を介し
て処理され、所望に応じてＬおよびＲの出力信号の生成
が可能である。
ＦＴＬ１１２により受信されかつ処理されて、（１千Ｌ
＋Ｒ）ｃｏｓ （ωｉ ｔ＋φ）の形式のＩ［信号１４
が生成される。信号復調装置（ＳＤＬＩ）１６が、一部
は基準発振器１７により提供される復調信号２４の関数
として、このＩＦ信号１４を復調して、復調された情報
信＠（この場合は、Ｌ＋Ｒ（１８）およびＬ−Ｒ（１９
））を生成する。これらの復調信号は次に、当業者には
よく知られた従来の技術によってマトリクス２１を介し
て処理され、所望に応じてＬおよびＲの出力信号の生成
が可能である。
ざらに、正接（ｔａｎｇｅｎｔ）処理装置ＴＰＵ２２は
復調信号の少なくとも一部（この場合はＬ−Ｒに関する
信号）を処理し、この信号をＲ８Ｕ１３用の制御信号２
３を生成するために利用する。この制御信号は、復調信
号２４と比較されＩＦ信号１４のエンベロープで乗じら
れると、少なくとも一部は位相の正接関数の平均値とし
て変化する。
復調信号の少なくとも一部（この場合はＬ−Ｒに関する
信号）を処理し、この信号をＲ８Ｕ１３用の制御信号２
３を生成するために利用する。この制御信号は、復調信
号２４と比較されＩＦ信号１４のエンベロープで乗じら
れると、少なくとも一部は位相の正接関数の平均値とし
て変化する。
その結果、入力信号と基準信号２６との位相差は基準発
振器１７からの復調器＠２４の周波数および位相とほぼ
等しくなり、それにより入力信号周波数とはかかわりな
く安定したＩＦ周波数が得られ、一方間時に正接口ツタ
の利点も得られる。
振器１７からの復調器＠２４の周波数および位相とほぼ
等しくなり、それにより入力信号周波数とはかかわりな
く安定したＩＦ周波数が得られ、一方間時に正接口ツタ
の利点も得られる。
さて第２図を参照すると、装置１０がより詳細に説明さ
れている。
れている。
標準型の連結コンデンサ同調機構３１は入力信号を受信
する機能を果たし、この信号はＩＦ段３２の入力１１を
通過する。ＦＴＵ１２はミキサ／ＡＧＣ（自動利得制御
）３３と、ＩＦフィルタ３４とＩＦ利得ＡＧＣ部３６と
を含む。双方のＡＧＣ装置３３，３６はＡＧＣ駆動機構
３７に応答し、この駆動機構自体は５ＤＬＪ１６からの
Ｌ十Ｒ復調信号に応答して、Ｌ十Ｒ信号の関数として八
〇〇３３．３６の利得を制御する。
する機能を果たし、この信号はＩＦ段３２の入力１１を
通過する。ＦＴＵ１２はミキサ／ＡＧＣ（自動利得制御
）３３と、ＩＦフィルタ３４とＩＦ利得ＡＧＣ部３６と
を含む。双方のＡＧＣ装置３３，３６はＡＧＣ駆動機構
３７に応答し、この駆動機構自体は５ＤＬＪ１６からの
Ｌ十Ｒ復調信号に応答して、Ｌ十Ｒ信号の関数として八
〇〇３３．３６の利得を制御する。
１Ｆ段３２はさらに電圧制御局部発振器（ＶＣＬＯ）で
あってよいＲ８Ｕ’１３を含んでいる。ＶＣＬＯはミキ
サ３３が入力信号を変換し、それにより、基準信号２６
によって変換された入力信号に関連する周波数と位相と
を有する信号を生成するために利用する基準信号２６を
ミキサ３３に供給する。
あってよいＲ８Ｕ’１３を含んでいる。ＶＣＬＯはミキ
サ３３が入力信号を変換し、それにより、基準信号２６
によって変換された入力信号に関連する周波数と位相と
を有する信号を生成するために利用する基準信号２６を
ミキサ３３に供給する。
ＩＦ信号１４の出力は５ＤＵ１６へと通過し、この５Ｄ
Ｕ１６は、全てよく知られた従来の技術にしたがって、
ＩＦ信号１４を復調しかつＬ十Ｒ成分を有する第１復調
信号１８を生成する制限器３８とエンベロープ検出器／
フィルタ３９とを含む。ＩＦ信号１４はまたＴＰＵ２２
へと通過する。
Ｕ１６は、全てよく知られた従来の技術にしたがって、
ＩＦ信号１４を復調しかつＬ十Ｒ成分を有する第１復調
信号１８を生成する制限器３８とエンベロープ検出器／
フィルタ３９とを含む。ＩＦ信号１４はまたＴＰＵ２２
へと通過する。
このＴＰＵ２２はＩＦ倍信号 （１＋Ｌ＋Ｒ）ｃ。
Ｓ（ω１を十φ）、ここでω１ｔはＩＦ搬送波である）
をＣＯＳφで割算するアナログ割算器４１を含む。結果
として得られた信号４１はＱ検出器／フィルタ４２へと
通過する。Ｑ検出器／フィルタ４２はゲーテッド復調器
を備え、これはその目的のために提供された基準信号に
関して９０度と２７０度において位相を１８０度反転し
、かつその目的のために提供された基準信号と直角位相
にある（所与の瞬間に）入り信号のベクトル量に関する
出力を生成する。本装置では、Ｑ検出器／フィルタ４２
はこのような（後により詳細に説明する）基準信号とし
て直角位相発生器４３からの信号を利用し、以下の形式
の信号を提供する。
をＣＯＳφで割算するアナログ割算器４１を含む。結果
として得られた信号４１はＱ検出器／フィルタ４２へと
通過する。Ｑ検出器／フィルタ４２はゲーテッド復調器
を備え、これはその目的のために提供された基準信号に
関して９０度と２７０度において位相を１８０度反転し
、かつその目的のために提供された基準信号と直角位相
にある（所与の瞬間に）入り信号のベクトル量に関する
出力を生成する。本装置では、Ｑ検出器／フィルタ４２
はこのような（後により詳細に説明する）基準信号とし
て直角位相発生器４３からの信号を利用し、以下の形式
の信号を提供する。
［（１＋Ｌ＋Ｒ）ｓｉｎ（ａｒｃｔａｎ（Ｌ−Ｒ）／（
１＋Ｌ＋Ｒ）月／Ｃ０５（φ）これはあるいは次のよう
に表わすこともできる。
１＋Ｌ＋Ｒ）月／Ｃ０５（φ）これはあるいは次のよう
に表わすこともできる。
［（１＋Ｌ＋Ｒ）ｓｉｎ（ａｒｃｔａｎ（Ｌ−Ｒ）／（
１＋Ｌ＋Ｒ）月／ｃｏｓ（ａｒｃｔａｎ（Ｌ−Ｒ）／（
１＋Ｌ＋Ｒ））上記はもちろん、基本的にＬ−Ｒに還元
し、第２の復調信号１９を有するタンジェント関数（正
弦十余弦）を構成する。少なくともこのＬ−Ｒ成分に関
連する信号４４はループドライバ４６に供給することが
でき、このループドライバ４６は入り信号を少なくとも
部分的に積分するフィルタを有し、かつＬ−Ｒ項に比例
する電流を提供する。
１＋Ｌ＋Ｒ）月／ｃｏｓ（ａｒｃｔａｎ（Ｌ−Ｒ）／（
１＋Ｌ＋Ｒ））上記はもちろん、基本的にＬ−Ｒに還元
し、第２の復調信号１９を有するタンジェント関数（正
弦十余弦）を構成する。少なくともこのＬ−Ｒ成分に関
連する信号４４はループドライバ４６に供給することが
でき、このループドライバ４６は入り信号を少なくとも
部分的に積分するフィルタを有し、かつＬ−Ｒ項に比例
する電流を提供する。
この電流はＲ３ＬＪ１３の周波数と位相を制御する制御
信号２３である。
信号２３である。
基準発振器１７は所定の安定周波数（この例では３．６
ＭＨｚ＞を有する復調信号２４を提供し、この信号は直
角位相発生器４３に供給される。直角位相発生器４３は
この信号２４を所望の周波数（この例では４５０ＫＨｚ
）まで分割し、これに基づく２つの出力を提供する。第
１の出力は移相のない（０度）４５０ＫＨｚの信号から
成り、第２の出力は所与の移相（９０度）をともなう４
５０ＫＨｚの信号である。前述のＱ検出器／フィルタ４
２は上に述べたようにｌ−Ｒ信号を生成するため後者の
信号を用いる。
ＭＨｚ＞を有する復調信号２４を提供し、この信号は直
角位相発生器４３に供給される。直角位相発生器４３は
この信号２４を所望の周波数（この例では４５０ＫＨｚ
）まで分割し、これに基づく２つの出力を提供する。第
１の出力は移相のない（０度）４５０ＫＨｚの信号から
成り、第２の出力は所与の移相（９０度）をともなう４
５０ＫＨｚの信号である。前述のＱ検出器／フィルタ４
２は上に述べたようにｌ−Ｒ信号を生成するため後者の
信号を用いる。
動作の際は、ミキサ３３と、アナログ分割器４１と、Ｑ
検出器４２と、ループ駆動器４６とＲ３Ｕ１３との間の
相互接続のループ特性によって、ループは正接ロックさ
れ、それによりループ駆動器４６からのＬ−Ｒ項の長い
項の平均はゼロにされる。実際において、入力信号と基
準信号２６との平均位相差が復調信号２４の周波数と位
相にほぼ等しいように、ＩＦ倍信号周波数は基準発振器
１７の復調信号２４の周波数に対してロックされる状態
になる。ＩＦ段３２の構成部品を適切に選択することに
より、例えば４５０ＫＨ７と０度の安定ＩＦ周波数と位
相を保つことができる。ＶＣＬＯはその後、その周波数
と位相とを調整して■Ｆ段３２を介した基準発振器１７
に対してこのロックが成されるようにする。
検出器４２と、ループ駆動器４６とＲ３Ｕ１３との間の
相互接続のループ特性によって、ループは正接ロックさ
れ、それによりループ駆動器４６からのＬ−Ｒ項の長い
項の平均はゼロにされる。実際において、入力信号と基
準信号２６との平均位相差が復調信号２４の周波数と位
相にほぼ等しいように、ＩＦ倍信号周波数は基準発振器
１７の復調信号２４の周波数に対してロックされる状態
になる。ＩＦ段３２の構成部品を適切に選択することに
より、例えば４５０ＫＨ７と０度の安定ＩＦ周波数と位
相を保つことができる。ＶＣＬＯはその後、その周波数
と位相とを調整して■Ｆ段３２を介した基準発振器１７
に対してこのロックが成されるようにする。
■検出器４７およびパイロットト−ン検出器４８を含む
他の要素も図示しである。これらの要素の存在とその機
能はよく理解されており、それらに関する付加的な情報
は、例えば米国特許第４、３７７、７２８＠および第１
１，４８９，４３１号により得ることができる。
他の要素も図示しである。これらの要素の存在とその機
能はよく理解されており、それらに関する付加的な情報
は、例えば米国特許第４、３７７、７２８＠および第１
１，４８９，４３１号により得ることができる。
［発明の効果］
この構成により多くの利点が得られる。先ず、標準の放
送では生じ得る搬送波に対する非対称位相偏移をともな
う単チャネル変調と共に標準のフェーズロックループを
用いた場合に起るステレオ信号分離の損失とひずみを回
避できる。さらに、ＩＦ倍信号対するように入り信号に
ロックすることにより、システム全体がＩＦの中心にて
ロックされた状態になり、性能が向上する。
送では生じ得る搬送波に対する非対称位相偏移をともな
う単チャネル変調と共に標準のフェーズロックループを
用いた場合に起るステレオ信号分離の損失とひずみを回
避できる。さらに、ＩＦ倍信号対するように入り信号に
ロックすることにより、システム全体がＩＦの中心にて
ロックされた状態になり、性能が向上する。
当業者は本発明の精神と範囲を逸脱することなく本発明
の多くの修正が可能でおることを理解しよう。したがっ
て請求項は、実施例に対して明白な限定性をともなわず
に開示された実施例に厳密に限定されるものとみなすべ
きではない。
の多くの修正が可能でおることを理解しよう。したがっ
て請求項は、実施例に対して明白な限定性をともなわず
に開示された実施例に厳密に限定されるものとみなすべ
きではない。
第１図は、本発明の１実施例に係る正接口ツク制御回路
を示すブロック回路図、そして第２図は、本発明に係る
正接ロック制御回路を含むラジオ受信機を示すブロック
回路図である。 １０：正接口ツタ制御回路、 １１：入力、１２：ＦＴ
Ｕ（周波数変換装置）、 １３：Ｒ８Ｕ（基準信号装置）、 １４：ＩＦ倍信号 １６：５ＤＵ（信号復調装置）、 １７：基準発振器、 ２１：マトリクス、２２：ＴＰＵ
（正接処理装置）、 ２３：制御信号、 ２４：復調信号、 ３１：連結コンデンサ同調機構、 ３２：ＩＦ段、 ３３：ミキサ／ＡＧＣ（自動利得制御）、３４：ＩＦフ
ィルタ、 ３６：ＩＦ利得ＡＧＣ。 ３７：ＡＧＣ駆動機構、 ３８二制限器、３９：検出器
／フィルタ、 ４１：アナログ分割器、 ４２：Ｑ検出器／フィルタ、 ４３：直角位相生成器、 ４６：ループ分割器、４７：
■検出器、 ４８：パイロットトーン検出器。
を示すブロック回路図、そして第２図は、本発明に係る
正接ロック制御回路を含むラジオ受信機を示すブロック
回路図である。 １０：正接口ツタ制御回路、 １１：入力、１２：ＦＴ
Ｕ（周波数変換装置）、 １３：Ｒ８Ｕ（基準信号装置）、 １４：ＩＦ倍信号 １６：５ＤＵ（信号復調装置）、 １７：基準発振器、 ２１：マトリクス、２２：ＴＰＵ
（正接処理装置）、 ２３：制御信号、 ２４：復調信号、 ３１：連結コンデンサ同調機構、 ３２：ＩＦ段、 ３３：ミキサ／ＡＧＣ（自動利得制御）、３４：ＩＦフ
ィルタ、 ３６：ＩＦ利得ＡＧＣ。 ３７：ＡＧＣ駆動機構、 ３８二制限器、３９：検出器
／フィルタ、 ４１：アナログ分割器、 ４２：Ｑ検出器／フィルタ、 ４３：直角位相生成器、 ４６：ループ分割器、４７：
■検出器、 ４８：パイロットトーン検出器。
Claims (1)
- 【特許請求の範囲】 １、振幅変調された情報信号を有する第１の搬送波信号
から成る入力信号を受信する入力装置と、前記入力信号
を受信しかつ前記入力信号を前記第１の搬送波信号とは
異なる周波数を有しかつ振幅変調された前記情報信号を
有する第２の搬送波信号から成るＩＦ信号へと変換する
ＩＦ装置と、前記ＩＦ信号を受信しかつ該ＩＦ信号を復
調して前記情報信号の少なくとも一部を含む復調された
信号を提供する復調装置とを有し、 前記ＩＦ装置はさらに、制御信号を受信しかつ前記制御
信号により少なくとも一部が決定される周波数および位
相を有する基準信号を提供する基準信号装置と、前記基
準信号と前記入力信号とを受信しかつ前記基準信号によ
り変換されると、前記第１搬送波信号に関連する周波数
および位相とを有する導出信号を提供する周波数変換器
とを含んでおり、前記導出信号は前記ＩＦ信号から成っ
ており、かつ 前記復調装置はさらに前記基準信号装置に前記制御信号
を提供することにより少なくとも部分的に前記復調され
た信号に応答する正接処理装置を含んでおり、前記制御
信号は前記復調された信号の少なくとも一部の正接関数
として変化することを特徴とする無線受信機。 ２、前記復調装置はさらに前記ＩＦ信号を復調するため
前記復調装置により用いられる復調用信号を提供する基
準発振器を含み、かつ前記正接処理装置は前記復調され
た信号と前記復調用信号の双方の正接関数として前記制
御信号を提供する請求項１記載の無線受信機。 ３、前記正接処理装置は、前記第１の搬送波信号と、前
記復調用信号の平均の周波数および位相と大むね等しい
前記基準信号との間の平均位相差を生成するため前記制
御信号を提供する請求項１記載の無線受信機。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| US07/038,563 US4782532A (en) | 1987-04-15 | 1987-04-15 | Automatic IF tangent lock control circuit |
| US38563 | 1987-04-15 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS63263926A true JPS63263926A (ja) | 1988-10-31 |
| JPH0580177B2 JPH0580177B2 (ja) | 1993-11-08 |
Family
ID=21900649
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63088344A Granted JPS63263926A (ja) | 1987-04-15 | 1988-04-12 | 自動ｉｆ正接ロック制御回路を備えた無線受信機 |
Country Status (11)
| Country | Link |
|---|---|
| US (1) | US4782532A (ja) |
| JP (1) | JPS63263926A (ja) |
| KR (1) | KR960003836B1 (ja) |
| CN (1) | CN1015854B (ja) |
| AU (1) | AU594286B2 (ja) |
| BR (1) | BR8801268A (ja) |
| CA (1) | CA1296776C (ja) |
| GB (1) | GB2203908B (ja) |
| HK (1) | HK11094A (ja) |
| IN (1) | IN170411B (ja) |
| MX (1) | MX168451B (ja) |
Families Citing this family (3)
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|---|---|---|---|---|
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Family Cites Families (2)
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|---|---|---|---|---|
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-
1988
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- 1988-03-07 MX MX010679A patent/MX168451B/es unknown
- 1988-03-21 BR BR8801268A patent/BR8801268A/pt not_active IP Right Cessation
- 1988-04-12 JP JP63088344A patent/JPS63263926A/ja active Granted
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-
1994
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| GB2203908B (en) | 1991-10-23 |
| CN1015854B (zh) | 1992-03-11 |
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| HK11094A (en) | 1994-02-09 |
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