JPS63190476A - Photoelectric converter - Google Patents

Photoelectric converter

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JPS63190476A
JPS63190476A JP62006254A JP625487A JPS63190476A JP S63190476 A JPS63190476 A JP S63190476A JP 62006254 A JP62006254 A JP 62006254A JP 625487 A JP625487 A JP 625487A JP S63190476 A JPS63190476 A JP S63190476A
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sensor
optical sensors
signal output
transistor
pulse
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成利 須川
Akira Ishizaki
明 石崎
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  • Transforming Light Signals Into Electric Signals (AREA)

Abstract

PURPOSE:To increase the degree of freedom for the design by providing plural number of selecting means selecting an optical sensor of a sensor block so as to suppress a drive frequency of a selection means per one sensor to a lower value even when high frequency operation is required because of many number of optical sensors. CONSTITUTION:n-set of output terminals of a sensor block 101 are connected to capacitors C11-C1n and connected in common to a signal output line 103 via transistors (TRs) T11-T1n. Pulses phi11-phi1n are given respectively to each gate of the TRs T11-T1n from a scanning circuit 105. Moreover, pulses phi1, phi2 are inputted to input terminals (a), (b) of the circuit 105. This is applied similarly to the sensor block 102. Since the scanning circuits 105, 106 are pro vided for the sensor blocks 101, 102, one scanning circuit has only to have n-set of operating frequency in case of the read of 2n-set of optical sensors and the degree of freedom of design is improved.

Description

【発明の詳細な説明】 [産業上の利用分野] 本発明は、複数個の光センサが配列され、該光センサの
出力を信号出力線を介して読み出す光電変換装置に関す
る。
DETAILED DESCRIPTION OF THE INVENTION [Field of Industrial Application] The present invention relates to a photoelectric conversion device in which a plurality of optical sensors are arranged and the output of the optical sensors is read out via a signal output line.

[従来技術] 第7図は、光センサがエリア状に配列された従来の撮像
装置の概略的回路図である。
[Prior Art] FIG. 7 is a schematic circuit diagram of a conventional imaging device in which optical sensors are arranged in areas.

同図において、エリア状に配列された光センサ30は水
平ライン31によって行ごとに共通接続され、水平ライ
ン31は垂直走査部32に接続されている。この垂直走
査部32の出力によって、任意のラインの光センサ30
が選択される。
In the figure, optical sensors 30 arranged in an area are commonly connected row by row by horizontal lines 31, and the horizontal lines 31 are connected to a vertical scanning section 32. The output of this vertical scanning unit 32 allows the optical sensor 30 of an arbitrary line to
is selected.

また、光センサ30は垂直ライン33に列ごとに共通接
続され、各垂直ライン33はトランジスタT1〜Tnを
介して信号出力線34に接続されている。トランジスタ
T1〜Tnの各ゲート′TL極は水平シフトレジスタ3
6の各出力端子に接続され、シフトレジスタ36からの
出力のタイミングに従ってトランジスタT1〜Tnは順
次ON状態となる。この水平走査によって、垂直走査部
32によって選択されたラインの光情報がシリアルに信
号−出力線34に読出され、アンプ37を通して外部へ
出力される。
Further, the optical sensors 30 are commonly connected to vertical lines 33 for each column, and each vertical line 33 is connected to a signal output line 34 via transistors T1 to Tn. Each gate'TL pole of the transistors T1 to Tn is connected to the horizontal shift register 3.
According to the timing of the output from the shift register 36, the transistors T1 to Tn are sequentially turned on. By this horizontal scanning, the optical information of the line selected by the vertical scanning section 32 is serially read out to the signal-output line 34 and outputted to the outside through the amplifier 37.

このような従来の装置では、通常、水平方向の画素数(
光センサ30の数)は200〜500画素である。した
がって、テレビジョンにおける1走査期間63.57p
secを考慮すると、水平シフトレジスタ36の動作周
波数は3〜8MHzとなる。この程度の画素数および周
波数であるならば、技術的に従来の装置で十分対応する
ことが可能である。
In such conventional devices, the number of horizontal pixels (
The number of optical sensors 30) is 200 to 500 pixels. Therefore, one scanning period in television is 63.57p
Considering sec, the operating frequency of the horizontal shift register 36 is 3 to 8 MHz. Technically, it is possible to adequately handle the number of pixels and frequency of this level using conventional devices.

[発明が解決しようとする問題点] しかしながら、撮像装置の高解像度化により、水平方向
の画素数は1024個以上に増大することは確実である
。この場合、上記テレビレートを考慮すると、水平シフ
トレジスタ36の動作周波数は約16MHz以上となる
[Problems to be Solved by the Invention] However, as the resolution of imaging devices increases, it is certain that the number of pixels in the horizontal direction will increase to 1024 or more. In this case, considering the above-mentioned television rate, the operating frequency of the horizontal shift register 36 will be about 16 MHz or more.

このような高周波数になると、従来の回路構成では設計
上の制約が厳しくなり、また歩留りの低下をもたらすと
いう問題点を有していた。
At such high frequencies, conventional circuit configurations have had the problem of severe design constraints and reduced yield.

[問題点を解決するための手段1 本発明による光電変換装置は、 各々所望個数の光センサからなる複数のセンサブロック
と、該センサブロックの光センサを所望の組合わせで選
択する複数の選択手段と、選択された光センサのセンサ
信号を取り出す複数の信号出力線と、を有し、 かつ、前記信号出力線が各々開閉手段を介して所望の組
合わせで共通に接続されていることを特徴とする。
[Means for Solving the Problems 1] A photoelectric conversion device according to the present invention includes a plurality of sensor blocks each including a desired number of optical sensors, and a plurality of selection means for selecting a desired combination of optical sensors of the sensor blocks. and a plurality of signal output lines for taking out the sensor signals of the selected optical sensors, and each of the signal output lines is commonly connected in a desired combination via an opening/closing means. shall be.

[作用] このように、上記選択手段(たとえばシフトレジスタ等
の走査回路)が複数個設けられているために、光センサ
の個数が多く高周波動作が必要な場合でも、1個当りの
選択手段の駆動周波数を低く抑えることができ、回路設
計および半導体素子のパターン設計等における自由度を
大きくすることができる。
[Function] In this way, since a plurality of the selection means (for example, a scanning circuit such as a shift register) are provided, even if there are a large number of optical sensors and high frequency operation is required, the number of selection means per one can be reduced. The drive frequency can be kept low, and the degree of freedom in circuit design, semiconductor element pattern design, etc. can be increased.

また、上記信号出力線が各々開閉手段を介して接続され
ているために、−の信号出力線に信号が取り出される際
に、当該信号出力線の開閉手段を閉じ、他の信号出力線
の開閉手段を開いておくことで、信号出力線に取り出さ
れる信号のレベル低下を防止することもでき、高解像度
で高出力の撮像装置の容易に構成することが可能となる
In addition, since the signal output lines are connected through switching means, when a signal is taken out to the - signal output line, the opening/closing means for the signal output line is closed, and the other signal output lines are opened/closed. By leaving the means open, it is also possible to prevent a drop in the level of the signal taken out to the signal output line, and it becomes possible to easily configure a high-resolution, high-output imaging device.

[実施例] 以下1本発明の実施例を図面を用いて詳細に説明する。[Example] EMBODIMENT OF THE INVENTION Below, one embodiment of the present invention will be described in detail using the drawings.

第1図は、本発明による光電変換装置の一実施例を示す
概略的回路図である。
FIG. 1 is a schematic circuit diagram showing an embodiment of a photoelectric conversion device according to the present invention.

本実施例では、n個の光センサからなるセンサブロック
101および102が設けられている。
In this embodiment, sensor blocks 101 and 102 each consisting of n optical sensors are provided.

センサブロックとは光センサの集合であり、各ブロック
が別個に形成されている場合、ニリアセンサのような1
つのセンサ群のうちの奇数/偶数ラインを示す場合ある
いは任意のラインの光センサの奇数番目/偶数番目を示
す場合等を含む概念である。本実施例では、説明の便宜
上、2個のセンサブロックを別個に図示したにすぎない
A sensor block is a collection of optical sensors, and when each block is formed separately, one
This concept includes cases where odd/even lines of one sensor group are shown, or odd/even photosensors on an arbitrary line are shown. In this embodiment, two sensor blocks are only illustrated separately for convenience of explanation.

同図において、センサブロック101のn本の出力端子
はコンデンサC1l〜01nに接続されると共に、トラ
ンジスタTli〜T1nを介して信号出力線103に共
通接続されている。トランジスタTl 1〜T1nの各
ゲート電極には走査回路105からパルスφ11〜φ1
nが各々入力する。また、走査回路105の入力端子a
およびbには、各々パルスφ1およびφ2が入力する。
In the figure, n output terminals of a sensor block 101 are connected to capacitors C1l to 01n, and are also commonly connected to a signal output line 103 via transistors Tli to T1n. Pulses φ11 to φ1 are applied from the scanning circuit 105 to each gate electrode of the transistors Tl 1 to T1n.
n input each. In addition, the input terminal a of the scanning circuit 105
Pulses φ1 and φ2 are input to and b, respectively.

信号出力線103は、トランジスタ7r1を介して接地
されるとともに、スイッチ手段であるトランジスタ10
7を介してアンプ109の入力端子に接続されている。
The signal output line 103 is grounded via a transistor 7r1, and is connected to a transistor 10 serving as a switch means.
7 to the input terminal of the amplifier 109.

トランジスタTr1のゲート電極にはパルスφC1が入
力し、トランジスタ107のゲート電極にはパルス小S
rlが入力する。
A pulse φC1 is input to the gate electrode of the transistor Tr1, and a small pulse S is input to the gate electrode of the transistor 107.
rl enters.

センサブロック102の場合も同様に構成されている。The sensor block 102 has a similar configuration.

すなわち、センサブロック102のn本の出力端子はコ
ンデンサC21〜C2nに接続されると共に、トランジ
スタT2 L NT2 nを介して信号出力線104に
共通接続されている。トランジスタT21〜T2nの各
ゲート電極には走査回路106からパルスφ21〜φ2
nが各々入力する。また、走査回路106の入力端子a
およびbには、走査回路105とは逆にパルスφ2およ
びφ1が各々入力する。
That is, the n output terminals of the sensor block 102 are connected to the capacitors C21 to C2n, and are commonly connected to the signal output line 104 via the transistors T2LNT2n. Pulses φ21 to φ2 are applied from the scanning circuit 106 to each gate electrode of the transistors T21 to T2n.
n input each. In addition, the input terminal a of the scanning circuit 106
In contrast to the scanning circuit 105, pulses φ2 and φ1 are input to the pulses φ2 and φ1, respectively.

信号出力線104は、トランジスタTr2を介して接地
されるとともに、スイッチ手段であるトランジスタ10
8を介してアンプ109の入力端子に接続されている。
The signal output line 104 is grounded via a transistor Tr2, and is connected to a transistor 10 which is a switch means.
8 to the input terminal of the amplifier 109.

トランジスタTr2のゲート電極にはパルスφC2が入
力し、トランジスタ108(7)ゲート電極にはパルス
φsr2が入力する。
A pulse φC2 is input to the gate electrode of the transistor Tr2, and a pulse φsr2 is input to the gate electrode of the transistor 108(7).

本実施例における走査回路105および106は、次の
ような動作を行う。
Scanning circuits 105 and 106 in this embodiment perform the following operations.

第2図は、走査回路の動作を示すタイミングチャートで
ある。
FIG. 2 is a timing chart showing the operation of the scanning circuit.

走査回路105および106は、それぞれパルスφ1お
よびφ2の2相駆動であり、第1図に示すように結線す
ることによって、タイミングチャートに示すように、パ
ルスφ1に同期して走査回路105のパルスφ11〜φ
1nが出力し。
The scanning circuits 105 and 106 are driven by two-phase pulses φ1 and φ2, respectively, and by connecting them as shown in FIG. 1, the pulse φ11 of the scanning circuit 105 is synchronized with the pulse φ1 as shown in the timing chart. ~φ
1n outputs.

パルスφ2に同期して走査回路106のパルスφ21〜
φ2nが出力する。したがって、パルスφ1およびφ2
のタイミングによって、所望のタイミングで又は独立し
て、走査回路105および106を動作させることがで
きる。
Pulse φ21~ of the scanning circuit 106 in synchronization with pulse φ2
φ2n outputs. Therefore, pulses φ1 and φ2
Depending on the timing, scanning circuits 105 and 106 can be operated at desired timing or independently.

なお、上記各パルスφはドライバ111から供給され、
ドライバ111は発振器112からのクロック信号に応
じたタイミングで各パルスを出力する。
Note that each pulse φ is supplied from the driver 111,
The driver 111 outputs each pulse at a timing according to a clock signal from an oscillator 112.

本実施例ではスイッチ手段としてトランジスタ107お
よび108を使用したが、勿論、導通時の抵抗が低いア
、ナログスイッチ等を用いてもよい。
In this embodiment, transistors 107 and 108 are used as the switching means, but of course analog switches or the like having low resistance when turned on may also be used.

また、3個以上のセンサブロックを設け、それらの信号
出力線を同様にスイッチ手段を介してアンプ109の入
力端子に共通に接続した構成も本発明の範囲内である。
Further, a configuration in which three or more sensor blocks are provided and their signal output lines are commonly connected to the input terminal of the amplifier 109 via a switch means is also within the scope of the present invention.

次に、本実施例の動作を第3図を参照しながら説明する
Next, the operation of this embodiment will be explained with reference to FIG.

第3図は、ドライバ111から出力される各パルスタイ
ミングの第1例を示すタイミングチャートである。
FIG. 3 is a timing chart showing a first example of each pulse timing output from the driver 111.

同図において、まずパルスφsrlをハイレベル、パル
スφsr2をローレベルとして、トランジスタ107を
ON、トランジスタ108をOFFとする。
In the figure, first, the pulse φsrl is set to a high level, the pulse φsr2 is set to a low level, and the transistor 107 is turned on and the transistor 108 is turned off.

この状態で走査回路105からパルスφ11を出力し、
トランジスタTitをONとする。これによって、セン
サブロック101の第1番目のセンサ信号がコンデンサ
C1lから信号出力線103に取り出され、トランジス
タ107およびアンプ109を通して出力端子110か
ら外部へ出力される。
In this state, the scanning circuit 105 outputs a pulse φ11,
Turn on the transistor Tit. As a result, the first sensor signal of the sensor block 101 is taken out from the capacitor C1l to the signal output line 103, and is outputted to the outside from the output terminal 110 through the transistor 107 and the amplifier 109.

これと同時に、パルスφC2をハイレベルにしてトラン
ジスタTr2をONにする。これにより、信号出力線1
04の残留電荷が除去される。
At the same time, the pulse φC2 is set to high level to turn on the transistor Tr2. As a result, signal output line 1
04 residual charge is removed.

こうしてセンサブロック101の第1番目のセンサ信号
が外部へ出力されると、今度はパルスφsr1およびφ
sr2を各々ローレベルおよびハイレベルへと反転させ
、トランジスタ107をOFF、トランジスタ108を
ONとする。
When the first sensor signal of the sensor block 101 is outputted to the outside in this way, the pulses φsr1 and φ
sr2 is inverted to low level and high level, respectively, and transistor 107 is turned off and transistor 108 is turned on.

この状態で走査回路106からパルスφ21を出力し、
トランジスタT21をONにする。これによって、セン
サブロック102の第1番目のセンサ信号がコンデンサ
C21から信号出力線104に取り出され、トランジス
タlO8およびアンプ109を通して外部へ出力される
In this state, the scanning circuit 106 outputs a pulse φ21,
Turn on transistor T21. As a result, the first sensor signal of the sensor block 102 is taken out from the capacitor C21 to the signal output line 104, and is outputted to the outside through the transistor lO8 and the amplifier 109.

これと同時に、パルスφC1はハイレベルとしてトラン
ジスタTr1をONとする。これによって、信号出力線
103に残留していた前回の信号電荷が除去される。
At the same time, the pulse φC1 is set to high level to turn on the transistor Tr1. As a result, the previous signal charge remaining on the signal output line 103 is removed.

以下同様にして、走査回路105からのパルスφ12〜
φ1nおよび走査回路106からのパルスφ22〜φ2
nによって、センサブロー、り101および102の各
センサ信号が交互に順次外部へ出力される。
Similarly, the pulses φ12~ from the scanning circuit 105 are
φ1n and pulses φ22 to φ2 from the scanning circuit 106
According to n, the sensor signals of sensor blow, 101 and 102 are alternately and sequentially output to the outside.

その際、トランジスタ107および10Bのうち信号が
読み出されない方はOFFであるために、信号を読み出
す方の信号出力線の配線容量は実質的にその信号出力線
自身の配線容量Cwのみとなる。このために、コンデン
サcit〜C1nおよびC21〜C2nの各容量CをC
wに比べて十分大きくしておけば、センサからの信号レ
ベルを大きく低下させることなく読み出すことができる
At this time, since the transistor 107 and 10B from which no signal is read is OFF, the wiring capacitance of the signal output line from which the signal is read is substantially only the wiring capacitance Cw of the signal output line itself. For this purpose, each capacitance C of capacitors cit~C1n and C21~C2n is changed to C
If it is made sufficiently larger than w, the signal level from the sensor can be read without significantly decreasing.

また、センサブロック101および102ごとに走査回
路105および106を設けているために、2n個の光
センサの読出しであっても、1個の走査回路はn個分の
動作周波数でよく、設計上の自由度が大きくなる。
Furthermore, since scanning circuits 105 and 106 are provided for each sensor block 101 and 102, even when reading out 2n optical sensors, one scanning circuit only needs to operate at the operating frequency of n optical sensors, which is a design problem. The degree of freedom increases.

本実施例では走査回路に入力するパルスφ1およびφ2
のタイミングによって、以下に示すような駆動を行うこ
とが可能である。
In this embodiment, pulses φ1 and φ2 input to the scanning circuit
Depending on the timing, it is possible to perform the following driving.

第4図は、ドライバ111から出力される各パルスタイ
ミングの第2例を示すタイミングチャートである。
FIG. 4 is a timing chart showing a second example of each pulse timing output from the driver 111.

第2例では、センサブロック101および102の光セ
ンサを順次読み出す場合を示す、すなわち、パルスφS
r1およびφsr2によってトランジスタ107をON
、トランジスタ108をOFFとしておき、この間に走
査回路105によってパルスφ11〜φ1nを順次出力
してセンサブロックlotの全センサ信号を読み出す、
同様に、トランジスタ107をOFF、トランジスタ1
08をONとして、センサブロック102の全センナ信
号を読み出す。
The second example shows a case where the optical sensors of sensor blocks 101 and 102 are sequentially read out, that is, the pulse φS
Transistor 107 is turned on by r1 and φsr2
, while the transistor 108 is turned off, the scanning circuit 105 sequentially outputs pulses φ11 to φ1n to read out all sensor signals of the sensor block lot.
Similarly, transistor 107 is turned off and transistor 1 is turned off.
08 is turned ON and all sensor signals of the sensor block 102 are read out.

第5図および第6図は、ドライバillから出力される
各パルスタイミングの第3例および第4例を示すタイミ
ングチャートである。
FIGS. 5 and 6 are timing charts showing third and fourth examples of each pulse timing output from the driver ill.

このように、いずれかの走査回路をOFFにして、一方
のセンサブロックだけの読出しを行うこともできる。
In this way, it is also possible to turn off one of the scanning circuits and read out only one sensor block.

[発明の効果] 以上詳細に説明したように本発明による光電変換装置は
、センサブロックの光センナを選択する選択手段が複数
個設けられているために、光センナの個数が多く高周波
動作が必要な場合でも、1個当りの選択手段の駆動周波
数を低く抑えることができ、回路設計および半導体素子
のパターン設計等における自由度を大きくすることがで
きる。
[Effects of the Invention] As explained in detail above, the photoelectric conversion device according to the present invention is provided with a plurality of selection means for selecting the optical sensors of the sensor block, so the number of optical sensors is large and high frequency operation is required. Even in such a case, the driving frequency of each selection means can be kept low, and the degree of freedom in circuit design, semiconductor element pattern design, etc. can be increased.

また、信号出力線が各々開閉手段を介して接続されてい
るために、−の信号出力線に信号が取り出される際に、
当該信号出力線の開閉手段を閉じ、他の信号出力線の開
閉手段を開いておくことで、信号出力線に取り出される
信号のレベル低下を防止することもでき、高解像度で高
出力の撮像装置の容易に構成することが可能となる。
In addition, since the signal output lines are connected through opening/closing means, when the signal is taken out to the - signal output line,
By closing the opening/closing means for the signal output line and leaving the opening/closing means for the other signal output lines open, it is possible to prevent a drop in the level of the signal taken out to the signal output line, which enables high-resolution, high-output imaging devices. can be easily configured.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は、本発明による光電変換装置の一実施例を示す
概略的回路図1 第2図は、走査回路の動作を示すタイミングチャート、 第3図は、ドライバ111から出力される各パルスタイ
ミングのi1例を示すタイミングチャート。 第4図は、ドライバ111から出力される各パルスタイ
ミングの第2例を示すタイミングチャート。 第5図および第6図は、ドライバ111から出力される
各パルスタイミングの第3例および第4例を示すタイミ
ングチャート。 第7図は、光センサがエリア状に配列された従来の撮像
装置の概略的回路図である。 101.102−拳・センサブロック 103.104・・・信号出力線 105.106−−・走査回路 107.108・・・トランジスタ(開閉手段)109
・・・アンプ 110・・・出力端子 代理人 弁理士 山 下 穣 平 第2図 第3図 @4図 第5図   第6N
FIG. 1 is a schematic circuit diagram showing one embodiment of a photoelectric conversion device according to the present invention. FIG. 2 is a timing chart showing the operation of the scanning circuit. FIG. 3 is a timing chart of each pulse output from the driver 111. A timing chart showing an example of i1. FIG. 4 is a timing chart showing a second example of each pulse timing output from the driver 111. 5 and 6 are timing charts showing third and fourth examples of each pulse timing output from the driver 111. FIG. FIG. 7 is a schematic circuit diagram of a conventional imaging device in which optical sensors are arranged in areas. 101.102-Fist/sensor block 103.104...Signal output line 105.106--Scanning circuit 107.108...Transistor (opening/closing means) 109
... Amplifier 110 ... Output terminal agent Patent attorney Jo Taira Yamashita Figure 2 Figure 3 @ Figure 4 Figure 5 Figure 6N

Claims (1)

【特許請求の範囲】[Claims] (1)各々所望個数の光センサからなる複数のセンサブ
ロックと、該センサブロックの光センサを所望の組合わ
せで選択する複数の選択手段と、選択された光センサの
センサ信号を取り出す複数の信号出力線と、を有し、 かつ、前記信号出力線が各々開閉手段を 介して所望の組合わせで共通に接続されていることを特
徴とする光電変換装置。
(1) A plurality of sensor blocks each consisting of a desired number of optical sensors, a plurality of selection means for selecting a desired combination of optical sensors of the sensor blocks, and a plurality of signals for extracting sensor signals of the selected optical sensors. An output line, and the signal output lines are commonly connected in a desired combination via opening/closing means.
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