JPS63169865A - 有効インピーダンス・ライン・フイード回路 - Google Patents

有効インピーダンス・ライン・フイード回路

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Publication number
JPS63169865A
JPS63169865A JP62317679A JP31767987A JPS63169865A JP S63169865 A JPS63169865 A JP S63169865A JP 62317679 A JP62317679 A JP 62317679A JP 31767987 A JP31767987 A JP 31767987A JP S63169865 A JPS63169865 A JP S63169865A
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JP
Japan
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tip
amplifier
ring
coupled
circuit
Prior art date
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Pending
Application number
JP62317679A
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English (en)
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ラインハード・ロツシユ
スタンレイ・ダニエル・ローゼンバウム
カルビン・プレツト
ズデネク・ホリイ
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Nortel Networks Ltd
Original Assignee
Northern Telecom Ltd
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Publication date
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    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04M—TELEPHONIC COMMUNICATION
    • H04M19/00—Current supply arrangements for telephone systems
    • H04M19/001—Current supply source at the exchanger providing current to substations
    • H04M19/005—Feeding arrangements without the use of line transformers

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  • Engineering & Computer Science (AREA)
  • Power Engineering (AREA)
  • Signal Processing (AREA)
  • Networks Using Active Elements (AREA)
  • Interface Circuits In Exchanges (AREA)
  • Amplifiers (AREA)
  • Devices For Supply Of Signal Current (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 産業上の利用分野 本発明は、電話システムのためのライン回路の分野に関
し、そしてさらに具体的には、例えば、米国特許第４．
４８４．０３２号「有効インピーダンス変圧器補助ライ
ン・フィード回路」、第４．５１４．５９５号「監視フ
ィルタリングを有する有効インピーダンス変圧器補助ラ
イン・フィード回路」、及び第４．５７１．４６０号「
改良接地障害保護を有する有効インピーダンス・ライン
・フィード回路」において開示された如く、有効インピ
ーダンス・ライン・フィード回路に関する。
発明の背景 一般的な有効インピーダンス・ライン・フィート回路は
、チップ及びリング端子により２線式通信線に対し励起
電流を供給するために、所定の交流インピーダンス及び
直流抵抗特性を表すように制御されるチップ及びリング
増幅器回路を含む。
有効インピーダンス・ライン・フィード回路は、チップ
及びリング端子と、電気絶縁基板にある皮膜抵抗器回路
網の形式において通常提供されるチップ及びリング・フ
ィード抵抗器とチップ及びリング電圧分周器によりチッ
プ及びリング電圧タップとに結合される。米国特許第４
，５７１．４６０号において開示されたライン・フィー
ド回路は、一対の整合抵抗器によってチップ及びリング
端子に直接に結合された入力を有する直流増幅器を含む
。
直流増幅器の出力は、チップ及びリング電圧タップに抵
抗により結合され、そしてまた、リング増幅器回路の入
力に単向抵抗電流パスにより結合される。
動作において、直流増幅器は、２線式通信線のリング・
リード線がら接地への低抵抗障害結合の場合において障
害電流と関連回路加熱を減少させる。この条件は、通常
、接地障害と呼ばれる。また、正常動作において、直流
増幅器は、ライン・フィード回路の十分な集積回路の実
施態様がさらに容易に製造可能である如く、制御回路の
差動入力の７訣しくは高共通モード拒否特性に対する依
存を減少させる。
特許と、先行技術とラベル付けされた第１図とに示され
た如く、直流増幅器は、反転入力に結合された抵抗器に
より２線式通信線に出現するポテンシャルによって制御
される。このため、これらの抵抗器は、好ましくは、２
ａ式通信線に出現する異常ポテンシャルから直流増幅器
を保護するのを援助するために、非常に高い抵抗値を有
する。
さらに、整合抵抗器の要求された高オーム値は、これら
の要素を集積回路に含むことを、実際上不可能ではない
としても、不都合にする。先行技術の別の欠点は、制御
回路における共通モード拒否に対する依存の減少が、抵
抗値の選択により、平衡トーキング条件又は非平衡リン
ギング条件の両方ではなく１つの条件中に動作のために
最適化されるということである。
米国特許第４．５７１．４６０号において開示された有
効インピーダンス・ライン・フィード回路に同様の動作
特性を有するが、さらに経済的な製造可能回路構成にお
いて、チップ及びリング電圧タップにおける共通モード
信号の改良取り消しを提供する有効インピーダンス・ラ
イン・フィード回路を提供することが発明の目的である
。
発明の要約 発明による有効インピーダンス・ライン・フィード回路
は、それぞれチップ及びリング・フィード抵抗器によっ
てチップ及びリング増幅器の出力に結合されたチップ及
びリング端子により、２線式通信線へ直流励起電流と交
流情報信号を供給するために、チップ及びリング・フィ
ード抵抗器における電流に比例する制御信号に応答する
チップ及びリング増幅器を含む。チップ及びリング電圧
分周器は、チップ及びリング・フィード抵抗器と組み合
わせて結合され、そしてチップ及びリング電圧タップを
含む、制御信号を生成するための制御回路は、チップ及
びリング電圧タップに結合された差動入力を含む。直流
増幅器は、チップ及びリング電圧タップにおける縦信号
を減衰させ、かつ２線式通信線における接地障害条件の
発生中障害電流伝導を減少させるために、チップ及びリ
ング端子における信号に応答する。有効インピーダンス
・ラインニフィード回路は、直流増幅器の反転入力が、
同様のオーム値である抵抗要素の第１対によってチップ
及びリング電圧タップに結合され、そして直流増幅器の
出力がまた、同様のオーム値である抵抗要素の第２対に
よってチップ及びリング電圧タップに結合されることを
特徴とする。
動作において、直流増幅器は、チップ及びリング端子に
おけるポテンシャルに関して減衰電気ポテンシャルを受
ける。このため直流増幅器は、都合の良いことに、有効
インピーダンス・ライン・フィード回路における残りの
増幅器と共に集積回路技術において製造可能である。
有効インピーダンス・ライン・フィード回路は、さらに
、補償回路が、チップ及びリング電圧タップの間に結合
され、かつ制御回路の動作によってチップ及びリング電
圧タップの間に通常導入される如く、非対称電流を補償
するために制御増幅器の出力に応答し、この場合直流増
幅器による接地障害電流制限動作のスレッショルドが、
チップ及びリング電圧タップにおいて出現する差動信号
における変動によって実質的に影響されず、そして制御
回路の共通モード拒否動作要求が緩和されることを特徴
とする。
実施例 第２図と第３図における有効インピーダンス・ライン・
フィード回路の多数の見地は、前述の特許において記載
されたライン・フィード回路の実施例に類似する。この
ため、多数の回路要素は、同様にラベル付けされる。し
かし、前述の特許のいづれかにおいて導入されない回路
要素が、明確にラベル付けされる。
第２図と第３図の各々において、チップ・フィード抵抗
器１２は、チップ端子２と、チップ増幅器回路２０の出
力端子４とに直列に結合される。
チップ・フィード抵抗器１２に同様のオーム値のリング
・フィード抵抗器１３は、リング端子３と、リング増幅
器回路４０の出力端子５とに直列に結合される。チップ
及びリング増幅器回路２０と４０は、一般に、図示され
ていないが、複数のライン回路に共通の電話システムに
おいてバッテリーから電力を供給される。チップ電圧分
周器１４は、チップ電圧タップ６を含み、そして端子４
と３の間に直列に結合される。リング電圧分周器１５は
、リング電圧タップ７を含み、そして端子２と５の間に
直列に結合される。６０における制御回路は、示された
如く、電圧タップ６と７に結合された増幅器２３１の差
動入力を含む、６０における制御回路の出力は、交流情
報信号と監視信号を関連電話システムに提供するために
、監視及び送信リード線に結合される。制御回路６０の
出力はまた、バイアス電圧源Ｖと同様、チップ増幅器回
路２０の非反転入力に抵抗により結合される。
抵抗器４５と４８は、チップ及びリング増幅器回路２０
と４０の出力の間に直列に結合され、そして抵抗器４５
と４８の接合は、リング増幅器回路４０の反転入力に結
合される。抵抗器４５と４８に対するオーム値は、同様
であり、その結果リング増幅器回路４０は、端子４にお
ける信号に関し１の利得を有する逆フォロワーとして機
能することが通常である。このため、チップ及びリング
増幅器回路の出力の動作交流インピーダンス及び直流抵
抗特性は、同様であり、そしてチップ増幅器回路２０の
出力と反転入力の間に示された如く結合された交流及び
直流回路網７８と７９によって主に決定される。
今まで記載された如く、有効インピーダンス・ライン・
フィード回路と共に、２１０−２１９の範囲においてラ
ベルで識別された回路要素は、改良接地障害保護と共通
モード拒否を提供する。
さらに詳ＨＥは、以後直流増幅器２１０ａと呼ばれる差
動増幅器回路は、抵抗器２１８ａと２１９ａと、ダイオ
ード２２０と２２１により、それぞれチップ及びリング
電圧タップ６と７に抵抗により結合された出力を含む。
出力はまた、示された如く、抵抗器２１６と直列に結合
されたダイオード２１５を含む単向抵抗電流バス２１４
により、リング増幅器回路４０の反転入力（こ結合され
る。
この実施例において、コンデンサー２１７は、接の間に
結合される。増幅器２１０ａの反転入力は、同様のオー
ム値である第１対の抵抗要素２１２ａと２１３ａによっ
てチップ及びリング電圧タップ６と７に結合される。直
流増幅器２１０ａの出力は、平行背面対背面構成におい
て配置されたダイオード２２０と２２１の一対と、同様
のオーム値の抵抗要素２１８ａと２１９ａの第２対によ
り、チップ及びリング電圧タップに結合される。６゜に
おける制御回路は、制御増幅器回路と補償増幅器回路を
含む、制御増幅器回路は、差動増幅器２３１を含み、そ
して補償増幅器回路は、差動増幅器２３５を含む。
第２図における回路の動作は、直流増幅器２１０ａの入
力信号が、チップ及びリング端子２と３から直接の代わ
りに、チップ及びリング電圧タップ６と７から取られる
ことを除いて、第１図における先行技術回路と基本的に
同じである。直流増幅器２１０ａは、抵抗器２１８ａと
２１９ａにより、チップ及びリング電圧タップ６と７に
おける信号を事実上取り消すことによって、チップ及び
リング端子において出現する共通モード信号に応答する
。抵抗器２１８ａと２１９ａはまた、直流増幅器２１０
ａに対するフィードバック抵抗器として作用する。
こうして、抵抗要素２１２ａ、２１３ａ、２１８ａと２
１９ａは、２線式通信線において出現する、異常電圧か
ら遮蔽されるために、これらの抵抗要素は、所望の如く
、薄膜技術又は集積シリコン技術のいづれかのために都
合が良い値を有するように規定される。抵抗要素２１２
ａと２１３ａは等しいオーム値を有するべきであるが、
実際値は、これらの要素が通常有効電流を伝えないため
に、決定的ではない、第１図に示された回路についての
小利点は、抵抗器２１２ａと２１３ａが、チップ及びリ
ング端子２と３と直接に結合されず、このためライン回
路によるオン・フック零入力電流消費は、僅かに減少さ
れるという事実から導出される。第１図におけるライン
回路と対比して、第２図における如きライン回路を備え
た一般中央局において、電力消費における測定可能な減
少が達成される。別の利点は、直流増幅器が、通常、ラ
イン・フィード回路の残りと統合されるという点におい
て、第２図における回路配置から導出される。このため
、結果の集積回路に対するビン配置（ｐｉｎ　　ｏｕｔ
　）要求は、削減され、その結果費用が節約される。
第２図における制御増幅器２３１は、増幅器２３１の出
力からのフィードバックが、抵抗器２３２により行われ
るという如き構成において、抵抗器２３２と２３３と結
合される。これは、チップ及びリング電圧タップ６と７
における不都合な負荷効果を避けるために、好ましくは
、補償される非対称配置である。補償増幅器２３５は、
示された如く、抵抗器２３４と２３６と結合されて、提
供される。動作において、補償増幅器２３５の出力は、
チップ電圧タップ６において抵抗器２３３により必要な
対称を提供するために、制御増幅器２３１の出力に関し
て位相反転される。補償作用は、チップ及びリング電圧
タップ６と７を一定ボテンシャルに維持させ、そしてこ
のためチップ及びリング電圧タップ６と７への非対称フ
ィードバックに応答して出現する差動信号に直流増幅器
２１０ａが応答することを防止する。
第３図に示された実施態様は、制御増幅器２３１と補償
増幅器２３５の代替的配置を提供する。
制御増幅器２３１は、動作において、抵抗器２３２ａに
よりリング電圧タップ７に伝導された非対称フィードバ
ック電流は、補償されるという如く、抵抗器２３３ａと
２３２ａと結合される。この実施態様における補償増幅
器２３５は、制御増幅器２３１の出力の位相反転レプリ
カを提供するために、抵抗器２３４ａと２３６ａと結合
される。これは、抵抗器２３７を経て、抵抗器２３８と
２３９の両方を通る補償電流を生成する。
【図面の簡単な説明】
第１図は、前述で議論された先行技術のライン・フィー
ド回路の概略図。 第２図は、発明による有効インピーダンス・ライン・フ
ィード回路の１つの実施例の概略図。 第３図は、発明による有効インピーダンス・ライン・フ
ィード回路の別の実施例の概略図。 ２・・・チップ端子 ３・・・リング端子 ６・・・チップ電圧タップ ７・・・リング電圧タップ １２・・・チップ・フィードバック抵抗１３・・・リン
グ・フィードバック抵抗６０・・・制御回路 ２３１・・・制御増幅器 ２１０・・・直流増幅器 ２３５・・・補償増幅器

Claims (1)

  1. 【特許請求の範囲】 １、それぞれチップ及びリング・フィード抵抗器によっ
    てチップ及びリング増幅器の出力に結合されたチップ及
    びリング端子により、励起電流と交流情報信号を２線式
    通信線に供給するために、チップ及びリング・フィード
    抵抗器における電流に比例する制御信号に応答するチッ
    プ及びリング増幅器と、それぞれチップ及びリング電圧
    タップを含むチップ及びリング電圧分周器と、制御信号
    を生成しかつチップ及びリング電圧タップに結合された
    差動入力を有する制御増幅器を含む制御回路と、チップ
    及びリング電圧タップにおける縦信号を減衰させ、かつ
    ２線式通信線における接地障害条件の発生中障害電流伝
    導を減少させるためにチップ及びリング端子における信
    号に応答する直流増幅器とを含み、直流増幅器の反転入
    力が、同様のオーム値である抵抗要素の第１対によって
    チップ及びリング電圧タップに結合され、そして直流増
    幅器の出力がまた、同様のオーム値である抵抗要素の第
    ２対によってチップ及びリング電圧タップに結合され、
    この場合動作において、直流増幅器は、チップ及びリン
    グ端子におけるポテンシャルと比較して、減衰電気ポテ
    ンシャルを受け、これによって、直流増幅器が、都合の
    良いことに、有効インピーダンス・ライン・フィード回
    路における他の増幅器と共に集積回路技術において製造
    可能であることを特徴とする有効インピーダンス・ライ
    ン・フィード回路。 ２、補償回路が、チップ及びリング電圧タップの間に結
    合され、かつ非対称電流を補償するために制御増幅器の
    出力に応答し、該非対称電流が、制御回路の正常動作に
    よってチップ及びリング電圧タップの間に導入され、こ
    の場合直流増幅器によって制御される接地障害電流制限
    動作のスレッショルドが、チップ及びリング電圧タップ
    において出現する差動信号における変動によって実質的
    に影響されないことをさらに特徴とする特許請求の範囲
    第１項に記載の有効インピーダンス・ライン・フィード
    回路。 ３、制御増幅器の出力が、リング電圧タップに抵抗によ
    り結合され、 制御増幅器の出力と第１増幅器の出力の間に直列に結合
    された第１及び第２抵抗要素の間の接合に結合された反
    転入力を有し、その出力が第３抵抗要素によってチップ
    電圧タップに結合された第１増幅器を具備する補償回路
    をさらに特徴とする特許請求の範囲第２項に記載の有効
    インピーダンス・ライン・フィード回路。 ４、制御増幅器の出力が、リング電圧タップに抵抗によ
    り結合され、 制御増幅器の出力と第１増幅器の出力の間に直列に結合
    された第１及び第２抵抗要素の接合に結合された反転入
    力を有する第１増幅器と、チップ及びリング電圧タップ
    の間に結合された第３及び第４抵抗要素と、第１増幅器
    の出力と第３及び第４抵抗要素の接合の間に直列に結合
    された第５抵抗要素とを具備する補償回路をさらに特徴
    とする特許請求の範囲第２項に記載の有効インピーダン
    ス・ライン・フィード回路。
JP62317679A 1986-12-24 1987-12-17 有効インピーダンス・ライン・フイード回路 Pending JPS63169865A (ja)

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CA000526332A CA1258930A (en) 1986-12-24 1986-12-24 Active impedance line feed circuit
CA526332 1986-12-24

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US (1) US4764956A (ja)
EP (1) EP0272800B1 (ja)
JP (1) JPS63169865A (ja)
CN (1) CN1009897B (ja)
AT (1) ATE84178T1 (ja)
CA (1) CA1258930A (ja)
DE (1) DE3783348T2 (ja)

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