JPS63126939U - - Google Patents
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- Publication number
- JPS63126939U JPS63126939U JP1891087U JP1891087U JPS63126939U JP S63126939 U JPS63126939 U JP S63126939U JP 1891087 U JP1891087 U JP 1891087U JP 1891087 U JP1891087 U JP 1891087U JP S63126939 U JPS63126939 U JP S63126939U
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- JP
- Japan
- Prior art keywords
- active
- target microprocessor
- emulator
- program memory
- target
- Prior art date
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- Pending
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- 230000004044 response Effects 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 2
- 239000000523 sample Substances 0.000 description 1
Landscapes
- Test And Diagnosis Of Digital Computers (AREA)
Description
第１図は本考案に係るインサーキツト・エミユ
レータの一実施例を示す構成図、第２図は本考案
の要部構成図、第３図は動作を説明するためのタ
イムチヤートである。
１０…ターゲツト・ボード、１１…ターゲツト
・マイクロプロセツサ、２０…プローブ、３０…
エミユレータ本体、５０…ターゲツト・マイクロ
プロセツサ、５１…アドレス・デコーダ、５２…
アクテイブ・プログラム・メモリ、５３…データ
バス・バツフア、５４…アクテイブ・シーケンス
回路。
FIG. 1 is a block diagram showing an embodiment of an in-circuit emulator according to the present invention, FIG. 2 is a block diagram of the main parts of the present invention, and FIG. 3 is a time chart for explaining the operation. DESCRIPTION OF SYMBOLS 10...Target board, 11...Target microprocessor, 20...Probe, 30...
Emulator body, 50...Target microprocessor, 51...Address decoder, 52...
Active program memory, 53...Data bus buffer, 54...Active sequence circuit.
Claims (1)
置としてのインサーキツト・エミユレータにおい
て、 アクテイブ・プログラムが格納されたアクテイ
ブ・プログラム・メモリと、 前記ターゲツト・マイクロプロセツサから出力
されるアドレスをデコードして前記アクテイブ・
プログラム・メモリをセレクトすると共に、ベク
タ・フエツチを検出するアドレス・デコーダと、 エミユレータ本体側からのアクテイブ要求信号
に応じて、ターゲツト・マイクロプロセツサに最
優先割り込みを発生させ、ターゲツト・マイクロ
プロセツサからアクノリツジ信号が返送されると
ターゲツト・マイクロプロセツサが前記アクテイ
ブ・プログラム・メモリに格納されているアクテ
イブ・プログラムを読取り実行できるように制御
するアクテイブ・シーケンス回路と を具備したことを特徴とするインサーキツト・エ
ミユレータ。[Scope of Claim for Utility Model Registration] In an incircuit emulator as a development support device for a target microprocessor, an active program memory storing an active program and an address output from the target microprocessor are provided. Decode the active
In addition to selecting the program memory, a top priority interrupt is generated to the target microprocessor in response to an active request signal from the address decoder that detects a vector fetch and the emulator main body, and the target microprocessor and an active sequence circuit for controlling the target microprocessor to read and execute the active program stored in the active program memory when an acknowledge signal is returned. Emulator.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1891087U JPS63126939U (en) | 1987-02-12 | 1987-02-12 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1891087U JPS63126939U (en) | 1987-02-12 | 1987-02-12 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS63126939U true JPS63126939U (en) | 1988-08-19 |
Family
ID=30813023
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1891087U Pending JPS63126939U (en) | 1987-02-12 | 1987-02-12 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS63126939U (en) |
-
1987
- 1987-02-12 JP JP1891087U patent/JPS63126939U/ja active Pending
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