JPS6289039U - - Google Patents
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- Publication number
- JPS6289039U JPS6289039U JP17921785U JP17921785U JPS6289039U JP S6289039 U JPS6289039 U JP S6289039U JP 17921785 U JP17921785 U JP 17921785U JP 17921785 U JP17921785 U JP 17921785U JP S6289039 U JPS6289039 U JP S6289039U
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- flip
- mismatch
- flops
- input terminals
- Prior art date
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- Pending
Links
- 238000001514 detection method Methods 0.000 claims description 3
- 208000011580 syndromic disease Diseases 0.000 claims description 3
- 238000010586 diagram Methods 0.000 description 2
Description
第１図は本考案に係る復号回路を示す図、第２
図は従来回路を示す図である。 １…不一致回路群、２…Ｄフリツプフロツプ群
、４，５…バツフア群、８…シンドローム演算回
路、９…誤り位置検出回路。
図は従来回路を示す図である。 １…不一致回路群、２…Ｄフリツプフロツプ群
、４，５…バツフア群、８…シンドローム演算回
路、９…誤り位置検出回路。
Claims (1)
- 誤り訂正符号によるシンドローム計算と誤り位
置検出を行なう復号回路に於いて、符号語を構成
するＮビツトのパラレル信号をＮ個の不一致回路
の一方の入力端子に夫々接続すると共に、該不一
致回路の出力端子をＮ個のＤフリツプフロツプの
データ入力端子に夫々接続し、該Ｄフリツプフロ
ツプの各出力端子は、制御信号により第１及び第
２の接続モードに切替えが可能な選択回路を介し
て前記Ｎ個の不一致回路の他方の各入力端子にフ
イードバツクされ、該不一致回路群及びＤフリツ
プフロツプ群は、選択回路の第１の接続モードに
てシンドローム演算回路を構成し、第２の接続モ
ードにて誤り位置検出回路を構成することを特徴
とする誤り訂正符号の復号回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17921785U JPS6289039U (ja) | 1985-11-20 | 1985-11-20 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17921785U JPS6289039U (ja) | 1985-11-20 | 1985-11-20 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6289039U true JPS6289039U (ja) | 1987-06-06 |
Family
ID=31122081
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP17921785U Pending JPS6289039U (ja) | 1985-11-20 | 1985-11-20 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6289039U (ja) |
-
1985
- 1985-11-20 JP JP17921785U patent/JPS6289039U/ja active Pending
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